LLVM  4.0.0
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AMDGPUISelLowering.h File Reference

Interface definition of the TargetLowering class that is common to all AMD GPUs. More...

#include "llvm/Target/TargetLowering.h"
Include dependency graph for AMDGPUISelLowering.h:
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Classes

class  llvm::AMDGPUTargetLowering
 

Namespaces

 llvm
 Compute iterated dominance frontiers using a linear time algorithm.
 
 llvm::AMDGPUISD
 

Enumerations

enum  llvm::AMDGPUISD::NodeType : unsigned {
  llvm::AMDGPUISD::FIRST_NUMBER = ISD::BUILTIN_OP_END, llvm::AMDGPUISD::CALL, llvm::AMDGPUISD::UMUL, llvm::AMDGPUISD::BRANCH_COND,
  llvm::AMDGPUISD::ENDPGM, llvm::AMDGPUISD::RETURN, llvm::AMDGPUISD::DWORDADDR, llvm::AMDGPUISD::FRACT,
  llvm::AMDGPUISD::CLAMP, llvm::AMDGPUISD::SETCC, llvm::AMDGPUISD::SETREG, llvm::AMDGPUISD::FMA_W_CHAIN,
  llvm::AMDGPUISD::FMUL_W_CHAIN, llvm::AMDGPUISD::COS_HW, llvm::AMDGPUISD::SIN_HW, llvm::AMDGPUISD::FMAX_LEGACY,
  llvm::AMDGPUISD::FMIN_LEGACY, llvm::AMDGPUISD::FMAX3, llvm::AMDGPUISD::SMAX3, llvm::AMDGPUISD::UMAX3,
  llvm::AMDGPUISD::FMIN3, llvm::AMDGPUISD::SMIN3, llvm::AMDGPUISD::UMIN3, llvm::AMDGPUISD::FMED3,
  llvm::AMDGPUISD::SMED3, llvm::AMDGPUISD::UMED3, llvm::AMDGPUISD::URECIP, llvm::AMDGPUISD::DIV_SCALE,
  llvm::AMDGPUISD::DIV_FMAS, llvm::AMDGPUISD::DIV_FIXUP, llvm::AMDGPUISD::TRIG_PREOP, llvm::AMDGPUISD::RCP,
  llvm::AMDGPUISD::RSQ, llvm::AMDGPUISD::RCP_LEGACY, llvm::AMDGPUISD::RSQ_LEGACY, llvm::AMDGPUISD::FMUL_LEGACY,
  llvm::AMDGPUISD::RSQ_CLAMP, llvm::AMDGPUISD::LDEXP, llvm::AMDGPUISD::FP_CLASS, llvm::AMDGPUISD::DOT4,
  llvm::AMDGPUISD::CARRY, llvm::AMDGPUISD::BORROW, llvm::AMDGPUISD::BFE_U32, llvm::AMDGPUISD::BFE_I32,
  llvm::AMDGPUISD::BFI, llvm::AMDGPUISD::BFM, llvm::AMDGPUISD::FFBH_U32, llvm::AMDGPUISD::FFBH_I32,
  llvm::AMDGPUISD::MUL_U24, llvm::AMDGPUISD::MUL_I24, llvm::AMDGPUISD::MULHI_U24, llvm::AMDGPUISD::MULHI_I24,
  llvm::AMDGPUISD::MAD_U24, llvm::AMDGPUISD::MAD_I24, llvm::AMDGPUISD::MUL_LOHI_I24, llvm::AMDGPUISD::MUL_LOHI_U24,
  llvm::AMDGPUISD::TEXTURE_FETCH, llvm::AMDGPUISD::EXPORT, llvm::AMDGPUISD::EXPORT_DONE, llvm::AMDGPUISD::R600_EXPORT,
  llvm::AMDGPUISD::CONST_ADDRESS, llvm::AMDGPUISD::REGISTER_LOAD, llvm::AMDGPUISD::REGISTER_STORE, llvm::AMDGPUISD::LOAD_INPUT,
  llvm::AMDGPUISD::SAMPLE, llvm::AMDGPUISD::SAMPLEB, llvm::AMDGPUISD::SAMPLED, llvm::AMDGPUISD::SAMPLEL,
  llvm::AMDGPUISD::CVT_F32_UBYTE0, llvm::AMDGPUISD::CVT_F32_UBYTE1, llvm::AMDGPUISD::CVT_F32_UBYTE2, llvm::AMDGPUISD::CVT_F32_UBYTE3,
  llvm::AMDGPUISD::BUILD_VERTICAL_VECTOR, llvm::AMDGPUISD::CONST_DATA_PTR, llvm::AMDGPUISD::SENDMSG, llvm::AMDGPUISD::SENDMSGHALT,
  llvm::AMDGPUISD::INTERP_MOV, llvm::AMDGPUISD::INTERP_P1, llvm::AMDGPUISD::INTERP_P2, llvm::AMDGPUISD::PC_ADD_REL_OFFSET,
  llvm::AMDGPUISD::KILL, llvm::AMDGPUISD::DUMMY_CHAIN, llvm::AMDGPUISD::FIRST_MEM_OPCODE_NUMBER = ISD::FIRST_TARGET_MEMORY_OPCODE, llvm::AMDGPUISD::STORE_MSKOR,
  llvm::AMDGPUISD::LOAD_CONSTANT, llvm::AMDGPUISD::TBUFFER_STORE_FORMAT, llvm::AMDGPUISD::ATOMIC_CMP_SWAP, llvm::AMDGPUISD::ATOMIC_INC,
  llvm::AMDGPUISD::ATOMIC_DEC, llvm::AMDGPUISD::BUFFER_LOAD, llvm::AMDGPUISD::BUFFER_LOAD_FORMAT, llvm::AMDGPUISD::LAST_AMDGPU_ISD_NUMBER
}
 

Detailed Description

Interface definition of the TargetLowering class that is common to all AMD GPUs.

Definition in file AMDGPUISelLowering.h.