LCOV - code coverage report
Current view: top level - build-llvm/lib/Target/AArch64 - AArch64GenAsmWriter.inc (source / functions) Hit Total Coverage
Test: llvm-toolchain.info Lines: 7014 7332 95.7 %
Date: 2018-07-13 00:08:38 Functions: 5 5 100.0 %
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          Line data    Source code
       1             : /*===- TableGen'erated file -------------------------------------*- C++ -*-===*\
       2             : |*                                                                            *|
       3             : |* Assembly Writer Source Fragment                                            *|
       4             : |*                                                                            *|
       5             : |* Automatically generated file, do not edit!                                 *|
       6             : |*                                                                            *|
       7             : \*===----------------------------------------------------------------------===*/
       8             : 
       9             : /// printInstruction - This method is automatically generated by tablegen
      10             : /// from the instruction set description.
      11       50637 : void AArch64InstPrinter::printInstruction(const MCInst *MI, const MCSubtargetInfo &STI, raw_ostream &O) {
      12             :   static const char AsmStrs[] = {
      13             :   /* 0 */ 's', 'h', 'a', '1', 's', 'u', '0', 9, 0,
      14             :   /* 9 */ 's', 'h', 'a', '2', '5', '6', 's', 'u', '0', 9, 0,
      15             :   /* 20 */ 'l', 'd', '1', 9, 0,
      16             :   /* 25 */ 't', 'r', 'n', '1', 9, 0,
      17             :   /* 31 */ 'z', 'i', 'p', '1', 9, 0,
      18             :   /* 37 */ 'u', 'z', 'p', '1', 9, 0,
      19             :   /* 43 */ 'd', 'c', 'p', 's', '1', 9, 0,
      20             :   /* 50 */ 's', 't', '1', 9, 0,
      21             :   /* 55 */ 's', 'h', 'a', '1', 's', 'u', '1', 9, 0,
      22             :   /* 64 */ 's', 'h', 'a', '2', '5', '6', 's', 'u', '1', 9, 0,
      23             :   /* 75 */ 'r', 'e', 'v', '3', '2', 9, 0,
      24             :   /* 82 */ 'l', 'd', '2', 9, 0,
      25             :   /* 87 */ 's', 'h', 'a', '2', '5', '6', 'h', '2', 9, 0,
      26             :   /* 97 */ 's', 'a', 'b', 'a', 'l', '2', 9, 0,
      27             :   /* 105 */ 'u', 'a', 'b', 'a', 'l', '2', 9, 0,
      28             :   /* 113 */ 's', 'q', 'd', 'm', 'l', 'a', 'l', '2', 9, 0,
      29             :   /* 123 */ 's', 'm', 'l', 'a', 'l', '2', 9, 0,
      30             :   /* 131 */ 'u', 'm', 'l', 'a', 'l', '2', 9, 0,
      31             :   /* 139 */ 's', 's', 'u', 'b', 'l', '2', 9, 0,
      32             :   /* 147 */ 'u', 's', 'u', 'b', 'l', '2', 9, 0,
      33             :   /* 155 */ 's', 'a', 'b', 'd', 'l', '2', 9, 0,
      34             :   /* 163 */ 'u', 'a', 'b', 'd', 'l', '2', 9, 0,
      35             :   /* 171 */ 's', 'a', 'd', 'd', 'l', '2', 9, 0,
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      37             :   /* 187 */ 's', 's', 'h', 'l', 'l', '2', 9, 0,
      38             :   /* 195 */ 'u', 's', 'h', 'l', 'l', '2', 9, 0,
      39             :   /* 203 */ 's', 'q', 'd', 'm', 'u', 'l', 'l', '2', 9, 0,
      40             :   /* 213 */ 'p', 'm', 'u', 'l', 'l', '2', 9, 0,
      41             :   /* 221 */ 's', 'm', 'u', 'l', 'l', '2', 9, 0,
      42             :   /* 229 */ 'u', 'm', 'u', 'l', 'l', '2', 9, 0,
      43             :   /* 237 */ 's', 'q', 'd', 'm', 'l', 's', 'l', '2', 9, 0,
      44             :   /* 247 */ 's', 'm', 'l', 's', 'l', '2', 9, 0,
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      47             :   /* 271 */ 'r', 's', 'u', 'b', 'h', 'n', '2', 9, 0,
      48             :   /* 280 */ 'r', 'a', 'd', 'd', 'h', 'n', '2', 9, 0,
      49             :   /* 289 */ 's', 'q', 's', 'h', 'r', 'n', '2', 9, 0,
      50             :   /* 298 */ 'u', 'q', 's', 'h', 'r', 'n', '2', 9, 0,
      51             :   /* 307 */ 's', 'q', 'r', 's', 'h', 'r', 'n', '2', 9, 0,
      52             :   /* 317 */ 'u', 'q', 'r', 's', 'h', 'r', 'n', '2', 9, 0,
      53             :   /* 327 */ 't', 'r', 'n', '2', 9, 0,
      54             :   /* 333 */ 'f', 'c', 'v', 't', 'n', '2', 9, 0,
      55             :   /* 341 */ 's', 'q', 'x', 't', 'n', '2', 9, 0,
      56             :   /* 349 */ 'u', 'q', 'x', 't', 'n', '2', 9, 0,
      57             :   /* 357 */ 's', 'q', 's', 'h', 'r', 'u', 'n', '2', 9, 0,
      58             :   /* 367 */ 's', 'q', 'r', 's', 'h', 'r', 'u', 'n', '2', 9, 0,
      59             :   /* 378 */ 's', 'q', 'x', 't', 'u', 'n', '2', 9, 0,
      60             :   /* 387 */ 'f', 'c', 'v', 't', 'x', 'n', '2', 9, 0,
      61             :   /* 396 */ 'z', 'i', 'p', '2', 9, 0,
      62             :   /* 402 */ 'u', 'z', 'p', '2', 9, 0,
      63             :   /* 408 */ 'd', 'c', 'p', 's', '2', 9, 0,
      64             :   /* 415 */ 's', 't', '2', 9, 0,
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      67             :   /* 436 */ 's', 'a', 'd', 'd', 'w', '2', 9, 0,
      68             :   /* 444 */ 'u', 'a', 'd', 'd', 'w', '2', 9, 0,
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      70             :   /* 457 */ 'd', 'c', 'p', 's', '3', 9, 0,
      71             :   /* 464 */ 's', 't', '3', 9, 0,
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      78             :   /* 508 */ 'b', 'r', 'a', 'a', 9, 0,
      79             :   /* 514 */ 'l', 'd', 'r', 'a', 'a', 9, 0,
      80             :   /* 521 */ 'b', 'l', 'r', 'a', 'a', 9, 0,
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      82             :   /* 534 */ 'u', 'a', 'b', 'a', 9, 0,
      83             :   /* 540 */ 'p', 'a', 'c', 'd', 'a', 9, 0,
      84             :   /* 547 */ 'l', 'd', 'a', 'd', 'd', 'a', 9, 0,
      85             :   /* 555 */ 'a', 'u', 't', 'd', 'a', 9, 0,
      86             :   /* 562 */ 'p', 'a', 'c', 'g', 'a', 9, 0,
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      88             :   /* 576 */ 'a', 'u', 't', 'i', 'a', 9, 0,
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     108             :   /* 725 */ 'p', 'a', 'c', 'i', 'z', 'a', 9, 0,
     109             :   /* 733 */ 'a', 'u', 't', 'i', 'z', 'a', 9, 0,
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     111             :   /* 747 */ 'l', 'd', 'f', 'f', '1', 'b', 9, 0,
     112             :   /* 755 */ 'l', 'd', 'n', 'f', '1', 'b', 9, 0,
     113             :   /* 763 */ 'l', 'd', 'n', 't', '1', 'b', 9, 0,
     114             :   /* 771 */ 's', 't', 'n', 't', '1', 'b', 9, 0,
     115             :   /* 779 */ 's', 't', '1', 'b', 9, 0,
     116             :   /* 785 */ 'c', 'r', 'c', '3', '2', 'b', 9, 0,
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     124             :   /* 838 */ 'l', 'd', 's', 'm', 'i', 'n', 'a', 'b', 9, 0,
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     138             :   /* 956 */ 'u', 'q', 'd', 'e', 'c', 'b', 9, 0,
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     145             :   /* 1008 */ 'p', 'a', 'c', 'i', 'b', 9, 0,
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     147             :   /* 1022 */ 'l', 'd', 'a', 'd', 'd', 'a', 'l', 'b', 9, 0,
     148             :   /* 1032 */ 'l', 'd', 's', 'm', 'i', 'n', 'a', 'l', 'b', 9, 0,
     149             :   /* 1043 */ 'l', 'd', 'u', 'm', 'i', 'n', 'a', 'l', 'b', 9, 0,
     150             :   /* 1054 */ 's', 'w', 'p', 'a', 'l', 'b', 9, 0,
     151             :   /* 1062 */ 'l', 'd', 'c', 'l', 'r', 'a', 'l', 'b', 9, 0,
     152             :   /* 1072 */ 'l', 'd', 'e', 'o', 'r', 'a', 'l', 'b', 9, 0,
     153             :   /* 1082 */ 'c', 'a', 's', 'a', 'l', 'b', 9, 0,
     154             :   /* 1090 */ 'l', 'd', 's', 'e', 't', 'a', 'l', 'b', 9, 0,
     155             :   /* 1100 */ 'l', 'd', 's', 'm', 'a', 'x', 'a', 'l', 'b', 9, 0,
     156             :   /* 1111 */ 'l', 'd', 'u', 'm', 'a', 'x', 'a', 'l', 'b', 9, 0,
     157             :   /* 1122 */ 'l', 'd', 'a', 'd', 'd', 'l', 'b', 9, 0,
     158             :   /* 1131 */ 'l', 'd', 's', 'm', 'i', 'n', 'l', 'b', 9, 0,
     159             :   /* 1141 */ 'l', 'd', 'u', 'm', 'i', 'n', 'l', 'b', 9, 0,
     160             :   /* 1151 */ 's', 'w', 'p', 'l', 'b', 9, 0,
     161             :   /* 1158 */ 'l', 'd', 'c', 'l', 'r', 'l', 'b', 9, 0,
     162             :   /* 1167 */ 'l', 'd', 'e', 'o', 'r', 'l', 'b', 9, 0,
     163             :   /* 1176 */ 'c', 'a', 's', 'l', 'b', 9, 0,
     164             :   /* 1183 */ 'l', 'd', 's', 'e', 't', 'l', 'b', 9, 0,
     165             :   /* 1192 */ 'l', 'd', 's', 'm', 'a', 'x', 'l', 'b', 9, 0,
     166             :   /* 1202 */ 'l', 'd', 'u', 'm', 'a', 'x', 'l', 'b', 9, 0,
     167             :   /* 1212 */ 'd', 'm', 'b', 9, 0,
     168             :   /* 1217 */ 'l', 'd', 's', 'm', 'i', 'n', 'b', 9, 0,
     169             :   /* 1226 */ 'l', 'd', 'u', 'm', 'i', 'n', 'b', 9, 0,
     170             :   /* 1235 */ 's', 'w', 'p', 'b', 9, 0,
     171             :   /* 1241 */ 'l', 'd', '1', 'r', 'q', 'b', 9, 0,
     172             :   /* 1249 */ 'l', 'd', '1', 'r', 'b', 9, 0,
     173             :   /* 1256 */ 'l', 'd', 'a', 'r', 'b', 9, 0,
     174             :   /* 1263 */ 'l', 'd', 'l', 'a', 'r', 'b', 9, 0,
     175             :   /* 1271 */ 'l', 'd', 'r', 'b', 9, 0,
     176             :   /* 1277 */ 'l', 'd', 'c', 'l', 'r', 'b', 9, 0,
     177             :   /* 1285 */ 's', 't', 'l', 'l', 'r', 'b', 9, 0,
     178             :   /* 1293 */ 's', 't', 'l', 'r', 'b', 9, 0,
     179             :   /* 1300 */ 'l', 'd', 'e', 'o', 'r', 'b', 9, 0,
     180             :   /* 1308 */ 'l', 'd', 'a', 'p', 'r', 'b', 9, 0,
     181             :   /* 1316 */ 'l', 'd', 't', 'r', 'b', 9, 0,
     182             :   /* 1323 */ 's', 't', 'r', 'b', 9, 0,
     183             :   /* 1329 */ 's', 't', 't', 'r', 'b', 9, 0,
     184             :   /* 1336 */ 'l', 'd', 'u', 'r', 'b', 9, 0,
     185             :   /* 1343 */ 's', 't', 'u', 'r', 'b', 9, 0,
     186             :   /* 1350 */ 'l', 'd', 'a', 'x', 'r', 'b', 9, 0,
     187             :   /* 1358 */ 'l', 'd', 'x', 'r', 'b', 9, 0,
     188             :   /* 1365 */ 's', 't', 'l', 'x', 'r', 'b', 9, 0,
     189             :   /* 1373 */ 's', 't', 'x', 'r', 'b', 9, 0,
     190             :   /* 1380 */ 'l', 'd', '1', 's', 'b', 9, 0,
     191             :   /* 1387 */ 'l', 'd', 'f', 'f', '1', 's', 'b', 9, 0,
     192             :   /* 1396 */ 'l', 'd', 'n', 'f', '1', 's', 'b', 9, 0,
     193             :   /* 1405 */ 'c', 'a', 's', 'b', 9, 0,
     194             :   /* 1411 */ 'd', 's', 'b', 9, 0,
     195             :   /* 1416 */ 'i', 's', 'b', 9, 0,
     196             :   /* 1421 */ 'l', 'd', '1', 'r', 's', 'b', 9, 0,
     197             :   /* 1429 */ 'l', 'd', 'r', 's', 'b', 9, 0,
     198             :   /* 1436 */ 'l', 'd', 't', 'r', 's', 'b', 9, 0,
     199             :   /* 1444 */ 'l', 'd', 'u', 'r', 's', 'b', 9, 0,
     200             :   /* 1452 */ 't', 's', 'b', 9, 0,
     201             :   /* 1457 */ 'l', 'd', 's', 'e', 't', 'b', 9, 0,
     202             :   /* 1465 */ 'c', 'n', 't', 'b', 9, 0,
     203             :   /* 1471 */ 's', 'x', 't', 'b', 9, 0,
     204             :   /* 1477 */ 'u', 'x', 't', 'b', 9, 0,
     205             :   /* 1483 */ 'f', 's', 'u', 'b', 9, 0,
     206             :   /* 1489 */ 's', 'h', 's', 'u', 'b', 9, 0,
     207             :   /* 1496 */ 'u', 'h', 's', 'u', 'b', 9, 0,
     208             :   /* 1503 */ 'f', 'm', 's', 'u', 'b', 9, 0,
     209             :   /* 1510 */ 'f', 'n', 'm', 's', 'u', 'b', 9, 0,
     210             :   /* 1518 */ 's', 'q', 's', 'u', 'b', 9, 0,
     211             :   /* 1525 */ 'u', 'q', 's', 'u', 'b', 9, 0,
     212             :   /* 1532 */ 'l', 'd', 's', 'm', 'a', 'x', 'b', 9, 0,
     213             :   /* 1541 */ 'l', 'd', 'u', 'm', 'a', 'x', 'b', 9, 0,
     214             :   /* 1550 */ 'p', 'a', 'c', 'd', 'z', 'b', 9, 0,
     215             :   /* 1558 */ 'a', 'u', 't', 'd', 'z', 'b', 9, 0,
     216             :   /* 1566 */ 'p', 'a', 'c', 'i', 'z', 'b', 9, 0,
     217             :   /* 1574 */ 'a', 'u', 't', 'i', 'z', 'b', 9, 0,
     218             :   /* 1582 */ 's', 'h', 'a', '1', 'c', 9, 0,
     219             :   /* 1589 */ 's', 'b', 'c', 9, 0,
     220             :   /* 1594 */ 'a', 'd', 'c', 9, 0,
     221             :   /* 1599 */ 'b', 'i', 'c', 9, 0,
     222             :   /* 1604 */ 'a', 'e', 's', 'i', 'm', 'c', 9, 0,
     223             :   /* 1612 */ 'a', 'e', 's', 'm', 'c', 9, 0,
     224             :   /* 1619 */ 'c', 's', 'i', 'n', 'c', 9, 0,
     225             :   /* 1626 */ 'h', 'v', 'c', 9, 0,
     226             :   /* 1631 */ 's', 'v', 'c', 9, 0,
     227             :   /* 1636 */ 'l', 'd', '1', 'd', 9, 0,
     228             :   /* 1642 */ 'l', 'd', 'f', 'f', '1', 'd', 9, 0,
     229             :   /* 1650 */ 'l', 'd', 'n', 'f', '1', 'd', 9, 0,
     230             :   /* 1658 */ 'l', 'd', 'n', 't', '1', 'd', 9, 0,
     231             :   /* 1666 */ 's', 't', 'n', 't', '1', 'd', 9, 0,
     232             :   /* 1674 */ 's', 't', '1', 'd', 9, 0,
     233             :   /* 1680 */ 'l', 'd', '2', 'd', 9, 0,
     234             :   /* 1686 */ 's', 't', '2', 'd', 9, 0,
     235             :   /* 1692 */ 'l', 'd', '3', 'd', 9, 0,
     236             :   /* 1698 */ 's', 't', '3', 'd', 9, 0,
     237             :   /* 1704 */ 'l', 'd', '4', 'd', 9, 0,
     238             :   /* 1710 */ 's', 't', '4', 'd', 9, 0,
     239             :   /* 1716 */ 'f', 'a', 'b', 'd', 9, 0,
     240             :   /* 1722 */ 's', 'a', 'b', 'd', 9, 0,
     241             :   /* 1728 */ 'u', 'a', 'b', 'd', 9, 0,
     242             :   /* 1734 */ 'x', 'p', 'a', 'c', 'd', 9, 0,
     243             :   /* 1741 */ 's', 'q', 'd', 'e', 'c', 'd', 9, 0,
     244             :   /* 1749 */ 'u', 'q', 'd', 'e', 'c', 'd', 9, 0,
     245             :   /* 1757 */ 's', 'q', 'i', 'n', 'c', 'd', 9, 0,
     246             :   /* 1765 */ 'u', 'q', 'i', 'n', 'c', 'd', 9, 0,
     247             :   /* 1773 */ 'f', 'c', 'a', 'd', 'd', 9, 0,
     248             :   /* 1780 */ 'l', 'd', 'a', 'd', 'd', 9, 0,
     249             :   /* 1787 */ 'f', 'a', 'd', 'd', 9, 0,
     250             :   /* 1793 */ 's', 'r', 'h', 'a', 'd', 'd', 9, 0,
     251             :   /* 1801 */ 'u', 'r', 'h', 'a', 'd', 'd', 9, 0,
     252             :   /* 1809 */ 's', 'h', 'a', 'd', 'd', 9, 0,
     253             :   /* 1816 */ 'u', 'h', 'a', 'd', 'd', 9, 0,
     254             :   /* 1823 */ 'f', 'm', 'a', 'd', 'd', 9, 0,
     255             :   /* 1830 */ 'f', 'n', 'm', 'a', 'd', 'd', 9, 0,
     256             :   /* 1838 */ 'u', 's', 'q', 'a', 'd', 'd', 9, 0,
     257             :   /* 1846 */ 's', 'u', 'q', 'a', 'd', 'd', 9, 0,
     258             :   /* 1854 */ 'p', 'r', 'f', 'd', 9, 0,
     259             :   /* 1860 */ 'n', 'a', 'n', 'd', 9, 0,
     260             :   /* 1866 */ 'l', 'd', '1', 'r', 'q', 'd', 9, 0,
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     272             :   /* 1948 */ 'f', 'r', 'e', 'c', 'p', 'e', 9, 0,
     273             :   /* 1956 */ 'u', 'r', 'e', 'c', 'p', 'e', 9, 0,
     274             :   /* 1964 */ 'f', 'c', 'c', 'm', 'p', 'e', 9, 0,
     275             :   /* 1972 */ 'f', 'c', 'm', 'p', 'e', 9, 0,
     276             :   /* 1979 */ 'a', 'e', 's', 'e', 9, 0,
     277             :   /* 1985 */ 'f', 'r', 's', 'q', 'r', 't', 'e', 9, 0,
     278             :   /* 1994 */ 'u', 'r', 's', 'q', 'r', 't', 'e', 9, 0,
     279             :   /* 2003 */ 'p', 't', 'r', 'u', 'e', 9, 0,
     280             :   /* 2010 */ 'b', 'i', 'f', 9, 0,
     281             :   /* 2015 */ 'r', 'm', 'i', 'f', 9, 0,
     282             :   /* 2021 */ 's', 'c', 'v', 't', 'f', 9, 0,
     283             :   /* 2028 */ 'u', 'c', 'v', 't', 'f', 9, 0,
     284             :   /* 2035 */ 'f', 'n', 'e', 'g', 9, 0,
     285             :   /* 2041 */ 's', 'q', 'n', 'e', 'g', 9, 0,
     286             :   /* 2048 */ 'c', 's', 'n', 'e', 'g', 9, 0,
     287             :   /* 2055 */ 's', 'h', 'a', '1', 'h', 9, 0,
     288             :   /* 2062 */ 'l', 'd', '1', 'h', 9, 0,
     289             :   /* 2068 */ 'l', 'd', 'f', 'f', '1', 'h', 9, 0,
     290             :   /* 2076 */ 'l', 'd', 'n', 'f', '1', 'h', 9, 0,
     291             :   /* 2084 */ 'l', 'd', 'n', 't', '1', 'h', 9, 0,
     292             :   /* 2092 */ 's', 't', 'n', 't', '1', 'h', 9, 0,
     293             :   /* 2100 */ 's', 't', '1', 'h', 9, 0,
     294             :   /* 2106 */ 'c', 'r', 'c', '3', '2', 'h', 9, 0,
     295             :   /* 2114 */ 'l', 'd', '2', 'h', 9, 0,
     296             :   /* 2120 */ 's', 't', '2', 'h', 9, 0,
     297             :   /* 2126 */ 'l', 'd', '3', 'h', 9, 0,
     298             :   /* 2132 */ 's', 't', '3', 'h', 9, 0,
     299             :   /* 2138 */ 'l', 'd', '4', 'h', 9, 0,
     300             :   /* 2144 */ 's', 't', '4', 'h', 9, 0,
     301             :   /* 2150 */ 's', 'h', 'a', '2', '5', '6', 'h', 9, 0,
     302             :   /* 2159 */ 'l', 'd', 'a', 'd', 'd', 'a', 'h', 9, 0,
     303             :   /* 2168 */ 's', 'q', 'r', 'd', 'm', 'l', 'a', 'h', 9, 0,
     304             :   /* 2178 */ 'l', 'd', 's', 'm', 'i', 'n', 'a', 'h', 9, 0,
     305             :   /* 2188 */ 'l', 'd', 'u', 'm', 'i', 'n', 'a', 'h', 9, 0,
     306             :   /* 2198 */ 's', 'w', 'p', 'a', 'h', 9, 0,
     307             :   /* 2205 */ 'l', 'd', 'c', 'l', 'r', 'a', 'h', 9, 0,
     308             :   /* 2214 */ 'l', 'd', 'e', 'o', 'r', 'a', 'h', 9, 0,
     309             :   /* 2223 */ 'c', 'a', 's', 'a', 'h', 9, 0,
     310             :   /* 2230 */ 'l', 'd', 's', 'e', 't', 'a', 'h', 9, 0,
     311             :   /* 2239 */ 'l', 'd', 's', 'm', 'a', 'x', 'a', 'h', 9, 0,
     312             :   /* 2249 */ 'l', 'd', 'u', 'm', 'a', 'x', 'a', 'h', 9, 0,
     313             :   /* 2259 */ 'c', 'r', 'c', '3', '2', 'c', 'h', 9, 0,
     314             :   /* 2268 */ 's', 'q', 'd', 'e', 'c', 'h', 9, 0,
     315             :   /* 2276 */ 'u', 'q', 'd', 'e', 'c', 'h', 9, 0,
     316             :   /* 2284 */ 's', 'q', 'i', 'n', 'c', 'h', 9, 0,
     317             :   /* 2292 */ 'u', 'q', 'i', 'n', 'c', 'h', 9, 0,
     318             :   /* 2300 */ 'l', 'd', 'a', 'd', 'd', 'h', 9, 0,
     319             :   /* 2308 */ 'p', 'r', 'f', 'h', 9, 0,
     320             :   /* 2314 */ 'l', 'd', 'a', 'd', 'd', 'a', 'l', 'h', 9, 0,
     321             :   /* 2324 */ 'l', 'd', 's', 'm', 'i', 'n', 'a', 'l', 'h', 9, 0,
     322             :   /* 2335 */ 'l', 'd', 'u', 'm', 'i', 'n', 'a', 'l', 'h', 9, 0,
     323             :   /* 2346 */ 's', 'w', 'p', 'a', 'l', 'h', 9, 0,
     324             :   /* 2354 */ 'l', 'd', 'c', 'l', 'r', 'a', 'l', 'h', 9, 0,
     325             :   /* 2364 */ 'l', 'd', 'e', 'o', 'r', 'a', 'l', 'h', 9, 0,
     326             :   /* 2374 */ 'c', 'a', 's', 'a', 'l', 'h', 9, 0,
     327             :   /* 2382 */ 'l', 'd', 's', 'e', 't', 'a', 'l', 'h', 9, 0,
     328             :   /* 2392 */ 'l', 'd', 's', 'm', 'a', 'x', 'a', 'l', 'h', 9, 0,
     329             :   /* 2403 */ 'l', 'd', 'u', 'm', 'a', 'x', 'a', 'l', 'h', 9, 0,
     330             :   /* 2414 */ 'l', 'd', 'a', 'd', 'd', 'l', 'h', 9, 0,
     331             :   /* 2423 */ 'l', 'd', 's', 'm', 'i', 'n', 'l', 'h', 9, 0,
     332             :   /* 2433 */ 'l', 'd', 'u', 'm', 'i', 'n', 'l', 'h', 9, 0,
     333             :   /* 2443 */ 's', 'w', 'p', 'l', 'h', 9, 0,
     334             :   /* 2450 */ 'l', 'd', 'c', 'l', 'r', 'l', 'h', 9, 0,
     335             :   /* 2459 */ 'l', 'd', 'e', 'o', 'r', 'l', 'h', 9, 0,
     336             :   /* 2468 */ 'c', 'a', 's', 'l', 'h', 9, 0,
     337             :   /* 2475 */ 'l', 'd', 's', 'e', 't', 'l', 'h', 9, 0,
     338             :   /* 2484 */ 's', 'q', 'd', 'm', 'u', 'l', 'h', 9, 0,
     339             :   /* 2493 */ 's', 'q', 'r', 'd', 'm', 'u', 'l', 'h', 9, 0,
     340             :   /* 2503 */ 's', 'm', 'u', 'l', 'h', 9, 0,
     341             :   /* 2510 */ 'u', 'm', 'u', 'l', 'h', 9, 0,
     342             :   /* 2517 */ 'l', 'd', 's', 'm', 'a', 'x', 'l', 'h', 9, 0,
     343             :   /* 2527 */ 'l', 'd', 'u', 'm', 'a', 'x', 'l', 'h', 9, 0,
     344             :   /* 2537 */ 'l', 'd', 's', 'm', 'i', 'n', 'h', 9, 0,
     345             :   /* 2546 */ 'l', 'd', 'u', 'm', 'i', 'n', 'h', 9, 0,
     346             :   /* 2555 */ 's', 'w', 'p', 'h', 9, 0,
     347             :   /* 2561 */ 'l', 'd', '1', 'r', 'q', 'h', 9, 0,
     348             :   /* 2569 */ 'l', 'd', '1', 'r', 'h', 9, 0,
     349             :   /* 2576 */ 'l', 'd', 'a', 'r', 'h', 9, 0,
     350             :   /* 2583 */ 'l', 'd', 'l', 'a', 'r', 'h', 9, 0,
     351             :   /* 2591 */ 'l', 'd', 'r', 'h', 9, 0,
     352             :   /* 2597 */ 'l', 'd', 'c', 'l', 'r', 'h', 9, 0,
     353             :   /* 2605 */ 's', 't', 'l', 'l', 'r', 'h', 9, 0,
     354             :   /* 2613 */ 's', 't', 'l', 'r', 'h', 9, 0,
     355             :   /* 2620 */ 'l', 'd', 'e', 'o', 'r', 'h', 9, 0,
     356             :   /* 2628 */ 'l', 'd', 'a', 'p', 'r', 'h', 9, 0,
     357             :   /* 2636 */ 'l', 'd', 't', 'r', 'h', 9, 0,
     358             :   /* 2643 */ 's', 't', 'r', 'h', 9, 0,
     359             :   /* 2649 */ 's', 't', 't', 'r', 'h', 9, 0,
     360             :   /* 2656 */ 'l', 'd', 'u', 'r', 'h', 9, 0,
     361             :   /* 2663 */ 's', 't', 'u', 'r', 'h', 9, 0,
     362             :   /* 2670 */ 'l', 'd', 'a', 'x', 'r', 'h', 9, 0,
     363             :   /* 2678 */ 'l', 'd', 'x', 'r', 'h', 9, 0,
     364             :   /* 2685 */ 's', 't', 'l', 'x', 'r', 'h', 9, 0,
     365             :   /* 2693 */ 's', 't', 'x', 'r', 'h', 9, 0,
     366             :   /* 2700 */ 'l', 'd', '1', 's', 'h', 9, 0,
     367             :   /* 2707 */ 'l', 'd', 'f', 'f', '1', 's', 'h', 9, 0,
     368             :   /* 2716 */ 'l', 'd', 'n', 'f', '1', 's', 'h', 9, 0,
     369             :   /* 2725 */ 'c', 'a', 's', 'h', 9, 0,
     370             :   /* 2731 */ 's', 'q', 'r', 'd', 'm', 'l', 's', 'h', 9, 0,
     371             :   /* 2741 */ 'l', 'd', '1', 'r', 's', 'h', 9, 0,
     372             :   /* 2749 */ 'l', 'd', 'r', 's', 'h', 9, 0,
     373             :   /* 2756 */ 'l', 'd', 't', 'r', 's', 'h', 9, 0,
     374             :   /* 2764 */ 'l', 'd', 'u', 'r', 's', 'h', 9, 0,
     375             :   /* 2772 */ 'l', 'd', 's', 'e', 't', 'h', 9, 0,
     376             :   /* 2780 */ 'c', 'n', 't', 'h', 9, 0,
     377             :   /* 2786 */ 's', 'x', 't', 'h', 9, 0,
     378             :   /* 2792 */ 'u', 'x', 't', 'h', 9, 0,
     379             :   /* 2798 */ 'l', 'd', 's', 'm', 'a', 'x', 'h', 9, 0,
     380             :   /* 2807 */ 'l', 'd', 'u', 'm', 'a', 'x', 'h', 9, 0,
     381             :   /* 2816 */ 'x', 'p', 'a', 'c', 'i', 9, 0,
     382             :   /* 2823 */ 'c', 'm', 'h', 'i', 9, 0,
     383             :   /* 2829 */ 'c', 'm', 'p', 'h', 'i', 9, 0,
     384             :   /* 2836 */ 's', 'l', 'i', 9, 0,
     385             :   /* 2841 */ 'm', 'v', 'n', 'i', 9, 0,
     386             :   /* 2847 */ 's', 'r', 'i', 9, 0,
     387             :   /* 2852 */ 'f', 'r', 'i', 'n', 't', 'i', 9, 0,
     388             :   /* 2860 */ 'm', 'o', 'v', 'i', 9, 0,
     389             :   /* 2866 */ 'b', 'r', 'k', 9, 0,
     390             :   /* 2871 */ 'm', 'o', 'v', 'k', 9, 0,
     391             :   /* 2877 */ 's', 'a', 'b', 'a', 'l', 9, 0,
     392             :   /* 2884 */ 'u', 'a', 'b', 'a', 'l', 9, 0,
     393             :   /* 2891 */ 'l', 'd', 'a', 'd', 'd', 'a', 'l', 9, 0,
     394             :   /* 2900 */ 's', 'q', 'd', 'm', 'l', 'a', 'l', 9, 0,
     395             :   /* 2909 */ 's', 'm', 'l', 'a', 'l', 9, 0,
     396             :   /* 2916 */ 'u', 'm', 'l', 'a', 'l', 9, 0,
     397             :   /* 2923 */ 'l', 'd', 's', 'm', 'i', 'n', 'a', 'l', 9, 0,
     398             :   /* 2933 */ 'l', 'd', 'u', 'm', 'i', 'n', 'a', 'l', 9, 0,
     399             :   /* 2943 */ 'c', 'a', 's', 'p', 'a', 'l', 9, 0,
     400             :   /* 2951 */ 's', 'w', 'p', 'a', 'l', 9, 0,
     401             :   /* 2958 */ 'l', 'd', 'c', 'l', 'r', 'a', 'l', 9, 0,
     402             :   /* 2967 */ 'l', 'd', 'e', 'o', 'r', 'a', 'l', 9, 0,
     403             :   /* 2976 */ 'c', 'a', 's', 'a', 'l', 9, 0,
     404             :   /* 2983 */ 'l', 'd', 's', 'e', 't', 'a', 'l', 9, 0,
     405             :   /* 2992 */ 'l', 'd', 's', 'm', 'a', 'x', 'a', 'l', 9, 0,
     406             :   /* 3002 */ 'l', 'd', 'u', 'm', 'a', 'x', 'a', 'l', 9, 0,
     407             :   /* 3012 */ 't', 'b', 'l', 9, 0,
     408             :   /* 3017 */ 's', 'm', 's', 'u', 'b', 'l', 9, 0,
     409             :   /* 3025 */ 'u', 'm', 's', 'u', 'b', 'l', 9, 0,
     410             :   /* 3033 */ 's', 's', 'u', 'b', 'l', 9, 0,
     411             :   /* 3040 */ 'u', 's', 'u', 'b', 'l', 9, 0,
     412             :   /* 3047 */ 's', 'a', 'b', 'd', 'l', 9, 0,
     413             :   /* 3054 */ 'u', 'a', 'b', 'd', 'l', 9, 0,
     414             :   /* 3061 */ 'l', 'd', 'a', 'd', 'd', 'l', 9, 0,
     415             :   /* 3069 */ 's', 'm', 'a', 'd', 'd', 'l', 9, 0,
     416             :   /* 3077 */ 'u', 'm', 'a', 'd', 'd', 'l', 9, 0,
     417             :   /* 3085 */ 's', 'a', 'd', 'd', 'l', 9, 0,
     418             :   /* 3092 */ 'u', 'a', 'd', 'd', 'l', 9, 0,
     419             :   /* 3099 */ 'f', 'c', 's', 'e', 'l', 9, 0,
     420             :   /* 3106 */ 's', 'q', 's', 'h', 'l', 9, 0,
     421             :   /* 3113 */ 'u', 'q', 's', 'h', 'l', 9, 0,
     422             :   /* 3120 */ 's', 'q', 'r', 's', 'h', 'l', 9, 0,
     423             :   /* 3128 */ 'u', 'q', 'r', 's', 'h', 'l', 9, 0,
     424             :   /* 3136 */ 's', 'r', 's', 'h', 'l', 9, 0,
     425             :   /* 3143 */ 'u', 'r', 's', 'h', 'l', 9, 0,
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     428             :   /* 3162 */ 's', 's', 'h', 'l', 'l', 9, 0,
     429             :   /* 3169 */ 'u', 's', 'h', 'l', 'l', 9, 0,
     430             :   /* 3176 */ 's', 'q', 'd', 'm', 'u', 'l', 'l', 9, 0,
     431             :   /* 3185 */ 'p', 'm', 'u', 'l', 'l', 9, 0,
     432             :   /* 3192 */ 's', 'm', 'u', 'l', 'l', 9, 0,
     433             :   /* 3199 */ 'u', 'm', 'u', 'l', 'l', 9, 0,
     434             :   /* 3206 */ 'l', 'd', 's', 'm', 'i', 'n', 'l', 9, 0,
     435             :   /* 3215 */ 'l', 'd', 'u', 'm', 'i', 'n', 'l', 9, 0,
     436             :   /* 3224 */ 'a', 'd', 'd', 'p', 'l', 9, 0,
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     438             :   /* 3238 */ 's', 'w', 'p', 'l', 9, 0,
     439             :   /* 3244 */ 'l', 'd', 'c', 'l', 'r', 'l', 9, 0,
     440             :   /* 3252 */ 'l', 'd', 'e', 'o', 'r', 'l', 9, 0,
     441             :   /* 3260 */ 'c', 'a', 's', 'l', 9, 0,
     442             :   /* 3266 */ 'b', 's', 'l', 9, 0,
     443             :   /* 3271 */ 's', 'q', 'd', 'm', 'l', 's', 'l', 9, 0,
     444             :   /* 3280 */ 's', 'm', 'l', 's', 'l', 9, 0,
     445             :   /* 3287 */ 'u', 'm', 'l', 's', 'l', 9, 0,
     446             :   /* 3294 */ 's', 'y', 's', 'l', 9, 0,
     447             :   /* 3300 */ 'l', 'd', 's', 'e', 't', 'l', 9, 0,
     448             :   /* 3308 */ 'f', 'c', 'v', 't', 'l', 9, 0,
     449             :   /* 3315 */ 'f', 'm', 'u', 'l', 9, 0,
     450             :   /* 3321 */ 'f', 'n', 'm', 'u', 'l', 9, 0,
     451             :   /* 3328 */ 'p', 'm', 'u', 'l', 9, 0,
     452             :   /* 3334 */ 'a', 'd', 'd', 'v', 'l', 9, 0,
     453             :   /* 3341 */ 'r', 'd', 'v', 'l', 9, 0,
     454             :   /* 3347 */ 'l', 'd', 's', 'm', 'a', 'x', 'l', 9, 0,
     455             :   /* 3356 */ 'l', 'd', 'u', 'm', 'a', 'x', 'l', 9, 0,
     456             :   /* 3365 */ 's', 'h', 'a', '1', 'm', 9, 0,
     457             :   /* 3372 */ 's', 'b', 'f', 'm', 9, 0,
     458             :   /* 3378 */ 'u', 'b', 'f', 'm', 9, 0,
     459             :   /* 3384 */ 'p', 'r', 'f', 'm', 9, 0,
     460             :   /* 3390 */ 'f', 'm', 'i', 'n', 'n', 'm', 9, 0,
     461             :   /* 3398 */ 'f', 'm', 'a', 'x', 'n', 'm', 9, 0,
     462             :   /* 3406 */ 'd', 'u', 'p', 'm', 9, 0,
     463             :   /* 3412 */ 'f', 'r', 'i', 'n', 't', 'm', 9, 0,
     464             :   /* 3420 */ 'p', 'r', 'f', 'u', 'm', 9, 0,
     465             :   /* 3427 */ 'r', 's', 'u', 'b', 'h', 'n', 9, 0,
     466             :   /* 3435 */ 'r', 'a', 'd', 'd', 'h', 'n', 9, 0,
     467             :   /* 3443 */ 'f', 'm', 'i', 'n', 9, 0,
     468             :   /* 3449 */ 'l', 'd', 's', 'm', 'i', 'n', 9, 0,
     469             :   /* 3457 */ 'l', 'd', 'u', 'm', 'i', 'n', 9, 0,
     470             :   /* 3465 */ 'c', 'c', 'm', 'n', 9, 0,
     471             :   /* 3471 */ 'e', 'o', 'n', 9, 0,
     472             :   /* 3476 */ 's', 'q', 's', 'h', 'r', 'n', 9, 0,
     473             :   /* 3484 */ 'u', 'q', 's', 'h', 'r', 'n', 9, 0,
     474             :   /* 3492 */ 's', 'q', 'r', 's', 'h', 'r', 'n', 9, 0,
     475             :   /* 3501 */ 'u', 'q', 'r', 's', 'h', 'r', 'n', 9, 0,
     476             :   /* 3510 */ 'o', 'r', 'n', 9, 0,
     477             :   /* 3515 */ 'f', 'r', 'i', 'n', 't', 'n', 9, 0,
     478             :   /* 3523 */ 'f', 'c', 'v', 't', 'n', 9, 0,
     479             :   /* 3530 */ 's', 'q', 'x', 't', 'n', 9, 0,
     480             :   /* 3537 */ 'u', 'q', 'x', 't', 'n', 9, 0,
     481             :   /* 3544 */ 's', 'q', 's', 'h', 'r', 'u', 'n', 9, 0,
     482             :   /* 3553 */ 's', 'q', 'r', 's', 'h', 'r', 'u', 'n', 9, 0,
     483             :   /* 3563 */ 's', 'q', 'x', 't', 'u', 'n', 9, 0,
     484             :   /* 3571 */ 'm', 'o', 'v', 'n', 9, 0,
     485             :   /* 3577 */ 'f', 'c', 'v', 't', 'x', 'n', 9, 0,
     486             :   /* 3585 */ 'c', 'm', 'p', 'l', 'o', 9, 0,
     487             :   /* 3592 */ 'f', 'c', 'm', 'u', 'o', 9, 0,
     488             :   /* 3599 */ 's', 'h', 'a', '1', 'p', 9, 0,
     489             :   /* 3606 */ 's', 'q', 'd', 'e', 'c', 'p', 9, 0,
     490             :   /* 3614 */ 'u', 'q', 'd', 'e', 'c', 'p', 9, 0,
     491             :   /* 3622 */ 's', 'q', 'i', 'n', 'c', 'p', 9, 0,
     492             :   /* 3630 */ 'u', 'q', 'i', 'n', 'c', 'p', 9, 0,
     493             :   /* 3638 */ 'f', 'a', 'd', 'd', 'p', 9, 0,
     494             :   /* 3645 */ 'l', 'd', 'p', 9, 0,
     495             :   /* 3650 */ 's', 'a', 'd', 'a', 'l', 'p', 9, 0,
     496             :   /* 3658 */ 'u', 'a', 'd', 'a', 'l', 'p', 9, 0,
     497             :   /* 3666 */ 's', 'a', 'd', 'd', 'l', 'p', 9, 0,
     498             :   /* 3674 */ 'u', 'a', 'd', 'd', 'l', 'p', 9, 0,
     499             :   /* 3682 */ 'f', 'c', 'c', 'm', 'p', 9, 0,
     500             :   /* 3689 */ 'f', 'c', 'm', 'p', 9, 0,
     501             :   /* 3695 */ 'f', 'm', 'i', 'n', 'n', 'm', 'p', 9, 0,
     502             :   /* 3704 */ 'f', 'm', 'a', 'x', 'n', 'm', 'p', 9, 0,
     503             :   /* 3713 */ 'l', 'd', 'n', 'p', 9, 0,
     504             :   /* 3719 */ 'f', 'm', 'i', 'n', 'p', 9, 0,
     505             :   /* 3726 */ 's', 'm', 'i', 'n', 'p', 9, 0,
     506             :   /* 3733 */ 'u', 'm', 'i', 'n', 'p', 9, 0,
     507             :   /* 3740 */ 's', 't', 'n', 'p', 9, 0,
     508             :   /* 3746 */ 'a', 'd', 'r', 'p', 9, 0,
     509             :   /* 3752 */ 'c', 'a', 's', 'p', 9, 0,
     510             :   /* 3758 */ 'c', 'n', 't', 'p', 9, 0,
     511             :   /* 3764 */ 'f', 'r', 'i', 'n', 't', 'p', 9, 0,
     512             :   /* 3772 */ 's', 't', 'p', 9, 0,
     513             :   /* 3777 */ 'f', 'd', 'u', 'p', 9, 0,
     514             :   /* 3783 */ 's', 'w', 'p', 9, 0,
     515             :   /* 3788 */ 'l', 'd', 'a', 'x', 'p', 9, 0,
     516             :   /* 3795 */ 'f', 'm', 'a', 'x', 'p', 9, 0,
     517             :   /* 3802 */ 's', 'm', 'a', 'x', 'p', 9, 0,
     518             :   /* 3809 */ 'u', 'm', 'a', 'x', 'p', 9, 0,
     519             :   /* 3816 */ 'l', 'd', 'x', 'p', 9, 0,
     520             :   /* 3822 */ 's', 't', 'l', 'x', 'p', 9, 0,
     521             :   /* 3829 */ 's', 't', 'x', 'p', 9, 0,
     522             :   /* 3835 */ 'f', 'c', 'm', 'e', 'q', 9, 0,
     523             :   /* 3842 */ 'c', 'm', 'p', 'e', 'q', 9, 0,
     524             :   /* 3849 */ 'l', 'd', '1', 'r', 9, 0,
     525             :   /* 3855 */ 'l', 'd', '2', 'r', 9, 0,
     526             :   /* 3861 */ 'l', 'd', '3', 'r', 9, 0,
     527             :   /* 3867 */ 'l', 'd', '4', 'r', 9, 0,
     528             :   /* 3873 */ 'l', 'd', 'a', 'r', 9, 0,
     529             :   /* 3879 */ 'l', 'd', 'l', 'a', 'r', 9, 0,
     530             :   /* 3886 */ 's', 'u', 'b', 'r', 9, 0,
     531             :   /* 3892 */ 'a', 'd', 'r', 9, 0,
     532             :   /* 3897 */ 'l', 'd', 'r', 9, 0,
     533             :   /* 3902 */ 'r', 'd', 'f', 'f', 'r', 9, 0,
     534             :   /* 3909 */ 'w', 'r', 'f', 'f', 'r', 9, 0,
     535             :   /* 3916 */ 's', 'r', 's', 'h', 'r', 9, 0,
     536             :   /* 3923 */ 'u', 'r', 's', 'h', 'r', 9, 0,
     537             :   /* 3930 */ 's', 's', 'h', 'r', 9, 0,
     538             :   /* 3936 */ 'u', 's', 'h', 'r', 9, 0,
     539             :   /* 3942 */ 'b', 'l', 'r', 9, 0,
     540             :   /* 3947 */ 'l', 'd', 'c', 'l', 'r', 9, 0,
     541             :   /* 3954 */ 's', 't', 'l', 'l', 'r', 9, 0,
     542             :   /* 3961 */ 'l', 's', 'l', 'r', 9, 0,
     543             :   /* 3967 */ 's', 't', 'l', 'r', 9, 0,
     544             :   /* 3973 */ 'l', 'd', 'e', 'o', 'r', 9, 0,
     545             :   /* 3980 */ 'n', 'o', 'r', 9, 0,
     546             :   /* 3985 */ 'r', 'o', 'r', 9, 0,
     547             :   /* 3990 */ 'l', 'd', 'a', 'p', 'r', 9, 0,
     548             :   /* 3997 */ 'o', 'r', 'r', 9, 0,
     549             :   /* 4002 */ 'a', 's', 'r', 'r', 9, 0,
     550             :   /* 4008 */ 'l', 's', 'r', 'r', 9, 0,
     551             :   /* 4014 */ 'a', 's', 'r', 9, 0,
     552             :   /* 4019 */ 'l', 's', 'r', 9, 0,
     553             :   /* 4024 */ 'm', 's', 'r', 9, 0,
     554             :   /* 4029 */ 'l', 'd', 't', 'r', 9, 0,
     555             :   /* 4035 */ 's', 't', 'r', 9, 0,
     556             :   /* 4040 */ 's', 't', 't', 'r', 9, 0,
     557             :   /* 4046 */ 'e', 'x', 't', 'r', 9, 0,
     558             :   /* 4052 */ 'l', 'd', 'u', 'r', 9, 0,
     559             :   /* 4058 */ 's', 't', 'u', 'r', 9, 0,
     560             :   /* 4064 */ 'l', 'd', 'a', 'x', 'r', 9, 0,
     561             :   /* 4071 */ 'l', 'd', 'x', 'r', 9, 0,
     562             :   /* 4077 */ 's', 't', 'l', 'x', 'r', 9, 0,
     563             :   /* 4084 */ 's', 't', 'x', 'r', 9, 0,
     564             :   /* 4090 */ 'c', 'a', 's', 9, 0,
     565             :   /* 4095 */ 'f', 'c', 'v', 't', 'a', 's', 9, 0,
     566             :   /* 4103 */ 'f', 'a', 'b', 's', 9, 0,
     567             :   /* 4109 */ 's', 'q', 'a', 'b', 's', 9, 0,
     568             :   /* 4116 */ 's', 'u', 'b', 's', 9, 0,
     569             :   /* 4122 */ 's', 'b', 'c', 's', 9, 0,
     570             :   /* 4128 */ 'a', 'd', 'c', 's', 9, 0,
     571             :   /* 4134 */ 'b', 'i', 'c', 's', 9, 0,
     572             :   /* 4140 */ 'a', 'd', 'd', 's', 9, 0,
     573             :   /* 4146 */ 'n', 'a', 'n', 'd', 's', 9, 0,
     574             :   /* 4153 */ 'p', 't', 'r', 'u', 'e', 's', 9, 0,
     575             :   /* 4161 */ 'c', 'm', 'h', 's', 9, 0,
     576             :   /* 4167 */ 'c', 'm', 'p', 'h', 's', 9, 0,
     577             :   /* 4174 */ 'c', 'l', 's', 9, 0,
     578             :   /* 4179 */ 'f', 'm', 'l', 's', 9, 0,
     579             :   /* 4185 */ 'c', 'm', 'p', 'l', 's', 9, 0,
     580             :   /* 4192 */ 'f', 'c', 'v', 't', 'm', 's', 9, 0,
     581             :   /* 4200 */ 'i', 'n', 's', 9, 0,
     582             :   /* 4205 */ 'o', 'r', 'n', 's', 9, 0,
     583             :   /* 4211 */ 'f', 'c', 'v', 't', 'n', 's', 9, 0,
     584             :   /* 4219 */ 'f', 'r', 'e', 'c', 'p', 's', 9, 0,
     585             :   /* 4227 */ 'f', 'c', 'v', 't', 'p', 's', 9, 0,
     586             :   /* 4235 */ 'r', 'd', 'f', 'f', 'r', 's', 9, 0,
     587             :   /* 4243 */ 'm', 'r', 's', 9, 0,
     588             :   /* 4248 */ 'e', 'o', 'r', 's', 9, 0,
     589             :   /* 4254 */ 'n', 'o', 'r', 's', 9, 0,
     590             :   /* 4260 */ 'o', 'r', 'r', 's', 9, 0,
     591             :   /* 4266 */ 'f', 'r', 's', 'q', 'r', 't', 's', 9, 0,
     592             :   /* 4275 */ 's', 'y', 's', 9, 0,
     593             :   /* 4280 */ 'f', 'c', 'v', 't', 'z', 's', 9, 0,
     594             :   /* 4288 */ 'f', 'j', 'c', 'v', 't', 'z', 's', 9, 0,
     595             :   /* 4297 */ 'r', 'e', 't', 9, 0,
     596             :   /* 4302 */ 'l', 'd', 's', 'e', 't', 9, 0,
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     598             :   /* 4316 */ 'f', 'c', 'm', 'g', 't', 9, 0,
     599             :   /* 4323 */ 'c', 'm', 'p', 'g', 't', 9, 0,
     600             :   /* 4330 */ 'r', 'b', 'i', 't', 9, 0,
     601             :   /* 4336 */ 'h', 'l', 't', 9, 0,
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     603             :   /* 4348 */ 'c', 'm', 'p', 'l', 't', 9, 0,
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     605             :   /* 4360 */ 'h', 'i', 'n', 't', 9, 0,
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     608             :   /* 4378 */ 'c', 'n', 'o', 't', 9, 0,
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     613             :   /* 4409 */ 'f', 'c', 'v', 't', 'a', 'u', 9, 0,
     614             :   /* 4417 */ 's', 'q', 's', 'h', 'l', 'u', 9, 0,
     615             :   /* 4425 */ 'f', 'c', 'v', 't', 'm', 'u', 9, 0,
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     695             :   /* 4990 */ 'f', 'r', 'i', 'n', 't', 'z', 9, 0,
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    1101             :     100716132U, // CCMPXi
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    1103             :     5350U,      // CFINV
    1104             :     6345506U,   // CLREX
    1105             :     100716623U, // CLSWr
    1106             :     100716623U, // CLSXr
    1107             :     12367U,     // CLS_ZPmZ_B
    1108             :     20559U,     // CLS_ZPmZ_D
    1109             :     34107471U,  // CLS_ZPmZ_H
    1110             :     36943U,     // CLS_ZPmZ_S
    1111             :     68202575U,  // CLSv16i8
    1112             :     68726863U,  // CLSv2i32
    1113             :     69775439U,  // CLSv4i16
    1114             :     70299727U,  // CLSv4i32
    1115             :     70824015U,  // CLSv8i16
    1116             :     71348303U,  // CLSv8i8
    1117             :     100717422U, // CLZWr
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    1119             :     13166U,     // CLZ_ZPmZ_B
    1120             :     21358U,     // CLZ_ZPmZ_D
    1121             :     34108270U,  // CLZ_ZPmZ_H
    1122             :     37742U,     // CLZ_ZPmZ_S
    1123             :     68203374U,  // CLZv16i8
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    1125             :     69776238U,  // CLZv4i16
    1126             :     70300526U,  // CLZv4i32
    1127             :     70824814U,  // CLZv8i16
    1128             :     71349102U,  // CLZv8i8
    1129             :     68202237U,  // CMEQv16i8
    1130             :     68202237U,  // CMEQv16i8rz
    1131             :     100716285U, // CMEQv1i64
    1132             :     100716285U, // CMEQv1i64rz
    1133             :     68726525U,  // CMEQv2i32
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    1145             :     68200308U,  // CMGEv16i8
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    1292             :     302000022U, // CMPNE_PPzZI_B
    1293             :     302008214U, // CMPNE_PPzZI_D
    1294             :     475031446U, // CMPNE_PPzZI_H
    1295             :     302024598U, // CMPNE_PPzZI_S
    1296             :     302000022U, // CMPNE_PPzZZ_B
    1297             :     302008214U, // CMPNE_PPzZZ_D
    1298             :     475031446U, // CMPNE_PPzZZ_H
    1299             :     302024598U, // CMPNE_PPzZZ_S
    1300             :     302000022U, // CMPNE_WIDE_PPzZZ_B
    1301             :     475031446U, // CMPNE_WIDE_PPzZZ_H
    1302             :     302024598U, // CMPNE_WIDE_PPzZZ_S
    1303             :     0U, // CMP_SWAP_128
    1304             :     0U, // CMP_SWAP_16
    1305             :     0U, // CMP_SWAP_32
    1306             :     0U, // CMP_SWAP_64
    1307             :     0U, // CMP_SWAP_8
    1308             :     68202792U,  // CMTSTv16i8
    1309             :     100716840U, // CMTSTv1i64
    1310             :     68727080U,  // CMTSTv2i32
    1311             :     69251368U,  // CMTSTv2i64
    1312             :     69775656U,  // CMTSTv4i16
    1313             :     70299944U,  // CMTSTv4i32
    1314             :     70824232U,  // CMTSTv8i16
    1315             :     71348520U,  // CMTSTv8i8
    1316             :     12571U,     // CNOT_ZPmZ_B
    1317             :     20763U,     // CNOT_ZPmZ_D
    1318             :     34107675U,  // CNOT_ZPmZ_H
    1319             :     37147U,     // CNOT_ZPmZ_S
    1320             :     503367098U, // CNTB_XPiI
    1321             :     503367526U, // CNTD_XPiI
    1322             :     503368413U, // CNTH_XPiI
    1323             :     302042799U, // CNTP_XPP_B
    1324             :     302042799U, // CNTP_XPP_D
    1325             :     302042799U, // CNTP_XPP_H
    1326             :     302042799U, // CNTP_XPP_S
    1327             :     503370461U, // CNTW_XPiI
    1328             :     12548U,     // CNT_ZPmZ_B
    1329             :     20740U,     // CNT_ZPmZ_D
    1330             :     34107652U,  // CNT_ZPmZ_H
    1331             :     37124U,     // CNT_ZPmZ_S
    1332             :     68202756U,  // CNTv16i8
    1333             :     71348484U,  // CNTv8i8
    1334             :     13121U,     // CPY_ZPmI_B
    1335             :     21313U,     // CPY_ZPmI_D
    1336             :     34108225U,  // CPY_ZPmI_H
    1337             :     37697U,     // CPY_ZPmI_S
    1338             :     13121U,     // CPY_ZPmR_B
    1339             :     21313U,     // CPY_ZPmR_D
    1340             :     34108225U,  // CPY_ZPmR_H
    1341             :     37697U,     // CPY_ZPmR_S
    1342             :     13121U,     // CPY_ZPmV_B
    1343             :     21313U,     // CPY_ZPmV_D
    1344             :     34108225U,  // CPY_ZPmV_H
    1345             :     37697U,     // CPY_ZPmV_S
    1346             :     302003009U, // CPY_ZPzI_B
    1347             :     302011201U, // CPY_ZPzI_D
    1348             :     475034433U, // CPY_ZPzI_H
    1349             :     302027585U, // CPY_ZPzI_S
    1350             :     67162566U,  // CPYi16
    1351             :     67162566U,  // CPYi32
    1352             :     67162566U,  // CPYi64
    1353             :     67162566U,  // CPYi8
    1354             :     100713234U, // CRC32Brr
    1355             :     100713388U, // CRC32CBrr
    1356             :     100714708U, // CRC32CHrr
    1357             :     100717138U, // CRC32CWrr
    1358             :     100717330U, // CRC32CXrr
    1359             :     100714555U, // CRC32Hrr
    1360             :     100717080U, // CRC32Wrr
    1361             :     100717295U, // CRC32Xrr
    1362             :     100715549U, // CSELWr
    1363             :     100715549U, // CSELXr
    1364             :     100714068U, // CSINCWr
    1365             :     100714068U, // CSINCXr
    1366             :     100716990U, // CSINVWr
    1367             :     100716990U, // CSINVXr
    1368             :     100714497U, // CSNEGWr
    1369             :     100714497U, // CSNEGXr
    1370             :     0U, // CompilerBarrier
    1371             :     73772U,     // DCPS1
    1372             :     74137U,     // DCPS2
    1373             :     74186U,     // DCPS3
    1374             :     536921015U, // DECB_XPiI
    1375             :     536921808U, // DECD_XPiI
    1376             :     536889040U, // DECD_ZPiI
    1377             :     536922335U, // DECH_XPiI
    1378             :     6842591U,   // DECH_ZPiI
    1379             :     167824921U, // DECP_XP_B
    1380             :     201379353U, // DECP_XP_D
    1381             :     570478105U, // DECP_XP_H
    1382             :     268488217U, // DECP_XP_S
    1383             :     19993U,     // DECP_ZP_D
    1384             :     604532249U, // DECP_ZP_H
    1385             :     36377U,     // DECP_ZP_S
    1386             :     536924765U, // DECW_XPiI
    1387             :     536908381U, // DECW_ZPiI
    1388             :     115901U,    // DMB
    1389             :     5340U,      // DRPS
    1390             :     116100U,    // DSB
    1391             :     637553999U, // DUPM_ZI
    1392             :     671100611U, // DUP_ZI_B
    1393             :     704663235U, // DUP_ZI_D
    1394             :     7368387U,   // DUP_ZI_H
    1395             :     738234051U, // DUP_ZI_S
    1396             :     100675267U, // DUP_ZR_B
    1397             :     100683459U, // DUP_ZR_D
    1398             :     611872451U, // DUP_ZR_H
    1399             :     100699843U, // DUP_ZR_S
    1400             :     167784131U, // DUP_ZZI_B
    1401             :     201346755U, // DUP_ZZI_D
    1402             :     776498883U, // DUP_ZZI_H
    1403             :     126659U,    // DUP_ZZI_Q
    1404             :     268472003U, // DUP_ZZI_S
    1405             :     101756611U, // DUPv16i8gpr
    1406             :     68202179U,  // DUPv16i8lane
    1407             :     102280899U, // DUPv2i32gpr
    1408             :     68726467U,  // DUPv2i32lane
    1409             :     102805187U, // DUPv2i64gpr
    1410             :     69250755U,  // DUPv2i64lane
    1411             :     103329475U, // DUPv4i16gpr
    1412             :     69775043U,  // DUPv4i16lane
    1413             :     103853763U, // DUPv4i32gpr
    1414             :     70299331U,  // DUPv4i32lane
    1415             :     104378051U, // DUPv8i16gpr
    1416             :     70823619U,  // DUPv8i16lane
    1417             :     104902339U, // DUPv8i8gpr
    1418             :     71347907U,  // DUPv8i8lane
    1419             :     0U, // EONWrr
    1420             :     100715920U, // EONWrs
    1421             :     0U, // EONXrr
    1422             :     100715920U, // EONXrs
    1423             :     302002329U, // EORS_PPzPP
    1424             :     100716424U, // EORWri
    1425             :     0U, // EORWrr
    1426             :     100716424U, // EORWrs
    1427             :     100716424U, // EORXri
    1428             :     0U, // EORXrr
    1429             :     100716424U, // EORXrs
    1430             :     302002056U, // EOR_PPzPP
    1431             :     201346952U, // EOR_ZI
    1432             :     302002056U, // EOR_ZPmZ_B
    1433             :     302010248U, // EOR_ZPmZ_D
    1434             :     38825864U,  // EOR_ZPmZ_H
    1435             :     302026632U, // EOR_ZPmZ_S
    1436             :     201346952U, // EOR_ZZZ
    1437             :     68202376U,  // EORv16i8
    1438             :     71348104U,  // EORv8i8
    1439             :     5345U,      // ERET
    1440             :     5265U,      // ERETAA
    1441             :     5272U,      // ERETAB
    1442             :     100716495U, // EXTRWrri
    1443             :     100716495U, // EXTRXrri
    1444             :     68202805U,  // EXTv16i8
    1445             :     71348533U,  // EXTv8i8
    1446             :     0U, // F128CSEL
    1447             :     100714165U, // FABD16
    1448             :     100714165U, // FABD32
    1449             :     100714165U, // FABD64
    1450             :     68724405U,  // FABDv2f32
    1451             :     69248693U,  // FABDv2f64
    1452             :     69772981U,  // FABDv4f16
    1453             :     70297269U,  // FABDv4f32
    1454             :     70821557U,  // FABDv8f16
    1455             :     100716552U, // FABSDr
    1456             :     100716552U, // FABSHr
    1457             :     100716552U, // FABSSr
    1458             :     20488U,     // FABS_ZPmZ_D
    1459             :     34107400U,  // FABS_ZPmZ_H
    1460             :     36872U,     // FABS_ZPmZ_S
    1461             :     68726792U,  // FABSv2f32
    1462             :     69251080U,  // FABSv2f64
    1463             :     69775368U,  // FABSv4f16
    1464             :     70299656U,  // FABSv4f32
    1465             :     70823944U,  // FABSv8f16
    1466             :     100714348U, // FACGE16
    1467             :     100714348U, // FACGE32
    1468             :     100714348U, // FACGE64
    1469             :     302008172U, // FACGE_PPzZZ_D
    1470             :     475031404U, // FACGE_PPzZZ_H
    1471             :     302024556U, // FACGE_PPzZZ_S
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    1641             :     475033097U, // FCMUO_PPzZZ_H
    1642             :     302026249U, // FCMUO_PPzZZ_S
    1643             :     21312U,     // FCPY_ZPmI_D
    1644             :     34108224U,  // FCPY_ZPmI_H
    1645             :     37696U,     // FCPY_ZPmI_S
    1646             :     100715548U, // FCSELDrrr
    1647             :     100715548U, // FCSELHrrr
    1648             :     100715548U, // FCSELSrrr
    1649             :     100716544U, // FCVTASUWDr
    1650             :     100716544U, // FCVTASUWHr
    1651             :     100716544U, // FCVTASUWSr
    1652             :     100716544U, // FCVTASUXDr
    1653             :     100716544U, // FCVTASUXHr
    1654             :     100716544U, // FCVTASUXSr
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    1813             :     100716898U, // FCVTZUSWDri
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    1815             :     100716898U, // FCVTZUSWSri
    1816             :     100716898U, // FCVTZUSXDri
    1817             :     100716898U, // FCVTZUSXHri
    1818             :     100716898U, // FCVTZUSXSri
    1819             :     100716898U, // FCVTZUUWDr
    1820             :     100716898U, // FCVTZUUWHr
    1821             :     100716898U, // FCVTZUUWSr
    1822             :     100716898U, // FCVTZUUXDr
    1823             :     100716898U, // FCVTZUUXHr
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    1825             :     20834U,     // FCVTZU_ZPmZ_DtoD
    1826             :     37218U,     // FCVTZU_ZPmZ_DtoS
    1827             :     20834U,     // FCVTZU_ZPmZ_HtoD
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    1829             :     37218U,     // FCVTZU_ZPmZ_HtoS
    1830             :     20834U,     // FCVTZU_ZPmZ_StoD
    1831             :     37218U,     // FCVTZU_ZPmZ_StoS
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    1845             :     70300002U,  // FCVTZUv4i32_shift
    1846             :     70824290U,  // FCVTZUv8f16
    1847             :     70824290U,  // FCVTZUv8i16_shift
    1848             :     34107695U,  // FCVT_ZPmZ_DtoH
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    1850             :     20783U,     // FCVT_ZPmZ_HtoD
    1851             :     37167U,     // FCVT_ZPmZ_HtoS
    1852             :     20783U,     // FCVT_ZPmZ_StoD
    1853             :     34107695U,  // FCVT_ZPmZ_StoH
    1854             :     100716917U, // FDIVDrr
    1855             :     100716917U, // FDIVHrr
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    1868             :     100714272U, // FMADDSrrr
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    1950             :     369189455U, // FMLAv1i64_indexed
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    1955             :     136897103U, // FMLAv4f16
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    1974             :     0U, // FMOVD0
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    1982             :     838914501U, // FMOVHi
    1983             :     100716997U, // FMOVHr
    1984             :     0U, // FMOVS0
    1985             :     100716997U, // FMOVSWr
    1986             :     838914501U, // FMOVSi
    1987             :     100716997U, // FMOVSr
    1988             :     100716997U, // FMOVWHr
    1989             :     100716997U, // FMOVWSr
    1990             :     110670277U, // FMOVXDHighr
    1991             :     100716997U, // FMOVXDr
    1992             :     100716997U, // FMOVXHr
    1993             :     840479173U, // FMOVv2f32_ns
    1994             :     841003461U, // FMOVv2f64_ns
    1995             :     841527749U, // FMOVv4f16_ns
    1996             :     842052037U, // FMOVv4f32_ns
    1997             :     842576325U, // FMOVv8f16_ns
    1998             :     100713952U, // FMSUBDrrr
    1999             :     100713952U, // FMSUBHrrr
    2000             :     100713952U, // FMSUBSrrr
    2001             :     100715764U, // FMULDrr
    2002             :     100715764U, // FMULHrr
    2003             :     100715764U, // FMULSrr
    2004             :     100717353U, // FMULX16
    2005             :     100717353U, // FMULX32
    2006             :     100717353U, // FMULX64
    2007             :     100717353U, // FMULXv1i16_indexed
    2008             :     100717353U, // FMULXv1i32_indexed
    2009             :     100717353U, // FMULXv1i64_indexed
    2010             :     68727593U,  // FMULXv2f32
    2011             :     69251881U,  // FMULXv2f64
    2012             :     68727593U,  // FMULXv2i32_indexed
    2013             :     69251881U,  // FMULXv2i64_indexed
    2014             :     69776169U,  // FMULXv4f16
    2015             :     70300457U,  // FMULXv4f32
    2016             :     69776169U,  // FMULXv4i16_indexed
    2017             :     70300457U,  // FMULXv4i32_indexed
    2018             :     70824745U,  // FMULXv8f16
    2019             :     70824745U,  // FMULXv8i16_indexed
    2020             :     302009588U, // FMUL_ZPmI_D
    2021             :     38825204U,  // FMUL_ZPmI_H
    2022             :     302025972U, // FMUL_ZPmI_S
    2023             :     201346292U, // FMUL_ZZZI_D
    2024             :     239627508U, // FMUL_ZZZI_H
    2025             :     268471540U, // FMUL_ZZZI_S
    2026             :     100715764U, // FMULv1i16_indexed
    2027             :     100715764U, // FMULv1i32_indexed
    2028             :     100715764U, // FMULv1i64_indexed
    2029             :     68726004U,  // FMULv2f32
    2030             :     69250292U,  // FMULv2f64
    2031             :     68726004U,  // FMULv2i32_indexed
    2032             :     69250292U,  // FMULv2i64_indexed
    2033             :     69774580U,  // FMULv4f16
    2034             :     70298868U,  // FMULv4f32
    2035             :     69774580U,  // FMULv4i16_indexed
    2036             :     70298868U,  // FMULv4i32_indexed
    2037             :     70823156U,  // FMULv8f16
    2038             :     70823156U,  // FMULv8i16_indexed
    2039             :     100714484U, // FNEGDr
    2040             :     100714484U, // FNEGHr
    2041             :     100714484U, // FNEGSr
    2042             :     18420U,     // FNEG_ZPmZ_D
    2043             :     34105332U,  // FNEG_ZPmZ_H
    2044             :     34804U,     // FNEG_ZPmZ_S
    2045             :     68724724U,  // FNEGv2f32
    2046             :     69249012U,  // FNEGv2f64
    2047             :     69773300U,  // FNEGv4f16
    2048             :     70297588U,  // FNEGv4f32
    2049             :     70821876U,  // FNEGv8f16
    2050             :     100714279U, // FNMADDDrrr
    2051             :     100714279U, // FNMADDHrrr
    2052             :     100714279U, // FNMADDSrrr
    2053             :     100713959U, // FNMSUBDrrr
    2054             :     100713959U, // FNMSUBHrrr
    2055             :     100713959U, // FNMSUBSrrr
    2056             :     100715770U, // FNMULDrr
    2057             :     100715770U, // FNMULHrr
    2058             :     100715770U, // FNMULSrr
    2059             :     100714397U, // FRECPEv1f16
    2060             :     100714397U, // FRECPEv1i32
    2061             :     100714397U, // FRECPEv1i64
    2062             :     68724637U,  // FRECPEv2f32
    2063             :     69248925U,  // FRECPEv2f64
    2064             :     69773213U,  // FRECPEv4f16
    2065             :     70297501U,  // FRECPEv4f32
    2066             :     70821789U,  // FRECPEv8f16
    2067             :     100716668U, // FRECPS16
    2068             :     100716668U, // FRECPS32
    2069             :     100716668U, // FRECPS64
    2070             :     68726908U,  // FRECPSv2f32
    2071             :     69251196U,  // FRECPSv2f64
    2072             :     69775484U,  // FRECPSv4f16
    2073             :     70299772U,  // FRECPSv4f32
    2074             :     70824060U,  // FRECPSv8f16
    2075             :     21296U,     // FRECPX_ZPmZ_D
    2076             :     34108208U,  // FRECPX_ZPmZ_H
    2077             :     37680U,     // FRECPX_ZPmZ_S
    2078             :     100717360U, // FRECPXv1f16
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    2081             :     100713132U, // FRINTADr
    2082             :     100713132U, // FRINTAHr
    2083             :     100713132U, // FRINTASr
    2084             :     17068U,     // FRINTA_ZPmZ_D
    2085             :     34103980U,  // FRINTA_ZPmZ_H
    2086             :     33452U,     // FRINTA_ZPmZ_S
    2087             :     68723372U,  // FRINTAv2f32
    2088             :     69247660U,  // FRINTAv2f64
    2089             :     69771948U,  // FRINTAv4f16
    2090             :     70296236U,  // FRINTAv4f32
    2091             :     70820524U,  // FRINTAv8f16
    2092             :     100715301U, // FRINTIDr
    2093             :     100715301U, // FRINTIHr
    2094             :     100715301U, // FRINTISr
    2095             :     19237U,     // FRINTI_ZPmZ_D
    2096             :     34106149U,  // FRINTI_ZPmZ_H
    2097             :     35621U,     // FRINTI_ZPmZ_S
    2098             :     68725541U,  // FRINTIv2f32
    2099             :     69249829U,  // FRINTIv2f64
    2100             :     69774117U,  // FRINTIv4f16
    2101             :     70298405U,  // FRINTIv4f32
    2102             :     70822693U,  // FRINTIv8f16
    2103             :     100715861U, // FRINTMDr
    2104             :     100715861U, // FRINTMHr
    2105             :     100715861U, // FRINTMSr
    2106             :     19797U,     // FRINTM_ZPmZ_D
    2107             :     34106709U,  // FRINTM_ZPmZ_H
    2108             :     36181U,     // FRINTM_ZPmZ_S
    2109             :     68726101U,  // FRINTMv2f32
    2110             :     69250389U,  // FRINTMv2f64
    2111             :     69774677U,  // FRINTMv4f16
    2112             :     70298965U,  // FRINTMv4f32
    2113             :     70823253U,  // FRINTMv8f16
    2114             :     100715964U, // FRINTNDr
    2115             :     100715964U, // FRINTNHr
    2116             :     100715964U, // FRINTNSr
    2117             :     19900U,     // FRINTN_ZPmZ_D
    2118             :     34106812U,  // FRINTN_ZPmZ_H
    2119             :     36284U,     // FRINTN_ZPmZ_S
    2120             :     68726204U,  // FRINTNv2f32
    2121             :     69250492U,  // FRINTNv2f64
    2122             :     69774780U,  // FRINTNv4f16
    2123             :     70299068U,  // FRINTNv4f32
    2124             :     70823356U,  // FRINTNv8f16
    2125             :     100716213U, // FRINTPDr
    2126             :     100716213U, // FRINTPHr
    2127             :     100716213U, // FRINTPSr
    2128             :     20149U,     // FRINTP_ZPmZ_D
    2129             :     34107061U,  // FRINTP_ZPmZ_H
    2130             :     36533U,     // FRINTP_ZPmZ_S
    2131             :     68726453U,  // FRINTPv2f32
    2132             :     69250741U,  // FRINTPv2f64
    2133             :     69775029U,  // FRINTPv4f16
    2134             :     70299317U,  // FRINTPv4f32
    2135             :     70823605U,  // FRINTPv8f16
    2136             :     100717368U, // FRINTXDr
    2137             :     100717368U, // FRINTXHr
    2138             :     100717368U, // FRINTXSr
    2139             :     21304U,     // FRINTX_ZPmZ_D
    2140             :     34108216U,  // FRINTX_ZPmZ_H
    2141             :     37688U,     // FRINTX_ZPmZ_S
    2142             :     68727608U,  // FRINTXv2f32
    2143             :     69251896U,  // FRINTXv2f64
    2144             :     69776184U,  // FRINTXv4f16
    2145             :     70300472U,  // FRINTXv4f32
    2146             :     70824760U,  // FRINTXv8f16
    2147             :     100717439U, // FRINTZDr
    2148             :     100717439U, // FRINTZHr
    2149             :     100717439U, // FRINTZSr
    2150             :     21375U,     // FRINTZ_ZPmZ_D
    2151             :     34108287U,  // FRINTZ_ZPmZ_H
    2152             :     37759U,     // FRINTZ_ZPmZ_S
    2153             :     68727679U,  // FRINTZv2f32
    2154             :     69251967U,  // FRINTZv2f64
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    2318             :     379728370U, // GLDFF1W_SXTW_SCALED_REAL
    2319             :     379728370U, // GLDFF1W_UXTW_REAL
    2320             :     379728370U, // GLDFF1W_UXTW_SCALED_REAL
    2321             :     151817U,    // HINT
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    4224             :     100713933U, // SUBWrx
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    4308             :     100717417U, // TBZW
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    4310             :     0U, // TCRETURNdi
    4311             :     0U, // TCRETURNri
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    4313             :     0U, // TLSDESC_CALLSEQ
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    4852             :     0U, // PHI
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    4865             :     0U, // DBG_LABEL
    4866             :     0U, // REG_SEQUENCE
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    4871             :     0U, // STACKMAP
    4872             :     0U, // FENTRY_CALL
    4873             :     0U, // PATCHPOINT
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    4879             :     0U, // PATCHABLE_FUNCTION_ENTER
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    4885             :     0U, // ICALL_BRANCH_FUNNEL
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    4910             :     0U, // G_STORE
    4911             :     0U, // G_ATOMIC_CMPXCHG_WITH_SUCCESS
    4912             :     0U, // G_ATOMIC_CMPXCHG
    4913             :     0U, // G_ATOMICRMW_XCHG
    4914             :     0U, // G_ATOMICRMW_ADD
    4915             :     0U, // G_ATOMICRMW_SUB
    4916             :     0U, // G_ATOMICRMW_AND
    4917             :     0U, // G_ATOMICRMW_NAND
    4918             :     0U, // G_ATOMICRMW_OR
    4919             :     0U, // G_ATOMICRMW_XOR
    4920             :     0U, // G_ATOMICRMW_MAX
    4921             :     0U, // G_ATOMICRMW_MIN
    4922             :     0U, // G_ATOMICRMW_UMAX
    4923             :     0U, // G_ATOMICRMW_UMIN
    4924             :     0U, // G_BRCOND
    4925             :     0U, // G_BRINDIRECT
    4926             :     0U, // G_INTRINSIC
    4927             :     0U, // G_INTRINSIC_W_SIDE_EFFECTS
    4928             :     0U, // G_ANYEXT
    4929             :     0U, // G_TRUNC
    4930             :     0U, // G_CONSTANT
    4931             :     0U, // G_FCONSTANT
    4932             :     0U, // G_VASTART
    4933             :     0U, // G_VAARG
    4934             :     0U, // G_SEXT
    4935             :     0U, // G_ZEXT
    4936             :     0U, // G_SHL
    4937             :     0U, // G_LSHR
    4938             :     0U, // G_ASHR
    4939             :     0U, // G_ICMP
    4940             :     0U, // G_FCMP
    4941             :     0U, // G_SELECT
    4942             :     0U, // G_UADDE
    4943             :     0U, // G_USUBE
    4944             :     0U, // G_SADDO
    4945             :     0U, // G_SSUBO
    4946             :     0U, // G_UMULO
    4947             :     0U, // G_SMULO
    4948             :     0U, // G_UMULH
    4949             :     0U, // G_SMULH
    4950             :     0U, // G_FADD
    4951             :     0U, // G_FSUB
    4952             :     0U, // G_FMUL
    4953             :     0U, // G_FMA
    4954             :     0U, // G_FDIV
    4955             :     0U, // G_FREM
    4956             :     0U, // G_FPOW
    4957             :     0U, // G_FEXP
    4958             :     0U, // G_FEXP2
    4959             :     0U, // G_FLOG
    4960             :     0U, // G_FLOG2
    4961             :     0U, // G_FNEG
    4962             :     0U, // G_FPEXT
    4963             :     0U, // G_FPTRUNC
    4964             :     0U, // G_FPTOSI
    4965             :     0U, // G_FPTOUI
    4966             :     0U, // G_SITOFP
    4967             :     0U, // G_UITOFP
    4968             :     0U, // G_FABS
    4969             :     0U, // G_GEP
    4970             :     0U, // G_PTR_MASK
    4971             :     0U, // G_BR
    4972             :     0U, // G_INSERT_VECTOR_ELT
    4973             :     0U, // G_EXTRACT_VECTOR_ELT
    4974             :     0U, // G_SHUFFLE_VECTOR
    4975             :     0U, // G_BSWAP
    4976             :     0U, // G_ADDRSPACE_CAST
    4977             :     0U, // ABS_ZPmZ_B
    4978             :     128U,       // ABS_ZPmZ_D
    4979             :     257U,       // ABS_ZPmZ_H
    4980             :     384U,       // ABS_ZPmZ_S
    4981             :     2U, // ABSv16i8
    4982             :     3U, // ABSv1i64
    4983             :     4U, // ABSv2i32
    4984             :     5U, // ABSv2i64
    4985             :     6U, // ABSv4i16
    4986             :     7U, // ABSv4i32
    4987             :     8U, // ABSv8i16
    4988             :     9U, // ABSv8i8
    4989             :     522U,       // ADCSWr
    4990             :     522U,       // ADCSXr
    4991             :     522U,       // ADCWr
    4992             :     522U,       // ADCXr
    4993             :     17035U,     // ADDHNv2i64_v2i32
    4994             :     17163U,     // ADDHNv2i64_v4i32
    4995             :     33420U,     // ADDHNv4i32_v4i16
    4996             :     33548U,     // ADDHNv4i32_v8i16
    4997             :     49933U,     // ADDHNv8i16_v16i8
    4998             :     49805U,     // ADDHNv8i16_v8i8
    4999             :     522U,       // ADDPL_XXI
    5000             :     66190U,     // ADDPv16i8
    5001             :     82575U,     // ADDPv2i32
    5002             :     17035U,     // ADDPv2i64
    5003             :     5U, // ADDPv2i64p
    5004             :     98960U,     // ADDPv4i16
    5005             :     33420U,     // ADDPv4i32
    5006             :     49805U,     // ADDPv8i16
    5007             :     115345U,    // ADDPv8i8
    5008             :     906U,       // ADDSWri
    5009             :     0U, // ADDSWrr
    5010             :     1034U,      // ADDSWrs
    5011             :     1162U,      // ADDSWrx
    5012             :     906U,       // ADDSXri
    5013             :     0U, // ADDSXrr
    5014             :     1034U,      // ADDSXrs
    5015             :     1162U,      // ADDSXrx
    5016             :     131594U,    // ADDSXrx64
    5017             :     522U,       // ADDVL_XXI
    5018             :     2U, // ADDVv16i8v
    5019             :     6U, // ADDVv4i16v
    5020             :     7U, // ADDVv4i32v
    5021             :     8U, // ADDVv8i16v
    5022             :     9U, // ADDVv8i8v
    5023             :     906U,       // ADDWri
    5024             :     0U, // ADDWrr
    5025             :     1034U,      // ADDWrs
    5026             :     1162U,      // ADDWrx
    5027             :     906U,       // ADDXri
    5028             :     0U, // ADDXrr
    5029             :     1034U,      // ADDXrs
    5030             :     1162U,      // ADDXrx
    5031             :     131594U,    // ADDXrx64
    5032             :     1290U,      // ADD_ZI_B
    5033             :     1418U,      // ADD_ZI_D
    5034             :     18U,        // ADD_ZI_H
    5035             :     1546U,      // ADD_ZI_S
    5036             :     149120U,    // ADD_ZPmZ_B
    5037             :     1197824U,   // ADD_ZPmZ_D
    5038             :     2262931U,   // ADD_ZPmZ_H
    5039             :     3295232U,   // ADD_ZPmZ_S
    5040             :     1674U,      // ADD_ZZZ_B
    5041             :     1802U,      // ADD_ZZZ_D
    5042             :     275U,       // ADD_ZZZ_H
    5043             :     2058U,      // ADD_ZZZ_S
    5044             :     0U, // ADDlowTLS
    5045             :     66190U,     // ADDv16i8
    5046             :     522U,       // ADDv1i64
    5047             :     82575U,     // ADDv2i32
    5048             :     17035U,     // ADDv2i64
    5049             :     98960U,     // ADDv4i16
    5050             :     33420U,     // ADDv4i32
    5051             :     49805U,     // ADDv8i16
    5052             :     115345U,    // ADDv8i8
    5053             :     0U, // ADJCALLSTACKDOWN
    5054             :     0U, // ADJCALLSTACKUP
    5055             :     3U, // ADR
    5056             :     0U, // ADRP
    5057             :     2186U,      // ADR_LSL_ZZZ_D_0
    5058             :     2314U,      // ADR_LSL_ZZZ_D_1
    5059             :     2442U,      // ADR_LSL_ZZZ_D_2
    5060             :     2570U,      // ADR_LSL_ZZZ_D_3
    5061             :     2698U,      // ADR_LSL_ZZZ_S_0
    5062             :     2826U,      // ADR_LSL_ZZZ_S_1
    5063             :     2954U,      // ADR_LSL_ZZZ_S_2
    5064             :     3082U,      // ADR_LSL_ZZZ_S_3
    5065             :     3210U,      // ADR_SXTW_ZZZ_D_0
    5066             :     3338U,      // ADR_SXTW_ZZZ_D_1
    5067             :     3466U,      // ADR_SXTW_ZZZ_D_2
    5068             :     3594U,      // ADR_SXTW_ZZZ_D_3
    5069             :     3722U,      // ADR_UXTW_ZZZ_D_0
    5070             :     3850U,      // ADR_UXTW_ZZZ_D_1
    5071             :     3978U,      // ADR_UXTW_ZZZ_D_2
    5072             :     4106U,      // ADR_UXTW_ZZZ_D_3
    5073             :     2U, // AESDrr
    5074             :     2U, // AESErr
    5075             :     2U, // AESIMCrr
    5076             :     0U, // AESIMCrrTied
    5077             :     2U, // AESMCrr
    5078             :     0U, // AESMCrrTied
    5079             :     4234U,      // ANDSWri
    5080             :     0U, // ANDSWrr
    5081             :     1034U,      // ANDSWrs
    5082             :     4362U,      // ANDSXri
    5083             :     0U, // ANDSXrr
    5084             :     1034U,      // ANDSXrs
    5085             :     149140U,    // ANDS_PPzPP
    5086             :     4234U,      // ANDWri
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    5088             :     1034U,      // ANDWrs
    5089             :     4362U,      // ANDXri
    5090             :     0U, // ANDXrr
    5091             :     1034U,      // ANDXrs
    5092             :     149140U,    // AND_PPzPP
    5093             :     4362U,      // AND_ZI
    5094             :     149120U,    // AND_ZPmZ_B
    5095             :     1197824U,   // AND_ZPmZ_D
    5096             :     2262931U,   // AND_ZPmZ_H
    5097             :     3295232U,   // AND_ZPmZ_S
    5098             :     1802U,      // AND_ZZZ
    5099             :     66190U,     // ANDv16i8
    5100             :     115345U,    // ANDv8i8
    5101             :     4343424U,   // ASRD_ZPmI_B
    5102             :     4343552U,   // ASRD_ZPmI_D
    5103             :     182163U,    // ASRD_ZPmI_H
    5104             :     4343808U,   // ASRD_ZPmI_S
    5105             :     149120U,    // ASRR_ZPmZ_B
    5106             :     1197824U,   // ASRR_ZPmZ_D
    5107             :     2262931U,   // ASRR_ZPmZ_H
    5108             :     3295232U,   // ASRR_ZPmZ_S
    5109             :     522U,       // ASRVWr
    5110             :     522U,       // ASRVXr
    5111             :     1197696U,   // ASR_WIDE_ZPmZ_B
    5112             :     198547U,    // ASR_WIDE_ZPmZ_H
    5113             :     1198080U,   // ASR_WIDE_ZPmZ_S
    5114             :     1802U,      // ASR_WIDE_ZZZ_B
    5115             :     21U,        // ASR_WIDE_ZZZ_H
    5116             :     1802U,      // ASR_WIDE_ZZZ_S
    5117             :     4343424U,   // ASR_ZPmI_B
    5118             :     4343552U,   // ASR_ZPmI_D
    5119             :     182163U,    // ASR_ZPmI_H
    5120             :     4343808U,   // ASR_ZPmI_S
    5121             :     149120U,    // ASR_ZPmZ_B
    5122             :     1197824U,   // ASR_ZPmZ_D
    5123             :     2262931U,   // ASR_ZPmZ_H
    5124             :     3295232U,   // ASR_ZPmZ_S
    5125             :     522U,       // ASR_ZZI_B
    5126             :     522U,       // ASR_ZZI_D
    5127             :     22U,        // ASR_ZZI_H
    5128             :     522U,       // ASR_ZZI_S
    5129             :     3U, // AUTDA
    5130             :     3U, // AUTDB
    5131             :     0U, // AUTDZA
    5132             :     0U, // AUTDZB
    5133             :     3U, // AUTIA
    5134             :     0U, // AUTIA1716
    5135             :     0U, // AUTIASP
    5136             :     0U, // AUTIAZ
    5137             :     3U, // AUTIB
    5138             :     0U, // AUTIB1716
    5139             :     0U, // AUTIBSP
    5140             :     0U, // AUTIBZ
    5141             :     0U, // AUTIZA
    5142             :     0U, // AUTIZB
    5143             :     0U, // B
    5144             :     5394826U,   // BFMWri
    5145             :     5394826U,   // BFMXri
    5146             :     0U, // BICSWrr
    5147             :     1034U,      // BICSWrs
    5148             :     0U, // BICSXrr
    5149             :     1034U,      // BICSXrs
    5150             :     149140U,    // BICS_PPzPP
    5151             :     0U, // BICWrr
    5152             :     1034U,      // BICWrs
    5153             :     0U, // BICXrr
    5154             :     1034U,      // BICXrs
    5155             :     149140U,    // BIC_PPzPP
    5156             :     149120U,    // BIC_ZPmZ_B
    5157             :     1197824U,   // BIC_ZPmZ_D
    5158             :     2262931U,   // BIC_ZPmZ_H
    5159             :     3295232U,   // BIC_ZPmZ_S
    5160             :     1802U,      // BIC_ZZZ
    5161             :     66190U,     // BICv16i8
    5162             :     0U, // BICv2i32
    5163             :     0U, // BICv4i16
    5164             :     0U, // BICv4i32
    5165             :     0U, // BICv8i16
    5166             :     115345U,    // BICv8i8
    5167             :     66190U,     // BIFv16i8
    5168             :     115345U,    // BIFv8i8
    5169             :     66318U,     // BITv16i8
    5170             :     115473U,    // BITv8i8
    5171             :     0U, // BL
    5172             :     0U, // BLR
    5173             :     3U, // BLRAA
    5174             :     0U, // BLRAAZ
    5175             :     3U, // BLRAB
    5176             :     0U, // BLRABZ
    5177             :     0U, // BR
    5178             :     3U, // BRAA
    5179             :     0U, // BRAAZ
    5180             :     3U, // BRAB
    5181             :     0U, // BRABZ
    5182             :     0U, // BRK
    5183             :     66318U,     // BSLv16i8
    5184             :     115473U,    // BSLv8i8
    5185             :     0U, // Bcc
    5186             :     217495U,    // CASAB
    5187             :     217495U,    // CASAH
    5188             :     217495U,    // CASALB
    5189             :     217495U,    // CASALH
    5190             :     217495U,    // CASALW
    5191             :     217495U,    // CASALX
    5192             :     217495U,    // CASAW
    5193             :     217495U,    // CASAX
    5194             :     217495U,    // CASB
    5195             :     217495U,    // CASH
    5196             :     217495U,    // CASLB
    5197             :     217495U,    // CASLH
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    5199             :     217495U,    // CASLX
    5200             :     0U, // CASPALW
    5201             :     0U, // CASPALX
    5202             :     0U, // CASPAW
    5203             :     0U, // CASPAX
    5204             :     0U, // CASPLW
    5205             :     0U, // CASPLX
    5206             :     0U, // CASPW
    5207             :     0U, // CASPX
    5208             :     217495U,    // CASW
    5209             :     217495U,    // CASX
    5210             :     0U, // CBNZW
    5211             :     0U, // CBNZX
    5212             :     0U, // CBZW
    5213             :     0U, // CBZX
    5214             :     6439434U,   // CCMNWi
    5215             :     6439434U,   // CCMNWr
    5216             :     6439434U,   // CCMNXi
    5217             :     6439434U,   // CCMNXr
    5218             :     6439434U,   // CCMPWi
    5219             :     6439434U,   // CCMPWr
    5220             :     6439434U,   // CCMPXi
    5221             :     6439434U,   // CCMPXr
    5222             :     0U, // CFINV
    5223             :     0U, // CLREX
    5224             :     3U, // CLSWr
    5225             :     3U, // CLSXr
    5226             :     0U, // CLS_ZPmZ_B
    5227             :     128U,       // CLS_ZPmZ_D
    5228             :     257U,       // CLS_ZPmZ_H
    5229             :     384U,       // CLS_ZPmZ_S
    5230             :     2U, // CLSv16i8
    5231             :     4U, // CLSv2i32
    5232             :     6U, // CLSv4i16
    5233             :     7U, // CLSv4i32
    5234             :     8U, // CLSv8i16
    5235             :     9U, // CLSv8i8
    5236             :     3U, // CLZWr
    5237             :     3U, // CLZXr
    5238             :     0U, // CLZ_ZPmZ_B
    5239             :     128U,       // CLZ_ZPmZ_D
    5240             :     257U,       // CLZ_ZPmZ_H
    5241             :     384U,       // CLZ_ZPmZ_S
    5242             :     2U, // CLZv16i8
    5243             :     4U, // CLZv2i32
    5244             :     6U, // CLZv4i16
    5245             :     7U, // CLZv4i32
    5246             :     8U, // CLZv8i16
    5247             :     9U, // CLZv8i8
    5248             :     66190U,     // CMEQv16i8
    5249             :     24U,        // CMEQv16i8rz
    5250             :     522U,       // CMEQv1i64
    5251             :     25U,        // CMEQv1i64rz
    5252             :     82575U,     // CMEQv2i32
    5253             :     26U,        // CMEQv2i32rz
    5254             :     17035U,     // CMEQv2i64
    5255             :     27U,        // CMEQv2i64rz
    5256             :     98960U,     // CMEQv4i16
    5257             :     28U,        // CMEQv4i16rz
    5258             :     33420U,     // CMEQv4i32
    5259             :     29U,        // CMEQv4i32rz
    5260             :     49805U,     // CMEQv8i16
    5261             :     30U,        // CMEQv8i16rz
    5262             :     115345U,    // CMEQv8i8
    5263             :     31U,        // CMEQv8i8rz
    5264             :     66190U,     // CMGEv16i8
    5265             :     24U,        // CMGEv16i8rz
    5266             :     522U,       // CMGEv1i64
    5267             :     25U,        // CMGEv1i64rz
    5268             :     82575U,     // CMGEv2i32
    5269             :     26U,        // CMGEv2i32rz
    5270             :     17035U,     // CMGEv2i64
    5271             :     27U,        // CMGEv2i64rz
    5272             :     98960U,     // CMGEv4i16
    5273             :     28U,        // CMGEv4i16rz
    5274             :     33420U,     // CMGEv4i32
    5275             :     29U,        // CMGEv4i32rz
    5276             :     49805U,     // CMGEv8i16
    5277             :     30U,        // CMGEv8i16rz
    5278             :     115345U,    // CMGEv8i8
    5279             :     31U,        // CMGEv8i8rz
    5280             :     66190U,     // CMGTv16i8
    5281             :     24U,        // CMGTv16i8rz
    5282             :     522U,       // CMGTv1i64
    5283             :     25U,        // CMGTv1i64rz
    5284             :     82575U,     // CMGTv2i32
    5285             :     26U,        // CMGTv2i32rz
    5286             :     17035U,     // CMGTv2i64
    5287             :     27U,        // CMGTv2i64rz
    5288             :     98960U,     // CMGTv4i16
    5289             :     28U,        // CMGTv4i16rz
    5290             :     33420U,     // CMGTv4i32
    5291             :     29U,        // CMGTv4i32rz
    5292             :     49805U,     // CMGTv8i16
    5293             :     30U,        // CMGTv8i16rz
    5294             :     115345U,    // CMGTv8i8
    5295             :     31U,        // CMGTv8i8rz
    5296             :     66190U,     // CMHIv16i8
    5297             :     522U,       // CMHIv1i64
    5298             :     82575U,     // CMHIv2i32
    5299             :     17035U,     // CMHIv2i64
    5300             :     98960U,     // CMHIv4i16
    5301             :     33420U,     // CMHIv4i32
    5302             :     49805U,     // CMHIv8i16
    5303             :     115345U,    // CMHIv8i8
    5304             :     66190U,     // CMHSv16i8
    5305             :     522U,       // CMHSv1i64
    5306             :     82575U,     // CMHSv2i32
    5307             :     17035U,     // CMHSv2i64
    5308             :     98960U,     // CMHSv4i16
    5309             :     33420U,     // CMHSv4i32
    5310             :     49805U,     // CMHSv8i16
    5311             :     115345U,    // CMHSv8i8
    5312             :     24U,        // CMLEv16i8rz
    5313             :     25U,        // CMLEv1i64rz
    5314             :     26U,        // CMLEv2i32rz
    5315             :     27U,        // CMLEv2i64rz
    5316             :     28U,        // CMLEv4i16rz
    5317             :     29U,        // CMLEv4i32rz
    5318             :     30U,        // CMLEv8i16rz
    5319             :     31U,        // CMLEv8i8rz
    5320             :     24U,        // CMLTv16i8rz
    5321             :     25U,        // CMLTv1i64rz
    5322             :     26U,        // CMLTv2i32rz
    5323             :     27U,        // CMLTv2i64rz
    5324             :     28U,        // CMLTv4i16rz
    5325             :     29U,        // CMLTv4i32rz
    5326             :     30U,        // CMLTv8i16rz
    5327             :     31U,        // CMLTv8i8rz
    5328             :     4343444U,   // CMPEQ_PPzZI_B
    5329             :     4343572U,   // CMPEQ_PPzZI_D
    5330             :     182163U,    // CMPEQ_PPzZI_H
    5331             :     4343828U,   // CMPEQ_PPzZI_S
    5332             :     149140U,    // CMPEQ_PPzZZ_B
    5333             :     1197844U,   // CMPEQ_PPzZZ_D
    5334             :     2262931U,   // CMPEQ_PPzZZ_H
    5335             :     3295252U,   // CMPEQ_PPzZZ_S
    5336             :     1197716U,   // CMPEQ_WIDE_PPzZZ_B
    5337             :     198547U,    // CMPEQ_WIDE_PPzZZ_H
    5338             :     1198100U,   // CMPEQ_WIDE_PPzZZ_S
    5339             :     4343444U,   // CMPGE_PPzZI_B
    5340             :     4343572U,   // CMPGE_PPzZI_D
    5341             :     182163U,    // CMPGE_PPzZI_H
    5342             :     4343828U,   // CMPGE_PPzZI_S
    5343             :     149140U,    // CMPGE_PPzZZ_B
    5344             :     1197844U,   // CMPGE_PPzZZ_D
    5345             :     2262931U,   // CMPGE_PPzZZ_H
    5346             :     3295252U,   // CMPGE_PPzZZ_S
    5347             :     1197716U,   // CMPGE_WIDE_PPzZZ_B
    5348             :     198547U,    // CMPGE_WIDE_PPzZZ_H
    5349             :     1198100U,   // CMPGE_WIDE_PPzZZ_S
    5350             :     4343444U,   // CMPGT_PPzZI_B
    5351             :     4343572U,   // CMPGT_PPzZI_D
    5352             :     182163U,    // CMPGT_PPzZI_H
    5353             :     4343828U,   // CMPGT_PPzZI_S
    5354             :     149140U,    // CMPGT_PPzZZ_B
    5355             :     1197844U,   // CMPGT_PPzZZ_D
    5356             :     2262931U,   // CMPGT_PPzZZ_H
    5357             :     3295252U,   // CMPGT_PPzZZ_S
    5358             :     1197716U,   // CMPGT_WIDE_PPzZZ_B
    5359             :     198547U,    // CMPGT_WIDE_PPzZZ_H
    5360             :     1198100U,   // CMPGT_WIDE_PPzZZ_S
    5361             :     7489172U,   // CMPHI_PPzZI_B
    5362             :     7489300U,   // CMPHI_PPzZI_D
    5363             :     231315U,    // CMPHI_PPzZI_H
    5364             :     7489556U,   // CMPHI_PPzZI_S
    5365             :     149140U,    // CMPHI_PPzZZ_B
    5366             :     1197844U,   // CMPHI_PPzZZ_D
    5367             :     2262931U,   // CMPHI_PPzZZ_H
    5368             :     3295252U,   // CMPHI_PPzZZ_S
    5369             :     1197716U,   // CMPHI_WIDE_PPzZZ_B
    5370             :     198547U,    // CMPHI_WIDE_PPzZZ_H
    5371             :     1198100U,   // CMPHI_WIDE_PPzZZ_S
    5372             :     7489172U,   // CMPHS_PPzZI_B
    5373             :     7489300U,   // CMPHS_PPzZI_D
    5374             :     231315U,    // CMPHS_PPzZI_H
    5375             :     7489556U,   // CMPHS_PPzZI_S
    5376             :     149140U,    // CMPHS_PPzZZ_B
    5377             :     1197844U,   // CMPHS_PPzZZ_D
    5378             :     2262931U,   // CMPHS_PPzZZ_H
    5379             :     3295252U,   // CMPHS_PPzZZ_S
    5380             :     1197716U,   // CMPHS_WIDE_PPzZZ_B
    5381             :     198547U,    // CMPHS_WIDE_PPzZZ_H
    5382             :     1198100U,   // CMPHS_WIDE_PPzZZ_S
    5383             :     4343444U,   // CMPLE_PPzZI_B
    5384             :     4343572U,   // CMPLE_PPzZI_D
    5385             :     182163U,    // CMPLE_PPzZI_H
    5386             :     4343828U,   // CMPLE_PPzZI_S
    5387             :     1197716U,   // CMPLE_WIDE_PPzZZ_B
    5388             :     198547U,    // CMPLE_WIDE_PPzZZ_H
    5389             :     1198100U,   // CMPLE_WIDE_PPzZZ_S
    5390             :     7489172U,   // CMPLO_PPzZI_B
    5391             :     7489300U,   // CMPLO_PPzZI_D
    5392             :     231315U,    // CMPLO_PPzZI_H
    5393             :     7489556U,   // CMPLO_PPzZI_S
    5394             :     1197716U,   // CMPLO_WIDE_PPzZZ_B
    5395             :     198547U,    // CMPLO_WIDE_PPzZZ_H
    5396             :     1198100U,   // CMPLO_WIDE_PPzZZ_S
    5397             :     7489172U,   // CMPLS_PPzZI_B
    5398             :     7489300U,   // CMPLS_PPzZI_D
    5399             :     231315U,    // CMPLS_PPzZI_H
    5400             :     7489556U,   // CMPLS_PPzZI_S
    5401             :     1197716U,   // CMPLS_WIDE_PPzZZ_B
    5402             :     198547U,    // CMPLS_WIDE_PPzZZ_H
    5403             :     1198100U,   // CMPLS_WIDE_PPzZZ_S
    5404             :     4343444U,   // CMPLT_PPzZI_B
    5405             :     4343572U,   // CMPLT_PPzZI_D
    5406             :     182163U,    // CMPLT_PPzZI_H
    5407             :     4343828U,   // CMPLT_PPzZI_S
    5408             :     1197716U,   // CMPLT_WIDE_PPzZZ_B
    5409             :     198547U,    // CMPLT_WIDE_PPzZZ_H
    5410             :     1198100U,   // CMPLT_WIDE_PPzZZ_S
    5411             :     4343444U,   // CMPNE_PPzZI_B
    5412             :     4343572U,   // CMPNE_PPzZI_D
    5413             :     182163U,    // CMPNE_PPzZI_H
    5414             :     4343828U,   // CMPNE_PPzZI_S
    5415             :     149140U,    // CMPNE_PPzZZ_B
    5416             :     1197844U,   // CMPNE_PPzZZ_D
    5417             :     2262931U,   // CMPNE_PPzZZ_H
    5418             :     3295252U,   // CMPNE_PPzZZ_S
    5419             :     1197716U,   // CMPNE_WIDE_PPzZZ_B
    5420             :     198547U,    // CMPNE_WIDE_PPzZZ_H
    5421             :     1198100U,   // CMPNE_WIDE_PPzZZ_S
    5422             :     0U, // CMP_SWAP_128
    5423             :     0U, // CMP_SWAP_16
    5424             :     0U, // CMP_SWAP_32
    5425             :     0U, // CMP_SWAP_64
    5426             :     0U, // CMP_SWAP_8
    5427             :     66190U,     // CMTSTv16i8
    5428             :     522U,       // CMTSTv1i64
    5429             :     82575U,     // CMTSTv2i32
    5430             :     17035U,     // CMTSTv2i64
    5431             :     98960U,     // CMTSTv4i16
    5432             :     33420U,     // CMTSTv4i32
    5433             :     49805U,     // CMTSTv8i16
    5434             :     115345U,    // CMTSTv8i8
    5435             :     0U, // CNOT_ZPmZ_B
    5436             :     128U,       // CNOT_ZPmZ_D
    5437             :     257U,       // CNOT_ZPmZ_H
    5438             :     384U,       // CNOT_ZPmZ_S
    5439             :     32U,        // CNTB_XPiI
    5440             :     32U,        // CNTD_XPiI
    5441             :     32U,        // CNTH_XPiI
    5442             :     1674U,      // CNTP_XPP_B
    5443             :     1802U,      // CNTP_XPP_D
    5444             :     4618U,      // CNTP_XPP_H
    5445             :     2058U,      // CNTP_XPP_S
    5446             :     32U,        // CNTW_XPiI
    5447             :     0U, // CNT_ZPmZ_B
    5448             :     128U,       // CNT_ZPmZ_D
    5449             :     257U,       // CNT_ZPmZ_H
    5450             :     384U,       // CNT_ZPmZ_S
    5451             :     2U, // CNTv16i8
    5452             :     9U, // CNTv8i8
    5453             :     4736U,      // CPY_ZPmI_B
    5454             :     4864U,      // CPY_ZPmI_D
    5455             :     33U,        // CPY_ZPmI_H
    5456             :     4992U,      // CPY_ZPmI_S
    5457             :     4480U,      // CPY_ZPmR_B
    5458             :     4480U,      // CPY_ZPmR_D
    5459             :     290U,       // CPY_ZPmR_H
    5460             :     4480U,      // CPY_ZPmR_S
    5461             :     4480U,      // CPY_ZPmV_B
    5462             :     4480U,      // CPY_ZPmV_D
    5463             :     290U,       // CPY_ZPmV_H
    5464             :     4480U,      // CPY_ZPmV_S
    5465             :     5140U,      // CPY_ZPzI_B
    5466             :     5268U,      // CPY_ZPzI_D
    5467             :     35U,        // CPY_ZPzI_H
    5468             :     5396U,      // CPY_ZPzI_S
    5469             :     5540U,      // CPYi16
    5470             :     5541U,      // CPYi32
    5471             :     5542U,      // CPYi64
    5472             :     5543U,      // CPYi8
    5473             :     522U,       // CRC32Brr
    5474             :     522U,       // CRC32CBrr
    5475             :     522U,       // CRC32CHrr
    5476             :     522U,       // CRC32CWrr
    5477             :     522U,       // CRC32CXrr
    5478             :     522U,       // CRC32Hrr
    5479             :     522U,       // CRC32Wrr
    5480             :     522U,       // CRC32Xrr
    5481             :     6439434U,   // CSELWr
    5482             :     6439434U,   // CSELXr
    5483             :     6439434U,   // CSINCWr
    5484             :     6439434U,   // CSINCXr
    5485             :     6439434U,   // CSINVWr
    5486             :     6439434U,   // CSINVXr
    5487             :     6439434U,   // CSNEGWr
    5488             :     6439434U,   // CSNEGXr
    5489             :     0U, // CompilerBarrier
    5490             :     0U, // DCPS1
    5491             :     0U, // DCPS2
    5492             :     0U, // DCPS3
    5493             :     0U, // DECB_XPiI
    5494             :     0U, // DECD_XPiI
    5495             :     0U, // DECD_ZPiI
    5496             :     0U, // DECH_XPiI
    5497             :     0U, // DECH_ZPiI
    5498             :     3U, // DECP_XP_B
    5499             :     3U, // DECP_XP_D
    5500             :     3U, // DECP_XP_H
    5501             :     3U, // DECP_XP_S
    5502             :     3U, // DECP_ZP_D
    5503             :     0U, // DECP_ZP_H
    5504             :     3U, // DECP_ZP_S
    5505             :     0U, // DECW_XPiI
    5506             :     0U, // DECW_ZPiI
    5507             :     0U, // DMB
    5508             :     0U, // DRPS
    5509             :     0U, // DSB
    5510             :     0U, // DUPM_ZI
    5511             :     0U, // DUP_ZI_B
    5512             :     0U, // DUP_ZI_D
    5513             :     0U, // DUP_ZI_H
    5514             :     0U, // DUP_ZI_S
    5515             :     3U, // DUP_ZR_B
    5516             :     3U, // DUP_ZR_D
    5517             :     0U, // DUP_ZR_H
    5518             :     3U, // DUP_ZR_S
    5519             :     40U,        // DUP_ZZI_B
    5520             :     40U,        // DUP_ZZI_D
    5521             :     0U, // DUP_ZZI_H
    5522             :     0U, // DUP_ZZI_Q
    5523             :     40U,        // DUP_ZZI_S
    5524             :     3U, // DUPv16i8gpr
    5525             :     5543U,      // DUPv16i8lane
    5526             :     3U, // DUPv2i32gpr
    5527             :     5541U,      // DUPv2i32lane
    5528             :     3U, // DUPv2i64gpr
    5529             :     5542U,      // DUPv2i64lane
    5530             :     3U, // DUPv4i16gpr
    5531             :     5540U,      // DUPv4i16lane
    5532             :     3U, // DUPv4i32gpr
    5533             :     5541U,      // DUPv4i32lane
    5534             :     3U, // DUPv8i16gpr
    5535             :     5540U,      // DUPv8i16lane
    5536             :     3U, // DUPv8i8gpr
    5537             :     5543U,      // DUPv8i8lane
    5538             :     0U, // EONWrr
    5539             :     1034U,      // EONWrs
    5540             :     0U, // EONXrr
    5541             :     1034U,      // EONXrs
    5542             :     149140U,    // EORS_PPzPP
    5543             :     4234U,      // EORWri
    5544             :     0U, // EORWrr
    5545             :     1034U,      // EORWrs
    5546             :     4362U,      // EORXri
    5547             :     0U, // EORXrr
    5548             :     1034U,      // EORXrs
    5549             :     149140U,    // EOR_PPzPP
    5550             :     4362U,      // EOR_ZI
    5551             :     149120U,    // EOR_ZPmZ_B
    5552             :     1197824U,   // EOR_ZPmZ_D
    5553             :     2262931U,   // EOR_ZPmZ_H
    5554             :     3295232U,   // EOR_ZPmZ_S
    5555             :     1802U,      // EOR_ZZZ
    5556             :     66190U,     // EORv16i8
    5557             :     115345U,    // EORv8i8
    5558             :     0U, // ERET
    5559             :     0U, // ERETAA
    5560             :     0U, // ERETAB
    5561             :     4342282U,   // EXTRWrri
    5562             :     4342282U,   // EXTRXrri
    5563             :     246414U,    // EXTv16i8
    5564             :     262801U,    // EXTv8i8
    5565             :     0U, // F128CSEL
    5566             :     522U,       // FABD16
    5567             :     522U,       // FABD32
    5568             :     522U,       // FABD64
    5569             :     82575U,     // FABDv2f32
    5570             :     17035U,     // FABDv2f64
    5571             :     98960U,     // FABDv4f16
    5572             :     33420U,     // FABDv4f32
    5573             :     49805U,     // FABDv8f16
    5574             :     3U, // FABSDr
    5575             :     3U, // FABSHr
    5576             :     3U, // FABSSr
    5577             :     128U,       // FABS_ZPmZ_D
    5578             :     257U,       // FABS_ZPmZ_H
    5579             :     384U,       // FABS_ZPmZ_S
    5580             :     4U, // FABSv2f32
    5581             :     5U, // FABSv2f64
    5582             :     6U, // FABSv4f16
    5583             :     7U, // FABSv4f32
    5584             :     8U, // FABSv8f16
    5585             :     522U,       // FACGE16
    5586             :     522U,       // FACGE32
    5587             :     522U,       // FACGE64
    5588             :     1197844U,   // FACGE_PPzZZ_D
    5589             :     2262931U,   // FACGE_PPzZZ_H
    5590             :     3295252U,   // FACGE_PPzZZ_S
    5591             :     82575U,     // FACGEv2f32
    5592             :     17035U,     // FACGEv2f64
    5593             :     98960U,     // FACGEv4f16
    5594             :     33420U,     // FACGEv4f32
    5595             :     49805U,     // FACGEv8f16
    5596             :     522U,       // FACGT16
    5597             :     522U,       // FACGT32
    5598             :     522U,       // FACGT64
    5599             :     1197844U,   // FACGT_PPzZZ_D
    5600             :     2262931U,   // FACGT_PPzZZ_H
    5601             :     3295252U,   // FACGT_PPzZZ_S
    5602             :     82575U,     // FACGTv2f32
    5603             :     17035U,     // FACGTv2f64
    5604             :     98960U,     // FACGTv4f16
    5605             :     33420U,     // FACGTv4f32
    5606             :     49805U,     // FACGTv8f16
    5607             :     522U,       // FADDDrr
    5608             :     522U,       // FADDHrr
    5609             :     82575U,     // FADDPv2f32
    5610             :     17035U,     // FADDPv2f64
    5611             :     41U,        // FADDPv2i16p
    5612             :     4U, // FADDPv2i32p
    5613             :     5U, // FADDPv2i64p
    5614             :     98960U,     // FADDPv4f16
    5615             :     33420U,     // FADDPv4f32
    5616             :     49805U,     // FADDPv8f16
    5617             :     522U,       // FADDSrr
    5618             :     8537856U,   // FADD_ZPmI_D
    5619             :     280467U,    // FADD_ZPmI_H
    5620             :     8538112U,   // FADD_ZPmI_S
    5621             :     82575U,     // FADDv2f32
    5622             :     17035U,     // FADDv2f64
    5623             :     98960U,     // FADDv4f16
    5624             :     33420U,     // FADDv4f32
    5625             :     49805U,     // FADDv8f16
    5626             :     68306688U,  // FCADD_ZPmZ_D
    5627             :     9602963U,   // FCADD_ZPmZ_H
    5628             :     70404096U,  // FCADD_ZPmZ_S
    5629             :     10781327U,  // FCADDv2f32
    5630             :     10797707U,  // FCADDv2f64
    5631             :     10814096U,  // FCADDv4f16
    5632             :     10830476U,  // FCADDv4f32
    5633             :     10846861U,  // FCADDv8f16
    5634             :     6439434U,   // FCCMPDrr
    5635             :     6439434U,   // FCCMPEDrr
    5636             :     6439434U,   // FCCMPEHrr
    5637             :     6439434U,   // FCCMPESrr
    5638             :     6439434U,   // FCCMPHrr
    5639             :     6439434U,   // FCCMPSrr
    5640             :     522U,       // FCMEQ16
    5641             :     522U,       // FCMEQ32
    5642             :     522U,       // FCMEQ64
    5643             :     378644U,    // FCMEQ_PPzZ0_D
    5644             :     5651U,      // FCMEQ_PPzZ0_H
    5645             :     378900U,    // FCMEQ_PPzZ0_S
    5646             :     1197844U,   // FCMEQ_PPzZZ_D
    5647             :     2262931U,   // FCMEQ_PPzZZ_H
    5648             :     3295252U,   // FCMEQ_PPzZZ_S
    5649             :     42U,        // FCMEQv1i16rz
    5650             :     42U,        // FCMEQv1i32rz
    5651             :     42U,        // FCMEQv1i64rz
    5652             :     82575U,     // FCMEQv2f32
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    5654             :     43U,        // FCMEQv2i32rz
    5655             :     44U,        // FCMEQv2i64rz
    5656             :     98960U,     // FCMEQv4f16
    5657             :     33420U,     // FCMEQv4f32
    5658             :     45U,        // FCMEQv4i16rz
    5659             :     46U,        // FCMEQv4i32rz
    5660             :     49805U,     // FCMEQv8f16
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    5767             :     6439434U,   // FCSELSrrr
    5768             :     3U, // FCVTASUWDr
    5769             :     3U, // FCVTASUWHr
    5770             :     3U, // FCVTASUWSr
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    5832             :     3U, // FCVTNSUWDr
    5833             :     3U, // FCVTNSUWHr
    5834             :     3U, // FCVTNSUWSr
    5835             :     3U, // FCVTNSUXDr
    5836             :     3U, // FCVTNSUXHr
    5837             :     3U, // FCVTNSUXSr
    5838             :     3U, // FCVTNSv1f16
    5839             :     3U, // FCVTNSv1i32
    5840             :     3U, // FCVTNSv1i64
    5841             :     4U, // FCVTNSv2f32
    5842             :     5U, // FCVTNSv2f64
    5843             :     6U, // FCVTNSv4f16
    5844             :     7U, // FCVTNSv4f32
    5845             :     8U, // FCVTNSv8f16
    5846             :     3U, // FCVTNUUWDr
    5847             :     3U, // FCVTNUUWHr
    5848             :     3U, // FCVTNUUWSr
    5849             :     3U, // FCVTNUUXDr
    5850             :     3U, // FCVTNUUXHr
    5851             :     3U, // FCVTNUUXSr
    5852             :     3U, // FCVTNUv1f16
    5853             :     3U, // FCVTNUv1i32
    5854             :     3U, // FCVTNUv1i64
    5855             :     4U, // FCVTNUv2f32
    5856             :     5U, // FCVTNUv2f64
    5857             :     6U, // FCVTNUv4f16
    5858             :     7U, // FCVTNUv4f32
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    5860             :     5U, // FCVTNv2i32
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    5864             :     3U, // FCVTPSUWDr
    5865             :     3U, // FCVTPSUWHr
    5866             :     3U, // FCVTPSUWSr
    5867             :     3U, // FCVTPSUXDr
    5868             :     3U, // FCVTPSUXHr
    5869             :     3U, // FCVTPSUXSr
    5870             :     3U, // FCVTPSv1f16
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    5875             :     6U, // FCVTPSv4f16
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    5880             :     3U, // FCVTPUUWSr
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    5882             :     3U, // FCVTPUUXHr
    5883             :     3U, // FCVTPUUXSr
    5884             :     3U, // FCVTPUv1f16
    5885             :     3U, // FCVTPUv1i32
    5886             :     3U, // FCVTPUv1i64
    5887             :     4U, // FCVTPUv2f32
    5888             :     5U, // FCVTPUv2f64
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    5890             :     7U, // FCVTPUv4f32
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    5899             :     522U,       // FCVTZSSWSri
    5900             :     522U,       // FCVTZSSXDri
    5901             :     522U,       // FCVTZSSXHri
    5902             :     522U,       // FCVTZSSXSri
    5903             :     3U, // FCVTZSUWDr
    5904             :     3U, // FCVTZSUWHr
    5905             :     3U, // FCVTZSUWSr
    5906             :     3U, // FCVTZSUXDr
    5907             :     3U, // FCVTZSUXHr
    5908             :     3U, // FCVTZSUXSr
    5909             :     128U,       // FCVTZS_ZPmZ_DtoD
    5910             :     128U,       // FCVTZS_ZPmZ_DtoS
    5911             :     6016U,      // FCVTZS_ZPmZ_HtoD
    5912             :     257U,       // FCVTZS_ZPmZ_HtoH
    5913             :     6016U,      // FCVTZS_ZPmZ_HtoS
    5914             :     384U,       // FCVTZS_ZPmZ_StoD
    5915             :     384U,       // FCVTZS_ZPmZ_StoS
    5916             :     522U,       // FCVTZSd
    5917             :     522U,       // FCVTZSh
    5918             :     522U,       // FCVTZSs
    5919             :     3U, // FCVTZSv1f16
    5920             :     3U, // FCVTZSv1i32
    5921             :     3U, // FCVTZSv1i64
    5922             :     4U, // FCVTZSv2f32
    5923             :     5U, // FCVTZSv2f64
    5924             :     527U,       // FCVTZSv2i32_shift
    5925             :     523U,       // FCVTZSv2i64_shift
    5926             :     6U, // FCVTZSv4f16
    5927             :     7U, // FCVTZSv4f32
    5928             :     528U,       // FCVTZSv4i16_shift
    5929             :     524U,       // FCVTZSv4i32_shift
    5930             :     8U, // FCVTZSv8f16
    5931             :     525U,       // FCVTZSv8i16_shift
    5932             :     522U,       // FCVTZUSWDri
    5933             :     522U,       // FCVTZUSWHri
    5934             :     522U,       // FCVTZUSWSri
    5935             :     522U,       // FCVTZUSXDri
    5936             :     522U,       // FCVTZUSXHri
    5937             :     522U,       // FCVTZUSXSri
    5938             :     3U, // FCVTZUUWDr
    5939             :     3U, // FCVTZUUWHr
    5940             :     3U, // FCVTZUUWSr
    5941             :     3U, // FCVTZUUXDr
    5942             :     3U, // FCVTZUUXHr
    5943             :     3U, // FCVTZUUXSr
    5944             :     128U,       // FCVTZU_ZPmZ_DtoD
    5945             :     128U,       // FCVTZU_ZPmZ_DtoS
    5946             :     6016U,      // FCVTZU_ZPmZ_HtoD
    5947             :     257U,       // FCVTZU_ZPmZ_HtoH
    5948             :     6016U,      // FCVTZU_ZPmZ_HtoS
    5949             :     384U,       // FCVTZU_ZPmZ_StoD
    5950             :     384U,       // FCVTZU_ZPmZ_StoS
    5951             :     522U,       // FCVTZUd
    5952             :     522U,       // FCVTZUh
    5953             :     522U,       // FCVTZUs
    5954             :     3U, // FCVTZUv1f16
    5955             :     3U, // FCVTZUv1i32
    5956             :     3U, // FCVTZUv1i64
    5957             :     4U, // FCVTZUv2f32
    5958             :     5U, // FCVTZUv2f64
    5959             :     527U,       // FCVTZUv2i32_shift
    5960             :     523U,       // FCVTZUv2i64_shift
    5961             :     6U, // FCVTZUv4f16
    5962             :     7U, // FCVTZUv4f32
    5963             :     528U,       // FCVTZUv4i16_shift
    5964             :     524U,       // FCVTZUv4i32_shift
    5965             :     8U, // FCVTZUv8f16
    5966             :     525U,       // FCVTZUv8i16_shift
    5967             :     50U,        // FCVT_ZPmZ_DtoH
    5968             :     128U,       // FCVT_ZPmZ_DtoS
    5969             :     6016U,      // FCVT_ZPmZ_HtoD
    5970             :     6016U,      // FCVT_ZPmZ_HtoS
    5971             :     384U,       // FCVT_ZPmZ_StoD
    5972             :     304U,       // FCVT_ZPmZ_StoH
    5973             :     522U,       // FDIVDrr
    5974             :     522U,       // FDIVHrr
    5975             :     522U,       // FDIVSrr
    5976             :     82575U,     // FDIVv2f32
    5977             :     17035U,     // FDIVv2f64
    5978             :     98960U,     // FDIVv4f16
    5979             :     33420U,     // FDIVv4f32
    5980             :     49805U,     // FDIVv8f16
    5981             :     0U, // FDUP_ZI_D
    5982             :     0U, // FDUP_ZI_H
    5983             :     0U, // FDUP_ZI_S
    5984             :     3U, // FJCVTZS
    5985             :     4342282U,   // FMADDDrrr
    5986             :     4342282U,   // FMADDHrrr
    5987             :     4342282U,   // FMADDSrrr
    5988             :     522U,       // FMAXDrr
    5989             :     522U,       // FMAXHrr
    5990             :     522U,       // FMAXNMDrr
    5991             :     522U,       // FMAXNMHrr
    5992             :     82575U,     // FMAXNMPv2f32
    5993             :     17035U,     // FMAXNMPv2f64
    5994             :     41U,        // FMAXNMPv2i16p
    5995             :     4U, // FMAXNMPv2i32p
    5996             :     5U, // FMAXNMPv2i64p
    5997             :     98960U,     // FMAXNMPv4f16
    5998             :     33420U,     // FMAXNMPv4f32
    5999             :     49805U,     // FMAXNMPv8f16
    6000             :     522U,       // FMAXNMSrr
    6001             :     6U, // FMAXNMVv4i16v
    6002             :     7U, // FMAXNMVv4i32v
    6003             :     8U, // FMAXNMVv8i16v
    6004             :     82575U,     // FMAXNMv2f32
    6005             :     17035U,     // FMAXNMv2f64
    6006             :     98960U,     // FMAXNMv4f16
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    6012             :     4U, // FMAXPv2i32p
    6013             :     5U, // FMAXPv2i64p
    6014             :     98960U,     // FMAXPv4f16
    6015             :     33420U,     // FMAXPv4f32
    6016             :     49805U,     // FMAXPv8f16
    6017             :     522U,       // FMAXSrr
    6018             :     6U, // FMAXVv4i16v
    6019             :     7U, // FMAXVv4i32v
    6020             :     8U, // FMAXVv8i16v
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    6203             :     128U,       // FRINTA_ZPmZ_D
    6204             :     257U,       // FRINTA_ZPmZ_H
    6205             :     384U,       // FRINTA_ZPmZ_S
    6206             :     4U, // FRINTAv2f32
    6207             :     5U, // FRINTAv2f64
    6208             :     6U, // FRINTAv4f16
    6209             :     7U, // FRINTAv4f32
    6210             :     8U, // FRINTAv8f16
    6211             :     3U, // FRINTIDr
    6212             :     3U, // FRINTIHr
    6213             :     3U, // FRINTISr
    6214             :     128U,       // FRINTI_ZPmZ_D
    6215             :     257U,       // FRINTI_ZPmZ_H
    6216             :     384U,       // FRINTI_ZPmZ_S
    6217             :     4U, // FRINTIv2f32
    6218             :     5U, // FRINTIv2f64
    6219             :     6U, // FRINTIv4f16
    6220             :     7U, // FRINTIv4f32
    6221             :     8U, // FRINTIv8f16
    6222             :     3U, // FRINTMDr
    6223             :     3U, // FRINTMHr
    6224             :     3U, // FRINTMSr
    6225             :     128U,       // FRINTM_ZPmZ_D
    6226             :     257U,       // FRINTM_ZPmZ_H
    6227             :     384U,       // FRINTM_ZPmZ_S
    6228             :     4U, // FRINTMv2f32
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    6230             :     6U, // FRINTMv4f16
    6231             :     7U, // FRINTMv4f32
    6232             :     8U, // FRINTMv8f16
    6233             :     3U, // FRINTNDr
    6234             :     3U, // FRINTNHr
    6235             :     3U, // FRINTNSr
    6236             :     128U,       // FRINTN_ZPmZ_D
    6237             :     257U,       // FRINTN_ZPmZ_H
    6238             :     384U,       // FRINTN_ZPmZ_S
    6239             :     4U, // FRINTNv2f32
    6240             :     5U, // FRINTNv2f64
    6241             :     6U, // FRINTNv4f16
    6242             :     7U, // FRINTNv4f32
    6243             :     8U, // FRINTNv8f16
    6244             :     3U, // FRINTPDr
    6245             :     3U, // FRINTPHr
    6246             :     3U, // FRINTPSr
    6247             :     128U,       // FRINTP_ZPmZ_D
    6248             :     257U,       // FRINTP_ZPmZ_H
    6249             :     384U,       // FRINTP_ZPmZ_S
    6250             :     4U, // FRINTPv2f32
    6251             :     5U, // FRINTPv2f64
    6252             :     6U, // FRINTPv4f16
    6253             :     7U, // FRINTPv4f32
    6254             :     8U, // FRINTPv8f16
    6255             :     3U, // FRINTXDr
    6256             :     3U, // FRINTXHr
    6257             :     3U, // FRINTXSr
    6258             :     128U,       // FRINTX_ZPmZ_D
    6259             :     257U,       // FRINTX_ZPmZ_H
    6260             :     384U,       // FRINTX_ZPmZ_S
    6261             :     4U, // FRINTXv2f32
    6262             :     5U, // FRINTXv2f64
    6263             :     6U, // FRINTXv4f16
    6264             :     7U, // FRINTXv4f32
    6265             :     8U, // FRINTXv8f16
    6266             :     3U, // FRINTZDr
    6267             :     3U, // FRINTZHr
    6268             :     3U, // FRINTZSr
    6269             :     128U,       // FRINTZ_ZPmZ_D
    6270             :     257U,       // FRINTZ_ZPmZ_H
    6271             :     384U,       // FRINTZ_ZPmZ_S
    6272             :     4U, // FRINTZv2f32
    6273             :     5U, // FRINTZv2f64
    6274             :     6U, // FRINTZv4f16
    6275             :     7U, // FRINTZv4f32
    6276             :     8U, // FRINTZv8f16
    6277             :     3U, // FRSQRTEv1f16
    6278             :     3U, // FRSQRTEv1i32
    6279             :     3U, // FRSQRTEv1i64
    6280             :     4U, // FRSQRTEv2f32
    6281             :     5U, // FRSQRTEv2f64
    6282             :     6U, // FRSQRTEv4f16
    6283             :     7U, // FRSQRTEv4f32
    6284             :     8U, // FRSQRTEv8f16
    6285             :     522U,       // FRSQRTS16
    6286             :     522U,       // FRSQRTS32
    6287             :     522U,       // FRSQRTS64
    6288             :     82575U,     // FRSQRTSv2f32
    6289             :     17035U,     // FRSQRTSv2f64
    6290             :     98960U,     // FRSQRTSv4f16
    6291             :     33420U,     // FRSQRTSv4f32
    6292             :     49805U,     // FRSQRTSv8f16
    6293             :     3U, // FSQRTDr
    6294             :     3U, // FSQRTHr
    6295             :     3U, // FSQRTSr
    6296             :     128U,       // FSQRT_ZPmZ_D
    6297             :     257U,       // FSQRT_ZPmZ_H
    6298             :     384U,       // FSQRT_ZPmZ_S
    6299             :     4U, // FSQRTv2f32
    6300             :     5U, // FSQRTv2f64
    6301             :     6U, // FSQRTv4f16
    6302             :     7U, // FSQRTv4f32
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    6304             :     522U,       // FSUBDrr
    6305             :     522U,       // FSUBHrr
    6306             :     522U,       // FSUBSrr
    6307             :     82575U,     // FSUBv2f32
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    6312             :     6306U,      // GLD1B_D_IMM_REAL
    6313             :     6410U,      // GLD1B_D_REAL
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    6317             :     6794U,      // GLD1B_S_SXTW_REAL
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    6319             :     51U,        // GLD1D_IMM_REAL
    6320             :     6410U,      // GLD1D_REAL
    6321             :     7050U,      // GLD1D_SCALED_REAL
    6322             :     6538U,      // GLD1D_SXTW_REAL
    6323             :     7178U,      // GLD1D_SXTW_SCALED_REAL
    6324             :     6666U,      // GLD1D_UXTW_REAL
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    6326             :     52U,        // GLD1H_D_IMM_REAL
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    6329             :     6538U,      // GLD1H_D_SXTW_REAL
    6330             :     7562U,      // GLD1H_D_SXTW_SCALED_REAL
    6331             :     6666U,      // GLD1H_D_UXTW_REAL
    6332             :     7690U,      // GLD1H_D_UXTW_SCALED_REAL
    6333             :     52U,        // GLD1H_S_IMM_REAL
    6334             :     6794U,      // GLD1H_S_SXTW_REAL
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    6336             :     6922U,      // GLD1H_S_UXTW_REAL
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    6455             :     0U, // INCW_XPiI
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    6457             :     522U,       // INDEX_II_B
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    6472             :     522U,       // INDEX_RR_S
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    7153             :     16139021U,  // MLSv8i16_indexed
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    7188             :     18252431U,  // MULv2i32_indexed
    7189             :     98960U,     // MULv4i16
    7190             :     18236048U,  // MULv4i16_indexed
    7191             :     33420U,     // MULv4i32
    7192             :     18252428U,  // MULv4i32_indexed
    7193             :     49805U,     // MULv8i16
    7194             :     18236045U,  // MULv8i16_indexed
    7195             :     115345U,    // MULv8i8
    7196             :     56U,        // MVNIv2i32
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    7200             :     56U,        // MVNIv4s_msl
    7201             :     56U,        // MVNIv8i16
    7202             :     149140U,    // NANDS_PPzPP
    7203             :     149140U,    // NAND_PPzPP
    7204             :     0U, // NEG_ZPmZ_B
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    7206             :     257U,       // NEG_ZPmZ_H
    7207             :     384U,       // NEG_ZPmZ_S
    7208             :     2U, // NEGv16i8
    7209             :     3U, // NEGv1i64
    7210             :     4U, // NEGv2i32
    7211             :     5U, // NEGv2i64
    7212             :     6U, // NEGv4i16
    7213             :     7U, // NEGv4i32
    7214             :     8U, // NEGv8i16
    7215             :     9U, // NEGv8i8
    7216             :     149140U,    // NORS_PPzPP
    7217             :     149140U,    // NOR_PPzPP
    7218             :     0U, // NOT_ZPmZ_B
    7219             :     128U,       // NOT_ZPmZ_D
    7220             :     257U,       // NOT_ZPmZ_H
    7221             :     384U,       // NOT_ZPmZ_S
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    7224             :     149140U,    // ORNS_PPzPP
    7225             :     0U, // ORNWrr
    7226             :     1034U,      // ORNWrs
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    7228             :     1034U,      // ORNXrs
    7229             :     149140U,    // ORN_PPzPP
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    7232             :     149140U,    // ORRS_PPzPP
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    7234             :     0U, // ORRWrr
    7235             :     1034U,      // ORRWrs
    7236             :     4362U,      // ORRXri
    7237             :     0U, // ORRXrr
    7238             :     1034U,      // ORRXrs
    7239             :     149140U,    // ORR_PPzPP
    7240             :     4362U,      // ORR_ZI
    7241             :     149120U,    // ORR_ZPmZ_B
    7242             :     1197824U,   // ORR_ZPmZ_D
    7243             :     2262931U,   // ORR_ZPmZ_H
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    7246             :     66190U,     // ORRv16i8
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    7254             :     0U, // PACDZA
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    7262             :     0U, // PACIB1716
    7263             :     0U, // PACIBSP
    7264             :     0U, // PACIBZ
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    7268             :     0U, // PMULLv1i64
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    7271             :     66190U,     // PMULv16i8
    7272             :     115345U,    // PMULv8i8
    7273             :     54U,        // PRFB_D_PZI
    7274             :     0U, // PRFB_D_SCALED
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    7296             :     0U, // PRFH_PRR
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    7303             :     10122U,     // PRFMui
    7304             :     0U, // PRFS_PRR
    7305             :     213514U,    // PRFUMi
    7306             :     0U, // PRFW_D_PZI
    7307             :     0U, // PRFW_D_SCALED
    7308             :     0U, // PRFW_D_SXTW_SCALED
    7309             :     0U, // PRFW_D_UXTW_SCALED
    7310             :     57U,        // PRFW_PRI
    7311             :     0U, // PRFW_S_PZI
    7312             :     0U, // PRFW_S_SXTW_SCALED
    7313             :     0U, // PRFW_S_UXTW_SCALED
    7314             :     3U, // PTRUES_B
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    7318             :     3U, // PTRUE_B
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    7320             :     0U, // PTRUE_H
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    7323             :     17163U,     // RADDHNv2i64_v4i32
    7324             :     33420U,     // RADDHNv4i32_v4i16
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    7326             :     49933U,     // RADDHNv8i16_v16i8
    7327             :     49805U,     // RADDHNv8i16_v8i8
    7328             :     3U, // RBITWr
    7329             :     3U, // RBITXr
    7330             :     2U, // RBITv16i8
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    7332             :     58U,        // RDFFRS_PPz
    7333             :     0U, // RDFFR_P
    7334             :     58U,        // RDFFR_PPz
    7335             :     3U, // RDVLI_XI
    7336             :     0U, // RET
    7337             :     0U, // RETAA
    7338             :     0U, // RETAB
    7339             :     0U, // RET_ReallyLR
    7340             :     3U, // REV16Wr
    7341             :     3U, // REV16Xr
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    7343             :     9U, // REV16v8i8
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    7448             :     50U,        // SCVTF_ZPmZ_DtoH
    7449             :     128U,       // SCVTF_ZPmZ_DtoS
    7450             :     257U,       // SCVTF_ZPmZ_HtoH
    7451             :     384U,       // SCVTF_ZPmZ_StoD
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    7453             :     384U,       // SCVTF_ZPmZ_StoS
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    7480             :     3295242U,   // SEL_ZPZZ_S
    7481             :     0U, // SETF16
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    7484             :     33546U,     // SHA1Crrr
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    7492             :     7U, // SHA256SU0rr
    7493             :     33548U,     // SHA256SU1rrr
    7494             :     66190U,     // SHADDv16i8
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    7865             :     522U,       // SQSHRUNs
    7866             :     4493U,      // SQSHRUNv16i8_shift
    7867             :     523U,       // SQSHRUNv2i32_shift
    7868             :     524U,       // SQSHRUNv4i16_shift
    7869             :     4491U,      // SQSHRUNv4i32_shift
    7870             :     4492U,      // SQSHRUNv8i16_shift
    7871             :     525U,       // SQSHRUNv8i8_shift
    7872             :     1290U,      // SQSUB_ZI_B
    7873             :     1418U,      // SQSUB_ZI_D
    7874             :     18U,        // SQSUB_ZI_H
    7875             :     1546U,      // SQSUB_ZI_S
    7876             :     1674U,      // SQSUB_ZZZ_B
    7877             :     1802U,      // SQSUB_ZZZ_D
    7878             :     275U,       // SQSUB_ZZZ_H
    7879             :     2058U,      // SQSUB_ZZZ_S
    7880             :     66190U,     // SQSUBv16i8
    7881             :     522U,       // SQSUBv1i16
    7882             :     522U,       // SQSUBv1i32
    7883             :     522U,       // SQSUBv1i64
    7884             :     522U,       // SQSUBv1i8
    7885             :     82575U,     // SQSUBv2i32
    7886             :     17035U,     // SQSUBv2i64
    7887             :     98960U,     // SQSUBv4i16
    7888             :     33420U,     // SQSUBv4i32
    7889             :     49805U,     // SQSUBv8i16
    7890             :     115345U,    // SQSUBv8i8
    7891             :     8U, // SQXTNv16i8
    7892             :     3U, // SQXTNv1i16
    7893             :     3U, // SQXTNv1i32
    7894             :     3U, // SQXTNv1i8
    7895             :     5U, // SQXTNv2i32
    7896             :     7U, // SQXTNv4i16
    7897             :     5U, // SQXTNv4i32
    7898             :     7U, // SQXTNv8i16
    7899             :     8U, // SQXTNv8i8
    7900             :     8U, // SQXTUNv16i8
    7901             :     3U, // SQXTUNv1i16
    7902             :     3U, // SQXTUNv1i32
    7903             :     3U, // SQXTUNv1i8
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    7908             :     8U, // SQXTUNv8i8
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    7911             :     98960U,     // SRHADDv4i16
    7912             :     33420U,     // SRHADDv4i32
    7913             :     49805U,     // SRHADDv8i16
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    7915             :     4490U,      // SRId
    7916             :     4494U,      // SRIv16i8_shift
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    7918             :     4491U,      // SRIv2i64_shift
    7919             :     4496U,      // SRIv4i16_shift
    7920             :     4492U,      // SRIv4i32_shift
    7921             :     4493U,      // SRIv8i16_shift
    7922             :     4497U,      // SRIv8i8_shift
    7923             :     66190U,     // SRSHLv16i8
    7924             :     522U,       // SRSHLv1i64
    7925             :     82575U,     // SRSHLv2i32
    7926             :     17035U,     // SRSHLv2i64
    7927             :     98960U,     // SRSHLv4i16
    7928             :     33420U,     // SRSHLv4i32
    7929             :     49805U,     // SRSHLv8i16
    7930             :     115345U,    // SRSHLv8i8
    7931             :     522U,       // SRSHRd
    7932             :     526U,       // SRSHRv16i8_shift
    7933             :     527U,       // SRSHRv2i32_shift
    7934             :     523U,       // SRSHRv2i64_shift
    7935             :     528U,       // SRSHRv4i16_shift
    7936             :     524U,       // SRSHRv4i32_shift
    7937             :     525U,       // SRSHRv8i16_shift
    7938             :     529U,       // SRSHRv8i8_shift
    7939             :     4490U,      // SRSRAd
    7940             :     4494U,      // SRSRAv16i8_shift
    7941             :     4495U,      // SRSRAv2i32_shift
    7942             :     4491U,      // SRSRAv2i64_shift
    7943             :     4496U,      // SRSRAv4i16_shift
    7944             :     4492U,      // SRSRAv4i32_shift
    7945             :     4493U,      // SRSRAv8i16_shift
    7946             :     4497U,      // SRSRAv8i8_shift
    7947             :     526U,       // SSHLLv16i8_shift
    7948             :     527U,       // SSHLLv2i32_shift
    7949             :     528U,       // SSHLLv4i16_shift
    7950             :     524U,       // SSHLLv4i32_shift
    7951             :     525U,       // SSHLLv8i16_shift
    7952             :     529U,       // SSHLLv8i8_shift
    7953             :     66190U,     // SSHLv16i8
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    7957             :     98960U,     // SSHLv4i16
    7958             :     33420U,     // SSHLv4i32
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    7961             :     522U,       // SSHRd
    7962             :     526U,       // SSHRv16i8_shift
    7963             :     527U,       // SSHRv2i32_shift
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    7965             :     528U,       // SSHRv4i16_shift
    7966             :     524U,       // SSHRv4i32_shift
    7967             :     525U,       // SSHRv8i16_shift
    7968             :     529U,       // SSHRv8i8_shift
    7969             :     4490U,      // SSRAd
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    7971             :     4495U,      // SSRAv2i32_shift
    7972             :     4491U,      // SSRAv2i64_shift
    7973             :     4496U,      // SSRAv4i16_shift
    7974             :     4492U,      // SSRAv4i32_shift
    7975             :     4493U,      // SSRAv8i16_shift
    7976             :     4497U,      // SSRAv8i8_shift
    7977             :     6410U,      // SST1B_D
    7978             :     6306U,      // SST1B_D_IMM
    7979             :     6538U,      // SST1B_D_SXTW
    7980             :     6666U,      // SST1B_D_UXTW
    7981             :     6306U,      // SST1B_S_IMM
    7982             :     6794U,      // SST1B_S_SXTW
    7983             :     6922U,      // SST1B_S_UXTW
    7984             :     6410U,      // SST1D
    7985             :     51U,        // SST1D_IMM
    7986             :     7050U,      // SST1D_SCALED
    7987             :     6538U,      // SST1D_SXTW
    7988             :     7178U,      // SST1D_SXTW_SCALED
    7989             :     6666U,      // SST1D_UXTW
    7990             :     7306U,      // SST1D_UXTW_SCALED
    7991             :     6410U,      // SST1H_D
    7992             :     52U,        // SST1H_D_IMM
    7993             :     7434U,      // SST1H_D_SCALED
    7994             :     6538U,      // SST1H_D_SXTW
    7995             :     7562U,      // SST1H_D_SXTW_SCALED
    7996             :     6666U,      // SST1H_D_UXTW
    7997             :     7690U,      // SST1H_D_UXTW_SCALED
    7998             :     52U,        // SST1H_S_IMM
    7999             :     6794U,      // SST1H_S_SXTW
    8000             :     7818U,      // SST1H_S_SXTW_SCALED
    8001             :     6922U,      // SST1H_S_UXTW
    8002             :     7946U,      // SST1H_S_UXTW_SCALED
    8003             :     6410U,      // SST1W_D
    8004             :     53U,        // SST1W_D_IMM
    8005             :     8074U,      // SST1W_D_SCALED
    8006             :     6538U,      // SST1W_D_SXTW
    8007             :     8202U,      // SST1W_D_SXTW_SCALED
    8008             :     6666U,      // SST1W_D_UXTW
    8009             :     8330U,      // SST1W_D_UXTW_SCALED
    8010             :     53U,        // SST1W_IMM
    8011             :     6794U,      // SST1W_SXTW
    8012             :     8458U,      // SST1W_SXTW_SCALED
    8013             :     6922U,      // SST1W_UXTW
    8014             :     8586U,      // SST1W_UXTW_SCALED
    8015             :     66190U,     // SSUBLv16i8_v8i16
    8016             :     82575U,     // SSUBLv2i32_v2i64
    8017             :     98960U,     // SSUBLv4i16_v4i32
    8018             :     33420U,     // SSUBLv4i32_v2i64
    8019             :     49805U,     // SSUBLv8i16_v4i32
    8020             :     115345U,    // SSUBLv8i8_v8i16
    8021             :     66189U,     // SSUBWv16i8_v8i16
    8022             :     82571U,     // SSUBWv2i32_v2i64
    8023             :     98956U,     // SSUBWv4i16_v4i32
    8024             :     33419U,     // SSUBWv4i32_v2i64
    8025             :     49804U,     // SSUBWv8i16_v4i32
    8026             :     115341U,    // SSUBWv8i8_v8i16
    8027             :     8714U,      // ST1B
    8028             :     8714U,      // ST1B_D
    8029             :     512394U,    // ST1B_D_IMM
    8030             :     8714U,      // ST1B_H
    8031             :     512394U,    // ST1B_H_IMM
    8032             :     512394U,    // ST1B_IMM
    8033             :     8714U,      // ST1B_S
    8034             :     512394U,    // ST1B_S_IMM
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    8036             :     512394U,    // ST1D_IMM
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    8229             :     8714U,      // STNT1B_ZRR
    8230             :     512394U,    // STNT1D_ZRI
    8231             :     8842U,      // STNT1D_ZRR
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    8234             :     512394U,    // STNT1W_ZRI
    8235             :     9482U,      // STNT1W_ZRR
    8236             :     20070935U,  // STPDi
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    8322             :     49805U,     // SUBHNv8i16_v8i8
    8323             :     1290U,      // SUBR_ZI_B
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    8349             :     1290U,      // SUB_ZI_B
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    8367             :     49805U,     // SUBv8i16
    8368             :     115345U,    // SUBv8i8
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    8393             :     0U, // SWPLW
    8394             :     0U, // SWPLX
    8395             :     0U, // SWPW
    8396             :     0U, // SWPX
    8397             :     128U,       // SXTB_ZPmZ_D
    8398             :     257U,       // SXTB_ZPmZ_H
    8399             :     384U,       // SXTB_ZPmZ_S
    8400             :     128U,       // SXTH_ZPmZ_D
    8401             :     384U,       // SXTH_ZPmZ_S
    8402             :     128U,       // SXTW_ZPmZ_D
    8403             :     10762U,     // SYSLxt
    8404             :     0U, // SYSxt
    8405             :     0U, // TBL_ZZZ_B
    8406             :     0U, // TBL_ZZZ_D
    8407             :     0U, // TBL_ZZZ_H
    8408             :     0U, // TBL_ZZZ_S
    8409             :     2U, // TBLv16i8Four
    8410             :     2U, // TBLv16i8One
    8411             :     2U, // TBLv16i8Three
    8412             :     2U, // TBLv16i8Two
    8413             :     9U, // TBLv8i8Four
    8414             :     9U, // TBLv8i8One
    8415             :     9U, // TBLv8i8Three
    8416             :     9U, // TBLv8i8Two
    8417             :     10890U,     // TBNZW
    8418             :     10890U,     // TBNZX
    8419             :     2U, // TBXv16i8Four
    8420             :     2U, // TBXv16i8One
    8421             :     2U, // TBXv16i8Three
    8422             :     2U, // TBXv16i8Two
    8423             :     9U, // TBXv8i8Four
    8424             :     9U, // TBXv8i8One
    8425             :     9U, // TBXv8i8Three
    8426             :     9U, // TBXv8i8Two
    8427             :     10890U,     // TBZW
    8428             :     10890U,     // TBZX
    8429             :     0U, // TCRETURNdi
    8430             :     0U, // TCRETURNri
    8431             :     0U, // TLSDESCCALL
    8432             :     0U, // TLSDESC_CALLSEQ
    8433             :     1674U,      // TRN1_PPP_B
    8434             :     1802U,      // TRN1_PPP_D
    8435             :     275U,       // TRN1_PPP_H
    8436             :     2058U,      // TRN1_PPP_S
    8437             :     1674U,      // TRN1_ZZZ_B
    8438             :     1802U,      // TRN1_ZZZ_D
    8439             :     275U,       // TRN1_ZZZ_H
    8440             :     2058U,      // TRN1_ZZZ_S
    8441             :     66190U,     // TRN1v16i8
    8442             :     82575U,     // TRN1v2i32
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    8446             :     49805U,     // TRN1v8i16
    8447             :     115345U,    // TRN1v8i8
    8448             :     1674U,      // TRN2_PPP_B
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    8453             :     1802U,      // TRN2_ZZZ_D
    8454             :     275U,       // TRN2_ZZZ_H
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    8484             :     2262931U,   // UABD_ZPmZ_H
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    8530             :     3U, // UCVTFUWHri
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    8533             :     3U, // UCVTFUXHri
    8534             :     3U, // UCVTFUXSri
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    8889             :     33419U,     // USUBWv4i32_v2i64
    8890             :     49804U,     // USUBWv8i16_v4i32
    8891             :     115341U,    // USUBWv8i8_v8i16
    8892             :     128U,       // UXTB_ZPmZ_D
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    8894             :     384U,       // UXTB_ZPmZ_S
    8895             :     128U,       // UXTH_ZPmZ_D
    8896             :     384U,       // UXTH_ZPmZ_S
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    8898             :     1674U,      // UZP1_PPP_B
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    8901             :     2058U,      // UZP1_PPP_S
    8902             :     1674U,      // UZP1_ZZZ_B
    8903             :     1802U,      // UZP1_ZZZ_D
    8904             :     275U,       // UZP1_ZZZ_H
    8905             :     2058U,      // UZP1_ZZZ_S
    8906             :     66190U,     // UZP1v16i8
    8907             :     82575U,     // UZP1v2i32
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    8910             :     33420U,     // UZP1v4i32
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    8912             :     115345U,    // UZP1v8i8
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    8928             :     0U, // WRFFR
    8929             :     0U, // XPACD
    8930             :     0U, // XPACI
    8931             :     0U, // XPACLRI
    8932             :     8U, // XTNv16i8
    8933             :     5U, // XTNv2i32
    8934             :     7U, // XTNv4i16
    8935             :     5U, // XTNv4i32
    8936             :     7U, // XTNv8i16
    8937             :     8U, // XTNv8i8
    8938             :     1674U,      // ZIP1_PPP_B
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    8949             :     98960U,     // ZIP1v4i16
    8950             :     33420U,     // ZIP1v4i32
    8951             :     49805U,     // ZIP1v8i16
    8952             :     115345U,    // ZIP1v8i8
    8953             :     1674U,      // ZIP2_PPP_B
    8954             :     1802U,      // ZIP2_PPP_D
    8955             :     275U,       // ZIP2_PPP_H
    8956             :     2058U,      // ZIP2_PPP_S
    8957             :     1674U,      // ZIP2_ZZZ_B
    8958             :     1802U,      // ZIP2_ZZZ_D
    8959             :     275U,       // ZIP2_ZZZ_H
    8960             :     2058U,      // ZIP2_ZZZ_S
    8961             :     66190U,     // ZIP2v16i8
    8962             :     82575U,     // ZIP2v2i32
    8963             :     17035U,     // ZIP2v2i64
    8964             :     98960U,     // ZIP2v4i16
    8965             :     33420U,     // ZIP2v4i32
    8966             :     49805U,     // ZIP2v8i16
    8967             :     115345U,    // ZIP2v8i8
    8968             :   };
    8969             : 
    8970       50637 :   O << "\t";
    8971             : 
    8972             :   // Emit the opcode for the instruction.
    8973             :   uint64_t Bits = 0;
    8974       50637 :   Bits |= (uint64_t)OpInfo0[MI->getOpcode()] << 0;
    8975       50637 :   Bits |= (uint64_t)OpInfo1[MI->getOpcode()] << 32;
    8976             :   assert(Bits != 0 && "Cannot print this instruction.");
    8977       50637 :   O << AsmStrs+(Bits & 8191)-1;
    8978             : 
    8979             : 
    8980             :   // Fragment 0 encoded into 6 bits for 54 unique commands.
    8981       50637 :   switch ((Bits >> 13) & 63) {
    8982           0 :   default: llvm_unreachable("Invalid command number.");
    8983             :   case 0:
    8984             :     // DBG_VALUE, DBG_LABEL, BUNDLE, LIFETIME_START, LIFETIME_END, FENTRY_CAL...
    8985             :     return;
    8986             :     break;
    8987         398 :   case 1:
    8988             :     // ABS_ZPmZ_B, ADD_ZI_B, ADD_ZPmZ_B, ADD_ZZZ_B, ANDS_PPzPP, AND_PPzPP, AN...
    8989         398 :     printSVERegOp<'b'>(MI, 0, STI, O);
    8990         398 :     break;
    8991         534 :   case 2:
    8992             :     // ABS_ZPmZ_D, ADD_ZI_D, ADD_ZPmZ_D, ADD_ZZZ_D, ADR_LSL_ZZZ_D_0, ADR_LSL_...
    8993         534 :     printSVERegOp<'d'>(MI, 0, STI, O);
    8994         534 :     break;
    8995         488 :   case 3:
    8996             :     // ABS_ZPmZ_H, ADD_ZI_H, ADD_ZPmZ_H, ADD_ZZZ_H, AND_ZPmZ_H, ASRD_ZPmI_H, ...
    8997         488 :     printSVERegOp<'h'>(MI, 0, STI, O);
    8998         488 :     O << ", ";
    8999         488 :     break;
    9000         627 :   case 4:
    9001             :     // ABS_ZPmZ_S, ADD_ZI_S, ADD_ZPmZ_S, ADD_ZZZ_S, ADR_LSL_ZZZ_S_0, ADR_LSL_...
    9002         627 :     printSVERegOp<'s'>(MI, 0, STI, O);
    9003         627 :     break;
    9004        7777 :   case 5:
    9005             :     // ABSv16i8, ABSv2i32, ABSv2i64, ABSv4i16, ABSv4i32, ABSv8i16, ABSv8i8, A...
    9006        7777 :     printVRegOperand(MI, 0, STI, O);
    9007        7777 :     break;
    9008       26656 :   case 6:
    9009             :     // ABSv1i64, ADCSWr, ADCSXr, ADCWr, ADCXr, ADDPL_XXI, ADDPv2i64p, ADDSWri...
    9010       26656 :     printOperand(MI, 0, STI, O);
    9011       26656 :     break;
    9012        2030 :   case 7:
    9013             :     // ADDHNv2i64_v4i32, ADDHNv4i32_v8i16, ADDHNv8i16_v16i8, AESDrr, AESErr, ...
    9014        2030 :     printVRegOperand(MI, 1, STI, O);
    9015        2030 :     break;
    9016        1549 :   case 8:
    9017             :     // B, BL
    9018        1549 :     printAlignedLabel(MI, 0, STI, O);
    9019        1549 :     return;
    9020             :     break;
    9021          67 :   case 9:
    9022             :     // BRK, DCPS1, DCPS2, DCPS3, HLT, HVC, SMC, SVC
    9023          67 :     printImmHex(MI, 0, STI, O);
    9024          67 :     return;
    9025             :     break;
    9026         449 :   case 10:
    9027             :     // Bcc
    9028         449 :     printCondCode(MI, 0, STI, O);
    9029         449 :     O << "\t";
    9030         449 :     printAlignedLabel(MI, 1, STI, O);
    9031         449 :     return;
    9032             :     break;
    9033        5024 :   case 11:
    9034             :     // CASAB, CASAH, CASALB, CASALH, CASALW, CASALX, CASAW, CASAX, CASB, CASH...
    9035        5024 :     printOperand(MI, 1, STI, O);
    9036        5024 :     break;
    9037          26 :   case 12:
    9038             :     // CASPALW, CASPAW, CASPLW, CASPW
    9039          26 :     printGPRSeqPairsClassOperand<32>(MI, 1, STI, O);
    9040          26 :     O << ", ";
    9041          26 :     printGPRSeqPairsClassOperand<32>(MI, 2, STI, O);
    9042          26 :     O << ", [";
    9043          26 :     printOperand(MI, 3, STI, O);
    9044             :     O << ']';
    9045             :     return;
    9046             :     break;
    9047          42 :   case 13:
    9048             :     // CASPALX, CASPAX, CASPLX, CASPX
    9049          42 :     printGPRSeqPairsClassOperand<64>(MI, 1, STI, O);
    9050          42 :     O << ", ";
    9051          42 :     printGPRSeqPairsClassOperand<64>(MI, 2, STI, O);
    9052          42 :     O << ", [";
    9053          42 :     printOperand(MI, 3, STI, O);
    9054             :     O << ']';
    9055             :     return;
    9056             :     break;
    9057         178 :   case 14:
    9058             :     // DMB, DSB, ISB, TSB
    9059         178 :     printBarrierOption(MI, 0, STI, O);
    9060         178 :     return;
    9061             :     break;
    9062           0 :   case 15:
    9063             :     // DUP_ZZI_Q
    9064           0 :     printSVERegOp<'q'>(MI, 0, STI, O);
    9065           0 :     O << ", ";
    9066           0 :     printSVERegOp<'q'>(MI, 1, STI, O);
    9067           0 :     printVectorIndex(MI, 2, STI, O);
    9068           0 :     return;
    9069             :     break;
    9070         416 :   case 16:
    9071             :     // GLD1B_D_IMM_REAL, GLD1B_D_REAL, GLD1B_D_SXTW_REAL, GLD1B_D_UXTW_REAL, ...
    9072         416 :     printTypedVectorList<0,'d'>(MI, 0, STI, O);
    9073         416 :     O << ", ";
    9074         416 :     printSVERegOp<>(MI, 1, STI, O);
    9075         416 :     break;
    9076         270 :   case 17:
    9077             :     // GLD1B_S_IMM_REAL, GLD1B_S_SXTW_REAL, GLD1B_S_UXTW_REAL, GLD1H_S_IMM_RE...
    9078         270 :     printTypedVectorList<0,'s'>(MI, 0, STI, O);
    9079         270 :     O << ", ";
    9080         270 :     printSVERegOp<>(MI, 1, STI, O);
    9081         270 :     break;
    9082           8 :   case 18:
    9083             :     // HINT
    9084           8 :     printImm(MI, 0, STI, O);
    9085           8 :     return;
    9086             :     break;
    9087          90 :   case 19:
    9088             :     // LD1B, LD1B_IMM_REAL, LD1RB_IMM, LD1RQ_B, LD1RQ_B_IMM, LD2B, LD2B_IMM, ...
    9089          90 :     printTypedVectorList<0,'b'>(MI, 0, STI, O);
    9090          90 :     O << ", ";
    9091          90 :     printSVERegOp<>(MI, 1, STI, O);
    9092          90 :     break;
    9093         128 :   case 20:
    9094             :     // LD1B_H, LD1B_H_IMM_REAL, LD1H, LD1H_IMM_REAL, LD1RB_H_IMM, LD1RH_IMM, ...
    9095         128 :     printTypedVectorList<0,'h'>(MI, 0, STI, O);
    9096         128 :     O << ", ";
    9097         128 :     printSVERegOp<>(MI, 1, STI, O);
    9098         128 :     break;
    9099          90 :   case 21:
    9100             :     // LD1Fourv16b, LD1Onev16b, LD1Rv16b, LD1Threev16b, LD1Twov16b, LD2Rv16b,...
    9101          90 :     printTypedVectorList<16, 'b'>(MI, 0, STI, O);
    9102          90 :     O << ", [";
    9103          90 :     printOperand(MI, 1, STI, O);
    9104             :     O << ']';
    9105             :     return;
    9106             :     break;
    9107          21 :   case 22:
    9108             :     // LD1Fourv16b_POST, LD1Onev16b_POST, LD1Rv16b_POST, LD1Threev16b_POST, L...
    9109          21 :     printTypedVectorList<16, 'b'>(MI, 1, STI, O);
    9110          21 :     O << ", [";
    9111          21 :     printOperand(MI, 2, STI, O);
    9112          21 :     O << "], ";
    9113          21 :     break;
    9114          21 :   case 23:
    9115             :     // LD1Fourv1d, LD1Onev1d, LD1Rv1d, LD1Threev1d, LD1Twov1d, LD2Rv1d, LD3Rv...
    9116          21 :     printTypedVectorList<1, 'd'>(MI, 0, STI, O);
    9117          21 :     O << ", [";
    9118          21 :     printOperand(MI, 1, STI, O);
    9119             :     O << ']';
    9120             :     return;
    9121             :     break;
    9122           5 :   case 24:
    9123             :     // LD1Fourv1d_POST, LD1Onev1d_POST, LD1Rv1d_POST, LD1Threev1d_POST, LD1Tw...
    9124           5 :     printTypedVectorList<1, 'd'>(MI, 1, STI, O);
    9125           5 :     O << ", [";
    9126           5 :     printOperand(MI, 2, STI, O);
    9127           5 :     O << "], ";
    9128           5 :     break;
    9129         149 :   case 25:
    9130             :     // LD1Fourv2d, LD1Onev2d, LD1Rv2d, LD1Threev2d, LD1Twov2d, LD2Rv2d, LD2Tw...
    9131         149 :     printTypedVectorList<2, 'd'>(MI, 0, STI, O);
    9132         149 :     O << ", [";
    9133         149 :     printOperand(MI, 1, STI, O);
    9134             :     O << ']';
    9135             :     return;
    9136             :     break;
    9137           1 :   case 26:
    9138             :     // LD1Fourv2d_POST, LD1Onev2d_POST, LD1Rv2d_POST, LD1Threev2d_POST, LD1Tw...
    9139           1 :     printTypedVectorList<2, 'd'>(MI, 1, STI, O);
    9140           1 :     O << ", [";
    9141           1 :     printOperand(MI, 2, STI, O);
    9142           1 :     O << "], ";
    9143           1 :     break;
    9144         143 :   case 27:
    9145             :     // LD1Fourv2s, LD1Onev2s, LD1Rv2s, LD1Threev2s, LD1Twov2s, LD2Rv2s, LD2Tw...
    9146         143 :     printTypedVectorList<2, 's'>(MI, 0, STI, O);
    9147         143 :     O << ", [";
    9148         143 :     printOperand(MI, 1, STI, O);
    9149             :     O << ']';
    9150             :     return;
    9151             :     break;
    9152           5 :   case 28:
    9153             :     // LD1Fourv2s_POST, LD1Onev2s_POST, LD1Rv2s_POST, LD1Threev2s_POST, LD1Tw...
    9154           5 :     printTypedVectorList<2, 's'>(MI, 1, STI, O);
    9155           5 :     O << ", [";
    9156           5 :     printOperand(MI, 2, STI, O);
    9157           5 :     O << "], ";
    9158           5 :     break;
    9159         136 :   case 29:
    9160             :     // LD1Fourv4h, LD1Onev4h, LD1Rv4h, LD1Threev4h, LD1Twov4h, LD2Rv4h, LD2Tw...
    9161         136 :     printTypedVectorList<4, 'h'>(MI, 0, STI, O);
    9162         136 :     O << ", [";
    9163         136 :     printOperand(MI, 1, STI, O);
    9164             :     O << ']';
    9165             :     return;
    9166             :     break;
    9167          17 :   case 30:
    9168             :     // LD1Fourv4h_POST, LD1Onev4h_POST, LD1Rv4h_POST, LD1Threev4h_POST, LD1Tw...
    9169          17 :     printTypedVectorList<4, 'h'>(MI, 1, STI, O);
    9170          17 :     O << ", [";
    9171          17 :     printOperand(MI, 2, STI, O);
    9172          17 :     O << "], ";
    9173          17 :     break;
    9174         140 :   case 31:
    9175             :     // LD1Fourv4s, LD1Onev4s, LD1Rv4s, LD1Threev4s, LD1Twov4s, LD2Rv4s, LD2Tw...
    9176         140 :     printTypedVectorList<4, 's'>(MI, 0, STI, O);
    9177         140 :     O << ", [";
    9178         140 :     printOperand(MI, 1, STI, O);
    9179             :     O << ']';
    9180             :     return;
    9181             :     break;
    9182           1 :   case 32:
    9183             :     // LD1Fourv4s_POST, LD1Onev4s_POST, LD1Rv4s_POST, LD1Threev4s_POST, LD1Tw...
    9184           1 :     printTypedVectorList<4, 's'>(MI, 1, STI, O);
    9185           1 :     O << ", [";
    9186           1 :     printOperand(MI, 2, STI, O);
    9187           1 :     O << "], ";
    9188           1 :     break;
    9189          88 :   case 33:
    9190             :     // LD1Fourv8b, LD1Onev8b, LD1Rv8b, LD1Threev8b, LD1Twov8b, LD2Rv8b, LD2Tw...
    9191          88 :     printTypedVectorList<8, 'b'>(MI, 0, STI, O);
    9192          88 :     O << ", [";
    9193          88 :     printOperand(MI, 1, STI, O);
    9194             :     O << ']';
    9195             :     return;
    9196             :     break;
    9197          21 :   case 34:
    9198             :     // LD1Fourv8b_POST, LD1Onev8b_POST, LD1Rv8b_POST, LD1Threev8b_POST, LD1Tw...
    9199          21 :     printTypedVectorList<8, 'b'>(MI, 1, STI, O);
    9200          21 :     O << ", [";
    9201          21 :     printOperand(MI, 2, STI, O);
    9202          21 :     O << "], ";
    9203          21 :     break;
    9204         142 :   case 35:
    9205             :     // LD1Fourv8h, LD1Onev8h, LD1Rv8h, LD1Threev8h, LD1Twov8h, LD2Rv8h, LD2Tw...
    9206         142 :     printTypedVectorList<8, 'h'>(MI, 0, STI, O);
    9207         142 :     O << ", [";
    9208         142 :     printOperand(MI, 1, STI, O);
    9209             :     O << ']';
    9210             :     return;
    9211             :     break;
    9212          23 :   case 36:
    9213             :     // LD1Fourv8h_POST, LD1Onev8h_POST, LD1Rv8h_POST, LD1Threev8h_POST, LD1Tw...
    9214          23 :     printTypedVectorList<8, 'h'>(MI, 1, STI, O);
    9215          23 :     O << ", [";
    9216          23 :     printOperand(MI, 2, STI, O);
    9217          23 :     O << "], ";
    9218          23 :     break;
    9219          18 :   case 37:
    9220             :     // LD1i16, LD2i16, LD3i16, LD4i16, ST1i16_POST, ST2i16_POST, ST3i16_POST,...
    9221          18 :     printTypedVectorList<0, 'h'>(MI, 1, STI, O);
    9222          18 :     printVectorIndex(MI, 2, STI, O);
    9223          18 :     O << ", [";
    9224          18 :     printOperand(MI, 3, STI, O);
    9225          18 :     break;
    9226           4 :   case 38:
    9227             :     // LD1i16_POST, LD2i16_POST, LD3i16_POST, LD4i16_POST
    9228           4 :     printTypedVectorList<0, 'h'>(MI, 2, STI, O);
    9229           4 :     printVectorIndex(MI, 3, STI, O);
    9230           4 :     O << ", [";
    9231           4 :     printOperand(MI, 4, STI, O);
    9232           4 :     O << "], ";
    9233           4 :     break;
    9234          18 :   case 39:
    9235             :     // LD1i32, LD2i32, LD3i32, LD4i32, ST1i32_POST, ST2i32_POST, ST3i32_POST,...
    9236          18 :     printTypedVectorList<0, 's'>(MI, 1, STI, O);
    9237          18 :     printVectorIndex(MI, 2, STI, O);
    9238          18 :     O << ", [";
    9239          18 :     printOperand(MI, 3, STI, O);
    9240          18 :     break;
    9241           4 :   case 40:
    9242             :     // LD1i32_POST, LD2i32_POST, LD3i32_POST, LD4i32_POST
    9243           4 :     printTypedVectorList<0, 's'>(MI, 2, STI, O);
    9244           4 :     printVectorIndex(MI, 3, STI, O);
    9245           4 :     O << ", [";
    9246           4 :     printOperand(MI, 4, STI, O);
    9247           4 :     O << "], ";
    9248           4 :     break;
    9249          12 :   case 41:
    9250             :     // LD1i64, LD2i64, LD3i64, LD4i64, ST1i64_POST, ST2i64_POST, ST3i64_POST,...
    9251          12 :     printTypedVectorList<0, 'd'>(MI, 1, STI, O);
    9252          12 :     printVectorIndex(MI, 2, STI, O);
    9253          12 :     O << ", [";
    9254          12 :     printOperand(MI, 3, STI, O);
    9255          12 :     break;
    9256           2 :   case 42:
    9257             :     // LD1i64_POST, LD2i64_POST, LD3i64_POST, LD4i64_POST
    9258           2 :     printTypedVectorList<0, 'd'>(MI, 2, STI, O);
    9259           2 :     printVectorIndex(MI, 3, STI, O);
    9260           2 :     O << ", [";
    9261           2 :     printOperand(MI, 4, STI, O);
    9262           2 :     O << "], ";
    9263           2 :     break;
    9264          14 :   case 43:
    9265             :     // LD1i8, LD2i8, LD3i8, LD4i8, ST1i8_POST, ST2i8_POST, ST3i8_POST, ST4i8_...
    9266          14 :     printTypedVectorList<0, 'b'>(MI, 1, STI, O);
    9267          14 :     printVectorIndex(MI, 2, STI, O);
    9268          14 :     O << ", [";
    9269          14 :     printOperand(MI, 3, STI, O);
    9270          14 :     break;
    9271           2 :   case 44:
    9272             :     // LD1i8_POST, LD2i8_POST, LD3i8_POST, LD4i8_POST
    9273           2 :     printTypedVectorList<0, 'b'>(MI, 2, STI, O);
    9274           2 :     printVectorIndex(MI, 3, STI, O);
    9275           2 :     O << ", [";
    9276           2 :     printOperand(MI, 4, STI, O);
    9277           2 :     O << "], ";
    9278           2 :     break;
    9279          16 :   case 45:
    9280             :     // LDR_PXI, LDR_ZXI, STR_PXI, STR_ZXI
    9281          16 :     printSVERegOp<>(MI, 0, STI, O);
    9282          16 :     O << ", [";
    9283          16 :     printOperand(MI, 1, STI, O);
    9284          16 :     O << ", ";
    9285          16 :     printOperand(MI, 2, STI, O);
    9286          16 :     O << ", mul vl]";
    9287          16 :     return;
    9288             :     break;
    9289        2511 :   case 46:
    9290             :     // MSR
    9291        2511 :     printMSRSystemRegister(MI, 0, STI, O);
    9292        2511 :     O << ", ";
    9293        2511 :     printOperand(MI, 1, STI, O);
    9294        2511 :     return;
    9295             :     break;
    9296          29 :   case 47:
    9297             :     // MSRpstateImm1, MSRpstateImm4
    9298          29 :     printSystemPStateField(MI, 0, STI, O);
    9299          29 :     O << ", ";
    9300          29 :     printOperand(MI, 1, STI, O);
    9301          29 :     return;
    9302             :     break;
    9303          72 :   case 48:
    9304             :     // PRFB_D_PZI, PRFB_D_SCALED, PRFB_D_SXTW_SCALED, PRFB_D_UXTW_SCALED, PRF...
    9305          72 :     printPrefetchOp<true>(MI, 0, STI, O);
    9306          72 :     O << ", ";
    9307          72 :     printSVERegOp<>(MI, 1, STI, O);
    9308          72 :     O << ", [";
    9309          72 :     break;
    9310          70 :   case 49:
    9311             :     // PRFMl, PRFMroW, PRFMroX, PRFMui, PRFUMi
    9312          70 :     printPrefetchOp(MI, 0, STI, O);
    9313          70 :     break;
    9314          18 :   case 50:
    9315             :     // ST1i16, ST2i16, ST3i16, ST4i16
    9316          18 :     printTypedVectorList<0, 'h'>(MI, 0, STI, O);
    9317          18 :     printVectorIndex(MI, 1, STI, O);
    9318          18 :     O << ", [";
    9319          18 :     printOperand(MI, 2, STI, O);
    9320             :     O << ']';
    9321             :     return;
    9322             :     break;
    9323          12 :   case 51:
    9324             :     // ST1i32, ST2i32, ST3i32, ST4i32
    9325          12 :     printTypedVectorList<0, 's'>(MI, 0, STI, O);
    9326          12 :     printVectorIndex(MI, 1, STI, O);
    9327          12 :     O << ", [";
    9328          12 :     printOperand(MI, 2, STI, O);
    9329             :     O << ']';
    9330             :     return;
    9331             :     break;
    9332          14 :   case 52:
    9333             :     // ST1i64, ST2i64, ST3i64, ST4i64
    9334          14 :     printTypedVectorList<0, 'd'>(MI, 0, STI, O);
    9335          14 :     printVectorIndex(MI, 1, STI, O);
    9336          14 :     O << ", [";
    9337          14 :     printOperand(MI, 2, STI, O);
    9338             :     O << ']';
    9339             :     return;
    9340             :     break;
    9341           9 :   case 53:
    9342             :     // ST1i8, ST2i8, ST3i8, ST4i8
    9343           9 :     printTypedVectorList<0, 'b'>(MI, 0, STI, O);
    9344           9 :     printVectorIndex(MI, 1, STI, O);
    9345           9 :     O << ", [";
    9346           9 :     printOperand(MI, 2, STI, O);
    9347             :     O << ']';
    9348             :     return;
    9349             :     break;
    9350             :   }
    9351             : 
    9352             : 
    9353             :   // Fragment 1 encoded into 6 bits for 55 unique commands.
    9354       44748 :   switch ((Bits >> 19) & 63) {
    9355           0 :   default: llvm_unreachable("Invalid command number.");
    9356       26382 :   case 0:
    9357             :     // ABS_ZPmZ_B, ABS_ZPmZ_D, ABS_ZPmZ_S, ABSv1i64, ADCSWr, ADCSXr, ADCWr, A...
    9358       26382 :     O << ", ";
    9359       26382 :     break;
    9360          80 :   case 1:
    9361             :     // ABS_ZPmZ_H, CLS_ZPmZ_H, CLZ_ZPmZ_H, CNOT_ZPmZ_H, CNT_ZPmZ_H, CPY_ZPmI_...
    9362          80 :     printSVERegOp<>(MI, 2, STI, O);
    9363          80 :     break;
    9364        1696 :   case 2:
    9365             :     // ABSv16i8, ADDHNv8i16_v16i8, ADDPv16i8, ADDv16i8, AESDrr, AESErr, AESIM...
    9366        1696 :     O << ".16b, ";
    9367        1696 :     break;
    9368        1249 :   case 3:
    9369             :     // ABSv2i32, ADDHNv2i64_v2i32, ADDPv2i32, ADDv2i32, BICv2i32, CLSv2i32, C...
    9370        1249 :     O << ".2s, ";
    9371        1249 :     break;
    9372        1347 :   case 4:
    9373             :     // ABSv2i64, ADDPv2i64, ADDv2i64, CMEQv2i64, CMEQv2i64rz, CMGEv2i64, CMGE...
    9374        1347 :     O << ".2d, ";
    9375        1347 :     break;
    9376        1004 :   case 5:
    9377             :     // ABSv4i16, ADDHNv4i32_v4i16, ADDPv4i16, ADDv4i16, BICv4i16, CLSv4i16, C...
    9378        1004 :     O << ".4h, ";
    9379        1004 :     break;
    9380        2554 :   case 6:
    9381             :     // ABSv4i32, ADDHNv2i64_v4i32, ADDPv4i32, ADDv4i32, BICv4i32, CLSv4i32, C...
    9382        2554 :     O << ".4s, ";
    9383        2554 :     break;
    9384        1120 :   case 7:
    9385             :     // ABSv8i16, ADDHNv4i32_v8i16, ADDPv8i16, ADDv8i16, BICv8i16, CLSv8i16, C...
    9386        1120 :     O << ".8h, ";
    9387        1120 :     break;
    9388         817 :   case 8:
    9389             :     // ABSv8i8, ADDHNv8i16_v8i8, ADDPv8i8, ADDv8i8, ANDv8i8, BICv8i8, BIFv8i8...
    9390         817 :     O << ".8b, ";
    9391         817 :     break;
    9392         142 :   case 9:
    9393             :     // ADD_ZI_H, ADD_ZZZ_H, ASR_WIDE_ZZZ_H, ASR_ZZI_H, DUP_ZZI_H, FMUL_ZZZI_H...
    9394         142 :     printSVERegOp<'h'>(MI, 1, STI, O);
    9395         142 :     break;
    9396         220 :   case 10:
    9397             :     // ADD_ZPmZ_H, AND_ZPmZ_H, ASRD_ZPmI_H, ASRR_ZPmZ_H, ASR_WIDE_ZPmZ_H, ASR...
    9398         220 :     printSVERegOp<>(MI, 1, STI, O);
    9399         220 :     break;
    9400        6917 :   case 11:
    9401             :     // ADR_LSL_ZZZ_D_0, ADR_LSL_ZZZ_D_1, ADR_LSL_ZZZ_D_2, ADR_LSL_ZZZ_D_3, AD...
    9402        6917 :     O << ", [";
    9403        6917 :     break;
    9404             :   case 12:
    9405             :     // AUTDZA, AUTDZB, AUTIZA, AUTIZB, BLR, BLRAAZ, BLRABZ, BR, BRAAZ, BRABZ,...
    9406             :     return;
    9407             :     break;
    9408          18 :   case 13:
    9409             :     // DECH_ZPiI, INCH_ZPiI, SQDECH_ZPiI, SQINCH_ZPiI, UQDECH_ZPiI, UQINCH_ZP...
    9410          18 :     printSVEPattern(MI, 2, STI, O);
    9411          18 :     O << ", mul ";
    9412          18 :     printOperand(MI, 3, STI, O);
    9413          18 :     return;
    9414             :     break;
    9415           0 :   case 14:
    9416             :     // DUP_ZI_H
    9417           0 :     printImm8OptLsl<int16_t>(MI, 1, STI, O);
    9418           0 :     return;
    9419             :     break;
    9420          16 :   case 15:
    9421             :     // DUP_ZR_H, INDEX_II_H, INDEX_IR_H, INDEX_RI_H, INDEX_RR_H
    9422          16 :     printOperand(MI, 1, STI, O);
    9423          16 :     break;
    9424           4 :   case 16:
    9425             :     // FCMLA_ZZZI_H
    9426           4 :     printSVERegOp<'h'>(MI, 2, STI, O);
    9427           4 :     O << ", ";
    9428           4 :     printSVERegOp<'h'>(MI, 3, STI, O);
    9429           4 :     printVectorIndex(MI, 4, STI, O);
    9430           4 :     O << ", ";
    9431           4 :     printComplexRotationOp<90, 0>(MI, 5, STI, O);
    9432           4 :     return;
    9433             :     break;
    9434          76 :   case 17:
    9435             :     // FCMPDri, FCMPEDri, FCMPEHri, FCMPESri, FCMPHri, FCMPSri
    9436          76 :     O << ", #0.0";
    9437          76 :     return;
    9438             :     break;
    9439           0 :   case 18:
    9440             :     // FDUP_ZI_H
    9441           0 :     printFPImmOperand(MI, 1, STI, O);
    9442           0 :     return;
    9443             :     break;
    9444           7 :   case 19:
    9445             :     // FMOVXDHighr, INSvi64gpr, INSvi64lane
    9446           7 :     O << ".d";
    9447           7 :     printVectorIndex(MI, 2, STI, O);
    9448           7 :     O << ", ";
    9449           7 :     break;
    9450         648 :   case 20:
    9451             :     // GLD1B_D_IMM_REAL, GLD1B_D_REAL, GLD1B_D_SXTW_REAL, GLD1B_D_UXTW_REAL, ...
    9452         648 :     O << "/z, [";
    9453         648 :     break;
    9454           0 :   case 21:
    9455             :     // INSvi16gpr, INSvi16lane
    9456           0 :     O << ".h";
    9457           0 :     printVectorIndex(MI, 2, STI, O);
    9458           0 :     O << ", ";
    9459           0 :     break;
    9460           0 :   case 22:
    9461             :     // INSvi32gpr, INSvi32lane
    9462           0 :     O << ".s";
    9463           0 :     printVectorIndex(MI, 2, STI, O);
    9464           0 :     O << ", ";
    9465           0 :     break;
    9466           0 :   case 23:
    9467             :     // INSvi8gpr, INSvi8lane
    9468           0 :     O << ".b";
    9469           0 :     printVectorIndex(MI, 2, STI, O);
    9470           0 :     O << ", ";
    9471           0 :     break;
    9472             :   case 24:
    9473             :     // LD1Fourv16b_POST, LD1Fourv2d_POST, LD1Fourv4s_POST, LD1Fourv8h_POST, L...
    9474             :     printPostIncOperand<64>(MI, 3, STI, O);
    9475             :     return;
    9476             :     break;
    9477             :   case 25:
    9478             :     // LD1Fourv1d_POST, LD1Fourv2s_POST, LD1Fourv4h_POST, LD1Fourv8b_POST, LD...
    9479             :     printPostIncOperand<32>(MI, 3, STI, O);
    9480             :     return;
    9481             :     break;
    9482             :   case 26:
    9483             :     // LD1Onev16b_POST, LD1Onev2d_POST, LD1Onev4s_POST, LD1Onev8h_POST, LD1Tw...
    9484             :     printPostIncOperand<16>(MI, 3, STI, O);
    9485             :     return;
    9486             :     break;
    9487             :   case 27:
    9488             :     // LD1Onev1d_POST, LD1Onev2s_POST, LD1Onev4h_POST, LD1Onev8b_POST, LD1Rv1...
    9489             :     printPostIncOperand<8>(MI, 3, STI, O);
    9490             :     return;
    9491             :     break;
    9492             :   case 28:
    9493             :     // LD1Rv16b_POST, LD1Rv8b_POST
    9494             :     printPostIncOperand<1>(MI, 3, STI, O);
    9495             :     return;
    9496             :     break;
    9497             :   case 29:
    9498             :     // LD1Rv2s_POST, LD1Rv4s_POST, LD2Rv4h_POST, LD2Rv8h_POST, LD4Rv16b_POST,...
    9499             :     printPostIncOperand<4>(MI, 3, STI, O);
    9500             :     return;
    9501             :     break;
    9502             :   case 30:
    9503             :     // LD1Rv4h_POST, LD1Rv8h_POST, LD2Rv16b_POST, LD2Rv8b_POST
    9504             :     printPostIncOperand<2>(MI, 3, STI, O);
    9505             :     return;
    9506             :     break;
    9507             :   case 31:
    9508             :     // LD1Threev16b_POST, LD1Threev2d_POST, LD1Threev4s_POST, LD1Threev8h_POS...
    9509             :     printPostIncOperand<48>(MI, 3, STI, O);
    9510             :     return;
    9511             :     break;
    9512             :   case 32:
    9513             :     // LD1Threev1d_POST, LD1Threev2s_POST, LD1Threev4h_POST, LD1Threev8b_POST...
    9514             :     printPostIncOperand<24>(MI, 3, STI, O);
    9515             :     return;
    9516             :     break;
    9517             :   case 33:
    9518             :     // LD1i16, LD1i32, LD1i64, LD1i8, LD2i16, LD2i32, LD2i64, LD2i8, LD3i16, ...
    9519             :     O << ']';
    9520             :     return;
    9521             :     break;
    9522             :   case 34:
    9523             :     // LD1i16_POST, LD2i8_POST
    9524             :     printPostIncOperand<2>(MI, 5, STI, O);
    9525             :     return;
    9526             :     break;
    9527             :   case 35:
    9528             :     // LD1i32_POST, LD2i16_POST, LD4i8_POST
    9529             :     printPostIncOperand<4>(MI, 5, STI, O);
    9530             :     return;
    9531             :     break;
    9532             :   case 36:
    9533             :     // LD1i64_POST, LD2i32_POST, LD4i16_POST
    9534             :     printPostIncOperand<8>(MI, 5, STI, O);
    9535             :     return;
    9536             :     break;
    9537             :   case 37:
    9538             :     // LD1i8_POST
    9539             :     printPostIncOperand<1>(MI, 5, STI, O);
    9540             :     return;
    9541             :     break;
    9542             :   case 38:
    9543             :     // LD2i64_POST, LD4i32_POST
    9544             :     printPostIncOperand<16>(MI, 5, STI, O);
    9545             :     return;
    9546             :     break;
    9547             :   case 39:
    9548             :     // LD3Rv16b_POST, LD3Rv8b_POST
    9549             :     printPostIncOperand<3>(MI, 3, STI, O);
    9550             :     return;
    9551             :     break;
    9552             :   case 40:
    9553             :     // LD3Rv2s_POST, LD3Rv4s_POST
    9554             :     printPostIncOperand<12>(MI, 3, STI, O);
    9555             :     return;
    9556             :     break;
    9557             :   case 41:
    9558             :     // LD3Rv4h_POST, LD3Rv8h_POST
    9559             :     printPostIncOperand<6>(MI, 3, STI, O);
    9560             :     return;
    9561             :     break;
    9562             :   case 42:
    9563             :     // LD3i16_POST
    9564             :     printPostIncOperand<6>(MI, 5, STI, O);
    9565             :     return;
    9566             :     break;
    9567             :   case 43:
    9568             :     // LD3i32_POST
    9569             :     printPostIncOperand<12>(MI, 5, STI, O);
    9570             :     return;
    9571             :     break;
    9572             :   case 44:
    9573             :     // LD3i64_POST
    9574             :     printPostIncOperand<24>(MI, 5, STI, O);
    9575             :     return;
    9576             :     break;
    9577             :   case 45:
    9578             :     // LD3i8_POST
    9579             :     printPostIncOperand<3>(MI, 5, STI, O);
    9580             :     return;
    9581             :     break;
    9582             :   case 46:
    9583             :     // LD4i64_POST
    9584             :     printPostIncOperand<32>(MI, 5, STI, O);
    9585             :     return;
    9586             :     break;
    9587           8 :   case 47:
    9588             :     // PMULLv1i64, PMULLv2i64
    9589           8 :     O << ".1q, ";
    9590           8 :     printVRegOperand(MI, 1, STI, O);
    9591           8 :     break;
    9592           8 :   case 48:
    9593             :     // PRFB_D_PZI, PRFD_D_PZI, PRFH_D_PZI, PRFW_D_PZI
    9594           8 :     printSVERegOp<'d'>(MI, 2, STI, O);
    9595           8 :     O << ", ";
    9596           8 :     break;
    9597          56 :   case 49:
    9598             :     // PRFB_D_SCALED, PRFB_D_SXTW_SCALED, PRFB_D_UXTW_SCALED, PRFB_PRI, PRFB_...
    9599          56 :     printOperand(MI, 2, STI, O);
    9600          56 :     O << ", ";
    9601          56 :     break;
    9602           8 :   case 50:
    9603             :     // PRFB_S_PZI, PRFD_S_PZI, PRFH_S_PZI, PRFW_S_PZI
    9604           8 :     printSVERegOp<'s'>(MI, 2, STI, O);
    9605           8 :     O << ", ";
    9606           8 :     break;
    9607           4 :   case 51:
    9608             :     // PTRUES_H, PTRUE_H
    9609           4 :     printSVEPattern(MI, 1, STI, O);
    9610           4 :     return;
    9611             :     break;
    9612           5 :   case 52:
    9613             :     // SADALPv2i32_v1i64, SADDLPv2i32_v1i64, UADALPv2i32_v1i64, UADDLPv2i32_v...
    9614           5 :     O << ".1d, ";
    9615           5 :     break;
    9616          12 :   case 53:
    9617             :     // ST1i16_POST, ST1i32_POST, ST1i64_POST, ST1i8_POST, ST2i16_POST, ST2i32...
    9618          12 :     O << "], ";
    9619          12 :     break;
    9620           4 :   case 54:
    9621             :     // TBL_ZZZ_H
    9622           4 :     printTypedVectorList<0,'h'>(MI, 1, STI, O);
    9623           4 :     O << ", ";
    9624           4 :     printSVERegOp<'h'>(MI, 2, STI, O);
    9625           4 :     return;
    9626             :     break;
    9627             :   }
    9628             : 
    9629             : 
    9630             :   // Fragment 2 encoded into 7 bits for 79 unique commands.
    9631       44296 :   switch ((Bits >> 25) & 127) {
    9632           0 :   default: llvm_unreachable("Invalid command number.");
    9633         210 :   case 0:
    9634             :     // ABS_ZPmZ_B, ABS_ZPmZ_D, ABS_ZPmZ_S, CLS_ZPmZ_B, CLS_ZPmZ_D, CLS_ZPmZ_S...
    9635         210 :     printSVERegOp<>(MI, 2, STI, O);
    9636         210 :     break;
    9637         172 :   case 1:
    9638             :     // ABS_ZPmZ_H, ADD_ZPmZ_H, AND_ZPmZ_H, ASRD_ZPmI_H, ASRR_ZPmZ_H, ASR_WIDE...
    9639         172 :     O << "/m, ";
    9640         172 :     break;
    9641        8557 :   case 2:
    9642             :     // ABSv16i8, ABSv2i32, ABSv2i64, ABSv4i16, ABSv4i32, ABSv8i16, ABSv8i8, A...
    9643        8557 :     printVRegOperand(MI, 1, STI, O);
    9644        8557 :     break;
    9645       18339 :   case 3:
    9646             :     // ABSv1i64, ADCSWr, ADCSXr, ADCWr, ADCXr, ADDPL_XXI, ADDSWri, ADDSWrs, A...
    9647       18339 :     printOperand(MI, 1, STI, O);
    9648       18339 :     break;
    9649        1853 :   case 4:
    9650             :     // ADDHNv2i64_v4i32, ADDHNv4i32_v8i16, ADDHNv8i16_v16i8, AESDrr, AESErr, ...
    9651        1853 :     printVRegOperand(MI, 2, STI, O);
    9652        1853 :     break;
    9653         166 :   case 5:
    9654             :     // ADD_ZI_B, ADD_ZZZ_B, ASR_WIDE_ZZZ_B, ASR_ZZI_B, DECP_XP_B, DUP_ZZI_B, ...
    9655         166 :     printSVERegOp<'b'>(MI, 1, STI, O);
    9656         166 :     break;
    9657         228 :   case 6:
    9658             :     // ADD_ZI_D, ADD_ZZZ_D, ADR_LSL_ZZZ_D_0, ADR_LSL_ZZZ_D_1, ADR_LSL_ZZZ_D_2...
    9659         228 :     printSVERegOp<'d'>(MI, 1, STI, O);
    9660         228 :     break;
    9661         160 :   case 7:
    9662             :     // ADD_ZI_H, ADD_ZZZ_H, ASR_WIDE_ZZZ_H, ASR_ZZI_H, FMUL_ZZZI_H, INDEX_II_...
    9663         160 :     O << ", ";
    9664         160 :     break;
    9665         177 :   case 8:
    9666             :     // ADD_ZI_S, ADD_ZZZ_S, ADR_LSL_ZZZ_S_0, ADR_LSL_ZZZ_S_1, ADR_LSL_ZZZ_S_2...
    9667         177 :     printSVERegOp<'s'>(MI, 1, STI, O);
    9668         177 :     break;
    9669         612 :   case 9:
    9670             :     // ADD_ZPmZ_B, ADD_ZPmZ_D, ADD_ZPmZ_S, ANDS_PPzPP, AND_PPzPP, AND_ZPmZ_B,...
    9671         612 :     printSVERegOp<>(MI, 1, STI, O);
    9672         612 :     break;
    9673        2951 :   case 10:
    9674             :     // ADRP
    9675        2951 :     printAdrpLabel(MI, 1, STI, O);
    9676        2951 :     return;
    9677             :     break;
    9678        3616 :   case 11:
    9679             :     // BFMWri, BFMXri, CASAB, CASAH, CASALB, CASALH, CASALW, CASALX, CASAW, C...
    9680        3616 :     printOperand(MI, 2, STI, O);
    9681        3616 :     break;
    9682         333 :   case 12:
    9683             :     // BICv2i32, BICv4i16, BICv4i32, BICv8i16, MOVKWi, MOVKXi, ORRv2i32, ORRv...
    9684         333 :     printImm(MI, 2, STI, O);
    9685         333 :     printShifter(MI, 3, STI, O);
    9686         333 :     return;
    9687             :     break;
    9688         316 :   case 13:
    9689             :     // CBNZW, CBNZX, CBZW, CBZX, LDRDl, LDRQl, LDRSWl, LDRSl, LDRWl, LDRXl, P...
    9690         316 :     printAlignedLabel(MI, 1, STI, O);
    9691         316 :     return;
    9692             :     break;
    9693         114 :   case 14:
    9694             :     // CMPEQ_PPzZI_H, CMPEQ_PPzZZ_H, CMPEQ_WIDE_PPzZZ_H, CMPGE_PPzZI_H, CMPGE...
    9695         114 :     O << "/z, ";
    9696         114 :     break;
    9697         144 :   case 15:
    9698             :     // CNTB_XPiI, CNTD_XPiI, CNTH_XPiI, CNTW_XPiI, PTRUES_B, PTRUES_D, PTRUES...
    9699         144 :     printSVEPattern(MI, 1, STI, O);
    9700         144 :     break;
    9701         116 :   case 16:
    9702             :     // DECB_XPiI, DECD_XPiI, DECD_ZPiI, DECH_XPiI, DECW_XPiI, DECW_ZPiI, INCB...
    9703         116 :     printSVEPattern(MI, 2, STI, O);
    9704         116 :     O << ", mul ";
    9705         116 :     printOperand(MI, 3, STI, O);
    9706         116 :     return;
    9707             :     break;
    9708          24 :   case 17:
    9709             :     // DECP_XP_H, INCP_XP_H, SQDECP_XPWd_H, SQDECP_XP_H, SQINCP_XPWd_H, SQINC...
    9710          24 :     printSVERegOp<'h'>(MI, 1, STI, O);
    9711          24 :     break;
    9712             :   case 18:
    9713             :     // DECP_ZP_H, DUP_ZR_H, INCP_ZP_H, SQDECP_ZP_H, SQINCP_ZP_H, UQDECP_ZP_H,...
    9714             :     return;
    9715             :     break;
    9716           2 :   case 19:
    9717             :     // DUPM_ZI
    9718           2 :     printLogicalImm<int64_t>(MI, 1, STI, O);
    9719           2 :     return;
    9720             :     break;
    9721           0 :   case 20:
    9722             :     // DUP_ZI_B
    9723           0 :     printImm8OptLsl<int8_t>(MI, 1, STI, O);
    9724           0 :     return;
    9725             :     break;
    9726           0 :   case 21:
    9727             :     // DUP_ZI_D
    9728           0 :     printImm8OptLsl<int64_t>(MI, 1, STI, O);
    9729           0 :     return;
    9730             :     break;
    9731           0 :   case 22:
    9732             :     // DUP_ZI_S
    9733           0 :     printImm8OptLsl<int32_t>(MI, 1, STI, O);
    9734           0 :     return;
    9735             :     break;
    9736           0 :   case 23:
    9737             :     // DUP_ZZI_H
    9738           0 :     printVectorIndex(MI, 2, STI, O);
    9739           0 :     return;
    9740             :     break;
    9741          30 :   case 24:
    9742             :     // FCMLA_ZZZI_S, GLD1B_S_IMM_REAL, GLD1H_S_IMM_REAL, GLD1SB_S_IMM_REAL, G...
    9743          30 :     printSVERegOp<'s'>(MI, 2, STI, O);
    9744          30 :     O << ", ";
    9745          30 :     break;
    9746         134 :   case 25:
    9747             :     // FDUP_ZI_D, FDUP_ZI_S, FMOVDi, FMOVHi, FMOVSi, FMOVv2f32_ns, FMOVv2f64_...
    9748         134 :     printFPImmOperand(MI, 1, STI, O);
    9749         134 :     return;
    9750             :     break;
    9751          36 :   case 26:
    9752             :     // GLD1B_D_IMM_REAL, GLD1D_IMM_REAL, GLD1H_D_IMM_REAL, GLD1SB_D_IMM_REAL,...
    9753          36 :     printSVERegOp<'d'>(MI, 2, STI, O);
    9754          36 :     O << ", ";
    9755          36 :     break;
    9756          20 :   case 27:
    9757             :     // INSvi16gpr, INSvi32gpr, INSvi64gpr, INSvi8gpr, PRFB_D_PZI, PRFB_PRI, P...
    9758          20 :     printOperand(MI, 3, STI, O);
    9759          20 :     break;
    9760           0 :   case 28:
    9761             :     // INSvi16lane, INSvi32lane, INSvi64lane, INSvi8lane
    9762           0 :     printVRegOperand(MI, 3, STI, O);
    9763           0 :     break;
    9764        2250 :   case 29:
    9765             :     // LDADDAB, LDADDAH, LDADDALB, LDADDALH, LDADDALW, LDADDALX, LDADDAW, LDA...
    9766        2250 :     printOperand(MI, 0, STI, O);
    9767        2250 :     O << ", [";
    9768        2250 :     printOperand(MI, 2, STI, O);
    9769             :     O << ']';
    9770             :     return;
    9771             :     break;
    9772         153 :   case 30:
    9773             :     // MOVID, MOVIv2d_ns
    9774         153 :     printSIMDType10Operand(MI, 1, STI, O);
    9775         153 :     return;
    9776             :     break;
    9777         274 :   case 31:
    9778             :     // MOVIv16b_ns, MOVIv2i32, MOVIv2s_msl, MOVIv4i16, MOVIv4i32, MOVIv4s_msl...
    9779         274 :     printImm(MI, 1, STI, O);
    9780         274 :     break;
    9781        3068 :   case 32:
    9782             :     // MRS
    9783        3068 :     printMRSSystemRegister(MI, 1, STI, O);
    9784        3068 :     return;
    9785             :     break;
    9786           4 :   case 33:
    9787             :     // PMULLv1i64
    9788           4 :     O << ".1d, ";
    9789           4 :     printVRegOperand(MI, 2, STI, O);
    9790           4 :     O << ".1d";
    9791           4 :     return;
    9792             :     break;
    9793           4 :   case 34:
    9794             :     // PMULLv2i64
    9795           4 :     O << ".2d, ";
    9796           4 :     printVRegOperand(MI, 2, STI, O);
    9797           4 :     O << ".2d";
    9798           4 :     return;
    9799             :     break;
    9800           2 :   case 35:
    9801             :     // PRFB_D_SCALED
    9802           2 :     printRegWithShiftExtend<false, 8, 'x', 'd'>(MI, 3, STI, O);
    9803             :     O << ']';
    9804             :     return;
    9805             :     break;
    9806           2 :   case 36:
    9807             :     // PRFB_D_SXTW_SCALED
    9808           2 :     printRegWithShiftExtend<true, 8, 'w', 'd'>(MI, 3, STI, O);
    9809             :     O << ']';
    9810             :     return;
    9811             :     break;
    9812           2 :   case 37:
    9813             :     // PRFB_D_UXTW_SCALED
    9814           2 :     printRegWithShiftExtend<false, 8, 'w', 'd'>(MI, 3, STI, O);
    9815             :     O << ']';
    9816             :     return;
    9817             :     break;
    9818             :   case 38:
    9819             :     // PRFB_PRR
    9820             :     printRegWithShiftExtend<false, 8, 'x', 0>(MI, 3, STI, O);
    9821             :     O << ']';
    9822             :     return;
    9823             :     break;
    9824           0 :   case 39:
    9825             :     // PRFB_S_SXTW_SCALED
    9826           0 :     printRegWithShiftExtend<true, 8, 'w', 's'>(MI, 3, STI, O);
    9827             :     O << ']';
    9828             :     return;
    9829             :     break;
    9830           4 :   case 40:
    9831             :     // PRFB_S_UXTW_SCALED
    9832           4 :     printRegWithShiftExtend<false, 8, 'w', 's'>(MI, 3, STI, O);
    9833             :     O << ']';
    9834             :     return;
    9835             :     break;
    9836           4 :   case 41:
    9837             :     // PRFD_D_PZI, PRFD_S_PZI
    9838           4 :     printImmScale<8>(MI, 3, STI, O);
    9839             :     O << ']';
    9840             :     return;
    9841             :     break;
    9842           2 :   case 42:
    9843             :     // PRFD_D_SCALED
    9844           2 :     printRegWithShiftExtend<false, 64, 'x', 'd'>(MI, 3, STI, O);
    9845             :     O << ']';
    9846             :     return;
    9847             :     break;
    9848           2 :   case 43:
    9849             :     // PRFD_D_SXTW_SCALED
    9850           2 :     printRegWithShiftExtend<true, 64, 'w', 'd'>(MI, 3, STI, O);
    9851             :     O << ']';
    9852             :     return;
    9853             :     break;
    9854           2 :   case 44:
    9855             :     // PRFD_D_UXTW_SCALED
    9856           2 :     printRegWithShiftExtend<false, 64, 'w', 'd'>(MI, 3, STI, O);
    9857             :     O << ']';
    9858             :     return;
    9859             :     break;
    9860           0 :   case 45:
    9861             :     // PRFD_PRR
    9862           0 :     printRegWithShiftExtend<false, 64, 'x', 0>(MI, 3, STI, O);
    9863             :     O << ']';
    9864             :     return;
    9865             :     break;
    9866           2 :   case 46:
    9867             :     // PRFD_S_SXTW_SCALED
    9868           2 :     printRegWithShiftExtend<true, 64, 'w', 's'>(MI, 3, STI, O);
    9869             :     O << ']';
    9870             :     return;
    9871             :     break;
    9872           2 :   case 47:
    9873             :     // PRFD_S_UXTW_SCALED
    9874           2 :     printRegWithShiftExtend<false, 64, 'w', 's'>(MI, 3, STI, O);
    9875             :     O << ']';
    9876             :     return;
    9877             :     break;
    9878           4 :   case 48:
    9879             :     // PRFH_D_PZI, PRFH_S_PZI
    9880           4 :     printImmScale<2>(MI, 3, STI, O);
    9881             :     O << ']';
    9882             :     return;
    9883             :     break;
    9884           2 :   case 49:
    9885             :     // PRFH_D_SCALED
    9886           2 :     printRegWithShiftExtend<false, 16, 'x', 'd'>(MI, 3, STI, O);
    9887             :     O << ']';
    9888             :     return;
    9889             :     break;
    9890           2 :   case 50:
    9891             :     // PRFH_D_SXTW_SCALED
    9892           2 :     printRegWithShiftExtend<true, 16, 'w', 'd'>(MI, 3, STI, O);
    9893             :     O << ']';
    9894             :     return;
    9895             :     break;
    9896           2 :   case 51:
    9897             :     // PRFH_D_UXTW_SCALED
    9898           2 :     printRegWithShiftExtend<false, 16, 'w', 'd'>(MI, 3, STI, O);
    9899             :     O << ']';
    9900             :     return;
    9901             :     break;
    9902           0 :   case 52:
    9903             :     // PRFH_PRR
    9904           0 :     printRegWithShiftExtend<false, 16, 'x', 0>(MI, 3, STI, O);
    9905             :     O << ']';
    9906             :     return;
    9907             :     break;
    9908           2 :   case 53:
    9909             :     // PRFH_S_SXTW_SCALED
    9910           2 :     printRegWithShiftExtend<true, 16, 'w', 's'>(MI, 3, STI, O);
    9911             :     O << ']';
    9912             :     return;
    9913             :     break;
    9914           2 :   case 54:
    9915             :     // PRFH_S_UXTW_SCALED
    9916           2 :     printRegWithShiftExtend<false, 16, 'w', 's'>(MI, 3, STI, O);
    9917             :     O << ']';
    9918             :     return;
    9919             :     break;
    9920           0 :   case 55:
    9921             :     // PRFS_PRR
    9922           0 :     printRegWithShiftExtend<false, 32, 'x', 0>(MI, 3, STI, O);
    9923             :     O << ']';
    9924             :     return;
    9925             :     break;
    9926           4 :   case 56:
    9927             :     // PRFW_D_PZI, PRFW_S_PZI
    9928           4 :     printImmScale<4>(MI, 3, STI, O);
    9929             :     O << ']';
    9930             :     return;
    9931             :     break;
    9932           2 :   case 57:
    9933             :     // PRFW_D_SCALED
    9934           2 :     printRegWithShiftExtend<false, 32, 'x', 'd'>(MI, 3, STI, O);
    9935             :     O << ']';
    9936             :     return;
    9937             :     break;
    9938           2 :   case 58:
    9939             :     // PRFW_D_SXTW_SCALED
    9940           2 :     printRegWithShiftExtend<true, 32, 'w', 'd'>(MI, 3, STI, O);
    9941             :     O << ']';
    9942             :     return;
    9943             :     break;
    9944           2 :   case 59:
    9945             :     // PRFW_D_UXTW_SCALED
    9946           2 :     printRegWithShiftExtend<false, 32, 'w', 'd'>(MI, 3, STI, O);
    9947             :     O << ']';
    9948             :     return;
    9949             :     break;
    9950           2 :   case 60:
    9951             :     // PRFW_S_SXTW_SCALED
    9952           2 :     printRegWithShiftExtend<true, 32, 'w', 's'>(MI, 3, STI, O);
    9953             :     O << ']';
    9954             :     return;
    9955             :     break;
    9956           2 :   case 61:
    9957             :     // PRFW_S_UXTW_SCALED
    9958           2 :     printRegWithShiftExtend<false, 32, 'w', 's'>(MI, 3, STI, O);
    9959             :     O << ']';
    9960             :     return;
    9961             :     break;
    9962          32 :   case 62:
    9963             :     // SQDECB_XPiWdI, SQDECD_XPiWdI, SQDECH_XPiWdI, SQDECW_XPiWdI, SQINCB_XPi...
    9964          32 :     printGPR64as32(MI, 1, STI, O);
    9965          32 :     O << ", ";
    9966          32 :     printSVEPattern(MI, 2, STI, O);
    9967          32 :     O << ", mul ";
    9968          32 :     printOperand(MI, 3, STI, O);
    9969          32 :     return;
    9970             :     break;
    9971             :   case 63:
    9972             :     // ST1i16_POST, ST2i8_POST
    9973             :     printPostIncOperand<2>(MI, 4, STI, O);
    9974             :     return;
    9975             :     break;
    9976             :   case 64:
    9977             :     // ST1i32_POST, ST2i16_POST, ST4i8_POST
    9978             :     printPostIncOperand<4>(MI, 4, STI, O);
    9979             :     return;
    9980             :     break;
    9981             :   case 65:
    9982             :     // ST1i64_POST, ST2i32_POST, ST4i16_POST
    9983             :     printPostIncOperand<8>(MI, 4, STI, O);
    9984             :     return;
    9985             :     break;
    9986             :   case 66:
    9987             :     // ST1i8_POST
    9988             :     printPostIncOperand<1>(MI, 4, STI, O);
    9989             :     return;
    9990             :     break;
    9991             :   case 67:
    9992             :     // ST2i64_POST, ST4i32_POST
    9993             :     printPostIncOperand<16>(MI, 4, STI, O);
    9994             :     return;
    9995             :     break;
    9996             :   case 68:
    9997             :     // ST3i16_POST
    9998             :     printPostIncOperand<6>(MI, 4, STI, O);
    9999             :     return;
   10000             :     break;
   10001             :   case 69:
   10002             :     // ST3i32_POST
   10003             :     printPostIncOperand<12>(MI, 4, STI, O);
   10004             :     return;
   10005             :     break;
   10006             :   case 70:
   10007             :     // ST3i64_POST
   10008             :     printPostIncOperand<24>(MI, 4, STI, O);
   10009             :     return;
   10010             :     break;
   10011             :   case 71:
   10012             :     // ST3i8_POST
   10013             :     printPostIncOperand<3>(MI, 4, STI, O);
   10014             :     return;
   10015             :     break;
   10016             :   case 72:
   10017             :     // ST4i64_POST
   10018             :     printPostIncOperand<32>(MI, 4, STI, O);
   10019             :     return;
   10020             :     break;
   10021          52 :   case 73:
   10022             :     // SYSxt
   10023          52 :     printSysCROperand(MI, 1, STI, O);
   10024          52 :     O << ", ";
   10025          52 :     printSysCROperand(MI, 2, STI, O);
   10026          52 :     O << ", ";
   10027          52 :     printOperand(MI, 3, STI, O);
   10028          52 :     O << ", ";
   10029          52 :     printOperand(MI, 4, STI, O);
   10030          52 :     return;
   10031             :     break;
   10032           4 :   case 74:
   10033             :     // TBL_ZZZ_B
   10034           4 :     printTypedVectorList<0,'b'>(MI, 1, STI, O);
   10035           4 :     O << ", ";
   10036           4 :     printSVERegOp<'b'>(MI, 2, STI, O);
   10037           4 :     return;
   10038             :     break;
   10039           4 :   case 75:
   10040             :     // TBL_ZZZ_D
   10041           4 :     printTypedVectorList<0,'d'>(MI, 1, STI, O);
   10042           4 :     O << ", ";
   10043           4 :     printSVERegOp<'d'>(MI, 2, STI, O);
   10044           4 :     return;
   10045             :     break;
   10046           4 :   case 76:
   10047             :     // TBL_ZZZ_S
   10048           4 :     printTypedVectorList<0,'s'>(MI, 1, STI, O);
   10049           4 :     O << ", ";
   10050           4 :     printSVERegOp<'s'>(MI, 2, STI, O);
   10051           4 :     return;
   10052             :     break;
   10053          35 :   case 77:
   10054             :     // TBLv16i8Four, TBLv16i8One, TBLv16i8Three, TBLv16i8Two, TBLv8i8Four, TB...
   10055          35 :     printTypedVectorList<16, 'b'>(MI, 1, STI, O);
   10056          35 :     O << ", ";
   10057          35 :     printVRegOperand(MI, 2, STI, O);
   10058          35 :     break;
   10059          26 :   case 78:
   10060             :     // TBXv16i8Four, TBXv16i8One, TBXv16i8Three, TBXv16i8Two, TBXv8i8Four, TB...
   10061          26 :     printTypedVectorList<16, 'b'>(MI, 2, STI, O);
   10062          26 :     O << ", ";
   10063          26 :     printVRegOperand(MI, 3, STI, O);
   10064          26 :     break;
   10065             :   }
   10066             : 
   10067             : 
   10068             :   // Fragment 3 encoded into 7 bits for 66 unique commands.
   10069       34793 :   switch ((Bits >> 32) & 127) {
   10070           0 :   default: llvm_unreachable("Invalid command number.");
   10071         444 :   case 0:
   10072             :     // ABS_ZPmZ_B, ABS_ZPmZ_D, ABS_ZPmZ_S, ADD_ZPmZ_B, ADD_ZPmZ_D, ADD_ZPmZ_S...
   10073         444 :     O << "/m, ";
   10074         444 :     break;
   10075          64 :   case 1:
   10076             :     // ABS_ZPmZ_H, CLS_ZPmZ_H, CLZ_ZPmZ_H, CNOT_ZPmZ_H, CNT_ZPmZ_H, FABS_ZPmZ...
   10077          64 :     printSVERegOp<'h'>(MI, 3, STI, O);
   10078          64 :     break;
   10079         649 :   case 2:
   10080             :     // ABSv16i8, ADDVv16i8v, AESDrr, AESErr, AESIMCrr, AESMCrr, CLSv16i8, CLZ...
   10081         649 :     O << ".16b";
   10082         649 :     return;
   10083             :     break;
   10084             :   case 3:
   10085             :     // ABSv1i64, ADR, AUTDA, AUTDB, AUTIA, AUTIB, BLRAA, BLRAB, BRAA, BRAB, C...
   10086             :     return;
   10087             :     break;
   10088         213 :   case 4:
   10089             :     // ABSv2i32, CLSv2i32, CLZv2i32, FABSv2f32, FADDPv2i32p, FCVTASv2f32, FCV...
   10090         213 :     O << ".2s";
   10091         213 :     return;
   10092             :     break;
   10093         174 :   case 5:
   10094             :     // ABSv2i64, ADDPv2i64p, FABSv2f64, FADDPv2i64p, FCVTASv2f64, FCVTAUv2f64...
   10095         174 :     O << ".2d";
   10096         174 :     return;
   10097             :     break;
   10098         280 :   case 6:
   10099             :     // ABSv4i16, ADDVv4i16v, CLSv4i16, CLZv4i16, FABSv4f16, FCVTASv4f16, FCVT...
   10100         280 :     O << ".4h";
   10101         280 :     return;
   10102             :     break;
   10103         496 :   case 7:
   10104             :     // ABSv4i32, ADDVv4i32v, CLSv4i32, CLZv4i32, FABSv4f32, FCVTASv4f32, FCVT...
   10105         496 :     O << ".4s";
   10106         496 :     return;
   10107             :     break;
   10108         241 :   case 8:
   10109             :     // ABSv8i16, ADDVv8i16v, CLSv8i16, CLZv8i16, FABSv8f16, FCVTASv8f16, FCVT...
   10110         241 :     O << ".8h";
   10111         241 :     return;
   10112             :     break;
   10113         186 :   case 9:
   10114             :     // ABSv8i8, ADDVv8i8v, CLSv8i8, CLZv8i8, CNTv8i8, NEGv8i8, NOTv8i8, RBITv...
   10115         186 :     O << ".8b";
   10116         186 :     return;
   10117             :     break;
   10118       16506 :   case 10:
   10119             :     // ADCSWr, ADCSXr, ADCWr, ADCXr, ADDPL_XXI, ADDSWri, ADDSWrs, ADDSWrx, AD...
   10120       16506 :     O << ", ";
   10121       16506 :     break;
   10122         709 :   case 11:
   10123             :     // ADDHNv2i64_v2i32, ADDHNv2i64_v4i32, ADDPv2i64, ADDv2i64, CMEQv2i64, CM...
   10124         709 :     O << ".2d, ";
   10125         709 :     break;
   10126        1664 :   case 12:
   10127             :     // ADDHNv4i32_v4i16, ADDHNv4i32_v8i16, ADDPv4i32, ADDv4i32, CMEQv4i32, CM...
   10128        1664 :     O << ".4s, ";
   10129        1664 :     break;
   10130         894 :   case 13:
   10131             :     // ADDHNv8i16_v16i8, ADDHNv8i16_v8i8, ADDPv8i16, ADDv8i16, CMEQv8i16, CMG...
   10132         894 :     O << ".8h, ";
   10133         894 :     break;
   10134        1083 :   case 14:
   10135             :     // ADDPv16i8, ADDv16i8, ANDv16i8, BICv16i8, BIFv16i8, BITv16i8, BSLv16i8,...
   10136        1083 :     O << ".16b, ";
   10137        1083 :     break;
   10138         946 :   case 15:
   10139             :     // ADDPv2i32, ADDv2i32, CMEQv2i32, CMGEv2i32, CMGTv2i32, CMHIv2i32, CMHSv...
   10140         946 :     O << ".2s, ";
   10141         946 :     break;
   10142         760 :   case 16:
   10143             :     // ADDPv4i16, ADDv4i16, CMEQv4i16, CMGEv4i16, CMGTv4i16, CMHIv4i16, CMHSv...
   10144         760 :     O << ".4h, ";
   10145         760 :     break;
   10146         652 :   case 17:
   10147             :     // ADDPv8i8, ADDv8i8, ANDv8i8, BICv8i8, BIFv8i8, BITv8i8, BSLv8i8, CMEQv8...
   10148         652 :     O << ".8b, ";
   10149         652 :     break;
   10150          56 :   case 18:
   10151             :     // ADD_ZI_H, SQADD_ZI_H, SQSUB_ZI_H, SUBR_ZI_H, SUB_ZI_H, UQADD_ZI_H, UQS...
   10152          56 :     printImm8OptLsl<uint16_t>(MI, 2, STI, O);
   10153          56 :     return;
   10154             :     break;
   10155         272 :   case 19:
   10156             :     // ADD_ZPmZ_H, ADD_ZZZ_H, AND_ZPmZ_H, ASRD_ZPmI_H, ASRR_ZPmZ_H, ASR_WIDE_...
   10157         272 :     printSVERegOp<'h'>(MI, 2, STI, O);
   10158         272 :     break;
   10159         332 :   case 20:
   10160             :     // ANDS_PPzPP, AND_PPzPP, BICS_PPzPP, BIC_PPzPP, CMPEQ_PPzZI_B, CMPEQ_PPz...
   10161         332 :     O << "/z, ";
   10162         332 :     break;
   10163           6 :   case 21:
   10164             :     // ASR_WIDE_ZZZ_H, LSL_WIDE_ZZZ_H, LSR_WIDE_ZZZ_H
   10165           6 :     printSVERegOp<'d'>(MI, 2, STI, O);
   10166           6 :     return;
   10167             :     break;
   10168          36 :   case 22:
   10169             :     // ASR_ZZI_H, INDEX_II_H, INDEX_IR_H, INDEX_RI_H, INDEX_RR_H, LSL_ZZI_H, ...
   10170          36 :     printOperand(MI, 2, STI, O);
   10171          36 :     return;
   10172             :     break;
   10173        2165 :   case 23:
   10174             :     // CASAB, CASAH, CASALB, CASALH, CASALW, CASALX, CASAW, CASAX, CASB, CASH...
   10175        2165 :     O << ", [";
   10176        2165 :     break;
   10177          20 :   case 24:
   10178             :     // CMEQv16i8rz, CMGEv16i8rz, CMGTv16i8rz, CMLEv16i8rz, CMLTv16i8rz
   10179          20 :     O << ".16b, #0";
   10180          20 :     return;
   10181             :     break;
   10182          20 :   case 25:
   10183             :     // CMEQv1i64rz, CMGEv1i64rz, CMGTv1i64rz, CMLEv1i64rz, CMLTv1i64rz
   10184          20 :     O << ", #0";
   10185          20 :     return;
   10186             :     break;
   10187          20 :   case 26:
   10188             :     // CMEQv2i32rz, CMGEv2i32rz, CMGTv2i32rz, CMLEv2i32rz, CMLTv2i32rz
   10189          20 :     O << ".2s, #0";
   10190          20 :     return;
   10191             :     break;
   10192          20 :   case 27:
   10193             :     // CMEQv2i64rz, CMGEv2i64rz, CMGTv2i64rz, CMLEv2i64rz, CMLTv2i64rz
   10194          20 :     O << ".2d, #0";
   10195          20 :     return;
   10196             :     break;
   10197          18 :   case 28:
   10198             :     // CMEQv4i16rz, CMGEv4i16rz, CMGTv4i16rz, CMLEv4i16rz, CMLTv4i16rz
   10199          18 :     O << ".4h, #0";
   10200          18 :     return;
   10201             :     break;
   10202          18 :   case 29:
   10203             :     // CMEQv4i32rz, CMGEv4i32rz, CMGTv4i32rz, CMLEv4i32rz, CMLTv4i32rz
   10204          18 :     O << ".4s, #0";
   10205          18 :     return;
   10206             :     break;
   10207          20 :   case 30:
   10208             :     // CMEQv8i16rz, CMGEv8i16rz, CMGTv8i16rz, CMLEv8i16rz, CMLTv8i16rz
   10209          20 :     O << ".8h, #0";
   10210          20 :     return;
   10211             :     break;
   10212          23 :   case 31:
   10213             :     // CMEQv8i8rz, CMGEv8i8rz, CMGTv8i8rz, CMLEv8i8rz, CMLTv8i8rz
   10214          23 :     O << ".8b, #0";
   10215          23 :     return;
   10216             :     break;
   10217           8 :   case 32:
   10218             :     // CNTB_XPiI, CNTD_XPiI, CNTH_XPiI, CNTW_XPiI
   10219           8 :     O << ", mul ";
   10220           8 :     printOperand(MI, 2, STI, O);
   10221           8 :     return;
   10222             :     break;
   10223           0 :   case 33:
   10224             :     // CPY_ZPmI_H
   10225           0 :     printImm8OptLsl<int16_t>(MI, 3, STI, O);
   10226           0 :     return;
   10227             :     break;
   10228          20 :   case 34:
   10229             :     // CPY_ZPmR_H, CPY_ZPmV_H, GLD1B_D_IMM_REAL, GLD1B_S_IMM_REAL, GLD1SB_D_I...
   10230          20 :     printOperand(MI, 3, STI, O);
   10231          20 :     break;
   10232           0 :   case 35:
   10233             :     // CPY_ZPzI_H
   10234           0 :     printImm8OptLsl<int16_t>(MI, 2, STI, O);
   10235           0 :     return;
   10236             :     break;
   10237         846 :   case 36:
   10238             :     // CPYi16, DUPv4i16lane, DUPv8i16lane, INSvi16lane, SMOVvi16to32, SMOVvi1...
   10239         846 :     O << ".h";
   10240         846 :     break;
   10241         106 :   case 37:
   10242             :     // CPYi32, DUPv2i32lane, DUPv4i32lane, INSvi32lane, SMOVvi32to64, UMOVvi3...
   10243         106 :     O << ".s";
   10244         106 :     break;
   10245          55 :   case 38:
   10246             :     // CPYi64, DUPv2i64lane, FMOVDXHighr, INSvi64lane, UMOVvi64
   10247          55 :     O << ".d";
   10248          55 :     break;
   10249         233 :   case 39:
   10250             :     // CPYi8, DUPv16i8lane, DUPv8i8lane, INSvi8lane, SMOVvi8to32, SMOVvi8to64...
   10251         233 :     O << ".b";
   10252         233 :     break;
   10253           0 :   case 40:
   10254             :     // DUP_ZZI_B, DUP_ZZI_D, DUP_ZZI_S
   10255           0 :     printVectorIndex(MI, 2, STI, O);
   10256           0 :     return;
   10257             :     break;
   10258           2 :   case 41:
   10259             :     // FADDPv2i16p, FMAXNMPv2i16p, FMAXPv2i16p, FMINNMPv2i16p, FMINPv2i16p
   10260           2 :     O << ".2h";
   10261           2 :     return;
   10262             :     break;
   10263          55 :   case 42:
   10264             :     // FCMEQv1i16rz, FCMEQv1i32rz, FCMEQv1i64rz, FCMGEv1i16rz, FCMGEv1i32rz, ...
   10265          55 :     O << ", #0.0";
   10266          55 :     return;
   10267             :     break;
   10268          32 :   case 43:
   10269             :     // FCMEQv2i32rz, FCMGEv2i32rz, FCMGTv2i32rz, FCMLEv2i32rz, FCMLTv2i32rz
   10270          32 :     O << ".2s, #0.0";
   10271          32 :     return;
   10272             :     break;
   10273          35 :   case 44:
   10274             :     // FCMEQv2i64rz, FCMGEv2i64rz, FCMGTv2i64rz, FCMLEv2i64rz, FCMLTv2i64rz
   10275          35 :     O << ".2d, #0.0";
   10276          35 :     return;
   10277             :     break;
   10278          10 :   case 45:
   10279             :     // FCMEQv4i16rz, FCMGEv4i16rz, FCMGTv4i16rz, FCMLEv4i16rz, FCMLTv4i16rz
   10280          10 :     O << ".4h, #0.0";
   10281          10 :     return;
   10282             :     break;
   10283          35 :   case 46:
   10284             :     // FCMEQv4i32rz, FCMGEv4i32rz, FCMGTv4i32rz, FCMLEv4i32rz, FCMLTv4i32rz
   10285          35 :     O << ".4s, #0.0";
   10286          35 :     return;
   10287             :     break;
   10288          10 :   case 47:
   10289             :     // FCMEQv8i16rz, FCMGEv8i16rz, FCMGTv8i16rz, FCMLEv8i16rz, FCMLTv8i16rz
   10290          10 :     O << ".8h, #0.0";
   10291          10 :     return;
   10292             :     break;
   10293          10 :   case 48:
   10294             :     // FCMLA_ZZZI_S, FCVT_ZPmZ_StoH, SCVTF_ZPmZ_StoH, UCVTF_ZPmZ_StoH
   10295          10 :     printSVERegOp<'s'>(MI, 3, STI, O);
   10296          10 :     break;
   10297           0 :   case 49:
   10298             :     // FCPY_ZPmI_H
   10299           0 :     printFPImmOperand(MI, 3, STI, O);
   10300           0 :     return;
   10301             :     break;
   10302           6 :   case 50:
   10303             :     // FCVT_ZPmZ_DtoH, SCVTF_ZPmZ_DtoH, UCVTF_ZPmZ_DtoH
   10304           6 :     printSVERegOp<'d'>(MI, 3, STI, O);
   10305           6 :     return;
   10306             :     break;
   10307           6 :   case 51:
   10308             :     // GLD1D_IMM_REAL, GLDFF1D_IMM_REAL, SST1D_IMM
   10309           6 :     printImmScale<8>(MI, 3, STI, O);
   10310             :     O << ']';
   10311             :     return;
   10312             :     break;
   10313          20 :   case 52:
   10314             :     // GLD1H_D_IMM_REAL, GLD1H_S_IMM_REAL, GLD1SH_D_IMM_REAL, GLD1SH_S_IMM_RE...
   10315          20 :     printImmScale<2>(MI, 3, STI, O);
   10316             :     O << ']';
   10317             :     return;
   10318             :     break;
   10319          16 :   case 53:
   10320             :     // GLD1SW_D_IMM_REAL, GLD1W_D_IMM_REAL, GLD1W_IMM_REAL, GLDFF1SW_D_IMM_RE...
   10321          16 :     printImmScale<4>(MI, 3, STI, O);
   10322             :     O << ']';
   10323             :     return;
   10324             :     break;
   10325             :   case 54:
   10326             :     // LDAPRB, LDAPRH, LDAPRW, LDAPRX, LDARB, LDARH, LDARW, LDARX, LDAXRB, LD...
   10327             :     O << ']';
   10328             :     return;
   10329             :     break;
   10330         807 :   case 55:
   10331             :     // LDRBBpost, LDRBpost, LDRDpost, LDRHHpost, LDRHpost, LDRQpost, LDRSBWpo...
   10332         807 :     O << "], ";
   10333         807 :     printOperand(MI, 3, STI, O);
   10334         807 :     return;
   10335             :     break;
   10336         227 :   case 56:
   10337             :     // MOVIv2i32, MOVIv2s_msl, MOVIv4i16, MOVIv4i32, MOVIv4s_msl, MOVIv8i16, ...
   10338         227 :     printShifter(MI, 2, STI, O);
   10339         227 :     return;
   10340             :     break;
   10341          16 :   case 57:
   10342             :     // PRFB_PRI, PRFD_PRI, PRFH_PRI, PRFW_PRI
   10343          16 :     O << ", mul vl]";
   10344          16 :     return;
   10345             :     break;
   10346           8 :   case 58:
   10347             :     // RDFFRS_PPz, RDFFR_PPz
   10348           8 :     O << "/z";
   10349           8 :     return;
   10350             :     break;
   10351           3 :   case 59:
   10352             :     // SHLLv16i8
   10353           3 :     O << ".16b, #8";
   10354           3 :     return;
   10355             :     break;
   10356           4 :   case 60:
   10357             :     // SHLLv2i32
   10358           4 :     O << ".2s, #32";
   10359           4 :     return;
   10360             :     break;
   10361           4 :   case 61:
   10362             :     // SHLLv4i16
   10363           4 :     O << ".4h, #16";
   10364           4 :     return;
   10365             :     break;
   10366           3 :   case 62:
   10367             :     // SHLLv4i32
   10368           3 :     O << ".4s, #32";
   10369           3 :     return;
   10370             :     break;
   10371           3 :   case 63:
   10372             :     // SHLLv8i16
   10373           3 :     O << ".8h, #16";
   10374           3 :     return;
   10375             :     break;
   10376           4 :   case 64:
   10377             :     // SHLLv8i8
   10378           4 :     O << ".8b, #8";
   10379           4 :     return;
   10380             :     break;
   10381           0 :   case 65:
   10382             :     // UMAX_ZI_H, UMIN_ZI_H
   10383           0 :     printImm(MI, 2, STI, O);
   10384           0 :     return;
   10385             :     break;
   10386             :   }
   10387             : 
   10388             : 
   10389             :   // Fragment 4 encoded into 7 bits for 87 unique commands.
   10390       27761 :   switch ((Bits >> 39) & 127) {
   10391           0 :   default: llvm_unreachable("Invalid command number.");
   10392          18 :   case 0:
   10393             :     // ABS_ZPmZ_B, CLS_ZPmZ_B, CLZ_ZPmZ_B, CNOT_ZPmZ_B, CNT_ZPmZ_B, NEG_ZPmZ_...
   10394          18 :     printSVERegOp<'b'>(MI, 3, STI, O);
   10395          18 :     return;
   10396             :     break;
   10397          90 :   case 1:
   10398             :     // ABS_ZPmZ_D, CLS_ZPmZ_D, CLZ_ZPmZ_D, CNOT_ZPmZ_D, CNT_ZPmZ_D, FABS_ZPmZ...
   10399          90 :     printSVERegOp<'d'>(MI, 3, STI, O);
   10400          90 :     break;
   10401             :   case 2:
   10402             :     // ABS_ZPmZ_H, ADD_ZZZ_H, CLS_ZPmZ_H, CLZ_ZPmZ_H, CNOT_ZPmZ_H, CNT_ZPmZ_H...
   10403             :     return;
   10404             :     break;
   10405          82 :   case 3:
   10406             :     // ABS_ZPmZ_S, CLS_ZPmZ_S, CLZ_ZPmZ_S, CNOT_ZPmZ_S, CNT_ZPmZ_S, FABS_ZPmZ...
   10407          82 :     printSVERegOp<'s'>(MI, 3, STI, O);
   10408          82 :     break;
   10409        6349 :   case 4:
   10410             :     // ADCSWr, ADCSXr, ADCWr, ADCXr, ADDPL_XXI, ADDSXrx64, ADDVL_XXI, ADDXrx6...
   10411        6349 :     printOperand(MI, 2, STI, O);
   10412        6349 :     break;
   10413        4932 :   case 5:
   10414             :     // ADDHNv2i64_v2i32, ADDHNv4i32_v4i16, ADDHNv8i16_v8i8, ADDPv16i8, ADDPv2...
   10415        4932 :     printVRegOperand(MI, 2, STI, O);
   10416        4932 :     break;
   10417        1401 :   case 6:
   10418             :     // ADDHNv2i64_v4i32, ADDHNv4i32_v8i16, ADDHNv8i16_v16i8, BITv16i8, BITv8i...
   10419        1401 :     printVRegOperand(MI, 3, STI, O);
   10420        1401 :     break;
   10421        3749 :   case 7:
   10422             :     // ADDSWri, ADDSXri, ADDWri, ADDXri, SUBSWri, SUBSXri, SUBWri, SUBXri
   10423        3749 :     printAddSubImm(MI, 2, STI, O);
   10424        3749 :     return;
   10425             :     break;
   10426         664 :   case 8:
   10427             :     // ADDSWrs, ADDSXrs, ADDWrs, ADDXrs, ANDSWrs, ANDSXrs, ANDWrs, ANDXrs, BI...
   10428         664 :     printShiftedRegister(MI, 2, STI, O);
   10429         664 :     return;
   10430             :     break;
   10431         270 :   case 9:
   10432             :     // ADDSWrx, ADDSXrx, ADDWrx, ADDXrx, SUBSWrx, SUBSXrx, SUBWrx, SUBXrx
   10433         270 :     printExtendedRegister(MI, 2, STI, O);
   10434         270 :     return;
   10435             :     break;
   10436          28 :   case 10:
   10437             :     // ADD_ZI_B, SQADD_ZI_B, SQSUB_ZI_B, SUBR_ZI_B, SUB_ZI_B, UQADD_ZI_B, UQS...
   10438          28 :     printImm8OptLsl<uint8_t>(MI, 2, STI, O);
   10439          28 :     return;
   10440             :     break;
   10441          56 :   case 11:
   10442             :     // ADD_ZI_D, SQADD_ZI_D, SQSUB_ZI_D, SUBR_ZI_D, SUB_ZI_D, UQADD_ZI_D, UQS...
   10443          56 :     printImm8OptLsl<uint64_t>(MI, 2, STI, O);
   10444          56 :     return;
   10445             :     break;
   10446          56 :   case 12:
   10447             :     // ADD_ZI_S, SQADD_ZI_S, SQSUB_ZI_S, SUBR_ZI_S, SUB_ZI_S, UQADD_ZI_S, UQS...
   10448          56 :     printImm8OptLsl<uint32_t>(MI, 2, STI, O);
   10449          56 :     return;
   10450             :     break;
   10451         256 :   case 13:
   10452             :     // ADD_ZPmZ_B, ADD_ZZZ_B, ANDS_PPzPP, AND_PPzPP, AND_ZPmZ_B, ASRD_ZPmI_B,...
   10453         256 :     printSVERegOp<'b'>(MI, 2, STI, O);
   10454         256 :     break;
   10455         266 :   case 14:
   10456             :     // ADD_ZPmZ_D, ADD_ZZZ_D, AND_ZPmZ_D, AND_ZZZ, ASRD_ZPmI_D, ASRR_ZPmZ_D, ...
   10457         266 :     printSVERegOp<'d'>(MI, 2, STI, O);
   10458         266 :     break;
   10459         208 :   case 15:
   10460             :     // ADD_ZPmZ_H, AND_ZPmZ_H, ASRD_ZPmI_H, ASRR_ZPmZ_H, ASR_WIDE_ZPmZ_H, ASR...
   10461         208 :     O << ", ";
   10462         208 :     break;
   10463         267 :   case 16:
   10464             :     // ADD_ZPmZ_S, ADD_ZZZ_S, AND_ZPmZ_S, ASRD_ZPmI_S, ASRR_ZPmZ_S, ASR_WIDE_...
   10465         267 :     printSVERegOp<'s'>(MI, 2, STI, O);
   10466         267 :     break;
   10467           4 :   case 17:
   10468             :     // ADR_LSL_ZZZ_D_0
   10469           4 :     printRegWithShiftExtend<false, 8, 'x', 'd'>(MI, 2, STI, O);
   10470             :     O << ']';
   10471             :     return;
   10472             :     break;
   10473           2 :   case 18:
   10474             :     // ADR_LSL_ZZZ_D_1
   10475           2 :     printRegWithShiftExtend<false, 16, 'x', 'd'>(MI, 2, STI, O);
   10476             :     O << ']';
   10477             :     return;
   10478             :     break;
   10479           2 :   case 19:
   10480             :     // ADR_LSL_ZZZ_D_2
   10481           2 :     printRegWithShiftExtend<false, 32, 'x', 'd'>(MI, 2, STI, O);
   10482             :     O << ']';
   10483             :     return;
   10484             :     break;
   10485           2 :   case 20:
   10486             :     // ADR_LSL_ZZZ_D_3
   10487           2 :     printRegWithShiftExtend<false, 64, 'x', 'd'>(MI, 2, STI, O);
   10488             :     O << ']';
   10489             :     return;
   10490             :     break;
   10491           4 :   case 21:
   10492             :     // ADR_LSL_ZZZ_S_0
   10493           4 :     printRegWithShiftExtend<false, 8, 'x', 's'>(MI, 2, STI, O);
   10494             :     O << ']';
   10495             :     return;
   10496             :     break;
   10497           2 :   case 22:
   10498             :     // ADR_LSL_ZZZ_S_1
   10499           2 :     printRegWithShiftExtend<false, 16, 'x', 's'>(MI, 2, STI, O);
   10500             :     O << ']';
   10501             :     return;
   10502             :     break;
   10503           2 :   case 23:
   10504             :     // ADR_LSL_ZZZ_S_2
   10505           2 :     printRegWithShiftExtend<false, 32, 'x', 's'>(MI, 2, STI, O);
   10506             :     O << ']';
   10507             :     return;
   10508             :     break;
   10509           2 :   case 24:
   10510             :     // ADR_LSL_ZZZ_S_3
   10511           2 :     printRegWithShiftExtend<false, 64, 'x', 's'>(MI, 2, STI, O);
   10512             :     O << ']';
   10513             :     return;
   10514             :     break;
   10515           4 :   case 25:
   10516             :     // ADR_SXTW_ZZZ_D_0
   10517           4 :     printRegWithShiftExtend<true, 8, 'w', 'd'>(MI, 2, STI, O);
   10518             :     O << ']';
   10519             :     return;
   10520             :     break;
   10521           2 :   case 26:
   10522             :     // ADR_SXTW_ZZZ_D_1
   10523           2 :     printRegWithShiftExtend<true, 16, 'w', 'd'>(MI, 2, STI, O);
   10524             :     O << ']';
   10525             :     return;
   10526             :     break;
   10527           2 :   case 27:
   10528             :     // ADR_SXTW_ZZZ_D_2
   10529           2 :     printRegWithShiftExtend<true, 32, 'w', 'd'>(MI, 2, STI, O);
   10530             :     O << ']';
   10531             :     return;
   10532             :     break;
   10533           2 :   case 28:
   10534             :     // ADR_SXTW_ZZZ_D_3
   10535           2 :     printRegWithShiftExtend<true, 64, 'w', 'd'>(MI, 2, STI, O);
   10536             :     O << ']';
   10537             :     return;
   10538             :     break;
   10539           4 :   case 29:
   10540             :     // ADR_UXTW_ZZZ_D_0
   10541           4 :     printRegWithShiftExtend<false, 8, 'w', 'd'>(MI, 2, STI, O);
   10542             :     O << ']';
   10543             :     return;
   10544             :     break;
   10545           2 :   case 30:
   10546             :     // ADR_UXTW_ZZZ_D_1
   10547           2 :     printRegWithShiftExtend<false, 16, 'w', 'd'>(MI, 2, STI, O);
   10548             :     O << ']';
   10549             :     return;
   10550             :     break;
   10551           2 :   case 31:
   10552             :     // ADR_UXTW_ZZZ_D_2
   10553           2 :     printRegWithShiftExtend<false, 32, 'w', 'd'>(MI, 2, STI, O);
   10554             :     O << ']';
   10555             :     return;
   10556             :     break;
   10557           2 :   case 32:
   10558             :     // ADR_UXTW_ZZZ_D_3
   10559           2 :     printRegWithShiftExtend<false, 64, 'w', 'd'>(MI, 2, STI, O);
   10560             :     O << ']';
   10561             :     return;
   10562             :     break;
   10563         673 :   case 33:
   10564             :     // ANDSWri, ANDWri, EORWri, ORRWri
   10565         673 :     printLogicalImm<int32_t>(MI, 2, STI, O);
   10566         673 :     return;
   10567             :     break;
   10568         223 :   case 34:
   10569             :     // ANDSXri, ANDXri, AND_ZI, EORXri, EOR_ZI, ORRXri, ORR_ZI
   10570         223 :     printLogicalImm<int64_t>(MI, 2, STI, O);
   10571         223 :     return;
   10572             :     break;
   10573        2239 :   case 35:
   10574             :     // BFMWri, BFMXri, CASAB, CASAH, CASALB, CASALH, CASALW, CASALX, CASAW, C...
   10575        2239 :     printOperand(MI, 3, STI, O);
   10576        2239 :     break;
   10577           2 :   case 36:
   10578             :     // CNTP_XPP_H
   10579           2 :     printSVERegOp<'h'>(MI, 2, STI, O);
   10580           2 :     return;
   10581             :     break;
   10582           0 :   case 37:
   10583             :     // CPY_ZPmI_B
   10584           0 :     printImm8OptLsl<int8_t>(MI, 3, STI, O);
   10585           0 :     return;
   10586             :     break;
   10587           0 :   case 38:
   10588             :     // CPY_ZPmI_D
   10589           0 :     printImm8OptLsl<int64_t>(MI, 3, STI, O);
   10590           0 :     return;
   10591             :     break;
   10592           0 :   case 39:
   10593             :     // CPY_ZPmI_S
   10594           0 :     printImm8OptLsl<int32_t>(MI, 3, STI, O);
   10595           0 :     return;
   10596             :     break;
   10597           0 :   case 40:
   10598             :     // CPY_ZPzI_B
   10599           0 :     printImm8OptLsl<int8_t>(MI, 2, STI, O);
   10600           0 :     return;
   10601             :     break;
   10602           0 :   case 41:
   10603             :     // CPY_ZPzI_D
   10604           0 :     printImm8OptLsl<int64_t>(MI, 2, STI, O);
   10605           0 :     return;
   10606             :     break;
   10607           0 :   case 42:
   10608             :     // CPY_ZPzI_S
   10609           0 :     printImm8OptLsl<int32_t>(MI, 2, STI, O);
   10610           0 :     return;
   10611             :     break;
   10612        1240 :   case 43:
   10613             :     // CPYi16, CPYi32, CPYi64, CPYi8, DUPv16i8lane, DUPv2i32lane, DUPv2i64lan...
   10614        1240 :     printVectorIndex(MI, 2, STI, O);
   10615        1240 :     return;
   10616             :     break;
   10617          12 :   case 44:
   10618             :     // FCMEQ_PPzZ0_H, FCMGE_PPzZ0_H, FCMGT_PPzZ0_H, FCMLE_PPzZ0_H, FCMLT_PPzZ...
   10619          12 :     O << ", #0.0";
   10620          12 :     return;
   10621             :     break;
   10622           4 :   case 45:
   10623             :     // FCMLA_ZZZI_S, INSvi16lane, INSvi32lane, INSvi64lane, INSvi8lane
   10624           4 :     printVectorIndex(MI, 4, STI, O);
   10625           4 :     break;
   10626           0 :   case 46:
   10627             :     // FCPY_ZPmI_D, FCPY_ZPmI_S
   10628           0 :     printFPImmOperand(MI, 3, STI, O);
   10629           0 :     return;
   10630             :     break;
   10631          12 :   case 47:
   10632             :     // FCVTZS_ZPmZ_HtoD, FCVTZS_ZPmZ_HtoS, FCVTZU_ZPmZ_HtoD, FCVTZU_ZPmZ_HtoS...
   10633          12 :     printSVERegOp<'h'>(MI, 3, STI, O);
   10634          12 :     return;
   10635             :     break;
   10636           4 :   case 48:
   10637             :     // FMUL_ZZZI_H
   10638           4 :     printVectorIndex(MI, 3, STI, O);
   10639           4 :     return;
   10640             :     break;
   10641             :   case 49:
   10642             :     // GLD1B_D_IMM_REAL, GLD1B_S_IMM_REAL, GLD1SB_D_IMM_REAL, GLD1SB_S_IMM_RE...
   10643             :     O << ']';
   10644             :     return;
   10645             :     break;
   10646          36 :   case 50:
   10647             :     // GLD1B_D_REAL, GLD1D_REAL, GLD1H_D_REAL, GLD1SB_D_REAL, GLD1SH_D_REAL, ...
   10648          36 :     printRegWithShiftExtend<false, 8, 'x', 'd'>(MI, 3, STI, O);
   10649             :     O << ']';
   10650             :     return;
   10651             :     break;
   10652          36 :   case 51:
   10653             :     // GLD1B_D_SXTW_REAL, GLD1D_SXTW_REAL, GLD1H_D_SXTW_REAL, GLD1SB_D_SXTW_R...
   10654          36 :     printRegWithShiftExtend<true, 8, 'w', 'd'>(MI, 3, STI, O);
   10655             :     O << ']';
   10656             :     return;
   10657             :     break;
   10658          36 :   case 52:
   10659             :     // GLD1B_D_UXTW_REAL, GLD1D_UXTW_REAL, GLD1H_D_UXTW_REAL, GLD1SB_D_UXTW_R...
   10660          36 :     printRegWithShiftExtend<false, 8, 'w', 'd'>(MI, 3, STI, O);
   10661             :     O << ']';
   10662             :     return;
   10663             :     break;
   10664          26 :   case 53:
   10665             :     // GLD1B_S_SXTW_REAL, GLD1H_S_SXTW_REAL, GLD1SB_S_SXTW_REAL, GLD1SH_S_SXT...
   10666          26 :     printRegWithShiftExtend<true, 8, 'w', 's'>(MI, 3, STI, O);
   10667             :     O << ']';
   10668             :     return;
   10669             :     break;
   10670          26 :   case 54:
   10671             :     // GLD1B_S_UXTW_REAL, GLD1H_S_UXTW_REAL, GLD1SB_S_UXTW_REAL, GLD1SH_S_UXT...
   10672          26 :     printRegWithShiftExtend<false, 8, 'w', 's'>(MI, 3, STI, O);
   10673             :     O << ']';
   10674             :     return;
   10675             :     break;
   10676           6 :   case 55:
   10677             :     // GLD1D_SCALED_REAL, GLDFF1D_SCALED_REAL, SST1D_SCALED
   10678           6 :     printRegWithShiftExtend<false, 64, 'x', 'd'>(MI, 3, STI, O);
   10679             :     O << ']';
   10680             :     return;
   10681             :     break;
   10682           6 :   case 56:
   10683             :     // GLD1D_SXTW_SCALED_REAL, GLDFF1D_SXTW_SCALED_REAL, SST1D_SXTW_SCALED
   10684           6 :     printRegWithShiftExtend<true, 64, 'w', 'd'>(MI, 3, STI, O);
   10685             :     O << ']';
   10686             :     return;
   10687             :     break;
   10688           6 :   case 57:
   10689             :     // GLD1D_UXTW_SCALED_REAL, GLDFF1D_UXTW_SCALED_REAL, SST1D_UXTW_SCALED
   10690           6 :     printRegWithShiftExtend<false, 64, 'w', 'd'>(MI, 3, STI, O);
   10691             :     O << ']';
   10692             :     return;
   10693             :     break;
   10694          10 :   case 58:
   10695             :     // GLD1H_D_SCALED_REAL, GLD1SH_D_SCALED_REAL, GLDFF1H_D_SCALED_REAL, GLDF...
   10696          10 :     printRegWithShiftExtend<false, 16, 'x', 'd'>(MI, 3, STI, O);
   10697             :     O << ']';
   10698             :     return;
   10699             :     break;
   10700          10 :   case 59:
   10701             :     // GLD1H_D_SXTW_SCALED_REAL, GLD1SH_D_SXTW_SCALED_REAL, GLDFF1H_D_SXTW_SC...
   10702          10 :     printRegWithShiftExtend<true, 16, 'w', 'd'>(MI, 3, STI, O);
   10703             :     O << ']';
   10704             :     return;
   10705             :     break;
   10706          10 :   case 60:
   10707             :     // GLD1H_D_UXTW_SCALED_REAL, GLD1SH_D_UXTW_SCALED_REAL, GLDFF1H_D_UXTW_SC...
   10708          10 :     printRegWithShiftExtend<false, 16, 'w', 'd'>(MI, 3, STI, O);
   10709             :     O << ']';
   10710             :     return;
   10711             :     break;
   10712          10 :   case 61:
   10713             :     // GLD1H_S_SXTW_SCALED_REAL, GLD1SH_S_SXTW_SCALED_REAL, GLDFF1H_S_SXTW_SC...
   10714          10 :     printRegWithShiftExtend<true, 16, 'w', 's'>(MI, 3, STI, O);
   10715             :     O << ']';
   10716             :     return;
   10717             :     break;
   10718          10 :   case 62:
   10719             :     // GLD1H_S_UXTW_SCALED_REAL, GLD1SH_S_UXTW_SCALED_REAL, GLDFF1H_S_UXTW_SC...
   10720          10 :     printRegWithShiftExtend<false, 16, 'w', 's'>(MI, 3, STI, O);
   10721             :     O << ']';
   10722             :     return;
   10723             :     break;
   10724          10 :   case 63:
   10725             :     // GLD1SW_D_SCALED_REAL, GLD1W_D_SCALED_REAL, GLDFF1SW_D_SCALED_REAL, GLD...
   10726          10 :     printRegWithShiftExtend<false, 32, 'x', 'd'>(MI, 3, STI, O);
   10727             :     O << ']';
   10728             :     return;
   10729             :     break;
   10730          10 :   case 64:
   10731             :     // GLD1SW_D_SXTW_SCALED_REAL, GLD1W_D_SXTW_SCALED_REAL, GLDFF1SW_D_SXTW_S...
   10732          10 :     printRegWithShiftExtend<true, 32, 'w', 'd'>(MI, 3, STI, O);
   10733             :     O << ']';
   10734             :     return;
   10735             :     break;
   10736          10 :   case 65:
   10737             :     // GLD1SW_D_UXTW_SCALED_REAL, GLD1W_D_UXTW_SCALED_REAL, GLDFF1SW_D_UXTW_S...
   10738          10 :     printRegWithShiftExtend<false, 32, 'w', 'd'>(MI, 3, STI, O);
   10739             :     O << ']';
   10740             :     return;
   10741             :     break;
   10742           6 :   case 66:
   10743             :     // GLD1W_SXTW_SCALED_REAL, GLDFF1W_SXTW_SCALED_REAL, SST1W_SXTW_SCALED
   10744           6 :     printRegWithShiftExtend<true, 32, 'w', 's'>(MI, 3, STI, O);
   10745             :     O << ']';
   10746             :     return;
   10747             :     break;
   10748           6 :   case 67:
   10749             :     // GLD1W_UXTW_SCALED_REAL, GLDFF1W_UXTW_SCALED_REAL, SST1W_UXTW_SCALED
   10750           6 :     printRegWithShiftExtend<false, 32, 'w', 's'>(MI, 3, STI, O);
   10751             :     O << ']';
   10752             :     return;
   10753             :     break;
   10754             :   case 68:
   10755             :     // LD1B, LD1B_D, LD1B_H, LD1B_S, LD1RQ_B, LD1SB_D, LD1SB_H, LD1SB_S, LD2B...
   10756             :     printRegWithShiftExtend<false, 8, 'x', 0>(MI, 3, STI, O);
   10757             :     O << ']';
   10758             :     return;
   10759             :     break;
   10760          38 :   case 69:
   10761             :     // LD1D, LD1RQ_D, LD2D, LD3D, LD4D, LDFF1D_REAL, LDNT1D_ZRR, ST1D, ST2D, ...
   10762          38 :     printRegWithShiftExtend<false, 64, 'x', 0>(MI, 3, STI, O);
   10763             :     O << ']';
   10764             :     return;
   10765             :     break;
   10766          60 :   case 70:
   10767             :     // LD1H, LD1H_D, LD1H_S, LD1RQ_H, LD1SH_D, LD1SH_S, LD2H, LD3H, LD4H, LDF...
   10768          60 :     printRegWithShiftExtend<false, 16, 'x', 0>(MI, 3, STI, O);
   10769             :     O << ']';
   10770             :     return;
   10771             :     break;
   10772          10 :   case 71:
   10773             :     // LD1RD_IMM, LDRAAwriteback, LDRABwriteback
   10774          10 :     printImmScale<8>(MI, 3, STI, O);
   10775          10 :     break;
   10776          42 :   case 72:
   10777             :     // LD1RH_D_IMM, LD1RH_IMM, LD1RH_S_IMM, LD1RSH_D_IMM, LD1RSH_S_IMM, LD2B_...
   10778          42 :     printImmScale<2>(MI, 3, STI, O);
   10779          42 :     break;
   10780          24 :   case 73:
   10781             :     // LD1RQ_B_IMM, LD1RQ_D_IMM, LD1RQ_H_IMM, LD1RQ_W_IMM
   10782          24 :     printImmScale<16>(MI, 3, STI, O);
   10783             :     O << ']';
   10784             :     return;
   10785             :     break;
   10786          50 :   case 74:
   10787             :     // LD1RQ_W, LD1SW_D, LD1W, LD1W_D, LD2W, LD3W, LD4W, LDFF1SW_D_REAL, LDFF...
   10788          50 :     printRegWithShiftExtend<false, 32, 'x', 0>(MI, 3, STI, O);
   10789             :     O << ']';
   10790             :     return;
   10791             :     break;
   10792          38 :   case 75:
   10793             :     // LD1RSW_IMM, LD1RW_D_IMM, LD1RW_IMM, LD4B_IMM, LD4D_IMM, LD4H_IMM, LD4W...
   10794          38 :     printImmScale<4>(MI, 3, STI, O);
   10795          38 :     break;
   10796          32 :   case 76:
   10797             :     // LD3B_IMM, LD3D_IMM, LD3H_IMM, LD3W_IMM, ST3B_IMM, ST3D_IMM, ST3H_IMM, ...
   10798          32 :     printImmScale<3>(MI, 3, STI, O);
   10799          32 :     O << ", mul vl]";
   10800          32 :     return;
   10801             :     break;
   10802           8 :   case 77:
   10803             :     // LDRAAindexed, LDRABindexed
   10804           8 :     printImmScale<8>(MI, 2, STI, O);
   10805             :     O << ']';
   10806             :     return;
   10807             :     break;
   10808             :   case 78:
   10809             :     // LDRBBui, LDRBui, LDRSBWui, LDRSBXui, STRBBui, STRBui
   10810             :     printUImm12Offset<1>(MI, 2, STI, O);
   10811             :     O << ']';
   10812             :     return;
   10813             :     break;
   10814             :   case 79:
   10815             :     // LDRDui, LDRXui, PRFMui, STRDui, STRXui
   10816             :     printUImm12Offset<8>(MI, 2, STI, O);
   10817             :     O << ']';
   10818             :     return;
   10819             :     break;
   10820             :   case 80:
   10821             :     // LDRHHui, LDRHui, LDRSHWui, LDRSHXui, STRHHui, STRHui
   10822             :     printUImm12Offset<2>(MI, 2, STI, O);
   10823             :     O << ']';
   10824             :     return;
   10825             :     break;
   10826             :   case 81:
   10827             :     // LDRQui, STRQui
   10828             :     printUImm12Offset<16>(MI, 2, STI, O);
   10829             :     O << ']';
   10830             :     return;
   10831             :     break;
   10832             :   case 82:
   10833             :     // LDRSWui, LDRSui, LDRWui, STRSui, STRWui
   10834             :     printUImm12Offset<4>(MI, 2, STI, O);
   10835             :     O << ']';
   10836             :     return;
   10837             :     break;
   10838          16 :   case 83:
   10839             :     // SQDECP_XPWd_B, SQDECP_XPWd_D, SQDECP_XPWd_H, SQDECP_XPWd_S, SQINCP_XPW...
   10840          16 :     printGPR64as32(MI, 2, STI, O);
   10841          16 :     return;
   10842             :     break;
   10843          13 :   case 84:
   10844             :     // SYSLxt
   10845          13 :     printSysCROperand(MI, 2, STI, O);
   10846          13 :     O << ", ";
   10847          13 :     printSysCROperand(MI, 3, STI, O);
   10848          13 :     O << ", ";
   10849          13 :     printOperand(MI, 4, STI, O);
   10850          13 :     return;
   10851             :     break;
   10852         138 :   case 85:
   10853             :     // TBNZW, TBNZX, TBZW, TBZX
   10854         138 :     printAlignedLabel(MI, 2, STI, O);
   10855         138 :     return;
   10856             :     break;
   10857          32 :   case 86:
   10858             :     // UMAX_ZI_B, UMAX_ZI_D, UMAX_ZI_S, UMIN_ZI_B, UMIN_ZI_D, UMIN_ZI_S
   10859          32 :     printImm(MI, 2, STI, O);
   10860          32 :     return;
   10861             :     break;
   10862             :   }
   10863             : 
   10864             : 
   10865             :   // Fragment 5 encoded into 6 bits for 36 unique commands.
   10866       16184 :   switch ((Bits >> 46) & 63) {
   10867           0 :   default: llvm_unreachable("Invalid command number.");
   10868             :   case 0:
   10869             :     // ABS_ZPmZ_D, ABS_ZPmZ_S, ADCSWr, ADCSXr, ADCWr, ADCXr, ADDPL_XXI, ADDVL...
   10870             :     return;
   10871             :     break;
   10872         500 :   case 1:
   10873             :     // ADDHNv2i64_v2i32, ADDHNv2i64_v4i32, ADDPv2i64, ADDv2i64, CMEQv2i64, CM...
   10874         500 :     O << ".2d";
   10875         500 :     return;
   10876             :     break;
   10877        1230 :   case 2:
   10878             :     // ADDHNv4i32_v4i16, ADDHNv4i32_v8i16, ADDPv4i32, ADDv4i32, CMEQv4i32, CM...
   10879        1230 :     O << ".4s";
   10880        1230 :     return;
   10881             :     break;
   10882         521 :   case 3:
   10883             :     // ADDHNv8i16_v16i8, ADDHNv8i16_v8i8, ADDPv8i16, ADDv8i16, CMEQv8i16, CMG...
   10884         521 :     O << ".8h";
   10885         521 :     return;
   10886             :     break;
   10887         594 :   case 4:
   10888             :     // ADDPv16i8, ADDv16i8, ANDv16i8, BICv16i8, BIFv16i8, BITv16i8, BSLv16i8,...
   10889         594 :     O << ".16b";
   10890         594 :     return;
   10891             :     break;
   10892         610 :   case 5:
   10893             :     // ADDPv2i32, ADDv2i32, CMEQv2i32, CMGEv2i32, CMGTv2i32, CMHIv2i32, CMHSv...
   10894         610 :     O << ".2s";
   10895         610 :     return;
   10896             :     break;
   10897         480 :   case 6:
   10898             :     // ADDPv4i16, ADDv4i16, CMEQv4i16, CMGEv4i16, CMGTv4i16, CMHIv4i16, CMHSv...
   10899         480 :     O << ".4h";
   10900         480 :     return;
   10901             :     break;
   10902         546 :   case 7:
   10903             :     // ADDPv8i8, ADDv8i8, ANDv8i8, BICv8i8, BIFv8i8, BITv8i8, BSLv8i8, CMEQv8...
   10904         546 :     O << ".8b";
   10905         546 :     return;
   10906             :     break;
   10907          16 :   case 8:
   10908             :     // ADDSXrx64, ADDXrx64, SUBSXrx64, SUBXrx64
   10909          16 :     printArithExtend(MI, 3, STI, O);
   10910          16 :     return;
   10911             :     break;
   10912        3750 :   case 9:
   10913             :     // ADD_ZPmZ_B, ADD_ZPmZ_D, ADD_ZPmZ_S, ANDS_PPzPP, AND_PPzPP, AND_ZPmZ_B,...
   10914        3750 :     O << ", ";
   10915        3750 :     break;
   10916          98 :   case 10:
   10917             :     // ADD_ZPmZ_H, AND_ZPmZ_H, ASRR_ZPmZ_H, ASR_ZPmZ_H, BIC_ZPmZ_H, CMPEQ_PPz...
   10918          98 :     printSVERegOp<'h'>(MI, 3, STI, O);
   10919          98 :     break;
   10920          40 :   case 11:
   10921             :     // ASRD_ZPmI_H, ASR_ZPmI_H, CMPEQ_PPzZI_H, CMPGE_PPzZI_H, CMPGT_PPzZI_H, ...
   10922          40 :     printOperand(MI, 3, STI, O);
   10923          40 :     return;
   10924             :     break;
   10925          26 :   case 12:
   10926             :     // ASR_WIDE_ZPmZ_H, CMPEQ_WIDE_PPzZZ_H, CMPGE_WIDE_PPzZZ_H, CMPGT_WIDE_PP...
   10927          26 :     printSVERegOp<'d'>(MI, 3, STI, O);
   10928          26 :     return;
   10929             :     break;
   10930             :   case 13:
   10931             :     // CASAB, CASAH, CASALB, CASALH, CASALW, CASALX, CASAW, CASAX, CASB, CASH...
   10932             :     O << ']';
   10933             :     return;
   10934             :     break;
   10935          16 :   case 14:
   10936             :     // CMPHI_PPzZI_H, CMPHS_PPzZI_H, CMPLO_PPzZI_H, CMPLS_PPzZI_H
   10937          16 :     printImm(MI, 3, STI, O);
   10938          16 :     return;
   10939             :     break;
   10940         431 :   case 15:
   10941             :     // EXTv16i8
   10942         431 :     O << ".16b, ";
   10943         431 :     printOperand(MI, 3, STI, O);
   10944         431 :     return;
   10945             :     break;
   10946          41 :   case 16:
   10947             :     // EXTv8i8
   10948          41 :     O << ".8b, ";
   10949          41 :     printOperand(MI, 3, STI, O);
   10950          41 :     return;
   10951             :     break;
   10952           8 :   case 17:
   10953             :     // FADD_ZPmI_H
   10954           8 :     printExactFPImm<AArch64ExactFPImm::half, AArch64ExactFPImm::one>(MI, 3, STI, O);
   10955           8 :     return;
   10956             :     break;
   10957          32 :   case 18:
   10958             :     // FCADDv2f32, FCMLAv2f32
   10959          32 :     O << ".2s, ";
   10960          32 :     break;
   10961           8 :   case 19:
   10962             :     // FCADDv2f64, FCMLAv2f64
   10963           8 :     O << ".2d, ";
   10964           8 :     break;
   10965           4 :   case 20:
   10966             :     // FCADDv4f16, FCMLAv4f16
   10967           4 :     O << ".4h, ";
   10968           4 :     break;
   10969           8 :   case 21:
   10970             :     // FCADDv4f32, FCMLAv4f32
   10971           8 :     O << ".4s, ";
   10972           8 :     break;
   10973           4 :   case 22:
   10974             :     // FCADDv8f16, FCMLAv8f16
   10975           4 :     O << ".8h, ";
   10976           4 :     break;
   10977          24 :   case 23:
   10978             :     // FCMEQ_PPzZ0_D, FCMEQ_PPzZ0_S, FCMGE_PPzZ0_D, FCMGE_PPzZ0_S, FCMGT_PPzZ...
   10979          24 :     O << ", #0.0";
   10980          24 :     return;
   10981             :     break;
   10982           8 :   case 24:
   10983             :     // FCMLA_ZPmZZ_H
   10984           8 :     printSVERegOp<'h'>(MI, 4, STI, O);
   10985           8 :     O << ", ";
   10986           8 :     printComplexRotationOp<90, 0>(MI, 5, STI, O);
   10987           8 :     return;
   10988             :     break;
   10989         534 :   case 25:
   10990             :     // FCMLAv4f16_indexed, FCMLAv8f16_indexed, FMLAv1i16_indexed, FMLAv4i16_i...
   10991         534 :     O << ".h";
   10992         534 :     break;
   10993         668 :   case 26:
   10994             :     // FCMLAv4f32_indexed, FMLAv1i32_indexed, FMLAv2i32_indexed, FMLAv4i32_in...
   10995         668 :     O << ".s";
   10996         668 :     break;
   10997           6 :   case 27:
   10998             :     // FMAX_ZPmI_H
   10999           6 :     printExactFPImm<AArch64ExactFPImm::zero, AArch64ExactFPImm::one>(MI, 3, STI, O);
   11000           6 :     return;
   11001             :     break;
   11002          84 :   case 28:
   11003             :     // FMLAv1i64_indexed, FMLAv2i64_indexed, FMLSv1i64_indexed, FMLSv2i64_ind...
   11004          84 :     O << ".d";
   11005          84 :     break;
   11006           6 :   case 29:
   11007             :     // FMUL_ZPmI_H
   11008           6 :     printExactFPImm<AArch64ExactFPImm::half, AArch64ExactFPImm::two>(MI, 3, STI, O);
   11009           6 :     return;
   11010             :     break;
   11011           8 :   case 30:
   11012             :     // FMUL_ZZZI_D, FMUL_ZZZI_S
   11013           8 :     printVectorIndex(MI, 3, STI, O);
   11014           8 :     return;
   11015             :     break;
   11016         264 :   case 31:
   11017             :     // LD1B_D_IMM_REAL, LD1B_H_IMM_REAL, LD1B_IMM_REAL, LD1B_S_IMM_REAL, LD1D...
   11018         264 :     O << ", mul vl]";
   11019         264 :     return;
   11020             :     break;
   11021         359 :   case 32:
   11022             :     // LDPDpost, LDPQpost, LDPSWpost, LDPSpost, LDPWpost, LDPXpost, STPDpost,...
   11023         359 :     O << "], ";
   11024         359 :     break;
   11025         830 :   case 33:
   11026             :     // LDRAAwriteback, LDRABwriteback, LDRBBpre, LDRBpre, LDRDpre, LDRHHpre, ...
   11027         830 :     O << "]!";
   11028         830 :     return;
   11029             :     break;
   11030          38 :   case 34:
   11031             :     // SDOTlanev16i8, SDOTlanev8i8, UDOTlanev16i8, UDOTlanev8i8
   11032          38 :     O << ".4b";
   11033          38 :     printVectorIndex(MI, 4, STI, O);
   11034          38 :     return;
   11035             :     break;
   11036          47 :   case 35:
   11037             :     // STLXPW, STLXPX, STXPW, STXPX
   11038          47 :     O << ", [";
   11039          47 :     printOperand(MI, 3, STI, O);
   11040             :     O << ']';
   11041             :     return;
   11042             :     break;
   11043             :   }
   11044             : 
   11045             : 
   11046             :   // Fragment 6 encoded into 6 bits for 35 unique commands.
   11047        5549 :   switch ((Bits >> 52) & 63) {
   11048           0 :   default: llvm_unreachable("Invalid command number.");
   11049         116 :   case 0:
   11050             :     // ADD_ZPmZ_B, ANDS_PPzPP, AND_PPzPP, AND_ZPmZ_B, ASRR_ZPmZ_B, ASR_ZPmZ_B...
   11051         116 :     printSVERegOp<'b'>(MI, 3, STI, O);
   11052         116 :     return;
   11053             :     break;
   11054         150 :   case 1:
   11055             :     // ADD_ZPmZ_D, AND_ZPmZ_D, ASRR_ZPmZ_D, ASR_WIDE_ZPmZ_B, ASR_WIDE_ZPmZ_S,...
   11056         150 :     printSVERegOp<'d'>(MI, 3, STI, O);
   11057         150 :     break;
   11058             :   case 2:
   11059             :     // ADD_ZPmZ_H, AND_ZPmZ_H, ASRR_ZPmZ_H, ASR_ZPmZ_H, BIC_ZPmZ_H, CMPEQ_PPz...
   11060             :     return;
   11061             :     break;
   11062          98 :   case 3:
   11063             :     // ADD_ZPmZ_S, AND_ZPmZ_S, ASRR_ZPmZ_S, ASR_ZPmZ_S, BIC_ZPmZ_S, CMPEQ_PPz...
   11064          98 :     printSVERegOp<'s'>(MI, 3, STI, O);
   11065          98 :     break;
   11066         814 :   case 4:
   11067             :     // ASRD_ZPmI_B, ASRD_ZPmI_D, ASRD_ZPmI_S, ASR_ZPmI_B, ASR_ZPmI_D, ASR_ZPm...
   11068         814 :     printOperand(MI, 3, STI, O);
   11069         814 :     return;
   11070             :     break;
   11071           0 :   case 5:
   11072             :     // BFMWri, BFMXri
   11073           0 :     printOperand(MI, 4, STI, O);
   11074           0 :     return;
   11075             :     break;
   11076         694 :   case 6:
   11077             :     // CCMNWi, CCMNWr, CCMNXi, CCMNXr, CCMPWi, CCMPWr, CCMPXi, CCMPXr, CSELWr...
   11078         694 :     printCondCode(MI, 3, STI, O);
   11079         694 :     return;
   11080             :     break;
   11081          48 :   case 7:
   11082             :     // CMPHI_PPzZI_B, CMPHI_PPzZI_D, CMPHI_PPzZI_S, CMPHS_PPzZI_B, CMPHS_PPzZ...
   11083          48 :     printImm(MI, 3, STI, O);
   11084          48 :     return;
   11085             :     break;
   11086           8 :   case 8:
   11087             :     // FADD_ZPmI_D, FADD_ZPmI_S
   11088           8 :     printExactFPImm<AArch64ExactFPImm::half, AArch64ExactFPImm::one>(MI, 3, STI, O);
   11089           8 :     return;
   11090             :     break;
   11091           4 :   case 9:
   11092             :     // FCADD_ZPmZ_H
   11093           4 :     O << ", ";
   11094           4 :     printComplexRotationOp<180, 90>(MI, 4, STI, O);
   11095           4 :     return;
   11096             :     break;
   11097          24 :   case 10:
   11098             :     // FCADDv2f32, FCADDv2f64, FCADDv4f16, FCADDv4f32, FCADDv8f16
   11099          24 :     printComplexRotationOp<180, 90>(MI, 3, STI, O);
   11100          24 :     return;
   11101             :     break;
   11102           8 :   case 11:
   11103             :     // FCMLA_ZPmZZ_D
   11104           8 :     printSVERegOp<'d'>(MI, 4, STI, O);
   11105           8 :     O << ", ";
   11106           8 :     printComplexRotationOp<90, 0>(MI, 5, STI, O);
   11107           8 :     return;
   11108             :     break;
   11109           8 :   case 12:
   11110             :     // FCMLA_ZPmZZ_S
   11111           8 :     printSVERegOp<'s'>(MI, 4, STI, O);
   11112           8 :     O << ", ";
   11113           8 :     printComplexRotationOp<90, 0>(MI, 5, STI, O);
   11114           8 :     return;
   11115             :     break;
   11116           4 :   case 13:
   11117             :     // FCMLA_ZZZI_S
   11118           4 :     printComplexRotationOp<90, 0>(MI, 5, STI, O);
   11119           4 :     return;
   11120             :     break;
   11121          32 :   case 14:
   11122             :     // FCMLAv2f32, FCMLAv2f64, FCMLAv4f16, FCMLAv4f32, FCMLAv8f16
   11123          32 :     printComplexRotationOp<90, 0>(MI, 4, STI, O);
   11124          32 :     return;
   11125             :     break;
   11126         725 :   case 15:
   11127             :     // FCMLAv4f16_indexed, FCMLAv4f32_indexed, FCMLAv8f16_indexed, FMLAv1i16_...
   11128         725 :     printVectorIndex(MI, 4, STI, O);
   11129         725 :     break;
   11130           8 :   case 16:
   11131             :     // FMAX_ZPmI_D, FMAX_ZPmI_S
   11132           8 :     printExactFPImm<AArch64ExactFPImm::zero, AArch64ExactFPImm::one>(MI, 3, STI, O);
   11133           8 :     return;
   11134             :     break;
   11135         561 :   case 17:
   11136             :     // FMULXv1i16_indexed, FMULXv1i32_indexed, FMULXv1i64_indexed, FMULXv2i32...
   11137         561 :     printVectorIndex(MI, 3, STI, O);
   11138         561 :     return;
   11139             :     break;
   11140           8 :   case 18:
   11141             :     // FMUL_ZPmI_D, FMUL_ZPmI_S
   11142           8 :     printExactFPImm<AArch64ExactFPImm::half, AArch64ExactFPImm::two>(MI, 3, STI, O);
   11143           8 :     return;
   11144             :     break;
   11145         765 :   case 19:
   11146             :     // LDNPDi, LDNPXi, LDPDi, LDPXi, STNPDi, STNPXi, STPDi, STPXi
   11147         765 :     printImmScale<8>(MI, 3, STI, O);
   11148             :     O << ']';
   11149             :     return;
   11150             :     break;
   11151          87 :   case 20:
   11152             :     // LDNPQi, LDPQi, STNPQi, STPQi
   11153          87 :     printImmScale<16>(MI, 3, STI, O);
   11154             :     O << ']';
   11155             :     return;
   11156             :     break;
   11157         167 :   case 21:
   11158             :     // LDNPSi, LDNPWi, LDPSWi, LDPSi, LDPWi, STNPSi, STNPWi, STPSi, STPWi
   11159         167 :     printImmScale<4>(MI, 3, STI, O);
   11160             :     O << ']';
   11161             :     return;
   11162             :     break;
   11163         538 :   case 22:
   11164             :     // LDPDpost, LDPDpre, LDPXpost, LDPXpre, STPDpost, STPDpre, STPXpost, STP...
   11165         538 :     printImmScale<8>(MI, 4, STI, O);
   11166         538 :     break;
   11167          31 :   case 23:
   11168             :     // LDPQpost, LDPQpre, STPQpost, STPQpre
   11169          31 :     printImmScale<16>(MI, 4, STI, O);
   11170          31 :     break;
   11171         139 :   case 24:
   11172             :     // LDPSWpost, LDPSWpre, LDPSpost, LDPSpre, LDPWpost, LDPWpre, STPSpost, S...
   11173         139 :     printImmScale<4>(MI, 4, STI, O);
   11174         139 :     break;
   11175             :   case 25:
   11176             :     // LDRBBroW, LDRBroW, LDRSBWroW, LDRSBXroW, STRBBroW, STRBroW
   11177             :     printMemExtend<'w', 8>(MI, 3, STI, O);
   11178             :     O << ']';
   11179             :     return;
   11180             :     break;
   11181             :   case 26:
   11182             :     // LDRBBroX, LDRBroX, LDRSBWroX, LDRSBXroX, STRBBroX, STRBroX
   11183             :     printMemExtend<'x', 8>(MI, 3, STI, O);
   11184             :     O << ']';
   11185             :     return;
   11186             :     break;
   11187             :   case 27:
   11188             :     // LDRDroW, LDRXroW, PRFMroW, STRDroW, STRXroW
   11189             :     printMemExtend<'w', 64>(MI, 3, STI, O);
   11190             :     O << ']';
   11191             :     return;
   11192             :     break;
   11193             :   case 28:
   11194             :     // LDRDroX, LDRXroX, PRFMroX, STRDroX, STRXroX
   11195             :     printMemExtend<'x', 64>(MI, 3, STI, O);
   11196             :     O << ']';
   11197             :     return;
   11198             :     break;
   11199             :   case 29:
   11200             :     // LDRHHroW, LDRHroW, LDRSHWroW, LDRSHXroW, STRHHroW, STRHroW
   11201             :     printMemExtend<'w', 16>(MI, 3, STI, O);
   11202             :     O << ']';
   11203             :     return;
   11204             :     break;
   11205             :   case 30:
   11206             :     // LDRHHroX, LDRHroX, LDRSHWroX, LDRSHXroX, STRHHroX, STRHroX
   11207             :     printMemExtend<'x', 16>(MI, 3, STI, O);
   11208             :     O << ']';
   11209             :     return;
   11210             :     break;
   11211             :   case 31:
   11212             :     // LDRQroW, STRQroW
   11213             :     printMemExtend<'w', 128>(MI, 3, STI, O);
   11214             :     O << ']';
   11215             :     return;
   11216             :     break;
   11217             :   case 32:
   11218             :     // LDRQroX, STRQroX
   11219             :     printMemExtend<'x', 128>(MI, 3, STI, O);
   11220             :     O << ']';
   11221             :     return;
   11222             :     break;
   11223             :   case 33:
   11224             :     // LDRSWroW, LDRSroW, LDRWroW, STRSroW, STRWroW
   11225             :     printMemExtend<'w', 32>(MI, 3, STI, O);
   11226             :     O << ']';
   11227             :     return;
   11228             :     break;
   11229             :   case 34:
   11230             :     // LDRSWroX, LDRSroX, LDRWroX, STRSroX, STRWroX
   11231             :     printMemExtend<'x', 32>(MI, 3, STI, O);
   11232             :     O << ']';
   11233             :     return;
   11234             :     break;
   11235             :   }
   11236             : 
   11237             : 
   11238             :   // Fragment 7 encoded into 2 bits for 3 unique commands.
   11239        1681 :   switch ((Bits >> 58) & 3) {
   11240           0 :   default: llvm_unreachable("Invalid command number.");
   11241             :   case 0:
   11242             :     // ADD_ZPmZ_D, ADD_ZPmZ_S, AND_ZPmZ_D, AND_ZPmZ_S, ASRR_ZPmZ_D, ASRR_ZPmZ...
   11243             :     return;
   11244             :     break;
   11245          36 :   case 1:
   11246             :     // FCADD_ZPmZ_D, FCADD_ZPmZ_S, FCMLAv4f16_indexed, FCMLAv4f32_indexed, FC...
   11247          36 :     O << ", ";
   11248             :     break;
   11249         349 :   case 2:
   11250             :     // LDPDpre, LDPQpre, LDPSWpre, LDPSpre, LDPWpre, LDPXpre, STPDpre, STPQpr...
   11251         349 :     O << "]!";
   11252         349 :     return;
   11253             :     break;
   11254             :   }
   11255             : 
   11256             : 
   11257             :   // Fragment 8 encoded into 1 bits for 2 unique commands.
   11258          36 :   if ((Bits >> 60) & 1) {
   11259             :     // FCMLAv4f16_indexed, FCMLAv4f32_indexed, FCMLAv8f16_indexed
   11260          28 :     printComplexRotationOp<90, 0>(MI, 5, STI, O);
   11261          28 :     return;
   11262             :   } else {
   11263             :     // FCADD_ZPmZ_D, FCADD_ZPmZ_S
   11264           8 :     printComplexRotationOp<180, 90>(MI, 4, STI, O);
   11265           8 :     return;
   11266             :   }
   11267             : 
   11268             : }
   11269             : 
   11270             : 
   11271             : /// getRegisterName - This method is automatically generated by tblgen
   11272             : /// from the register set description.  This returns the assembler name
   11273             : /// for the specified register.
   11274      189271 : const char *AArch64InstPrinter::
   11275             : getRegisterName(unsigned RegNo, unsigned AltIdx) {
   11276             :   assert(RegNo && RegNo < 661 && "Invalid register number!");
   11277             : 
   11278             :   static const char AsmStrsNoRegAltName[] = {
   11279             :   /* 0 */ 'D', '7', '_', 'D', '8', '_', 'D', '9', '_', 'D', '1', '0', 0,
   11280             :   /* 13 */ 'Q', '7', '_', 'Q', '8', '_', 'Q', '9', '_', 'Q', '1', '0', 0,
   11281             :   /* 26 */ 'W', '9', '_', 'W', '1', '0', 0,
   11282             :   /* 33 */ 'X', '9', '_', 'X', '1', '0', 0,
   11283             :   /* 40 */ 'Z', '7', '_', 'Z', '8', '_', 'Z', '9', '_', 'Z', '1', '0', 0,
   11284             :   /* 53 */ 'b', '1', '0', 0,
   11285             :   /* 57 */ 'd', '1', '0', 0,
   11286             :   /* 61 */ 'h', '1', '0', 0,
   11287             :   /* 65 */ 'p', '1', '0', 0,
   11288             :   /* 69 */ 'q', '1', '0', 0,
   11289             :   /* 73 */ 's', '1', '0', 0,
   11290             :   /* 77 */ 'w', '1', '0', 0,
   11291             :   /* 81 */ 'x', '1', '0', 0,
   11292             :   /* 85 */ 'z', '1', '0', 0,
   11293             :   /* 89 */ 'D', '1', '7', '_', 'D', '1', '8', '_', 'D', '1', '9', '_', 'D', '2', '0', 0,
   11294             :   /* 105 */ 'Q', '1', '7', '_', 'Q', '1', '8', '_', 'Q', '1', '9', '_', 'Q', '2', '0', 0,
   11295             :   /* 121 */ 'W', '1', '9', '_', 'W', '2', '0', 0,
   11296             :   /* 129 */ 'X', '1', '9', '_', 'X', '2', '0', 0,
   11297             :   /* 137 */ 'Z', '1', '7', '_', 'Z', '1', '8', '_', 'Z', '1', '9', '_', 'Z', '2', '0', 0,
   11298             :   /* 153 */ 'b', '2', '0', 0,
   11299             :   /* 157 */ 'd', '2', '0', 0,
   11300             :   /* 161 */ 'h', '2', '0', 0,
   11301             :   /* 165 */ 'q', '2', '0', 0,
   11302             :   /* 169 */ 's', '2', '0', 0,
   11303             :   /* 173 */ 'w', '2', '0', 0,
   11304             :   /* 177 */ 'x', '2', '0', 0,
   11305             :   /* 181 */ 'z', '2', '0', 0,
   11306             :   /* 185 */ 'D', '2', '7', '_', 'D', '2', '8', '_', 'D', '2', '9', '_', 'D', '3', '0', 0,
   11307             :   /* 201 */ 'Q', '2', '7', '_', 'Q', '2', '8', '_', 'Q', '2', '9', '_', 'Q', '3', '0', 0,
   11308             :   /* 217 */ 'W', '2', '9', '_', 'W', '3', '0', 0,
   11309             :   /* 225 */ 'Z', '2', '7', '_', 'Z', '2', '8', '_', 'Z', '2', '9', '_', 'Z', '3', '0', 0,
   11310             :   /* 241 */ 'b', '3', '0', 0,
   11311             :   /* 245 */ 'd', '3', '0', 0,
   11312             :   /* 249 */ 'h', '3', '0', 0,
   11313             :   /* 253 */ 'q', '3', '0', 0,
   11314             :   /* 257 */ 's', '3', '0', 0,
   11315             :   /* 261 */ 'w', '3', '0', 0,
   11316             :   /* 265 */ 'x', '3', '0', 0,
   11317             :   /* 269 */ 'z', '3', '0', 0,
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   11319             :   /* 288 */ 'Q', '2', '9', '_', 'Q', '3', '0', '_', 'Q', '3', '1', '_', 'Q', '0', 0,
   11320             :   /* 303 */ 'W', 'Z', 'R', '_', 'W', '0', 0,
   11321             :   /* 310 */ 'X', 'Z', 'R', '_', 'X', '0', 0,
   11322             :   /* 317 */ 'Z', '2', '9', '_', 'Z', '3', '0', '_', 'Z', '3', '1', '_', 'Z', '0', 0,
   11323             :   /* 332 */ 'b', '0', 0,
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   11326             :   /* 341 */ 'p', '0', 0,
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   11332             :   /* 359 */ 'D', '8', '_', 'D', '9', '_', 'D', '1', '0', '_', 'D', '1', '1', 0,
   11333             :   /* 373 */ 'Q', '8', '_', 'Q', '9', '_', 'Q', '1', '0', '_', 'Q', '1', '1', 0,
   11334             :   /* 387 */ 'W', '1', '0', '_', 'W', '1', '1', 0,
   11335             :   /* 395 */ 'X', '1', '0', '_', 'X', '1', '1', 0,
   11336             :   /* 403 */ 'Z', '8', '_', 'Z', '9', '_', 'Z', '1', '0', '_', 'Z', '1', '1', 0,
   11337             :   /* 417 */ 'b', '1', '1', 0,
   11338             :   /* 421 */ 'd', '1', '1', 0,
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   11342             :   /* 437 */ 's', '1', '1', 0,
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   11346             :   /* 453 */ 'D', '1', '8', '_', 'D', '1', '9', '_', 'D', '2', '0', '_', 'D', '2', '1', 0,
   11347             :   /* 469 */ 'Q', '1', '8', '_', 'Q', '1', '9', '_', 'Q', '2', '0', '_', 'Q', '2', '1', 0,
   11348             :   /* 485 */ 'W', '2', '0', '_', 'W', '2', '1', 0,
   11349             :   /* 493 */ 'X', '2', '0', '_', 'X', '2', '1', 0,
   11350             :   /* 501 */ 'Z', '1', '8', '_', 'Z', '1', '9', '_', 'Z', '2', '0', '_', 'Z', '2', '1', 0,
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   11401             :   /* 863 */ 'b', '2', '2', 0,
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   11403             :   /* 871 */ 'h', '2', '2', 0,
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   11405             :   /* 879 */ 's', '2', '2', 0,
   11406             :   /* 883 */ 'w', '2', '2', 0,
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   11410             :   /* 908 */ 'Q', '3', '1', '_', 'Q', '0', '_', 'Q', '1', '_', 'Q', '2', 0,
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   11414             :   /* 946 */ 'b', '2', 0,
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   11424             :   /* 989 */ 'Q', '1', '0', '_', 'Q', '1', '1', '_', 'Q', '1', '2', '_', 'Q', '1', '3', 0,
   11425             :   /* 1005 */ 'W', '1', '2', '_', 'W', '1', '3', 0,
   11426             :   /* 1013 */ 'X', '1', '2', '_', 'X', '1', '3', 0,
   11427             :   /* 1021 */ 'Z', '1', '0', '_', 'Z', '1', '1', '_', 'Z', '1', '2', '_', 'Z', '1', '3', 0,
   11428             :   /* 1037 */ 'b', '1', '3', 0,
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   11438             :   /* 1089 */ 'Q', '2', '0', '_', 'Q', '2', '1', '_', 'Q', '2', '2', '_', 'Q', '2', '3', 0,
   11439             :   /* 1105 */ 'W', '2', '2', '_', 'W', '2', '3', 0,
   11440             :   /* 1113 */ 'X', '2', '2', '_', 'X', '2', '3', 0,
   11441             :   /* 1121 */ 'Z', '2', '0', '_', 'Z', '2', '1', '_', 'Z', '2', '2', '_', 'Z', '2', '3', 0,
   11442             :   /* 1137 */ 'b', '2', '3', 0,
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   11451             :   /* 1181 */ 'Q', '0', '_', 'Q', '1', '_', 'Q', '2', '_', 'Q', '3', 0,
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   11454             :   /* 1205 */ 'Z', '0', '_', 'Z', '1', '_', 'Z', '2', '_', 'Z', '3', 0,
   11455             :   /* 1217 */ 'b', '3', 0,
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   11459             :   /* 1229 */ 'q', '3', 0,
   11460             :   /* 1232 */ 's', '3', 0,
   11461             :   /* 1235 */ 'w', '3', 0,
   11462             :   /* 1238 */ 'x', '3', 0,
   11463             :   /* 1241 */ 'z', '3', 0,
   11464             :   /* 1244 */ 'D', '1', '1', '_', 'D', '1', '2', '_', 'D', '1', '3', '_', 'D', '1', '4', 0,
   11465             :   /* 1260 */ 'Q', '1', '1', '_', 'Q', '1', '2', '_', 'Q', '1', '3', '_', 'Q', '1', '4', 0,
   11466             :   /* 1276 */ 'W', '1', '3', '_', 'W', '1', '4', 0,
   11467             :   /* 1284 */ 'X', '1', '3', '_', 'X', '1', '4', 0,
   11468             :   /* 1292 */ 'Z', '1', '1', '_', 'Z', '1', '2', '_', 'Z', '1', '3', '_', 'Z', '1', '4', 0,
   11469             :   /* 1308 */ 'b', '1', '4', 0,
   11470             :   /* 1312 */ 'd', '1', '4', 0,
   11471             :   /* 1316 */ 'h', '1', '4', 0,
   11472             :   /* 1320 */ 'p', '1', '4', 0,
   11473             :   /* 1324 */ 'q', '1', '4', 0,
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   11475             :   /* 1332 */ 'w', '1', '4', 0,
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   11478             :   /* 1344 */ 'D', '2', '1', '_', 'D', '2', '2', '_', 'D', '2', '3', '_', 'D', '2', '4', 0,
   11479             :   /* 1360 */ 'Q', '2', '1', '_', 'Q', '2', '2', '_', 'Q', '2', '3', '_', 'Q', '2', '4', 0,
   11480             :   /* 1376 */ 'W', '2', '3', '_', 'W', '2', '4', 0,
   11481             :   /* 1384 */ 'X', '2', '3', '_', 'X', '2', '4', 0,
   11482             :   /* 1392 */ 'Z', '2', '1', '_', 'Z', '2', '2', '_', 'Z', '2', '3', '_', 'Z', '2', '4', 0,
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   11492             :   /* 1452 */ 'Q', '1', '_', 'Q', '2', '_', 'Q', '3', '_', 'Q', '4', 0,
   11493             :   /* 1464 */ 'W', '3', '_', 'W', '4', 0,
   11494             :   /* 1470 */ 'X', '3', '_', 'X', '4', 0,
   11495             :   /* 1476 */ 'Z', '1', '_', 'Z', '2', '_', 'Z', '3', '_', 'Z', '4', 0,
   11496             :   /* 1488 */ 'b', '4', 0,
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   11498             :   /* 1494 */ 'h', '4', 0,
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   11500             :   /* 1500 */ 'q', '4', 0,
   11501             :   /* 1503 */ 's', '4', 0,
   11502             :   /* 1506 */ 'w', '4', 0,
   11503             :   /* 1509 */ 'x', '4', 0,
   11504             :   /* 1512 */ 'z', '4', 0,
   11505             :   /* 1515 */ 'D', '1', '2', '_', 'D', '1', '3', '_', 'D', '1', '4', '_', 'D', '1', '5', 0,
   11506             :   /* 1531 */ 'Q', '1', '2', '_', 'Q', '1', '3', '_', 'Q', '1', '4', '_', 'Q', '1', '5', 0,
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   11508             :   /* 1555 */ 'X', '1', '4', '_', 'X', '1', '5', 0,
   11509             :   /* 1563 */ 'Z', '1', '2', '_', 'Z', '1', '3', '_', 'Z', '1', '4', '_', 'Z', '1', '5', 0,
   11510             :   /* 1579 */ 'b', '1', '5', 0,
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   11547             :   /* 1802 */ 'Q', '1', '3', '_', 'Q', '1', '4', '_', 'Q', '1', '5', '_', 'Q', '1', '6', 0,
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   11560             :   /* 1898 */ 'Q', '2', '3', '_', 'Q', '2', '4', '_', 'Q', '2', '5', '_', 'Q', '2', '6', 0,
   11561             :   /* 1914 */ 'W', '2', '5', '_', 'W', '2', '6', 0,
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   11563             :   /* 1930 */ 'Z', '2', '3', '_', 'Z', '2', '4', '_', 'Z', '2', '5', '_', 'Z', '2', '6', 0,
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   11571             :   /* 1974 */ 'z', '2', '6', 0,
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   11573             :   /* 1990 */ 'Q', '3', '_', 'Q', '4', '_', 'Q', '5', '_', 'Q', '6', 0,
   11574             :   /* 2002 */ 'W', '5', '_', 'W', '6', 0,
   11575             :   /* 2008 */ 'X', '5', '_', 'X', '6', 0,
   11576             :   /* 2014 */ 'Z', '3', '_', 'Z', '4', '_', 'Z', '5', '_', 'Z', '6', 0,
   11577             :   /* 2026 */ 'b', '6', 0,
   11578             :   /* 2029 */ 'd', '6', 0,
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   11580             :   /* 2035 */ 'p', '6', 0,
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   11582             :   /* 2041 */ 's', '6', 0,
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   11584             :   /* 2047 */ 'x', '6', 0,
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   11586             :   /* 2053 */ 'D', '1', '4', '_', 'D', '1', '5', '_', 'D', '1', '6', '_', 'D', '1', '7', 0,
   11587             :   /* 2069 */ 'Q', '1', '4', '_', 'Q', '1', '5', '_', 'Q', '1', '6', '_', 'Q', '1', '7', 0,
   11588             :   /* 2085 */ 'W', '1', '6', '_', 'W', '1', '7', 0,
   11589             :   /* 2093 */ 'X', '1', '6', '_', 'X', '1', '7', 0,
   11590             :   /* 2101 */ 'Z', '1', '4', '_', 'Z', '1', '5', '_', 'Z', '1', '6', '_', 'Z', '1', '7', 0,
   11591             :   /* 2117 */ 'b', '1', '7', 0,
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   11593             :   /* 2125 */ 'h', '1', '7', 0,
   11594             :   /* 2129 */ 'q', '1', '7', 0,
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   11598             :   /* 2145 */ 'z', '1', '7', 0,
   11599             :   /* 2149 */ 'D', '2', '4', '_', 'D', '2', '5', '_', 'D', '2', '6', '_', 'D', '2', '7', 0,
   11600             :   /* 2165 */ 'Q', '2', '4', '_', 'Q', '2', '5', '_', 'Q', '2', '6', '_', 'Q', '2', '7', 0,
   11601             :   /* 2181 */ 'W', '2', '6', '_', 'W', '2', '7', 0,
   11602             :   /* 2189 */ 'X', '2', '6', '_', 'X', '2', '7', 0,
   11603             :   /* 2197 */ 'Z', '2', '4', '_', 'Z', '2', '5', '_', 'Z', '2', '6', '_', 'Z', '2', '7', 0,
   11604             :   /* 2213 */ 'b', '2', '7', 0,
   11605             :   /* 2217 */ 'd', '2', '7', 0,
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   11616             :   /* 2281 */ 'Z', '4', '_', 'Z', '5', '_', 'Z', '6', '_', 'Z', '7', 0,
   11617             :   /* 2293 */ 'b', '7', 0,
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   11625             :   /* 2317 */ 'z', '7', 0,
   11626             :   /* 2320 */ 'D', '1', '5', '_', 'D', '1', '6', '_', 'D', '1', '7', '_', 'D', '1', '8', 0,
   11627             :   /* 2336 */ 'Q', '1', '5', '_', 'Q', '1', '6', '_', 'Q', '1', '7', '_', 'Q', '1', '8', 0,
   11628             :   /* 2352 */ 'W', '1', '7', '_', 'W', '1', '8', 0,
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   11756             :     1954, 2221, 2488, 2747, 249, 605, 341, 684, 955, 1226, 1497, 1768, 2035, 2302, 
   11757             :     2569, 2828, 65, 429, 775, 1049, 1320, 1591, 344, 687, 958, 1229, 1500, 1771, 
   11758             :     2038, 2305, 2572, 2831, 69, 433, 779, 1053, 1324, 1595, 1862, 2129, 2396, 2663, 
   11759             :     165, 529, 875, 1149, 1420, 1691, 1958, 2225, 2492, 2751, 253, 609, 347, 690, 
   11760             :     961, 1232, 1503, 1774, 2041, 2308, 2575, 2834, 73, 437, 783, 1057, 1328, 1599, 
   11761             :     1866, 2133, 2400, 2667, 169, 533, 879, 1153, 1424, 1695, 1962, 2229, 2496, 2755, 
   11762             :     257, 613, 350, 693, 964, 1235, 1506, 1777, 2044, 2311, 2578, 2837, 77, 441, 
   11763             :     787, 1061, 1332, 1603, 1870, 2137, 2404, 2671, 173, 537, 883, 1157, 1428, 1699, 
   11764             :     1966, 2233, 2500, 2759, 261, 353, 696, 967, 1238, 1509, 1780, 2047, 2314, 2581, 
   11765             :     2840, 81, 445, 791, 1065, 1336, 1607, 1874, 2141, 2408, 2675, 177, 541, 887, 
   11766             :     1161, 1432, 1703, 1970, 2237, 2504, 356, 699, 970, 1241, 1512, 1783, 2050, 2317, 
   11767             :     2584, 2843, 85, 449, 795, 1069, 1340, 1611, 1878, 2145, 2412, 2679, 181, 545, 
   11768             :     891, 1165, 1436, 1707, 1974, 2241, 2508, 2767, 269, 617, 2895, 2922, 2942, 2962, 
   11769             :     2982, 3002, 3022, 3042, 3062, 3082, 2874, 2901, 2928, 2948, 2968, 2988, 3008, 3028, 
   11770             :     3048, 3068, 2881, 2908, 2935, 2955, 2975, 2995, 3015, 3035, 3055, 3075, 2888, 2915, 
   11771             :     629, 902, 1175, 1446, 1717, 1984, 2251, 2518, 2777, 6, 365, 709, 981, 1252, 
   11772             :     1523, 1794, 2061, 2328, 2595, 97, 461, 807, 1081, 1352, 1623, 1890, 2157, 2424, 
   11773             :     2691, 193, 557, 281, 1169, 1440, 1711, 1978, 2245, 2512, 2771, 0, 359, 702, 
   11774             :     973, 1244, 1515, 1786, 2053, 2320, 2587, 89, 453, 799, 1073, 1344, 1615, 1882, 
   11775             :     2149, 2416, 2683, 185, 549, 273, 621, 895, 899, 1172, 1443, 1714, 1981, 2248, 
   11776             :     2515, 2774, 3, 362, 705, 977, 1248, 1519, 1790, 2057, 2324, 2591, 93, 457, 
   11777             :     803, 1077, 1348, 1619, 1886, 2153, 2420, 2687, 189, 553, 277, 625, 643, 915, 
   11778             :     1187, 1458, 1729, 1996, 2263, 2530, 2789, 19, 379, 724, 997, 1268, 1539, 1810, 
   11779             :     2077, 2344, 2611, 113, 477, 823, 1097, 1368, 1639, 1906, 2173, 2440, 2707, 209, 
   11780             :     573, 296, 1181, 1452, 1723, 1990, 2257, 2524, 2783, 13, 373, 717, 989, 1260, 
   11781             :     1531, 1802, 2069, 2336, 2603, 105, 469, 815, 1089, 1360, 1631, 1898, 2165, 2432, 
   11782             :     2699, 201, 565, 288, 635, 908, 912, 1184, 1455, 1726, 1993, 2260, 2527, 2786, 
   11783             :     16, 376, 720, 993, 1264, 1535, 1806, 2073, 2340, 2607, 109, 473, 819, 1093, 
   11784             :     1364, 1635, 1902, 2169, 2436, 2703, 205, 569, 292, 639, 303, 2859, 649, 921, 
   11785             :     1193, 1464, 1735, 2002, 2269, 2536, 2795, 26, 387, 732, 1005, 1276, 1547, 1818, 
   11786             :     2085, 2352, 2619, 121, 485, 831, 1105, 1376, 1647, 1914, 2181, 2448, 2715, 217, 
   11787             :     2853, 2867, 310, 2846, 655, 927, 1199, 1470, 1741, 2008, 2275, 2542, 2801, 33, 
   11788             :     395, 740, 1013, 1284, 1555, 1826, 2093, 2360, 2627, 129, 493, 839, 1113, 1384, 
   11789             :     1655, 1922, 2189, 2456, 669, 940, 1211, 1482, 1753, 2020, 2287, 2554, 2813, 46, 
   11790             :     409, 755, 1029, 1300, 1571, 1842, 2109, 2376, 2643, 145, 509, 855, 1129, 1400, 
   11791             :     1671, 1938, 2205, 2472, 2731, 233, 589, 325, 1205, 1476, 1747, 2014, 2281, 2548, 
   11792             :     2807, 40, 403, 748, 1021, 1292, 1563, 1834, 2101, 2368, 2635, 137, 501, 847, 
   11793             :     1121, 1392, 1663, 1930, 2197, 2464, 2723, 225, 581, 317, 661, 933, 937, 1208, 
   11794             :     1479, 1750, 2017, 2284, 2551, 2810, 43, 406, 751, 1025, 1296, 1567, 1838, 2105, 
   11795             :     2372, 2639, 141, 505, 851, 1125, 1396, 1667, 1934, 2201, 2468, 2727, 229, 585, 
   11796             :     321, 665, 
   11797             :   };
   11798             : 
   11799             :   static const char AsmStrsvlist1[] = {
   11800             :   /* 0 */ 0,
   11801             :   };
   11802             : 
   11803             :   static const uint8_t RegAsmOffsetvlist1[] = {
   11804             :     0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 
   11805             :     0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 
   11806             :     0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 
   11807             :     0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 
   11808             :     0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 
   11809             :     0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 
   11810             :     0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 
   11811             :     0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 
   11812             :     0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 
   11813             :     0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 
   11814             :     0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 
   11815             :     0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 
   11816             :     0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 
   11817             :     0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 
   11818             :     0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 
   11819             :     0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 
   11820             :     0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 
   11821             :     0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 
   11822             :     0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 
   11823             :     0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 
   11824             :     0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 
   11825             :     0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 
   11826             :     0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 
   11827             :     0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 
   11828             :     0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 
   11829             :     0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 
   11830             :     0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 
   11831             :     0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 
   11832             :     0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 
   11833             :     0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 
   11834             :     0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 
   11835             :     0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 
   11836             :     0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 
   11837             :     0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 
   11838             :     0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 
   11839             :     0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 
   11840             :     0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 
   11841             :     0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 
   11842             :     0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 
   11843             :     0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 
   11844             :     0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 
   11845             :     0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 
   11846             :     0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 
   11847             :     0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 
   11848             :     0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 
   11849             :     0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 
   11850             :     0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 
   11851             :     0, 0, 
   11852             :   };
   11853             : 
   11854             :   static const char AsmStrsvreg[] = {
   11855             :   /* 0 */ 'v', '1', '0', 0,
   11856             :   /* 4 */ 'v', '2', '0', 0,
   11857             :   /* 8 */ 'v', '3', '0', 0,
   11858             :   /* 12 */ 'v', '0', 0,
   11859             :   /* 15 */ 'v', '1', '1', 0,
   11860             :   /* 19 */ 'v', '2', '1', 0,
   11861             :   /* 23 */ 'v', '3', '1', 0,
   11862             :   /* 27 */ 'v', '1', 0,
   11863             :   /* 30 */ 'v', '1', '2', 0,
   11864             :   /* 34 */ 'v', '2', '2', 0,
   11865             :   /* 38 */ 'v', '2', 0,
   11866             :   /* 41 */ 'v', '1', '3', 0,
   11867             :   /* 45 */ 'v', '2', '3', 0,
   11868             :   /* 49 */ 'v', '3', 0,
   11869             :   /* 52 */ 'v', '1', '4', 0,
   11870             :   /* 56 */ 'v', '2', '4', 0,
   11871             :   /* 60 */ 'v', '4', 0,
   11872             :   /* 63 */ 'v', '1', '5', 0,
   11873             :   /* 67 */ 'v', '2', '5', 0,
   11874             :   /* 71 */ 'v', '5', 0,
   11875             :   /* 74 */ 'v', '1', '6', 0,
   11876             :   /* 78 */ 'v', '2', '6', 0,
   11877             :   /* 82 */ 'v', '6', 0,
   11878             :   /* 85 */ 'v', '1', '7', 0,
   11879             :   /* 89 */ 'v', '2', '7', 0,
   11880             :   /* 93 */ 'v', '7', 0,
   11881             :   /* 96 */ 'v', '1', '8', 0,
   11882             :   /* 100 */ 'v', '2', '8', 0,
   11883             :   /* 104 */ 'v', '8', 0,
   11884             :   /* 107 */ 'v', '1', '9', 0,
   11885             :   /* 111 */ 'v', '2', '9', 0,
   11886             :   /* 115 */ 'v', '9', 0,
   11887             :   };
   11888             : 
   11889             :   static const uint8_t RegAsmOffsetvreg[] = {
   11890             :     3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 
   11891             :     3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 
   11892             :     3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 12, 27, 
   11893             :     38, 49, 60, 71, 82, 93, 104, 115, 0, 15, 30, 41, 52, 63, 
   11894             :     74, 85, 96, 107, 4, 19, 34, 45, 56, 67, 78, 89, 100, 111, 
   11895             :     8, 23, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 
   11896             :     3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 
   11897             :     3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 
   11898             :     3, 3, 3, 3, 3, 3, 3, 3, 12, 27, 38, 49, 60, 71, 
   11899             :     82, 93, 104, 115, 0, 15, 30, 41, 52, 63, 74, 85, 96, 107, 
   11900             :     4, 19, 34, 45, 56, 67, 78, 89, 100, 111, 8, 23, 3, 3, 
   11901             :     3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 
   11902             :     3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 
   11903             :     3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 
   11904             :     3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 
   11905             :     3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 
   11906             :     3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 
   11907             :     3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 
   11908             :     3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 
   11909             :     3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 
   11910             :     3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 
   11911             :     3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 
   11912             :     12, 27, 38, 49, 60, 71, 82, 93, 104, 115, 0, 15, 30, 41, 
   11913             :     52, 63, 74, 85, 96, 107, 4, 19, 34, 45, 56, 67, 78, 89, 
   11914             :     100, 111, 8, 23, 12, 27, 38, 49, 60, 71, 82, 93, 104, 115, 
   11915             :     0, 15, 30, 41, 52, 63, 74, 85, 96, 107, 4, 19, 34, 45, 
   11916             :     56, 67, 78, 89, 100, 111, 8, 23, 12, 27, 38, 49, 60, 71, 
   11917             :     82, 93, 104, 115, 0, 15, 30, 41, 52, 63, 74, 85, 96, 107, 
   11918             :     4, 19, 34, 45, 56, 67, 78, 89, 100, 111, 8, 23, 12, 27, 
   11919             :     38, 49, 60, 71, 82, 93, 104, 115, 0, 15, 30, 41, 52, 63, 
   11920             :     74, 85, 96, 107, 4, 19, 34, 45, 56, 67, 78, 89, 100, 111, 
   11921             :     8, 23, 12, 27, 38, 49, 60, 71, 82, 93, 104, 115, 0, 15, 
   11922             :     30, 41, 52, 63, 74, 85, 96, 107, 4, 19, 34, 45, 56, 67, 
   11923             :     78, 89, 100, 111, 8, 23, 12, 27, 38, 49, 60, 71, 82, 93, 
   11924             :     104, 115, 0, 15, 30, 41, 52, 63, 74, 85, 96, 107, 4, 19, 
   11925             :     34, 45, 56, 67, 78, 89, 100, 111, 8, 23, 3, 3, 3, 3, 
   11926             :     3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 
   11927             :     3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 
   11928             :     3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 
   11929             :     3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 
   11930             :     3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 
   11931             :     3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 
   11932             :     3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 
   11933             :     3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 
   11934             :     3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 
   11935             :     3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 
   11936             :     3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 
   11937             :     3, 3, 
   11938             :   };
   11939             : 
   11940      189271 :   switch(AltIdx) {
   11941           0 :   default: llvm_unreachable("Invalid register alt name index!");
   11942      141457 :   case AArch64::NoRegAltName:
   11943             :     assert(*(AsmStrsNoRegAltName+RegAsmOffsetNoRegAltName[RegNo-1]) &&
   11944             :            "Invalid alt name index for register!");
   11945      141457 :     return AsmStrsNoRegAltName+RegAsmOffsetNoRegAltName[RegNo-1];
   11946           0 :   case AArch64::vlist1:
   11947             :     assert(*(AsmStrsvlist1+RegAsmOffsetvlist1[RegNo-1]) &&
   11948             :            "Invalid alt name index for register!");
   11949           0 :     return AsmStrsvlist1+RegAsmOffsetvlist1[RegNo-1];
   11950       47814 :   case AArch64::vreg:
   11951             :     assert(*(AsmStrsvreg+RegAsmOffsetvreg[RegNo-1]) &&
   11952             :            "Invalid alt name index for register!");
   11953       47814 :     return AsmStrsvreg+RegAsmOffsetvreg[RegNo-1];
   11954             :   }
   11955             : }
   11956             : 
   11957             : #ifdef PRINT_ALIAS_INSTR
   11958             : #undef PRINT_ALIAS_INSTR
   11959             : 
   11960             : static bool AArch64InstPrinterValidateMCOperand(const MCOperand &MCOp,
   11961             :                   const MCSubtargetInfo &STI,
   11962             :                   unsigned PredicateIndex);
   11963       75505 : bool AArch64InstPrinter::printAliasInstr(const MCInst *MI, const MCSubtargetInfo &STI, raw_ostream &OS) {
   11964             :   const char *AsmString;
   11965       75505 :   switch (MI->getOpcode()) {
   11966             :   default: return false;
   11967             :   case AArch64::ADDSWri:
   11968          56 :     if (MI->getNumOperands() == 4 &&
   11969          85 :         MI->getOperand(0).getReg() == AArch64::WZR &&
   11970         114 :         MI->getOperand(1).isReg() &&
   11971          29 :         MRI.getRegClass(AArch64::GPR32spRegClassID).contains(MI->getOperand(1).getReg())) {
   11972             :       // (ADDSWri WZR, GPR32sp:$src, addsub_shifted_imm32:$imm)
   11973             :       AsmString = "cmn     $\x02, $\xFF\x03\x01";
   11974             :       break;
   11975             :     }
   11976             :     return false;
   11977             :   case AArch64::ADDSWrs:
   11978         155 :     if (MI->getNumOperands() == 4 &&
   11979         233 :         MI->getOperand(0).getReg() == AArch64::WZR &&
   11980         156 :         MI->getOperand(1).isReg() &&
   11981         156 :         MRI.getRegClass(AArch64::GPR32RegClassID).contains(MI->getOperand(1).getReg()) &&
   11982         156 :         MI->getOperand(2).isReg() &&
   11983         156 :         MRI.getRegClass(AArch64::GPR32RegClassID).contains(MI->getOperand(2).getReg()) &&
   11984         311 :         MI->getOperand(3).isImm() &&
   11985          78 :         MI->getOperand(3).getImm() == 0) {
   11986             :       // (ADDSWrs WZR, GPR32:$src1, GPR32:$src2, 0)
   11987             :       AsmString = "cmn     $\x02, $\x03";
   11988             :       break;
   11989             :     }
   11990         117 :     if (MI->getNumOperands() == 4 &&
   11991         157 :         MI->getOperand(0).getReg() == AArch64::WZR &&
   11992          80 :         MI->getOperand(1).isReg() &&
   11993          80 :         MRI.getRegClass(AArch64::GPR32RegClassID).contains(MI->getOperand(1).getReg()) &&
   11994         197 :         MI->getOperand(2).isReg() &&
   11995          40 :         MRI.getRegClass(AArch64::GPR32RegClassID).contains(MI->getOperand(2).getReg())) {
   11996             :       // (ADDSWrs WZR, GPR32:$src1, GPR32:$src2, arith_shift32:$sh)
   11997             :       AsmString = "cmn     $\x02, $\x03$\xFF\x04\x02";
   11998             :       break;
   11999             :     }
   12000          77 :     if (MI->getNumOperands() == 4 &&
   12001         154 :         MI->getOperand(0).isReg() &&
   12002         154 :         MRI.getRegClass(AArch64::GPR32RegClassID).contains(MI->getOperand(0).getReg()) &&
   12003         154 :         MI->getOperand(1).isReg() &&
   12004         154 :         MRI.getRegClass(AArch64::GPR32RegClassID).contains(MI->getOperand(1).getReg()) &&
   12005         154 :         MI->getOperand(2).isReg() &&
   12006         154 :         MRI.getRegClass(AArch64::GPR32RegClassID).contains(MI->getOperand(2).getReg()) &&
   12007         231 :         MI->getOperand(3).isImm() &&
   12008          77 :         MI->getOperand(3).getImm() == 0) {
   12009             :       // (ADDSWrs GPR32:$dst, GPR32:$src1, GPR32:$src2, 0)
   12010             :       AsmString = "adds    $\x01, $\x02, $\x03";
   12011             :       break;
   12012             :     }
   12013             :     return false;
   12014             :   case AArch64::ADDSWrx:
   12015          40 :     if (MI->getNumOperands() == 4 &&
   12016          53 :         MI->getOperand(0).getReg() == AArch64::WZR &&
   12017          18 :         MI->getOperand(1).isReg() &&
   12018          18 :         MRI.getRegClass(AArch64::GPR32sponlyRegClassID).contains(MI->getOperand(1).getReg()) &&
   12019          10 :         MI->getOperand(2).isReg() &&
   12020          10 :         MRI.getRegClass(AArch64::GPR32RegClassID).contains(MI->getOperand(2).getReg()) &&
   12021          50 :         MI->getOperand(3).isImm() &&
   12022           5 :         MI->getOperand(3).getImm() == 16) {
   12023             :       // (ADDSWrx WZR, GPR32sponly:$src1, GPR32:$src2, 16)
   12024             :       AsmString = "cmn     $\x02, $\x03";
   12025             :       break;
   12026             :     }
   12027          39 :     if (MI->getNumOperands() == 4 &&
   12028          51 :         MI->getOperand(0).getReg() == AArch64::WZR &&
   12029          24 :         MI->getOperand(1).isReg() &&
   12030          24 :         MRI.getRegClass(AArch64::GPR32spRegClassID).contains(MI->getOperand(1).getReg()) &&
   12031          63 :         MI->getOperand(2).isReg() &&
   12032          12 :         MRI.getRegClass(AArch64::GPR32RegClassID).contains(MI->getOperand(2).getReg())) {
   12033             :       // (ADDSWrx WZR, GPR32sp:$src1, GPR32:$src2, arith_extend:$sh)
   12034             :       AsmString = "cmn     $\x02, $\x03$\xFF\x04\x03";
   12035             :       break;
   12036             :     }
   12037          27 :     if (MI->getNumOperands() == 4 &&
   12038          54 :         MI->getOperand(0).isReg() &&
   12039          54 :         MRI.getRegClass(AArch64::GPR32RegClassID).contains(MI->getOperand(0).getReg()) &&
   12040          32 :         MI->getOperand(1).isReg() &&
   12041          32 :         MRI.getRegClass(AArch64::GPR32sponlyRegClassID).contains(MI->getOperand(1).getReg()) &&
   12042          10 :         MI->getOperand(2).isReg() &&
   12043          10 :         MRI.getRegClass(AArch64::GPR32RegClassID).contains(MI->getOperand(2).getReg()) &&
   12044          37 :         MI->getOperand(3).isImm() &&
   12045           5 :         MI->getOperand(3).getImm() == 16) {
   12046             :       // (ADDSWrx GPR32:$dst, GPR32sponly:$src1, GPR32:$src2, 16)
   12047             :       AsmString = "adds    $\x01, $\x02, $\x03";
   12048             :       break;
   12049             :     }
   12050             :     return false;
   12051             :   case AArch64::ADDSXri:
   12052          92 :     if (MI->getNumOperands() == 4 &&
   12053         111 :         MI->getOperand(0).getReg() == AArch64::XZR &&
   12054         130 :         MI->getOperand(1).isReg() &&
   12055          19 :         MRI.getRegClass(AArch64::GPR64spRegClassID).contains(MI->getOperand(1).getReg())) {
   12056             :       // (ADDSXri XZR, GPR64sp:$src, addsub_shifted_imm64:$imm)
   12057             :       AsmString = "cmn     $\x02, $\xFF\x03\x01";
   12058             :       break;
   12059             :     }
   12060             :     return false;
   12061             :   case AArch64::ADDSXrs:
   12062         165 :     if (MI->getNumOperands() == 4 &&
   12063         247 :         MI->getOperand(0).getReg() == AArch64::XZR &&
   12064         164 :         MI->getOperand(1).isReg() &&
   12065         164 :         MRI.getRegClass(AArch64::GPR64RegClassID).contains(MI->getOperand(1).getReg()) &&
   12066         164 :         MI->getOperand(2).isReg() &&
   12067         164 :         MRI.getRegClass(AArch64::GPR64RegClassID).contains(MI->getOperand(2).getReg()) &&
   12068         329 :         MI->getOperand(3).isImm() &&
   12069          82 :         MI->getOperand(3).getImm() == 0) {
   12070             :       // (ADDSXrs XZR, GPR64:$src1, GPR64:$src2, 0)
   12071             :       AsmString = "cmn     $\x02, $\x03";
   12072             :       break;
   12073             :     }
   12074         123 :     if (MI->getNumOperands() == 4 &&
   12075         163 :         MI->getOperand(0).getReg() == AArch64::XZR &&
   12076          80 :         MI->getOperand(1).isReg() &&
   12077          80 :         MRI.getRegClass(AArch64::GPR64RegClassID).contains(MI->getOperand(1).getReg()) &&
   12078         203 :         MI->getOperand(2).isReg() &&
   12079          40 :         MRI.getRegClass(AArch64::GPR64RegClassID).contains(MI->getOperand(2).getReg())) {
   12080             :       // (ADDSXrs XZR, GPR64:$src1, GPR64:$src2, arith_shift64:$sh)
   12081             :       AsmString = "cmn     $\x02, $\x03$\xFF\x04\x02";
   12082             :       break;
   12083             :     }
   12084          83 :     if (MI->getNumOperands() == 4 &&
   12085         166 :         MI->getOperand(0).isReg() &&
   12086         166 :         MRI.getRegClass(AArch64::GPR64RegClassID).contains(MI->getOperand(0).getReg()) &&
   12087         166 :         MI->getOperand(1).isReg() &&
   12088         166 :         MRI.getRegClass(AArch64::GPR64RegClassID).contains(MI->getOperand(1).getReg()) &&
   12089         166 :         MI->getOperand(2).isReg() &&
   12090         166 :         MRI.getRegClass(AArch64::GPR64RegClassID).contains(MI->getOperand(2).getReg()) &&
   12091         249 :         MI->getOperand(3).isImm() &&
   12092          83 :         MI->getOperand(3).getImm() == 0) {
   12093             :       // (ADDSXrs GPR64:$dst, GPR64:$src1, GPR64:$src2, 0)
   12094             :       AsmString = "adds    $\x01, $\x02, $\x03";
   12095             :       break;
   12096             :     }
   12097             :     return false;
   12098             :   case AArch64::ADDSXrx:
   12099          27 :     if (MI->getNumOperands() == 4 &&
   12100          35 :         MI->getOperand(0).getReg() == AArch64::XZR &&
   12101          16 :         MI->getOperand(1).isReg() &&
   12102          16 :         MRI.getRegClass(AArch64::GPR64spRegClassID).contains(MI->getOperand(1).getReg()) &&