LCOV - code coverage report
Current view: top level - build-llvm/lib/Target/AArch64 - AArch64GenAsmWriter.inc (source / functions) Hit Total Coverage
Test: llvm-toolchain.info Lines: 3756 4902 76.6 %
Date: 2017-09-14 15:23:50 Functions: 4 4 100.0 %
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          Line data    Source code
       1             : /*===- TableGen'erated file -------------------------------------*- C++ -*-===*\
       2             : |*                                                                            *|
       3             : |* Assembly Writer Source Fragment                                            *|
       4             : |*                                                                            *|
       5             : |* Automatically generated file, do not edit!                                 *|
       6             : |*                                                                            *|
       7             : \*===----------------------------------------------------------------------===*/
       8             : 
       9             : /// printInstruction - This method is automatically generated by tablegen
      10             : /// from the instruction set description.
      11       38914 : void AArch64InstPrinter::printInstruction(const MCInst *MI, const MCSubtargetInfo &STI, raw_ostream &O) {
      12             :   static const char AsmStrs[] = {
      13             :   /* 0 */ 's', 'h', 'a', '1', 's', 'u', '0', 9, 0,
      14             :   /* 9 */ 's', 'h', 'a', '2', '5', '6', 's', 'u', '0', 9, 0,
      15             :   /* 20 */ 'l', 'd', '1', 9, 0,
      16             :   /* 25 */ 't', 'r', 'n', '1', 9, 0,
      17             :   /* 31 */ 'z', 'i', 'p', '1', 9, 0,
      18             :   /* 37 */ 'u', 'z', 'p', '1', 9, 0,
      19             :   /* 43 */ 'd', 'c', 'p', 's', '1', 9, 0,
      20             :   /* 50 */ 's', 't', '1', 9, 0,
      21             :   /* 55 */ 's', 'h', 'a', '1', 's', 'u', '1', 9, 0,
      22             :   /* 64 */ 's', 'h', 'a', '2', '5', '6', 's', 'u', '1', 9, 0,
      23             :   /* 75 */ 'r', 'e', 'v', '3', '2', 9, 0,
      24             :   /* 82 */ 'l', 'd', '2', 9, 0,
      25             :   /* 87 */ 's', 'h', 'a', '2', '5', '6', 'h', '2', 9, 0,
      26             :   /* 97 */ 's', 'a', 'b', 'a', 'l', '2', 9, 0,
      27             :   /* 105 */ 'u', 'a', 'b', 'a', 'l', '2', 9, 0,
      28             :   /* 113 */ 's', 'q', 'd', 'm', 'l', 'a', 'l', '2', 9, 0,
      29             :   /* 123 */ 's', 'm', 'l', 'a', 'l', '2', 9, 0,
      30             :   /* 131 */ 'u', 'm', 'l', 'a', 'l', '2', 9, 0,
      31             :   /* 139 */ 's', 's', 'u', 'b', 'l', '2', 9, 0,
      32             :   /* 147 */ 'u', 's', 'u', 'b', 'l', '2', 9, 0,
      33             :   /* 155 */ 's', 'a', 'b', 'd', 'l', '2', 9, 0,
      34             :   /* 163 */ 'u', 'a', 'b', 'd', 'l', '2', 9, 0,
      35             :   /* 171 */ 's', 'a', 'd', 'd', 'l', '2', 9, 0,
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      37             :   /* 187 */ 's', 's', 'h', 'l', 'l', '2', 9, 0,
      38             :   /* 195 */ 'u', 's', 'h', 'l', 'l', '2', 9, 0,
      39             :   /* 203 */ 's', 'q', 'd', 'm', 'u', 'l', 'l', '2', 9, 0,
      40             :   /* 213 */ 'p', 'm', 'u', 'l', 'l', '2', 9, 0,
      41             :   /* 221 */ 's', 'm', 'u', 'l', 'l', '2', 9, 0,
      42             :   /* 229 */ 'u', 'm', 'u', 'l', 'l', '2', 9, 0,
      43             :   /* 237 */ 's', 'q', 'd', 'm', 'l', 's', 'l', '2', 9, 0,
      44             :   /* 247 */ 's', 'm', 'l', 's', 'l', '2', 9, 0,
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      47             :   /* 271 */ 'r', 's', 'u', 'b', 'h', 'n', '2', 9, 0,
      48             :   /* 280 */ 'r', 'a', 'd', 'd', 'h', 'n', '2', 9, 0,
      49             :   /* 289 */ 's', 'q', 's', 'h', 'r', 'n', '2', 9, 0,
      50             :   /* 298 */ 'u', 'q', 's', 'h', 'r', 'n', '2', 9, 0,
      51             :   /* 307 */ 's', 'q', 'r', 's', 'h', 'r', 'n', '2', 9, 0,
      52             :   /* 317 */ 'u', 'q', 'r', 's', 'h', 'r', 'n', '2', 9, 0,
      53             :   /* 327 */ 't', 'r', 'n', '2', 9, 0,
      54             :   /* 333 */ 'f', 'c', 'v', 't', 'n', '2', 9, 0,
      55             :   /* 341 */ 's', 'q', 'x', 't', 'n', '2', 9, 0,
      56             :   /* 349 */ 'u', 'q', 'x', 't', 'n', '2', 9, 0,
      57             :   /* 357 */ 's', 'q', 's', 'h', 'r', 'u', 'n', '2', 9, 0,
      58             :   /* 367 */ 's', 'q', 'r', 's', 'h', 'r', 'u', 'n', '2', 9, 0,
      59             :   /* 378 */ 's', 'q', 'x', 't', 'u', 'n', '2', 9, 0,
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      61             :   /* 396 */ 'z', 'i', 'p', '2', 9, 0,
      62             :   /* 402 */ 'u', 'z', 'p', '2', 9, 0,
      63             :   /* 408 */ 'd', 'c', 'p', 's', '2', 9, 0,
      64             :   /* 415 */ 's', 't', '2', 9, 0,
      65             :   /* 420 */ 's', 's', 'u', 'b', 'w', '2', 9, 0,
      66             :   /* 428 */ 'u', 's', 'u', 'b', 'w', '2', 9, 0,
      67             :   /* 436 */ 's', 'a', 'd', 'd', 'w', '2', 9, 0,
      68             :   /* 444 */ 'u', 'a', 'd', 'd', 'w', '2', 9, 0,
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      70             :   /* 457 */ 'd', 'c', 'p', 's', '3', 9, 0,
      71             :   /* 464 */ 's', 't', '3', 9, 0,
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      78             :   /* 506 */ 'b', 'l', 'r', 'a', 'a', 9, 0,
      79             :   /* 513 */ 's', 'a', 'b', 'a', 9, 0,
      80             :   /* 519 */ 'u', 'a', 'b', 'a', 9, 0,
      81             :   /* 525 */ 'p', 'a', 'c', 'd', 'a', 9, 0,
      82             :   /* 532 */ 'l', 'd', 'a', 'd', 'd', 'a', 9, 0,
      83             :   /* 540 */ 'a', 'u', 't', 'd', 'a', 9, 0,
      84             :   /* 547 */ 'p', 'a', 'c', 'g', 'a', 9, 0,
      85             :   /* 554 */ 'p', 'a', 'c', 'i', 'a', 9, 0,
      86             :   /* 561 */ 'a', 'u', 't', 'i', 'a', 9, 0,
      87             :   /* 568 */ 'f', 'c', 'm', 'l', 'a', 9, 0,
      88             :   /* 575 */ 'f', 'm', 'l', 'a', 9, 0,
      89             :   /* 581 */ 'l', 'd', 's', 'm', 'i', 'n', 'a', 9, 0,
      90             :   /* 590 */ 'l', 'd', 'u', 'm', 'i', 'n', 'a', 9, 0,
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     107             :   /* 718 */ 'a', 'u', 't', 'i', 'z', 'a', 9, 0,
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     109             :   /* 734 */ 'l', 'd', 'a', 'd', 'd', 'a', 'b', 9, 0,
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     111             :   /* 753 */ 'l', 'd', 'u', 'm', 'i', 'n', 'a', 'b', 9, 0,
     112             :   /* 763 */ 's', 'w', 'p', 'a', 'b', 9, 0,
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     114             :   /* 776 */ 'l', 'd', 'r', 'a', 'b', 9, 0,
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     140             :   /* 1008 */ 'l', 'd', 'u', 'm', 'i', 'n', 'l', 'b', 9, 0,
     141             :   /* 1018 */ 's', 'w', 'p', 'l', 'b', 9, 0,
     142             :   /* 1025 */ 'l', 'd', 'c', 'l', 'r', 'l', 'b', 9, 0,
     143             :   /* 1034 */ 'l', 'd', 'e', 'o', 'r', 'l', 'b', 9, 0,
     144             :   /* 1043 */ 'c', 'a', 's', 'l', 'b', 9, 0,
     145             :   /* 1050 */ 'l', 'd', 's', 'e', 't', 'l', 'b', 9, 0,
     146             :   /* 1059 */ 'l', 'd', 's', 'm', 'a', 'x', 'l', 'b', 9, 0,
     147             :   /* 1069 */ 'l', 'd', 'u', 'm', 'a', 'x', 'l', 'b', 9, 0,
     148             :   /* 1079 */ 'd', 'm', 'b', 9, 0,
     149             :   /* 1084 */ 'l', 'd', 's', 'm', 'i', 'n', 'b', 9, 0,
     150             :   /* 1093 */ 'l', 'd', 'u', 'm', 'i', 'n', 'b', 9, 0,
     151             :   /* 1102 */ 's', 'w', 'p', 'b', 9, 0,
     152             :   /* 1108 */ 'l', 'd', 'a', 'r', 'b', 9, 0,
     153             :   /* 1115 */ 'l', 'd', 'l', 'a', 'r', 'b', 9, 0,
     154             :   /* 1123 */ 'l', 'd', 'r', 'b', 9, 0,
     155             :   /* 1129 */ 'l', 'd', 'c', 'l', 'r', 'b', 9, 0,
     156             :   /* 1137 */ 's', 't', 'l', 'l', 'r', 'b', 9, 0,
     157             :   /* 1145 */ 's', 't', 'l', 'r', 'b', 9, 0,
     158             :   /* 1152 */ 'l', 'd', 'e', 'o', 'r', 'b', 9, 0,
     159             :   /* 1160 */ 'l', 'd', 'a', 'p', 'r', 'b', 9, 0,
     160             :   /* 1168 */ 'l', 'd', 't', 'r', 'b', 9, 0,
     161             :   /* 1175 */ 's', 't', 'r', 'b', 9, 0,
     162             :   /* 1181 */ 's', 't', 't', 'r', 'b', 9, 0,
     163             :   /* 1188 */ 'l', 'd', 'u', 'r', 'b', 9, 0,
     164             :   /* 1195 */ 's', 't', 'u', 'r', 'b', 9, 0,
     165             :   /* 1202 */ 'l', 'd', 'a', 'x', 'r', 'b', 9, 0,
     166             :   /* 1210 */ 'l', 'd', 'x', 'r', 'b', 9, 0,
     167             :   /* 1217 */ 's', 't', 'l', 'x', 'r', 'b', 9, 0,
     168             :   /* 1225 */ 's', 't', 'x', 'r', 'b', 9, 0,
     169             :   /* 1232 */ 'c', 'a', 's', 'b', 9, 0,
     170             :   /* 1238 */ 'd', 's', 'b', 9, 0,
     171             :   /* 1243 */ 'i', 's', 'b', 9, 0,
     172             :   /* 1248 */ 'l', 'd', 'r', 's', 'b', 9, 0,
     173             :   /* 1255 */ 'l', 'd', 't', 'r', 's', 'b', 9, 0,
     174             :   /* 1263 */ 'l', 'd', 'u', 'r', 's', 'b', 9, 0,
     175             :   /* 1271 */ 'l', 'd', 's', 'e', 't', 'b', 9, 0,
     176             :   /* 1279 */ 'f', 's', 'u', 'b', 9, 0,
     177             :   /* 1285 */ 's', 'h', 's', 'u', 'b', 9, 0,
     178             :   /* 1292 */ 'u', 'h', 's', 'u', 'b', 9, 0,
     179             :   /* 1299 */ 'f', 'm', 's', 'u', 'b', 9, 0,
     180             :   /* 1306 */ 'f', 'n', 'm', 's', 'u', 'b', 9, 0,
     181             :   /* 1314 */ 's', 'q', 's', 'u', 'b', 9, 0,
     182             :   /* 1321 */ 'u', 'q', 's', 'u', 'b', 9, 0,
     183             :   /* 1328 */ 'l', 'd', 's', 'm', 'a', 'x', 'b', 9, 0,
     184             :   /* 1337 */ 'l', 'd', 'u', 'm', 'a', 'x', 'b', 9, 0,
     185             :   /* 1346 */ 'p', 'a', 'c', 'd', 'z', 'b', 9, 0,
     186             :   /* 1354 */ 'a', 'u', 't', 'd', 'z', 'b', 9, 0,
     187             :   /* 1362 */ 'p', 'a', 'c', 'i', 'z', 'b', 9, 0,
     188             :   /* 1370 */ 'a', 'u', 't', 'i', 'z', 'b', 9, 0,
     189             :   /* 1378 */ 's', 'h', 'a', '1', 'c', 9, 0,
     190             :   /* 1385 */ 's', 'b', 'c', 9, 0,
     191             :   /* 1390 */ 'a', 'd', 'c', 9, 0,
     192             :   /* 1395 */ 'b', 'i', 'c', 9, 0,
     193             :   /* 1400 */ 'a', 'e', 's', 'i', 'm', 'c', 9, 0,
     194             :   /* 1408 */ 'a', 'e', 's', 'm', 'c', 9, 0,
     195             :   /* 1415 */ 'c', 's', 'i', 'n', 'c', 9, 0,
     196             :   /* 1422 */ 'h', 'v', 'c', 9, 0,
     197             :   /* 1427 */ 's', 'v', 'c', 9, 0,
     198             :   /* 1432 */ 'f', 'a', 'b', 'd', 9, 0,
     199             :   /* 1438 */ 's', 'a', 'b', 'd', 9, 0,
     200             :   /* 1444 */ 'u', 'a', 'b', 'd', 9, 0,
     201             :   /* 1450 */ 'x', 'p', 'a', 'c', 'd', 9, 0,
     202             :   /* 1457 */ 'f', 'c', 'a', 'd', 'd', 9, 0,
     203             :   /* 1464 */ 'l', 'd', 'a', 'd', 'd', 9, 0,
     204             :   /* 1471 */ 'f', 'a', 'd', 'd', 9, 0,
     205             :   /* 1477 */ 's', 'r', 'h', 'a', 'd', 'd', 9, 0,
     206             :   /* 1485 */ 'u', 'r', 'h', 'a', 'd', 'd', 9, 0,
     207             :   /* 1493 */ 's', 'h', 'a', 'd', 'd', 9, 0,
     208             :   /* 1500 */ 'u', 'h', 'a', 'd', 'd', 9, 0,
     209             :   /* 1507 */ 'f', 'm', 'a', 'd', 'd', 9, 0,
     210             :   /* 1514 */ 'f', 'n', 'm', 'a', 'd', 'd', 9, 0,
     211             :   /* 1522 */ 'u', 's', 'q', 'a', 'd', 'd', 9, 0,
     212             :   /* 1530 */ 's', 'u', 'q', 'a', 'd', 'd', 9, 0,
     213             :   /* 1538 */ 'a', 'n', 'd', 9, 0,
     214             :   /* 1543 */ 'a', 'e', 's', 'd', 9, 0,
     215             :   /* 1549 */ 'f', 'a', 'c', 'g', 'e', 9, 0,
     216             :   /* 1556 */ 'f', 'c', 'm', 'g', 'e', 9, 0,
     217             :   /* 1563 */ 'f', 'c', 'm', 'l', 'e', 9, 0,
     218             :   /* 1570 */ 'f', 'r', 'e', 'c', 'p', 'e', 9, 0,
     219             :   /* 1578 */ 'u', 'r', 'e', 'c', 'p', 'e', 9, 0,
     220             :   /* 1586 */ 'f', 'c', 'c', 'm', 'p', 'e', 9, 0,
     221             :   /* 1594 */ 'f', 'c', 'm', 'p', 'e', 9, 0,
     222             :   /* 1601 */ 'a', 'e', 's', 'e', 9, 0,
     223             :   /* 1607 */ 'f', 'r', 's', 'q', 'r', 't', 'e', 9, 0,
     224             :   /* 1616 */ 'u', 'r', 's', 'q', 'r', 't', 'e', 9, 0,
     225             :   /* 1625 */ 'b', 'i', 'f', 9, 0,
     226             :   /* 1630 */ 's', 'c', 'v', 't', 'f', 9, 0,
     227             :   /* 1637 */ 'u', 'c', 'v', 't', 'f', 9, 0,
     228             :   /* 1644 */ 'f', 'n', 'e', 'g', 9, 0,
     229             :   /* 1650 */ 's', 'q', 'n', 'e', 'g', 9, 0,
     230             :   /* 1657 */ 'c', 's', 'n', 'e', 'g', 9, 0,
     231             :   /* 1664 */ 's', 'h', 'a', '1', 'h', 9, 0,
     232             :   /* 1671 */ 'c', 'r', 'c', '3', '2', 'h', 9, 0,
     233             :   /* 1679 */ 's', 'h', 'a', '2', '5', '6', 'h', 9, 0,
     234             :   /* 1688 */ 'l', 'd', 'a', 'd', 'd', 'a', 'h', 9, 0,
     235             :   /* 1697 */ 's', 'q', 'r', 'd', 'm', 'l', 'a', 'h', 9, 0,
     236             :   /* 1707 */ 'l', 'd', 's', 'm', 'i', 'n', 'a', 'h', 9, 0,
     237             :   /* 1717 */ 'l', 'd', 'u', 'm', 'i', 'n', 'a', 'h', 9, 0,
     238             :   /* 1727 */ 's', 'w', 'p', 'a', 'h', 9, 0,
     239             :   /* 1734 */ 'l', 'd', 'c', 'l', 'r', 'a', 'h', 9, 0,
     240             :   /* 1743 */ 'l', 'd', 'e', 'o', 'r', 'a', 'h', 9, 0,
     241             :   /* 1752 */ 'c', 'a', 's', 'a', 'h', 9, 0,
     242             :   /* 1759 */ 'l', 'd', 's', 'e', 't', 'a', 'h', 9, 0,
     243             :   /* 1768 */ 'l', 'd', 's', 'm', 'a', 'x', 'a', 'h', 9, 0,
     244             :   /* 1778 */ 'l', 'd', 'u', 'm', 'a', 'x', 'a', 'h', 9, 0,
     245             :   /* 1788 */ 'c', 'r', 'c', '3', '2', 'c', 'h', 9, 0,
     246             :   /* 1797 */ 'l', 'd', 'a', 'd', 'd', 'h', 9, 0,
     247             :   /* 1805 */ 'l', 'd', 'a', 'd', 'd', 'a', 'l', 'h', 9, 0,
     248             :   /* 1815 */ 'l', 'd', 's', 'm', 'i', 'n', 'a', 'l', 'h', 9, 0,
     249             :   /* 1826 */ 'l', 'd', 'u', 'm', 'i', 'n', 'a', 'l', 'h', 9, 0,
     250             :   /* 1837 */ 's', 'w', 'p', 'a', 'l', 'h', 9, 0,
     251             :   /* 1845 */ 'l', 'd', 'c', 'l', 'r', 'a', 'l', 'h', 9, 0,
     252             :   /* 1855 */ 'l', 'd', 'e', 'o', 'r', 'a', 'l', 'h', 9, 0,
     253             :   /* 1865 */ 'c', 'a', 's', 'a', 'l', 'h', 9, 0,
     254             :   /* 1873 */ 'l', 'd', 's', 'e', 't', 'a', 'l', 'h', 9, 0,
     255             :   /* 1883 */ 'l', 'd', 's', 'm', 'a', 'x', 'a', 'l', 'h', 9, 0,
     256             :   /* 1894 */ 'l', 'd', 'u', 'm', 'a', 'x', 'a', 'l', 'h', 9, 0,
     257             :   /* 1905 */ 'l', 'd', 'a', 'd', 'd', 'l', 'h', 9, 0,
     258             :   /* 1914 */ 'l', 'd', 's', 'm', 'i', 'n', 'l', 'h', 9, 0,
     259             :   /* 1924 */ 'l', 'd', 'u', 'm', 'i', 'n', 'l', 'h', 9, 0,
     260             :   /* 1934 */ 's', 'w', 'p', 'l', 'h', 9, 0,
     261             :   /* 1941 */ 'l', 'd', 'c', 'l', 'r', 'l', 'h', 9, 0,
     262             :   /* 1950 */ 'l', 'd', 'e', 'o', 'r', 'l', 'h', 9, 0,
     263             :   /* 1959 */ 'c', 'a', 's', 'l', 'h', 9, 0,
     264             :   /* 1966 */ 'l', 'd', 's', 'e', 't', 'l', 'h', 9, 0,
     265             :   /* 1975 */ 's', 'q', 'd', 'm', 'u', 'l', 'h', 9, 0,
     266             :   /* 1984 */ 's', 'q', 'r', 'd', 'm', 'u', 'l', 'h', 9, 0,
     267             :   /* 1994 */ 's', 'm', 'u', 'l', 'h', 9, 0,
     268             :   /* 2001 */ 'u', 'm', 'u', 'l', 'h', 9, 0,
     269             :   /* 2008 */ 'l', 'd', 's', 'm', 'a', 'x', 'l', 'h', 9, 0,
     270             :   /* 2018 */ 'l', 'd', 'u', 'm', 'a', 'x', 'l', 'h', 9, 0,
     271             :   /* 2028 */ 'l', 'd', 's', 'm', 'i', 'n', 'h', 9, 0,
     272             :   /* 2037 */ 'l', 'd', 'u', 'm', 'i', 'n', 'h', 9, 0,
     273             :   /* 2046 */ 's', 'w', 'p', 'h', 9, 0,
     274             :   /* 2052 */ 'l', 'd', 'a', 'r', 'h', 9, 0,
     275             :   /* 2059 */ 'l', 'd', 'l', 'a', 'r', 'h', 9, 0,
     276             :   /* 2067 */ 'l', 'd', 'r', 'h', 9, 0,
     277             :   /* 2073 */ 'l', 'd', 'c', 'l', 'r', 'h', 9, 0,
     278             :   /* 2081 */ 's', 't', 'l', 'l', 'r', 'h', 9, 0,
     279             :   /* 2089 */ 's', 't', 'l', 'r', 'h', 9, 0,
     280             :   /* 2096 */ 'l', 'd', 'e', 'o', 'r', 'h', 9, 0,
     281             :   /* 2104 */ 'l', 'd', 'a', 'p', 'r', 'h', 9, 0,
     282             :   /* 2112 */ 'l', 'd', 't', 'r', 'h', 9, 0,
     283             :   /* 2119 */ 's', 't', 'r', 'h', 9, 0,
     284             :   /* 2125 */ 's', 't', 't', 'r', 'h', 9, 0,
     285             :   /* 2132 */ 'l', 'd', 'u', 'r', 'h', 9, 0,
     286             :   /* 2139 */ 's', 't', 'u', 'r', 'h', 9, 0,
     287             :   /* 2146 */ 'l', 'd', 'a', 'x', 'r', 'h', 9, 0,
     288             :   /* 2154 */ 'l', 'd', 'x', 'r', 'h', 9, 0,
     289             :   /* 2161 */ 's', 't', 'l', 'x', 'r', 'h', 9, 0,
     290             :   /* 2169 */ 's', 't', 'x', 'r', 'h', 9, 0,
     291             :   /* 2176 */ 'c', 'a', 's', 'h', 9, 0,
     292             :   /* 2182 */ 's', 'q', 'r', 'd', 'm', 'l', 's', 'h', 9, 0,
     293             :   /* 2192 */ 'l', 'd', 'r', 's', 'h', 9, 0,
     294             :   /* 2199 */ 'l', 'd', 't', 'r', 's', 'h', 9, 0,
     295             :   /* 2207 */ 'l', 'd', 'u', 'r', 's', 'h', 9, 0,
     296             :   /* 2215 */ 'l', 'd', 's', 'e', 't', 'h', 9, 0,
     297             :   /* 2223 */ 'l', 'd', 's', 'm', 'a', 'x', 'h', 9, 0,
     298             :   /* 2232 */ 'l', 'd', 'u', 'm', 'a', 'x', 'h', 9, 0,
     299             :   /* 2241 */ 'x', 'p', 'a', 'c', 'i', 9, 0,
     300             :   /* 2248 */ 'c', 'm', 'h', 'i', 9, 0,
     301             :   /* 2254 */ 's', 'l', 'i', 9, 0,
     302             :   /* 2259 */ 'm', 'v', 'n', 'i', 9, 0,
     303             :   /* 2265 */ 's', 'r', 'i', 9, 0,
     304             :   /* 2270 */ 'f', 'r', 'i', 'n', 't', 'i', 9, 0,
     305             :   /* 2278 */ 'm', 'o', 'v', 'i', 9, 0,
     306             :   /* 2284 */ 'b', 'r', 'k', 9, 0,
     307             :   /* 2289 */ 'm', 'o', 'v', 'k', 9, 0,
     308             :   /* 2295 */ 's', 'a', 'b', 'a', 'l', 9, 0,
     309             :   /* 2302 */ 'u', 'a', 'b', 'a', 'l', 9, 0,
     310             :   /* 2309 */ 'l', 'd', 'a', 'd', 'd', 'a', 'l', 9, 0,
     311             :   /* 2318 */ 's', 'q', 'd', 'm', 'l', 'a', 'l', 9, 0,
     312             :   /* 2327 */ 's', 'm', 'l', 'a', 'l', 9, 0,
     313             :   /* 2334 */ 'u', 'm', 'l', 'a', 'l', 9, 0,
     314             :   /* 2341 */ 'l', 'd', 's', 'm', 'i', 'n', 'a', 'l', 9, 0,
     315             :   /* 2351 */ 'l', 'd', 'u', 'm', 'i', 'n', 'a', 'l', 9, 0,
     316             :   /* 2361 */ 'c', 'a', 's', 'p', 'a', 'l', 9, 0,
     317             :   /* 2369 */ 's', 'w', 'p', 'a', 'l', 9, 0,
     318             :   /* 2376 */ 'l', 'd', 'c', 'l', 'r', 'a', 'l', 9, 0,
     319             :   /* 2385 */ 'l', 'd', 'e', 'o', 'r', 'a', 'l', 9, 0,
     320             :   /* 2394 */ 'c', 'a', 's', 'a', 'l', 9, 0,
     321             :   /* 2401 */ 'l', 'd', 's', 'e', 't', 'a', 'l', 9, 0,
     322             :   /* 2410 */ 'l', 'd', 's', 'm', 'a', 'x', 'a', 'l', 9, 0,
     323             :   /* 2420 */ 'l', 'd', 'u', 'm', 'a', 'x', 'a', 'l', 9, 0,
     324             :   /* 2430 */ 't', 'b', 'l', 9, 0,
     325             :   /* 2435 */ 's', 'm', 's', 'u', 'b', 'l', 9, 0,
     326             :   /* 2443 */ 'u', 'm', 's', 'u', 'b', 'l', 9, 0,
     327             :   /* 2451 */ 's', 's', 'u', 'b', 'l', 9, 0,
     328             :   /* 2458 */ 'u', 's', 'u', 'b', 'l', 9, 0,
     329             :   /* 2465 */ 's', 'a', 'b', 'd', 'l', 9, 0,
     330             :   /* 2472 */ 'u', 'a', 'b', 'd', 'l', 9, 0,
     331             :   /* 2479 */ 'l', 'd', 'a', 'd', 'd', 'l', 9, 0,
     332             :   /* 2487 */ 's', 'm', 'a', 'd', 'd', 'l', 9, 0,
     333             :   /* 2495 */ 'u', 'm', 'a', 'd', 'd', 'l', 9, 0,
     334             :   /* 2503 */ 's', 'a', 'd', 'd', 'l', 9, 0,
     335             :   /* 2510 */ 'u', 'a', 'd', 'd', 'l', 9, 0,
     336             :   /* 2517 */ 'f', 'c', 's', 'e', 'l', 9, 0,
     337             :   /* 2524 */ 's', 'q', 's', 'h', 'l', 9, 0,
     338             :   /* 2531 */ 'u', 'q', 's', 'h', 'l', 9, 0,
     339             :   /* 2538 */ 's', 'q', 'r', 's', 'h', 'l', 9, 0,
     340             :   /* 2546 */ 'u', 'q', 'r', 's', 'h', 'l', 9, 0,
     341             :   /* 2554 */ 's', 'r', 's', 'h', 'l', 9, 0,
     342             :   /* 2561 */ 'u', 'r', 's', 'h', 'l', 9, 0,
     343             :   /* 2568 */ 's', 's', 'h', 'l', 9, 0,
     344             :   /* 2574 */ 'u', 's', 'h', 'l', 9, 0,
     345             :   /* 2580 */ 's', 's', 'h', 'l', 'l', 9, 0,
     346             :   /* 2587 */ 'u', 's', 'h', 'l', 'l', 9, 0,
     347             :   /* 2594 */ 's', 'q', 'd', 'm', 'u', 'l', 'l', 9, 0,
     348             :   /* 2603 */ 'p', 'm', 'u', 'l', 'l', 9, 0,
     349             :   /* 2610 */ 's', 'm', 'u', 'l', 'l', 9, 0,
     350             :   /* 2617 */ 'u', 'm', 'u', 'l', 'l', 9, 0,
     351             :   /* 2624 */ 'l', 'd', 's', 'm', 'i', 'n', 'l', 9, 0,
     352             :   /* 2633 */ 'l', 'd', 'u', 'm', 'i', 'n', 'l', 9, 0,
     353             :   /* 2642 */ 'c', 'a', 's', 'p', 'l', 9, 0,
     354             :   /* 2649 */ 's', 'w', 'p', 'l', 9, 0,
     355             :   /* 2655 */ 'l', 'd', 'c', 'l', 'r', 'l', 9, 0,
     356             :   /* 2663 */ 'l', 'd', 'e', 'o', 'r', 'l', 9, 0,
     357             :   /* 2671 */ 'c', 'a', 's', 'l', 9, 0,
     358             :   /* 2677 */ 'b', 's', 'l', 9, 0,
     359             :   /* 2682 */ 's', 'q', 'd', 'm', 'l', 's', 'l', 9, 0,
     360             :   /* 2691 */ 's', 'm', 'l', 's', 'l', 9, 0,
     361             :   /* 2698 */ 'u', 'm', 'l', 's', 'l', 9, 0,
     362             :   /* 2705 */ 's', 'y', 's', 'l', 9, 0,
     363             :   /* 2711 */ 'l', 'd', 's', 'e', 't', 'l', 9, 0,
     364             :   /* 2719 */ 'f', 'c', 'v', 't', 'l', 9, 0,
     365             :   /* 2726 */ 'f', 'm', 'u', 'l', 9, 0,
     366             :   /* 2732 */ 'f', 'n', 'm', 'u', 'l', 9, 0,
     367             :   /* 2739 */ 'p', 'm', 'u', 'l', 9, 0,
     368             :   /* 2745 */ 'l', 'd', 's', 'm', 'a', 'x', 'l', 9, 0,
     369             :   /* 2754 */ 'l', 'd', 'u', 'm', 'a', 'x', 'l', 9, 0,
     370             :   /* 2763 */ 's', 'h', 'a', '1', 'm', 9, 0,
     371             :   /* 2770 */ 's', 'b', 'f', 'm', 9, 0,
     372             :   /* 2776 */ 'u', 'b', 'f', 'm', 9, 0,
     373             :   /* 2782 */ 'p', 'r', 'f', 'm', 9, 0,
     374             :   /* 2788 */ 'f', 'm', 'i', 'n', 'n', 'm', 9, 0,
     375             :   /* 2796 */ 'f', 'm', 'a', 'x', 'n', 'm', 9, 0,
     376             :   /* 2804 */ 'f', 'r', 'i', 'n', 't', 'm', 9, 0,
     377             :   /* 2812 */ 'p', 'r', 'f', 'u', 'm', 9, 0,
     378             :   /* 2819 */ 'r', 's', 'u', 'b', 'h', 'n', 9, 0,
     379             :   /* 2827 */ 'r', 'a', 'd', 'd', 'h', 'n', 9, 0,
     380             :   /* 2835 */ 'f', 'm', 'i', 'n', 9, 0,
     381             :   /* 2841 */ 'l', 'd', 's', 'm', 'i', 'n', 9, 0,
     382             :   /* 2849 */ 'l', 'd', 'u', 'm', 'i', 'n', 9, 0,
     383             :   /* 2857 */ 'c', 'c', 'm', 'n', 9, 0,
     384             :   /* 2863 */ 'e', 'o', 'n', 9, 0,
     385             :   /* 2868 */ 's', 'q', 's', 'h', 'r', 'n', 9, 0,
     386             :   /* 2876 */ 'u', 'q', 's', 'h', 'r', 'n', 9, 0,
     387             :   /* 2884 */ 's', 'q', 'r', 's', 'h', 'r', 'n', 9, 0,
     388             :   /* 2893 */ 'u', 'q', 'r', 's', 'h', 'r', 'n', 9, 0,
     389             :   /* 2902 */ 'o', 'r', 'n', 9, 0,
     390             :   /* 2907 */ 'f', 'r', 'i', 'n', 't', 'n', 9, 0,
     391             :   /* 2915 */ 'f', 'c', 'v', 't', 'n', 9, 0,
     392             :   /* 2922 */ 's', 'q', 'x', 't', 'n', 9, 0,
     393             :   /* 2929 */ 'u', 'q', 'x', 't', 'n', 9, 0,
     394             :   /* 2936 */ 's', 'q', 's', 'h', 'r', 'u', 'n', 9, 0,
     395             :   /* 2945 */ 's', 'q', 'r', 's', 'h', 'r', 'u', 'n', 9, 0,
     396             :   /* 2955 */ 's', 'q', 'x', 't', 'u', 'n', 9, 0,
     397             :   /* 2963 */ 'm', 'o', 'v', 'n', 9, 0,
     398             :   /* 2969 */ 'f', 'c', 'v', 't', 'x', 'n', 9, 0,
     399             :   /* 2977 */ 's', 'h', 'a', '1', 'p', 9, 0,
     400             :   /* 2984 */ 'f', 'a', 'd', 'd', 'p', 9, 0,
     401             :   /* 2991 */ 'l', 'd', 'p', 9, 0,
     402             :   /* 2996 */ 's', 'a', 'd', 'a', 'l', 'p', 9, 0,
     403             :   /* 3004 */ 'u', 'a', 'd', 'a', 'l', 'p', 9, 0,
     404             :   /* 3012 */ 's', 'a', 'd', 'd', 'l', 'p', 9, 0,
     405             :   /* 3020 */ 'u', 'a', 'd', 'd', 'l', 'p', 9, 0,
     406             :   /* 3028 */ 'f', 'c', 'c', 'm', 'p', 9, 0,
     407             :   /* 3035 */ 'f', 'c', 'm', 'p', 9, 0,
     408             :   /* 3041 */ 'f', 'm', 'i', 'n', 'n', 'm', 'p', 9, 0,
     409             :   /* 3050 */ 'f', 'm', 'a', 'x', 'n', 'm', 'p', 9, 0,
     410             :   /* 3059 */ 'l', 'd', 'n', 'p', 9, 0,
     411             :   /* 3065 */ 'f', 'm', 'i', 'n', 'p', 9, 0,
     412             :   /* 3072 */ 's', 'm', 'i', 'n', 'p', 9, 0,
     413             :   /* 3079 */ 'u', 'm', 'i', 'n', 'p', 9, 0,
     414             :   /* 3086 */ 's', 't', 'n', 'p', 9, 0,
     415             :   /* 3092 */ 'a', 'd', 'r', 'p', 9, 0,
     416             :   /* 3098 */ 'c', 'a', 's', 'p', 9, 0,
     417             :   /* 3104 */ 'f', 'r', 'i', 'n', 't', 'p', 9, 0,
     418             :   /* 3112 */ 's', 't', 'p', 9, 0,
     419             :   /* 3117 */ 'd', 'u', 'p', 9, 0,
     420             :   /* 3122 */ 's', 'w', 'p', 9, 0,
     421             :   /* 3127 */ 'l', 'd', 'a', 'x', 'p', 9, 0,
     422             :   /* 3134 */ 'f', 'm', 'a', 'x', 'p', 9, 0,
     423             :   /* 3141 */ 's', 'm', 'a', 'x', 'p', 9, 0,
     424             :   /* 3148 */ 'u', 'm', 'a', 'x', 'p', 9, 0,
     425             :   /* 3155 */ 'l', 'd', 'x', 'p', 9, 0,
     426             :   /* 3161 */ 's', 't', 'l', 'x', 'p', 9, 0,
     427             :   /* 3168 */ 's', 't', 'x', 'p', 9, 0,
     428             :   /* 3174 */ 'f', 'c', 'm', 'e', 'q', 9, 0,
     429             :   /* 3181 */ 'l', 'd', '1', 'r', 9, 0,
     430             :   /* 3187 */ 'l', 'd', '2', 'r', 9, 0,
     431             :   /* 3193 */ 'l', 'd', '3', 'r', 9, 0,
     432             :   /* 3199 */ 'l', 'd', '4', 'r', 9, 0,
     433             :   /* 3205 */ 'l', 'd', 'a', 'r', 9, 0,
     434             :   /* 3211 */ 'l', 'd', 'l', 'a', 'r', 9, 0,
     435             :   /* 3218 */ 'b', 'r', 9, 0,
     436             :   /* 3222 */ 'a', 'd', 'r', 9, 0,
     437             :   /* 3227 */ 'l', 'd', 'r', 9, 0,
     438             :   /* 3232 */ 's', 'r', 's', 'h', 'r', 9, 0,
     439             :   /* 3239 */ 'u', 'r', 's', 'h', 'r', 9, 0,
     440             :   /* 3246 */ 's', 's', 'h', 'r', 9, 0,
     441             :   /* 3252 */ 'u', 's', 'h', 'r', 9, 0,
     442             :   /* 3258 */ 'b', 'l', 'r', 9, 0,
     443             :   /* 3263 */ 'l', 'd', 'c', 'l', 'r', 9, 0,
     444             :   /* 3270 */ 's', 't', 'l', 'l', 'r', 9, 0,
     445             :   /* 3277 */ 's', 't', 'l', 'r', 9, 0,
     446             :   /* 3283 */ 'l', 'd', 'e', 'o', 'r', 9, 0,
     447             :   /* 3290 */ 'r', 'o', 'r', 9, 0,
     448             :   /* 3295 */ 'l', 'd', 'a', 'p', 'r', 9, 0,
     449             :   /* 3302 */ 'o', 'r', 'r', 9, 0,
     450             :   /* 3307 */ 'a', 's', 'r', 9, 0,
     451             :   /* 3312 */ 'l', 's', 'r', 9, 0,
     452             :   /* 3317 */ 'm', 's', 'r', 9, 0,
     453             :   /* 3322 */ 'l', 'd', 't', 'r', 9, 0,
     454             :   /* 3328 */ 's', 't', 'r', 9, 0,
     455             :   /* 3333 */ 's', 't', 't', 'r', 9, 0,
     456             :   /* 3339 */ 'e', 'x', 't', 'r', 9, 0,
     457             :   /* 3345 */ 'l', 'd', 'u', 'r', 9, 0,
     458             :   /* 3351 */ 's', 't', 'u', 'r', 9, 0,
     459             :   /* 3357 */ 'l', 'd', 'a', 'x', 'r', 9, 0,
     460             :   /* 3364 */ 'l', 'd', 'x', 'r', 9, 0,
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     463             :   /* 3383 */ 'c', 'a', 's', 9, 0,
     464             :   /* 3388 */ 'f', 'c', 'v', 't', 'a', 's', 9, 0,
     465             :   /* 3396 */ 'f', 'a', 'b', 's', 9, 0,
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     468             :   /* 3415 */ 's', 'b', 'c', 's', 9, 0,
     469             :   /* 3421 */ 'a', 'd', 'c', 's', 9, 0,
     470             :   /* 3427 */ 'b', 'i', 'c', 's', 9, 0,
     471             :   /* 3433 */ 'a', 'd', 'd', 's', 9, 0,
     472             :   /* 3439 */ 'a', 'n', 'd', 's', 9, 0,
     473             :   /* 3445 */ 'c', 'm', 'h', 's', 9, 0,
     474             :   /* 3451 */ 'c', 'l', 's', 9, 0,
     475             :   /* 3456 */ 'f', 'm', 'l', 's', 9, 0,
     476             :   /* 3462 */ 'f', 'c', 'v', 't', 'm', 's', 9, 0,
     477             :   /* 3470 */ 'i', 'n', 's', 9, 0,
     478             :   /* 3475 */ 'f', 'c', 'v', 't', 'n', 's', 9, 0,
     479             :   /* 3483 */ 'f', 'r', 'e', 'c', 'p', 's', 9, 0,
     480             :   /* 3491 */ 'f', 'c', 'v', 't', 'p', 's', 9, 0,
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     482             :   /* 3504 */ 'f', 'r', 's', 'q', 'r', 't', 's', 9, 0,
     483             :   /* 3513 */ 's', 'y', 's', 9, 0,
     484             :   /* 3518 */ 'f', 'c', 'v', 't', 'z', 's', 9, 0,
     485             :   /* 3526 */ 'f', 'j', 'c', 'v', 't', 'z', 's', 9, 0,
     486             :   /* 3535 */ 'r', 'e', 't', 9, 0,
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     488             :   /* 3547 */ 'f', 'a', 'c', 'g', 't', 9, 0,
     489             :   /* 3554 */ 'f', 'c', 'm', 'g', 't', 9, 0,
     490             :   /* 3561 */ 'r', 'b', 'i', 't', 9, 0,
     491             :   /* 3567 */ 'h', 'l', 't', 9, 0,
     492             :   /* 3572 */ 'f', 'c', 'm', 'l', 't', 9, 0,
     493             :   /* 3579 */ 'c', 'n', 't', 9, 0,
     494             :   /* 3584 */ 'h', 'i', 'n', 't', 9, 0,
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     496             :   /* 3596 */ 'u', 'd', 'o', 't', 9, 0,
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     514             :   /* 3717 */ 'u', 'a', 'd', 'd', 'l', 'v', 9, 0,
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     520             :   /* 3764 */ 'c', 's', 'i', 'n', 'v', 9, 0,
     521             :   /* 3771 */ 'f', 'm', 'o', 'v', 9, 0,
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     523             :   /* 3783 */ 'u', 'm', 'o', 'v', 9, 0,
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     535             :   /* 3869 */ 'l', 'd', 't', 'r', 's', 'w', 9, 0,
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     537             :   /* 3885 */ 'c', 'r', 'c', '3', '2', 'x', 9, 0,
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     539             :   /* 3899 */ 'l', 'd', 's', 'm', 'a', 'x', 9, 0,
     540             :   /* 3907 */ 'l', 'd', 'u', 'm', 'a', 'x', 9, 0,
     541             :   /* 3915 */ 't', 'b', 'x', 9, 0,
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     555             :   /* 4010 */ 't', 'b', 'n', 'z', 9, 0,
     556             :   /* 4016 */ 'f', 'r', 'i', 'n', 't', 'z', 9, 0,
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     558             :   /* 4030 */ '.', 't', 'l', 's', 'd', 'e', 's', 'c', 'c', 'a', 'l', 'l', 32, 0,
     559             :   /* 4044 */ '#', 32, 'X', 'R', 'a', 'y', 32, 'F', 'u', 'n', 'c', 't', 'i', 'o', 'n', 32, 'P', 'a', 't', 'c', 'h', 'a', 'b', 'l', 'e', 32, 'R', 'E', 'T', '.', 0,
     560             :   /* 4075 */ 'b', '.', 0,
     561             :   /* 4078 */ '#', 32, 'X', 'R', 'a', 'y', 32, 'C', 'u', 's', 't', 'o', 'm', 32, 'E', 'v', 'e', 'n', 't', 32, 'L', 'o', 'g', '.', 0,
     562             :   /* 4103 */ '#', 32, 'X', 'R', 'a', 'y', 32, 'F', 'u', 'n', 'c', 't', 'i', 'o', 'n', 32, 'E', 'n', 't', 'e', 'r', '.', 0,
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     578             :   /* 4300 */ 'a', 'u', 't', 'i', 'a', 's', 'p', 0,
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     590             :     0U, // PHI
     591             :     0U, // INLINEASM
     592             :     0U, // CFI_INSTRUCTION
     593             :     0U, // EH_LABEL
     594             :     0U, // GC_LABEL
     595             :     0U, // ANNOTATION_LABEL
     596             :     0U, // KILL
     597             :     0U, // EXTRACT_SUBREG
     598             :     0U, // INSERT_SUBREG
     599             :     0U, // IMPLICIT_DEF
     600             :     0U, // SUBREG_TO_REG
     601             :     0U, // COPY_TO_REGCLASS
     602             :     4232U,      // DBG_VALUE
     603             :     0U, // REG_SEQUENCE
     604             :     0U, // COPY
     605             :     4225U,      // BUNDLE
     606             :     4242U,      // LIFETIME_START
     607             :     4212U,      // LIFETIME_END
     608             :     0U, // STACKMAP
     609             :     4279U,      // FENTRY_CALL
     610             :     0U, // PATCHPOINT
     611             :     0U, // LOAD_STACK_GUARD
     612             :     0U, // STATEPOINT
     613             :     0U, // LOCAL_ESCAPE
     614             :     0U, // FAULTING_OP
     615             :     0U, // PATCHABLE_OP
     616             :     4104U,      // PATCHABLE_FUNCTION_ENTER
     617             :     4045U,      // PATCHABLE_RET
     618             :     4150U,      // PATCHABLE_FUNCTION_EXIT
     619             :     4127U,      // PATCHABLE_TAIL_CALL
     620             :     4079U,      // PATCHABLE_EVENT_CALL
     621             :     0U, // G_ADD
     622             :     0U, // G_SUB
     623             :     0U, // G_MUL
     624             :     0U, // G_SDIV
     625             :     0U, // G_UDIV
     626             :     0U, // G_SREM
     627             :     0U, // G_UREM
     628             :     0U, // G_AND
     629             :     0U, // G_OR
     630             :     0U, // G_XOR
     631             :     0U, // G_IMPLICIT_DEF
     632             :     0U, // G_PHI
     633             :     0U, // G_FRAME_INDEX
     634             :     0U, // G_GLOBAL_VALUE
     635             :     0U, // G_EXTRACT
     636             :     0U, // G_UNMERGE_VALUES
     637             :     0U, // G_INSERT
     638             :     0U, // G_MERGE_VALUES
     639             :     0U, // G_PTRTOINT
     640             :     0U, // G_INTTOPTR
     641             :     0U, // G_BITCAST
     642             :     0U, // G_LOAD
     643             :     0U, // G_STORE
     644             :     0U, // G_BRCOND
     645             :     0U, // G_BRINDIRECT
     646             :     0U, // G_INTRINSIC
     647             :     0U, // G_INTRINSIC_W_SIDE_EFFECTS
     648             :     0U, // G_ANYEXT
     649             :     0U, // G_TRUNC
     650             :     0U, // G_CONSTANT
     651             :     0U, // G_FCONSTANT
     652             :     0U, // G_VASTART
     653             :     0U, // G_VAARG
     654             :     0U, // G_SEXT
     655             :     0U, // G_ZEXT
     656             :     0U, // G_SHL
     657             :     0U, // G_LSHR
     658             :     0U, // G_ASHR
     659             :     0U, // G_ICMP
     660             :     0U, // G_FCMP
     661             :     0U, // G_SELECT
     662             :     0U, // G_UADDE
     663             :     0U, // G_USUBE
     664             :     0U, // G_SADDO
     665             :     0U, // G_SSUBO
     666             :     0U, // G_UMULO
     667             :     0U, // G_SMULO
     668             :     0U, // G_UMULH
     669             :     0U, // G_SMULH
     670             :     0U, // G_FADD
     671             :     0U, // G_FSUB
     672             :     0U, // G_FMUL
     673             :     0U, // G_FMA
     674             :     0U, // G_FDIV
     675             :     0U, // G_FREM
     676             :     0U, // G_FPOW
     677             :     0U, // G_FEXP
     678             :     0U, // G_FEXP2
     679             :     0U, // G_FLOG
     680             :     0U, // G_FLOG2
     681             :     0U, // G_FNEG
     682             :     0U, // G_FPEXT
     683             :     0U, // G_FPTRUNC
     684             :     0U, // G_FPTOSI
     685             :     0U, // G_FPTOUI
     686             :     0U, // G_SITOFP
     687             :     0U, // G_UITOFP
     688             :     0U, // G_GEP
     689             :     0U, // G_PTR_MASK
     690             :     0U, // G_BR
     691             :     0U, // G_INSERT_VECTOR_ELT
     692             :     0U, // G_EXTRACT_VECTOR_ELT
     693             :     0U, // G_SHUFFLE_VECTOR
     694             :     11590U,     // ABSv16i8
     695             :     1107840326U,        // ABSv1i64
     696             :     2148543814U,        // ABSv2i32
     697             :     3222809926U,        // ABSv2i64
     698             :     2108742U,   // ABSv4i16
     699             :     1076374854U,        // ABSv4i32
     700             :     2150640966U,        // ABSv8i16
     701             :     3224907078U,        // ABSv8i8
     702             :     34098526U,  // ADCSWr
     703             :     34098526U,  // ADCSXr
     704             :     34096495U,  // ADCWr
     705             :     34096495U,  // ADCXr
     706             :     1074801421U,        // ADDHNv2i64_v2i32
     707             :     1143496986U,        // ADDHNv2i64_v4i32
     708             :     2149591821U,        // ADDHNv4i32_v4i16
     709             :     2217763098U,        // ADDHNv4i32_v8i16
     710             :     3288359194U,        // ADDHNv8i16_v16i8
     711             :     3224906509U,        // ADDHNv8i16_v8i8
     712             :     11178U,     // ADDPv16i8
     713             :     1074801578U,        // ADDPv2i32
     714             :     1075325866U,        // ADDPv2i64
     715             :     3221769130U,        // ADDPv2i64p
     716             :     2149591978U,        // ADDPv4i16
     717             :     2150116266U,        // ADDPv4i32
     718             :     3224382378U,        // ADDPv8i16
     719             :     3224906666U,        // ADDPv8i8
     720             :     34098538U,  // ADDSWri
     721             :     0U, // ADDSWrr
     722             :     34098538U,  // ADDSWrs
     723             :     34098538U,  // ADDSWrx
     724             :     34098538U,  // ADDSXri
     725             :     0U, // ADDSXrr
     726             :     34098538U,  // ADDSXrs
     727             :     34098538U,  // ADDSXrx
     728             :     34098538U,  // ADDSXrx64
     729             :     544353U,    // ADDVv16i8v
     730             :     544353U,    // ADDVv4i16v
     731             :     1074286177U,        // ADDVv4i32v
     732             :     2148028001U,        // ADDVv8i16v
     733             :     3221769825U,        // ADDVv8i8v
     734             :     34096564U,  // ADDWri
     735             :     0U, // ADDWrr
     736             :     34096564U,  // ADDWrs
     737             :     34096564U,  // ADDWrx
     738             :     34096564U,  // ADDXri
     739             :     0U, // ADDXrr
     740             :     34096564U,  // ADDXrs
     741             :     34096564U,  // ADDXrx
     742             :     34096564U,  // ADDXrx64
     743             :     9652U,      // ADDv16i8
     744             :     34096564U,  // ADDv1i64
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     746             :     1075324340U,        // ADDv2i64
     747             :     2149590452U,        // ADDv4i16
     748             :     2150114740U,        // ADDv4i32
     749             :     3224380852U,        // ADDv8i16
     750             :     3224905140U,        // ADDv8i8
     751             :     0U, // ADJCALLSTACKDOWN
     752             :     0U, // ADJCALLSTACKUP
     753             :     1107840151U,        // ADR
     754             :     101207061U, // ADRP
     755             :     67134984U,  // AESDrr
     756             :     67135042U,  // AESErr
     757             :     9593U,      // AESIMCrr
     758             :     0U, // AESIMCrrTied
     759             :     9601U,      // AESMCrr
     760             :     0U, // AESMCrrTied
     761             :     34098544U,  // ANDSWri
     762             :     0U, // ANDSWrr
     763             :     34098544U,  // ANDSWrs
     764             :     34098544U,  // ANDSXri
     765             :     0U, // ANDSXrr
     766             :     34098544U,  // ANDSXrs
     767             :     34096643U,  // ANDWri
     768             :     0U, // ANDWrr
     769             :     34096643U,  // ANDWrs
     770             :     34096643U,  // ANDXri
     771             :     0U, // ANDXrr
     772             :     34096643U,  // ANDXrs
     773             :     9731U,      // ANDv16i8
     774             :     3224905219U,        // ANDv8i8
     775             :     34098412U,  // ASRVWr
     776             :     34098412U,  // ASRVXr
     777             :     1107837469U,        // AUTDA
     778             :     1107837797U,        // AUTDB
     779             :     4211391U,   // AUTDZA
     780             :     4212043U,   // AUTDZB
     781             :     1107837490U,        // AUTIA
     782             :     4182U,      // AUTIA1716
     783             :     4301U,      // AUTIASP
     784             :     4342U,      // AUTIAZ
     785             :     1107837811U,        // AUTIB
     786             :     4202U,      // AUTIB1716
     787             :     4317U,      // AUTIBSP
     788             :     4356U,      // AUTIBZ
     789             :     4211407U,   // AUTIZA
     790             :     4212059U,   // AUTIZB
     791             :     33500U,     // B
     792             :     134761172U, // BFMWri
     793             :     134761172U, // BFMXri
     794             :     0U, // BICSWrr
     795             :     34098532U,  // BICSWrs
     796             :     0U, // BICSXrr
     797             :     34098532U,  // BICSXrs
     798             :     0U, // BICWrr
     799             :     34096500U,  // BICWrs
     800             :     0U, // BICXrr
     801             :     34096500U,  // BICXrs
     802             :     9588U,      // BICv16i8
     803             :     168846708U, // BICv2i32
     804             :     169895284U, // BICv4i16
     805             :     170419572U, // BICv4i32
     806             :     170943860U, // BICv8i16
     807             :     3224905076U,        // BICv8i8
     808             :     9818U,      // BIFv16i8
     809             :     3224905306U,        // BIFv8i8
     810             :     67137003U,  // BITv16i8
     811             :     3292032491U,        // BITv8i8
     812             :     35200U,     // BL
     813             :     4213947U,   // BLR
     814             :     1107837435U,        // BLRAA
     815             :     4214655U,   // BLRAAZ
     816             :     1107837712U,        // BLRAB
     817             :     4214670U,   // BLRABZ
     818             :     4213907U,   // BR
     819             :     1107837422U,        // BRAA
     820             :     4214648U,   // BRAAZ
     821             :     1107837699U,        // BRAB
     822             :     4214663U,   // BRABZ
     823             :     43245U,     // BRK
     824             :     67136118U,  // BSLv16i8
     825             :     3292031606U,        // BSLv8i8
     826             :     53228U,     // Bcc
     827             :     134800169U, // CASAB
     828             :     134801113U, // CASAH
     829             :     134800310U, // CASALB
     830             :     134801226U, // CASALH
     831             :     134801755U, // CASALW
     832             :     134801755U, // CASALX
     833             :     134800015U, // CASAW
     834             :     134800015U, // CASAX
     835             :     134800593U, // CASB
     836             :     134801537U, // CASH
     837             :     134800404U, // CASLB
     838             :     134801320U, // CASLH
     839             :     134802032U, // CASLW
     840             :     134802032U, // CASLX
     841             :     67898U,     // CASPALW
     842             :     76090U,     // CASPALX
     843             :     66136U,     // CASPAW
     844             :     74328U,     // CASPAX
     845             :     68179U,     // CASPLW
     846             :     76371U,     // CASPLX
     847             :     68635U,     // CASPW
     848             :     76827U,     // CASPX
     849             :     134802744U, // CASW
     850             :     134802744U, // CASX
     851             :     201871269U, // CBNZW
     852             :     201871269U, // CBNZX
     853             :     201871254U, // CBZW
     854             :     201871254U, // CBZX
     855             :     34097962U,  // CCMNWi
     856             :     34097962U,  // CCMNWr
     857             :     34097962U,  // CCMNXi
     858             :     34097962U,  // CCMNXr
     859             :     34098134U,  // CCMPWi
     860             :     34098134U,  // CCMPWr
     861             :     34098134U,  // CCMPXi
     862             :     34098134U,  // CCMPXr
     863             :     4214618U,   // CLREX
     864             :     1107840380U,        // CLSWr
     865             :     1107840380U,        // CLSXr
     866             :     11644U,     // CLSv16i8
     867             :     2148543868U,        // CLSv2i32
     868             :     2108796U,   // CLSv4i16
     869             :     1076374908U,        // CLSv4i32
     870             :     2150641020U,        // CLSv8i16
     871             :     3224907132U,        // CLSv8i8
     872             :     1107840928U,        // CLZWr
     873             :     1107840928U,        // CLZXr
     874             :     12192U,     // CLZv16i8
     875             :     2148544416U,        // CLZv2i32
     876             :     2109344U,   // CLZv4i16
     877             :     1076375456U,        // CLZv4i32
     878             :     2150641568U,        // CLZv8i16
     879             :     3224907680U,        // CLZv8i8
     880             :     11368U,     // CMEQv16i8
     881             :     1073753192U,        // CMEQv16i8rz
     882             :     34098280U,  // CMEQv1i64
     883             :     2181581928U,        // CMEQv1i64rz
     884             :     1074801768U,        // CMEQv2i32
     885             :     3222285416U,        // CMEQv2i32rz
     886             :     1075326056U,        // CMEQv2i64
     887             :     1584232U,   // CMEQv2i64rz
     888             :     2149592168U,        // CMEQv4i16
     889             :     1075850344U,        // CMEQv4i16rz
     890             :     2150116456U,        // CMEQv4i32
     891             :     2150116456U,        // CMEQv4i32rz
     892             :     3224382568U,        // CMEQv8i16
     893             :     3224382568U,        // CMEQv8i16rz
     894             :     3224906856U,        // CMEQv8i8
     895             :     3681384U,   // CMEQv8i8rz
     896             :     9750U,      // CMGEv16i8
     897             :     1073751574U,        // CMGEv16i8rz
     898             :     34096662U,  // CMGEv1i64
     899             :     2181580310U,        // CMGEv1i64rz
     900             :     1074800150U,        // CMGEv2i32
     901             :     3222283798U,        // CMGEv2i32rz
     902             :     1075324438U,        // CMGEv2i64
     903             :     1582614U,   // CMGEv2i64rz
     904             :     2149590550U,        // CMGEv4i16
     905             :     1075848726U,        // CMGEv4i16rz
     906             :     2150114838U,        // CMGEv4i32
     907             :     2150114838U,        // CMGEv4i32rz
     908             :     3224380950U,        // CMGEv8i16
     909             :     3224380950U,        // CMGEv8i16rz
     910             :     3224905238U,        // CMGEv8i8
     911             :     3679766U,   // CMGEv8i8rz
     912             :     11748U,     // CMGTv16i8
     913             :     1073753572U,        // CMGTv16i8rz
     914             :     34098660U,  // CMGTv1i64
     915             :     2181582308U,        // CMGTv1i64rz
     916             :     1074802148U,        // CMGTv2i32
     917             :     3222285796U,        // CMGTv2i32rz
     918             :     1075326436U,        // CMGTv2i64
     919             :     1584612U,   // CMGTv2i64rz
     920             :     2149592548U,        // CMGTv4i16
     921             :     1075850724U,        // CMGTv4i16rz
     922             :     2150116836U,        // CMGTv4i32
     923             :     2150116836U,        // CMGTv4i32rz
     924             :     3224382948U,        // CMGTv8i16
     925             :     3224382948U,        // CMGTv8i16rz
     926             :     3224907236U,        // CMGTv8i8
     927             :     3681764U,   // CMGTv8i8rz
     928             :     10441U,     // CMHIv16i8
     929             :     34097353U,  // CMHIv1i64
     930             :     1074800841U,        // CMHIv2i32
     931             :     1075325129U,        // CMHIv2i64
     932             :     2149591241U,        // CMHIv4i16
     933             :     2150115529U,        // CMHIv4i32
     934             :     3224381641U,        // CMHIv8i16
     935             :     3224905929U,        // CMHIv8i8
     936             :     11638U,     // CMHSv16i8
     937             :     34098550U,  // CMHSv1i64
     938             :     1074802038U,        // CMHSv2i32
     939             :     1075326326U,        // CMHSv2i64
     940             :     2149592438U,        // CMHSv4i16
     941             :     2150116726U,        // CMHSv4i32
     942             :     3224382838U,        // CMHSv8i16
     943             :     3224907126U,        // CMHSv8i8
     944             :     1073751581U,        // CMLEv16i8rz
     945             :     2181580317U,        // CMLEv1i64rz
     946             :     3222283805U,        // CMLEv2i32rz
     947             :     1582621U,   // CMLEv2i64rz
     948             :     1075848733U,        // CMLEv4i16rz
     949             :     2150114845U,        // CMLEv4i32rz
     950             :     3224380957U,        // CMLEv8i16rz
     951             :     3679773U,   // CMLEv8i8rz
     952             :     1073753590U,        // CMLTv16i8rz
     953             :     2181582326U,        // CMLTv1i64rz
     954             :     3222285814U,        // CMLTv2i32rz
     955             :     1584630U,   // CMLTv2i64rz
     956             :     1075850742U,        // CMLTv4i16rz
     957             :     2150116854U,        // CMLTv4i32rz
     958             :     3224382966U,        // CMLTv8i16rz
     959             :     3681782U,   // CMLTv8i8rz
     960             :     0U, // CMP_SWAP_128
     961             :     0U, // CMP_SWAP_16
     962             :     0U, // CMP_SWAP_32
     963             :     0U, // CMP_SWAP_64
     964             :     0U, // CMP_SWAP_8
     965             :     11807U,     // CMTSTv16i8
     966             :     34098719U,  // CMTSTv1i64
     967             :     1074802207U,        // CMTSTv2i32
     968             :     1075326495U,        // CMTSTv2i64
     969             :     2149592607U,        // CMTSTv4i16
     970             :     2150116895U,        // CMTSTv4i32
     971             :     3224383007U,        // CMTSTv8i16
     972             :     3224907295U,        // CMTSTv8i8
     973             :     11772U,     // CNTv16i8
     974             :     3224907260U,        // CNTv8i8
     975             :     1074286269U,        // CPYi16
     976             :     2148028093U,        // CPYi32
     977             :     3221769917U,        // CPYi64
     978             :     544445U,    // CPYi8
     979             :     34095831U,  // CRC32Brr
     980             :     34095949U,  // CRC32CBrr
     981             :     34096893U,  // CRC32CHrr
     982             :     34098937U,  // CRC32CWrr
     983             :     34099025U,  // CRC32CXrr
     984             :     34096776U,  // CRC32Hrr
     985             :     34098915U,  // CRC32Wrr
     986             :     34098990U,  // CRC32Xrr
     987             :     34097623U,  // CSELWr
     988             :     34097623U,  // CSELXr
     989             :     34096520U,  // CSINCWr
     990             :     34096520U,  // CSINCXr
     991             :     34098869U,  // CSINVWr
     992             :     34098869U,  // CSINVXr
     993             :     34096762U,  // CSNEGWr
     994             :     34096762U,  // CSNEGXr
     995             :     0U, // CompilerBarrier
     996             :     41004U,     // DCPS1
     997             :     41369U,     // DCPS2
     998             :     41418U,     // DCPS3
     999             :     83000U,     // DMB
    1000             :     4325U,      // DRPS
    1001             :     83159U,     // DSB
    1002             :     1107307566U,        // DUPv16i8gpr
    1003             :     11310U,     // DUPv16i8lane
    1004             :     1108356142U,        // DUPv2i32gpr
    1005             :     2148543534U,        // DUPv2i32lane
    1006             :     1108880430U,        // DUPv2i64gpr
    1007             :     3222809646U,        // DUPv2i64lane
    1008             :     1109404718U,        // DUPv4i16gpr
    1009             :     1075850286U,        // DUPv4i16lane
    1010             :     1109929006U,        // DUPv4i32gpr
    1011             :     2150116398U,        // DUPv4i32lane
    1012             :     1110453294U,        // DUPv8i16gpr
    1013             :     1076898862U,        // DUPv8i16lane
    1014             :     1110977582U,        // DUPv8i8gpr
    1015             :     3681326U,   // DUPv8i8lane
    1016             :     0U, // EONWrr
    1017             :     34097968U,  // EONWrs
    1018             :     0U, // EONXrr
    1019             :     34097968U,  // EONXrs
    1020             :     34098390U,  // EORWri
    1021             :     0U, // EORWrr
    1022             :     34098390U,  // EORWrs
    1023             :     34098390U,  // EORXri
    1024             :     0U, // EORXrr
    1025             :     34098390U,  // EORXrs
    1026             :     11478U,     // EORv16i8
    1027             :     3224906966U,        // EORv8i8
    1028             :     4330U,      // ERET
    1029             :     4257U,      // ERETAA
    1030             :     4264U,      // ERETAB
    1031             :     34098444U,  // EXTRWrri
    1032             :     34098444U,  // EXTRXrri
    1033             :     11820U,     // EXTv16i8
    1034             :     3224907308U,        // EXTv8i8
    1035             :     0U, // F128CSEL
    1036             :     34096537U,  // FABD16
    1037             :     34096537U,  // FABD32
    1038             :     34096537U,  // FABD64
    1039             :     1074800025U,        // FABDv2f32
    1040             :     1075324313U,        // FABDv2f64
    1041             :     2149590425U,        // FABDv4f16
    1042             :     2150114713U,        // FABDv4f32
    1043             :     3224380825U,        // FABDv8f16
    1044             :     1107840325U,        // FABSDr
    1045             :     1107840325U,        // FABSHr
    1046             :     1107840325U,        // FABSSr
    1047             :     2148543813U,        // FABSv2f32
    1048             :     3222809925U,        // FABSv2f64
    1049             :     2108741U,   // FABSv4f16
    1050             :     1076374853U,        // FABSv4f32
    1051             :     2150640965U,        // FABSv8f16
    1052             :     34096654U,  // FACGE16
    1053             :     34096654U,  // FACGE32
    1054             :     34096654U,  // FACGE64
    1055             :     1074800142U,        // FACGEv2f32
    1056             :     1075324430U,        // FACGEv2f64
    1057             :     2149590542U,        // FACGEv4f16
    1058             :     2150114830U,        // FACGEv4f32
    1059             :     3224380942U,        // FACGEv8f16
    1060             :     34098652U,  // FACGT16
    1061             :     34098652U,  // FACGT32
    1062             :     34098652U,  // FACGT64
    1063             :     1074802140U,        // FACGTv2f32
    1064             :     1075326428U,        // FACGTv2f64
    1065             :     2149592540U,        // FACGTv4f16
    1066             :     2150116828U,        // FACGTv4f32
    1067             :     3224382940U,        // FACGTv8f16
    1068             :     34096576U,  // FADDDrr
    1069             :     34096576U,  // FADDHrr
    1070             :     1074801577U,        // FADDPv2f32
    1071             :     1075325865U,        // FADDPv2f64
    1072             :     1074285481U,        // FADDPv2i16p
    1073             :     2148027305U,        // FADDPv2i32p
    1074             :     3221769129U,        // FADDPv2i64p
    1075             :     2149591977U,        // FADDPv4f16
    1076             :     2150116265U,        // FADDPv4f32
    1077             :     3224382377U,        // FADDPv8f16
    1078             :     34096576U,  // FADDSrr
    1079             :     1074800064U,        // FADDv2f32
    1080             :     1075324352U,        // FADDv2f64
    1081             :     2149590464U,        // FADDv4f16
    1082             :     2150114752U,        // FADDv4f32
    1083             :     3224380864U,        // FADDv8f16
    1084             :     1074800050U,        // FCADDv2f32
    1085             :     1075324338U,        // FCADDv2f64
    1086             :     2149590450U,        // FCADDv4f16
    1087             :     2150114738U,        // FCADDv4f32
    1088             :     3224380850U,        // FCADDv8f16
    1089             :     34098133U,  // FCCMPDrr
    1090             :     34096691U,  // FCCMPEDrr
    1091             :     34096691U,  // FCCMPEHrr
    1092             :     34096691U,  // FCCMPESrr
    1093             :     34098133U,  // FCCMPHrr
    1094             :     34098133U,  // FCCMPSrr
    1095             :     34098279U,  // FCMEQ16
    1096             :     34098279U,  // FCMEQ32
    1097             :     34098279U,  // FCMEQ64
    1098             :     2181581927U,        // FCMEQv1i16rz
    1099             :     2181581927U,        // FCMEQv1i32rz
    1100             :     2181581927U,        // FCMEQv1i64rz
    1101             :     1074801767U,        // FCMEQv2f32
    1102             :     1075326055U,        // FCMEQv2f64
    1103             :     3222285415U,        // FCMEQv2i32rz
    1104             :     1584231U,   // FCMEQv2i64rz
    1105             :     2149592167U,        // FCMEQv4f16
    1106             :     2150116455U,        // FCMEQv4f32
    1107             :     1075850343U,        // FCMEQv4i16rz
    1108             :     2150116455U,        // FCMEQv4i32rz
    1109             :     3224382567U,        // FCMEQv8f16
    1110             :     3224382567U,        // FCMEQv8i16rz
    1111             :     34096661U,  // FCMGE16
    1112             :     34096661U,  // FCMGE32
    1113             :     34096661U,  // FCMGE64
    1114             :     2181580309U,        // FCMGEv1i16rz
    1115             :     2181580309U,        // FCMGEv1i32rz
    1116             :     2181580309U,        // FCMGEv1i64rz
    1117             :     1074800149U,        // FCMGEv2f32
    1118             :     1075324437U,        // FCMGEv2f64
    1119             :     3222283797U,        // FCMGEv2i32rz
    1120             :     1582613U,   // FCMGEv2i64rz
    1121             :     2149590549U,        // FCMGEv4f16
    1122             :     2150114837U,        // FCMGEv4f32
    1123             :     1075848725U,        // FCMGEv4i16rz
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    1125             :     3224380949U,        // FCMGEv8f16
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    1130             :     2181582307U,        // FCMGTv1i16rz
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    1139             :     1075850723U,        // FCMGTv4i16rz
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    1142             :     3224382947U,        // FCMGTv8i16rz
    1143             :     1141924409U,        // FCMLAv2f32
    1144             :     1142448697U,        // FCMLAv2f64
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    1146             :     2216714809U,        // FCMLAv4f16_indexed
    1147             :     2217239097U,        // FCMLAv4f32
    1148             :     2217239097U,        // FCMLAv4f32_indexed
    1149             :     3291505209U,        // FCMLAv8f16
    1150             :     3291505209U,        // FCMLAv8f16_indexed
    1151             :     2181580316U,        // FCMLEv1i16rz
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    1160             :     2181582325U,        // FCMLTv1i32rz
    1161             :     2181582325U,        // FCMLTv1i64rz
    1162             :     3222285813U,        // FCMLTv2i32rz
    1163             :     1584629U,   // FCMLTv2i64rz
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    1165             :     2150116853U,        // FCMLTv4i32rz
    1166             :     3224382965U,        // FCMLTv8i16rz
    1167             :     4738012U,   // FCMPDri
    1168             :     1107839964U,        // FCMPDrr
    1169             :     4736571U,   // FCMPEDri
    1170             :     1107838523U,        // FCMPEDrr
    1171             :     4736571U,   // FCMPEHri
    1172             :     1107838523U,        // FCMPEHrr
    1173             :     4736571U,   // FCMPESri
    1174             :     1107838523U,        // FCMPESrr
    1175             :     4738012U,   // FCMPHri
    1176             :     1107839964U,        // FCMPHrr
    1177             :     4738012U,   // FCMPSri
    1178             :     1107839964U,        // FCMPSrr
    1179             :     34097622U,  // FCSELDrrr
    1180             :     34097622U,  // FCSELHrrr
    1181             :     34097622U,  // FCSELSrrr
    1182             :     1107840317U,        // FCVTASUWDr
    1183             :     1107840317U,        // FCVTASUWHr
    1184             :     1107840317U,        // FCVTASUWSr
    1185             :     1107840317U,        // FCVTASUXDr
    1186             :     1107840317U,        // FCVTASUXHr
    1187             :     1107840317U,        // FCVTASUXSr
    1188             :     1107840317U,        // FCVTASv1f16
    1189             :     1107840317U,        // FCVTASv1i32
    1190             :     1107840317U,        // FCVTASv1i64
    1191             :     2148543805U,        // FCVTASv2f32
    1192             :     3222809917U,        // FCVTASv2f64
    1193             :     2108733U,   // FCVTASv4f16
    1194             :     1076374845U,        // FCVTASv4f32
    1195             :     2150640957U,        // FCVTASv8f16
    1196             :     1107840561U,        // FCVTAUUWDr
    1197             :     1107840561U,        // FCVTAUUWHr
    1198             :     1107840561U,        // FCVTAUUWSr
    1199             :     1107840561U,        // FCVTAUUXDr
    1200             :     1107840561U,        // FCVTAUUXHr
    1201             :     1107840561U,        // FCVTAUUXSr
    1202             :     1107840561U,        // FCVTAUv1f16
    1203             :     1107840561U,        // FCVTAUv1i32
    1204             :     1107840561U,        // FCVTAUv1i64
    1205             :     2148544049U,        // FCVTAUv2f32
    1206             :     3222810161U,        // FCVTAUv2f64
    1207             :     2108977U,   // FCVTAUv4f16
    1208             :     1076375089U,        // FCVTAUv4f32
    1209             :     2150641201U,        // FCVTAUv8f16
    1210             :     1107840550U,        // FCVTDHr
    1211             :     1107840550U,        // FCVTDSr
    1212             :     1107840550U,        // FCVTHDr
    1213             :     1107840550U,        // FCVTHSr
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    1216             :     1075323144U,        // FCVTLv4i32
    1217             :     2150113544U,        // FCVTLv8i16
    1218             :     1107840391U,        // FCVTMSUWDr
    1219             :     1107840391U,        // FCVTMSUWHr
    1220             :     1107840391U,        // FCVTMSUWSr
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    1222             :     1107840391U,        // FCVTMSUXHr
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    1226             :     1107840391U,        // FCVTMSv1i64
    1227             :     2148543879U,        // FCVTMSv2f32
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    1230             :     1076374919U,        // FCVTMSv4f32
    1231             :     2150641031U,        // FCVTMSv8f16
    1232             :     1107840577U,        // FCVTMUUWDr
    1233             :     1107840577U,        // FCVTMUUWHr
    1234             :     1107840577U,        // FCVTMUUWSr
    1235             :     1107840577U,        // FCVTMUUXDr
    1236             :     1107840577U,        // FCVTMUUXHr
    1237             :     1107840577U,        // FCVTMUUXSr
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    1240             :     1107840577U,        // FCVTMUv1i64
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    1242             :     3222810177U,        // FCVTMUv2f64
    1243             :     2108993U,   // FCVTMUv4f16
    1244             :     1076375105U,        // FCVTMUv4f32
    1245             :     2150641217U,        // FCVTMUv8f16
    1246             :     1107840404U,        // FCVTNSUWDr
    1247             :     1107840404U,        // FCVTNSUWHr
    1248             :     1107840404U,        // FCVTNSUWSr
    1249             :     1107840404U,        // FCVTNSUXDr
    1250             :     1107840404U,        // FCVTNSUXHr
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    1263             :     1107840585U,        // FCVTNUUXDr
    1264             :     1107840585U,        // FCVTNUUXHr
    1265             :     1107840585U,        // FCVTNUUXSr
    1266             :     1107840585U,        // FCVTNUv1f16
    1267             :     1107840585U,        // FCVTNUv1i32
    1268             :     1107840585U,        // FCVTNUv1i64
    1269             :     2148544073U,        // FCVTNUv2f32
    1270             :     3222810185U,        // FCVTNUv2f64
    1271             :     2109001U,   // FCVTNUv4f16
    1272             :     1076375113U,        // FCVTNUv4f32
    1273             :     2150641225U,        // FCVTNUv8f16
    1274             :     3222285156U,        // FCVTNv2i32
    1275             :     1075850084U,        // FCVTNv4i16
    1276             :     3290980686U,        // FCVTNv4i32
    1277             :     1144021326U,        // FCVTNv8i16
    1278             :     1107840420U,        // FCVTPSUWDr
    1279             :     1107840420U,        // FCVTPSUWHr
    1280             :     1107840420U,        // FCVTPSUWSr
    1281             :     1107840420U,        // FCVTPSUXDr
    1282             :     1107840420U,        // FCVTPSUXHr
    1283             :     1107840420U,        // FCVTPSUXSr
    1284             :     1107840420U,        // FCVTPSv1f16
    1285             :     1107840420U,        // FCVTPSv1i32
    1286             :     1107840420U,        // FCVTPSv1i64
    1287             :     2148543908U,        // FCVTPSv2f32
    1288             :     3222810020U,        // FCVTPSv2f64
    1289             :     2108836U,   // FCVTPSv4f16
    1290             :     1076374948U,        // FCVTPSv4f32
    1291             :     2150641060U,        // FCVTPSv8f16
    1292             :     1107840593U,        // FCVTPUUWDr
    1293             :     1107840593U,        // FCVTPUUWHr
    1294             :     1107840593U,        // FCVTPUUWSr
    1295             :     1107840593U,        // FCVTPUUXDr
    1296             :     1107840593U,        // FCVTPUUXHr
    1297             :     1107840593U,        // FCVTPUUXSr
    1298             :     1107840593U,        // FCVTPUv1f16
    1299             :     1107840593U,        // FCVTPUv1i32
    1300             :     1107840593U,        // FCVTPUv1i64
    1301             :     2148544081U,        // FCVTPUv2f32
    1302             :     3222810193U,        // FCVTPUv2f64
    1303             :     2109009U,   // FCVTPUv4f16
    1304             :     1076375121U,        // FCVTPUv4f32
    1305             :     2150641233U,        // FCVTPUv8f16
    1306             :     1107840550U,        // FCVTSDr
    1307             :     1107840550U,        // FCVTSHr
    1308             :     1107839898U,        // FCVTXNv1i64
    1309             :     3222285210U,        // FCVTXNv2f32
    1310             :     3290980740U,        // FCVTXNv4f32
    1311             :     34098623U,  // FCVTZSSWDri
    1312             :     34098623U,  // FCVTZSSWHri
    1313             :     34098623U,  // FCVTZSSWSri
    1314             :     34098623U,  // FCVTZSSXDri
    1315             :     34098623U,  // FCVTZSSXHri
    1316             :     34098623U,  // FCVTZSSXSri
    1317             :     1107840447U,        // FCVTZSUWDr
    1318             :     1107840447U,        // FCVTZSUWHr
    1319             :     1107840447U,        // FCVTZSUWSr
    1320             :     1107840447U,        // FCVTZSUXDr
    1321             :     1107840447U,        // FCVTZSUXHr
    1322             :     1107840447U,        // FCVTZSUXSr
    1323             :     34098623U,  // FCVTZSd
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    1325             :     34098623U,  // FCVTZSs
    1326             :     1107840447U,        // FCVTZSv1f16
    1327             :     1107840447U,        // FCVTZSv1i32
    1328             :     1107840447U,        // FCVTZSv1i64
    1329             :     2148543935U,        // FCVTZSv2f32
    1330             :     3222810047U,        // FCVTZSv2f64
    1331             :     1074802111U,        // FCVTZSv2i32_shift
    1332             :     1075326399U,        // FCVTZSv2i64_shift
    1333             :     2108863U,   // FCVTZSv4f16
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    1336             :     2150116799U,        // FCVTZSv4i32_shift
    1337             :     2150641087U,        // FCVTZSv8f16
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    1339             :     34098777U,  // FCVTZUSWDri
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    1344             :     34098777U,  // FCVTZUSXSri
    1345             :     1107840601U,        // FCVTZUUWDr
    1346             :     1107840601U,        // FCVTZUUWHr
    1347             :     1107840601U,        // FCVTZUUWSr
    1348             :     1107840601U,        // FCVTZUUXDr
    1349             :     1107840601U,        // FCVTZUUXHr
    1350             :     1107840601U,        // FCVTZUUXSr
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    1355             :     1107840601U,        // FCVTZUv1i32
    1356             :     1107840601U,        // FCVTZUv1i64
    1357             :     2148544089U,        // FCVTZUv2f32
    1358             :     3222810201U,        // FCVTZUv2f64
    1359             :     1074802265U,        // FCVTZUv2i32_shift
    1360             :     1075326553U,        // FCVTZUv2i64_shift
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    1363             :     2149592665U,        // FCVTZUv4i16_shift
    1364             :     2150116953U,        // FCVTZUv4i32_shift
    1365             :     2150641241U,        // FCVTZUv8f16
    1366             :     3224383065U,        // FCVTZUv8i16_shift
    1367             :     34098796U,  // FDIVDrr
    1368             :     34098796U,  // FDIVHrr
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    1370             :     1074802284U,        // FDIVv2f32
    1371             :     1075326572U,        // FDIVv2f64
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    1373             :     2150116972U,        // FDIVv4f32
    1374             :     3224383084U,        // FDIVv8f16
    1375             :     1107840455U,        // FJCVTZS
    1376             :     34096612U,  // FMADDDrrr
    1377             :     34096612U,  // FMADDHrrr
    1378             :     34096612U,  // FMADDSrrr
    1379             :     34098998U,  // FMAXDrr
    1380             :     34098998U,  // FMAXHrr
    1381             :     34097901U,  // FMAXNMDrr
    1382             :     34097901U,  // FMAXNMHrr
    1383             :     1074801643U,        // FMAXNMPv2f32
    1384             :     1075325931U,        // FMAXNMPv2f64
    1385             :     1074285547U,        // FMAXNMPv2i16p
    1386             :     2148027371U,        // FMAXNMPv2i32p
    1387             :     3221769195U,        // FMAXNMPv2i64p
    1388             :     2149592043U,        // FMAXNMPv4f16
    1389             :     2150116331U,        // FMAXNMPv4f32
    1390             :     3224382443U,        // FMAXNMPv8f16
    1391             :     34097901U,  // FMAXNMSrr
    1392             :     544407U,    // FMAXNMVv4i16v
    1393             :     1074286231U,        // FMAXNMVv4i32v
    1394             :     2148028055U,        // FMAXNMVv8i16v
    1395             :     1074801389U,        // FMAXNMv2f32
    1396             :     1075325677U,        // FMAXNMv2f64
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    1398             :     2150116077U,        // FMAXNMv4f32
    1399             :     3224382189U,        // FMAXNMv8f16
    1400             :     1074801727U,        // FMAXPv2f32
    1401             :     1075326015U,        // FMAXPv2f64
    1402             :     1074285631U,        // FMAXPv2i16p
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    1404             :     3221769279U,        // FMAXPv2i64p
    1405             :     2149592127U,        // FMAXPv4f16
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    1408             :     34098998U,  // FMAXSrr
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    1420             :     34097893U,  // FMINNMHrr
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    1422             :     1075325922U,        // FMINNMPv2f64
    1423             :     1074285538U,        // FMINNMPv2i16p
    1424             :     2148027362U,        // FMINNMPv2i32p
    1425             :     3221769186U,        // FMINNMPv2i64p
    1426             :     2149592034U,        // FMINNMPv4f16
    1427             :     2150116322U,        // FMINNMPv4f32
    1428             :     3224382434U,        // FMINNMPv8f16
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    1576             :     1107837597U,        // FRINTADr
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    1906             :     52972830U,  // LDAXRW
    1907             :     52972830U,  // LDAXRX
    1908             :     336126743U, // LDCLRAB
    1909             :     336127687U, // LDCLRAH
    1910             :     336126882U, // LDCLRALB
    1911             :     336127798U, // LDCLRALH
    1912             :     336128329U, // LDCLRALW
    1913             :     336128329U, // LDCLRALX
    1914             :     336126565U, // LDCLRAW
    1915             :     336126565U, // LDCLRAX
    1916             :     336127082U, // LDCLRB
    1917             :     336128026U, // LDCLRH
    1918             :     336126978U, // LDCLRLB
    1919             :     336127894U, // LDCLRLH
    1920             :     336128608U, // LDCLRLW
    1921             :     336128608U, // LDCLRLX
    1922             :     336129216U, // LDCLRW
    1923             :     336129216U, // LDCLRX
    1924             :     336126752U, // LDEORAB
    1925             :     336127696U, // LDEORAH
    1926             :     336126892U, // LDEORALB
    1927             :     336127808U, // LDEORALH
    1928             :     336128338U, // LDEORALW
    1929             :     336128338U, // LDEORALX
    1930             :     336126573U, // LDEORAW
    1931             :     336126573U, // LDEORAX
    1932             :     336127105U, // LDEORB
    1933             :     336128049U, // LDEORH
    1934             :     336126987U, // LDEORLB
    1935             :     336127903U, // LDEORLH
    1936             :     336128616U, // LDEORLW
    1937             :     336128616U, // LDEORLX
    1938             :     336129236U, // LDEORW
    1939             :     336129236U, // LDEORX
    1940             :     52970588U,  // LDLARB
    1941             :     52971532U,  // LDLARH
    1942             :     52972684U,  // LDLARW
    1943             :     52972684U,  // LDLARX
    1944             :     34098164U,  // LDNPDi
    1945             :     34098164U,  // LDNPQi
    1946             :     34098164U,  // LDNPSi
    1947             :     34098164U,  // LDNPWi
    1948             :     34098164U,  // LDNPXi
    1949             :     34098096U,  // LDPDi
    1950             :     134802352U, // LDPDpost
    1951             :     134802352U, // LDPDpre
    1952             :     34098096U,  // LDPQi
    1953             :     134802352U, // LDPQpost
    1954             :     134802352U, // LDPQpre
    1955             :     34098960U,  // LDPSWi
    1956             :     134803216U, // LDPSWpost
    1957             :     134803216U, // LDPSWpre
    1958             :     34098096U,  // LDPSi
    1959             :     134802352U, // LDPSpost
    1960             :     134802352U, // LDPSpre
    1961             :     34098096U,  // LDPWi
    1962             :     134802352U, // LDPWpost
    1963             :     134802352U, // LDPWpre
    1964             :     34098096U,  // LDPXi
    1965             :     134802352U, // LDPXpost
    1966             :     134802352U, // LDPXpre
    1967             :     52969972U,  // LDRAAindexed
    1968             :     153674228U, // LDRAAwriteback
    1969             :     52970249U,  // LDRABindexed
    1970             :     153674505U, // LDRABwriteback
    1971             :     1227416676U,        // LDRBBpost
    1972             :     153674852U, // LDRBBpre
    1973             :     52970596U,  // LDRBBroW
    1974             :     52970596U,  // LDRBBroX
    1975             :     52970596U,  // LDRBBui
    1976             :     1227418780U,        // LDRBpost
    1977             :     153676956U, // LDRBpre
    1978             :     52972700U,  // LDRBroW
    1979             :     52972700U,  // LDRBroX
    1980             :     52972700U,  // LDRBui
    1981             :     201870492U, // LDRDl
    1982             :     1227418780U,        // LDRDpost
    1983             :     153676956U, // LDRDpre
    1984             :     52972700U,  // LDRDroW
    1985             :     52972700U,  // LDRDroX
    1986             :     52972700U,  // LDRDui
    1987             :     1227417620U,        // LDRHHpost
    1988             :     153675796U, // LDRHHpre
    1989             :     52971540U,  // LDRHHroW
    1990             :     52971540U,  // LDRHHroX
    1991             :     52971540U,  // LDRHHui
    1992             :     1227418780U,        // LDRHpost
    1993             :     153676956U, // LDRHpre
    1994             :     52972700U,  // LDRHroW
    1995             :     52972700U,  // LDRHroX
    1996             :     52972700U,  // LDRHui
    1997             :     201870492U, // LDRQl
    1998             :     1227418780U,        // LDRQpost
    1999             :     153676956U, // LDRQpre
    2000             :     52972700U,  // LDRQroW
    2001             :     52972700U,  // LDRQroX
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    2003             :     1227416801U,        // LDRSBWpost
    2004             :     153674977U, // LDRSBWpre
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    2008             :     1227416801U,        // LDRSBXpost
    2009             :     153674977U, // LDRSBXpre
    2010             :     52970721U,  // LDRSBXroW
    2011             :     52970721U,  // LDRSBXroX
    2012             :     52970721U,  // LDRSBXui
    2013             :     1227417745U,        // LDRSHWpost
    2014             :     153675921U, // LDRSHWpre
    2015             :     52971665U,  // LDRSHWroW
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    2017             :     52971665U,  // LDRSHWui
    2018             :     1227417745U,        // LDRSHXpost
    2019             :     153675921U, // LDRSHXpre
    2020             :     52971665U,  // LDRSHXroW
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    2022             :     52971665U,  // LDRSHXui
    2023             :     201871127U, // LDRSWl
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    2090             :     336127867U, // LDSMINLH
    2091             :     336128577U, // LDSMINLW
    2092             :     336128577U, // LDSMINLX
    2093             :     336128794U, // LDSMINW
    2094             :     336128794U, // LDSMINX
    2095             :     52970641U,  // LDTRBi
    2096             :     52971585U,  // LDTRHi
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    2099             :     52971672U,  // LDTRSHWi
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    2101             :     52973342U,  // LDTRSWi
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    2103             :     52972795U,  // LDTRXi
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    2107             :     336127847U, // LDUMAXALH
    2108             :     336128373U, // LDUMAXALW
    2109             :     336128373U, // LDUMAXALX
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    2111             :     336126638U, // LDUMAXAX
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    2113             :     336128185U, // LDUMAXH
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    2156             :     0U, // LOADgot
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    2166             :     2216714811U,        // MLAv4i16
    2167             :     2216714811U,        // MLAv4i16_indexed
    2168             :     2217239099U,        // MLAv4i32
    2169             :     2217239099U,        // MLAv4i32_indexed
    2170             :     3291505211U,        // MLAv8i16
    2171             :     3291505211U,        // MLAv8i16_indexed
    2172             :     3292029499U,        // MLAv8i8
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    2176             :     2216717698U,        // MLSv4i16
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    2179             :     2217241986U,        // MLSv4i32_indexed
    2180             :     3291508098U,        // MLSv8i16
    2181             :     3291508098U,        // MLSv8i16_indexed
    2182             :     3292032386U,        // MLSv8i8
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    2198             :     2550681529U,        // MOVZXi
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    2209             :     298230U,    // MSR
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    2214             :     10920U,     // MULv16i8
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    2216             :     1074801320U,        // MULv2i32_indexed
    2217             :     2149591720U,        // MULv4i16
    2218             :     2149591720U,        // MULv4i16_indexed
    2219             :     2150116008U,        // MULv4i32
    2220             :     2150116008U,        // MULv4i32_indexed
    2221             :     3224382120U,        // MULv8i16
    2222             :     3224382120U,        // MULv8i16_indexed
    2223             :     3224906408U,        // MULv8i8
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    2233             :     3222808174U,        // NEGv2i64
    2234             :     2106990U,   // NEGv4i16
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    2236             :     2150639214U,        // NEGv8i16
    2237             :     3224905326U,        // NEGv8i8
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    2239             :     3224907283U,        // NOTv8i8
    2240             :     0U, // ORNWrr
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    2243             :     34098007U,  // ORNXrs
    2244             :     11095U,     // ORNv16i8
    2245             :     3224906583U,        // ORNv8i8
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    2251             :     34098407U,  // ORRXrs
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    2257             :     3224906983U,        // ORRv8i8
    2258             :     1107837454U,        // PACDA
    2259             :     1107837782U,        // PACDB
    2260             :     4211383U,   // PACDZA
    2261             :     4212035U,   // PACDZB
    2262             :     34095652U,  // PACGA
    2263             :     1107837483U,        // PACIA
    2264             :     4172U,      // PACIA1716
    2265             :     4293U,      // PACIASP
    2266             :     4335U,      // PACIAZ
    2267             :     1107837804U,        // PACIB
    2268             :     4192U,      // PACIB1716
    2269             :     4309U,      // PACIBSP
    2270             :     4349U,      // PACIBZ
    2271             :     4211399U,   // PACIZA
    2272             :     4212051U,   // PACIZB
    2273             :     3154134U,   // PMULLv16i8
    2274             :     489695788U, // PMULLv1i64
    2275             :     523247830U, // PMULLv2i64
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    2277             :     10932U,     // PMULv16i8
    2278             :     3224906420U,        // PMULv8i8
    2279             :     202164959U, // PRFMl
    2280             :     53267167U,  // PRFMroW
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    2282             :     53267167U,  // PRFMui
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    2284             :     1074801420U,        // RADDHNv2i64_v2i32
    2285             :     1143496985U,        // RADDHNv2i64_v4i32
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    2289             :     3224906508U,        // RADDHNv8i16_v8i8
    2290             :     1107840490U,        // RBITWr
    2291             :     1107840490U,        // RBITXr
    2292             :     11754U,     // RBITv16i8
    2293             :     3224907242U,        // RBITv8i8
    2294             :     4214224U,   // RET
    2295             :     4258U,      // RETAA
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    2297             :     0U, // RET_ReallyLR
    2298             :     1107837415U,        // REV16Wr
    2299             :     1107837415U,        // REV16Xr
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    2303             :     8268U,      // REV32v16i8
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    2307             :     8662U,      // REV64v16i8
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    3172             :     0U, // TLSDESC_CALLSEQ
    3173             :     8218U,      // TRN1v16i8
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    3182             :     1075323208U,        // TRN2v2i64
    3183             :     2149589320U,        // TRN2v4i16
    3184             :     2150113608U,        // TRN2v4i32
    3185             :     3224379720U,        // TRN2v8i16
    3186             :     3224904008U,        // TRN2v8i8
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    3201             :     2150115753U,        // UABDLv4i16_v4i32
    3202             :     2149064868U,        // UABDLv4i32_v2i64
    3203             :     3223855268U,        // UABDLv8i16_v4i32
    3204             :     3224381865U,        // UABDLv8i8_v8i16
    3205             :     9637U,      // UABDv16i8
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    3565             :   };
    3566             : 
    3567             :   static const uint16_t OpInfo1[] = {
    3568             :     0U, // PHI
    3569             :     0U, // INLINEASM
    3570             :     0U, // CFI_INSTRUCTION
    3571             :     0U, // EH_LABEL
    3572             :     0U, // GC_LABEL
    3573             :     0U, // ANNOTATION_LABEL
    3574             :     0U, // KILL
    3575             :     0U, // EXTRACT_SUBREG
    3576             :     0U, // INSERT_SUBREG
    3577             :     0U, // IMPLICIT_DEF
    3578             :     0U, // SUBREG_TO_REG
    3579             :     0U, // COPY_TO_REGCLASS
    3580             :     0U, // DBG_VALUE
    3581             :     0U, // REG_SEQUENCE
    3582             :     0U, // COPY
    3583             :     0U, // BUNDLE
    3584             :     0U, // LIFETIME_START
    3585             :     0U, // LIFETIME_END
    3586             :     0U, // STACKMAP
    3587             :     0U, // FENTRY_CALL
    3588             :     0U, // PATCHPOINT
    3589             :     0U, // LOAD_STACK_GUARD
    3590             :     0U, // STATEPOINT
    3591             :     0U, // LOCAL_ESCAPE
    3592             :     0U, // FAULTING_OP
    3593             :     0U, // PATCHABLE_OP
    3594             :     0U, // PATCHABLE_FUNCTION_ENTER
    3595             :     0U, // PATCHABLE_RET
    3596             :     0U, // PATCHABLE_FUNCTION_EXIT
    3597             :     0U, // PATCHABLE_TAIL_CALL
    3598             :     0U, // PATCHABLE_EVENT_CALL
    3599             :     0U, // G_ADD
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    3609             :     0U, // G_IMPLICIT_DEF
    3610             :     0U, // G_PHI
    3611             :     0U, // G_FRAME_INDEX
    3612             :     0U, // G_GLOBAL_VALUE
    3613             :     0U, // G_EXTRACT
    3614             :     0U, // G_UNMERGE_VALUES
    3615             :     0U, // G_INSERT
    3616             :     0U, // G_MERGE_VALUES
    3617             :     0U, // G_PTRTOINT
    3618             :     0U, // G_INTTOPTR
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    3620             :     0U, // G_LOAD
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    3625             :     0U, // G_INTRINSIC_W_SIDE_EFFECTS
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    3630             :     0U, // G_VASTART
    3631             :     0U, // G_VAARG
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    3663             :     0U, // G_FPTOUI
    3664             :     0U, // G_SITOFP
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    3671             :     0U, // G_SHUFFLE_VECTOR
    3672             :     0U, // ABSv16i8
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    3682             :     2U, // ADCWr
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    3684             :     530U,       // ADDHNv2i64_v2i32
    3685             :     546U,       // ADDHNv2i64_v4i32
    3686             :     1042U,      // ADDHNv4i32_v4i16
    3687             :     1058U,      // ADDHNv4i32_v8i16
    3688             :     1570U,      // ADDHNv8i16_v16i8
    3689             :     1554U,      // ADDHNv8i16_v8i8
    3690             :     2067U,      // ADDPv16i8
    3691             :     2579U,      // ADDPv2i32
    3692             :     530U,       // ADDPv2i64
    3693             :     0U, // ADDPv2i64p
    3694             :     3091U,      // ADDPv4i16
    3695             :     1042U,      // ADDPv4i32
    3696             :     1554U,      // ADDPv8i16
    3697             :     3603U,      // ADDPv8i8
    3698             :     50U,        // ADDSWri
    3699             :     0U, // ADDSWrr
    3700             :     66U,        // ADDSWrs
    3701             :     82U,        // ADDSWrx
    3702             :     50U,        // ADDSXri
    3703             :     0U, // ADDSXrr
    3704             :     66U,        // ADDSXrs
    3705             :     82U,        // ADDSXrx
    3706             :     4098U,      // ADDSXrx64
    3707             :     0U, // ADDVv16i8v
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    3713             :     0U, // ADDWrr
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    3729             :     0U, // ADJCALLSTACKDOWN
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    3731             :     0U, // ADR
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    3772             :     0U, // BICSWrr
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    3814             :     5252U,      // CASH
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    3819             :     0U, // CASPALW
    3820             :     0U, // CASPALX
    3821             :     0U, // CASPAW
    3822             :     0U, // CASPAX
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    3824             :     0U, // CASPLX
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    3827             :     5252U,      // CASW
    3828             :     5252U,      // CASX
    3829             :     0U, // CBNZW
    3830             :     0U, // CBNZX
    3831             :     0U, // CBZW
    3832             :     0U, // CBZX
    3833             :     20994U,     // CCMNWi
    3834             :     20994U,     // CCMNWr
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    3837             :     20994U,     // CCMPWi
    3838             :     20994U,     // CCMPWr
    3839             :     20994U,     // CCMPXi
    3840             :     20994U,     // CCMPXr
    3841             :     0U, // CLREX
    3842             :     0U, // CLSWr
    3843             :     0U, // CLSXr
    3844             :     0U, // CLSv16i8
    3845             :     0U, // CLSv2i32
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    3895             :     4U, // CMGTv2i32rz
    3896             :     530U,       // CMGTv2i64
    3897             :     5U, // CMGTv2i64rz
    3898             :     3091U,      // CMGTv4i16
    3899             :     5U, // CMGTv4i16rz
    3900             :     1042U,      // CMGTv4i32
    3901             :     5U, // CMGTv4i32rz
    3902             :     1554U,      // CMGTv8i16
    3903             :     5U, // CMGTv8i16rz
    3904             :     3603U,      // CMGTv8i8
    3905             :     6U, // CMGTv8i8rz
    3906             :     2067U,      // CMHIv16i8
    3907             :     2U, // CMHIv1i64
    3908             :     2579U,      // CMHIv2i32
    3909             :     530U,       // CMHIv2i64
    3910             :     3091U,      // CMHIv4i16
    3911             :     1042U,      // CMHIv4i32
    3912             :     1554U,      // CMHIv8i16
    3913             :     3603U,      // CMHIv8i8
    3914             :     2067U,      // CMHSv16i8
    3915             :     2U, // CMHSv1i64
    3916             :     2579U,      // CMHSv2i32
    3917             :     530U,       // CMHSv2i64
    3918             :     3091U,      // CMHSv4i16
    3919             :     1042U,      // CMHSv4i32
    3920             :     1554U,      // CMHSv8i16
    3921             :     3603U,      // CMHSv8i8
    3922             :     4U, // CMLEv16i8rz
    3923             :     4U, // CMLEv1i64rz
    3924             :     4U, // CMLEv2i32rz
    3925             :     5U, // CMLEv2i64rz
    3926             :     5U, // CMLEv4i16rz
    3927             :     5U, // CMLEv4i32rz
    3928             :     5U, // CMLEv8i16rz
    3929             :     6U, // CMLEv8i8rz
    3930             :     4U, // CMLTv16i8rz
    3931             :     4U, // CMLTv1i64rz
    3932             :     4U, // CMLTv2i32rz
    3933             :     5U, // CMLTv2i64rz
    3934             :     5U, // CMLTv4i16rz
    3935             :     5U, // CMLTv4i32rz
    3936             :     5U, // CMLTv8i16rz
    3937             :     6U, // CMLTv8i8rz
    3938             :     0U, // CMP_SWAP_128
    3939             :     0U, // CMP_SWAP_16
    3940             :     0U, // CMP_SWAP_32
    3941             :     0U, // CMP_SWAP_64
    3942             :     0U, // CMP_SWAP_8
    3943             :     2067U,      // CMTSTv16i8
    3944             :     2U, // CMTSTv1i64
    3945             :     2579U,      // CMTSTv2i32
    3946             :     530U,       // CMTSTv2i64
    3947             :     3091U,      // CMTSTv4i16
    3948             :     1042U,      // CMTSTv4i32
    3949             :     1554U,      // CMTSTv8i16
    3950             :     3603U,      // CMTSTv8i8
    3951             :     0U, // CNTv16i8
    3952             :     1U, // CNTv8i8
    3953             :     150U,       // CPYi16
    3954             :     150U,       // CPYi32
    3955             :     150U,       // CPYi64
    3956             :     151U,       // CPYi8
    3957             :     2U, // CRC32Brr
    3958             :     2U, // CRC32CBrr
    3959             :     2U, // CRC32CHrr
    3960             :     2U, // CRC32CWrr
    3961             :     2U, // CRC32CXrr
    3962             :     2U, // CRC32Hrr
    3963             :     2U, // CRC32Wrr
    3964             :     2U, // CRC32Xrr
    3965             :     20994U,     // CSELWr
    3966             :     20994U,     // CSELXr
    3967             :     20994U,     // CSINCWr
    3968             :     20994U,     // CSINCXr
    3969             :     20994U,     // CSINVWr
    3970             :     20994U,     // CSINVXr
    3971             :     20994U,     // CSNEGWr
    3972             :     20994U,     // CSNEGXr
    3973             :     0U, // CompilerBarrier
    3974             :     0U, // DCPS1
    3975             :     0U, // DCPS2
    3976             :     0U, // DCPS3
    3977             :     0U, // DMB
    3978             :     0U, // DRPS
    3979             :     0U, // DSB
    3980             :     0U, // DUPv16i8gpr
    3981             :     151U,       // DUPv16i8lane
    3982             :     0U, // DUPv2i32gpr
    3983             :     150U,       // DUPv2i32lane
    3984             :     0U, // DUPv2i64gpr
    3985             :     150U,       // DUPv2i64lane
    3986             :     0U, // DUPv4i16gpr
    3987             :     150U,       // DUPv4i16lane
    3988             :     0U, // DUPv4i32gpr
    3989             :     150U,       // DUPv4i32lane
    3990             :     0U, // DUPv8i16gpr
    3991             :     150U,       // DUPv8i16lane
    3992             :     0U, // DUPv8i8gpr
    3993             :     151U,       // DUPv8i8lane
    3994             :     0U, // EONWrr
    3995             :     66U,        // EONWrs
    3996             :     0U, // EONXrr
    3997             :     66U,        // EONXrs
    3998             :     98U,        // EORWri
    3999             :     0U, // EORWrr
    4000             :     66U,        // EORWrs
    4001             :     114U,       // EORXri
    4002             :     0U, // EORXrr
    4003             :     66U,        // EORXrs
    4004             :     2067U,      // EORv16i8
    4005             :     3603U,      // EORv8i8
    4006             :     0U, // ERET
    4007             :     0U, // ERETAA
    4008             :     0U, // ERETAB
    4009             :     37378U,     // EXTRWrri
    4010             :     37378U,     // EXTRXrri
    4011             :     5651U,      // EXTv16i8
    4012             :     6163U,      // EXTv8i8
    4013             :     0U, // F128CSEL
    4014             :     2U, // FABD16
    4015             :     2U, // FABD32
    4016             :     2U, // FABD64
    4017             :     2579U,      // FABDv2f32
    4018             :     530U,       // FABDv2f64
    4019             :     3091U,      // FABDv4f16
    4020             :     1042U,      // FABDv4f32
    4021             :     1554U,      // FABDv8f16
    4022             :     0U, // FABSDr
    4023             :     0U, // FABSHr
    4024             :     0U, // FABSSr
    4025             :     0U, // FABSv2f32
    4026             :     0U, // FABSv2f64
    4027             :     1U, // FABSv4f16
    4028             :     1U, // FABSv4f32
    4029             :     1U, // FABSv8f16
    4030             :     2U, // FACGE16
    4031             :     2U, // FACGE32
    4032             :     2U, // FACGE64
    4033             :     2579U,      // FACGEv2f32
    4034             :     530U,       // FACGEv2f64
    4035             :     3091U,      // FACGEv4f16
    4036             :     1042U,      // FACGEv4f32
    4037             :     1554U,      // FACGEv8f16
    4038             :     2U, // FACGT16
    4039             :     2U, // FACGT32
    4040             :     2U, // FACGT64
    4041             :     2579U,      // FACGTv2f32
    4042             :     530U,       // FACGTv2f64
    4043             :     3091U,      // FACGTv4f16
    4044             :     1042U,      // FACGTv4f32
    4045             :     1554U,      // FACGTv8f16
    4046             :     2U, // FADDDrr
    4047             :     2U, // FADDHrr
    4048             :     2579U,      // FADDPv2f32
    4049             :     530U,       // FADDPv2f64
    4050             :     7U, // FADDPv2i16p
    4051             :     0U, // FADDPv2i32p
    4052             :     0U, // FADDPv2i64p
    4053             :     3091U,      // FADDPv4f16
    4054             :     1042U,      // FADDPv4f32
    4055             :     1554U,      // FADDPv8f16
    4056             :     2U, // FADDSrr
    4057             :     2579U,      // FADDv2f32
    4058             :     530U,       // FADDv2f64
    4059             :     3091U,      // FADDv4f16
    4060             :     1042U,      // FADDv4f32
    4061             :     1554U,      // FADDv8f16
    4062             :     55827U,     // FCADDv2f32
    4063             :     56338U,     // FCADDv2f64
    4064             :     56851U,     // FCADDv4f16
    4065             :     57362U,     // FCADDv4f32
    4066             :     57874U,     // FCADDv8f16
    4067             :     20994U,     // FCCMPDrr
    4068             :     20994U,     // FCCMPEDrr
    4069             :     20994U,     // FCCMPEHrr
    4070             :     20994U,     // FCCMPESrr
    4071             :     20994U,     // FCCMPHrr
    4072             :     20994U,     // FCCMPSrr
    4073             :     2U, // FCMEQ16
    4074             :     2U, // FCMEQ32
    4075             :     2U, // FCMEQ64
    4076             :     7U, // FCMEQv1i16rz
    4077             :     7U, // FCMEQv1i32rz
    4078             :     7U, // FCMEQv1i64rz
    4079             :     2579U,      // FCMEQv2f32
    4080             :     530U,       // FCMEQv2f64
    4081             :     7U, // FCMEQv2i32rz
    4082             :     8U, // FCMEQv2i64rz
    4083             :     3091U,      // FCMEQv4f16
    4084             :     1042U,      // FCMEQv4f32
    4085             :     8U, // FCMEQv4i16rz
    4086             :     8U, // FCMEQv4i32rz
    4087             :     1554U,      // FCMEQv8f16
    4088             :     8U, // FCMEQv8i16rz
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    4293             :     2U, // FCVTZSSXHri
    4294             :     2U, // FCVTZSSXSri
    4295             :     0U, // FCVTZSUWDr
    4296             :     0U, // FCVTZSUWHr
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    4298             :     0U, // FCVTZSUXDr
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    4356             :     37378U,     // FMADDSrrr
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    4895             :     0U, // LDCLRH
    4896             :     0U, // LDCLRLB
    4897             :     0U, // LDCLRLH
    4898             :     0U, // LDCLRLW
    4899             :     0U, // LDCLRLX
    4900             :     0U, // LDCLRW
    4901             :     0U, // LDCLRX
    4902             :     0U, // LDEORAB
    4903             :     0U, // LDEORAH
    4904             :     0U, // LDEORALB
    4905             :     0U, // LDEORALH
    4906             :     0U, // LDEORALW
    4907             :     0U, // LDEORALX
    4908             :     0U, // LDEORAW
    4909             :     0U, // LDEORAX
    4910             :     0U, // LDEORB
    4911             :     0U, // LDEORH
    4912             :     0U, // LDEORLB
    4913             :     0U, // LDEORLH
    4914             :     0U, // LDEORLW
    4915             :     0U, // LDEORLX
    4916             :     0U, // LDEORW
    4917             :     0U, // LDEORX
    4918             :     9U, // LDLARB
    4919             :     9U, // LDLARH
    4920             :     9U, // LDLARW
    4921             :     9U, // LDLARX
    4922             :     53764U,     // LDNPDi
    4923             :     4612U,      // LDNPQi
    4924             :     20996U,     // LDNPSi
    4925             :     20996U,     // LDNPWi
    4926             :     53764U,     // LDNPXi
    4927             :     53764U,     // LDPDi
    4928             :     43652U,     // LDPDpost
    4929             :     37508U,     // LDPDpre
    4930             :     4612U,      // LDPQi
    4931             :     60036U,     // LDPQpost
    4932             :     53892U,     // LDPQpre
    4933             :     20996U,     // LDPSWi
    4934             :     10884U,     // LDPSWpost
    4935             :     4740U,      // LDPSWpre
    4936             :     20996U,     // LDPSi
    4937             :     10884U,     // LDPSpost
    4938             :     4740U,      // LDPSpre
    4939             :     20996U,     // LDPWi
    4940             :     10884U,     // LDPWpost
    4941             :     4740U,      // LDPWpre
    4942             :     53764U,     // LDPXi
    4943             :     43652U,     // LDPXpost
    4944             :     37508U,     // LDPXpre
    4945             :     178U,       // LDRAAindexed
    4946             :     194U,       // LDRAAwriteback
    4947             :     178U,       // LDRABindexed
    4948             :     194U,       // LDRABwriteback
    4949             :     9U, // LDRBBpost
    4950             :     11394U,     // LDRBBpre
    4951             :     20994U,     // LDRBBroW
    4952             :     37378U,     // LDRBBroX
    4953             :     210U,       // LDRBBui
    4954             :     9U, // LDRBpost
    4955             :     11394U,     // LDRBpre
    4956             :     20994U,     // LDRBroW
    4957             :     37378U,     // LDRBroX
    4958             :     210U,       // LDRBui
    4959             :     0U, // LDRDl
    4960             :     9U, // LDRDpost
    4961             :     11394U,     // LDRDpre
    4962             :     53762U,     // LDRDroW
    4963             :     4610U,      // LDRDroX
    4964             :     226U,       // LDRDui
    4965             :     9U, // LDRHHpost
    4966             :     11394U,     // LDRHHpre
    4967             :     20994U,     // LDRHHroW
    4968             :     37378U,     // LDRHHroX
    4969             :     242U,       // LDRHHui
    4970             :     9U, // LDRHpost
    4971             :     11394U,     // LDRHpre
    4972             :     20994U,     // LDRHroW
    4973             :     37378U,     // LDRHroX
    4974             :     242U,       // LDRHui
    4975             :     0U, // LDRQl
    4976             :     9U, // LDRQpost
    4977             :     11394U,     // LDRQpre
    4978             :     53762U,     // LDRQroW
    4979             :     4610U,      // LDRQroX
    4980             :     258U,       // LDRQui
    4981             :     9U, // LDRSBWpost
    4982             :     11394U,     // LDRSBWpre
    4983             :     20994U,     // LDRSBWroW
    4984             :     37378U,     // LDRSBWroX
    4985             :     210U,       // LDRSBWui
    4986             :     9U, // LDRSBXpost
    4987             :     11394U,     // LDRSBXpre
    4988             :     20994U,     // LDRSBXroW
    4989             :     37378U,     // LDRSBXroX
    4990             :     210U,       // LDRSBXui
    4991             :     9U, // LDRSHWpost
    4992             :     11394U,     // LDRSHWpre
    4993             :     20994U,     // LDRSHWroW
    4994             :     37378U,     // LDRSHWroX
    4995             :     242U,       // LDRSHWui
    4996             :     9U, // LDRSHXpost
    4997             :     11394U,     // LDRSHXpre
    4998             :     20994U,     // LDRSHXroW
    4999             :     37378U,     // LDRSHXroX
    5000             :     242U,       // LDRSHXui
    5001             :     0U, // LDRSWl
    5002             :     9U, // LDRSWpost
    5003             :     11394U,     // LDRSWpre
    5004             :     20994U,     // LDRSWroW
    5005             :     37378U,     // LDRSWroX
    5006             :     274U,       // LDRSWui
    5007             :     0U, // LDRSl
    5008             :     9U, // LDRSpost
    5009             :     11394U,     // LDRSpre
    5010             :     20994U,     // LDRSroW
    5011             :     37378U,     // LDRSroX
    5012             :     274U,       // LDRSui
    5013             :     0U, // LDRWl
    5014             :     9U, // LDRWpost
    5015             :     11394U,     // LDRWpre
    5016             :     20994U,     // LDRWroW
    5017             :     37378U,     // LDRWroX
    5018             :     274U,       // LDRWui
    5019             :     0U, // LDRXl
    5020             :     9U, // LDRXpost
    5021             :     11394U,     // LDRXpre
    5022             :     53762U,     // LDRXroW
    5023             :     4610U,      // LDRXroX
    5024             :     226U,       // LDRXui
    5025             :     0U, // LDSETAB
    5026             :     0U, // LDSETAH
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    5028             :     0U, // LDSETALH
    5029             :     0U, // LDSETALW
    5030             :     0U, // LDSETALX
    5031             :     0U, // LDSETAW
    5032             :     0U, // LDSETAX
    5033             :     0U, // LDSETB
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    5035             :     0U, // LDSETLB
    5036             :     0U, // LDSETLH
    5037             :     0U, // LDSETLW
    5038             :     0U, // LDSETLX
    5039             :     0U, // LDSETW
    5040             :     0U, // LDSETX
    5041             :     0U, // LDSMAXAB
    5042             :     0U, // LDSMAXAH
    5043             :     0U, // LDSMAXALB
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    5045             :     0U, // LDSMAXALW
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    5049             :     0U, // LDSMAXB
    5050             :     0U, // LDSMAXH
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    5052             :     0U, // LDSMAXLH
    5053             :     0U, // LDSMAXLW
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    5059             :     0U, // LDSMINALB
    5060             :     0U, // LDSMINALH
    5061             :     0U, // LDSMINALW
    5062             :     0U, // LDSMINALX
    5063             :     0U, // LDSMINAW
    5064             :     0U, // LDSMINAX
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    5066             :     0U, // LDSMINH
    5067             :     0U, // LDSMINLB
    5068             :     0U, // LDSMINLH
    5069             :     0U, // LDSMINLW
    5070             :     0U, // LDSMINLX
    5071             :     0U, // LDSMINW
    5072             :     0U, // LDSMINX
    5073             :     5122U,      // LDTRBi
    5074             :     5122U,      // LDTRHi
    5075             :     5122U,      // LDTRSBWi
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    5077             :     5122U,      // LDTRSHWi
    5078             :     5122U,      // LDTRSHXi
    5079             :     5122U,      // LDTRSWi
    5080             :     5122U,      // LDTRWi
    5081             :     5122U,      // LDTRXi
    5082             :     0U, // LDUMAXAB
    5083             :     0U, // LDUMAXAH
    5084             :     0U, // LDUMAXALB
    5085             :     0U, // LDUMAXALH
    5086             :     0U, // LDUMAXALW
    5087             :     0U, // LDUMAXALX
    5088             :     0U, // LDUMAXAW
    5089             :     0U, // LDUMAXAX
    5090             :     0U, // LDUMAXB
    5091             :     0U, // LDUMAXH
    5092             :     0U, // LDUMAXLB
    5093             :     0U, // LDUMAXLH
    5094             :     0U, // LDUMAXLW
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    5096             :     0U, // LDUMAXW
    5097             :     0U, // LDUMAXX
    5098             :     0U, // LDUMINAB
    5099             :     0U, // LDUMINAH
    5100             :     0U, // LDUMINALB
    5101             :     0U, // LDUMINALH
    5102             :     0U, // LDUMINALW
    5103             :     0U, // LDUMINALX
    5104             :     0U, // LDUMINAW
    5105             :     0U, // LDUMINAX
    5106             :     0U, // LDUMINB
    5107             :     0U, // LDUMINH
    5108             :     0U, // LDUMINLB
    5109             :     0U, // LDUMINLH
    5110             :     0U, // LDUMINLW
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    5112             :     0U, // LDUMINW
    5113             :     0U, // LDUMINX
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    5311             :     1570U,      // SABALv8i16_v4i32
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    5314             :     2595U,      // SABAv2i32
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    5365             :     37378U,     // SBFMXri
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    5461             :     1U, // SMAXVv8i8v
    5462             :     2067U,      // SMAXv16i8
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    5466             :     1554U,      // SMAXv8i16
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    5468             :     0U, // SMC
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    5470             :     2579U,      // SMINPv2i32
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    5475             :     0U, // SMINVv16i8v
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    5477             :     1U, // SMINVv4i32v
    5478             :     1U, // SMINVv8i16v
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    5480             :     2067U,      // SMINv16i8
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    6043             :     53762U,     // STRXroW
    6044             :     4610U,      // STRXroX
    6045             :     226U,       // STRXui
    6046             :     5122U,      // STTRBi
    6047             :     5122U,      // STTRHi
    6048             :     5122U,      // STTRWi
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    6050             :     5122U,      // STURBBi
    6051             :     5122U,      // STURBi
    6052             :     5122U,      // STURDi
    6053             :     5122U,      // STURHHi
    6054             :     5122U,      // STURHi
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    6056             :     5122U,      // STURSi
    6057             :     5122U,      // STURWi
    6058             :     5122U,      // STURXi
    6059             :     12290U,     // STXPW
    6060             :     12290U,     // STXPX
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    6062             :     5124U,      // STXRH
    6063             :     5124U,      // STXRW
    6064             :     5124U,      // STXRX
    6065             :     530U,       // SUBHNv2i64_v2i32
    6066             :     546U,       // SUBHNv2i64_v4i32
    6067             :     1042U,      // SUBHNv4i32_v4i16
    6068             :     1058U,      // SUBHNv4i32_v8i16
    6069             :     1570U,      // SUBHNv8i16_v16i8
    6070             :     1554U,      // SUBHNv8i16_v8i8
    6071             :     50U,        // SUBSWri
    6072             :     0U, // SUBSWrr
    6073             :     66U,        // SUBSWrs
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    6076             :     0U, // SUBSXrr
    6077             :     66U,        // SUBSXrs
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    6126             :     0U, // SYSxt
    6127             :     0U, // TBLv16i8Four
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    6133             :     1U, // TBLv8i8Three
    6134             :     1U, // TBLv8i8Two
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    6137             :     0U, // TBXv16i8Four
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    6145             :     306U,       // TBZW
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    6147             :     0U, // TCRETURNdi
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    6149             :     0U, // TLSDESCCALL
    6150             :     0U, // TLSDESC_CALLSEQ
    6151             :     2067U,      // TRN1v16i8
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    6155             :     1042U,      // TRN1v4i32
    6156             :     1554U,      // TRN1v8i16
    6157             :     3603U,      // TRN1v8i8
    6158             :     2067U,      // TRN2v16i8
    6159             :     2579U,      // TRN2v2i32
    6160             :     530U,       // TRN2v2i64
    6161             :     3091U,      // TRN2v4i16
    6162             :     1042U,      // TRN2v4i32
    6163             :     1554U,      // TRN2v8i16
    6164             :     3603U,      // TRN2v8i8
    6165             :     2083U,      // UABALv16i8_v8i16
    6166             :     2595U,      // UABALv2i32_v2i64
    6167             :     3107U,      // UABALv4i16_v4i32
    6168             :     1058U,      // UABALv4i32_v2i64
    6169             :     1570U,      // UABALv8i16_v4i32
    6170             :     3619U,      // UABALv8i8_v8i16
    6171             :     2083U,      // UABAv16i8
    6172             :     2595U,      // UABAv2i32
    6173             :     3107U,      // UABAv4i16
    6174             :     1058U,      // UABAv4i32
    6175             :     1570U,      // UABAv8i16
    6176             :     3619U,      // UABAv8i8
    6177             :     2067U,      // UABDLv16i8_v8i16
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    6181             :     1554U,      // UABDLv8i16_v4i32
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    6183             :     2067U,      // UABDv16i8
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    6205             :     1U, // UADDLVv8i8v
    6206             :     2067U,      // UADDLv16i8_v8i16
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    6208             :     3091U,      // UADDLv4i16_v4i32
    6209             :     1042U,      // UADDLv4i32_v2i64
    6210             :     1554U,      // UADDLv8i16_v4i32
    6211             :     3603U,      // UADDLv8i8_v8i16
    6212             :     2066U,      // UADDWv16i8_v8i16
    6213             :     2578U,      // UADDWv2i32_v2i64
    6214             :     3090U,      // UADDWv4i16_v4i32
    6215             :     1042U,      // UADDWv4i32_v2i64
    6216             :     1554U,      // UADDWv8i16_v4i32
    6217             :     3602U,      // UADDWv8i8_v8i16
    6218             :     37378U,     // UBFMWri
    6219             :     37378U,     // UBFMXri
    6220             :     2U, // UCVTFSWDri
    6221             :     2U, // UCVTFSWHri
    6222             :     2U, // UCVTFSWSri
    6223             :     2U, // UCVTFSXDri
    6224             :     2U, // UCVTFSXHri
    6225             :     2U, // UCVTFSXSri
    6226             :     0U, // UCVTFUWDri
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    6558             :     0U, // DBG_VALUE
    6559             :     0U, // REG_SEQUENCE
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    6568             :     0U, // STATEPOINT
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    6570             :     0U, // FAULTING_OP
    6571             :     0U, // PATCHABLE_OP
    6572             :     0U, // PATCHABLE_FUNCTION_ENTER
    6573             :     0U, // PATCHABLE_RET
    6574             :     0U, // PATCHABLE_FUNCTION_EXIT
    6575             :     0U, // PATCHABLE_TAIL_CALL
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    6577             :     0U, // G_ADD
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    6588             :     0U, // G_PHI
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    6590             :     0U, // G_GLOBAL_VALUE
    6591             :     0U, // G_EXTRACT
    6592             :     0U, // G_UNMERGE_VALUES
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    6915             :     0U, // CMLTv8i8rz
    6916             :     0U, // CMP_SWAP_128
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    6922             :     0U, // CMTSTv1i64
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    6929             :     0U, // CNTv16i8
    6930             :     0U, // CNTv8i8
    6931             :     0U, // CPYi16
    6932             :     0U, // CPYi32
    6933             :     0U, // CPYi64
    6934             :     0U, // CPYi8
    6935             :     0U, // CRC32Brr
    6936             :     0U, // CRC32CBrr
    6937             :     0U, // CRC32CHrr
    6938             :     0U, // CRC32CWrr
    6939             :     0U, // CRC32CXrr
    6940             :     0U, // CRC32Hrr
    6941             :     0U, // CRC32Wrr
    6942             :     0U, // CRC32Xrr
    6943             :     0U, // CSELWr
    6944             :     0U, // CSELXr
    6945             :     0U, // CSINCWr
    6946             :     0U, // CSINCXr
    6947             :     0U, // CSINVWr
    6948             :     0U, // CSINVXr
    6949             :     0U, // CSNEGWr
    6950             :     0U, // CSNEGXr
    6951             :     0U, // CompilerBarrier
    6952             :     0U, // DCPS1
    6953             :     0U, // DCPS2
    6954             :     0U, // DCPS3
    6955             :     0U, // DMB
    6956             :     0U, // DRPS
    6957             :     0U, // DSB
    6958             :     0U, // DUPv16i8gpr
    6959             :     0U, // DUPv16i8lane
    6960             :     0U, // DUPv2i32gpr
    6961             :     0U, // DUPv2i32lane
    6962             :     0U, // DUPv2i64gpr
    6963             :     0U, // DUPv2i64lane
    6964             :     0U, // DUPv4i16gpr
    6965             :     0U, // DUPv4i16lane
    6966             :     0U, // DUPv4i32gpr
    6967             :     0U, // DUPv4i32lane
    6968             :     0U, // DUPv8i16gpr
    6969             :     0U, // DUPv8i16lane
    6970             :     0U, // DUPv8i8gpr
    6971             :     0U, // DUPv8i8lane
    6972             :     0U, // EONWrr
    6973             :     0U, // EONWrs
    6974             :     0U, // EONXrr
    6975             :     0U, // EONXrs
    6976             :     0U, // EORWri
    6977             :     0U, // EORWrr
    6978             :     0U, // EORWrs
    6979             :     0U, // EORXri
    6980             :     0U, // EORXrr
    6981             :     0U, // EORXrs
    6982             :     0U, // EORv16i8
    6983             :     0U, // EORv8i8
    6984             :     0U, // ERET
    6985             :     0U, // ERETAA
    6986             :     0U, // ERETAB
    6987             :     0U, // EXTRWrri
    6988             :     0U, // EXTRXrri
    6989             :     0U, // EXTv16i8
    6990             :     0U, // EXTv8i8
    6991             :     0U, // F128CSEL
    6992             :     0U, // FABD16
    6993             :     0U, // FABD32
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    6998             :     0U, // FABDv4f32
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    7000             :     0U, // FABSDr
    7001             :     0U, // FABSHr
    7002             :     0U, // FABSSr
    7003             :     0U, // FABSv2f32
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    7005             :     0U, // FABSv4f16
    7006             :     0U, // FABSv4f32
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    7008             :     0U, // FACGE16
    7009             :     0U, // FACGE32
    7010             :     0U, // FACGE64
    7011             :     0U, // FACGEv2f32
    7012             :     0U, // FACGEv2f64
    7013             :     0U, // FACGEv4f16
    7014             :     0U, // FACGEv4f32
    7015             :     0U, // FACGEv8f16
    7016             :     0U, // FACGT16
    7017             :     0U, // FACGT32
    7018             :     0U, // FACGT64
    7019             :     0U, // FACGTv2f32
    7020             :     0U, // FACGTv2f64
    7021             :     0U, // FACGTv4f16
    7022             :     0U, // FACGTv4f32
    7023             :     0U, // FACGTv8f16
    7024             :     0U, // FADDDrr
    7025             :     0U, // FADDHrr
    7026             :     0U, // FADDPv2f32
    7027             :     0U, // FADDPv2f64
    7028             :     0U, // FADDPv2i16p
    7029             :     0U, // FADDPv2i32p
    7030             :     0U, // FADDPv2i64p
    7031             :     0U, // FADDPv4f16
    7032             :     0U, // FADDPv4f32
    7033             :     0U, // FADDPv8f16
    7034             :     0U, // FADDSrr
    7035             :     0U, // FADDv2f32
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    7878             :     0U, // LDCLRW
    7879             :     0U, // LDCLRX
    7880             :     0U, // LDEORAB
    7881             :     0U, // LDEORAH
    7882             :     0U, // LDEORALB
    7883             :     0U, // LDEORALH
    7884             :     0U, // LDEORALW
    7885             :     0U, // LDEORALX
    7886             :     0U, // LDEORAW
    7887             :     0U, // LDEORAX
    7888             :     0U, // LDEORB
    7889             :     0U, // LDEORH
    7890             :     0U, // LDEORLB
    7891             :     0U, // LDEORLH
    7892             :     0U, // LDEORLW
    7893             :     0U, // LDEORLX
    7894             :     0U, // LDEORW
    7895             :     0U, // LDEORX
    7896             :     0U, // LDLARB
    7897             :     0U, // LDLARH
    7898             :     0U, // LDLARW
    7899             :     0U, // LDLARX
    7900             :     1U, // LDNPDi
    7901             :     2U, // LDNPQi
    7902             :     2U, // LDNPSi
    7903             :     2U, // LDNPWi
    7904             :     1U, // LDNPXi
    7905             :     1U, // LDPDi
    7906             :     10U,        // LDPDpost
    7907             :     18U,        // LDPDpre
    7908             :     2U, // LDPQi
    7909             :     10U,        // LDPQpost
    7910             :     18U,        // LDPQpre
    7911             :     2U, // LDPSWi
    7912             :     11U,        // LDPSWpost
    7913             :     19U,        // LDPSWpre
    7914             :     2U, // LDPSi
    7915             :     11U,        // LDPSpost
    7916             :     19U,        // LDPSpre
    7917             :     2U, // LDPWi
    7918             :     11U,        // LDPWpost
    7919             :     19U,        // LDPWpre
    7920             :     1U, // LDPXi
    7921             :     10U,        // LDPXpost
    7922             :     18U,        // LDPXpre
    7923             :     0U, // LDRAAindexed
    7924             :     0U, // LDRAAwriteback
    7925             :     0U, // LDRABindexed
    7926             :     0U, // LDRABwriteback
    7927             :     0U, // LDRBBpost
    7928             :     0U, // LDRBBpre
    7929             :     3U, // LDRBBroW
    7930             :     3U, // LDRBBroX
    7931             :     0U, // LDRBBui
    7932             :     0U, // LDRBpost
    7933             :     0U, // LDRBpre
    7934             :     3U, // LDRBroW
    7935             :     3U, // LDRBroX
    7936             :     0U, // LDRBui
    7937             :     0U, // LDRDl
    7938             :     0U, // LDRDpost
    7939             :     0U, // LDRDpre
    7940             :     3U, // LDRDroW
    7941             :     4U, // LDRDroX
    7942             :     0U, // LDRDui
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    7944             :     0U, // LDRHHpre
    7945             :     4U, // LDRHHroW
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    7948             :     0U, // LDRHpost
    7949             :     0U, // LDRHpre
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    7965             :     0U, // LDRSBXpre
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    7970             :     0U, // LDRSHWpre
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    7998             :     0U, // LDRXpost
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    8001             :     4U, // LDRXroX
    8002             :     0U, // LDRXui
    8003             :     0U, // LDSETAB
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    8009             :     0U, // LDSETAW
    8010             :     0U, // LDSETAX
    8011             :     0U, // LDSETB
    8012             :     0U, // LDSETH
    8013             :     0U, // LDSETLB
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    8090             :     0U, // LDUMINW
    8091             :     0U, // LDUMINX
    8092             :     0U, // LDURBBi
    8093             :     0U, // LDURBi
    8094             :     0U, // LDURDi
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    8096             :     0U, // LDURHi
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    8098             :     0U, // LDURSBWi
    8099             :     0U, // LDURSBXi
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    9337             :     0U, // UQRSHRNb
    9338             :     0U, // UQRSHRNh
    9339             :     0U, // UQRSHRNs
    9340             :     0U, // UQRSHRNv16i8_shift
    9341             :     0U, // UQRSHRNv2i32_shift
    9342             :     0U, // UQRSHRNv4i16_shift
    9343             :     0U, // UQRSHRNv4i32_shift
    9344             :     0U, // UQRSHRNv8i16_shift
    9345             :     0U, // UQRSHRNv8i8_shift
    9346             :     0U, // UQSHLb
    9347             :     0U, // UQSHLd
    9348             :     0U, // UQSHLh
    9349             :     0U, // UQSHLs
    9350             :     0U, // UQSHLv16i8
    9351             :     0U, // UQSHLv16i8_shift
    9352             :     0U, // UQSHLv1i16
    9353             :     0U, // UQSHLv1i32
    9354             :     0U, // UQSHLv1i64
    9355             :     0U, // UQSHLv1i8
    9356             :     0U, // UQSHLv2i32
    9357             :     0U, // UQSHLv2i32_shift
    9358             :     0U, // UQSHLv2i64
    9359             :     0U, // UQSHLv2i64_shift
    9360             :     0U, // UQSHLv4i16
    9361             :     0U, // UQSHLv4i16_shift
    9362             :     0U, // UQSHLv4i32
    9363             :     0U, // UQSHLv4i32_shift
    9364             :     0U, // UQSHLv8i16
    9365             :     0U, // UQSHLv8i16_shift
    9366             :     0U, // UQSHLv8i8
    9367             :     0U, // UQSHLv8i8_shift
    9368             :     0U, // UQSHRNb
    9369             :     0U, // UQSHRNh
    9370             :     0U, // UQSHRNs
    9371             :     0U, // UQSHRNv16i8_shift
    9372             :     0U, // UQSHRNv2i32_shift
    9373             :     0U, // UQSHRNv4i16_shift
    9374             :     0U, // UQSHRNv4i32_shift
    9375             :     0U, // UQSHRNv8i16_shift
    9376             :     0U, // UQSHRNv8i8_shift
    9377             :     0U, // UQSUBv16i8
    9378             :     0U, // UQSUBv1i16
    9379             :     0U, // UQSUBv1i32
    9380             :     0U, // UQSUBv1i64
    9381             :     0U, // UQSUBv1i8
    9382             :     0U, // UQSUBv2i32
    9383             :     0U, // UQSUBv2i64
    9384             :     0U, // UQSUBv4i16
    9385             :     0U, // UQSUBv4i32
    9386             :     0U, // UQSUBv8i16
    9387             :     0U, // UQSUBv8i8
    9388             :     0U, // UQXTNv16i8
    9389             :     0U, // UQXTNv1i16
    9390             :     0U, // UQXTNv1i32
    9391             :     0U, // UQXTNv1i8
    9392             :     0U, // UQXTNv2i32
    9393             :     0U, // UQXTNv4i16
    9394             :     0U, // UQXTNv4i32
    9395             :     0U, // UQXTNv8i16
    9396             :     0U, // UQXTNv8i8
    9397             :     0U, // URECPEv2i32
    9398             :     0U, // URECPEv4i32
    9399             :     0U, // URHADDv16i8
    9400             :     0U, // URHADDv2i32
    9401             :     0U, // URHADDv4i16
    9402             :     0U, // URHADDv4i32
    9403             :     0U, // URHADDv8i16
    9404             :     0U, // URHADDv8i8
    9405             :     0U, // URSHLv16i8
    9406             :     0U, // URSHLv1i64
    9407             :     0U, // URSHLv2i32
    9408             :     0U, // URSHLv2i64
    9409             :     0U, // URSHLv4i16
    9410             :     0U, // URSHLv4i32
    9411             :     0U, // URSHLv8i16
    9412             :     0U, // URSHLv8i8
    9413             :     0U, // URSHRd
    9414             :     0U, // URSHRv16i8_shift
    9415             :     0U, // URSHRv2i32_shift
    9416             :     0U, // URSHRv2i64_shift
    9417             :     0U, // URSHRv4i16_shift
    9418             :     0U, // URSHRv4i32_shift
    9419             :     0U, // URSHRv8i16_shift
    9420             :     0U, // URSHRv8i8_shift
    9421             :     0U, // URSQRTEv2i32
    9422             :     0U, // URSQRTEv4i32
    9423             :     0U, // URSRAd
    9424             :     0U, // URSRAv16i8_shift
    9425             :     0U, // URSRAv2i32_shift
    9426             :     0U, // URSRAv2i64_shift
    9427             :     0U, // URSRAv4i16_shift
    9428             :     0U, // URSRAv4i32_shift
    9429             :     0U, // URSRAv8i16_shift
    9430             :     0U, // URSRAv8i8_shift
    9431             :     0U, // USHLLv16i8_shift
    9432             :     0U, // USHLLv2i32_shift
    9433             :     0U, // USHLLv4i16_shift
    9434             :     0U, // USHLLv4i32_shift
    9435             :     0U, // USHLLv8i16_shift
    9436             :     0U, // USHLLv8i8_shift
    9437             :     0U, // USHLv16i8
    9438             :     0U, // USHLv1i64
    9439             :     0U, // USHLv2i32
    9440             :     0U, // USHLv2i64
    9441             :     0U, // USHLv4i16
    9442             :     0U, // USHLv4i32
    9443             :     0U, // USHLv8i16
    9444             :     0U, // USHLv8i8
    9445             :     0U, // USHRd
    9446             :     0U, // USHRv16i8_shift
    9447             :     0U, // USHRv2i32_shift
    9448             :     0U, // USHRv2i64_shift
    9449             :     0U, // USHRv4i16_shift
    9450             :     0U, // USHRv4i32_shift
    9451             :     0U, // USHRv8i16_shift
    9452             :     0U, // USHRv8i8_shift
    9453             :     0U, // USQADDv16i8
    9454             :     0U, // USQADDv1i16
    9455             :     0U, // USQADDv1i32
    9456             :     0U, // USQADDv1i64
    9457             :     0U, // USQADDv1i8
    9458             :     0U, // USQADDv2i32
    9459             :     0U, // USQADDv2i64
    9460             :     0U, // USQADDv4i16
    9461             :     0U, // USQADDv4i32
    9462             :     0U, // USQADDv8i16
    9463             :     0U, // USQADDv8i8
    9464             :     0U, // USRAd
    9465             :     0U, // USRAv16i8_shift
    9466             :     0U, // USRAv2i32_shift
    9467             :     0U, // USRAv2i64_shift
    9468             :     0U, // USRAv4i16_shift
    9469             :     0U, // USRAv4i32_shift
    9470             :     0U, // USRAv8i16_shift
    9471             :     0U, // USRAv8i8_shift
    9472             :     0U, // USUBLv16i8_v8i16
    9473             :     0U, // USUBLv2i32_v2i64
    9474             :     0U, // USUBLv4i16_v4i32
    9475             :     0U, // USUBLv4i32_v2i64
    9476             :     0U, // USUBLv8i16_v4i32
    9477             :     0U, // USUBLv8i8_v8i16
    9478             :     0U, // USUBWv16i8_v8i16
    9479             :     0U, // USUBWv2i32_v2i64
    9480             :     0U, // USUBWv4i16_v4i32
    9481             :     0U, // USUBWv4i32_v2i64
    9482             :     0U, // USUBWv8i16_v4i32
    9483             :     0U, // USUBWv8i8_v8i16
    9484             :     0U, // UZP1v16i8
    9485             :     0U, // UZP1v2i32
    9486             :     0U, // UZP1v2i64
    9487             :     0U, // UZP1v4i16
    9488             :     0U, // UZP1v4i32
    9489             :     0U, // UZP1v8i16
    9490             :     0U, // UZP1v8i8
    9491             :     0U, // UZP2v16i8
    9492             :     0U, // UZP2v2i32
    9493             :     0U, // UZP2v2i64
    9494             :     0U, // UZP2v4i16
    9495             :     0U, // UZP2v4i32
    9496             :     0U, // UZP2v8i16
    9497             :     0U, // UZP2v8i8
    9498             :     0U, // XPACD
    9499             :     0U, // XPACI
    9500             :     0U, // XPACLRI
    9501             :     0U, // XTNv16i8
    9502             :     0U, // XTNv2i32
    9503             :     0U, // XTNv4i16
    9504             :     0U, // XTNv4i32
    9505             :     0U, // XTNv8i16
    9506             :     0U, // XTNv8i8
    9507             :     0U, // ZIP1v16i8
    9508             :     0U, // ZIP1v2i32
    9509             :     0U, // ZIP1v2i64
    9510             :     0U, // ZIP1v4i16
    9511             :     0U, // ZIP1v4i32
    9512             :     0U, // ZIP1v8i16
    9513             :     0U, // ZIP1v8i8
    9514             :     0U, // ZIP2v16i8
    9515             :     0U, // ZIP2v2i32
    9516             :     0U, // ZIP2v2i64
    9517             :     0U, // ZIP2v4i16
    9518             :     0U, // ZIP2v4i32
    9519             :     0U, // ZIP2v8i16
    9520             :     0U, // ZIP2v8i8
    9521             :   };
    9522             : 
    9523       38914 :   O << "\t";
    9524             : 
    9525             :   // Emit the opcode for the instruction.
    9526       38914 :   uint64_t Bits = 0;
    9527       38914 :   Bits |= (uint64_t)OpInfo0[MI->getOpcode()] << 0;
    9528       38914 :   Bits |= (uint64_t)OpInfo1[MI->getOpcode()] << 32;
    9529       38914 :   Bits |= (uint64_t)OpInfo2[MI->getOpcode()] << 48;
    9530             :   assert(Bits != 0 && "Cannot print this instruction.");
    9531       38914 :   O << AsmStrs+(Bits & 8191)-1;
    9532             : 
    9533             : 
    9534             :   // Fragment 0 encoded into 6 bits for 43 unique commands.
    9535       38914 :   switch ((Bits >> 13) & 63) {
    9536           0 :   default: llvm_unreachable("Invalid command number.");
    9537             :   case 0:
    9538             :     // DBG_VALUE, BUNDLE, LIFETIME_START, LIFETIME_END, FENTRY_CALL, PATCHABL...
    9539             :     return;
    9540             :     break;
    9541        6773 :   case 1:
    9542             :     // ABSv16i8, ABSv2i32, ABSv2i64, ABSv4i16, ABSv4i32, ABSv8i16, ABSv8i8, A...
    9543        6773 :     printVRegOperand(MI, 0, STI, O);
    9544        6773 :     break;
    9545       21427 :   case 2:
    9546             :     // ABSv1i64, ADCSWr, ADCSXr, ADCWr, ADCXr, ADDPv2i64p, ADDSWri, ADDSWrs, ...
    9547       21427 :     printOperand(MI, 0, STI, O);
    9548       21427 :     break;
    9549        2244 :   case 3:
    9550             :     // ADDHNv2i64_v4i32, ADDHNv4i32_v8i16, ADDHNv8i16_v16i8, AESDrr, AESErr, ...
    9551        2244 :     printVRegOperand(MI, 1, STI, O);
    9552        2244 :     break;
    9553        1294 :   case 4:
    9554             :     // B, BL
    9555        1294 :     printAlignedLabel(MI, 0, STI, O);
    9556        1294 :     return;
    9557             :     break;
    9558          58 :   case 5:
    9559             :     // BRK, DCPS1, DCPS2, DCPS3, HLT, HVC, SMC, SVC
    9560          58 :     printImmHex(MI, 0, STI, O);
    9561          58 :     return;
    9562             :     break;
    9563         414 :   case 6:
    9564             :     // Bcc
    9565         414 :     printCondCode(MI, 0, STI, O);
    9566         414 :     O << "\t";
    9567         414 :     printAlignedLabel(MI, 1, STI, O);
    9568         414 :     return;
    9569             :     break;
    9570        3273 :   case 7:
    9571             :     // CASAB, CASAH, CASALB, CASALH, CASALW, CASALX, CASAW, CASAX, CASB, CASH...
    9572        3273 :     printOperand(MI, 1, STI, O);
    9573        3273 :     break;
    9574          10 :   case 8:
    9575             :     // CASPALW, CASPAW, CASPLW, CASPW
    9576          10 :     printGPRSeqPairsClassOperand<32>(MI, 1, STI, O);
    9577          10 :     O << ", ";
    9578          10 :     printGPRSeqPairsClassOperand<32>(MI, 2, STI, O);
    9579          10 :     O << ", [";
    9580          10 :     printOperand(MI, 3, STI, O);
    9581             :     O << ']';
    9582             :     return;
    9583             :     break;
    9584          10 :   case 9:
    9585             :     // CASPALX, CASPAX, CASPLX, CASPX
    9586          10 :     printGPRSeqPairsClassOperand<64>(MI, 1, STI, O);
    9587          10 :     O << ", ";
    9588          10 :     printGPRSeqPairsClassOperand<64>(MI, 2, STI, O);
    9589          10 :     O << ", [";
    9590          10 :     printOperand(MI, 3, STI, O);
    9591             :     O << ']';
    9592             :     return;
    9593             :     break;
    9594         143 :   case 10:
    9595             :     // DMB, DSB, ISB
    9596         143 :     printBarrierOption(MI, 0, STI, O);
    9597         143 :     return;
    9598             :     break;
    9599           6 :   case 11:
    9600             :     // HINT
    9601           6 :     printImm(MI, 0, STI, O);
    9602           6 :     return;
    9603             :     break;
    9604          86 :   case 12:
    9605             :     // LD1Fourv16b, LD1Onev16b, LD1Rv16b, LD1Threev16b, LD1Twov16b, LD2Rv16b,...
    9606          86 :     printTypedVectorList<16, 'b'>(MI, 0, STI, O);
    9607          86 :     O << ", [";
    9608          86 :     printOperand(MI, 1, STI, O);
    9609             :     O << ']';
    9610             :     return;
    9611             :     break;
    9612          24 :   case 13:
    9613             :     // LD1Fourv16b_POST, LD1Onev16b_POST, LD1Rv16b_POST, LD1Threev16b_POST, L...
    9614          24 :     printTypedVectorList<16, 'b'>(MI, 1, STI, O);
    9615          24 :     O << ", [";
    9616          24 :     printOperand(MI, 2, STI, O);
    9617          24 :     O << "], ";
    9618          24 :     break;
    9619          21 :   case 14:
    9620             :     // LD1Fourv1d, LD1Onev1d, LD1Rv1d, LD1Threev1d, LD1Twov1d, LD2Rv1d, LD3Rv...
    9621          21 :     printTypedVectorList<1, 'd'>(MI, 0, STI, O);
    9622          21 :     O << ", [";
    9623          21 :     printOperand(MI, 1, STI, O);
    9624             :     O << ']';
    9625             :     return;
    9626             :     break;
    9627          14 :   case 15:
    9628             :     // LD1Fourv1d_POST, LD1Onev1d_POST, LD1Rv1d_POST, LD1Threev1d_POST, LD1Tw...
    9629          14 :     printTypedVectorList<1, 'd'>(MI, 1, STI, O);
    9630          14 :     O << ", [";
    9631          14 :     printOperand(MI, 2, STI, O);
    9632          14 :     O << "], ";
    9633          14 :     break;
    9634         205 :   case 16:
    9635             :     // LD1Fourv2d, LD1Onev2d, LD1Rv2d, LD1Threev2d, LD1Twov2d, LD2Rv2d, LD2Tw...
    9636         205 :     printTypedVectorList<2, 'd'>(MI, 0, STI, O);
    9637         205 :     O << ", [";
    9638         205 :     printOperand(MI, 1, STI, O);
    9639             :     O << ']';
    9640             :     return;
    9641             :     break;
    9642          24 :   case 17:
    9643             :     // LD1Fourv2d_POST, LD1Onev2d_POST, LD1Rv2d_POST, LD1Threev2d_POST, LD1Tw...
    9644          24 :     printTypedVectorList<2, 'd'>(MI, 1, STI, O);
    9645          24 :     O << ", [";
    9646          24 :     printOperand(MI, 2, STI, O);
    9647          24 :     O << "], ";
    9648          24 :     break;
    9649         137 :   case 18:
    9650             :     // LD1Fourv2s, LD1Onev2s, LD1Rv2s, LD1Threev2s, LD1Twov2s, LD2Rv2s, LD2Tw...
    9651         137 :     printTypedVectorList<2, 's'>(MI, 0, STI, O);
    9652         137 :     O << ", [";
    9653         137 :     printOperand(MI, 1, STI, O);
    9654             :     O << ']';
    9655             :     return;
    9656             :     break;
    9657          20 :   case 19:
    9658             :     // LD1Fourv2s_POST, LD1Onev2s_POST, LD1Rv2s_POST, LD1Threev2s_POST, LD1Tw...
    9659          20 :     printTypedVectorList<2, 's'>(MI, 1, STI, O);
    9660          20 :     O << ", [";
    9661          20 :     printOperand(MI, 2, STI, O);
    9662          20 :     O << "], ";
    9663          20 :     break;
    9664         104 :   case 20:
    9665             :     // LD1Fourv4h, LD1Onev4h, LD1Rv4h, LD1Threev4h, LD1Twov4h, LD2Rv4h, LD2Tw...
    9666         104 :     printTypedVectorList<4, 'h'>(MI, 0, STI, O);
    9667         104 :     O << ", [";
    9668         104 :     printOperand(MI, 1, STI, O);
    9669             :     O << ']';
    9670             :     return;
    9671             :     break;
    9672          20 :   case 21:
    9673             :     // LD1Fourv4h_POST, LD1Onev4h_POST, LD1Rv4h_POST, LD1Threev4h_POST, LD1Tw...
    9674          20 :     printTypedVectorList<4, 'h'>(MI, 1, STI, O);
    9675          20 :     O << ", [";
    9676          20 :     printOperand(MI, 2, STI, O);
    9677          20 :     O << "], ";
    9678          20 :     break;
    9679          92 :   case 22:
    9680             :     // LD1Fourv4s, LD1Onev4s, LD1Rv4s, LD1Threev4s, LD1Twov4s, LD2Rv4s, LD2Tw...
    9681          92 :     printTypedVectorList<4, 's'>(MI, 0, STI, O);
    9682          92 :     O << ", [";
    9683          92 :     printOperand(MI, 1, STI, O);
    9684             :     O << ']';
    9685             :     return;
    9686             :     break;
    9687          28 :   case 23:
    9688             :     // LD1Fourv4s_POST, LD1Onev4s_POST, LD1Rv4s_POST, LD1Threev4s_POST, LD1Tw...
    9689          28 :     printTypedVectorList<4, 's'>(MI, 1, STI, O);
    9690          28 :     O << ", [";
    9691          28 :     printOperand(MI, 2, STI, O);
    9692          28 :     O << "], ";
    9693          28 :     break;
    9694          86 :   case 24:
    9695             :     // LD1Fourv8b, LD1Onev8b, LD1Rv8b, LD1Threev8b, LD1Twov8b, LD2Rv8b, LD2Tw...
    9696          86 :     printTypedVectorList<8, 'b'>(MI, 0, STI, O);
    9697          86 :     O << ", [";
    9698          86 :     printOperand(MI, 1, STI, O);
    9699             :     O << ']';
    9700             :     return;
    9701             :     break;
    9702          24 :   case 25:
    9703             :     // LD1Fourv8b_POST, LD1Onev8b_POST, LD1Rv8b_POST, LD1Threev8b_POST, LD1Tw...
    9704          24 :     printTypedVectorList<8, 'b'>(MI, 1, STI, O);
    9705          24 :     O << ", [";
    9706          24 :     printOperand(MI, 2, STI, O);
    9707          24 :     O << "], ";
    9708          24 :     break;
    9709         133 :   case 26:
    9710             :     // LD1Fourv8h, LD1Onev8h, LD1Rv8h, LD1Threev8h, LD1Twov8h, LD2Rv8h, LD2Tw...
    9711         133 :     printTypedVectorList<8, 'h'>(MI, 0, STI, O);
    9712         133 :     O << ", [";
    9713         133 :     printOperand(MI, 1, STI, O);
    9714             :     O << ']';
    9715             :     return;
    9716             :     break;
    9717          28 :   case 27:
    9718             :     // LD1Fourv8h_POST, LD1Onev8h_POST, LD1Rv8h_POST, LD1Threev8h_POST, LD1Tw...
    9719          28 :     printTypedVectorList<8, 'h'>(MI, 1, STI, O);
    9720          28 :     O << ", [";
    9721          28 :     printOperand(MI, 2, STI, O);
    9722          28 :     O << "], ";
    9723          28 :     break;
    9724          22 :   case 28:
    9725             :     // LD1i16, LD2i16, LD3i16, LD4i16, ST1i16_POST, ST2i16_POST, ST3i16_POST,...
    9726          22 :     printTypedVectorList<0, 'h'>(MI, 1, STI, O);
    9727          22 :     printVectorIndex(MI, 2, STI, O);
    9728          22 :     O << ", [";
    9729          22 :     printOperand(MI, 3, STI, O);
    9730          22 :     break;
    9731           8 :   case 29:
    9732             :     // LD1i16_POST, LD2i16_POST, LD3i16_POST, LD4i16_POST
    9733           8 :     printTypedVectorList<0, 'h'>(MI, 2, STI, O);
    9734           8 :     printVectorIndex(MI, 3, STI, O);
    9735           8 :     O << ", [";
    9736           8 :     printOperand(MI, 4, STI, O);
    9737           8 :     O << "], ";
    9738           8 :     break;
    9739          22 :   case 30:
    9740             :     // LD1i32, LD2i32, LD3i32, LD4i32, ST1i32_POST, ST2i32_POST, ST3i32_POST,...
    9741          22 :     printTypedVectorList<0, 's'>(MI, 1, STI, O);
    9742          22 :     printVectorIndex(MI, 2, STI, O);
    9743          22 :     O << ", [";
    9744          22 :     printOperand(MI, 3, STI, O);
    9745          22 :     break;
    9746           6 :   case 31:
    9747             :     // LD1i32_POST, LD2i32_POST, LD3i32_POST, LD4i32_POST
    9748           6 :     printTypedVectorList<0, 's'>(MI, 2, STI, O);
    9749           6 :     printVectorIndex(MI, 3, STI, O);
    9750           6 :     O << ", [";
    9751           6 :     printOperand(MI, 4, STI, O);
    9752           6 :     O << "], ";
    9753           6 :     break;
    9754          16 :   case 32:
    9755             :     // LD1i64, LD2i64, LD3i64, LD4i64, ST1i64_POST, ST2i64_POST, ST3i64_POST,...
    9756          16 :     printTypedVectorList<0, 'd'>(MI, 1, STI, O);
    9757          16 :     printVectorIndex(MI, 2, STI, O);
    9758          16 :     O << ", [";
    9759          16 :     printOperand(MI, 3, STI, O);
    9760          16 :     break;
    9761           7 :   case 33:
    9762             :     // LD1i64_POST, LD2i64_POST, LD3i64_POST, LD4i64_POST
    9763           7 :     printTypedVectorList<0, 'd'>(MI, 2, STI, O);
    9764           7 :     printVectorIndex(MI, 3, STI, O);
    9765           7 :     O << ", [";
    9766           7 :     printOperand(MI, 4, STI, O);
    9767           7 :     O << "], ";
    9768           7 :     break;
    9769          14 :   case 34:
    9770             :     // LD1i8, LD2i8, LD3i8, LD4i8, ST1i8_POST, ST2i8_POST, ST3i8_POST, ST4i8_...
    9771          14 :     printTypedVectorList<0, 'b'>(MI, 1, STI, O);
    9772          14 :     printVectorIndex(MI, 2, STI, O);
    9773          14 :     O << ", [";
    9774          14 :     printOperand(MI, 3, STI, O);
    9775          14 :     break;
    9776           6 :   case 35:
    9777             :     // LD1i8_POST, LD2i8_POST, LD3i8_POST, LD4i8_POST
    9778           6 :     printTypedVectorList<0, 'b'>(MI, 2, STI, O);
    9779           6 :     printVectorIndex(MI, 3, STI, O);
    9780           6 :     O << ", [";
    9781           6 :     printOperand(MI, 4, STI, O);
    9782           6 :     O << "], ";
    9783           6 :     break;
    9784        1933 :   case 36:
    9785             :     // MSR
    9786        1933 :     printMSRSystemRegister(MI, 0, STI, O);
    9787        1933 :     O << ", ";
    9788        1933 :     printOperand(MI, 1, STI, O);
    9789        1933 :     return;
    9790             :     break;
    9791          24 :   case 37:
    9792             :     // MSRpstateImm1, MSRpstateImm4
    9793          24 :     printSystemPStateField(MI, 0, STI, O);
    9794          24 :     O << ", ";
    9795          24 :     printOperand(MI, 1, STI, O);
    9796          24 :     return;
    9797             :     break;
    9798          60 :   case 38:
    9799             :     // PRFMl, PRFMroW, PRFMroX, PRFMui, PRFUMi
    9800          60 :     printPrefetchOp(MI, 0, STI, O);
    9801          60 :     break;
    9802          17 :   case 39:
    9803             :     // ST1i16, ST2i16, ST3i16, ST4i16
    9804          17 :     printTypedVectorList<0, 'h'>(MI, 0, STI, O);
    9805          17 :     printVectorIndex(MI, 1, STI, O);
    9806          17 :     O << ", [";
    9807          17 :     printOperand(MI, 2, STI, O);
    9808             :     O << ']';
    9809             :     return;
    9810             :     break;
    9811          10 :   case 40:
    9812             :     // ST1i32, ST2i32, ST3i32, ST4i32
    9813          10 :     printTypedVectorList<0, 's'>(MI, 0, STI, O);
    9814          10 :     printVectorIndex(MI, 1, STI, O);
    9815          10 :     O << ", [";
    9816          10 :     printOperand(MI, 2, STI, O);
    9817             :     O << ']';
    9818             :     return;
    9819             :     break;
    9820          16 :   case 41:
    9821             :     // ST1i64, ST2i64, ST3i64, ST4i64
    9822          16 :     printTypedVectorList<0, 'd'>(MI, 0, STI, O);
    9823          16 :     printVectorIndex(MI, 1, STI, O);
    9824          16 :     O << ", [";
    9825          16 :     printOperand(MI, 2, STI, O);
    9826             :     O << ']';
    9827             :     return;
    9828             :     break;
    9829           9 :   case 42:
    9830             :     // ST1i8, ST2i8, ST3i8, ST4i8
    9831           9 :     printTypedVectorList<0, 'b'>(MI, 0, STI, O);
    9832           9 :     printVectorIndex(MI, 1, STI, O);
    9833           9 :     O << ", [";
    9834           9 :     printOperand(MI, 2, STI, O);
    9835             :     O << ']';
    9836             :     return;
    9837             :     break;
    9838             :   }
    9839             : 
    9840             : 
    9841             :   // Fragment 1 encoded into 6 bits for 41 unique commands.
    9842       34060 :   switch ((Bits >> 19) & 63) {
    9843           0 :   default: llvm_unreachable("Invalid command number.");
    9844        1522 :   case 0:
    9845             :     // ABSv16i8, ADDHNv8i16_v16i8, ADDPv16i8, ADDv16i8, AESDrr, AESErr, AESIM...
    9846        1522 :     O << ".16b, ";
    9847        1522 :     break;
    9848       18825 :   case 1:
    9849             :     // ABSv1i64, ADCSWr, ADCSXr, ADCWr, ADCXr, ADDPv2i64p, ADDSWri, ADDSWrs, ...
    9850       18825 :     O << ", ";
    9851       18825 :     break;
    9852        1167 :   case 2:
    9853             :     // ABSv2i32, ADDHNv2i64_v2i32, ADDPv2i32, ADDv2i32, BICv2i32, CLSv2i32, C...
    9854        1167 :     O << ".2s, ";
    9855        1167 :     break;
    9856        1215 :   case 3:
    9857             :     // ABSv2i64, ADDPv2i64, ADDv2i64, CMEQv2i64, CMEQv2i64rz, CMGEv2i64, CMGE...
    9858        1215 :     O << ".2d, ";
    9859        1215 :     break;
    9860         854 :   case 4:
    9861             :     // ABSv4i16, ADDHNv4i32_v4i16, ADDPv4i16, ADDv4i16, BICv4i16, CLSv4i16, C...
    9862         854 :     O << ".4h, ";
    9863         854 :     break;
    9864        1911 :   case 5:
    9865             :     // ABSv4i32, ADDHNv2i64_v4i32, ADDPv4i32, ADDv4i32, BICv4i32, CLSv4i32, C...
    9866        1911 :     O << ".4s, ";
    9867        1911 :     break;
    9868        1039 :   case 6:
    9869             :     // ABSv8i16, ADDHNv4i32_v8i16, ADDPv8i16, ADDv8i16, BICv8i16, CLSv8i16, C...
    9870        1039 :     O << ".8h, ";
    9871        1039 :     break;
    9872         742 :   case 7:
    9873             :     // ABSv8i8, ADDHNv8i16_v8i8, ADDPv8i8, ADDv8i8, ANDv8i8, BICv8i8, BIFv8i8...
    9874         742 :     O << ".8b, ";
    9875         742 :     break;
    9876             :   case 8:
    9877             :     // AUTDZA, AUTDZB, AUTIZA, AUTIZB, BLR, BLRAAZ, BLRABZ, BR, BRAAZ, BRABZ,...
    9878             :     return;
    9879             :     break;
    9880          60 :   case 9:
    9881             :     // FCMPDri, FCMPEDri, FCMPEHri, FCMPESri, FCMPHri, FCMPSri
    9882          60 :     O << ", #0.0";
    9883          60 :     return;
    9884             :     break;
    9885          75 :   case 10:
    9886             :     // FMOVXDHighr, INSvi64gpr, INSvi64lane
    9887          75 :     O << ".d";
    9888          75 :     printVectorIndex(MI, 2, STI, O);
    9889          75 :     O << ", ";
    9890          75 :     break;
    9891         292 :   case 11:
    9892             :     // INSvi16gpr, INSvi16lane
    9893         292 :     O << ".h";
    9894         292 :     printVectorIndex(MI, 2, STI, O);
    9895         292 :     O << ", ";
    9896         292 :     break;
    9897          71 :   case 12:
    9898             :     // INSvi32gpr, INSvi32lane
    9899          71 :     O << ".s";
    9900          71 :     printVectorIndex(MI, 2, STI, O);
    9901          71 :     O << ", ";
    9902          71 :     break;
    9903         116 :   case 13:
    9904             :     // INSvi8gpr, INSvi8lane
    9905         116 :     O << ".b";
    9906         116 :     printVectorIndex(MI, 2, STI, O);
    9907         116 :     O << ", ";
    9908         116 :     break;
    9909             :   case 14:
    9910             :     // LD1Fourv16b_POST, LD1Fourv2d_POST, LD1Fourv4s_POST, LD1Fourv8h_POST, L...
    9911          20 :     printPostIncOperand<64>(MI, 3, STI, O);
    9912             :     return;
    9913             :     break;
    9914             :   case 15:
    9915             :     // LD1Fourv1d_POST, LD1Fourv2s_POST, LD1Fourv4h_POST, LD1Fourv8b_POST, LD...
    9916          46 :     printPostIncOperand<32>(MI, 3, STI, O);
    9917             :     return;
    9918             :     break;
    9919             :   case 16:
    9920             :     // LD1Onev16b_POST, LD1Onev2d_POST, LD1Onev4s_POST, LD1Onev8h_POST, LD1Tw...
    9921          34 :     printPostIncOperand<16>(MI, 3, STI, O);
    9922             :     return;
    9923             :     break;
    9924             :   case 17:
    9925             :     // LD1Onev1d_POST, LD1Onev2s_POST, LD1Onev4h_POST, LD1Onev8b_POST, LD1Rv1...
    9926          16 :     printPostIncOperand<8>(MI, 3, STI, O);
    9927             :     return;
    9928             :     break;
    9929             :   case 18:
    9930             :     // LD1Rv16b_POST, LD1Rv8b_POST
    9931           4 :     printPostIncOperand<1>(MI, 3, STI, O);
    9932             :     return;
    9933             :     break;
    9934             :   case 19:
    9935             :     // LD1Rv2s_POST, LD1Rv4s_POST, LD2Rv4h_POST, LD2Rv8h_POST, LD4Rv16b_POST,...
    9936           6 :     printPostIncOperand<4>(MI, 3, STI, O);
    9937             :     return;
    9938             :     break;
    9939             :   case 20:
    9940             :     // LD1Rv4h_POST, LD1Rv8h_POST, LD2Rv16b_POST, LD2Rv8b_POST
    9941           6 :     printPostIncOperand<2>(MI, 3, STI, O);
    9942             :     return;
    9943             :     break;
    9944             :   case 21:
    9945             :     // LD1Threev16b_POST, LD1Threev2d_POST, LD1Threev4s_POST, LD1Threev8h_POS...
    9946          24 :     printPostIncOperand<48>(MI, 3, STI, O);
    9947             :     return;
    9948             :     break;
    9949             :   case 22:
    9950             :     // LD1Threev1d_POST, LD1Threev2s_POST, LD1Threev4h_POST, LD1Threev8b_POST...
    9951          16 :     printPostIncOperand<24>(MI, 3, STI, O);
    9952             :     return;
    9953             :     break;
    9954          50 :   case 23:
    9955             :     // LD1i16, LD1i32, LD1i64, LD1i8, LD2i16, LD2i32, LD2i64, LD2i8, LD3i16, ...
    9956             :     O << ']';
    9957             :     return;
    9958             :     break;
    9959             :   case 24:
    9960             :     // LD1i16_POST, LD2i8_POST
    9961           2 :     printPostIncOperand<2>(MI, 5, STI, O);
    9962             :     return;
    9963             :     break;
    9964             :   case 25:
    9965             :     // LD1i32_POST, LD2i16_POST, LD4i8_POST
    9966           5 :     printPostIncOperand<4>(MI, 5, STI, O);
    9967             :     return;
    9968             :     break;
    9969             :   case 26:
    9970             :     // LD1i64_POST, LD2i32_POST, LD4i16_POST
    9971           6 :     printPostIncOperand<8>(MI, 5, STI, O);
    9972             :     return;
    9973             :     break;
    9974             :   case 27:
    9975             :     // LD1i8_POST
    9976           3 :     printPostIncOperand<1>(MI, 5, STI, O);
    9977             :     return;
    9978             :     break;
    9979             :   case 28:
    9980             :     // LD2i64_POST, LD4i32_POST
    9981           2 :     printPostIncOperand<16>(MI, 5, STI, O);
    9982             :     return;
    9983             :     break;
    9984             :   case 29:
    9985             :     // LD3Rv16b_POST, LD3Rv8b_POST
    9986           4 :     printPostIncOperand<3>(MI, 3, STI, O);
    9987             :     return;
    9988             :     break;
    9989             :   case 30:
    9990             :     // LD3Rv2s_POST, LD3Rv4s_POST
    9991           2 :     printPostIncOperand<12>(MI, 3, STI, O);
    9992             :     return;
    9993             :     break;
    9994             :   case 31:
    9995             :     // LD3Rv4h_POST, LD3Rv8h_POST
    9996           4 :     printPostIncOperand<6>(MI, 3, STI, O);
    9997             :     return;
    9998             :     break;
    9999             :   case 32:
   10000             :     // LD3i16_POST
   10001           1 :     printPostIncOperand<6>(MI, 5, STI, O);
   10002             :     return;
   10003             :     break;
   10004             :   case 33:
   10005             :     // LD3i32_POST
   10006           3 :     printPostIncOperand<12>(MI, 5, STI, O);
   10007             :     return;
   10008             :     break;
   10009             :   case 34:
   10010             :     // LD3i64_POST
   10011           1 :     printPostIncOperand<24>(MI, 5, STI, O);
   10012             :     return;
   10013             :     break;
   10014             :   case 35:
   10015             :     // LD3i8_POST
   10016           1 :     printPostIncOperand<3>(MI, 5, STI, O);
   10017             :     return;
   10018             :     break;
   10019             :   case 36:
   10020             :     // LD4i64_POST
   10021           3 :     printPostIncOperand<32>(MI, 5, STI, O);
   10022             :     return;
   10023             :     break;
   10024        5723 :   case 37:
   10025             :     // LDAPRB, LDAPRH, LDAPRW, LDAPRX, LDARB, LDARH, LDARW, LDARX, LDAXRB, LD...
   10026        5723 :     O << ", [";
   10027        5723 :     break;
   10028           8 :   case 38:
   10029             :     // PMULLv1i64, PMULLv2i64
   10030           8 :     O << ".1q, ";
   10031           8 :     printVRegOperand(MI, 1, STI, O);
   10032           8 :     break;
   10033           5 :   case 39:
   10034             :     // SADALPv2i32_v1i64, SADDLPv2i32_v1i64, UADALPv2i32_v1i64, UADDLPv2i32_v...
   10035           5 :     O << ".1d, ";
   10036           5 :     break;
   10037          24 :   case 40:
   10038             :     // ST1i16_POST, ST1i32_POST, ST1i64_POST, ST1i8_POST, ST2i16_POST, ST2i32...
   10039          24 :     O << "], ";
   10040          24 :     break;
   10041             :   }
   10042             : 
   10043             : 
   10044             :   // Fragment 2 encoded into 5 bits for 29 unique commands.
   10045       33589 :   switch ((Bits >> 25) & 31) {
   10046           0 :   default: llvm_unreachable("Invalid command number.");
   10047        7447 :   case 0:
   10048             :     // ABSv16i8, ABSv2i32, ABSv2i64, ABSv4i16, ABSv4i32, ABSv8i16, ABSv8i8, A...
   10049        7447 :     printVRegOperand(MI, 1, STI, O);
   10050        7447 :     break;
   10051       15463 :   case 1:
   10052             :     // ABSv1i64, ADCSWr, ADCSXr, ADCWr, ADCXr, ADDSWri, ADDSWrs, ADDSWrx, ADD...
   10053       15463 :     printOperand(MI, 1, STI, O);
   10054       15463 :     break;
   10055        1519 :   case 2:
   10056             :     // ADDHNv2i64_v4i32, ADDHNv4i32_v8i16, ADDHNv8i16_v16i8, AESDrr, AESErr, ...
   10057        1519 :     printVRegOperand(MI, 2, STI, O);
   10058        1519 :     break;
   10059        1879 :   case 3:
   10060             :     // ADRP
   10061        1879 :     printAdrpLabel(MI, 1, STI, O);
   10062        1879 :     return;
   10063             :     break;
   10064        2311 :   case 4:
   10065             :     // BFMWri, BFMXri, CASAB, CASAH, CASALB, CASALH, CASALW, CASALX, CASAW, C...
   10066        2311 :     printOperand(MI, 2, STI, O);
   10067        2311 :     break;
   10068         274 :   case 5:
   10069             :     // BICv2i32, BICv4i16, BICv4i32, BICv8i16, MOVKWi, MOVKXi, ORRv2i32, ORRv...
   10070         274 :     printImm(MI, 2, STI, O);
   10071         274 :     printShifter(MI, 3, STI, O);
   10072         274 :     return;
   10073             :     break;
   10074         290 :   case 6:
   10075             :     // CBNZW, CBNZX, CBZW, CBZX, LDRDl, LDRQl, LDRSWl, LDRSl, LDRWl, LDRXl, P...
   10076         290 :     printAlignedLabel(MI, 1, STI, O);
   10077         290 :     return;
   10078             :     break;
   10079         124 :   case 7:
   10080             :     // FMOVDi, FMOVHi, FMOVSi, FMOVv2f32_ns, FMOVv2f64_ns, FMOVv4f16_ns, FMOV...
   10081         124 :     printFPImmOperand(MI, 1, STI, O);
   10082         124 :     return;
   10083             :     break;
   10084         385 :   case 8:
   10085             :     // INSvi16gpr, INSvi32gpr, INSvi64gpr, INSvi8gpr
   10086         385 :     printOperand(MI, 3, STI, O);
   10087         385 :     return;
   10088             :     break;
   10089         163 :   case 9:
   10090             :     // INSvi16lane, INSvi32lane, INSvi64lane, INSvi8lane
   10091         163 :     printVRegOperand(MI, 3, STI, O);
   10092         163 :     break;
   10093         962 :   case 10:
   10094             :     // LDADDAB, LDADDAH, LDADDALB, LDADDALH, LDADDALW, LDADDALX, LDADDAW, LDA...
   10095         962 :     printOperand(MI, 0, STI, O);
   10096         962 :     O << ", [";
   10097         962 :     printOperand(MI, 2, STI, O);
   10098             :     O << ']';
   10099             :     return;
   10100             :     break;
   10101         157 :   case 11:
   10102             :     // MOVID, MOVIv2d_ns
   10103         157 :     printSIMDType10Operand(MI, 1, STI, O);
   10104         157 :     return;
   10105             :     break;
   10106         212 :   case 12:
   10107             :     // MOVIv16b_ns, MOVIv2i32, MOVIv2s_msl, MOVIv4i16, MOVIv4i32, MOVIv4s_msl...
   10108         212 :     printImm(MI, 1, STI, O);
   10109         212 :     break;
   10110        2308 :   case 13:
   10111             :     // MRS
   10112        2308 :     printMRSSystemRegister(MI, 1, STI, O);
   10113        2308 :     return;
   10114             :     break;
   10115           4 :   case 14:
   10116             :     // PMULLv1i64
   10117           4 :     O << ".1d, ";
   10118           4 :     printVRegOperand(MI, 2, STI, O);
   10119           4 :     O << ".1d";
   10120           4 :     return;
   10121             :     break;
   10122           4 :   case 15:
   10123             :     // PMULLv2i64
   10124           4 :     O << ".2d, ";
   10125           4 :     printVRegOperand(MI, 2, STI, O);
   10126           4 :     O << ".2d";
   10127           4 :     return;
   10128             :     break;
   10129             :   case 16:
   10130             :     // ST1i16_POST, ST2i8_POST
   10131           2 :     printPostIncOperand<2>(MI, 4, STI, O);
   10132             :     return;
   10133             :     break;
   10134             :   case 17:
   10135             :     // ST1i32_POST, ST2i16_POST, ST4i8_POST
   10136           5 :     printPostIncOperand<4>(MI, 4, STI, O);
   10137             :     return;
   10138             :     break;
   10139             :   case 18:
   10140             :     // ST1i64_POST, ST2i32_POST, ST4i16_POST
   10141           7 :     printPostIncOperand<8>(MI, 4, STI, O);
   10142             :     return;
   10143             :     break;
   10144             :   case 19:
   10145             :     // ST1i8_POST
   10146           1 :     printPostIncOperand<1>(MI, 4, STI, O);
   10147             :     return;
   10148             :     break;
   10149             :   case 20:
   10150             :     // ST2i64_POST, ST4i32_POST
   10151           2 :     printPostIncOperand<16>(MI, 4, STI, O);
   10152             :     return;
   10153             :     break;
   10154             :   case 21:
   10155             :     // ST3i16_POST
   10156           3 :     printPostIncOperand<6>(MI, 4, STI, O);
   10157             :     return;
   10158             :     break;
   10159             :   case 22:
   10160             :     // ST3i32_POST
   10161           1 :     printPostIncOperand<12>(MI, 4, STI, O);
   10162             :     return;
   10163             :     break;
   10164             :   case 23:
   10165             :     // ST3i64_POST
   10166           1 :     printPostIncOperand<24>(MI, 4, STI, O);
   10167             :     return;
   10168             :     break;
   10169             :   case 24:
   10170             :     // ST3i8_POST
   10171           1 :     printPostIncOperand<3>(MI, 4, STI, O);
   10172             :     return;
   10173             :     break;
   10174             :   case 25:
   10175             :     // ST4i64_POST
   10176           1 :     printPostIncOperand<32>(MI, 4, STI, O);
   10177             :     return;
   10178             :     break;
   10179           9 :   case 26:
   10180             :     // SYSxt
   10181           9 :     printSysCROperand(MI, 1, STI, O);
   10182           9 :     O << ", ";
   10183           9 :     printSysCROperand(MI, 2, STI, O);
   10184           9 :     O << ", ";
   10185           9 :     printOperand(MI, 3, STI, O);
   10186           9 :     O << ", ";
   10187           9 :     printOperand(MI, 4, STI, O);
   10188           9 :     return;
   10189             :     break;
   10190          28 :   case 27:
   10191             :     // TBLv16i8Four, TBLv16i8One, TBLv16i8Three, TBLv16i8Two, TBLv8i8Four, TB...
   10192          28 :     printTypedVectorList<16, 'b'>(MI, 1, STI, O);
   10193          28 :     O << ", ";
   10194          28 :     printVRegOperand(MI, 2, STI, O);
   10195          28 :     break;
   10196          26 :   case 28:
   10197             :     // TBXv16i8Four, TBXv16i8One, TBXv16i8Three, TBXv16i8Two, TBXv8i8Four, TB...
   10198          26 :     printTypedVectorList<16, 'b'>(MI, 2, STI, O);
   10199          26 :     O << ", ";
   10200          26 :     printVRegOperand(MI, 3, STI, O);
   10201          26 :     break;
   10202             :   }
   10203             : 
   10204             : 
   10205             :   // Fragment 3 encoded into 6 bits for 45 unique commands.
   10206       27169 :   switch ((Bits >> 30) & 63) {
   10207           0 :   default: llvm_unreachable("Invalid command number.");
   10208         547 :   case 0:
   10209             :     // ABSv16i8, ADDVv16i8v, AESDrr, AESErr, AESIMCrr, AESMCrr, CLSv16i8, CLZ...
   10210         547 :     O << ".16b";
   10211         547 :     return;
   10212             :     break;
   10213             :   case 1:
   10214             :     // ABSv1i64, ADR, AUTDA, AUTDB, AUTIA, AUTIB, BLRAA, BLRAB, BRAA, BRAB, C...
   10215             :     return;
   10216             :     break;
   10217         213 :   case 2:
   10218             :     // ABSv2i32, CLSv2i32, CLZv2i32, FABSv2f32, FADDPv2i32p, FCVTASv2f32, FCV...
   10219         213 :     O << ".2s";
   10220         213 :     return;
   10221             :     break;
   10222         158 :   case 3:
   10223             :     // ABSv2i64, ADDPv2i64p, FABSv2f64, FADDPv2i64p, FCVTASv2f64, FCVTAUv2f64...
   10224         158 :     O << ".2d";
   10225         158 :     return;
   10226             :     break;
   10227         196 :   case 4:
   10228             :     // ABSv4i16, ADDVv4i16v, CLSv4i16, CLZv4i16, FABSv4f16, FCVTASv4f16, FCVT...
   10229         196 :     O << ".4h";
   10230         196 :     return;
   10231             :     break;
   10232         449 :   case 5:
   10233             :     // ABSv4i32, ADDVv4i32v, CLSv4i32, CLZv4i32, FABSv4f32, FCVTASv4f32, FCVT...
   10234         449 :     O << ".4s";
   10235         449 :     return;
   10236             :     break;
   10237         213 :   case 6:
   10238             :     // ABSv8i16, ADDVv8i16v, CLSv8i16, CLZv8i16, FABSv8f16, FCVTASv8f16, FCVT...
   10239         213 :     O << ".8h";
   10240         213 :     return;
   10241             :     break;
   10242         177 :   case 7:
   10243             :     // ABSv8i8, ADDVv8i8v, CLSv8i8, CLZv8i8, CNTv8i8, NEGv8i8, NOTv8i8, RBITv...
   10244         177 :     O << ".8b";
   10245         177 :     return;
   10246             :     break;
   10247       12565 :   case 8:
   10248             :     // ADCSWr, ADCSXr, ADCWr, ADCXr, ADDSWri, ADDSWrs, ADDSWrx, ADDSXri, ADDS...
   10249       12565 :     O << ", ";
   10250       12565 :     break;
   10251         664 :   case 9:
   10252             :     // ADDHNv2i64_v2i32, ADDHNv2i64_v4i32, ADDPv2i64, ADDv2i64, CMEQv2i64, CM...
   10253         664 :     O << ".2d, ";
   10254         664 :     break;
   10255        1132 :   case 10:
   10256             :     // ADDHNv4i32_v4i16, ADDHNv4i32_v8i16, ADDPv4i32, ADDv4i32, CMEQv4i32, CM...
   10257        1132 :     O << ".4s, ";
   10258        1132 :     break;
   10259         798 :   case 11:
   10260             :     // ADDHNv8i16_v16i8, ADDHNv8i16_v8i8, ADDPv8i16, ADDv8i16, CMEQv8i16, CMG...
   10261         798 :     O << ".8h, ";
   10262         798 :     break;
   10263        1007 :   case 12:
   10264             :     // ADDPv16i8, ADDv16i8, ANDv16i8, BICv16i8, BIFv16i8, BITv16i8, BSLv16i8,...
   10265        1007 :     O << ".16b, ";
   10266        1007 :     break;
   10267         851 :   case 13:
   10268             :     // ADDPv2i32, ADDv2i32, CMEQv2i32, CMGEv2i32, CMGTv2i32, CMHIv2i32, CMHSv...
   10269         851 :     O << ".2s, ";
   10270         851 :     break;
   10271         668 :   case 14:
   10272             :     // ADDPv4i16, ADDv4i16, CMEQv4i16, CMGEv4i16, CMGTv4i16, CMHIv4i16, CMHSv...
   10273         668 :     O << ".4h, ";
   10274         668 :     break;
   10275         596 :   case 15:
   10276             :     // ADDPv8i8, ADDv8i8, ANDv8i8, BICv8i8, BIFv8i8, BITv8i8, BSLv8i8, CMEQv8...
   10277         596 :     O << ".8b, ";
   10278         596 :     break;
   10279        1863 :   case 16:
   10280             :     // CASAB, CASAH, CASALB, CASALH, CASALW, CASALX, CASAW, CASAX, CASB, CASH...
   10281        1863 :     O << ", [";
   10282        1863 :     break;
   10283          20 :   case 17:
   10284             :     // CMEQv16i8rz, CMGEv16i8rz, CMGTv16i8rz, CMLEv16i8rz, CMLTv16i8rz
   10285          20 :     O << ".16b, #0";
   10286          20 :     return;
   10287             :     break;
   10288          20 :   case 18:
   10289             :     // CMEQv1i64rz, CMGEv1i64rz, CMGTv1i64rz, CMLEv1i64rz, CMLTv1i64rz
   10290          20 :     O << ", #0";
   10291          20 :     return;
   10292             :     break;
   10293          20 :   case 19:
   10294             :     // CMEQv2i32rz, CMGEv2i32rz, CMGTv2i32rz, CMLEv2i32rz, CMLTv2i32rz
   10295          20 :     O << ".2s, #0";
   10296          20 :     return;
   10297             :     break;
   10298          20 :   case 20:
   10299             :     // CMEQv2i64rz, CMGEv2i64rz, CMGTv2i64rz, CMLEv2i64rz, CMLTv2i64rz
   10300          20 :     O << ".2d, #0";
   10301          20 :     return;
   10302             :     break;
   10303          18 :   case 21:
   10304             :     // CMEQv4i16rz, CMGEv4i16rz, CMGTv4i16rz, CMLEv4i16rz, CMLTv4i16rz
   10305          18 :     O << ".4h, #0";
   10306          18 :     return;
   10307             :     break;
   10308          18 :   case 22:
   10309             :     // CMEQv4i32rz, CMGEv4i32rz, CMGTv4i32rz, CMLEv4i32rz, CMLTv4i32rz
   10310          18 :     O << ".4s, #0";
   10311          18 :     return;
   10312             :     break;
   10313          20 :   case 23:
   10314             :     // CMEQv8i16rz, CMGEv8i16rz, CMGTv8i16rz, CMLEv8i16rz, CMLTv8i16rz
   10315          20 :     O << ".8h, #0";
   10316          20 :     return;
   10317             :     break;
   10318          23 :   case 24:
   10319             :     // CMEQv8i8rz, CMGEv8i8rz, CMGTv8i8rz, CMLEv8i8rz, CMLTv8i8rz
   10320          23 :     O << ".8b, #0";
   10321          23 :     return;
   10322             :     break;
   10323         738 :   case 25:
   10324             :     // CPYi16, DUPv4i16lane, DUPv8i16lane, INSvi16lane, SMOVvi16to32, SMOVvi1...
   10325         738 :     O << ".h";
   10326         738 :     break;
   10327         127 :   case 26:
   10328             :     // CPYi32, DUPv2i32lane, DUPv4i32lane, INSvi32lane, SMOVvi32to64, UMOVvi3...
   10329         127 :     O << ".s";
   10330         127 :     break;
   10331         107 :   case 27:
   10332             :     // CPYi64, DUPv2i64lane, FMOVDXHighr, INSvi64lane, UMOVvi64
   10333         107 :     O << ".d";
   10334         107 :     break;
   10335         258 :   case 28:
   10336             :     // CPYi8, DUPv16i8lane, DUPv8i8lane, INSvi8lane, SMOVvi8to32, SMOVvi8to64...
   10337         258 :     O << ".b";
   10338         258 :     break;
   10339           2 :   case 29:
   10340             :     // FADDPv2i16p, FMAXNMPv2i16p, FMAXPv2i16p, FMINNMPv2i16p, FMINPv2i16p
   10341           2 :     O << ".2h";
   10342           2 :     return;
   10343             :     break;
   10344          55 :   case 30:
   10345             :     // FCMEQv1i16rz, FCMEQv1i32rz, FCMEQv1i64rz, FCMGEv1i16rz, FCMGEv1i32rz, ...
   10346          55 :     O << ", #0.0";
   10347          55 :     return;
   10348             :     break;
   10349          32 :   case 31:
   10350             :     // FCMEQv2i32rz, FCMGEv2i32rz, FCMGTv2i32rz, FCMLEv2i32rz, FCMLTv2i32rz
   10351          32 :     O << ".2s, #0.0";
   10352          32 :     return;
   10353             :     break;
   10354          35 :   case 32:
   10355             :     // FCMEQv2i64rz, FCMGEv2i64rz, FCMGTv2i64rz, FCMLEv2i64rz, FCMLTv2i64rz
   10356          35 :     O << ".2d, #0.0";
   10357          35 :     return;
   10358             :     break;
   10359          10 :   case 33:
   10360             :     // FCMEQv4i16rz, FCMGEv4i16rz, FCMGTv4i16rz, FCMLEv4i16rz, FCMLTv4i16rz
   10361          10 :     O << ".4h, #0.0";
   10362          10 :     return;
   10363             :     break;
   10364          35 :   case 34:
   10365             :     // FCMEQv4i32rz, FCMGEv4i32rz, FCMGTv4i32rz, FCMLEv4i32rz, FCMLTv4i32rz
   10366          35 :     O << ".4s, #0.0";
   10367          35 :     return;
   10368             :     break;
   10369          10 :   case 35:
   10370             :     // FCMEQv8i16rz, FCMGEv8i16rz, FCMGTv8i16rz, FCMLEv8i16rz, FCMLTv8i16rz
   10371          10 :     O << ".8h, #0.0";
   10372          10 :     return;
   10373             :     break;
   10374         338 :   case 36:
   10375             :     // LDAPRB, LDAPRH, LDAPRW, LDAPRX, LDARB, LDARH, LDARW, LDARX, LDAXRB, LD...
   10376             :     O << ']';
   10377             :     return;
   10378             :     break;
   10379         670 :   case 37:
   10380             :     // LDRBBpost, LDRBpost, LDRDpost, LDRHHpost, LDRHpost, LDRQpost, LDRSBWpo...
   10381         670 :     O << "], ";
   10382         670 :     printOperand(MI, 3, STI, O);
   10383         670 :     return;
   10384             :     break;
   10385         183 :   case 38:
   10386             :     // MOVIv2i32, MOVIv2s_msl, MOVIv4i16, MOVIv4i32, MOVIv4s_msl, MOVIv8i16, ...
   10387         183 :     printShifter(MI, 2, STI, O);
   10388         183 :     return;
   10389             :     break;
   10390           3 :   case 39:
   10391             :     // SHLLv16i8
   10392           3 :     O << ".16b, #8";
   10393           3 :     return;
   10394             :     break;
   10395           4 :   case 40:
   10396             :     // SHLLv2i32
   10397           4 :     O << ".2s, #32";
   10398           4 :     return;
   10399             :     break;
   10400           4 :   case 41:
   10401             :     // SHLLv4i16
   10402           4 :     O << ".4h, #16";
   10403           4 :     return;
   10404             :     break;
   10405           3 :   case 42:
   10406             :     // SHLLv4i32
   10407           3 :     O << ".4s, #32";
   10408           3 :     return;
   10409             :     break;
   10410           3 :   case 43:
   10411             :     // SHLLv8i16
   10412           3 :     O << ".8h, #16";
   10413           3 :     return;
   10414             :     break;
   10415           4 :   case 44:
   10416             :     // SHLLv8i8
   10417           4 :     O << ".8b, #8";
   10418           4 :     return;
   10419             :     break;
   10420             :   }
   10421             : 
   10422             : 
   10423             :   // Fragment 4 encoded into 5 bits for 20 unique commands.
   10424       21374 :   switch ((Bits >> 36) & 31) {
   10425           0 :   default: llvm_unreachable("Invalid command number.");
   10426        5507 :   case 0:
   10427             :     // ADCSWr, ADCSXr, ADCWr, ADCXr, ADDSXrx64, ADDXrx64, ADDv1i64, ASRVWr, A...
   10428        5507 :     printOperand(MI, 2, STI, O);
   10429        5507 :     break;
   10430        4225 :   case 1:
   10431             :     // ADDHNv2i64_v2i32, ADDHNv4i32_v4i16, ADDHNv8i16_v8i8, ADDPv16i8, ADDPv2...
   10432        4225 :     printVRegOperand(MI, 2, STI, O);
   10433        4225 :     break;
   10434        1126 :   case 2:
   10435             :     // ADDHNv2i64_v4i32, ADDHNv4i32_v8i16, ADDHNv8i16_v16i8, BITv16i8, BITv8i...
   10436        1126 :     printVRegOperand(MI, 3, STI, O);
   10437        1126 :     break;
   10438        2738 :   case 3:
   10439             :     // ADDSWri, ADDSXri, ADDWri, ADDXri, SUBSWri, SUBSXri, SUBWri, SUBXri
   10440        2738 :     printAddSubImm(MI, 2, STI, O);
   10441        2738 :     return;
   10442             :     break;
   10443         582 :   case 4:
   10444             :     // ADDSWrs, ADDSXrs, ADDWrs, ADDXrs, ANDSWrs, ANDSXrs, ANDWrs, ANDXrs, BI...
   10445         582 :     printShiftedRegister(MI, 2, STI, O);
   10446         582 :     return;
   10447             :     break;
   10448         266 :   case 5:
   10449             :     // ADDSWrx, ADDSXrx, ADDWrx, ADDXrx, SUBSWrx, SUBSXrx, SUBWrx, SUBXrx
   10450         266 :     printExtendedRegister(MI, 2, STI, O);
   10451         266 :     return;
   10452             :     break;
   10453         518 :   case 6:
   10454             :     // ANDSWri, ANDWri, EORWri, ORRWri
   10455         518 :     printLogicalImm32(MI, 2, STI, O);
   10456         518 :     return;
   10457             :     break;
   10458         161 :   case 7:
   10459             :     // ANDSXri, ANDXri, EORXri, ORRXri
   10460         161 :     printLogicalImm64(MI, 2, STI, O);
   10461         161 :     return;
   10462             :     break;
   10463        1702 :   case 8:
   10464             :     // BFMWri, BFMXri, CASAB, CASAH, CASALB, CASALH, CASALW, CASALX, CASAW, C...
   10465        1702 :     printOperand(MI, 3, STI, O);
   10466        1702 :     break;
   10467        1067 :   case 9:
   10468             :     // CPYi16, CPYi32, CPYi64, CPYi8, DUPv16i8lane, DUPv2i32lane, DUPv2i64lan...
   10469        1067 :     printVectorIndex(MI, 2, STI, O);
   10470        1067 :     return;
   10471             :     break;
   10472         163 :   case 10:
   10473             :     // INSvi16lane, INSvi32lane, INSvi64lane, INSvi8lane
   10474         163 :     printVectorIndex(MI, 4, STI, O);
   10475         163 :     return;
   10476             :     break;
   10477           8 :   case 11:
   10478             :     // LDRAAindexed, LDRABindexed
   10479           8 :     printImmScale<8>(MI, 2, STI, O);
   10480             :     O << ']';
   10481             :     return;
   10482             :     break;
   10483           8 :   case 12:
   10484             :     // LDRAAwriteback, LDRABwriteback
   10485           8 :     printImmScale<8>(MI, 3, STI, O);
   10486           8 :     O << "]!";
   10487           8 :     return;
   10488             :     break;
   10489             :   case 13:
   10490             :     // LDRBBui, LDRBui, LDRSBWui, LDRSBXui, STRBBui, STRBui
   10491         460 :     printUImm12Offset<1>(MI, 2, STI, O);
   10492             :     O << ']';
   10493             :     return;
   10494             :     break;
   10495             :   case 14:
   10496             :     // LDRDui, LDRXui, PRFMui, STRDui, STRXui
   10497        3460 :     printUImm12Offset<8>(MI, 2, STI, O);
   10498             :     O << ']';
   10499             :     return;
   10500             :     break;
   10501             :   case 15:
   10502             :     // LDRHHui, LDRHui, LDRSHWui, LDRSHXui, STRHHui, STRHui
   10503         418 :     printUImm12Offset<2>(MI, 2, STI, O);
   10504             :     O << ']';
   10505             :     return;
   10506             :     break;
   10507             :   case 16:
   10508             :     // LDRQui, STRQui
   10509         498 :     printUImm12Offset<16>(MI, 2, STI, O);
   10510             :     O << ']';
   10511             :     return;
   10512             :     break;
   10513             :   case 17:
   10514             :     // LDRSWui, LDRSui, LDRWui, STRSui, STRWui
   10515        1490 :     printUImm12Offset<4>(MI, 2, STI, O);
   10516             :     O << ']';
   10517             :     return;
   10518             :     break;
   10519          10 :   case 18:
   10520             :     // SYSLxt
   10521          10 :     printSysCROperand(MI, 2, STI, O);
   10522          10 :     O << ", ";
   10523          10 :     printSysCROperand(MI, 3, STI, O);
   10524          10 :     O << ", ";
   10525          10 :     printOperand(MI, 4, STI, O);
   10526          10 :     return;
   10527             :     break;
   10528         130 :   case 19:
   10529             :     // TBNZW, TBNZX, TBZW, TBZX
   10530         130 :     printAlignedLabel(MI, 2, STI, O);
   10531         130 :     return;
   10532             :     break;
   10533             :   }
   10534             : 
   10535             : 
   10536             :   // Fragment 5 encoded into 5 bits for 25 unique commands.
   10537       12560 :   switch ((Bits >> 41) & 31) {
   10538           0 :   default: llvm_unreachable("Invalid command number.");
   10539             :   case 0:
   10540             :     // ADCSWr, ADCSXr, ADCWr, ADCXr, ADDv1i64, ASRVWr, ASRVXr, CMEQv1i64, CMG...
   10541             :     return;
   10542             :     break;
   10543         468 :   case 1:
   10544             :     // ADDHNv2i64_v2i32, ADDHNv2i64_v4i32, ADDPv2i64, ADDv2i64, CMEQv2i64, CM...
   10545         468 :     O << ".2d";
   10546         468 :     return;
   10547             :     break;
   10548         781 :   case 2:
   10549             :     // ADDHNv4i32_v4i16, ADDHNv4i32_v8i16, ADDPv4i32, ADDv4i32, CMEQv4i32, CM...
   10550         781 :     O << ".4s";
   10551         781 :     return;
   10552             :     break;
   10553         490 :   case 3:
   10554             :     // ADDHNv8i16_v16i8, ADDHNv8i16_v8i8, ADDPv8i16, ADDv8i16, CMEQv8i16, CMG...
   10555         490 :     O << ".8h";
   10556         490 :     return;
   10557             :     break;
   10558         532 :   case 4:
   10559             :     // ADDPv16i8, ADDv16i8, ANDv16i8, BICv16i8, BIFv16i8, BITv16i8, BSLv16i8,...
   10560         532 :     O << ".16b";
   10561         532 :     return;
   10562             :     break;
   10563         592 :   case 5:
   10564             :     // ADDPv2i32, ADDv2i32, CMEQv2i32, CMGEv2i32, CMGTv2i32, CMHIv2i32, CMHSv...
   10565         592 :     O << ".2s";
   10566         592 :     return;
   10567             :     break;
   10568         453 :   case 6:
   10569             :     // ADDPv4i16, ADDv4i16, CMEQv4i16, CMGEv4i16, CMGTv4i16, CMHIv4i16, CMHSv...
   10570         453 :     O << ".4h";
   10571         453 :     return;
   10572             :     break;
   10573         499 :   case 7:
   10574             :     // ADDPv8i8, ADDv8i8, ANDv8i8, BICv8i8, BIFv8i8, BITv8i8, BSLv8i8, CMEQv8...
   10575         499 :     O << ".8b";
   10576         499 :     return;
   10577             :     break;
   10578          14 :   case 8:
   10579             :     // ADDSXrx64, ADDXrx64, SUBSXrx64, SUBXrx64
   10580          14 :     printArithExtend(MI, 3, STI, O);
   10581          14 :     return;
   10582             :     break;
   10583        2819 :   case 9:
   10584             :     // BFMWri, BFMXri, CCMNWi, CCMNWr, CCMNXi, CCMNXr, CCMPWi, CCMPWr, CCMPXi...
   10585        2819 :     O << ", ";
   10586        2819 :     break;
   10587         798 :   case 10:
   10588             :     // CASAB, CASAH, CASALB, CASALH, CASALW, CASALX, CASAW, CASAX, CASB, CASH...
   10589             :     O << ']';
   10590             :     return;
   10591             :     break;
   10592         424 :   case 11:
   10593             :     // EXTv16i8
   10594         424 :     O << ".16b, ";
   10595         424 :     printOperand(MI, 3, STI, O);
   10596         424 :     return;
   10597             :     break;
   10598          38 :   case 12:
   10599             :     // EXTv8i8
   10600          38 :     O << ".8b, ";
   10601          38 :     printOperand(MI, 3, STI, O);
   10602          38 :     return;
   10603             :     break;
   10604          32 :   case 13:
   10605             :     // FCADDv2f32, FCMLAv2f32
   10606          32 :     O << ".2s, ";
   10607          32 :     break;
   10608           8 :   case 14:
   10609             :     // FCADDv2f64, FCMLAv2f64
   10610           8 :     O << ".2d, ";
   10611           8 :     break;
   10612           4 :   case 15:
   10613             :     // FCADDv4f16, FCMLAv4f16
   10614           4 :     O << ".4h, ";
   10615           4 :     break;
   10616           8 :   case 16:
   10617             :     // FCADDv4f32, FCMLAv4f32
   10618           8 :     O << ".4s, ";
   10619           8 :     break;
   10620           4 :   case 17:
   10621             :     // FCADDv8f16, FCMLAv8f16
   10622           4 :     O << ".8h, ";
   10623           4 :     break;
   10624         413 :   case 18:
   10625             :     // FCMLAv4f16_indexed, FCMLAv8f16_indexed, FMLAv1i16_indexed, FMLAv4i16_i...
   10626         413 :     O << ".h";
   10627         413 :     break;
   10628         508 :   case 19:
   10629             :     // FCMLAv4f32_indexed, FMLAv1i32_indexed, FMLAv2i32_indexed, FMLAv4i32_in...
   10630         508 :     O << ".s";
   10631         508 :     break;
   10632          67 :   case 20:
   10633             :     // FMLAv1i64_indexed, FMLAv2i64_indexed, FMLSv1i64_indexed, FMLSv2i64_ind...
   10634          67 :     O << ".d";
   10635          67 :     break;
   10636         324 :   case 21:
   10637             :     // LDPDpost, LDPQpost, LDPSWpost, LDPSpost, LDPWpost, LDPXpost, STPDpost,...
   10638         324 :     O << "], ";
   10639         324 :     break;
   10640         692 :   case 22:
   10641             :     // LDRBBpre, LDRBpre, LDRDpre, LDRHHpre, LDRHpre, LDRQpre, LDRSBWpre, LDR...
   10642         692 :     O << "]!";
   10643         692 :     return;
   10644             :     break;
   10645          30 :   case 23:
   10646             :     // SDOTIDX2S, SDOTIDX4S, UDOTIDX2S, UDOTIDX4S
   10647          30 :     O << ".4b";
   10648          30 :     printVectorIndex(MI, 4, STI, O);
   10649          30 :     return;
   10650             :     break;
   10651          43 :   case 24:
   10652             :     // STLXPW, STLXPX, STXPW, STXPX
   10653          43 :     O << ", [";
   10654          43 :     printOperand(MI, 3, STI, O);
   10655             :     O << ']';
   10656             :     return;
   10657             :     break;
   10658             :   }
   10659             : 
   10660             : 
   10661             :   // Fragment 6 encoded into 5 bits for 23 unique commands.
   10662        4187 :   switch ((Bits >> 46) & 31) {
   10663           0 :   default: llvm_unreachable("Invalid command number.");
   10664           0 :   case 0:
   10665             :     // BFMWri, BFMXri
   10666           0 :     printOperand(MI, 4, STI, O);
   10667           0 :     return;
   10668             :     break;
   10669         588 :   case 1:
   10670             :     // CCMNWi, CCMNWr, CCMNXi, CCMNXr, CCMPWi, CCMPWr, CCMPXi, CCMPXr, CSELWr...
   10671         588 :     printCondCode(MI, 3, STI, O);
   10672         588 :     return;
   10673             :     break;
   10674         646 :   case 2:
   10675             :     // EXTRWrri, EXTRXrri, FMADDDrrr, FMADDHrrr, FMADDSrrr, FMSUBDrrr, FMSUBH...
   10676         646 :     printOperand(MI, 3, STI, O);
   10677         646 :     return;
   10678             :     break;
   10679          24 :   case 3:
   10680             :     // FCADDv2f32, FCADDv2f64, FCADDv4f16, FCADDv4f32, FCADDv8f16
   10681          24 :     printComplexRotationOp<180, 90>(MI, 3, STI, O);
   10682          24 :     return;
   10683             :     break;
   10684          32 :   case 4:
   10685             :     // FCMLAv2f32, FCMLAv2f64, FCMLAv4f16, FCMLAv4f32, FCMLAv8f16
   10686          32 :     printComplexRotationOp<90, 0>(MI, 4, STI, O);
   10687          32 :     return;
   10688             :     break;
   10689         555 :   case 5:
   10690             :     // FCMLAv4f16_indexed, FCMLAv4f32_indexed, FCMLAv8f16_indexed, FMLAv1i16_...
   10691         555 :     printVectorIndex(MI, 4, STI, O);
   10692         555 :     break;
   10693         433 :   case 6:
   10694             :     // FMULXv1i16_indexed, FMULXv1i32_indexed, FMULXv1i64_indexed, FMULXv2i32...
   10695         433 :     printVectorIndex(MI, 3, STI, O);
   10696         433 :     return;
   10697             :     break;
   10698         689 :   case 7:
   10699             :     // LDNPDi, LDNPXi, LDPDi, LDPXi, STNPDi, STNPXi, STPDi, STPXi
   10700         689 :     printImmScale<8>(MI, 3, STI, O);
   10701             :     O << ']';
   10702             :     return;
   10703             :     break;
   10704          72 :   case 8:
   10705             :     // LDNPQi, LDPQi, STNPQi, STPQi
   10706          72 :     printImmScale<16>(MI, 3, STI, O);
   10707             :     O << ']';
   10708             :     return;
   10709             :     break;
   10710         158 :   case 9:
   10711             :     // LDNPSi, LDNPWi, LDPSWi, LDPSi, LDPWi, STNPSi, STNPWi, STPSi, STPWi
   10712         158 :     printImmScale<4>(MI, 3, STI, O);
   10713             :     O << ']';
   10714             :     return;
   10715             :     break;
   10716         485 :   case 10:
   10717             :     // LDPDpost, LDPDpre, LDPXpost, LDPXpre, STPDpost, STPDpre, STPXpost, STP...
   10718         485 :     printImmScale<8>(MI, 4, STI, O);
   10719         485 :     break;
   10720          25 :   case 11:
   10721             :     // LDPQpost, LDPQpre, STPQpost, STPQpre
   10722          25 :     printImmScale<16>(MI, 4, STI, O);
   10723          25 :     break;
   10724         119 :   case 12:
   10725             :     // LDPSWpost, LDPSWpre, LDPSpost, LDPSpre, LDPWpost, LDPWpre, STPSpost, S...
   10726         119 :     printImmScale<4>(MI, 4, STI, O);
   10727         119 :     break;
   10728             :   case 13:
   10729             :     // LDRBBroW, LDRBroW, LDRSBWroW, LDRSBXroW, STRBBroW, STRBroW
   10730          46 :     printMemExtend<'w', 8>(MI, 3, STI, O);
   10731             :     O << ']';
   10732             :     return;
   10733             :     break;
   10734             :   case 14:
   10735             :     // LDRBBroX, LDRBroX, LDRSBWroX, LDRSBXroX, STRBBroX, STRBroX
   10736          34 :     printMemExtend<'x', 8>(MI, 3, STI, O);
   10737             :     O << ']';
   10738             :     return;
   10739             :     break;
   10740             :   case 15:
   10741             :     // LDRDroW, LDRXroW, PRFMroW, STRDroW, STRXroW
   10742          88 :     printMemExtend<'w', 64>(MI, 3, STI, O);
   10743             :     O << ']';
   10744             :     return;
   10745             :     break;
   10746             :   case 16:
   10747             :     // LDRDroX, LDRXroX, PRFMroX, STRDroX, STRXroX
   10748         128 :     printMemExtend<'x', 64>(MI, 3, STI, O);
   10749             :     O << ']';
   10750             :     return;
   10751             :     break;
   10752             :   case 17:
   10753             :     // LDRHHroW, LDRHroW, LDRSHWroW, LDRSHXroW, STRHHroW, STRHroW
   10754          70 :     printMemExtend<'w', 16>(MI, 3, STI, O);
   10755             :     O << ']';
   10756             :     return;
   10757             :     break;
   10758             :   case 18:
   10759             :     // LDRHHroX, LDRHroX, LDRSHWroX, LDRSHXroX, STRHHroX, STRHroX
   10760          62 :     printMemExtend<'x', 16>(MI, 3, STI, O);
   10761             :     O << ']';
   10762             :     return;
   10763             :     break;
   10764             :   case 19:
   10765             :     // LDRQroW, STRQroW
   10766          68 :     printMemExtend<'w', 128>(MI, 3, STI, O);
   10767             :     O << ']';
   10768             :     return;
   10769             :     break;
   10770             :   case 20:
   10771             :     // LDRQroX, STRQroX
   10772          42 :     printMemExtend<'x', 128>(MI, 3, STI, O);
   10773             :     O << ']';
   10774             :     return;
   10775             :     break;
   10776             :   case 21:
   10777             :     // LDRSWroW, LDRSroW, LDRWroW, STRSroW, STRWroW
   10778          84 :     printMemExtend<'w', 32>(MI, 3, STI, O);
   10779             :     O << ']';
   10780             :     return;
   10781             :     break;
   10782             :   case 22:
   10783             :     // LDRSWroX, LDRSroX, LDRWroX, STRSroX, STRWroX
   10784         100 :     printMemExtend<'x', 32>(MI, 3, STI, O);
   10785             :     O << ']';
   10786             :     return;
   10787             :     break;
   10788             :   }
   10789             : 
   10790             : 
   10791             :   // Fragment 7 encoded into 2 bits for 3 unique commands.
   10792        1184 :   switch ((Bits >> 51) & 3) {
   10793           0 :   default: llvm_unreachable("Invalid command number.");
   10794          28 :   case 0:
   10795             :     // FCMLAv4f16_indexed, FCMLAv4f32_indexed, FCMLAv8f16_indexed
   10796          28 :     O << ", ";
   10797          28 :     printComplexRotationOp<90, 0>(MI, 5, STI, O);
   10798          28 :     return;
   10799             :     break;
   10800             :   case 1:
   10801             :     // FMLAv1i16_indexed, FMLAv1i32_indexed, FMLAv1i64_indexed, FMLAv2i32_ind...
   10802             :     return;
   10803             :     break;
   10804         305 :   case 2:
   10805             :     // LDPDpre, LDPQpre, LDPSWpre, LDPSpre, LDPWpre, LDPXpre, STPDpre, STPQpr...
   10806         305 :     O << "]!";
   10807         305 :     return;
   10808             :     break;
   10809             :   }
   10810             : 
   10811             : }
   10812             : 
   10813             : 
   10814             : /// getRegisterName - This method is automatically generated by tblgen
   10815             : /// from the register set description.  This returns the assembler name
   10816             : /// for the specified register.
   10817      147494 : const char *AArch64InstPrinter::
   10818             : getRegisterName(unsigned RegNo, unsigned AltIdx) {
   10819             :   assert(RegNo && RegNo < 484 && "Invalid register number!");
   10820             : 
   10821             :   static const char AsmStrsNoRegAltName[] = {
   10822             :   /* 0 */ 'D', '7', '_', 'D', '8', '_', 'D', '9', '_', 'D', '1', '0', 0,
   10823             :   /* 13 */ 'Q', '7', '_', 'Q', '8', '_', 'Q', '9', '_', 'Q', '1', '0', 0,
   10824             :   /* 26 */ 'W', '9', '_', 'W', '1', '0', 0,
   10825             :   /* 33 */ 'X', '9', '_', 'X', '1', '0', 0,
   10826             :   /* 40 */ 'b', '1', '0', 0,
   10827             :   /* 44 */ 'd', '1', '0', 0,
   10828             :   /* 48 */ 'h', '1', '0', 0,
   10829             :   /* 52 */ 'q', '1', '0', 0,
   10830             :   /* 56 */ 's', '1', '0', 0,
   10831             :   /* 60 */ 'w', '1', '0', 0,
   10832             :   /* 64 */ 'x', '1', '0', 0,
   10833             :   /* 68 */ 'D', '1', '7', '_', 'D', '1', '8', '_', 'D', '1', '9', '_', 'D', '2', '0', 0,
   10834             :   /* 84 */ 'Q', '1', '7', '_', 'Q', '1', '8', '_', 'Q', '1', '9', '_', 'Q', '2', '0', 0,
   10835             :   /* 100 */ 'W', '1', '9', '_', 'W', '2', '0', 0,
   10836             :   /* 108 */ 'X', '1', '9', '_', 'X', '2', '0', 0,
   10837             :   /* 116 */ 'b', '2', '0', 0,
   10838             :   /* 120 */ 'd', '2', '0', 0,
   10839             :   /* 124 */ 'h', '2', '0', 0,
   10840             :   /* 128 */ 'q', '2', '0', 0,
   10841             :   /* 132 */ 's', '2', '0', 0,
   10842             :   /* 136 */ 'w', '2', '0', 0,
   10843             :   /* 140 */ 'x', '2', '0', 0,
   10844             :   /* 144 */ 'D', '2', '7', '_', 'D', '2', '8', '_', 'D', '2', '9', '_', 'D', '3', '0', 0,
   10845             :   /* 160 */ 'Q', '2', '7', '_', 'Q', '2', '8', '_', 'Q', '2', '9', '_', 'Q', '3', '0', 0,
   10846             :   /* 176 */ 'W', '2', '9', '_', 'W', '3', '0', 0,
   10847             :   /* 184 */ 'b', '3', '0', 0,
   10848             :   /* 188 */ 'd', '3', '0', 0,
   10849             :   /* 192 */ 'h', '3', '0', 0,
   10850             :   /* 196 */ 'q', '3', '0', 0,
   10851             :   /* 200 */ 's', '3', '0', 0,
   10852             :   /* 204 */ 'w', '3', '0', 0,
   10853             :   /* 208 */ 'x', '3', '0', 0,
   10854             :   /* 212 */ 'D', '2', '9', '_', 'D', '3', '0', '_', 'D', '3', '1', '_', 'D', '0', 0,
   10855             :   /* 227 */ 'Q', '2', '9', '_', 'Q', '3', '0', '_', 'Q', '3', '1', '_', 'Q', '0', 0,
   10856             :   /* 242 */ 'W', 'Z', 'R', '_', 'W', '0', 0,
   10857             :   /* 249 */ 'X', 'Z', 'R', '_', 'X', '0', 0,
   10858             :   /* 256 */ 'b', '0', 0,
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   10865             :   /* 277 */ 'D', '8', '_', 'D', '9', '_', 'D', '1', '0', '_', 'D', '1', '1', 0,
   10866             :   /* 291 */ 'Q', '8', '_', 'Q', '9', '_', 'Q', '1', '0', '_', 'Q', '1', '1', 0,
   10867             :   /* 305 */ 'W', '1', '0', '_', 'W', '1', '1', 0,
   10868             :   /* 313 */ 'X', '1', '0', '_', 'X', '1', '1', 0,
   10869             :   /* 321 */ 'b', '1', '1', 0,
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   10871             :   /* 329 */ 'h', '1', '1', 0,
   10872             :   /* 333 */ 'q', '1', '1', 0,
   10873             :   /* 337 */ 's', '1', '1', 0,
   10874             :   /* 341 */ 'w', '1', '1', 0,
   10875             :   /* 345 */ 'x', '1', '1', 0,
   10876             :   /* 349 */ 'D', '1', '8', '_', 'D', '1', '9', '_', 'D', '2', '0', '_', 'D', '2', '1', 0,
   10877             :   /* 365 */ 'Q', '1', '8', '_', 'Q', '1', '9', '_', 'Q', '2', '0', '_', 'Q', '2', '1', 0,
   10878             :   /* 381 */ 'W', '2', '0', '_', 'W', '2', '1', 0,
   10879             :   /* 389 */ 'X', '2', '0', '_', 'X', '2', '1', 0,
   10880             :   /* 397 */ 'b', '2', '1', 0,
   10881             :   /* 401 */ 'd', '2', '1', 0,
   10882             :   /* 405 */ 'h', '2', '1', 0,
   10883             :   /* 409 */ 'q', '2', '1', 0,
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   10888             :   /* 441 */ 'Q', '2', '8', '_', 'Q', '2', '9', '_', 'Q', '3', '0', '_', 'Q', '3', '1', 0,
   10889             :   /* 457 */ 'b', '3', '1', 0,
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   10892             :   /* 469 */ 'q', '3', '1', 0,
   10893             :   /* 473 */ 's', '3', '1', 0,
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   10895             :   /* 491 */ 'Q', '3', '0', '_', 'Q', '3', '1', '_', 'Q', '0', '_', 'Q', '1', 0,
   10896             :   /* 505 */ 'W', '0', '_', 'W', '1', 0,
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   10902             :   /* 529 */ 's', '1', 0,
   10903             :   /* 532 */ 'w', '1', 0,
   10904             :   /* 535 */ 'x', '1', 0,
   10905             :   /* 538 */ 'D', '9', '_', 'D', '1', '0', '_', 'D', '1', '1', '_', 'D', '1', '2', 0,
   10906             :   /* 553 */ 'Q', '9', '_', 'Q', '1', '0', '_', 'Q', '1', '1', '_', 'Q', '1', '2', 0,
   10907             :   /* 568 */ 'W', '1', '1', '_', 'W', '1', '2', 0,
   10908             :   /* 576 */ 'X', '1', '1', '_', 'X', '1', '2', 0,
   10909             :   /* 584 */ 'b', '1', '2', 0,
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   10911             :   /* 592 */ 'h', '1', '2', 0,
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   10913             :   /* 600 */ 's', '1', '2', 0,
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   10916             :   /* 612 */ 'D', '1', '9', '_', 'D', '2', '0', '_', 'D', '2', '1', '_', 'D', '2', '2', 0,
   10917             :   /* 628 */ 'Q', '1', '9', '_', 'Q', '2', '0', '_', 'Q', '2', '1', '_', 'Q', '2', '2', 0,
   10918             :   /* 644 */ 'W', '2', '1', '_', 'W', '2', '2', 0,
   10919             :   /* 652 */ 'X', '2', '1', '_', 'X', '2', '2', 0,
   10920             :   /* 660 */ 'b', '2', '2', 0,
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   10928             :   /* 701 */ 'Q', '3', '1', '_', 'Q', '0', '_', 'Q', '1', '_', 'Q', '2', 0,
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   10930             :   /* 720 */ 'X', '1', '_', 'X', '2', 0,
   10931             :   /* 726 */ 'b', '2', 0,
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   10934             :   /* 735 */ 'q', '2', 0,
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   10937             :   /* 744 */ 'x', '2', 0,
   10938             :   /* 747 */ 'D', '1', '0', '_', 'D', '1', '1', '_', 'D', '1', '2', '_', 'D', '1', '3', 0,
   10939             :   /* 763 */ 'Q', '1', '0', '_', 'Q', '1', '1', '_', 'Q', '1', '2', '_', 'Q', '1', '3', 0,
   10940             :   /* 779 */ 'W', '1', '2', '_', 'W', '1', '3', 0,
   10941             :   /* 787 */ 'X', '1', '2', '_', 'X', '1', '3', 0,
   10942             :   /* 795 */ 'b', '1', '3', 0,
   10943             :   /* 799 */ 'd', '1', '3', 0,
   10944             :   /* 803 */ 'h', '1', '3', 0,
   10945             :   /* 807 */ 'q', '1', '3', 0,
   10946             :   /* 811 */ 's', '1', '3', 0,
   10947             :   /* 815 */ 'w', '1', '3', 0,
   10948             :   /* 819 */ 'x', '1', '3', 0,
   10949             :   /* 823 */ 'D', '2', '0', '_', 'D', '2', '1', '_', 'D', '2', '2', '_', 'D', '2', '3', 0,
   10950             :   /* 839 */ 'Q', '2', '0', '_', 'Q', '2', '1', '_', 'Q', '2', '2', '_', 'Q', '2', '3', 0,
   10951             :   /* 855 */ 'W', '2', '2', '_', 'W', '2', '3', 0,
   10952             :   /* 863 */ 'X', '2', '2', '_', 'X', '2', '3', 0,
   10953             :   /* 871 */ 'b', '2', '3', 0,
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   10960             :   /* 899 */ 'D', '0', '_', 'D', '1', '_', 'D', '2', '_', 'D', '3', 0,
   10961             :   /* 911 */ 'Q', '0', '_', 'Q', '1', '_', 'Q', '2', '_', 'Q', '3', 0,
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   10964             :   /* 935 */ 'b', '3', 0,
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   10972             :   /* 972 */ 'Q', '1', '1', '_', 'Q', '1', '2', '_', 'Q', '1', '3', '_', 'Q', '1', '4', 0,
   10973             :   /* 988 */ 'W', '1', '3', '_', 'W', '1', '4', 0,
   10974             :   /* 996 */ 'X', '1', '3', '_', 'X', '1', '4', 0,
   10975             :   /* 1004 */ 'b', '1', '4', 0,
   10976             :   /* 1008 */ 'd', '1', '4', 0,
   10977             :   /* 1012 */ 'h', '1', '4', 0,
   10978             :   /* 1016 */ 'q', '1', '4', 0,
   10979             :   /* 1020 */ 's', '1', '4', 0,
   10980             :   /* 1024 */ 'w', '1', '4', 0,
   10981             :   /* 1028 */ 'x', '1', '4', 0,
   10982             :   /* 1032 */ 'D', '2', '1', '_', 'D', '2', '2', '_', 'D', '2', '3', '_', 'D', '2', '4', 0,
   10983             :   /* 1048 */ 'Q', '2', '1', '_', 'Q', '2', '2', '_', 'Q', '2', '3', '_', 'Q', '2', '4', 0,
   10984             :   /* 1064 */ 'W', '2', '3', '_', 'W', '2', '4', 0,
   10985             :   /* 1072 */ 'X', '2', '3', '_', 'X', '2', '4', 0,
   10986             :   /* 1080 */ 'b', '2', '4', 0,
   10987             :   /* 1084 */ 'd', '2', '4', 0,
   10988             :   /* 1088 */ 'h', '2', '4', 0,
   10989             :   /* 1092 */ 'q', '2', '4', 0,
   10990             :   /* 1096 */ 's', '2', '4', 0,
   10991             :   /* 1100 */ 'w', '2', '4', 0,
   10992             :   /* 1104 */ 'x', '2', '4', 0,
   10993             :   /* 1108 */ 'D', '1', '_', 'D', '2', '_', 'D', '3', '_', 'D', '4', 0,
   10994             :   /* 1120 */ 'Q', '1', '_', 'Q', '2', '_', 'Q', '3', '_', 'Q', '4', 0,
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   10996             :   /* 1138 */ 'X', '3', '_', 'X', '4', 0,
   10997             :   /* 1144 */ 'b', '4', 0,
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   10999             :   /* 1150 */ 'h', '4', 0,
   11000             :   /* 1153 */ 'q', '4', 0,
   11001             :   /* 1156 */ 's', '4', 0,
   11002             :   /* 1159 */ 'w', '4', 0,
   11003             :   /* 1162 */ 'x', '4', 0,
   11004             :   /* 1165 */ 'D', '1', '2', '_', 'D', '1', '3', '_', 'D', '1', '4', '_', 'D', '1', '5', 0,
   11005             :   /* 1181 */ 'Q', '1', '2', '_', 'Q', '1', '3', '_', 'Q', '1', '4', '_', 'Q', '1', '5', 0,
   11006             :   /* 1197 */ 'W', '1', '4', '_', 'W', '1', '5', 0,
   11007             :   /* 1205 */ 'X', '1', '4', '_', 'X', '1', '5', 0,
   11008             :   /* 1213 */ 'b', '1', '5', 0,
   11009             :   /* 1217 */ 'd', '1', '5', 0,
   11010             :   /* 1221 */ 'h', '1', '5', 0,
   11011             :   /* 1225 */ 'q', '1', '5', 0,
   11012             :   /* 1229 */ 's', '1', '5', 0,
   11013             :   /* 1233 */ 'w', '1', '5', 0,
   11014             :   /* 1237 */ 'x', '1', '5', 0,
   11015             :   /* 1241 */ 'D', '2', '2', '_', 'D', '2', '3', '_', 'D', '2', '4', '_', 'D', '2', '5', 0,
   11016             :   /* 1257 */ 'Q', '2', '2', '_', 'Q', '2', '3', '_', 'Q', '2', '4', '_', 'Q', '2', '5', 0,
   11017             :   /* 1273 */ 'W', '2', '4', '_', 'W', '2', '5', 0,
   11018             :   /* 1281 */ 'X', '2', '4', '_', 'X', '2', '5', 0,
   11019             :   /* 1289 */ 'b', '2', '5', 0,
   11020             :   /* 1293 */ 'd', '2', '5', 0,
   11021             :   /* 1297 */ 'h', '2', '5', 0,
   11022             :   /* 1301 */ 'q', '2', '5', 0,
   11023             :   /* 1305 */ 's', '2', '5', 0,
   11024             :   /* 1309 */ 'w', '2', '5', 0,
   11025             :   /* 1313 */ 'x', '2', '5', 0,
   11026             :   /* 1317 */ 'D', '2', '_', 'D', '3', '_', 'D', '4', '_', 'D', '5', 0,
   11027             :   /* 1329 */ 'Q', '2', '_', 'Q', '3', '_', 'Q', '4', '_', 'Q', '5', 0,
   11028             :   /* 1341 */ 'W', '4', '_', 'W', '5', 0,
   11029             :   /* 1347 */ 'X', '4', '_', 'X', '5', 0,
   11030             :   /* 1353 */ 'b', '5', 0,
   11031             :   /* 1356 */ 'd', '5', 0,
   11032             :   /* 1359 */ 'h', '5', 0,
   11033             :   /* 1362 */ 'q', '5', 0,
   11034             :   /* 1365 */ 's', '5', 0,
   11035             :   /* 1368 */ 'w', '5', 0,
   11036             :   /* 1371 */ 'x', '5', 0,
   11037             :   /* 1374 */ 'D', '1', '3', '_', 'D', '1', '4', '_', 'D', '1', '5', '_', 'D', '1', '6', 0,
   11038             :   /* 1390 */ 'Q', '1', '3', '_', 'Q', '1', '4', '_', 'Q', '1', '5', '_', 'Q', '1', '6', 0,
   11039             :   /* 1406 */ 'W', '1', '5', '_', 'W', '1', '6', 0,
   11040             :   /* 1414 */ 'X', '1', '5', '_', 'X', '1', '6', 0,
   11041             :   /* 1422 */ 'b', '1', '6', 0,
   11042             :   /* 1426 */ 'd', '1', '6', 0,
   11043             :   /* 1430 */ 'h', '1', '6', 0,
   11044             :   /* 1434 */ 'q', '1', '6', 0,
   11045             :   /* 1438 */ 's', '1', '6', 0,
   11046             :   /* 1442 */ 'w', '1', '6', 0,
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   11048             :   /* 1450 */ 'D', '2', '3', '_', 'D', '2', '4', '_', 'D', '2', '5', '_', 'D', '2', '6', 0,
   11049             :   /* 1466 */ 'Q', '2', '3', '_', 'Q', '2', '4', '_', 'Q', '2', '5', '_', 'Q', '2', '6', 0,
   11050             :   /* 1482 */ 'W', '2', '5', '_', 'W', '2', '6', 0,
   11051             :   /* 1490 */ 'X', '2', '5', '_', 'X', '2', '6', 0,
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   11053             :   /* 1502 */ 'd', '2', '6', 0,
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   11055             :   /* 1510 */ 'q', '2', '6', 0,
   11056             :   /* 1514 */ 's', '2', '6', 0,
   11057             :   /* 1518 */ 'w', '2', '6', 0,
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   11068             :   /* 1577 */ 'w', '6', 0,
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   11070             :   /* 1583 */ 'D', '1', '4', '_', 'D', '1', '5', '_', 'D', '1', '6', '_', 'D', '1', '7', 0,
   11071             :   /* 1599 */ 'Q', '1', '4', '_', 'Q', '1', '5', '_', 'Q', '1', '6', '_', 'Q', '1', '7', 0,
   11072             :   /* 1615 */ 'W', '1', '6', '_', 'W', '1', '7', 0,
   11073             :   /* 1623 */ 'X', '1', '6', '_', 'X', '1', '7', 0,
   11074             :   /* 1631 */ 'b', '1', '7', 0,
   11075             :   /* 1635 */ 'd', '1', '7', 0,
   11076             :   /* 1639 */ 'h', '1', '7', 0,
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   11078             :   /* 1647 */ 's', '1', '7', 0,
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   11081             :   /* 1659 */ 'D', '2', '4', '_', 'D', '2', '5', '_', 'D', '2', '6', '_', 'D', '2', '7', 0,
   11082             :   /* 1675 */ 'Q', '2', '4', '_', 'Q', '2', '5', '_', 'Q', '2', '6', '_', 'Q', '2', '7', 0,
   11083             :   /* 1691 */ 'W', '2', '6', '_', 'W', '2', '7', 0,
   11084             :   /* 1699 */ 'X', '2', '6', '_', 'X', '2', '7', 0,
   11085             :   /* 1707 */ 'b', '2', '7', 0,
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   11092             :   /* 1735 */ 'D', '4', '_', 'D', '5', '_', 'D', '6', '_', 'D', '7', 0,
   11093             :   /* 1747 */ 'Q', '4', '_', 'Q', '5', '_', 'Q', '6', '_', 'Q', '7', 0,
   11094             :   /* 1759 */ 'W', '6', '_', 'W', '7', 0,
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   11097             :   /* 1774 */ 'd', '7', 0,
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   11099             :   /* 1780 */ 'q', '7', 0,
   11100             :   /* 1783 */ 's', '7', 0,
   11101             :   /* 1786 */ 'w', '7', 0,
   11102             :   /* 1789 */ 'x', '7', 0,
   11103             :   /* 1792 */ 'D', '1', '5', '_', 'D', '1', '6', '_', 'D', '1', '7', '_', 'D', '1', '8', 0,
   11104             :   /* 1808 */ 'Q', '1', '5', '_', 'Q', '1', '6', '_', 'Q', '1', '7', '_', 'Q', '1', '8', 0,
   11105             :   /* 1824 */ 'W', '1', '7', '_', 'W', '1', '8', 0,
   11106             :   /* 1832 */ 'X', '1', '7', '_', 'X', '1', '8', 0,
   11107             :   /* 1840 */ 'b', '1', '8', 0,
   11108             :   /* 1844 */ 'd', '1', '8', 0,
   11109             :   /* 1848 */ 'h', '1', '8', 0,
   11110             :   /* 1852 */ 'q', '1', '8', 0,
   11111             :   /* 1856 */ 's', '1', '8', 0,
   11112             :   /* 1860 */ 'w', '1', '8', 0,
   11113             :   /* 1864 */ 'x', '1', '8', 0,
   11114             :   /* 1868 */ 'D', '2', '5', '_', 'D', '2', '6', '_', 'D', '2', '7', '_', 'D', '2', '8', 0,
   11115             :   /* 1884 */ 'Q', '2', '5', '_', 'Q', '2', '6', '_', 'Q', '2', '7', '_', 'Q', '2', '8', 0,
   11116             :   /* 1900 */ 'W', '2', '7', '_', 'W', '2', '8', 0,
   11117             :   /* 1908 */ 'X', '2', '7', '_', 'X', '2', '8', 0,
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   11119             :   /* 1920 */ 'd', '2', '8', 0,
   11120             :   /* 1924 */ 'h', '2', '8', 0,
   11121             :   /* 1928 */ 'q', '2', '8', 0,
   11122             :   /* 1932 */ 's', '2', '8', 0,
   11123             :   /* 1936 */ 'w', '2', '8', 0,
   11124             :   /* 1940 */ 'x', '2', '8', 0,
   11125             :   /* 1944 */ 'D', '5', '_', 'D', '6', '_', 'D', '7', '_', 'D', '8', 0,
   11126             :   /* 1956 */ 'Q', '5', '_', 'Q', '6', '_', 'Q', '7', '_', 'Q', '8', 0,
   11127             :   /* 1968 */ 'W', '7', '_', 'W', '8', 0,
   11128             :   /* 1974 */ 'X', '7', '_', 'X', '8', 0,
   11129             :   /* 1980 */ 'b', '8', 0,
   11130             :   /* 1983 */ 'd', '8', 0,
   11131             :   /* 1986 */ 'h', '8', 0,
   11132             :   /* 1989 */ 'q', '8', 0,
   11133             :   /* 1992 */ 's', '8', 0,
   11134             :   /* 1995 */ 'w', '8', 0,
   11135             :   /* 1998 */ 'x', '8', 0,
   11136             :   /* 2001 */ 'D', '1', '6', '_', 'D', '1', '7', '_', 'D', '1', '8', '_', 'D', '1', '9', 0,
   11137             :   /* 2017 */ 'Q', '1', '6', '_', 'Q', '1', '7', '_', 'Q', '1', '8', '_', 'Q', '1', '9', 0,
   11138             :   /* 2033 */ 'W', '1', '8', '_', 'W', '1', '9', 0,
   11139             :   /* 2041 */ 'X', '1', '8', '_', 'X', '1', '9', 0,
   11140             :   /* 2049 */ 'b', '1', '9', 0,
   11141             :   /* 2053 */ 'd', '1', '9', 0,
   11142             :   /* 2057 */ 'h', '1', '9', 0,
   11143             :   /* 2061 */ 'q', '1', '9', 0,
   11144             :   /* 2065 */ 's', '1', '9', 0,
   11145             :   /* 2069 */ 'w', '1', '9', 0,
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   11147             :   /* 2077 */ 'D', '2', '6', '_', 'D', '2', '7', '_', 'D', '2', '8', '_', 'D', '2', '9', 0,
   11148             :   /* 2093 */ 'Q', '2', '6', '_', 'Q', '2', '7', '_', 'Q', '2', '8', '_', 'Q', '2', '9', 0,
   11149             :   /* 2109 */ 'W', '2', '8', '_', 'W', '2', '9', 0,
   11150             :   /* 2117 */ 'b', '2', '9', 0,
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   11158             :   /* 2157 */ 'Q', '6', '_', 'Q', '7', '_', 'Q', '8', '_', 'Q', '9', 0,
   11159             :   /* 2169 */ 'W', '8', '_', 'W', '9', 0,
   11160             :   /* 2175 */ 'X', '8', '_', 'X', '9', 0,
   11161             :   /* 2181 */ 'b', '9', 0,
   11162             :   /* 2184 */ 'd', '9', 0,
   11163             :   /* 2187 */ 'h', '9', 0,
   11164             :   /* 2190 */ 'q', '9', 0,
   11165             :   /* 2193 */ 's', '9', 0,
   11166             :   /* 2196 */ 'w', '9', 0,
   11167             :   /* 2199 */ 'x', '9', 0,
   11168             :   /* 2202 */ 'X', '2', '8', '_', 'F', 'P', 0,
   11169             :   /* 2209 */ 'F', 'P', '_', 'L', 'R', 0,
   11170             :   /* 2215 */ 'W', '3', '0', '_', 'W', 'Z', 'R', 0,
   11171             :   /* 2223 */ 'L', 'R', '_', 'X', 'Z', 'R', 0,
   11172             :   /* 2230 */ 'w', 's', 'p', 0,
   11173             :   /* 2234 */ 'w', 'z', 'r', 0,
   11174             :   /* 2238 */ 'x', 'z', 'r', 0,
   11175             :   /* 2242 */ 'n', 'z', 'c', 'v', 0,
   11176             :   };
   11177             : 
   11178             :   static const uint16_t RegAsmOffsetNoRegAltName[] = {
   11179             :     2141, 208, 2242, 2231, 2230, 2234, 2238, 256, 517, 726, 935, 1144, 1353, 1562, 
   11180             :     1771, 1980, 2181, 40, 321, 584, 795, 1004, 1213, 1422, 1631, 1840, 2049, 116, 
   11181             :     397, 660, 871, 1080, 1289, 1498, 1707, 1916, 2117, 184, 457, 259, 520, 729, 
   11182             :     938, 1147, 1356, 1565, 1774, 1983, 2184, 44, 325, 588, 799, 1008, 1217, 1426, 
   11183             :     1635, 1844, 2053, 120, 401, 664, 875, 1084, 1293, 1502, 1711, 1920, 2121, 188, 
   11184             :     461, 262, 523, 732, 941, 1150, 1359, 1568, 1777, 1986, 2187, 48, 329, 592, 
   11185             :     803, 1012, 1221, 1430, 1639, 1848, 2057, 124, 405, 668, 879, 1088, 1297, 1506, 
   11186             :     1715, 1924, 2125, 192, 465, 265, 526, 735, 944, 1153, 1362, 1571, 1780, 1989, 
   11187             :     2190, 52, 333, 596, 807, 1016, 1225, 1434, 1643, 1852, 2061, 128, 409, 672, 
   11188             :     883, 1092, 1301, 1510, 1719, 1928, 2129, 196, 469, 268, 529, 738, 947, 1156, 
   11189             :     1365, 1574, 1783, 1992, 2193, 56, 337, 600, 811, 1020, 1229, 1438, 1647, 1856, 
   11190             :     2065, 132, 413, 676, 887, 1096, 1305, 1514, 1723, 1932, 2133, 200, 473, 271, 
   11191             :     532, 741, 950, 1159, 1368, 1577, 1786, 1995, 2196, 60, 341, 604, 815, 1024, 
   11192             :     1233, 1442, 1651, 1860, 2069, 136, 417, 680, 891, 1100, 1309, 1518, 1727, 1936, 
   11193             :     2137, 204, 274, 535, 744, 953, 1162, 1371, 1580, 1789, 1998, 2199, 64, 345, 
   11194             :     608, 819, 1028, 1237, 1446, 1655, 1864, 2073, 140, 421, 684, 895, 1104, 1313, 
   11195             :     1522, 1731, 1940, 485, 695, 905, 1114, 1323, 1532, 1741, 1950, 2151, 6, 283, 
   11196             :     545, 755, 964, 1173, 1382, 1591, 1800, 2009, 76, 357, 620, 831, 1040, 1249, 
   11197             :     1458, 1667, 1876, 2085, 152, 433, 220, 899, 1108, 1317, 1526, 1735, 1944, 2145, 
   11198             :     0, 277, 538, 747, 956, 1165, 1374, 1583, 1792, 2001, 68, 349, 612, 823, 
   11199             :     1032, 1241, 1450, 1659, 1868, 2077, 144, 425, 212, 477, 688, 692, 902, 1111, 
   11200             :     1320, 1529, 1738, 1947, 2148, 3, 280, 541, 751, 960, 1169, 1378, 1587, 1796, 
   11201             :     2005, 72, 353, 616, 827, 1036, 1245, 1454, 1663, 1872, 2081, 148, 429, 216, 
   11202             :     481, 499, 708, 917, 1126, 1335, 1544, 1753, 1962, 2163, 19, 297, 560, 771, 
   11203             :     980, 1189, 1398, 1607, 1816, 2025, 92, 373, 636, 847, 1056, 1265, 1474, 1683, 
   11204             :     1892, 2101, 168, 449, 235, 911, 1120, 1329, 1538, 1747, 1956, 2157, 13, 291, 
   11205             :     553, 763, 972, 1181, 1390, 1599, 1808, 2017, 84, 365, 628, 839, 1048, 1257, 
   11206             :     1466, 1675, 1884, 2093, 160, 441, 227, 491, 701, 705, 914, 1123, 1332, 1541, 
   11207             :     1750, 1959, 2160, 16, 294, 556, 767, 976, 1185, 1394, 1603, 1812, 2021, 88, 
   11208             :     369, 632, 843, 1052, 1261, 1470, 1679, 1888, 2097, 164, 445, 231, 495, 242, 
   11209             :     2215, 505, 714, 923, 1132, 1341, 1550, 1759, 1968, 2169, 26, 305, 568, 779, 
   11210             :     988, 1197, 1406, 1615, 1824, 2033, 100, 381, 644, 855, 1064, 1273, 1482, 1691, 
   11211             :     1900, 2109, 176, 2209, 2223, 249, 2202, 511, 720, 929, 1138, 1347, 1556, 1765, 
   11212             :     1974, 2175, 33, 313, 576, 787, 996, 1205, 1414, 1623, 1832, 2041, 108, 389, 
   11213             :     652, 863, 1072, 1281, 1490, 1699, 1908, 
   11214             :   };
   11215             : 
   11216             :   static const char AsmStrsvlist1[] = {
   11217             :   /* 0 */ 0,
   11218             :   };
   11219             : 
   11220             :   static const uint8_t RegAsmOffsetvlist1[] = {
   11221             :     0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 
   11222             :     0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 
   11223             :     0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 
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   11256             :   };
   11257             : 
   11258             :   static const char AsmStrsvreg[] = {
   11259             :   /* 0 */ 'v', '1', '0', 0,
   11260             :   /* 4 */ 'v', '2', '0', 0,
   11261             :   /* 8 */ 'v', '3', '0', 0,
   11262             :   /* 12 */ 'v', '0', 0,
   11263             :   /* 15 */ 'v', '1', '1', 0,
   11264             :   /* 19 */ 'v', '2', '1', 0,
   11265             :   /* 23 */ 'v', '3', '1', 0,
   11266             :   /* 27 */ 'v', '1', 0,
   11267             :   /* 30 */ 'v', '1', '2', 0,
   11268             :   /* 34 */ 'v', '2', '2', 0,
   11269             :   /* 38 */ 'v', '2', 0,
   11270             :   /* 41 */ 'v', '1', '3', 0,
   11271             :   /* 45 */ 'v', '2', '3', 0,
   11272             :   /* 49 */ 'v', '3', 0,
   11273             :   /* 52 */ 'v', '1', '4', 0,
   11274             :   /* 56 */ 'v', '2', '4', 0,
   11275             :   /* 60 */ 'v', '4', 0,
   11276             :   /* 63 */ 'v', '1', '5', 0,
   11277             :   /* 67 */ 'v', '2', '5', 0,
   11278             :   /* 71 */ 'v', '5', 0,
   11279             :   /* 74 */ 'v', '1', '6', 0,
   11280             :   /* 78 */ 'v', '2', '6', 0,
   11281             :   /* 82 */ 'v', '6', 0,
   11282             :   /* 85 */ 'v', '1', '7', 0,
   11283             :   /* 89 */ 'v', '2', '7', 0,
   11284             :   /* 93 */ 'v', '7', 0,
   11285             :   /* 96 */ 'v', '1', '8', 0,
   11286             :   /* 100 */ 'v', '2', '8', 0,
   11287             :   /* 104 */ 'v', '8', 0,
   11288             :   /* 107 */ 'v', '1', '9', 0,
   11289             :   /* 111 */ 'v', '2', '9', 0,
   11290             :   /* 115 */ 'v', '9', 0,
   11291             :   };
   11292             : 
   11293             :   static const uint8_t RegAsmOffsetvreg[] = {
   11294             :     3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 
   11295             :     3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 
   11296             :     3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 12, 27, 38, 
   11297             :     49, 60, 71, 82, 93, 104, 115, 0, 15, 30, 41, 52, 63, 74, 
   11298             :     85, 96, 107, 4, 19, 34, 45, 56, 67, 78, 89, 100, 111, 8, 
   11299             :     23, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 
   11300             :     3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 
   11301             :     3, 3, 3, 3, 3, 12, 27, 38, 49, 60, 71, 82, 93, 104, 
   11302             :     115, 0, 15, 30, 41, 52, 63, 74, 85, 96, 107, 4, 19, 34, 
   11303             :     45, 56, 67, 78, 89, 100, 111, 8, 23, 3, 3, 3, 3, 3, 
   11304             :     3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 
   11305             :     3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 
   11306             :     3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 
   11307             :     3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 
   11308             :     3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 
   11309             :     3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 
   11310             :     3, 3, 3, 12, 27, 38, 49, 60, 71, 82, 93, 104, 115, 0, 
   11311             :     15, 30, 41, 52, 63, 74, 85, 96, 107, 4, 19, 34, 45, 56, 
   11312             :     67, 78, 89, 100, 111, 8, 23, 12, 27, 38, 49, 60, 71, 82, 
   11313             :     93, 104, 115, 0, 15, 30, 41, 52, 63, 74, 85, 96, 107, 4, 
   11314             :     19, 34, 45, 56, 67, 78, 89, 100, 111, 8, 23, 12, 27, 38, 
   11315             :     49, 60, 71, 82, 93, 104, 115, 0, 15, 30, 41, 52, 63, 74, 
   11316             :     85, 96, 107, 4, 19, 34, 45, 56, 67, 78, 89, 100, 111, 8, 
   11317             :     23, 12, 27, 38, 49, 60, 71, 82, 93, 104, 115, 0, 15, 30, 
   11318             :     41, 52, 63, 74, 85, 96, 107, 4, 19, 34, 45, 56, 67, 78, 
   11319             :     89, 100, 111, 8, 23, 12, 27, 38, 49, 60, 71, 82, 93, 104, 
   11320             :     115, 0, 15, 30, 41, 52, 63, 74, 85, 96, 107, 4, 19, 34, 
   11321             :     45, 56, 67, 78, 89, 100, 111, 8, 23, 12, 27, 38, 49, 60, 
   11322             :     71, 82, 93, 104, 115, 0, 15, 30, 41, 52, 63, 74, 85, 96, 
   11323             :     107, 4, 19, 34, 45, 56, 67, 78, 89, 100, 111, 8, 23, 3, 
   11324             :     3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 
   11325             :     3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 
   11326             :     3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 
   11327             :     3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 
   11328             :     3, 3, 3, 3, 3, 3, 3, 
   11329             :   };
   11330             : 
   11331      147494 :   switch(AltIdx) {
   11332           0 :   default: llvm_unreachable("Invalid register alt name index!");
   11333      104868 :   case AArch64::NoRegAltName:
   11334             :     assert(*(AsmStrsNoRegAltName+RegAsmOffsetNoRegAltName[RegNo-1]) &&
   11335             :            "Invalid alt name index for register!");
   11336      104868 :     return AsmStrsNoRegAltName+RegAsmOffsetNoRegAltName[RegNo-1];
   11337           0 :   case AArch64::vlist1:
   11338             :     assert(*(AsmStrsvlist1+RegAsmOffsetvlist1[RegNo-1]) &&
   11339             :            "Invalid alt name index for register!");
   11340           0 :     return AsmStrsvlist1+RegAsmOffsetvlist1[RegNo-1];
   11341       42626 :   case AArch64::vreg:
   11342             :     assert(*(AsmStrsvreg+RegAsmOffsetvreg[RegNo-1]) &&
   11343             :            "Invalid alt name index for register!");
   11344       42626 :     return AsmStrsvreg+RegAsmOffsetvreg[RegNo-1];
   11345             :   }
   11346             : }
   11347             : 
   11348             : #ifdef PRINT_ALIAS_INSTR
   11349             : #undef PRINT_ALIAS_INSTR
   11350             : 
   11351             : static bool AArch64InstPrinterValidateMCOperand(const MCOperand &MCOp,
   11352             :                   const MCSubtargetInfo &STI,
   11353             :                   unsigned PredicateIndex);
   11354       52511 : bool AArch64InstPrinter::printAliasInstr(const MCInst *MI, const MCSubtargetInfo &STI, raw_ostream &OS) {
   11355             :   const char *AsmString;
   11356       52511 :   switch (MI->getOpcode()) {
   11357             :   default: return false;
   11358          51 :   case AArch64::ADDSWri:
   11359         102 :     if (MI->getNumOperands() == 4 &&
   11360          77 :         MI->getOperand(0).getReg() == AArch64::WZR &&
   11361         103 :         MI->getOperand(1).isReg() &&
   11362          78 :         MRI.getRegClass(AArch64::GPR32spRegClassID).contains(MI->getOperand(1).getReg())) {
   11363             :       // (ADDSWri WZR, GPR32sp:$src, addsub_shifted_imm32:$imm)
   11364             :       AsmString = "cmn     $\x02, $\xFF\x03\x01";
   11365             :       break;
   11366             :     }
   11367             :     return false;
   11368         126 :   case AArch64::ADDSWrs:
   11369         252 :     if (MI->getNumOperands() == 4 &&
   11370         187 :         MI->getOperand(0).getReg() == AArch64::WZR &&
   11371         122 :         MI->getOperand(1).isReg() &&
   11372         244 :         MRI.getRegClass(AArch64::GPR32RegClassID).contains(MI->getOperand(1).getReg()) &&
   11373         122 :         MI->getOperand(2).isReg() &&
   11374         244 :         MRI.getRegClass(AArch64::GPR32RegClassID).contains(MI->getOperand(2).getReg()) &&
   11375         248 :         MI->getOperand(3).isImm() &&
   11376          61 :         MI->getOperand(3).getImm() == 0) {
   11377             :       // (ADDSWrs WZR, GPR32:$src1, GPR32:$src2, 0)
   11378             :       AsmString = "cmn     $\x02, $\x03";
   11379             :       break;
   11380             :     }
   11381         194 :     if (MI->getNumOperands() == 4 &&
   11382         129 :         MI->getOperand(0).getReg() == AArch64::WZR &&
   11383          64 :         MI->getOperand(1).isReg() &&
   11384         128 :         MRI.getRegClass(AArch64::GPR32RegClassID).contains(MI->getOperand(1).getReg()) &&
   11385         161 :         MI->getOperand(2).isReg() &&
   11386          96 :         MRI.getRegClass(AArch64::GPR32RegClassID).contains(MI->getOperand(2).getReg())) {
   11387             :       // (ADDSWrs WZR, GPR32:$src1, GPR32:$src2, arith_shift32:$sh)
   11388             :       AsmString = "cmn     $\x02, $\x03$\xFF\x04\x02";
   11389             :       break;
   11390             :     }
   11391         130 :     if (MI->getNumOperands() == 4 &&
   11392         130 :         MI->getOperand(0).isReg() &&
   11393         260 :         MRI.getRegClass(AArch64::GPR32RegClassID).contains(MI->getOperand(0).getReg()) &&
   11394         130 :         MI->getOperand(1).isReg() &&
   11395         260 :         MRI.getRegClass(AArch64::GPR32RegClassID).contains(MI->getOperand(1).getReg()) &&
   11396         130 :         MI->getOperand(2).isReg() &&
   11397         260 :         MRI.getRegClass(AArch64::GPR32RegClassID).contains(MI->getOperand(2).getReg()) &&
   11398         195 :         MI->getOperand(3).isImm() &&
   11399          65 :         MI->getOperand(3).getImm() == 0) {
   11400             :       // (ADDSWrs GPR32:$dst, GPR32:$src1, GPR32:$src2, 0)
   11401             :       AsmString = "adds    $\x01, $\x02, $\x03";
   11402             :       break;
   11403             :     }
   11404             :     return false;
   11405          40 :   case AArch64::ADDSWrx:
   11406          80 :     if (MI->getNumOperands() == 4 &&
   11407          53 :         MI->getOperand(0).getReg() == AArch64::WZR &&
   11408          18 :         MI->getOperand(1).isReg() &&
   11409          36 :         MRI.getRegClass(AArch64::GPR32sponlyRegClassID).contains(MI->getOperand(1).getReg()) &&
   11410          10 :         MI->getOperand(2).isReg() &&
   11411          20 :         MRI.getRegClass(AArch64::GPR32RegClassID).contains(MI->getOperand(2).getReg()) &&
   11412          50 :         MI->getOperand(3).isImm() &&
   11413           5 :         MI->getOperand(3).getImm() == 16) {
   11414             :       // (ADDSWrx WZR, GPR32sponly:$src1, GPR32:$src2, 16)
   11415             :       AsmString = "cmn     $\x02, $\x03";
   11416             :       break;
   11417             :     }
   11418          78 :     if (MI->getNumOperands() == 4 &&
   11419          51 :         MI->getOperand(0).getReg() == AArch64::WZR &&
   11420          24 :         MI->getOperand(1).isReg() &&
   11421          48 :         MRI.getRegClass(AArch64::GPR32spRegClassID).contains(MI->getOperand(1).getReg()) &&
   11422          63 :         MI->getOperand(2).isReg() &&
   11423          36 :         MRI.getRegClass(AArch64::GPR32RegClassID).contains(MI->getOperand(2).getReg())) {
   11424             :       // (ADDSWrx WZR, GPR32sp:$src1, GPR32:$src2, arith_extend:$sh)
   11425             :       AsmString = "cmn     $\x02, $\x03$\xFF\x04\x03";
   11426             :       break;
   11427             :     }
   11428          54 :     if (MI->getNumOperands() == 4 &&
   11429          54 :         MI->getOperand(0).isReg() &&
   11430         108 :         MRI.getRegClass(AArch64::GPR32RegClassID).contains(MI->getOperand(0).getReg()) &&
   11431          32 :         MI->getOperand(1).isReg() &&
   11432          64 :         MRI.getRegClass(AArch64::GPR32sponlyRegClassID).contains(MI->getOperand(1).getReg()) &&
   11433          10 :         MI->getOperand(2).isReg() &&
   11434          20 :         MRI.getRegClass(AArch64::GPR32RegClassID).contains(MI->getOperand(2).getReg()) &&
   11435          37 :         MI->getOperand(3).isImm() &&
   11436           5 :         MI->getOperand(3).getImm() == 16) {
   11437             :       // (ADDSWrx GPR32:$dst, GPR32sponly:$src1, GPR32:$src2, 16)
   11438             :       AsmString = "adds    $\x01, $\x02, $\x03";
   11439             :       break;
   11440             :     }
   11441             :     return false;
   11442          85 :   case AArch64::ADDSXri:
   11443         170 :     if (MI->getNumOperands() == 4 &&
   11444         101 :         MI->getOperand(0).getReg() == AArch64::XZR &&
   11445         117 :         MI->getOperand(1).isReg() &&
   11446          48 :         MRI.getRegClass(AArch64::GPR64spRegClassID).contains(MI->getOperand(1).getReg())) {
   11447             :       // (ADDSXri XZR, GPR64sp:$src, addsub_shifted_imm64:$imm)
   11448             :       AsmString = "cmn     $\x02, $\xFF\x03\x01";
   11449             :       break;
   11450             :     }
   11451             :     return false;
   11452         136 :   case AArch64::ADDSXrs:
   11453         272 :     if (MI->getNumOperands() == 4 &&
   11454         201 :         MI->getOperand(0).getReg() == AArch64::XZR &&
   11455         130 :         MI->getOperand(1).isReg() &&
   11456         260 :         MRI.getRegClass(AArch64::GPR64RegClassID).contains(MI->getOperand(1).getReg()) &&
   11457         130 :         MI->getOperand(2).isReg() &&
   11458         260 :         MRI.getRegClass(AArch64::GPR64RegClassID).contains(MI->getOperand(2).getReg()) &&
   11459         266 :         MI->getOperand(3).isImm() &&
   11460          65 :         MI->getOperand(3).getImm() == 0) {
   11461             :       // (ADDSXrs XZR, GPR64:$src1, GPR64:$src2, 0)
   11462             :       AsmString = "cmn     $\x02, $\x03";
   11463             :       break;
   11464             :     }
   11465         206 :     if (MI->getNumOperands() == 4 &&
   11466         135 :         MI->getOperand(0).getReg() == AArch64::XZR &&
   11467          64 :         MI->getOperand(1).isReg() &&
   11468         128 :         MRI.getRegClass(AArch64::GPR64RegClassID).contains(MI->getOperand(1).getReg()) &&
   11469         167 :         MI->getOperand(2).isReg() &&
   11470          96 :         MRI.getRegClass(AArch64::GPR64RegClassID).contains(MI->getOperand(2).getReg())) {
   11471             :       // (ADDSXrs XZR, GPR64:$src1, GPR64:$src2, arith_shift64:$sh)
   11472             :       AsmString = "cmn     $\x02, $\x03$\xFF\x04\x02";
   11473             :       break;
   11474             :     }
   11475         142 :     if (MI->getNumOperands() == 4 &&
   11476         142 :         MI->getOperand(0).isReg() &&
   11477         284 :         MRI.getRegClass(AArch64::GPR64RegClassID).contains(MI->getOperand(0).getReg()) &&
   11478         142 :         MI->getOperand(1).isReg() &&
   11479         284 :         MRI.getRegClass(AArch64::GPR64RegClassID).contains(MI->getOperand(1).getReg()) &&
   11480         142 :         MI->getOperand(2).isReg() &&
   11481         284 :         MRI.getRegClass(AArch64::GPR64RegClassID).contains(MI->getOperand(2).getReg()) &&
   11482         213 :         MI->getOperand(3).isImm() &&
   11483          71 :         MI->getOperand(3).getImm() == 0) {
   11484             :       // (ADDSXrs GPR64:$dst, GPR64:$src1, GPR64:$src2, 0)
   11485             :       AsmString = "adds    $\x01, $\x02, $\x03";
   11486             :       break;
   11487             :     }
   11488             :     return false;
   11489          27 :   case AArch64::ADDSXrx:
   11490          54 :     if (MI->getNumOperands() == 4 &&
   11491          35 :         MI->getOperand(0).getReg() == AArch64::XZR &&
   11492          16 :         MI->getOperand(1).isReg() &&
   11493          32 :         MRI.getRegClass(AArch64::GPR64spRegClassID).contains(MI->getOperand(1).getReg()) &&
   11494          43 :         MI->getOperand(2).isReg() &&
   11495          24 :         MRI.getRegClass(AArch64::GPR32RegClassID).contains(MI->getOperand(2).getReg())) {
   11496             :       // (ADDSXrx XZR, GPR64sp:$src1, GPR32:$src2, arith_extend:$sh)
   11497             :       AsmString = "cmn     $\x02, $\x03$\xFF\x04\x03";
   11498             :       break;
   11499             :     }
   11500             :     return false;
   11501           5 :   case AArch64::ADDSXrx64:
   11502          10 :     if (MI->getNumOperands() == 4 &&
   11503           8 :         MI->getOperand(0).getReg() == AArch64::XZR &&
   11504           4 :         MI->getOperand(1).isReg() &&
   11505           8 :         MRI.getRegClass(AArch64::GPR64sponlyRegClassID).contains(MI->getOperand(1).getReg()) &&
   11506           2 :         MI->getOperand(2).isReg() &&
   11507           4 :         MRI.getRegClass(AArch64::GPR64RegClassID).contains(MI->getOperand(2).getReg()) &&
   11508           7 :         MI->getOperand(3).isImm() &&
   11509           1 :         MI->getOperand(3).getImm() == 24) {
   11510             :       // (ADDSXrx64 XZR, GPR64sponly:$src1, GPR64:$src2, 24)
   11511             :       AsmString = "cmn     $\x02, $\x03";
   11512             :       break;
   11513             :     }
   11514           8 :     if (MI->getNumOperands() == 4 &&
   11515           6 :         MI->getOperand(0).getReg() == AArch64::XZR &&
   11516           4 :         MI->getOperand(1).isReg() &&
   11517           8 :         MRI.getRegClass(AArch64::GPR64spRegClassID).contains(MI->getOperand(1).getReg()) &&
   11518           8 :         MI->getOperand(2).isReg() &&
   11519           6 :         MRI.getRegClass(AArch64::GPR64RegClassID).contains(MI->getOperand(2).getReg())) {
   11520             :       // (ADDSXrx64 XZR, GPR64sp:$src1, GPR64:$src2, arith_extendlsl64:$sh)
   11521             :       AsmString = "cmn     $\x02, $\x03$\xFF\x04\x03";
   11522             :       break;
   11523             :     }
   11524           4 :     if (MI->getNumOperands() == 4 &&
   11525           4 :         MI->getOperand(0).isReg() &&
   11526           8 :         MRI.getRegClass(AArch64::GPR64RegClassID).contains(MI->getOperand(0).getReg()) &&
   11527           2 :         MI->getOperand(1).isReg() &&
   11528           4 :         MRI.getRegClass(AArch64::GPR64sponlyRegClassID).contains(MI->getOperand(1).getReg()) &&
   11529           0 :         MI->getOperand(2).isReg() &&
   11530           0 :         MRI.getRegClass(AArch64::GPR64RegClassID).contains(MI->getOperand(2).getReg()) &&
   11531           2 :         MI->getOperand(3).isImm() &&
   11532           0 :         MI->getOperand(3).getImm() == 24) {
   11533             :       // (ADDSXrx64 GPR64:$dst, GPR64sponly:$src1, GPR64:$src2, 24)
   11534             :       AsmString = "adds    $\x01, $\x02, $\x03";
   11535             :       break;
   11536             :     }
   11537             :     return false;
   11538         139 :   case AArch64::ADDWri:
   11539         278 :     if (MI->getNumOperands() == 4 &&
   11540         152 :         MI->getOperand(0).isReg() &&
   11541         304 :         MRI.getRegClass(AArch64::GPR32sponlyRegClassID).contains(MI->getOperand(0).getReg()) &&
   11542          26 :         MI->getOperand(1).isReg() &&
   11543          52 :         MRI.getRegClass(AArch64::GPR32spRegClassID).contains(MI->getOperand(1).getReg()) &&
   11544          26 :         MI->getOperand(2).isImm() &&
   11545          18 :         MI->getOperand(2).getImm() == 0 &&
   11546         149 :         MI->getOperand(3).isImm() &&
   11547           5 :         MI->getOperand(3).getImm() == 0) {
   11548             :       // (ADDWri GPR32sponly:$dst, GPR32sp:$src, 0, 0)
   11549             :       AsmString = "mov $\x01, $\x02";
   11550             :       break;
   11551             :     }
   11552         268 :     if (MI->getNumOperands() == 4 &&
   11553         268 :         MI->getOperand(0).isReg() &&
   11554         536 :         MRI.getRegClass(AArch64::GPR32spRegClassID).contains(MI->getOperand(0).getReg()) &&
   11555         146 :         MI->getOperand(1).isReg() &&
   11556         292 :         MRI.getRegClass(AArch64::GPR32sponlyRegClassID).contains(MI->getOperand(1).getReg()) &&
   11557          24 :         MI->getOperand(2).isImm() &&
   11558          16 :         MI->getOperand(2).getImm() == 0 &&
   11559         142 :         MI->getOperand(3).isImm() &&
   11560           4 :         MI->getOperand(3).getImm() == 0) {
   11561             :       // (ADDWri GPR32sp:$dst, GPR32sponly:$src, 0, 0)
   11562             :       AsmString = "mov $\x01, $\x02";
   11563             :       break;
   11564             :     }
   11565             :     return false;
   11566         242 :   case AArch64::ADDWrs:
   11567         484 :     if (MI->getNumOperands() == 4 &&
   11568         484 :         MI->getOperand(0).isReg() &&
   11569         968 :         MRI.getRegClass(AArch64::GPR32RegClassID).contains(MI->getOperand(0).getReg()) &&
   11570         484 :         MI->getOperand(1).isReg() &&
   11571         968 :         MRI.getRegClass(AArch64::GPR32RegClassID).contains(MI->getOperand(1).getReg()) &&
   11572         484 :         MI->getOperand(2).isReg() &&
   11573         968 :         MRI.getRegClass(AArch64::GPR32RegClassID).contains(MI->getOperand(2).getReg()) &&
   11574         726 :         MI->getOperand(3).isImm() &&
   11575         242 :         MI->getOperand(3).getImm() == 0) {
   11576             :       // (ADDWrs GPR32:$dst, GPR32:$src1, GPR32:$src2, 0)
   11577             :       AsmString = "add     $\x01, $\x02, $\x03";
   11578             :       break;
   11579             :     }
   11580             :     return false;
   11581          48 :   case AArch64::ADDWrx:
   11582          96 :     if (MI->getNumOperands() == 4 &&
   11583          48 :         MI->getOperand(0).isReg() &&
   11584          96 :         MRI.getRegClass(AArch64::GPR32sponlyRegClassID).contains(MI->getOperand(0).getReg()) &&
   11585           0 :         MI->getOperand(1).isReg() &&
   11586           0 :         MRI.getRegClass(AArch64::GPR32spRegClassID).contains(MI->getOperand(1).getReg()) &&
   11587           0 :         MI->getOperand(2).isReg() &&
   11588           0 :         MRI.getRegClass(AArch64::GPR32RegClassID).contains(MI->getOperand(2).getReg()) &&
   11589          48 :         MI->getOperand(3).isImm() &&
   11590           0 :         MI->getOperand(3).getImm() == 16) {
   11591             :       // (ADDWrx GPR32sponly:$dst, GPR32sp:$src1, GPR32:$src2, 16)
   11592             :       AsmString = "add     $\x01, $\x02, $\x03";
   11593             :       break;
   11594             :     }
   11595          96 :     if (MI->getNumOperands() == 4 &&
   11596          96 :         MI->getOperand(0).isReg() &&
   11597         192 :         MRI.getRegClass(AArch64::GPR32spRegClassID).contains(MI->getOperand(0).getReg()) &&
   11598          54 :         MI->getOperand(1).isReg() &&
   11599         108 :         MRI.getRegClass(AArch64::GPR32sponlyRegClassID).contains(MI->getOperand(1).getReg()) &&
   11600          12 :         MI->getOperand(2).isReg() &&
   11601          24 :         MRI.getRegClass(AArch64::GPR32RegClassID).contains(MI->getOperand(2).getReg()) &&
   11602          60 :         MI->getOperand(3).isImm() &&
   11603           6 :         MI->getOperand(3).getImm() == 16) {
   11604             :       // (ADDWrx GPR32sp:$dst, GPR32sponly:$src1, GPR32:$src2, 16)
   11605             :       AsmString = "add     $\x01, $\x02, $\x03";
   11606             :       break;
   11607             :     }
   11608             :     return false;
   11609        2068 :   case AArch64::ADDXri:
   11610        4136 :     if (MI->getNumOperands() == 4 &&
   11611        2519 :         MI->getOperand(0).isReg() &&
   11612        4957 :         MRI.getRegClass(AArch64::GPR64sponlyRegClassID).contains(MI->getOperand(0).getReg()) &&
   11613         740 :         MI->getOperand(1).isReg() &&
   11614        1480 :         MRI.getRegClass(AArch64::GPR64spRegClassID).contains(MI->getOperand(1).getReg()) &&
   11615         740 :         MI->getOperand(2).isImm() &&
   11616         409 :         MI->getOperand(2).getImm() == 0 &&
   11617        2146 :         MI->getOperand(3).isImm() &&
   11618          39 :         MI->getOperand(3).getImm() == 0) {
   11619             :       // (ADDXri GPR64sponly:$dst, GPR64sp:$src, 0, 0)
   11620             :       AsmString = "mov $\x01, $\x02";
   11621             :       break;
   11622             :     }
   11623        4058 :     if (MI->getNumOperands() == 4 &&
   11624        4058 :         MI->getOperand(0).isReg() &&
   11625        8116 :         MRI.getRegClass(AArch64::GPR64spRegClassID).contains(MI->getOperand(0).getReg()) &&
   11626        2608 :         MI->getOperand(1).isReg() &&
   11627        5199 :         MRI.getRegClass(AArch64::GPR64sponlyRegClassID).contains(MI->getOperand(1).getReg()) &&
   11628        1124 :         MI->getOperand(2).isImm() &&
   11629         654 :         MI->getOperand(2).getImm() == 0 &&
   11630        2213 :         MI->getOperand(3).isImm() &&
   11631          92 :         MI->getOperand(3).getImm() == 0) {
   11632             :       // (ADDXri GPR64sp:$dst, GPR64sponly:$src, 0, 0)
   11633             :       AsmString = "mov $\x01, $\x02";
   11634             :       break;
   11635             :     }
   11636             :     return false;
   11637         238 :   case AArch64::ADDXrs:
   11638         476 :     if (MI->getNumOperands() == 4 &&
   11639         476 :         MI->getOperand(0).isReg() &&
   11640         952 :         MRI.getRegClass(AArch64::GPR64RegClassID).contains(MI->getOperand(0).getReg()) &&
   11641         476 :         MI->getOperand(1).isReg() &&
   11642         952 :         MRI.getRegClass(AArch64::GPR64RegClassID).contains(MI->getOperand(1).getReg()) &&
   11643         476 :         MI->getOperand(2).isReg() &&
   11644         952 :         MRI.getRegClass(AArch64::GPR64RegClassID).contains(MI->getOperand(2).getReg()) &&
   11645         714 :         MI->getOperand(3).isImm() &&
   11646         238 :         MI->getOperand(3).getImm() == 0) {
   11647             :       // (ADDXrs GPR64:$dst, GPR64:$src1, GPR64:$src2, 0)
   11648             :       AsmString = "add     $\x01, $\x02, $\x03";
   11649             :       break;
   11650             :     }
   11651             :     return false;
   11652           9 :   case AArch64::ADDXrx64:
   11653          18 :     if (MI->getNumOperands() == 4 &&
   11654          14 :         MI->getOperand(0).isReg() &&
   11655          28 :         MRI.getRegClass(AArch64::GPR64sponlyRegClassID).contains(MI->getOperand(0).getReg()) &&
   11656          10 :         MI->getOperand(1).isReg() &&
   11657          20 :         MRI.getRegClass(AArch64::GPR64spRegClassID).contains(MI->getOperand(1).getReg()) &&
   11658          10 :         MI->getOperand(2).isReg() &&
   11659          20 :         MRI.getRegClass(AArch64::GPR64RegClassID).contains(MI->getOperand(2).getReg()) &&
   11660          19 :         MI->getOperand(3).isImm() &&
   11661           5 :         MI->getOperand(3).getImm() == 24) {
   11662             :       // (ADDXrx64 GPR64sponly:$dst, GPR64sp:$src1, GPR64:$src2, 24)
   11663             :       AsmString = "add     $\x01, $\x02, $\x03";
   11664             :       break;
   11665             :     }
   11666           8 :     if (MI->getNumOperands() == 4 &&
   11667           8 :         MI->getOperand(0).isReg() &&
   11668          16 :         MRI.getRegClass(AArch64::GPR64spRegClassID).contains(MI->getOperand(0).getReg()) &&
   11669           4 :         MI->getOperand(1).isReg() &&
   11670           8 :         MRI.getRegClass(AArch64::GPR64sponlyRegClassID).contains(MI->getOperand(1).getReg()) &&
   11671           0 :         MI->getOperand(2).isReg() &&
   11672           0 :         MRI.getRegClass(AArch64::GPR64RegClassID).contains(MI->getOperand(2).getReg()) &&
   11673           4 :         MI->getOperand(3).isImm() &&
   11674           0 :         MI->getOperand(3).getImm() == 24) {
   11675             :       // (ADDXrx64 GPR64sp:$dst, GPR64sponly:$src1, GPR64:$src2, 24)
   11676             :       AsmString = "add     $\x01, $\x02, $\x03";
   11677             :       break;
   11678             :     }
   11679             :     return false;
   11680          36 :   case AArch64::ANDSWri:
   11681          72 :     if (MI->getNumOperands() == 3 &&
   11682          56 :         MI->getOperand(0).getReg() == AArch64::WZR &&
   11683          76 :         MI->getOperand(1).isReg() &&
   11684          60 :         MRI.getRegClass(AArch64::GPR32RegClassID).contains(MI->getOperand(1).getReg())) {
   11685             :       // (ANDSWri WZR, GPR32:$src1, logical_imm32:$src2)
   11686             :       AsmString = "tst $\x02, $\xFF\x03\x04";
   11687             :       break;
   11688             :     }
   11689             :     return false;
   11690          18 :   case AArch64::ANDSWrs:
   11691          36 :     if (MI->getNumOperands() == 4 &&
   11692          22 :         MI->getOperand(0).getReg() == AArch64::WZR &&
   11693           8 :         MI->getOperand(1).isReg() &&
   11694          16 :         MRI.getRegClass(AArch64::GPR32RegClassID).contains(MI->getOperand(1).getReg()) &&
   11695           8 :         MI->getOperand(2).isReg() &&
   11696          16 :         MRI.getRegClass(AArch64::GPR32RegClassID).contains(MI->getOperand(2).getReg()) &&
   11697          26 :         MI->getOperand(3).isImm() &&
   11698           4 :         MI->getOperand(3).getImm() == 0) {
   11699             :       // (ANDSWrs WZR, GPR32:$src1, GPR32:$src2, 0)
   11700             :       AsmString = "tst $\x02, $\x03";
   11701             :       break;
   11702             :     }
   11703          36 :     if (MI->getNumOperands() == 4 &&
   11704          22 :         MI->getOperand(0).getReg() == AArch64::WZR &&
   11705           8 :         MI->getOperand(1).isReg() &&
   11706          16 :         MRI.getRegClass(AArch64::GPR32RegClassID).contains(MI->getOperand(1).getReg()) &&
   11707          26 :         MI->getOperand(2).isReg() &&
   11708          12 :         MRI.getRegClass(AArch64::GPR32RegClassID).contains(MI->getOperand(2).getReg())) {
   11709             :       // (ANDSWrs WZR, GPR32:$src1, GPR32:$src2, logical_shift32:$sh)
   11710             :       AsmString = "tst $\x02, $\x03$\xFF\x04\x02";
   11711             :       break;
   11712             :     }
   11713          28 :     if (MI->getNumOperands() == 4 &&
   11714          28 :         MI->getOperand(0).isReg() &&
   11715          56 :         MRI.getRegClass(AArch64::GPR32RegClassID).contains(MI->getOperand(0).getReg()) &&
   11716          28 :         MI->getOperand(1).isReg() &&
   11717          56 :         MRI.getRegClass(AArch64::GPR32RegClassID).contains(MI->getOperand(1).getReg()) &&
   11718          28 :         MI->getOperand(2).isReg() &&
   11719          56 :         MRI.getRegClass(AArch64::GPR32RegClassID).contains(MI->getOperand(2).getReg()) &&
   11720          42 :         MI->getOperand(3).isImm() &&
   11721          14 :         MI->getOperand(3).getImm() == 0) {
   11722             :       // (ANDSWrs GPR32:$dst, GPR32:$src1, GPR32:$src2, 0)
   11723             :       AsmString = "ands    $\x01, $\x02, $\x03";
   11724             :       break;
   11725             :     }
   11726             :     return false;
   11727          29 :   case AArch64::ANDSXri:
   11728          58 :     if (MI->getNumOperands() == 3 &&
   11729          43 :         MI->getOperand(0).getReg() == AArch64::XZR &&
   11730          57 :         MI->getOperand(1).isReg() &&
   11731          42 :         MRI.getRegClass(AArch64::GPR64RegClassID).contains(MI->getOperand(1).getReg())) {
   11732             :       // (ANDSXri XZR, GPR64:$src1, logical_imm64:$src2)
   11733             :       AsmString = "tst $\x02, $\xFF\x03\x05";
   11734             :       break;
   11735             :     }
   11736             :     return false;
   11737          24 :   case AArch64::ANDSXrs:
   11738          48 :     if (MI->getNumOperands() == 4 &&
   11739          34 :         MI->getOperand(0).getReg() == AArch64::XZR &&
   11740          20 :         MI->getOperand(1).isReg() &&
   11741          40 :         MRI.getRegClass(AArch64::GPR64RegClassID).contains(MI->getOperand(1).getReg()) &&
   11742          20 :         MI->getOperand(2).isReg() &&
   11743          40 :         MRI.getRegClass(AArch64::GPR64RegClassID).contains(MI->getOperand(2).getReg()) &&
   11744          44 :         MI->getOperand(3).isImm() &&
   11745          10 :         MI->getOperand(3).getImm() == 0) {
   11746             :       // (ANDSXrs XZR, GPR64:$src1, GPR64:$src2, 0)
   11747             :       AsmString = "tst $\x02, $\x03";
   11748             :       break;
   11749             :     }
   11750          44 :     if (MI->getNumOperands() == 4 &&
   11751          30 :         MI->getOperand(0).getReg() == AArch64::XZR &&
   11752          16 :         MI->getOperand(1).isReg() &&
   11753          32 :         MRI.getRegClass(AArch64::GPR64RegClassID).contains(MI->getOperand(1).getReg()) &&
   11754          38 :         MI->getOperand(2).isReg() &&
   11755          24 :         MRI.getRegClass(AArch64::GPR64RegClassID).contains(MI->getOperand(2).getReg())) {
   11756             :       // (ANDSXrs XZR, GPR64:$src1, GPR64:$src2, logical_shift64:$sh)
   11757             :       AsmString = "tst $\x02, $\x03$\xFF\x04\x02";
   11758             :       break;
   11759             :     }
   11760          28 :     if (MI->getNumOperands() == 4 &&
   11761          28 :         MI->getOperand(0).isReg() &&
   11762          56 :         MRI.getRegClass(AArch64::GPR64RegClassID).contains(MI->getOperand(0).getReg()) &&
   11763          28 :         MI->getOperand(1).isReg() &&
   11764          56 :         MRI.getRegClass(AArch64::GPR64RegClassID).contains(MI->getOperand(1).getReg()) &&
   11765          28 :         MI->getOperand(2).isReg() &&
   11766          56 :         MRI.getRegClass(AArch64::GPR64RegClassID).contains(MI->getOperand(2).getReg()) &&
   11767          42 :         MI->getOperand(3).isImm() &&
   11768          14 :         MI->getOperand(3).getImm() == 0) {
   11769             :       // (ANDSXrs GPR64:$dst, GPR64:$src1, GPR64:$src2, 0)
   11770             :       AsmString = "ands    $\x01, $\x02, $\x03";
   11771             :       break;
   11772             :     }
   11773             :     return false;
   11774          70 :   case AArch64::ANDWrs:
   11775         140 :     if (MI->getNumOperands() == 4 &&
   11776         140 :         MI->getOperand(0).isReg() &&
   11777         280 :         MRI.getRegClass(AArch64::GPR32RegClassID).contains(MI->getOperand(0).getReg()) &&
   11778         140 :         MI->getOperand(1).isReg() &&
   11779         280 :         MRI.getRegClass(AArch64::GPR32RegClassID).contains(MI->getOperand(1).getReg()) &&
   11780         140 :         MI->getOperand(2).isReg() &&
   11781         280 :         MRI.getRegClass(AArch64::GPR32RegClassID).contains(MI->getOperand(2).getReg()) &&
   11782         210 :         MI->getOperand(3).isImm() &&
   11783          70 :         MI->getOperand(3).getImm() == 0) {
   11784             :       // (ANDWrs GPR32:$dst, GPR32:$src1, GPR32:$src2, 0)
   11785             :       AsmString = "and     $\x01, $\x02, $\x03";
   11786             :       break;
   11787             :     }
   11788             :     return false;
   11789          39 :   case AArch64::ANDXrs:
   11790          78 :     if (MI->getNumOperands() == 4 &&
   11791          78 :         MI->getOperand(0).isReg() &&
   11792         156 :         MRI.getRegClass(AArch64::GPR64RegClassID).contains(MI->getOperand(0).getReg()) &&
   11793          78 :         MI->getOperand(1).isReg() &&
   11794         156 :         MRI.getRegClass(AArch64::GPR64RegClassID).contains(MI->getOperand(1).getReg()) &&
   11795          78 :         MI->getOperand(2).isReg() &&
   11796         156 :         MRI.getRegClass(AArch64::GPR64RegClassID).contains(MI->getOperand(2).getReg()) &&
   11797         117 :         MI->getOperand(3).isImm() &&
   11798          39 :         MI->getOperand(3).getImm() == 0) {
   11799             :       // (ANDXrs GPR64:$dst, GPR64:$src1, GPR64:$src2, 0)
   11800             :       AsmString = "and     $\x01, $\x02, $\x03";
   11801             :       break;
   11802             :     }
   11803             :     return false;
   11804          18 :   case AArch64::BICSWrs:
   11805          36 :     if (MI->getNumOperands() == 4 &&
   11806          36 :         MI->getOperand(0).isReg() &&
   11807          72 :         MRI.getRegClass(AArch64::GPR32RegClassID).contains(MI->getOperand(0).getReg()) &&
   11808          36 :         MI->getOperand(1).isReg() &&
   11809          72 :         MRI.getRegClass(AArch64::GPR32RegClassID).contains(MI->getOperand(1).getReg()) &&
   11810          36 :         MI->getOperand(2).isReg() &&
   11811          72 :         MRI.getRegClass(AArch64::GPR32RegClassID).contains(MI->getOperand(2).getReg()) &&
   11812          54 :         MI->getOperand(3).isImm() &&
   11813          18 :         MI->getOperand(3).getImm() == 0) {
   11814             :       // (BICSWrs GPR32:$dst, GPR32:$src1, GPR32:$src2, 0)
   11815             :       AsmString = "bics    $\x01, $\x02, $\x03";
   11816             :       break;
   11817             :     }
   11818             :     return false;
   11819          14 :   case AArch64::BICSXrs:
   11820          28 :     if (MI->getNumOperands() == 4 &&
   11821          28 :         MI->getOperand(0).isReg() &&
   11822          56 :         MRI.getRegClass(AArch64::GPR64RegClassID).contains(MI->getOperand(0).getReg()) &&
   11823          28 :         MI->getOperand(1).isReg() &&
   11824          56 :         MRI.getRegClass(AArch64::GPR64RegClassID).contains(MI->getOperand(1).getReg()) &&
   11825          28 :         MI->getOperand(2).isReg() &&
   11826          56 :         MRI.getRegClass(AArch64::GPR64RegClassID).contains(MI->getOperand(2).getReg()) &&
   11827          42 :         MI->getOperand(3).isImm() &&
   11828          14 :         MI->getOperand(3).getImm() == 0) {
   11829             :       // (BICSXrs GPR64:$dst, GPR64:$src1, GPR64:$src2, 0)
   11830             :       AsmString = "bics    $\x01, $\x02, $\x03";
   11831             :       break;
   11832             :     }
   11833             :     return false;
   11834          23 :   case AArch64::BICWrs:
   11835          46 :     if (MI->getNumOperands() == 4 &&
   11836          46 :         MI->getOperand(0).isReg() &&
   11837          92 :         MRI.getRegClass(AArch64::GPR32RegClassID).contains(MI->getOperand(0).getReg()) &&
   11838          46 :         MI->getOperand(1).isReg() &&
   11839          92 :         MRI.getRegClass(AArch64::GPR32RegClassID).contains(MI->getOperand(1).getReg()) &&
   11840          46 :         MI->getOperand(2).isReg() &&
   11841          92 :         MRI.getRegClass(AArch64::GPR32RegClassID).contains(MI->getOperand(2).getReg()) &&
   11842          69 :         MI->getOperand(3).isImm() &&
   11843          23 :         MI->getOperand(3).getImm() == 0) {
   11844             :       // (BICWrs GPR32:$dst, GPR32:$src1, GPR32:$src2, 0)
   11845             :       AsmString = "bic     $\x01, $\x02, $\x03";
   11846             :       break;
   11847             :     }
   11848             :     return false;
   11849          17 :   case AArch64::BICXrs:
   11850          34 :     if (MI->getNumOperands() == 4 &&
   11851          34 :         MI->getOperand(0).isReg() &&
   11852          68 :         MRI.getRegClass(AArch64::GPR64RegClassID).contains(MI->getOperand(0).getReg()) &&
   11853          34 :         MI->getOperand(1).isReg() &&
   11854          68 :         MRI.getRegClass(AArch64::GPR64RegClassID).contains(MI->getOperand(1).getReg()) &&
   11855          34 :         MI->getOperand(2).isReg() &&
   11856          68 :         MRI.getRegClass(AArch64::GPR64RegClassID).contains(MI->getOperand(2).getReg()) &&
   11857          51 :         MI->getOperand(3).isImm() &&
   11858          17 :         MI->getOperand(3).getImm() == 0) {
   11859             :       // (BICXrs GPR64:$dst, GPR64:$src1, GPR64:$src2, 0)
   11860             :       AsmString = "bic     $\x01, $\x02, $\x03";
   11861             :       break;
   11862             :     }
   11863             :     return false;
   11864          21 :   case AArch64::BICv2i32:
   11865          21 :     if (MI->getNumOperands() == 3 &&
   11866           0 :         MI->getOperand(0).isReg() &&
   11867           0 :         MRI.getRegClass(AArch64::FPR64RegClassID).contains(MI->getOperand(0).getReg()) &&
   11868          21 :         MI->getOperand(2).isImm() &&
   11869           0 :         MI->getOperand(2).getImm() == 0) {
   11870             :       // (BICv2i32 V64:$Vd, imm0_255:$imm, 0)
   11871             :       AsmString = "bic $\xFF\x01\x06.2s, $\xFF\x02\x07";
   11872             :       break;
   11873             :     }
   11874             :     return false;
   11875          17 :   case AArch64::BICv4i16:
   11876          17 :     if (MI->getNumOperands() == 3 &&
   11877           0 :         MI->getOperand(0).isReg() &&
   11878           0 :         MRI.getRegClass(AArch64::FPR64RegClassID).contains(MI->getOperand(0).getReg()) &&
   11879          17 :         MI->getOperand(2).isImm() &&
   11880           0 :         MI->getOperand(2).getImm() == 0) {
   11881             :       // (BICv4i16 V64:$Vd, imm0_255:$imm, 0)
   11882             :       AsmString = "bic $\xFF\x01\x06.4h, $\xFF\x02\x07";
   11883             :       break;
   11884             :     }
   11885             :     return false;
   11886          24 :   case AArch64::BICv4i32:
   11887          24 :     if (MI->getNumOperands() == 3 &&
   11888           0 :         MI->getOperand(0).isReg() &&
   11889           0 :         MRI.getRegClass(AArch64::FPR128RegClassID).contains(MI->getOperand(0).getReg()) &&
   11890          24 :         MI->getOperand(2).isImm() &&
   11891           0 :         MI->getOperand(2).getImm() == 0) {
   11892             :       // (BICv4i32 V128:$Vd, imm0_255:$imm, 0)
   11893             :       AsmString = "bic $\xFF\x01\x06.4s, $\xFF\x02\x07";
   11894             :       break;
   11895             :     }
   11896             :     return false;
   11897          14 :   case AArch64::BICv8i16:
   11898          14 :     if (MI->getNumOperands() == 3 &&
   11899           0 :         MI->getOperand(0).isReg() &&
   11900           0 :         MRI.getRegClass(AArch64::FPR128RegClassID).contains(MI->getOperand(0).getReg()) &&
   11901          14 :         MI->getOperand(2).isImm() &&
   11902           0 :         MI->getOperand(2).getImm() == 0) {
   11903             :       // (BICv8i16 V128:$Vd, imm0_255:$imm, 0)
   11904             :       AsmString = "bic $\xFF\x01\x06.8h, $\xFF\x02\x07";
   11905             :       break;
   11906             :     }
   11907             :     return false;
   11908          32 :   case AArch64::CLREX:
   11909          64 :     if (MI->getNumOperands() == 1 &&
   11910          96 :         MI->getOperand(0).isImm() &&
   11911          32 :         MI->getOperand(0).getImm() == 15) {
   11912             :       // (CLREX 15)
   11913             :       AsmString = "clrex";
   11914             :       break;
   11915             :     }
   11916             :     return false;
   11917         147 :   case AArch64::CSINCWr:
   11918         294 :     if (MI->getNumOperands() == 4 &&
   11919         294 :         MI->getOperand(0).isReg() &&
   11920         588 :         MRI.getRegClass(AArch64::GPR32RegClassID).contains(MI->getOperand(0).getReg()) &&
   11921         256 :         MI->getOperand(1).getReg() == AArch64::WZR &&
   11922         256 :         MI->getOperand(2).getReg() == AArch64::WZR &&
   11923         105 :         AArch64InstPrinterValidateMCOperand(MI->getOperand(3), STI, 1)) {
   11924             :       // (CSINCWr GPR32:$dst, WZR, WZR, inv_ccode:$cc)
   11925             :       AsmString = "cset $\x01, $\xFF\x04\x08";
   11926             :       break;
   11927             :     }
   11928          90 :     if (MI->getNumOperands() == 4 &&
   11929          90 :         MI->getOperand(0).isReg() &&
   11930         180 :         MRI.getRegClass(AArch64::GPR32RegClassID).contains(MI->getOperand(0).getReg()) &&
   11931          90 :         MI->getOperand(1).isReg() &&
   11932         180 :         MRI.getRegClass(AArch64::GPR32RegClassID).contains(MI->getOperand(1).getReg()) &&
   11933          90 :         MI->getOperand(2).isReg() &&
   11934         135 :         MI->getOperand(2).getReg() == MI->getOperand(1).getReg() &&
   11935          20 :         AArch64InstPrinterValidateMCOperand(MI->getOperand(3), STI, 1)) {
   11936             :       // (CSINCWr GPR32:$dst, GPR32:$src, GPR32:$src, inv_ccode:$cc)
   11937             :       AsmString = "cinc $\x01, $\x02, $\xFF\x04\x08";
   11938             :       break;
   11939             :     }
   11940             :     return false;
   11941          49 :   case AArch64::CSINCXr:
   11942          98 :     if (MI->getNumOperands() == 4 &&
   11943          98 :         MI->getOperand(0).isReg() &&
   11944         196 :         MRI.getRegClass(AArch64::GPR64RegClassID).contains(MI->getOperand(0).getReg()) &&
   11945          61 :         MI->getOperand(1).getReg() == AArch64::XZR &&
   11946          61 :         MI->getOperand(2).getReg() == AArch64::XZR &&
   11947           8 :         AArch64InstPrinterValidateMCOperand(MI->getOperand(3), STI, 1)) {
   11948             :       // (CSINCXr GPR64:$dst, XZR, XZR, inv_ccode:$cc)
   11949             :       AsmString = "cset $\x01, $\xFF\x04\x08";
   11950             :       break;
   11951             :     }
   11952          82 :     if (MI->getNumOperands() == 4 &&
   11953          82 :         MI->getOperand(0).isReg() &&
   11954         164 :         MRI.getRegClass(AArch64::GPR64RegClassID).contains(MI->getOperand(0).getReg()) &&
   11955          82 :         MI->getOperand(1).isReg() &&
   11956         164 :         MRI.getRegClass(AArch64::GPR64RegClassID).contains(MI->getOperand(1).getReg()) &&
   11957          82 :         MI->getOperand(2).isReg() &&
   11958         123 :         MI->getOperand(2).getReg() == MI->getOperand(1).getReg() &&
   11959          14 :         AArch64InstPrinterValidateMCOperand(MI->getOperand(3), STI, 1)) {
   11960             :       // (CSINCXr GPR64:$dst, GPR64:$src, GPR64:$src, inv_ccode:$cc)
   11961             :       AsmString = "cinc $\x01, $\x02, $\xFF\x04\x08";
   11962             :       break;
   11963             :     }
   11964             :     return false;
   11965         314 :   case AArch64::CSINVWr:
   11966         628 :     if (MI->getNumOperands() == 4 &&
   11967         628 :         MI->getOperand(0).isReg() &&
   11968        1256 :         MRI.getRegClass(AArch64::GPR32RegClassID).contains(MI->getOperand(0).getReg()) &&
   11969         556 :         MI->getOperand(1).getReg() == AArch64::WZR &&
   11970         556 :         MI->getOperand(2).getReg() == AArch64::WZR &&
   11971         238 :         AArch64InstPrinterValidateMCOperand(MI->getOperand(3), STI, 1)) {
   11972             :       // (CSINVWr GPR32:$dst, WZR, WZR, inv_ccode:$cc)
   11973             :       AsmString = "csetm $\x01, $\xFF\x04\x08";
   11974             :       break;
   11975             :     }
   11976         152 :     if (MI->getNumOperands() == 4 &&
   11977         152 :         MI->getOperand(0).isReg() &&
   11978         304 :         MRI.getRegClass(AArch64::GPR32RegClassID).contains(MI->getOperand(0).getReg()) &&
   11979         152 :         MI->getOperand(1).isReg() &&
   11980         304 :         MRI.getRegClass(AArch64::GPR32RegClassID).contains(MI->getOperand(1).getReg()) &&
   11981         152 :         MI->getOperand(2).isReg() &&
   11982         228 :         MI->getOperand(2).getReg() == MI->getOperand(1).getReg() &&
   11983          16 :         AArch64InstPrinterValidateMCOperand(MI->getOperand(3), STI, 1)) {
   11984             :       // (CSINVWr GPR32:$dst, GPR32:$src, GPR32:$src, inv_ccode:$cc)
   11985             :       AsmString = "cinv $\x01, $\x02, $\xFF\x04\x08";
   11986             :       break;
   11987             :     }
   11988             :     return false;
   11989          51 :   case AArch64::CSINVXr:
   11990         102 :     if (MI->getNumOperands() == 4 &&
   11991         102 :         MI->getOperand(0).isReg() &&
   11992         204 :         MRI.getRegClass(AArch64::GPR64RegClassID).contains(MI->getOperand(0).getReg()) &&
   11993          68 :         MI->getOperand(1).getReg() == AArch64::XZR &&
   11994          68 :         MI->getOperand(2).getReg() == AArch64::XZR &&
   11995          13 :         AArch64InstPrinterValidateMCOperand(MI->getOperand(3), STI, 1)) {
   11996             :       // (CSINVXr GPR64:$dst, XZR, XZR, inv_ccode:$cc)
   11997             :       AsmString = "csetm $\x01, $\xFF\x04\x08";
   11998             :       break;
   11999             :     }
   12000          82 :     if (MI->getNumOperands() == 4 &&
   12001          82 :         MI->getOperand(0).isReg() &&
   12002         164 :         MRI.getRegClass(AArch64::GPR64RegClassID).contains(MI->getOperand(0).getReg()) &&
   12003          82 :         MI->getOperand(1).isReg() &&
   12004         164 :         MRI.getRegClass(AArch64::GPR64RegClassID).contains(MI->getOperand(1).getReg()) &&
   12005          82 :         MI->getOperand(2).isReg() &&
   12006         123 :         MI->getOperand(2).getReg() == MI->getOperand(1).getReg() &&
   12007          15 :         AArch64InstPrinterValidateMCOperand(MI->getOperand(3), STI, 1)) {
   12008             :       // (CSINVXr GPR64:$dst, GPR64:$src, GPR64:$src, inv_ccode:$cc)
   12009             :       AsmString = "cinv $\x01, $\x02, $\xFF\x04\x08";
   12010             :       break;
   12011             :     }
   12012             :     return false;
   12013          40 :   case AArch64::CSNEGWr:
   12014          80 :     if (MI->getNumOperands() == 4 &&
   12015          80 :         MI->getOperand(0).isReg() &&
   12016         160 :         MRI.getRegClass(AArch64::GPR32RegClassID).contains(MI->getOperand(0).getReg()) &&
   12017          80 :         MI->getOperand(1).isReg() &&
   12018         160 :         MRI.getRegClass(AArch64::GPR32RegClassID).contains(MI->getOperand(1).getReg()) &&
   12019          80 :         MI->getOperand(2).isReg() &&
   12020         120 :         MI->getOperand(2).getReg() == MI->getOperand(1).getReg() &&
   12021          17 :         AArch64InstPrinterValidateMCOperand(MI->getOperand(3), STI, 1)) {
   12022             :       // (CSNEGWr GPR32:$dst, GPR32:$src, GPR32:$src, inv_ccode:$cc)
   12023             :       AsmString = "cneg $\x01, $\x02, $\xFF\x04\x08";
   12024             :       break;
   12025             :     }
   12026             :     return false;
   12027          39 :   case AArch64::CSNEGXr:
   12028          78 :     if (MI->getNumOperands() == 4 &&
   12029          78 :         MI->getOperand(0).isReg() &&
   12030         156 :         MRI.getRegClass(AArch64::GPR64RegClassID).contains(MI->getOperand(0).getReg()) &&
   12031          78 :         MI->getOperand(1).isReg() &&
   12032         156 :         MRI.getRegClass(AArch64::GPR64RegClassID).contains(MI->getOperand(1).getReg()) &&
   12033          78 :         MI->getOperand(2).isReg() &&
   12034         117 :         MI->getOperand(2).getReg() == MI->getOperand(1).getReg() &&
   12035          16 :         AArch64InstPrinterValidateMCOperand(MI->getOperand(3), STI, 1)) {
   12036             :       // (CSNEGXr GPR64:$dst, GPR64:$src, GPR64:$src, inv_ccode:$cc)
   12037             :       AsmString = "cneg $\x01, $\x02, $\xFF\x04\x08";
   12038             :       break;
   12039             :     }
   12040             :     return false;
   12041          11 :   case AArch64::DCPS1:
   12042          22 :     if (MI->getNumOperands() == 1 &&
   12043          33 :         MI->getOperand(0).isImm() &&
   12044          11 :         MI->getOperand(0).getImm() == 0) {
   12045             :       // (DCPS1 0)
   12046             :       AsmString = "dcps1";
   12047             :       break;
   12048             :     }
   12049             :     return false;
   12050          11 :   case AArch64::DCPS2:
   12051          22 :     if (MI->getNumOperands() == 1 &&
   12052          33 :         MI->getOperand(0).isImm() &&
   12053          11 :         MI->getOperand(0).getImm() == 0) {
   12054             :       // (DCPS2 0)
   12055             :       AsmString = "dcps2";
   12056             :       break;
   12057             :     }
   12058             :     return false;
   12059          11 :   case AArch64::DCPS3:
   12060          22 :     if (MI->getNumOperands() == 1 &&
   12061          33 :         MI->getOperand(0).isImm() &&
   12062          11 :         MI->getOperand(0).getImm() == 0) {
   12063             :       // (DCPS3 0)
   12064             :       AsmString = "dcps3";
   12065             :       break;
   12066             :     }
   12067             :     return false;
   12068          13 :   case AArch64::EONWrs:
   12069          26 :     if (MI->getNumOperands() == 4 &&
   12070          26 :         MI->getOperand(0).isReg() &&
   12071          52 :         MRI.getRegClass(AArch64::GPR32RegClassID).contains(MI->getOperand(0).getReg()) &&
   12072          26 :         MI->getOperand(1).isReg() &&
   12073          52 :         MRI.getRegClass(AArch64::GPR32RegClassID).contains(MI->getOperand(1).getReg()) &&
   12074          26 :         MI->getOperand(2).isReg() &&
   12075          52 :         MRI.getRegClass(AArch64::GPR32RegClassID).contains(MI->getOperand(2).getReg()) &&
   12076          39 :         MI->getOperand(3).isImm() &&
   12077          13 :         MI->getOperand(3).getImm() == 0) {
   12078             :       // (EONWrs GPR32:$dst, GPR32:$src1, GPR32:$src2, 0)
   12079             :       AsmString = "eon     $\x01, $\x02, $\x03";
   12080             :       break;
   12081             :     }
   12082             :     return false;
   12083          16 :   case AArch64::EONXrs:
   12084          32 :     if (MI->getNumOperands() == 4 &&
   12085          32 :         MI->getOperand(0).isReg() &&
   12086          64 :         MRI.getRegClass(AArch64::GPR64RegClassID).contains(MI->getOperand(0).getReg()) &&
   12087          32 :         MI->getOperand(1).isReg() &&
   12088          64 :         MRI.getRegClass(AArch64::GPR64RegClassID).contains(MI->getOperand(1).getReg()) &&
   12089          32 :         MI->getOperand(2).isReg() &&
   12090          64 :         MRI.getRegClass(AArch64::GPR64RegClassID).contains(MI->getOperand(2).getReg()) &&
   12091          48 :         MI->getOperand(3).isImm() &&
   12092          16 :         MI->getOperand(3).getImm() == 0) {
   12093             :       // (EONXrs GPR64:$dst, GPR64:$src1, GPR64:$src2, 0)
   12094             :       AsmString = "eon     $\x01, $\x02, $\x03";
   12095             :       break;
   12096             :     }
   12097             :     return false;
   12098          20 :   case AArch64::EORWrs:
   12099          40 :     if (MI->getNumOperands() == 4 &&
   12100          40 :         MI->getOperand(0).isReg() &&
   12101          80 :         MRI.getRegClass(AArch64::GPR32RegClassID).contains(MI->getOperand(0).getReg()) &&
   12102          40 :         MI->getOperand(1).isReg() &&
   12103          80 :         MRI.getRegClass(AArch64::GPR32RegClassID).contains(MI->getOperand(1).getReg()) &&
   12104          40 :         MI->getOperand(2).isReg() &&
   12105          80 :         MRI.getRegClass(AArch64::GPR32RegClassID).contains(MI->getOperand(2).getReg()) &&
   12106          60 :         MI->getOperand(3).isImm() &&
   12107          20 :         MI->getOperand(3).getImm() == 0) {
   12108             :       // (EORWrs GPR32:$dst, GPR32:$src1, GPR32:$src2, 0)
   12109             :       AsmString = "eor     $\x01, $\x02, $\x03";
   12110             :       break;
   12111             :     }
   12112             :     return false;
   12113          24 :   case AArch64::EORXrs:
   12114          48 :     if (MI->getNumOperands() == 4 &&
   12115          48 :         MI->getOperand(0).isReg() &&
   12116          96 :         MRI.getRegClass(AArch64::GPR64RegClassID).contains(MI->getOperand(0).getReg()) &&
   12117          48 :         MI->getOperand(1).isReg() &&
   12118          96 :         MRI.getRegClass(AArch64::GPR64RegClassID).contains(MI->getOperand(1).getReg()) &&
   12119          48 :         MI->getOperand(2).isReg() &&
   12120          96 :         MRI.getRegClass(AArch64::GPR64RegClassID).contains(MI->getOperand(2).getReg()) &&
   12121          72 :         MI->getOperand(3).isImm() &&
   12122          24 :         MI->getOperand(3).getImm() == 0) {
   12123             :       // (EORXrs GPR64:$dst, GPR64:$src1, GPR64:$src2, 0)
   12124             :       AsmString = "eor     $\x01, $\x02, $\x03";
   12125             :       break;
   12126             :     }
   12127             :     return false;
   12128          16 :   case AArch64::EXTRWrri:
   12129          32 :     if (MI->getNumOperands() == 4 &&
   12130          32 :         MI->getOperand(0).isReg() &&
   12131          64 :         MRI.getRegClass(AArch64::GPR32RegClassID).contains(MI->getOperand(0).getReg()) &&
   12132          32 :         MI->getOperand(1).isReg() &&
   12133          64 :         MRI.getRegClass(AArch64::GPR32RegClassID).contains(MI->getOperand(1).getReg()) &&
   12134          48 :         MI->getOperand(2).isReg() &&
   12135          32 :         MI->getOperand(2).getReg() == MI->getOperand(1).getReg()) {
   12136             :       // (EXTRWrri GPR32:$dst, GPR32:$src, GPR32:$src, imm0_31:$shift)
   12137             :       AsmString = "ror $\x01, $\x02, $\x04";
   12138             :       break;
   12139             :     }
   12140             :     return false;
   12141          23 :   case AArch64::EXTRXrri:
   12142          46 :     if (MI->getNumOperands() == 4 &&
   12143          46 :         MI->getOperand(0).isReg() &&
   12144          92 :         MRI.getRegClass(AArch64::GPR64RegClassID).contains(MI->getOperand(0).getReg()) &&
   12145          46 :         MI->getOperand(1).isReg() &&
   12146          92 :         MRI.getRegClass(AArch64::GPR64RegClassID).contains(MI->getOperand(1).getReg()) &&
   12147          69 :         MI->getOperand(2).isReg() &&
   12148          46 :         MI->getOperand(2).getReg() == MI->getOperand(1).getReg()) {
   12149             :       // (EXTRXrri GPR64:$dst, GPR64:$src, GPR64:$src, imm0_63:$shift)
   12150             :       AsmString = "ror $\x01, $\x02, $\x04";
   12151             :       break;
   12152             :     }
   12153             :     return false;
   12154         167 :   case AArch64::HINT:
   12155         334 :     if (MI->getNumOperands() == 1 &&
   12156         501 :         MI->getOperand(0).isImm() &&
   12157         167 :         MI->getOperand(0).getImm() == 0) {
   12158             :       // (HINT { 0, 0, 0 })
   12159             :       AsmString = "nop";
   12160             :       break;
   12161             :     }
   12162          90 :     if (MI->getNumOperands() == 1 &&
   12163         135 :         MI->getOperand(0).isImm() &&
   12164          45 :         MI->getOperand(0).getImm() == 1) {
   12165             :       // (HINT { 0, 0, 1 })
   12166             :       AsmString = "yield";
   12167             :       break;
   12168             :     }
   12169          76 :     if (MI->getNumOperands() == 1 &&
   12170         114 :         MI->getOperand(0).isImm() &&
   12171          38 :         MI->getOperand(0).getImm() == 2) {
   12172             :       // (HINT { 0, 1, 0 })
   12173             :       AsmString = "wfe";
   12174             :       break;
   12175             :     }
   12176          62 :     if (MI->getNumOperands() == 1 &&
   12177          93 :         MI->getOperand(0).isImm() &&
   12178          31 :         MI->getOperand(0).getImm() == 3) {
   12179             :       // (HINT { 0, 1, 1 })
   12180             :       AsmString = "wfi";
   12181             :       break;
   12182             :     }
   12183          48 :     if (MI->getNumOperands() == 1 &&
   12184          72 :         MI->getOperand(0).isImm() &&
   12185          24 :         MI->getOperand(0).getImm() == 4) {
   12186             :       // (HINT { 1, 0, 0 })
   12187             :       AsmString = "sev";
   12188             :       break;
   12189             :     }
   12190          34 :     if (MI->getNumOperands() == 1 &&
   12191          51 :         MI->getOperand(0).isImm() &&
   12192          17 :         MI->getOperand(0).getImm() == 5) {
   12193             :       // (HINT { 1, 0, 1 })
   12194             :       AsmString = "sevl";
   12195             :       break;
   12196             :     }
   12197          20 :     if (MI->getNumOperands() == 1 &&
   12198          20 :         MI->getOperand(0).isImm() &&
   12199          22 :         MI->getOperand(0).getImm() == 16 &&
   12200           4 :         STI.getFeatureBits()[AArch64::FeatureRAS]) {
   12201             :       // (HINT { 1, 0, 0, 0, 0 })
   12202             :       AsmString = "esb";
   12203             :       break;
   12204             :     }
   12205          16 :     if (MI->getNumOperands() == 1 &&
   12206          27 :         AArch64InstPrinterValidateMCOperand(MI->getOperand(0), STI, 2) &&
   12207           6 :         STI.getFeatureBits()[AArch64::FeatureSPE]) {
   12208             :       // (HINT psbhint_op:$op)
   12209             :       AsmString = "psb $\xFF\x01\x09";
   12210             :       break;
   12211             :     }
   12212             :     return false;
   12213         235 :   case AArch64::INSvi16gpr:
   12214         235 :     if (MI->getNumOperands() == 3 &&
   12215           0 :         MI->getOperand(0).isReg() &&
   12216           0 :         MRI.getRegClass(AArch64::FPR128RegClassID).contains(MI->getOperand(0).getReg()) &&
   12217           0 :         MI->getOperand(2).isReg() &&
   12218         235 :         MRI.getRegClass(AArch64::GPR32RegClassID).contains(MI->getOperand(2).getReg()) &&
   12219           0 :         STI.getFeatureBits()[AArch64::FeatureNEON]) {
   12220             :       // (INSvi16gpr V128:$dst, VectorIndexH:$idx, GPR32:$src)
   12221             :       AsmString = "mov     $\xFF\x01\x06.h$\xFF\x02\x0A, $\x03";
   12222             :       break;
   12223             :     }
   12224             :     return false;
   12225          57 :   case AArch64::INSvi16lane:
   12226          57 :     if (MI->getNumOperands() == 4 &&
   12227           0 :         MI->getOperand(0).isReg() &&
   12228           0 :         MRI.getRegClass(AArch64::FPR128RegClassID).contains(MI->getOperand(0).getReg()) &&
   12229           0 :         MI->getOperand(2).isReg() &&