LCOV - code coverage report
Current view: top level - build-llvm/lib/Target/ARM - ARMGenAsmWriter.inc (source / functions) Hit Total Coverage
Test: llvm-toolchain.info Lines: 1512 1558 97.0 %
Date: 2018-05-20 00:06:23 Functions: 4 4 100.0 %
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          Line data    Source code
       1             : /*===- TableGen'erated file -------------------------------------*- C++ -*-===*\
       2             : |*                                                                            *|
       3             : |* Assembly Writer Source Fragment                                            *|
       4             : |*                                                                            *|
       5             : |* Automatically generated file, do not edit!                                 *|
       6             : |*                                                                            *|
       7             : \*===----------------------------------------------------------------------===*/
       8             : 
       9             : /// printInstruction - This method is automatically generated by tablegen
      10             : /// from the instruction set description.
      11      142925 : void ARMInstPrinter::printInstruction(const MCInst *MI, const MCSubtargetInfo &STI, raw_ostream &O) {
      12             :   static const char AsmStrs[] = {
      13             :   /* 0 */ 's', 'h', 'a', '1', 's', 'u', '0', '.', '3', '2', 9, 0,
      14             :   /* 12 */ 's', 'h', 'a', '2', '5', '6', 's', 'u', '0', '.', '3', '2', 9, 0,
      15             :   /* 26 */ 's', 'h', 'a', '1', 's', 'u', '1', '.', '3', '2', 9, 0,
      16             :   /* 38 */ 's', 'h', 'a', '2', '5', '6', 's', 'u', '1', '.', '3', '2', 9, 0,
      17             :   /* 52 */ 's', 'h', 'a', '2', '5', '6', 'h', '2', '.', '3', '2', 9, 0,
      18             :   /* 65 */ 's', 'h', 'a', '1', 'c', '.', '3', '2', 9, 0,
      19             :   /* 75 */ 's', 'h', 'a', '1', 'h', '.', '3', '2', 9, 0,
      20             :   /* 85 */ 's', 'h', 'a', '2', '5', '6', 'h', '.', '3', '2', 9, 0,
      21             :   /* 97 */ 's', 'h', 'a', '1', 'm', '.', '3', '2', 9, 0,
      22             :   /* 107 */ 's', 'h', 'a', '1', 'p', '.', '3', '2', 9, 0,
      23             :   /* 117 */ 'v', 'c', 'v', 't', 'a', '.', 's', '3', '2', '.', 'f', '3', '2', 9, 0,
      24             :   /* 132 */ 'v', 'c', 'v', 't', 'm', '.', 's', '3', '2', '.', 'f', '3', '2', 9, 0,
      25             :   /* 147 */ 'v', 'c', 'v', 't', 'n', '.', 's', '3', '2', '.', 'f', '3', '2', 9, 0,
      26             :   /* 162 */ 'v', 'c', 'v', 't', 'p', '.', 's', '3', '2', '.', 'f', '3', '2', 9, 0,
      27             :   /* 177 */ 'v', 'c', 'v', 't', 'a', '.', 'u', '3', '2', '.', 'f', '3', '2', 9, 0,
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      30             :   /* 222 */ 'v', 'c', 'v', 't', 'p', '.', 'u', '3', '2', '.', 'f', '3', '2', 9, 0,
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      33             :   /* 260 */ 'v', 'c', 'a', 'd', 'd', '.', 'f', '3', '2', 9, 0,
      34             :   /* 271 */ 'v', 's', 'e', 'l', 'g', 'e', '.', 'f', '3', '2', 9, 0,
      35             :   /* 283 */ 'v', 'm', 'i', 'n', 'n', 'm', '.', 'f', '3', '2', 9, 0,
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      42             :   /* 367 */ 'v', 's', 'e', 'l', 'g', 't', '.', 'f', '3', '2', 9, 0,
      43             :   /* 379 */ 'v', 'r', 'i', 'n', 't', 'x', '.', 'f', '3', '2', 9, 0,
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     128             :   /* 1303 */ 's', 'e', 't', 'p', 'a', 'n', 9, 0,
     129             :   /* 1311 */ 'c', 'p', 's', 9, 0,
     130             :   /* 1316 */ 'm', 'o', 'v', 's', 9, 0,
     131             :   /* 1322 */ 'h', 'l', 't', 9, 0,
     132             :   /* 1327 */ 'b', 'k', 'p', 't', 9, 0,
     133             :   /* 1333 */ 'h', 'v', 'c', '.', 'w', 9, 0,
     134             :   /* 1340 */ 'u', 'd', 'f', '.', 'w', 9, 0,
     135             :   /* 1347 */ 'c', 'r', 'c', '3', '2', 'w', 9, 0,
     136             :   /* 1355 */ 'c', 'r', 'c', '3', '2', 'c', 'w', 9, 0,
     137             :   /* 1364 */ 'p', 'l', 'd', 'w', 9, 0,
     138             :   /* 1370 */ 'b', 'x', 9, 0,
     139             :   /* 1374 */ 'b', 'l', 'x', 9, 0,
     140             :   /* 1379 */ 'c', 'b', 'z', 9, 0,
     141             :   /* 1384 */ 'c', 'b', 'n', 'z', 9, 0,
     142             :   /* 1390 */ 's', 'r', 's', 'd', 'a', 9, 's', 'p', '!', ',', 32, 0,
     143             :   /* 1402 */ 's', 'r', 's', 'i', 'a', 9, 's', 'p', '!', ',', 32, 0,
     144             :   /* 1414 */ 's', 'r', 's', 'd', 'b', 9, 's', 'p', '!', ',', 32, 0,
     145             :   /* 1426 */ 's', 'r', 's', 'i', 'b', 9, 's', 'p', '!', ',', 32, 0,
     146             :   /* 1438 */ 's', 'r', 's', 'd', 'a', 9, 's', 'p', ',', 32, 0,
     147             :   /* 1449 */ 's', 'r', 's', 'i', 'a', 9, 's', 'p', ',', 32, 0,
     148             :   /* 1460 */ 's', 'r', 's', 'd', 'b', 9, 's', 'p', ',', 32, 0,
     149             :   /* 1471 */ 's', 'r', 's', 'i', 'b', 9, 's', 'p', ',', 32, 0,
     150             :   /* 1482 */ '#', 32, 'X', 'R', 'a', 'y', 32, 'F', 'u', 'n', 'c', 't', 'i', 'o', 'n', 32, 'P', 'a', 't', 'c', 'h', 'a', 'b', 'l', 'e', 32, 'R', 'E', 'T', '.', 0,
     151             :   /* 1513 */ '#', 32, 'X', 'R', 'a', 'y', 32, 'T', 'y', 'p', 'e', 'd', 32, 'E', 'v', 'e', 'n', 't', 32, 'L', 'o', 'g', '.', 0,
     152             :   /* 1537 */ '#', 32, 'X', 'R', 'a', 'y', 32, 'C', 'u', 's', 't', 'o', 'm', 32, 'E', 'v', 'e', 'n', 't', 32, 'L', 'o', 'g', '.', 0,
     153             :   /* 1562 */ '#', 32, 'X', 'R', 'a', 'y', 32, 'F', 'u', 'n', 'c', 't', 'i', 'o', 'n', 32, 'E', 'n', 't', 'e', 'r', '.', 0,
     154             :   /* 1585 */ '#', 32, 'X', 'R', 'a', 'y', 32, 'T', 'a', 'i', 'l', 32, 'C', 'a', 'l', 'l', 32, 'E', 'x', 'i', 't', '.', 0,
     155             :   /* 1608 */ '#', 32, 'X', 'R', 'a', 'y', 32, 'F', 'u', 'n', 'c', 't', 'i', 'o', 'n', 32, 'E', 'x', 'i', 't', '.', 0,
     156             :   /* 1630 */ '_', '_', 'b', 'r', 'k', 'd', 'i', 'v', '0', 0,
     157             :   /* 1640 */ 'v', 'l', 'd', '1', 0,
     158             :   /* 1645 */ 'd', 'c', 'p', 's', '1', 0,
     159             :   /* 1651 */ 'v', 's', 't', '1', 0,
     160             :   /* 1656 */ 'v', 'r', 'e', 'v', '3', '2', 0,
     161             :   /* 1663 */ 'l', 'd', 'c', '2', 0,
     162             :   /* 1668 */ 'm', 'r', 'c', '2', 0,
     163             :   /* 1673 */ 'm', 'r', 'r', 'c', '2', 0,
     164             :   /* 1679 */ 's', 't', 'c', '2', 0,
     165             :   /* 1684 */ 'v', 'l', 'd', '2', 0,
     166             :   /* 1689 */ 'c', 'd', 'p', '2', 0,
     167             :   /* 1694 */ 'm', 'c', 'r', '2', 0,
     168             :   /* 1699 */ 'm', 'c', 'r', 'r', '2', 0,
     169             :   /* 1705 */ 'd', 'c', 'p', 's', '2', 0,
     170             :   /* 1711 */ 'v', 's', 't', '2', 0,
     171             :   /* 1716 */ 'v', 'l', 'd', '3', 0,
     172             :   /* 1721 */ 'd', 'c', 'p', 's', '3', 0,
     173             :   /* 1727 */ 'v', 's', 't', '3', 0,
     174             :   /* 1732 */ 'v', 'r', 'e', 'v', '6', '4', 0,
     175             :   /* 1739 */ 'v', 'l', 'd', '4', 0,
     176             :   /* 1744 */ 'v', 's', 't', '4', 0,
     177             :   /* 1749 */ 's', 'x', 't', 'a', 'b', '1', '6', 0,
     178             :   /* 1757 */ 'u', 'x', 't', 'a', 'b', '1', '6', 0,
     179             :   /* 1765 */ 's', 'x', 't', 'b', '1', '6', 0,
     180             :   /* 1772 */ 'u', 'x', 't', 'b', '1', '6', 0,
     181             :   /* 1779 */ 's', 'h', 's', 'u', 'b', '1', '6', 0,
     182             :   /* 1787 */ 'u', 'h', 's', 'u', 'b', '1', '6', 0,
     183             :   /* 1795 */ 'u', 'q', 's', 'u', 'b', '1', '6', 0,
     184             :   /* 1803 */ 's', 's', 'u', 'b', '1', '6', 0,
     185             :   /* 1810 */ 'u', 's', 'u', 'b', '1', '6', 0,
     186             :   /* 1817 */ 's', 'h', 'a', 'd', 'd', '1', '6', 0,
     187             :   /* 1825 */ 'u', 'h', 'a', 'd', 'd', '1', '6', 0,
     188             :   /* 1833 */ 'u', 'q', 'a', 'd', 'd', '1', '6', 0,
     189             :   /* 1841 */ 's', 'a', 'd', 'd', '1', '6', 0,
     190             :   /* 1848 */ 'u', 'a', 'd', 'd', '1', '6', 0,
     191             :   /* 1855 */ 's', 's', 'a', 't', '1', '6', 0,
     192             :   /* 1862 */ 'u', 's', 'a', 't', '1', '6', 0,
     193             :   /* 1869 */ 'v', 'r', 'e', 'v', '1', '6', 0,
     194             :   /* 1876 */ 'u', 's', 'a', 'd', 'a', '8', 0,
     195             :   /* 1883 */ 's', 'h', 's', 'u', 'b', '8', 0,
     196             :   /* 1890 */ 'u', 'h', 's', 'u', 'b', '8', 0,
     197             :   /* 1897 */ 'u', 'q', 's', 'u', 'b', '8', 0,
     198             :   /* 1904 */ 's', 's', 'u', 'b', '8', 0,
     199             :   /* 1910 */ 'u', 's', 'u', 'b', '8', 0,
     200             :   /* 1916 */ 'u', 's', 'a', 'd', '8', 0,
     201             :   /* 1922 */ 's', 'h', 'a', 'd', 'd', '8', 0,
     202             :   /* 1929 */ 'u', 'h', 'a', 'd', 'd', '8', 0,
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     204             :   /* 1943 */ 's', 'a', 'd', 'd', '8', 0,
     205             :   /* 1949 */ 'u', 'a', 'd', 'd', '8', 0,
     206             :   /* 1955 */ 'L', 'I', 'F', 'E', 'T', 'I', 'M', 'E', '_', 'E', 'N', 'D', 0,
     207             :   /* 1968 */ 'B', 'U', 'N', 'D', 'L', 'E', 0,
     208             :   /* 1975 */ 'D', 'B', 'G', '_', 'V', 'A', 'L', 'U', 'E', 0,
     209             :   /* 1985 */ 'D', 'B', 'G', '_', 'L', 'A', 'B', 'E', 'L', 0,
     210             :   /* 1995 */ '@', 32, 'C', 'O', 'M', 'P', 'I', 'L', 'E', 'R', 32, 'B', 'A', 'R', 'R', 'I', 'E', 'R', 0,
     211             :   /* 2014 */ 'L', 'I', 'F', 'E', 'T', 'I', 'M', 'E', '_', 'S', 'T', 'A', 'R', 'T', 0,
     212             :   /* 2029 */ 'v', 'a', 'b', 'a', 0,
     213             :   /* 2034 */ 'l', 'd', 'a', 0,
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     273             :   /* 2376 */ 'm', 'r', 'r', 'c', 0,
     274             :   /* 2381 */ 'r', 's', 'c', 0,
     275             :   /* 2385 */ 's', 't', 'c', 0,
     276             :   /* 2389 */ 's', 'v', 'c', 0,
     277             :   /* 2393 */ 's', 'm', 'l', 'a', 'd', 0,
     278             :   /* 2399 */ 's', 'm', 'u', 'a', 'd', 0,
     279             :   /* 2405 */ 'v', 'a', 'b', 'd', 0,
     280             :   /* 2410 */ 'q', 'd', 'a', 'd', 'd', 0,
     281             :   /* 2416 */ 'v', 'r', 'h', 'a', 'd', 'd', 0,
     282             :   /* 2423 */ 'v', 'h', 'a', 'd', 'd', 0,
     283             :   /* 2429 */ 'v', 'p', 'a', 'd', 'd', 0,
     284             :   /* 2435 */ 'v', 'q', 'a', 'd', 'd', 0,
     285             :   /* 2441 */ 'v', 'a', 'd', 'd', 0,
     286             :   /* 2446 */ 's', 'm', 'l', 'a', 'l', 'd', 0,
     287             :   /* 2453 */ 'p', 'l', 'd', 0,
     288             :   /* 2457 */ 's', 'm', 'l', 's', 'l', 'd', 0,
     289             :   /* 2464 */ 'v', 'a', 'n', 'd', 0,
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     378             :   /* 3001 */ 'v', 'q', 's', 'h', 'r', 'n', 0,
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     441             :   /* 3358 */ 'l', 'd', 'r', 'b', 't', 0,
     442             :   /* 3364 */ 's', 't', 'r', 'b', 't', 0,
     443             :   /* 3370 */ 'l', 'd', 'r', 's', 'b', 't', 0,
     444             :   /* 3377 */ 'e', 'r', 'e', 't', 0,
     445             :   /* 3382 */ 'v', 'a', 'c', 'g', 't', 0,
     446             :   /* 3388 */ 'v', 'c', 'g', 't', 0,
     447             :   /* 3393 */ 'l', 'd', 'r', 'h', 't', 0,
     448             :   /* 3399 */ 's', 't', 'r', 'h', 't', 0,
     449             :   /* 3405 */ 'l', 'd', 'r', 's', 'h', 't', 0,
     450             :   /* 3412 */ 'r', 'b', 'i', 't', 0,
     451             :   /* 3417 */ 'v', 'b', 'i', 't', 0,
     452             :   /* 3422 */ 'v', 'c', 'l', 't', 0,
     453             :   /* 3427 */ 'v', 'c', 'n', 't', 0,
     454             :   /* 3432 */ 'h', 'i', 'n', 't', 0,
     455             :   /* 3437 */ 'l', 'd', 'r', 't', 0,
     456             :   /* 3442 */ 'v', 's', 'q', 'r', 't', 0,
     457             :   /* 3448 */ 's', 't', 'r', 't', 0,
     458             :   /* 3453 */ 'v', 't', 's', 't', 0,
     459             :   /* 3458 */ 's', 'm', 'l', 'a', 't', 't', 0,
     460             :   /* 3465 */ 's', 'm', 'l', 'a', 'l', 't', 't', 0,
     461             :   /* 3473 */ 's', 'm', 'u', 'l', 't', 't', 0,
     462             :   /* 3480 */ 't', 't', 't', 0,
     463             :   /* 3484 */ 'v', 'c', 'v', 't', 't', 0,
     464             :   /* 3490 */ 'v', 'j', 'c', 'v', 't', 0,
     465             :   /* 3496 */ 'v', 'c', 'v', 't', 0,
     466             :   /* 3501 */ 'm', 'o', 'v', 't', 0,
     467             :   /* 3506 */ 's', 'm', 'l', 'a', 'w', 't', 0,
     468             :   /* 3513 */ 's', 'm', 'u', 'l', 'w', 't', 0,
     469             :   /* 3520 */ 'v', 'e', 'x', 't', 0,
     470             :   /* 3525 */ 'v', 'q', 's', 'h', 'l', 'u', 0,
     471             :   /* 3532 */ 'r', 'e', 'v', 0,
     472             :   /* 3536 */ 's', 'd', 'i', 'v', 0,
     473             :   /* 3541 */ 'u', 'd', 'i', 'v', 0,
     474             :   /* 3546 */ 'v', 'd', 'i', 'v', 0,
     475             :   /* 3551 */ 'v', 'm', 'o', 'v', 0,
     476             :   /* 3556 */ 'v', 's', 'u', 'b', 'w', 0,
     477             :   /* 3562 */ 'v', 'a', 'd', 'd', 'w', 0,
     478             :   /* 3568 */ 'p', 'l', 'd', 'w', 0,
     479             :   /* 3573 */ 'm', 'o', 'v', 'w', 0,
     480             :   /* 3578 */ 'f', 'l', 'd', 'm', 'i', 'a', 'x', 0,
     481             :   /* 3586 */ 'f', 's', 't', 'm', 'i', 'a', 'x', 0,
     482             :   /* 3594 */ 'v', 'p', 'm', 'a', 'x', 0,
     483             :   /* 3600 */ 'v', 'm', 'a', 'x', 0,
     484             :   /* 3605 */ 's', 'h', 's', 'a', 'x', 0,
     485             :   /* 3611 */ 'u', 'h', 's', 'a', 'x', 0,
     486             :   /* 3617 */ 'u', 'q', 's', 'a', 'x', 0,
     487             :   /* 3623 */ 's', 's', 'a', 'x', 0,
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     489             :   /* 3633 */ 'f', 'l', 'd', 'm', 'd', 'b', 'x', 0,
     490             :   /* 3641 */ 'f', 's', 't', 'm', 'd', 'b', 'x', 0,
     491             :   /* 3649 */ 'v', 't', 'b', 'x', 0,
     492             :   /* 3654 */ 's', 'm', 'l', 'a', 'd', 'x', 0,
     493             :   /* 3661 */ 's', 'm', 'u', 'a', 'd', 'x', 0,
     494             :   /* 3668 */ 's', 'm', 'l', 'a', 'l', 'd', 'x', 0,
     495             :   /* 3676 */ 's', 'm', 'l', 's', 'l', 'd', 'x', 0,
     496             :   /* 3684 */ 's', 'm', 'l', 's', 'd', 'x', 0,
     497             :   /* 3691 */ 's', 'm', 'u', 's', 'd', 'x', 0,
     498             :   /* 3698 */ 'l', 'd', 'a', 'e', 'x', 0,
     499             :   /* 3704 */ 's', 't', 'l', 'e', 'x', 0,
     500             :   /* 3710 */ 'l', 'd', 'r', 'e', 'x', 0,
     501             :   /* 3716 */ 'c', 'l', 'r', 'e', 'x', 0,
     502             :   /* 3722 */ 's', 't', 'r', 'e', 'x', 0,
     503             :   /* 3728 */ 's', 'b', 'f', 'x', 0,
     504             :   /* 3733 */ 'u', 'b', 'f', 'x', 0,
     505             :   /* 3738 */ 'b', 'l', 'x', 0,
     506             :   /* 3742 */ 'r', 'r', 'x', 0,
     507             :   /* 3746 */ 's', 'h', 'a', 's', 'x', 0,
     508             :   /* 3752 */ 'u', 'h', 'a', 's', 'x', 0,
     509             :   /* 3758 */ 'u', 'q', 'a', 's', 'x', 0,
     510             :   /* 3764 */ 's', 'a', 's', 'x', 0,
     511             :   /* 3769 */ 'u', 'a', 's', 'x', 0,
     512             :   /* 3774 */ 'v', 'r', 'i', 'n', 't', 'x', 0,
     513             :   /* 3781 */ 'v', 'c', 'l', 'z', 0,
     514             :   /* 3786 */ 'v', 'r', 'i', 'n', 't', 'z', 0,
     515             :   };
     516             : 
     517             :   static const uint32_t OpInfo0[] = {
     518             :     0U, // PHI
     519             :     0U, // INLINEASM
     520             :     0U, // CFI_INSTRUCTION
     521             :     0U, // EH_LABEL
     522             :     0U, // GC_LABEL
     523             :     0U, // ANNOTATION_LABEL
     524             :     0U, // KILL
     525             :     0U, // EXTRACT_SUBREG
     526             :     0U, // INSERT_SUBREG
     527             :     0U, // IMPLICIT_DEF
     528             :     0U, // SUBREG_TO_REG
     529             :     0U, // COPY_TO_REGCLASS
     530             :     1976U,      // DBG_VALUE
     531             :     1986U,      // DBG_LABEL
     532             :     0U, // REG_SEQUENCE
     533             :     0U, // COPY
     534             :     1969U,      // BUNDLE
     535             :     2015U,      // LIFETIME_START
     536             :     1956U,      // LIFETIME_END
     537             :     0U, // STACKMAP
     538             :     2853U,      // FENTRY_CALL
     539             :     0U, // PATCHPOINT
     540             :     0U, // LOAD_STACK_GUARD
     541             :     0U, // STATEPOINT
     542             :     0U, // LOCAL_ESCAPE
     543             :     0U, // FAULTING_OP
     544             :     0U, // PATCHABLE_OP
     545             :     1563U,      // PATCHABLE_FUNCTION_ENTER
     546             :     1483U,      // PATCHABLE_RET
     547             :     1609U,      // PATCHABLE_FUNCTION_EXIT
     548             :     1586U,      // PATCHABLE_TAIL_CALL
     549             :     1538U,      // PATCHABLE_EVENT_CALL
     550             :     1514U,      // PATCHABLE_TYPED_EVENT_CALL
     551             :     0U, // ICALL_BRANCH_FUNNEL
     552             :     0U, // G_ADD
     553             :     0U, // G_SUB
     554             :     0U, // G_MUL
     555             :     0U, // G_SDIV
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     557             :     0U, // G_SREM
     558             :     0U, // G_UREM
     559             :     0U, // G_AND
     560             :     0U, // G_OR
     561             :     0U, // G_XOR
     562             :     0U, // G_IMPLICIT_DEF
     563             :     0U, // G_PHI
     564             :     0U, // G_FRAME_INDEX
     565             :     0U, // G_GLOBAL_VALUE
     566             :     0U, // G_EXTRACT
     567             :     0U, // G_UNMERGE_VALUES
     568             :     0U, // G_INSERT
     569             :     0U, // G_MERGE_VALUES
     570             :     0U, // G_PTRTOINT
     571             :     0U, // G_INTTOPTR
     572             :     0U, // G_BITCAST
     573             :     0U, // G_LOAD
     574             :     0U, // G_SEXTLOAD
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     576             :     0U, // G_STORE
     577             :     0U, // G_ATOMIC_CMPXCHG_WITH_SUCCESS
     578             :     0U, // G_ATOMIC_CMPXCHG
     579             :     0U, // G_ATOMICRMW_XCHG
     580             :     0U, // G_ATOMICRMW_ADD
     581             :     0U, // G_ATOMICRMW_SUB
     582             :     0U, // G_ATOMICRMW_AND
     583             :     0U, // G_ATOMICRMW_NAND
     584             :     0U, // G_ATOMICRMW_OR
     585             :     0U, // G_ATOMICRMW_XOR
     586             :     0U, // G_ATOMICRMW_MAX
     587             :     0U, // G_ATOMICRMW_MIN
     588             :     0U, // G_ATOMICRMW_UMAX
     589             :     0U, // G_ATOMICRMW_UMIN
     590             :     0U, // G_BRCOND
     591             :     0U, // G_BRINDIRECT
     592             :     0U, // G_INTRINSIC
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     594             :     0U, // G_ANYEXT
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     596             :     0U, // G_CONSTANT
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     599             :     0U, // G_VAARG
     600             :     0U, // G_SEXT
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     605             :     0U, // G_ICMP
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     609             :     0U, // G_USUBE
     610             :     0U, // G_SADDO
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     615             :     0U, // G_SMULH
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     633             :     0U, // G_UITOFP
     634             :     0U, // G_FABS
     635             :     0U, // G_GEP
     636             :     0U, // G_PTR_MASK
     637             :     0U, // G_BR
     638             :     0U, // G_INSERT_VECTOR_ELT
     639             :     0U, // G_EXTRACT_VECTOR_ELT
     640             :     0U, // G_SHUFFLE_VECTOR
     641             :     0U, // G_BSWAP
     642             :     0U, // ABS
     643             :     6448U,      // ADCri
     644             :     6448U,      // ADCrr
     645             :     10544U,     // ADCrsi
     646             :     14640U,     // ADCrsr
     647             :     0U, // ADDSri
     648             :     0U, // ADDSrr
     649             :     0U, // ADDSrsi
     650             :     0U, // ADDSrsr
     651             :     6509U,      // ADDri
     652             :     6509U,      // ADDrr
     653             :     10605U,     // ADDrsi
     654             :     14701U,     // ADDrsr
     655             :     0U, // ADJCALLSTACKDOWN
     656             :     0U, // ADJCALLSTACKUP
     657             :     19525U,     // ADR
     658             :     1090671737U,        // AESD
     659             :     1090671745U,        // AESE
     660             :     1107448934U,        // AESIMC
     661             :     1107448944U,        // AESMC
     662             :     6562U,      // ANDri
     663             :     6562U,      // ANDrr
     664             :     10658U,     // ANDrsi
     665             :     14754U,     // ANDrsr
     666             :     269427U,    // ASRi
     667             :     269427U,    // ASRr
     668             :     0U, // B
     669             :     0U, // BCCZi64
     670             :     0U, // BCCi64
     671             :     26936U,     // BFC
     672             :     31378U,     // BFI
     673             :     6461U,      // BICri
     674             :     6461U,      // BICrr
     675             :     10557U,     // BICrsi
     676             :     14653U,     // BICrsr
     677             :     415024U,    // BKPT
     678             :     414996U,    // BL
     679             :     415071U,    // BLX
     680             :     1073778331U,        // BLX_pred
     681             :     415071U,    // BLXi
     682             :     1073777379U,        // BL_pred
     683             :     0U, // BMOVPCB_CALL
     684             :     0U, // BMOVPCRX_CALL
     685             :     0U, // BR_JTadd
     686             :     0U, // BR_JTm_i12
     687             :     0U, // BR_JTm_rs
     688             :     0U, // BR_JTr
     689             :     415067U,    // BX
     690             :     1073777316U,        // BXJ
     691             :     0U, // BX_CALL
     692             :     564791U,    // BX_RET
     693             :     1073778231U,        // BX_pred
     694             :     1073776715U,        // Bcc
     695             :     2197859344U,        // CDP
     696             :     67809709U,  // CDP2
     697             :     3717U,      // CLREX
     698             :     20167U,     // CLZ
     699             :     19382U,     // CMNri
     700             :     19382U,     // CMNzrr
     701             :     27574U,     // CMNzrsi
     702             :     31670U,     // CMNzrsr
     703             :     0U, // CMP_SWAP_16
     704             :     0U, // CMP_SWAP_32
     705             :     0U, // CMP_SWAP_64
     706             :     0U, // CMP_SWAP_8
     707             :     19482U,     // CMPri
     708             :     19482U,     // CMPrr
     709             :     27674U,     // CMPrsi
     710             :     31770U,     // CMPrsr
     711             :     0U, // CONSTPOOL_ENTRY
     712             :     0U, // COPY_STRUCT_BYVAL_I32
     713             :     415008U,    // CPS1p
     714             :     1157680340U,        // CPS2p
     715             :     83938516U,  // CPS3p
     716             :     33707179U,  // CRC32B
     717             :     33707187U,  // CRC32CB
     718             :     33707256U,  // CRC32CH
     719             :     33707340U,  // CRC32CW
     720             :     33707248U,  // CRC32H
     721             :     33707332U,  // CRC32W
     722             :     1996U,      // CompilerBarrier
     723             :     1073777154U,        // DBG
     724             :     54474U,     // DMB
     725             :     54479U,     // DSB
     726             :     7265U,      // EORri
     727             :     7265U,      // EORrr
     728             :     11361U,     // EORrsi
     729             :     15457U,     // EORrsr
     730             :     433458U,    // ERET
     731             :     3322695136U,        // FCONSTD
     732             :     3322826208U,        // FCONSTH
     733             :     3322957280U,        // FCONSTS
     734             :     33574450U,  // FLDMXDB_UPD
     735             :     36347U,     // FLDMXIA
     736             :     33574395U,  // FLDMXIA_UPD
     737             :     1219800U,   // FMSTAT
     738             :     33574458U,  // FSTMXDB_UPD
     739             :     36355U,     // FSTMXIA
     740             :     33574403U,  // FSTMXIA_UPD
     741             :     1073778025U,        // HINT
     742             :     415019U,    // HLT
     743             :     414937U,    // HVC
     744             :     58580U,     // ISB
     745             :     117767511U, // ITasm
     746             :     0U, // Int_eh_sjlj_dispatchsetup
     747             :     0U, // Int_eh_sjlj_longjmp
     748             :     0U, // Int_eh_sjlj_setjmp
     749             :     0U, // Int_eh_sjlj_setjmp_nofp
     750             :     0U, // Int_eh_sjlj_setup_dispatch
     751             :     0U, // JUMPTABLE_ADDRS
     752             :     0U, // JUMPTABLE_INSTS
     753             :     0U, // JUMPTABLE_TBB
     754             :     0U, // JUMPTABLE_TBH
     755             :     18419U,     // LDA
     756             :     18504U,     // LDAB
     757             :     20083U,     // LDAEX
     758             :     18704U,     // LDAEXB
     759             :     134236604U, // LDAEXD
     760             :     19062U,     // LDAEXH
     761             :     18964U,     // LDAH
     762             :     152352006U, // LDC2L_OFFSET
     763             :     1242871046U,        // LDC2L_OPTION
     764             :     2316612870U,        // LDC2L_POST
     765             :     185906438U, // LDC2L_PRE
     766             :     152351124U, // LDC2_OFFSET
     767             :     1242870164U,        // LDC2_OPTION
     768             :     2316611988U,        // LDC2_POST
     769             :     185905556U, // LDC2_PRE
     770             :     3271588588U,        // LDCL_OFFSET
     771             :     3271588588U,        // LDCL_OPTION
     772             :     3271588588U,        // LDCL_POST
     773             :     3271588588U,        // LDCL_PRE
     774             :     3271588148U,        // LDC_OFFSET
     775             :     3271588148U,        // LDC_OPTION
     776             :     3271588148U,        // LDC_POST
     777             :     3271588148U,        // LDC_PRE
     778             :     34807U,     // LDMDA
     779             :     33572855U,  // LDMDA_UPD
     780             :     34938U,     // LDMDB
     781             :     33572986U,  // LDMDB_UPD
     782             :     35715U,     // LDMIA
     783             :     0U, // LDMIA_RET
     784             :     33573763U,  // LDMIA_UPD
     785             :     34957U,     // LDMIB
     786             :     33573005U,  // LDMIB_UPD
     787             :     281887U,    // LDRBT_POST
     788             :     68895U,     // LDRBT_POST_IMM
     789             :     68895U,     // LDRBT_POST_REG
     790             :     67751U,     // LDRB_POST_IMM
     791             :     67751U,     // LDRB_POST_REG
     792             :     30887U,     // LDRB_PRE_IMM
     793             :     67751U,     // LDRB_PRE_REG
     794             :     26791U,     // LDRBi12
     795             :     30887U,     // LDRBrs
     796             :     281674U,    // LDRConstPool
     797             :     68006U,     // LDRD
     798             :     43430U,     // LDRD_POST
     799             :     43430U,     // LDRD_PRE
     800             :     20095U,     // LDREX
     801             :     18718U,     // LDREXB
     802             :     134236618U, // LDREXD
     803             :     19076U,     // LDREXH
     804             :     31304U,     // LDRH
     805             :     32066U,     // LDRHTi
     806             :     68930U,     // LDRHTr
     807             :     68168U,     // LDRH_POST
     808             :     68168U,     // LDRH_PRE
     809             :     0U, // LDRLIT_ga_abs
     810             :     0U, // LDRLIT_ga_pcrel
     811             :     0U, // LDRLIT_ga_pcrel_ldr
     812             :     30905U,     // LDRSB
     813             :     32043U,     // LDRSBTi
     814             :     68907U,     // LDRSBTr
     815             :     67769U,     // LDRSB_POST
     816             :     67769U,     // LDRSB_PRE
     817             :     31323U,     // LDRSH
     818             :     32078U,     // LDRSHTi
     819             :     68942U,     // LDRSHTr
     820             :     68187U,     // LDRSH_POST
     821             :     68187U,     // LDRSH_PRE
     822             :     281966U,    // LDRT_POST
     823             :     68974U,     // LDRT_POST_IMM
     824             :     68974U,     // LDRT_POST_REG
     825             :     68682U,     // LDR_POST_IMM
     826             :     68682U,     // LDR_POST_REG
     827             :     31818U,     // LDR_PRE_IMM
     828             :     68682U,     // LDR_PRE_REG
     829             :     27722U,     // LDRcp
     830             :     27722U,     // LDRi12
     831             :     31818U,     // LDRrs
     832             :     0U, // LEApcrel
     833             :     0U, // LEApcrelJT
     834             :     269148U,    // LSLi
     835             :     269148U,    // LSLr
     836             :     269434U,    // LSRi
     837             :     269434U,    // LSRr
     838             :     2197859393U,        // MCR
     839             :     17478067U,  // MCR2
     840             :     2197884009U,        // MCRR
     841             :     17478073U,  // MCRR2
     842             :     0U, // MEMCPY
     843             :     10271U,     // MLA
     844             :     0U, // MLAv5
     845             :     31916U,     // MLS
     846             :     0U, // MOVCCi
     847             :     0U, // MOVCCi16
     848             :     0U, // MOVCCi32imm
     849             :     0U, // MOVCCr
     850             :     0U, // MOVCCsi
     851             :     0U, // MOVCCsr
     852             :     1482209U,   // MOVPCLR
     853             :     0U, // MOVPCRX
     854             :     28078U,     // MOVTi16
     855             :     0U, // MOVTi16_ga_pcrel
     856             :     0U, // MOV_ga_pcrel
     857             :     0U, // MOV_ga_pcrel_ldr
     858             :     73185U,     // MOVi
     859             :     19958U,     // MOVi16
     860             :     0U, // MOVi16_ga_pcrel
     861             :     0U, // MOVi32imm
     862             :     73185U,     // MOVr
     863             :     73185U,     // MOVr_TC
     864             :     7649U,      // MOVsi
     865             :     11745U,     // MOVsr
     866             :     0U, // MOVsra_flag
     867             :     0U, // MOVsrl_flag
     868             :     201369925U, // MRC
     869             :     74138U,     // MRC2
     870             :     218171721U, // MRRC
     871             :     78240U,     // MRRC2
     872             :     36057U,     // MRS
     873             :     19673U,     // MRSbanked
     874             :     1073777881U,        // MRSsys
     875             :     2382384255U,        // MSR
     876             :     251677823U, // MSRbanked
     877             :     2382384255U,        // MSRi
     878             :     7020U,      // MUL
     879             :     0U, // MULv5
     880             :     0U, // MVNCCi
     881             :     72698U,     // MVNi
     882             :     72698U,     // MVNr
     883             :     7162U,      // MVNsi
     884             :     11258U,     // MVNsr
     885             :     7279U,      // ORRri
     886             :     7279U,      // ORRrr
     887             :     11375U,     // ORRrsi
     888             :     15471U,     // ORRrsr
     889             :     0U, // PICADD
     890             :     0U, // PICLDR
     891             :     0U, // PICLDRB
     892             :     0U, // PICLDRH
     893             :     0U, // PICLDRSB
     894             :     0U, // PICLDRSH
     895             :     0U, // PICSTR
     896             :     0U, // PICSTRB
     897             :     0U, // PICSTRH
     898             :     32010U,     // PKHBT
     899             :     30918U,     // PKHTB
     900             :     83285U,     // PLDWi12
     901             :     87381U,     // PLDWrs
     902             :     83166U,     // PLDi12
     903             :     87262U,     // PLDrs
     904             :     83201U,     // PLIi12
     905             :     87297U,     // PLIrs
     906             :     27013U,     // QADD
     907             :     26411U,     // QADD16
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     909             :     28336U,     // QASX
     910             :     26987U,     // QDADD
     911             :     26859U,     // QDSUB
     912             :     28195U,     // QSAX
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     915             :     26475U,     // QSUB8
     916             :     19797U,     // RBIT
     917             :     19917U,     // REV
     918             :     18255U,     // REV16
     919             :     19046U,     // REVSH
     920             :     414877U,    // RFEDA
     921             :     1594525U,   // RFEDA_UPD
     922             :     414908U,    // RFEDB
     923             :     1594556U,   // RFEDB_UPD
     924             :     414884U,    // RFEIA
     925             :     1594532U,   // RFEIA_UPD
     926             :     414915U,    // RFEIB
     927             :     1594563U,   // RFEIB_UPD
     928             :     269413U,    // RORi
     929             :     269413U,    // RORr
     930             :     0U, // RRX
     931             :     335519U,    // RRXi
     932             :     0U, // RSBSri
     933             :     0U, // RSBSrsi
     934             :     0U, // RSBSrsr
     935             :     6331U,      // RSBri
     936             :     6331U,      // RSBrr
     937             :     10427U,     // RSBrsi
     938             :     14523U,     // RSBrsr
     939             :     6478U,      // RSCri
     940             :     6478U,      // RSCrr
     941             :     10574U,     // RSCrsi
     942             :     14670U,     // RSCrsr
     943             :     26418U,     // SADD16
     944             :     26520U,     // SADD8
     945             :     28341U,     // SASX
     946             :     6444U,      // SBCri
     947             :     6444U,      // SBCrr
     948             :     10540U,     // SBCrsi
     949             :     14636U,     // SBCrsr
     950             :     32401U,     // SBFX
     951             :     28113U,     // SDIV
     952             :     27401U,     // SEL
     953             :     91363U,     // SETEND
     954             :     415000U,    // SETPAN
     955             :     16928834U,  // SHA1C
     956             :     1107447884U,        // SHA1H
     957             :     16928866U,  // SHA1M
     958             :     16928876U,  // SHA1P
     959             :     16928769U,  // SHA1SU0
     960             :     1090670619U,        // SHA1SU1
     961             :     16928854U,  // SHA256H
     962             :     16928821U,  // SHA256H2
     963             :     1090670605U,        // SHA256SU0
     964             :     16928807U,  // SHA256SU1
     965             :     26394U,     // SHADD16
     966             :     26499U,     // SHADD8
     967             :     28323U,     // SHASX
     968             :     28182U,     // SHSAX
     969             :     26356U,     // SHSUB16
     970             :     26460U,     // SHSUB8
     971             :     1073776961U,        // SMC
     972             :     30809U,     // SMLABB
     973             :     32003U,     // SMLABT
     974             :     31066U,     // SMLAD
     975             :     32327U,     // SMLADX
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     982             :     44426U,     // SMLALTT
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     991             :     44637U,     // SMLSLDX
     992             :     30749U,     // SMMLA
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     998             :     26976U,     // SMUAD
     999             :     28238U,     // SMUADX
    1000             :     26728U,     // SMULBB
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    1003             :     0U, // SMULLv5
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    1005             :     28050U,     // SMULTT
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    1007             :     28090U,     // SMULWT
    1008             :     27062U,     // SMUSD
    1009             :     28268U,     // SMUSDX
    1010             :     0U, // SPACE
    1011             :     415135U,    // SRSDA
    1012             :     415087U,    // SRSDA_UPD
    1013             :     415157U,    // SRSDB
    1014             :     415111U,    // SRSDB_UPD
    1015             :     415146U,    // SRSIA
    1016             :     415099U,    // SRSIA_UPD
    1017             :     415168U,    // SRSIB
    1018             :     415123U,    // SRSIB_UPD
    1019             :     31988U,     // SSAT
    1020             :     26432U,     // SSAT16
    1021             :     28200U,     // SSAX
    1022             :     26380U,     // SSUB16
    1023             :     26481U,     // SSUB8
    1024             :     152352013U, // STC2L_OFFSET
    1025             :     1242871053U,        // STC2L_OPTION
    1026             :     2316612877U,        // STC2L_POST
    1027             :     185906445U, // STC2L_PRE
    1028             :     152351143U, // STC2_OFFSET
    1029             :     1242870183U,        // STC2_OPTION
    1030             :     2316612007U,        // STC2_POST
    1031             :     185905575U, // STC2_PRE
    1032             :     3271588593U,        // STCL_OFFSET
    1033             :     3271588593U,        // STCL_OPTION
    1034             :     3271588593U,        // STCL_POST
    1035             :     3271588593U,        // STCL_PRE
    1036             :     3271588178U,        // STC_OFFSET
    1037             :     3271588178U,        // STC_OPTION
    1038             :     3271588178U,        // STC_POST
    1039             :     3271588178U,        // STC_PRE
    1040             :     19302U,     // STL
    1041             :     18585U,     // STLB
    1042             :     28281U,     // STLEX
    1043             :     26903U,     // STLEXB
    1044             :     27075U,     // STLEXD
    1045             :     27261U,     // STLEXH
    1046             :     18994U,     // STLH
    1047             :     34813U,     // STMDA
    1048             :     33572861U,  // STMDA_UPD
    1049             :     34945U,     // STMDB
    1050             :     33572993U,  // STMDB_UPD
    1051             :     35721U,     // STMIA
    1052             :     33573769U,  // STMIA_UPD
    1053             :     34963U,     // STMIB
    1054             :     33573011U,  // STMIB_UPD
    1055             :     281893U,    // STRBT_POST
    1056             :     33623333U,  // STRBT_POST_IMM
    1057             :     33623333U,  // STRBT_POST_REG
    1058             :     33622188U,  // STRB_POST_IMM
    1059             :     33622188U,  // STRB_POST_REG
    1060             :     33585324U,  // STRB_PRE_IMM
    1061             :     33622188U,  // STRB_PRE_REG
    1062             :     26796U,     // STRBi12
    1063             :     0U, // STRBi_preidx
    1064             :     0U, // STRBr_preidx
    1065             :     30892U,     // STRBrs
    1066             :     68011U,     // STRD
    1067             :     33597867U,  // STRD_POST
    1068             :     33597867U,  // STRD_PRE
    1069             :     28299U,     // STREX
    1070             :     26917U,     // STREXB
    1071             :     27089U,     // STREXD
    1072             :     27275U,     // STREXH
    1073             :     31309U,     // STRH
    1074             :     33586504U,  // STRHTi
    1075             :     33623368U,  // STRHTr
    1076             :     33622605U,  // STRH_POST
    1077             :     33622605U,  // STRH_PRE
    1078             :     0U, // STRH_preidx
    1079             :     281977U,    // STRT_POST
    1080             :     33623417U,  // STRT_POST_IMM
    1081             :     33623417U,  // STRT_POST_REG
    1082             :     33623179U,  // STR_POST_IMM
    1083             :     33623179U,  // STR_POST_REG
    1084             :     33586315U,  // STR_PRE_IMM
    1085             :     33623179U,  // STR_PRE_REG
    1086             :     27787U,     // STRi12
    1087             :     0U, // STRi_preidx
    1088             :     0U, // STRr_preidx
    1089             :     31883U,     // STRrs
    1090             :     0U, // SUBS_PC_LR
    1091             :     0U, // SUBSri
    1092             :     0U, // SUBSrr
    1093             :     0U, // SUBSrsi
    1094             :     0U, // SUBSrsr
    1095             :     6381U,      // SUBri
    1096             :     6381U,      // SUBrr
    1097             :     10477U,     // SUBrsi
    1098             :     14573U,     // SUBrsr
    1099             :     1073776982U,        // SVC
    1100             :     27688U,     // SWP
    1101             :     26786U,     // SWPB
    1102             :     30797U,     // SXTAB
    1103             :     30422U,     // SXTAB16
    1104             :     31266U,     // SXTAH
    1105             :     26849U,     // SXTB
    1106             :     26342U,     // SXTB16
    1107             :     27244U,     // SXTH
    1108             :     0U, // TAILJMPd
    1109             :     0U, // TAILJMPr
    1110             :     0U, // TAILJMPr4
    1111             :     0U, // TCRETURNdi
    1112             :     0U, // TCRETURNri
    1113             :     19510U,     // TEQri
    1114             :     19510U,     // TEQrr
    1115             :     27702U,     // TEQrsi
    1116             :     31798U,     // TEQrsr
    1117             :     0U, // TPsoft
    1118             :     3083U,      // TRAP
    1119             :     3083U,      // TRAPNaCl
    1120             :     19839U,     // TSTri
    1121             :     19839U,     // TSTrr
    1122             :     28031U,     // TSTrsi
    1123             :     32127U,     // TSTrsr
    1124             :     26425U,     // UADD16
    1125             :     26526U,     // UADD8
    1126             :     28346U,     // UASX
    1127             :     32406U,     // UBFX
    1128             :     414955U,    // UDF
    1129             :     28118U,     // UDIV
    1130             :     26402U,     // UHADD16
    1131             :     26506U,     // UHADD8
    1132             :     28329U,     // UHASX
    1133             :     28188U,     // UHSAX
    1134             :     26364U,     // UHSUB16
    1135             :     26467U,     // UHSUB8
    1136             :     43700U,     // UMAAL
    1137             :     96981U,     // UMLAL
    1138             :     0U, // UMLALv5
    1139             :     11079U,     // UMULL
    1140             :     0U, // UMULLv5
    1141             :     26410U,     // UQADD16
    1142             :     26513U,     // UQADD8
    1143             :     28335U,     // UQASX
    1144             :     28194U,     // UQSAX
    1145             :     26372U,     // UQSUB16
    1146             :     26474U,     // UQSUB8
    1147             :     26493U,     // USAD8
    1148             :     30549U,     // USADA8
    1149             :     31993U,     // USAT
    1150             :     26439U,     // USAT16
    1151             :     28205U,     // USAX
    1152             :     26387U,     // USUB16
    1153             :     26487U,     // USUB8
    1154             :     30803U,     // UXTAB
    1155             :     30430U,     // UXTAB16
    1156             :     31272U,     // UXTAH
    1157             :     26854U,     // UXTB
    1158             :     26349U,     // UXTB16
    1159             :     27249U,     // UXTH
    1160             :     18512570U,  // VABALsv2i64
    1161             :     18643642U,  // VABALsv4i32
    1162             :     18774714U,  // VABALsv8i16
    1163             :     18905786U,  // VABALuv2i64
    1164             :     19036858U,  // VABALuv4i32
    1165             :     19167930U,  // VABALuv8i16
    1166             :     18773998U,  // VABAsv16i8
    1167             :     18511854U,  // VABAsv2i32
    1168             :     18642926U,  // VABAsv4i16
    1169             :     18511854U,  // VABAsv4i32
    1170             :     18642926U,  // VABAsv8i16
    1171             :     18773998U,  // VABAsv8i8
    1172             :     19167214U,  // VABAuv16i8
    1173             :     18905070U,  // VABAuv2i32
    1174             :     19036142U,  // VABAuv4i16
    1175             :     18905070U,  // VABAuv4i32
    1176             :     19036142U,  // VABAuv8i16
    1177             :     19167214U,  // VABAuv8i8
    1178             :     35285750U,  // VABDLsv2i64
    1179             :     35416822U,  // VABDLsv4i32
    1180             :     35547894U,  // VABDLsv8i16
    1181             :     35678966U,  // VABDLuv2i64
    1182             :     35810038U,  // VABDLuv4i32
    1183             :     35941110U,  // VABDLuv8i16
    1184             :     2249222502U,        // VABDfd
    1185             :     2249222502U,        // VABDfq
    1186             :     2249091430U,        // VABDhd
    1187             :     2249091430U,        // VABDhq
    1188             :     35547494U,  // VABDsv16i8
    1189             :     35285350U,  // VABDsv2i32
    1190             :     35416422U,  // VABDsv4i16
    1191             :     35285350U,  // VABDsv4i32
    1192             :     35416422U,  // VABDsv8i16
    1193             :     35547494U,  // VABDsv8i8
    1194             :     35940710U,  // VABDuv16i8
    1195             :     35678566U,  // VABDuv2i32
    1196             :     35809638U,  // VABDuv4i16
    1197             :     35678566U,  // VABDuv4i32
    1198             :     35809638U,  // VABDuv8i16
    1199             :     35940710U,  // VABDuv8i8
    1200             :     2248952987U,        // VABSD
    1201             :     2249084059U,        // VABSH
    1202             :     2249215131U,        // VABSS
    1203             :     2249215131U,        // VABSfd
    1204             :     2249215131U,        // VABSfq
    1205             :     2249084059U,        // VABShd
    1206             :     2249084059U,        // VABShq
    1207             :     1109281947U,        // VABSv16i8
    1208             :     1109019803U,        // VABSv2i32
    1209             :     1109150875U,        // VABSv4i16
    1210             :     1109019803U,        // VABSv4i32
    1211             :     1109150875U,        // VABSv8i16
    1212             :     1109281947U,        // VABSv8i8
    1213             :     2249222616U,        // VACGEfd
    1214             :     2249222616U,        // VACGEfq
    1215             :     2249091544U,        // VACGEhd
    1216             :     2249091544U,        // VACGEhq
    1217             :     2249223479U,        // VACGTfd
    1218             :     2249223479U,        // VACGTfq
    1219             :     2249092407U,        // VACGThd
    1220             :     2249092407U,        // VACGThq
    1221             :     2248960394U,        // VADDD
    1222             :     2249091466U,        // VADDH
    1223             :     36072356U,  // VADDHNv2i32
    1224             :     36203428U,  // VADDHNv4i16
    1225             :     36334500U,  // VADDHNv8i8
    1226             :     35285763U,  // VADDLsv2i64
    1227             :     35416835U,  // VADDLsv4i32
    1228             :     35547907U,  // VADDLsv8i16
    1229             :     35678979U,  // VADDLuv2i64
    1230             :     35810051U,  // VADDLuv4i32
    1231             :     35941123U,  // VADDLuv8i16
    1232             :     2249222538U,        // VADDS
    1233             :     35286507U,  // VADDWsv2i64
    1234             :     35417579U,  // VADDWsv4i32
    1235             :     35548651U,  // VADDWsv8i16
    1236             :     35679723U,  // VADDWuv2i64
    1237             :     35810795U,  // VADDWuv4i32
    1238             :     35941867U,  // VADDWuv8i16
    1239             :     2249222538U,        // VADDfd
    1240             :     2249222538U,        // VADDfq
    1241             :     2249091466U,        // VADDhd
    1242             :     2249091466U,        // VADDhq
    1243             :     36465034U,  // VADDv16i8
    1244             :     36071818U,  // VADDv1i64
    1245             :     36202890U,  // VADDv2i32
    1246             :     36071818U,  // VADDv2i64
    1247             :     36333962U,  // VADDv4i16
    1248             :     36202890U,  // VADDv4i32
    1249             :     36333962U,  // VADDv8i16
    1250             :     36465034U,  // VADDv8i8
    1251             :     27041U,     // VANDd
    1252             :     27041U,     // VANDq
    1253             :     26940U,     // VBICd
    1254             :     271083836U, // VBICiv2i32
    1255             :     271214908U, // VBICiv4i16
    1256             :     271083836U, // VBICiv4i32
    1257             :     271214908U, // VBICiv8i16
    1258             :     26940U,     // VBICq
    1259             :     31229U,     // VBIFd
    1260             :     31229U,     // VBIFq
    1261             :     32090U,     // VBITd
    1262             :     32090U,     // VBITq
    1263             :     31571U,     // VBSLd
    1264             :     31571U,     // VBSLq
    1265             :     33706245U,  // VCADDv2f32
    1266             :     33706946U,  // VCADDv4f16
    1267             :     33706245U,  // VCADDv4f32
    1268             :     33706946U,  // VCADDv8f16
    1269             :     2249223217U,        // VCEQfd
    1270             :     2249223217U,        // VCEQfq
    1271             :     2249092145U,        // VCEQhd
    1272             :     2249092145U,        // VCEQhq
    1273             :     36465713U,  // VCEQv16i8
    1274             :     36203569U,  // VCEQv2i32
    1275             :     36334641U,  // VCEQv4i16
    1276             :     36203569U,  // VCEQv4i32
    1277             :     36334641U,  // VCEQv8i16
    1278             :     36465713U,  // VCEQv8i8
    1279             :     3257682993U,        // VCEQzv16i8
    1280             :     2249215025U,        // VCEQzv2f32
    1281             :     3257420849U,        // VCEQzv2i32
    1282             :     2249083953U,        // VCEQzv4f16
    1283             :     2249215025U,        // VCEQzv4f32
    1284             :     3257551921U,        // VCEQzv4i16
    1285             :     3257420849U,        // VCEQzv4i32
    1286             :     2249083953U,        // VCEQzv8f16
    1287             :     3257551921U,        // VCEQzv8i16
    1288             :     3257682993U,        // VCEQzv8i8
    1289             :     2249222622U,        // VCGEfd
    1290             :     2249222622U,        // VCGEfq
    1291             :     2249091550U,        // VCGEhd
    1292             :     2249091550U,        // VCGEhq
    1293             :     35547614U,  // VCGEsv16i8
    1294             :     35285470U,  // VCGEsv2i32
    1295             :     35416542U,  // VCGEsv4i16
    1296             :     35285470U,  // VCGEsv4i32
    1297             :     35416542U,  // VCGEsv8i16
    1298             :     35547614U,  // VCGEsv8i8
    1299             :     35940830U,  // VCGEuv16i8
    1300             :     35678686U,  // VCGEuv2i32
    1301             :     35809758U,  // VCGEuv4i16
    1302             :     35678686U,  // VCGEuv4i32
    1303             :     35809758U,  // VCGEuv8i16
    1304             :     35940830U,  // VCGEuv8i8
    1305             :     3256764894U,        // VCGEzv16i8
    1306             :     2249214430U,        // VCGEzv2f32
    1307             :     3256502750U,        // VCGEzv2i32
    1308             :     2249083358U,        // VCGEzv4f16
    1309             :     2249214430U,        // VCGEzv4f32
    1310             :     3256633822U,        // VCGEzv4i16
    1311             :     3256502750U,        // VCGEzv4i32
    1312             :     2249083358U,        // VCGEzv8f16
    1313             :     3256633822U,        // VCGEzv8i16
    1314             :     3256764894U,        // VCGEzv8i8
    1315             :     2249223485U,        // VCGTfd
    1316             :     2249223485U,        // VCGTfq
    1317             :     2249092413U,        // VCGThd
    1318             :     2249092413U,        // VCGThq
    1319             :     35548477U,  // VCGTsv16i8
    1320             :     35286333U,  // VCGTsv2i32
    1321             :     35417405U,  // VCGTsv4i16
    1322             :     35286333U,  // VCGTsv4i32
    1323             :     35417405U,  // VCGTsv8i16
    1324             :     35548477U,  // VCGTsv8i8
    1325             :     35941693U,  // VCGTuv16i8
    1326             :     35679549U,  // VCGTuv2i32
    1327             :     35810621U,  // VCGTuv4i16
    1328             :     35679549U,  // VCGTuv4i32
    1329             :     35810621U,  // VCGTuv8i16
    1330             :     35941693U,  // VCGTuv8i8
    1331             :     3256765757U,        // VCGTzv16i8
    1332             :     2249215293U,        // VCGTzv2f32
    1333             :     3256503613U,        // VCGTzv2i32
    1334             :     2249084221U,        // VCGTzv4f16
    1335             :     2249215293U,        // VCGTzv4f32
    1336             :     3256634685U,        // VCGTzv4i16
    1337             :     3256503613U,        // VCGTzv4i32
    1338             :     2249084221U,        // VCGTzv8f16
    1339             :     3256634685U,        // VCGTzv8i16
    1340             :     3256765757U,        // VCGTzv8i8
    1341             :     3256764899U,        // VCLEzv16i8
    1342             :     2249214435U,        // VCLEzv2f32
    1343             :     3256502755U,        // VCLEzv2i32
    1344             :     2249083363U,        // VCLEzv4f16
    1345             :     2249214435U,        // VCLEzv4f32
    1346             :     3256633827U,        // VCLEzv4i16
    1347             :     3256502755U,        // VCLEzv4i32
    1348             :     2249083363U,        // VCLEzv8f16
    1349             :     3256633827U,        // VCLEzv8i16
    1350             :     3256764899U,        // VCLEzv8i8
    1351             :     1109281957U,        // VCLSv16i8
    1352             :     1109019813U,        // VCLSv2i32
    1353             :     1109150885U,        // VCLSv4i16
    1354             :     1109019813U,        // VCLSv4i32
    1355             :     1109150885U,        // VCLSv8i16
    1356             :     1109281957U,        // VCLSv8i8
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    1522             :     101742638U, // VFMAfd
    1523             :     101742638U, // VFMAfq
    1524             :     101611566U, // VFMAhd
    1525             :     101611566U, // VFMAhq
    1526             :     101481659U, // VFMSD
    1527             :     101612731U, // VFMSH
    1528             :     101743803U, // VFMSS
    1529             :     101743803U, // VFMSfd
    1530             :     101743803U, // VFMSfq
    1531             :     101612731U, // VFMShd
    1532             :     101612731U, // VFMShq
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    1534             :     101611571U, // VFNMAH
    1535             :     101742643U, // VFNMAS
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    1538             :     101743808U, // VFNMSS
    1539             :     5139936U,   // VGETLNi32
    1540             :     1109159392U,        // VGETLNs16
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    1543             :     1109683680U,        // VGETLNu8
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    1585             :     2486068841U,        // VLD1DUPq8
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    1600             :     5047913U,   // VLD1LNdWB_register_Asm_16
    1601             :     5178985U,   // VLD1LNdWB_register_Asm_32
    1602             :     3081833U,   // VLD1LNdWB_register_Asm_8
    1603             :     0U, // VLD1LNq16Pseudo
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    1608             :     0U, // VLD1LNq8Pseudo_UPD
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    1627             :     2505074281U,        // VLD1d64
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    1787             :     472807093U, // VLD3DUPqWB_register_Asm_8
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    1807             :     5179061U,   // VLD3LNdWB_register_Asm_32
    1808             :     3081909U,   // VLD3LNdWB_register_Asm_8
    1809             :     5609141U,   // VLD3LNq16
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    1812             :     5613237U,   // VLD3LNq16_UPD
    1813             :     5740213U,   // VLD3LNq32
    1814             :     0U, // VLD3LNq32Pseudo
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    1817             :     5011125U,   // VLD3LNqAsm_16
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    1820             :     5142197U,   // VLD3LNqWB_fixed_Asm_32
    1821             :     5047989U,   // VLD3LNqWB_register_Asm_16
    1822             :     5179061U,   // VLD3LNqWB_register_Asm_32
    1823             :     5572277U,   // VLD3d16
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    1830             :     5736117U,   // VLD3d32_UPD
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    1834             :     5867189U,   // VLD3d8_UPD
    1835             :     2538366645U,        // VLD3dAsm_16
    1836             :     2538497717U,        // VLD3dAsm_32
    1837             :     2536400565U,        // VLD3dAsm_8
    1838             :     2538366645U,        // VLD3dWB_fixed_Asm_16
    1839             :     2538497717U,        // VLD3dWB_fixed_Asm_32
    1840             :     2536400565U,        // VLD3dWB_fixed_Asm_8
    1841             :     2538370741U,        // VLD3dWB_register_Asm_16
    1842             :     2538501813U,        // VLD3dWB_register_Asm_32
    1843             :     2536404661U,        // VLD3dWB_register_Asm_8
    1844             :     5572277U,   // VLD3q16
    1845             :     0U, // VLD3q16Pseudo_UPD
    1846             :     5605045U,   // VLD3q16_UPD
    1847             :     0U, // VLD3q16oddPseudo
    1848             :     0U, // VLD3q16oddPseudo_UPD
    1849             :     5703349U,   // VLD3q32
    1850             :     0U, // VLD3q32Pseudo_UPD
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    1852             :     0U, // VLD3q32oddPseudo
    1853             :     0U, // VLD3q32oddPseudo_UPD
    1854             :     5834421U,   // VLD3q8
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    1856             :     5867189U,   // VLD3q8_UPD
    1857             :     0U, // VLD3q8oddPseudo
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    1865             :     491550389U, // VLD3qWB_register_Asm_16
    1866             :     491681461U, // VLD3qWB_register_Asm_32
    1867             :     489584309U, // VLD3qWB_register_Asm_8
    1868             :     1079289548U,        // VLD4DUPd16
    1869             :     0U, // VLD4DUPd16Pseudo
    1870             :     0U, // VLD4DUPd16Pseudo_UPD
    1871             :     1079359180U,        // VLD4DUPd16_UPD
    1872             :     1079420620U,        // VLD4DUPd32
    1873             :     0U, // VLD4DUPd32Pseudo
    1874             :     0U, // VLD4DUPd32Pseudo_UPD
    1875             :     1079490252U,        // VLD4DUPd32_UPD
    1876             :     1079551692U,        // VLD4DUPd8
    1877             :     0U, // VLD4DUPd8Pseudo
    1878             :     0U, // VLD4DUPd8Pseudo_UPD
    1879             :     1079621324U,        // VLD4DUPd8_UPD
    1880             :     1582065356U,        // VLD4DUPdAsm_16
    1881             :     1582196428U,        // VLD4DUPdAsm_32
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    1883             :     2655807180U,        // VLD4DUPdWB_fixed_Asm_16
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    1885             :     2653841100U,        // VLD4DUPdWB_fixed_Asm_8
    1886             :     508327628U, // VLD4DUPdWB_register_Asm_16
    1887             :     508458700U, // VLD4DUPdWB_register_Asm_32
    1888             :     506361548U, // VLD4DUPdWB_register_Asm_8
    1889             :     1079289548U,        // VLD4DUPq16
    1890             :     1079359180U,        // VLD4DUPq16_UPD
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    1892             :     1079490252U,        // VLD4DUPq32_UPD
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    1894             :     1079621324U,        // VLD4DUPq8_UPD
    1895             :     1598842572U,        // VLD4DUPqAsm_16
    1896             :     1598973644U,        // VLD4DUPqAsm_32
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    1899             :     2672715468U,        // VLD4DUPqWB_fixed_Asm_32
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    1901             :     525104844U, // VLD4DUPqWB_register_Asm_16
    1902             :     525235916U, // VLD4DUPqWB_register_Asm_32
    1903             :     523138764U, // VLD4DUPqWB_register_Asm_8
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    1906             :     0U, // VLD4LNd16Pseudo_UPD
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    1910             :     0U, // VLD4LNd32Pseudo_UPD
    1911             :     5752524U,   // VLD4LNd32_UPD
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    1915             :     5883596U,   // VLD4LNd8_UPD
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    1921             :     3045068U,   // VLD4LNdWB_fixed_Asm_8
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    1923             :     5179084U,   // VLD4LNdWB_register_Asm_32
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    1926             :     0U, // VLD4LNq16Pseudo
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    1928             :     5621452U,   // VLD4LNq16_UPD
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    1935             :     5011148U,   // VLD4LNqWB_fixed_Asm_16
    1936             :     5142220U,   // VLD4LNqWB_fixed_Asm_32
    1937             :     5048012U,   // VLD4LNqWB_register_Asm_16
    1938             :     5179084U,   // VLD4LNqWB_register_Asm_32
    1939             :     5547724U,   // VLD4d16
    1940             :     0U, // VLD4d16Pseudo
    1941             :     0U, // VLD4d16Pseudo_UPD
    1942             :     5617356U,   // VLD4d16_UPD
    1943             :     5678796U,   // VLD4d32
    1944             :     0U, // VLD4d32Pseudo
    1945             :     0U, // VLD4d32Pseudo_UPD
    1946             :     5748428U,   // VLD4d32_UPD
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    1948             :     0U, // VLD4d8Pseudo
    1949             :     0U, // VLD4d8Pseudo_UPD
    1950             :     5879500U,   // VLD4d8_UPD
    1951             :     2521589452U,        // VLD4dAsm_16
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    1954             :     2521589452U,        // VLD4dWB_fixed_Asm_16
    1955             :     2521720524U,        // VLD4dWB_fixed_Asm_32
    1956             :     2519623372U,        // VLD4dWB_fixed_Asm_8
    1957             :     2521593548U,        // VLD4dWB_register_Asm_16
    1958             :     2521724620U,        // VLD4dWB_register_Asm_32
    1959             :     2519627468U,        // VLD4dWB_register_Asm_8
    1960             :     5547724U,   // VLD4q16
    1961             :     0U, // VLD4q16Pseudo_UPD
    1962             :     5617356U,   // VLD4q16_UPD
    1963             :     0U, // VLD4q16oddPseudo
    1964             :     0U, // VLD4q16oddPseudo_UPD
    1965             :     5678796U,   // VLD4q32
    1966             :     0U, // VLD4q32Pseudo_UPD
    1967             :     5748428U,   // VLD4q32_UPD
    1968             :     0U, // VLD4q32oddPseudo
    1969             :     0U, // VLD4q32oddPseudo_UPD
    1970             :     5809868U,   // VLD4q8
    1971             :     0U, // VLD4q8Pseudo_UPD
    1972             :     5879500U,   // VLD4q8_UPD
    1973             :     0U, // VLD4q8oddPseudo
    1974             :     0U, // VLD4q8oddPseudo_UPD
    1975             :     1615619788U,        // VLD4qAsm_16
    1976             :     1615750860U,        // VLD4qAsm_32
    1977             :     1613653708U,        // VLD4qAsm_8
    1978             :     2689361612U,        // VLD4qWB_fixed_Asm_16
    1979             :     2689492684U,        // VLD4qWB_fixed_Asm_32
    1980             :     2687395532U,        // VLD4qWB_fixed_Asm_8
    1981             :     541882060U, // VLD4qWB_register_Asm_16
    1982             :     542013132U, // VLD4qWB_register_Asm_32
    1983             :     539915980U, // VLD4qWB_register_Asm_8
    1984             :     33572985U,  // VLDMDDB_UPD
    1985             :     34825U,     // VLDMDIA
    1986             :     33572873U,  // VLDMDIA_UPD
    1987             :     0U, // VLDMQIA
    1988             :     33572985U,  // VLDMSDB_UPD
    1989             :     34825U,     // VLDMSIA
    1990             :     33572873U,  // VLDMSIA_UPD
    1991             :     27721U,     // VLDRD
    1992             :     5008457U,   // VLDRH
    1993             :     27721U,     // VLDRS
    1994             :     1073777537U,        // VLLDM
    1995             :     1073777543U,        // VLSTM
    1996             :     33706588U,  // VMAXNMD
    1997             :     33706981U,  // VMAXNMH
    1998             :     33706280U,  // VMAXNMNDf
    1999             :     33706981U,  // VMAXNMNDh
    2000             :     33706280U,  // VMAXNMNQf
    2001             :     33706981U,  // VMAXNMNQh
    2002             :     33706280U,  // VMAXNMS
    2003             :     2249223697U,        // VMAXfd
    2004             :     2249223697U,        // VMAXfq
    2005             :     2249092625U,        // VMAXhd
    2006             :     2249092625U,        // VMAXhq
    2007             :     35548689U,  // VMAXsv16i8
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    2035             :     35548081U,  // VMINsv8i8
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    2272             :     1109281941U,        // VQABSv8i8
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    2331             :     18643481U,  // VQRDMLAHv8i16
    2332             :     18549330U,  // VQRDMLSHslv2i32
    2333             :     18680402U,  // VQRDMLSHslv4i16
    2334             :     18549330U,  // VQRDMLSHslv4i32
    2335             :     18680402U,  // VQRDMLSHslv8i16
    2336             :     18512466U,  // VQRDMLSHv2i32
    2337             :     18643538U,  // VQRDMLSHv4i16
    2338             :     18512466U,  // VQRDMLSHv4i32
    2339             :     18643538U,  // VQRDMLSHv8i16
    2340             :     35289663U,  // VQRDMULHslv2i32
    2341             :     35420735U,  // VQRDMULHslv4i16
    2342             :     35289663U,  // VQRDMULHslv4i32
    2343             :     35420735U,  // VQRDMULHslv8i16
    2344             :     35285567U,  // VQRDMULHv2i32
    2345             :     35416639U,  // VQRDMULHv4i16
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    2347             :     35416639U,  // VQRDMULHv8i16
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    2360             :     35810067U,  // VQRSHLuv4i16
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    2461             :     5129925U,   // VREV64q32
    2462             :     3032773U,   // VREV64q8
    2463             :     35547505U,  // VRHADDsv16i8
    2464             :     35285361U,  // VRHADDsv2i32
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    2466             :     35285361U,  // VRHADDsv4i32
    2467             :     35416433U,  // VRHADDsv8i16
    2468             :     35547505U,  // VRHADDsv8i8
    2469             :     35940721U,  // VRHADDuv16i8
    2470             :     35678577U,  // VRHADDuv2i32
    2471             :     35809649U,  // VRHADDuv4i16
    2472             :     35678577U,  // VRHADDuv4i32
    2473             :     35809649U,  // VRHADDuv8i16
    2474             :     35940721U,  // VRHADDuv8i8
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    2480             :     1107448758U,        // VRINTANQh
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    2487             :     1107448817U,        // VRINTMNQh
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    2490             :     1107448829U,        // VRINTNH
    2491             :     1107448128U,        // VRINTNNDf
    2492             :     1107448829U,        // VRINTNNDh
    2493             :     1107448128U,        // VRINTNNQf
    2494             :     1107448829U,        // VRINTNNQh
    2495             :     1107448128U,        // VRINTNS
    2496             :     1107448448U,        // VRINTPD
    2497             :     1107448841U,        // VRINTPH
    2498             :     1107448140U,        // VRINTPNDf
    2499             :     1107448841U,        // VRINTPNDh
    2500             :     1107448140U,        // VRINTPNQf
    2501             :     1107448841U,        // VRINTPNQh
    2502             :     1107448140U,        // VRINTPS
    2503             :     2248952963U,        // VRINTRD
    2504             :     2249084035U,        // VRINTRH
    2505             :     2249215107U,        // VRINTRS
    2506             :     2248953535U,        // VRINTXD
    2507             :     2249084607U,        // VRINTXH
    2508             :     1107448188U,        // VRINTXNDf
    2509             :     1107448899U,        // VRINTXNDh
    2510             :     1107448188U,        // VRINTXNQf
    2511             :     1107448899U,        // VRINTXNQh
    2512             :     2249215679U,        // VRINTXS
    2513             :     2248953547U,        // VRINTZD
    2514             :     2249084619U,        // VRINTZH
    2515             :     1107448200U,        // VRINTZNDf
    2516             :     1107448922U,        // VRINTZNDh
    2517             :     1107448200U,        // VRINTZNQf
    2518             :     1107448922U,        // VRINTZNQh
    2519             :     2249215691U,        // VRINTZS
    2520             :     35547930U,  // VRSHLsv16i8
    2521             :     40266522U,  // VRSHLsv1i64
    2522             :     35285786U,  // VRSHLsv2i32
    2523             :     40266522U,  // VRSHLsv2i64
    2524             :     35416858U,  // VRSHLsv4i16
    2525             :     35285786U,  // VRSHLsv4i32
    2526             :     35416858U,  // VRSHLsv8i16
    2527             :     35547930U,  // VRSHLsv8i8
    2528             :     35941146U,  // VRSHLuv16i8
    2529             :     40397594U,  // VRSHLuv1i64
    2530             :     35679002U,  // VRSHLuv2i32
    2531             :     40397594U,  // VRSHLuv2i64
    2532             :     35810074U,  // VRSHLuv4i16
    2533             :     35679002U,  // VRSHLuv4i32
    2534             :     35810074U,  // VRSHLuv8i16
    2535             :     35941146U,  // VRSHLuv8i8
    2536             :     36072393U,  // VRSHRNv2i32
    2537             :     36203465U,  // VRSHRNv4i16
    2538             :     36334537U,  // VRSHRNv8i8
    2539             :     35548238U,  // VRSHRsv16i8
    2540             :     40266830U,  // VRSHRsv1i64
    2541             :     35286094U,  // VRSHRsv2i32
    2542             :     40266830U,  // VRSHRsv2i64
    2543             :     35417166U,  // VRSHRsv4i16
    2544             :     35286094U,  // VRSHRsv4i32
    2545             :     35417166U,  // VRSHRsv8i16
    2546             :     35548238U,  // VRSHRsv8i8
    2547             :     35941454U,  // VRSHRuv16i8
    2548             :     40397902U,  // VRSHRuv1i64
    2549             :     35679310U,  // VRSHRuv2i32
    2550             :     40397902U,  // VRSHRuv2i64
    2551             :     35810382U,  // VRSHRuv4i16
    2552             :     35679310U,  // VRSHRuv4i32
    2553             :     35810382U,  // VRSHRuv8i16
    2554             :     35941454U,  // VRSHRuv8i8
    2555             :     1109412341U,        // VRSQRTEd
    2556             :     2249214453U,        // VRSQRTEfd
    2557             :     2249214453U,        // VRSQRTEfq
    2558             :     2249083381U,        // VRSQRTEhd
    2559             :     2249083381U,        // VRSQRTEhq
    2560             :     1109412341U,        // VRSQRTEq
    2561             :     2249223399U,        // VRSQRTSfd
    2562             :     2249223399U,        // VRSQRTSfq
    2563             :     2249092327U,        // VRSQRTShd
    2564             :     2249092327U,        // VRSQRTShq
    2565             :     18774073U,  // VRSRAsv16i8
    2566             :     23492665U,  // VRSRAsv1i64
    2567             :     18511929U,  // VRSRAsv2i32
    2568             :     23492665U,  // VRSRAsv2i64
    2569             :     18643001U,  // VRSRAsv4i16
    2570             :     18511929U,  // VRSRAsv4i32
    2571             :     18643001U,  // VRSRAsv8i16
    2572             :     18774073U,  // VRSRAsv8i8
    2573             :     19167289U,  // VRSRAuv16i8
    2574             :     23623737U,  // VRSRAuv1i64
    2575             :     18905145U,  // VRSRAuv2i32
    2576             :     23623737U,  // VRSRAuv2i64
    2577             :     19036217U,  // VRSRAuv4i16
    2578             :     18905145U,  // VRSRAuv4i32
    2579             :     19036217U,  // VRSRAuv8i16
    2580             :     19167289U,  // VRSRAuv8i8
    2581             :     36072333U,  // VRSUBHNv2i32
    2582             :     36203405U,  // VRSUBHNv4i16
    2583             :     36334477U,  // VRSUBHNv8i8
    2584             :     513161U,    // VSDOTD
    2585             :     7066761U,   // VSDOTDI
    2586             :     513161U,    // VSDOTQ
    2587             :     7066761U,   // VSDOTQI
    2588             :     33706636U,  // VSELEQD
    2589             :     33707029U,  // VSELEQH
    2590             :     33706328U,  // VSELEQS
    2591             :     33706564U,  // VSELGED
    2592             :     33706957U,  // VSELGEH
    2593             :     33706256U,  // VSELGES
    2594             :     33706660U,  // VSELGTD
    2595             :     33707063U,  // VSELGTH
    2596             :     33706352U,  // VSELGTS
    2597             :     33706648U,  // VSELVSD
    2598             :     33707051U,  // VSELVSH
    2599             :     33706340U,  // VSELVSS
    2600             :     3226238432U,        // VSETLNi16
    2601             :     3226369504U,        // VSETLNi32
    2602             :     3224272352U,        // VSETLNi8
    2603             :     36334387U,  // VSHLLi16
    2604             :     36203315U,  // VSHLLi32
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    2606             :     35285811U,  // VSHLLsv2i64
    2607             :     35416883U,  // VSHLLsv4i32
    2608             :     35547955U,  // VSHLLsv8i16
    2609             :     35679027U,  // VSHLLuv2i64
    2610             :     35810099U,  // VSHLLuv4i32
    2611             :     35941171U,  // VSHLLuv8i16
    2612             :     36465440U,  // VSHLiv16i8
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    2617             :     36203296U,  // VSHLiv4i32
    2618             :     36334368U,  // VSHLiv8i16
    2619             :     36465440U,  // VSHLiv8i8
    2620             :     35547936U,  // VSHLsv16i8
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    2625             :     35285792U,  // VSHLsv4i32
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    2630             :     35679008U,  // VSHLuv2i32
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    2644             :     35286100U,  // VSHRsv4i32
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    2649             :     35679316U,  // VSHRuv2i32
    2650             :     40397908U,  // VSHRuv2i64
    2651             :     35810388U,  // VSHRuv4i16
    2652             :     35679316U,  // VSHRuv4i32
    2653             :     35810388U,  // VSHRuv8i16
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    2655             :     7105961U,   // VSHTOD
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    2846             :     0U, // VST3LNd16Pseudo
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    2989             :     0U, // VST4q32oddPseudo
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    3004             :     539915985U, // VST4qWB_register_Asm_8
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    3007             :     33572880U,  // VSTMDIA_UPD
    3008             :     0U, // VSTMQIA
    3009             :     33572992U,  // VSTMSDB_UPD
    3010             :     34832U,     // VSTMSIA
    3011             :     33572880U,  // VSTMSIA_UPD
    3012             :     27786U,     // VSTRD
    3013             :     5008522U,   // VSTRH
    3014             :     27786U,     // VSTRS
    3015             :     2248960253U,        // VSUBD
    3016             :     2249091325U,        // VSUBH
    3017             :     36072341U,  // VSUBHNv2i32
    3018             :     36203413U,  // VSUBHNv4i16
    3019             :     36334485U,  // VSUBHNv8i8
    3020             :     35285734U,  // VSUBLsv2i64
    3021             :     35416806U,  // VSUBLsv4i32
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    3023             :     35678950U,  // VSUBLuv2i64
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    3027             :     35286501U,  // VSUBWsv2i64
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    3030             :     35679717U,  // VSUBWuv2i64
    3031             :     35810789U,  // VSUBWuv4i32
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    3043             :     36333821U,  // VSUBv8i16
    3044             :     36464893U,  // VSUBv8i8
    3045             :     31783U,     // VSWPd
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    3047             :     3042017U,   // VTBL1
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    3050             :     0U, // VTBL3Pseudo
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    3052             :     0U, // VTBL4Pseudo
    3053             :     3046978U,   // VTBX1
    3054             :     3046978U,   // VTBX2
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    3058             :     0U, // VTBX4Pseudo
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    3064             :     305941647U, // VTOSIRS
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    3081             :     1182821801U,        // VTOULH
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    3114             :     3046420U,   // VZIPd8
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    3116             :     5143572U,   // VZIPq32
    3117             :     3046420U,   // VZIPq8
    3118             :     0U, // WIN__CHKSTK
    3119             :     0U, // WIN__DBZCHK
    3120             :     34807U,     // sysLDMDA
    3121             :     33572855U,  // sysLDMDA_UPD
    3122             :     34938U,     // sysLDMDB
    3123             :     33572986U,  // sysLDMDB_UPD
    3124             :     35715U,     // sysLDMIA
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    3127             :     33573005U,  // sysLDMIB_UPD
    3128             :     34813U,     // sysSTMDA
    3129             :     33572861U,  // sysSTMDA_UPD
    3130             :     34945U,     // sysSTMDB
    3131             :     33572993U,  // sysSTMDB_UPD
    3132             :     35721U,     // sysSTMIA
    3133             :     33573769U,  // sysSTMIA_UPD
    3134             :     34963U,     // sysSTMIB
    3135             :     33573011U,  // sysSTMIB_UPD
    3136             :     0U, // t2ABS
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    3669             :   };
    3670             : 
    3671             :   static const uint32_t OpInfo1[] = {
    3672             :     0U, // PHI
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    3674             :     0U, // CFI_INSTRUCTION
    3675             :     0U, // EH_LABEL
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    3679             :     0U, // EXTRACT_SUBREG
    3680             :     0U, // INSERT_SUBREG
    3681             :     0U, // IMPLICIT_DEF
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    3683             :     0U, // COPY_TO_REGCLASS
    3684             :     0U, // DBG_VALUE
    3685             :     0U, // DBG_LABEL
    3686             :     0U, // REG_SEQUENCE
    3687             :     0U, // COPY
    3688             :     0U, // BUNDLE
    3689             :     0U, // LIFETIME_START
    3690             :     0U, // LIFETIME_END
    3691             :     0U, // STACKMAP
    3692             :     0U, // FENTRY_CALL
    3693             :     0U, // PATCHPOINT
    3694             :     0U, // LOAD_STACK_GUARD
    3695             :     0U, // STATEPOINT
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    3697             :     0U, // FAULTING_OP
    3698             :     0U, // PATCHABLE_OP
    3699             :     0U, // PATCHABLE_FUNCTION_ENTER
    3700             :     0U, // PATCHABLE_RET
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    3702             :     0U, // PATCHABLE_TAIL_CALL
    3703             :     0U, // PATCHABLE_EVENT_CALL
    3704             :     0U, // PATCHABLE_TYPED_EVENT_CALL
    3705             :     0U, // ICALL_BRANCH_FUNNEL
    3706             :     0U, // G_ADD
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    3720             :     0U, // G_EXTRACT
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    3732             :     0U, // G_ATOMIC_CMPXCHG
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    3744             :     0U, // G_BRCOND
    3745             :     0U, // G_BRINDIRECT
    3746             :     0U, // G_INTRINSIC
    3747             :     0U, // G_INTRINSIC_W_SIDE_EFFECTS
    3748             :     0U, // G_ANYEXT
    3749             :     0U, // G_TRUNC
    3750             :     0U, // G_CONSTANT
    3751             :     0U, // G_FCONSTANT
    3752             :     0U, // G_VASTART
    3753             :     0U, // G_VAARG
    3754             :     0U, // G_SEXT
    3755             :     0U, // G_ZEXT
    3756             :     0U, // G_SHL
    3757             :     0U, // G_LSHR
    3758             :     0U, // G_ASHR
    3759             :     0U, // G_ICMP
    3760             :     0U, // G_FCMP
    3761             :     0U, // G_SELECT
    3762             :     0U, // G_UADDE
    3763             :     0U, // G_USUBE
    3764             :     0U, // G_SADDO
    3765             :     0U, // G_SSUBO
    3766             :     0U, // G_UMULO
    3767             :     0U, // G_SMULO
    3768             :     0U, // G_UMULH
    3769             :     0U, // G_SMULH
    3770             :     0U, // G_FADD
    3771             :     0U, // G_FSUB
    3772             :     0U, // G_FMUL
    3773             :     0U, // G_FMA
    3774             :     0U, // G_FDIV
    3775             :     0U, // G_FREM
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    3777             :     0U, // G_FEXP
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    3779             :     0U, // G_FLOG
    3780             :     0U, // G_FLOG2
    3781             :     0U, // G_FNEG
    3782             :     0U, // G_FPEXT
    3783             :     0U, // G_FPTRUNC
    3784             :     0U, // G_FPTOSI
    3785             :     0U, // G_FPTOUI
    3786             :     0U, // G_SITOFP
    3787             :     0U, // G_UITOFP
    3788             :     0U, // G_FABS
    3789             :     0U, // G_GEP
    3790             :     0U, // G_PTR_MASK
    3791             :     0U, // G_BR
    3792             :     0U, // G_INSERT_VECTOR_ELT
    3793             :     0U, // G_EXTRACT_VECTOR_ELT
    3794             :     0U, // G_SHUFFLE_VECTOR
    3795             :     0U, // G_BSWAP
    3796             :     0U, // ABS
    3797             :     0U, // ADCri
    3798             :     32768U,     // ADCrr
    3799             :     65536U,     // ADCrsi
    3800             :     0U, // ADCrsr
    3801             :     0U, // ADDSri
    3802             :     0U, // ADDSrr
    3803             :     0U, // ADDSrsi
    3804             :     0U, // ADDSrsr
    3805             :     0U, // ADDri
    3806             :     32768U,     // ADDrr
    3807             :     65536U,     // ADDrsi
    3808             :     0U, // ADDrsr
    3809             :     0U, // ADJCALLSTACKDOWN
    3810             :     0U, // ADJCALLSTACKUP
    3811             :     8U, // ADR
    3812             :     0U, // AESD
    3813             :     0U, // AESE
    3814             :     0U, // AESIMC
    3815             :     0U, // AESMC
    3816             :     0U, // ANDri
    3817             :     32768U,     // ANDrr
    3818             :     65536U,     // ANDrsi
    3819             :     0U, // ANDrsr
    3820             :     32768U,     // ASRi
    3821             :     32768U,     // ASRr
    3822             :     0U, // B
    3823             :     0U, // BCCZi64
    3824             :     0U, // BCCi64
    3825             :     16U,        // BFC
    3826             :     98328U,     // BFI
    3827             :     0U, // BICri
    3828             :     32768U,     // BICrr
    3829             :     65536U,     // BICrsi
    3830             :     0U, // BICrsr
    3831             :     0U, // BKPT
    3832             :     0U, // BL
    3833             :     0U, // BLX
    3834             :     0U, // BLX_pred
    3835             :     0U, // BLXi
    3836             :     0U, // BL_pred
    3837             :     0U, // BMOVPCB_CALL
    3838             :     0U, // BMOVPCRX_CALL
    3839             :     0U, // BR_JTadd
    3840             :     0U, // BR_JTm_i12
    3841             :     0U, // BR_JTm_rs
    3842             :     0U, // BR_JTr
    3843             :     0U, // BX
    3844             :     0U, // BXJ
    3845             :     0U, // BX_CALL
    3846             :     0U, // BX_RET
    3847             :     0U, // BX_pred
    3848             :     0U, // Bcc
    3849             :     1056U,      // CDP
    3850             :     0U, // CDP2
    3851             :     0U, // CLREX
    3852             :     2048U,      // CLZ
    3853             :     40U,        // CMNri
    3854             :     2048U,      // CMNzrr
    3855             :     48U,        // CMNzrsi
    3856             :     56U,        // CMNzrsr
    3857             :     0U, // CMP_SWAP_16
    3858             :     0U, // CMP_SWAP_32
    3859             :     0U, // CMP_SWAP_64
    3860             :     0U, // CMP_SWAP_8
    3861             :     40U,        // CMPri
    3862             :     2048U,      // CMPrr
    3863             :     48U,        // CMPrsi
    3864             :     56U,        // CMPrsr
    3865             :     0U, // CONSTPOOL_ENTRY
    3866             :     0U, // COPY_STRUCT_BYVAL_I32
    3867             :     0U, // CPS1p
    3868             :     0U, // CPS2p
    3869             :     2072U,      // CPS3p
    3870             :     2072U,      // CRC32B
    3871             :     2072U,      // CRC32CB
    3872             :     2072U,      // CRC32CH
    3873             :     2072U,      // CRC32CW
    3874             :     2072U,      // CRC32H
    3875             :     2072U,      // CRC32W
    3876             :     0U, // CompilerBarrier
    3877             :     0U, // DBG
    3878             :     0U, // DMB
    3879             :     0U, // DSB
    3880             :     0U, // EORri
    3881             :     32768U,     // EORrr
    3882             :     65536U,     // EORrsi
    3883             :     0U, // EORrsr
    3884             :     0U, // ERET
    3885             :     0U, // FCONSTD
    3886             :     0U, // FCONSTH
    3887             :     0U, // FCONSTS
    3888             :     65U,        // FLDMXDB_UPD
    3889             :     2120U,      // FLDMXIA
    3890             :     65U,        // FLDMXIA_UPD
    3891             :     0U, // FMSTAT
    3892             :     65U,        // FSTMXDB_UPD
    3893             :     2120U,      // FSTMXIA
    3894             :     65U,        // FSTMXIA_UPD
    3895             :     0U, // HINT
    3896             :     0U, // HLT
    3897             :     0U, // HVC
    3898             :     0U, // ISB
    3899             :     0U, // ITasm
    3900             :     0U, // Int_eh_sjlj_dispatchsetup
    3901             :     0U, // Int_eh_sjlj_longjmp
    3902             :     0U, // Int_eh_sjlj_setjmp
    3903             :     0U, // Int_eh_sjlj_setjmp_nofp
    3904             :     0U, // Int_eh_sjlj_setup_dispatch
    3905             :     0U, // JUMPTABLE_ADDRS
    3906             :     0U, // JUMPTABLE_INSTS
    3907             :     0U, // JUMPTABLE_TBB
    3908             :     0U, // JUMPTABLE_TBH
    3909             :     80U,        // LDA
    3910             :     80U,        // LDAB
    3911             :     80U,        // LDAEX
    3912             :     80U,        // LDAEXB
    3913             :     0U, // LDAEXD
    3914             :     80U,        // LDAEXH
    3915             :     80U,        // LDAH
    3916             :     0U, // LDC2L_OFFSET
    3917             :     1U, // LDC2L_OPTION
    3918             :     1U, // LDC2L_POST
    3919             :     0U, // LDC2L_PRE
    3920             :     0U, // LDC2_OFFSET
    3921             :     1U, // LDC2_OPTION
    3922             :     1U, // LDC2_POST
    3923             :     0U, // LDC2_PRE
    3924             :     89U,        // LDCL_OFFSET
    3925             :     131169U,    // LDCL_OPTION
    3926             :     163937U,    // LDCL_POST
    3927             :     105U,       // LDCL_PRE
    3928             :     89U,        // LDC_OFFSET
    3929             :     131169U,    // LDC_OPTION
    3930             :     163937U,    // LDC_POST
    3931             :     105U,       // LDC_PRE
    3932             :     2120U,      // LDMDA
    3933             :     65U,        // LDMDA_UPD
    3934             :     2120U,      // LDMDB
    3935             :     65U,        // LDMDB_UPD
    3936             :     2120U,      // LDMIA
    3937             :     0U, // LDMIA_RET
    3938             :     65U,        // LDMIA_UPD
    3939             :     2120U,      // LDMIB
    3940             :     65U,        // LDMIB_UPD
    3941             :     80U,        // LDRBT_POST
    3942             :     196704U,    // LDRBT_POST_IMM
    3943             :     196704U,    // LDRBT_POST_REG
    3944             :     196704U,    // LDRB_POST_IMM
    3945             :     196704U,    // LDRB_POST_REG
    3946             :     112U,       // LDRB_PRE_IMM
    3947             :     120U,       // LDRB_PRE_REG
    3948             :     128U,       // LDRBi12
    3949             :     136U,       // LDRBrs
    3950             :     2048U,      // LDRConstPool
    3951             :     229376U,    // LDRD
    3952             :     2359296U,   // LDRD_POST
    3953             :     294912U,    // LDRD_PRE
    3954             :     80U,        // LDREX
    3955             :     80U,        // LDREXB
    3956             :     0U, // LDREXD
    3957             :     80U,        // LDREXH
    3958             :     144U,       // LDRH
    3959             :     327776U,    // LDRHTi
    3960             :     360544U,    // LDRHTr
    3961             :     393312U,    // LDRH_POST
    3962             :     152U,       // LDRH_PRE
    3963             :     0U, // LDRLIT_ga_abs
    3964             :     0U, // LDRLIT_ga_pcrel
    3965             :     0U, // LDRLIT_ga_pcrel_ldr
    3966             :     144U,       // LDRSB
    3967             :     327776U,    // LDRSBTi
    3968             :     360544U,    // LDRSBTr
    3969             :     393312U,    // LDRSB_POST
    3970             :     152U,       // LDRSB_PRE
    3971             :     144U,       // LDRSH
    3972             :     327776U,    // LDRSHTi
    3973             :     360544U,    // LDRSHTr
    3974             :     393312U,    // LDRSH_POST
    3975             :     152U,       // LDRSH_PRE
    3976             :     80U,        // LDRT_POST
    3977             :     196704U,    // LDRT_POST_IMM
    3978             :     196704U,    // LDRT_POST_REG
    3979             :     196704U,    // LDR_POST_IMM
    3980             :     196704U,    // LDR_POST_REG
    3981             :     112U,       // LDR_PRE_IMM
    3982             :     120U,       // LDR_PRE_REG
    3983             :     128U,       // LDRcp
    3984             :     128U,       // LDRi12
    3985             :     136U,       // LDRrs
    3986             :     0U, // LEApcrel
    3987             :     0U, // LEApcrelJT
    3988             :     32768U,     // LSLi
    3989             :     32768U,     // LSLr
    3990             :     32768U,     // LSRi
    3991             :     32768U,     // LSRr
    3992             :     4623392U,   // MCR
    3993             :     160U,       // MCR2
    3994             :     6720544U,   // MCRR
    3995             :     458920U,    // MCRR2
    3996             :     0U, // MEMCPY
    3997             :     35684352U,  // MLA
    3998             :     0U, // MLAv5
    3999             :     35684352U,  // MLS
    4000             :     0U, // MOVCCi
    4001             :     0U, // MOVCCi16
    4002             :     0U, // MOVCCi32imm
    4003             :     0U, // MOVCCr
    4004             :     0U, // MOVCCsi
    4005             :     0U, // MOVCCsr
    4006             :     0U, // MOVPCLR
    4007             :     0U, // MOVPCRX
    4008             :     2072U,      // MOVTi16
    4009             :     0U, // MOVTi16_ga_pcrel
    4010             :     0U, // MOV_ga_pcrel
    4011             :     0U, // MOV_ga_pcrel_ldr
    4012             :     40U,        // MOVi
    4013             :     2048U,      // MOVi16
    4014             :     0U, // MOVi16_ga_pcrel
    4015             :     0U, // MOVi32imm
    4016             :     2048U,      // MOVr
    4017             :     2048U,      // MOVr_TC
    4018             :     48U,        // MOVsi
    4019             :     56U,        // MOVsr
    4020             :     0U, // MOVsra_flag
    4021             :     0U, // MOVsrl_flag
    4022             :     0U, // MRC
    4023             :     0U, // MRC2
    4024             :     0U, // MRRC
    4025             :     0U, // MRRC2
    4026             :     2U, // MRS
    4027             :     176U,       // MRSbanked
    4028             :     2U, // MRSsys
    4029             :     64U,        // MSR
    4030             :     0U, // MSRbanked
    4031             :     2U, // MSRi
    4032             :     32768U,     // MUL
    4033             :     0U, // MULv5
    4034             :     0U, // MVNCCi
    4035             :     40U,        // MVNi
    4036             :     2048U,      // MVNr
    4037             :     48U,        // MVNsi
    4038             :     56U,        // MVNsr
    4039             :     0U, // ORRri
    4040             :     32768U,     // ORRrr
    4041             :     65536U,     // ORRrsi
    4042             :     0U, // ORRrsr
    4043             :     0U, // PICADD
    4044             :     0U, // PICLDR
    4045             :     0U, // PICLDRB
    4046             :     0U, // PICLDRH
    4047             :     0U, // PICLDRSB
    4048             :     0U, // PICLDRSH
    4049             :     0U, // PICSTR
    4050             :     0U, // PICSTRB
    4051             :     0U, // PICSTRH
    4052             :     8421376U,   // PKHBT
    4053             :     10518528U,  // PKHTB
    4054             :     0U, // PLDWi12
    4055             :     0U, // PLDWrs
    4056             :     0U, // PLDi12
    4057             :     0U, // PLDrs
    4058             :     0U, // PLIi12
    4059             :     0U, // PLIrs
    4060             :     32768U,     // QADD
    4061             :     32768U,     // QADD16
    4062             :     32768U,     // QADD8
    4063             :     32768U,     // QASX
    4064             :     32768U,     // QDADD
    4065             :     32768U,     // QDSUB
    4066             :     32768U,     // QSAX
    4067             :     32768U,     // QSUB
    4068             :     32768U,     // QSUB16
    4069             :     32768U,     // QSUB8
    4070             :     2048U,      // RBIT
    4071             :     2048U,      // REV
    4072             :     2048U,      // REV16
    4073             :     2048U,      // REVSH
    4074             :     0U, // RFEDA
    4075             :     0U, // RFEDA_UPD
    4076             :     0U, // RFEDB
    4077             :     0U, // RFEDB_UPD
    4078             :     0U, // RFEIA
    4079             :     0U, // RFEIA_UPD
    4080             :     0U, // RFEIB
    4081             :     0U, // RFEIB_UPD
    4082             :     32768U,     // RORi
    4083             :     32768U,     // RORr
    4084             :     0U, // RRX
    4085             :     2048U,      // RRXi
    4086             :     0U, // RSBSri
    4087             :     0U, // RSBSrsi
    4088             :     0U, // RSBSrsr
    4089             :     0U, // RSBri
    4090             :     32768U,     // RSBrr
    4091             :     65536U,     // RSBrsi
    4092             :     0U, // RSBrsr
    4093             :     0U, // RSCri
    4094             :     32768U,     // RSCrr
    4095             :     65536U,     // RSCrsi
    4096             :     0U, // RSCrsr
    4097             :     32768U,     // SADD16
    4098             :     32768U,     // SADD8
    4099             :     32768U,     // SASX
    4100             :     0U, // SBCri
    4101             :     32768U,     // SBCrr
    4102             :     65536U,     // SBCrsi
    4103             :     0U, // SBCrsr
    4104             :     69238784U,  // SBFX
    4105             :     32768U,     // SDIV
    4106             :     32768U,     // SEL
    4107             :     0U, // SETEND
    4108             :     0U, // SETPAN
    4109             :     2216U,      // SHA1C
    4110             :     0U, // SHA1H
    4111             :     2216U,      // SHA1M
    4112             :     2216U,      // SHA1P
    4113             :     2216U,      // SHA1SU0
    4114             :     0U, // SHA1SU1
    4115             :     2216U,      // SHA256H
    4116             :     2216U,      // SHA256H2
    4117             :     0U, // SHA256SU0
    4118             :     2216U,      // SHA256SU1
    4119             :     32768U,     // SHADD16
    4120             :     32768U,     // SHADD8
    4121             :     32768U,     // SHASX
    4122             :     32768U,     // SHSAX
    4123             :     32768U,     // SHSUB16
    4124             :     32768U,     // SHSUB8
    4125             :     0U, // SMC
    4126             :     35684352U,  // SMLABB
    4127             :     35684352U,  // SMLABT
    4128             :     35684352U,  // SMLAD
    4129             :     35684352U,  // SMLADX
    4130             :     0U, // SMLAL
    4131             :     35684352U,  // SMLALBB
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    4133             :     35684352U,  // SMLALD
    4134             :     35684352U,  // SMLALDX
    4135             :     35684352U,  // SMLALTB
    4136             :     35684352U,  // SMLALTT
    4137             :     0U, // SMLALv5
    4138             :     35684352U,  // SMLATB
    4139             :     35684352U,  // SMLATT
    4140             :     35684352U,  // SMLAWB
    4141             :     35684352U,  // SMLAWT
    4142             :     35684352U,  // SMLSD
    4143             :     35684352U,  // SMLSDX
    4144             :     35684352U,  // SMLSLD
    4145             :     35684352U,  // SMLSLDX
    4146             :     35684352U,  // SMMLA
    4147             :     35684352U,  // SMMLAR
    4148             :     35684352U,  // SMMLS
    4149             :     35684352U,  // SMMLSR
    4150             :     32768U,     // SMMUL
    4151             :     32768U,     // SMMULR
    4152             :     32768U,     // SMUAD
    4153             :     32768U,     // SMUADX
    4154             :     32768U,     // SMULBB
    4155             :     32768U,     // SMULBT
    4156             :     35684352U,  // SMULL
    4157             :     0U, // SMULLv5
    4158             :     32768U,     // SMULTB
    4159             :     32768U,     // SMULTT
    4160             :     32768U,     // SMULWB
    4161             :     32768U,     // SMULWT
    4162             :     32768U,     // SMUSD
    4163             :     32768U,     // SMUSDX
    4164             :     0U, // SPACE
    4165             :     0U, // SRSDA
    4166             :     0U, // SRSDA_UPD
    4167             :     0U, // SRSDB
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    4176             :     32768U,     // SSUB16
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    4178             :     0U, // STC2L_OFFSET
    4179             :     1U, // STC2L_OPTION
    4180             :     1U, // STC2L_POST
    4181             :     0U, // STC2L_PRE
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    4208             :     65U,        // STMIB_UPD
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    4214             :     112U,       // STRB_PRE_IMM
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    4216             :     128U,       // STRBi12
    4217             :     0U, // STRBi_preidx
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    4220             :     229376U,    // STRD
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    4226             :     491520U,    // STREXH
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    4234             :     196704U,    // STRT_POST_IMM
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    4238             :     112U,       // STR_PRE_IMM
    4239             :     120U,       // STR_PRE_REG
    4240             :     128U,       // STRi12
    4241             :     0U, // STRi_preidx
    4242             :     0U, // STRr_preidx
    4243             :     136U,       // STRrs
    4244             :     0U, // SUBS_PC_LR
    4245             :     0U, // SUBSri
    4246             :     0U, // SUBSrr
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    4248             :     0U, // SUBSrsr
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    4250             :     32768U,     // SUBrr
    4251             :     65536U,     // SUBrsi
    4252             :     0U, // SUBrsr
    4253             :     0U, // SVC
    4254             :     491520U,    // SWP
    4255             :     491520U,    // SWPB
    4256             :     12615680U,  // SXTAB
    4257             :     12615680U,  // SXTAB16
    4258             :     12615680U,  // SXTAH
    4259             :     5120U,      // SXTB
    4260             :     5120U,      // SXTB16
    4261             :     5120U,      // SXTH
    4262             :     0U, // TAILJMPd
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    4266             :     0U, // TCRETURNri
    4267             :     40U,        // TEQri
    4268             :     2048U,      // TEQrr
    4269             :     48U,        // TEQrsi
    4270             :     56U,        // TEQrsr
    4271             :     0U, // TPsoft
    4272             :     0U, // TRAP
    4273             :     0U, // TRAPNaCl
    4274             :     40U,        // TSTri
    4275             :     2048U,      // TSTrr
    4276             :     48U,        // TSTrsi
    4277             :     56U,        // TSTrsr
    4278             :     32768U,     // UADD16
    4279             :     32768U,     // UADD8
    4280             :     32768U,     // UASX
    4281             :     69238784U,  // UBFX
    4282             :     0U, // UDF
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    4284             :     32768U,     // UHADD16
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    4286             :     32768U,     // UHASX
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    4298             :     32768U,     // UQSAX
    4299             :     32768U,     // UQSUB16
    4300             :     32768U,     // UQSUB8
    4301             :     32768U,     // USAD8
    4302             :     35684352U,  // USADA8
    4303             :     14712832U,  // USAT
    4304             :     32768U,     // USAT16
    4305             :     32768U,     // USAX
    4306             :     32768U,     // USUB16
    4307             :     32768U,     // USUB8
    4308             :     12615680U,  // UXTAB
    4309             :     12615680U,  // UXTAB16
    4310             :     12615680U,  // UXTAH
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    4312             :     5120U,      // UXTB16
    4313             :     5120U,      // UXTH
    4314             :     2216U,      // VABALsv2i64
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    4317             :     2216U,      // VABALuv2i64
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    4328             :     2216U,      // VABAuv4i16
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    4332             :     2072U,      // VABDLsv2i64
    4333             :     2072U,      // VABDLsv4i32
    4334             :     2072U,      // VABDLsv8i16
    4335             :     2072U,      // VABDLuv2i64
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    4337             :     2072U,      // VABDLuv8i16
    4338             :     527392U,    // VABDfd
    4339             :     527392U,    // VABDfq
    4340             :     527392U,    // VABDhd
    4341             :     527392U,    // VABDhq
    4342             :     2072U,      // VABDsv16i8
    4343             :     2072U,      // VABDsv2i32
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    4345             :     2072U,      // VABDsv4i32
    4346             :     2072U,      // VABDsv8i16
    4347             :     2072U,      // VABDsv8i8
    4348             :     2072U,      // VABDuv16i8
    4349             :     2072U,      // VABDuv2i32
    4350             :     2072U,      // VABDuv4i16
    4351             :     2072U,      // VABDuv4i32
    4352             :     2072U,      // VABDuv8i16
    4353             :     2072U,      // VABDuv8i8
    4354             :     64U,        // VABSD
    4355             :     64U,        // VABSH
    4356             :     64U,        // VABSS
    4357             :     64U,        // VABSfd
    4358             :     64U,        // VABSfq
    4359             :     64U,        // VABShd
    4360             :     64U,        // VABShq
    4361             :     0U, // VABSv16i8
    4362             :     0U, // VABSv2i32
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    4364             :     0U, // VABSv4i32
    4365             :     0U, // VABSv8i16
    4366             :     0U, // VABSv8i8
    4367             :     527392U,    // VACGEfd
    4368             :     527392U,    // VACGEfq
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    4370             :     527392U,    // VACGEhq
    4371             :     527392U,    // VACGTfd
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    4373             :     527392U,    // VACGThd
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    4375             :     527392U,    // VADDD
    4376             :     527392U,    // VADDH
    4377             :     2072U,      // VADDHNv2i32
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    4405             :     32768U,     // VANDd
    4406             :     32768U,     // VANDq
    4407             :     32768U,     // VBICd
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    4410             :     0U, // VBICiv4i32
    4411             :     0U, // VBICiv8i16
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    4415             :     557080U,    // VBITd
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    4427             :     2072U,      // VCEQv16i8
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    4443             :     527392U,    // VCGEfd
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    4469             :     527392U,    // VCGTfd
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    4727             :     67U,        // VLD1DUPd32
    4728             :     211U,       // VLD1DUPd32wb_fixed
    4729             :     9251U,      // VLD1DUPd32wb_register
    4730             :     67U,        // VLD1DUPd8
    4731             :     211U,       // VLD1DUPd8wb_fixed
    4732             :     9251U,      // VLD1DUPd8wb_register
    4733             :     67U,        // VLD1DUPq16
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    4735             :     9251U,      // VLD1DUPq16wb_register
    4736             :     67U,        // VLD1DUPq32
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    4742             :     665820U,    // VLD1LNd16
    4743             :     698596U,    // VLD1LNd16_UPD
    4744             :     665820U,    // VLD1LNd32
    4745             :     698596U,    // VLD1LNd32_UPD
    4746             :     665820U,    // VLD1LNd8
    4747             :     698596U,    // VLD1LNd8_UPD
    4748             :     2280U,      // VLD1LNdAsm_16
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    4752             :     11496U,     // VLD1LNdWB_fixed_Asm_32
    4753             :     11496U,     // VLD1LNdWB_fixed_Asm_8
    4754             :     721128U,    // VLD1LNdWB_register_Asm_16
    4755             :     721128U,    // VLD1LNdWB_register_Asm_32
    4756             :     721128U,    // VLD1LNdWB_register_Asm_8
    4757             :     0U, // VLD1LNq16Pseudo
    4758             :     0U, // VLD1LNq16Pseudo_UPD
    4759             :     0U, // VLD1LNq32Pseudo
    4760             :     0U, // VLD1LNq32Pseudo_UPD
    4761             :     0U, // VLD1LNq8Pseudo
    4762             :     0U, // VLD1LNq8Pseudo_UPD
    4763             :     67U,        // VLD1d16
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    4766             :     9251U,      // VLD1d16Qwb_register
    4767             :     67U,        // VLD1d16T
    4768             :     211U,       // VLD1d16Twb_fixed
    4769             :     9251U,      // VLD1d16Twb_register
    4770             :     211U,       // VLD1d16wb_fixed
    4771             :     9251U,      // VLD1d16wb_register
    4772             :     67U,        // VLD1d32
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    4775             :     9251U,      // VLD1d32Qwb_register
    4776             :     67U,        // VLD1d32T
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    4781             :     67U,        // VLD1d64
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    4785             :     0U, // VLD1d64QPseudoWB_register
    4786             :     211U,       // VLD1d64Qwb_fixed
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    4794             :     211U,       // VLD1d64wb_fixed
    4795             :     9251U,      // VLD1d64wb_register
    4796             :     67U,        // VLD1d8
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    4829             :     67U,        // VLD2DUPd8
    4830             :     211U,       // VLD2DUPd8wb_fixed
    4831             :     9251U,      // VLD2DUPd8wb_register
    4832             :     67U,        // VLD2DUPd8x2
    4833             :     211U,       // VLD2DUPd8x2wb_fixed
    4834             :     9251U,      // VLD2DUPd8x2wb_register
    4835             :     766180U,    // VLD2LNd16
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    4838             :     799988U,    // VLD2LNd16_UPD
    4839             :     766180U,    // VLD2LNd32
    4840             :     0U, // VLD2LNd32Pseudo
    4841             :     0U, // VLD2LNd32Pseudo_UPD
    4842             :     799988U,    // VLD2LNd32_UPD
    4843             :     766180U,    // VLD2LNd8
    4844             :     0U, // VLD2LNd8Pseudo
    4845             :     0U, // VLD2LNd8Pseudo_UPD
    4846             :     799988U,    // VLD2LNd8_UPD
    4847             :     2280U,      // VLD2LNdAsm_16
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    4849             :     2280U,      // VLD2LNdAsm_8
    4850             :     11496U,     // VLD2LNdWB_fixed_Asm_16
    4851             :     11496U,     // VLD2LNdWB_fixed_Asm_32
    4852             :     11496U,     // VLD2LNdWB_fixed_Asm_8
    4853             :     721128U,    // VLD2LNdWB_register_Asm_16
    4854             :     721128U,    // VLD2LNdWB_register_Asm_32
    4855             :     721128U,    // VLD2LNdWB_register_Asm_8
    4856             :     766180U,    // VLD2LNq16
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    4862             :     0U, // VLD2LNq32Pseudo_UPD
    4863             :     799988U,    // VLD2LNq32_UPD
    4864             :     2280U,      // VLD2LNqAsm_16
    4865             :     2280U,      // VLD2LNqAsm_32
    4866             :     11496U,     // VLD2LNqWB_fixed_Asm_16
    4867             :     11496U,     // VLD2LNqWB_fixed_Asm_32
    4868             :     721128U,    // VLD2LNqWB_register_Asm_16
    4869             :     721128U,    // VLD2LNqWB_register_Asm_32
    4870             :     67U,        // VLD2b16
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    4873             :     67U,        // VLD2b32
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    4875             :     9251U,      // VLD2b32wb_register
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    4878             :     9251U,      // VLD2b8wb_register
    4879             :     67U,        // VLD2d16
    4880             :     211U,       // VLD2d16wb_fixed
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    4894             :     67U,        // VLD2q32
    4895             :     0U, // VLD2q32Pseudo
    4896             :     0U, // VLD2q32PseudoWB_fixed
    4897             :     0U, // VLD2q32PseudoWB_register
    4898             :     211U,       // VLD2q32wb_fixed
    4899             :     9251U,      // VLD2q32wb_register
    4900             :     67U,        // VLD2q8
    4901             :     0U, // VLD2q8Pseudo
    4902             :     0U, // VLD2q8PseudoWB_fixed
    4903             :     0U, // VLD2q8PseudoWB_register
    4904             :     211U,       // VLD2q8wb_fixed
    4905             :     9251U,      // VLD2q8wb_register
    4906             :     14588U,     // VLD3DUPd16
    4907             :     0U, // VLD3DUPd16Pseudo
    4908             :     0U, // VLD3DUPd16Pseudo_UPD
    4909             :     834812U,    // VLD3DUPd16_UPD
    4910             :     14588U,     // VLD3DUPd32
    4911             :     0U, // VLD3DUPd32Pseudo
    4912             :     0U, // VLD3DUPd32Pseudo_UPD
    4913             :     834812U,    // VLD3DUPd32_UPD
    4914             :     14588U,     // VLD3DUPd8
    4915             :     0U, // VLD3DUPd8Pseudo
    4916             :     0U, // VLD3DUPd8Pseudo_UPD
    4917             :     834812U,    // VLD3DUPd8_UPD
    4918             :     0U, // VLD3DUPdAsm_16
    4919             :     0U, // VLD3DUPdAsm_32
    4920             :     0U, // VLD3DUPdAsm_8
    4921             :     4U, // VLD3DUPdWB_fixed_Asm_16
    4922             :     4U, // VLD3DUPdWB_fixed_Asm_32
    4923             :     4U, // VLD3DUPdWB_fixed_Asm_8
    4924             :     2216U,      // VLD3DUPdWB_register_Asm_16
    4925             :     2216U,      // VLD3DUPdWB_register_Asm_32
    4926             :     2216U,      // VLD3DUPdWB_register_Asm_8
    4927             :     14588U,     // VLD3DUPq16
    4928             :     834812U,    // VLD3DUPq16_UPD
    4929             :     14588U,     // VLD3DUPq32
    4930             :     834812U,    // VLD3DUPq32_UPD
    4931             :     14588U,     // VLD3DUPq8
    4932             :     834812U,    // VLD3DUPq8_UPD
    4933             :     0U, // VLD3DUPqAsm_16
    4934             :     0U, // VLD3DUPqAsm_32
    4935             :     0U, // VLD3DUPqAsm_8
    4936             :     4U, // VLD3DUPqWB_fixed_Asm_16
    4937             :     4U, // VLD3DUPqWB_fixed_Asm_32
    4938             :     4U, // VLD3DUPqWB_fixed_Asm_8
    4939             :     2216U,      // VLD3DUPqWB_register_Asm_16
    4940             :     2216U,      // VLD3DUPqWB_register_Asm_32
    4941             :     2216U,      // VLD3DUPqWB_register_Asm_8
    4942             :     865524U,    // VLD3LNd16
    4943             :     0U, // VLD3LNd16Pseudo
    4944             :     0U, // VLD3LNd16Pseudo_UPD
    4945             :     895236U,    // VLD3LNd16_UPD
    4946             :     865524U,    // VLD3LNd32
    4947             :     0U, // VLD3LNd32Pseudo
    4948             :     0U, // VLD3LNd32Pseudo_UPD
    4949             :     895236U,    // VLD3LNd32_UPD
    4950             :     865524U,    // VLD3LNd8
    4951             :     0U, // VLD3LNd8Pseudo
    4952             :     0U, // VLD3LNd8Pseudo_UPD
    4953             :     895236U,    // VLD3LNd8_UPD
    4954             :     2280U,      // VLD3LNdAsm_16
    4955             :     2280U,      // VLD3LNdAsm_32
    4956             :     2280U,      // VLD3LNdAsm_8
    4957             :     11496U,     // VLD3LNdWB_fixed_Asm_16
    4958             :     11496U,     // VLD3LNdWB_fixed_Asm_32
    4959             :     11496U,     // VLD3LNdWB_fixed_Asm_8
    4960             :     721128U,    // VLD3LNdWB_register_Asm_16
    4961             :     721128U,    // VLD3LNdWB_register_Asm_32
    4962             :     721128U,    // VLD3LNdWB_register_Asm_8
    4963             :     865524U,    // VLD3LNq16
    4964             :     0U, // VLD3LNq16Pseudo
    4965             :     0U, // VLD3LNq16Pseudo_UPD
    4966             :     895236U,    // VLD3LNq16_UPD
    4967             :     865524U,    // VLD3LNq32
    4968             :     0U, // VLD3LNq32Pseudo
    4969             :     0U, // VLD3LNq32Pseudo_UPD
    4970             :     895236U,    // VLD3LNq32_UPD
    4971             :     2280U,      // VLD3LNqAsm_16
    4972             :     2280U,      // VLD3LNqAsm_32
    4973             :     11496U,     // VLD3LNqWB_fixed_Asm_16
    4974             :     11496U,     // VLD3LNqWB_fixed_Asm_32
    4975             :     721128U,    // VLD3LNqWB_register_Asm_16
    4976             :     721128U,    // VLD3LNqWB_register_Asm_32
    4977             :     119570432U, // VLD3d16
    4978             :     0U, // VLD3d16Pseudo
    4979             :     0U, // VLD3d16Pseudo_UPD
    4980             :     153124864U, // VLD3d16_UPD
    4981             :     119570432U, // VLD3d32
    4982             :     0U, // VLD3d32Pseudo
    4983             :     0U, // VLD3d32Pseudo_UPD
    4984             :     153124864U, // VLD3d32_UPD
    4985             :     119570432U, // VLD3d8
    4986             :     0U, // VLD3d8Pseudo
    4987             :     0U, // VLD3d8Pseudo_UPD
    4988             :     153124864U, // VLD3d8_UPD
    4989             :     67U,        // VLD3dAsm_16
    4990             :     67U,        // VLD3dAsm_32
    4991             :     67U,        // VLD3dAsm_8
    4992             :     211U,       // VLD3dWB_fixed_Asm_16
    4993             :     211U,       // VLD3dWB_fixed_Asm_32
    4994             :     211U,       // VLD3dWB_fixed_Asm_8
    4995             :     532515U,    // VLD3dWB_register_Asm_16
    4996             :     532515U,    // VLD3dWB_register_Asm_32
    4997             :     532515U,    // VLD3dWB_register_Asm_8
    4998             :     119570432U, // VLD3q16
    4999             :     0U, // VLD3q16Pseudo_UPD
    5000             :     153124864U, // VLD3q16_UPD
    5001             :     0U, // VLD3q16oddPseudo
    5002             :     0U, // VLD3q16oddPseudo_UPD
    5003             :     119570432U, // VLD3q32
    5004             :     0U, // VLD3q32Pseudo_UPD
    5005             :     153124864U, // VLD3q32_UPD
    5006             :     0U, // VLD3q32oddPseudo
    5007             :     0U, // VLD3q32oddPseudo_UPD
    5008             :     119570432U, // VLD3q8
    5009             :     0U, // VLD3q8Pseudo_UPD
    5010             :     153124864U, // VLD3q8_UPD
    5011             :     0U, // VLD3q8oddPseudo
    5012             :     0U, // VLD3q8oddPseudo_UPD
    5013             :     0U, // VLD3qAsm_16
    5014             :     0U, // VLD3qAsm_32
    5015             :     0U, // VLD3qAsm_8
    5016             :     4U, // VLD3qWB_fixed_Asm_16
    5017             :     4U, // VLD3qWB_fixed_Asm_32
    5018             :     4U, // VLD3qWB_fixed_Asm_8
    5019             :     2216U,      // VLD3qWB_register_Asm_16
    5020             :     2216U,      // VLD3qWB_register_Asm_32
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    5028             :     0U, // VLD4DUPd32Pseudo_UPD
    5029             :     16652U,     // VLD4DUPd32_UPD
    5030             :     539916U,    // VLD4DUPd8
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    5032             :     0U, // VLD4DUPd8Pseudo_UPD
    5033             :     16652U,     // VLD4DUPd8_UPD
    5034             :     0U, // VLD4DUPdAsm_16
    5035             :     0U, // VLD4DUPdAsm_32
    5036             :     0U, // VLD4DUPdAsm_8
    5037             :     4U, // VLD4DUPdWB_fixed_Asm_16
    5038             :     4U, // VLD4DUPdWB_fixed_Asm_32
    5039             :     4U, // VLD4DUPdWB_fixed_Asm_8
    5040             :     2216U,      // VLD4DUPdWB_register_Asm_16
    5041             :     2216U,      // VLD4DUPdWB_register_Asm_32
    5042             :     2216U,      // VLD4DUPdWB_register_Asm_8
    5043             :     539916U,    // VLD4DUPq16
    5044             :     16652U,     // VLD4DUPq16_UPD
    5045             :     539916U,    // VLD4DUPq32
    5046             :     16652U,     // VLD4DUPq32_UPD
    5047             :     539916U,    // VLD4DUPq8
    5048             :     16652U,     // VLD4DUPq8_UPD
    5049             :     0U, // VLD4DUPqAsm_16
    5050             :     0U, // VLD4DUPqAsm_32
    5051             :     0U, // VLD4DUPqAsm_8
    5052             :     4U, // VLD4DUPqWB_fixed_Asm_16
    5053             :     4U, // VLD4DUPqWB_fixed_Asm_32
    5054             :     4U, // VLD4DUPqWB_fixed_Asm_8
    5055             :     2216U,      // VLD4DUPqWB_register_Asm_16
    5056             :     2216U,      // VLD4DUPqWB_register_Asm_32
    5057             :     2216U,      // VLD4DUPqWB_register_Asm_8
    5058             :     189313284U, // VLD4LNd16
    5059             :     0U, // VLD4LNd16Pseudo
    5060             :     0U, // VLD4LNd16Pseudo_UPD
    5061             :     276U,       // VLD4LNd16_UPD
    5062             :     189313284U, // VLD4LNd32
    5063             :     0U, // VLD4LNd32Pseudo
    5064             :     0U, // VLD4LNd32Pseudo_UPD
    5065             :     276U,       // VLD4LNd32_UPD
    5066             :     189313284U, // VLD4LNd8
    5067             :     0U, // VLD4LNd8Pseudo
    5068             :     0U, // VLD4LNd8Pseudo_UPD
    5069             :     276U,       // VLD4LNd8_UPD
    5070             :     2280U,      // VLD4LNdAsm_16
    5071             :     2280U,      // VLD4LNdAsm_32
    5072             :     2280U,      // VLD4LNdAsm_8
    5073             :     11496U,     // VLD4LNdWB_fixed_Asm_16
    5074             :     11496U,     // VLD4LNdWB_fixed_Asm_32
    5075             :     11496U,     // VLD4LNdWB_fixed_Asm_8
    5076             :     721128U,    // VLD4LNdWB_register_Asm_16
    5077             :     721128U,    // VLD4LNdWB_register_Asm_32
    5078             :     721128U,    // VLD4LNdWB_register_Asm_8
    5079             :     189313284U, // VLD4LNq16
    5080             :     0U, // VLD4LNq16Pseudo
    5081             :     0U, // VLD4LNq16Pseudo_UPD
    5082             :     276U,       // VLD4LNq16_UPD
    5083             :     189313284U, // VLD4LNq32
    5084             :     0U, // VLD4LNq32Pseudo
    5085             :     0U, // VLD4LNq32Pseudo_UPD
    5086             :     276U,       // VLD4LNq32_UPD
    5087             :     2280U,      // VLD4LNqAsm_16
    5088             :     2280U,      // VLD4LNqAsm_32
    5089             :     11496U,     // VLD4LNqWB_fixed_Asm_16
    5090             :     11496U,     // VLD4LNqWB_fixed_Asm_32
    5091             :     721128U,    // VLD4LNqWB_register_Asm_16
    5092             :     721128U,    // VLD4LNqWB_register_Asm_32
    5093             :     572555264U, // VLD4d16
    5094             :     0U, // VLD4d16Pseudo
    5095             :     0U, // VLD4d16Pseudo_UPD
    5096             :     1646297088U,        // VLD4d16_UPD
    5097             :     572555264U, // VLD4d32
    5098             :     0U, // VLD4d32Pseudo
    5099             :     0U, // VLD4d32Pseudo_UPD
    5100             :     1646297088U,        // VLD4d32_UPD
    5101             :     572555264U, // VLD4d8
    5102             :     0U, // VLD4d8Pseudo
    5103             :     0U, // VLD4d8Pseudo_UPD
    5104             :     1646297088U,        // VLD4d8_UPD
    5105             :     67U,        // VLD4dAsm_16
    5106             :     67U,        // VLD4dAsm_32
    5107             :     67U,        // VLD4dAsm_8
    5108             :     211U,       // VLD4dWB_fixed_Asm_16
    5109             :     211U,       // VLD4dWB_fixed_Asm_32
    5110             :     211U,       // VLD4dWB_fixed_Asm_8
    5111             :     532515U,    // VLD4dWB_register_Asm_16
    5112             :     532515U,    // VLD4dWB_register_Asm_32
    5113             :     532515U,    // VLD4dWB_register_Asm_8
    5114             :     572555264U, // VLD4q16
    5115             :     0U, // VLD4q16Pseudo_UPD
    5116             :     1646297088U,        // VLD4q16_UPD
    5117             :     0U, // VLD4q16oddPseudo
    5118             :     0U, // VLD4q16oddPseudo_UPD
    5119             :     572555264U, // VLD4q32
    5120             :     0U, // VLD4q32Pseudo_UPD
    5121             :     1646297088U,        // VLD4q32_UPD
    5122             :     0U, // VLD4q32oddPseudo
    5123             :     0U, // VLD4q32oddPseudo_UPD
    5124             :     572555264U, // VLD4q8
    5125             :     0U, // VLD4q8Pseudo_UPD
    5126             :     1646297088U,        // VLD4q8_UPD
    5127             :     0U, // VLD4q8oddPseudo
    5128             :     0U, // VLD4q8oddPseudo_UPD
    5129             :     0U, // VLD4qAsm_16
    5130             :     0U, // VLD4qAsm_32
    5131             :     0U, // VLD4qAsm_8
    5132             :     4U, // VLD4qWB_fixed_Asm_16
    5133             :     4U, // VLD4qWB_fixed_Asm_32
    5134             :     4U, // VLD4qWB_fixed_Asm_8
    5135             :     2216U,      // VLD4qWB_register_Asm_16
    5136             :     2216U,      // VLD4qWB_register_Asm_32
    5137             :     2216U,      // VLD4qWB_register_Asm_8
    5138             :     65U,        // VLDMDDB_UPD
    5139             :     2120U,      // VLDMDIA
    5140             :     65U,        // VLDMDIA_UPD
    5141             :     0U, // VLDMQIA
    5142             :     65U,        // VLDMSDB_UPD
    5143             :     2120U,      // VLDMSIA
    5144             :     65U,        // VLDMSIA_UPD
    5145             :     280U,       // VLDRD
    5146             :     288U,       // VLDRH
    5147             :     280U,       // VLDRS
    5148             :     0U, // VLLDM
    5149             :     0U, // VLSTM
    5150             :     2072U,      // VMAXNMD
    5151             :     2072U,      // VMAXNMH
    5152             :     2072U,      // VMAXNMNDf
    5153             :     2072U,      // VMAXNMNDh
    5154             :     2072U,      // VMAXNMNQf
    5155             :     2072U,      // VMAXNMNQh
    5156             :     2072U,      // VMAXNMS
    5157             :     527392U,    // VMAXfd
    5158             :     527392U,    // VMAXfq
    5159             :     527392U,    // VMAXhd
    5160             :     527392U,    // VMAXhq
    5161             :     2072U,      // VMAXsv16i8
    5162             :     2072U,      // VMAXsv2i32
    5163             :     2072U,      // VMAXsv4i16
    5164             :     2072U,      // VMAXsv4i32
    5165             :     2072U,      // VMAXsv8i16
    5166             :     2072U,      // VMAXsv8i8
    5167             :     2072U,      // VMAXuv16i8
    5168             :     2072U,      // VMAXuv2i32
    5169             :     2072U,      // VMAXuv4i16
    5170             :     2072U,      // VMAXuv4i32
    5171             :     2072U,      // VMAXuv8i16
    5172             :     2072U,      // VMAXuv8i8
    5173             :     2072U,      // VMINNMD
    5174             :     2072U,      // VMINNMH
    5175             :     2072U,      // VMINNMNDf
    5176             :     2072U,      // VMINNMNDh
    5177             :     2072U,      // VMINNMNQf
    5178             :     2072U,      // VMINNMNQh
    5179             :     2072U,      // VMINNMS
    5180             :     527392U,    // VMINfd
    5181             :     527392U,    // VMINfq
    5182             :     527392U,    // VMINhd
    5183             :     527392U,    // VMINhq
    5184             :     2072U,      // VMINsv16i8
    5185             :     2072U,      // VMINsv2i32
    5186             :     2072U,      // VMINsv4i16
    5187             :     2072U,      // VMINsv4i32
    5188             :     2072U,      // VMINsv8i16
    5189             :     2072U,      // VMINsv8i8
    5190             :     2072U,      // VMINuv16i8
    5191             :     2072U,      // VMINuv2i32
    5192             :     2072U,      // VMINuv4i16
    5193             :     2072U,      // VMINuv4i32
    5194             :     2072U,      // VMINuv8i16
    5195             :     2072U,      // VMINuv8i8
    5196             :     532515U,    // VMLAD
    5197             :     532515U,    // VMLAH
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    5199             :     530600U,    // VMLALslsv4i16
    5200             :     530600U,    // VMLALsluv2i32
    5201             :     530600U,    // VMLALsluv4i16
    5202             :     2216U,      // VMLALsv2i64
    5203             :     2216U,      // VMLALsv4i32
    5204             :     2216U,      // VMLALsv8i16
    5205             :     2216U,      // VMLALuv2i64
    5206             :     2216U,      // VMLALuv4i32
    5207             :     2216U,      // VMLALuv8i16
    5208             :     532515U,    // VMLAS
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    5243             :     532515U,    // VMLShq
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    5245             :     925731U,    // VMLSslfq
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    5247             :     925731U,    // VMLSslhq
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    6159             :     65U,        // VSTMDDB_UPD
    6160             :     2120U,      // VSTMDIA
    6161             :     65U,        // VSTMDIA_UPD
    6162             :     0U, // VSTMQIA
    6163             :     65U,        // VSTMSDB_UPD
    6164             :     2120U,      // VSTMSIA
    6165             :     65U,        // VSTMSIA_UPD
    6166             :     280U,       // VSTRD
    6167             :     288U,       // VSTRH
    6168             :     280U,       // VSTRS
    6169             :     527392U,    // VSUBD
    6170             :     527392U,    // VSUBH
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    6206             :     0U, // VTBL4Pseudo
    6207             :     360U,       // VTBX1
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    6277             :     393U,       // sysLDMDB_UPD
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    6724             :     0U, // tBKPT
    6725             :     0U, // tBL
    6726             :     0U, // tBLXNSr
    6727             :     0U, // tBLXi
    6728             :     0U, // tBLXr
    6729             :     0U, // tBRIND
    6730             :     0U, // tBR_JTr
    6731             :     0U, // tBX
    6732             :     0U, // tBXNS
    6733             :     0U, // tBX_CALL
    6734             :     0U, // tBX_RET
    6735             :     0U, // tBX_RET_vararg
    6736             :     0U, // tBcc
    6737             :     0U, // tBfar
    6738             :     0U, // tCBNZ
    6739             :     0U, // tCBZ
    6740             :     2048U,      // tCMNz
    6741             :     2048U,      // tCMPhir
    6742             :     2048U,      // tCMPi8
    6743             :     2048U,      // tCMPr
    6744             :     0U, // tCPS
    6745             :     0U, // tEOR
    6746             :     0U, // tHINT
    6747             :     0U, // tHLT
    6748             :     0U, // tInt_WIN_eh_sjlj_longjmp
    6749             :     0U, // tInt_eh_sjlj_longjmp
    6750             :     0U, // tInt_eh_sjlj_setjmp
    6751             :     2120U,      // tLDMIA
    6752             :     0U, // tLDMIA_UPD
    6753             :     480U,       // tLDRBi
    6754             :     488U,       // tLDRBr
    6755             :     2048U,      // tLDRConstPool
    6756             :     496U,       // tLDRHi
    6757             :     488U,       // tLDRHr
    6758             :     0U, // tLDRLIT_ga_abs
    6759             :     0U, // tLDRLIT_ga_pcrel
    6760             :     488U,       // tLDRSB
    6761             :     488U,       // tLDRSH
    6762             :     0U, // tLDR_postidx
    6763             :     504U,       // tLDRi
    6764             :     424U,       // tLDRpci
    6765             :     0U, // tLDRpci_pic
    6766             :     488U,       // tLDRr
    6767             :     512U,       // tLDRspi
    6768             :     0U, // tLEApcrel
    6769             :     0U, // tLEApcrelJT
    6770             :     2216U,      // tLSLri
    6771             :     0U, // tLSLrr
    6772             :     472U,       // tLSRri
    6773             :     0U, // tLSRrr
    6774             :     0U, // tMOVCCr_pseudo
    6775             :     0U, // tMOVSr
    6776             :     0U, // tMOVi8
    6777             :     2048U,      // tMOVr
    6778             :     2216U,      // tMUL
    6779             :     0U, // tMVN
    6780             :     0U, // tORR
    6781             :     0U, // tPICADD
    6782             :     0U, // tPOP
    6783             :     0U, // tPOP_RET
    6784             :     0U, // tPUSH
    6785             :     2048U,      // tREV
    6786             :     2048U,      // tREV16
    6787             :     2048U,      // tREVSH
    6788             :     0U, // tROR
    6789             :     0U, // tRSB
    6790             :     0U, // tSBC
    6791             :     0U, // tSBCS
    6792             :     0U, // tSETEND
    6793             :     65U,        // tSTMIA_UPD
    6794             :     480U,       // tSTRBi
    6795             :     488U,       // tSTRBr
    6796             :     496U,       // tSTRHi
    6797             :     488U,       // tSTRHr
    6798             :     504U,       // tSTRi
    6799             :     488U,       // tSTRr
    6800             :     512U,       // tSTRspi
    6801             :     0U, // tSUBSi3
    6802             :     0U, // tSUBSi8
    6803             :     0U, // tSUBSrr
    6804             :     2216U,      // tSUBi3
    6805             :     0U, // tSUBi8
    6806             :     2216U,      // tSUBrr
    6807             :     456U,       // tSUBspi
    6808             :     0U, // tSVC
    6809             :     2048U,      // tSXTB
    6810             :     2048U,      // tSXTH
    6811             :     0U, // tTAILJMPd
    6812             :     0U, // tTAILJMPdND
    6813             :     0U, // tTAILJMPr
    6814             :     0U, // tTBB_JT
    6815             :     0U, // tTBH_JT
    6816             :     0U, // tTPsoft
    6817             :     0U, // tTRAP
    6818             :     2048U,      // tTST
    6819             :     0U, // tUDF
    6820             :     2048U,      // tUXTB
    6821             :     2048U,      // tUXTH
    6822             :     0U, // t__brkdiv0
    6823             :   };
    6824             : 
    6825      142925 :   O << "\t";
    6826             : 
    6827             :   // Emit the opcode for the instruction.
    6828             :   uint64_t Bits = 0;
    6829      142925 :   Bits |= (uint64_t)OpInfo0[MI->getOpcode()] << 0;
    6830      142925 :   Bits |= (uint64_t)OpInfo1[MI->getOpcode()] << 32;
    6831             :   assert(Bits != 0 && "Cannot print this instruction.");
    6832      142925 :   O << AsmStrs+(Bits & 4095)-1;
    6833             : 
    6834             : 
    6835             :   // Fragment 0 encoded into 5 bits for 31 unique commands.
    6836      142925 :   switch ((Bits >> 12) & 31) {
    6837           0 :   default: llvm_unreachable("Invalid command number.");
    6838             :   case 0:
    6839             :     // DBG_VALUE, DBG_LABEL, BUNDLE, LIFETIME_START, LIFETIME_END, FENTRY_CAL...
    6840             :     return;
    6841             :     break;
    6842       11363 :   case 1:
    6843             :     // ADCri, ADCrr, ADDri, ADDrr, ANDri, ANDrr, ASRi, ASRr, BICri, BICrr, EO...
    6844       11363 :     printSBitModifierOperand(MI, 5, STI, O);
    6845       11363 :     printPredicateOperand(MI, 3, STI, O);
    6846       11363 :     break;
    6847        1497 :   case 2:
    6848             :     // ADCrsi, ADDrsi, ANDrsi, BICrsi, EORrsi, MLA, MOVsr, MVNsr, ORRrsi, RSB...
    6849        1497 :     printSBitModifierOperand(MI, 6, STI, O);
    6850        1497 :     printPredicateOperand(MI, 4, STI, O);
    6851        1497 :     break;
    6852         278 :   case 3:
    6853             :     // ADCrsr, ADDrsr, ANDrsr, BICrsr, EORrsr, ORRrsr, RSBrsr, RSCrsr, SBCrsr...
    6854         278 :     printSBitModifierOperand(MI, 7, STI, O);
    6855         278 :     printPredicateOperand(MI, 5, STI, O);
    6856         278 :     O << "\t";
    6857         278 :     printOperand(MI, 0, STI, O);
    6858         278 :     O << ", ";
    6859         278 :     printOperand(MI, 1, STI, O);
    6860         278 :     O << ", ";
    6861         278 :     printSORegRegOperand(MI, 2, STI, O);
    6862         278 :     return;
    6863             :     break;
    6864       22672 :   case 4:
    6865             :     // ADR, CLZ, CMNri, CMNzrr, CMPri, CMPrr, FCONSTD, FCONSTH, FCONSTS, FLDM...
    6866       22672 :     printPredicateOperand(MI, 2, STI, O);
    6867       22672 :     break;
    6868        6123 :   case 5:
    6869             :     // AESD, AESE, AESIMC, AESMC, BKPT, BL, BLX, BLXi, BX, CPS1p, CRC32B, CRC...
    6870        6123 :     printOperand(MI, 0, STI, O);
    6871        6123 :     break;
    6872       43613 :   case 6:
    6873             :     // BFC, CMNzrsi, CMPrsi, LDRBi12, LDRcp, LDRi12, MOVTi16, QADD, QADD16, Q...
    6874       43613 :     printPredicateOperand(MI, 3, STI, O);
    6875       43613 :     break;
    6876        8047 :   case 7:
    6877             :     // BFI, CMNzrsr, CMPrsr, LDCL_OFFSET, LDCL_OPTION, LDCL_POST, LDCL_PRE, L...
    6878        8047 :     printPredicateOperand(MI, 4, STI, O);
    6879        8047 :     break;
    6880        9294 :   case 8:
    6881             :     // BLX_pred, BL_pred, BXJ, BX_pred, Bcc, DBG, FLDMXIA, FSTMXIA, HINT, LDM...
    6882        9294 :     printPredicateOperand(MI, 1, STI, O);
    6883        9294 :     break;
    6884       13165 :   case 9:
    6885             :     // BX_RET, ERET, FMSTAT, MOVPCLR, t2CLREX, t2DCPS1, t2DCPS2, t2DCPS3, t2S...
    6886       13165 :     printPredicateOperand(MI, 0, STI, O);
    6887       13165 :     break;
    6888         702 :   case 10:
    6889             :     // CDP, LDRD_POST, LDRD_PRE, MCR, MRC, SMLALBB, SMLALBT, SMLALD, SMLALDX,...
    6890         702 :     printPredicateOperand(MI, 6, STI, O);
    6891         702 :     break;
    6892         101 :   case 11:
    6893             :     // CDP2, LDC2L_OFFSET, LDC2L_OPTION, LDC2L_POST, LDC2L_PRE, LDC2_OFFSET, ...
    6894         101 :     printPImmediate(MI, 0, STI, O);
    6895         101 :     O << ", ";
    6896         101 :     break;
    6897          51 :   case 12:
    6898             :     // CPS2p, CPS3p, t2CPS2p, t2CPS3p, tCPS
    6899          51 :     printCPSIMod(MI, 0, STI, O);
    6900          51 :     break;
    6901         312 :   case 13:
    6902             :     // DMB, DSB
    6903         312 :     printMemBOption(MI, 0, STI, O);
    6904         312 :     return;
    6905             :     break;
    6906          13 :   case 14:
    6907             :     // ISB
    6908          13 :     printInstSyncBOption(MI, 0, STI, O);
    6909          13 :     return;
    6910             :     break;
    6911        3674 :   case 15:
    6912             :     // ITasm, t2IT
    6913        3674 :     printThumbITMask(MI, 1, STI, O);
    6914        3674 :     break;
    6915        3447 :   case 16:
    6916             :     // LDRBT_POST_IMM, LDRBT_POST_REG, LDRB_POST_IMM, LDRB_POST_REG, LDRB_PRE...
    6917        3447 :     printPredicateOperand(MI, 5, STI, O);
    6918        3447 :     break;
    6919        8899 :   case 17:
    6920             :     // MOVi, MOVr, MOVr_TC, MVNi, MVNr, RRXi, t2MOVi, t2MOVr, t2MVNi, t2MVNr,...
    6921        8899 :     printSBitModifierOperand(MI, 4, STI, O);
    6922        8899 :     printPredicateOperand(MI, 2, STI, O);
    6923        8899 :     break;
    6924          10 :   case 18:
    6925             :     // MRC2
    6926          10 :     printPImmediate(MI, 1, STI, O);
    6927          10 :     O << ", ";
    6928          10 :     printOperand(MI, 2, STI, O);
    6929          10 :     O << ", ";
    6930          10 :     printOperand(MI, 0, STI, O);
    6931          10 :     O << ", ";
    6932          10 :     printCImmediate(MI, 3, STI, O);
    6933          10 :     O << ", ";
    6934          10 :     printCImmediate(MI, 4, STI, O);
    6935          10 :     O << ", ";
    6936          10 :     printOperand(MI, 5, STI, O);
    6937          10 :     return;
    6938             :     break;
    6939           8 :   case 19:
    6940             :     // MRRC2
    6941           8 :     printPImmediate(MI, 2, STI, O);
    6942           8 :     O << ", ";
    6943           8 :     printOperand(MI, 3, STI, O);
    6944           8 :     O << ", ";
    6945           8 :     printOperand(MI, 0, STI, O);
    6946           8 :     O << ", ";
    6947           8 :     printOperand(MI, 1, STI, O);
    6948           8 :     O << ", ";
    6949           8 :     printCImmediate(MI, 4, STI, O);
    6950           8 :     return;
    6951             :     break;
    6952          15 :   case 20:
    6953             :     // PLDWi12, PLDi12, PLIi12
    6954          15 :     printAddrModeImm12Operand<false>(MI, 0, STI, O);
    6955          15 :     return;
    6956             :     break;
    6957          14 :   case 21:
    6958             :     // PLDWrs, PLDrs, PLIrs
    6959          14 :     printAddrMode2Operand(MI, 0, STI, O);
    6960          14 :     return;
    6961             :     break;
    6962          28 :   case 22:
    6963             :     // SETEND, tSETEND
    6964          28 :     printSetendOperand(MI, 0, STI, O);
    6965          28 :     return;
    6966             :     break;
    6967          65 :   case 23:
    6968             :     // SMLAL, UMLAL
    6969          65 :     printSBitModifierOperand(MI, 8, STI, O);
    6970          65 :     printPredicateOperand(MI, 6, STI, O);
    6971          65 :     O << "\t";
    6972          65 :     printOperand(MI, 0, STI, O);
    6973          65 :     O << ", ";
    6974          65 :     printOperand(MI, 1, STI, O);
    6975          65 :     O << ", ";
    6976          65 :     printOperand(MI, 2, STI, O);
    6977          65 :     O << ", ";
    6978          65 :     printOperand(MI, 3, STI, O);
    6979          65 :     return;
    6980             :     break;
    6981         351 :   case 24:
    6982             :     // VLD1LNd16_UPD, VLD1LNd32_UPD, VLD1LNd8_UPD, VLD2LNd16, VLD2LNd32, VLD2...
    6983         351 :     printPredicateOperand(MI, 7, STI, O);
    6984         351 :     break;
    6985         121 :   case 25:
    6986             :     // VLD2LNd16_UPD, VLD2LNd32_UPD, VLD2LNd8_UPD, VLD2LNq16_UPD, VLD2LNq32_U...
    6987         121 :     printPredicateOperand(MI, 9, STI, O);
    6988         121 :     break;
    6989          69 :   case 26:
    6990             :     // VLD3LNd16_UPD, VLD3LNd32_UPD, VLD3LNd8_UPD, VLD3LNq16_UPD, VLD3LNq32_U...
    6991          69 :     printPredicateOperand(MI, 11, STI, O);
    6992          69 :     break;
    6993         279 :   case 27:
    6994             :     // VLD4DUPd16_UPD, VLD4DUPd32_UPD, VLD4DUPd8_UPD, VLD4DUPq16_UPD, VLD4DUP...
    6995         279 :     printPredicateOperand(MI, 8, STI, O);
    6996         279 :     break;
    6997          39 :   case 28:
    6998             :     // VLD4LNd16_UPD, VLD4LNd32_UPD, VLD4LNd8_UPD, VLD4LNq16_UPD, VLD4LNq32_U...
    6999          39 :     printPredicateOperand(MI, 13, STI, O);
    7000          39 :     break;
    7001          72 :   case 29:
    7002             :     // VSDOTD, VSDOTDI, VSDOTQ, VSDOTQI, VUDOTD, VUDOTDI, VUDOTQ, VUDOTQI
    7003          72 :     printOperand(MI, 1, STI, O);
    7004          72 :     O << ", ";
    7005          72 :     printOperand(MI, 2, STI, O);
    7006          72 :     O << ", ";
    7007          72 :     printOperand(MI, 3, STI, O);
    7008          72 :     break;
    7009        8264 :   case 30:
    7010             :     // tADC, tADDi3, tADDi8, tADDrr, tAND, tASRri, tASRrr, tBIC, tEOR, tLSLri...
    7011        8264 :     printSBitModifierOperand(MI, 1, STI, O);
    7012        8264 :     break;
    7013             :   }
    7014             : 
    7015             : 
    7016             :   // Fragment 1 encoded into 7 bits for 75 unique commands.
    7017      141843 :   switch ((Bits >> 17) & 127) {
    7018           0 :   default: llvm_unreachable("Invalid command number.");
    7019       90753 :   case 0:
    7020             :     // ADCri, ADCrr, ADCrsi, ADDri, ADDrr, ADDrsi, ADR, ANDri, ANDrr, ANDrsi,...
    7021       90753 :     O << "\t";
    7022       90753 :     break;
    7023        2084 :   case 1:
    7024             :     // AESD, AESE, AESIMC, AESMC, CRC32B, CRC32CB, CRC32CH, CRC32CW, CRC32H, ...
    7025        2084 :     O << ", ";
    7026        2084 :     break;
    7027             :   case 2:
    7028             :     // ASRi, ASRr, ITasm, LDRBT_POST, LDRConstPool, LDRT_POST, LSLi, LSLr, LS...
    7029             :     O << ' ';
    7030             :     break;
    7031             :   case 3:
    7032             :     // BKPT, BL, BLX, BLXi, BX, CPS1p, ERET, HLT, HVC, RFEDA, RFEDB, RFEIA, R...
    7033             :     return;
    7034             :     break;
    7035        3244 :   case 4:
    7036             :     // BX_RET
    7037        3244 :     O << "\tlr";
    7038        3244 :     return;
    7039             :     break;
    7040          31 :   case 5:
    7041             :     // CDP2, MCR2, MCRR2
    7042          31 :     printOperand(MI, 1, STI, O);
    7043          31 :     O << ", ";
    7044          31 :     break;
    7045        1987 :   case 6:
    7046             :     // FCONSTD, VABSD, VADDD, VCMPD, VCMPED, VCMPEZD, VCMPZD, VDIVD, VFMAD, V...
    7047        1987 :     O << ".f64\t";
    7048        1987 :     printOperand(MI, 0, STI, O);
    7049        1987 :     break;
    7050        1256 :   case 7:
    7051             :     // FCONSTH, VABDhd, VABDhq, VABSH, VABShd, VABShq, VACGEhd, VACGEhq, VACG...
    7052        1256 :     O << ".f16\t";
    7053        1256 :     printOperand(MI, 0, STI, O);
    7054        1256 :     break;
    7055        4032 :   case 8:
    7056             :     // FCONSTS, VABDfd, VABDfq, VABSS, VABSfd, VABSfq, VACGEfd, VACGEfq, VACG...
    7057        4032 :     O << ".f32\t";
    7058        4032 :     printOperand(MI, 0, STI, O);
    7059        4032 :     break;
    7060         635 :   case 9:
    7061             :     // FMSTAT
    7062         635 :     O << "\tAPSR_nzcv, fpscr";
    7063         635 :     return;
    7064             :     break;
    7065          70 :   case 10:
    7066             :     // LDC2L_OFFSET, LDC2L_OPTION, LDC2L_POST, LDC2L_PRE, LDC2_OFFSET, LDC2_O...
    7067          70 :     printCImmediate(MI, 1, STI, O);
    7068          70 :     O << ", ";
    7069          70 :     break;
    7070        3231 :   case 11:
    7071             :     // MOVPCLR
    7072        3231 :     O << "\tpc, lr";
    7073        3231 :     return;
    7074             :     break;
    7075             :   case 12:
    7076             :     // RFEDA_UPD, RFEDB_UPD, RFEIA_UPD, RFEIB_UPD
    7077             :     O << '!';
    7078             :     return;
    7079             :     break;
    7080         537 :   case 13:
    7081             :     // VABALsv2i64, VABAsv2i32, VABAsv4i32, VABDLsv2i64, VABDsv2i32, VABDsv4i...
    7082         537 :     O << ".s32\t";
    7083         537 :     printOperand(MI, 0, STI, O);
    7084         537 :     O << ", ";
    7085         537 :     break;
    7086         601 :   case 14:
    7087             :     // VABALsv4i32, VABAsv4i16, VABAsv8i16, VABDLsv4i32, VABDsv4i16, VABDsv8i...
    7088         601 :     O << ".s16\t";
    7089         601 :     printOperand(MI, 0, STI, O);
    7090         601 :     O << ", ";
    7091         601 :     break;
    7092         449 :   case 15:
    7093             :     // VABALsv8i16, VABAsv16i8, VABAsv8i8, VABDLsv8i16, VABDsv16i8, VABDsv8i8...
    7094         449 :     O << ".s8\t";
    7095         449 :     printOperand(MI, 0, STI, O);
    7096         449 :     O << ", ";
    7097         449 :     break;
    7098         388 :   case 16:
    7099             :     // VABALuv2i64, VABAuv2i32, VABAuv4i32, VABDLuv2i64, VABDuv2i32, VABDuv4i...
    7100         388 :     O << ".u32\t";
    7101         388 :     printOperand(MI, 0, STI, O);
    7102         388 :     O << ", ";
    7103         388 :     break;
    7104         462 :   case 17:
    7105             :     // VABALuv4i32, VABAuv4i16, VABAuv8i16, VABDLuv4i32, VABDuv4i16, VABDuv8i...
    7106         462 :     O << ".u16\t";
    7107         462 :     printOperand(MI, 0, STI, O);
    7108         462 :     O << ", ";
    7109         462 :     break;
    7110         404 :   case 18:
    7111             :     // VABALuv8i16, VABAuv16i8, VABAuv8i8, VABDLuv8i16, VABDuv16i8, VABDuv8i8...
    7112         404 :     O << ".u8\t";
    7113         404 :     printOperand(MI, 0, STI, O);
    7114         404 :     O << ", ";
    7115         404 :     break;
    7116         220 :   case 19:
    7117             :     // VADDHNv2i32, VADDv1i64, VADDv2i64, VMOVNv2i32, VMOVv1i64, VMOVv2i64, V...
    7118         220 :     O << ".i64\t";
    7119         220 :     printOperand(MI, 0, STI, O);
    7120         220 :     O << ", ";
    7121         220 :     break;
    7122         729 :   case 20:
    7123             :     // VADDHNv4i16, VADDv2i32, VADDv4i32, VBICiv2i32, VBICiv4i32, VCEQv2i32, ...
    7124         729 :     O << ".i32\t";
    7125         729 :     printOperand(MI, 0, STI, O);
    7126         729 :     O << ", ";
    7127         729 :     break;
    7128         439 :   case 21:
    7129             :     // VADDHNv8i8, VADDv4i16, VADDv8i16, VBICiv4i16, VBICiv8i16, VCEQv4i16, V...
    7130         439 :     O << ".i16\t";
    7131         439 :     printOperand(MI, 0, STI, O);
    7132         439 :     O << ", ";
    7133         439 :     break;
    7134         341 :   case 22:
    7135             :     // VADDv16i8, VADDv8i8, VCEQv16i8, VCEQv8i8, VCEQzv16i8, VCEQzv8i8, VCLZv...
    7136         341 :     O << ".i8\t";
    7137         341 :     printOperand(MI, 0, STI, O);
    7138         341 :     O << ", ";
    7139         341 :     break;
    7140        1147 :   case 23:
    7141             :     // VCNTd, VCNTq, VDUP8d, VDUP8q, VDUPLN8d, VDUPLN8q, VEXTd8, VEXTq8, VLD1...
    7142        1147 :     O << ".8\t";
    7143        1147 :     break;
    7144          33 :   case 24:
    7145             :     // VCVTBDH, VCVTTDH
    7146          33 :     O << ".f16.f64\t";
    7147          33 :     printOperand(MI, 0, STI, O);
    7148          33 :     O << ", ";
    7149          33 :     printOperand(MI, 1, STI, O);
    7150          33 :     return;
    7151             :     break;
    7152          34 :   case 25:
    7153             :     // VCVTBHD, VCVTTHD
    7154          34 :     O << ".f64.f16\t";
    7155          34 :     printOperand(MI, 0, STI, O);
    7156          34 :     O << ", ";
    7157          34 :     printOperand(MI, 1, STI, O);
    7158          34 :     return;
    7159             :     break;
    7160         298 :   case 26:
    7161             :     // VCVTBHS, VCVTTHS, VCVTh2f
    7162         298 :     O << ".f32.f16\t";
    7163         298 :     printOperand(MI, 0, STI, O);
    7164         298 :     O << ", ";
    7165         298 :     printOperand(MI, 1, STI, O);
    7166         298 :     return;
    7167             :     break;
    7168         148 :   case 27:
    7169             :     // VCVTBSH, VCVTTSH, VCVTf2h
    7170         148 :     O << ".f16.f32\t";
    7171         148 :     printOperand(MI, 0, STI, O);
    7172         148 :     O << ", ";
    7173         148 :     printOperand(MI, 1, STI, O);
    7174         148 :     return;
    7175             :     break;
    7176          78 :   case 28:
    7177             :     // VCVTDS
    7178          78 :     O << ".f64.f32\t";
    7179          78 :     printOperand(MI, 0, STI, O);
    7180          78 :     O << ", ";
    7181          78 :     printOperand(MI, 1, STI, O);
    7182          78 :     return;
    7183             :     break;
    7184          30 :   case 29:
    7185             :     // VCVTSD
    7186          30 :     O << ".f32.f64\t";
    7187          30 :     printOperand(MI, 0, STI, O);
    7188          30 :     O << ", ";
    7189          30 :     printOperand(MI, 1, STI, O);
    7190          30 :     return;
    7191             :     break;
    7192          97 :   case 30:
    7193             :     // VCVTf2sd, VCVTf2sq, VCVTf2xsd, VCVTf2xsq, VTOSIRS, VTOSIZS, VTOSLS
    7194          97 :     O << ".s32.f32\t";
    7195          97 :     printOperand(MI, 0, STI, O);
    7196          97 :     O << ", ";
    7197          97 :     printOperand(MI, 1, STI, O);
    7198          97 :     break;
    7199          79 :   case 31:
    7200             :     // VCVTf2ud, VCVTf2uq, VCVTf2xud, VCVTf2xuq, VTOUIRS, VTOUIZS, VTOULS
    7201          79 :     O << ".u32.f32\t";
    7202          79 :     printOperand(MI, 0, STI, O);
    7203          79 :     O << ", ";
    7204          79 :     printOperand(MI, 1, STI, O);
    7205          79 :     break;
    7206          20 :   case 32:
    7207             :     // VCVTh2sd, VCVTh2sq, VCVTh2xsd, VCVTh2xsq, VTOSHH
    7208          20 :     O << ".s16.f16\t";
    7209          20 :     printOperand(MI, 0, STI, O);
    7210          20 :     O << ", ";
    7211          20 :     printOperand(MI, 1, STI, O);
    7212          20 :     break;
    7213          20 :   case 33:
    7214             :     // VCVTh2ud, VCVTh2uq, VCVTh2xud, VCVTh2xuq, VTOUHH
    7215          20 :     O << ".u16.f16\t";
    7216          20 :     printOperand(MI, 0, STI, O);
    7217          20 :     O << ", ";
    7218          20 :     printOperand(MI, 1, STI, O);
    7219          20 :     break;
    7220         124 :   case 34:
    7221             :     // VCVTs2fd, VCVTs2fq, VCVTxs2fd, VCVTxs2fq, VSITOS, VSLTOS
    7222         124 :     O << ".f32.s32\t";
    7223         124 :     printOperand(MI, 0, STI, O);
    7224         124 :     O << ", ";
    7225         124 :     printOperand(MI, 1, STI, O);
    7226         124 :     break;
    7227          20 :   case 35:
    7228             :     // VCVTs2hd, VCVTs2hq, VCVTxs2hd, VCVTxs2hq, VSHTOH
    7229          20 :     O << ".f16.s16\t";
    7230          20 :     printOperand(MI, 0, STI, O);
    7231          20 :     O << ", ";
    7232          20 :     printOperand(MI, 1, STI, O);
    7233          20 :     break;
    7234          85 :   case 36:
    7235             :     // VCVTu2fd, VCVTu2fq, VCVTxu2fd, VCVTxu2fq, VUITOS, VULTOS
    7236          85 :     O << ".f32.u32\t";
    7237          85 :     printOperand(MI, 0, STI, O);
    7238          85 :     O << ", ";
    7239          85 :     printOperand(MI, 1, STI, O);
    7240          85 :     break;
    7241          20 :   case 37:
    7242             :     // VCVTu2hd, VCVTu2hq, VCVTxu2hd, VCVTxu2hq, VUHTOH
    7243          20 :     O << ".f16.u16\t";
    7244          20 :     printOperand(MI, 0, STI, O);
    7245          20 :     O << ", ";
    7246          20 :     printOperand(MI, 1, STI, O);
    7247          20 :     break;
    7248        1349 :   case 38:
    7249             :     // VDUP16d, VDUP16q, VDUPLN16d, VDUPLN16q, VEXTd16, VEXTq16, VLD1DUPd16, ...
    7250        1349 :     O << ".16\t";
    7251        1349 :     break;
    7252        2153 :   case 39:
    7253             :     // VDUP32d, VDUP32q, VDUPLN32d, VDUPLN32q, VEXTd32, VEXTq32, VGETLNi32, V...
    7254        2153 :     O << ".32\t";
    7255        2153 :     break;
    7256        3511 :   case 40:
    7257             :     // VEXTq64, VLD1d64, VLD1d64Q, VLD1d64Qwb_fixed, VLD1d64Qwb_register, VLD...
    7258        3511 :     O << ".64\t";
    7259        3511 :     break;
    7260          46 :   case 41:
    7261             :     // VJCVT, VTOSIRD, VTOSIZD, VTOSLD
    7262          46 :     O << ".s32.f64\t";
    7263          46 :     printOperand(MI, 0, STI, O);
    7264          46 :     O << ", ";
    7265          46 :     printOperand(MI, 1, STI, O);
    7266          46 :     break;
    7267         448 :   case 42:
    7268             :     // VLD1LNd16, VLD1LNd16_UPD, VLD2LNd16, VLD2LNd16_UPD, VLD2LNq16, VLD2LNq...
    7269         448 :     O << ".16\t{";
    7270         448 :     break;
    7271         688 :   case 43:
    7272             :     // VLD1LNd32, VLD1LNd32_UPD, VLD2LNd32, VLD2LNd32_UPD, VLD2LNq32, VLD2LNq...
    7273         688 :     O << ".32\t{";
    7274         688 :     break;
    7275         378 :   case 44:
    7276             :     // VLD1LNd8, VLD1LNd8_UPD, VLD2LNd8, VLD2LNd8_UPD, VLD3DUPd8, VLD3DUPd8_U...
    7277         378 :     O << ".8\t{";
    7278         378 :     break;
    7279          58 :   case 45:
    7280             :     // VMSR
    7281          58 :     O << "\tfpscr, ";
    7282          58 :     printOperand(MI, 0, STI, O);
    7283          58 :     return;
    7284             :     break;
    7285          16 :   case 46:
    7286             :     // VMSR_FPEXC
    7287          16 :     O << "\tfpexc, ";
    7288          16 :     printOperand(MI, 0, STI, O);
    7289          16 :     return;
    7290             :     break;
    7291           2 :   case 47:
    7292             :     // VMSR_FPINST
    7293           2 :     O << "\tfpinst, ";
    7294           2 :     printOperand(MI, 0, STI, O);
    7295           2 :     return;
    7296             :     break;
    7297           2 :   case 48:
    7298             :     // VMSR_FPINST2
    7299           2 :     O << "\tfpinst2, ";
    7300           2 :     printOperand(MI, 0, STI, O);
    7301           2 :     return;
    7302             :     break;
    7303          20 :   case 49:
    7304             :     // VMSR_FPSID
    7305          20 :     O << "\tfpsid, ";
    7306          20 :     printOperand(MI, 0, STI, O);
    7307          20 :     return;
    7308             :     break;
    7309          19 :   case 50:
    7310             :     // VMULLp8, VMULpd, VMULpq
    7311          19 :     O << ".p8\t";
    7312          19 :     printOperand(MI, 0, STI, O);
    7313          19 :     O << ", ";
    7314          19 :     printOperand(MI, 1, STI, O);
    7315          19 :     O << ", ";
    7316          19 :     printOperand(MI, 2, STI, O);
    7317          19 :     return;
    7318             :     break;
    7319         172 :   case 51:
    7320             :     // VQADDsv1i64, VQADDsv2i64, VQMOVNsuv2i32, VQMOVNsv2i32, VQRSHLsv1i64, V...
    7321         172 :     O << ".s64\t";
    7322         172 :     printOperand(MI, 0, STI, O);
    7323         172 :     O << ", ";
    7324         172 :     break;
    7325         162 :   case 52:
    7326             :     // VQADDuv1i64, VQADDuv2i64, VQMOVNuv2i32, VQRSHLuv1i64, VQRSHLuv2i64, VQ...
    7327         162 :     O << ".u64\t";
    7328         162 :     printOperand(MI, 0, STI, O);
    7329         162 :     O << ", ";
    7330         162 :     break;
    7331          36 :   case 53:
    7332             :     // VSDOTDI, VSDOTQI, VUDOTDI, VUDOTQI
    7333          36 :     printVectorIndex(MI, 4, STI, O);
    7334          36 :     return;
    7335             :     break;
    7336           1 :   case 54:
    7337             :     // VSHTOD
    7338           1 :     O << ".f64.s16\t";
    7339           1 :     printOperand(MI, 0, STI, O);
    7340           1 :     O << ", ";
    7341           1 :     printOperand(MI, 1, STI, O);
    7342           1 :     O << ", ";
    7343           1 :     printFBits16(MI, 2, STI, O);
    7344           1 :     return;
    7345             :     break;
    7346           1 :   case 55:
    7347             :     // VSHTOS
    7348           1 :     O << ".f32.s16\t";
    7349           1 :     printOperand(MI, 0, STI, O);
    7350           1 :     O << ", ";
    7351           1 :     printOperand(MI, 1, STI, O);
    7352           1 :     O << ", ";
    7353           1 :     printFBits16(MI, 2, STI, O);
    7354           1 :     return;
    7355             :     break;
    7356          46 :   case 56:
    7357             :     // VSITOD, VSLTOD
    7358          46 :     O << ".f64.s32\t";
    7359          46 :     printOperand(MI, 0, STI, O);
    7360          46 :     O << ", ";
    7361          46 :     printOperand(MI, 1, STI, O);
    7362          46 :     break;
    7363          16 :   case 57:
    7364             :     // VSITOH, VSLTOH
    7365          16 :     O << ".f16.s32\t";
    7366          16 :     printOperand(MI, 0, STI, O);
    7367          16 :     O << ", ";
    7368          16 :     printOperand(MI, 1, STI, O);
    7369          16 :     break;
    7370           1 :   case 58:
    7371             :     // VTOSHD
    7372           1 :     O << ".s16.f64\t";
    7373           1 :     printOperand(MI, 0, STI, O);
    7374           1 :     O << ", ";
    7375           1 :     printOperand(MI, 1, STI, O);
    7376           1 :     O << ", ";
    7377           1 :     printFBits16(MI, 2, STI, O);
    7378           1 :     return;
    7379             :     break;
    7380           1 :   case 59:
    7381             :     // VTOSHS
    7382           1 :     O << ".s16.f32\t";
    7383           1 :     printOperand(MI, 0, STI, O);
    7384           1 :     O << ", ";
    7385           1 :     printOperand(MI, 1, STI, O);
    7386           1 :     O << ", ";
    7387           1 :     printFBits16(MI, 2, STI, O);
    7388           1 :     return;
    7389             :     break;
    7390          20 :   case 60:
    7391             :     // VTOSIRH, VTOSIZH, VTOSLH
    7392          20 :     O << ".s32.f16\t";
    7393          20 :     printOperand(MI, 0, STI, O);
    7394          20 :     O << ", ";
    7395          20 :     printOperand(MI, 1, STI, O);
    7396          20 :     break;
    7397           1 :   case 61:
    7398             :     // VTOUHD
    7399           1 :     O << ".u16.f64\t";
    7400           1 :     printOperand(MI, 0, STI, O);
    7401           1 :     O << ", ";
    7402           1 :     printOperand(MI, 1, STI, O);
    7403           1 :     O << ", ";
    7404           1 :     printFBits16(MI, 2, STI, O);
    7405           1 :     return;
    7406             :     break;
    7407           1 :   case 62:
    7408             :     // VTOUHS
    7409           1 :     O << ".u16.f32\t";
    7410           1 :     printOperand(MI, 0, STI, O);
    7411           1 :     O << ", ";
    7412           1 :     printOperand(MI, 1, STI, O);
    7413           1 :     O << ", ";
    7414           1 :     printFBits16(MI, 2, STI, O);
    7415           1 :     return;
    7416             :     break;
    7417          33 :   case 63:
    7418             :     // VTOUIRD, VTOUIZD, VTOULD
    7419          33 :     O << ".u32.f64\t";
    7420          33 :     printOperand(MI, 0, STI, O);
    7421          33 :     O << ", ";
    7422          33 :     printOperand(MI, 1, STI, O);
    7423          33 :     break;
    7424          20 :   case 64:
    7425             :     // VTOUIRH, VTOUIZH, VTOULH
    7426          20 :     O << ".u32.f16\t";
    7427          20 :     printOperand(MI, 0, STI, O);
    7428          20 :     O << ", ";
    7429          20 :     printOperand(MI, 1, STI, O);
    7430          20 :     break;
    7431           1 :   case 65:
    7432             :     // VUHTOD
    7433           1 :     O << ".f64.u16\t";
    7434           1 :     printOperand(MI, 0, STI, O);
    7435           1 :     O << ", ";
    7436           1 :     printOperand(MI, 1, STI, O);
    7437           1 :     O << ", ";
    7438           1 :     printFBits16(MI, 2, STI, O);
    7439           1 :     return;
    7440             :     break;
    7441           1 :   case 66:
    7442             :     // VUHTOS
    7443           1 :     O << ".f32.u16\t";
    7444           1 :     printOperand(MI, 0, STI, O);
    7445           1 :     O << ", ";
    7446           1 :     printOperand(MI, 1, STI, O);
    7447           1 :     O << ", ";
    7448           1 :     printFBits16(MI, 2, STI, O);
    7449           1 :     return;
    7450             :     break;
    7451          30 :   case 67:
    7452             :     // VUITOD, VULTOD
    7453          30 :     O << ".f64.u32\t";
    7454          30 :     printOperand(MI, 0, STI, O);
    7455          30 :     O << ", ";
    7456          30 :     printOperand(MI, 1, STI, O);
    7457          30 :     break;
    7458          16 :   case 68:
    7459             :     // VUITOH, VULTOH
    7460          16 :     O << ".f16.u32\t";
    7461          16 :     printOperand(MI, 0, STI, O);
    7462          16 :     O << ", ";
    7463          16 :     printOperand(MI, 1, STI, O);
    7464          16 :     break;
    7465        5978 :   case 69:
    7466             :     // t2ADCrr, t2ADCrs, t2ADDri, t2ADDrr, t2ADDrs, t2ADR, t2ANDrr, t2ANDrs, ...
    7467        5978 :     O << ".w\t";
    7468        5978 :     break;
    7469          20 :   case 70:
    7470             :     // t2SRSDB, t2SRSIA
    7471          20 :     O << "\tsp, ";
    7472          20 :     printOperand(MI, 0, STI, O);
    7473          20 :     return;
    7474             :     break;
    7475          20 :   case 71:
    7476             :     // t2SRSDB_UPD, t2SRSIA_UPD
    7477          20 :     O << "\tsp!, ";
    7478          20 :     printOperand(MI, 0, STI, O);
    7479          20 :     return;
    7480             :     break;
    7481          22 :   case 72:
    7482             :     // t2SUBS_PC_LR
    7483          22 :     O << "\tpc, lr, ";
    7484          22 :     printOperand(MI, 0, STI, O);
    7485          22 :     return;
    7486             :     break;
    7487        5788 :   case 73:
    7488             :     // tADC, tADDi3, tADDi8, tADDrr, tAND, tASRri, tASRrr, tBIC, tEOR, tLSLri...
    7489        5788 :     printPredicateOperand(MI, 4, STI, O);
    7490        5788 :     O << "\t";
    7491        5788 :     printOperand(MI, 0, STI, O);
    7492        5788 :     O << ", ";
    7493        5788 :     break;
    7494        2476 :   case 74:
    7495             :     // tMOVi8, tMVN, tRSB
    7496        2476 :     printPredicateOperand(MI, 3, STI, O);
    7497        2476 :     O << "\t";
    7498        2476 :     printOperand(MI, 0, STI, O);
    7499        2476 :     O << ", ";
    7500        2476 :     printOperand(MI, 2, STI, O);
    7501        2476 :     break;
    7502             :   }
    7503             : 
    7504             : 
    7505             :   // Fragment 2 encoded into 6 bits for 59 unique commands.
    7506      129743 :   switch ((Bits >> 24) & 63) {
    7507           0 :   default: llvm_unreachable("Invalid command number.");
    7508       86343 :   case 0:
    7509             :     // ADCri, ADCrr, ADCrsi, ADDri, ADDrr, ADDrsi, ADR, ANDri, ANDrr, ANDrsi,...
    7510       86343 :     printOperand(MI, 0, STI, O);
    7511       86343 :     break;
    7512        6261 :   case 1:
    7513             :     // AESD, AESE, MCR2, MCRR2, SHA1C, SHA1M, SHA1P, SHA1SU0, SHA1SU1, SHA256...
    7514        6261 :     printOperand(MI, 2, STI, O);
    7515        6261 :     break;
    7516        7954 :   case 2:
    7517             :     // AESIMC, AESMC, CRC32B, CRC32CB, CRC32CH, CRC32CW, CRC32H, CRC32W, FLDM...
    7518        7954 :     printOperand(MI, 1, STI, O);
    7519        7954 :     break;
    7520         850 :   case 3:
    7521             :     // CDP, LDCL_OFFSET, LDCL_OPTION, LDCL_POST, LDCL_PRE, LDC_OFFSET, LDC_OP...
    7522         850 :     printPImmediate(MI, 0, STI, O);
    7523         850 :     O << ", ";
    7524         850 :     break;
    7525          14 :   case 4:
    7526             :     // CDP2
    7527          14 :     printCImmediate(MI, 2, STI, O);
    7528          14 :     O << ", ";
    7529          14 :     printCImmediate(MI, 3, STI, O);
    7530          14 :     O << ", ";
    7531          14 :     printCImmediate(MI, 4, STI, O);
    7532          14 :     O << ", ";
    7533          14 :     printOperand(MI, 5, STI, O);
    7534          14 :     return;
    7535             :     break;
    7536          51 :   case 5:
    7537             :     // CPS2p, CPS3p, t2CPS2p, t2CPS3p, tCPS
    7538          51 :     printCPSIFlag(MI, 1, STI, O);
    7539          51 :     break;
    7540        7313 :   case 6:
    7541             :     // FCONSTD, FCONSTH, FCONSTS, VABDfd, VABDfq, VABDhd, VABDhq, VABSD, VABS...
    7542        7313 :     O << ", ";
    7543        7313 :     break;
    7544        3674 :   case 7:
    7545             :     // ITasm, t2IT
    7546        3674 :     printMandatoryPredicateOperand(MI, 0, STI, O);
    7547        3674 :     return;
    7548             :     break;
    7549          97 :   case 8:
    7550             :     // LDAEXD, LDREXD
    7551          97 :     printGPRPairOperand(MI, 0, STI, O);
    7552          97 :     O << ", ";
    7553          97 :     printAddrMode7Operand(MI, 1, STI, O);
    7554          97 :     return;
    7555             :     break;
    7556          28 :   case 9:
    7557             :     // LDC2L_OFFSET, LDC2_OFFSET, STC2L_OFFSET, STC2_OFFSET
    7558          28 :     printAddrMode5Operand<false>(MI, 2, STI, O);
    7559          28 :     return;
    7560             :     break;
    7561          34 :   case 10:
    7562             :     // LDC2L_OPTION, LDC2L_POST, LDC2_OPTION, LDC2_POST, STC2L_OPTION, STC2L_...
    7563          34 :     printAddrMode7Operand(MI, 2, STI, O);
    7564          34 :     O << ", ";
    7565          34 :     break;
    7566           8 :   case 11:
    7567             :     // LDC2L_PRE, LDC2_PRE, STC2L_PRE, STC2_PRE
    7568           8 :     printAddrMode5Operand<true>(MI, 2, STI, O);
    7569             :     O << '!';
    7570             :     return;
    7571             :     break;
    7572          67 :   case 12:
    7573             :     // MRC, t2MRC, t2MRC2
    7574          67 :     printPImmediate(MI, 1, STI, O);
    7575          67 :     O << ", ";
    7576          67 :     printOperand(MI, 2, STI, O);
    7577          67 :     O << ", ";
    7578          67 :     printOperand(MI, 0, STI, O);
    7579          67 :     O << ", ";
    7580          67 :     printCImmediate(MI, 3, STI, O);
    7581          67 :     O << ", ";
    7582          67 :     printCImmediate(MI, 4, STI, O);
    7583          67 :     O << ", ";
    7584          67 :     printOperand(MI, 5, STI, O);
    7585          67 :     return;
    7586             :     break;
    7587          43 :   case 13:
    7588             :     // MRRC, t2MRRC, t2MRRC2
    7589          43 :     printPImmediate(MI, 2, STI, O);
    7590          43 :     O << ", ";
    7591          43 :     printOperand(MI, 3, STI, O);
    7592          43 :     O << ", ";
    7593          43 :     printOperand(MI, 0, STI, O);
    7594          43 :     O << ", ";
    7595          43 :     printOperand(MI, 1, STI, O);
    7596          43 :     O << ", ";
    7597          43 :     printCImmediate(MI, 4, STI, O);
    7598          43 :     return;
    7599             :     break;
    7600         372 :   case 14:
    7601             :     // MSR, MSRi, t2MSR_AR, t2MSR_M
    7602         372 :     printMSRMaskOperand(MI, 0, STI, O);
    7603         372 :     O << ", ";
    7604         372 :     break;
    7605         132 :   case 15:
    7606             :     // MSRbanked, t2MSRbanked
    7607         132 :     printBankedRegOperand(MI, 0, STI, O);
    7608         132 :     O << ", ";
    7609         132 :     printOperand(MI, 1, STI, O);
    7610         132 :     return;
    7611             :     break;
    7612         460 :   case 16:
    7613             :     // VBICiv2i32, VBICiv4i16, VBICiv4i32, VBICiv8i16, VMOVv16i8, VMOVv1i64, ...
    7614         460 :     printNEONModImmOperand(MI, 1, STI, O);
    7615         460 :     return;
    7616             :     break;
    7617         151 :   case 17:
    7618             :     // VCMPEZD, VCMPEZH, VCMPEZS, VCMPZD, VCMPZH, VCMPZS, tRSB
    7619         151 :     O << ", #0";
    7620         151 :     return;
    7621             :     break;
    7622             :   case 18:
    7623             :     // VCVTf2sd, VCVTf2sq, VCVTf2ud, VCVTf2uq, VCVTh2sd, VCVTh2sq, VCVTh2ud, ...
    7624             :     return;
    7625             :     break;
    7626          41 :   case 19:
    7627             :     // VLD1DUPd16, VLD1DUPd16wb_fixed, VLD1DUPd16wb_register, VLD1DUPd32, VLD...
    7628          41 :     printVectorListOneAllLanes(MI, 0, STI, O);
    7629          41 :     O << ", ";
    7630          41 :     break;
    7631          78 :   case 20:
    7632             :     // VLD1DUPq16, VLD1DUPq16wb_fixed, VLD1DUPq16wb_register, VLD1DUPq32, VLD...
    7633          78 :     printVectorListTwoAllLanes(MI, 0, STI, O);
    7634          78 :     O << ", ";
    7635          78 :     break;
    7636         212 :   case 21:
    7637             :     // VLD1d16, VLD1d16wb_fixed, VLD1d16wb_register, VLD1d32, VLD1d32wb_fixed...
    7638         212 :     printVectorListOne(MI, 0, STI, O);
    7639         212 :     O << ", ";
    7640         212 :     break;
    7641         205 :   case 22:
    7642             :     // VLD1d16Q, VLD1d16Qwb_fixed, VLD1d16Qwb_register, VLD1d32Q, VLD1d32Qwb_...
    7643         205 :     printVectorListFour(MI, 0, STI, O);
    7644         205 :     O << ", ";
    7645         205 :     break;
    7646          63 :   case 23:
    7647             :     // VLD1d16T, VLD1d16Twb_fixed, VLD1d16Twb_register, VLD1d32T, VLD1d32Twb_...
    7648          63 :     printVectorListThree(MI, 0, STI, O);
    7649          63 :     O << ", ";
    7650          63 :     break;
    7651        2580 :   case 24:
    7652             :     // VLD1q16, VLD1q16wb_fixed, VLD1q16wb_register, VLD1q32, VLD1q32wb_fixed...
    7653        2580 :     printVectorListTwo(MI, 0, STI, O);
    7654        2580 :     O << ", ";
    7655        2580 :     break;
    7656          45 :   case 25:
    7657             :     // VLD2DUPd16x2, VLD2DUPd16x2wb_fixed, VLD2DUPd16x2wb_register, VLD2DUPd3...
    7658          45 :     printVectorListTwoSpacedAllLanes(MI, 0, STI, O);
    7659          45 :     O << ", ";
    7660          45 :     break;
    7661          45 :   case 26:
    7662             :     // VLD2b16, VLD2b16wb_fixed, VLD2b16wb_register, VLD2b32, VLD2b32wb_fixed...
    7663          45 :     printVectorListTwoSpaced(MI, 0, STI, O);
    7664          45 :     O << ", ";
    7665          45 :     break;
    7666           0 :   case 27:
    7667             :     // VLD3DUPdAsm_16, VLD3DUPdAsm_32, VLD3DUPdAsm_8, VLD3DUPdWB_fixed_Asm_16...
    7668           0 :     printVectorListThreeAllLanes(MI, 0, STI, O);
    7669           0 :     O << ", ";
    7670           0 :     printAddrMode6Operand(MI, 1, STI, O);
    7671           0 :     break;
    7672           0 :   case 28:
    7673             :     // VLD3DUPqAsm_16, VLD3DUPqAsm_32, VLD3DUPqAsm_8, VLD3DUPqWB_fixed_Asm_16...
    7674           0 :     printVectorListThreeSpacedAllLanes(MI, 0, STI, O);
    7675           0 :     O << ", ";
    7676           0 :     printAddrMode6Operand(MI, 1, STI, O);
    7677           0 :     break;
    7678           0 :   case 29:
    7679             :     // VLD3qAsm_16, VLD3qAsm_32, VLD3qAsm_8, VLD3qWB_fixed_Asm_16, VLD3qWB_fi...
    7680           0 :     printVectorListThreeSpaced(MI, 0, STI, O);
    7681           0 :     O << ", ";
    7682           0 :     printAddrMode6Operand(MI, 1, STI, O);
    7683           0 :     break;
    7684           0 :   case 30:
    7685             :     // VLD4DUPdAsm_16, VLD4DUPdAsm_32, VLD4DUPdAsm_8, VLD4DUPdWB_fixed_Asm_16...
    7686           0 :     printVectorListFourAllLanes(MI, 0, STI, O);
    7687           0 :     O << ", ";
    7688           0 :     printAddrMode6Operand(MI, 1, STI, O);
    7689           0 :     break;
    7690           0 :   case 31:
    7691             :     // VLD4DUPqAsm_16, VLD4DUPqAsm_32, VLD4DUPqAsm_8, VLD4DUPqWB_fixed_Asm_16...
    7692           0 :     printVectorListFourSpacedAllLanes(MI, 0, STI, O);
    7693           0 :     O << ", ";
    7694           0 :     printAddrMode6Operand(MI, 1, STI, O);
    7695           0 :     break;
    7696           0 :   case 32:
    7697             :     // VLD4qAsm_16, VLD4qAsm_32, VLD4qAsm_8, VLD4qWB_fixed_Asm_16, VLD4qWB_fi...
    7698           0 :     printVectorListFourSpaced(MI, 0, STI, O);
    7699           0 :     O << ", ";
    7700           0 :     printAddrMode6Operand(MI, 1, STI, O);
    7701           0 :     break;
    7702         311 :   case 33:
    7703             :     // VST1LNd16_UPD, VST1LNd32_UPD, VST1LNd8_UPD, VST2LNd16_UPD, VST2LNd32_U...
    7704         311 :     printOperand(MI, 4, STI, O);
    7705         311 :     break;
    7706          58 :   case 34:
    7707             :     // VST1d16, VST1d32, VST1d64, VST1d8
    7708          58 :     printVectorListOne(MI, 2, STI, O);
    7709          58 :     O << ", ";
    7710          58 :     printAddrMode6Operand(MI, 0, STI, O);
    7711          58 :     return;
    7712             :     break;
    7713          81 :   case 35:
    7714             :     // VST1d16Q, VST1d32Q, VST1d64Q, VST1d8Q, VST2q16, VST2q32, VST2q8
    7715          81 :     printVectorListFour(MI, 2, STI, O);
    7716          81 :     O << ", ";
    7717          81 :     printAddrMode6Operand(MI, 0, STI, O);
    7718          81 :     return;
    7719             :     break;
    7720          67 :   case 36:
    7721             :     // VST1d16Qwb_fixed, VST1d32Qwb_fixed, VST1d64Qwb_fixed, VST1d8Qwb_fixed,...
    7722          67 :     printVectorListFour(MI, 3, STI, O);
    7723          67 :     O << ", ";
    7724          67 :     printAddrMode6Operand(MI, 1, STI, O);
    7725             :     O << '!';
    7726             :     return;
    7727             :     break;
    7728          34 :   case 37:
    7729             :     // VST1d16Qwb_register, VST1d32Qwb_register, VST1d64Qwb_register, VST1d8Q...
    7730          34 :     printVectorListFour(MI, 4, STI, O);
    7731          34 :     O << ", ";
    7732          34 :     printAddrMode6Operand(MI, 1, STI, O);
    7733          34 :     O << ", ";
    7734          34 :     printOperand(MI, 3, STI, O);
    7735          34 :     return;
    7736             :     break;
    7737          10 :   case 38:
    7738             :     // VST1d16T, VST1d32T, VST1d64T, VST1d8T
    7739          10 :     printVectorListThree(MI, 2, STI, O);
    7740          10 :     O << ", ";
    7741          10 :     printAddrMode6Operand(MI, 0, STI, O);
    7742          10 :     return;
    7743             :     break;
    7744          18 :   case 39:
    7745             :     // VST1d16Twb_fixed, VST1d32Twb_fixed, VST1d64Twb_fixed, VST1d8Twb_fixed
    7746          18 :     printVectorListThree(MI, 3, STI, O);
    7747          18 :     O << ", ";
    7748          18 :     printAddrMode6Operand(MI, 1, STI, O);
    7749             :     O << '!';
    7750             :     return;
    7751             :     break;
    7752          18 :   case 40:
    7753             :     // VST1d16Twb_register, VST1d32Twb_register, VST1d64Twb_register, VST1d8T...
    7754          18 :     printVectorListThree(MI, 4, STI, O);
    7755          18 :     O << ", ";
    7756          18 :     printAddrMode6Operand(MI, 1, STI, O);
    7757          18 :     O << ", ";
    7758          18 :     printOperand(MI, 3, STI, O);
    7759          18 :     return;
    7760             :     break;
    7761          77 :   case 41:
    7762             :     // VST1d16wb_fixed, VST1d32wb_fixed, VST1d64wb_fixed, VST1d8wb_fixed
    7763          77 :     printVectorListOne(MI, 3, STI, O);
    7764          77 :     O << ", ";
    7765          77 :     printAddrMode6Operand(MI, 1, STI, O);
    7766             :     O << '!';
    7767             :     return;
    7768             :     break;
    7769          26 :   case 42:
    7770             :     // VST1d16wb_register, VST1d32wb_register, VST1d64wb_register, VST1d8wb_r...
    7771          26 :     printVectorListOne(MI, 4, STI, O);
    7772          26 :     O << ", ";
    7773          26 :     printAddrMode6Operand(MI, 1, STI, O);
    7774          26 :     O << ", ";
    7775          26 :     printOperand(MI, 3, STI, O);
    7776          26 :     return;
    7777             :     break;
    7778        1411 :   case 43:
    7779             :     // VST1q16, VST1q32, VST1q64, VST1q8, VST2d16, VST2d32, VST2d8
    7780        1411 :     printVectorListTwo(MI, 2, STI, O);
    7781        1411 :     O << ", ";
    7782        1411 :     printAddrMode6Operand(MI, 0, STI, O);
    7783        1411 :     return;
    7784             :     break;
    7785         127 :   case 44:
    7786             :     // VST1q16wb_fixed, VST1q32wb_fixed, VST1q64wb_fixed, VST1q8wb_fixed, VST...
    7787         127 :     printVectorListTwo(MI, 3, STI, O);
    7788         127 :     O << ", ";
    7789         127 :     printAddrMode6Operand(MI, 1, STI, O);
    7790             :     O << '!';
    7791             :     return;
    7792             :     break;
    7793          64 :   case 45:
    7794             :     // VST1q16wb_register, VST1q32wb_register, VST1q64wb_register, VST1q8wb_r...
    7795          64 :     printVectorListTwo(MI, 4, STI, O);
    7796          64 :     O << ", ";
    7797          64 :     printAddrMode6Operand(MI, 1, STI, O);
    7798          64 :     O << ", ";
    7799          64 :     printOperand(MI, 3, STI, O);
    7800          64 :     return;
    7801             :     break;
    7802          14 :   case 46:
    7803             :     // VST2b16, VST2b32, VST2b8
    7804          14 :     printVectorListTwoSpaced(MI, 2, STI, O);
    7805          14 :     O << ", ";
    7806          14 :     printAddrMode6Operand(MI, 0, STI, O);
    7807          14 :     return;
    7808             :     break;
    7809          12 :   case 47:
    7810             :     // VST2b16wb_fixed, VST2b32wb_fixed, VST2b8wb_fixed
    7811          12 :     printVectorListTwoSpaced(MI, 3, STI, O);
    7812          12 :     O << ", ";
    7813          12 :     printAddrMode6Operand(MI, 1, STI, O);
    7814             :     O << '!';
    7815             :     return;
    7816             :     break;
    7817          13 :   case 48:
    7818             :     // VST2b16wb_register, VST2b32wb_register, VST2b8wb_register
    7819          13 :     printVectorListTwoSpaced(MI, 4, STI, O);
    7820          13 :     O << ", ";
    7821          13 :     printAddrMode6Operand(MI, 1, STI, O);
    7822          13 :     O << ", ";
    7823          13 :     printOperand(MI, 3, STI, O);
    7824          13 :     return;
    7825             :     break;
    7826         334 :   case 49:
    7827             :     // t2DMB, t2DSB
    7828         334 :     printMemBOption(MI, 0, STI, O);
    7829         334 :     return;
    7830             :     break;
    7831          22 :   case 50:
    7832             :     // t2ISB
    7833          22 :     printInstSyncBOption(MI, 0, STI, O);
    7834          22 :     return;
    7835             :     break;
    7836          53 :   case 51:
    7837             :     // t2PLDWi12, t2PLDi12, t2PLIi12
    7838          53 :     printAddrModeImm12Operand<false>(MI, 0, STI, O);
    7839          53 :     return;
    7840             :     break;
    7841          24 :   case 52:
    7842             :     // t2PLDWi8, t2PLDi8, t2PLIi8
    7843          24 :     printT2AddrModeImm8Operand<false>(MI, 0, STI, O);
    7844          24 :     return;
    7845             :     break;
    7846          60 :   case 53:
    7847             :     // t2PLDWs, t2PLDs, t2PLIs
    7848          60 :     printT2AddrModeSoRegOperand(MI, 0, STI, O);
    7849          60 :     return;
    7850             :     break;
    7851          39 :   case 54:
    7852             :     // t2PLDpci, t2PLIpci
    7853          39 :     printThumbLdrLabelOperand(MI, 0, STI, O);
    7854          39 :     return;
    7855             :     break;
    7856          27 :   case 55:
    7857             :     // t2TBB
    7858          27 :     printAddrModeTBB(MI, 0, STI, O);
    7859          27 :     return;
    7860             :     break;
    7861           9 :   case 56:
    7862             :     // t2TBH
    7863           9 :     printAddrModeTBH(MI, 0, STI, O);
    7864           9 :     return;
    7865             :     break;
    7866        3333 :   case 57:
    7867             :     // tADC, tADDi8, tAND, tASRrr, tBIC, tEOR, tLSLrr, tLSRrr, tORR, tROR, tS...
    7868        3333 :     printOperand(MI, 3, STI, O);
    7869        3333 :     return;
    7870             :     break;
    7871        3401 :   case 58:
    7872             :     // tPOP, tPUSH
    7873        3401 :     printRegisterList(MI, 2, STI, O);
    7874        3401 :     return;
    7875             :     break;
    7876             :   }
    7877             : 
    7878             : 
    7879             :   // Fragment 3 encoded into 5 bits for 30 unique commands.
    7880      112758 :   switch ((Bits >> 30) & 31) {
    7881           0 :   default: llvm_unreachable("Invalid command number.");
    7882       86633 :   case 0:
    7883             :     // ADCri, ADCrr, ADCrsi, ADDri, ADDrr, ADDrsi, ADR, ANDri, ANDrr, ANDrsi,...
    7884       86633 :     O << ", ";
    7885       86633 :     break;
    7886             :   case 1:
    7887             :     // AESD, AESE, AESIMC, AESMC, BLX_pred, BL_pred, BXJ, BX_pred, Bcc, CPS2p...
    7888             :     return;
    7889             :     break;
    7890        6742 :   case 2:
    7891             :     // CDP, MCR, MCRR, MSR, VABDfd, VABDfq, VABDhd, VABDhq, VABSD, VABSH, VAB...
    7892        6742 :     printOperand(MI, 1, STI, O);
    7893        6742 :     break;
    7894         436 :   case 3:
    7895             :     // FCONSTD, FCONSTH, FCONSTS, VMOVv2f32, VMOVv4f32
    7896         436 :     printFPImmOperand(MI, 1, STI, O);
    7897         436 :     return;
    7898             :     break;
    7899         351 :   case 4:
    7900             :     // FLDMXDB_UPD, FLDMXIA_UPD, FSTMXDB_UPD, FSTMXIA_UPD, LDMDA_UPD, LDMDB_U...
    7901         351 :     O << "!, ";
    7902         351 :     printRegisterList(MI, 4, STI, O);
    7903         351 :     break;
    7904          13 :   case 5:
    7905             :     // LDC2L_OPTION, LDC2_OPTION, STC2L_OPTION, STC2_OPTION
    7906          13 :     printCoprocOptionImm(MI, 3, STI, O);
    7907          13 :     return;
    7908             :     break;
    7909          21 :   case 6:
    7910             :     // LDC2L_POST, LDC2_POST, STC2L_POST, STC2_POST
    7911          21 :     printPostIdxImm8s4Operand(MI, 3, STI, O);
    7912          21 :     return;
    7913             :     break;
    7914         714 :   case 7:
    7915             :     // LDCL_OFFSET, LDCL_OPTION, LDCL_POST, LDCL_PRE, LDC_OFFSET, LDC_OPTION,...
    7916         714 :     printCImmediate(MI, 1, STI, O);
    7917         714 :     O << ", ";
    7918         714 :     break;
    7919          20 :   case 8:
    7920             :     // MRS, t2MRS_AR
    7921          20 :     O << ", apsr";
    7922          20 :     return;
    7923             :     break;
    7924           9 :   case 9:
    7925             :     // MRSsys, t2MRSsys_AR
    7926           9 :     O << ", spsr";
    7927           9 :     return;
    7928             :     break;
    7929          63 :   case 10:
    7930             :     // MSRi
    7931          63 :     printModImmOperand(MI, 1, STI, O);
    7932          63 :     return;
    7933             :     break;
    7934          27 :   case 11:
    7935             :     // VCEQzv16i8, VCEQzv2i32, VCEQzv4i16, VCEQzv4i32, VCEQzv8i16, VCEQzv8i8,...
    7936          27 :     O << ", #0";
    7937          27 :     return;
    7938             :     break;
    7939         540 :   case 12:
    7940             :     // VCVTf2xsd, VCVTf2xsq, VCVTf2xud, VCVTf2xuq, VCVTh2xsd, VCVTh2xsq, VCVT...
    7941         540 :     printOperand(MI, 2, STI, O);
    7942         540 :     break;
    7943          64 :   case 13:
    7944             :     // VGETLNs16, VGETLNs8, VGETLNu16, VGETLNu8
    7945          64 :     printVectorIndex(MI, 2, STI, O);
    7946          64 :     return;
    7947             :     break;
    7948        2639 :   case 14:
    7949             :     // VLD1DUPd16, VLD1DUPd32, VLD1DUPd8, VLD1DUPq16, VLD1DUPq32, VLD1DUPq8, ...
    7950        2639 :     printAddrMode6Operand(MI, 1, STI, O);
    7951        2639 :     break;
    7952         630 :   case 15:
    7953             :     // VLD1DUPd16wb_fixed, VLD1DUPd16wb_register, VLD1DUPd32wb_fixed, VLD1DUP...
    7954         630 :     printAddrMode6Operand(MI, 2, STI, O);
    7955         630 :     break;
    7956             :   case 16:
    7957             :     // VLD1LNd16, VLD1LNd16_UPD, VLD1LNd32, VLD1LNd32_UPD, VLD1LNd8, VLD1LNd8...
    7958             :     O << '[';
    7959             :     break;
    7960         143 :   case 17:
    7961             :     // VLD3DUPd16, VLD3DUPd16_UPD, VLD3DUPd32, VLD3DUPd32_UPD, VLD3DUPd8, VLD...
    7962         143 :     O << "[], ";
    7963         143 :     printOperand(MI, 1, STI, O);
    7964         143 :     O << "[], ";
    7965         143 :     printOperand(MI, 2, STI, O);
    7966         143 :     break;
    7967             :   case 18:
    7968             :     // VLD3DUPdWB_fixed_Asm_16, VLD3DUPdWB_fixed_Asm_32, VLD3DUPdWB_fixed_Asm...
    7969             :     O << '!';
    7970             :     return;
    7971             :     break;
    7972          36 :   case 19:
    7973             :     // VMRS
    7974          36 :     O << ", fpscr";
    7975          36 :     return;
    7976             :     break;
    7977           2 :   case 20:
    7978             :     // VMRS_FPEXC
    7979           2 :     O << ", fpexc";
    7980           2 :     return;
    7981             :     break;
    7982           2 :   case 21:
    7983             :     // VMRS_FPINST
    7984           2 :     O << ", fpinst";
    7985           2 :     return;
    7986             :     break;
    7987           2 :   case 22:
    7988             :     // VMRS_FPINST2
    7989           2 :     O << ", fpinst2";
    7990           2 :     return;
    7991             :     break;
    7992          32 :   case 23:
    7993             :     // VMRS_FPSID
    7994          32 :     O << ", fpsid";
    7995          32 :     return;
    7996             :     break;
    7997          19 :   case 24:
    7998             :     // VMRS_MVFR0
    7999          19 :     O << ", mvfr0";
    8000          19 :     return;
    8001             :     break;
    8002          19 :   case 25:
    8003             :     // VMRS_MVFR1
    8004          19 :     O << ", mvfr1";
    8005          19 :     return;
    8006             :     break;
    8007          11 :   case 26:
    8008             :     // VMRS_MVFR2
    8009          11 :     O << ", mvfr2";
    8010          11 :     return;
    8011             :     break;
    8012         229 :   case 27:
    8013             :     // VSETLNi16, VSETLNi32, VSETLNi8
    8014         229 :     printVectorIndex(MI, 3, STI, O);
    8015         229 :     O << ", ";
    8016         229 :     printOperand(MI, 2, STI, O);
    8017         229 :     return;
    8018             :     break;
    8019          16 :   case 28:
    8020             :     // VSHTOH, VTOSHH, VTOUHH, VUHTOH
    8021          16 :     printFBits16(MI, 2, STI, O);
    8022          16 :     return;
    8023             :     break;
    8024          24 :   case 29:
    8025             :     // VSLTOD, VSLTOH, VSLTOS, VTOSLD, VTOSLH, VTOSLS, VTOULD, VTOULH, VTOULS...
    8026          24 :     printFBits32(MI, 2, STI, O);
    8027          24 :     return;
    8028             :     break;
    8029             :   }
    8030             : 
    8031             : 
    8032             :   // Fragment 4 encoded into 7 bits for 65 unique commands.
    8033       99148 :   switch ((Bits >> 35) & 127) {
    8034           0 :   default: llvm_unreachable("Invalid command number.");
    8035       41726 :   case 0:
    8036             :     // ADCri, ADCrr, ADCrsi, ADDri, ADDrr, ADDrsi, ANDri, ANDrr, ANDrsi, ASRi...
    8037       41726 :     printOperand(MI, 1, STI, O);
    8038       41726 :     break;
    8039         237 :   case 1:
    8040             :     // ADR, t2ADR
    8041         237 :     printAdrLabelOperand<0>(MI, 1, STI, O);
    8042         237 :     return;
    8043             :     break;
    8044         223 :   case 2:
    8045             :     // BFC, t2BFC
    8046         223 :     printBitfieldInvMaskImmOperand(MI, 2, STI, O);
    8047         223 :     return;
    8048             :     break;
    8049        7140 :   case 3:
    8050             :     // BFI, CPS3p, CRC32B, CRC32CB, CRC32CH, CRC32CW, CRC32H, CRC32W, MOVTi16...
    8051        7140 :     printOperand(MI, 2, STI, O);
    8052        7140 :     break;
    8053        3147 :   case 4:
    8054             :     // CDP, MCR, MCRR, VABDfd, VABDfq, VABDhd, VABDhq, VACGEfd, VACGEfq, VACG...
    8055        3147 :     O << ", ";
    8056        3147 :     break;
    8057        4187 :   case 5:
    8058             :     // CMNri, CMPri, MOVi, MVNi, TEQri, TSTri
    8059        4187 :     printModImmOperand(MI, 1, STI, O);
    8060        4187 :     return;
    8061             :     break;
    8062         111 :   case 6:
    8063             :     // CMNzrsi, CMPrsi, MOVsi, MVNsi, TEQrsi, TSTrsi
    8064         111 :     printSORegImmOperand(MI, 1, STI, O);
    8065         111 :     return;
    8066             :     break;
    8067          71 :   case 7:
    8068             :     // CMNzrsr, CMPrsr, MOVsr, MVNsr, TEQrsr, TSTrsr, t2MOVSsr, t2MOVsr
    8069          71 :     printSORegRegOperand(MI, 1, STI, O);
    8070          71 :     return;
    8071             :     break;
    8072             :   case 8:
    8073             :     // FLDMXDB_UPD, FLDMXIA_UPD, FSTMXDB_UPD, FSTMXIA_UPD, LDMDA_UPD, LDMDB_U...
    8074             :     return;
    8075             :     break;
    8076         601 :   case 9:
    8077             :     // FLDMXIA, FSTMXIA, LDMDA, LDMDB, LDMIA, LDMIB, STMDA, STMDB, STMIA, STM...
    8078         601 :     printRegisterList(MI, 3, STI, O);
    8079         601 :     break;
    8080         292 :   case 10:
    8081             :     // LDA, LDAB, LDAEX, LDAEXB, LDAEXH, LDAH, LDRBT_POST, LDREX, LDREXB, LDR...
    8082         292 :     printAddrMode7Operand(MI, 1, STI, O);
    8083         292 :     return;
    8084             :     break;
    8085         248 :   case 11:
    8086             :     // LDCL_OFFSET, LDC_OFFSET, STCL_OFFSET, STC_OFFSET, t2LDC2L_OFFSET, t2LD...
    8087         248 :     printAddrMode5Operand<false>(MI, 2, STI, O);
    8088         248 :     return;
    8089             :     break;
    8090        3761 :   case 12:
    8091             :     // LDCL_OPTION, LDCL_POST, LDC_OPTION, LDC_POST, LDRBT_POST_IMM, LDRBT_PO...
    8092        3761 :     printAddrMode7Operand(MI, 2, STI, O);
    8093        3761 :     break;
    8094         166 :   case 13:
    8095             :     // LDCL_PRE, LDC_PRE, STCL_PRE, STC_PRE, t2LDC2L_PRE, t2LDC2_PRE, t2LDCL_...
    8096         166 :     printAddrMode5Operand<true>(MI, 2, STI, O);
    8097             :     O << '!';
    8098             :     return;
    8099             :     break;
    8100          92 :   case 14:
    8101             :     // LDRB_PRE_IMM, LDR_PRE_IMM, STRB_PRE_IMM, STR_PRE_IMM
    8102          92 :     printAddrModeImm12Operand<true>(MI, 2, STI, O);
    8103             :     O << '!';
    8104             :     return;
    8105             :     break;
    8106          35 :   case 15:
    8107             :     // LDRB_PRE_REG, LDR_PRE_REG, STRB_PRE_REG, STR_PRE_REG
    8108          35 :     printAddrMode2Operand(MI, 2, STI, O);
    8109             :     O << '!';
    8110             :     return;
    8111             :     break;
    8112        7649 :   case 16:
    8113             :     // LDRBi12, LDRcp, LDRi12, STRBi12, STRi12, t2LDRBi12, t2LDRHi12, t2LDRSB...
    8114        7649 :     printAddrModeImm12Operand<false>(MI, 1, STI, O);
    8115        7649 :     return;
    8116             :     break;
    8117         428 :   case 17:
    8118             :     // LDRBrs, LDRrs, STRBrs, STRrs
    8119         428 :     printAddrMode2Operand(MI, 1, STI, O);
    8120         428 :     return;
    8121             :     break;
    8122         728 :   case 18:
    8123             :     // LDRH, LDRSB, LDRSH, STRH
    8124         728 :     printAddrMode3Operand<false>(MI, 1, STI, O);
    8125         728 :     return;
    8126             :     break;
    8127          33 :   case 19:
    8128             :     // LDRH_PRE, LDRSB_PRE, LDRSH_PRE, STRH_PRE
    8129          33 :     printAddrMode3Operand<true>(MI, 2, STI, O);
    8130             :     O << '!';
    8131             :     return;
    8132             :     break;
    8133          10 :   case 20:
    8134             :     // MCR2
    8135          10 :     printCImmediate(MI, 3, STI, O);
    8136          10 :     O << ", ";
    8137          10 :     printCImmediate(MI, 4, STI, O);
    8138          10 :     O << ", ";
    8139          10 :     printOperand(MI, 5, STI, O);
    8140          10 :     return;
    8141             :     break;
    8142        2833 :   case 21:
    8143             :     // MCRR2, SHA1C, SHA1M, SHA1P, SHA1SU0, SHA256H, SHA256H2, SHA256SU1, VAB...
    8144        2833 :     printOperand(MI, 3, STI, O);
    8145        2833 :     break;
    8146         132 :   case 22:
    8147             :     // MRSbanked, t2MRSbanked
    8148         132 :     printBankedRegOperand(MI, 1, STI, O);
    8149         132 :     return;
    8150             :     break;
    8151         101 :   case 23:
    8152             :     // SSAT, SSAT16, t2SSAT, t2SSAT16
    8153         101 :     printImmPlusOneOperand(MI, 1, STI, O);
    8154         101 :     O << ", ";
    8155         101 :     printOperand(MI, 2, STI, O);
    8156         101 :     break;
    8157          73 :   case 24:
    8158             :     // STLEXD, STREXD
    8159          73 :     printGPRPairOperand(MI, 1, STI, O);
    8160          73 :     O << ", ";
    8161          73 :     printAddrMode7Operand(MI, 2, STI, O);
    8162          73 :     return;
    8163             :     break;
    8164          41 :   case 25:
    8165             :     // VCEQzv2f32, VCEQzv4f16, VCEQzv4f32, VCEQzv8f16, VCGEzv2f32, VCGEzv4f16...
    8166          41 :     O << ", #0";
    8167          41 :     return;
    8168             :     break;
    8169             :   case 26:
    8170             :     // VLD1DUPd16wb_fixed, VLD1DUPd32wb_fixed, VLD1DUPd8wb_fixed, VLD1DUPq16w...
    8171             :     O << '!';
    8172             :     return;
    8173             :     break;
    8174         177 :   case 27:
    8175             :     // VLD1LNd16, VLD1LNd32, VLD1LNd8, VST2LNd16, VST2LNd32, VST2LNd8, VST2LN...
    8176         177 :     printNoHashImmediate(MI, 4, STI, O);
    8177         177 :     break;
    8178         156 :   case 28:
    8179             :     // VLD1LNd16_UPD, VLD1LNd32_UPD, VLD1LNd8_UPD, VLD2LNd16, VLD2LNd32, VLD2...
    8180         156 :     printNoHashImmediate(MI, 6, STI, O);
    8181         156 :     break;
    8182           0 :   case 29:
    8183             :     // VLD1LNdAsm_16, VLD1LNdAsm_32, VLD1LNdAsm_8, VLD1LNdWB_fixed_Asm_16, VL...
    8184           0 :     printAddrMode6Operand(MI, 2, STI, O);
    8185           0 :     break;
    8186         121 :   case 30:
    8187             :     // VLD2LNd16_UPD, VLD2LNd32_UPD, VLD2LNd8_UPD, VLD2LNq16_UPD, VLD2LNq32_U...
    8188         121 :     printNoHashImmediate(MI, 8, STI, O);
    8189         121 :     O << "], ";
    8190         121 :     break;
    8191          56 :   case 31:
    8192             :     // VLD3DUPd16, VLD3DUPd16_UPD, VLD3DUPd32, VLD3DUPd32_UPD, VLD3DUPd8, VLD...
    8193          56 :     O << "[]}, ";
    8194          56 :     break;
    8195          69 :   case 32:
    8196             :     // VLD3LNd16_UPD, VLD3LNd32_UPD, VLD3LNd8_UPD, VLD3LNq16_UPD, VLD3LNq32_U...
    8197          69 :     printNoHashImmediate(MI, 10, STI, O);
    8198          69 :     O << "], ";
    8199          69 :     printOperand(MI, 1, STI, O);
    8200             :     O << '[';
    8201          69 :     printNoHashImmediate(MI, 10, STI, O);
    8202          69 :     O << "], ";
    8203          69 :     printOperand(MI, 2, STI, O);
    8204             :     O << '[';
    8205          69 :     printNoHashImmediate(MI, 10, STI, O);
    8206          69 :     break;
    8207          87 :   case 33:
    8208             :     // VLD4DUPd16, VLD4DUPd16_UPD, VLD4DUPd32, VLD4DUPd32_UPD, VLD4DUPd8, VLD...
    8209          87 :     O << "[], ";
    8210          87 :     printOperand(MI, 3, STI, O);
    8211          87 :     O << "[]}, ";
    8212          87 :     break;
    8213          39 :   case 34:
    8214             :     // VLD4LNd16_UPD, VLD4LNd32_UPD, VLD4LNd8_UPD, VLD4LNq16_UPD, VLD4LNq32_U...
    8215          39 :     printNoHashImmediate(MI, 12, STI, O);
    8216          39 :     O << "], ";
    8217          39 :     printOperand(MI, 1, STI, O);
    8218             :     O << '[';
    8219          39 :     printNoHashImmediate(MI, 12, STI, O);
    8220          39 :     O << "], ";
    8221          39 :     printOperand(MI, 2, STI, O);
    8222             :     O << '[';
    8223          39 :     printNoHashImmediate(MI, 12, STI, O);
    8224          39 :     O << "], ";
    8225          39 :     printOperand(MI, 3, STI, O);
    8226             :     O << '[';
    8227          39 :     printNoHashImmediate(MI, 12, STI, O);
    8228          39 :     O << "]}, ";
    8229          39 :     printAddrMode6Operand(MI, 5, STI, O);
    8230          39 :     printAddrMode6OffsetOperand(MI, 7, STI, O);
    8231          39 :     return;
    8232             :     break;
    8233        4480 :   case 35:
    8234             :     // VLDRD, VLDRS, VSTRD, VSTRS
    8235        4480 :     printAddrMode5Operand<false>(MI, 1, STI, O);
    8236        4480 :     return;
    8237             :     break;
    8238         522 :   case 36:
    8239             :     // VLDRH, VSTRH
    8240         522 :     printAddrMode5FP16Operand<false>(MI, 1, STI, O);
    8241         522 :     return;
    8242             :     break;
    8243          98 :   case 37:
    8244             :     // VST1LNd16, VST1LNd32, VST1LNd8
    8245          98 :     printNoHashImmediate(MI, 3, STI, O);
    8246          98 :     O << "]}, ";
    8247          98 :     printAddrMode6Operand(MI, 0, STI, O);
    8248          98 :     return;
    8249             :     break;
    8250          75 :   case 38:
    8251             :     // VST1LNd16_UPD, VST1LNd32_UPD, VST1LNd8_UPD, VST3LNd16, VST3LNd32, VST3...
    8252          75 :     printNoHashImmediate(MI, 5, STI, O);
    8253          75 :     break;
    8254          21 :   case 39:
    8255             :     // VST3LNd16_UPD, VST3LNd32_UPD, VST3LNd8_UPD, VST3LNq16_UPD, VST3LNq32_U...
    8256          21 :     printNoHashImmediate(MI, 7, STI, O);
    8257          21 :     O << "], ";
    8258          21 :     printOperand(MI, 5, STI, O);
    8259             :     O << '[';
    8260          21 :     printNoHashImmediate(MI, 7, STI, O);
    8261          21 :     O << "], ";
    8262          21 :     printOperand(MI, 6, STI, O);
    8263             :     O << '[';
    8264          21 :     printNoHashImmediate(MI, 7, STI, O);
    8265          21 :     O << "]}, ";
    8266          21 :     printAddrMode6Operand(MI, 1, STI, O);
    8267          21 :     printAddrMode6OffsetOperand(MI, 3, STI, O);
    8268          21 :     return;
    8269             :     break;
    8270         178 :   case 40:
    8271             :     // VST3d16_UPD, VST3d32_UPD, VST3d8_UPD, VST3q16_UPD, VST3q32_UPD, VST3q8...
    8272         178 :     printOperand(MI, 5, STI, O);
    8273         178 :     O << ", ";
    8274         178 :     printOperand(MI, 6, STI, O);
    8275         178 :     break;
    8276          10 :   case 41:
    8277             :     // VTBL1
    8278          10 :     printVectorListOne(MI, 1, STI, O);
    8279          10 :     O << ", ";
    8280          10 :     printOperand(MI, 2, STI, O);
    8281          10 :     return;
    8282             :     break;
    8283          10 :   case 42:
    8284             :     // VTBL2
    8285          10 :     printVectorListTwo(MI, 1, STI, O);
    8286          10 :     O << ", ";
    8287          10 :     printOperand(MI, 2, STI, O);
    8288          10 :     return;
    8289             :     break;
    8290           5 :   case 43:
    8291             :     // VTBL3
    8292           5 :     printVectorListThree(MI, 1, STI, O);
    8293           5 :     O << ", ";
    8294           5 :     printOperand(MI, 2, STI, O);
    8295           5 :     return;
    8296             :     break;
    8297           5 :   case 44:
    8298             :     // VTBL4
    8299           5 :     printVectorListFour(MI, 1, STI, O);
    8300           5 :     O << ", ";
    8301           5 :     printOperand(MI, 2, STI, O);
    8302           5 :     return;
    8303             :     break;
    8304           5 :   case 45:
    8305             :     // VTBX1
    8306           5 :     printVectorListOne(MI, 2, STI, O);
    8307           5 :     O << ", ";
    8308           5 :     printOperand(MI, 3, STI, O);
    8309           5 :     return;
    8310             :     break;
    8311           5 :   case 46:
    8312             :     // VTBX2
    8313           5 :     printVectorListTwo(MI, 2, STI, O);
    8314           5 :     O << ", ";
    8315           5 :     printOperand(MI, 3, STI, O);
    8316           5 :     return;
    8317             :     break;
    8318           6 :   case 47:
    8319             :     // VTBX3
    8320           6 :     printVectorListThree(MI, 2, STI, O);
    8321           6 :     O << ", ";
    8322           6 :     printOperand(MI, 3, STI, O);
    8323           6 :     return;
    8324             :     break;
    8325           6 :   case 48:
    8326             :     // VTBX4
    8327           6 :     printVectorListFour(MI, 2, STI, O);
    8328           6 :     O << ", ";
    8329           6 :     printOperand(MI, 3, STI, O);
    8330           6 :     return;
    8331             :     break;
    8332           6 :   case 49:
    8333             :     // sysLDMDA_UPD, sysLDMDB_UPD, sysLDMIA_UPD, sysLDMIB_UPD, sysSTMDA_UPD, ...
    8334           6 :     O << " ^";
    8335           6 :     return;
    8336             :     break;
    8337         108 :   case 50:
    8338             :     // t2CMNzrs, t2CMPrs, t2MOVSsi, t2MOVsi, t2MVNs, t2TEQrs, t2TSTrs
    8339         108 :     printT2SOOperand(MI, 1, STI, O);
    8340         108 :     return;
    8341             :     break;
    8342         167 :   case 51:
    8343             :     // t2LDRBT, t2LDRBi8, t2LDRHT, t2LDRHi8, t2LDRSBT, t2LDRSBi8, t2LDRSHT, t...
    8344         167 :     printT2AddrModeImm8Operand<false>(MI, 1, STI, O);
    8345         167 :     return;
    8346             :     break;
    8347         166 :   case 52:
    8348             :     // t2LDRB_PRE, t2LDRH_PRE, t2LDRSB_PRE, t2LDRSH_PRE, t2LDR_PRE, t2STRB_PR...
    8349         166 :     printT2AddrModeImm8Operand<true>(MI, 2, STI, O);
    8350             :     O << '!';
    8351             :     return;
    8352             :     break;
    8353        1189 :   case 53:
    8354             :     // t2LDRBpci, t2LDRHpci, t2LDRSBpci, t2LDRSHpci, t2LDRpci, tLDRpci
    8355        1189 :     printThumbLdrLabelOperand(MI, 1, STI, O);
    8356        1189 :     return;
    8357             :     break;
    8358         330 :   case 54:
    8359             :     // t2LDRBs, t2LDRHs, t2LDRSBs, t2LDRSHs, t2LDRs, t2STRBs, t2STRHs, t2STRs
    8360         330 :     printT2AddrModeSoRegOperand(MI, 1, STI, O);
    8361         330 :     return;
    8362             :     break;
    8363          60 :   case 55:
    8364             :     // t2LDREX
    8365          60 :     printT2AddrModeImm0_1020s4Operand(MI, 1, STI, O);
    8366          60 :     return;
    8367             :     break;
    8368         144 :   case 56:
    8369             :     // t2MRS_M
    8370         144 :     printMSRMaskOperand(MI, 1, STI, O);
    8371         144 :     return;
    8372             :     break;
    8373        1667 :   case 57:
    8374             :     // tADDspi, tSUBspi
    8375        1667 :     printThumbS4ImmOperand(MI, 2, STI, O);
    8376        1667 :     return;
    8377             :     break;
    8378         128 :   case 58:
    8379             :     // tADR
    8380         128 :     printAdrLabelOperand<2>(MI, 1, STI, O);
    8381         128 :     return;
    8382             :     break;
    8383         509 :   case 59:
    8384             :     // tASRri, tLSRri
    8385         509 :     printThumbSRImm(MI, 3, STI, O);
    8386         509 :     return;
    8387             :     break;
    8388        1339 :   case 60:
    8389             :     // tLDRBi, tSTRBi
    8390        1339 :     printThumbAddrModeImm5S1Operand(MI, 1, STI, O);
    8391        1339 :     return;
    8392             :     break;
    8393         389 :   case 61:
    8394             :     // tLDRBr, tLDRHr, tLDRSB, tLDRSH, tLDRr, tSTRBr, tSTRHr, tSTRr
    8395         389 :     printThumbAddrModeRROperand(MI, 1, STI, O);
    8396         389 :     return;
    8397             :     break;
    8398         635 :   case 62:
    8399             :     // tLDRHi, tSTRHi
    8400         635 :     printThumbAddrModeImm5S2Operand(MI, 1, STI, O);
    8401         635 :     return;
    8402             :     break;
    8403        2585 :   case 63:
    8404             :     // tLDRi, tSTRi
    8405        2585 :     printThumbAddrModeImm5S4Operand(MI, 1, STI, O);
    8406        2585 :     return;
    8407             :     break;
    8408        1822 :   case 64:
    8409             :     // tLDRspi, tSTRspi
    8410        1822 :     printThumbAddrModeSPOperand(MI, 1, STI, O);
    8411        1822 :     return;
    8412             :     break;
    8413             :   }
    8414             : 
    8415             : 
    8416             :   // Fragment 5 encoded into 5 bits for 23 unique commands.
    8417       60228 :   switch ((Bits >> 42) & 31) {
    8418           0 :   default: llvm_unreachable("Invalid command number.");
    8419       26300 :   case 0:
    8420             :     // ADCri, ADCrr, ADCrsi, ADDri, ADDrr, ADDrsi, ANDri, ANDrr, ANDrsi, ASRi...
    8421       26300 :     O << ", ";
    8422       26300 :     break;
    8423          32 :   case 1:
    8424             :     // CDP, t2CDP, t2CDP2
    8425          32 :     printCImmediate(MI, 2, STI, O);
    8426          32 :     O << ", ";
    8427          32 :     printCImmediate(MI, 3, STI, O);
    8428          32 :     O << ", ";
    8429          32 :     printCImmediate(MI, 4, STI, O);
    8430          32 :     O << ", ";
    8431          32 :     printOperand(MI, 5, STI, O);
    8432          32 :     return;
    8433             :     break;
    8434             :   case 2:
    8435             :     // CLZ, CMNzrr, CMPrr, CPS3p, CRC32B, CRC32CB, CRC32CH, CRC32CW, CRC32H, ...
    8436             :     return;
    8437             :     break;
    8438        2420 :   case 3:
    8439             :     // MCR, MCRR, VABDfd, VABDfq, VABDhd, VABDhq, VACGEfd, VACGEfq, VACGEhd, ...
    8440        2420 :     printOperand(MI, 2, STI, O);
    8441        2420 :     break;
    8442          76 :   case 4:
    8443             :     // SSAT, t2SSAT
    8444          76 :     printShiftImmOperand(MI, 3, STI, O);
    8445          76 :     return;
    8446             :     break;
    8447         558 :   case 5:
    8448             :     // SXTB, SXTB16, SXTH, UXTB, UXTB16, UXTH, t2SXTB, t2SXTB16, t2SXTH, t2UX...
    8449         558 :     printRotImmOperand(MI, 2, STI, O);
    8450         558 :     return;
    8451             :     break;
    8452         114 :   case 6:
    8453             :     // VCMLAv2f32_indexed, VCMLAv4f16_indexed, VCMLAv4f32_indexed, VCMLAv8f16...
    8454         114 :     printVectorIndex(MI, 4, STI, O);
    8455         114 :     break;
    8456         415 :   case 7:
    8457             :     // VDUPLN16d, VDUPLN16q, VDUPLN32d, VDUPLN32q, VDUPLN8d, VDUPLN8q, VGETLN...
    8458         415 :     printVectorIndex(MI, 2, STI, O);
    8459         415 :     return;
    8460             :     break;
    8461         433 :   case 8:
    8462             :     // VFMAD, VFMAH, VFMAS, VFMAfd, VFMAfq, VFMAhd, VFMAhq, VFMSD, VFMSH, VFM...
    8463         433 :     printOperand(MI, 3, STI, O);
    8464         433 :     break;
    8465         262 :   case 9:
    8466             :     // VLD1DUPd16wb_register, VLD1DUPd32wb_register, VLD1DUPd8wb_register, VL...
    8467         262 :     printOperand(MI, 4, STI, O);
    8468         262 :     return;
    8469             :     break;
    8470         248 :   case 10:
    8471             :     // VLD1LNd16, VLD1LNd16_UPD, VLD1LNd32, VLD1LNd32_UPD, VLD1LNd8, VLD1LNd8...
    8472         248 :     O << "]}, ";
    8473         248 :     break;
    8474             :   case 11:
    8475             :     // VLD1LNdWB_fixed_Asm_16, VLD1LNdWB_fixed_Asm_32, VLD1LNdWB_fixed_Asm_8,...
    8476             :     O << '!';
    8477             :     return;
    8478             :     break;
    8479         229 :   case 12:
    8480             :     // VLD2LNd16, VLD2LNd32, VLD2LNd8, VLD2LNq16, VLD2LNq32, VLD4LNd16, VLD4L...
    8481         229 :     O << "], ";
    8482         229 :     break;
    8483          70 :   case 13:
    8484             :     // VLD2LNd16_UPD, VLD2LNd32_UPD, VLD2LNd8_UPD, VLD2LNq16_UPD, VLD2LNq32_U...
    8485          70 :     printOperand(MI, 1, STI, O);
    8486             :     O << '[';
    8487          70 :     printNoHashImmediate(MI, 8, STI, O);
    8488          70 :     break;
    8489          19 :   case 14:
    8490             :     // VLD3DUPd16, VLD3DUPd32, VLD3DUPd8, VLD3DUPq16, VLD3DUPq32, VLD3DUPq8
    8491          19 :     printAddrMode6Operand(MI, 3, STI, O);
    8492          19 :     return;
    8493             :     break;
    8494          70 :   case 15:
    8495             :     // VLD3DUPd16_UPD, VLD3DUPd32_UPD, VLD3DUPd8_UPD, VLD3DUPq16_UPD, VLD3DUP...
    8496          70 :     printAddrMode6Operand(MI, 4, STI, O);
    8497          70 :     break;
    8498          54 :   case 16:
    8499             :     // VLD4DUPd16_UPD, VLD4DUPd32_UPD, VLD4DUPd8_UPD, VLD4DUPq16_UPD, VLD4DUP...
    8500          54 :     printAddrMode6Operand(MI, 5, STI, O);
    8501          54 :     printAddrMode6OffsetOperand(MI, 7, STI, O);
    8502          54 :     return;
    8503             :     break;
    8504          52 :   case 17:
    8505             :     // VMULLslsv2i32, VMULLslsv4i16, VMULLsluv2i32, VMULLsluv4i16, VMULslv2i3...
    8506          52 :     printVectorIndex(MI, 3, STI, O);
    8507          52 :     return;
    8508             :     break;
    8509          73 :   case 18:
    8510             :     // VST3d16_UPD, VST3d32_UPD, VST3d8_UPD, VST3q16_UPD, VST3q32_UPD, VST3q8...
    8511          73 :     O << "}, ";
    8512          73 :     printAddrMode6Operand(MI, 1, STI, O);
    8513          73 :     printAddrMode6OffsetOperand(MI, 3, STI, O);
    8514          73 :     return;
    8515             :     break;
    8516          51 :   case 19:
    8517             :     // VST4LNd16_UPD, VST4LNd32_UPD, VST4LNd8_UPD, VST4LNq16_UPD, VST4LNq32_U...
    8518          51 :     printOperand(MI, 5, STI, O);
    8519             :     O << '[';
    8520          51 :     printNoHashImmediate(MI, 8, STI, O);
    8521          51 :     O << "], ";
    8522          51 :     printOperand(MI, 6, STI, O);
    8523             :     O << '[';
    8524          51 :     printNoHashImmediate(MI, 8, STI, O);
    8525          51 :     O << "], ";
    8526          51 :     printOperand(MI, 7, STI, O);
    8527             :     O << '[';
    8528          51 :     printNoHashImmediate(MI, 8, STI, O);
    8529          51 :     O << "]}, ";
    8530          51 :     printAddrMode6Operand(MI, 1, STI, O);
    8531          51 :     printAddrMode6OffsetOperand(MI, 3, STI, O);
    8532          51 :     return;
    8533             :     break;
    8534           2 :   case 20:
    8535             :     // sysLDMDA, sysLDMDB, sysLDMIA, sysLDMIB, sysSTMDA, sysSTMDB, sysSTMIA, ...
    8536           2 :     O << " ^";
    8537           2 :     return;
    8538             :     break;
    8539        1210 :   case 21:
    8540             :     // t2LDRB_POST, t2LDRH_POST, t2LDRSB_POST, t2LDRSH_POST, t2LDR_POST, t2ST...
    8541        1210 :     printT2AddrModeImm8OffsetOperand(MI, 3, STI, O);
    8542        1210 :     return;
    8543             :     break;
    8544           5 :   case 22:
    8545             :     // t2MOVsra_flag, t2MOVsrl_flag
    8546           5 :     O << ", #1";
    8547           5 :     return;
    8548             :     break;
    8549             :   }
    8550             : 
    8551             : 
    8552             :   // Fragment 6 encoded into 6 bits for 38 unique commands.
    8553       29884 :   switch ((Bits >> 47) & 63) {
    8554           0 :   default: llvm_unreachable("Invalid command number.");
    8555        5468 :   case 0:
    8556             :     // ADCri, ADDri, ANDri, BICri, EORri, ORRri, RSBri, RSCri, SBCri, SUBri
    8557        5468 :     printModImmOperand(MI, 2, STI, O);
    8558        5468 :     return;
    8559             :     break;
    8560       14320 :   case 1:
    8561             :     // ADCrr, ADDrr, ANDrr, ASRi, ASRr, BICrr, EORrr, LSLi, LSLr, LSRi, LSRr,...
    8562       14320 :     printOperand(MI, 2, STI, O);
    8563       14320 :     break;
    8564         891 :   case 2:
    8565             :     // ADCrsi, ADDrsi, ANDrsi, BICrsi, EORrsi, ORRrsi, RSBrsi, RSCrsi, SBCrsi...
    8566         891 :     printSORegImmOperand(MI, 2, STI, O);
    8567         891 :     return;
    8568             :     break;
    8569          70 :   case 3:
    8570             :     // BFI, t2BFI
    8571          70 :     printBitfieldInvMaskImmOperand(MI, 3, STI, O);
    8572          70 :     return;
    8573             :     break;
    8574          96 :   case 4:
    8575             :     // LDCL_OPTION, LDC_OPTION, STCL_OPTION, STC_OPTION, t2LDC2L_OPTION, t2LD...
    8576          96 :     printCoprocOptionImm(MI, 3, STI, O);
    8577          96 :     return;
    8578             :     break;
    8579         204 :   case 5:
    8580             :     // LDCL_POST, LDC_POST, STCL_POST, STC_POST, t2LDC2L_POST, t2LDC2_POST, t...
    8581         204 :     printPostIdxImm8s4Operand(MI, 3, STI, O);
    8582         204 :     return;
    8583             :     break;
    8584        1833 :   case 6:
    8585             :     // LDRBT_POST_IMM, LDRBT_POST_REG, LDRB_POST_IMM, LDRB_POST_REG, LDRT_POS...
    8586        1833 :     printAddrMode2OffsetOperand(MI, 3, STI, O);
    8587        1833 :     return;
    8588             :     break;
    8589         107 :   case 7:
    8590             :     // LDRD, STRD
    8591         107 :     printAddrMode3Operand<false>(MI, 2, STI, O);
    8592         107 :     return;
    8593             :     break;
    8594         109 :   case 8:
    8595             :     // LDRD_POST, STRD_POST, t2LDRD_POST, t2STRD_POST
    8596         109 :     printAddrMode7Operand(MI, 3, STI, O);
    8597         109 :     break;
    8598          12 :   case 9:
    8599             :     // LDRD_PRE, STRD_PRE
    8600          12 :     printAddrMode3Operand<true>(MI, 3, STI, O);
    8601             :     O << '!';
    8602             :     return;
    8603             :     break;
    8604          25 :   case 10:
    8605             :     // LDRHTi, LDRSBTi, LDRSHTi, STRHTi
    8606          25 :     printPostIdxImm8Operand(MI, 3, STI, O);
    8607          25 :     return;
    8608             :     break;
    8609          27 :   case 11:
    8610             :     // LDRHTr, LDRSBTr, LDRSHTr, STRHTr
    8611          27 :     printPostIdxRegOperand(MI, 3, STI, O);
    8612          27 :     return;
    8613             :     break;
    8614         366 :   case 12:
    8615             :     // LDRH_POST, LDRSB_POST, LDRSH_POST, STRH_POST
    8616         366 :     printAddrMode3OffsetOperand(MI, 3, STI, O);
    8617         366 :     return;
    8618             :     break;
    8619         156 :   case 13:
    8620             :     // MCR, MCRR, VCMLAv2f32_indexed, VCMLAv4f16_indexed, VCMLAv4f32_indexed,...
    8621         156 :     O << ", ";
    8622         156 :     break;
    8623           7 :   case 14:
    8624             :     // MCRR2
    8625           7 :     printCImmediate(MI, 4, STI, O);
    8626           7 :     return;
    8627             :     break;
    8628         329 :   case 15:
    8629             :     // STLEX, STLEXB, STLEXH, STREX, STREXB, STREXH, SWP, SWPB, t2LDAEXD, t2L...
    8630         329 :     printAddrMode7Operand(MI, 2, STI, O);
    8631         329 :     return;
    8632             :     break;
    8633             :   case 16:
    8634             :     // VABDfd, VABDfq, VABDhd, VABDhq, VACGEfd, VACGEfq, VACGEhd, VACGEhq, VA...
    8635             :     return;
    8636             :     break;
    8637         395 :   case 17:
    8638             :     // VBIFd, VBIFq, VBITd, VBITq, VBSLd, VBSLq, VLD4LNd16, VLD4LNd32, VLD4LN...
    8639         395 :     printOperand(MI, 3, STI, O);
    8640         395 :     break;
    8641          32 :   case 18:
    8642             :     // VCADDv2f32, VCADDv4f16, VCADDv4f32, VCADDv8f16
    8643          32 :     printComplexRotationOp<180, 90>(MI, 3, STI, O);
    8644          32 :     return;
    8645             :     break;
    8646          48 :   case 19:
    8647             :     // VCMLAv2f32, VCMLAv4f16, VCMLAv4f32, VCMLAv8f16
    8648          48 :     printComplexRotationOp<90, 0>(MI, 4, STI, O);
    8649          48 :     return;
    8650             :     break;
    8651         182 :   case 20:
    8652             :     // VLD1LNd16, VLD1LNd32, VLD1LNd8, VST1LNd16_UPD, VST1LNd32_UPD, VST1LNd8...
    8653         182 :     printAddrMode6Operand(MI, 1, STI, O);
    8654         182 :     break;
    8655          44 :   case 21:
    8656             :     // VLD1LNd16_UPD, VLD1LNd32_UPD, VLD1LNd8_UPD
    8657          44 :     printAddrMode6Operand(MI, 2, STI, O);
    8658          44 :     printAddrMode6OffsetOperand(MI, 4, STI, O);
    8659          44 :     return;
    8660             :     break;
    8661         122 :   case 22:
    8662             :     // VLD1LNdWB_register_Asm_16, VLD1LNdWB_register_Asm_32, VLD1LNdWB_regist...
    8663         122 :     printOperand(MI, 4, STI, O);
    8664         122 :     break;
    8665          50 :   case 23:
    8666             :     // VLD2LNd16, VLD2LNd32, VLD2LNd8, VLD2LNq16, VLD2LNq32
    8667          50 :     printOperand(MI, 1, STI, O);
    8668             :     O << '[';
    8669          50 :     printNoHashImmediate(MI, 6, STI, O);
    8670          50 :     O << "]}, ";
    8671          50 :     printAddrMode6Operand(MI, 2, STI, O);
    8672          50 :     return;
    8673             :     break;
    8674          27 :   case 24:
    8675             :     // VLD2LNd16_UPD, VLD2LNd32_UPD, VLD2LNd8_UPD, VLD2LNq16_UPD, VLD2LNq32_U...
    8676          27 :     O << "]}, ";
    8677          27 :     printAddrMode6Operand(MI, 3, STI, O);
    8678          27 :     printAddrMode6OffsetOperand(MI, 5, STI, O);
    8679          27 :     return;
    8680             :     break;
    8681          37 :   case 25:
    8682             :     // VLD3DUPd16_UPD, VLD3DUPd32_UPD, VLD3DUPd8_UPD, VLD3DUPq16_UPD, VLD3DUP...
    8683          37 :     printAddrMode6OffsetOperand(MI, 6, STI, O);
    8684          37 :     return;
    8685             :     break;
    8686          43 :   case 26:
    8687             :     // VLD3LNd16, VLD3LNd32, VLD3LNd8, VLD3LNq16, VLD3LNq32
    8688          43 :     O << "], ";
    8689          43 :     printOperand(MI, 2, STI, O);
    8690             :     O << '[';
    8691          43 :     printNoHashImmediate(MI, 8, STI, O);
    8692          43 :     O << "]}, ";
    8693          43 :     printAddrMode6Operand(MI, 3, STI, O);
    8694          43 :     return;
    8695             :     break;
    8696          22 :   case 27:
    8697             :     // VLD3LNd16_UPD, VLD3LNd32_UPD, VLD3LNd8_UPD, VLD3LNq16_UPD, VLD3LNq32_U...
    8698          22 :     printAddrMode6Operand(MI, 4, STI, O);
    8699          22 :     printAddrMode6OffsetOperand(MI, 6, STI, O);
    8700          22 :     return;
    8701             :     break;
    8702          16 :   case 28:
    8703             :     // VMLAslfd, VMLAslfq, VMLAslhd, VMLAslhq, VMLSslfd, VMLSslfq, VMLSslhd, ...
    8704          16 :     printVectorIndex(MI, 4, STI, O);
    8705          16 :     return;
    8706             :     break;
    8707          24 :   case 29:
    8708             :     // VMULslfd, VMULslfq, VMULslhd, VMULslhq
    8709          24 :     printVectorIndex(MI, 3, STI, O);
    8710          24 :     return;
    8711             :     break;
    8712          19 :   case 30:
    8713             :     // VST2LNd16_UPD, VST2LNd32_UPD, VST2LNd8_UPD, VST2LNq16_UPD, VST2LNq32_U...
    8714          19 :     printOperand(MI, 5, STI, O);
    8715             :     O << '[';
    8716          19 :     printNoHashImmediate(MI, 6, STI, O);
    8717          19 :     O << "]}, ";
    8718          19 :     printAddrMode6Operand(MI, 1, STI, O);
    8719          19 :     printAddrMode6OffsetOperand(MI, 3, STI, O);
    8720          19 :     return;
    8721             :     break;
    8722         105 :   case 31:
    8723             :     // VST4d16_UPD, VST4d32_UPD, VST4d8_UPD, VST4q16_UPD, VST4q32_UPD, VST4q8...
    8724         105 :     printOperand(MI, 7, STI, O);
    8725         105 :     O << "}, ";
    8726         105 :     printAddrMode6Operand(MI, 1, STI, O);
    8727         105 :     printAddrMode6OffsetOperand(MI, 3, STI, O);
    8728         105 :     return;
    8729             :     break;
    8730         432 :   case 32:
    8731             :     // t2ADCrs, t2ADDrs, t2ANDrs, t2BICrs, t2EORrs, t2ORNrs, t2ORRrs, t2RSBrs...
    8732         432 :     printT2SOOperand(MI, 2, STI, O);
    8733         432 :     return;
    8734             :     break;
    8735          83 :   case 33:
    8736             :     // t2ASRri, t2LSRri
    8737          83 :     printThumbSRImm(MI, 2, STI, O);
    8738          83 :     return;
    8739             :     break;
    8740          62 :   case 34:
    8741             :     // t2LDRD_PRE, t2STRD_PRE
    8742          62 :     printT2AddrModeImm8s4Operand<true>(MI, 3, STI, O);
    8743             :     O << '!';
    8744             :     return;
    8745             :     break;
    8746         268 :   case 35:
    8747             :     // t2LDRDi8, t2STRDi8
    8748         268 :     printT2AddrModeImm8s4Operand<false>(MI, 2, STI, O);
    8749         268 :     return;
    8750             :     break;
    8751          68 :   case 36:
    8752             :     // t2STREX
    8753          68 :     printT2AddrModeImm0_1020s4Operand(MI, 2, STI, O);
    8754          68 :     return;
    8755             :     break;
    8756         981 :   case 37:
    8757             :     // tADDrSPi
    8758         981 :     printThumbS4ImmOperand(MI, 2, STI, O);
    8759         981 :     return;
    8760             :     break;
    8761             :   }
    8762             : 
    8763             : 
    8764             :   // Fragment 7 encoded into 4 bits for 13 unique commands.
    8765       15284 :   switch ((Bits >> 53) & 15) {
    8766           0 :   default: llvm_unreachable("Invalid command number.");
    8767             :   case 0:
    8768             :     // ADCrr, ADDrr, ANDrr, ASRi, ASRr, BICrr, EORrr, LSLi, LSLr, LSRi, LSRr,...
    8769             :     return;
    8770             :     break;
    8771        1501 :   case 1:
    8772             :     // LDRD_POST, MLA, MLS, SBFX, SMLABB, SMLABT, SMLAD, SMLADX, SMLALBB, SML...
    8773        1501 :     O << ", ";
    8774        1501 :     break;
    8775          59 :   case 2:
    8776             :     // MCR, t2MCR, t2MCR2
    8777          59 :     printCImmediate(MI, 3, STI, O);
    8778          59 :     O << ", ";
    8779          59 :     printCImmediate(MI, 4, STI, O);
    8780          59 :     O << ", ";
    8781          59 :     printOperand(MI, 5, STI, O);
    8782          59 :     return;
    8783             :     break;
    8784          45 :   case 3:
    8785             :     // MCRR, t2MCRR, t2MCRR2
    8786          45 :     printOperand(MI, 3, STI, O);
    8787          45 :     O << ", ";
    8788          45 :     printCImmediate(MI, 4, STI, O);
    8789          45 :     return;
    8790             :     break;
    8791          47 :   case 4:
    8792             :     // PKHBT, t2PKHBT
    8793          47 :     printPKHLSLShiftImm(MI, 3, STI, O);
    8794          47 :     return;
    8795             :     break;
    8796          26 :   case 5:
    8797             :     // PKHTB, t2PKHTB
    8798          26 :     printPKHASRShiftImm(MI, 3, STI, O);
    8799          26 :     return;
    8800             :     break;
    8801         309 :   case 6:
    8802             :     // SXTAB, SXTAB16, SXTAH, UXTAB, UXTAB16, UXTAH, t2SXTAB, t2SXTAB16, t2SX...
    8803         309 :     printRotImmOperand(MI, 3, STI, O);
    8804         309 :     return;
    8805             :     break;
    8806          84 :   case 7:
    8807             :     // USAT, t2USAT
    8808          84 :     printShiftImmOperand(MI, 3, STI, O);
    8809          84 :     return;
    8810             :     break;
    8811          52 :   case 8:
    8812             :     // VCMLAv2f32_indexed, VCMLAv4f16_indexed, VCMLAv4f32_indexed, VCMLAv8f16...
    8813          52 :     printComplexRotationOp<90, 0>(MI, 5, STI, O);
    8814          52 :     return;
    8815             :     break;
    8816         211 :   case 9:
    8817             :     // VLD3d16, VLD3d16_UPD, VLD3d32, VLD3d32_UPD, VLD3d8, VLD3d8_UPD, VLD3q1...
    8818         211 :     O << "}, ";
    8819         211 :     break;
    8820             :   case 10:
    8821             :     // VLD4LNd16, VLD4LNd32, VLD4LNd8, VLD4LNq16, VLD4LNq32, VST2LNd16, VST2L...
    8822             :     O << '[';
    8823             :     break;
    8824          42 :   case 11:
    8825             :     // VST1LNd16_UPD, VST1LNd32_UPD, VST1LNd8_UPD
    8826          42 :     printAddrMode6OffsetOperand(MI, 3, STI, O);
    8827          42 :     return;
    8828             :     break;
    8829          79 :   case 12:
    8830             :     // t2LDRD_POST, t2STRD_POST
    8831          79 :     printT2AddrModeImm8s4OffsetOperand(MI, 4, STI, O);
    8832          79 :     return;
    8833             :     break;
    8834             :   }
    8835             : 
    8836             : 
    8837             :   // Fragment 8 encoded into 4 bits for 12 unique commands.
    8838        1872 :   switch ((Bits >> 57) & 15) {
    8839           0 :   default: llvm_unreachable("Invalid command number.");
    8840          30 :   case 0:
    8841             :     // LDRD_POST, STRD_POST
    8842          30 :     printAddrMode3OffsetOperand(MI, 4, STI, O);
    8843          30 :     return;
    8844             :     break;
    8845        1175 :   case 1:
    8846             :     // MLA, MLS, SMLABB, SMLABT, SMLAD, SMLADX, SMLALBB, SMLALBT, SMLALD, SML...
    8847        1175 :     printOperand(MI, 3, STI, O);
    8848             :     break;
    8849         167 :   case 2:
    8850             :     // SBFX, UBFX, t2SBFX, t2UBFX
    8851         167 :     printImmPlusOneOperand(MI, 3, STI, O);
    8852         167 :     return;
    8853             :     break;
    8854          69 :   case 3:
    8855             :     // VLD3d16, VLD3d32, VLD3d8, VLD3q16, VLD3q32, VLD3q8
    8856          69 :     printAddrMode6Operand(MI, 3, STI, O);
    8857          69 :     return;
    8858             :     break;
    8859          85 :   case 4:
    8860             :     // VLD3d16_UPD, VLD3d32_UPD, VLD3d8_UPD, VLD3q16_UPD, VLD3q32_UPD, VLD3q8...
    8861          85 :     printAddrMode6Operand(MI, 4, STI, O);
    8862          85 :     printAddrMode6OffsetOperand(MI, 6, STI, O);
    8863          85 :     return;
    8864             :     break;
    8865          47 :   case 5:
    8866             :     // VLD4LNd16, VLD4LNd32, VLD4LNd8, VLD4LNq16, VLD4LNq32
    8867          47 :     printNoHashImmediate(MI, 10, STI, O);
    8868          47 :     O << "]}, ";
    8869          47 :     printAddrMode6Operand(MI, 4, STI, O);
    8870          47 :     return;
    8871             :     break;
    8872          37 :   case 6:
    8873             :     // VST2LNd16, VST2LNd32, VST2LNd8, VST2LNq16, VST2LNq32
    8874          37 :     printNoHashImmediate(MI, 4, STI, O);
    8875          37 :     O << "]}, ";
    8876          37 :     printAddrMode6Operand(MI, 0, STI, O);
    8877          37 :     return;
    8878             :     break;
    8879          33 :   case 7:
    8880             :     // VST3LNd16, VST3LNd32, VST3LNd8, VST3LNq16, VST3LNq32
    8881          33 :     printNoHashImmediate(MI, 5, STI, O);
    8882          33 :     O << "], ";
    8883          33 :     printOperand(MI, 4, STI, O);
    8884             :     O << '[';
    8885          33 :     printNoHashImmediate(MI, 5, STI, O);
    8886          33 :     O << "]}, ";
    8887          33 :     printAddrMode6Operand(MI, 0, STI, O);
    8888          33 :     return;
    8889             :     break;
    8890          57 :   case 8:
    8891             :     // VST3d16, VST3d32, VST3d8, VST3q16, VST3q32, VST3q8
    8892          57 :     printAddrMode6Operand(MI, 0, STI, O);
    8893          57 :     return;
    8894             :     break;
    8895          43 :   case 9:
    8896             :     // VST4LNd16, VST4LNd32, VST4LNd8, VST4LNq16, VST4LNq32
    8897          43 :     printNoHashImmediate(MI, 6, STI, O);
    8898          43 :     O << "], ";
    8899          43 :     printOperand(MI, 4, STI, O);
    8900             :     O << '[';
    8901          43 :     printNoHashImmediate(MI, 6, STI, O);
    8902          43 :     O << "], ";
    8903          43 :     printOperand(MI, 5, STI, O);
    8904             :     O << '[';
    8905          43 :     printNoHashImmediate(MI, 6, STI, O);
    8906          43 :     O << "]}, ";
    8907          43 :     printAddrMode6Operand(MI, 0, STI, O);
    8908          43 :     return;
    8909             :     break;
    8910          65 :   case 10:
    8911             :     // VST4d16, VST4d32, VST4d8, VST4q16, VST4q32, VST4q8
    8912          65 :     printOperand(MI, 5, STI, O);
    8913          65 :     O << "}, ";
    8914          65 :     printAddrMode6Operand(MI, 0, STI, O);
    8915          65 :     return;
    8916             :     break;
    8917          64 :   case 11:
    8918             :     // t2STLEXD, t2STREXD
    8919          64 :     printAddrMode7Operand(MI, 3, STI, O);
    8920          64 :     return;
    8921             :     break;
    8922             :   }
    8923             : 
    8924             : 
    8925             :   // Fragment 9 encoded into 1 bits for 2 unique commands.
    8926        1175 :   if ((Bits >> 61) & 1) {
    8927             :     // VLD4d16, VLD4d16_UPD, VLD4d32, VLD4d32_UPD, VLD4d8, VLD4d8_UPD, VLD4q1...
    8928         161 :     O << "}, ";
    8929             :   } else {
    8930             :     // MLA, MLS, SMLABB, SMLABT, SMLAD, SMLADX, SMLALBB, SMLALBT, SMLALD, SML...
    8931             :     return;
    8932             :   }
    8933             : 
    8934             : 
    8935             :   // Fragment 10 encoded into 1 bits for 2 unique commands.
    8936         161 :   if ((Bits >> 62) & 1) {
    8937             :     // VLD4d16_UPD, VLD4d32_UPD, VLD4d8_UPD, VLD4q16_UPD, VLD4q32_UPD, VLD4q8...
    8938          99 :     printAddrMode6Operand(MI, 5, STI, O);
    8939          99 :     printAddrMode6OffsetOperand(MI, 7, STI, O);
    8940          99 :     return;
    8941             :   } else {
    8942             :     // VLD4d16, VLD4d32, VLD4d8, VLD4q16, VLD4q32, VLD4q8
    8943          62 :     printAddrMode6Operand(MI, 4, STI, O);
    8944          62 :     return;
    8945             :   }
    8946             : 
    8947             : }
    8948             : 
    8949             : 
    8950             : /// getRegisterName - This method is automatically generated by tblgen
    8951             : /// from the register set description.  This returns the assembler name
    8952             : /// for the specified register.
    8953      278772 : const char *ARMInstPrinter::getRegisterName(unsigned RegNo) {
    8954             :   assert(RegNo && RegNo < 289 && "Invalid register number!");
    8955             : 
    8956             :   static const char AsmStrs[] = {
    8957             :   /* 0 */ 'D', '4', '_', 'D', '6', '_', 'D', '8', '_', 'D', '1', '0', 0,
    8958             :   /* 13 */ 'D', '7', '_', 'D', '8', '_', 'D', '9', '_', 'D', '1', '0', 0,
    8959             :   /* 26 */ 'Q', '7', '_', 'Q', '8', '_', 'Q', '9', '_', 'Q', '1', '0', 0,
    8960             :   /* 39 */ 'd', '1', '0', 0,
    8961             :   /* 43 */ 'q', '1', '0', 0,
    8962             :   /* 47 */ 'r', '1', '0', 0,
    8963             :   /* 51 */ 's', '1', '0', 0,
    8964             :   /* 55 */ 'D', '1', '4', '_', 'D', '1', '6', '_', 'D', '1', '8', '_', 'D', '2', '0', 0,
    8965             :   /* 71 */ 'D', '1', '7', '_', 'D', '1', '8', '_', 'D', '1', '9', '_', 'D', '2', '0', 0,
    8966             :   /* 87 */ 'd', '2', '0', 0,
    8967             :   /* 91 */ 's', '2', '0', 0,
    8968             :   /* 95 */ 'D', '2', '4', '_', 'D', '2', '6', '_', 'D', '2', '8', '_', 'D', '3', '0', 0,
    8969             :   /* 111 */ 'D', '2', '7', '_', 'D', '2', '8', '_', 'D', '2', '9', '_', 'D', '3', '0', 0,
    8970             :   /* 127 */ 'd', '3', '0', 0,
    8971             :   /* 131 */ 's', '3', '0', 0,
    8972             :   /* 135 */ 'd', '0', 0,
    8973             :   /* 138 */ 'q', '0', 0,
    8974             :   /* 141 */ 'm', 'v', 'f', 'r', '0', 0,
    8975             :   /* 147 */ 's', '0', 0,
    8976             :   /* 150 */ 'D', '9', '_', 'D', '1', '0', '_', 'D', '1', '1', 0,
    8977             :   /* 161 */ 'D', '5', '_', 'D', '7', '_', 'D', '9', '_', 'D', '1', '1', 0,
    8978             :   /* 174 */ 'Q', '8', '_', 'Q', '9', '_', 'Q', '1', '0', '_', 'Q', '1', '1', 0,
    8979             :   /* 188 */ 'R', '1', '0', '_', 'R', '1', '1', 0,
    8980             :   /* 196 */ 'd', '1', '1', 0,
    8981             :   /* 200 */ 'q', '1', '1', 0,
    8982             :   /* 204 */ 'r', '1', '1', 0,
    8983             :   /* 208 */ 's', '1', '1', 0,
    8984             :   /* 212 */ 'D', '1', '9', '_', 'D', '2', '0', '_', 'D', '2', '1', 0,
    8985             :   /* 224 */ 'D', '1', '5', '_', 'D', '1', '7', '_', 'D', '1', '9', '_', 'D', '2', '1', 0,
    8986             :   /* 240 */ 'd', '2', '1', 0,
    8987             :   /* 244 */ 's', '2', '1', 0,
    8988             :   /* 248 */ 'D', '2', '9', '_', 'D', '3', '0', '_', 'D', '3', '1', 0,
    8989             :   /* 260 */ 'D', '2', '5', '_', 'D', '2', '7', '_', 'D', '2', '9', '_', 'D', '3', '1', 0,
    8990             :   /* 276 */ 'd', '3', '1', 0,
    8991             :   /* 280 */ 's', '3', '1', 0,
    8992             :   /* 284 */ 'Q', '0', '_', 'Q', '1', 0,
    8993             :   /* 290 */ 'R', '0', '_', 'R', '1', 0,
    8994             :   /* 296 */ 'd', '1', 0,
    8995             :   /* 299 */ 'q', '1', 0,
    8996             :   /* 302 */ 'm', 'v', 'f', 'r', '1', 0,
    8997             :   /* 308 */ 's', '1', 0,
    8998             :   /* 311 */ 'D', '6', '_', 'D', '8', '_', 'D', '1', '0', '_', 'D', '1', '2', 0,
    8999             :   /* 325 */ 'D', '9', '_', 'D', '1', '0', '_', 'D', '1', '1', '_', 'D', '1', '2', 0,
    9000             :   /* 340 */ 'Q', '9', '_', 'Q', '1', '0', '_', 'Q', '1', '1', '_', 'Q', '1', '2', 0,
    9001             :   /* 355 */ 'd', '1', '2', 0,
    9002             :   /* 359 */ 'q', '1', '2', 0,
    9003             :   /* 363 */ 'r', '1', '2', 0,
    9004             :   /* 367 */ 's', '1', '2', 0,
    9005             :   /* 371 */ 'D', '1', '6', '_', 'D', '1', '8', '_', 'D', '2', '0', '_', 'D', '2', '2', 0,
    9006             :   /* 387 */ 'D', '1', '9', '_', 'D', '2', '0', '_', 'D', '2', '1', '_', 'D', '2', '2', 0,
    9007             :   /* 403 */ 'd', '2', '2', 0,
    9008             :   /* 407 */ 's', '2', '2', 0,
    9009             :   /* 411 */ 'D', '0', '_', 'D', '2', 0,
    9010             :   /* 417 */ 'D', '0', '_', 'D', '1', '_', 'D', '2', 0,
    9011             :   /* 426 */ 'Q', '1', '_', 'Q', '2', 0,
    9012             :   /* 432 */ 'd', '2', 0,
    9013             :   /* 435 */ 'q', '2', 0,
    9014             :   /* 438 */ 'm', 'v', 'f', 'r', '2', 0,
    9015             :   /* 444 */ 's', '2', 0,
    9016             :   /* 447 */ 'f', 'p', 'i', 'n', 's', 't', '2', 0,
    9017             :   /* 455 */ 'D', '7', '_', 'D', '9', '_', 'D', '1', '1', '_', 'D', '1', '3', 0,
    9018             :   /* 469 */ 'D', '1', '1', '_', 'D', '1', '2', '_', 'D', '1', '3', 0,
    9019             :   /* 481 */ 'Q', '1', '0', '_', 'Q', '1', '1', '_', 'Q', '1', '2', '_', 'Q', '1', '3', 0,
    9020             :   /* 497 */ 'd', '1', '3', 0,
    9021             :   /* 501 */ 'q', '1', '3', 0,
    9022             :   /* 505 */ 's', '1', '3', 0,
    9023             :   /* 509 */ 'D', '1', '7', '_', 'D', '1', '9', '_', 'D', '2', '1', '_', 'D', '2', '3', 0,
    9024             :   /* 525 */ 'D', '2', '1', '_', 'D', '2', '2', '_', 'D', '2', '3', 0,
    9025             :   /* 537 */ 'd', '2', '3', 0,
    9026             :   /* 541 */ 's', '2', '3', 0,
    9027             :   /* 545 */ 'D', '1', '_', 'D', '3', 0,
    9028             :   /* 551 */ 'D', '1', '_', 'D', '2', '_', 'D', '3', 0,
    9029             :   /* 560 */ 'Q', '0', '_', 'Q', '1', '_', 'Q', '2', '_', 'Q', '3', 0,
    9030             :   /* 572 */ 'R', '2', '_', 'R', '3', 0,
    9031             :   /* 578 */ 'd', '3', 0,
    9032             :   /* 581 */ 'q', '3', 0,
    9033             :   /* 584 */ 'r', '3', 0,
    9034             :   /* 587 */ 's', '3', 0,
    9035             :   /* 590 */ 'D', '8', '_', 'D', '1', '0', '_', 'D', '1', '2', '_', 'D', '1', '4', 0,
    9036             :   /* 605 */ 'D', '1', '1', '_', 'D', '1', '2', '_', 'D', '1', '3', '_', 'D', '1', '4', 0,
    9037             :   /* 621 */ 'Q', '1', '1', '_', 'Q', '1', '2', '_', 'Q', '1', '3', '_', 'Q', '1', '4', 0,
    9038             :   /* 637 */ 'd', '1', '4', 0,
    9039             :   /* 641 */ 'q', '1', '4', 0,
    9040             :   /* 645 */ 's', '1', '4', 0,
    9041             :   /* 649 */ 'D', '1', '8', '_', 'D', '2', '0', '_', 'D', '2', '2', '_', 'D', '2', '4', 0,
    9042             :   /* 665 */ 'D', '2', '1', '_', 'D', '2', '2', '_', 'D', '2', '3', '_', 'D', '2', '4', 0,
    9043             :   /* 681 */ 'd', '2', '4', 0,
    9044             :   /* 685 */ 's', '2', '4', 0,
    9045             :   /* 689 */ 'D', '0', '_', 'D', '2', '_', 'D', '4', 0,
    9046             :   /* 698 */ 'D', '1', '_', 'D', '2', '_', 'D', '3', '_', 'D', '4', 0,
    9047             :   /* 710 */ 'Q', '1', '_', 'Q', '2', '_', 'Q', '3', '_', 'Q', '4', 0,
    9048             :   /* 722 */ 'd', '4', 0,
    9049             :   /* 725 */ 'q', '4', 0,
    9050             :   /* 728 */ 'r', '4', 0,
    9051             :   /* 731 */ 's', '4', 0,
    9052             :   /* 734 */ 'D', '9', '_', 'D', '1', '1', '_', 'D', '1', '3', '_', 'D', '1', '5', 0,
    9053             :   /* 749 */ 'D', '1', '3', '_', 'D', '1', '4', '_', 'D', '1', '5', 0,
    9054             :   /* 761 */ 'Q', '1', '2', '_', 'Q', '1', '3', '_', 'Q', '1', '4', '_', 'Q', '1', '5', 0,
    9055             :   /* 777 */ 'd', '1', '5', 0,
    9056             :   /* 781 */ 'q', '1', '5', 0,
    9057             :   /* 785 */ 's', '1', '5', 0,
    9058             :   /* 789 */ 'D', '1', '9', '_', 'D', '2', '1', '_', 'D', '2', '3', '_', 'D', '2', '5', 0,
    9059             :   /* 805 */ 'D', '2', '3', '_', 'D', '2', '4', '_', 'D', '2', '5', 0,
    9060             :   /* 817 */ 'd', '2', '5', 0,
    9061             :   /* 821 */ 's', '2', '5', 0,
    9062             :   /* 825 */ 'D', '1', '_', 'D', '3', '_', 'D', '5', 0,
    9063             :   /* 834 */ 'D', '3', '_', 'D', '4', '_', 'D', '5', 0,
    9064             :   /* 843 */ 'Q', '2', '_', 'Q', '3', '_', 'Q', '4', '_', 'Q', '5', 0,
    9065             :   /* 855 */ 'R', '4', '_', 'R', '5', 0,
    9066             :   /* 861 */ 'd', '5', 0,
    9067             :   /* 864 */ 'q', '5', 0,
    9068             :   /* 867 */ 'r', '5', 0,
    9069             :   /* 870 */ 's', '5', 0,
    9070             :   /* 873 */ 'D', '1', '0', '_', 'D', '1', '2', '_', 'D', '1', '4', '_', 'D', '1', '6', 0,
    9071             :   /* 889 */ 'D', '1', '3', '_', 'D', '1', '4', '_', 'D', '1', '5', '_', 'D', '1', '6', 0,
    9072             :   /* 905 */ 'd', '1', '6', 0,
    9073             :   /* 909 */ 's', '1', '6', 0,
    9074             :   /* 913 */ 'D', '2', '0', '_', 'D', '2', '2', '_', 'D', '2', '4', '_', 'D', '2', '6', 0,
    9075             :   /* 929 */ 'D', '2', '3', '_', 'D', '2', '4', '_', 'D', '2', '5', '_', 'D', '2', '6', 0,
    9076             :   /* 945 */ 'd', '2', '6', 0,
    9077             :   /* 949 */ 's', '2', '6', 0,
    9078             :   /* 953 */ 'D', '0', '_', 'D', '2', '_', 'D', '4', '_', 'D', '6', 0,
    9079             :   /* 965 */ 'D', '3', '_', 'D', '4', '_', 'D', '5', '_', 'D', '6', 0,
    9080             :   /* 977 */ 'Q', '3', '_', 'Q', '4', '_', 'Q', '5', '_', 'Q', '6', 0,
    9081             :   /* 989 */ 'd', '6', 0,
    9082             :   /* 992 */ 'q', '6', 0,
    9083             :   /* 995 */ 'r', '6', 0,
    9084             :   /* 998 */ 's', '6', 0,
    9085             :   /* 1001 */ 'D', '1', '1', '_', 'D', '1', '3', '_', 'D', '1', '5', '_', 'D', '1', '7', 0,
    9086             :   /* 1017 */ 'D', '1', '5', '_', 'D', '1', '6', '_', 'D', '1', '7', 0,
    9087             :   /* 1029 */ 'd', '1', '7', 0,
    9088             :   /* 1033 */ 's', '1', '7', 0,
    9089             :   /* 1037 */ 'D', '2', '1', '_', 'D', '2', '3', '_', 'D', '2', '5', '_', 'D', '2', '7', 0,
    9090             :   /* 1053 */ 'D', '2', '5', '_', 'D', '2', '6', '_', 'D', '2', '7', 0,
    9091             :   /* 1065 */ 'd', '2', '7', 0,
    9092             :   /* 1069 */ 's', '2', '7', 0,
    9093             :   /* 1073 */ 'D', '1', '_', 'D', '3', '_', 'D', '5', '_', 'D', '7', 0,
    9094             :   /* 1085 */ 'D', '5', '_', 'D', '6', '_', 'D', '7', 0,
    9095             :   /* 1094 */ 'Q', '4', '_', 'Q', '5', '_', 'Q', '6', '_', 'Q', '7', 0,
    9096             :   /* 1106 */ 'R', '6', '_', 'R', '7', 0,
    9097             :   /* 1112 */ 'd', '7', 0,
    9098             :   /* 1115 */ 'q', '7', 0,
    9099             :   /* 1118 */ 'r', '7', 0,
    9100             :   /* 1121 */ 's', '7', 0,
    9101             :   /* 1124 */ 'D', '1', '2', '_', 'D', '1', '4', '_', 'D', '1', '6', '_', 'D', '1', '8', 0,
    9102             :   /* 1140 */ 'D', '1', '5', '_', 'D', '1', '6', '_', 'D', '1', '7', '_', 'D', '1', '8', 0,
    9103             :   /* 1156 */ 'd', '1', '8', 0,
    9104             :   /* 1160 */ 's', '1', '8', 0,
    9105             :   /* 1164 */ 'D', '2', '2', '_', 'D', '2', '4', '_', 'D', '2', '6', '_', 'D', '2', '8', 0,
    9106             :   /* 1180 */ 'D', '2', '5', '_', 'D', '2', '6', '_', 'D', '2', '7', '_', 'D', '2', '8', 0,
    9107             :   /* 1196 */ 'd', '2', '8', 0,
    9108             :   /* 1200 */ 's', '2', '8', 0,
    9109             :   /* 1204 */ 'D', '2', '_', 'D', '4', '_', 'D', '6', '_', 'D', '8', 0,
    9110             :   /* 1216 */ 'D', '5', '_', 'D', '6', '_', 'D', '7', '_', 'D', '8', 0,
    9111             :   /* 1228 */ 'Q', '5', '_', 'Q', '6', '_', 'Q', '7', '_', 'Q', '8', 0,
    9112             :   /* 1240 */ 'd', '8', 0,
    9113             :   /* 1243 */ 'q', '8', 0,
    9114             :   /* 1246 */ 'r', '8', 0,
    9115             :   /* 1249 */ 's', '8', 0,
    9116             :   /* 1252 */ 'D', '1', '3', '_', 'D', '1', '5', '_', 'D', '1', '7', '_', 'D', '1', '9', 0,
    9117             :   /* 1268 */ 'D', '1', '7', '_', 'D', '1', '8', '_', 'D', '1', '9', 0,
    9118             :   /* 1280 */ 'd', '1', '9', 0,
    9119             :   /* 1284 */ 's', '1', '9', 0,
    9120             :   /* 1288 */ 'D', '2', '3', '_', 'D', '2', '5', '_', 'D', '2', '7', '_', 'D', '2', '9', 0,
    9121             :   /* 1304 */ 'D', '2', '7', '_', 'D', '2', '8', '_', 'D', '2', '9', 0,
    9122             :   /* 1316 */ 'd', '2', '9', 0,
    9123             :   /* 1320 */ 's', '2', '9', 0,
    9124             :   /* 1324 */ 'D', '3', '_', 'D', '5', '_', 'D', '7', '_', 'D', '9', 0,
    9125             :   /* 1336 */ 'D', '7', '_', 'D', '8', '_', 'D', '9', 0,
    9126             :   /* 1345 */ 'Q', '6', '_', 'Q', '7', '_', 'Q', '8', '_', 'Q', '9', 0,
    9127             :   /* 1357 */ 'R', '8', '_', 'R', '9', 0,
    9128             :   /* 1363 */ 'd', '9', 0,
    9129             :   /* 1366 */ 'q', '9', 0,
    9130             :   /* 1369 */ 'r', '9', 0,
    9131             :   /* 1372 */ 's', '9', 0,
    9132             :   /* 1375 */ 'R', '1', '2', '_', 'S', 'P', 0,
    9133             :   /* 1382 */ 'p', 'c', 0,
    9134             :   /* 1385 */ 'f', 'p', 'e', 'x', 'c', 0,
    9135             :   /* 1391 */ 'f', 'p', 's', 'i', 'd', 0,
    9136             :   /* 1397 */ 'i', 't', 's', 't', 'a', 't', 'e', 0,
    9137             :   /* 1405 */ 's', 'p', 0,
    9138             :   /* 1408 */ 'f', 'p', 's', 'c', 'r', 0,
    9139             :   /* 1414 */ 'l', 'r', 0,
    9140             :   /* 1417 */ 'a', 'p', 's', 'r', 0,
    9141             :   /* 1422 */ 'c', 'p', 's', 'r', 0,
    9142             :   /* 1427 */ 's', 'p', 's', 'r', 0,
    9143             :   /* 1432 */ 'f', 'p', 'i', 'n', 's', 't', 0,
    9144             :   /* 1439 */ 'f', 'p', 's', 'c', 'r', '_', 'n', 'z', 'c', 'v', 0,
    9145             :   /* 1450 */ 'a', 'p', 's', 'r', '_', 'n', 'z', 'c', 'v', 0,
    9146             :   };
    9147             : 
    9148             :   static const uint16_t RegAsmOffset[] = {
    9149             :     1417, 1450, 1422, 1385, 1432, 1408, 1439, 1391, 1397, 1414, 1382, 1405, 1427, 135, 
    9150             :     296, 432, 578, 722, 861, 989, 1112, 1240, 1363, 39, 196, 355, 497, 637, 
    9151             :     777, 905, 1029, 1156, 1280, 87, 240, 403, 537, 681, 817, 945, 1065, 1196, 
    9152             :     1316, 127, 276, 447, 141, 302, 438, 138, 299, 435, 581, 725, 864, 992, 
    9153             :     1115, 1243, 1366, 43, 200, 359, 501, 641, 781, 144, 305, 441, 584, 728, 
    9154             :     867, 995, 1118, 1246, 1369, 47, 204, 363, 147, 308, 444, 587, 731, 870, 
    9155             :     998, 1121, 1249, 1372, 51, 208, 367, 505, 645, 785, 909, 1033, 1160, 1284, 
    9156             :     91, 244, 407, 541, 685, 821, 949, 1069, 1200, 1320, 131, 280, 411, 545, 
    9157             :     692, 828, 959, 1079, 1210, 1330, 6, 167, 317, 461, 597, 741, 881, 1009, 
    9158             :     1132, 1260, 63, 232, 379, 517, 657, 797, 921, 1045, 1172, 1296, 103, 268, 
    9159             :     284, 426, 566, 716, 849, 983, 1100, 1234, 1351, 32, 180, 347, 489, 629, 
    9160             :     769, 560, 710, 843, 977, 1094, 1228, 1345, 26, 174, 340, 481, 621, 761, 
    9161             :     1375, 290, 572, 855, 1106, 1357, 188, 417, 551, 701, 834, 968, 1085, 1219, 
    9162             :     1336, 16, 150, 328, 469, 609, 749, 893, 1017, 1144, 1268, 75, 212, 391, 
    9163             :     525, 669, 805, 933, 1053, 1184, 1304, 115, 248, 689, 825, 956, 1076, 1207, 
    9164             :     1327, 3, 164, 314, 458, 593, 737, 877, 1005, 1128, 1256, 59, 228, 375, 
    9165             :     513, 653, 793, 917, 1041, 1168, 1292, 99, 264, 953, 1073, 1204, 1324, 0, 
    9166             :     161, 311, 455, 590, 734, 873, 1001, 1124, 1252, 55, 224, 371, 509, 649, 
    9167             :     789, 913, 1037, 1164, 1288, 95, 260, 420, 704, 971, 1222, 19, 332, 613, 
    9168             :     897, 1148, 79, 395, 673, 937, 1188, 119, 698, 965, 1216, 13, 325, 605, 
    9169             :     889, 1140, 71, 387, 665, 929, 1180, 111, 
    9170             :   };
    9171             : 
    9172             :   assert (*(AsmStrs+RegAsmOffset[RegNo-1]) &&
    9173             :           "Invalid alt name index for register!");
    9174      278772 :   return AsmStrs+RegAsmOffset[RegNo-1];
    9175             : }
    9176             : 
    9177             : #ifdef PRINT_ALIAS_INSTR
    9178             : #undef PRINT_ALIAS_INSTR
    9179             : 
    9180      143323 : bool ARMInstPrinter::printAliasInstr(const MCInst *MI, const MCSubtargetInfo &STI, raw_ostream &OS) {
    9181             :   const char *AsmString;
    9182      143323 :   switch (MI->getOpcode()) {
    9183             :   default: return false;
    9184             :   case ARM::DSB:
    9185          98 :     if (MI->getNumOperands() == 1 &&
    9186         196 :         MI->getOperand(0).isImm() &&
    9187         104 :         MI->getOperand(0).getImm() == 12 &&
    9188         104 :         !STI.getFeatureBits()[ARM::ModeThumb] &&
    9189             :         STI.getFeatureBits()[ARM::FeatureDFB]) {
    9190             :       // (DSB 12)
    9191             :       AsmString = "dfb";
    9192             :       break;
    9193             :     }
    9194             :     return false;
    9195             :   case ARM::HINT:
    9196         192 :     if (MI->getNumOperands() == 3 &&
    9197         384 :         MI->getOperand(0).isImm() &&
    9198         327 :         MI->getOperand(0).getImm() == 0 &&
    9199         327 :         !STI.getFeatureBits()[ARM::ModeThumb] &&
    9200             :         STI.getFeatureBits()[ARM::HasV6KOps]) {
    9201             :       // (HINT 0, pred:$p)
    9202             :       AsmString = "nop$\xFF\x02\x01";
    9203             :       break;
    9204             :     }
    9205          57 :     if (MI->getNumOperands() == 3 &&
    9206         114 :         MI->getOperand(0).isImm() &&
    9207          68 :         MI->getOperand(0).getImm() == 1 &&
    9208          68 :         !STI.getFeatureBits()[ARM::ModeThumb] &&
    9209             :         STI.getFeatureBits()[ARM::HasV6KOps]) {
    9210             :       // (HINT 1, pred:$p)
    9211             :       AsmString = "yield$\xFF\x02\x01";
    9212             :       break;
    9213             :     }
    9214          46 :     if (MI->getNumOperands() == 3 &&
    9215          92 :         MI->getOperand(0).isImm() &&
    9216          57 :         MI->getOperand(0).getImm() == 2 &&
    9217          57 :         !STI.getFeatureBits()[ARM::ModeThumb] &&
    9218             :         STI.getFeatureBits()[ARM::HasV6KOps]) {
    9219             :       // (HINT 2, pred:$p)
    9220             :       AsmString = "wfe$\xFF\x02\x01";
    9221             :       break;
    9222             :     }
    9223          35 :     if (MI->getNumOperands() == 3 &&
    9224          70 :         MI->getOperand(0).isImm() &&
    9225          46 :         MI->getOperand(0).getImm() == 3 &&
    9226          46 :         !STI.getFeatureBits()[ARM::ModeThumb] &&
    9227             :         STI.getFeatureBits()[ARM::HasV6KOps]) {
    9228             :       // (HINT 3, pred:$p)
    9229             :       AsmString = "wfi$\xFF\x02\x01";
    9230             :       break;
    9231             :     }
    9232          24 :     if (MI->getNumOperands() == 3 &&
    9233          48 :         MI->getOperand(0).isImm() &&
    9234          35 :         MI->getOperand(0).getImm() == 4 &&
    9235          35 :         !STI.getFeatureBits()[ARM::ModeThumb] &&
    9236             :         STI.getFeatureBits()[ARM::HasV6KOps]) {
    9237             :       // (HINT 4, pred:$p)
    9238             :       AsmString = "sev$\xFF\x02\x01";
    9239             :       break;
    9240             :     }
    9241          13 :     if (MI->getNumOperands() == 3 &&
    9242          26 :         MI->getOperand(0).isImm() &&
    9243          18 :         MI->getOperand(0).getImm() == 5 &&
    9244          18 :         !STI.getFeatureBits()[ARM::ModeThumb] &&
    9245             :         STI.getFeatureBits()[ARM::HasV8Ops]) {
    9246             :       // (HINT 5, pred:$p)
    9247             :       AsmString = "sevl$\xFF\x02\x01";
    9248             :       break;
    9249             :     }
    9250          10 :     if (MI->getNumOperands() == 3 &&
    9251          20 :         MI->getOperand(0).isImm() &&
    9252          13 :         MI->getOperand(0).getImm() == 16 &&
    9253          13 :         !STI.getFeatureBits()[ARM::ModeThumb] &&
    9254             :         STI.getFeatureBits()[ARM::FeatureRAS]) {
    9255             :       // (HINT 16, pred:$p)
    9256             :       AsmString = "esb$\xFF\x02\x01";
    9257             :       break;
    9258             :     }
    9259           8 :     if (MI->getNumOperands() == 3 &&
    9260          16 :         MI->getOperand(0).isImm() &&
    9261          10 :         MI->getOperand(0).getImm() == 20 &&
    9262          10 :         !STI.getFeatureBits()[ARM::ModeThumb] &&
    9263             :         STI.getFeatureBits()[ARM::HasV6KOps]) {
    9264             :       // (HINT 20, pred:$p)
    9265             :       AsmString = "csdb$\xFF\x02\x01";
    9266             :       break;
    9267             :     }
    9268             :     return false;
    9269             :   case ARM::t2DSB:
    9270          90 :     if (MI->getNumOperands() == 3 &&
    9271         180 :         MI->getOperand(0).isImm() &&
    9272         186 :         MI->getOperand(0).getImm() == 12 &&
    9273             :         STI.getFeatureBits()[ARM::FeatureDFB]) {
    9274             :       // (t2DSB 12, pred:$p)
    9275             :       AsmString = "dfb$\xFF\x02\x01";
    9276             :       break;
    9277             :     }
    9278             :     return false;
    9279             :   case ARM::t2HINT:
    9280          35 :     if (MI->getNumOperands() == 3 &&
    9281          70 :         MI->getOperand(0).isImm() &&
    9282          41 :         MI->getOperand(0).getImm() == 0 &&
    9283          41 :         STI.getFeatureBits()[ARM::ModeThumb] &&
    9284             :         STI.getFeatureBits()[ARM::FeatureThumb2]) {
    9285             :       // (t2HINT 0, pred:$p)
    9286             :       AsmString = "nop$\xFF\x02\x01.w";
    9287             :       break;
    9288             :     }
    9289          29 :     if (MI->getNumOperands() == 3 &&
    9290          58 :         MI->getOperand(0).isImm() &&
    9291          31 :         MI->getOperand(0).getImm() == 1 &&
    9292          31 :         STI.getFeatureBits()[ARM::ModeThumb] &&
    9293             :         STI.getFeatureBits()[ARM::FeatureThumb2]) {
    9294             :       // (t2HINT 1, pred:$p)
    9295             :       AsmString = "yield$\xFF\x02\x01.w";
    9296             :       break;
    9297             :     }
    9298          27 :     if (MI->getNumOperands() == 3 &&
    9299          54 :         MI->getOperand(0).isImm() &&
    9300          29 :         MI->getOperand(0).getImm() == 2 &&
    9301          29 :         STI.getFeatureBits()[ARM::ModeThumb] &&
    9302             :         STI.getFeatureBits()[ARM::FeatureThumb2]) {
    9303             :       // (t2HINT 2, pred:$p)
    9304             :       AsmString = "wfe$\xFF\x02\x01.w";
    9305             :       break;
    9306             :     }
    9307          25 :     if (MI->getNumOperands() == 3 &&
    9308          50 :         MI->getOperand(0).isImm() &&
    9309          27 :         MI->getOperand(0).getImm() == 3 &&
    9310          27 :         STI.getFeatureBits()[ARM::ModeThumb] &&
    9311             :         STI.getFeatureBits()[ARM::FeatureThumb2]) {
    9312             :       // (t2HINT 3, pred:$p)
    9313             :       AsmString = "wfi$\xFF\x02\x01.w";
    9314             :       break;
    9315             :     }
    9316          23 :     if (MI->getNumOperands() == 3 &&
    9317          46 :         MI->getOperand(0).isImm() &&
    9318          31 :         MI->getOperand(0).getImm() == 4 &&
    9319          31 :         STI.getFeatureBits()[ARM::ModeThumb] &&
    9320             :         STI.getFeatureBits()[ARM::FeatureThumb2]) {
    9321             :       // (t2HINT 4, pred:$p)
    9322             :       AsmString = "sev$\xFF\x02\x01.w";
    9323             :       break;
    9324             :     }
    9325          15 :     if (MI->getNumOperands() == 3 &&
    9326          30 :         MI->getOperand(0).isImm() &&
    9327          17 :         MI->getOperand(0).getImm() == 5 &&
    9328           2 :         STI.getFeatureBits()[ARM::ModeThumb] &&
    9329          17 :         STI.getFeatureBits()[ARM::FeatureThumb2] &&
    9330             :         STI.getFeatureBits()[ARM::HasV8Ops]) {
    9331             :       // (t2HINT 5, pred:$p)
    9332             :       AsmString = "sevl$\xFF\x02\x01.w";
    9333             :       break;
    9334             :     }
    9335          13 :     if (MI->getNumOperands() == 3 &&
    9336          26 :         MI->getOperand(0).isImm() &&
    9337          18 :         MI->getOperand(0).getImm() == 16 &&
    9338           5 :         STI.getFeatureBits()[ARM::ModeThumb] &&
    9339          18 :         STI.getFeatureBits()[ARM::FeatureThumb2] &&
    9340             :         STI.getFeatureBits()[ARM::FeatureRAS]) {
    9341             :       // (t2HINT 16, pred:$p)
    9342             :       AsmString = "esb$\xFF\x02\x01.w";
    9343             :       break;
    9344             :     }
    9345          11 :     if (MI->getNumOperands() == 3 &&
    9346          22 :         MI->getOperand(0).isImm() &&
    9347          13 :         MI->getOperand(0).getImm() == 20 &&
    9348          13 :         STI.getFeatureBits()[ARM::ModeThumb] &&
    9349             :         STI.getFeatureBits()[ARM::FeatureThumb2]) {
    9350             :       // (t2HINT 20, pred:$p)
    9351             :       AsmString = "csdb$\xFF\x02\x01";
    9352             :       break;
    9353             :     }
    9354             :     return false;
    9355             :   case ARM::t2SUBS_PC_LR:
    9356          56 :     if (MI->getNumOperands() == 3 &&
    9357         112 :         MI->getOperand(0).isImm() &&
    9358         105 :         MI->getOperand(0).getImm() == 0 &&
    9359          49 :         STI.getFeatureBits()[ARM::ModeThumb] &&
    9360         105 :         STI.getFeatureBits()[ARM::FeatureThumb2] &&
    9361             :         STI.getFeatureBits()[ARM::FeatureVirtualization]) {
    9362             :       // (t2SUBS_PC_LR 0, pred:$p)
    9363             :       AsmString = "eret$\xFF\x02\x01";
    9364             :       break;
    9365             :     }
    9366             :     return false;
    9367             :   case ARM::tHINT:
    9368         158 :     if (MI->getNumOperands() == 3 &&
    9369         316 :         MI->getOperand(0).isImm() &&
    9370         244 :         MI->getOperand(0).getImm() == 0 &&
    9371         244 :         STI.getFeatureBits()[ARM::ModeThumb] &&
    9372             :         STI.getFeatureBits()[ARM::HasV6MOps]) {
    9373             :       // (tHINT 0, pred:$p)
    9374             :       AsmString = "nop$\xFF\x02\x01";
    9375             :       break;
    9376             :     }
    9377          72 :     if (MI->getNumOperands() == 3 &&
    9378         144 :         MI->getOperand(0).isImm() &&
    9379          88 :         MI->getOperand(0).getImm() == 1 &&
    9380          88 :         STI.getFeatureBits()[ARM::ModeThumb] &&
    9381             :         STI.getFeatureBits()[ARM::HasV6MOps]) {
    9382             :       // (tHINT 1, pred:$p)
    9383             :       AsmString = "yield$\xFF\x02\x01";
    9384             :       break;
    9385             :     }
    9386          56 :     if (MI->getNumOperands() == 3 &&
    9387         112 :         MI->getOperand(0).isImm() &&
    9388          72 :         MI->getOperand(0).getImm() == 2 &&
    9389          72 :         STI.getFeatureBits()[ARM::ModeThumb] &&
    9390             :         STI.getFeatureBits()[ARM::HasV6MOps]) {
    9391             :       // (tHINT 2, pred:$p)
    9392             :       AsmString = "wfe$\xFF\x02\x01";
    9393             :       break;
    9394             :     }
    9395          40 :     if (MI->getNumOperands() == 3 &&
    9396          80 :         MI->getOperand(0).isImm() &&
    9397          56 :         MI->getOperand(0).getImm() == 3 &&
    9398          56 :         STI.getFeatureBits()[ARM::ModeThumb] &&
    9399             :         STI.getFeatureBits()[ARM::HasV6MOps]) {
    9400             :       // (tHINT 3, pred:$p)
    9401             :       AsmString = "wfi$\xFF\x02\x01";
    9402             :       break;
    9403             :     }
    9404          24 :     if (MI->getNumOperands() == 3 &&
    9405          48 :         MI->getOperand(0).isImm() &&
    9406          34 :         MI->getOperand(0).getImm() == 4 &&
    9407          34 :         STI.getFeatureBits()[ARM::ModeThumb] &&
    9408             :         STI.getFeatureBits()[ARM::HasV6MOps]) {
    9409             :       // (tHINT 4, pred:$p)
    9410             :       AsmString = "sev$\xFF\x02\x01";
    9411             :       break;
    9412             :     }
    9413          14 :     if (MI->getNumOperands() == 3 &&
    9414          28 :         MI->getOperand(0).isImm() &&
    9415          21 :         MI->getOperand(0).getImm() == 5 &&
    9416           7 :         STI.getFeatureBits()[ARM::ModeThumb] &&
    9417          20 :         STI.getFeatureBits()[ARM::FeatureThumb2] &&
    9418             :         STI.getFeatureBits()[ARM::HasV8Ops]) {
    9419             :       // (tHINT 5, pred:$p)
    9420             :       AsmString = "sevl$\xFF\x02\x01";
    9421             :       break;
    9422             :     }
    9423             :     return false;
    9424             :   }
    9425             : 
    9426             :   unsigned I = 0;
    9427        4693 :   while (AsmString[I] != ' ' && AsmString[I] != '\t' &&
    9428        2998 :          AsmString[I] != '$' && AsmString[I] != '\0')
    9429        1299 :     ++I;
    9430         398 :   OS << '\t' << StringRef(AsmString, I);
    9431         398 :   if (AsmString[I] != '\0') {
    9432         396 :     if (AsmString[I] == ' ' || AsmString[I] == '\t') {
    9433             :       OS << '\t';
    9434           0 :       ++I;
    9435             :     }
    9436             :     do {
    9437         444 :       if (AsmString[I] == '$') {
    9438         396 :         ++I;
    9439         396 :         if (AsmString[I] == (char)0xff) {
    9440         396 :           ++I;
    9441         396 :           int OpIdx = AsmString[I++] - 1;
    9442         396 :           int PrintMethodIdx = AsmString[I++] - 1;
    9443         396 :           printCustomAliasOperand(MI, OpIdx, PrintMethodIdx, STI, OS);
    9444             :         } else
    9445           0 :           printOperand(MI, unsigned(AsmString[I++]) - 1, STI, OS);
    9446             :       } else {
    9447          48 :         OS << AsmString[I++];
    9448             :       }
    9449         444 :     } while (AsmString[I] != '\0');
    9450             :   }
    9451             : 
    9452             :   return true;
    9453             : }
    9454             : 
    9455         396 : void ARMInstPrinter::printCustomAliasOperand(
    9456             :          const MCInst *MI, unsigned OpIdx,
    9457             :          unsigned PrintMethodIdx,
    9458             :          const MCSubtargetInfo &STI,
    9459             :          raw_ostream &OS) {
    9460         396 :   switch (PrintMethodIdx) {
    9461           0 :   default:
    9462           0 :     llvm_unreachable("Unknown PrintMethod kind");
    9463             :     break;
    9464         396 :   case 0:
    9465         396 :     printPredicateOperand(MI, OpIdx, STI, OS);
    9466             :     break;
    9467             :   }
    9468         396 : }
    9469             : 
    9470             : #endif // PRINT_ALIAS_INSTR

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