LCOV - code coverage report
Current view: top level - build-llvm/lib/Target/ARM - ARMGenAsmWriter.inc (source / functions) Hit Total Coverage
Test: llvm-toolchain.info Lines: 1528 1574 97.1 %
Date: 2017-09-14 15:23:50 Functions: 4 4 100.0 %
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          Line data    Source code
       1             : /*===- TableGen'erated file -------------------------------------*- C++ -*-===*\
       2             : |*                                                                            *|
       3             : |* Assembly Writer Source Fragment                                            *|
       4             : |*                                                                            *|
       5             : |* Automatically generated file, do not edit!                                 *|
       6             : |*                                                                            *|
       7             : \*===----------------------------------------------------------------------===*/
       8             : 
       9             : /// printInstruction - This method is automatically generated by tablegen
      10             : /// from the instruction set description.
      11      130176 : void ARMInstPrinter::printInstruction(const MCInst *MI, const MCSubtargetInfo &STI, raw_ostream &O) {
      12             :   static const char AsmStrs[] = {
      13             :   /* 0 */ 's', 'h', 'a', '1', 's', 'u', '0', '.', '3', '2', 9, 0,
      14             :   /* 12 */ 's', 'h', 'a', '2', '5', '6', 's', 'u', '0', '.', '3', '2', 9, 0,
      15             :   /* 26 */ 's', 'h', 'a', '1', 's', 'u', '1', '.', '3', '2', 9, 0,
      16             :   /* 38 */ 's', 'h', 'a', '2', '5', '6', 's', 'u', '1', '.', '3', '2', 9, 0,
      17             :   /* 52 */ 's', 'h', 'a', '2', '5', '6', 'h', '2', '.', '3', '2', 9, 0,
      18             :   /* 65 */ 's', 'h', 'a', '1', 'c', '.', '3', '2', 9, 0,
      19             :   /* 75 */ 's', 'h', 'a', '1', 'h', '.', '3', '2', 9, 0,
      20             :   /* 85 */ 's', 'h', 'a', '2', '5', '6', 'h', '.', '3', '2', 9, 0,
      21             :   /* 97 */ 's', 'h', 'a', '1', 'm', '.', '3', '2', 9, 0,
      22             :   /* 107 */ 's', 'h', 'a', '1', 'p', '.', '3', '2', 9, 0,
      23             :   /* 117 */ 'v', 'c', 'v', 't', 'a', '.', 's', '3', '2', '.', 'f', '3', '2', 9, 0,
      24             :   /* 132 */ 'v', 'c', 'v', 't', 'm', '.', 's', '3', '2', '.', 'f', '3', '2', 9, 0,
      25             :   /* 147 */ 'v', 'c', 'v', 't', 'n', '.', 's', '3', '2', '.', 'f', '3', '2', 9, 0,
      26             :   /* 162 */ 'v', 'c', 'v', 't', 'p', '.', 's', '3', '2', '.', 'f', '3', '2', 9, 0,
      27             :   /* 177 */ 'v', 'c', 'v', 't', 'a', '.', 'u', '3', '2', '.', 'f', '3', '2', 9, 0,
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      29             :   /* 207 */ 'v', 'c', 'v', 't', 'n', '.', 'u', '3', '2', '.', 'f', '3', '2', 9, 0,
      30             :   /* 222 */ 'v', 'c', 'v', 't', 'p', '.', 'u', '3', '2', '.', 'f', '3', '2', 9, 0,
      31             :   /* 237 */ 'v', 'r', 'i', 'n', 't', 'a', '.', 'f', '3', '2', 9, 0,
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      33             :   /* 261 */ 'v', 'm', 'i', 'n', 'n', 'm', '.', 'f', '3', '2', 9, 0,
      34             :   /* 273 */ 'v', 'm', 'a', 'x', 'n', 'm', '.', 'f', '3', '2', 9, 0,
      35             :   /* 285 */ 'v', 'r', 'i', 'n', 't', 'm', '.', 'f', '3', '2', 9, 0,
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      37             :   /* 309 */ 'v', 'r', 'i', 'n', 't', 'p', '.', 'f', '3', '2', 9, 0,
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      41             :   /* 357 */ 'v', 'r', 'i', 'n', 't', 'x', '.', 'f', '3', '2', 9, 0,
      42             :   /* 369 */ 'v', 'r', 'i', 'n', 't', 'z', '.', 'f', '3', '2', 9, 0,
      43             :   /* 381 */ 'l', 'd', 'c', '2', 9, 0,
      44             :   /* 387 */ 'm', 'r', 'c', '2', 9, 0,
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      62             :   /* 593 */ 'v', 'r', 'i', 'n', 't', 'm', '.', 'f', '6', '4', 9, 0,
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      72             :   /* 721 */ 'v', 'c', 'v', 't', 'p', '.', 's', '3', '2', '.', 'f', '1', '6', 9, 0,
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     129             :   /* 1289 */ 'h', 'v', 'c', '.', 'w', 9, 0,
     130             :   /* 1296 */ 'u', 'd', 'f', '.', 'w', 9, 0,
     131             :   /* 1303 */ 'c', 'r', 'c', '3', '2', 'w', 9, 0,
     132             :   /* 1311 */ 'c', 'r', 'c', '3', '2', 'c', 'w', 9, 0,
     133             :   /* 1320 */ 'p', 'l', 'd', 'w', 9, 0,
     134             :   /* 1326 */ 'b', 'x', 9, 0,
     135             :   /* 1330 */ 'b', 'l', 'x', 9, 0,
     136             :   /* 1335 */ 'c', 'b', 'z', 9, 0,
     137             :   /* 1340 */ 'c', 'b', 'n', 'z', 9, 0,
     138             :   /* 1346 */ 's', 'r', 's', 'd', 'a', 9, 's', 'p', '!', ',', 32, 0,
     139             :   /* 1358 */ 's', 'r', 's', 'i', 'a', 9, 's', 'p', '!', ',', 32, 0,
     140             :   /* 1370 */ 's', 'r', 's', 'd', 'b', 9, 's', 'p', '!', ',', 32, 0,
     141             :   /* 1382 */ 's', 'r', 's', 'i', 'b', 9, 's', 'p', '!', ',', 32, 0,
     142             :   /* 1394 */ 's', 'r', 's', 'd', 'a', 9, 's', 'p', ',', 32, 0,
     143             :   /* 1405 */ 's', 'r', 's', 'i', 'a', 9, 's', 'p', ',', 32, 0,
     144             :   /* 1416 */ 's', 'r', 's', 'd', 'b', 9, 's', 'p', ',', 32, 0,
     145             :   /* 1427 */ 's', 'r', 's', 'i', 'b', 9, 's', 'p', ',', 32, 0,
     146             :   /* 1438 */ '#', 32, 'X', 'R', 'a', 'y', 32, 'F', 'u', 'n', 'c', 't', 'i', 'o', 'n', 32, 'P', 'a', 't', 'c', 'h', 'a', 'b', 'l', 'e', 32, 'R', 'E', 'T', '.', 0,
     147             :   /* 1469 */ '#', 32, 'X', 'R', 'a', 'y', 32, 'C', 'u', 's', 't', 'o', 'm', 32, 'E', 'v', 'e', 'n', 't', 32, 'L', 'o', 'g', '.', 0,
     148             :   /* 1494 */ '#', 32, 'X', 'R', 'a', 'y', 32, 'F', 'u', 'n', 'c', 't', 'i', 'o', 'n', 32, 'E', 'n', 't', 'e', 'r', '.', 0,
     149             :   /* 1517 */ '#', 32, 'X', 'R', 'a', 'y', 32, 'T', 'a', 'i', 'l', 32, 'C', 'a', 'l', 'l', 32, 'E', 'x', 'i', 't', '.', 0,
     150             :   /* 1540 */ '#', 32, 'X', 'R', 'a', 'y', 32, 'F', 'u', 'n', 'c', 't', 'i', 'o', 'n', 32, 'E', 'x', 'i', 't', '.', 0,
     151             :   /* 1562 */ '_', '_', 'b', 'r', 'k', 'd', 'i', 'v', '0', 0,
     152             :   /* 1572 */ 'v', 'l', 'd', '1', 0,
     153             :   /* 1577 */ 'd', 'c', 'p', 's', '1', 0,
     154             :   /* 1583 */ 'v', 's', 't', '1', 0,
     155             :   /* 1588 */ 'v', 'r', 'e', 'v', '3', '2', 0,
     156             :   /* 1595 */ 'l', 'd', 'c', '2', 0,
     157             :   /* 1600 */ 'm', 'r', 'c', '2', 0,
     158             :   /* 1605 */ 'm', 'r', 'r', 'c', '2', 0,
     159             :   /* 1611 */ 's', 't', 'c', '2', 0,
     160             :   /* 1616 */ 'v', 'l', 'd', '2', 0,
     161             :   /* 1621 */ 'c', 'd', 'p', '2', 0,
     162             :   /* 1626 */ 'm', 'c', 'r', '2', 0,
     163             :   /* 1631 */ 'm', 'c', 'r', 'r', '2', 0,
     164             :   /* 1637 */ 'd', 'c', 'p', 's', '2', 0,
     165             :   /* 1643 */ 'v', 's', 't', '2', 0,
     166             :   /* 1648 */ 'v', 'l', 'd', '3', 0,
     167             :   /* 1653 */ 'd', 'c', 'p', 's', '3', 0,
     168             :   /* 1659 */ 'v', 's', 't', '3', 0,
     169             :   /* 1664 */ 'v', 'r', 'e', 'v', '6', '4', 0,
     170             :   /* 1671 */ 'v', 'l', 'd', '4', 0,
     171             :   /* 1676 */ 'v', 's', 't', '4', 0,
     172             :   /* 1681 */ 's', 'x', 't', 'a', 'b', '1', '6', 0,
     173             :   /* 1689 */ 'u', 'x', 't', 'a', 'b', '1', '6', 0,
     174             :   /* 1697 */ 's', 'x', 't', 'b', '1', '6', 0,
     175             :   /* 1704 */ 'u', 'x', 't', 'b', '1', '6', 0,
     176             :   /* 1711 */ 's', 'h', 's', 'u', 'b', '1', '6', 0,
     177             :   /* 1719 */ 'u', 'h', 's', 'u', 'b', '1', '6', 0,
     178             :   /* 1727 */ 'u', 'q', 's', 'u', 'b', '1', '6', 0,
     179             :   /* 1735 */ 's', 's', 'u', 'b', '1', '6', 0,
     180             :   /* 1742 */ 'u', 's', 'u', 'b', '1', '6', 0,
     181             :   /* 1749 */ 's', 'h', 'a', 'd', 'd', '1', '6', 0,
     182             :   /* 1757 */ 'u', 'h', 'a', 'd', 'd', '1', '6', 0,
     183             :   /* 1765 */ 'u', 'q', 'a', 'd', 'd', '1', '6', 0,
     184             :   /* 1773 */ 's', 'a', 'd', 'd', '1', '6', 0,
     185             :   /* 1780 */ 'u', 'a', 'd', 'd', '1', '6', 0,
     186             :   /* 1787 */ 's', 's', 'a', 't', '1', '6', 0,
     187             :   /* 1794 */ 'u', 's', 'a', 't', '1', '6', 0,
     188             :   /* 1801 */ 'v', 'r', 'e', 'v', '1', '6', 0,
     189             :   /* 1808 */ 'u', 's', 'a', 'd', 'a', '8', 0,
     190             :   /* 1815 */ 's', 'h', 's', 'u', 'b', '8', 0,
     191             :   /* 1822 */ 'u', 'h', 's', 'u', 'b', '8', 0,
     192             :   /* 1829 */ 'u', 'q', 's', 'u', 'b', '8', 0,
     193             :   /* 1836 */ 's', 's', 'u', 'b', '8', 0,
     194             :   /* 1842 */ 'u', 's', 'u', 'b', '8', 0,
     195             :   /* 1848 */ 'u', 's', 'a', 'd', '8', 0,
     196             :   /* 1854 */ 's', 'h', 'a', 'd', 'd', '8', 0,
     197             :   /* 1861 */ 'u', 'h', 'a', 'd', 'd', '8', 0,
     198             :   /* 1868 */ 'u', 'q', 'a', 'd', 'd', '8', 0,
     199             :   /* 1875 */ 's', 'a', 'd', 'd', '8', 0,
     200             :   /* 1881 */ 'u', 'a', 'd', 'd', '8', 0,
     201             :   /* 1887 */ 'L', 'I', 'F', 'E', 'T', 'I', 'M', 'E', '_', 'E', 'N', 'D', 0,
     202             :   /* 1900 */ 'B', 'U', 'N', 'D', 'L', 'E', 0,
     203             :   /* 1907 */ 'D', 'B', 'G', '_', 'V', 'A', 'L', 'U', 'E', 0,
     204             :   /* 1917 */ '@', 32, 'C', 'O', 'M', 'P', 'I', 'L', 'E', 'R', 32, 'B', 'A', 'R', 'R', 'I', 'E', 'R', 0,
     205             :   /* 1936 */ 'L', 'I', 'F', 'E', 'T', 'I', 'M', 'E', '_', 'S', 'T', 'A', 'R', 'T', 0,
     206             :   /* 1951 */ 'v', 'a', 'b', 'a', 0,
     207             :   /* 1956 */ 'l', 'd', 'a', 0,
     208             :   /* 1960 */ 'l', 'd', 'm', 'd', 'a', 0,
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     210             :   /* 1972 */ 'r', 'f', 'e', 'i', 'a', 0,
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     213             :   /* 1992 */ 's', 'r', 's', 'i', 'a', 0,
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     215             :   /* 2004 */ 'v', 'n', 'm', 'l', 'a', 0,
     216             :   /* 2010 */ 'v', 'm', 'l', 'a', 0,
     217             :   /* 2015 */ 'v', 'f', 'm', 'a', 0,
     218             :   /* 2020 */ 'v', 'f', 'n', 'm', 'a', 0,
     219             :   /* 2026 */ 'v', 'r', 's', 'r', 'a', 0,
     220             :   /* 2032 */ 'v', 's', 'r', 'a', 0,
     221             :   /* 2037 */ 't', 't', 'a', 0,
     222             :   /* 2041 */ 'l', 'd', 'a', 'b', 0,
     223             :   /* 2046 */ 's', 'x', 't', 'a', 'b', 0,
     224             :   /* 2052 */ 'u', 'x', 't', 'a', 'b', 0,
     225             :   /* 2058 */ 's', 'm', 'l', 'a', 'b', 'b', 0,
     226             :   /* 2065 */ 's', 'm', 'l', 'a', 'l', 'b', 'b', 0,
     227             :   /* 2073 */ 's', 'm', 'u', 'l', 'b', 'b', 0,
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     230             :   /* 2090 */ 'v', 'l', 'd', 'm', 'd', 'b', 0,
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     242             :   /* 2154 */ 'l', 'd', 'r', 's', 'b', 0,
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     244             :   /* 2167 */ 'p', 'k', 'h', 't', 'b', 0,
     245             :   /* 2173 */ 's', 'm', 'l', 'a', 'l', 't', 'b', 0,
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     250             :   /* 2204 */ 'q', 'd', 's', 'u', 'b', 0,
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     252             :   /* 2216 */ 'v', 'q', 's', 'u', 'b', 0,
     253             :   /* 2222 */ 'v', 's', 'u', 'b', 0,
     254             :   /* 2227 */ 's', 'm', 'l', 'a', 'w', 'b', 0,
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     261             :   /* 2273 */ 'a', 'd', 'c', 0,
     262             :   /* 2277 */ 'l', 'd', 'c', 0,
     263             :   /* 2281 */ 'b', 'f', 'c', 0,
     264             :   /* 2285 */ 'v', 'b', 'i', 'c', 0,
     265             :   /* 2290 */ 's', 'm', 'c', 0,
     266             :   /* 2294 */ 'm', 'r', 'c', 0,
     267             :   /* 2298 */ 'm', 'r', 'r', 'c', 0,
     268             :   /* 2303 */ 'r', 's', 'c', 0,
     269             :   /* 2307 */ 's', 't', 'c', 0,
     270             :   /* 2311 */ 's', 'v', 'c', 0,
     271             :   /* 2315 */ 's', 'm', 'l', 'a', 'd', 0,
     272             :   /* 2321 */ 's', 'm', 'u', 'a', 'd', 0,
     273             :   /* 2327 */ 'v', 'a', 'b', 'd', 0,
     274             :   /* 2332 */ 'q', 'd', 'a', 'd', 'd', 0,
     275             :   /* 2338 */ 'v', 'r', 'h', 'a', 'd', 'd', 0,
     276             :   /* 2345 */ 'v', 'h', 'a', 'd', 'd', 0,
     277             :   /* 2351 */ 'v', 'p', 'a', 'd', 'd', 0,
     278             :   /* 2357 */ 'v', 'q', 'a', 'd', 'd', 0,
     279             :   /* 2363 */ 'v', 'a', 'd', 'd', 0,
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     281             :   /* 2375 */ 'p', 'l', 'd', 0,
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     443             :   /* 3327 */ 'l', 'd', 'r', 's', 'h', 't', 0,
     444             :   /* 3334 */ 'r', 'b', 'i', 't', 0,
     445             :   /* 3339 */ 'v', 'b', 'i', 't', 0,
     446             :   /* 3344 */ 'v', 'c', 'l', 't', 0,
     447             :   /* 3349 */ 'v', 'c', 'n', 't', 0,
     448             :   /* 3354 */ 'h', 'i', 'n', 't', 0,
     449             :   /* 3359 */ 'l', 'd', 'r', 't', 0,
     450             :   /* 3364 */ 'v', 's', 'q', 'r', 't', 0,
     451             :   /* 3370 */ 's', 't', 'r', 't', 0,
     452             :   /* 3375 */ 'v', 't', 's', 't', 0,
     453             :   /* 3380 */ 's', 'm', 'l', 'a', 't', 't', 0,
     454             :   /* 3387 */ 's', 'm', 'l', 'a', 'l', 't', 't', 0,
     455             :   /* 3395 */ 's', 'm', 'u', 'l', 't', 't', 0,
     456             :   /* 3402 */ 't', 't', 't', 0,
     457             :   /* 3406 */ 'v', 'c', 'v', 't', 't', 0,
     458             :   /* 3412 */ 'v', 'j', 'c', 'v', 't', 0,
     459             :   /* 3418 */ 'v', 'c', 'v', 't', 0,
     460             :   /* 3423 */ 'm', 'o', 'v', 't', 0,
     461             :   /* 3428 */ 's', 'm', 'l', 'a', 'w', 't', 0,
     462             :   /* 3435 */ 's', 'm', 'u', 'l', 'w', 't', 0,
     463             :   /* 3442 */ 'v', 'e', 'x', 't', 0,
     464             :   /* 3447 */ 'v', 'q', 's', 'h', 'l', 'u', 0,
     465             :   /* 3454 */ 'r', 'e', 'v', 0,
     466             :   /* 3458 */ 's', 'd', 'i', 'v', 0,
     467             :   /* 3463 */ 'u', 'd', 'i', 'v', 0,
     468             :   /* 3468 */ 'v', 'd', 'i', 'v', 0,
     469             :   /* 3473 */ 'v', 'm', 'o', 'v', 0,
     470             :   /* 3478 */ 'v', 's', 'u', 'b', 'w', 0,
     471             :   /* 3484 */ 'v', 'a', 'd', 'd', 'w', 0,
     472             :   /* 3490 */ 'p', 'l', 'd', 'w', 0,
     473             :   /* 3495 */ 'm', 'o', 'v', 'w', 0,
     474             :   /* 3500 */ 'f', 'l', 'd', 'm', 'i', 'a', 'x', 0,
     475             :   /* 3508 */ 'f', 's', 't', 'm', 'i', 'a', 'x', 0,
     476             :   /* 3516 */ 'v', 'p', 'm', 'a', 'x', 0,
     477             :   /* 3522 */ 'v', 'm', 'a', 'x', 0,
     478             :   /* 3527 */ 's', 'h', 's', 'a', 'x', 0,
     479             :   /* 3533 */ 'u', 'h', 's', 'a', 'x', 0,
     480             :   /* 3539 */ 'u', 'q', 's', 'a', 'x', 0,
     481             :   /* 3545 */ 's', 's', 'a', 'x', 0,
     482             :   /* 3550 */ 'u', 's', 'a', 'x', 0,
     483             :   /* 3555 */ 'f', 'l', 'd', 'm', 'd', 'b', 'x', 0,
     484             :   /* 3563 */ 'f', 's', 't', 'm', 'd', 'b', 'x', 0,
     485             :   /* 3571 */ 'v', 't', 'b', 'x', 0,
     486             :   /* 3576 */ 's', 'm', 'l', 'a', 'd', 'x', 0,
     487             :   /* 3583 */ 's', 'm', 'u', 'a', 'd', 'x', 0,
     488             :   /* 3590 */ 's', 'm', 'l', 'a', 'l', 'd', 'x', 0,
     489             :   /* 3598 */ 's', 'm', 'l', 's', 'l', 'd', 'x', 0,
     490             :   /* 3606 */ 's', 'm', 'l', 's', 'd', 'x', 0,
     491             :   /* 3613 */ 's', 'm', 'u', 's', 'd', 'x', 0,
     492             :   /* 3620 */ 'l', 'd', 'a', 'e', 'x', 0,
     493             :   /* 3626 */ 's', 't', 'l', 'e', 'x', 0,
     494             :   /* 3632 */ 'l', 'd', 'r', 'e', 'x', 0,
     495             :   /* 3638 */ 'c', 'l', 'r', 'e', 'x', 0,
     496             :   /* 3644 */ 's', 't', 'r', 'e', 'x', 0,
     497             :   /* 3650 */ 's', 'b', 'f', 'x', 0,
     498             :   /* 3655 */ 'u', 'b', 'f', 'x', 0,
     499             :   /* 3660 */ 'b', 'l', 'x', 0,
     500             :   /* 3664 */ 'r', 'r', 'x', 0,
     501             :   /* 3668 */ 's', 'h', 'a', 's', 'x', 0,
     502             :   /* 3674 */ 'u', 'h', 'a', 's', 'x', 0,
     503             :   /* 3680 */ 'u', 'q', 'a', 's', 'x', 0,
     504             :   /* 3686 */ 's', 'a', 's', 'x', 0,
     505             :   /* 3691 */ 'u', 'a', 's', 'x', 0,
     506             :   /* 3696 */ 'v', 'r', 'i', 'n', 't', 'x', 0,
     507             :   /* 3703 */ 'v', 'c', 'l', 'z', 0,
     508             :   /* 3708 */ 'v', 'r', 'i', 'n', 't', 'z', 0,
     509             :   };
     510             : 
     511             :   static const uint32_t OpInfo0[] = {
     512             :     0U, // PHI
     513             :     0U, // INLINEASM
     514             :     0U, // CFI_INSTRUCTION
     515             :     0U, // EH_LABEL
     516             :     0U, // GC_LABEL
     517             :     0U, // ANNOTATION_LABEL
     518             :     0U, // KILL
     519             :     0U, // EXTRACT_SUBREG
     520             :     0U, // INSERT_SUBREG
     521             :     0U, // IMPLICIT_DEF
     522             :     0U, // SUBREG_TO_REG
     523             :     0U, // COPY_TO_REGCLASS
     524             :     1908U,      // DBG_VALUE
     525             :     0U, // REG_SEQUENCE
     526             :     0U, // COPY
     527             :     1901U,      // BUNDLE
     528             :     1937U,      // LIFETIME_START
     529             :     1888U,      // LIFETIME_END
     530             :     0U, // STACKMAP
     531             :     2775U,      // FENTRY_CALL
     532             :     0U, // PATCHPOINT
     533             :     0U, // LOAD_STACK_GUARD
     534             :     0U, // STATEPOINT
     535             :     0U, // LOCAL_ESCAPE
     536             :     0U, // FAULTING_OP
     537             :     0U, // PATCHABLE_OP
     538             :     1495U,      // PATCHABLE_FUNCTION_ENTER
     539             :     1439U,      // PATCHABLE_RET
     540             :     1541U,      // PATCHABLE_FUNCTION_EXIT
     541             :     1518U,      // PATCHABLE_TAIL_CALL
     542             :     1470U,      // PATCHABLE_EVENT_CALL
     543             :     0U, // G_ADD
     544             :     0U, // G_SUB
     545             :     0U, // G_MUL
     546             :     0U, // G_SDIV
     547             :     0U, // G_UDIV
     548             :     0U, // G_SREM
     549             :     0U, // G_UREM
     550             :     0U, // G_AND
     551             :     0U, // G_OR
     552             :     0U, // G_XOR
     553             :     0U, // G_IMPLICIT_DEF
     554             :     0U, // G_PHI
     555             :     0U, // G_FRAME_INDEX
     556             :     0U, // G_GLOBAL_VALUE
     557             :     0U, // G_EXTRACT
     558             :     0U, // G_UNMERGE_VALUES
     559             :     0U, // G_INSERT
     560             :     0U, // G_MERGE_VALUES
     561             :     0U, // G_PTRTOINT
     562             :     0U, // G_INTTOPTR
     563             :     0U, // G_BITCAST
     564             :     0U, // G_LOAD
     565             :     0U, // G_STORE
     566             :     0U, // G_BRCOND
     567             :     0U, // G_BRINDIRECT
     568             :     0U, // G_INTRINSIC
     569             :     0U, // G_INTRINSIC_W_SIDE_EFFECTS
     570             :     0U, // G_ANYEXT
     571             :     0U, // G_TRUNC
     572             :     0U, // G_CONSTANT
     573             :     0U, // G_FCONSTANT
     574             :     0U, // G_VASTART
     575             :     0U, // G_VAARG
     576             :     0U, // G_SEXT
     577             :     0U, // G_ZEXT
     578             :     0U, // G_SHL
     579             :     0U, // G_LSHR
     580             :     0U, // G_ASHR
     581             :     0U, // G_ICMP
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     583             :     0U, // G_SELECT
     584             :     0U, // G_UADDE
     585             :     0U, // G_USUBE
     586             :     0U, // G_SADDO
     587             :     0U, // G_SSUBO
     588             :     0U, // G_UMULO
     589             :     0U, // G_SMULO
     590             :     0U, // G_UMULH
     591             :     0U, // G_SMULH
     592             :     0U, // G_FADD
     593             :     0U, // G_FSUB
     594             :     0U, // G_FMUL
     595             :     0U, // G_FMA
     596             :     0U, // G_FDIV
     597             :     0U, // G_FREM
     598             :     0U, // G_FPOW
     599             :     0U, // G_FEXP
     600             :     0U, // G_FEXP2
     601             :     0U, // G_FLOG
     602             :     0U, // G_FLOG2
     603             :     0U, // G_FNEG
     604             :     0U, // G_FPEXT
     605             :     0U, // G_FPTRUNC
     606             :     0U, // G_FPTOSI
     607             :     0U, // G_FPTOUI
     608             :     0U, // G_SITOFP
     609             :     0U, // G_UITOFP
     610             :     0U, // G_GEP
     611             :     0U, // G_PTR_MASK
     612             :     0U, // G_BR
     613             :     0U, // G_INSERT_VECTOR_ELT
     614             :     0U, // G_EXTRACT_VECTOR_ELT
     615             :     0U, // G_SHUFFLE_VECTOR
     616             :     0U, // ABS
     617             :     6370U,      // ADCri
     618             :     6370U,      // ADCrr
     619             :     10466U,     // ADCrsi
     620             :     14562U,     // ADCrsr
     621             :     0U, // ADDSri
     622             :     0U, // ADDSrr
     623             :     0U, // ADDSrsi
     624             :     0U, // ADDSrsr
     625             :     6431U,      // ADDri
     626             :     6431U,      // ADDrr
     627             :     10527U,     // ADDrsi
     628             :     14623U,     // ADDrsr
     629             :     0U, // ADJCALLSTACKDOWN
     630             :     0U, // ADJCALLSTACKUP
     631             :     19447U,     // ADR
     632             :     1090671693U,        // AESD
     633             :     1090671701U,        // AESE
     634             :     1107448890U,        // AESIMC
     635             :     1107448900U,        // AESMC
     636             :     6484U,      // ANDri
     637             :     6484U,      // ANDrr
     638             :     10580U,     // ANDrsi
     639             :     14676U,     // ANDrsr
     640             :     269349U,    // ASRi
     641             :     269349U,    // ASRr
     642             :     0U, // B
     643             :     0U, // BCCZi64
     644             :     0U, // BCCi64
     645             :     26858U,     // BFC
     646             :     31300U,     // BFI
     647             :     6383U,      // BICri
     648             :     6383U,      // BICrr
     649             :     10479U,     // BICrsi
     650             :     14575U,     // BICrsr
     651             :     414980U,    // BKPT
     652             :     414952U,    // BL
     653             :     415027U,    // BLX
     654             :     1073778253U,        // BLX_pred
     655             :     415027U,    // BLXi
     656             :     1073777301U,        // BL_pred
     657             :     0U, // BMOVPCB_CALL
     658             :     0U, // BMOVPCRX_CALL
     659             :     0U, // BR_JTadd
     660             :     0U, // BR_JTm
     661             :     0U, // BR_JTr
     662             :     415023U,    // BX
     663             :     1073777238U,        // BXJ
     664             :     0U, // BX_CALL
     665             :     564713U,    // BX_RET
     666             :     1073778153U,        // BX_pred
     667             :     1073776637U,        // Bcc
     668             :     2197859266U,        // CDP
     669             :     67809687U,  // CDP2
     670             :     3639U,      // CLREX
     671             :     20089U,     // CLZ
     672             :     19304U,     // CMNri
     673             :     19304U,     // CMNzrr
     674             :     27496U,     // CMNzrsi
     675             :     31592U,     // CMNzrsr
     676             :     0U, // CMP_SWAP_16
     677             :     0U, // CMP_SWAP_32
     678             :     0U, // CMP_SWAP_64
     679             :     0U, // CMP_SWAP_8
     680             :     19404U,     // CMPri
     681             :     19404U,     // CMPrr
     682             :     27596U,     // CMPrsi
     683             :     31692U,     // CMPrsr
     684             :     0U, // CONSTPOOL_ENTRY
     685             :     0U, // COPY_STRUCT_BYVAL_I32
     686             :     414964U,    // CPS1p
     687             :     1157680262U,        // CPS2p
     688             :     83938438U,  // CPS3p
     689             :     33707135U,  // CRC32B
     690             :     33707143U,  // CRC32CB
     691             :     33707212U,  // CRC32CH
     692             :     33707296U,  // CRC32CW
     693             :     33707204U,  // CRC32H
     694             :     33707288U,  // CRC32W
     695             :     1918U,      // CompilerBarrier
     696             :     1073777076U,        // DBG
     697             :     54430U,     // DMB
     698             :     54435U,     // DSB
     699             :     7187U,      // EORri
     700             :     7187U,      // EORrr
     701             :     11283U,     // EORrsi
     702             :     15379U,     // EORrsr
     703             :     433380U,    // ERET
     704             :     3322695058U,        // FCONSTD
     705             :     3322826130U,        // FCONSTH
     706             :     3322957202U,        // FCONSTS
     707             :     33574372U,  // FLDMXDB_UPD
     708             :     36269U,     // FLDMXIA
     709             :     33574317U,  // FLDMXIA_UPD
     710             :     1219722U,   // FMSTAT
     711             :     33574380U,  // FSTMXDB_UPD
     712             :     36277U,     // FSTMXIA
     713             :     33574325U,  // FSTMXIA_UPD
     714             :     1073777947U,        // HINT
     715             :     414975U,    // HLT
     716             :     414893U,    // HVC
     717             :     58536U,     // ISB
     718             :     117767433U, // ITasm
     719             :     0U, // Int_eh_sjlj_dispatchsetup
     720             :     0U, // Int_eh_sjlj_longjmp
     721             :     0U, // Int_eh_sjlj_setjmp
     722             :     0U, // Int_eh_sjlj_setjmp_nofp
     723             :     0U, // Int_eh_sjlj_setup_dispatch
     724             :     0U, // JUMPTABLE_ADDRS
     725             :     0U, // JUMPTABLE_INSTS
     726             :     0U, // JUMPTABLE_TBB
     727             :     0U, // JUMPTABLE_TBH
     728             :     18341U,     // LDA
     729             :     18426U,     // LDAB
     730             :     20005U,     // LDAEX
     731             :     18626U,     // LDAEXB
     732             :     134236526U, // LDAEXD
     733             :     18984U,     // LDAEXH
     734             :     18886U,     // LDAH
     735             :     152351962U, // LDC2L_OFFSET
     736             :     1242871002U,        // LDC2L_OPTION
     737             :     2316612826U,        // LDC2L_POST
     738             :     185906394U, // LDC2L_PRE
     739             :     152351102U, // LDC2_OFFSET
     740             :     1242870142U,        // LDC2_OPTION
     741             :     2316611966U,        // LDC2_POST
     742             :     185905534U, // LDC2_PRE
     743             :     3271588510U,        // LDCL_OFFSET
     744             :     3271588510U,        // LDCL_OPTION
     745             :     3271588510U,        // LDCL_POST
     746             :     3271588510U,        // LDCL_PRE
     747             :     3271588070U,        // LDC_OFFSET
     748             :     3271588070U,        // LDC_OPTION
     749             :     3271588070U,        // LDC_POST
     750             :     3271588070U,        // LDC_PRE
     751             :     34729U,     // LDMDA
     752             :     33572777U,  // LDMDA_UPD
     753             :     34860U,     // LDMDB
     754             :     33572908U,  // LDMDB_UPD
     755             :     35637U,     // LDMIA
     756             :     0U, // LDMIA_RET
     757             :     33573685U,  // LDMIA_UPD
     758             :     34879U,     // LDMIB
     759             :     33572927U,  // LDMIB_UPD
     760             :     281809U,    // LDRBT_POST
     761             :     68817U,     // LDRBT_POST_IMM
     762             :     68817U,     // LDRBT_POST_REG
     763             :     67673U,     // LDRB_POST_IMM
     764             :     67673U,     // LDRB_POST_REG
     765             :     30809U,     // LDRB_PRE_IMM
     766             :     67673U,     // LDRB_PRE_REG
     767             :     26713U,     // LDRBi12
     768             :     30809U,     // LDRBrs
     769             :     281596U,    // LDRConstPool
     770             :     67928U,     // LDRD
     771             :     43352U,     // LDRD_POST
     772             :     43352U,     // LDRD_PRE
     773             :     20017U,     // LDREX
     774             :     18640U,     // LDREXB
     775             :     134236540U, // LDREXD
     776             :     18998U,     // LDREXH
     777             :     31226U,     // LDRH
     778             :     31988U,     // LDRHTi
     779             :     68852U,     // LDRHTr
     780             :     68090U,     // LDRH_POST
     781             :     68090U,     // LDRH_PRE
     782             :     0U, // LDRLIT_ga_abs
     783             :     0U, // LDRLIT_ga_pcrel
     784             :     0U, // LDRLIT_ga_pcrel_ldr
     785             :     30827U,     // LDRSB
     786             :     31965U,     // LDRSBTi
     787             :     68829U,     // LDRSBTr
     788             :     67691U,     // LDRSB_POST
     789             :     67691U,     // LDRSB_PRE
     790             :     31245U,     // LDRSH
     791             :     32000U,     // LDRSHTi
     792             :     68864U,     // LDRSHTr
     793             :     68109U,     // LDRSH_POST
     794             :     68109U,     // LDRSH_PRE
     795             :     281888U,    // LDRT_POST
     796             :     68896U,     // LDRT_POST_IMM
     797             :     68896U,     // LDRT_POST_REG
     798             :     68604U,     // LDR_POST_IMM
     799             :     68604U,     // LDR_POST_REG
     800             :     31740U,     // LDR_PRE_IMM
     801             :     68604U,     // LDR_PRE_REG
     802             :     27644U,     // LDRcp
     803             :     27644U,     // LDRi12
     804             :     31740U,     // LDRrs
     805             :     0U, // LEApcrel
     806             :     0U, // LEApcrelJT
     807             :     269070U,    // LSLi
     808             :     269070U,    // LSLr
     809             :     269356U,    // LSRi
     810             :     269356U,    // LSRr
     811             :     2197859315U,        // MCR
     812             :     17478045U,  // MCR2
     813             :     2197883931U,        // MCRR
     814             :     17478051U,  // MCRR2
     815             :     0U, // MEMCPY
     816             :     10193U,     // MLA
     817             :     0U, // MLAv5
     818             :     31838U,     // MLS
     819             :     0U, // MOVCCi
     820             :     0U, // MOVCCi16
     821             :     0U, // MOVCCi32imm
     822             :     0U, // MOVCCr
     823             :     0U, // MOVCCsi
     824             :     0U, // MOVCCsr
     825             :     1482131U,   // MOVPCLR
     826             :     0U, // MOVPCRX
     827             :     28000U,     // MOVTi16
     828             :     0U, // MOVTi16_ga_pcrel
     829             :     0U, // MOV_ga_pcrel
     830             :     0U, // MOV_ga_pcrel_ldr
     831             :     73107U,     // MOVi
     832             :     19880U,     // MOVi16
     833             :     0U, // MOVi16_ga_pcrel
     834             :     0U, // MOVi32imm
     835             :     73107U,     // MOVr
     836             :     73107U,     // MOVr_TC
     837             :     7571U,      // MOVsi
     838             :     11667U,     // MOVsr
     839             :     0U, // MOVsra_flag
     840             :     0U, // MOVsrl_flag
     841             :     201369847U, // MRC
     842             :     74116U,     // MRC2
     843             :     218171643U, // MRRC
     844             :     78218U,     // MRRC2
     845             :     35979U,     // MRS
     846             :     19595U,     // MRSbanked
     847             :     1073777803U,        // MRSsys
     848             :     2382384177U,        // MSR
     849             :     251677745U, // MSRbanked
     850             :     2382384177U,        // MSRi
     851             :     6942U,      // MUL
     852             :     0U, // MULv5
     853             :     0U, // MVNCCi
     854             :     72620U,     // MVNi
     855             :     72620U,     // MVNr
     856             :     7084U,      // MVNsi
     857             :     11180U,     // MVNsr
     858             :     7201U,      // ORRri
     859             :     7201U,      // ORRrr
     860             :     11297U,     // ORRrsi
     861             :     15393U,     // ORRrsr
     862             :     0U, // PICADD
     863             :     0U, // PICLDR
     864             :     0U, // PICLDRB
     865             :     0U, // PICLDRH
     866             :     0U, // PICLDRSB
     867             :     0U, // PICLDRSH
     868             :     0U, // PICSTR
     869             :     0U, // PICSTRB
     870             :     0U, // PICSTRH
     871             :     31932U,     // PKHBT
     872             :     30840U,     // PKHTB
     873             :     83241U,     // PLDWi12
     874             :     87337U,     // PLDWrs
     875             :     83122U,     // PLDi12
     876             :     87218U,     // PLDrs
     877             :     83157U,     // PLIi12
     878             :     87253U,     // PLIrs
     879             :     26935U,     // QADD
     880             :     26343U,     // QADD16
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     883             :     26909U,     // QDADD
     884             :     26781U,     // QDSUB
     885             :     28117U,     // QSAX
     886             :     26794U,     // QSUB
     887             :     26305U,     // QSUB16
     888             :     26407U,     // QSUB8
     889             :     19719U,     // RBIT
     890             :     19839U,     // REV
     891             :     18187U,     // REV16
     892             :     18968U,     // REVSH
     893             :     414833U,    // RFEDA
     894             :     1594481U,   // RFEDA_UPD
     895             :     414864U,    // RFEDB
     896             :     1594512U,   // RFEDB_UPD
     897             :     414840U,    // RFEIA
     898             :     1594488U,   // RFEIA_UPD
     899             :     414871U,    // RFEIB
     900             :     1594519U,   // RFEIB_UPD
     901             :     269335U,    // RORi
     902             :     269335U,    // RORr
     903             :     0U, // RRX
     904             :     335441U,    // RRXi
     905             :     0U, // RSBSri
     906             :     0U, // RSBSrsi
     907             :     0U, // RSBSrsr
     908             :     6253U,      // RSBri
     909             :     6253U,      // RSBrr
     910             :     10349U,     // RSBrsi
     911             :     14445U,     // RSBrsr
     912             :     6400U,      // RSCri
     913             :     6400U,      // RSCrr
     914             :     10496U,     // RSCrsi
     915             :     14592U,     // RSCrsr
     916             :     26350U,     // SADD16
     917             :     26452U,     // SADD8
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     919             :     6366U,      // SBCri
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     923             :     32323U,     // SBFX
     924             :     28035U,     // SDIV
     925             :     27323U,     // SEL
     926             :     91319U,     // SETEND
     927             :     414956U,    // SETPAN
     928             :     16928834U,  // SHA1C
     929             :     1107447884U,        // SHA1H
     930             :     16928866U,  // SHA1M
     931             :     16928876U,  // SHA1P
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     933             :     1090670619U,        // SHA1SU1
     934             :     16928854U,  // SHA256H
     935             :     16928821U,  // SHA256H2
     936             :     1090670605U,        // SHA256SU0
     937             :     16928807U,  // SHA256SU1
     938             :     26326U,     // SHADD16
     939             :     26431U,     // SHADD8
     940             :     28245U,     // SHASX
     941             :     28104U,     // SHSAX
     942             :     26288U,     // SHSUB16
     943             :     26392U,     // SHSUB8
     944             :     1073776883U,        // SMC
     945             :     30731U,     // SMLABB
     946             :     31925U,     // SMLABT
     947             :     30988U,     // SMLAD
     948             :     32249U,     // SMLADX
     949             :     96897U,     // SMLAL
     950             :     43026U,     // SMLALBB
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     955             :     44348U,     // SMLALTT
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     958             :     32053U,     // SMLATT
     959             :     30900U,     // SMLAWB
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     965             :     30671U,     // SMMLA
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     981             :     26984U,     // SMUSD
     982             :     28190U,     // SMUSDX
     983             :     0U, // SPACE
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     985             :     415043U,    // SRSDA_UPD
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     987             :     415067U,    // SRSDB_UPD
     988             :     415102U,    // SRSIA
     989             :     415055U,    // SRSIA_UPD
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     991             :     415079U,    // SRSIB_UPD
     992             :     31910U,     // SSAT
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    1011             :     3271588100U,        // STC_POST
    1012             :     3271588100U,        // STC_PRE
    1013             :     19224U,     // STL
    1014             :     18507U,     // STLB
    1015             :     28203U,     // STLEX
    1016             :     26825U,     // STLEXB
    1017             :     26997U,     // STLEXD
    1018             :     27183U,     // STLEXH
    1019             :     18916U,     // STLH
    1020             :     34735U,     // STMDA
    1021             :     33572783U,  // STMDA_UPD
    1022             :     34867U,     // STMDB
    1023             :     33572915U,  // STMDB_UPD
    1024             :     35643U,     // STMIA
    1025             :     33573691U,  // STMIA_UPD
    1026             :     34885U,     // STMIB
    1027             :     33572933U,  // STMIB_UPD
    1028             :     281815U,    // STRBT_POST
    1029             :     33623255U,  // STRBT_POST_IMM
    1030             :     33623255U,  // STRBT_POST_REG
    1031             :     33622110U,  // STRB_POST_IMM
    1032             :     33622110U,  // STRB_POST_REG
    1033             :     33585246U,  // STRB_PRE_IMM
    1034             :     33622110U,  // STRB_PRE_REG
    1035             :     26718U,     // STRBi12
    1036             :     0U, // STRBi_preidx
    1037             :     0U, // STRBr_preidx
    1038             :     30814U,     // STRBrs
    1039             :     67933U,     // STRD
    1040             :     33597789U,  // STRD_POST
    1041             :     33597789U,  // STRD_PRE
    1042             :     28221U,     // STREX
    1043             :     26839U,     // STREXB
    1044             :     27011U,     // STREXD
    1045             :     27197U,     // STREXH
    1046             :     31231U,     // STRH
    1047             :     33586426U,  // STRHTi
    1048             :     33623290U,  // STRHTr
    1049             :     33622527U,  // STRH_POST
    1050             :     33622527U,  // STRH_PRE
    1051             :     0U, // STRH_preidx
    1052             :     281899U,    // STRT_POST
    1053             :     33623339U,  // STRT_POST_IMM
    1054             :     33623339U,  // STRT_POST_REG
    1055             :     33623101U,  // STR_POST_IMM
    1056             :     33623101U,  // STR_POST_REG
    1057             :     33586237U,  // STR_PRE_IMM
    1058             :     33623101U,  // STR_PRE_REG
    1059             :     27709U,     // STRi12
    1060             :     0U, // STRi_preidx
    1061             :     0U, // STRr_preidx
    1062             :     31805U,     // STRrs
    1063             :     0U, // SUBS_PC_LR
    1064             :     0U, // SUBSri
    1065             :     0U, // SUBSrr
    1066             :     0U, // SUBSrsi
    1067             :     0U, // SUBSrsr
    1068             :     6303U,      // SUBri
    1069             :     6303U,      // SUBrr
    1070             :     10399U,     // SUBrsi
    1071             :     14495U,     // SUBrsr
    1072             :     1073776904U,        // SVC
    1073             :     27610U,     // SWP
    1074             :     26708U,     // SWPB
    1075             :     30719U,     // SXTAB
    1076             :     30354U,     // SXTAB16
    1077             :     31188U,     // SXTAH
    1078             :     26771U,     // SXTB
    1079             :     26274U,     // SXTB16
    1080             :     27166U,     // SXTH
    1081             :     0U, // TAILJMPd
    1082             :     0U, // TAILJMPr
    1083             :     0U, // TAILJMPr4
    1084             :     0U, // TCRETURNdi
    1085             :     0U, // TCRETURNri
    1086             :     19432U,     // TEQri
    1087             :     19432U,     // TEQrr
    1088             :     27624U,     // TEQrsi
    1089             :     31720U,     // TEQrsr
    1090             :     0U, // TPsoft
    1091             :     3005U,      // TRAP
    1092             :     3005U,      // TRAPNaCl
    1093             :     19761U,     // TSTri
    1094             :     19761U,     // TSTrr
    1095             :     27953U,     // TSTrsi
    1096             :     32049U,     // TSTrsr
    1097             :     26357U,     // UADD16
    1098             :     26458U,     // UADD8
    1099             :     28268U,     // UASX
    1100             :     32328U,     // UBFX
    1101             :     414911U,    // UDF
    1102             :     28040U,     // UDIV
    1103             :     26334U,     // UHADD16
    1104             :     26438U,     // UHADD8
    1105             :     28251U,     // UHASX
    1106             :     28110U,     // UHSAX
    1107             :     26296U,     // UHSUB16
    1108             :     26399U,     // UHSUB8
    1109             :     43622U,     // UMAAL
    1110             :     96903U,     // UMLAL
    1111             :     0U, // UMLALv5
    1112             :     11001U,     // UMULL
    1113             :     0U, // UMULLv5
    1114             :     26342U,     // UQADD16
    1115             :     26445U,     // UQADD8
    1116             :     28257U,     // UQASX
    1117             :     28116U,     // UQSAX
    1118             :     26304U,     // UQSUB16
    1119             :     26406U,     // UQSUB8
    1120             :     26425U,     // USAD8
    1121             :     30481U,     // USADA8
    1122             :     31915U,     // USAT
    1123             :     26371U,     // USAT16
    1124             :     28127U,     // USAX
    1125             :     26319U,     // USUB16
    1126             :     26419U,     // USUB8
    1127             :     30725U,     // UXTAB
    1128             :     30362U,     // UXTAB16
    1129             :     31194U,     // UXTAH
    1130             :     26776U,     // UXTB
    1131             :     26281U,     // UXTB16
    1132             :     27171U,     // UXTH
    1133             :     18512492U,  // VABALsv2i64
    1134             :     18643564U,  // VABALsv4i32
    1135             :     18774636U,  // VABALsv8i16
    1136             :     18905708U,  // VABALuv2i64
    1137             :     19036780U,  // VABALuv4i32
    1138             :     19167852U,  // VABALuv8i16
    1139             :     18773920U,  // VABAsv16i8
    1140             :     18511776U,  // VABAsv2i32
    1141             :     18642848U,  // VABAsv4i16
    1142             :     18511776U,  // VABAsv4i32
    1143             :     18642848U,  // VABAsv8i16
    1144             :     18773920U,  // VABAsv8i8
    1145             :     19167136U,  // VABAuv16i8
    1146             :     18904992U,  // VABAuv2i32
    1147             :     19036064U,  // VABAuv4i16
    1148             :     18904992U,  // VABAuv4i32
    1149             :     19036064U,  // VABAuv8i16
    1150             :     19167136U,  // VABAuv8i8
    1151             :     35285672U,  // VABDLsv2i64
    1152             :     35416744U,  // VABDLsv4i32
    1153             :     35547816U,  // VABDLsv8i16
    1154             :     35678888U,  // VABDLuv2i64
    1155             :     35809960U,  // VABDLuv4i32
    1156             :     35941032U,  // VABDLuv8i16
    1157             :     2249222424U,        // VABDfd
    1158             :     2249222424U,        // VABDfq
    1159             :     2249091352U,        // VABDhd
    1160             :     2249091352U,        // VABDhq
    1161             :     35547416U,  // VABDsv16i8
    1162             :     35285272U,  // VABDsv2i32
    1163             :     35416344U,  // VABDsv4i16
    1164             :     35285272U,  // VABDsv4i32
    1165             :     35416344U,  // VABDsv8i16
    1166             :     35547416U,  // VABDsv8i8
    1167             :     35940632U,  // VABDuv16i8
    1168             :     35678488U,  // VABDuv2i32
    1169             :     35809560U,  // VABDuv4i16
    1170             :     35678488U,  // VABDuv4i32
    1171             :     35809560U,  // VABDuv8i16
    1172             :     35940632U,  // VABDuv8i8
    1173             :     2248952909U,        // VABSD
    1174             :     2249083981U,        // VABSH
    1175             :     2249215053U,        // VABSS
    1176             :     2249215053U,        // VABSfd
    1177             :     2249215053U,        // VABSfq
    1178             :     2249083981U,        // VABShd
    1179             :     2249083981U,        // VABShq
    1180             :     1109281869U,        // VABSv16i8
    1181             :     1109019725U,        // VABSv2i32
    1182             :     1109150797U,        // VABSv4i16
    1183             :     1109019725U,        // VABSv4i32
    1184             :     1109150797U,        // VABSv8i16
    1185             :     1109281869U,        // VABSv8i8
    1186             :     2249222538U,        // VACGEfd
    1187             :     2249222538U,        // VACGEfq
    1188             :     2249091466U,        // VACGEhd
    1189             :     2249091466U,        // VACGEhq
    1190             :     2249223401U,        // VACGTfd
    1191             :     2249223401U,        // VACGTfq
    1192             :     2249092329U,        // VACGThd
    1193             :     2249092329U,        // VACGThq
    1194             :     2248960316U,        // VADDD
    1195             :     2249091388U,        // VADDH
    1196             :     36072278U,  // VADDHNv2i32
    1197             :     36203350U,  // VADDHNv4i16
    1198             :     36334422U,  // VADDHNv8i8
    1199             :     35285685U,  // VADDLsv2i64
    1200             :     35416757U,  // VADDLsv4i32
    1201             :     35547829U,  // VADDLsv8i16
    1202             :     35678901U,  // VADDLuv2i64
    1203             :     35809973U,  // VADDLuv4i32
    1204             :     35941045U,  // VADDLuv8i16
    1205             :     2249222460U,        // VADDS
    1206             :     35286429U,  // VADDWsv2i64
    1207             :     35417501U,  // VADDWsv4i32
    1208             :     35548573U,  // VADDWsv8i16
    1209             :     35679645U,  // VADDWuv2i64
    1210             :     35810717U,  // VADDWuv4i32
    1211             :     35941789U,  // VADDWuv8i16
    1212             :     2249222460U,        // VADDfd
    1213             :     2249222460U,        // VADDfq
    1214             :     2249091388U,        // VADDhd
    1215             :     2249091388U,        // VADDhq
    1216             :     36464956U,  // VADDv16i8
    1217             :     36071740U,  // VADDv1i64
    1218             :     36202812U,  // VADDv2i32
    1219             :     36071740U,  // VADDv2i64
    1220             :     36333884U,  // VADDv4i16
    1221             :     36202812U,  // VADDv4i32
    1222             :     36333884U,  // VADDv8i16
    1223             :     36464956U,  // VADDv8i8
    1224             :     26963U,     // VANDd
    1225             :     26963U,     // VANDq
    1226             :     26862U,     // VBICd
    1227             :     271083758U, // VBICiv2i32
    1228             :     271214830U, // VBICiv4i16
    1229             :     271083758U, // VBICiv4i32
    1230             :     271214830U, // VBICiv8i16
    1231             :     26862U,     // VBICq
    1232             :     31151U,     // VBIFd
    1233             :     31151U,     // VBIFq
    1234             :     32012U,     // VBITd
    1235             :     32012U,     // VBITq
    1236             :     31493U,     // VBSLd
    1237             :     31493U,     // VBSLq
    1238             :     2249223139U,        // VCEQfd
    1239             :     2249223139U,        // VCEQfq
    1240             :     2249092067U,        // VCEQhd
    1241             :     2249092067U,        // VCEQhq
    1242             :     36465635U,  // VCEQv16i8
    1243             :     36203491U,  // VCEQv2i32
    1244             :     36334563U,  // VCEQv4i16
    1245             :     36203491U,  // VCEQv4i32
    1246             :     36334563U,  // VCEQv8i16
    1247             :     36465635U,  // VCEQv8i8
    1248             :     3257682915U,        // VCEQzv16i8
    1249             :     2249214947U,        // VCEQzv2f32
    1250             :     3257420771U,        // VCEQzv2i32
    1251             :     2249083875U,        // VCEQzv4f16
    1252             :     2249214947U,        // VCEQzv4f32
    1253             :     3257551843U,        // VCEQzv4i16
    1254             :     3257420771U,        // VCEQzv4i32
    1255             :     2249083875U,        // VCEQzv8f16
    1256             :     3257551843U,        // VCEQzv8i16
    1257             :     3257682915U,        // VCEQzv8i8
    1258             :     2249222544U,        // VCGEfd
    1259             :     2249222544U,        // VCGEfq
    1260             :     2249091472U,        // VCGEhd
    1261             :     2249091472U,        // VCGEhq
    1262             :     35547536U,  // VCGEsv16i8
    1263             :     35285392U,  // VCGEsv2i32
    1264             :     35416464U,  // VCGEsv4i16
    1265             :     35285392U,  // VCGEsv4i32
    1266             :     35416464U,  // VCGEsv8i16
    1267             :     35547536U,  // VCGEsv8i8
    1268             :     35940752U,  // VCGEuv16i8
    1269             :     35678608U,  // VCGEuv2i32
    1270             :     35809680U,  // VCGEuv4i16
    1271             :     35678608U,  // VCGEuv4i32
    1272             :     35809680U,  // VCGEuv8i16
    1273             :     35940752U,  // VCGEuv8i8
    1274             :     3256764816U,        // VCGEzv16i8
    1275             :     2249214352U,        // VCGEzv2f32
    1276             :     3256502672U,        // VCGEzv2i32
    1277             :     2249083280U,        // VCGEzv4f16
    1278             :     2249214352U,        // VCGEzv4f32
    1279             :     3256633744U,        // VCGEzv4i16
    1280             :     3256502672U,        // VCGEzv4i32
    1281             :     2249083280U,        // VCGEzv8f16
    1282             :     3256633744U,        // VCGEzv8i16
    1283             :     3256764816U,        // VCGEzv8i8
    1284             :     2249223407U,        // VCGTfd
    1285             :     2249223407U,        // VCGTfq
    1286             :     2249092335U,        // VCGThd
    1287             :     2249092335U,        // VCGThq
    1288             :     35548399U,  // VCGTsv16i8
    1289             :     35286255U,  // VCGTsv2i32
    1290             :     35417327U,  // VCGTsv4i16
    1291             :     35286255U,  // VCGTsv4i32
    1292             :     35417327U,  // VCGTsv8i16
    1293             :     35548399U,  // VCGTsv8i8
    1294             :     35941615U,  // VCGTuv16i8
    1295             :     35679471U,  // VCGTuv2i32
    1296             :     35810543U,  // VCGTuv4i16
    1297             :     35679471U,  // VCGTuv4i32
    1298             :     35810543U,  // VCGTuv8i16
    1299             :     35941615U,  // VCGTuv8i8
    1300             :     3256765679U,        // VCGTzv16i8
    1301             :     2249215215U,        // VCGTzv2f32
    1302             :     3256503535U,        // VCGTzv2i32
    1303             :     2249084143U,        // VCGTzv4f16
    1304             :     2249215215U,        // VCGTzv4f32
    1305             :     3256634607U,        // VCGTzv4i16
    1306             :     3256503535U,        // VCGTzv4i32
    1307             :     2249084143U,        // VCGTzv8f16
    1308             :     3256634607U,        // VCGTzv8i16
    1309             :     3256765679U,        // VCGTzv8i8
    1310             :     3256764821U,        // VCLEzv16i8
    1311             :     2249214357U,        // VCLEzv2f32
    1312             :     3256502677U,        // VCLEzv2i32
    1313             :     2249083285U,        // VCLEzv4f16
    1314             :     2249214357U,        // VCLEzv4f32
    1315             :     3256633749U,        // VCLEzv4i16
    1316             :     3256502677U,        // VCLEzv4i32
    1317             :     2249083285U,        // VCLEzv8f16
    1318             :     3256633749U,        // VCLEzv8i16
    1319             :     3256764821U,        // VCLEzv8i8
    1320             :     1109281879U,        // VCLSv16i8
    1321             :     1109019735U,        // VCLSv2i32
    1322             :     1109150807U,        // VCLSv4i16
    1323             :     1109019735U,        // VCLSv4i32
    1324             :     1109150807U,        // VCLSv8i16
    1325             :     1109281879U,        // VCLSv8i8
    1326             :     3256765713U,        // VCLTzv16i8
    1327             :     2249215249U,        // VCLTzv2f32
    1328             :     3256503569U,        // VCLTzv2i32
    1329             :     2249084177U,        // VCLTzv4f16
    1330             :     2249215249U,        // VCLTzv4f32
    1331             :     3256634641U,        // VCLTzv4i16
    1332             :     3256503569U,        // VCLTzv4i32
    1333             :     2249084177U,        // VCLTzv8f16
    1334             :     3256634641U,        // VCLTzv8i16
    1335             :     3256765713U,        // VCLTzv8i8
    1336             :     1110199928U,        // VCLZv16i8
    1337             :     1109937784U,        // VCLZv2i32
    1338             :     1110068856U,        // VCLZv4i16
    1339             :     1109937784U,        // VCLZv4i32
    1340             :     1110068856U,        // VCLZv8i16
    1341             :     1110199928U,        // VCLZv8i8
    1342             :     2248952779U,        // VCMPD
    1343             :     2248952225U,        // VCMPED
    1344             :     2249083297U,        // VCMPEH
    1345             :     2249214369U,        // VCMPES
    1346             :     286034337U, // VCMPEZD
    1347             :     286165409U, // VCMPEZH
    1348             :     286296481U, // VCMPEZS
    1349             :     2249083851U,        // VCMPH
    1350             :     2249214923U,        // VCMPS
    1351             :     286034891U, // VCMPZD
    1352             :     286165963U, // VCMPZH
    1353             :     286297035U, // VCMPZS
    1354             :     3034390U,   // VCNTd
    1355             :     3034390U,   // VCNTq
    1356             :     1107447926U,        // VCVTANSDf
    1357             :     1107448605U,        // VCVTANSDh
    1358             :     1107447926U,        // VCVTANSQf
    1359             :     1107448605U,        // VCVTANSQh
    1360             :     1107447986U,        // VCVTANUDf
    1361             :     1107448665U,        // VCVTANUDh
    1362             :     1107447986U,        // VCVTANUQf
    1363             :     1107448665U,        // VCVTANUQh
    1364             :     1107448234U,        // VCVTASD
    1365             :     1107448485U,        // VCVTASH
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    1368             :     1107448545U,        // VCVTAUH
    1369             :     1107447986U,        // VCVTAUS
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    1372             :     3426445U,   // VCVTBHS
    1373             :     3557517U,   // VCVTBSH
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    1375             :     1107447941U,        // VCVTMNSDf
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    1378             :     1107448620U,        // VCVTMNSQh
    1379             :     1107448001U,        // VCVTMNUDf
    1380             :     1107448680U,        // VCVTMNUDh
    1381             :     1107448001U,        // VCVTMNUQf
    1382             :     1107448680U,        // VCVTMNUQh
    1383             :     1107448249U,        // VCVTMSD
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    1392             :     1107448635U,        // VCVTNNSQh
    1393             :     1107448016U,        // VCVTNNUDf
    1394             :     1107448695U,        // VCVTNNUDh
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    1396             :     1107448695U,        // VCVTNNUQh
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    1410             :     1107448710U,        // VCVTPNUQh
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    1421             :     3558735U,   // VCVTTSH
    1422             :     3558747U,   // VCVTf2h
    1423             :     305941851U, // VCVTf2sd
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    1676             :     5178961U,   // VLD2LNqWB_register_Asm_32
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    1712             :     3593406033U,        // VLD2q8wb_register
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    1716             :     1079346801U,        // VLD3DUPd16_UPD
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    1748             :     472807025U, // VLD3DUPqWB_register_Asm_8
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    1769             :     3081841U,   // VLD3LNdWB_register_Asm_8
    1770             :     5609073U,   // VLD3LNq16
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    1773             :     5613169U,   // VLD3LNq16_UPD
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    1783             :     5178993U,   // VLD3LNqWB_register_Asm_32
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    1807             :     5604977U,   // VLD3q16_UPD
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    1809             :     0U, // VLD3q16oddPseudo_UPD
    1810             :     5703281U,   // VLD3q32
    1811             :     0U, // VLD3q32Pseudo_UPD
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    1813             :     0U, // VLD3q32oddPseudo
    1814             :     0U, // VLD3q32oddPseudo_UPD
    1815             :     5834353U,   // VLD3q8
    1816             :     0U, // VLD3q8Pseudo_UPD
    1817             :     5867121U,   // VLD3q8_UPD
    1818             :     0U, // VLD3q8oddPseudo
    1819             :     0U, // VLD3q8oddPseudo_UPD
    1820             :     1565288049U,        // VLD3qAsm_16
    1821             :     1565419121U,        // VLD3qAsm_32
    1822             :     1563321969U,        // VLD3qAsm_8
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    1825             :     2637063793U,        // VLD3qWB_fixed_Asm_8
    1826             :     491550321U, // VLD3qWB_register_Asm_16
    1827             :     491681393U, // VLD3qWB_register_Asm_32
    1828             :     489584241U, // VLD3qWB_register_Asm_8
    1829             :     1079289480U,        // VLD4DUPd16
    1830             :     0U, // VLD4DUPd16Pseudo
    1831             :     0U, // VLD4DUPd16Pseudo_UPD
    1832             :     1079359112U,        // VLD4DUPd16_UPD
    1833             :     1079420552U,        // VLD4DUPd32
    1834             :     0U, // VLD4DUPd32Pseudo
    1835             :     0U, // VLD4DUPd32Pseudo_UPD
    1836             :     1079490184U,        // VLD4DUPd32_UPD
    1837             :     1079551624U,        // VLD4DUPd8
    1838             :     0U, // VLD4DUPd8Pseudo
    1839             :     0U, // VLD4DUPd8Pseudo_UPD
    1840             :     1079621256U,        // VLD4DUPd8_UPD
    1841             :     1582065288U,        // VLD4DUPdAsm_16
    1842             :     1582196360U,        // VLD4DUPdAsm_32
    1843             :     1580099208U,        // VLD4DUPdAsm_8
    1844             :     2655807112U,        // VLD4DUPdWB_fixed_Asm_16
    1845             :     2655938184U,        // VLD4DUPdWB_fixed_Asm_32
    1846             :     2653841032U,        // VLD4DUPdWB_fixed_Asm_8
    1847             :     508327560U, // VLD4DUPdWB_register_Asm_16
    1848             :     508458632U, // VLD4DUPdWB_register_Asm_32
    1849             :     506361480U, // VLD4DUPdWB_register_Asm_8
    1850             :     1079289480U,        // VLD4DUPq16
    1851             :     1079359112U,        // VLD4DUPq16_UPD
    1852             :     1079420552U,        // VLD4DUPq32
    1853             :     1079490184U,        // VLD4DUPq32_UPD
    1854             :     1079551624U,        // VLD4DUPq8
    1855             :     1079621256U,        // VLD4DUPq8_UPD
    1856             :     1598842504U,        // VLD4DUPqAsm_16
    1857             :     1598973576U,        // VLD4DUPqAsm_32
    1858             :     1596876424U,        // VLD4DUPqAsm_8
    1859             :     2672584328U,        // VLD4DUPqWB_fixed_Asm_16
    1860             :     2672715400U,        // VLD4DUPqWB_fixed_Asm_32
    1861             :     2670618248U,        // VLD4DUPqWB_fixed_Asm_8
    1862             :     525104776U, // VLD4DUPqWB_register_Asm_16
    1863             :     525235848U, // VLD4DUPqWB_register_Asm_32
    1864             :     523138696U, // VLD4DUPqWB_register_Asm_8
    1865             :     5613192U,   // VLD4LNd16
    1866             :     0U, // VLD4LNd16Pseudo
    1867             :     0U, // VLD4LNd16Pseudo_UPD
    1868             :     5621384U,   // VLD4LNd16_UPD
    1869             :     5744264U,   // VLD4LNd32
    1870             :     0U, // VLD4LNd32Pseudo
    1871             :     0U, // VLD4LNd32Pseudo_UPD
    1872             :     5752456U,   // VLD4LNd32_UPD
    1873             :     5875336U,   // VLD4LNd8
    1874             :     0U, // VLD4LNd8Pseudo
    1875             :     0U, // VLD4LNd8Pseudo_UPD
    1876             :     5883528U,   // VLD4LNd8_UPD
    1877             :     5011080U,   // VLD4LNdAsm_16
    1878             :     5142152U,   // VLD4LNdAsm_32
    1879             :     3045000U,   // VLD4LNdAsm_8
    1880             :     5011080U,   // VLD4LNdWB_fixed_Asm_16
    1881             :     5142152U,   // VLD4LNdWB_fixed_Asm_32
    1882             :     3045000U,   // VLD4LNdWB_fixed_Asm_8
    1883             :     5047944U,   // VLD4LNdWB_register_Asm_16
    1884             :     5179016U,   // VLD4LNdWB_register_Asm_32
    1885             :     3081864U,   // VLD4LNdWB_register_Asm_8
    1886             :     5613192U,   // VLD4LNq16
    1887             :     0U, // VLD4LNq16Pseudo
    1888             :     0U, // VLD4LNq16Pseudo_UPD
    1889             :     5621384U,   // VLD4LNq16_UPD
    1890             :     5744264U,   // VLD4LNq32
    1891             :     0U, // VLD4LNq32Pseudo
    1892             :     0U, // VLD4LNq32Pseudo_UPD
    1893             :     5752456U,   // VLD4LNq32_UPD
    1894             :     5011080U,   // VLD4LNqAsm_16
    1895             :     5142152U,   // VLD4LNqAsm_32
    1896             :     5011080U,   // VLD4LNqWB_fixed_Asm_16
    1897             :     5142152U,   // VLD4LNqWB_fixed_Asm_32
    1898             :     5047944U,   // VLD4LNqWB_register_Asm_16
    1899             :     5179016U,   // VLD4LNqWB_register_Asm_32
    1900             :     5547656U,   // VLD4d16
    1901             :     0U, // VLD4d16Pseudo
    1902             :     0U, // VLD4d16Pseudo_UPD
    1903             :     5617288U,   // VLD4d16_UPD
    1904             :     5678728U,   // VLD4d32
    1905             :     0U, // VLD4d32Pseudo
    1906             :     0U, // VLD4d32Pseudo_UPD
    1907             :     5748360U,   // VLD4d32_UPD
    1908             :     5809800U,   // VLD4d8
    1909             :     0U, // VLD4d8Pseudo
    1910             :     0U, // VLD4d8Pseudo_UPD
    1911             :     5879432U,   // VLD4d8_UPD
    1912             :     2521589384U,        // VLD4dAsm_16
    1913             :     2521720456U,        // VLD4dAsm_32
    1914             :     2519623304U,        // VLD4dAsm_8
    1915             :     2521589384U,        // VLD4dWB_fixed_Asm_16
    1916             :     2521720456U,        // VLD4dWB_fixed_Asm_32
    1917             :     2519623304U,        // VLD4dWB_fixed_Asm_8
    1918             :     2521593480U,        // VLD4dWB_register_Asm_16
    1919             :     2521724552U,        // VLD4dWB_register_Asm_32
    1920             :     2519627400U,        // VLD4dWB_register_Asm_8
    1921             :     5547656U,   // VLD4q16
    1922             :     0U, // VLD4q16Pseudo_UPD
    1923             :     5617288U,   // VLD4q16_UPD
    1924             :     0U, // VLD4q16oddPseudo
    1925             :     0U, // VLD4q16oddPseudo_UPD
    1926             :     5678728U,   // VLD4q32
    1927             :     0U, // VLD4q32Pseudo_UPD
    1928             :     5748360U,   // VLD4q32_UPD
    1929             :     0U, // VLD4q32oddPseudo
    1930             :     0U, // VLD4q32oddPseudo_UPD
    1931             :     5809800U,   // VLD4q8
    1932             :     0U, // VLD4q8Pseudo_UPD
    1933             :     5879432U,   // VLD4q8_UPD
    1934             :     0U, // VLD4q8oddPseudo
    1935             :     0U, // VLD4q8oddPseudo_UPD
    1936             :     1615619720U,        // VLD4qAsm_16
    1937             :     1615750792U,        // VLD4qAsm_32
    1938             :     1613653640U,        // VLD4qAsm_8
    1939             :     2689361544U,        // VLD4qWB_fixed_Asm_16
    1940             :     2689492616U,        // VLD4qWB_fixed_Asm_32
    1941             :     2687395464U,        // VLD4qWB_fixed_Asm_8
    1942             :     541881992U, // VLD4qWB_register_Asm_16
    1943             :     542013064U, // VLD4qWB_register_Asm_32
    1944             :     539915912U, // VLD4qWB_register_Asm_8
    1945             :     33572907U,  // VLDMDDB_UPD
    1946             :     34747U,     // VLDMDIA
    1947             :     33572795U,  // VLDMDIA_UPD
    1948             :     0U, // VLDMQIA
    1949             :     33572907U,  // VLDMSDB_UPD
    1950             :     34747U,     // VLDMSIA
    1951             :     33572795U,  // VLDMSIA_UPD
    1952             :     27643U,     // VLDRD
    1953             :     5008379U,   // VLDRH
    1954             :     27643U,     // VLDRS
    1955             :     1073777459U,        // VLLDM
    1956             :     1073777465U,        // VLSTM
    1957             :     33706566U,  // VMAXNMD
    1958             :     33706937U,  // VMAXNMH
    1959             :     33706258U,  // VMAXNMNDf
    1960             :     33706937U,  // VMAXNMNDh
    1961             :     33706258U,  // VMAXNMNQf
    1962             :     33706937U,  // VMAXNMNQh
    1963             :     33706258U,  // VMAXNMS
    1964             :     2249223619U,        // VMAXfd
    1965             :     2249223619U,        // VMAXfq
    1966             :     2249092547U,        // VMAXhd
    1967             :     2249092547U,        // VMAXhq
    1968             :     35548611U,  // VMAXsv16i8
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    1970             :     35417539U,  // VMAXsv4i16
    1971             :     35286467U,  // VMAXsv4i32
    1972             :     35417539U,  // VMAXsv8i16
    1973             :     35548611U,  // VMAXsv8i8
    1974             :     35941827U,  // VMAXuv16i8
    1975             :     35679683U,  // VMAXuv2i32
    1976             :     35810755U,  // VMAXuv4i16
    1977             :     35679683U,  // VMAXuv4i32
    1978             :     35810755U,  // VMAXuv8i16
    1979             :     35941827U,  // VMAXuv8i8
    1980             :     33706554U,  // VMINNMD
    1981             :     33706925U,  // VMINNMH
    1982             :     33706246U,  // VMINNMNDf
    1983             :     33706925U,  // VMINNMNDh
    1984             :     33706246U,  // VMINNMNQf
    1985             :     33706925U,  // VMINNMNQh
    1986             :     33706246U,  // VMINNMS
    1987             :     2249223011U,        // VMINfd
    1988             :     2249223011U,        // VMINfq
    1989             :     2249091939U,        // VMINhd
    1990             :     2249091939U,        // VMINhq
    1991             :     35548003U,  // VMINsv16i8
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    1997             :     35941219U,  // VMINuv16i8
    1998             :     35679075U,  // VMINuv2i32
    1999             :     35810147U,  // VMINuv4i16
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    2001             :     35810147U,  // VMINuv8i16
    2002             :     35941219U,  // VMINuv8i8
    2003             :     101480411U, // VMLAD
    2004             :     101611483U, // VMLAH
    2005             :     18549389U,  // VMLALslsv2i32
    2006             :     18680461U,  // VMLALslsv4i16
    2007             :     18942605U,  // VMLALsluv2i32
    2008             :     19073677U,  // VMLALsluv4i16
    2009             :     18512525U,  // VMLALsv2i64
    2010             :     18643597U,  // VMLALsv4i32
    2011             :     18774669U,  // VMLALsv8i16
    2012             :     18905741U,  // VMLALuv2i64
    2013             :     19036813U,  // VMLALuv4i32
    2014             :     19167885U,  // VMLALuv8i16
    2015             :     101742555U, // VMLAS
    2016             :     101742555U, // VMLAfd
    2017             :     101742555U, // VMLAfq
    2018             :     101611483U, // VMLAhd
    2019             :     101611483U, // VMLAhq
    2020             :     101779419U, // VMLAslfd
    2021             :     101779419U, // VMLAslfq
    2022             :     101648347U, // VMLAslhd
    2023             :     101648347U, // VMLAslhq
    2024             :     19466203U,  // VMLAslv2i32
    2025             :     19597275U,  // VMLAslv4i16
    2026             :     19466203U,  // VMLAslv4i32
    2027             :     19597275U,  // VMLAslv8i16
    2028             :     19691483U,  // VMLAv16i8
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    2030             :     19560411U,  // VMLAv4i16
    2031             :     19429339U,  // VMLAv4i32
    2032             :     19560411U,  // VMLAv8i16
    2033             :     19691483U,  // VMLAv8i8
    2034             :     101481576U, // VMLSD
    2035             :     101612648U, // VMLSH
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    2037             :     18680594U,  // VMLSLslsv4i16
    2038             :     18942738U,  // VMLSLsluv2i32
    2039             :     19073810U,  // VMLSLsluv4i16
    2040             :     18512658U,  // VMLSLsv2i64
    2041             :     18643730U,  // VMLSLsv4i32
    2042             :     18774802U,  // VMLSLsv8i16
    2043             :     18905874U,  // VMLSLuv2i64
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    2047             :     101743720U, // VMLSfd
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    2056             :     19598440U,  // VMLSslv4i16
    2057             :     19467368U,  // VMLSslv4i32
    2058             :     19598440U,  // VMLSslv8i16
    2059             :     19692648U,  // VMLSv16i8
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    2062             :     19430504U,  // VMLSv4i32
    2063             :     19561576U,  // VMLSv8i16
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    2077             :     1109806007U,        // VMOVNv2i32
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    2087             :     32146U,     // VMOVSRR
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    2096             :     271076754U, // VMOVv4i32
    2097             :     271207826U, // VMOVv8i16
    2098             :     271338898U, // VMOVv8i8
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    2103             :     3221261450U,        // VMRS_FPSID
    2104             :     35978U,     // VMRS_MVFR0
    2105             :     1073777802U,        // VMRS_MVFR1
    2106             :     2147519626U,        // VMRS_MVFR2
    2107             :     5934128U,   // VMSR
    2108             :     6065200U,   // VMSR_FPEXC
    2109             :     6196272U,   // VMSR_FPINST
    2110             :     6327344U,   // VMSR_FPINST2
    2111             :     6458416U,   // VMSR_FPSID
    2112             :     2248960808U,        // VMULD
    2113             :     2249091880U,        // VMULH
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    2117             :     35420927U,  // VMULLslsv4i16
    2118             :     35683071U,  // VMULLsluv2i32
    2119             :     35814143U,  // VMULLsluv4i16
    2120             :     35285759U,  // VMULLsv2i64
    2121             :     35416831U,  // VMULLsv4i32
    2122             :     35547903U,  // VMULLsv8i16
    2123             :     35678975U,  // VMULLuv2i64
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    2125             :     35941119U,  // VMULLuv8i16
    2126             :     2249222952U,        // VMULS
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    2139             :     36207400U,  // VMULslv4i32
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    2141             :     36465448U,  // VMULv16i8
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    2144             :     36203304U,  // VMULv4i32
    2145             :     36334376U,  // VMULv8i16
    2146             :     36465448U,  // VMULv8i8
    2147             :     19371U,     // VMVNd
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    2151             :     271076267U, // VMVNv4i32
    2152             :     271207339U, // VMVNv8i16
    2153             :     2248952254U,        // VNEGD
    2154             :     2249083326U,        // VNEGH
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    2157             :     2249214398U,        // VNEGfd
    2158             :     2249083326U,        // VNEGhd
    2159             :     2249083326U,        // VNEGhq
    2160             :     1109150142U,        // VNEGs16d
    2161             :     1109150142U,        // VNEGs16q
    2162             :     1109019070U,        // VNEGs32d
    2163             :     1109019070U,        // VNEGs32q
    2164             :     1109281214U,        // VNEGs8d
    2165             :     1109281214U,        // VNEGs8q
    2166             :     101480405U, // VNMLAD
    2167             :     101611477U, // VNMLAH
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    2169             :     101481570U, // VNMLSD
    2170             :     101612642U, // VNMLSH
    2171             :     101743714U, // VNMLSS
    2172             :     2248960802U,        // VNMULD
    2173             :     2249091874U,        // VNMULH
    2174             :     2249222946U,        // VNMULS
    2175             :     27528U,     // VORNd
    2176             :     27528U,     // VORNq
    2177             :     27680U,     // VORRd
    2178             :     271084576U, // VORRiv2i32
    2179             :     271215648U, // VORRiv4i16
    2180             :     271084576U, // VORRiv4i32
    2181             :     271215648U, // VORRiv8i16
    2182             :     27680U,     // VORRq
    2183             :     1092512370U,        // VPADALsv16i8
    2184             :     1092250226U,        // VPADALsv2i32
    2185             :     1092381298U,        // VPADALsv4i16
    2186             :     1092250226U,        // VPADALsv4i32
    2187             :     1092381298U,        // VPADALsv8i16
    2188             :     1092512370U,        // VPADALsv8i8
    2189             :     1092905586U,        // VPADALuv16i8
    2190             :     1092643442U,        // VPADALuv2i32
    2191             :     1092774514U,        // VPADALuv4i16
    2192             :     1092643442U,        // VPADALuv4i32
    2193             :     1092774514U,        // VPADALuv8i16
    2194             :     1092905586U,        // VPADALuv8i8
    2195             :     1109281454U,        // VPADDLsv16i8
    2196             :     1109019310U,        // VPADDLsv2i32
    2197             :     1109150382U,        // VPADDLsv4i16
    2198             :     1109019310U,        // VPADDLsv4i32
    2199             :     1109150382U,        // VPADDLsv8i16
    2200             :     1109281454U,        // VPADDLsv8i8
    2201             :     1109674670U,        // VPADDLuv16i8
    2202             :     1109412526U,        // VPADDLuv2i32
    2203             :     1109543598U,        // VPADDLuv4i16
    2204             :     1109412526U,        // VPADDLuv4i32
    2205             :     1109543598U,        // VPADDLuv8i16
    2206             :     1109674670U,        // VPADDLuv8i8
    2207             :     2249222448U,        // VPADDf
    2208             :     2249091376U,        // VPADDh
    2209             :     36333872U,  // VPADDi16
    2210             :     36202800U,  // VPADDi32
    2211             :     36464944U,  // VPADDi8
    2212             :     2249223613U,        // VPMAXf
    2213             :     2249092541U,        // VPMAXh
    2214             :     35417533U,  // VPMAXs16
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    2217             :     35810749U,  // VPMAXu16
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    2219             :     35941821U,  // VPMAXu8
    2220             :     2249223005U,        // VPMINf
    2221             :     2249091933U,        // VPMINh
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    2224             :     35547997U,  // VPMINs8
    2225             :     35810141U,  // VPMINu16
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    2228             :     1109281863U,        // VQABSv16i8
    2229             :     1109019719U,        // VQABSv2i32
    2230             :     1109150791U,        // VQABSv4i16
    2231             :     1109019719U,        // VQABSv4i32
    2232             :     1109150791U,        // VQABSv8i16
    2233             :     1109281863U,        // VQABSv8i8
    2234             :     35547446U,  // VQADDsv16i8
    2235             :     40266038U,  // VQADDsv1i64
    2236             :     35285302U,  // VQADDsv2i32
    2237             :     40266038U,  // VQADDsv2i64
    2238             :     35416374U,  // VQADDsv4i16
    2239             :     35285302U,  // VQADDsv4i32
    2240             :     35416374U,  // VQADDsv8i16
    2241             :     35547446U,  // VQADDsv8i8
    2242             :     35940662U,  // VQADDuv16i8
    2243             :     40397110U,  // VQADDuv1i64
    2244             :     35678518U,  // VQADDuv2i32
    2245             :     40397110U,  // VQADDuv2i64
    2246             :     35809590U,  // VQADDuv4i16
    2247             :     35678518U,  // VQADDuv4i32
    2248             :     35809590U,  // VQADDuv8i16
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    2250             :     18549369U,  // VQDMLALslv2i32
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    2254             :     18549514U,  // VQDMLSLslv2i32
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    2256             :     18512650U,  // VQDMLSLv2i64
    2257             :     18643722U,  // VQDMLSLv4i32
    2258             :     35289577U,  // VQDMULHslv2i32
    2259             :     35420649U,  // VQDMULHslv4i16
    2260             :     35289577U,  // VQDMULHslv4i32
    2261             :     35420649U,  // VQDMULHslv8i16
    2262             :     35285481U,  // VQDMULHv2i32
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    2264             :     35285481U,  // VQDMULHv4i32
    2265             :     35416553U,  // VQDMULHv8i16
    2266             :     35289835U,  // VQDMULLslv2i32
    2267             :     35420907U,  // VQDMULLslv4i16
    2268             :     35285739U,  // VQDMULLv2i64
    2269             :     35416811U,  // VQDMULLv4i32
    2270             :     1114000291U,        // VQMOVNsuv2i32
    2271             :     1109019555U,        // VQMOVNsuv4i16
    2272             :     1109150627U,        // VQMOVNsuv8i8
    2273             :     1114000304U,        // VQMOVNsv2i32
    2274             :     1109019568U,        // VQMOVNsv4i16
    2275             :     1109150640U,        // VQMOVNsv8i8
    2276             :     1114131376U,        // VQMOVNuv2i32
    2277             :     1109412784U,        // VQMOVNuv4i16
    2278             :     1109543856U,        // VQMOVNuv8i8
    2279             :     1109281208U,        // VQNEGv16i8
    2280             :     1109019064U,        // VQNEGv2i32
    2281             :     1109150136U,        // VQNEGv4i16
    2282             :     1109019064U,        // VQNEGv4i32
    2283             :     1109150136U,        // VQNEGv8i16
    2284             :     1109281208U,        // VQNEGv8i8
    2285             :     18549195U,  // VQRDMLAHslv2i32
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    2287             :     18549195U,  // VQRDMLAHslv4i32
    2288             :     18680267U,  // VQRDMLAHslv8i16
    2289             :     18512331U,  // VQRDMLAHv2i32
    2290             :     18643403U,  // VQRDMLAHv4i16
    2291             :     18512331U,  // VQRDMLAHv4i32
    2292             :     18643403U,  // VQRDMLAHv8i16
    2293             :     18549252U,  // VQRDMLSHslv2i32
    2294             :     18680324U,  // VQRDMLSHslv4i16
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    2296             :     18680324U,  // VQRDMLSHslv8i16
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    2300             :     18643460U,  // VQRDMLSHv8i16
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    2303             :     35289585U,  // VQRDMULHslv4i32
    2304             :     35420657U,  // VQRDMULHslv8i16
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    2307             :     35285489U,  // VQRDMULHv4i32
    2308             :     35416561U,  // VQRDMULHv8i16
    2309             :     35547845U,  // VQRSHLsv16i8
    2310             :     40266437U,  // VQRSHLsv1i64
    2311             :     35285701U,  // VQRSHLsv2i32
    2312             :     40266437U,  // VQRSHLsv2i64
    2313             :     35416773U,  // VQRSHLsv4i16
    2314             :     35285701U,  // VQRSHLsv4i32
    2315             :     35416773U,  // VQRSHLsv8i16
    2316             :     35547845U,  // VQRSHLsv8i8
    2317             :     35941061U,  // VQRSHLuv16i8
    2318             :     40397509U,  // VQRSHLuv1i64
    2319             :     35678917U,  // VQRSHLuv2i32
    2320             :     40397509U,  // VQRSHLuv2i64
    2321             :     35809989U,  // VQRSHLuv4i16
    2322             :     35678917U,  // VQRSHLuv4i32
    2323             :     35809989U,  // VQRSHLuv8i16
    2324             :     35941061U,  // VQRSHLuv8i8
    2325             :     40266611U,  // VQRSHRNsv2i32
    2326             :     35285875U,  // VQRSHRNsv4i16
    2327             :     35416947U,  // VQRSHRNsv8i8
    2328             :     40397683U,  // VQRSHRNuv2i32
    2329             :     35679091U,  // VQRSHRNuv4i16
    2330             :     35810163U,  // VQRSHRNuv8i8
    2331             :     40266650U,  // VQRSHRUNv2i32
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    2341             :     35547839U,  // VQSHLsiv8i8
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    2423             :     3032705U,   // VREV64q8
    2424             :     35547427U,  // VRHADDsv16i8
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    2429             :     35547427U,  // VRHADDsv8i8
    2430             :     35940643U,  // VRHADDuv16i8
    2431             :     35678499U,  // VRHADDuv2i32
    2432             :     35809571U,  // VRHADDuv4i16
    2433             :     35678499U,  // VRHADDuv4i32
    2434             :     35809571U,  // VRHADDuv8i16
    2435             :     35940643U,  // VRHADDuv8i8
    2436             :     1107448354U,        // VRINTAD
    2437             :     1107448725U,        // VRINTAH
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    2439             :     1107448725U,        // VRINTANDh
    2440             :     1107448046U,        // VRINTANQf
    2441             :     1107448725U,        // VRINTANQh
    2442             :     1107448046U,        // VRINTAS
    2443             :     1107448402U,        // VRINTMD
    2444             :     1107448773U,        // VRINTMH
    2445             :     1107448094U,        // VRINTMNDf
    2446             :     1107448773U,        // VRINTMNDh
    2447             :     1107448094U,        // VRINTMNQf
    2448             :     1107448773U,        // VRINTMNQh
    2449             :     1107448094U,        // VRINTMS
    2450             :     1107448414U,        // VRINTND
    2451             :     1107448785U,        // VRINTNH
    2452             :     1107448106U,        // VRINTNNDf
    2453             :     1107448785U,        // VRINTNNDh
    2454             :     1107448106U,        // VRINTNNQf
    2455             :     1107448785U,        // VRINTNNQh
    2456             :     1107448106U,        // VRINTNS
    2457             :     1107448426U,        // VRINTPD
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    2460             :     1107448797U,        // VRINTPNDh
    2461             :     1107448118U,        // VRINTPNQf
    2462             :     1107448797U,        // VRINTPNQh
    2463             :     1107448118U,        // VRINTPS
    2464             :     2248952885U,        // VRINTRD
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    2466             :     2249215029U,        // VRINTRS
    2467             :     2248953457U,        // VRINTXD
    2468             :     2249084529U,        // VRINTXH
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    2470             :     1107448855U,        // VRINTXNDh
    2471             :     1107448166U,        // VRINTXNQf
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    2489             :     35941068U,  // VRSHLuv16i8
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    2492             :     40397516U,  // VRSHLuv2i64
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    2848             :     559384188U, // VST3d32_UPD
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    3558             :     35637U,     // tLDMIA
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    3630             :   };
    3631             : 
    3632             :   static const uint32_t OpInfo1[] = {
    3633             :     0U, // PHI
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    3636             :     0U, // EH_LABEL
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    3644             :     0U, // COPY_TO_REGCLASS
    3645             :     0U, // DBG_VALUE
    3646             :     0U, // REG_SEQUENCE
    3647             :     0U, // COPY
    3648             :     0U, // BUNDLE
    3649             :     0U, // LIFETIME_START
    3650             :     0U, // LIFETIME_END
    3651             :     0U, // STACKMAP
    3652             :     0U, // FENTRY_CALL
    3653             :     0U, // PATCHPOINT
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    3655             :     0U, // STATEPOINT
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    3657             :     0U, // FAULTING_OP
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    3675             :     0U, // G_PHI
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    3678             :     0U, // G_EXTRACT
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    3680             :     0U, // G_INSERT
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    3682             :     0U, // G_PTRTOINT
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    3689             :     0U, // G_INTRINSIC
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    3691             :     0U, // G_ANYEXT
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    3749             :     0U, // ADDrsr
    3750             :     0U, // ADJCALLSTACKDOWN
    3751             :     0U, // ADJCALLSTACKUP
    3752             :     8U, // ADR
    3753             :     0U, // AESD
    3754             :     0U, // AESE
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    3756             :     0U, // AESMC
    3757             :     0U, // ANDri
    3758             :     32768U,     // ANDrr
    3759             :     65536U,     // ANDrsi
    3760             :     0U, // ANDrsr
    3761             :     32768U,     // ASRi
    3762             :     32768U,     // ASRr
    3763             :     0U, // B
    3764             :     0U, // BCCZi64
    3765             :     0U, // BCCi64
    3766             :     16U,        // BFC
    3767             :     98328U,     // BFI
    3768             :     0U, // BICri
    3769             :     32768U,     // BICrr
    3770             :     65536U,     // BICrsi
    3771             :     0U, // BICrsr
    3772             :     0U, // BKPT
    3773             :     0U, // BL
    3774             :     0U, // BLX
    3775             :     0U, // BLX_pred
    3776             :     0U, // BLXi
    3777             :     0U, // BL_pred
    3778             :     0U, // BMOVPCB_CALL
    3779             :     0U, // BMOVPCRX_CALL
    3780             :     0U, // BR_JTadd
    3781             :     0U, // BR_JTm
    3782             :     0U, // BR_JTr
    3783             :     0U, // BX
    3784             :     0U, // BXJ
    3785             :     0U, // BX_CALL
    3786             :     0U, // BX_RET
    3787             :     0U, // BX_pred
    3788             :     0U, // Bcc
    3789             :     1056U,      // CDP
    3790             :     0U, // CDP2
    3791             :     0U, // CLREX
    3792             :     2048U,      // CLZ
    3793             :     40U,        // CMNri
    3794             :     2048U,      // CMNzrr
    3795             :     48U,        // CMNzrsi
    3796             :     56U,        // CMNzrsr
    3797             :     0U, // CMP_SWAP_16
    3798             :     0U, // CMP_SWAP_32
    3799             :     0U, // CMP_SWAP_64
    3800             :     0U, // CMP_SWAP_8
    3801             :     40U,        // CMPri
    3802             :     2048U,      // CMPrr
    3803             :     48U,        // CMPrsi
    3804             :     56U,        // CMPrsr
    3805             :     0U, // CONSTPOOL_ENTRY
    3806             :     0U, // COPY_STRUCT_BYVAL_I32
    3807             :     0U, // CPS1p
    3808             :     0U, // CPS2p
    3809             :     2072U,      // CPS3p
    3810             :     2072U,      // CRC32B
    3811             :     2072U,      // CRC32CB
    3812             :     2072U,      // CRC32CH
    3813             :     2072U,      // CRC32CW
    3814             :     2072U,      // CRC32H
    3815             :     2072U,      // CRC32W
    3816             :     0U, // CompilerBarrier
    3817             :     0U, // DBG
    3818             :     0U, // DMB
    3819             :     0U, // DSB
    3820             :     0U, // EORri
    3821             :     32768U,     // EORrr
    3822             :     65536U,     // EORrsi
    3823             :     0U, // EORrsr
    3824             :     0U, // ERET
    3825             :     0U, // FCONSTD
    3826             :     0U, // FCONSTH
    3827             :     0U, // FCONSTS
    3828             :     65U,        // FLDMXDB_UPD
    3829             :     2120U,      // FLDMXIA
    3830             :     65U,        // FLDMXIA_UPD
    3831             :     0U, // FMSTAT
    3832             :     65U,        // FSTMXDB_UPD
    3833             :     2120U,      // FSTMXIA
    3834             :     65U,        // FSTMXIA_UPD
    3835             :     0U, // HINT
    3836             :     0U, // HLT
    3837             :     0U, // HVC
    3838             :     0U, // ISB
    3839             :     0U, // ITasm
    3840             :     0U, // Int_eh_sjlj_dispatchsetup
    3841             :     0U, // Int_eh_sjlj_longjmp
    3842             :     0U, // Int_eh_sjlj_setjmp
    3843             :     0U, // Int_eh_sjlj_setjmp_nofp
    3844             :     0U, // Int_eh_sjlj_setup_dispatch
    3845             :     0U, // JUMPTABLE_ADDRS
    3846             :     0U, // JUMPTABLE_INSTS
    3847             :     0U, // JUMPTABLE_TBB
    3848             :     0U, // JUMPTABLE_TBH
    3849             :     80U,        // LDA
    3850             :     80U,        // LDAB
    3851             :     80U,        // LDAEX
    3852             :     80U,        // LDAEXB
    3853             :     0U, // LDAEXD
    3854             :     80U,        // LDAEXH
    3855             :     80U,        // LDAH
    3856             :     0U, // LDC2L_OFFSET
    3857             :     1U, // LDC2L_OPTION
    3858             :     1U, // LDC2L_POST
    3859             :     0U, // LDC2L_PRE
    3860             :     0U, // LDC2_OFFSET
    3861             :     1U, // LDC2_OPTION
    3862             :     1U, // LDC2_POST
    3863             :     0U, // LDC2_PRE
    3864             :     89U,        // LDCL_OFFSET
    3865             :     131169U,    // LDCL_OPTION
    3866             :     163937U,    // LDCL_POST
    3867             :     105U,       // LDCL_PRE
    3868             :     89U,        // LDC_OFFSET
    3869             :     131169U,    // LDC_OPTION
    3870             :     163937U,    // LDC_POST
    3871             :     105U,       // LDC_PRE
    3872             :     2120U,      // LDMDA
    3873             :     65U,        // LDMDA_UPD
    3874             :     2120U,      // LDMDB
    3875             :     65U,        // LDMDB_UPD
    3876             :     2120U,      // LDMIA
    3877             :     0U, // LDMIA_RET
    3878             :     65U,        // LDMIA_UPD
    3879             :     2120U,      // LDMIB
    3880             :     65U,        // LDMIB_UPD
    3881             :     80U,        // LDRBT_POST
    3882             :     196704U,    // LDRBT_POST_IMM
    3883             :     196704U,    // LDRBT_POST_REG
    3884             :     196704U,    // LDRB_POST_IMM
    3885             :     196704U,    // LDRB_POST_REG
    3886             :     112U,       // LDRB_PRE_IMM
    3887             :     120U,       // LDRB_PRE_REG
    3888             :     128U,       // LDRBi12
    3889             :     136U,       // LDRBrs
    3890             :     2048U,      // LDRConstPool
    3891             :     229376U,    // LDRD
    3892             :     2359296U,   // LDRD_POST
    3893             :     294912U,    // LDRD_PRE
    3894             :     80U,        // LDREX
    3895             :     80U,        // LDREXB
    3896             :     0U, // LDREXD
    3897             :     80U,        // LDREXH
    3898             :     144U,       // LDRH
    3899             :     327776U,    // LDRHTi
    3900             :     360544U,    // LDRHTr
    3901             :     393312U,    // LDRH_POST
    3902             :     152U,       // LDRH_PRE
    3903             :     0U, // LDRLIT_ga_abs
    3904             :     0U, // LDRLIT_ga_pcrel
    3905             :     0U, // LDRLIT_ga_pcrel_ldr
    3906             :     144U,       // LDRSB
    3907             :     327776U,    // LDRSBTi
    3908             :     360544U,    // LDRSBTr
    3909             :     393312U,    // LDRSB_POST
    3910             :     152U,       // LDRSB_PRE
    3911             :     144U,       // LDRSH
    3912             :     327776U,    // LDRSHTi
    3913             :     360544U,    // LDRSHTr
    3914             :     393312U,    // LDRSH_POST
    3915             :     152U,       // LDRSH_PRE
    3916             :     80U,        // LDRT_POST
    3917             :     196704U,    // LDRT_POST_IMM
    3918             :     196704U,    // LDRT_POST_REG
    3919             :     196704U,    // LDR_POST_IMM
    3920             :     196704U,    // LDR_POST_REG
    3921             :     112U,       // LDR_PRE_IMM
    3922             :     120U,       // LDR_PRE_REG
    3923             :     128U,       // LDRcp
    3924             :     128U,       // LDRi12
    3925             :     136U,       // LDRrs
    3926             :     0U, // LEApcrel
    3927             :     0U, // LEApcrelJT
    3928             :     32768U,     // LSLi
    3929             :     32768U,     // LSLr
    3930             :     32768U,     // LSRi
    3931             :     32768U,     // LSRr
    3932             :     4623392U,   // MCR
    3933             :     160U,       // MCR2
    3934             :     6720544U,   // MCRR
    3935             :     458920U,    // MCRR2
    3936             :     0U, // MEMCPY
    3937             :     35684352U,  // MLA
    3938             :     0U, // MLAv5
    3939             :     35684352U,  // MLS
    3940             :     0U, // MOVCCi
    3941             :     0U, // MOVCCi16
    3942             :     0U, // MOVCCi32imm
    3943             :     0U, // MOVCCr
    3944             :     0U, // MOVCCsi
    3945             :     0U, // MOVCCsr
    3946             :     0U, // MOVPCLR
    3947             :     0U, // MOVPCRX
    3948             :     2072U,      // MOVTi16
    3949             :     0U, // MOVTi16_ga_pcrel
    3950             :     0U, // MOV_ga_pcrel
    3951             :     0U, // MOV_ga_pcrel_ldr
    3952             :     40U,        // MOVi
    3953             :     2048U,      // MOVi16
    3954             :     0U, // MOVi16_ga_pcrel
    3955             :     0U, // MOVi32imm
    3956             :     2048U,      // MOVr
    3957             :     2048U,      // MOVr_TC
    3958             :     48U,        // MOVsi
    3959             :     56U,        // MOVsr
    3960             :     0U, // MOVsra_flag
    3961             :     0U, // MOVsrl_flag
    3962             :     0U, // MRC
    3963             :     0U, // MRC2
    3964             :     0U, // MRRC
    3965             :     0U, // MRRC2
    3966             :     2U, // MRS
    3967             :     176U,       // MRSbanked
    3968             :     2U, // MRSsys
    3969             :     64U,        // MSR
    3970             :     0U, // MSRbanked
    3971             :     2U, // MSRi
    3972             :     32768U,     // MUL
    3973             :     0U, // MULv5
    3974             :     0U, // MVNCCi
    3975             :     40U,        // MVNi
    3976             :     2048U,      // MVNr
    3977             :     48U,        // MVNsi
    3978             :     56U,        // MVNsr
    3979             :     0U, // ORRri
    3980             :     32768U,     // ORRrr
    3981             :     65536U,     // ORRrsi
    3982             :     0U, // ORRrsr
    3983             :     0U, // PICADD
    3984             :     0U, // PICLDR
    3985             :     0U, // PICLDRB
    3986             :     0U, // PICLDRH
    3987             :     0U, // PICLDRSB
    3988             :     0U, // PICLDRSH
    3989             :     0U, // PICSTR
    3990             :     0U, // PICSTRB
    3991             :     0U, // PICSTRH
    3992             :     8421376U,   // PKHBT
    3993             :     10518528U,  // PKHTB
    3994             :     0U, // PLDWi12
    3995             :     0U, // PLDWrs
    3996             :     0U, // PLDi12
    3997             :     0U, // PLDrs
    3998             :     0U, // PLIi12
    3999             :     0U, // PLIrs
    4000             :     32768U,     // QADD
    4001             :     32768U,     // QADD16
    4002             :     32768U,     // QADD8
    4003             :     32768U,     // QASX
    4004             :     32768U,     // QDADD
    4005             :     32768U,     // QDSUB
    4006             :     32768U,     // QSAX
    4007             :     32768U,     // QSUB
    4008             :     32768U,     // QSUB16
    4009             :     32768U,     // QSUB8
    4010             :     2048U,      // RBIT
    4011             :     2048U,      // REV
    4012             :     2048U,      // REV16
    4013             :     2048U,      // REVSH
    4014             :     0U, // RFEDA
    4015             :     0U, // RFEDA_UPD
    4016             :     0U, // RFEDB
    4017             :     0U, // RFEDB_UPD
    4018             :     0U, // RFEIA
    4019             :     0U, // RFEIA_UPD
    4020             :     0U, // RFEIB
    4021             :     0U, // RFEIB_UPD
    4022             :     32768U,     // RORi
    4023             :     32768U,     // RORr
    4024             :     0U, // RRX
    4025             :     2048U,      // RRXi
    4026             :     0U, // RSBSri
    4027             :     0U, // RSBSrsi
    4028             :     0U, // RSBSrsr
    4029             :     0U, // RSBri
    4030             :     32768U,     // RSBrr
    4031             :     65536U,     // RSBrsi
    4032             :     0U, // RSBrsr
    4033             :     0U, // RSCri
    4034             :     32768U,     // RSCrr
    4035             :     65536U,     // RSCrsi
    4036             :     0U, // RSCrsr
    4037             :     32768U,     // SADD16
    4038             :     32768U,     // SADD8
    4039             :     32768U,     // SASX
    4040             :     0U, // SBCri
    4041             :     32768U,     // SBCrr
    4042             :     65536U,     // SBCrsi
    4043             :     0U, // SBCrsr
    4044             :     69238784U,  // SBFX
    4045             :     32768U,     // SDIV
    4046             :     32768U,     // SEL
    4047             :     0U, // SETEND
    4048             :     0U, // SETPAN
    4049             :     2216U,      // SHA1C
    4050             :     0U, // SHA1H
    4051             :     2216U,      // SHA1M
    4052             :     2216U,      // SHA1P
    4053             :     2216U,      // SHA1SU0
    4054             :     0U, // SHA1SU1
    4055             :     2216U,      // SHA256H
    4056             :     2216U,      // SHA256H2
    4057             :     0U, // SHA256SU0
    4058             :     2216U,      // SHA256SU1
    4059             :     32768U,     // SHADD16
    4060             :     32768U,     // SHADD8
    4061             :     32768U,     // SHASX
    4062             :     32768U,     // SHSAX
    4063             :     32768U,     // SHSUB16
    4064             :     32768U,     // SHSUB8
    4065             :     0U, // SMC
    4066             :     35684352U,  // SMLABB
    4067             :     35684352U,  // SMLABT
    4068             :     35684352U,  // SMLAD
    4069             :     35684352U,  // SMLADX
    4070             :     0U, // SMLAL
    4071             :     35684352U,  // SMLALBB
    4072             :     35684352U,  // SMLALBT
    4073             :     35684352U,  // SMLALD
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    4075             :     35684352U,  // SMLALTB
    4076             :     35684352U,  // SMLALTT
    4077             :     0U, // SMLALv5
    4078             :     35684352U,  // SMLATB
    4079             :     35684352U,  // SMLATT
    4080             :     35684352U,  // SMLAWB
    4081             :     35684352U,  // SMLAWT
    4082             :     35684352U,  // SMLSD
    4083             :     35684352U,  // SMLSDX
    4084             :     35684352U,  // SMLSLD
    4085             :     35684352U,  // SMLSLDX
    4086             :     35684352U,  // SMMLA
    4087             :     35684352U,  // SMMLAR
    4088             :     35684352U,  // SMMLS
    4089             :     35684352U,  // SMMLSR
    4090             :     32768U,     // SMMUL
    4091             :     32768U,     // SMMULR
    4092             :     32768U,     // SMUAD
    4093             :     32768U,     // SMUADX
    4094             :     32768U,     // SMULBB
    4095             :     32768U,     // SMULBT
    4096             :     35684352U,  // SMULL
    4097             :     0U, // SMULLv5
    4098             :     32768U,     // SMULTB
    4099             :     32768U,     // SMULTT
    4100             :     32768U,     // SMULWB
    4101             :     32768U,     // SMULWT
    4102             :     32768U,     // SMUSD
    4103             :     32768U,     // SMUSDX
    4104             :     0U, // SPACE
    4105             :     0U, // SRSDA
    4106             :     0U, // SRSDA_UPD
    4107             :     0U, // SRSDB
    4108             :     0U, // SRSDB_UPD
    4109             :     0U, // SRSIA
    4110             :     0U, // SRSIA_UPD
    4111             :     0U, // SRSIB
    4112             :     0U, // SRSIB_UPD
    4113             :     4280U,      // SSAT
    4114             :     2232U,      // SSAT16
    4115             :     32768U,     // SSAX
    4116             :     32768U,     // SSUB16
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    4118             :     0U, // STC2L_OFFSET
    4119             :     1U, // STC2L_OPTION
    4120             :     1U, // STC2L_POST
    4121             :     0U, // STC2L_PRE
    4122             :     0U, // STC2_OFFSET
    4123             :     1U, // STC2_OPTION
    4124             :     1U, // STC2_POST
    4125             :     0U, // STC2_PRE
    4126             :     89U,        // STCL_OFFSET
    4127             :     131169U,    // STCL_OPTION
    4128             :     163937U,    // STCL_POST
    4129             :     105U,       // STCL_PRE
    4130             :     89U,        // STC_OFFSET
    4131             :     131169U,    // STC_OPTION
    4132             :     163937U,    // STC_POST
    4133             :     105U,       // STC_PRE
    4134             :     80U,        // STL
    4135             :     80U,        // STLB
    4136             :     491520U,    // STLEX
    4137             :     491520U,    // STLEXB
    4138             :     192U,       // STLEXD
    4139             :     491520U,    // STLEXH
    4140             :     80U,        // STLH
    4141             :     2120U,      // STMDA
    4142             :     65U,        // STMDA_UPD
    4143             :     2120U,      // STMDB
    4144             :     65U,        // STMDB_UPD
    4145             :     2120U,      // STMIA
    4146             :     65U,        // STMIA_UPD
    4147             :     2120U,      // STMIB
    4148             :     65U,        // STMIB_UPD
    4149             :     80U,        // STRBT_POST
    4150             :     196704U,    // STRBT_POST_IMM
    4151             :     196704U,    // STRBT_POST_REG
    4152             :     196704U,    // STRB_POST_IMM
    4153             :     196704U,    // STRB_POST_REG
    4154             :     112U,       // STRB_PRE_IMM
    4155             :     120U,       // STRB_PRE_REG
    4156             :     128U,       // STRBi12
    4157             :     0U, // STRBi_preidx
    4158             :     0U, // STRBr_preidx
    4159             :     136U,       // STRBrs
    4160             :     229376U,    // STRD
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    4183             :     136U,       // STRrs
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    4207             :     40U,        // TEQri
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    4211             :     0U, // TPsoft
    4212             :     0U, // TRAP
    4213             :     0U, // TRAPNaCl
    4214             :     40U,        // TSTri
    4215             :     2048U,      // TSTrr
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    4217             :     56U,        // TSTrsr
    4218             :     32768U,     // UADD16
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    4221             :     69238784U,  // UBFX
    4222             :     0U, // UDF
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    4235             :     32768U,     // UQADD16
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    4240             :     32768U,     // UQSUB8
    4241             :     32768U,     // USAD8
    4242             :     35684352U,  // USADA8
    4243             :     14712832U,  // USAT
    4244             :     32768U,     // USAT16
    4245             :     32768U,     // USAX
    4246             :     32768U,     // USUB16
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    4248             :     12615680U,  // UXTAB
    4249             :     12615680U,  // UXTAB16
    4250             :     12615680U,  // UXTAH
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    4252             :     5120U,      // UXTB16
    4253             :     5120U,      // UXTH
    4254             :     2216U,      // VABALsv2i64
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    4257             :     2216U,      // VABALuv2i64
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    4259             :     2216U,      // VABALuv8i16
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    4266             :     2216U,      // VABAuv16i8
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    4275             :     2072U,      // VABDLuv2i64
    4276             :     2072U,      // VABDLuv4i32
    4277             :     2072U,      // VABDLuv8i16
    4278             :     527392U,    // VABDfd
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    4280             :     527392U,    // VABDhd
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    4327             :     2072U,      // VADDWsv2i64
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    4340             :     2072U,      // VADDv2i64
    4341             :     2072U,      // VADDv4i16
    4342             :     2072U,      // VADDv4i32
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    4344             :     2072U,      // VADDv8i8
    4345             :     32768U,     // VANDd
    4346             :     32768U,     // VANDq
    4347             :     32768U,     // VBICd
    4348             :     0U, // VBICiv2i32
    4349             :     0U, // VBICiv4i16
    4350             :     0U, // VBICiv4i32
    4351             :     0U, // VBICiv8i16
    4352             :     32768U,     // VBICq
    4353             :     557080U,    // VBIFd
    4354             :     557080U,    // VBIFq
    4355             :     557080U,    // VBITd
    4356             :     557080U,    // VBITq
    4357             :     557080U,    // VBSLd
    4358             :     557080U,    // VBSLq
    4359             :     527392U,    // VCEQfd
    4360             :     527392U,    // VCEQfq
    4361             :     527392U,    // VCEQhd
    4362             :     527392U,    // VCEQhq
    4363             :     2072U,      // VCEQv16i8
    4364             :     2072U,      // VCEQv2i32
    4365             :     2072U,      // VCEQv4i16
    4366             :     2072U,      // VCEQv4i32
    4367             :     2072U,      // VCEQv8i16
    4368             :     2072U,      // VCEQv8i8
    4369             :     2U, // VCEQzv16i8
    4370             :     200U,       // VCEQzv2f32
    4371             :     2U, // VCEQzv2i32
    4372             :     200U,       // VCEQzv4f16
    4373             :     200U,       // VCEQzv4f32
    4374             :     2U, // VCEQzv4i16
    4375             :     2U, // VCEQzv4i32
    4376             :     200U,       // VCEQzv8f16
    4377             :     2U, // VCEQzv8i16
    4378             :     2U, // VCEQzv8i8
    4379             :     527392U,    // VCGEfd
    4380             :     527392U,    // VCGEfq
    4381             :     527392U,    // VCGEhd
    4382             :     527392U,    // VCGEhq
    4383             :     2072U,      // VCGEsv16i8
    4384             :     2072U,      // VCGEsv2i32
    4385             :     2072U,      // VCGEsv4i16
    4386             :     2072U,      // VCGEsv4i32
    4387             :     2072U,      // VCGEsv8i16
    4388             :     2072U,      // VCGEsv8i8
    4389             :     2072U,      // VCGEuv16i8
    4390             :     2072U,      // VCGEuv2i32
    4391             :     2072U,      // VCGEuv4i16
    4392             :     2072U,      // VCGEuv4i32
    4393             :     2072U,      // VCGEuv8i16
    4394             :     2072U,      // VCGEuv8i8
    4395             :     2U, // VCGEzv16i8
    4396             :     200U,       // VCGEzv2f32
    4397             :     2U, // VCGEzv2i32
    4398             :     200U,       // VCGEzv4f16
    4399             :     200U,       // VCGEzv4f32
    4400             :     2U, // VCGEzv4i16
    4401             :     2U, // VCGEzv4i32
    4402             :     200U,       // VCGEzv8f16
    4403             :     2U, // VCGEzv8i16
    4404             :     2U, // VCGEzv8i8
    4405             :     527392U,    // VCGTfd
    4406             :     527392U,    // VCGTfq
    4407             :     527392U,    // VCGThd
    4408             :     527392U,    // VCGThq
    4409             :     2072U,      // VCGTsv16i8
    4410             :     2072U,      // VCGTsv2i32
    4411             :     2072U,      // VCGTsv4i16
    4412             :     2072U,      // VCGTsv4i32
    4413             :     2072U,      // VCGTsv8i16
    4414             :     2072U,      // VCGTsv8i8
    4415             :     2072U,      // VCGTuv16i8
    4416             :     2072U,      // VCGTuv2i32
    4417             :     2072U,      // VCGTuv4i16
    4418             :     2072U,      // VCGTuv4i32
    4419             :     2072U,      // VCGTuv8i16
    4420             :     2072U,      // VCGTuv8i8
    4421             :     2U, // VCGTzv16i8
    4422             :     200U,       // VCGTzv2f32
    4423             :     2U, // VCGTzv2i32
    4424             :     200U,       // VCGTzv4f16
    4425             :     200U,       // VCGTzv4f32
    4426             :     2U, // VCGTzv4i16
    4427             :     2U, // VCGTzv4i32
    4428             :     200U,       // VCGTzv8f16
    4429             :     2U, // VCGTzv8i16
    4430             :     2U, // VCGTzv8i8
    4431             :     2U, // VCLEzv16i8
    4432             :     200U,       // VCLEzv2f32
    4433             :     2U, // VCLEzv2i32
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    4440             :     2U, // VCLEzv8i8
    4441             :     0U, // VCLSv16i8
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    4446             :     0U, // VCLSv8i8
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    4453             :     2U, // VCLTzv4i32
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    4455             :     2U, // VCLTzv8i16
    4456             :     2U, // VCLTzv8i8
    4457             :     0U, // VCLZv16i8
    4458             :     0U, // VCLZv2i32
    4459             :     0U, // VCLZv4i16
    4460             :     0U, // VCLZv4i32
    4461             :     0U, // VCLZv8i16
    4462             :     0U, // VCLZv8i8
    4463             :     64U,        // VCMPD
    4464             :     64U,        // VCMPED
    4465             :     64U,        // VCMPEH
    4466             :     64U,        // VCMPES
    4467             :     0U, // VCMPEZD
    4468             :     0U, // VCMPEZH
    4469             :     0U, // VCMPEZS
    4470             :     64U,        // VCMPH
    4471             :     64U,        // VCMPS
    4472             :     0U, // VCMPZD
    4473             :     0U, // VCMPZH
    4474             :     0U, // VCMPZS
    4475             :     2048U,      // VCNTd
    4476             :     2048U,      // VCNTq
    4477             :     0U, // VCVTANSDf
    4478             :     0U, // VCVTANSDh
    4479             :     0U, // VCVTANSQf
    4480             :     0U, // VCVTANSQh
    4481             :     0U, // VCVTANUDf
    4482             :     0U, // VCVTANUDh
    4483             :     0U, // VCVTANUQf
    4484             :     0U, // VCVTANUQh
    4485             :     0U, // VCVTASD
    4486             :     0U, // VCVTASH
    4487             :     0U, // VCVTASS
    4488             :     0U, // VCVTAUD
    4489             :     0U, // VCVTAUH
    4490             :     0U, // VCVTAUS
    4491             :     0U, // VCVTBDH
    4492             :     0U, // VCVTBHD
    4493             :     0U, // VCVTBHS
    4494             :     0U, // VCVTBSH
    4495             :     0U, // VCVTDS
    4496             :     0U, // VCVTMNSDf
    4497             :     0U, // VCVTMNSDh
    4498             :     0U, // VCVTMNSQf
    4499             :     0U, // VCVTMNSQh
    4500             :     0U, // VCVTMNUDf
    4501             :     0U, // VCVTMNUDh
    4502             :     0U, // VCVTMNUQf
    4503             :     0U, // VCVTMNUQh
    4504             :     0U, // VCVTMSD
    4505             :     0U, // VCVTMSH
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    4507             :     0U, // VCVTMUD
    4508             :     0U, // VCVTMUH
    4509             :     0U, // VCVTMUS
    4510             :     0U, // VCVTNNSDf
    4511             :     0U, // VCVTNNSDh
    4512             :     0U, // VCVTNNSQf
    4513             :     0U, // VCVTNNSQh
    4514             :     0U, // VCVTNNUDf
    4515             :     0U, // VCVTNNUDh
    4516             :     0U, // VCVTNNUQf
    4517             :     0U, // VCVTNNUQh
    4518             :     0U, // VCVTNSD
    4519             :     0U, // VCVTNSH
    4520             :     0U, // VCVTNSS
    4521             :     0U, // VCVTNUD
    4522             :     0U, // VCVTNUH
    4523             :     0U, // VCVTNUS
    4524             :     0U, // VCVTPNSDf
    4525             :     0U, // VCVTPNSDh
    4526             :     0U, // VCVTPNSQf
    4527             :     0U, // VCVTPNSQh
    4528             :     0U, // VCVTPNUDf
    4529             :     0U, // VCVTPNUDh
    4530             :     0U, // VCVTPNUQf
    4531             :     0U, // VCVTPNUQh
    4532             :     0U, // VCVTPSD
    4533             :     0U, // VCVTPSH
    4534             :     0U, // VCVTPSS
    4535             :     0U, // VCVTPUD
    4536             :     0U, // VCVTPUH
    4537             :     0U, // VCVTPUS
    4538             :     0U, // VCVTSD
    4539             :     0U, // VCVTTDH
    4540             :     0U, // VCVTTHD
    4541             :     0U, // VCVTTHS
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    4724             :     67U,        // VLD1d8
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    4783             :     655592U,    // VLD2LNdWB_register_Asm_8
    4784             :     699620U,    // VLD2LNq16
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    4833             :     8227U,      // VLD2q8wb_register
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    4845             :     768252U,    // VLD3DUPd8_UPD
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    4867             :     2216U,      // VLD3DUPqWB_register_Asm_16
    4868             :     2216U,      // VLD3DUPqWB_register_Asm_32
    4869             :     2216U,      // VLD3DUPqWB_register_Asm_8
    4870             :     798964U,    // VLD3LNd16
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    4876             :     0U, // VLD3LNd32Pseudo_UPD
    4877             :     828676U,    // VLD3LNd32_UPD
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    4887             :     10472U,     // VLD3LNdWB_fixed_Asm_8
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    4890             :     655592U,    // VLD3LNdWB_register_Asm_8
    4891             :     798964U,    // VLD3LNq16
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    4893             :     0U, // VLD3LNq16Pseudo_UPD
    4894             :     828676U,    // VLD3LNq16_UPD
    4895             :     798964U,    // VLD3LNq32
    4896             :     0U, // VLD3LNq32Pseudo
    4897             :     0U, // VLD3LNq32Pseudo_UPD
    4898             :     828676U,    // VLD3LNq32_UPD
    4899             :     2280U,      // VLD3LNqAsm_16
    4900             :     2280U,      // VLD3LNqAsm_32
    4901             :     10472U,     // VLD3LNqWB_fixed_Asm_16
    4902             :     10472U,     // VLD3LNqWB_fixed_Asm_32
    4903             :     655592U,    // VLD3LNqWB_register_Asm_16
    4904             :     655592U,    // VLD3LNqWB_register_Asm_32
    4905             :     117473280U, // VLD3d16
    4906             :     0U, // VLD3d16Pseudo
    4907             :     0U, // VLD3d16Pseudo_UPD
    4908             :     151027712U, // VLD3d16_UPD
    4909             :     117473280U, // VLD3d32
    4910             :     0U, // VLD3d32Pseudo
    4911             :     0U, // VLD3d32Pseudo_UPD
    4912             :     151027712U, // VLD3d32_UPD
    4913             :     117473280U, // VLD3d8
    4914             :     0U, // VLD3d8Pseudo
    4915             :     0U, // VLD3d8Pseudo_UPD
    4916             :     151027712U, // VLD3d8_UPD
    4917             :     67U,        // VLD3dAsm_16
    4918             :     67U,        // VLD3dAsm_32
    4919             :     67U,        // VLD3dAsm_8
    4920             :     211U,       // VLD3dWB_fixed_Asm_16
    4921             :     211U,       // VLD3dWB_fixed_Asm_32
    4922             :     211U,       // VLD3dWB_fixed_Asm_8
    4923             :     531491U,    // VLD3dWB_register_Asm_16
    4924             :     531491U,    // VLD3dWB_register_Asm_32
    4925             :     531491U,    // VLD3dWB_register_Asm_8
    4926             :     117473280U, // VLD3q16
    4927             :     0U, // VLD3q16Pseudo_UPD
    4928             :     151027712U, // VLD3q16_UPD
    4929             :     0U, // VLD3q16oddPseudo
    4930             :     0U, // VLD3q16oddPseudo_UPD
    4931             :     117473280U, // VLD3q32
    4932             :     0U, // VLD3q32Pseudo_UPD
    4933             :     151027712U, // VLD3q32_UPD
    4934             :     0U, // VLD3q32oddPseudo
    4935             :     0U, // VLD3q32oddPseudo_UPD
    4936             :     117473280U, // VLD3q8
    4937             :     0U, // VLD3q8Pseudo_UPD
    4938             :     151027712U, // VLD3q8_UPD
    4939             :     0U, // VLD3q8oddPseudo
    4940             :     0U, // VLD3q8oddPseudo_UPD
    4941             :     0U, // VLD3qAsm_16
    4942             :     0U, // VLD3qAsm_32
    4943             :     0U, // VLD3qAsm_8
    4944             :     4U, // VLD3qWB_fixed_Asm_16
    4945             :     4U, // VLD3qWB_fixed_Asm_32
    4946             :     4U, // VLD3qWB_fixed_Asm_8
    4947             :     2216U,      // VLD3qWB_register_Asm_16
    4948             :     2216U,      // VLD3qWB_register_Asm_32
    4949             :     2216U,      // VLD3qWB_register_Asm_8
    4950             :     538892U,    // VLD4DUPd16
    4951             :     0U, // VLD4DUPd16Pseudo
    4952             :     0U, // VLD4DUPd16Pseudo_UPD
    4953             :     15628U,     // VLD4DUPd16_UPD
    4954             :     538892U,    // VLD4DUPd32
    4955             :     0U, // VLD4DUPd32Pseudo
    4956             :     0U, // VLD4DUPd32Pseudo_UPD
    4957             :     15628U,     // VLD4DUPd32_UPD
    4958             :     538892U,    // VLD4DUPd8
    4959             :     0U, // VLD4DUPd8Pseudo
    4960             :     0U, // VLD4DUPd8Pseudo_UPD
    4961             :     15628U,     // VLD4DUPd8_UPD
    4962             :     0U, // VLD4DUPdAsm_16
    4963             :     0U, // VLD4DUPdAsm_32
    4964             :     0U, // VLD4DUPdAsm_8
    4965             :     4U, // VLD4DUPdWB_fixed_Asm_16
    4966             :     4U, // VLD4DUPdWB_fixed_Asm_32
    4967             :     4U, // VLD4DUPdWB_fixed_Asm_8
    4968             :     2216U,      // VLD4DUPdWB_register_Asm_16
    4969             :     2216U,      // VLD4DUPdWB_register_Asm_32
    4970             :     2216U,      // VLD4DUPdWB_register_Asm_8
    4971             :     538892U,    // VLD4DUPq16
    4972             :     15628U,     // VLD4DUPq16_UPD
    4973             :     538892U,    // VLD4DUPq32
    4974             :     15628U,     // VLD4DUPq32_UPD
    4975             :     538892U,    // VLD4DUPq8
    4976             :     15628U,     // VLD4DUPq8_UPD
    4977             :     0U, // VLD4DUPqAsm_16
    4978             :     0U, // VLD4DUPqAsm_32
    4979             :     0U, // VLD4DUPqAsm_8
    4980             :     4U, // VLD4DUPqWB_fixed_Asm_16
    4981             :     4U, // VLD4DUPqWB_fixed_Asm_32
    4982             :     4U, // VLD4DUPqWB_fixed_Asm_8
    4983             :     2216U,      // VLD4DUPqWB_register_Asm_16
    4984             :     2216U,      // VLD4DUPqWB_register_Asm_32
    4985             :     2216U,      // VLD4DUPqWB_register_Asm_8
    4986             :     187215108U, // VLD4LNd16
    4987             :     0U, // VLD4LNd16Pseudo
    4988             :     0U, // VLD4LNd16Pseudo_UPD
    4989             :     276U,       // VLD4LNd16_UPD
    4990             :     187215108U, // VLD4LNd32
    4991             :     0U, // VLD4LNd32Pseudo
    4992             :     0U, // VLD4LNd32Pseudo_UPD
    4993             :     276U,       // VLD4LNd32_UPD
    4994             :     187215108U, // VLD4LNd8
    4995             :     0U, // VLD4LNd8Pseudo
    4996             :     0U, // VLD4LNd8Pseudo_UPD
    4997             :     276U,       // VLD4LNd8_UPD
    4998             :     2280U,      // VLD4LNdAsm_16
    4999             :     2280U,      // VLD4LNdAsm_32
    5000             :     2280U,      // VLD4LNdAsm_8
    5001             :     10472U,     // VLD4LNdWB_fixed_Asm_16
    5002             :     10472U,     // VLD4LNdWB_fixed_Asm_32
    5003             :     10472U,     // VLD4LNdWB_fixed_Asm_8
    5004             :     655592U,    // VLD4LNdWB_register_Asm_16
    5005             :     655592U,    // VLD4LNdWB_register_Asm_32
    5006             :     655592U,    // VLD4LNdWB_register_Asm_8
    5007             :     187215108U, // VLD4LNq16
    5008             :     0U, // VLD4LNq16Pseudo
    5009             :     0U, // VLD4LNq16Pseudo_UPD
    5010             :     276U,       // VLD4LNq16_UPD
    5011             :     187215108U, // VLD4LNq32
    5012             :     0U, // VLD4LNq32Pseudo
    5013             :     0U, // VLD4LNq32Pseudo_UPD
    5014             :     276U,       // VLD4LNq32_UPD
    5015             :     2280U,      // VLD4LNqAsm_16
    5016             :     2280U,      // VLD4LNqAsm_32
    5017             :     10472U,     // VLD4LNqWB_fixed_Asm_16
    5018             :     10472U,     // VLD4LNqWB_fixed_Asm_32
    5019             :     655592U,    // VLD4LNqWB_register_Asm_16
    5020             :     655592U,    // VLD4LNqWB_register_Asm_32
    5021             :     572555264U, // VLD4d16
    5022             :     0U, // VLD4d16Pseudo
    5023             :     0U, // VLD4d16Pseudo_UPD
    5024             :     1646297088U,        // VLD4d16_UPD
    5025             :     572555264U, // VLD4d32
    5026             :     0U, // VLD4d32Pseudo
    5027             :     0U, // VLD4d32Pseudo_UPD
    5028             :     1646297088U,        // VLD4d32_UPD
    5029             :     572555264U, // VLD4d8
    5030             :     0U, // VLD4d8Pseudo
    5031             :     0U, // VLD4d8Pseudo_UPD
    5032             :     1646297088U,        // VLD4d8_UPD
    5033             :     67U,        // VLD4dAsm_16
    5034             :     67U,        // VLD4dAsm_32
    5035             :     67U,        // VLD4dAsm_8
    5036             :     211U,       // VLD4dWB_fixed_Asm_16
    5037             :     211U,       // VLD4dWB_fixed_Asm_32
    5038             :     211U,       // VLD4dWB_fixed_Asm_8
    5039             :     531491U,    // VLD4dWB_register_Asm_16
    5040             :     531491U,    // VLD4dWB_register_Asm_32
    5041             :     531491U,    // VLD4dWB_register_Asm_8
    5042             :     572555264U, // VLD4q16
    5043             :     0U, // VLD4q16Pseudo_UPD
    5044             :     1646297088U,        // VLD4q16_UPD
    5045             :     0U, // VLD4q16oddPseudo
    5046             :     0U, // VLD4q16oddPseudo_UPD
    5047             :     572555264U, // VLD4q32
    5048             :     0U, // VLD4q32Pseudo_UPD
    5049             :     1646297088U,        // VLD4q32_UPD
    5050             :     0U, // VLD4q32oddPseudo
    5051             :     0U, // VLD4q32oddPseudo_UPD
    5052             :     572555264U, // VLD4q8
    5053             :     0U, // VLD4q8Pseudo_UPD
    5054             :     1646297088U,        // VLD4q8_UPD
    5055             :     0U, // VLD4q8oddPseudo
    5056             :     0U, // VLD4q8oddPseudo_UPD
    5057             :     0U, // VLD4qAsm_16
    5058             :     0U, // VLD4qAsm_32
    5059             :     0U, // VLD4qAsm_8
    5060             :     4U, // VLD4qWB_fixed_Asm_16
    5061             :     4U, // VLD4qWB_fixed_Asm_32
    5062             :     4U, // VLD4qWB_fixed_Asm_8
    5063             :     2216U,      // VLD4qWB_register_Asm_16
    5064             :     2216U,      // VLD4qWB_register_Asm_32
    5065             :     2216U,      // VLD4qWB_register_Asm_8
    5066             :     65U,        // VLDMDDB_UPD
    5067             :     2120U,      // VLDMDIA
    5068             :     65U,        // VLDMDIA_UPD
    5069             :     0U, // VLDMQIA
    5070             :     65U,        // VLDMSDB_UPD
    5071             :     2120U,      // VLDMSIA
    5072             :     65U,        // VLDMSIA_UPD
    5073             :     280U,       // VLDRD
    5074             :     288U,       // VLDRH
    5075             :     280U,       // VLDRS
    5076             :     0U, // VLLDM
    5077             :     0U, // VLSTM
    5078             :     2072U,      // VMAXNMD
    5079             :     2072U,      // VMAXNMH
    5080             :     2072U,      // VMAXNMNDf
    5081             :     2072U,      // VMAXNMNDh
    5082             :     2072U,      // VMAXNMNQf
    5083             :     2072U,      // VMAXNMNQh
    5084             :     2072U,      // VMAXNMS
    5085             :     527392U,    // VMAXfd
    5086             :     527392U,    // VMAXfq
    5087             :     527392U,    // VMAXhd
    5088             :     527392U,    // VMAXhq
    5089             :     2072U,      // VMAXsv16i8
    5090             :     2072U,      // VMAXsv2i32
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    5092             :     2072U,      // VMAXsv4i32
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    5100             :     2072U,      // VMAXuv8i8
    5101             :     2072U,      // VMINNMD
    5102             :     2072U,      // VMINNMH
    5103             :     2072U,      // VMINNMNDf
    5104             :     2072U,      // VMINNMNDh
    5105             :     2072U,      // VMINNMNQf
    5106             :     2072U,      // VMINNMNQh
    5107             :     2072U,      // VMINNMS
    5108             :     527392U,    // VMINfd
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    5117             :     2072U,      // VMINsv8i8
    5118             :     2072U,      // VMINuv16i8
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    5123             :     2072U,      // VMINuv8i8
    5124             :     531491U,    // VMLAD
    5125             :     531491U,    // VMLAH
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    5128             :     16552U,     // VMLALsluv2i32
    5129             :     16552U,     // VMLALsluv4i16
    5130             :     2216U,      // VMLALsv2i64
    5131             :     2216U,      // VMLALsv4i32
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    5134             :     2216U,      // VMLALuv4i32
    5135             :     2216U,      // VMLALuv8i16
    5136             :     531491U,    // VMLAS
    5137             :     531491U,    // VMLAfd
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    5140             :     531491U,    // VMLAhq
    5141             :     859171U,    // VMLAslfd
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    5149             :     2216U,      // VMLAv16i8
    5150             :     2216U,      // VMLAv2i32
    5151             :     2216U,      // VMLAv4i16
    5152             :     2216U,      // VMLAv4i32
    5153             :     2216U,      // VMLAv8i16
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    5155             :     531491U,    // VMLSD
    5156             :     531491U,    // VMLSH
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    5175             :     859171U,    // VMLSslhq
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    5180             :     2216U,      // VMLSv16i8
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    5185             :     2216U,      // VMLSv8i8
    5186             :     64U,        // VMOVD
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    5188             :     32768U,     // VMOVDRR
    5189             :     0U, // VMOVDcc
    5190             :     0U, // VMOVH
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    5213             :     0U, // VMOVv2i32
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    5218             :     0U, // VMOVv8i16
    5219             :     0U, // VMOVv8i8
    5220             :     4U, // VMRS
    5221             :     5U, // VMRS_FPEXC
    5222             :     5U, // VMRS_FPINST
    5223             :     5U, // VMRS_FPINST2
    5224             :     5U, // VMRS_FPSID
    5225             :     6U, // VMRS_MVFR0
    5226             :     6U, // VMRS_MVFR1
    5227             :     6U, // VMRS_MVFR2
    5228             :     0U, // VMSR
    5229             :     0U, // VMSR_FPEXC
    5230             :     0U, // VMSR_FPINST
    5231             :     0U, // VMSR_FPINST2
    5232             :     0U, // VMSR_FPSID
    5233             :     527392U,    // VMULD
    5234             :     527392U,    // VMULH
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    5241             :     2072U,      // VMULLsv2i64
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    5790             :     10472U,     // VST1LNdWB_fixed_Asm_16
    5791             :     10472U,     // VST1LNdWB_fixed_Asm_32
    5792             :     10472U,     // VST1LNdWB_fixed_Asm_8
    5793             :     655592U,    // VST1LNdWB_register_Asm_16
    5794             :     655592U,    // VST1LNdWB_register_Asm_32
    5795             :     655592U,    // VST1LNdWB_register_Asm_8
    5796             :     0U, // VST1LNq16Pseudo
    5797             :     0U, // VST1LNq16Pseudo_UPD
    5798             :     0U, // VST1LNq32Pseudo
    5799             :     0U, // VST1LNq32Pseudo_UPD
    5800             :     0U, // VST1LNq8Pseudo
    5801             :     0U, // VST1LNq8Pseudo_UPD
    5802             :     0U, // VST1d16
    5803             :     0U, // VST1d16Q
    5804             :     0U, // VST1d16Qwb_fixed
    5805             :     0U, // VST1d16Qwb_register
    5806             :     0U, // VST1d16T
    5807             :     0U, // VST1d16Twb_fixed
    5808             :     0U, // VST1d16Twb_register
    5809             :     0U, // VST1d16wb_fixed
    5810             :     0U, // VST1d16wb_register
    5811             :     0U, // VST1d32
    5812             :     0U, // VST1d32Q
    5813             :     0U, // VST1d32Qwb_fixed
    5814             :     0U, // VST1d32Qwb_register
    5815             :     0U, // VST1d32T
    5816             :     0U, // VST1d32Twb_fixed
    5817             :     0U, // VST1d32Twb_register
    5818             :     0U, // VST1d32wb_fixed
    5819             :     0U, // VST1d32wb_register
    5820             :     0U, // VST1d64
    5821             :     0U, // VST1d64Q
    5822             :     0U, // VST1d64QPseudo
    5823             :     0U, // VST1d64QPseudoWB_fixed
    5824             :     0U, // VST1d64QPseudoWB_register
    5825             :     0U, // VST1d64Qwb_fixed
    5826             :     0U, // VST1d64Qwb_register
    5827             :     0U, // VST1d64T
    5828             :     0U, // VST1d64TPseudo
    5829             :     0U, // VST1d64TPseudoWB_fixed
    5830             :     0U, // VST1d64TPseudoWB_register
    5831             :     0U, // VST1d64Twb_fixed
    5832             :     0U, // VST1d64Twb_register
    5833             :     0U, // VST1d64wb_fixed
    5834             :     0U, // VST1d64wb_register
    5835             :     0U, // VST1d8
    5836             :     0U, // VST1d8Q
    5837             :     0U, // VST1d8Qwb_fixed
    5838             :     0U, // VST1d8Qwb_register
    5839             :     0U, // VST1d8T
    5840             :     0U, // VST1d8Twb_fixed
    5841             :     0U, // VST1d8Twb_register
    5842             :     0U, // VST1d8wb_fixed
    5843             :     0U, // VST1d8wb_register
    5844             :     0U, // VST1q16
    5845             :     0U, // VST1q16wb_fixed
    5846             :     0U, // VST1q16wb_register
    5847             :     0U, // VST1q32
    5848             :     0U, // VST1q32wb_fixed
    5849             :     0U, // VST1q32wb_register
    5850             :     0U, // VST1q64
    5851             :     0U, // VST1q64wb_fixed
    5852             :     0U, // VST1q64wb_register
    5853             :     0U, // VST1q8
    5854             :     0U, // VST1q8wb_fixed
    5855             :     0U, // VST1q8wb_register
    5856             :     220769500U, // VST2LNd16
    5857             :     0U, // VST2LNd16Pseudo
    5858             :     0U, // VST2LNd16Pseudo_UPD
    5859             :     928996U,    // VST2LNd16_UPD
    5860             :     220769500U, // VST2LNd32
    5861             :     0U, // VST2LNd32Pseudo
    5862             :     0U, // VST2LNd32Pseudo_UPD
    5863             :     928996U,    // VST2LNd32_UPD
    5864             :     220769500U, // VST2LNd8
    5865             :     0U, // VST2LNd8Pseudo
    5866             :     0U, // VST2LNd8Pseudo_UPD
    5867             :     928996U,    // VST2LNd8_UPD
    5868             :     2280U,      // VST2LNdAsm_16
    5869             :     2280U,      // VST2LNdAsm_32
    5870             :     2280U,      // VST2LNdAsm_8
    5871             :     10472U,     // VST2LNdWB_fixed_Asm_16
    5872             :     10472U,     // VST2LNdWB_fixed_Asm_32
    5873             :     10472U,     // VST2LNdWB_fixed_Asm_8
    5874             :     655592U,    // VST2LNdWB_register_Asm_16
    5875             :     655592U,    // VST2LNdWB_register_Asm_32
    5876             :     655592U,    // VST2LNdWB_register_Asm_8
    5877             :     220769500U, // VST2LNq16
    5878             :     0U, // VST2LNq16Pseudo
    5879             :     0U, // VST2LNq16Pseudo_UPD
    5880             :     928996U,    // VST2LNq16_UPD
    5881             :     220769500U, // VST2LNq32
    5882             :     0U, // VST2LNq32Pseudo
    5883             :     0U, // VST2LNq32Pseudo_UPD
    5884             :     928996U,    // VST2LNq32_UPD
    5885             :     2280U,      // VST2LNqAsm_16
    5886             :     2280U,      // VST2LNqAsm_32
    5887             :     10472U,     // VST2LNqWB_fixed_Asm_16
    5888             :     10472U,     // VST2LNqWB_fixed_Asm_32
    5889             :     655592U,    // VST2LNqWB_register_Asm_16
    5890             :     655592U,    // VST2LNqWB_register_Asm_32
    5891             :     0U, // VST2b16
    5892             :     0U, // VST2b16wb_fixed
    5893             :     0U, // VST2b16wb_register
    5894             :     0U, // VST2b32
    5895             :     0U, // VST2b32wb_fixed
    5896             :     0U, // VST2b32wb_register
    5897             :     0U, // VST2b8
    5898             :     0U, // VST2b8wb_fixed
    5899             :     0U, // VST2b8wb_register
    5900             :     0U, // VST2d16
    5901             :     0U, // VST2d16wb_fixed
    5902             :     0U, // VST2d16wb_register
    5903             :     0U, // VST2d32
    5904             :     0U, // VST2d32wb_fixed
    5905             :     0U, // VST2d32wb_register
    5906             :     0U, // VST2d8
    5907             :     0U, // VST2d8wb_fixed
    5908             :     0U, // VST2d8wb_register
    5909             :     0U, // VST2q16
    5910             :     0U, // VST2q16Pseudo
    5911             :     0U, // VST2q16PseudoWB_fixed
    5912             :     0U, // VST2q16PseudoWB_register
    5913             :     0U, // VST2q16wb_fixed
    5914             :     0U, // VST2q16wb_register
    5915             :     0U, // VST2q32
    5916             :     0U, // VST2q32Pseudo
    5917             :     0U, // VST2q32PseudoWB_fixed
    5918             :     0U, // VST2q32PseudoWB_register
    5919             :     0U, // VST2q32wb_fixed
    5920             :     0U, // VST2q32wb_register
    5921             :     0U, // VST2q8
    5922             :     0U, // VST2q8Pseudo
    5923             :     0U, // VST2q8PseudoWB_fixed
    5924             :     0U, // VST2q8PseudoWB_register
    5925             :     0U, // VST2q8wb_fixed
    5926             :     0U, // VST2q8wb_register
    5927             :     254324020U, // VST3LNd16
    5928             :     0U, // VST3LNd16Pseudo
    5929             :     0U, // VST3LNd16Pseudo_UPD
    5930             :     316U,       // VST3LNd16_UPD
    5931             :     254324020U, // VST3LNd32
    5932             :     0U, // VST3LNd32Pseudo
    5933             :     0U, // VST3LNd32Pseudo_UPD
    5934             :     316U,       // VST3LNd32_UPD
    5935             :     254324020U, // VST3LNd8
    5936             :     0U, // VST3LNd8Pseudo
    5937             :     0U, // VST3LNd8Pseudo_UPD
    5938             :     316U,       // VST3LNd8_UPD
    5939             :     2280U,      // VST3LNdAsm_16
    5940             :     2280U,      // VST3LNdAsm_32
    5941             :     2280U,      // VST3LNdAsm_8
    5942             :     10472U,     // VST3LNdWB_fixed_Asm_16
    5943             :     10472U,     // VST3LNdWB_fixed_Asm_32
    5944             :     10472U,     // VST3LNdWB_fixed_Asm_8
    5945             :     655592U,    // VST3LNdWB_register_Asm_16
    5946             :     655592U,    // VST3LNdWB_register_Asm_32
    5947             :     655592U,    // VST3LNdWB_register_Asm_8
    5948             :     254324020U, // VST3LNq16
    5949             :     0U, // VST3LNq16Pseudo
    5950             :     0U, // VST3LNq16Pseudo_UPD
    5951             :     316U,       // VST3LNq16_UPD
    5952             :     254324020U, // VST3LNq32
    5953             :     0U, // VST3LNq32Pseudo
    5954             :     0U, // VST3LNq32Pseudo_UPD
    5955             :     316U,       // VST3LNq32_UPD
    5956             :     2280U,      // VST3LNqAsm_16
    5957             :     2280U,      // VST3LNqAsm_32
    5958             :     10472U,     // VST3LNqWB_fixed_Asm_16
    5959             :     10472U,     // VST3LNqWB_fixed_Asm_32
    5960             :     655592U,    // VST3LNqWB_register_Asm_16
    5961             :     655592U,    // VST3LNqWB_register_Asm_32
    5962             :     285868200U, // VST3d16
    5963             :     0U, // VST3d16Pseudo
    5964             :     0U, // VST3d16Pseudo_UPD
    5965             :     18752U,     // VST3d16_UPD
    5966             :     285868200U, // VST3d32
    5967             :     0U, // VST3d32Pseudo
    5968             :     0U, // VST3d32Pseudo_UPD
    5969             :     18752U,     // VST3d32_UPD
    5970             :     285868200U, // VST3d8
    5971             :     0U, // VST3d8Pseudo
    5972             :     0U, // VST3d8Pseudo_UPD
    5973             :     18752U,     // VST3d8_UPD
    5974             :     67U,        // VST3dAsm_16
    5975             :     67U,        // VST3dAsm_32
    5976             :     67U,        // VST3dAsm_8
    5977             :     211U,       // VST3dWB_fixed_Asm_16
    5978             :     211U,       // VST3dWB_fixed_Asm_32
    5979             :     211U,       // VST3dWB_fixed_Asm_8
    5980             :     531491U,    // VST3dWB_register_Asm_16
    5981             :     531491U,    // VST3dWB_register_Asm_32
    5982             :     531491U,    // VST3dWB_register_Asm_8
    5983             :     285868200U, // VST3q16
    5984             :     0U, // VST3q16Pseudo_UPD
    5985             :     18752U,     // VST3q16_UPD
    5986             :     0U, // VST3q16oddPseudo
    5987             :     0U, // VST3q16oddPseudo_UPD
    5988             :     285868200U, // VST3q32
    5989             :     0U, // VST3q32Pseudo_UPD
    5990             :     18752U,     // VST3q32_UPD
    5991             :     0U, // VST3q32oddPseudo
    5992             :     0U, // VST3q32oddPseudo_UPD
    5993             :     285868200U, // VST3q8
    5994             :     0U, // VST3q8Pseudo_UPD
    5995             :     18752U,     // VST3q8_UPD
    5996             :     0U, // VST3q8oddPseudo
    5997             :     0U, // VST3q8oddPseudo_UPD
    5998             :     0U, // VST3qAsm_16
    5999             :     0U, // VST3qAsm_32
    6000             :     0U, // VST3qAsm_8
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    6002             :     4U, // VST3qWB_fixed_Asm_32
    6003             :     4U, // VST3qWB_fixed_Asm_8
    6004             :     2216U,      // VST3qWB_register_Asm_16
    6005             :     2216U,      // VST3qWB_register_Asm_32
    6006             :     2216U,      // VST3qWB_register_Asm_8
    6007             :     321432804U, // VST4LNd16
    6008             :     0U, // VST4LNd16Pseudo
    6009             :     0U, // VST4LNd16Pseudo_UPD
    6010             :     19700U,     // VST4LNd16_UPD
    6011             :     321432804U, // VST4LNd32
    6012             :     0U, // VST4LNd32Pseudo
    6013             :     0U, // VST4LNd32Pseudo_UPD
    6014             :     19700U,     // VST4LNd32_UPD
    6015             :     321432804U, // VST4LNd8
    6016             :     0U, // VST4LNd8Pseudo
    6017             :     0U, // VST4LNd8Pseudo_UPD
    6018             :     19700U,     // VST4LNd8_UPD
    6019             :     2280U,      // VST4LNdAsm_16
    6020             :     2280U,      // VST4LNdAsm_32
    6021             :     2280U,      // VST4LNdAsm_8
    6022             :     10472U,     // VST4LNdWB_fixed_Asm_16
    6023             :     10472U,     // VST4LNdWB_fixed_Asm_32
    6024             :     10472U,     // VST4LNdWB_fixed_Asm_8
    6025             :     655592U,    // VST4LNdWB_register_Asm_16
    6026             :     655592U,    // VST4LNdWB_register_Asm_32
    6027             :     655592U,    // VST4LNdWB_register_Asm_8
    6028             :     321432804U, // VST4LNq16
    6029             :     0U, // VST4LNq16Pseudo
    6030             :     0U, // VST4LNq16Pseudo_UPD
    6031             :     19700U,     // VST4LNq16_UPD
    6032             :     321432804U, // VST4LNq32
    6033             :     0U, // VST4LNq32Pseudo
    6034             :     0U, // VST4LNq32Pseudo_UPD
    6035             :     19700U,     // VST4LNq32_UPD
    6036             :     2280U,      // VST4LNqAsm_16
    6037             :     2280U,      // VST4LNqAsm_32
    6038             :     10472U,     // VST4LNqWB_fixed_Asm_16
    6039             :     10472U,     // VST4LNqWB_fixed_Asm_32
    6040             :     655592U,    // VST4LNqWB_register_Asm_16
    6041             :     655592U,    // VST4LNqWB_register_Asm_32
    6042             :     338297000U, // VST4d16
    6043             :     0U, // VST4d16Pseudo
    6044             :     0U, // VST4d16Pseudo_UPD
    6045             :     950592U,    // VST4d16_UPD
    6046             :     338297000U, // VST4d32
    6047             :     0U, // VST4d32Pseudo
    6048             :     0U, // VST4d32Pseudo_UPD
    6049             :     950592U,    // VST4d32_UPD
    6050             :     338297000U, // VST4d8
    6051             :     0U, // VST4d8Pseudo
    6052             :     0U, // VST4d8Pseudo_UPD
    6053             :     950592U,    // VST4d8_UPD
    6054             :     67U,        // VST4dAsm_16
    6055             :     67U,        // VST4dAsm_32
    6056             :     67U,        // VST4dAsm_8
    6057             :     211U,       // VST4dWB_fixed_Asm_16
    6058             :     211U,       // VST4dWB_fixed_Asm_32
    6059             :     211U,       // VST4dWB_fixed_Asm_8
    6060             :     531491U,    // VST4dWB_register_Asm_16
    6061             :     531491U,    // VST4dWB_register_Asm_32
    6062             :     531491U,    // VST4dWB_register_Asm_8
    6063             :     338297000U, // VST4q16
    6064             :     0U, // VST4q16Pseudo_UPD
    6065             :     950592U,    // VST4q16_UPD
    6066             :     0U, // VST4q16oddPseudo
    6067             :     0U, // VST4q16oddPseudo_UPD
    6068             :     338297000U, // VST4q32
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    6070             :     950592U,    // VST4q32_UPD
    6071             :     0U, // VST4q32oddPseudo
    6072             :     0U, // VST4q32oddPseudo_UPD
    6073             :     338297000U, // VST4q8
    6074             :     0U, // VST4q8Pseudo_UPD
    6075             :     950592U,    // VST4q8_UPD
    6076             :     0U, // VST4q8oddPseudo
    6077             :     0U, // VST4q8oddPseudo_UPD
    6078             :     0U, // VST4qAsm_16
    6079             :     0U, // VST4qAsm_32
    6080             :     0U, // VST4qAsm_8
    6081             :     4U, // VST4qWB_fixed_Asm_16
    6082             :     4U, // VST4qWB_fixed_Asm_32
    6083             :     4U, // VST4qWB_fixed_Asm_8
    6084             :     2216U,      // VST4qWB_register_Asm_16
    6085             :     2216U,      // VST4qWB_register_Asm_32
    6086             :     2216U,      // VST4qWB_register_Asm_8
    6087             :     65U,        // VSTMDDB_UPD
    6088             :     2120U,      // VSTMDIA
    6089             :     65U,        // VSTMDIA_UPD
    6090             :     0U, // VSTMQIA
    6091             :     65U,        // VSTMSDB_UPD
    6092             :     2120U,      // VSTMSIA
    6093             :     65U,        // VSTMSIA_UPD
    6094             :     280U,       // VSTRD
    6095             :     288U,       // VSTRH
    6096             :     280U,       // VSTRS
    6097             :     527392U,    // VSUBD
    6098             :     527392U,    // VSUBH
    6099             :     2072U,      // VSUBHNv2i32
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    6101             :     2072U,      // VSUBHNv8i8
    6102             :     2072U,      // VSUBLsv2i64
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    6104             :     2072U,      // VSUBLsv8i16
    6105             :     2072U,      // VSUBLuv2i64
    6106             :     2072U,      // VSUBLuv4i32
    6107             :     2072U,      // VSUBLuv8i16
    6108             :     527392U,    // VSUBS
    6109             :     2072U,      // VSUBWsv2i64
    6110             :     2072U,      // VSUBWsv4i32
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    6126             :     2072U,      // VSUBv8i8
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    6128             :     2048U,      // VSWPq
    6129             :     328U,       // VTBL1
    6130             :     336U,       // VTBL2
    6131             :     344U,       // VTBL3
    6132             :     0U, // VTBL3Pseudo
    6133             :     352U,       // VTBL4
    6134             :     0U, // VTBL4Pseudo
    6135             :     360U,       // VTBX1
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    6138             :     0U, // VTBX3Pseudo
    6139             :     384U,       // VTBX4
    6140             :     0U, // VTBX4Pseudo
    6141             :     0U, // VTOSHD
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    6143             :     0U, // VTOSHS
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    6733             :     0U, // tSUBi8
    6734             :     2216U,      // tSUBrr
    6735             :     456U,       // tSUBspi
    6736             :     0U, // tSVC
    6737             :     2048U,      // tSXTB
    6738             :     2048U,      // tSXTH
    6739             :     0U, // tTAILJMPd
    6740             :     0U, // tTAILJMPdND
    6741             :     0U, // tTAILJMPr
    6742             :     0U, // tTBB_JT
    6743             :     0U, // tTBH_JT
    6744             :     0U, // tTPsoft
    6745             :     0U, // tTRAP
    6746             :     2048U,      // tTST
    6747             :     0U, // tUDF
    6748             :     2048U,      // tUXTB
    6749             :     2048U,      // tUXTH
    6750             :     0U, // t__brkdiv0
    6751             :   };
    6752             : 
    6753      130176 :   O << "\t";
    6754             : 
    6755             :   // Emit the opcode for the instruction.
    6756      130176 :   uint64_t Bits = 0;
    6757      130176 :   Bits |= (uint64_t)OpInfo0[MI->getOpcode()] << 0;
    6758      130176 :   Bits |= (uint64_t)OpInfo1[MI->getOpcode()] << 32;
    6759             :   assert(Bits != 0 && "Cannot print this instruction.");
    6760      130176 :   O << AsmStrs+(Bits & 4095)-1;
    6761             : 
    6762             : 
    6763             :   // Fragment 0 encoded into 5 bits for 30 unique commands.
    6764      130176 :   switch ((Bits >> 12) & 31) {
    6765           0 :   default: llvm_unreachable("Invalid command number.");
    6766             :   case 0:
    6767             :     // DBG_VALUE, BUNDLE, LIFETIME_START, LIFETIME_END, FENTRY_CALL, PATCHABL...
    6768             :     return;
    6769             :     break;
    6770       10588 :   case 1:
    6771             :     // ADCri, ADCrr, ADDri, ADDrr, ANDri, ANDrr, ASRi, ASRr, BICri, BICrr, EO...
    6772       10588 :     printSBitModifierOperand(MI, 5, STI, O);
    6773       10588 :     printPredicateOperand(MI, 3, STI, O);
    6774       10588 :     break;
    6775        1381 :   case 2:
    6776             :     // ADCrsi, ADDrsi, ANDrsi, BICrsi, EORrsi, MLA, MOVsr, MVNsr, ORRrsi, RSB...
    6777        1381 :     printSBitModifierOperand(MI, 6, STI, O);
    6778        1381 :     printPredicateOperand(MI, 4, STI, O);
    6779        1381 :     break;
    6780         278 :   case 3:
    6781             :     // ADCrsr, ADDrsr, ANDrsr, BICrsr, EORrsr, ORRrsr, RSBrsr, RSCrsr, SBCrsr...
    6782         278 :     printSBitModifierOperand(MI, 7, STI, O);
    6783         278 :     printPredicateOperand(MI, 5, STI, O);
    6784         278 :     O << "\t";
    6785         278 :     printOperand(MI, 0, STI, O);
    6786         278 :     O << ", ";
    6787         278 :     printOperand(MI, 1, STI, O);
    6788         278 :     O << ", ";
    6789         278 :     printSORegRegOperand(MI, 2, STI, O);
    6790         278 :     return;
    6791             :     break;
    6792       19463 :   case 4:
    6793             :     // ADR, CLZ, CMNri, CMNzrr, CMPri, CMPrr, FCONSTD, FCONSTH, FCONSTS, FLDM...
    6794       19463 :     printPredicateOperand(MI, 2, STI, O);
    6795       19463 :     break;
    6796        5283 :   case 5:
    6797             :     // AESD, AESE, AESIMC, AESMC, BKPT, BL, BLX, BLXi, BX, CPS1p, CRC32B, CRC...
    6798        5283 :     printOperand(MI, 0, STI, O);
    6799        5283 :     break;
    6800       41192 :   case 6:
    6801             :     // BFC, CMNzrsi, CMPrsi, LDRBi12, LDRcp, LDRi12, MOVTi16, QADD, QADD16, Q...
    6802       41192 :     printPredicateOperand(MI, 3, STI, O);
    6803       41192 :     break;
    6804        7685 :   case 7:
    6805             :     // BFI, CMNzrsr, CMPrsr, LDCL_OFFSET, LDCL_OPTION, LDCL_POST, LDCL_PRE, L...
    6806        7685 :     printPredicateOperand(MI, 4, STI, O);
    6807        7685 :     break;
    6808        8110 :   case 8:
    6809             :     // BLX_pred, BL_pred, BXJ, BX_pred, Bcc, DBG, FLDMXIA, FSTMXIA, HINT, LDM...
    6810        8110 :     printPredicateOperand(MI, 1, STI, O);
    6811        8110 :     break;
    6812       11313 :   case 9:
    6813             :     // BX_RET, ERET, FMSTAT, MOVPCLR, t2CLREX, t2DCPS1, t2DCPS2, t2DCPS3, t2S...
    6814       11313 :     printPredicateOperand(MI, 0, STI, O);
    6815       11313 :     break;
    6816         696 :   case 10:
    6817             :     // CDP, LDRD_POST, LDRD_PRE, MCR, MRC, SMLALBB, SMLALBT, SMLALD, SMLALDX,...
    6818         696 :     printPredicateOperand(MI, 6, STI, O);
    6819         696 :     break;
    6820         101 :   case 11:
    6821             :     // CDP2, LDC2L_OFFSET, LDC2L_OPTION, LDC2L_POST, LDC2L_PRE, LDC2_OFFSET, ...
    6822         101 :     printPImmediate(MI, 0, STI, O);
    6823         101 :     O << ", ";
    6824         101 :     break;
    6825          48 :   case 12:
    6826             :     // CPS2p, CPS3p, t2CPS2p, t2CPS3p, tCPS
    6827          48 :     printCPSIMod(MI, 0, STI, O);
    6828          48 :     break;
    6829         311 :   case 13:
    6830             :     // DMB, DSB
    6831         311 :     printMemBOption(MI, 0, STI, O);
    6832         311 :     return;
    6833             :     break;
    6834          13 :   case 14:
    6835             :     // ISB
    6836          13 :     printInstSyncBOption(MI, 0, STI, O);
    6837          13 :     return;
    6838             :     break;
    6839        3587 :   case 15:
    6840             :     // ITasm, t2IT
    6841        3587 :     printThumbITMask(MI, 1, STI, O);
    6842        3587 :     break;
    6843        3422 :   case 16:
    6844             :     // LDRBT_POST_IMM, LDRBT_POST_REG, LDRB_POST_IMM, LDRB_POST_REG, LDRB_PRE...
    6845        3422 :     printPredicateOperand(MI, 5, STI, O);
    6846        3422 :     break;
    6847        8326 :   case 17:
    6848             :     // MOVi, MOVr, MOVr_TC, MVNi, MVNr, RRXi, t2MOVi, t2MOVr, t2MVNi, t2MVNr,...
    6849        8326 :     printSBitModifierOperand(MI, 4, STI, O);
    6850        8326 :     printPredicateOperand(MI, 2, STI, O);
    6851        8326 :     break;
    6852          10 :   case 18:
    6853             :     // MRC2
    6854          10 :     printPImmediate(MI, 1, STI, O);
    6855          10 :     O << ", ";
    6856          10 :     printOperand(MI, 2, STI, O);
    6857          10 :     O << ", ";
    6858          10 :     printOperand(MI, 0, STI, O);
    6859          10 :     O << ", ";
    6860          10 :     printCImmediate(MI, 3, STI, O);
    6861          10 :     O << ", ";
    6862          10 :     printCImmediate(MI, 4, STI, O);
    6863          10 :     O << ", ";
    6864          10 :     printOperand(MI, 5, STI, O);
    6865          10 :     return;
    6866             :     break;
    6867           8 :   case 19:
    6868             :     // MRRC2
    6869           8 :     printPImmediate(MI, 2, STI, O);
    6870           8 :     O << ", ";
    6871           8 :     printOperand(MI, 3, STI, O);
    6872           8 :     O << ", ";
    6873           8 :     printOperand(MI, 0, STI, O);
    6874           8 :     O << ", ";
    6875           8 :     printOperand(MI, 1, STI, O);
    6876           8 :     O << ", ";
    6877           8 :     printCImmediate(MI, 4, STI, O);
    6878           8 :     return;
    6879             :     break;
    6880          15 :   case 20:
    6881             :     // PLDWi12, PLDi12, PLIi12
    6882          15 :     printAddrModeImm12Operand<false>(MI, 0, STI, O);
    6883          15 :     return;
    6884             :     break;
    6885          14 :   case 21:
    6886             :     // PLDWrs, PLDrs, PLIrs
    6887          14 :     printAddrMode2Operand(MI, 0, STI, O);
    6888          14 :     return;
    6889             :     break;
    6890          28 :   case 22:
    6891             :     // SETEND, tSETEND
    6892          28 :     printSetendOperand(MI, 0, STI, O);
    6893          28 :     return;
    6894             :     break;
    6895          65 :   case 23:
    6896             :     // SMLAL, UMLAL
    6897          65 :     printSBitModifierOperand(MI, 8, STI, O);
    6898          65 :     printPredicateOperand(MI, 6, STI, O);
    6899          65 :     O << "\t";
    6900          65 :     printOperand(MI, 0, STI, O);
    6901          65 :     O << ", ";
    6902          65 :     printOperand(MI, 1, STI, O);
    6903          65 :     O << ", ";
    6904          65 :     printOperand(MI, 2, STI, O);
    6905          65 :     O << ", ";
    6906          65 :     printOperand(MI, 3, STI, O);
    6907          65 :     return;
    6908             :     break;
    6909         351 :   case 24:
    6910             :     // VLD1LNd16_UPD, VLD1LNd32_UPD, VLD1LNd8_UPD, VLD2LNd16, VLD2LNd32, VLD2...
    6911         351 :     printPredicateOperand(MI, 7, STI, O);
    6912         351 :     break;
    6913         121 :   case 25:
    6914             :     // VLD2LNd16_UPD, VLD2LNd32_UPD, VLD2LNd8_UPD, VLD2LNq16_UPD, VLD2LNq32_U...
    6915         121 :     printPredicateOperand(MI, 9, STI, O);
    6916         121 :     break;
    6917          69 :   case 26:
    6918             :     // VLD3LNd16_UPD, VLD3LNd32_UPD, VLD3LNd8_UPD, VLD3LNq16_UPD, VLD3LNq32_U...
    6919          69 :     printPredicateOperand(MI, 11, STI, O);
    6920          69 :     break;
    6921         279 :   case 27:
    6922             :     // VLD4DUPd16_UPD, VLD4DUPd32_UPD, VLD4DUPd8_UPD, VLD4DUPq16_UPD, VLD4DUP...
    6923         279 :     printPredicateOperand(MI, 8, STI, O);
    6924         279 :     break;
    6925          39 :   case 28:
    6926             :     // VLD4LNd16_UPD, VLD4LNd32_UPD, VLD4LNd8_UPD, VLD4LNq16_UPD, VLD4LNq32_U...
    6927          39 :     printPredicateOperand(MI, 13, STI, O);
    6928          39 :     break;
    6929        7217 :   case 29:
    6930             :     // tADC, tADDi3, tADDi8, tADDrr, tAND, tASRri, tASRrr, tBIC, tEOR, tLSLri...
    6931        7217 :     printSBitModifierOperand(MI, 1, STI, O);
    6932        7217 :     break;
    6933             :   }
    6934             : 
    6935             : 
    6936             :   // Fragment 1 encoded into 7 bits for 74 unique commands.
    6937      129271 :   switch ((Bits >> 17) & 127) {
    6938           0 :   default: llvm_unreachable("Invalid command number.");
    6939       84058 :   case 0:
    6940             :     // ADCri, ADCrr, ADCrsi, ADDri, ADDrr, ADDrsi, ADR, ANDri, ANDrr, ANDrsi,...
    6941       84058 :     O << "\t";
    6942       84058 :     break;
    6943        1610 :   case 1:
    6944             :     // AESD, AESE, AESIMC, AESMC, CRC32B, CRC32CB, CRC32CH, CRC32CW, CRC32H, ...
    6945        1610 :     O << ", ";
    6946        1610 :     break;
    6947          17 :   case 2:
    6948             :     // ASRi, ASRr, ITasm, LDRBT_POST, LDRConstPool, LDRT_POST, LSLi, LSLr, LS...
    6949             :     O << ' ';
    6950             :     break;
    6951             :   case 3:
    6952             :     // BKPT, BL, BLX, BLXi, BX, CPS1p, ERET, HLT, HVC, RFEDA, RFEDB, RFEIA, R...
    6953             :     return;
    6954             :     break;
    6955        2982 :   case 4:
    6956             :     // BX_RET
    6957        2982 :     O << "\tlr";
    6958        2982 :     return;
    6959             :     break;
    6960          31 :   case 5:
    6961             :     // CDP2, MCR2, MCRR2
    6962          31 :     printOperand(MI, 1, STI, O);
    6963          31 :     O << ", ";
    6964          31 :     break;
    6965        1944 :   case 6:
    6966             :     // FCONSTD, VABSD, VADDD, VCMPD, VCMPED, VCMPEZD, VCMPZD, VDIVD, VFMAD, V...
    6967        1944 :     O << ".f64\t";
    6968        1944 :     printOperand(MI, 0, STI, O);
    6969        1944 :     break;
    6970         364 :   case 7:
    6971             :     // FCONSTH, VABDhd, VABDhq, VABSH, VABShd, VABShq, VACGEhd, VACGEhq, VACG...
    6972         364 :     O << ".f16\t";
    6973         364 :     printOperand(MI, 0, STI, O);
    6974         364 :     break;
    6975        3496 :   case 8:
    6976             :     // FCONSTS, VABDfd, VABDfq, VABSS, VABSfd, VABSfq, VACGEfd, VACGEfq, VACG...
    6977        3496 :     O << ".f32\t";
    6978        3496 :     printOperand(MI, 0, STI, O);
    6979        3496 :     break;
    6980         318 :   case 9:
    6981             :     // FMSTAT
    6982         318 :     O << "\tAPSR_nzcv, fpscr";
    6983         318 :     return;
    6984             :     break;
    6985          70 :   case 10:
    6986             :     // LDC2L_OFFSET, LDC2L_OPTION, LDC2L_POST, LDC2L_PRE, LDC2_OFFSET, LDC2_O...
    6987          70 :     printCImmediate(MI, 1, STI, O);
    6988          70 :     O << ", ";
    6989          70 :     break;
    6990        2740 :   case 11:
    6991             :     // MOVPCLR
    6992        2740 :     O << "\tpc, lr";
    6993        2740 :     return;
    6994             :     break;
    6995          29 :   case 12:
    6996             :     // RFEDA_UPD, RFEDB_UPD, RFEIA_UPD, RFEIB_UPD
    6997             :     O << '!';
    6998             :     return;
    6999             :     break;
    7000         537 :   case 13:
    7001             :     // VABALsv2i64, VABAsv2i32, VABAsv4i32, VABDLsv2i64, VABDsv2i32, VABDsv4i...
    7002         537 :     O << ".s32\t";
    7003         537 :     printOperand(MI, 0, STI, O);
    7004         537 :     O << ", ";
    7005         537 :     break;
    7006         602 :   case 14:
    7007             :     // VABALsv4i32, VABAsv4i16, VABAsv8i16, VABDLsv4i32, VABDsv4i16, VABDsv8i...
    7008         602 :     O << ".s16\t";
    7009         602 :     printOperand(MI, 0, STI, O);
    7010         602 :     O << ", ";
    7011         602 :     break;
    7012         455 :   case 15:
    7013             :     // VABALsv8i16, VABAsv16i8, VABAsv8i8, VABDLsv8i16, VABDsv16i8, VABDsv8i8...
    7014         455 :     O << ".s8\t";
    7015         455 :     printOperand(MI, 0, STI, O);
    7016         455 :     O << ", ";
    7017         455 :     break;
    7018         388 :   case 16:
    7019             :     // VABALuv2i64, VABAuv2i32, VABAuv4i32, VABDLuv2i64, VABDuv2i32, VABDuv4i...
    7020         388 :     O << ".u32\t";
    7021         388 :     printOperand(MI, 0, STI, O);
    7022         388 :     O << ", ";
    7023         388 :     break;
    7024         464 :   case 17:
    7025             :     // VABALuv4i32, VABAuv4i16, VABAuv8i16, VABDLuv4i32, VABDuv4i16, VABDuv8i...
    7026         464 :     O << ".u16\t";
    7027         464 :     printOperand(MI, 0, STI, O);
    7028         464 :     O << ", ";
    7029         464 :     break;
    7030         404 :   case 18:
    7031             :     // VABALuv8i16, VABAuv16i8, VABAuv8i8, VABDLuv8i16, VABDuv16i8, VABDuv8i8...
    7032         404 :     O << ".u8\t";
    7033         404 :     printOperand(MI, 0, STI, O);
    7034         404 :     O << ", ";
    7035         404 :     break;
    7036         213 :   case 19:
    7037             :     // VADDHNv2i32, VADDv1i64, VADDv2i64, VMOVNv2i32, VMOVv1i64, VMOVv2i64, V...
    7038         213 :     O << ".i64\t";
    7039         213 :     printOperand(MI, 0, STI, O);
    7040         213 :     O << ", ";
    7041         213 :     break;
    7042         717 :   case 20:
    7043             :     // VADDHNv4i16, VADDv2i32, VADDv4i32, VBICiv2i32, VBICiv4i32, VCEQv2i32, ...
    7044         717 :     O << ".i32\t";
    7045         717 :     printOperand(MI, 0, STI, O);
    7046         717 :     O << ", ";
    7047         717 :     break;
    7048         422 :   case 21:
    7049             :     // VADDHNv8i8, VADDv4i16, VADDv8i16, VBICiv4i16, VBICiv8i16, VCEQv4i16, V...
    7050         422 :     O << ".i16\t";
    7051         422 :     printOperand(MI, 0, STI, O);
    7052         422 :     O << ", ";
    7053         422 :     break;
    7054         339 :   case 22:
    7055             :     // VADDv16i8, VADDv8i8, VCEQv16i8, VCEQv8i8, VCEQzv16i8, VCEQzv8i8, VCLZv...
    7056         339 :     O << ".i8\t";
    7057         339 :     printOperand(MI, 0, STI, O);
    7058         339 :     O << ", ";
    7059         339 :     break;
    7060        1068 :   case 23:
    7061             :     // VCNTd, VCNTq, VDUP8d, VDUP8q, VDUPLN8d, VDUPLN8q, VEXTd8, VEXTq8, VLD1...
    7062        1068 :     O << ".8\t";
    7063        1068 :     break;
    7064          25 :   case 24:
    7065             :     // VCVTBDH, VCVTTDH
    7066          25 :     O << ".f16.f64\t";
    7067          25 :     printOperand(MI, 0, STI, O);
    7068          25 :     O << ", ";
    7069          25 :     printOperand(MI, 1, STI, O);
    7070          25 :     return;
    7071             :     break;
    7072          26 :   case 25:
    7073             :     // VCVTBHD, VCVTTHD
    7074          26 :     O << ".f64.f16\t";
    7075          26 :     printOperand(MI, 0, STI, O);
    7076          26 :     O << ", ";
    7077          26 :     printOperand(MI, 1, STI, O);
    7078          26 :     return;
    7079             :     break;
    7080          94 :   case 26:
    7081             :     // VCVTBHS, VCVTTHS, VCVTh2f
    7082          94 :     O << ".f32.f16\t";
    7083          94 :     printOperand(MI, 0, STI, O);
    7084          94 :     O << ", ";
    7085          94 :     printOperand(MI, 1, STI, O);
    7086          94 :     return;
    7087             :     break;
    7088          64 :   case 27:
    7089             :     // VCVTBSH, VCVTTSH, VCVTf2h
    7090          64 :     O << ".f16.f32\t";
    7091          64 :     printOperand(MI, 0, STI, O);
    7092          64 :     O << ", ";
    7093          64 :     printOperand(MI, 1, STI, O);
    7094          64 :     return;
    7095             :     break;
    7096          70 :   case 28:
    7097             :     // VCVTDS
    7098          70 :     O << ".f64.f32\t";
    7099          70 :     printOperand(MI, 0, STI, O);
    7100          70 :     O << ", ";
    7101          70 :     printOperand(MI, 1, STI, O);
    7102          70 :     return;
    7103             :     break;
    7104          30 :   case 29:
    7105             :     // VCVTSD
    7106          30 :     O << ".f32.f64\t";
    7107          30 :     printOperand(MI, 0, STI, O);
    7108          30 :     O << ", ";
    7109          30 :     printOperand(MI, 1, STI, O);
    7110          30 :     return;
    7111             :     break;
    7112          84 :   case 30:
    7113             :     // VCVTf2sd, VCVTf2sq, VCVTf2xsd, VCVTf2xsq, VTOSIRS, VTOSIZS, VTOSLS
    7114          84 :     O << ".s32.f32\t";
    7115          84 :     printOperand(MI, 0, STI, O);
    7116          84 :     O << ", ";
    7117          84 :     printOperand(MI, 1, STI, O);
    7118          84 :     break;
    7119          67 :   case 31:
    7120             :     // VCVTf2ud, VCVTf2uq, VCVTf2xud, VCVTf2xuq, VTOUIRS, VTOUIZS, VTOULS
    7121          67 :     O << ".u32.f32\t";
    7122          67 :     printOperand(MI, 0, STI, O);
    7123          67 :     O << ", ";
    7124          67 :     printOperand(MI, 1, STI, O);
    7125          67 :     break;
    7126          20 :   case 32:
    7127             :     // VCVTh2sd, VCVTh2sq, VCVTh2xsd, VCVTh2xsq, VTOSHH
    7128          20 :     O << ".s16.f16\t";
    7129          20 :     printOperand(MI, 0, STI, O);
    7130          20 :     O << ", ";
    7131          20 :     printOperand(MI, 1, STI, O);
    7132          20 :     break;
    7133          20 :   case 33:
    7134             :     // VCVTh2ud, VCVTh2uq, VCVTh2xud, VCVTh2xuq, VTOUHH
    7135          20 :     O << ".u16.f16\t";
    7136          20 :     printOperand(MI, 0, STI, O);
    7137          20 :     O << ", ";
    7138          20 :     printOperand(MI, 1, STI, O);
    7139          20 :     break;
    7140         116 :   case 34:
    7141             :     // VCVTs2fd, VCVTs2fq, VCVTxs2fd, VCVTxs2fq, VSITOS, VSLTOS
    7142         116 :     O << ".f32.s32\t";
    7143         116 :     printOperand(MI, 0, STI, O);
    7144         116 :     O << ", ";
    7145         116 :     printOperand(MI, 1, STI, O);
    7146         116 :     break;
    7147          20 :   case 35:
    7148             :     // VCVTs2hd, VCVTs2hq, VCVTxs2hd, VCVTxs2hq, VSHTOH
    7149          20 :     O << ".f16.s16\t";
    7150          20 :     printOperand(MI, 0, STI, O);
    7151          20 :     O << ", ";
    7152          20 :     printOperand(MI, 1, STI, O);
    7153          20 :     break;
    7154          76 :   case 36:
    7155             :     // VCVTu2fd, VCVTu2fq, VCVTxu2fd, VCVTxu2fq, VUITOS, VULTOS
    7156          76 :     O << ".f32.u32\t";
    7157          76 :     printOperand(MI, 0, STI, O);
    7158          76 :     O << ", ";
    7159          76 :     printOperand(MI, 1, STI, O);
    7160          76 :     break;
    7161          20 :   case 37:
    7162             :     // VCVTu2hd, VCVTu2hq, VCVTxu2hd, VCVTxu2hq, VUHTOH
    7163          20 :     O << ".f16.u16\t";
    7164          20 :     printOperand(MI, 0, STI, O);
    7165          20 :     O << ", ";
    7166          20 :     printOperand(MI, 1, STI, O);
    7167          20 :     break;
    7168         855 :   case 38:
    7169             :     // VDUP16d, VDUP16q, VDUPLN16d, VDUPLN16q, VEXTd16, VEXTq16, VLD1DUPd16, ...
    7170         855 :     O << ".16\t";
    7171         855 :     break;
    7172        2143 :   case 39:
    7173             :     // VDUP32d, VDUP32q, VDUPLN32d, VDUPLN32q, VEXTd32, VEXTq32, VGETLNi32, V...
    7174        2143 :     O << ".32\t";
    7175        2143 :     break;
    7176        3494 :   case 40:
    7177             :     // VEXTq64, VLD1d64, VLD1d64Q, VLD1d64Qwb_fixed, VLD1d64Qwb_register, VLD...
    7178        3494 :     O << ".64\t";
    7179        3494 :     break;
    7180          41 :   case 41:
    7181             :     // VJCVT, VTOSIRD, VTOSIZD, VTOSLD
    7182          41 :     O << ".s32.f64\t";
    7183          41 :     printOperand(MI, 0, STI, O);
    7184          41 :     O << ", ";
    7185          41 :     printOperand(MI, 1, STI, O);
    7186          41 :     break;
    7187         448 :   case 42:
    7188             :     // VLD1LNd16, VLD1LNd16_UPD, VLD2LNd16, VLD2LNd16_UPD, VLD2LNq16, VLD2LNq...
    7189         448 :     O << ".16\t{";
    7190         448 :     break;
    7191         694 :   case 43:
    7192             :     // VLD1LNd32, VLD1LNd32_UPD, VLD2LNd32, VLD2LNd32_UPD, VLD2LNq32, VLD2LNq...
    7193         694 :     O << ".32\t{";
    7194         694 :     break;
    7195         380 :   case 44:
    7196             :     // VLD1LNd8, VLD1LNd8_UPD, VLD2LNd8, VLD2LNd8_UPD, VLD3DUPd8, VLD3DUPd8_U...
    7197         380 :     O << ".8\t{";
    7198         380 :     break;
    7199           9 :   case 45:
    7200             :     // VMSR
    7201           9 :     O << "\tfpscr, ";
    7202           9 :     printOperand(MI, 0, STI, O);
    7203           9 :     return;
    7204             :     break;
    7205           2 :   case 46:
    7206             :     // VMSR_FPEXC
    7207           2 :     O << "\tfpexc, ";
    7208           2 :     printOperand(MI, 0, STI, O);
    7209           2 :     return;
    7210             :     break;
    7211           2 :   case 47:
    7212             :     // VMSR_FPINST
    7213           2 :     O << "\tfpinst, ";
    7214           2 :     printOperand(MI, 0, STI, O);
    7215           2 :     return;
    7216             :     break;
    7217           2 :   case 48:
    7218             :     // VMSR_FPINST2
    7219           2 :     O << "\tfpinst2, ";
    7220           2 :     printOperand(MI, 0, STI, O);
    7221           2 :     return;
    7222             :     break;
    7223           2 :   case 49:
    7224             :     // VMSR_FPSID
    7225           2 :     O << "\tfpsid, ";
    7226           2 :     printOperand(MI, 0, STI, O);
    7227           2 :     return;
    7228             :     break;
    7229          19 :   case 50:
    7230             :     // VMULLp8, VMULpd, VMULpq
    7231          19 :     O << ".p8\t";
    7232          19 :     printOperand(MI, 0, STI, O);
    7233          19 :     O << ", ";
    7234          19 :     printOperand(MI, 1, STI, O);
    7235          19 :     O << ", ";
    7236          19 :     printOperand(MI, 2, STI, O);
    7237          19 :     return;
    7238             :     break;
    7239         172 :   case 51:
    7240             :     // VQADDsv1i64, VQADDsv2i64, VQMOVNsuv2i32, VQMOVNsv2i32, VQRSHLsv1i64, V...
    7241         172 :     O << ".s64\t";
    7242         172 :     printOperand(MI, 0, STI, O);
    7243         172 :     O << ", ";
    7244         172 :     break;
    7245         162 :   case 52:
    7246             :     // VQADDuv1i64, VQADDuv2i64, VQMOVNuv2i32, VQRSHLuv1i64, VQRSHLuv2i64, VQ...
    7247         162 :     O << ".u64\t";
    7248         162 :     printOperand(MI, 0, STI, O);
    7249         162 :     O << ", ";
    7250         162 :     break;
    7251           1 :   case 53:
    7252             :     // VSHTOD
    7253           1 :     O << ".f64.s16\t";
    7254           1 :     printOperand(MI, 0, STI, O);
    7255           1 :     O << ", ";
    7256           1 :     printOperand(MI, 1, STI, O);
    7257           1 :     O << ", ";
    7258           1 :     printFBits16(MI, 2, STI, O);
    7259           1 :     return;
    7260             :     break;
    7261           1 :   case 54:
    7262             :     // VSHTOS
    7263           1 :     O << ".f32.s16\t";
    7264           1 :     printOperand(MI, 0, STI, O);
    7265           1 :     O << ", ";
    7266           1 :     printOperand(MI, 1, STI, O);
    7267           1 :     O << ", ";
    7268           1 :     printFBits16(MI, 2, STI, O);
    7269           1 :     return;
    7270             :     break;
    7271          47 :   case 55:
    7272             :     // VSITOD, VSLTOD
    7273          47 :     O << ".f64.s32\t";
    7274          47 :     printOperand(MI, 0, STI, O);
    7275          47 :     O << ", ";
    7276          47 :     printOperand(MI, 1, STI, O);
    7277          47 :     break;
    7278           8 :   case 56:
    7279             :     // VSITOH, VSLTOH
    7280           8 :     O << ".f16.s32\t";
    7281           8 :     printOperand(MI, 0, STI, O);
    7282           8 :     O << ", ";
    7283           8 :     printOperand(MI, 1, STI, O);
    7284           8 :     break;
    7285           1 :   case 57:
    7286             :     // VTOSHD
    7287           1 :     O << ".s16.f64\t";
    7288           1 :     printOperand(MI, 0, STI, O);
    7289           1 :     O << ", ";
    7290           1 :     printOperand(MI, 1, STI, O);
    7291           1 :     O << ", ";
    7292           1 :     printFBits16(MI, 2, STI, O);
    7293           1 :     return;
    7294             :     break;
    7295           1 :   case 58:
    7296             :     // VTOSHS
    7297           1 :     O << ".s16.f32\t";
    7298           1 :     printOperand(MI, 0, STI, O);
    7299           1 :     O << ", ";
    7300           1 :     printOperand(MI, 1, STI, O);
    7301           1 :     O << ", ";
    7302           1 :     printFBits16(MI, 2, STI, O);
    7303           1 :     return;
    7304             :     break;
    7305          12 :   case 59:
    7306             :     // VTOSIRH, VTOSIZH, VTOSLH
    7307          12 :     O << ".s32.f16\t";
    7308          12 :     printOperand(MI, 0, STI, O);
    7309          12 :     O << ", ";
    7310          12 :     printOperand(MI, 1, STI, O);
    7311          12 :     break;
    7312           1 :   case 60:
    7313             :     // VTOUHD
    7314           1 :     O << ".u16.f64\t";
    7315           1 :     printOperand(MI, 0, STI, O);
    7316           1 :     O << ", ";
    7317           1 :     printOperand(MI, 1, STI, O);
    7318           1 :     O << ", ";
    7319           1 :     printFBits16(MI, 2, STI, O);
    7320           1 :     return;
    7321             :     break;
    7322           1 :   case 61:
    7323             :     // VTOUHS
    7324           1 :     O << ".u16.f32\t";
    7325           1 :     printOperand(MI, 0, STI, O);
    7326           1 :     O << ", ";
    7327           1 :     printOperand(MI, 1, STI, O);
    7328           1 :     O << ", ";
    7329           1 :     printFBits16(MI, 2, STI, O);
    7330           1 :     return;
    7331             :     break;
    7332          27 :   case 62:
    7333             :     // VTOUIRD, VTOUIZD, VTOULD
    7334          27 :     O << ".u32.f64\t";
    7335          27 :     printOperand(MI, 0, STI, O);
    7336          27 :     O << ", ";
    7337          27 :     printOperand(MI, 1, STI, O);
    7338          27 :     break;
    7339          12 :   case 63:
    7340             :     // VTOUIRH, VTOUIZH, VTOULH
    7341          12 :     O << ".u32.f16\t";
    7342          12 :     printOperand(MI, 0, STI, O);
    7343          12 :     O << ", ";
    7344          12 :     printOperand(MI, 1, STI, O);
    7345          12 :     break;
    7346           1 :   case 64:
    7347             :     // VUHTOD
    7348           1 :     O << ".f64.u16\t";
    7349           1 :     printOperand(MI, 0, STI, O);
    7350           1 :     O << ", ";
    7351           1 :     printOperand(MI, 1, STI, O);
    7352           1 :     O << ", ";
    7353           1 :     printFBits16(MI, 2, STI, O);
    7354           1 :     return;
    7355             :     break;
    7356           1 :   case 65:
    7357             :     // VUHTOS
    7358           1 :     O << ".f32.u16\t";
    7359           1 :     printOperand(MI, 0, STI, O);
    7360           1 :     O << ", ";
    7361           1 :     printOperand(MI, 1, STI, O);
    7362           1 :     O << ", ";
    7363           1 :     printFBits16(MI, 2, STI, O);
    7364           1 :     return;
    7365             :     break;
    7366          29 :   case 66:
    7367             :     // VUITOD, VULTOD
    7368          29 :     O << ".f64.u32\t";
    7369          29 :     printOperand(MI, 0, STI, O);
    7370          29 :     O << ", ";
    7371          29 :     printOperand(MI, 1, STI, O);
    7372          29 :     break;
    7373           8 :   case 67:
    7374             :     // VUITOH, VULTOH
    7375           8 :     O << ".f16.u32\t";
    7376           8 :     printOperand(MI, 0, STI, O);
    7377           8 :     O << ", ";
    7378           8 :     printOperand(MI, 1, STI, O);
    7379           8 :     break;
    7380        5701 :   case 68:
    7381             :     // t2ADCrr, t2ADCrs, t2ADDri, t2ADDrr, t2ADDrs, t2ADR, t2ANDrr, t2ANDrs, ...
    7382        5701 :     O << ".w\t";
    7383        5701 :     break;
    7384          20 :   case 69:
    7385             :     // t2SRSDB, t2SRSIA
    7386          20 :     O << "\tsp, ";
    7387          20 :     printOperand(MI, 0, STI, O);
    7388          20 :     return;
    7389             :     break;
    7390          20 :   case 70:
    7391             :     // t2SRSDB_UPD, t2SRSIA_UPD
    7392          20 :     O << "\tsp!, ";
    7393          20 :     printOperand(MI, 0, STI, O);
    7394          20 :     return;
    7395             :     break;
    7396          22 :   case 71:
    7397             :     // t2SUBS_PC_LR
    7398          22 :     O << "\tpc, lr, ";
    7399          22 :     printOperand(MI, 0, STI, O);
    7400          22 :     return;
    7401             :     break;
    7402        5025 :   case 72:
    7403             :     // tADC, tADDi3, tADDi8, tADDrr, tAND, tASRri, tASRrr, tBIC, tEOR, tLSLri...
    7404        5025 :     printPredicateOperand(MI, 4, STI, O);
    7405        5025 :     O << "\t";
    7406        5025 :     printOperand(MI, 0, STI, O);
    7407        5025 :     O << ", ";
    7408        5025 :     break;
    7409        2192 :   case 73:
    7410             :     // tMOVi8, tMVN, tRSB
    7411        2192 :     printPredicateOperand(MI, 3, STI, O);
    7412        2192 :     O << "\t";
    7413        2192 :     printOperand(MI, 0, STI, O);
    7414        2192 :     O << ", ";
    7415        2192 :     printOperand(MI, 2, STI, O);
    7416        2192 :     break;
    7417             :   }
    7418             : 
    7419             : 
    7420             :   // Fragment 2 encoded into 6 bits for 59 unique commands.
    7421      119072 :   switch ((Bits >> 24) & 63) {
    7422           0 :   default: llvm_unreachable("Invalid command number.");
    7423       79741 :   case 0:
    7424             :     // ADCri, ADCrr, ADCrsi, ADDri, ADDrr, ADDrsi, ADR, ANDri, ANDrr, ANDrsi,...
    7425       79741 :     printOperand(MI, 0, STI, O);
    7426       79741 :     break;
    7427        5273 :   case 1:
    7428             :     // AESD, AESE, MCR2, MCRR2, SHA1C, SHA1M, SHA1P, SHA1SU0, SHA1SU1, SHA256...
    7429        5273 :     printOperand(MI, 2, STI, O);
    7430        5273 :     break;
    7431        7605 :   case 2:
    7432             :     // AESIMC, AESMC, CRC32B, CRC32CB, CRC32CH, CRC32CW, CRC32H, CRC32W, FLDM...
    7433        7605 :     printOperand(MI, 1, STI, O);
    7434        7605 :     break;
    7435         848 :   case 3:
    7436             :     // CDP, LDCL_OFFSET, LDCL_OPTION, LDCL_POST, LDCL_PRE, LDC_OFFSET, LDC_OP...
    7437         848 :     printPImmediate(MI, 0, STI, O);
    7438         848 :     O << ", ";
    7439         848 :     break;
    7440          14 :   case 4:
    7441             :     // CDP2
    7442          14 :     printCImmediate(MI, 2, STI, O);
    7443          14 :     O << ", ";
    7444          14 :     printCImmediate(MI, 3, STI, O);
    7445          14 :     O << ", ";
    7446          14 :     printCImmediate(MI, 4, STI, O);
    7447          14 :     O << ", ";
    7448          14 :     printOperand(MI, 5, STI, O);
    7449          14 :     return;
    7450             :     break;
    7451          48 :   case 5:
    7452             :     // CPS2p, CPS3p, t2CPS2p, t2CPS3p, tCPS
    7453          48 :     printCPSIFlag(MI, 1, STI, O);
    7454          48 :     break;
    7455        5875 :   case 6:
    7456             :     // FCONSTD, FCONSTH, FCONSTS, VABDfd, VABDfq, VABDhd, VABDhq, VABSD, VABS...
    7457        5875 :     O << ", ";
    7458        5875 :     break;
    7459        3587 :   case 7:
    7460             :     // ITasm, t2IT
    7461        3587 :     printMandatoryPredicateOperand(MI, 0, STI, O);
    7462        3587 :     return;
    7463             :     break;
    7464          97 :   case 8:
    7465             :     // LDAEXD, LDREXD
    7466          97 :     printGPRPairOperand(MI, 0, STI, O);
    7467          97 :     O << ", ";
    7468          97 :     printAddrMode7Operand(MI, 1, STI, O);
    7469          97 :     return;
    7470             :     break;
    7471          28 :   case 9:
    7472             :     // LDC2L_OFFSET, LDC2_OFFSET, STC2L_OFFSET, STC2_OFFSET
    7473          28 :     printAddrMode5Operand<false>(MI, 2, STI, O);
    7474          28 :     return;
    7475             :     break;
    7476          34 :   case 10:
    7477             :     // LDC2L_OPTION, LDC2L_POST, LDC2_OPTION, LDC2_POST, STC2L_OPTION, STC2L_...
    7478          34 :     printAddrMode7Operand(MI, 2, STI, O);
    7479          34 :     O << ", ";
    7480          34 :     break;
    7481           8 :   case 11:
    7482             :     // LDC2L_PRE, LDC2_PRE, STC2L_PRE, STC2_PRE
    7483           8 :     printAddrMode5Operand<true>(MI, 2, STI, O);
    7484             :     O << '!';
    7485             :     return;
    7486             :     break;
    7487          67 :   case 12:
    7488             :     // MRC, t2MRC, t2MRC2
    7489          67 :     printPImmediate(MI, 1, STI, O);
    7490          67 :     O << ", ";
    7491          67 :     printOperand(MI, 2, STI, O);
    7492          67 :     O << ", ";
    7493          67 :     printOperand(MI, 0, STI, O);
    7494          67 :     O << ", ";
    7495          67 :     printCImmediate(MI, 3, STI, O);
    7496          67 :     O << ", ";
    7497          67 :     printCImmediate(MI, 4, STI, O);
    7498          67 :     O << ", ";
    7499          67 :     printOperand(MI, 5, STI, O);
    7500          67 :     return;
    7501             :     break;
    7502          43 :   case 13:
    7503             :     // MRRC, t2MRRC, t2MRRC2
    7504          43 :     printPImmediate(MI, 2, STI, O);
    7505          43 :     O << ", ";
    7506          43 :     printOperand(MI, 3, STI, O);
    7507          43 :     O << ", ";
    7508          43 :     printOperand(MI, 0, STI, O);
    7509          43 :     O << ", ";
    7510          43 :     printOperand(MI, 1, STI, O);
    7511          43 :     O << ", ";
    7512          43 :     printCImmediate(MI, 4, STI, O);
    7513          43 :     return;
    7514             :     break;
    7515         367 :   case 14:
    7516             :     // MSR, MSRi, t2MSR_AR, t2MSR_M
    7517         367 :     printMSRMaskOperand(MI, 0, STI, O);
    7518         367 :     O << ", ";
    7519         367 :     break;
    7520         132 :   case 15:
    7521             :     // MSRbanked, t2MSRbanked
    7522         132 :     printBankedRegOperand(MI, 0, STI, O);
    7523         132 :     O << ", ";
    7524         132 :     printOperand(MI, 1, STI, O);
    7525         132 :     return;
    7526             :     break;
    7527         423 :   case 16:
    7528             :     // VBICiv2i32, VBICiv4i16, VBICiv4i32, VBICiv8i16, VMOVv16i8, VMOVv1i64, ...
    7529         423 :     printNEONModImmOperand(MI, 1, STI, O);
    7530         423 :     return;
    7531             :     break;
    7532         114 :   case 17:
    7533             :     // VCMPEZD, VCMPEZH, VCMPEZS, VCMPZD, VCMPZH, VCMPZS, tRSB
    7534         114 :     O << ", #0";
    7535         114 :     return;
    7536             :     break;
    7537             :   case 18:
    7538             :     // VCVTf2sd, VCVTf2sq, VCVTf2ud, VCVTf2uq, VCVTh2sd, VCVTh2sq, VCVTh2ud, ...
    7539             :     return;
    7540             :     break;
    7541          41 :   case 19:
    7542             :     // VLD1DUPd16, VLD1DUPd16wb_fixed, VLD1DUPd16wb_register, VLD1DUPd32, VLD...
    7543          41 :     printVectorListOneAllLanes(MI, 0, STI, O);
    7544          41 :     O << ", ";
    7545          41 :     break;
    7546          78 :   case 20:
    7547             :     // VLD1DUPq16, VLD1DUPq16wb_fixed, VLD1DUPq16wb_register, VLD1DUPq32, VLD...
    7548          78 :     printVectorListTwoAllLanes(MI, 0, STI, O);
    7549          78 :     O << ", ";
    7550          78 :     break;
    7551         207 :   case 21:
    7552             :     // VLD1d16, VLD1d16wb_fixed, VLD1d16wb_register, VLD1d32, VLD1d32wb_fixed...
    7553         207 :     printVectorListOne(MI, 0, STI, O);
    7554         207 :     O << ", ";
    7555         207 :     break;
    7556         202 :   case 22:
    7557             :     // VLD1d16Q, VLD1d16Qwb_fixed, VLD1d16Qwb_register, VLD1d32Q, VLD1d32Qwb_...
    7558         202 :     printVectorListFour(MI, 0, STI, O);
    7559         202 :     O << ", ";
    7560         202 :     break;
    7561          61 :   case 23:
    7562             :     // VLD1d16T, VLD1d16Twb_fixed, VLD1d16Twb_register, VLD1d32T, VLD1d32Twb_...
    7563          61 :     printVectorListThree(MI, 0, STI, O);
    7564          61 :     O << ", ";
    7565          61 :     break;
    7566        2540 :   case 24:
    7567             :     // VLD1q16, VLD1q16wb_fixed, VLD1q16wb_register, VLD1q32, VLD1q32wb_fixed...
    7568        2540 :     printVectorListTwo(MI, 0, STI, O);
    7569        2540 :     O << ", ";
    7570        2540 :     break;
    7571          45 :   case 25:
    7572             :     // VLD2DUPd16x2, VLD2DUPd16x2wb_fixed, VLD2DUPd16x2wb_register, VLD2DUPd3...
    7573          45 :     printVectorListTwoSpacedAllLanes(MI, 0, STI, O);
    7574          45 :     O << ", ";
    7575          45 :     break;
    7576          45 :   case 26:
    7577             :     // VLD2b16, VLD2b16wb_fixed, VLD2b16wb_register, VLD2b32, VLD2b32wb_fixed...
    7578          45 :     printVectorListTwoSpaced(MI, 0, STI, O);
    7579          45 :     O << ", ";
    7580          45 :     break;
    7581           0 :   case 27:
    7582             :     // VLD3DUPdAsm_16, VLD3DUPdAsm_32, VLD3DUPdAsm_8, VLD3DUPdWB_fixed_Asm_16...
    7583           0 :     printVectorListThreeAllLanes(MI, 0, STI, O);
    7584           0 :     O << ", ";
    7585           0 :     printAddrMode6Operand(MI, 1, STI, O);
    7586           0 :     break;
    7587           0 :   case 28:
    7588             :     // VLD3DUPqAsm_16, VLD3DUPqAsm_32, VLD3DUPqAsm_8, VLD3DUPqWB_fixed_Asm_16...
    7589           0 :     printVectorListThreeSpacedAllLanes(MI, 0, STI, O);
    7590           0 :     O << ", ";
    7591           0 :     printAddrMode6Operand(MI, 1, STI, O);
    7592           0 :     break;
    7593           0 :   case 29:
    7594             :     // VLD3qAsm_16, VLD3qAsm_32, VLD3qAsm_8, VLD3qWB_fixed_Asm_16, VLD3qWB_fi...
    7595           0 :     printVectorListThreeSpaced(MI, 0, STI, O);
    7596           0 :     O << ", ";
    7597           0 :     printAddrMode6Operand(MI, 1, STI, O);
    7598           0 :     break;
    7599           0 :   case 30:
    7600             :     // VLD4DUPdAsm_16, VLD4DUPdAsm_32, VLD4DUPdAsm_8, VLD4DUPdWB_fixed_Asm_16...
    7601           0 :     printVectorListFourAllLanes(MI, 0, STI, O);
    7602           0 :     O << ", ";
    7603           0 :     printAddrMode6Operand(MI, 1, STI, O);
    7604           0 :     break;
    7605           0 :   case 31:
    7606             :     // VLD4DUPqAsm_16, VLD4DUPqAsm_32, VLD4DUPqAsm_8, VLD4DUPqWB_fixed_Asm_16...
    7607           0 :     printVectorListFourSpacedAllLanes(MI, 0, STI, O);
    7608           0 :     O << ", ";
    7609           0 :     printAddrMode6Operand(MI, 1, STI, O);
    7610           0 :     break;
    7611           0 :   case 32:
    7612             :     // VLD4qAsm_16, VLD4qAsm_32, VLD4qAsm_8, VLD4qWB_fixed_Asm_16, VLD4qWB_fi...
    7613           0 :     printVectorListFourSpaced(MI, 0, STI, O);
    7614           0 :     O << ", ";
    7615           0 :     printAddrMode6Operand(MI, 1, STI, O);
    7616           0 :     break;
    7617         311 :   case 33:
    7618             :     // VST1LNd16_UPD, VST1LNd32_UPD, VST1LNd8_UPD, VST2LNd16_UPD, VST2LNd32_U...
    7619         311 :     printOperand(MI, 4, STI, O);
    7620         311 :     break;
    7621          53 :   case 34:
    7622             :     // VST1d16, VST1d32, VST1d64, VST1d8
    7623          53 :     printVectorListOne(MI, 2, STI, O);
    7624          53 :     O << ", ";
    7625          53 :     printAddrMode6Operand(MI, 0, STI, O);
    7626          53 :     return;
    7627             :     break;
    7628          80 :   case 35:
    7629             :     // VST1d16Q, VST1d32Q, VST1d64Q, VST1d8Q, VST2q16, VST2q32, VST2q8
    7630          80 :     printVectorListFour(MI, 2, STI, O);
    7631          80 :     O << ", ";
    7632          80 :     printAddrMode6Operand(MI, 0, STI, O);
    7633          80 :     return;
    7634             :     break;
    7635          66 :   case 36:
    7636             :     // VST1d16Qwb_fixed, VST1d32Qwb_fixed, VST1d64Qwb_fixed, VST1d8Qwb_fixed,...
    7637          66 :     printVectorListFour(MI, 3, STI, O);
    7638          66 :     O << ", ";
    7639          66 :     printAddrMode6Operand(MI, 1, STI, O);
    7640             :     O << '!';
    7641             :     return;
    7642             :     break;
    7643          33 :   case 37:
    7644             :     // VST1d16Qwb_register, VST1d32Qwb_register, VST1d64Qwb_register, VST1d8Q...
    7645          33 :     printVectorListFour(MI, 4, STI, O);
    7646          33 :     O << ", ";
    7647          33 :     printAddrMode6Operand(MI, 1, STI, O);
    7648          33 :     O << ", ";
    7649          33 :     printOperand(MI, 3, STI, O);
    7650          33 :     return;
    7651             :     break;
    7652          10 :   case 38:
    7653             :     // VST1d16T, VST1d32T, VST1d64T, VST1d8T
    7654          10 :     printVectorListThree(MI, 2, STI, O);
    7655          10 :     O << ", ";
    7656          10 :     printAddrMode6Operand(MI, 0, STI, O);
    7657          10 :     return;
    7658             :     break;
    7659          18 :   case 39:
    7660             :     // VST1d16Twb_fixed, VST1d32Twb_fixed, VST1d64Twb_fixed, VST1d8Twb_fixed
    7661          18 :     printVectorListThree(MI, 3, STI, O);
    7662          18 :     O << ", ";
    7663          18 :     printAddrMode6Operand(MI, 1, STI, O);
    7664             :     O << '!';
    7665             :     return;
    7666             :     break;
    7667          17 :   case 40:
    7668             :     // VST1d16Twb_register, VST1d32Twb_register, VST1d64Twb_register, VST1d8T...
    7669          17 :     printVectorListThree(MI, 4, STI, O);
    7670          17 :     O << ", ";
    7671          17 :     printAddrMode6Operand(MI, 1, STI, O);
    7672          17 :     O << ", ";
    7673          17 :     printOperand(MI, 3, STI, O);
    7674          17 :     return;
    7675             :     break;
    7676          77 :   case 41:
    7677             :     // VST1d16wb_fixed, VST1d32wb_fixed, VST1d64wb_fixed, VST1d8wb_fixed
    7678          77 :     printVectorListOne(MI, 3, STI, O);
    7679          77 :     O << ", ";
    7680          77 :     printAddrMode6Operand(MI, 1, STI, O);
    7681             :     O << '!';
    7682             :     return;
    7683             :     break;
    7684          26 :   case 42:
    7685             :     // VST1d16wb_register, VST1d32wb_register, VST1d64wb_register, VST1d8wb_r...
    7686          26 :     printVectorListOne(MI, 4, STI, O);
    7687          26 :     O << ", ";
    7688          26 :     printAddrMode6Operand(MI, 1, STI, O);
    7689          26 :     O << ", ";
    7690          26 :     printOperand(MI, 3, STI, O);
    7691          26 :     return;
    7692             :     break;
    7693        1378 :   case 43:
    7694             :     // VST1q16, VST1q32, VST1q64, VST1q8, VST2d16, VST2d32, VST2d8
    7695        1378 :     printVectorListTwo(MI, 2, STI, O);
    7696        1378 :     O << ", ";
    7697        1378 :     printAddrMode6Operand(MI, 0, STI, O);
    7698        1378 :     return;
    7699             :     break;
    7700         124 :   case 44:
    7701             :     // VST1q16wb_fixed, VST1q32wb_fixed, VST1q64wb_fixed, VST1q8wb_fixed, VST...
    7702         124 :     printVectorListTwo(MI, 3, STI, O);
    7703         124 :     O << ", ";
    7704         124 :     printAddrMode6Operand(MI, 1, STI, O);
    7705             :     O << '!';
    7706             :     return;
    7707             :     break;
    7708          61 :   case 45:
    7709             :     // VST1q16wb_register, VST1q32wb_register, VST1q64wb_register, VST1q8wb_r...
    7710          61 :     printVectorListTwo(MI, 4, STI, O);
    7711          61 :     O << ", ";
    7712          61 :     printAddrMode6Operand(MI, 1, STI, O);
    7713          61 :     O << ", ";
    7714          61 :     printOperand(MI, 3, STI, O);
    7715          61 :     return;
    7716             :     break;
    7717          14 :   case 46:
    7718             :     // VST2b16, VST2b32, VST2b8
    7719          14 :     printVectorListTwoSpaced(MI, 2, STI, O);
    7720          14 :     O << ", ";
    7721          14 :     printAddrMode6Operand(MI, 0, STI, O);
    7722          14 :     return;
    7723             :     break;
    7724          12 :   case 47:
    7725             :     // VST2b16wb_fixed, VST2b32wb_fixed, VST2b8wb_fixed
    7726          12 :     printVectorListTwoSpaced(MI, 3, STI, O);
    7727          12 :     O << ", ";
    7728          12 :     printAddrMode6Operand(MI, 1, STI, O);
    7729             :     O << '!';
    7730             :     return;
    7731             :     break;
    7732          13 :   case 48:
    7733             :     // VST2b16wb_register, VST2b32wb_register, VST2b8wb_register
    7734          13 :     printVectorListTwoSpaced(MI, 4, STI, O);
    7735          13 :     O << ", ";
    7736          13 :     printAddrMode6Operand(MI, 1, STI, O);
    7737          13 :     O << ", ";
    7738          13 :     printOperand(MI, 3, STI, O);
    7739          13 :     return;
    7740             :     break;
    7741         333 :   case 49:
    7742             :     // t2DMB, t2DSB
    7743         333 :     printMemBOption(MI, 0, STI, O);
    7744         333 :     return;
    7745             :     break;
    7746          22 :   case 50:
    7747             :     // t2ISB
    7748          22 :     printInstSyncBOption(MI, 0, STI, O);
    7749          22 :     return;
    7750             :     break;
    7751          53 :   case 51:
    7752             :     // t2PLDWi12, t2PLDi12, t2PLIi12
    7753          53 :     printAddrModeImm12Operand<false>(MI, 0, STI, O);
    7754          53 :     return;
    7755             :     break;
    7756          24 :   case 52:
    7757             :     // t2PLDWi8, t2PLDi8, t2PLIi8
    7758          24 :     printT2AddrModeImm8Operand<false>(MI, 0, STI, O);
    7759          24 :     return;
    7760             :     break;
    7761          60 :   case 53:
    7762             :     // t2PLDWs, t2PLDs, t2PLIs
    7763          60 :     printT2AddrModeSoRegOperand(MI, 0, STI, O);
    7764          60 :     return;
    7765             :     break;
    7766          39 :   case 54:
    7767             :     // t2PLDpci, t2PLIpci
    7768          39 :     printThumbLdrLabelOperand(MI, 0, STI, O);
    7769          39 :     return;
    7770             :     break;
    7771          25 :   case 55:
    7772             :     // t2TBB
    7773          25 :     printAddrModeTBB(MI, 0, STI, O);
    7774          25 :     return;
    7775             :     break;
    7776           9 :   case 56:
    7777             :     // t2TBH
    7778           9 :     printAddrModeTBH(MI, 0, STI, O);
    7779           9 :     return;
    7780             :     break;
    7781        3029 :   case 57:
    7782             :     // tADC, tADDi8, tAND, tASRrr, tBIC, tEOR, tLSLrr, tLSRrr, tORR, tROR, tS...
    7783        3029 :     printOperand(MI, 3, STI, O);
    7784        3029 :     return;
    7785             :     break;
    7786        3048 :   case 58:
    7787             :     // tPOP, tPUSH
    7788        3048 :     printRegisterList(MI, 2, STI, O);
    7789        3048 :     return;
    7790             :     break;
    7791             :   }
    7792             : 
    7793             : 
    7794             :   // Fragment 3 encoded into 5 bits for 30 unique commands.
    7795      103321 :   switch ((Bits >> 30) & 31) {
    7796           0 :   default: llvm_unreachable("Invalid command number.");
    7797       80309 :   case 0:
    7798             :     // ADCri, ADCrr, ADCrsi, ADDri, ADDrr, ADDrsi, ADR, ANDri, ANDrr, ANDrsi,...
    7799       80309 :     O << ", ";
    7800       80309 :     break;
    7801             :   case 1:
    7802             :     // AESD, AESE, AESIMC, AESMC, BLX_pred, BL_pred, BXJ, BX_pred, Bcc, CPS2p...
    7803             :     return;
    7804             :     break;
    7805        5659 :   case 2:
    7806             :     // CDP, MCR, MCRR, MSR, VABDfd, VABDfq, VABDhd, VABDhq, VABSD, VABSH, VAB...
    7807        5659 :     printOperand(MI, 1, STI, O);
    7808        5659 :     break;
    7809         210 :   case 3:
    7810             :     // FCONSTD, FCONSTH, FCONSTS, VMOVv2f32, VMOVv4f32
    7811         210 :     printFPImmOperand(MI, 1, STI, O);
    7812         210 :     return;
    7813             :     break;
    7814         376 :   case 4:
    7815             :     // FLDMXDB_UPD, FLDMXIA_UPD, FSTMXDB_UPD, FSTMXIA_UPD, LDMDA_UPD, LDMDB_U...
    7816         376 :     O << "!, ";
    7817         376 :     printRegisterList(MI, 4, STI, O);
    7818         376 :     break;
    7819          13 :   case 5:
    7820             :     // LDC2L_OPTION, LDC2_OPTION, STC2L_OPTION, STC2_OPTION
    7821          13 :     printCoprocOptionImm(MI, 3, STI, O);
    7822          13 :     return;
    7823             :     break;
    7824          21 :   case 6:
    7825             :     // LDC2L_POST, LDC2_POST, STC2L_POST, STC2_POST
    7826          21 :     printPostIdxImm8s4Operand(MI, 3, STI, O);
    7827          21 :     return;
    7828             :     break;
    7829         712 :   case 7:
    7830             :     // LDCL_OFFSET, LDCL_OPTION, LDCL_POST, LDCL_PRE, LDC_OFFSET, LDC_OPTION,...
    7831         712 :     printCImmediate(MI, 1, STI, O);
    7832         712 :     O << ", ";
    7833         712 :     break;
    7834          20 :   case 8:
    7835             :     // MRS, t2MRS_AR
    7836          20 :     O << ", apsr";
    7837          20 :     return;
    7838             :     break;
    7839           9 :   case 9:
    7840             :     // MRSsys, t2MRSsys_AR
    7841           9 :     O << ", spsr";
    7842           9 :     return;
    7843             :     break;
    7844          63 :   case 10:
    7845             :     // MSRi
    7846          63 :     printModImmOperand(MI, 1, STI, O);
    7847          63 :     return;
    7848             :     break;
    7849          27 :   case 11:
    7850             :     // VCEQzv16i8, VCEQzv2i32, VCEQzv4i16, VCEQzv4i32, VCEQzv8i16, VCEQzv8i8,...
    7851          27 :     O << ", #0";
    7852          27 :     return;
    7853             :     break;
    7854         406 :   case 12:
    7855             :     // VCVTf2xsd, VCVTf2xsq, VCVTf2xud, VCVTf2xuq, VCVTh2xsd, VCVTh2xsq, VCVT...
    7856         406 :     printOperand(MI, 2, STI, O);
    7857         406 :     break;
    7858          68 :   case 13:
    7859             :     // VGETLNs16, VGETLNs8, VGETLNu16, VGETLNu8
    7860          68 :     printVectorIndex(MI, 2, STI, O);
    7861          68 :     return;
    7862             :     break;
    7863        2605 :   case 14:
    7864             :     // VLD1DUPd16, VLD1DUPd32, VLD1DUPd8, VLD1DUPq16, VLD1DUPq32, VLD1DUPq8, ...
    7865        2605 :     printAddrMode6Operand(MI, 1, STI, O);
    7866        2605 :     break;
    7867         614 :   case 15:
    7868             :     // VLD1DUPd16wb_fixed, VLD1DUPd16wb_register, VLD1DUPd32wb_fixed, VLD1DUP...
    7869         614 :     printAddrMode6Operand(MI, 2, STI, O);
    7870         614 :     break;
    7871         762 :   case 16:
    7872             :     // VLD1LNd16, VLD1LNd16_UPD, VLD1LNd32, VLD1LNd32_UPD, VLD1LNd8, VLD1LNd8...
    7873             :     O << '[';
    7874             :     break;
    7875         143 :   case 17:
    7876             :     // VLD3DUPd16, VLD3DUPd16_UPD, VLD3DUPd32, VLD3DUPd32_UPD, VLD3DUPd8, VLD...
    7877         143 :     O << "[], ";
    7878         143 :     printOperand(MI, 1, STI, O);
    7879         143 :     O << "[], ";
    7880         143 :     printOperand(MI, 2, STI, O);
    7881         143 :     break;
    7882           2 :   case 18:
    7883             :     // VLD3DUPdWB_fixed_Asm_16, VLD3DUPdWB_fixed_Asm_32, VLD3DUPdWB_fixed_Asm...
    7884             :     O << '!';
    7885             :     return;
    7886             :     break;
    7887          11 :   case 19:
    7888             :     // VMRS
    7889          11 :     O << ", fpscr";
    7890          11 :     return;
    7891             :     break;
    7892           2 :   case 20:
    7893             :     // VMRS_FPEXC
    7894           2 :     O << ", fpexc";
    7895           2 :     return;
    7896             :     break;
    7897           2 :   case 21:
    7898             :     // VMRS_FPINST
    7899           2 :     O << ", fpinst";
    7900           2 :     return;
    7901             :     break;
    7902           2 :   case 22:
    7903             :     // VMRS_FPINST2
    7904           2 :     O << ", fpinst2";
    7905           2 :     return;
    7906             :     break;
    7907           4 :   case 23:
    7908             :     // VMRS_FPSID
    7909           4 :     O << ", fpsid";
    7910           4 :     return;
    7911             :     break;
    7912           1 :   case 24:
    7913             :     // VMRS_MVFR0
    7914           1 :     O << ", mvfr0";
    7915           1 :     return;
    7916             :     break;
    7917           1 :   case 25:
    7918             :     // VMRS_MVFR1
    7919           1 :     O << ", mvfr1";
    7920           1 :     return;
    7921             :     break;
    7922           4 :   case 26:
    7923             :     // VMRS_MVFR2
    7924           4 :     O << ", mvfr2";
    7925           4 :     return;
    7926             :     break;
    7927         231 :   case 27:
    7928             :     // VSETLNi16, VSETLNi32, VSETLNi8
    7929         231 :     printVectorIndex(MI, 3, STI, O);
    7930         231 :     O << ", ";
    7931         231 :     printOperand(MI, 2, STI, O);
    7932         231 :     return;
    7933             :     break;
    7934          16 :   case 28:
    7935             :     // VSHTOH, VTOSHH, VTOUHH, VUHTOH
    7936          16 :     printFBits16(MI, 2, STI, O);
    7937          16 :     return;
    7938             :     break;
    7939          24 :   case 29:
    7940             :     // VSLTOD, VSLTOH, VSLTOS, VTOSLD, VTOSLH, VTOSLS, VTOULD, VTOULH, VTOULS...
    7941          24 :     printFBits32(MI, 2, STI, O);
    7942          24 :     return;
    7943             :     break;
    7944             :   }
    7945             : 
    7946             : 
    7947             :   // Fragment 4 encoded into 7 bits for 65 unique commands.
    7948       91586 :   switch ((Bits >> 35) & 127) {
    7949           0 :   default: llvm_unreachable("Invalid command number.");
    7950       38801 :   case 0:
    7951             :     // ADCri, ADCrr, ADCrsi, ADDri, ADDrr, ADDrsi, ANDri, ANDrr, ANDrsi, ASRi...
    7952       38801 :     printOperand(MI, 1, STI, O);
    7953       38801 :     break;
    7954         234 :   case 1:
    7955             :     // ADR, t2ADR
    7956         234 :     printAdrLabelOperand<0>(MI, 1, STI, O);
    7957         234 :     return;
    7958             :     break;
    7959         213 :   case 2:
    7960             :     // BFC, t2BFC
    7961         213 :     printBitfieldInvMaskImmOperand(MI, 2, STI, O);
    7962         213 :     return;
    7963             :     break;
    7964        6695 :   case 3:
    7965             :     // BFI, CPS3p, CRC32B, CRC32CB, CRC32CH, CRC32CW, CRC32H, CRC32W, MOVTi16...
    7966        6695 :     printOperand(MI, 2, STI, O);
    7967        6695 :     break;
    7968        2817 :   case 4:
    7969             :     // CDP, MCR, MCRR, VABDfd, VABDfq, VABDhd, VABDhq, VACGEfd, VACGEfq, VACG...
    7970        2817 :     O << ", ";
    7971        2817 :     break;
    7972        3798 :   case 5:
    7973             :     // CMNri, CMPri, MOVi, MVNi, TEQri, TSTri
    7974        3798 :     printModImmOperand(MI, 1, STI, O);
    7975        3798 :     return;
    7976             :     break;
    7977         100 :   case 6:
    7978             :     // CMNzrsi, CMPrsi, MOVsi, MVNsi, TEQrsi, TSTrsi
    7979         100 :     printSORegImmOperand(MI, 1, STI, O);
    7980         100 :     return;
    7981             :     break;
    7982          68 :   case 7:
    7983             :     // CMNzrsr, CMPrsr, MOVsr, MVNsr, TEQrsr, TSTrsr, t2MOVSsr, t2MOVsr
    7984          68 :     printSORegRegOperand(MI, 1, STI, O);
    7985          68 :     return;
    7986             :     break;
    7987             :   case 8:
    7988             :     // FLDMXDB_UPD, FLDMXIA_UPD, FSTMXDB_UPD, FSTMXIA_UPD, LDMDA_UPD, LDMDB_U...
    7989             :     return;
    7990             :     break;
    7991         589 :   case 9:
    7992             :     // FLDMXIA, FSTMXIA, LDMDA, LDMDB, LDMIA, LDMIB, STMDA, STMDB, STMIA, STM...
    7993         589 :     printRegisterList(MI, 3, STI, O);
    7994         589 :     break;
    7995         292 :   case 10:
    7996             :     // LDA, LDAB, LDAEX, LDAEXB, LDAEXH, LDAH, LDRBT_POST, LDREX, LDREXB, LDR...
    7997         292 :     printAddrMode7Operand(MI, 1, STI, O);
    7998         292 :     return;
    7999             :     break;
    8000         248 :   case 11:
    8001             :     // LDCL_OFFSET, LDC_OFFSET, STCL_OFFSET, STC_OFFSET, t2LDC2L_OFFSET, t2LD...
    8002         248 :     printAddrMode5Operand<false>(MI, 2, STI, O);
    8003         248 :     return;
    8004             :     break;
    8005        3752 :   case 12:
    8006             :     // LDCL_OPTION, LDCL_POST, LDC_OPTION, LDC_POST, LDRBT_POST_IMM, LDRBT_PO...
    8007        3752 :     printAddrMode7Operand(MI, 2, STI, O);
    8008        3752 :     break;
    8009         166 :   case 13:
    8010             :     // LDCL_PRE, LDC_PRE, STCL_PRE, STC_PRE, t2LDC2L_PRE, t2LDC2_PRE, t2LDCL_...
    8011         166 :     printAddrMode5Operand<true>(MI, 2, STI, O);
    8012             :     O << '!';
    8013             :     return;
    8014             :     break;
    8015          50 :   case 14:
    8016             :     // LDRB_PRE_IMM, LDR_PRE_IMM, STRB_PRE_IMM, STR_PRE_IMM
    8017          50 :     printAddrModeImm12Operand<true>(MI, 2, STI, O);
    8018             :     O << '!';
    8019             :     return;
    8020             :     break;
    8021          35 :   case 15:
    8022             :     // LDRB_PRE_REG, LDR_PRE_REG, STRB_PRE_REG, STR_PRE_REG
    8023          35 :     printAddrMode2Operand(MI, 2, STI, O);
    8024             :     O << '!';
    8025             :     return;
    8026             :     break;
    8027        7370 :   case 16:
    8028             :     // LDRBi12, LDRcp, LDRi12, STRBi12, STRi12, t2LDRBi12, t2LDRHi12, t2LDRSB...
    8029        7370 :     printAddrModeImm12Operand<false>(MI, 1, STI, O);
    8030        7370 :     return;
    8031             :     break;
    8032         403 :   case 17:
    8033             :     // LDRBrs, LDRrs, STRBrs, STRrs
    8034         403 :     printAddrMode2Operand(MI, 1, STI, O);
    8035         403 :     return;
    8036             :     break;
    8037         682 :   case 18:
    8038             :     // LDRH, LDRSB, LDRSH, STRH
    8039         682 :     printAddrMode3Operand<false>(MI, 1, STI, O);
    8040         682 :     return;
    8041             :     break;
    8042          33 :   case 19:
    8043             :     // LDRH_PRE, LDRSB_PRE, LDRSH_PRE, STRH_PRE
    8044          33 :     printAddrMode3Operand<true>(MI, 2, STI, O);
    8045             :     O << '!';
    8046             :     return;
    8047             :     break;
    8048          10 :   case 20:
    8049             :     // MCR2
    8050          10 :     printCImmediate(MI, 3, STI, O);
    8051          10 :     O << ", ";
    8052          10 :     printCImmediate(MI, 4, STI, O);
    8053          10 :     O << ", ";
    8054          10 :     printOperand(MI, 5, STI, O);
    8055          10 :     return;
    8056             :     break;
    8057        2417 :   case 21:
    8058             :     // MCRR2, SHA1C, SHA1M, SHA1P, SHA1SU0, SHA256H, SHA256H2, SHA256SU1, VAB...
    8059        2417 :     printOperand(MI, 3, STI, O);
    8060        2417 :     break;
    8061         132 :   case 22:
    8062             :     // MRSbanked, t2MRSbanked
    8063         132 :     printBankedRegOperand(MI, 1, STI, O);
    8064         132 :     return;
    8065             :     break;
    8066         101 :   case 23:
    8067             :     // SSAT, SSAT16, t2SSAT, t2SSAT16
    8068         101 :     printImmPlusOneOperand(MI, 1, STI, O);
    8069         101 :     O << ", ";
    8070         101 :     printOperand(MI, 2, STI, O);
    8071         101 :     break;
    8072          73 :   case 24:
    8073             :     // STLEXD, STREXD
    8074          73 :     printGPRPairOperand(MI, 1, STI, O);
    8075          73 :     O << ", ";
    8076          73 :     printAddrMode7Operand(MI, 2, STI, O);
    8077          73 :     return;
    8078             :     break;
    8079          41 :   case 25:
    8080             :     // VCEQzv2f32, VCEQzv4f16, VCEQzv4f32, VCEQzv8f16, VCGEzv2f32, VCGEzv4f16...
    8081          41 :     O << ", #0";
    8082          41 :     return;
    8083             :     break;
    8084         371 :   case 26:
    8085             :     // VLD1DUPd16wb_fixed, VLD1DUPd32wb_fixed, VLD1DUPd8wb_fixed, VLD1DUPq16w...
    8086             :     O << '!';
    8087             :     return;
    8088             :     break;
    8089         183 :   case 27:
    8090             :     // VLD1LNd16, VLD1LNd32, VLD1LNd8, VST2LNd16, VST2LNd32, VST2LNd8, VST2LN...
    8091         183 :     printNoHashImmediate(MI, 4, STI, O);
    8092         183 :     break;
    8093         156 :   case 28:
    8094             :     // VLD1LNd16_UPD, VLD1LNd32_UPD, VLD1LNd8_UPD, VLD2LNd16, VLD2LNd32, VLD2...
    8095         156 :     printNoHashImmediate(MI, 6, STI, O);
    8096         156 :     break;
    8097           0 :   case 29:
    8098             :     // VLD1LNdAsm_16, VLD1LNdAsm_32, VLD1LNdAsm_8, VLD1LNdWB_fixed_Asm_16, VL...
    8099           0 :     printAddrMode6Operand(MI, 2, STI, O);
    8100           0 :     break;
    8101         121 :   case 30:
    8102             :     // VLD2LNd16_UPD, VLD2LNd32_UPD, VLD2LNd8_UPD, VLD2LNq16_UPD, VLD2LNq32_U...
    8103         121 :     printNoHashImmediate(MI, 8, STI, O);
    8104         121 :     O << "], ";
    8105         121 :     break;
    8106          56 :   case 31:
    8107             :     // VLD3DUPd16, VLD3DUPd16_UPD, VLD3DUPd32, VLD3DUPd32_UPD, VLD3DUPd8, VLD...
    8108          56 :     O << "[]}, ";
    8109          56 :     break;
    8110          69 :   case 32:
    8111             :     // VLD3LNd16_UPD, VLD3LNd32_UPD, VLD3LNd8_UPD, VLD3LNq16_UPD, VLD3LNq32_U...
    8112          69 :     printNoHashImmediate(MI, 10, STI, O);
    8113          69 :     O << "], ";
    8114          69 :     printOperand(MI, 1, STI, O);
    8115          69 :     O << '[';
    8116          69 :     printNoHashImmediate(MI, 10, STI, O);
    8117          69 :     O << "], ";
    8118          69 :     printOperand(MI, 2, STI, O);
    8119          69 :     O << '[';
    8120          69 :     printNoHashImmediate(MI, 10, STI, O);
    8121          69 :     break;
    8122          87 :   case 33:
    8123             :     // VLD4DUPd16, VLD4DUPd16_UPD, VLD4DUPd32, VLD4DUPd32_UPD, VLD4DUPd8, VLD...
    8124          87 :     O << "[], ";
    8125          87 :     printOperand(MI, 3, STI, O);
    8126          87 :     O << "[]}, ";
    8127          87 :     break;
    8128          39 :   case 34:
    8129             :     // VLD4LNd16_UPD, VLD4LNd32_UPD, VLD4LNd8_UPD, VLD4LNq16_UPD, VLD4LNq32_U...
    8130          39 :     printNoHashImmediate(MI, 12, STI, O);
    8131          39 :     O << "], ";
    8132          39 :     printOperand(MI, 1, STI, O);
    8133          39 :     O << '[';
    8134          39 :     printNoHashImmediate(MI, 12, STI, O);
    8135          39 :     O << "], ";
    8136          39 :     printOperand(MI, 2, STI, O);
    8137          39 :     O << '[';
    8138          39 :     printNoHashImmediate(MI, 12, STI, O);
    8139          39 :     O << "], ";
    8140          39 :     printOperand(MI, 3, STI, O);
    8141          39 :     O << '[';
    8142          39 :     printNoHashImmediate(MI, 12, STI, O);
    8143          39 :     O << "]}, ";
    8144          39 :     printAddrMode6Operand(MI, 5, STI, O);
    8145          39 :     printAddrMode6OffsetOperand(MI, 7, STI, O);
    8146          39 :     return;
    8147             :     break;
    8148        4208 :   case 35:
    8149             :     // VLDRD, VLDRS, VSTRD, VSTRS
    8150        4208 :     printAddrMode5Operand<false>(MI, 1, STI, O);
    8151        4208 :     return;
    8152             :     break;
    8153          32 :   case 36:
    8154             :     // VLDRH, VSTRH
    8155          32 :     printAddrMode5FP16Operand<false>(MI, 1, STI, O);
    8156          32 :     return;
    8157             :     break;
    8158          98 :   case 37:
    8159             :     // VST1LNd16, VST1LNd32, VST1LNd8
    8160          98 :     printNoHashImmediate(MI, 3, STI, O);
    8161          98 :     O << "]}, ";
    8162          98 :     printAddrMode6Operand(MI, 0, STI, O);
    8163          98 :     return;
    8164             :     break;
    8165          75 :   case 38:
    8166             :     // VST1LNd16_UPD, VST1LNd32_UPD, VST1LNd8_UPD, VST3LNd16, VST3LNd32, VST3...
    8167          75 :     printNoHashImmediate(MI, 5, STI, O);
    8168          75 :     break;
    8169          21 :   case 39:
    8170             :     // VST3LNd16_UPD, VST3LNd32_UPD, VST3LNd8_UPD, VST3LNq16_UPD, VST3LNq32_U...
    8171          21 :     printNoHashImmediate(MI, 7, STI, O);
    8172          21 :     O << "], ";
    8173          21 :     printOperand(MI, 5, STI, O);
    8174          21 :     O << '[';
    8175          21 :     printNoHashImmediate(MI, 7, STI, O);
    8176          21 :     O << "], ";
    8177          21 :     printOperand(MI, 6, STI, O);
    8178          21 :     O << '[';
    8179          21 :     printNoHashImmediate(MI, 7, STI, O);
    8180          21 :     O << "]}, ";
    8181          21 :     printAddrMode6Operand(MI, 1, STI, O);
    8182          21 :     printAddrMode6OffsetOperand(MI, 3, STI, O);
    8183          21 :     return;
    8184             :     break;
    8185         178 :   case 40:
    8186             :     // VST3d16_UPD, VST3d32_UPD, VST3d8_UPD, VST3q16_UPD, VST3q32_UPD, VST3q8...
    8187         178 :     printOperand(MI, 5, STI, O);
    8188         178 :     O << ", ";
    8189         178 :     printOperand(MI, 6, STI, O);
    8190         178 :     break;
    8191          10 :   case 41:
    8192             :     // VTBL1
    8193          10 :     printVectorListOne(MI, 1, STI, O);
    8194          10 :     O << ", ";
    8195          10 :     printOperand(MI, 2, STI, O);
    8196          10 :     return;
    8197             :     break;
    8198          10 :   case 42:
    8199             :     // VTBL2
    8200          10 :     printVectorListTwo(MI, 1, STI, O);
    8201          10 :     O << ", ";
    8202          10 :     printOperand(MI, 2, STI, O);
    8203          10 :     return;
    8204             :     break;
    8205           5 :   case 43:
    8206             :     // VTBL3
    8207           5 :     printVectorListThree(MI, 1, STI, O);
    8208           5 :     O << ", ";
    8209           5 :     printOperand(MI, 2, STI, O);
    8210           5 :     return;
    8211             :     break;
    8212           5 :   case 44:
    8213             :     // VTBL4
    8214           5 :     printVectorListFour(MI, 1, STI, O);
    8215           5 :     O << ", ";
    8216           5 :     printOperand(MI, 2, STI, O);
    8217           5 :     return;
    8218             :     break;
    8219           5 :   case 45:
    8220             :     // VTBX1
    8221           5 :     printVectorListOne(MI, 2, STI, O);
    8222           5 :     O << ", ";
    8223           5 :     printOperand(MI, 3, STI, O);
    8224           5 :     return;
    8225             :     break;
    8226           5 :   case 46:
    8227             :     // VTBX2
    8228           5 :     printVectorListTwo(MI, 2, STI, O);
    8229           5 :     O << ", ";
    8230           5 :     printOperand(MI, 3, STI, O);
    8231           5 :     return;
    8232             :     break;
    8233           6 :   case 47:
    8234             :     // VTBX3
    8235           6 :     printVectorListThree(MI, 2, STI, O);
    8236           6 :     O << ", ";
    8237           6 :     printOperand(MI, 3, STI, O);
    8238           6 :     return;
    8239             :     break;
    8240           6 :   case 48:
    8241             :     // VTBX4
    8242           6 :     printVectorListFour(MI, 2, STI, O);
    8243           6 :     O << ", ";
    8244           6 :     printOperand(MI, 3, STI, O);
    8245           6 :     return;
    8246             :     break;
    8247           6 :   case 49:
    8248             :     // sysLDMDA_UPD, sysLDMDB_UPD, sysLDMIA_UPD, sysLDMIB_UPD, sysSTMDA_UPD, ...
    8249           6 :     O << " ^";
    8250           6 :     return;
    8251             :     break;
    8252          98 :   case 50:
    8253             :     // t2CMNzrs, t2CMPrs, t2MOVSsi, t2MOVsi, t2MVNs, t2TEQrs, t2TSTrs
    8254          98 :     printT2SOOperand(MI, 1, STI, O);
    8255          98 :     return;
    8256             :     break;
    8257         164 :   case 51:
    8258             :     // t2LDRBT, t2LDRBi8, t2LDRHT, t2LDRHi8, t2LDRSBT, t2LDRSBi8, t2LDRSHT, t...
    8259         164 :     printT2AddrModeImm8Operand<false>(MI, 1, STI, O);
    8260         164 :     return;
    8261             :     break;
    8262         166 :   case 52:
    8263             :     // t2LDRB_PRE, t2LDRH_PRE, t2LDRSB_PRE, t2LDRSH_PRE, t2LDR_PRE, t2STRB_PR...
    8264         166 :     printT2AddrModeImm8Operand<true>(MI, 2, STI, O);
    8265             :     O << '!';
    8266             :     return;
    8267             :     break;
    8268        1128 :   case 53:
    8269             :     // t2LDRBpci, t2LDRHpci, t2LDRSBpci, t2LDRSHpci, t2LDRpci, tLDRpci
    8270        1128 :     printThumbLdrLabelOperand(MI, 1, STI, O);
    8271        1128 :     return;
    8272             :     break;
    8273         331 :   case 54:
    8274             :     // t2LDRBs, t2LDRHs, t2LDRSBs, t2LDRSHs, t2LDRs, t2STRBs, t2STRHs, t2STRs
    8275         331 :     printT2AddrModeSoRegOperand(MI, 1, STI, O);
    8276         331 :     return;
    8277             :     break;
    8278          60 :   case 55:
    8279             :     // t2LDREX
    8280          60 :     printT2AddrModeImm0_1020s4Operand(MI, 1, STI, O);
    8281          60 :     return;
    8282             :     break;
    8283         139 :   case 56:
    8284             :     // t2MRS_M
    8285         139 :     printMSRMaskOperand(MI, 1, STI, O);
    8286         139 :     return;
    8287             :     break;
    8288        1489 :   case 57:
    8289             :     // tADDspi, tSUBspi
    8290        1489 :     printThumbS4ImmOperand(MI, 2, STI, O);
    8291        1489 :     return;
    8292             :     break;
    8293         128 :   case 58:
    8294             :     // tADR
    8295         128 :     printAdrLabelOperand<2>(MI, 1, STI, O);
    8296         128 :     return;
    8297             :     break;
    8298         366 :   case 59:
    8299             :     // tASRri, tLSRri
    8300         366 :     printThumbSRImm(MI, 3, STI, O);
    8301         366 :     return;
    8302             :     break;
    8303        1252 :   case 60:
    8304             :     // tLDRBi, tSTRBi
    8305        1252 :     printThumbAddrModeImm5S1Operand(MI, 1, STI, O);
    8306        1252 :     return;
    8307             :     break;
    8308         355 :   case 61:
    8309             :     // tLDRBr, tLDRHr, tLDRSB, tLDRSH, tLDRr, tSTRBr, tSTRHr, tSTRr
    8310         355 :     printThumbAddrModeRROperand(MI, 1, STI, O);
    8311         355 :     return;
    8312             :     break;
    8313         544 :   case 62:
    8314             :     // tLDRHi, tSTRHi
    8315         544 :     printThumbAddrModeImm5S2Operand(MI, 1, STI, O);
    8316         544 :     return;
    8317             :     break;
    8318        2280 :   case 63:
    8319             :     // tLDRi, tSTRi
    8320        2280 :     printThumbAddrModeImm5S4Operand(MI, 1, STI, O);
    8321        2280 :     return;
    8322             :     break;
    8323        1789 :   case 64:
    8324             :     // tLDRspi, tSTRspi
    8325        1789 :     printThumbAddrModeSPOperand(MI, 1, STI, O);
    8326        1789 :     return;
    8327             :     break;
    8328             :   }
    8329             : 
    8330             : 
    8331             :   // Fragment 5 encoded into 5 bits for 23 unique commands.
    8332       56097 :   switch ((Bits >> 42) & 31) {
    8333           0 :   default: llvm_unreachable("Invalid command number.");
    8334       25057 :   case 0:
    8335             :     // ADCri, ADCrr, ADCrsi, ADDri, ADDrr, ADDrsi, ANDri, ANDrr, ANDrsi, ASRi...
    8336       25057 :     O << ", ";
    8337       25057 :     break;
    8338          32 :   case 1:
    8339             :     // CDP, t2CDP, t2CDP2
    8340          32 :     printCImmediate(MI, 2, STI, O);
    8341          32 :     O << ", ";
    8342          32 :     printCImmediate(MI, 3, STI, O);
    8343          32 :     O << ", ";
    8344          32 :     printCImmediate(MI, 4, STI, O);
    8345          32 :     O << ", ";
    8346          32 :     printOperand(MI, 5, STI, O);
    8347          32 :     return;
    8348             :     break;
    8349             :   case 2:
    8350             :     // CLZ, CMNzrr, CMPrr, CPS3p, CRC32B, CRC32CB, CRC32CH, CRC32CW, CRC32H, ...
    8351             :     return;
    8352             :     break;
    8353        2243 :   case 3:
    8354             :     // MCR, MCRR, VABDfd, VABDfq, VABDhd, VABDhq, VACGEfd, VACGEfq, VACGEhd, ...
    8355        2243 :     printOperand(MI, 2, STI, O);
    8356        2243 :     break;
    8357          76 :   case 4:
    8358             :     // SSAT, t2SSAT
    8359          76 :     printShiftImmOperand(MI, 3, STI, O);
    8360          76 :     return;
    8361             :     break;
    8362         576 :   case 5:
    8363             :     // SXTB, SXTB16, SXTH, UXTB, UXTB16, UXTH, t2SXTB, t2SXTB16, t2SXTH, t2UX...
    8364         576 :     printRotImmOperand(MI, 2, STI, O);
    8365         576 :     return;
    8366             :     break;
    8367         408 :   case 6:
    8368             :     // VDUPLN16d, VDUPLN16q, VDUPLN32d, VDUPLN32q, VDUPLN8d, VDUPLN8q, VGETLN...
    8369         408 :     printVectorIndex(MI, 2, STI, O);
    8370         408 :     return;
    8371             :     break;
    8372         299 :   case 7:
    8373             :     // VFMAD, VFMAH, VFMAS, VFMAfd, VFMAfq, VFMAhd, VFMAhq, VFMSD, VFMSH, VFM...
    8374         299 :     printOperand(MI, 3, STI, O);
    8375         299 :     break;
    8376         243 :   case 8:
    8377             :     // VLD1DUPd16wb_register, VLD1DUPd32wb_register, VLD1DUPd8wb_register, VL...
    8378         243 :     printOperand(MI, 4, STI, O);
    8379         243 :     return;
    8380             :     break;
    8381         254 :   case 9:
    8382             :     // VLD1LNd16, VLD1LNd16_UPD, VLD1LNd32, VLD1LNd32_UPD, VLD1LNd8, VLD1LNd8...
    8383         254 :     O << "]}, ";
    8384         254 :     break;
    8385           0 :   case 10:
    8386             :     // VLD1LNdWB_fixed_Asm_16, VLD1LNdWB_fixed_Asm_32, VLD1LNdWB_fixed_Asm_8,...
    8387             :     O << '!';
    8388             :     return;
    8389             :     break;
    8390         229 :   case 11:
    8391             :     // VLD2LNd16, VLD2LNd32, VLD2LNd8, VLD2LNq16, VLD2LNq32, VLD4LNd16, VLD4L...
    8392         229 :     O << "], ";
    8393         229 :     break;
    8394          70 :   case 12:
    8395             :     // VLD2LNd16_UPD, VLD2LNd32_UPD, VLD2LNd8_UPD, VLD2LNq16_UPD, VLD2LNq32_U...
    8396          70 :     printOperand(MI, 1, STI, O);
    8397          70 :     O << '[';
    8398          70 :     printNoHashImmediate(MI, 8, STI, O);
    8399          70 :     break;
    8400          19 :   case 13:
    8401             :     // VLD3DUPd16, VLD3DUPd32, VLD3DUPd8, VLD3DUPq16, VLD3DUPq32, VLD3DUPq8
    8402          19 :     printAddrMode6Operand(MI, 3, STI, O);
    8403          19 :     return;
    8404             :     break;
    8405          70 :   case 14:
    8406             :     // VLD3DUPd16_UPD, VLD3DUPd32_UPD, VLD3DUPd8_UPD, VLD3DUPq16_UPD, VLD3DUP...
    8407          70 :     printAddrMode6Operand(MI, 4, STI, O);
    8408          70 :     break;
    8409          54 :   case 15:
    8410             :     // VLD4DUPd16_UPD, VLD4DUPd32_UPD, VLD4DUPd8_UPD, VLD4DUPq16_UPD, VLD4DUP...
    8411          54 :     printAddrMode6Operand(MI, 5, STI, O);
    8412          54 :     printAddrMode6OffsetOperand(MI, 7, STI, O);
    8413          54 :     return;
    8414             :     break;
    8415          62 :   case 16:
    8416             :     // VMLALslsv2i32, VMLALslsv4i16, VMLALsluv2i32, VMLALsluv4i16, VMLAslv2i3...
    8417          62 :     printVectorIndex(MI, 4, STI, O);
    8418          62 :     return;
    8419             :     break;
    8420          84 :   case 17:
    8421             :     // VMULLslsv2i32, VMULLslsv4i16, VMULLsluv2i32, VMULLsluv4i16, VMULslv2i3...
    8422          84 :     printVectorIndex(MI, 3, STI, O);
    8423          84 :     return;
    8424             :     break;
    8425          73 :   case 18:
    8426             :     // VST3d16_UPD, VST3d32_UPD, VST3d8_UPD, VST3q16_UPD, VST3q32_UPD, VST3q8...
    8427          73 :     O << "}, ";
    8428          73 :     printAddrMode6Operand(MI, 1, STI, O);
    8429          73 :     printAddrMode6OffsetOperand(MI, 3, STI, O);
    8430          73 :     return;
    8431             :     break;
    8432          51 :   case 19:
    8433             :     // VST4LNd16_UPD, VST4LNd32_UPD, VST4LNd8_UPD, VST4LNq16_UPD, VST4LNq32_U...
    8434          51 :     printOperand(MI, 5, STI, O);
    8435          51 :     O << '[';
    8436          51 :     printNoHashImmediate(MI, 8, STI, O);
    8437          51 :     O << "], ";
    8438          51 :     printOperand(MI, 6, STI, O);
    8439          51 :     O << '[';
    8440          51 :     printNoHashImmediate(MI, 8, STI, O);
    8441          51 :     O << "], ";
    8442          51 :     printOperand(MI, 7, STI, O);
    8443          51 :     O << '[';
    8444          51 :     printNoHashImmediate(MI, 8, STI, O);
    8445          51 :     O << "]}, ";
    8446          51 :     printAddrMode6Operand(MI, 1, STI, O);
    8447          51 :     printAddrMode6OffsetOperand(MI, 3, STI, O);
    8448          51 :     return;
    8449             :     break;
    8450           2 :   case 20:
    8451             :     // sysLDMDA, sysLDMDB, sysLDMIA, sysLDMIB, sysSTMDA, sysSTMDB, sysSTMIA, ...
    8452           2 :     O << " ^";
    8453           2 :     return;
    8454             :     break;
    8455        1205 :   case 21:
    8456             :     // t2LDRB_POST, t2LDRH_POST, t2LDRSB_POST, t2LDRSH_POST, t2LDR_POST, t2ST...
    8457        1205 :     printT2AddrModeImm8OffsetOperand(MI, 3, STI, O);
    8458        1205 :     return;
    8459             :     break;
    8460           5 :   case 22:
    8461             :     // t2MOVsra_flag, t2MOVsrl_flag
    8462           5 :     O << ", #1";
    8463           5 :     return;
    8464             :     break;
    8465             :   }
    8466             : 
    8467             : 
    8468             :   // Fragment 6 encoded into 6 bits for 36 unique commands.
    8469       28222 :   switch ((Bits >> 47) & 63) {
    8470           0 :   default: llvm_unreachable("Invalid command number.");
    8471        5045 :   case 0:
    8472             :     // ADCri, ADDri, ANDri, BICri, EORri, ORRri, RSBri, RSCri, SBCri, SUBri
    8473        5045 :     printModImmOperand(MI, 2, STI, O);
    8474        5045 :     return;
    8475             :     break;
    8476       13803 :   case 1:
    8477             :     // ADCrr, ADDrr, ANDrr, ASRi, ASRr, BICrr, EORrr, LSLi, LSLr, LSRi, LSRr,...
    8478       13803 :     printOperand(MI, 2, STI, O);
    8479       13803 :     break;
    8480         841 :   case 2:
    8481             :     // ADCrsi, ADDrsi, ANDrsi, BICrsi, EORrsi, ORRrsi, RSBrsi, RSCrsi, SBCrsi...
    8482         841 :     printSORegImmOperand(MI, 2, STI, O);
    8483         841 :     return;
    8484             :     break;
    8485          66 :   case 3:
    8486             :     // BFI, t2BFI
    8487          66 :     printBitfieldInvMaskImmOperand(MI, 3, STI, O);
    8488          66 :     return;
    8489             :     break;
    8490          96 :   case 4:
    8491             :     // LDCL_OPTION, LDC_OPTION, STCL_OPTION, STC_OPTION, t2LDC2L_OPTION, t2LD...
    8492          96 :     printCoprocOptionImm(MI, 3, STI, O);
    8493          96 :     return;
    8494             :     break;
    8495         202 :   case 5:
    8496             :     // LDCL_POST, LDC_POST, STCL_POST, STC_POST, t2LDC2L_POST, t2LDC2_POST, t...
    8497         202 :     printPostIdxImm8s4Operand(MI, 3, STI, O);
    8498         202 :     return;
    8499             :     break;
    8500        1831 :   case 6:
    8501             :     // LDRBT_POST_IMM, LDRBT_POST_REG, LDRB_POST_IMM, LDRB_POST_REG, LDRT_POS...
    8502        1831 :     printAddrMode2OffsetOperand(MI, 3, STI, O);
    8503        1831 :     return;
    8504             :     break;
    8505         103 :   case 7:
    8506             :     // LDRD, STRD
    8507         103 :     printAddrMode3Operand<false>(MI, 2, STI, O);
    8508         103 :     return;
    8509             :     break;
    8510         107 :   case 8:
    8511             :     // LDRD_POST, STRD_POST, t2LDRD_POST, t2STRD_POST
    8512         107 :     printAddrMode7Operand(MI, 3, STI, O);
    8513         107 :     break;
    8514          12 :   case 9:
    8515             :     // LDRD_PRE, STRD_PRE
    8516          12 :     printAddrMode3Operand<true>(MI, 3, STI, O);
    8517             :     O << '!';
    8518             :     return;
    8519             :     break;
    8520          25 :   case 10:
    8521             :     // LDRHTi, LDRSBTi, LDRSHTi, STRHTi
    8522          25 :     printPostIdxImm8Operand(MI, 3, STI, O);
    8523          25 :     return;
    8524             :     break;
    8525          27 :   case 11:
    8526             :     // LDRHTr, LDRSBTr, LDRSHTr, STRHTr
    8527          27 :     printPostIdxRegOperand(MI, 3, STI, O);
    8528          27 :     return;
    8529             :     break;
    8530         366 :   case 12:
    8531             :     // LDRH_POST, LDRSB_POST, LDRSH_POST, STRH_POST
    8532         366 :     printAddrMode3OffsetOperand(MI, 3, STI, O);
    8533         366 :     return;
    8534             :     break;
    8535         104 :   case 13:
    8536             :     // MCR, MCRR, t2MCR, t2MCR2, t2MCRR, t2MCRR2
    8537         104 :     O << ", ";
    8538         104 :     break;
    8539           7 :   case 14:
    8540             :     // MCRR2
    8541           7 :     printCImmediate(MI, 4, STI, O);
    8542           7 :     return;
    8543             :     break;
    8544         329 :   case 15:
    8545             :     // STLEX, STLEXB, STLEXH, STREX, STREXB, STREXH, SWP, SWPB, t2LDAEXD, t2L...
    8546         329 :     printAddrMode7Operand(MI, 2, STI, O);
    8547         329 :     return;
    8548             :     break;
    8549             :   case 16:
    8550             :     // VABDfd, VABDfq, VABDhd, VABDhq, VACGEfd, VACGEfq, VACGEhd, VACGEhq, VA...
    8551             :     return;
    8552             :     break;
    8553         392 :   case 17:
    8554             :     // VBIFd, VBIFq, VBITd, VBITq, VBSLd, VBSLq, VLD4LNd16, VLD4LNd32, VLD4LN...
    8555         392 :     printOperand(MI, 3, STI, O);
    8556         392 :     break;
    8557         188 :   case 18:
    8558             :     // VLD1LNd16, VLD1LNd32, VLD1LNd8, VST1LNd16_UPD, VST1LNd32_UPD, VST1LNd8...
    8559         188 :     printAddrMode6Operand(MI, 1, STI, O);
    8560         188 :     break;
    8561          44 :   case 19:
    8562             :     // VLD1LNd16_UPD, VLD1LNd32_UPD, VLD1LNd8_UPD
    8563          44 :     printAddrMode6Operand(MI, 2, STI, O);
    8564          44 :     printAddrMode6OffsetOperand(MI, 4, STI, O);
    8565          44 :     return;
    8566             :     break;
    8567         122 :   case 20:
    8568             :     // VLD1LNdWB_register_Asm_16, VLD1LNdWB_register_Asm_32, VLD1LNdWB_regist...
    8569         122 :     printOperand(MI, 4, STI, O);
    8570         122 :     break;
    8571          50 :   case 21:
    8572             :     // VLD2LNd16, VLD2LNd32, VLD2LNd8, VLD2LNq16, VLD2LNq32
    8573          50 :     printOperand(MI, 1, STI, O);
    8574          50 :     O << '[';
    8575          50 :     printNoHashImmediate(MI, 6, STI, O);
    8576          50 :     O << "]}, ";
    8577          50 :     printAddrMode6Operand(MI, 2, STI, O);
    8578          50 :     return;
    8579             :     break;
    8580          27 :   case 22:
    8581             :     // VLD2LNd16_UPD, VLD2LNd32_UPD, VLD2LNd8_UPD, VLD2LNq16_UPD, VLD2LNq32_U...
    8582          27 :     O << "]}, ";
    8583          27 :     printAddrMode6Operand(MI, 3, STI, O);
    8584          27 :     printAddrMode6OffsetOperand(MI, 5, STI, O);
    8585          27 :     return;
    8586             :     break;
    8587          37 :   case 23:
    8588             :     // VLD3DUPd16_UPD, VLD3DUPd32_UPD, VLD3DUPd8_UPD, VLD3DUPq16_UPD, VLD3DUP...
    8589          37 :     printAddrMode6OffsetOperand(MI, 6, STI, O);
    8590          37 :     return;
    8591             :     break;
    8592          43 :   case 24:
    8593             :     // VLD3LNd16, VLD3LNd32, VLD3LNd8, VLD3LNq16, VLD3LNq32
    8594          43 :     O << "], ";
    8595          43 :     printOperand(MI, 2, STI, O);
    8596          43 :     O << '[';
    8597          43 :     printNoHashImmediate(MI, 8, STI, O);
    8598          43 :     O << "]}, ";
    8599          43 :     printAddrMode6Operand(MI, 3, STI, O);
    8600          43 :     return;
    8601             :     break;
    8602          22 :   case 25:
    8603             :     // VLD3LNd16_UPD, VLD3LNd32_UPD, VLD3LNd8_UPD, VLD3LNq16_UPD, VLD3LNq32_U...
    8604          22 :     printAddrMode6Operand(MI, 4, STI, O);
    8605          22 :     printAddrMode6OffsetOperand(MI, 6, STI, O);
    8606          22 :     return;
    8607             :     break;
    8608          17 :   case 26:
    8609             :     // VMLAslfd, VMLAslfq, VMLAslhd, VMLAslhq, VMLSslfd, VMLSslfq, VMLSslhd, ...
    8610          17 :     printVectorIndex(MI, 4, STI, O);
    8611          17 :     return;
    8612             :     break;
    8613          22 :   case 27:
    8614             :     // VMULslfd, VMULslfq, VMULslhd, VMULslhq
    8615          22 :     printVectorIndex(MI, 3, STI, O);
    8616          22 :     return;
    8617             :     break;
    8618          19 :   case 28:
    8619             :     // VST2LNd16_UPD, VST2LNd32_UPD, VST2LNd8_UPD, VST2LNq16_UPD, VST2LNq32_U...
    8620          19 :     printOperand(MI, 5, STI, O);
    8621          19 :     O << '[';
    8622          19 :     printNoHashImmediate(MI, 6, STI, O);
    8623          19 :     O << "]}, ";
    8624          19 :     printAddrMode6Operand(MI, 1, STI, O);
    8625          19 :     printAddrMode6OffsetOperand(MI, 3, STI, O);
    8626          19 :     return;
    8627             :     break;
    8628         105 :   case 29:
    8629             :     // VST4d16_UPD, VST4d32_UPD, VST4d8_UPD, VST4q16_UPD, VST4q32_UPD, VST4q8...
    8630         105 :     printOperand(MI, 7, STI, O);
    8631         105 :     O << "}, ";
    8632         105 :     printAddrMode6Operand(MI, 1, STI, O);
    8633         105 :     printAddrMode6OffsetOperand(MI, 3, STI, O);
    8634         105 :     return;
    8635             :     break;
    8636         373 :   case 30:
    8637             :     // t2ADCrs, t2ADDrs, t2ANDrs, t2BICrs, t2EORrs, t2ORNrs, t2ORRrs, t2RSBrs...
    8638         373 :     printT2SOOperand(MI, 2, STI, O);
    8639         373 :     return;
    8640             :     break;
    8641          83 :   case 31:
    8642             :     // t2ASRri, t2LSRri
    8643          83 :     printThumbSRImm(MI, 2, STI, O);
    8644          83 :     return;
    8645             :     break;
    8646          60 :   case 32:
    8647             :     // t2LDRD_PRE, t2STRD_PRE
    8648          60 :     printT2AddrModeImm8s4Operand<true>(MI, 3, STI, O);
    8649             :     O << '!';
    8650             :     return;
    8651             :     break;
    8652         250 :   case 33:
    8653             :     // t2LDRDi8, t2STRDi8
    8654         250 :     printT2AddrModeImm8s4Operand<false>(MI, 2, STI, O);
    8655         250 :     return;
    8656             :     break;
    8657          68 :   case 34:
    8658             :     // t2STREX
    8659          68 :     printT2AddrModeImm0_1020s4Operand(MI, 2, STI, O);
    8660          68 :     return;
    8661             :     break;
    8662         904 :   case 35:
    8663             :     // tADDrSPi
    8664         904 :     printThumbS4ImmOperand(MI, 2, STI, O);
    8665         904 :     return;
    8666             :     break;
    8667             :   }
    8668             : 
    8669             : 
    8670             :   // Fragment 7 encoded into 4 bits for 12 unique commands.
    8671       14716 :   switch ((Bits >> 53) & 15) {
    8672           0 :   default: llvm_unreachable("Invalid command number.");
    8673             :   case 0:
    8674             :     // ADCrr, ADDrr, ANDrr, ASRi, ASRr, BICrr, EORrr, LSLi, LSLr, LSRi, LSRr,...
    8675             :     return;
    8676             :     break;
    8677        1426 :   case 1:
    8678             :     // LDRD_POST, MLA, MLS, SBFX, SMLABB, SMLABT, SMLAD, SMLADX, SMLALBB, SML...
    8679        1426 :     O << ", ";
    8680        1426 :     break;
    8681          59 :   case 2:
    8682             :     // MCR, t2MCR, t2MCR2
    8683          59 :     printCImmediate(MI, 3, STI, O);
    8684          59 :     O << ", ";
    8685          59 :     printCImmediate(MI, 4, STI, O);
    8686          59 :     O << ", ";
    8687          59 :     printOperand(MI, 5, STI, O);
    8688          59 :     return;
    8689             :     break;
    8690          45 :   case 3:
    8691             :     // MCRR, t2MCRR, t2MCRR2
    8692          45 :     printOperand(MI, 3, STI, O);
    8693          45 :     O << ", ";
    8694          45 :     printCImmediate(MI, 4, STI, O);
    8695          45 :     return;
    8696             :     break;
    8697          47 :   case 4:
    8698             :     // PKHBT, t2PKHBT
    8699          47 :     printPKHLSLShiftImm(MI, 3, STI, O);
    8700          47 :     return;
    8701             :     break;
    8702          26 :   case 5:
    8703             :     // PKHTB, t2PKHTB
    8704          26 :     printPKHASRShiftImm(MI, 3, STI, O);
    8705          26 :     return;
    8706             :     break;
    8707         309 :   case 6:
    8708             :     // SXTAB, SXTAB16, SXTAH, UXTAB, UXTAB16, UXTAH, t2SXTAB, t2SXTAB16, t2SX...
    8709         309 :     printRotImmOperand(MI, 3, STI, O);
    8710         309 :     return;
    8711             :     break;
    8712          68 :   case 7:
    8713             :     // USAT, t2USAT
    8714          68 :     printShiftImmOperand(MI, 3, STI, O);
    8715          68 :     return;
    8716             :     break;
    8717         213 :   case 8:
    8718             :     // VLD3d16, VLD3d16_UPD, VLD3d32, VLD3d32_UPD, VLD3d8, VLD3d8_UPD, VLD3q1...
    8719         213 :     O << "}, ";
    8720         213 :     break;
    8721         160 :   case 9:
    8722             :     // VLD4LNd16, VLD4LNd32, VLD4LNd8, VLD4LNq16, VLD4LNq32, VST2LNd16, VST2L...
    8723             :     O << '[';
    8724             :     break;
    8725          42 :   case 10:
    8726             :     // VST1LNd16_UPD, VST1LNd32_UPD, VST1LNd8_UPD
    8727          42 :     printAddrMode6OffsetOperand(MI, 3, STI, O);
    8728          42 :     return;
    8729             :     break;
    8730          77 :   case 11:
    8731             :     // t2LDRD_POST, t2STRD_POST
    8732          77 :     printT2AddrModeImm8s4OffsetOperand(MI, 4, STI, O);
    8733          77 :     return;
    8734             :     break;
    8735             :   }
    8736             : 
    8737             : 
    8738             :   // Fragment 8 encoded into 4 bits for 12 unique commands.
    8739        1799 :   switch ((Bits >> 57) & 15) {
    8740           0 :   default: llvm_unreachable("Invalid command number.");
    8741          30 :   case 0:
    8742             :     // LDRD_POST, STRD_POST
    8743          30 :     printAddrMode3OffsetOperand(MI, 4, STI, O);
    8744          30 :     return;
    8745             :     break;
    8746        1130 :   case 1:
    8747             :     // MLA, MLS, SMLABB, SMLABT, SMLAD, SMLADX, SMLALBB, SMLALBT, SMLALD, SML...
    8748        1130 :     printOperand(MI, 3, STI, O);
    8749             :     break;
    8750         137 :   case 2:
    8751             :     // SBFX, UBFX, t2SBFX, t2UBFX
    8752         137 :     printImmPlusOneOperand(MI, 3, STI, O);
    8753         137 :     return;
    8754             :     break;
    8755          71 :   case 3:
    8756             :     // VLD3d16, VLD3d32, VLD3d8, VLD3q16, VLD3q32, VLD3q8
    8757          71 :     printAddrMode6Operand(MI, 3, STI, O);
    8758          71 :     return;
    8759             :     break;
    8760          85 :   case 4:
    8761             :     // VLD3d16_UPD, VLD3d32_UPD, VLD3d8_UPD, VLD3q16_UPD, VLD3q32_UPD, VLD3q8...
    8762          85 :     printAddrMode6Operand(MI, 4, STI, O);
    8763          85 :     printAddrMode6OffsetOperand(MI, 6, STI, O);
    8764          85 :     return;
    8765             :     break;
    8766          47 :   case 5:
    8767             :     // VLD4LNd16, VLD4LNd32, VLD4LNd8, VLD4LNq16, VLD4LNq32
    8768          47 :     printNoHashImmediate(MI, 10, STI, O);
    8769          47 :     O << "]}, ";
    8770          47 :     printAddrMode6Operand(MI, 4, STI, O);
    8771          47 :     return;
    8772             :     break;
    8773          37 :   case 6:
    8774             :     // VST2LNd16, VST2LNd32, VST2LNd8, VST2LNq16, VST2LNq32
    8775          37 :     printNoHashImmediate(MI, 4, STI, O);
    8776          37 :     O << "]}, ";
    8777          37 :     printAddrMode6Operand(MI, 0, STI, O);
    8778          37 :     return;
    8779             :     break;
    8780          33 :   case 7:
    8781             :     // VST3LNd16, VST3LNd32, VST3LNd8, VST3LNq16, VST3LNq32
    8782          33 :     printNoHashImmediate(MI, 5, STI, O);
    8783          33 :     O << "], ";
    8784          33 :     printOperand(MI, 4, STI, O);
    8785          33 :     O << '[';
    8786          33 :     printNoHashImmediate(MI, 5, STI, O);
    8787          33 :     O << "]}, ";
    8788          33 :     printAddrMode6Operand(MI, 0, STI, O);
    8789          33 :     return;
    8790             :     break;
    8791          57 :   case 8:
    8792             :     // VST3d16, VST3d32, VST3d8, VST3q16, VST3q32, VST3q8
    8793          57 :     printAddrMode6Operand(MI, 0, STI, O);
    8794          57 :     return;
    8795             :     break;
    8796          43 :   case 9:
    8797             :     // VST4LNd16, VST4LNd32, VST4LNd8, VST4LNq16, VST4LNq32
    8798          43 :     printNoHashImmediate(MI, 6, STI, O);
    8799          43 :     O << "], ";
    8800          43 :     printOperand(MI, 4, STI, O);
    8801          43 :     O << '[';
    8802          43 :     printNoHashImmediate(MI, 6, STI, O);
    8803          43 :     O << "], ";
    8804          43 :     printOperand(MI, 5, STI, O);
    8805          43 :     O << '[';
    8806          43 :     printNoHashImmediate(MI, 6, STI, O);
    8807          43 :     O << "]}, ";
    8808          43 :     printAddrMode6Operand(MI, 0, STI, O);
    8809          43 :     return;
    8810             :     break;
    8811          65 :   case 10:
    8812             :     // VST4d16, VST4d32, VST4d8, VST4q16, VST4q32, VST4q8
    8813          65 :     printOperand(MI, 5, STI, O);
    8814          65 :     O << "}, ";
    8815          65 :     printAddrMode6Operand(MI, 0, STI, O);
    8816          65 :     return;
    8817             :     break;
    8818          64 :   case 11:
    8819             :     // t2STLEXD, t2STREXD
    8820          64 :     printAddrMode7Operand(MI, 3, STI, O);
    8821          64 :     return;
    8822             :     break;
    8823             :   }
    8824             : 
    8825             : 
    8826             :   // Fragment 9 encoded into 1 bits for 2 unique commands.
    8827        1130 :   if ((Bits >> 61) & 1) {
    8828             :     // VLD4d16, VLD4d16_UPD, VLD4d32, VLD4d32_UPD, VLD4d8, VLD4d8_UPD, VLD4q1...
    8829         161 :     O << "}, ";
    8830             :   } else {
    8831             :     // MLA, MLS, SMLABB, SMLABT, SMLAD, SMLADX, SMLALBB, SMLALBT, SMLALD, SML...
    8832             :     return;
    8833             :   }
    8834             : 
    8835             : 
    8836             :   // Fragment 10 encoded into 1 bits for 2 unique commands.
    8837         161 :   if ((Bits >> 62) & 1) {
    8838             :     // VLD4d16_UPD, VLD4d32_UPD, VLD4d8_UPD, VLD4q16_UPD, VLD4q32_UPD, VLD4q8...
    8839          99 :     printAddrMode6Operand(MI, 5, STI, O);
    8840          99 :     printAddrMode6OffsetOperand(MI, 7, STI, O);
    8841          99 :     return;
    8842             :   } else {
    8843             :     // VLD4d16, VLD4d32, VLD4d8, VLD4q16, VLD4q32, VLD4q8
    8844          62 :     printAddrMode6Operand(MI, 4, STI, O);
    8845          62 :     return;
    8846             :   }
    8847             : 
    8848             : }
    8849             : 
    8850             : 
    8851             : /// getRegisterName - This method is automatically generated by tblgen
    8852             : /// from the register set description.  This returns the assembler name
    8853             : /// for the specified register.
    8854      256636 : const char *ARMInstPrinter::getRegisterName(unsigned RegNo) {
    8855             :   assert(RegNo && RegNo < 289 && "Invalid register number!");
    8856             : 
    8857             :   static const char AsmStrs[] = {
    8858             :   /* 0 */ 'D', '4', '_', 'D', '6', '_', 'D', '8', '_', 'D', '1', '0', 0,
    8859             :   /* 13 */ 'D', '7', '_', 'D', '8', '_', 'D', '9', '_', 'D', '1', '0', 0,
    8860             :   /* 26 */ 'Q', '7', '_', 'Q', '8', '_', 'Q', '9', '_', 'Q', '1', '0', 0,
    8861             :   /* 39 */ 'd', '1', '0', 0,
    8862             :   /* 43 */ 'q', '1', '0', 0,
    8863             :   /* 47 */ 'r', '1', '0', 0,
    8864             :   /* 51 */ 's', '1', '0', 0,
    8865             :   /* 55 */ 'D', '1', '4', '_', 'D', '1', '6', '_', 'D', '1', '8', '_', 'D', '2', '0', 0,
    8866             :   /* 71 */ 'D', '1', '7', '_', 'D', '1', '8', '_', 'D', '1', '9', '_', 'D', '2', '0', 0,
    8867             :   /* 87 */ 'd', '2', '0', 0,
    8868             :   /* 91 */ 's', '2', '0', 0,
    8869             :   /* 95 */ 'D', '2', '4', '_', 'D', '2', '6', '_', 'D', '2', '8', '_', 'D', '3', '0', 0,
    8870             :   /* 111 */ 'D', '2', '7', '_', 'D', '2', '8', '_', 'D', '2', '9', '_', 'D', '3', '0', 0,
    8871             :   /* 127 */ 'd', '3', '0', 0,
    8872             :   /* 131 */ 's', '3', '0', 0,
    8873             :   /* 135 */ 'd', '0', 0,
    8874             :   /* 138 */ 'q', '0', 0,
    8875             :   /* 141 */ 'm', 'v', 'f', 'r', '0', 0,
    8876             :   /* 147 */ 's', '0', 0,
    8877             :   /* 150 */ 'D', '9', '_', 'D', '1', '0', '_', 'D', '1', '1', 0,
    8878             :   /* 161 */ 'D', '5', '_', 'D', '7', '_', 'D', '9', '_', 'D', '1', '1', 0,
    8879             :   /* 174 */ 'Q', '8', '_', 'Q', '9', '_', 'Q', '1', '0', '_', 'Q', '1', '1', 0,
    8880             :   /* 188 */ 'R', '1', '0', '_', 'R', '1', '1', 0,
    8881             :   /* 196 */ 'd', '1', '1', 0,
    8882             :   /* 200 */ 'q', '1', '1', 0,
    8883             :   /* 204 */ 'r', '1', '1', 0,
    8884             :   /* 208 */ 's', '1', '1', 0,
    8885             :   /* 212 */ 'D', '1', '9', '_', 'D', '2', '0', '_', 'D', '2', '1', 0,
    8886             :   /* 224 */ 'D', '1', '5', '_', 'D', '1', '7', '_', 'D', '1', '9', '_', 'D', '2', '1', 0,
    8887             :   /* 240 */ 'd', '2', '1', 0,
    8888             :   /* 244 */ 's', '2', '1', 0,
    8889             :   /* 248 */ 'D', '2', '9', '_', 'D', '3', '0', '_', 'D', '3', '1', 0,
    8890             :   /* 260 */ 'D', '2', '5', '_', 'D', '2', '7', '_', 'D', '2', '9', '_', 'D', '3', '1', 0,
    8891             :   /* 276 */ 'd', '3', '1', 0,
    8892             :   /* 280 */ 's', '3', '1', 0,
    8893             :   /* 284 */ 'Q', '0', '_', 'Q', '1', 0,
    8894             :   /* 290 */ 'R', '0', '_', 'R', '1', 0,
    8895             :   /* 296 */ 'd', '1', 0,
    8896             :   /* 299 */ 'q', '1', 0,
    8897             :   /* 302 */ 'm', 'v', 'f', 'r', '1', 0,
    8898             :   /* 308 */ 's', '1', 0,
    8899             :   /* 311 */ 'D', '6', '_', 'D', '8', '_', 'D', '1', '0', '_', 'D', '1', '2', 0,
    8900             :   /* 325 */ 'D', '9', '_', 'D', '1', '0', '_', 'D', '1', '1', '_', 'D', '1', '2', 0,
    8901             :   /* 340 */ 'Q', '9', '_', 'Q', '1', '0', '_', 'Q', '1', '1', '_', 'Q', '1', '2', 0,
    8902             :   /* 355 */ 'd', '1', '2', 0,
    8903             :   /* 359 */ 'q', '1', '2', 0,
    8904             :   /* 363 */ 'r', '1', '2', 0,
    8905             :   /* 367 */ 's', '1', '2', 0,
    8906             :   /* 371 */ 'D', '1', '6', '_', 'D', '1', '8', '_', 'D', '2', '0', '_', 'D', '2', '2', 0,
    8907             :   /* 387 */ 'D', '1', '9', '_', 'D', '2', '0', '_', 'D', '2', '1', '_', 'D', '2', '2', 0,
    8908             :   /* 403 */ 'd', '2', '2', 0,
    8909             :   /* 407 */ 's', '2', '2', 0,
    8910             :   /* 411 */ 'D', '0', '_', 'D', '2', 0,
    8911             :   /* 417 */ 'D', '0', '_', 'D', '1', '_', 'D', '2', 0,
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    8913             :   /* 432 */ 'd', '2', 0,
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    9055             :     867, 995, 1118, 1246, 1369, 47, 204, 363, 147, 308, 444, 587, 731, 870, 
    9056             :     998, 1121, 1249, 1372, 51, 208, 367, 505, 645, 785, 909, 1033, 1160, 1284, 
    9057             :     91, 244, 407, 541, 685, 821, 949, 1069, 1200, 1320, 131, 280, 411, 545, 
    9058             :     692, 828, 959, 1079, 1210, 1330, 6, 167, 317, 461, 597, 741, 881, 1009, 
    9059             :     1132, 1260, 63, 232, 379, 517, 657, 797, 921, 1045, 1172, 1296, 103, 268, 
    9060             :     284, 426, 566, 716, 849, 983, 1100, 1234, 1351, 32, 180, 347, 489, 629, 
    9061             :     769, 560, 710, 843, 977, 1094, 1228, 1345, 26, 174, 340, 481, 621, 761, 
    9062             :     1375, 290, 572, 855, 1106, 1357, 188, 417, 551, 701, 834, 968, 1085, 1219, 
    9063             :     1336, 16, 150, 328, 469, 609, 749, 893, 1017, 1144, 1268, 75, 212, 391, 
    9064             :     525, 669, 805, 933, 1053, 1184, 1304, 115, 248, 689, 825, 956, 1076, 1207, 
    9065             :     1327, 3, 164, 314, 458, 593, 737, 877, 1005, 1128, 1256, 59, 228, 375, 
    9066             :     513, 653, 793, 917, 1041, 1168, 1292, 99, 264, 953, 1073, 1204, 1324, 0, 
    9067             :     161, 311, 455, 590, 734, 873, 1001, 1124, 1252, 55, 224, 371, 509, 649, 
    9068             :     789, 913, 1037, 1164, 1288, 95, 260, 420, 704, 971, 1222, 19, 332, 613, 
    9069             :     897, 1148, 79, 395, 673, 937, 1188, 119, 698, 965, 1216, 13, 325, 605, 
    9070             :     889, 1140, 71, 387, 665, 929, 1180, 111, 
    9071             :   };
    9072             : 
    9073             :   assert (*(AsmStrs+RegAsmOffset[RegNo-1]) &&
    9074             :           "Invalid alt name index for register!");
    9075      256636 :   return AsmStrs+RegAsmOffset[RegNo-1];
    9076             : }
    9077             : 
    9078             : #ifdef PRINT_ALIAS_INSTR
    9079             : #undef PRINT_ALIAS_INSTR
    9080             : 
    9081      130567 : bool ARMInstPrinter::printAliasInstr(const MCInst *MI, const MCSubtargetInfo &STI, raw_ostream &OS) {
    9082             :   const char *AsmString;
    9083      130567 :   switch (MI->getOpcode()) {
    9084             :   default: return false;
    9085         192 :   case ARM::HINT:
    9086         384 :     if (MI->getNumOperands() == 3 &&
    9087         384 :         MI->getOperand(0).isImm() &&
    9088         329 :         MI->getOperand(0).getImm() == 0 &&
    9089         603 :         !STI.getFeatureBits()[ARM::ModeThumb] &&
    9090         274 :         STI.getFeatureBits()[ARM::HasV6KOps]) {
    9091             :       // (HINT 0, pred:$p)
    9092             :       AsmString = "nop$\xFF\x02\x01";
    9093             :       break;
    9094             :     }
    9095         110 :     if (MI->getNumOperands() == 3 &&
    9096         110 :         MI->getOperand(0).isImm() &&
    9097          66 :         MI->getOperand(0).getImm() == 1 &&
    9098          88 :         !STI.getFeatureBits()[ARM::ModeThumb] &&
    9099          22 :         STI.getFeatureBits()[ARM::HasV6KOps]) {
    9100             :       // (HINT 1, pred:$p)
    9101             :       AsmString = "yield$\xFF\x02\x01";
    9102             :       break;
    9103             :     }
    9104          88 :     if (MI->getNumOperands() == 3 &&
    9105          88 :         MI->getOperand(0).isImm() &&
    9106          55 :         MI->getOperand(0).getImm() == 2 &&
    9107          77 :         !STI.getFeatureBits()[ARM::ModeThumb] &&
    9108          22 :         STI.getFeatureBits()[ARM::HasV6KOps]) {
    9109             :       // (HINT 2, pred:$p)
    9110             :       AsmString = "wfe$\xFF\x02\x01";
    9111             :       break;
    9112             :     }
    9113          66 :     if (MI->getNumOperands() == 3 &&
    9114          66 :         MI->getOperand(0).isImm() &&
    9115          44 :         MI->getOperand(0).getImm() == 3 &&
    9116          66 :         !STI.getFeatureBits()[ARM::ModeThumb] &&
    9117          22 :         STI.getFeatureBits()[ARM::HasV6KOps]) {
    9118             :       // (HINT 3, pred:$p)
    9119             :       AsmString = "wfi$\xFF\x02\x01";
    9120             :       break;
    9121             :     }
    9122          44 :     if (MI->getNumOperands() == 3 &&
    9123          44 :         MI->getOperand(0).isImm() &&
    9124          33 :         MI->getOperand(0).getImm() == 4 &&
    9125          55 :         !STI.getFeatureBits()[ARM::ModeThumb] &&
    9126          22 :         STI.getFeatureBits()[ARM::HasV6KOps]) {
    9127             :       // (HINT 4, pred:$p)
    9128             :       AsmString = "sev$\xFF\x02\x01";
    9129             :       break;
    9130             :     }
    9131          22 :     if (MI->getNumOperands() == 3 &&
    9132          22 :         MI->getOperand(0).isImm() &&
    9133          16 :         MI->getOperand(0).getImm() == 5 &&
    9134          26 :         !STI.getFeatureBits()[ARM::ModeThumb] &&
    9135          10 :         STI.getFeatureBits()[ARM::HasV8Ops]) {
    9136             :       // (HINT 5, pred:$p)
    9137             :       AsmString = "sevl$\xFF\x02\x01";
    9138             :       break;
    9139             :     }
    9140          16 :     if (MI->getNumOperands() == 3 &&
    9141          16 :         MI->getOperand(0).isImm() &&
    9142          11 :         MI->getOperand(0).getImm() == 16 &&
    9143          17 :         !STI.getFeatureBits()[ARM::ModeThumb] &&
    9144           6 :         STI.getFeatureBits()[ARM::FeatureRAS]) {
    9145             :       // (HINT 16, pred:$p)
    9146             :       AsmString = "esb$\xFF\x02\x01";
    9147             :       break;
    9148             :     }
    9149             :     return false;
    9150          33 :   case ARM::t2HINT:
    9151          66 :     if (MI->getNumOperands() == 3 &&
    9152          66 :         MI->getOperand(0).isImm() &&
    9153          39 :         MI->getOperand(0).getImm() == 0 &&
    9154          51 :         STI.getFeatureBits()[ARM::ModeThumb] &&
    9155          12 :         STI.getFeatureBits()[ARM::FeatureThumb2]) {
    9156             :       // (t2HINT 0, pred:$p)
    9157             :       AsmString = "nop$\xFF\x02\x01.w";
    9158             :       break;
    9159             :     }
    9160          54 :     if (MI->getNumOperands() == 3 &&
    9161          54 :         MI->getOperand(0).isImm() &&
    9162          29 :         MI->getOperand(0).getImm() == 1 &&
    9163          33 :         STI.getFeatureBits()[ARM::ModeThumb] &&
    9164           4 :         STI.getFeatureBits()[ARM::FeatureThumb2]) {
    9165             :       // (t2HINT 1, pred:$p)
    9166             :       AsmString = "yield$\xFF\x02\x01.w";
    9167             :       break;
    9168             :     }
    9169          50 :     if (MI->getNumOperands() == 3 &&
    9170          50 :         MI->getOperand(0).isImm() &&
    9171          27 :         MI->getOperand(0).getImm() == 2 &&
    9172          31 :         STI.getFeatureBits()[ARM::ModeThumb] &&
    9173           4 :         STI.getFeatureBits()[ARM::FeatureThumb2]) {
    9174             :       // (t2HINT 2, pred:$p)
    9175             :       AsmString = "wfe$\xFF\x02\x01.w";
    9176             :       break;
    9177             :     }
    9178          46 :     if (MI->getNumOperands() == 3 &&
    9179          46 :         MI->getOperand(0).isImm() &&
    9180          25 :         MI->getOperand(0).getImm() == 3 &&
    9181          29 :         STI.getFeatureBits()[ARM::ModeThumb] &&
    9182           4 :         STI.getFeatureBits()[ARM::FeatureThumb2]) {
    9183             :       // (t2HINT 3, pred:$p)
    9184             :       AsmString = "wfi$\xFF\x02\x01.w";
    9185             :       break;
    9186             :     }
    9187          42 :     if (MI->getNumOperands() == 3 &&
    9188          42 :         MI->getOperand(0).isImm() &&
    9189          29 :         MI->getOperand(0).getImm() == 4 &&
    9190          45 :         STI.getFeatureBits()[ARM::ModeThumb] &&
    9191          16 :         STI.getFeatureBits()[ARM::FeatureThumb2]) {
    9192             :       // (t2HINT 4, pred:$p)
    9193             :       AsmString = "sev$\xFF\x02\x01.w";
    9194             :       break;
    9195             :     }
    9196          26 :     if (MI->getNumOperands() == 3 &&
    9197          26 :         MI->getOperand(0).isImm() &&
    9198          15 :         MI->getOperand(0).getImm() == 5 &&
    9199           6 :         STI.getFeatureBits()[ARM::ModeThumb] &&
    9200          19 :         STI.getFeatureBits()[ARM::FeatureThumb2] &&
    9201           4 :         STI.getFeatureBits()[ARM::HasV8Ops]) {
    9202             :       // (t2HINT 5, pred:$p)
    9203             :       AsmString = "sevl$\xFF\x02\x01.w";
    9204             :       break;
    9205             :     }
    9206          22 :     if (MI->getNumOperands() == 3 &&
    9207          22 :         MI->getOperand(0).isImm() &&
    9208          16 :         MI->getOperand(0).getImm() == 16 &&
    9209          15 :         STI.getFeatureBits()[ARM::ModeThumb] &&
    9210          26 :         STI.getFeatureBits()[ARM::FeatureThumb2] &&
    9211          10 :         STI.getFeatureBits()[ARM::FeatureRAS]) {
    9212             :       // (t2HINT 16, pred:$p)
    9213             :       AsmString = "esb$\xFF\x02\x01.w";
    9214             :       break;
    9215             :     }
    9216             :     return false;
    9217          56 :   case ARM::t2SUBS_PC_LR:
    9218         112 :     if (MI->getNumOperands() == 3 &&
    9219         112 :         MI->getOperand(0).isImm() &&
    9220         105 :         MI->getOperand(0).getImm() == 0 &&
    9221         147 :         STI.getFeatureBits()[ARM::ModeThumb] &&
    9222         203 :         STI.getFeatureBits()[ARM::FeatureThumb2] &&
    9223          98 :         STI.getFeatureBits()[ARM::FeatureVirtualization]) {
    9224             :       // (t2SUBS_PC_LR 0, pred:$p)
    9225             :       AsmString = "eret$\xFF\x02\x01";
    9226             :       break;
    9227             :     }
    9228             :     return false;
    9229         157 :   case ARM::tHINT:
    9230         314 :     if (MI->getNumOperands() == 3 &&
    9231         314 :         MI->getOperand(0).isImm() &&
    9232         242 :         MI->getOperand(0).getImm() == 0 &&
    9233         412 :         STI.getFeatureBits()[ARM::ModeThumb] &&
    9234         170 :         STI.getFeatureBits()[ARM::HasV6MOps]) {
    9235             :       // (tHINT 0, pred:$p)
    9236             :       AsmString = "nop$\xFF\x02\x01";
    9237             :       break;
    9238             :     }
    9239         144 :     if (MI->getNumOperands() == 3 &&
    9240         144 :         MI->getOperand(0).isImm() &&
    9241          88 :         MI->getOperand(0).getImm() == 1 &&
    9242         120 :         STI.getFeatureBits()[ARM::ModeThumb] &&
    9243          32 :         STI.getFeatureBits()[ARM::HasV6MOps]) {
    9244             :       // (tHINT 1, pred:$p)
    9245             :       AsmString = "yield$\xFF\x02\x01";
    9246             :       break;
    9247             :     }
    9248         112 :     if (MI->getNumOperands() == 3 &&
    9249         112 :         MI->getOperand(0).isImm() &&
    9250          72 :         MI->getOperand(0).getImm() == 2 &&
    9251         104 :         STI.getFeatureBits()[ARM::ModeThumb] &&
    9252          32 :         STI.getFeatureBits()[ARM::HasV6MOps]) {
    9253             :       // (tHINT 2, pred:$p)
    9254             :       AsmString = "wfe$\xFF\x02\x01";
    9255             :       break;
    9256             :     }
    9257          80 :     if (MI->getNumOperands() == 3 &&
    9258          80 :         MI->getOperand(0).isImm() &&
    9259          56 :         MI->getOperand(0).getImm() == 3 &&
    9260          88 :         STI.getFeatureBits()[ARM::ModeThumb] &&
    9261          32 :         STI.getFeatureBits()[ARM::HasV6MOps]) {
    9262             :       // (tHINT 3, pred:$p)
    9263             :       AsmString = "wfi$\xFF\x02\x01";
    9264             :       break;
    9265             :     }
    9266          48 :     if (MI->getNumOperands() == 3 &&
    9267          48 :         MI->getOperand(0).isImm() &&
    9268          34 :         MI->getOperand(0).getImm() == 4 &&
    9269          54 :         STI.getFeatureBits()[ARM::ModeThumb] &&
    9270          20 :         STI.getFeatureBits()[ARM::HasV6MOps]) {
    9271             :       // (tHINT 4, pred:$p)
    9272             :       AsmString = "sev$\xFF\x02\x01";
    9273             :       break;
    9274             :     }
    9275          28 :     if (MI->getNumOperands() == 3 &&
    9276          28 :         MI->getOperand(0).isImm() &&
    9277          21 :         MI->getOperand(0).getImm() == 5 &&
    9278          21 :         STI.getFeatureBits()[ARM::ModeThumb] &&
    9279          34 :         STI.getFeatureBits()[ARM::FeatureThumb2] &&
    9280          12 :         STI.getFeatureBits()[ARM::HasV8Ops]) {
    9281             :       // (tHINT 5, pred:$p)
    9282             :       AsmString = "sevl$\xFF\x02\x01";
    9283             :       break;
    9284             :     }
    9285             :     return false;
    9286             :   }
    9287             : 
    9288         391 :   unsigned I = 0;
    9289        4604 :   while (AsmString[I] != ' ' && AsmString[I] != '\t' &&
    9290        2939 :          AsmString[I] != '$' && AsmString[I] != '\0')
    9291        1274 :     ++I;
    9292         782 :   OS << '\t' << StringRef(AsmString, I);
    9293         391 :   if (AsmString[I] != '\0') {
    9294         391 :     if (AsmString[I] == ' ' || AsmString[I] == '\t')      OS << '\t';
    9295             :     do {
    9296         439 :       if (AsmString[I] == '$') {
    9297         391 :         ++I;
    9298         391 :         if (AsmString[I] == (char)0xff) {
    9299         391 :           ++I;
    9300         391 :           int OpIdx = AsmString[I++] - 1;
    9301         391 :           int PrintMethodIdx = AsmString[I++] - 1;
    9302         391 :           printCustomAliasOperand(MI, OpIdx, PrintMethodIdx, STI, OS);
    9303             :         } else
    9304           0 :           printOperand(MI, unsigned(AsmString[I++]) - 1, STI, OS);
    9305             :       } else {
    9306          48 :         OS << AsmString[I++];
    9307             :       }
    9308         439 :     } while (AsmString[I] != '\0');
    9309             :   }
    9310             : 
    9311             :   return true;
    9312             : }
    9313             : 
    9314         391 : void ARMInstPrinter::printCustomAliasOperand(
    9315             :          const MCInst *MI, unsigned OpIdx,
    9316             :          unsigned PrintMethodIdx,
    9317             :          const MCSubtargetInfo &STI,
    9318             :          raw_ostream &OS) {
    9319         391 :   switch (PrintMethodIdx) {
    9320           0 :   default:
    9321           0 :     llvm_unreachable("Unknown PrintMethod kind");
    9322             :     break;
    9323         391 :   case 0:
    9324         391 :     printPredicateOperand(MI, OpIdx, STI, OS);
    9325             :     break;
    9326             :   }
    9327         391 : }
    9328             : 
    9329             : #endif // PRINT_ALIAS_INSTR

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