LCOV - code coverage report
Current view: top level - build-llvm/lib/Target/MSP430 - MSP430GenAsmWriter.inc (source / functions) Hit Total Coverage
Test: llvm-toolchain.info Lines: 58 67 86.6 %
Date: 2018-02-21 06:32:55 Functions: 2 2 100.0 %
Legend: Lines: hit not hit

          Line data    Source code
       1             : /*===- TableGen'erated file -------------------------------------*- C++ -*-===*\
       2             : |*                                                                            *|
       3             : |* Assembly Writer Source Fragment                                            *|
       4             : |*                                                                            *|
       5             : |* Automatically generated file, do not edit!                                 *|
       6             : |*                                                                            *|
       7             : \*===----------------------------------------------------------------------===*/
       8             : 
       9             : /// printInstruction - This method is automatically generated by tablegen
      10             : /// from the instruction set description.
      11        2481 : void MSP430InstPrinter::printInstruction(const MCInst *MI, raw_ostream &O) {
      12             :   static const char AsmStrs[] = {
      13             :   /* 0 */ 'r', 'l', 'a', '.', 'b', 9, 0,
      14             :   /* 7 */ 'r', 'r', 'a', '.', 'b', 9, 0,
      15             :   /* 14 */ 's', 'u', 'b', '.', 'b', 9, 0,
      16             :   /* 21 */ 's', 'u', 'b', 'c', '.', 'b', 9, 0,
      17             :   /* 29 */ 'a', 'd', 'd', 'c', '.', 'b', 9, 0,
      18             :   /* 37 */ 'b', 'i', 'c', '.', 'b', 9, 0,
      19             :   /* 44 */ 'c', 'l', 'r', 'c', 10, 9, 'r', 'r', 'c', '.', 'b', 9, 0,
      20             :   /* 57 */ 'a', 'd', 'd', '.', 'b', 9, 0,
      21             :   /* 64 */ 'a', 'n', 'd', '.', 'b', 9, 0,
      22             :   /* 71 */ 'c', 'm', 'p', '.', 'b', 9, 0,
      23             :   /* 78 */ 'x', 'o', 'r', '.', 'b', 9, 0,
      24             :   /* 85 */ 'b', 'i', 's', '.', 'b', 9, 0,
      25             :   /* 92 */ 'b', 'i', 't', '.', 'b', 9, 0,
      26             :   /* 99 */ 'm', 'o', 'v', '.', 'b', 9, 0,
      27             :   /* 106 */ 's', 'w', 'p', 'b', 9, 0,
      28             :   /* 112 */ 'c', 'a', 'l', 'l', 9, 0,
      29             :   /* 118 */ 'j', 'm', 'p', 9, 0,
      30             :   /* 123 */ 'b', 'r', 9, 0,
      31             :   /* 127 */ 's', 'x', 't', 9, 0,
      32             :   /* 132 */ 'r', 'l', 'a', '.', 'w', 9, 0,
      33             :   /* 139 */ 'r', 'r', 'a', '.', 'w', 9, 0,
      34             :   /* 146 */ 's', 'u', 'b', '.', 'w', 9, 0,
      35             :   /* 153 */ 's', 'u', 'b', 'c', '.', 'w', 9, 0,
      36             :   /* 161 */ 'a', 'd', 'd', 'c', '.', 'w', 9, 0,
      37             :   /* 169 */ 'b', 'i', 'c', '.', 'w', 9, 0,
      38             :   /* 176 */ 'c', 'l', 'r', 'c', 10, 9, 'r', 'r', 'c', '.', 'w', 9, 0,
      39             :   /* 189 */ 'a', 'd', 'd', '.', 'w', 9, 0,
      40             :   /* 196 */ 'a', 'n', 'd', '.', 'w', 9, 0,
      41             :   /* 203 */ 'p', 'u', 's', 'h', '.', 'w', 9, 0,
      42             :   /* 211 */ 'c', 'm', 'p', '.', 'w', 9, 0,
      43             :   /* 218 */ 'p', 'o', 'p', '.', 'w', 9, 0,
      44             :   /* 225 */ 'x', 'o', 'r', '.', 'w', 9, 0,
      45             :   /* 232 */ 'b', 'i', 's', '.', 'w', 9, 0,
      46             :   /* 239 */ 'b', 'i', 't', '.', 'w', 9, 0,
      47             :   /* 246 */ 'm', 'o', 'v', '.', 'w', 9, 0,
      48             :   /* 253 */ '#', 32, 'X', 'R', 'a', 'y', 32, 'F', 'u', 'n', 'c', 't', 'i', 'o', 'n', 32, 'P', 'a', 't', 'c', 'h', 'a', 'b', 'l', 'e', 32, 'R', 'E', 'T', '.', 0,
      49             :   /* 284 */ '#', 32, 'X', 'R', 'a', 'y', 32, 'C', 'u', 's', 't', 'o', 'm', 32, 'E', 'v', 'e', 'n', 't', 32, 'L', 'o', 'g', '.', 0,
      50             :   /* 309 */ '#', 32, 'X', 'R', 'a', 'y', 32, 'F', 'u', 'n', 'c', 't', 'i', 'o', 'n', 32, 'E', 'n', 't', 'e', 'r', '.', 0,
      51             :   /* 332 */ '#', 32, 'X', 'R', 'a', 'y', 32, 'T', 'a', 'i', 'l', 32, 'C', 'a', 'l', 'l', 32, 'E', 'x', 'i', 't', '.', 0,
      52             :   /* 355 */ '#', 32, 'X', 'R', 'a', 'y', 32, 'F', 'u', 'n', 'c', 't', 'i', 'o', 'n', 32, 'E', 'x', 'i', 't', '.', 0,
      53             :   /* 377 */ 's', 'u', 'b', '.', 'b', 9, '@', 0,
      54             :   /* 385 */ 'a', 'd', 'd', '.', 'b', 9, '@', 0,
      55             :   /* 393 */ 'a', 'n', 'd', '.', 'b', 9, '@', 0,
      56             :   /* 401 */ 'x', 'o', 'r', '.', 'b', 9, '@', 0,
      57             :   /* 409 */ 'b', 'i', 's', '.', 'b', 9, '@', 0,
      58             :   /* 417 */ 'm', 'o', 'v', '.', 'b', 9, '@', 0,
      59             :   /* 425 */ 's', 'u', 'b', '.', 'w', 9, '@', 0,
      60             :   /* 433 */ 'a', 'd', 'd', '.', 'w', 9, '@', 0,
      61             :   /* 441 */ 'a', 'n', 'd', '.', 'w', 9, '@', 0,
      62             :   /* 449 */ 'x', 'o', 'r', '.', 'w', 9, '@', 0,
      63             :   /* 457 */ 'b', 'i', 's', '.', 'w', 9, '@', 0,
      64             :   /* 465 */ 'm', 'o', 'v', '.', 'w', 9, '@', 0,
      65             :   /* 473 */ 'L', 'I', 'F', 'E', 'T', 'I', 'M', 'E', '_', 'E', 'N', 'D', 0,
      66             :   /* 486 */ 'B', 'U', 'N', 'D', 'L', 'E', 0,
      67             :   /* 493 */ 'D', 'B', 'G', '_', 'V', 'A', 'L', 'U', 'E', 0,
      68             :   /* 503 */ '#', 'A', 'D', 'J', 'C', 'A', 'L', 'L', 'S', 'T', 'A', 'C', 'K', 'D', 'O', 'W', 'N', 0,
      69             :   /* 521 */ '#', 32, 'S', 'r', 'a', '1', '6', 32, 'P', 'S', 'E', 'U', 'D', 'O', 0,
      70             :   /* 536 */ '#', 32, 'S', 'h', 'l', '1', '6', 32, 'P', 'S', 'E', 'U', 'D', 'O', 0,
      71             :   /* 551 */ '#', 32, 'S', 'r', 'l', '1', '6', 32, 'P', 'S', 'E', 'U', 'D', 'O', 0,
      72             :   /* 566 */ '#', 32, 'S', 'e', 'l', 'e', 'c', 't', '1', '6', 32, 'P', 'S', 'E', 'U', 'D', 'O', 0,
      73             :   /* 584 */ '#', 32, 'S', 'r', 'a', '8', 32, 'P', 'S', 'E', 'U', 'D', 'O', 0,
      74             :   /* 598 */ '#', 32, 'S', 'h', 'l', '8', 32, 'P', 'S', 'E', 'U', 'D', 'O', 0,
      75             :   /* 612 */ '#', 32, 'S', 'r', 'l', '8', 32, 'P', 'S', 'E', 'U', 'D', 'O', 0,
      76             :   /* 626 */ '#', 32, 'S', 'e', 'l', 'e', 'c', 't', '8', 32, 'P', 'S', 'E', 'U', 'D', 'O', 0,
      77             :   /* 643 */ '#', 32, 'A', 'D', 'D', 'f', 'r', 'a', 'm', 'e', 32, 'P', 'S', 'E', 'U', 'D', 'O', 0,
      78             :   /* 661 */ '#', 'A', 'D', 'J', 'C', 'A', 'L', 'L', 'S', 'T', 'A', 'C', 'K', 'U', 'P', 0,
      79             :   /* 677 */ 'L', 'I', 'F', 'E', 'T', 'I', 'M', 'E', '_', 'S', 'T', 'A', 'R', 'T', 0,
      80             :   /* 692 */ 'r', 'e', 't', 'i', 0,
      81             :   /* 697 */ 'j', 0,
      82             :   /* 699 */ '#', 32, 'F', 'E', 'n', 't', 'r', 'y', 32, 'c', 'a', 'l', 'l', 0,
      83             :   /* 713 */ 'n', 'o', 'p', 0,
      84             :   /* 717 */ 'r', 'e', 't', 0,
      85             :   };
      86             : 
      87             :   static const uint16_t OpInfo0[] = {
      88             :     0U, // PHI
      89             :     0U, // INLINEASM
      90             :     0U, // CFI_INSTRUCTION
      91             :     0U, // EH_LABEL
      92             :     0U, // GC_LABEL
      93             :     0U, // ANNOTATION_LABEL
      94             :     0U, // KILL
      95             :     0U, // EXTRACT_SUBREG
      96             :     0U, // INSERT_SUBREG
      97             :     0U, // IMPLICIT_DEF
      98             :     0U, // SUBREG_TO_REG
      99             :     0U, // COPY_TO_REGCLASS
     100             :     494U,       // DBG_VALUE
     101             :     0U, // REG_SEQUENCE
     102             :     0U, // COPY
     103             :     487U,       // BUNDLE
     104             :     678U,       // LIFETIME_START
     105             :     474U,       // LIFETIME_END
     106             :     0U, // STACKMAP
     107             :     700U,       // FENTRY_CALL
     108             :     0U, // PATCHPOINT
     109             :     0U, // LOAD_STACK_GUARD
     110             :     0U, // STATEPOINT
     111             :     0U, // LOCAL_ESCAPE
     112             :     0U, // FAULTING_OP
     113             :     0U, // PATCHABLE_OP
     114             :     310U,       // PATCHABLE_FUNCTION_ENTER
     115             :     254U,       // PATCHABLE_RET
     116             :     356U,       // PATCHABLE_FUNCTION_EXIT
     117             :     333U,       // PATCHABLE_TAIL_CALL
     118             :     285U,       // PATCHABLE_EVENT_CALL
     119             :     0U, // G_ADD
     120             :     0U, // G_SUB
     121             :     0U, // G_MUL
     122             :     0U, // G_SDIV
     123             :     0U, // G_UDIV
     124             :     0U, // G_SREM
     125             :     0U, // G_UREM
     126             :     0U, // G_AND
     127             :     0U, // G_OR
     128             :     0U, // G_XOR
     129             :     0U, // G_IMPLICIT_DEF
     130             :     0U, // G_PHI
     131             :     0U, // G_FRAME_INDEX
     132             :     0U, // G_GLOBAL_VALUE
     133             :     0U, // G_EXTRACT
     134             :     0U, // G_UNMERGE_VALUES
     135             :     0U, // G_INSERT
     136             :     0U, // G_MERGE_VALUES
     137             :     0U, // G_PTRTOINT
     138             :     0U, // G_INTTOPTR
     139             :     0U, // G_BITCAST
     140             :     0U, // G_LOAD
     141             :     0U, // G_STORE
     142             :     0U, // G_ATOMIC_CMPXCHG_WITH_SUCCESS
     143             :     0U, // G_ATOMIC_CMPXCHG
     144             :     0U, // G_ATOMICRMW_XCHG
     145             :     0U, // G_ATOMICRMW_ADD
     146             :     0U, // G_ATOMICRMW_SUB
     147             :     0U, // G_ATOMICRMW_AND
     148             :     0U, // G_ATOMICRMW_NAND
     149             :     0U, // G_ATOMICRMW_OR
     150             :     0U, // G_ATOMICRMW_XOR
     151             :     0U, // G_ATOMICRMW_MAX
     152             :     0U, // G_ATOMICRMW_MIN
     153             :     0U, // G_ATOMICRMW_UMAX
     154             :     0U, // G_ATOMICRMW_UMIN
     155             :     0U, // G_BRCOND
     156             :     0U, // G_BRINDIRECT
     157             :     0U, // G_INTRINSIC
     158             :     0U, // G_INTRINSIC_W_SIDE_EFFECTS
     159             :     0U, // G_ANYEXT
     160             :     0U, // G_TRUNC
     161             :     0U, // G_CONSTANT
     162             :     0U, // G_FCONSTANT
     163             :     0U, // G_VASTART
     164             :     0U, // G_VAARG
     165             :     0U, // G_SEXT
     166             :     0U, // G_ZEXT
     167             :     0U, // G_SHL
     168             :     0U, // G_LSHR
     169             :     0U, // G_ASHR
     170             :     0U, // G_ICMP
     171             :     0U, // G_FCMP
     172             :     0U, // G_SELECT
     173             :     0U, // G_UADDE
     174             :     0U, // G_USUBE
     175             :     0U, // G_SADDO
     176             :     0U, // G_SSUBO
     177             :     0U, // G_UMULO
     178             :     0U, // G_SMULO
     179             :     0U, // G_UMULH
     180             :     0U, // G_SMULH
     181             :     0U, // G_FADD
     182             :     0U, // G_FSUB
     183             :     0U, // G_FMUL
     184             :     0U, // G_FMA
     185             :     0U, // G_FDIV
     186             :     0U, // G_FREM
     187             :     0U, // G_FPOW
     188             :     0U, // G_FEXP
     189             :     0U, // G_FEXP2
     190             :     0U, // G_FLOG
     191             :     0U, // G_FLOG2
     192             :     0U, // G_FNEG
     193             :     0U, // G_FPEXT
     194             :     0U, // G_FPTRUNC
     195             :     0U, // G_FPTOSI
     196             :     0U, // G_FPTOUI
     197             :     0U, // G_SITOFP
     198             :     0U, // G_UITOFP
     199             :     0U, // G_GEP
     200             :     0U, // G_PTR_MASK
     201             :     0U, // G_BR
     202             :     0U, // G_INSERT_VECTOR_ELT
     203             :     0U, // G_EXTRACT_VECTOR_ELT
     204             :     0U, // G_SHUFFLE_VECTOR
     205             :     0U, // G_BSWAP
     206             :     1186U,      // ADC16mi
     207             :     18594U,     // ADC16mm
     208             :     1186U,      // ADC16mr
     209             :     1186U,      // ADC16ri
     210             :     34978U,     // ADC16rm
     211             :     1186U,      // ADC16rr
     212             :     1054U,      // ADC8mi
     213             :     18462U,     // ADC8mm
     214             :     1054U,      // ADC8mr
     215             :     1054U,      // ADC8ri
     216             :     34846U,     // ADC8rm
     217             :     1054U,      // ADC8rr
     218             :     1214U,      // ADD16mi
     219             :     18622U,     // ADD16mm
     220             :     1214U,      // ADD16mr
     221             :     1214U,      // ADD16ri
     222             :     35006U,     // ADD16rm
     223             :     3506U,      // ADD16rm_POST
     224             :     1214U,      // ADD16rr
     225             :     1082U,      // ADD8mi
     226             :     18490U,     // ADD8mm
     227             :     1082U,      // ADD8mr
     228             :     1082U,      // ADD8ri
     229             :     34874U,     // ADD8rm
     230             :     3458U,      // ADD8rm_POST
     231             :     1082U,      // ADD8rr
     232             :     644U,       // ADDframe
     233             :     504U,       // ADJCALLSTACKDOWN
     234             :     662U,       // ADJCALLSTACKUP
     235             :     1221U,      // AND16mi
     236             :     18629U,     // AND16mm
     237             :     1221U,      // AND16mr
     238             :     1221U,      // AND16ri
     239             :     35013U,     // AND16rm
     240             :     3514U,      // AND16rm_POST
     241             :     1221U,      // AND16rr
     242             :     1089U,      // AND8mi
     243             :     18497U,     // AND8mm
     244             :     1089U,      // AND8mr
     245             :     1089U,      // AND8ri
     246             :     34881U,     // AND8rm
     247             :     3466U,      // AND8rm_POST
     248             :     1089U,      // AND8rr
     249             :     18602U,     // BIC16mm
     250             :     1194U,      // BIC16mr
     251             :     34986U,     // BIC16rm
     252             :     1194U,      // BIC16rr
     253             :     18470U,     // BIC8mm
     254             :     1062U,      // BIC8mr
     255             :     34854U,     // BIC8rm
     256             :     1062U,      // BIC8rr
     257             :     1264U,      // BIT16mi
     258             :     18672U,     // BIT16mm
     259             :     1264U,      // BIT16mr
     260             :     4336U,      // BIT16ri
     261             :     5360U,      // BIT16rm
     262             :     4336U,      // BIT16rr
     263             :     1117U,      // BIT8mi
     264             :     18525U,     // BIT8mm
     265             :     1117U,      // BIT8mr
     266             :     4189U,      // BIT8ri
     267             :     5213U,      // BIT8rm
     268             :     4189U,      // BIT8rr
     269             :     6268U,      // Bi
     270             :     7292U,      // Bm
     271             :     6268U,      // Br
     272             :     6257U,      // CALLi
     273             :     8305U,      // CALLm
     274             :     6257U,      // CALLr
     275             :     1236U,      // CMP16mi
     276             :     1236U,      // CMP16mr
     277             :     4308U,      // CMP16ri
     278             :     5332U,      // CMP16rm
     279             :     4308U,      // CMP16rr
     280             :     1096U,      // CMP8mi
     281             :     1096U,      // CMP8mr
     282             :     4168U,      // CMP8ri
     283             :     5192U,      // CMP8rm
     284             :     4168U,      // CMP8rr
     285             :     9914U,      // JCC
     286             :     10359U,     // JMP
     287             :     1271U,      // MOV16mi
     288             :     18679U,     // MOV16mm
     289             :     1271U,      // MOV16mr
     290             :     4343U,      // MOV16ri
     291             :     5367U,      // MOV16rm
     292             :     50642U,     // MOV16rm_POST
     293             :     4343U,      // MOV16rr
     294             :     1124U,      // MOV8mi
     295             :     18532U,     // MOV8mm
     296             :     1124U,      // MOV8mr
     297             :     4196U,      // MOV8ri
     298             :     5220U,      // MOV8rm
     299             :     50594U,     // MOV8rm_POST
     300             :     4196U,      // MOV8rr
     301             :     5220U,      // MOVZX16rm8
     302             :     4196U,      // MOVZX16rr8
     303             :     714U,       // NOP
     304             :     1257U,      // OR16mi
     305             :     18665U,     // OR16mm
     306             :     1257U,      // OR16mr
     307             :     1257U,      // OR16ri
     308             :     35049U,     // OR16rm
     309             :     3530U,      // OR16rm_POST
     310             :     1257U,      // OR16rr
     311             :     1110U,      // OR8mi
     312             :     18518U,     // OR8mm
     313             :     1110U,      // OR8mr
     314             :     1110U,      // OR8ri
     315             :     34902U,     // OR8rm
     316             :     3482U,      // OR8rm_POST
     317             :     1110U,      // OR8rr
     318             :     6363U,      // POP16r
     319             :     6348U,      // PUSH16r
     320             :     718U,       // RET
     321             :     693U,       // RETI
     322             :     6284U,      // SAR16r1
     323             :     6321U,      // SAR16r1c
     324             :     6152U,      // SAR8r1
     325             :     6189U,      // SAR8r1c
     326             :     1178U,      // SBC16mi
     327             :     18586U,     // SBC16mm
     328             :     1178U,      // SBC16mr
     329             :     1178U,      // SBC16ri
     330             :     34970U,     // SBC16rm
     331             :     1178U,      // SBC16rr
     332             :     1046U,      // SBC8mi
     333             :     18454U,     // SBC8mm
     334             :     1046U,      // SBC8mr
     335             :     1046U,      // SBC8ri
     336             :     34838U,     // SBC8rm
     337             :     1046U,      // SBC8rr
     338             :     6272U,      // SEXT16r
     339             :     6277U,      // SHL16r1
     340             :     6145U,      // SHL8r1
     341             :     1171U,      // SUB16mi
     342             :     18579U,     // SUB16mm
     343             :     1171U,      // SUB16mr
     344             :     1171U,      // SUB16ri
     345             :     34963U,     // SUB16rm
     346             :     3498U,      // SUB16rm_POST
     347             :     1171U,      // SUB16rr
     348             :     1039U,      // SUB8mi
     349             :     18447U,     // SUB8mm
     350             :     1039U,      // SUB8mr
     351             :     1039U,      // SUB8ri
     352             :     34831U,     // SUB8rm
     353             :     3450U,      // SUB8rm_POST
     354             :     1039U,      // SUB8rr
     355             :     6251U,      // SWPB16r
     356             :     567U,       // Select16
     357             :     627U,       // Select8
     358             :     537U,       // Shl16
     359             :     599U,       // Shl8
     360             :     522U,       // Sra16
     361             :     585U,       // Sra8
     362             :     552U,       // Srl16
     363             :     613U,       // Srl8
     364             :     1250U,      // XOR16mi
     365             :     18658U,     // XOR16mm
     366             :     1250U,      // XOR16mr
     367             :     1250U,      // XOR16ri
     368             :     35042U,     // XOR16rm
     369             :     3522U,      // XOR16rm_POST
     370             :     1250U,      // XOR16rr
     371             :     1103U,      // XOR8mi
     372             :     18511U,     // XOR8mm
     373             :     1103U,      // XOR8mr
     374             :     1103U,      // XOR8ri
     375             :     34895U,     // XOR8rm
     376             :     3474U,      // XOR8rm_POST
     377             :     1103U,      // XOR8rr
     378             :     4196U,      // ZEXT16r
     379             :   };
     380             : 
     381             :   static const uint8_t OpInfo1[] = {
     382             :     0U, // PHI
     383             :     0U, // INLINEASM
     384             :     0U, // CFI_INSTRUCTION
     385             :     0U, // EH_LABEL
     386             :     0U, // GC_LABEL
     387             :     0U, // ANNOTATION_LABEL
     388             :     0U, // KILL
     389             :     0U, // EXTRACT_SUBREG
     390             :     0U, // INSERT_SUBREG
     391             :     0U, // IMPLICIT_DEF
     392             :     0U, // SUBREG_TO_REG
     393             :     0U, // COPY_TO_REGCLASS
     394             :     0U, // DBG_VALUE
     395             :     0U, // REG_SEQUENCE
     396             :     0U, // COPY
     397             :     0U, // BUNDLE
     398             :     0U, // LIFETIME_START
     399             :     0U, // LIFETIME_END
     400             :     0U, // STACKMAP
     401             :     0U, // FENTRY_CALL
     402             :     0U, // PATCHPOINT
     403             :     0U, // LOAD_STACK_GUARD
     404             :     0U, // STATEPOINT
     405             :     0U, // LOCAL_ESCAPE
     406             :     0U, // FAULTING_OP
     407             :     0U, // PATCHABLE_OP
     408             :     0U, // PATCHABLE_FUNCTION_ENTER
     409             :     0U, // PATCHABLE_RET
     410             :     0U, // PATCHABLE_FUNCTION_EXIT
     411             :     0U, // PATCHABLE_TAIL_CALL
     412             :     0U, // PATCHABLE_EVENT_CALL
     413             :     0U, // G_ADD
     414             :     0U, // G_SUB
     415             :     0U, // G_MUL
     416             :     0U, // G_SDIV
     417             :     0U, // G_UDIV
     418             :     0U, // G_SREM
     419             :     0U, // G_UREM
     420             :     0U, // G_AND
     421             :     0U, // G_OR
     422             :     0U, // G_XOR
     423             :     0U, // G_IMPLICIT_DEF
     424             :     0U, // G_PHI
     425             :     0U, // G_FRAME_INDEX
     426             :     0U, // G_GLOBAL_VALUE
     427             :     0U, // G_EXTRACT
     428             :     0U, // G_UNMERGE_VALUES
     429             :     0U, // G_INSERT
     430             :     0U, // G_MERGE_VALUES
     431             :     0U, // G_PTRTOINT
     432             :     0U, // G_INTTOPTR
     433             :     0U, // G_BITCAST
     434             :     0U, // G_LOAD
     435             :     0U, // G_STORE
     436             :     0U, // G_ATOMIC_CMPXCHG_WITH_SUCCESS
     437             :     0U, // G_ATOMIC_CMPXCHG
     438             :     0U, // G_ATOMICRMW_XCHG
     439             :     0U, // G_ATOMICRMW_ADD
     440             :     0U, // G_ATOMICRMW_SUB
     441             :     0U, // G_ATOMICRMW_AND
     442             :     0U, // G_ATOMICRMW_NAND
     443             :     0U, // G_ATOMICRMW_OR
     444             :     0U, // G_ATOMICRMW_XOR
     445             :     0U, // G_ATOMICRMW_MAX
     446             :     0U, // G_ATOMICRMW_MIN
     447             :     0U, // G_ATOMICRMW_UMAX
     448             :     0U, // G_ATOMICRMW_UMIN
     449             :     0U, // G_BRCOND
     450             :     0U, // G_BRINDIRECT
     451             :     0U, // G_INTRINSIC
     452             :     0U, // G_INTRINSIC_W_SIDE_EFFECTS
     453             :     0U, // G_ANYEXT
     454             :     0U, // G_TRUNC
     455             :     0U, // G_CONSTANT
     456             :     0U, // G_FCONSTANT
     457             :     0U, // G_VASTART
     458             :     0U, // G_VAARG
     459             :     0U, // G_SEXT
     460             :     0U, // G_ZEXT
     461             :     0U, // G_SHL
     462             :     0U, // G_LSHR
     463             :     0U, // G_ASHR
     464             :     0U, // G_ICMP
     465             :     0U, // G_FCMP
     466             :     0U, // G_SELECT
     467             :     0U, // G_UADDE
     468             :     0U, // G_USUBE
     469             :     0U, // G_SADDO
     470             :     0U, // G_SSUBO
     471             :     0U, // G_UMULO
     472             :     0U, // G_SMULO
     473             :     0U, // G_UMULH
     474             :     0U, // G_SMULH
     475             :     0U, // G_FADD
     476             :     0U, // G_FSUB
     477             :     0U, // G_FMUL
     478             :     0U, // G_FMA
     479             :     0U, // G_FDIV
     480             :     0U, // G_FREM
     481             :     0U, // G_FPOW
     482             :     0U, // G_FEXP
     483             :     0U, // G_FEXP2
     484             :     0U, // G_FLOG
     485             :     0U, // G_FLOG2
     486             :     0U, // G_FNEG
     487             :     0U, // G_FPEXT
     488             :     0U, // G_FPTRUNC
     489             :     0U, // G_FPTOSI
     490             :     0U, // G_FPTOUI
     491             :     0U, // G_SITOFP
     492             :     0U, // G_UITOFP
     493             :     0U, // G_GEP
     494             :     0U, // G_PTR_MASK
     495             :     0U, // G_BR
     496             :     0U, // G_INSERT_VECTOR_ELT
     497             :     0U, // G_EXTRACT_VECTOR_ELT
     498             :     0U, // G_SHUFFLE_VECTOR
     499             :     0U, // G_BSWAP
     500             :     0U, // ADC16mi
     501             :     0U, // ADC16mm
     502             :     0U, // ADC16mr
     503             :     1U, // ADC16ri
     504             :     0U, // ADC16rm
     505             :     1U, // ADC16rr
     506             :     0U, // ADC8mi
     507             :     0U, // ADC8mm
     508             :     0U, // ADC8mr
     509             :     1U, // ADC8ri
     510             :     0U, // ADC8rm
     511             :     1U, // ADC8rr
     512             :     0U, // ADD16mi
     513             :     0U, // ADD16mm
     514             :     0U, // ADD16mr
     515             :     1U, // ADD16ri
     516             :     0U, // ADD16rm
     517             :     0U, // ADD16rm_POST
     518             :     1U, // ADD16rr
     519             :     0U, // ADD8mi
     520             :     0U, // ADD8mm
     521             :     0U, // ADD8mr
     522             :     1U, // ADD8ri
     523             :     0U, // ADD8rm
     524             :     0U, // ADD8rm_POST
     525             :     1U, // ADD8rr
     526             :     0U, // ADDframe
     527             :     0U, // ADJCALLSTACKDOWN
     528             :     0U, // ADJCALLSTACKUP
     529             :     0U, // AND16mi
     530             :     0U, // AND16mm
     531             :     0U, // AND16mr
     532             :     1U, // AND16ri
     533             :     0U, // AND16rm
     534             :     0U, // AND16rm_POST
     535             :     1U, // AND16rr
     536             :     0U, // AND8mi
     537             :     0U, // AND8mm
     538             :     0U, // AND8mr
     539             :     1U, // AND8ri
     540             :     0U, // AND8rm
     541             :     0U, // AND8rm_POST
     542             :     1U, // AND8rr
     543             :     0U, // BIC16mm
     544             :     0U, // BIC16mr
     545             :     0U, // BIC16rm
     546             :     1U, // BIC16rr
     547             :     0U, // BIC8mm
     548             :     0U, // BIC8mr
     549             :     0U, // BIC8rm
     550             :     1U, // BIC8rr
     551             :     0U, // BIT16mi
     552             :     0U, // BIT16mm
     553             :     0U, // BIT16mr
     554             :     0U, // BIT16ri
     555             :     0U, // BIT16rm
     556             :     0U, // BIT16rr
     557             :     0U, // BIT8mi
     558             :     0U, // BIT8mm
     559             :     0U, // BIT8mr
     560             :     0U, // BIT8ri
     561             :     0U, // BIT8rm
     562             :     0U, // BIT8rr
     563             :     0U, // Bi
     564             :     0U, // Bm
     565             :     0U, // Br
     566             :     0U, // CALLi
     567             :     0U, // CALLm
     568             :     0U, // CALLr
     569             :     0U, // CMP16mi
     570             :     0U, // CMP16mr
     571             :     0U, // CMP16ri
     572             :     0U, // CMP16rm
     573             :     0U, // CMP16rr
     574             :     0U, // CMP8mi
     575             :     0U, // CMP8mr
     576             :     0U, // CMP8ri
     577             :     0U, // CMP8rm
     578             :     0U, // CMP8rr
     579             :     0U, // JCC
     580             :     0U, // JMP
     581             :     0U, // MOV16mi
     582             :     0U, // MOV16mm
     583             :     0U, // MOV16mr
     584             :     0U, // MOV16ri
     585             :     0U, // MOV16rm
     586             :     0U, // MOV16rm_POST
     587             :     0U, // MOV16rr
     588             :     0U, // MOV8mi
     589             :     0U, // MOV8mm
     590             :     0U, // MOV8mr
     591             :     0U, // MOV8ri
     592             :     0U, // MOV8rm
     593             :     0U, // MOV8rm_POST
     594             :     0U, // MOV8rr
     595             :     0U, // MOVZX16rm8
     596             :     0U, // MOVZX16rr8
     597             :     0U, // NOP
     598             :     0U, // OR16mi
     599             :     0U, // OR16mm
     600             :     0U, // OR16mr
     601             :     1U, // OR16ri
     602             :     0U, // OR16rm
     603             :     0U, // OR16rm_POST
     604             :     1U, // OR16rr
     605             :     0U, // OR8mi
     606             :     0U, // OR8mm
     607             :     0U, // OR8mr
     608             :     1U, // OR8ri
     609             :     0U, // OR8rm
     610             :     0U, // OR8rm_POST
     611             :     1U, // OR8rr
     612             :     0U, // POP16r
     613             :     0U, // PUSH16r
     614             :     0U, // RET
     615             :     0U, // RETI
     616             :     0U, // SAR16r1
     617             :     0U, // SAR16r1c
     618             :     0U, // SAR8r1
     619             :     0U, // SAR8r1c
     620             :     0U, // SBC16mi
     621             :     0U, // SBC16mm
     622             :     0U, // SBC16mr
     623             :     1U, // SBC16ri
     624             :     0U, // SBC16rm
     625             :     1U, // SBC16rr
     626             :     0U, // SBC8mi
     627             :     0U, // SBC8mm
     628             :     0U, // SBC8mr
     629             :     1U, // SBC8ri
     630             :     0U, // SBC8rm
     631             :     1U, // SBC8rr
     632             :     0U, // SEXT16r
     633             :     0U, // SHL16r1
     634             :     0U, // SHL8r1
     635             :     0U, // SUB16mi
     636             :     0U, // SUB16mm
     637             :     0U, // SUB16mr
     638             :     1U, // SUB16ri
     639             :     0U, // SUB16rm
     640             :     0U, // SUB16rm_POST
     641             :     1U, // SUB16rr
     642             :     0U, // SUB8mi
     643             :     0U, // SUB8mm
     644             :     0U, // SUB8mr
     645             :     1U, // SUB8ri
     646             :     0U, // SUB8rm
     647             :     0U, // SUB8rm_POST
     648             :     1U, // SUB8rr
     649             :     0U, // SWPB16r
     650             :     0U, // Select16
     651             :     0U, // Select8
     652             :     0U, // Shl16
     653             :     0U, // Shl8
     654             :     0U, // Sra16
     655             :     0U, // Sra8
     656             :     0U, // Srl16
     657             :     0U, // Srl8
     658             :     0U, // XOR16mi
     659             :     0U, // XOR16mm
     660             :     0U, // XOR16mr
     661             :     1U, // XOR16ri
     662             :     0U, // XOR16rm
     663             :     0U, // XOR16rm_POST
     664             :     1U, // XOR16rr
     665             :     0U, // XOR8mi
     666             :     0U, // XOR8mm
     667             :     0U, // XOR8mr
     668             :     1U, // XOR8ri
     669             :     0U, // XOR8rm
     670             :     0U, // XOR8rm_POST
     671             :     1U, // XOR8rr
     672             :     0U, // ZEXT16r
     673             :   };
     674             : 
     675        2481 :   O << "\t";
     676             : 
     677             :   // Emit the opcode for the instruction.
     678             :   uint32_t Bits = 0;
     679        2481 :   Bits |= OpInfo0[MI->getOpcode()] << 0;
     680        2481 :   Bits |= OpInfo1[MI->getOpcode()] << 16;
     681             :   assert(Bits != 0 && "Cannot print this instruction.");
     682        2481 :   O << AsmStrs+(Bits & 1023)-1;
     683             : 
     684             : 
     685             :   // Fragment 0 encoded into 4 bits for 11 unique commands.
     686        2481 :   switch ((Bits >> 10) & 15) {
     687           0 :   default: llvm_unreachable("Invalid command number.");
     688             :   case 0:
     689             :     // DBG_VALUE, BUNDLE, LIFETIME_START, LIFETIME_END, FENTRY_CALL, PATCHABL...
     690             :     return;
     691             :     break;
     692        1111 :   case 1:
     693             :     // ADC16mi, ADC16mr, ADC16ri, ADC16rr, ADC8mi, ADC8mr, ADC8ri, ADC8rr, AD...
     694        1111 :     printOperand(MI, 2, O);
     695        1111 :     break;
     696          58 :   case 2:
     697             :     // ADC16mm, ADC16rm, ADC8mm, ADC8rm, ADD16mm, ADD16rm, ADD8mm, ADD8rm, AN...
     698          58 :     printSrcMemOperand(MI, 2, O);
     699          58 :     O << ", ";
     700          58 :     break;
     701           5 :   case 3:
     702             :     // ADD16rm_POST, ADD8rm_POST, AND16rm_POST, AND8rm_POST, OR16rm_POST, OR8...
     703           5 :     printOperand(MI, 3, O);
     704           5 :     O << "+, ";
     705           5 :     printOperand(MI, 0, O);
     706           5 :     return;
     707             :     break;
     708         373 :   case 4:
     709             :     // BIT16ri, BIT16rr, BIT8ri, BIT8rr, CMP16ri, CMP16rr, CMP8ri, CMP8rr, MO...
     710         373 :     printOperand(MI, 1, O);
     711         373 :     O << ", ";
     712         373 :     printOperand(MI, 0, O);
     713         373 :     return;
     714             :     break;
     715         303 :   case 5:
     716             :     // BIT16rm, BIT8rm, CMP16rm, CMP8rm, MOV16rm, MOV8rm, MOVZX16rm8
     717         303 :     printSrcMemOperand(MI, 1, O);
     718         303 :     O << ", ";
     719         303 :     printOperand(MI, 0, O);
     720         303 :     return;
     721             :     break;
     722         278 :   case 6:
     723             :     // Bi, Br, CALLi, CALLr, POP16r, PUSH16r, SAR16r1, SAR16r1c, SAR8r1, SAR8...
     724         278 :     printOperand(MI, 0, O);
     725         278 :     return;
     726             :     break;
     727           2 :   case 7:
     728             :     // Bm
     729           2 :     printSrcMemOperand(MI, 0, O);
     730           2 :     return;
     731             :     break;
     732           0 :   case 8:
     733             :     // CALLm
     734           0 :     printSrcMemOperand(MI, 0, O, "mem");
     735           0 :     return;
     736             :     break;
     737          52 :   case 9:
     738             :     // JCC
     739          52 :     printCCOperand(MI, 1, O);
     740          52 :     O << "\t";
     741          52 :     printPCRelImmOperand(MI, 0, O);
     742          52 :     return;
     743             :     break;
     744           7 :   case 10:
     745             :     // JMP
     746           7 :     printPCRelImmOperand(MI, 0, O);
     747           7 :     return;
     748             :     break;
     749             :   }
     750             : 
     751             : 
     752             :   // Fragment 1 encoded into 2 bits for 4 unique commands.
     753        1169 :   switch ((Bits >> 14) & 3) {
     754           0 :   default: llvm_unreachable("Invalid command number.");
     755        1111 :   case 0:
     756             :     // ADC16mi, ADC16mr, ADC16ri, ADC16rr, ADC8mi, ADC8mr, ADC8ri, ADC8rr, AD...
     757        1111 :     O << ", ";
     758             :     break;
     759          27 :   case 1:
     760             :     // ADC16mm, ADC8mm, ADD16mm, ADD8mm, AND16mm, AND8mm, BIC16mm, BIC8mm, BI...
     761          27 :     printSrcMemOperand(MI, 0, O);
     762          27 :     return;
     763             :     break;
     764          31 :   case 2:
     765             :     // ADC16rm, ADC8rm, ADD16rm, ADD8rm, AND16rm, AND8rm, BIC16rm, BIC8rm, OR...
     766          31 :     printOperand(MI, 0, O);
     767          31 :     return;
     768             :     break;
     769           0 :   case 3:
     770             :     // MOV16rm_POST, MOV8rm_POST
     771           0 :     O << "+, ";
     772           0 :     printOperand(MI, 0, O);
     773           0 :     return;
     774             :     break;
     775             :   }
     776             : 
     777             : 
     778             :   // Fragment 2 encoded into 1 bits for 2 unique commands.
     779        1111 :   if ((Bits >> 16) & 1) {
     780             :     // ADC16ri, ADC16rr, ADC8ri, ADC8rr, ADD16ri, ADD16rr, ADD8ri, ADD8rr, AN...
     781         248 :     printOperand(MI, 0, O);
     782         248 :     return;
     783             :   } else {
     784             :     // ADC16mi, ADC16mr, ADC8mi, ADC8mr, ADD16mi, ADD16mr, ADD8mi, ADD8mr, AN...
     785         863 :     printSrcMemOperand(MI, 0, O);
     786         863 :     return;
     787             :   }
     788             : 
     789             : }
     790             : 
     791             : 
     792             : /// getRegisterName - This method is automatically generated by tblgen
     793             : /// from the register set description.  This returns the assembler name
     794             : /// for the specified register.
     795        2028 : const char *MSP430InstPrinter::getRegisterName(unsigned RegNo) {
     796             :   assert(RegNo && RegNo < 33 && "Invalid register number!");
     797             : 
     798             :   static const char AsmStrs[] = {
     799             :   /* 0 */ 'r', '1', '0', 0,
     800             :   /* 4 */ 'r', '0', 0,
     801             :   /* 7 */ 'r', '1', '1', 0,
     802             :   /* 11 */ 'r', '1', 0,
     803             :   /* 14 */ 'r', '1', '2', 0,
     804             :   /* 18 */ 'r', '2', 0,
     805             :   /* 21 */ 'r', '1', '3', 0,
     806             :   /* 25 */ 'r', '3', 0,
     807             :   /* 28 */ 'r', '1', '4', 0,
     808             :   /* 32 */ 'r', '4', 0,
     809             :   /* 35 */ 'r', '1', '5', 0,
     810             :   /* 39 */ 'r', '5', 0,
     811             :   /* 42 */ 'r', '6', 0,
     812             :   /* 45 */ 'r', '7', 0,
     813             :   /* 48 */ 'r', '8', 0,
     814             :   /* 51 */ 'r', '9', 0,
     815             :   };
     816             : 
     817             :   static const uint8_t RegAsmOffset[] = {
     818             :     25, 25, 32, 32, 4, 4, 11, 11, 18, 18, 39, 42, 45, 48, 
     819             :     51, 0, 7, 14, 21, 28, 35, 39, 42, 45, 48, 51, 0, 7, 
     820             :     14, 21, 28, 35, 
     821             :   };
     822             : 
     823             :   assert (*(AsmStrs+RegAsmOffset[RegNo-1]) &&
     824             :           "Invalid alt name index for register!");
     825        2028 :   return AsmStrs+RegAsmOffset[RegNo-1];
     826             : }
     827             : 
     828             : #ifdef PRINT_ALIAS_INSTR
     829             : #undef PRINT_ALIAS_INSTR
     830             : 
     831             : bool MSP430InstPrinter::printAliasInstr(const MCInst *MI, raw_ostream &OS) {
     832             :   return false;
     833             : }
     834             : 
     835             : #endif // PRINT_ALIAS_INSTR

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