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1 : /*===- TableGen'erated file -------------------------------------*- C++ -*-===*\
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3 : |* Assembly Writer Source Fragment *|
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5 : |* Automatically generated file, do not edit! *|
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8 :
9 : /// printInstruction - This method is automatically generated by tablegen
10 : /// from the instruction set description.
11 58738 : void AArch64InstPrinter::printInstruction(const MCInst *MI, const MCSubtargetInfo &STI, raw_ostream &O) {
12 : static const char AsmStrs[] = {
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231 : /* 1700 */ 's', 'x', 't', 'b', 9, 0,
232 : /* 1706 */ 'u', 'x', 't', 'b', 9, 0,
233 : /* 1712 */ 'f', 's', 'u', 'b', 9, 0,
234 : /* 1718 */ 's', 'h', 's', 'u', 'b', 9, 0,
235 : /* 1725 */ 'u', 'h', 's', 'u', 'b', 9, 0,
236 : /* 1732 */ 'f', 'm', 's', 'u', 'b', 9, 0,
237 : /* 1739 */ 'f', 'n', 'm', 's', 'u', 'b', 9, 0,
238 : /* 1747 */ 's', 'q', 's', 'u', 'b', 9, 0,
239 : /* 1754 */ 'u', 'q', 's', 'u', 'b', 9, 0,
240 : /* 1761 */ 'r', 'e', 'v', 'b', 9, 0,
241 : /* 1767 */ 'l', 'd', 's', 'm', 'a', 'x', 'b', 9, 0,
242 : /* 1776 */ 'l', 'd', 'u', 'm', 'a', 'x', 'b', 9, 0,
243 : /* 1785 */ 'p', 'a', 'c', 'd', 'z', 'b', 9, 0,
244 : /* 1793 */ 'a', 'u', 't', 'd', 'z', 'b', 9, 0,
245 : /* 1801 */ 'p', 'a', 'c', 'i', 'z', 'b', 9, 0,
246 : /* 1809 */ 'a', 'u', 't', 'i', 'z', 'b', 9, 0,
247 : /* 1817 */ 's', 'h', 'a', '1', 'c', 9, 0,
248 : /* 1824 */ 's', 'b', 'c', 9, 0,
249 : /* 1829 */ 'a', 'd', 'c', 9, 0,
250 : /* 1834 */ 'b', 'i', 'c', 9, 0,
251 : /* 1839 */ 'a', 'e', 's', 'i', 'm', 'c', 9, 0,
252 : /* 1847 */ 'a', 'e', 's', 'm', 'c', 9, 0,
253 : /* 1854 */ 'c', 's', 'i', 'n', 'c', 9, 0,
254 : /* 1861 */ 'h', 'v', 'c', 9, 0,
255 : /* 1866 */ 's', 'v', 'c', 9, 0,
256 : /* 1871 */ 'l', 'd', '1', 'd', 9, 0,
257 : /* 1877 */ 'l', 'd', 'f', 'f', '1', 'd', 9, 0,
258 : /* 1885 */ 'l', 'd', 'n', 'f', '1', 'd', 9, 0,
259 : /* 1893 */ 'l', 'd', 'n', 't', '1', 'd', 9, 0,
260 : /* 1901 */ 's', 't', 'n', 't', '1', 'd', 9, 0,
261 : /* 1909 */ 's', 't', '1', 'd', 9, 0,
262 : /* 1915 */ 'l', 'd', '2', 'd', 9, 0,
263 : /* 1921 */ 's', 't', '2', 'd', 9, 0,
264 : /* 1927 */ 'l', 'd', '3', 'd', 9, 0,
265 : /* 1933 */ 's', 't', '3', 'd', 9, 0,
266 : /* 1939 */ 'l', 'd', '4', 'd', 9, 0,
267 : /* 1945 */ 's', 't', '4', 'd', 9, 0,
268 : /* 1951 */ 'f', 'm', 'a', 'd', 9, 0,
269 : /* 1957 */ 'f', 'n', 'm', 'a', 'd', 9, 0,
270 : /* 1964 */ 'f', 't', 'm', 'a', 'd', 9, 0,
271 : /* 1971 */ 'f', 'a', 'b', 'd', 9, 0,
272 : /* 1977 */ 's', 'a', 'b', 'd', 9, 0,
273 : /* 1983 */ 'u', 'a', 'b', 'd', 9, 0,
274 : /* 1989 */ 'x', 'p', 'a', 'c', 'd', 9, 0,
275 : /* 1996 */ 's', 'q', 'd', 'e', 'c', 'd', 9, 0,
276 : /* 2004 */ 'u', 'q', 'd', 'e', 'c', 'd', 9, 0,
277 : /* 2012 */ 's', 'q', 'i', 'n', 'c', 'd', 9, 0,
278 : /* 2020 */ 'u', 'q', 'i', 'n', 'c', 'd', 9, 0,
279 : /* 2028 */ 'f', 'c', 'a', 'd', 'd', 9, 0,
280 : /* 2035 */ 'l', 'd', 'a', 'd', 'd', 9, 0,
281 : /* 2042 */ 'f', 'a', 'd', 'd', 9, 0,
282 : /* 2048 */ 's', 'r', 'h', 'a', 'd', 'd', 9, 0,
283 : /* 2056 */ 'u', 'r', 'h', 'a', 'd', 'd', 9, 0,
284 : /* 2064 */ 's', 'h', 'a', 'd', 'd', 9, 0,
285 : /* 2071 */ 'u', 'h', 'a', 'd', 'd', 9, 0,
286 : /* 2078 */ 'f', 'm', 'a', 'd', 'd', 9, 0,
287 : /* 2085 */ 'f', 'n', 'm', 'a', 'd', 'd', 9, 0,
288 : /* 2093 */ 'u', 's', 'q', 'a', 'd', 'd', 9, 0,
289 : /* 2101 */ 's', 'u', 'q', 'a', 'd', 'd', 9, 0,
290 : /* 2109 */ 'p', 'r', 'f', 'd', 9, 0,
291 : /* 2115 */ 'n', 'a', 'n', 'd', 9, 0,
292 : /* 2121 */ 'l', 'd', '1', 'r', 'q', 'd', 9, 0,
293 : /* 2129 */ 'l', 'd', '1', 'r', 'd', 9, 0,
294 : /* 2136 */ 'a', 's', 'r', 'd', 9, 0,
295 : /* 2142 */ 'a', 'e', 's', 'd', 9, 0,
296 : /* 2148 */ 'c', 'n', 't', 'd', 9, 0,
297 : /* 2154 */ 's', 'm', '4', 'e', 9, 0,
298 : /* 2160 */ 's', 'p', 'l', 'i', 'c', 'e', 9, 0,
299 : /* 2168 */ 'f', 'a', 'c', 'g', 'e', 9, 0,
300 : /* 2175 */ 'f', 'c', 'm', 'g', 'e', 9, 0,
301 : /* 2182 */ 'c', 'm', 'p', 'g', 'e', 9, 0,
302 : /* 2189 */ 'f', 's', 'c', 'a', 'l', 'e', 9, 0,
303 : /* 2197 */ 'w', 'h', 'i', 'l', 'e', 'l', 'e', 9, 0,
304 : /* 2206 */ 'f', 'c', 'm', 'l', 'e', 9, 0,
305 : /* 2213 */ 'c', 'm', 'p', 'l', 'e', 9, 0,
306 : /* 2220 */ 'f', 'c', 'm', 'n', 'e', 9, 0,
307 : /* 2227 */ 'c', 't', 'e', 'r', 'm', 'n', 'e', 9, 0,
308 : /* 2236 */ 'c', 'm', 'p', 'n', 'e', 9, 0,
309 : /* 2243 */ 'f', 'r', 'e', 'c', 'p', 'e', 9, 0,
310 : /* 2251 */ 'u', 'r', 'e', 'c', 'p', 'e', 9, 0,
311 : /* 2259 */ 'f', 'c', 'c', 'm', 'p', 'e', 9, 0,
312 : /* 2267 */ 'f', 'c', 'm', 'p', 'e', 9, 0,
313 : /* 2274 */ 'a', 'e', 's', 'e', 9, 0,
314 : /* 2280 */ 'p', 'f', 'a', 'l', 's', 'e', 9, 0,
315 : /* 2288 */ 'f', 'r', 's', 'q', 'r', 't', 'e', 9, 0,
316 : /* 2297 */ 'u', 'r', 's', 'q', 'r', 't', 'e', 9, 0,
317 : /* 2306 */ 'p', 't', 'r', 'u', 'e', 9, 0,
318 : /* 2313 */ 'b', 'i', 'f', 9, 0,
319 : /* 2318 */ 'r', 'm', 'i', 'f', 9, 0,
320 : /* 2324 */ 's', 'c', 'v', 't', 'f', 9, 0,
321 : /* 2331 */ 'u', 'c', 'v', 't', 'f', 9, 0,
322 : /* 2338 */ 's', 'u', 'b', 'g', 9, 0,
323 : /* 2344 */ 'a', 'd', 'd', 'g', 9, 0,
324 : /* 2350 */ 'l', 'd', 'g', 9, 0,
325 : /* 2355 */ 'f', 'n', 'e', 'g', 9, 0,
326 : /* 2361 */ 's', 'q', 'n', 'e', 'g', 9, 0,
327 : /* 2368 */ 'c', 's', 'n', 'e', 'g', 9, 0,
328 : /* 2375 */ 'i', 'r', 'g', 9, 0,
329 : /* 2380 */ 's', 'h', 'a', '1', 'h', 9, 0,
330 : /* 2387 */ 'l', 'd', '1', 'h', 9, 0,
331 : /* 2393 */ 'l', 'd', 'f', 'f', '1', 'h', 9, 0,
332 : /* 2401 */ 'l', 'd', 'n', 'f', '1', 'h', 9, 0,
333 : /* 2409 */ 'l', 'd', 'n', 't', '1', 'h', 9, 0,
334 : /* 2417 */ 's', 't', 'n', 't', '1', 'h', 9, 0,
335 : /* 2425 */ 's', 't', '1', 'h', 9, 0,
336 : /* 2431 */ 's', 'h', 'a', '5', '1', '2', 'h', 9, 0,
337 : /* 2440 */ 'c', 'r', 'c', '3', '2', 'h', 9, 0,
338 : /* 2448 */ 'l', 'd', '2', 'h', 9, 0,
339 : /* 2454 */ 's', 't', '2', 'h', 9, 0,
340 : /* 2460 */ 'l', 'd', '3', 'h', 9, 0,
341 : /* 2466 */ 's', 't', '3', 'h', 9, 0,
342 : /* 2472 */ 'l', 'd', '4', 'h', 9, 0,
343 : /* 2478 */ 's', 't', '4', 'h', 9, 0,
344 : /* 2484 */ 's', 'h', 'a', '2', '5', '6', 'h', 9, 0,
345 : /* 2493 */ 'l', 'd', 'a', 'd', 'd', 'a', 'h', 9, 0,
346 : /* 2502 */ 's', 'q', 'r', 'd', 'm', 'l', 'a', 'h', 9, 0,
347 : /* 2512 */ 'l', 'd', 's', 'm', 'i', 'n', 'a', 'h', 9, 0,
348 : /* 2522 */ 'l', 'd', 'u', 'm', 'i', 'n', 'a', 'h', 9, 0,
349 : /* 2532 */ 's', 'w', 'p', 'a', 'h', 9, 0,
350 : /* 2539 */ 'l', 'd', 'c', 'l', 'r', 'a', 'h', 9, 0,
351 : /* 2548 */ 'l', 'd', 'e', 'o', 'r', 'a', 'h', 9, 0,
352 : /* 2557 */ 'c', 'a', 's', 'a', 'h', 9, 0,
353 : /* 2564 */ 'l', 'd', 's', 'e', 't', 'a', 'h', 9, 0,
354 : /* 2573 */ 'l', 'd', 's', 'm', 'a', 'x', 'a', 'h', 9, 0,
355 : /* 2583 */ 'l', 'd', 'u', 'm', 'a', 'x', 'a', 'h', 9, 0,
356 : /* 2593 */ 'c', 'r', 'c', '3', '2', 'c', 'h', 9, 0,
357 : /* 2602 */ 's', 'q', 'd', 'e', 'c', 'h', 9, 0,
358 : /* 2610 */ 'u', 'q', 'd', 'e', 'c', 'h', 9, 0,
359 : /* 2618 */ 's', 'q', 'i', 'n', 'c', 'h', 9, 0,
360 : /* 2626 */ 'u', 'q', 'i', 'n', 'c', 'h', 9, 0,
361 : /* 2634 */ 'l', 'd', 'a', 'd', 'd', 'h', 9, 0,
362 : /* 2642 */ 'p', 'r', 'f', 'h', 9, 0,
363 : /* 2648 */ 'l', 'd', 'a', 'd', 'd', 'a', 'l', 'h', 9, 0,
364 : /* 2658 */ 'l', 'd', 's', 'm', 'i', 'n', 'a', 'l', 'h', 9, 0,
365 : /* 2669 */ 'l', 'd', 'u', 'm', 'i', 'n', 'a', 'l', 'h', 9, 0,
366 : /* 2680 */ 's', 'w', 'p', 'a', 'l', 'h', 9, 0,
367 : /* 2688 */ 'l', 'd', 'c', 'l', 'r', 'a', 'l', 'h', 9, 0,
368 : /* 2698 */ 'l', 'd', 'e', 'o', 'r', 'a', 'l', 'h', 9, 0,
369 : /* 2708 */ 'c', 'a', 's', 'a', 'l', 'h', 9, 0,
370 : /* 2716 */ 'l', 'd', 's', 'e', 't', 'a', 'l', 'h', 9, 0,
371 : /* 2726 */ 'l', 'd', 's', 'm', 'a', 'x', 'a', 'l', 'h', 9, 0,
372 : /* 2737 */ 'l', 'd', 'u', 'm', 'a', 'x', 'a', 'l', 'h', 9, 0,
373 : /* 2748 */ 'l', 'd', 'a', 'd', 'd', 'l', 'h', 9, 0,
374 : /* 2757 */ 'l', 'd', 's', 'm', 'i', 'n', 'l', 'h', 9, 0,
375 : /* 2767 */ 'l', 'd', 'u', 'm', 'i', 'n', 'l', 'h', 9, 0,
376 : /* 2777 */ 's', 'w', 'p', 'l', 'h', 9, 0,
377 : /* 2784 */ 'l', 'd', 'c', 'l', 'r', 'l', 'h', 9, 0,
378 : /* 2793 */ 'l', 'd', 'e', 'o', 'r', 'l', 'h', 9, 0,
379 : /* 2802 */ 'c', 'a', 's', 'l', 'h', 9, 0,
380 : /* 2809 */ 'l', 'd', 's', 'e', 't', 'l', 'h', 9, 0,
381 : /* 2818 */ 's', 'q', 'd', 'm', 'u', 'l', 'h', 9, 0,
382 : /* 2827 */ 's', 'q', 'r', 'd', 'm', 'u', 'l', 'h', 9, 0,
383 : /* 2837 */ 's', 'm', 'u', 'l', 'h', 9, 0,
384 : /* 2844 */ 'u', 'm', 'u', 'l', 'h', 9, 0,
385 : /* 2851 */ 'l', 'd', 's', 'm', 'a', 'x', 'l', 'h', 9, 0,
386 : /* 2861 */ 'l', 'd', 'u', 'm', 'a', 'x', 'l', 'h', 9, 0,
387 : /* 2871 */ 'l', 'd', 's', 'm', 'i', 'n', 'h', 9, 0,
388 : /* 2880 */ 'l', 'd', 'u', 'm', 'i', 'n', 'h', 9, 0,
389 : /* 2889 */ 's', 'w', 'p', 'h', 9, 0,
390 : /* 2895 */ 'l', 'd', '1', 'r', 'q', 'h', 9, 0,
391 : /* 2903 */ 'l', 'd', '1', 'r', 'h', 9, 0,
392 : /* 2910 */ 'l', 'd', 'a', 'r', 'h', 9, 0,
393 : /* 2917 */ 'l', 'd', 'l', 'a', 'r', 'h', 9, 0,
394 : /* 2925 */ 'l', 'd', 'r', 'h', 9, 0,
395 : /* 2931 */ 'l', 'd', 'c', 'l', 'r', 'h', 9, 0,
396 : /* 2939 */ 's', 't', 'l', 'l', 'r', 'h', 9, 0,
397 : /* 2947 */ 's', 't', 'l', 'r', 'h', 9, 0,
398 : /* 2954 */ 'l', 'd', 'e', 'o', 'r', 'h', 9, 0,
399 : /* 2962 */ 'l', 'd', 'a', 'p', 'r', 'h', 9, 0,
400 : /* 2970 */ 'l', 'd', 't', 'r', 'h', 9, 0,
401 : /* 2977 */ 's', 't', 'r', 'h', 9, 0,
402 : /* 2983 */ 's', 't', 't', 'r', 'h', 9, 0,
403 : /* 2990 */ 'l', 'd', 'u', 'r', 'h', 9, 0,
404 : /* 2997 */ 's', 't', 'l', 'u', 'r', 'h', 9, 0,
405 : /* 3005 */ 'l', 'd', 'a', 'p', 'u', 'r', 'h', 9, 0,
406 : /* 3014 */ 's', 't', 'u', 'r', 'h', 9, 0,
407 : /* 3021 */ 'l', 'd', 'a', 'x', 'r', 'h', 9, 0,
408 : /* 3029 */ 'l', 'd', 'x', 'r', 'h', 9, 0,
409 : /* 3036 */ 's', 't', 'l', 'x', 'r', 'h', 9, 0,
410 : /* 3044 */ 's', 't', 'x', 'r', 'h', 9, 0,
411 : /* 3051 */ 'l', 'd', '1', 's', 'h', 9, 0,
412 : /* 3058 */ 'l', 'd', 'f', 'f', '1', 's', 'h', 9, 0,
413 : /* 3067 */ 'l', 'd', 'n', 'f', '1', 's', 'h', 9, 0,
414 : /* 3076 */ 'c', 'a', 's', 'h', 9, 0,
415 : /* 3082 */ 's', 'q', 'r', 'd', 'm', 'l', 's', 'h', 9, 0,
416 : /* 3092 */ 'l', 'd', '1', 'r', 's', 'h', 9, 0,
417 : /* 3100 */ 'l', 'd', 'r', 's', 'h', 9, 0,
418 : /* 3107 */ 'l', 'd', 't', 'r', 's', 'h', 9, 0,
419 : /* 3115 */ 'l', 'd', 'u', 'r', 's', 'h', 9, 0,
420 : /* 3123 */ 'l', 'd', 'a', 'p', 'u', 'r', 's', 'h', 9, 0,
421 : /* 3133 */ 'l', 'd', 's', 'e', 't', 'h', 9, 0,
422 : /* 3141 */ 'c', 'n', 't', 'h', 9, 0,
423 : /* 3147 */ 's', 'x', 't', 'h', 9, 0,
424 : /* 3153 */ 'u', 'x', 't', 'h', 9, 0,
425 : /* 3159 */ 'r', 'e', 'v', 'h', 9, 0,
426 : /* 3165 */ 'l', 'd', 's', 'm', 'a', 'x', 'h', 9, 0,
427 : /* 3174 */ 'l', 'd', 'u', 'm', 'a', 'x', 'h', 9, 0,
428 : /* 3183 */ 'x', 'p', 'a', 'c', 'i', 9, 0,
429 : /* 3190 */ 'p', 'u', 'n', 'p', 'k', 'h', 'i', 9, 0,
430 : /* 3199 */ 's', 'u', 'n', 'p', 'k', 'h', 'i', 9, 0,
431 : /* 3208 */ 'u', 'u', 'n', 'p', 'k', 'h', 'i', 9, 0,
432 : /* 3217 */ 'c', 'm', 'h', 'i', 9, 0,
433 : /* 3223 */ 'c', 'm', 'p', 'h', 'i', 9, 0,
434 : /* 3230 */ 's', 'l', 'i', 9, 0,
435 : /* 3235 */ 'g', 'm', 'i', 9, 0,
436 : /* 3240 */ 'm', 'v', 'n', 'i', 9, 0,
437 : /* 3246 */ 's', 'r', 'i', 9, 0,
438 : /* 3251 */ 'f', 'r', 'i', 'n', 't', 'i', 9, 0,
439 : /* 3259 */ 'm', 'o', 'v', 'i', 9, 0,
440 : /* 3265 */ 'b', 'r', 'k', 9, 0,
441 : /* 3270 */ 'm', 'o', 'v', 'k', 9, 0,
442 : /* 3276 */ 's', 'a', 'b', 'a', 'l', 9, 0,
443 : /* 3283 */ 'u', 'a', 'b', 'a', 'l', 9, 0,
444 : /* 3290 */ 'l', 'd', 'a', 'd', 'd', 'a', 'l', 9, 0,
445 : /* 3299 */ 's', 'q', 'd', 'm', 'l', 'a', 'l', 9, 0,
446 : /* 3308 */ 'f', 'm', 'l', 'a', 'l', 9, 0,
447 : /* 3315 */ 's', 'm', 'l', 'a', 'l', 9, 0,
448 : /* 3322 */ 'u', 'm', 'l', 'a', 'l', 9, 0,
449 : /* 3329 */ 'l', 'd', 's', 'm', 'i', 'n', 'a', 'l', 9, 0,
450 : /* 3339 */ 'l', 'd', 'u', 'm', 'i', 'n', 'a', 'l', 9, 0,
451 : /* 3349 */ 'c', 'a', 's', 'p', 'a', 'l', 9, 0,
452 : /* 3357 */ 's', 'w', 'p', 'a', 'l', 9, 0,
453 : /* 3364 */ 'l', 'd', 'c', 'l', 'r', 'a', 'l', 9, 0,
454 : /* 3373 */ 'l', 'd', 'e', 'o', 'r', 'a', 'l', 9, 0,
455 : /* 3382 */ 'c', 'a', 's', 'a', 'l', 9, 0,
456 : /* 3389 */ 'l', 'd', 's', 'e', 't', 'a', 'l', 9, 0,
457 : /* 3398 */ 'l', 'd', 's', 'm', 'a', 'x', 'a', 'l', 9, 0,
458 : /* 3408 */ 'l', 'd', 'u', 'm', 'a', 'x', 'a', 'l', 9, 0,
459 : /* 3418 */ 't', 'b', 'l', 9, 0,
460 : /* 3423 */ 's', 'm', 's', 'u', 'b', 'l', 9, 0,
461 : /* 3431 */ 'u', 'm', 's', 'u', 'b', 'l', 9, 0,
462 : /* 3439 */ 's', 's', 'u', 'b', 'l', 9, 0,
463 : /* 3446 */ 'u', 's', 'u', 'b', 'l', 9, 0,
464 : /* 3453 */ 's', 'a', 'b', 'd', 'l', 9, 0,
465 : /* 3460 */ 'u', 'a', 'b', 'd', 'l', 9, 0,
466 : /* 3467 */ 'l', 'd', 'a', 'd', 'd', 'l', 9, 0,
467 : /* 3475 */ 's', 'm', 'a', 'd', 'd', 'l', 9, 0,
468 : /* 3483 */ 'u', 'm', 'a', 'd', 'd', 'l', 9, 0,
469 : /* 3491 */ 's', 'a', 'd', 'd', 'l', 9, 0,
470 : /* 3498 */ 'u', 'a', 'd', 'd', 'l', 9, 0,
471 : /* 3505 */ 'f', 'c', 's', 'e', 'l', 9, 0,
472 : /* 3512 */ 'f', 't', 's', 's', 'e', 'l', 9, 0,
473 : /* 3520 */ 's', 'q', 's', 'h', 'l', 9, 0,
474 : /* 3527 */ 'u', 'q', 's', 'h', 'l', 9, 0,
475 : /* 3534 */ 's', 'q', 'r', 's', 'h', 'l', 9, 0,
476 : /* 3542 */ 'u', 'q', 'r', 's', 'h', 'l', 9, 0,
477 : /* 3550 */ 's', 'r', 's', 'h', 'l', 9, 0,
478 : /* 3557 */ 'u', 'r', 's', 'h', 'l', 9, 0,
479 : /* 3564 */ 's', 's', 'h', 'l', 9, 0,
480 : /* 3570 */ 'u', 's', 'h', 'l', 9, 0,
481 : /* 3576 */ 's', 's', 'h', 'l', 'l', 9, 0,
482 : /* 3583 */ 'u', 's', 'h', 'l', 'l', 9, 0,
483 : /* 3590 */ 's', 'q', 'd', 'm', 'u', 'l', 'l', 9, 0,
484 : /* 3599 */ 'p', 'm', 'u', 'l', 'l', 9, 0,
485 : /* 3606 */ 's', 'm', 'u', 'l', 'l', 9, 0,
486 : /* 3613 */ 'u', 'm', 'u', 'l', 'l', 9, 0,
487 : /* 3620 */ 'l', 'd', 's', 'm', 'i', 'n', 'l', 9, 0,
488 : /* 3629 */ 'l', 'd', 'u', 'm', 'i', 'n', 'l', 9, 0,
489 : /* 3638 */ 'a', 'd', 'd', 'p', 'l', 9, 0,
490 : /* 3645 */ 'c', 'a', 's', 'p', 'l', 9, 0,
491 : /* 3652 */ 's', 'w', 'p', 'l', 9, 0,
492 : /* 3658 */ 'l', 'd', 'c', 'l', 'r', 'l', 9, 0,
493 : /* 3666 */ 'l', 'd', 'e', 'o', 'r', 'l', 9, 0,
494 : /* 3674 */ 'c', 'a', 's', 'l', 9, 0,
495 : /* 3680 */ 'b', 's', 'l', 9, 0,
496 : /* 3685 */ 's', 'q', 'd', 'm', 'l', 's', 'l', 9, 0,
497 : /* 3694 */ 'f', 'm', 'l', 's', 'l', 9, 0,
498 : /* 3701 */ 's', 'm', 'l', 's', 'l', 9, 0,
499 : /* 3708 */ 'u', 'm', 'l', 's', 'l', 9, 0,
500 : /* 3715 */ 's', 'y', 's', 'l', 9, 0,
501 : /* 3721 */ 'l', 'd', 's', 'e', 't', 'l', 9, 0,
502 : /* 3729 */ 'f', 'c', 'v', 't', 'l', 9, 0,
503 : /* 3736 */ 'f', 'm', 'u', 'l', 9, 0,
504 : /* 3742 */ 'f', 'n', 'm', 'u', 'l', 9, 0,
505 : /* 3749 */ 'p', 'm', 'u', 'l', 9, 0,
506 : /* 3755 */ 'f', 't', 's', 'm', 'u', 'l', 9, 0,
507 : /* 3763 */ 'a', 'd', 'd', 'v', 'l', 9, 0,
508 : /* 3770 */ 'r', 'd', 'v', 'l', 9, 0,
509 : /* 3776 */ 'l', 'd', 's', 'm', 'a', 'x', 'l', 9, 0,
510 : /* 3785 */ 'l', 'd', 'u', 'm', 'a', 'x', 'l', 9, 0,
511 : /* 3794 */ 's', 'h', 'a', '1', 'm', 9, 0,
512 : /* 3801 */ 's', 'b', 'f', 'm', 9, 0,
513 : /* 3807 */ 'u', 'b', 'f', 'm', 9, 0,
514 : /* 3813 */ 'p', 'r', 'f', 'm', 9, 0,
515 : /* 3819 */ 'f', 'm', 'i', 'n', 'n', 'm', 9, 0,
516 : /* 3827 */ 'f', 'm', 'a', 'x', 'n', 'm', 9, 0,
517 : /* 3835 */ 'd', 'u', 'p', 'm', 9, 0,
518 : /* 3841 */ 'f', 'r', 'i', 'n', 't', 'm', 9, 0,
519 : /* 3849 */ 'p', 'r', 'f', 'u', 'm', 9, 0,
520 : /* 3856 */ 'r', 's', 'u', 'b', 'h', 'n', 9, 0,
521 : /* 3864 */ 'r', 'a', 'd', 'd', 'h', 'n', 9, 0,
522 : /* 3872 */ 'f', 'm', 'i', 'n', 9, 0,
523 : /* 3878 */ 'l', 'd', 's', 'm', 'i', 'n', 9, 0,
524 : /* 3886 */ 'l', 'd', 'u', 'm', 'i', 'n', 9, 0,
525 : /* 3894 */ 'b', 'r', 'k', 'n', 9, 0,
526 : /* 3900 */ 'c', 'c', 'm', 'n', 9, 0,
527 : /* 3906 */ 'e', 'o', 'n', 9, 0,
528 : /* 3911 */ 's', 'q', 's', 'h', 'r', 'n', 9, 0,
529 : /* 3919 */ 'u', 'q', 's', 'h', 'r', 'n', 9, 0,
530 : /* 3927 */ 's', 'q', 'r', 's', 'h', 'r', 'n', 9, 0,
531 : /* 3936 */ 'u', 'q', 'r', 's', 'h', 'r', 'n', 9, 0,
532 : /* 3945 */ 'o', 'r', 'n', 9, 0,
533 : /* 3950 */ 'f', 'r', 'i', 'n', 't', 'n', 9, 0,
534 : /* 3958 */ 'f', 'c', 'v', 't', 'n', 9, 0,
535 : /* 3965 */ 's', 'q', 'x', 't', 'n', 9, 0,
536 : /* 3972 */ 'u', 'q', 'x', 't', 'n', 9, 0,
537 : /* 3979 */ 's', 'q', 's', 'h', 'r', 'u', 'n', 9, 0,
538 : /* 3988 */ 's', 'q', 'r', 's', 'h', 'r', 'u', 'n', 9, 0,
539 : /* 3998 */ 's', 'q', 'x', 't', 'u', 'n', 9, 0,
540 : /* 4006 */ 'm', 'o', 'v', 'n', 9, 0,
541 : /* 4012 */ 'f', 'c', 'v', 't', 'x', 'n', 9, 0,
542 : /* 4020 */ 'w', 'h', 'i', 'l', 'e', 'l', 'o', 9, 0,
543 : /* 4029 */ 'p', 'u', 'n', 'p', 'k', 'l', 'o', 9, 0,
544 : /* 4038 */ 's', 'u', 'n', 'p', 'k', 'l', 'o', 9, 0,
545 : /* 4047 */ 'u', 'u', 'n', 'p', 'k', 'l', 'o', 9, 0,
546 : /* 4056 */ 'c', 'm', 'p', 'l', 'o', 9, 0,
547 : /* 4063 */ 'f', 'c', 'm', 'u', 'o', 9, 0,
548 : /* 4070 */ 's', 'h', 'a', '1', 'p', 9, 0,
549 : /* 4077 */ 's', 'u', 'b', 'p', 9, 0,
550 : /* 4083 */ 's', 'q', 'd', 'e', 'c', 'p', 9, 0,
551 : /* 4091 */ 'u', 'q', 'd', 'e', 'c', 'p', 9, 0,
552 : /* 4099 */ 's', 'q', 'i', 'n', 'c', 'p', 9, 0,
553 : /* 4107 */ 'u', 'q', 'i', 'n', 'c', 'p', 9, 0,
554 : /* 4115 */ 'f', 'a', 'd', 'd', 'p', 9, 0,
555 : /* 4122 */ 'l', 'd', 'p', 9, 0,
556 : /* 4127 */ 's', 't', 'g', 'p', 9, 0,
557 : /* 4133 */ 's', 'a', 'd', 'a', 'l', 'p', 9, 0,
558 : /* 4141 */ 'u', 'a', 'd', 'a', 'l', 'p', 9, 0,
559 : /* 4149 */ 's', 'a', 'd', 'd', 'l', 'p', 9, 0,
560 : /* 4157 */ 'u', 'a', 'd', 'd', 'l', 'p', 9, 0,
561 : /* 4165 */ 'f', 'c', 'c', 'm', 'p', 9, 0,
562 : /* 4172 */ 'f', 'c', 'm', 'p', 9, 0,
563 : /* 4178 */ 'f', 'm', 'i', 'n', 'n', 'm', 'p', 9, 0,
564 : /* 4187 */ 'f', 'm', 'a', 'x', 'n', 'm', 'p', 9, 0,
565 : /* 4196 */ 'l', 'd', 'n', 'p', 9, 0,
566 : /* 4202 */ 'f', 'm', 'i', 'n', 'p', 9, 0,
567 : /* 4209 */ 's', 'm', 'i', 'n', 'p', 9, 0,
568 : /* 4216 */ 'u', 'm', 'i', 'n', 'p', 9, 0,
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574 : /* 4255 */ 's', 't', 'p', 9, 0,
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576 : /* 4266 */ 's', 'w', 'p', 9, 0,
577 : /* 4271 */ 'l', 'd', 'a', 'x', 'p', 9, 0,
578 : /* 4278 */ 'f', 'm', 'a', 'x', 'p', 9, 0,
579 : /* 4285 */ 's', 'm', 'a', 'x', 'p', 9, 0,
580 : /* 4292 */ 'u', 'm', 'a', 'x', 'p', 9, 0,
581 : /* 4299 */ 'l', 'd', 'x', 'p', 9, 0,
582 : /* 4305 */ 's', 't', 'l', 'x', 'p', 9, 0,
583 : /* 4312 */ 's', 't', 'x', 'p', 9, 0,
584 : /* 4318 */ 'f', 'c', 'm', 'e', 'q', 9, 0,
585 : /* 4325 */ 'c', 't', 'e', 'r', 'm', 'e', 'q', 9, 0,
586 : /* 4334 */ 'c', 'm', 'p', 'e', 'q', 9, 0,
587 : /* 4341 */ 'l', 'd', '1', 'r', 9, 0,
588 : /* 4347 */ 'l', 'd', '2', 'r', 9, 0,
589 : /* 4353 */ 'l', 'd', '3', 'r', 9, 0,
590 : /* 4359 */ 'l', 'd', '4', 'r', 9, 0,
591 : /* 4365 */ 'l', 'd', 'a', 'r', 9, 0,
592 : /* 4371 */ 'l', 'd', 'l', 'a', 'r', 9, 0,
593 : /* 4378 */ 'x', 'a', 'r', 9, 0,
594 : /* 4383 */ 'f', 's', 'u', 'b', 'r', 9, 0,
595 : /* 4390 */ 'a', 'd', 'r', 9, 0,
596 : /* 4395 */ 'l', 'd', 'r', 9, 0,
597 : /* 4400 */ 'r', 'd', 'f', 'f', 'r', 9, 0,
598 : /* 4407 */ 'w', 'r', 'f', 'f', 'r', 9, 0,
599 : /* 4414 */ 's', 'r', 's', 'h', 'r', 9, 0,
600 : /* 4421 */ 'u', 'r', 's', 'h', 'r', 9, 0,
601 : /* 4428 */ 's', 's', 'h', 'r', 9, 0,
602 : /* 4434 */ 'u', 's', 'h', 'r', 9, 0,
603 : /* 4440 */ 'b', 'l', 'r', 9, 0,
604 : /* 4445 */ 'l', 'd', 'c', 'l', 'r', 9, 0,
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606 : /* 4459 */ 'l', 's', 'l', 'r', 9, 0,
607 : /* 4465 */ 's', 't', 'l', 'r', 9, 0,
608 : /* 4471 */ 'l', 'd', 'e', 'o', 'r', 9, 0,
609 : /* 4478 */ 'n', 'o', 'r', 9, 0,
610 : /* 4483 */ 'r', 'o', 'r', 9, 0,
611 : /* 4488 */ 'l', 'd', 'a', 'p', 'r', 9, 0,
612 : /* 4495 */ 'o', 'r', 'r', 9, 0,
613 : /* 4500 */ 'a', 's', 'r', 'r', 9, 0,
614 : /* 4506 */ 'l', 's', 'r', 'r', 9, 0,
615 : /* 4512 */ 'a', 's', 'r', 9, 0,
616 : /* 4517 */ 'l', 's', 'r', 9, 0,
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619 : /* 4533 */ 'l', 'd', 't', 'r', 9, 0,
620 : /* 4539 */ 's', 't', 'r', 9, 0,
621 : /* 4544 */ 's', 't', 't', 'r', 9, 0,
622 : /* 4550 */ 'e', 'x', 't', 'r', 9, 0,
623 : /* 4556 */ 'l', 'd', 'u', 'r', 9, 0,
624 : /* 4562 */ 's', 't', 'l', 'u', 'r', 9, 0,
625 : /* 4569 */ 'l', 'd', 'a', 'p', 'u', 'r', 9, 0,
626 : /* 4577 */ 's', 't', 'u', 'r', 9, 0,
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629 : /* 4597 */ 'u', 'd', 'i', 'v', 'r', 9, 0,
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633 : /* 4624 */ 's', 't', 'x', 'r', 9, 0,
634 : /* 4630 */ 'c', 'a', 's', 9, 0,
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637 : /* 4650 */ 'f', 'c', 'v', 't', 'a', 's', 9, 0,
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642 : /* 4686 */ 's', 'u', 'b', 's', 9, 0,
643 : /* 4692 */ 's', 'b', 'c', 's', 9, 0,
644 : /* 4698 */ 'a', 'd', 'c', 's', 9, 0,
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646 : /* 4710 */ 'a', 'd', 'd', 's', 9, 0,
647 : /* 4716 */ 'n', 'a', 'n', 'd', 's', 9, 0,
648 : /* 4723 */ 'p', 't', 'r', 'u', 'e', 's', 9, 0,
649 : /* 4731 */ 'c', 'm', 'h', 's', 9, 0,
650 : /* 4737 */ 'c', 'm', 'p', 'h', 's', 9, 0,
651 : /* 4744 */ 'c', 'l', 's', 9, 0,
652 : /* 4749 */ 'w', 'h', 'i', 'l', 'e', 'l', 's', 9, 0,
653 : /* 4758 */ 'f', 'm', 'l', 's', 9, 0,
654 : /* 4764 */ 'f', 'n', 'm', 'l', 's', 9, 0,
655 : /* 4771 */ 'c', 'm', 'p', 'l', 's', 9, 0,
656 : /* 4778 */ 'f', 'c', 'v', 't', 'm', 's', 9, 0,
657 : /* 4786 */ 'i', 'n', 's', 9, 0,
658 : /* 4791 */ 'b', 'r', 'k', 'n', 's', 9, 0,
659 : /* 4798 */ 'o', 'r', 'n', 's', 9, 0,
660 : /* 4804 */ 'f', 'c', 'v', 't', 'n', 's', 9, 0,
661 : /* 4812 */ 's', 'u', 'b', 'p', 's', 9, 0,
662 : /* 4819 */ 'f', 'r', 'e', 'c', 'p', 's', 9, 0,
663 : /* 4827 */ 'f', 'c', 'v', 't', 'p', 's', 9, 0,
664 : /* 4835 */ 'r', 'd', 'f', 'f', 'r', 's', 9, 0,
665 : /* 4843 */ 'm', 'r', 's', 9, 0,
666 : /* 4848 */ 'e', 'o', 'r', 's', 9, 0,
667 : /* 4854 */ 'n', 'o', 'r', 's', 9, 0,
668 : /* 4860 */ 'o', 'r', 'r', 's', 9, 0,
669 : /* 4866 */ 'f', 'r', 's', 'q', 'r', 't', 's', 9, 0,
670 : /* 4875 */ 's', 'y', 's', 9, 0,
671 : /* 4880 */ 'f', 'c', 'v', 't', 'z', 's', 9, 0,
672 : /* 4888 */ 'f', 'j', 'c', 'v', 't', 'z', 's', 9, 0,
673 : /* 4897 */ 'c', 'o', 'm', 'p', 'a', 'c', 't', 9, 0,
674 : /* 4906 */ 'r', 'e', 't', 9, 0,
675 : /* 4911 */ 'l', 'd', 's', 'e', 't', 9, 0,
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677 : /* 4925 */ 'f', 'c', 'm', 'g', 't', 9, 0,
678 : /* 4932 */ 'c', 'm', 'p', 'g', 't', 9, 0,
679 : /* 4939 */ 'r', 'b', 'i', 't', 9, 0,
680 : /* 4945 */ 'w', 'h', 'i', 'l', 'e', 'l', 't', 9, 0,
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682 : /* 4959 */ 'f', 'c', 'm', 'l', 't', 9, 0,
683 : /* 4966 */ 'c', 'm', 'p', 'l', 't', 9, 0,
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687 : /* 4990 */ 'u', 'd', 'o', 't', 9, 0,
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805 : /* 5953 */ 'a', 'u', 't', 'i', 'b', '1', '7', '1', '6', 0,
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9775 : 57736U, // UQSHLv4i16
9776 : 264U, // UQSHLv4i16_shift
9777 : 24966U, // UQSHLv4i32
9778 : 262U, // UQSHLv4i32_shift
9779 : 33158U, // UQSHLv8i16
9780 : 262U, // UQSHLv8i16_shift
9781 : 65928U, // UQSHLv8i8
9782 : 264U, // UQSHLv8i8_shift
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9791 : 262U, // UQSHRNv8i8_shift
9792 : 709U, // UQSUB_ZI_B
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9794 : 9U, // UQSUB_ZI_H
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9800 : 41351U, // UQSUBv16i8
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9836 : 261U, // URSHRd
9837 : 263U, // URSHRv16i8_shift
9838 : 263U, // URSHRv2i32_shift
9839 : 261U, // URSHRv2i64_shift
9840 : 264U, // URSHRv4i16_shift
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9844 : 2U, // URSQRTEv2i32
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9869 : 263U, // USHRv16i8_shift
9870 : 263U, // USHRv2i32_shift
9871 : 261U, // USHRv2i64_shift
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9876 : 1U, // USQADDv16i8
9877 : 1U, // USQADDv1i16
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9880 : 1U, // USQADDv1i8
9881 : 2U, // USQADDv2i32
9882 : 2U, // USQADDv2i64
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9886 : 4U, // USQADDv8i8
9887 : 2373U, // USRAd
9888 : 2375U, // USRAv16i8_shift
9889 : 2375U, // USRAv2i32_shift
9890 : 2373U, // USRAv2i64_shift
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9892 : 2374U, // USRAv4i32_shift
9893 : 2374U, // USRAv8i16_shift
9894 : 2376U, // USRAv8i8_shift
9895 : 41351U, // USUBLv16i8_v8i16
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9900 : 65928U, // USUBLv8i8_v8i16
9901 : 41350U, // USUBWv16i8_v8i16
9902 : 49541U, // USUBWv2i32_v2i64
9903 : 57734U, // USUBWv4i16_v4i32
9904 : 24965U, // USUBWv4i32_v2i64
9905 : 33158U, // USUBWv8i16_v4i32
9906 : 65926U, // USUBWv8i8_v8i16
9907 : 1U, // UUNPKHI_ZZ_D
9908 : 0U, // UUNPKHI_ZZ_H
9909 : 1U, // UUNPKHI_ZZ_S
9910 : 1U, // UUNPKLO_ZZ_D
9911 : 0U, // UUNPKLO_ZZ_H
9912 : 1U, // UUNPKLO_ZZ_S
9913 : 64U, // UXTB_ZPmZ_D
9914 : 128U, // UXTB_ZPmZ_H
9915 : 192U, // UXTB_ZPmZ_S
9916 : 64U, // UXTH_ZPmZ_D
9917 : 192U, // UXTH_ZPmZ_S
9918 : 64U, // UXTW_ZPmZ_D
9919 : 901U, // UZP1_PPP_B
9920 : 965U, // UZP1_PPP_D
9921 : 137U, // UZP1_PPP_H
9922 : 1093U, // UZP1_PPP_S
9923 : 901U, // UZP1_ZZZ_B
9924 : 965U, // UZP1_ZZZ_D
9925 : 137U, // UZP1_ZZZ_H
9926 : 1093U, // UZP1_ZZZ_S
9927 : 41351U, // UZP1v16i8
9928 : 49543U, // UZP1v2i32
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9930 : 57736U, // UZP1v4i16
9931 : 24966U, // UZP1v4i32
9932 : 33158U, // UZP1v8i16
9933 : 65928U, // UZP1v8i8
9934 : 901U, // UZP2_PPP_B
9935 : 965U, // UZP2_PPP_D
9936 : 137U, // UZP2_PPP_H
9937 : 1093U, // UZP2_PPP_S
9938 : 901U, // UZP2_ZZZ_B
9939 : 965U, // UZP2_ZZZ_D
9940 : 137U, // UZP2_ZZZ_H
9941 : 1093U, // UZP2_ZZZ_S
9942 : 41351U, // UZP2v16i8
9943 : 49543U, // UZP2v2i32
9944 : 16773U, // UZP2v2i64
9945 : 57736U, // UZP2v4i16
9946 : 24966U, // UZP2v4i32
9947 : 33158U, // UZP2v8i16
9948 : 65928U, // UZP2v8i8
9949 : 261U, // WHILELE_PWW_B
9950 : 261U, // WHILELE_PWW_D
9951 : 11U, // WHILELE_PWW_H
9952 : 261U, // WHILELE_PWW_S
9953 : 261U, // WHILELE_PXX_B
9954 : 261U, // WHILELE_PXX_D
9955 : 11U, // WHILELE_PXX_H
9956 : 261U, // WHILELE_PXX_S
9957 : 261U, // WHILELO_PWW_B
9958 : 261U, // WHILELO_PWW_D
9959 : 11U, // WHILELO_PWW_H
9960 : 261U, // WHILELO_PWW_S
9961 : 261U, // WHILELO_PXX_B
9962 : 261U, // WHILELO_PXX_D
9963 : 11U, // WHILELO_PXX_H
9964 : 261U, // WHILELO_PXX_S
9965 : 261U, // WHILELS_PWW_B
9966 : 261U, // WHILELS_PWW_D
9967 : 11U, // WHILELS_PWW_H
9968 : 261U, // WHILELS_PWW_S
9969 : 261U, // WHILELS_PXX_B
9970 : 261U, // WHILELS_PXX_D
9971 : 11U, // WHILELS_PXX_H
9972 : 261U, // WHILELS_PXX_S
9973 : 261U, // WHILELT_PWW_B
9974 : 261U, // WHILELT_PWW_D
9975 : 11U, // WHILELT_PWW_H
9976 : 261U, // WHILELT_PWW_S
9977 : 261U, // WHILELT_PXX_B
9978 : 261U, // WHILELT_PXX_D
9979 : 11U, // WHILELT_PXX_H
9980 : 261U, // WHILELT_PXX_S
9981 : 0U, // WRFFR
9982 : 0U, // XAFLAG
9983 : 156037U, // XAR
9984 : 0U, // XPACD
9985 : 0U, // XPACI
9986 : 0U, // XPACLRI
9987 : 4U, // XTNv16i8
9988 : 2U, // XTNv2i32
9989 : 3U, // XTNv4i16
9990 : 2U, // XTNv4i32
9991 : 3U, // XTNv8i16
9992 : 4U, // XTNv8i8
9993 : 901U, // ZIP1_PPP_B
9994 : 965U, // ZIP1_PPP_D
9995 : 137U, // ZIP1_PPP_H
9996 : 1093U, // ZIP1_PPP_S
9997 : 901U, // ZIP1_ZZZ_B
9998 : 965U, // ZIP1_ZZZ_D
9999 : 137U, // ZIP1_ZZZ_H
10000 : 1093U, // ZIP1_ZZZ_S
10001 : 41351U, // ZIP1v16i8
10002 : 49543U, // ZIP1v2i32
10003 : 16773U, // ZIP1v2i64
10004 : 57736U, // ZIP1v4i16
10005 : 24966U, // ZIP1v4i32
10006 : 33158U, // ZIP1v8i16
10007 : 65928U, // ZIP1v8i8
10008 : 901U, // ZIP2_PPP_B
10009 : 965U, // ZIP2_PPP_D
10010 : 137U, // ZIP2_PPP_H
10011 : 1093U, // ZIP2_PPP_S
10012 : 901U, // ZIP2_ZZZ_B
10013 : 965U, // ZIP2_ZZZ_D
10014 : 137U, // ZIP2_ZZZ_H
10015 : 1093U, // ZIP2_ZZZ_S
10016 : 41351U, // ZIP2v16i8
10017 : 49543U, // ZIP2v2i32
10018 : 16773U, // ZIP2v2i64
10019 : 57736U, // ZIP2v4i16
10020 : 24966U, // ZIP2v4i32
10021 : 33158U, // ZIP2v8i16
10022 : 65928U, // ZIP2v8i8
10023 : 901U, // anonymous_1355
10024 : };
10025 :
10026 58738 : O << "\t";
10027 :
10028 : // Emit the opcode for the instruction.
10029 : uint64_t Bits = 0;
10030 58738 : Bits |= (uint64_t)OpInfo0[MI->getOpcode()] << 0;
10031 58738 : Bits |= (uint64_t)OpInfo1[MI->getOpcode()] << 32;
10032 : assert(Bits != 0 && "Cannot print this instruction.");
10033 58738 : O << AsmStrs+(Bits & 8191)-1;
10034 :
10035 :
10036 : // Fragment 0 encoded into 6 bits for 54 unique commands.
10037 58738 : switch ((Bits >> 13) & 63) {
10038 0 : default: llvm_unreachable("Invalid command number.");
10039 : case 0:
10040 : // DBG_VALUE, DBG_LABEL, BUNDLE, LIFETIME_START, LIFETIME_END, FENTRY_CAL...
10041 : return;
10042 : break;
10043 553 : case 1:
10044 : // ABS_ZPmZ_B, ADD_ZI_B, ADD_ZPmZ_B, ADD_ZZZ_B, ANDS_PPzPP, AND_PPzPP, AN...
10045 553 : printSVERegOp<'b'>(MI, 0, STI, O);
10046 553 : break;
10047 1563 : case 2:
10048 : // ABS_ZPmZ_D, ADD_ZI_D, ADD_ZPmZ_D, ADD_ZZZ_D, ADR_LSL_ZZZ_D_0, ADR_LSL_...
10049 1563 : printSVERegOp<'d'>(MI, 0, STI, O);
10050 1563 : break;
10051 700 : case 3:
10052 : // ABS_ZPmZ_H, ADD_ZI_H, ADD_ZPmZ_H, ADD_ZZZ_H, AND_ZPmZ_H, ASRD_ZPmI_H, ...
10053 700 : printSVERegOp<'h'>(MI, 0, STI, O);
10054 700 : O << ", ";
10055 700 : break;
10056 871 : case 4:
10057 : // ABS_ZPmZ_S, ADD_ZI_S, ADD_ZPmZ_S, ADD_ZZZ_S, ADR_LSL_ZZZ_S_0, ADR_LSL_...
10058 871 : printSVERegOp<'s'>(MI, 0, STI, O);
10059 871 : break;
10060 8259 : case 5:
10061 : // ABSv16i8, ABSv2i32, ABSv2i64, ABSv4i16, ABSv4i32, ABSv8i16, ABSv8i8, A...
10062 8259 : printVRegOperand(MI, 0, STI, O);
10063 8259 : break;
10064 31393 : case 6:
10065 : // ABSv1i64, ADCSWr, ADCSXr, ADCWr, ADCXr, ADDG, ADDPL_XXI, ADDPv2i64p, A...
10066 31393 : printOperand(MI, 0, STI, O);
10067 31393 : break;
10068 2143 : case 7:
10069 : // ADDHNv2i64_v4i32, ADDHNv4i32_v8i16, ADDHNv8i16_v16i8, AESDrr, AESErr, ...
10070 2143 : printVRegOperand(MI, 1, STI, O);
10071 2143 : break;
10072 1711 : case 8:
10073 : // B, BL
10074 1711 : printAlignedLabel(MI, 0, STI, O);
10075 1711 : return;
10076 : break;
10077 84 : case 9:
10078 : // BRK, DCPS1, DCPS2, DCPS3, HLT, HVC, SMC, SVC
10079 84 : printImmHex(MI, 0, STI, O);
10080 84 : return;
10081 : break;
10082 479 : case 10:
10083 : // Bcc
10084 479 : printCondCode(MI, 0, STI, O);
10085 479 : O << "\t";
10086 479 : printAlignedLabel(MI, 1, STI, O);
10087 479 : return;
10088 : break;
10089 5196 : case 11:
10090 : // CASAB, CASAH, CASALB, CASALH, CASALW, CASALX, CASAW, CASAX, CASB, CASH...
10091 5196 : printOperand(MI, 1, STI, O);
10092 5196 : break;
10093 26 : case 12:
10094 : // CASPALW, CASPAW, CASPLW, CASPW
10095 26 : printGPRSeqPairsClassOperand<32>(MI, 1, STI, O);
10096 26 : O << ", ";
10097 26 : printGPRSeqPairsClassOperand<32>(MI, 2, STI, O);
10098 26 : O << ", [";
10099 26 : printOperand(MI, 3, STI, O);
10100 : O << ']';
10101 : return;
10102 : break;
10103 42 : case 13:
10104 : // CASPALX, CASPAX, CASPLX, CASPX
10105 42 : printGPRSeqPairsClassOperand<64>(MI, 1, STI, O);
10106 42 : O << ", ";
10107 42 : printGPRSeqPairsClassOperand<64>(MI, 2, STI, O);
10108 42 : O << ", [";
10109 42 : printOperand(MI, 3, STI, O);
10110 : O << ']';
10111 : return;
10112 : break;
10113 173 : case 14:
10114 : // DMB, DSB, ISB, TSB
10115 173 : printBarrierOption(MI, 0, STI, O);
10116 173 : return;
10117 : break;
10118 0 : case 15:
10119 : // DUP_ZZI_Q
10120 0 : printSVERegOp<'q'>(MI, 0, STI, O);
10121 0 : O << ", ";
10122 0 : printSVERegOp<'q'>(MI, 1, STI, O);
10123 0 : printVectorIndex(MI, 2, STI, O);
10124 0 : return;
10125 : break;
10126 416 : case 16:
10127 : // GLD1B_D_IMM_REAL, GLD1B_D_REAL, GLD1B_D_SXTW_REAL, GLD1B_D_UXTW_REAL, ...
10128 416 : printTypedVectorList<0,'d'>(MI, 0, STI, O);
10129 416 : O << ", ";
10130 416 : printSVERegOp<>(MI, 1, STI, O);
10131 416 : break;
10132 270 : case 17:
10133 : // GLD1B_S_IMM_REAL, GLD1B_S_SXTW_REAL, GLD1B_S_UXTW_REAL, GLD1H_S_IMM_RE...
10134 270 : printTypedVectorList<0,'s'>(MI, 0, STI, O);
10135 270 : O << ", ";
10136 270 : printSVERegOp<>(MI, 1, STI, O);
10137 270 : break;
10138 16 : case 18:
10139 : // HINT
10140 16 : printImm(MI, 0, STI, O);
10141 16 : return;
10142 : break;
10143 90 : case 19:
10144 : // LD1B, LD1B_IMM_REAL, LD1RB_IMM, LD1RQ_B, LD1RQ_B_IMM, LD2B, LD2B_IMM, ...
10145 90 : printTypedVectorList<0,'b'>(MI, 0, STI, O);
10146 90 : O << ", ";
10147 90 : printSVERegOp<>(MI, 1, STI, O);
10148 90 : break;
10149 128 : case 20:
10150 : // LD1B_H, LD1B_H_IMM_REAL, LD1H, LD1H_IMM_REAL, LD1RB_H_IMM, LD1RH_IMM, ...
10151 128 : printTypedVectorList<0,'h'>(MI, 0, STI, O);
10152 128 : O << ", ";
10153 128 : printSVERegOp<>(MI, 1, STI, O);
10154 128 : break;
10155 90 : case 21:
10156 : // LD1Fourv16b, LD1Onev16b, LD1Rv16b, LD1Threev16b, LD1Twov16b, LD2Rv16b,...
10157 90 : printTypedVectorList<16, 'b'>(MI, 0, STI, O);
10158 90 : O << ", [";
10159 90 : printOperand(MI, 1, STI, O);
10160 : O << ']';
10161 : return;
10162 : break;
10163 21 : case 22:
10164 : // LD1Fourv16b_POST, LD1Onev16b_POST, LD1Rv16b_POST, LD1Threev16b_POST, L...
10165 21 : printTypedVectorList<16, 'b'>(MI, 1, STI, O);
10166 21 : O << ", [";
10167 21 : printOperand(MI, 2, STI, O);
10168 21 : O << "], ";
10169 21 : break;
10170 21 : case 23:
10171 : // LD1Fourv1d, LD1Onev1d, LD1Rv1d, LD1Threev1d, LD1Twov1d, LD2Rv1d, LD3Rv...
10172 21 : printTypedVectorList<1, 'd'>(MI, 0, STI, O);
10173 21 : O << ", [";
10174 21 : printOperand(MI, 1, STI, O);
10175 : O << ']';
10176 : return;
10177 : break;
10178 5 : case 24:
10179 : // LD1Fourv1d_POST, LD1Onev1d_POST, LD1Rv1d_POST, LD1Threev1d_POST, LD1Tw...
10180 5 : printTypedVectorList<1, 'd'>(MI, 1, STI, O);
10181 5 : O << ", [";
10182 5 : printOperand(MI, 2, STI, O);
10183 5 : O << "], ";
10184 5 : break;
10185 149 : case 25:
10186 : // LD1Fourv2d, LD1Onev2d, LD1Rv2d, LD1Threev2d, LD1Twov2d, LD2Rv2d, LD2Tw...
10187 149 : printTypedVectorList<2, 'd'>(MI, 0, STI, O);
10188 149 : O << ", [";
10189 149 : printOperand(MI, 1, STI, O);
10190 : O << ']';
10191 : return;
10192 : break;
10193 1 : case 26:
10194 : // LD1Fourv2d_POST, LD1Onev2d_POST, LD1Rv2d_POST, LD1Threev2d_POST, LD1Tw...
10195 1 : printTypedVectorList<2, 'd'>(MI, 1, STI, O);
10196 1 : O << ", [";
10197 1 : printOperand(MI, 2, STI, O);
10198 1 : O << "], ";
10199 1 : break;
10200 143 : case 27:
10201 : // LD1Fourv2s, LD1Onev2s, LD1Rv2s, LD1Threev2s, LD1Twov2s, LD2Rv2s, LD2Tw...
10202 143 : printTypedVectorList<2, 's'>(MI, 0, STI, O);
10203 143 : O << ", [";
10204 143 : printOperand(MI, 1, STI, O);
10205 : O << ']';
10206 : return;
10207 : break;
10208 5 : case 28:
10209 : // LD1Fourv2s_POST, LD1Onev2s_POST, LD1Rv2s_POST, LD1Threev2s_POST, LD1Tw...
10210 5 : printTypedVectorList<2, 's'>(MI, 1, STI, O);
10211 5 : O << ", [";
10212 5 : printOperand(MI, 2, STI, O);
10213 5 : O << "], ";
10214 5 : break;
10215 136 : case 29:
10216 : // LD1Fourv4h, LD1Onev4h, LD1Rv4h, LD1Threev4h, LD1Twov4h, LD2Rv4h, LD2Tw...
10217 136 : printTypedVectorList<4, 'h'>(MI, 0, STI, O);
10218 136 : O << ", [";
10219 136 : printOperand(MI, 1, STI, O);
10220 : O << ']';
10221 : return;
10222 : break;
10223 17 : case 30:
10224 : // LD1Fourv4h_POST, LD1Onev4h_POST, LD1Rv4h_POST, LD1Threev4h_POST, LD1Tw...
10225 17 : printTypedVectorList<4, 'h'>(MI, 1, STI, O);
10226 17 : O << ", [";
10227 17 : printOperand(MI, 2, STI, O);
10228 17 : O << "], ";
10229 17 : break;
10230 140 : case 31:
10231 : // LD1Fourv4s, LD1Onev4s, LD1Rv4s, LD1Threev4s, LD1Twov4s, LD2Rv4s, LD2Tw...
10232 140 : printTypedVectorList<4, 's'>(MI, 0, STI, O);
10233 140 : O << ", [";
10234 140 : printOperand(MI, 1, STI, O);
10235 : O << ']';
10236 : return;
10237 : break;
10238 1 : case 32:
10239 : // LD1Fourv4s_POST, LD1Onev4s_POST, LD1Rv4s_POST, LD1Threev4s_POST, LD1Tw...
10240 1 : printTypedVectorList<4, 's'>(MI, 1, STI, O);
10241 1 : O << ", [";
10242 1 : printOperand(MI, 2, STI, O);
10243 1 : O << "], ";
10244 1 : break;
10245 88 : case 33:
10246 : // LD1Fourv8b, LD1Onev8b, LD1Rv8b, LD1Threev8b, LD1Twov8b, LD2Rv8b, LD2Tw...
10247 88 : printTypedVectorList<8, 'b'>(MI, 0, STI, O);
10248 88 : O << ", [";
10249 88 : printOperand(MI, 1, STI, O);
10250 : O << ']';
10251 : return;
10252 : break;
10253 21 : case 34:
10254 : // LD1Fourv8b_POST, LD1Onev8b_POST, LD1Rv8b_POST, LD1Threev8b_POST, LD1Tw...
10255 21 : printTypedVectorList<8, 'b'>(MI, 1, STI, O);
10256 21 : O << ", [";
10257 21 : printOperand(MI, 2, STI, O);
10258 21 : O << "], ";
10259 21 : break;
10260 174 : case 35:
10261 : // LD1Fourv8h, LD1Onev8h, LD1Rv8h, LD1Threev8h, LD1Twov8h, LD2Rv8h, LD2Tw...
10262 174 : printTypedVectorList<8, 'h'>(MI, 0, STI, O);
10263 174 : O << ", [";
10264 174 : printOperand(MI, 1, STI, O);
10265 : O << ']';
10266 : return;
10267 : break;
10268 23 : case 36:
10269 : // LD1Fourv8h_POST, LD1Onev8h_POST, LD1Rv8h_POST, LD1Threev8h_POST, LD1Tw...
10270 23 : printTypedVectorList<8, 'h'>(MI, 1, STI, O);
10271 23 : O << ", [";
10272 23 : printOperand(MI, 2, STI, O);
10273 23 : O << "], ";
10274 23 : break;
10275 18 : case 37:
10276 : // LD1i16, LD2i16, LD3i16, LD4i16, ST1i16_POST, ST2i16_POST, ST3i16_POST,...
10277 18 : printTypedVectorList<0, 'h'>(MI, 1, STI, O);
10278 18 : printVectorIndex(MI, 2, STI, O);
10279 18 : O << ", [";
10280 18 : printOperand(MI, 3, STI, O);
10281 18 : break;
10282 4 : case 38:
10283 : // LD1i16_POST, LD2i16_POST, LD3i16_POST, LD4i16_POST
10284 4 : printTypedVectorList<0, 'h'>(MI, 2, STI, O);
10285 4 : printVectorIndex(MI, 3, STI, O);
10286 4 : O << ", [";
10287 4 : printOperand(MI, 4, STI, O);
10288 4 : O << "], ";
10289 4 : break;
10290 18 : case 39:
10291 : // LD1i32, LD2i32, LD3i32, LD4i32, ST1i32_POST, ST2i32_POST, ST3i32_POST,...
10292 18 : printTypedVectorList<0, 's'>(MI, 1, STI, O);
10293 18 : printVectorIndex(MI, 2, STI, O);
10294 18 : O << ", [";
10295 18 : printOperand(MI, 3, STI, O);
10296 18 : break;
10297 4 : case 40:
10298 : // LD1i32_POST, LD2i32_POST, LD3i32_POST, LD4i32_POST
10299 4 : printTypedVectorList<0, 's'>(MI, 2, STI, O);
10300 4 : printVectorIndex(MI, 3, STI, O);
10301 4 : O << ", [";
10302 4 : printOperand(MI, 4, STI, O);
10303 4 : O << "], ";
10304 4 : break;
10305 12 : case 41:
10306 : // LD1i64, LD2i64, LD3i64, LD4i64, ST1i64_POST, ST2i64_POST, ST3i64_POST,...
10307 12 : printTypedVectorList<0, 'd'>(MI, 1, STI, O);
10308 12 : printVectorIndex(MI, 2, STI, O);
10309 12 : O << ", [";
10310 12 : printOperand(MI, 3, STI, O);
10311 12 : break;
10312 2 : case 42:
10313 : // LD1i64_POST, LD2i64_POST, LD3i64_POST, LD4i64_POST
10314 2 : printTypedVectorList<0, 'd'>(MI, 2, STI, O);
10315 2 : printVectorIndex(MI, 3, STI, O);
10316 2 : O << ", [";
10317 2 : printOperand(MI, 4, STI, O);
10318 2 : O << "], ";
10319 2 : break;
10320 14 : case 43:
10321 : // LD1i8, LD2i8, LD3i8, LD4i8, ST1i8_POST, ST2i8_POST, ST3i8_POST, ST4i8_...
10322 14 : printTypedVectorList<0, 'b'>(MI, 1, STI, O);
10323 14 : printVectorIndex(MI, 2, STI, O);
10324 14 : O << ", [";
10325 14 : printOperand(MI, 3, STI, O);
10326 14 : break;
10327 2 : case 44:
10328 : // LD1i8_POST, LD2i8_POST, LD3i8_POST, LD4i8_POST
10329 2 : printTypedVectorList<0, 'b'>(MI, 2, STI, O);
10330 2 : printVectorIndex(MI, 3, STI, O);
10331 2 : O << ", [";
10332 2 : printOperand(MI, 4, STI, O);
10333 2 : O << "], ";
10334 2 : break;
10335 604 : case 45:
10336 : // LDR_PXI, LDR_ZXI, MOVPRFX_ZZ, PTEST_PP, STR_PXI, STR_ZXI
10337 604 : printSVERegOp<>(MI, 0, STI, O);
10338 604 : break;
10339 2595 : case 46:
10340 : // MSR
10341 2595 : printMSRSystemRegister(MI, 0, STI, O);
10342 2595 : O << ", ";
10343 2595 : printOperand(MI, 1, STI, O);
10344 2595 : return;
10345 : break;
10346 35 : case 47:
10347 : // MSRpstateImm1, MSRpstateImm4
10348 35 : printSystemPStateField(MI, 0, STI, O);
10349 35 : O << ", ";
10350 35 : printOperand(MI, 1, STI, O);
10351 35 : return;
10352 : break;
10353 72 : case 48:
10354 : // PRFB_D_PZI, PRFB_D_SCALED, PRFB_D_SXTW_SCALED, PRFB_D_UXTW_SCALED, PRF...
10355 72 : printPrefetchOp<true>(MI, 0, STI, O);
10356 72 : O << ", ";
10357 72 : printSVERegOp<>(MI, 1, STI, O);
10358 72 : O << ", [";
10359 72 : break;
10360 70 : case 49:
10361 : // PRFMl, PRFMroW, PRFMroX, PRFMui, PRFUMi
10362 70 : printPrefetchOp(MI, 0, STI, O);
10363 70 : break;
10364 18 : case 50:
10365 : // ST1i16, ST2i16, ST3i16, ST4i16
10366 18 : printTypedVectorList<0, 'h'>(MI, 0, STI, O);
10367 18 : printVectorIndex(MI, 1, STI, O);
10368 18 : O << ", [";
10369 18 : printOperand(MI, 2, STI, O);
10370 : O << ']';
10371 : return;
10372 : break;
10373 12 : case 51:
10374 : // ST1i32, ST2i32, ST3i32, ST4i32
10375 12 : printTypedVectorList<0, 's'>(MI, 0, STI, O);
10376 12 : printVectorIndex(MI, 1, STI, O);
10377 12 : O << ", [";
10378 12 : printOperand(MI, 2, STI, O);
10379 : O << ']';
10380 : return;
10381 : break;
10382 14 : case 52:
10383 : // ST1i64, ST2i64, ST3i64, ST4i64
10384 14 : printTypedVectorList<0, 'd'>(MI, 0, STI, O);
10385 14 : printVectorIndex(MI, 1, STI, O);
10386 14 : O << ", [";
10387 14 : printOperand(MI, 2, STI, O);
10388 : O << ']';
10389 : return;
10390 : break;
10391 9 : case 53:
10392 : // ST1i8, ST2i8, ST3i8, ST4i8
10393 9 : printTypedVectorList<0, 'b'>(MI, 0, STI, O);
10394 9 : printVectorIndex(MI, 1, STI, O);
10395 9 : O << ", [";
10396 9 : printOperand(MI, 2, STI, O);
10397 : O << ']';
10398 : return;
10399 : break;
10400 : }
10401 :
10402 :
10403 : // Fragment 1 encoded into 6 bits for 56 unique commands.
10404 52496 : switch ((Bits >> 19) & 63) {
10405 0 : default: llvm_unreachable("Invalid command number.");
10406 30405 : case 0:
10407 : // ABS_ZPmZ_B, ABS_ZPmZ_D, ABS_ZPmZ_S, ABSv1i64, ADCSWr, ADCSXr, ADCWr, A...
10408 30405 : O << ", ";
10409 30405 : break;
10410 84 : case 1:
10411 : // ABS_ZPmZ_H, CLS_ZPmZ_H, CLZ_ZPmZ_H, CNOT_ZPmZ_H, CNT_ZPmZ_H, CPY_ZPmI_...
10412 84 : printSVERegOp<>(MI, 2, STI, O);
10413 84 : break;
10414 1788 : case 2:
10415 : // ABSv16i8, ADDHNv8i16_v16i8, ADDPv16i8, ADDv16i8, AESDrr, AESErr, AESIM...
10416 1788 : O << ".16b, ";
10417 1788 : break;
10418 1311 : case 3:
10419 : // ABSv2i32, ADDHNv2i64_v2i32, ADDPv2i32, ADDv2i32, BICv2i32, CLSv2i32, C...
10420 1311 : O << ".2s, ";
10421 1311 : break;
10422 1514 : case 4:
10423 : // ABSv2i64, ADDPv2i64, ADDv2i64, CMEQv2i64, CMEQv2i64rz, CMGEv2i64, CMGE...
10424 1514 : O << ".2d, ";
10425 1514 : break;
10426 1011 : case 5:
10427 : // ABSv4i16, ADDHNv4i32_v4i16, ADDPv4i16, ADDv4i16, BICv4i16, CLSv4i16, C...
10428 1011 : O << ".4h, ";
10429 1011 : break;
10430 2792 : case 6:
10431 : // ABSv4i32, ADDHNv2i64_v4i32, ADDPv4i32, ADDv4i32, BICv4i32, CLSv4i32, C...
10432 2792 : O << ".4s, ";
10433 2792 : break;
10434 1142 : case 7:
10435 : // ABSv8i16, ADDHNv4i32_v8i16, ADDPv8i16, ADDv8i16, BICv8i16, CLSv8i16, C...
10436 1142 : O << ".8h, ";
10437 1142 : break;
10438 823 : case 8:
10439 : // ABSv8i8, ADDHNv8i16_v8i8, ADDPv8i8, ADDv8i8, ANDv8i8, BICv8i8, BIFv8i8...
10440 823 : O << ".8b, ";
10441 823 : break;
10442 170 : case 9:
10443 : // ADD_ZI_H, ADD_ZZZ_H, ASR_WIDE_ZZZ_H, ASR_ZZI_H, DUP_ZZI_H, FADD_ZZZ_H,...
10444 170 : printSVERegOp<'h'>(MI, 1, STI, O);
10445 170 : break;
10446 348 : case 10:
10447 : // ADD_ZPmZ_H, AND_ZPmZ_H, ASRD_ZPmI_H, ASRR_ZPmZ_H, ASR_WIDE_ZPmZ_H, ASR...
10448 348 : printSVERegOp<>(MI, 1, STI, O);
10449 348 : break;
10450 9785 : case 11:
10451 : // ADR_LSL_ZZZ_D_0, ADR_LSL_ZZZ_D_1, ADR_LSL_ZZZ_D_2, ADR_LSL_ZZZ_D_3, AD...
10452 9785 : O << ", [";
10453 9785 : break;
10454 : case 12:
10455 : // AUTDZA, AUTDZB, AUTIZA, AUTIZB, BLR, BLRAAZ, BLRABZ, BR, BRAAZ, BRABZ,...
10456 : return;
10457 : break;
10458 28 : case 13:
10459 : // DECH_ZPiI, INCH_ZPiI, SQDECH_ZPiI, SQINCH_ZPiI, UQDECH_ZPiI, UQINCH_ZP...
10460 28 : printSVEPattern(MI, 2, STI, O);
10461 28 : O << ", mul ";
10462 28 : printOperand(MI, 3, STI, O);
10463 28 : return;
10464 : break;
10465 0 : case 14:
10466 : // DUP_ZI_H
10467 0 : printImm8OptLsl<int16_t>(MI, 1, STI, O);
10468 0 : return;
10469 : break;
10470 32 : case 15:
10471 : // DUP_ZR_H, INDEX_II_H, INDEX_IR_H, INDEX_RI_H, INDEX_RR_H, WHILELE_PWW_...
10472 32 : printOperand(MI, 1, STI, O);
10473 32 : break;
10474 8 : case 16:
10475 : // FCMLA_ZZZI_H, FMLA_ZZZI_H, FMLS_ZZZI_H
10476 8 : printSVERegOp<'h'>(MI, 2, STI, O);
10477 8 : O << ", ";
10478 8 : printSVERegOp<'h'>(MI, 3, STI, O);
10479 8 : printVectorIndex(MI, 4, STI, O);
10480 8 : break;
10481 76 : case 17:
10482 : // FCMPDri, FCMPEDri, FCMPEHri, FCMPESri, FCMPHri, FCMPSri
10483 76 : O << ", #0.0";
10484 76 : return;
10485 : break;
10486 0 : case 18:
10487 : // FDUP_ZI_H
10488 0 : printFPImmOperand(MI, 1, STI, O);
10489 0 : return;
10490 : break;
10491 7 : case 19:
10492 : // FMOVXDHighr, INSvi64gpr, INSvi64lane
10493 7 : O << ".d";
10494 7 : printVectorIndex(MI, 2, STI, O);
10495 7 : O << ", ";
10496 7 : break;
10497 648 : case 20:
10498 : // GLD1B_D_IMM_REAL, GLD1B_D_REAL, GLD1B_D_SXTW_REAL, GLD1B_D_UXTW_REAL, ...
10499 648 : O << "/z, [";
10500 648 : break;
10501 62 : case 21:
10502 : // INSR_ZR_H, INSR_ZV_H, PRFB_D_SCALED, PRFB_D_SXTW_SCALED, PRFB_D_UXTW_S...
10503 62 : printOperand(MI, 2, STI, O);
10504 62 : break;
10505 0 : case 22:
10506 : // INSvi16gpr, INSvi16lane
10507 0 : O << ".h";
10508 0 : printVectorIndex(MI, 2, STI, O);
10509 0 : O << ", ";
10510 0 : break;
10511 0 : case 23:
10512 : // INSvi32gpr, INSvi32lane
10513 0 : O << ".s";
10514 0 : printVectorIndex(MI, 2, STI, O);
10515 0 : O << ", ";
10516 0 : break;
10517 0 : case 24:
10518 : // INSvi8gpr, INSvi8lane
10519 0 : O << ".b";
10520 0 : printVectorIndex(MI, 2, STI, O);
10521 0 : O << ", ";
10522 0 : break;
10523 : case 25:
10524 : // LD1Fourv16b_POST, LD1Fourv2d_POST, LD1Fourv4s_POST, LD1Fourv8h_POST, L...
10525 : printPostIncOperand<64>(MI, 3, STI, O);
10526 : return;
10527 : break;
10528 : case 26:
10529 : // LD1Fourv1d_POST, LD1Fourv2s_POST, LD1Fourv4h_POST, LD1Fourv8b_POST, LD...
10530 : printPostIncOperand<32>(MI, 3, STI, O);
10531 : return;
10532 : break;
10533 : case 27:
10534 : // LD1Onev16b_POST, LD1Onev2d_POST, LD1Onev4s_POST, LD1Onev8h_POST, LD1Tw...
10535 : printPostIncOperand<16>(MI, 3, STI, O);
10536 : return;
10537 : break;
10538 : case 28:
10539 : // LD1Onev1d_POST, LD1Onev2s_POST, LD1Onev4h_POST, LD1Onev8b_POST, LD1Rv1...
10540 : printPostIncOperand<8>(MI, 3, STI, O);
10541 : return;
10542 : break;
10543 : case 29:
10544 : // LD1Rv16b_POST, LD1Rv8b_POST
10545 : printPostIncOperand<1>(MI, 3, STI, O);
10546 : return;
10547 : break;
10548 : case 30:
10549 : // LD1Rv2s_POST, LD1Rv4s_POST, LD2Rv4h_POST, LD2Rv8h_POST, LD4Rv16b_POST,...
10550 : printPostIncOperand<4>(MI, 3, STI, O);
10551 : return;
10552 : break;
10553 : case 31:
10554 : // LD1Rv4h_POST, LD1Rv8h_POST, LD2Rv16b_POST, LD2Rv8b_POST
10555 : printPostIncOperand<2>(MI, 3, STI, O);
10556 : return;
10557 : break;
10558 : case 32:
10559 : // LD1Threev16b_POST, LD1Threev2d_POST, LD1Threev4s_POST, LD1Threev8h_POS...
10560 : printPostIncOperand<48>(MI, 3, STI, O);
10561 : return;
10562 : break;
10563 : case 33:
10564 : // LD1Threev1d_POST, LD1Threev2s_POST, LD1Threev4h_POST, LD1Threev8b_POST...
10565 : printPostIncOperand<24>(MI, 3, STI, O);
10566 : return;
10567 : break;
10568 : case 34:
10569 : // LD1i16, LD1i32, LD1i64, LD1i8, LD2i16, LD2i32, LD2i64, LD2i8, LD3i16, ...
10570 : O << ']';
10571 : return;
10572 : break;
10573 : case 35:
10574 : // LD1i16_POST, LD2i8_POST
10575 : printPostIncOperand<2>(MI, 5, STI, O);
10576 : return;
10577 : break;
10578 : case 36:
10579 : // LD1i32_POST, LD2i16_POST, LD4i8_POST
10580 : printPostIncOperand<4>(MI, 5, STI, O);
10581 : return;
10582 : break;
10583 : case 37:
10584 : // LD1i64_POST, LD2i32_POST, LD4i16_POST
10585 : printPostIncOperand<8>(MI, 5, STI, O);
10586 : return;
10587 : break;
10588 : case 38:
10589 : // LD1i8_POST
10590 : printPostIncOperand<1>(MI, 5, STI, O);
10591 : return;
10592 : break;
10593 : case 39:
10594 : // LD2i64_POST, LD4i32_POST
10595 : printPostIncOperand<16>(MI, 5, STI, O);
10596 : return;
10597 : break;
10598 : case 40:
10599 : // LD3Rv16b_POST, LD3Rv8b_POST
10600 : printPostIncOperand<3>(MI, 3, STI, O);
10601 : return;
10602 : break;
10603 : case 41:
10604 : // LD3Rv2s_POST, LD3Rv4s_POST
10605 : printPostIncOperand<12>(MI, 3, STI, O);
10606 : return;
10607 : break;
10608 : case 42:
10609 : // LD3Rv4h_POST, LD3Rv8h_POST
10610 : printPostIncOperand<6>(MI, 3, STI, O);
10611 : return;
10612 : break;
10613 : case 43:
10614 : // LD3i16_POST
10615 : printPostIncOperand<6>(MI, 5, STI, O);
10616 : return;
10617 : break;
10618 : case 44:
10619 : // LD3i32_POST
10620 : printPostIncOperand<12>(MI, 5, STI, O);
10621 : return;
10622 : break;
10623 : case 45:
10624 : // LD3i64_POST
10625 : printPostIncOperand<24>(MI, 5, STI, O);
10626 : return;
10627 : break;
10628 : case 46:
10629 : // LD3i8_POST
10630 : printPostIncOperand<3>(MI, 5, STI, O);
10631 : return;
10632 : break;
10633 : case 47:
10634 : // LD4i64_POST
10635 : printPostIncOperand<32>(MI, 5, STI, O);
10636 : return;
10637 : break;
10638 8 : case 48:
10639 : // PMULLv1i64, PMULLv2i64
10640 8 : O << ".1q, ";
10641 8 : printVRegOperand(MI, 1, STI, O);
10642 8 : break;
10643 8 : case 49:
10644 : // PRFB_D_PZI, PRFD_D_PZI, PRFH_D_PZI, PRFW_D_PZI
10645 8 : printSVERegOp<'d'>(MI, 2, STI, O);
10646 8 : O << ", ";
10647 8 : break;
10648 8 : case 50:
10649 : // PRFB_S_PZI, PRFD_S_PZI, PRFH_S_PZI, PRFW_S_PZI
10650 8 : printSVERegOp<'s'>(MI, 2, STI, O);
10651 8 : O << ", ";
10652 8 : break;
10653 4 : case 51:
10654 : // PTRUES_H, PTRUE_H
10655 4 : printSVEPattern(MI, 1, STI, O);
10656 4 : return;
10657 : break;
10658 16 : case 52:
10659 : // PUNPKHI_PP, PUNPKLO_PP, SUNPKHI_ZZ_H, SUNPKLO_ZZ_H, UUNPKHI_ZZ_H, UUNP...
10660 16 : printSVERegOp<'b'>(MI, 1, STI, O);
10661 16 : return;
10662 : break;
10663 6 : case 53:
10664 : // SADALPv2i32_v1i64, SADDLPv2i32_v1i64, UADALPv2i32_v1i64, UADDLPv2i32_v...
10665 6 : O << ".1d, ";
10666 6 : break;
10667 36 : case 54:
10668 : // ST1i16_POST, ST1i32_POST, ST1i64_POST, ST1i8_POST, ST2GPostIndex, ST2i...
10669 36 : O << "], ";
10670 36 : break;
10671 4 : case 55:
10672 : // TBL_ZZZ_H
10673 4 : printTypedVectorList<0,'h'>(MI, 1, STI, O);
10674 4 : O << ", ";
10675 4 : printSVERegOp<'h'>(MI, 2, STI, O);
10676 4 : return;
10677 : break;
10678 : }
10679 :
10680 :
10681 : // Fragment 2 encoded into 6 bits for 59 unique commands.
10682 51996 : switch ((Bits >> 25) & 63) {
10683 0 : default: llvm_unreachable("Invalid command number.");
10684 383 : case 0:
10685 : // ABS_ZPmZ_B, ABS_ZPmZ_D, ABS_ZPmZ_S, BRKA_PPmP, BRKB_PPmP, CLS_ZPmZ_B, ...
10686 383 : printSVERegOp<>(MI, 2, STI, O);
10687 383 : break;
10688 272 : case 1:
10689 : // ABS_ZPmZ_H, ADD_ZPmZ_H, AND_ZPmZ_H, ASRD_ZPmI_H, ASRR_ZPmZ_H, ASR_WIDE...
10690 272 : O << "/m, ";
10691 272 : break;
10692 8882 : case 2:
10693 : // ABSv16i8, ABSv2i32, ABSv2i64, ABSv4i16, ABSv4i32, ABSv8i16, ABSv8i8, A...
10694 8882 : printVRegOperand(MI, 1, STI, O);
10695 8882 : break;
10696 22549 : case 3:
10697 : // ABSv1i64, ADCSWr, ADCSXr, ADCWr, ADCXr, ADDG, ADDPL_XXI, ADDSWri, ADDS...
10698 22549 : printOperand(MI, 1, STI, O);
10699 22549 : break;
10700 1949 : case 4:
10701 : // ADDHNv2i64_v4i32, ADDHNv4i32_v8i16, ADDHNv8i16_v16i8, AESDrr, AESErr, ...
10702 1949 : printVRegOperand(MI, 2, STI, O);
10703 1949 : break;
10704 186 : case 5:
10705 : // ADD_ZI_B, ADD_ZZZ_B, ASR_WIDE_ZZZ_B, ASR_ZZI_B, DECP_XP_B, DUP_ZZI_B, ...
10706 186 : printSVERegOp<'b'>(MI, 1, STI, O);
10707 186 : break;
10708 291 : case 6:
10709 : // ADD_ZI_D, ADD_ZZZ_D, ADR_LSL_ZZZ_D_0, ADR_LSL_ZZZ_D_1, ADR_LSL_ZZZ_D_2...
10710 291 : printSVERegOp<'d'>(MI, 1, STI, O);
10711 291 : break;
10712 264 : case 7:
10713 : // ADD_ZI_H, ADD_ZZZ_H, ASR_WIDE_ZZZ_H, ASR_ZZI_H, CLASTA_ZPZ_H, CLASTB_Z...
10714 264 : O << ", ";
10715 264 : break;
10716 213 : case 8:
10717 : // ADD_ZI_S, ADD_ZZZ_S, ADR_LSL_ZZZ_S_0, ADR_LSL_ZZZ_S_1, ADR_LSL_ZZZ_S_2...
10718 213 : printSVERegOp<'s'>(MI, 1, STI, O);
10719 213 : break;
10720 2352 : case 9:
10721 : // ADD_ZPmZ_B, ADD_ZPmZ_D, ADD_ZPmZ_S, ANDS_PPzPP, ANDV_VPZ_B, ANDV_VPZ_D...
10722 2352 : printSVERegOp<>(MI, 1, STI, O);
10723 2352 : break;
10724 3046 : case 10:
10725 : // ADRP
10726 3046 : printAdrpLabel(MI, 1, STI, O);
10727 3046 : return;
10728 : break;
10729 3762 : case 11:
10730 : // BFMWri, BFMXri, CASAB, CASAH, CASALB, CASALH, CASALW, CASALX, CASAW, C...
10731 3762 : printOperand(MI, 2, STI, O);
10732 3762 : break;
10733 383 : case 12:
10734 : // BICv2i32, BICv4i16, BICv4i32, BICv8i16, MOVKWi, MOVKXi, ORRv2i32, ORRv...
10735 383 : printImm(MI, 2, STI, O);
10736 383 : printShifter(MI, 3, STI, O);
10737 383 : return;
10738 : break;
10739 384 : case 13:
10740 : // CBNZW, CBNZX, CBZW, CBZX, LDRDl, LDRQl, LDRSWl, LDRSl, LDRWl, LDRXl, P...
10741 384 : printAlignedLabel(MI, 1, STI, O);
10742 384 : return;
10743 : break;
10744 138 : case 14:
10745 : // CMPEQ_PPzZI_H, CMPEQ_PPzZZ_H, CMPEQ_WIDE_PPzZZ_H, CMPGE_PPzZI_H, CMPGE...
10746 138 : O << "/z, ";
10747 138 : break;
10748 144 : case 15:
10749 : // CNTB_XPiI, CNTD_XPiI, CNTH_XPiI, CNTW_XPiI, PTRUES_B, PTRUES_D, PTRUES...
10750 144 : printSVEPattern(MI, 1, STI, O);
10751 144 : break;
10752 136 : case 16:
10753 : // DECB_XPiI, DECD_XPiI, DECD_ZPiI, DECH_XPiI, DECW_XPiI, DECW_ZPiI, INCB...
10754 136 : printSVEPattern(MI, 2, STI, O);
10755 136 : O << ", mul ";
10756 136 : printOperand(MI, 3, STI, O);
10757 136 : return;
10758 : break;
10759 32 : case 17:
10760 : // DECP_XP_H, INCP_XP_H, SQDECP_XPWd_H, SQDECP_XP_H, SQINCP_XPWd_H, SQINC...
10761 32 : printSVERegOp<'h'>(MI, 1, STI, O);
10762 32 : break;
10763 : case 18:
10764 : // DECP_ZP_H, DUP_ZR_H, FEXPA_ZZ_H, FMLA_ZZZI_H, FMLS_ZZZI_H, FRECPE_ZZ_H...
10765 : return;
10766 : break;
10767 2 : case 19:
10768 : // DUPM_ZI
10769 2 : printLogicalImm<int64_t>(MI, 1, STI, O);
10770 2 : return;
10771 : break;
10772 0 : case 20:
10773 : // DUP_ZI_B
10774 0 : printImm8OptLsl<int8_t>(MI, 1, STI, O);
10775 0 : return;
10776 : break;
10777 0 : case 21:
10778 : // DUP_ZI_D
10779 0 : printImm8OptLsl<int64_t>(MI, 1, STI, O);
10780 0 : return;
10781 : break;
10782 0 : case 22:
10783 : // DUP_ZI_S
10784 0 : printImm8OptLsl<int32_t>(MI, 1, STI, O);
10785 0 : return;
10786 : break;
10787 0 : case 23:
10788 : // DUP_ZZI_H
10789 0 : printVectorIndex(MI, 2, STI, O);
10790 0 : return;
10791 : break;
10792 36 : case 24:
10793 : // FCMLA_ZZZI_S, FMLA_ZZZI_S, FMLS_ZZZI_S, GLD1B_S_IMM_REAL, GLD1H_S_IMM_...
10794 36 : printSVERegOp<'s'>(MI, 2, STI, O);
10795 36 : O << ", ";
10796 36 : break;
10797 150 : case 25:
10798 : // FDUP_ZI_D, FDUP_ZI_S, FMOVDi, FMOVHi, FMOVSi, FMOVv2f32_ns, FMOVv2f64_...
10799 150 : printFPImmOperand(MI, 1, STI, O);
10800 150 : return;
10801 : break;
10802 44 : case 26:
10803 : // FMLA_ZZZI_D, FMLS_ZZZI_D, GLD1B_D_IMM_REAL, GLD1D_IMM_REAL, GLD1H_D_IM...
10804 44 : printSVERegOp<'d'>(MI, 2, STI, O);
10805 44 : O << ", ";
10806 44 : break;
10807 4 : case 27:
10808 : // INSvi16gpr, INSvi32gpr, INSvi64gpr, INSvi8gpr, PRFB_D_PZI, PRFB_S_PZI
10809 4 : printOperand(MI, 3, STI, O);
10810 4 : break;
10811 0 : case 28:
10812 : // INSvi16lane, INSvi32lane, INSvi64lane, INSvi8lane
10813 0 : printVRegOperand(MI, 3, STI, O);
10814 0 : break;
10815 2250 : case 29:
10816 : // LDADDAB, LDADDAH, LDADDALB, LDADDALH, LDADDALW, LDADDALX, LDADDAW, LDA...
10817 2250 : printOperand(MI, 0, STI, O);
10818 2250 : O << ", [";
10819 2250 : printOperand(MI, 2, STI, O);
10820 : O << ']';
10821 : return;
10822 : break;
10823 293 : case 30:
10824 : // MOVID, MOVIv2d_ns
10825 293 : printSIMDType10Operand(MI, 1, STI, O);
10826 293 : return;
10827 : break;
10828 323 : case 31:
10829 : // MOVIv16b_ns, MOVIv2i32, MOVIv2s_msl, MOVIv4i16, MOVIv4i32, MOVIv4s_msl...
10830 323 : printImm(MI, 1, STI, O);
10831 323 : break;
10832 3173 : case 32:
10833 : // MRS
10834 3173 : printMRSSystemRegister(MI, 1, STI, O);
10835 3173 : return;
10836 : break;
10837 4 : case 33:
10838 : // PMULLv1i64
10839 4 : O << ".1d, ";
10840 4 : printVRegOperand(MI, 2, STI, O);
10841 4 : O << ".1d";
10842 4 : return;
10843 : break;
10844 4 : case 34:
10845 : // PMULLv2i64
10846 4 : O << ".2d, ";
10847 4 : printVRegOperand(MI, 2, STI, O);
10848 4 : O << ".2d";
10849 4 : return;
10850 : break;
10851 4 : case 35:
10852 : // PRFD_D_PZI, PRFD_S_PZI
10853 4 : printImmScale<8>(MI, 3, STI, O);
10854 : O << ']';
10855 : return;
10856 : break;
10857 4 : case 36:
10858 : // PRFH_D_PZI, PRFH_S_PZI
10859 4 : printImmScale<2>(MI, 3, STI, O);
10860 : O << ']';
10861 : return;
10862 : break;
10863 4 : case 37:
10864 : // PRFW_D_PZI, PRFW_S_PZI
10865 4 : printImmScale<4>(MI, 3, STI, O);
10866 : O << ']';
10867 : return;
10868 : break;
10869 16 : case 38:
10870 : // SDOT_ZZZI_D, SDOT_ZZZ_D, UDOT_ZZZI_D, UDOT_ZZZ_D
10871 16 : printSVERegOp<'h'>(MI, 2, STI, O);
10872 16 : O << ", ";
10873 16 : printSVERegOp<'h'>(MI, 3, STI, O);
10874 16 : break;
10875 8 : case 39:
10876 : // SDOT_ZZZI_S, SDOT_ZZZ_S, UDOT_ZZZI_S, UDOT_ZZZ_S
10877 8 : printSVERegOp<'b'>(MI, 2, STI, O);
10878 8 : O << ", ";
10879 8 : printSVERegOp<'b'>(MI, 3, STI, O);
10880 8 : break;
10881 32 : case 40:
10882 : // SQDECB_XPiWdI, SQDECD_XPiWdI, SQDECH_XPiWdI, SQDECW_XPiWdI, SQINCB_XPi...
10883 32 : printGPR64as32(MI, 1, STI, O);
10884 32 : O << ", ";
10885 32 : printSVEPattern(MI, 2, STI, O);
10886 32 : O << ", mul ";
10887 32 : printOperand(MI, 3, STI, O);
10888 32 : return;
10889 : break;
10890 : case 41:
10891 : // ST1i16_POST, ST2i8_POST
10892 : printPostIncOperand<2>(MI, 4, STI, O);
10893 : return;
10894 : break;
10895 : case 42:
10896 : // ST1i32_POST, ST2i16_POST, ST4i8_POST
10897 : printPostIncOperand<4>(MI, 4, STI, O);
10898 : return;
10899 : break;
10900 : case 43:
10901 : // ST1i64_POST, ST2i32_POST, ST4i16_POST
10902 : printPostIncOperand<8>(MI, 4, STI, O);
10903 : return;
10904 : break;
10905 : case 44:
10906 : // ST1i8_POST
10907 : printPostIncOperand<1>(MI, 4, STI, O);
10908 : return;
10909 : break;
10910 24 : case 45:
10911 : // ST2GOffset, STGOffset, STZ2GOffset, STZGOffset
10912 24 : printImmScale<16>(MI, 1, STI, O);
10913 : O << ']';
10914 : return;
10915 : break;
10916 48 : case 46:
10917 : // ST2GPostIndex, ST2GPreIndex, STGPostIndex, STGPreIndex, STZ2GPostIndex...
10918 48 : printImmScale<16>(MI, 2, STI, O);
10919 48 : break;
10920 : case 47:
10921 : // ST2i64_POST, ST4i32_POST
10922 : printPostIncOperand<16>(MI, 4, STI, O);
10923 : return;
10924 : break;
10925 : case 48:
10926 : // ST3i16_POST
10927 : printPostIncOperand<6>(MI, 4, STI, O);
10928 : return;
10929 : break;
10930 : case 49:
10931 : // ST3i32_POST
10932 : printPostIncOperand<12>(MI, 4, STI, O);
10933 : return;
10934 : break;
10935 : case 50:
10936 : // ST3i64_POST
10937 : printPostIncOperand<24>(MI, 4, STI, O);
10938 : return;
10939 : break;
10940 : case 51:
10941 : // ST3i8_POST
10942 : printPostIncOperand<3>(MI, 4, STI, O);
10943 : return;
10944 : break;
10945 : case 52:
10946 : // ST4i64_POST
10947 : printPostIncOperand<32>(MI, 4, STI, O);
10948 : return;
10949 : break;
10950 92 : case 53:
10951 : // SYSxt
10952 92 : printSysCROperand(MI, 1, STI, O);
10953 92 : O << ", ";
10954 92 : printSysCROperand(MI, 2, STI, O);
10955 92 : O << ", ";
10956 92 : printOperand(MI, 3, STI, O);
10957 92 : O << ", ";
10958 92 : printOperand(MI, 4, STI, O);
10959 92 : return;
10960 : break;
10961 4 : case 54:
10962 : // TBL_ZZZ_B
10963 4 : printTypedVectorList<0,'b'>(MI, 1, STI, O);
10964 4 : O << ", ";
10965 4 : printSVERegOp<'b'>(MI, 2, STI, O);
10966 4 : return;
10967 : break;
10968 4 : case 55:
10969 : // TBL_ZZZ_D
10970 4 : printTypedVectorList<0,'d'>(MI, 1, STI, O);
10971 4 : O << ", ";
10972 4 : printSVERegOp<'d'>(MI, 2, STI, O);
10973 4 : return;
10974 : break;
10975 4 : case 56:
10976 : // TBL_ZZZ_S
10977 4 : printTypedVectorList<0,'s'>(MI, 1, STI, O);
10978 4 : O << ", ";
10979 4 : printSVERegOp<'s'>(MI, 2, STI, O);
10980 4 : return;
10981 : break;
10982 35 : case 57:
10983 : // TBLv16i8Four, TBLv16i8One, TBLv16i8Three, TBLv16i8Two, TBLv8i8Four, TB...
10984 35 : printTypedVectorList<16, 'b'>(MI, 1, STI, O);
10985 35 : O << ", ";
10986 35 : printVRegOperand(MI, 2, STI, O);
10987 35 : break;
10988 26 : case 58:
10989 : // TBXv16i8Four, TBXv16i8One, TBXv16i8Three, TBXv16i8Two, TBXv8i8Four, TB...
10990 26 : printTypedVectorList<16, 'b'>(MI, 2, STI, O);
10991 26 : O << ", ";
10992 26 : printVRegOperand(MI, 3, STI, O);
10993 26 : break;
10994 : }
10995 :
10996 :
10997 : // Fragment 3 encoded into 7 bits for 93 unique commands.
10998 41957 : switch ((Bits >> 31) & 127) {
10999 0 : default: llvm_unreachable("Invalid command number.");
11000 1051 : case 0:
11001 : // ABS_ZPmZ_B, ABS_ZPmZ_D, ABS_ZPmZ_S, ADD_ZPmZ_B, ADD_ZPmZ_D, ADD_ZPmZ_S...
11002 1051 : O << "/m, ";
11003 1051 : break;
11004 92 : case 1:
11005 : // ABS_ZPmZ_H, CLS_ZPmZ_H, CLZ_ZPmZ_H, CNOT_ZPmZ_H, CNT_ZPmZ_H, FABS_ZPmZ...
11006 92 : printSVERegOp<'h'>(MI, 3, STI, O);
11007 92 : break;
11008 659 : case 2:
11009 : // ABSv16i8, ADDVv16i8v, AESDrr, AESErr, AESIMCrr, AESMCrr, CLSv16i8, CLZ...
11010 659 : O << ".16b";
11011 659 : return;
11012 : break;
11013 : case 3:
11014 : // ABSv1i64, ADR, AUTDA, AUTDB, AUTIA, AUTIB, BLRAA, BLRAB, BRAA, BRAB, C...
11015 : return;
11016 : break;
11017 226 : case 4:
11018 : // ABSv2i32, CLSv2i32, CLZv2i32, FABSv2f32, FADDPv2i32p, FCVTASv2f32, FCV...
11019 226 : O << ".2s";
11020 226 : return;
11021 : break;
11022 190 : case 5:
11023 : // ABSv2i64, ADDPv2i64p, FABSv2f64, FADDPv2i64p, FCVTASv2f64, FCVTAUv2f64...
11024 190 : O << ".2d";
11025 190 : return;
11026 : break;
11027 282 : case 6:
11028 : // ABSv4i16, ADDVv4i16v, CLSv4i16, CLZv4i16, FABSv4f16, FCVTASv4f16, FCVT...
11029 282 : O << ".4h";
11030 282 : return;
11031 : break;
11032 534 : case 7:
11033 : // ABSv4i32, ADDVv4i32v, CLSv4i32, CLZv4i32, FABSv4f32, FCVTASv4f32, FCVT...
11034 534 : O << ".4s";
11035 534 : return;
11036 : break;
11037 245 : case 8:
11038 : // ABSv8i16, ADDVv8i16v, CLSv8i16, CLZv8i16, FABSv8f16, FCVTASv8f16, FCVT...
11039 245 : O << ".8h";
11040 245 : return;
11041 : break;
11042 193 : case 9:
11043 : // ABSv8i8, ADDVv8i8v, CLSv8i8, CLZv8i8, CNTv8i8, NEGv8i8, NOTv8i8, RBITv...
11044 193 : O << ".8b";
11045 193 : return;
11046 : break;
11047 20303 : case 10:
11048 : // ADCSWr, ADCSXr, ADCWr, ADCXr, ADDG, ADDPL_XXI, ADDSWri, ADDSWrs, ADDSW...
11049 20303 : O << ", ";
11050 20303 : break;
11051 727 : case 11:
11052 : // ADDHNv2i64_v2i32, ADDHNv2i64_v4i32, ADDPv2i64, ADDv2i64, CMEQv2i64, CM...
11053 727 : O << ".2d, ";
11054 727 : break;
11055 1763 : case 12:
11056 : // ADDHNv4i32_v4i16, ADDHNv4i32_v8i16, ADDPv4i32, ADDv4i32, CMEQv4i32, CM...
11057 1763 : O << ".4s, ";
11058 1763 : break;
11059 906 : case 13:
11060 : // ADDHNv8i16_v16i8, ADDHNv8i16_v8i8, ADDPv8i16, ADDv8i16, CMEQv8i16, CMG...
11061 906 : O << ".8h, ";
11062 906 : break;
11063 1157 : case 14:
11064 : // ADDPv16i8, ADDv16i8, ANDv16i8, BCAX, BICv16i8, BIFv16i8, BITv16i8, BSL...
11065 1157 : O << ".16b, ";
11066 1157 : break;
11067 957 : case 15:
11068 : // ADDPv2i32, ADDv2i32, CMEQv2i32, CMGEv2i32, CMGTv2i32, CMHIv2i32, CMHSv...
11069 957 : O << ".2s, ";
11070 957 : break;
11071 808 : case 16:
11072 : // ADDPv4i16, ADDv4i16, CMEQv4i16, CMGEv4i16, CMGTv4i16, CMHIv4i16, CMHSv...
11073 808 : O << ".4h, ";
11074 808 : break;
11075 654 : case 17:
11076 : // ADDPv8i8, ADDv8i8, ANDv8i8, BICv8i8, BIFv8i8, BITv8i8, BSLv8i8, CMEQv8...
11077 654 : O << ".8b, ";
11078 654 : break;
11079 56 : case 18:
11080 : // ADD_ZI_H, SQADD_ZI_H, SQSUB_ZI_H, SUBR_ZI_H, SUB_ZI_H, UQADD_ZI_H, UQS...
11081 56 : printImm8OptLsl<uint16_t>(MI, 2, STI, O);
11082 56 : return;
11083 : break;
11084 392 : case 19:
11085 : // ADD_ZPmZ_H, ADD_ZZZ_H, AND_ZPmZ_H, ASRD_ZPmI_H, ASRR_ZPmZ_H, ASR_WIDE_...
11086 392 : printSVERegOp<'h'>(MI, 2, STI, O);
11087 392 : break;
11088 832 : case 20:
11089 : // ANDS_PPzPP, AND_PPzPP, BICS_PPzPP, BIC_PPzPP, BRKAS_PPzP, BRKA_PPzP, B...
11090 832 : O << "/z, ";
11091 832 : break;
11092 6 : case 21:
11093 : // ASR_WIDE_ZZZ_H, LSL_WIDE_ZZZ_H, LSR_WIDE_ZZZ_H
11094 6 : printSVERegOp<'d'>(MI, 2, STI, O);
11095 6 : return;
11096 : break;
11097 56 : case 22:
11098 : // ASR_ZZI_H, INDEX_II_H, INDEX_IR_H, INDEX_RI_H, INDEX_RR_H, LSL_ZZI_H, ...
11099 56 : printOperand(MI, 2, STI, O);
11100 56 : return;
11101 : break;
11102 2747 : case 23:
11103 : // CASAB, CASAH, CASALB, CASALH, CASALW, CASALX, CASAW, CASAX, CASB, CASH...
11104 2747 : O << ", [";
11105 2747 : break;
11106 20 : case 24:
11107 : // CMEQv16i8rz, CMGEv16i8rz, CMGTv16i8rz, CMLEv16i8rz, CMLTv16i8rz
11108 20 : O << ".16b, #0";
11109 20 : return;
11110 : break;
11111 20 : case 25:
11112 : // CMEQv1i64rz, CMGEv1i64rz, CMGTv1i64rz, CMLEv1i64rz, CMLTv1i64rz
11113 20 : O << ", #0";
11114 20 : return;
11115 : break;
11116 20 : case 26:
11117 : // CMEQv2i32rz, CMGEv2i32rz, CMGTv2i32rz, CMLEv2i32rz, CMLTv2i32rz
11118 20 : O << ".2s, #0";
11119 20 : return;
11120 : break;
11121 20 : case 27:
11122 : // CMEQv2i64rz, CMGEv2i64rz, CMGTv2i64rz, CMLEv2i64rz, CMLTv2i64rz
11123 20 : O << ".2d, #0";
11124 20 : return;
11125 : break;
11126 20 : case 28:
11127 : // CMEQv4i16rz, CMGEv4i16rz, CMGTv4i16rz, CMLEv4i16rz, CMLTv4i16rz
11128 20 : O << ".4h, #0";
11129 20 : return;
11130 : break;
11131 29 : case 29:
11132 : // CMEQv4i32rz, CMGEv4i32rz, CMGTv4i32rz, CMLEv4i32rz, CMLTv4i32rz
11133 29 : O << ".4s, #0";
11134 29 : return;
11135 : break;
11136 20 : case 30:
11137 : // CMEQv8i16rz, CMGEv8i16rz, CMGTv8i16rz, CMLEv8i16rz, CMLTv8i16rz
11138 20 : O << ".8h, #0";
11139 20 : return;
11140 : break;
11141 23 : case 31:
11142 : // CMEQv8i8rz, CMGEv8i8rz, CMGTv8i8rz, CMLEv8i8rz, CMLTv8i8rz
11143 23 : O << ".8b, #0";
11144 23 : return;
11145 : break;
11146 8 : case 32:
11147 : // CNTB_XPiI, CNTD_XPiI, CNTH_XPiI, CNTW_XPiI
11148 8 : O << ", mul ";
11149 8 : printOperand(MI, 2, STI, O);
11150 8 : return;
11151 : break;
11152 0 : case 33:
11153 : // CPY_ZPmI_H
11154 0 : printImm8OptLsl<int16_t>(MI, 3, STI, O);
11155 0 : return;
11156 : break;
11157 36 : case 34:
11158 : // CPY_ZPmR_H, CPY_ZPmV_H, GLD1B_D_IMM_REAL, GLD1B_S_IMM_REAL, GLD1SB_D_I...
11159 36 : printOperand(MI, 3, STI, O);
11160 36 : break;
11161 0 : case 35:
11162 : // CPY_ZPzI_H
11163 0 : printImm8OptLsl<int16_t>(MI, 2, STI, O);
11164 0 : return;
11165 : break;
11166 826 : case 36:
11167 : // CPYi16, DUPv4i16lane, DUPv8i16lane, INSvi16lane, SMOVvi16to32, SMOVvi1...
11168 826 : O << ".h";
11169 826 : break;
11170 127 : case 37:
11171 : // CPYi32, DUPv2i32lane, DUPv4i32lane, INSvi32lane, SMOVvi32to64, UMOVvi3...
11172 127 : O << ".s";
11173 127 : break;
11174 56 : case 38:
11175 : // CPYi64, DUPv2i64lane, FMOVDXHighr, INSvi64lane, UMOVvi64
11176 56 : O << ".d";
11177 56 : break;
11178 237 : case 39:
11179 : // CPYi8, DUPv16i8lane, DUPv8i8lane, INSvi8lane, SMOVvi8to32, SMOVvi8to64...
11180 237 : O << ".b";
11181 237 : break;
11182 0 : case 40:
11183 : // DUP_ZZI_B, DUP_ZZI_D, DUP_ZZI_S
11184 0 : printVectorIndex(MI, 2, STI, O);
11185 0 : return;
11186 : break;
11187 2 : case 41:
11188 : // FADDPv2i16p, FMAXNMPv2i16p, FMAXPv2i16p, FMINNMPv2i16p, FMINPv2i16p
11189 2 : O << ".2h";
11190 2 : return;
11191 : break;
11192 55 : case 42:
11193 : // FCMEQv1i16rz, FCMEQv1i32rz, FCMEQv1i64rz, FCMGEv1i16rz, FCMGEv1i32rz, ...
11194 55 : O << ", #0.0";
11195 55 : return;
11196 : break;
11197 32 : case 43:
11198 : // FCMEQv2i32rz, FCMGEv2i32rz, FCMGTv2i32rz, FCMLEv2i32rz, FCMLTv2i32rz
11199 32 : O << ".2s, #0.0";
11200 32 : return;
11201 : break;
11202 35 : case 44:
11203 : // FCMEQv2i64rz, FCMGEv2i64rz, FCMGTv2i64rz, FCMLEv2i64rz, FCMLTv2i64rz
11204 35 : O << ".2d, #0.0";
11205 35 : return;
11206 : break;
11207 10 : case 45:
11208 : // FCMEQv4i16rz, FCMGEv4i16rz, FCMGTv4i16rz, FCMLEv4i16rz, FCMLTv4i16rz
11209 10 : O << ".4h, #0.0";
11210 10 : return;
11211 : break;
11212 35 : case 46:
11213 : // FCMEQv4i32rz, FCMGEv4i32rz, FCMGTv4i32rz, FCMLEv4i32rz, FCMLTv4i32rz
11214 35 : O << ".4s, #0.0";
11215 35 : return;
11216 : break;
11217 10 : case 47:
11218 : // FCMEQv8i16rz, FCMGEv8i16rz, FCMGTv8i16rz, FCMLEv8i16rz, FCMLTv8i16rz
11219 10 : O << ".8h, #0.0";
11220 10 : return;
11221 : break;
11222 4 : case 48:
11223 : // FCMLA_ZZZI_H
11224 4 : printComplexRotationOp<90, 0>(MI, 5, STI, O);
11225 4 : return;
11226 : break;
11227 16 : case 49:
11228 : // FCMLA_ZZZI_S, FCVT_ZPmZ_StoH, FMLA_ZZZI_S, FMLS_ZZZI_S, SCVTF_ZPmZ_Sto...
11229 16 : printSVERegOp<'s'>(MI, 3, STI, O);
11230 16 : break;
11231 0 : case 50:
11232 : // FCPY_ZPmI_H
11233 0 : printFPImmOperand(MI, 3, STI, O);
11234 0 : return;
11235 : break;
11236 14 : case 51:
11237 : // FCVT_ZPmZ_DtoH, FMLA_ZZZI_D, FMLS_ZZZI_D, SCVTF_ZPmZ_DtoH, UCVTF_ZPmZ_...
11238 14 : printSVERegOp<'d'>(MI, 3, STI, O);
11239 14 : break;
11240 48 : case 52:
11241 : // FMLAL2_2S, FMLALI2_2s, FMLALI_2s, FMLAL_2S, FMLSL2_2S, FMLSLI2_2s, FML...
11242 48 : O << ".2h, ";
11243 48 : break;
11244 6 : case 53:
11245 : // GLD1D_IMM_REAL, GLDFF1D_IMM_REAL, SST1D_IMM
11246 6 : printImmScale<8>(MI, 3, STI, O);
11247 : O << ']';
11248 : return;
11249 : break;
11250 20 : case 54:
11251 : // GLD1H_D_IMM_REAL, GLD1H_S_IMM_REAL, GLD1SH_D_IMM_REAL, GLD1SH_S_IMM_RE...
11252 20 : printImmScale<2>(MI, 3, STI, O);
11253 : O << ']';
11254 : return;
11255 : break;
11256 16 : case 55:
11257 : // GLD1SW_D_IMM_REAL, GLD1W_D_IMM_REAL, GLD1W_IMM_REAL, GLDFF1SW_D_IMM_RE...
11258 16 : printImmScale<4>(MI, 3, STI, O);
11259 : O << ']';
11260 : return;
11261 : break;
11262 : case 56:
11263 : // LDAPRB, LDAPRH, LDAPRW, LDAPRX, LDARB, LDARH, LDARW, LDARX, LDAXRB, LD...
11264 : O << ']';
11265 : return;
11266 : break;
11267 37 : case 57:
11268 : // LDGV, ST2GPreIndex, STGPreIndex, STGV, STZ2GPreIndex, STZGPreIndex
11269 37 : O << "]!";
11270 37 : return;
11271 : break;
11272 844 : case 58:
11273 : // LDRBBpost, LDRBpost, LDRDpost, LDRHHpost, LDRHpost, LDRQpost, LDRSBWpo...
11274 844 : O << "], ";
11275 844 : printOperand(MI, 3, STI, O);
11276 844 : return;
11277 : break;
11278 265 : case 59:
11279 : // MOVIv2i32, MOVIv2s_msl, MOVIv4i16, MOVIv4i32, MOVIv4s_msl, MOVIv8i16, ...
11280 265 : printShifter(MI, 2, STI, O);
11281 265 : return;
11282 : break;
11283 2 : case 60:
11284 : // PRFB_D_SCALED
11285 2 : printRegWithShiftExtend<false, 8, 'x', 'd'>(MI, 3, STI, O);
11286 : O << ']';
11287 : return;
11288 : break;
11289 2 : case 61:
11290 : // PRFB_D_SXTW_SCALED
11291 2 : printRegWithShiftExtend<true, 8, 'w', 'd'>(MI, 3, STI, O);
11292 : O << ']';
11293 : return;
11294 : break;
11295 2 : case 62:
11296 : // PRFB_D_UXTW_SCALED
11297 2 : printRegWithShiftExtend<false, 8, 'w', 'd'>(MI, 3, STI, O);
11298 : O << ']';
11299 : return;
11300 : break;
11301 : case 63:
11302 : // PRFB_PRR
11303 : printRegWithShiftExtend<false, 8, 'x', 0>(MI, 3, STI, O);
11304 : O << ']';
11305 : return;
11306 : break;
11307 0 : case 64:
11308 : // PRFB_S_SXTW_SCALED
11309 0 : printRegWithShiftExtend<true, 8, 'w', 's'>(MI, 3, STI, O);
11310 : O << ']';
11311 : return;
11312 : break;
11313 4 : case 65:
11314 : // PRFB_S_UXTW_SCALED
11315 4 : printRegWithShiftExtend<false, 8, 'w', 's'>(MI, 3, STI, O);
11316 : O << ']';
11317 : return;
11318 : break;
11319 2 : case 66:
11320 : // PRFD_D_SCALED
11321 2 : printRegWithShiftExtend<false, 64, 'x', 'd'>(MI, 3, STI, O);
11322 : O << ']';
11323 : return;
11324 : break;
11325 2 : case 67:
11326 : // PRFD_D_SXTW_SCALED
11327 2 : printRegWithShiftExtend<true, 64, 'w', 'd'>(MI, 3, STI, O);
11328 : O << ']';
11329 : return;
11330 : break;
11331 2 : case 68:
11332 : // PRFD_D_UXTW_SCALED
11333 2 : printRegWithShiftExtend<false, 64, 'w', 'd'>(MI, 3, STI, O);
11334 : O << ']';
11335 : return;
11336 : break;
11337 0 : case 69:
11338 : // PRFD_PRR
11339 0 : printRegWithShiftExtend<false, 64, 'x', 0>(MI, 3, STI, O);
11340 : O << ']';
11341 : return;
11342 : break;
11343 2 : case 70:
11344 : // PRFD_S_SXTW_SCALED
11345 2 : printRegWithShiftExtend<true, 64, 'w', 's'>(MI, 3, STI, O);
11346 : O << ']';
11347 : return;
11348 : break;
11349 2 : case 71:
11350 : // PRFD_S_UXTW_SCALED
11351 2 : printRegWithShiftExtend<false, 64, 'w', 's'>(MI, 3, STI, O);
11352 : O << ']';
11353 : return;
11354 : break;
11355 2 : case 72:
11356 : // PRFH_D_SCALED
11357 2 : printRegWithShiftExtend<false, 16, 'x', 'd'>(MI, 3, STI, O);
11358 : O << ']';
11359 : return;
11360 : break;
11361 2 : case 73:
11362 : // PRFH_D_SXTW_SCALED
11363 2 : printRegWithShiftExtend<true, 16, 'w', 'd'>(MI, 3, STI, O);
11364 : O << ']';
11365 : return;
11366 : break;
11367 2 : case 74:
11368 : // PRFH_D_UXTW_SCALED
11369 2 : printRegWithShiftExtend<false, 16, 'w', 'd'>(MI, 3, STI, O);
11370 : O << ']';
11371 : return;
11372 : break;
11373 0 : case 75:
11374 : // PRFH_PRR
11375 0 : printRegWithShiftExtend<false, 16, 'x', 0>(MI, 3, STI, O);
11376 : O << ']';
11377 : return;
11378 : break;
11379 2 : case 76:
11380 : // PRFH_S_SXTW_SCALED
11381 2 : printRegWithShiftExtend<true, 16, 'w', 's'>(MI, 3, STI, O);
11382 : O << ']';
11383 : return;
11384 : break;
11385 2 : case 77:
11386 : // PRFH_S_UXTW_SCALED
11387 2 : printRegWithShiftExtend<false, 16, 'w', 's'>(MI, 3, STI, O);
11388 : O << ']';
11389 : return;
11390 : break;
11391 0 : case 78:
11392 : // PRFS_PRR
11393 0 : printRegWithShiftExtend<false, 32, 'x', 0>(MI, 3, STI, O);
11394 : O << ']';
11395 : return;
11396 : break;
11397 2 : case 79:
11398 : // PRFW_D_SCALED
11399 2 : printRegWithShiftExtend<false, 32, 'x', 'd'>(MI, 3, STI, O);
11400 : O << ']';
11401 : return;
11402 : break;
11403 2 : case 80:
11404 : // PRFW_D_SXTW_SCALED
11405 2 : printRegWithShiftExtend<true, 32, 'w', 'd'>(MI, 3, STI, O);
11406 : O << ']';
11407 : return;
11408 : break;
11409 2 : case 81:
11410 : // PRFW_D_UXTW_SCALED
11411 2 : printRegWithShiftExtend<false, 32, 'w', 'd'>(MI, 3, STI, O);
11412 : O << ']';
11413 : return;
11414 : break;
11415 2 : case 82:
11416 : // PRFW_S_SXTW_SCALED
11417 2 : printRegWithShiftExtend<true, 32, 'w', 's'>(MI, 3, STI, O);
11418 : O << ']';
11419 : return;
11420 : break;
11421 2 : case 83:
11422 : // PRFW_S_UXTW_SCALED
11423 2 : printRegWithShiftExtend<false, 32, 'w', 's'>(MI, 3, STI, O);
11424 : O << ']';
11425 : return;
11426 : break;
11427 8 : case 84:
11428 : // RDFFRS_PPz, RDFFR_PPz
11429 8 : O << "/z";
11430 8 : return;
11431 : break;
11432 12 : case 85:
11433 : // SDOT_ZZZI_D, SDOT_ZZZI_S, UDOT_ZZZI_D, UDOT_ZZZI_S
11434 12 : printVectorIndex(MI, 4, STI, O);
11435 12 : return;
11436 : break;
11437 3 : case 86:
11438 : // SHLLv16i8
11439 3 : O << ".16b, #8";
11440 3 : return;
11441 : break;
11442 4 : case 87:
11443 : // SHLLv2i32
11444 4 : O << ".2s, #32";
11445 4 : return;
11446 : break;
11447 4 : case 88:
11448 : // SHLLv4i16
11449 4 : O << ".4h, #16";
11450 4 : return;
11451 : break;
11452 3 : case 89:
11453 : // SHLLv4i32
11454 3 : O << ".4s, #32";
11455 3 : return;
11456 : break;
11457 3 : case 90:
11458 : // SHLLv8i16
11459 3 : O << ".8h, #16";
11460 3 : return;
11461 : break;
11462 4 : case 91:
11463 : // SHLLv8i8
11464 4 : O << ".8b, #8";
11465 4 : return;
11466 : break;
11467 0 : case 92:
11468 : // UMAX_ZI_H, UMIN_ZI_H
11469 0 : printImm(MI, 2, STI, O);
11470 0 : return;
11471 : break;
11472 : }
11473 :
11474 :
11475 : // Fragment 4 encoded into 7 bits for 89 unique commands.
11476 33749 : switch ((Bits >> 38) & 127) {
11477 0 : default: llvm_unreachable("Invalid command number.");
11478 32 : case 0:
11479 : // ABS_ZPmZ_B, BRKA_PPmP, BRKB_PPmP, CLS_ZPmZ_B, CLZ_ZPmZ_B, CNOT_ZPmZ_B,...
11480 32 : printSVERegOp<'b'>(MI, 3, STI, O);
11481 32 : break;
11482 308 : case 1:
11483 : // ABS_ZPmZ_D, CLS_ZPmZ_D, CLZ_ZPmZ_D, CNOT_ZPmZ_D, CNT_ZPmZ_D, FABS_ZPmZ...
11484 308 : printSVERegOp<'d'>(MI, 3, STI, O);
11485 308 : break;
11486 : case 2:
11487 : // ABS_ZPmZ_H, ADD_ZZZ_H, CLS_ZPmZ_H, CLZ_ZPmZ_H, CNOT_ZPmZ_H, CNT_ZPmZ_H...
11488 : return;
11489 : break;
11490 119 : case 3:
11491 : // ABS_ZPmZ_S, CLS_ZPmZ_S, CLZ_ZPmZ_S, CNOT_ZPmZ_S, CNT_ZPmZ_S, FABS_ZPmZ...
11492 119 : printSVERegOp<'s'>(MI, 3, STI, O);
11493 119 : break;
11494 7355 : case 4:
11495 : // ADCSWr, ADCSXr, ADCWr, ADCXr, ADDPL_XXI, ADDSXrx64, ADDVL_XXI, ADDXrx6...
11496 7355 : printOperand(MI, 2, STI, O);
11497 7355 : break;
11498 24 : case 5:
11499 : // ADDG, LDG, SUBG
11500 24 : printImmScale<16>(MI, 2, STI, O);
11501 24 : break;
11502 5138 : case 6:
11503 : // ADDHNv2i64_v2i32, ADDHNv4i32_v4i16, ADDHNv8i16_v8i8, ADDPv16i8, ADDPv2...
11504 5138 : printVRegOperand(MI, 2, STI, O);
11505 5138 : break;
11506 1497 : case 7:
11507 : // ADDHNv2i64_v4i32, ADDHNv4i32_v8i16, ADDHNv8i16_v16i8, BITv16i8, BITv8i...
11508 1497 : printVRegOperand(MI, 3, STI, O);
11509 1497 : break;
11510 4015 : case 8:
11511 : // ADDSWri, ADDSXri, ADDWri, ADDXri, SUBSWri, SUBSXri, SUBWri, SUBXri
11512 4015 : printAddSubImm(MI, 2, STI, O);
11513 4015 : return;
11514 : break;
11515 675 : case 9:
11516 : // ADDSWrs, ADDSXrs, ADDWrs, ADDXrs, ANDSWrs, ANDSXrs, ANDWrs, ANDXrs, BI...
11517 675 : printShiftedRegister(MI, 2, STI, O);
11518 675 : return;
11519 : break;
11520 272 : case 10:
11521 : // ADDSWrx, ADDSXrx, ADDWrx, ADDXrx, SUBSWrx, SUBSXrx, SUBWrx, SUBXrx
11522 272 : printExtendedRegister(MI, 2, STI, O);
11523 272 : return;
11524 : break;
11525 28 : case 11:
11526 : // ADD_ZI_B, SQADD_ZI_B, SQSUB_ZI_B, SUBR_ZI_B, SUB_ZI_B, UQADD_ZI_B, UQS...
11527 28 : printImm8OptLsl<uint8_t>(MI, 2, STI, O);
11528 28 : return;
11529 : break;
11530 70 : case 12:
11531 : // ADD_ZI_D, SQADD_ZI_D, SQSUB_ZI_D, SUBR_ZI_D, SUB_ZI_D, UQADD_ZI_D, UQS...
11532 70 : printImm8OptLsl<uint64_t>(MI, 2, STI, O);
11533 70 : return;
11534 : break;
11535 56 : case 13:
11536 : // ADD_ZI_S, SQADD_ZI_S, SQSUB_ZI_S, SUBR_ZI_S, SUB_ZI_S, UQADD_ZI_S, UQS...
11537 56 : printImm8OptLsl<uint32_t>(MI, 2, STI, O);
11538 56 : return;
11539 : break;
11540 373 : case 14:
11541 : // ADD_ZPmZ_B, ADD_ZZZ_B, ANDS_PPzPP, ANDV_VPZ_B, AND_PPzPP, AND_ZPmZ_B, ...
11542 373 : printSVERegOp<'b'>(MI, 2, STI, O);
11543 373 : break;
11544 983 : case 15:
11545 : // ADD_ZPmZ_D, ADD_ZZZ_D, ANDV_VPZ_D, AND_ZPmZ_D, AND_ZZZ, ASRD_ZPmI_D, A...
11546 983 : printSVERegOp<'d'>(MI, 2, STI, O);
11547 983 : break;
11548 312 : case 16:
11549 : // ADD_ZPmZ_H, AND_ZPmZ_H, ASRD_ZPmI_H, ASRR_ZPmZ_H, ASR_WIDE_ZPmZ_H, ASR...
11550 312 : O << ", ";
11551 312 : break;
11552 448 : case 17:
11553 : // ADD_ZPmZ_S, ADD_ZZZ_S, ANDV_VPZ_S, AND_ZPmZ_S, ASRD_ZPmI_S, ASRR_ZPmZ_...
11554 448 : printSVERegOp<'s'>(MI, 2, STI, O);
11555 448 : break;
11556 4 : case 18:
11557 : // ADR_LSL_ZZZ_D_0
11558 4 : printRegWithShiftExtend<false, 8, 'x', 'd'>(MI, 2, STI, O);
11559 : O << ']';
11560 : return;
11561 : break;
11562 2 : case 19:
11563 : // ADR_LSL_ZZZ_D_1
11564 2 : printRegWithShiftExtend<false, 16, 'x', 'd'>(MI, 2, STI, O);
11565 : O << ']';
11566 : return;
11567 : break;
11568 2 : case 20:
11569 : // ADR_LSL_ZZZ_D_2
11570 2 : printRegWithShiftExtend<false, 32, 'x', 'd'>(MI, 2, STI, O);
11571 : O << ']';
11572 : return;
11573 : break;
11574 2 : case 21:
11575 : // ADR_LSL_ZZZ_D_3
11576 2 : printRegWithShiftExtend<false, 64, 'x', 'd'>(MI, 2, STI, O);
11577 : O << ']';
11578 : return;
11579 : break;
11580 4 : case 22:
11581 : // ADR_LSL_ZZZ_S_0
11582 4 : printRegWithShiftExtend<false, 8, 'x', 's'>(MI, 2, STI, O);
11583 : O << ']';
11584 : return;
11585 : break;
11586 2 : case 23:
11587 : // ADR_LSL_ZZZ_S_1
11588 2 : printRegWithShiftExtend<false, 16, 'x', 's'>(MI, 2, STI, O);
11589 : O << ']';
11590 : return;
11591 : break;
11592 2 : case 24:
11593 : // ADR_LSL_ZZZ_S_2
11594 2 : printRegWithShiftExtend<false, 32, 'x', 's'>(MI, 2, STI, O);
11595 : O << ']';
11596 : return;
11597 : break;
11598 2 : case 25:
11599 : // ADR_LSL_ZZZ_S_3
11600 2 : printRegWithShiftExtend<false, 64, 'x', 's'>(MI, 2, STI, O);
11601 : O << ']';
11602 : return;
11603 : break;
11604 4 : case 26:
11605 : // ADR_SXTW_ZZZ_D_0
11606 4 : printRegWithShiftExtend<true, 8, 'w', 'd'>(MI, 2, STI, O);
11607 : O << ']';
11608 : return;
11609 : break;
11610 2 : case 27:
11611 : // ADR_SXTW_ZZZ_D_1
11612 2 : printRegWithShiftExtend<true, 16, 'w', 'd'>(MI, 2, STI, O);
11613 : O << ']';
11614 : return;
11615 : break;
11616 2 : case 28:
11617 : // ADR_SXTW_ZZZ_D_2
11618 2 : printRegWithShiftExtend<true, 32, 'w', 'd'>(MI, 2, STI, O);
11619 : O << ']';
11620 : return;
11621 : break;
11622 2 : case 29:
11623 : // ADR_SXTW_ZZZ_D_3
11624 2 : printRegWithShiftExtend<true, 64, 'w', 'd'>(MI, 2, STI, O);
11625 : O << ']';
11626 : return;
11627 : break;
11628 4 : case 30:
11629 : // ADR_UXTW_ZZZ_D_0
11630 4 : printRegWithShiftExtend<false, 8, 'w', 'd'>(MI, 2, STI, O);
11631 : O << ']';
11632 : return;
11633 : break;
11634 2 : case 31:
11635 : // ADR_UXTW_ZZZ_D_1
11636 2 : printRegWithShiftExtend<false, 16, 'w', 'd'>(MI, 2, STI, O);
11637 : O << ']';
11638 : return;
11639 : break;
11640 2 : case 32:
11641 : // ADR_UXTW_ZZZ_D_2
11642 2 : printRegWithShiftExtend<false, 32, 'w', 'd'>(MI, 2, STI, O);
11643 : O << ']';
11644 : return;
11645 : break;
11646 2 : case 33:
11647 : // ADR_UXTW_ZZZ_D_3
11648 2 : printRegWithShiftExtend<false, 64, 'w', 'd'>(MI, 2, STI, O);
11649 : O << ']';
11650 : return;
11651 : break;
11652 759 : case 34:
11653 : // ANDSWri, ANDWri, EORWri, ORRWri
11654 759 : printLogicalImm<int32_t>(MI, 2, STI, O);
11655 759 : return;
11656 : break;
11657 237 : case 35:
11658 : // ANDSXri, ANDXri, AND_ZI, EORXri, EOR_ZI, ORRXri, ORR_ZI
11659 237 : printLogicalImm<int64_t>(MI, 2, STI, O);
11660 237 : return;
11661 : break;
11662 38 : case 36:
11663 : // ANDV_VPZ_H, CNTP_XPP_H, EORV_VPZ_H, FADDV_VPZ_H, FMAXNMV_VPZ_H, FMAXV_...
11664 38 : printSVERegOp<'h'>(MI, 2, STI, O);
11665 38 : return;
11666 : break;
11667 2312 : case 37:
11668 : // BFMWri, BFMXri, CASAB, CASAH, CASALB, CASALH, CASALW, CASALX, CASAW, C...
11669 2312 : printOperand(MI, 3, STI, O);
11670 2312 : break;
11671 0 : case 38:
11672 : // CPY_ZPmI_B
11673 0 : printImm8OptLsl<int8_t>(MI, 3, STI, O);
11674 0 : return;
11675 : break;
11676 0 : case 39:
11677 : // CPY_ZPmI_D
11678 0 : printImm8OptLsl<int64_t>(MI, 3, STI, O);
11679 0 : return;
11680 : break;
11681 0 : case 40:
11682 : // CPY_ZPmI_S
11683 0 : printImm8OptLsl<int32_t>(MI, 3, STI, O);
11684 0 : return;
11685 : break;
11686 0 : case 41:
11687 : // CPY_ZPzI_B
11688 0 : printImm8OptLsl<int8_t>(MI, 2, STI, O);
11689 0 : return;
11690 : break;
11691 0 : case 42:
11692 : // CPY_ZPzI_D
11693 0 : printImm8OptLsl<int64_t>(MI, 2, STI, O);
11694 0 : return;
11695 : break;
11696 0 : case 43:
11697 : // CPY_ZPzI_S
11698 0 : printImm8OptLsl<int32_t>(MI, 2, STI, O);
11699 0 : return;
11700 : break;
11701 1246 : case 44:
11702 : // CPYi16, CPYi32, CPYi64, CPYi8, DUPv16i8lane, DUPv2i32lane, DUPv2i64lan...
11703 1246 : printVectorIndex(MI, 2, STI, O);
11704 1246 : return;
11705 : break;
11706 12 : case 45:
11707 : // FCMEQ_PPzZ0_H, FCMGE_PPzZ0_H, FCMGT_PPzZ0_H, FCMLE_PPzZ0_H, FCMLT_PPzZ...
11708 12 : O << ", #0.0";
11709 12 : return;
11710 : break;
11711 18 : case 46:
11712 : // FCMLA_ZZZI_S, FMLA_ZZZI_D, FMLA_ZZZI_S, FMLS_ZZZI_D, FMLS_ZZZI_S, INSv...
11713 18 : printVectorIndex(MI, 4, STI, O);
11714 18 : break;
11715 0 : case 47:
11716 : // FCPY_ZPmI_D, FCPY_ZPmI_S
11717 0 : printFPImmOperand(MI, 3, STI, O);
11718 0 : return;
11719 : break;
11720 12 : case 48:
11721 : // FCVTZS_ZPmZ_HtoD, FCVTZS_ZPmZ_HtoS, FCVTZU_ZPmZ_HtoD, FCVTZU_ZPmZ_HtoS...
11722 12 : printSVERegOp<'h'>(MI, 3, STI, O);
11723 12 : return;
11724 : break;
11725 4 : case 49:
11726 : // FMUL_ZZZI_H
11727 4 : printVectorIndex(MI, 3, STI, O);
11728 4 : return;
11729 : break;
11730 : case 50:
11731 : // GLD1B_D_IMM_REAL, GLD1B_S_IMM_REAL, GLD1SB_D_IMM_REAL, GLD1SB_S_IMM_RE...
11732 : O << ']';
11733 : return;
11734 : break;
11735 36 : case 51:
11736 : // GLD1B_D_REAL, GLD1D_REAL, GLD1H_D_REAL, GLD1SB_D_REAL, GLD1SH_D_REAL, ...
11737 36 : printRegWithShiftExtend<false, 8, 'x', 'd'>(MI, 3, STI, O);
11738 : O << ']';
11739 : return;
11740 : break;
11741 36 : case 52:
11742 : // GLD1B_D_SXTW_REAL, GLD1D_SXTW_REAL, GLD1H_D_SXTW_REAL, GLD1SB_D_SXTW_R...
11743 36 : printRegWithShiftExtend<true, 8, 'w', 'd'>(MI, 3, STI, O);
11744 : O << ']';
11745 : return;
11746 : break;
11747 36 : case 53:
11748 : // GLD1B_D_UXTW_REAL, GLD1D_UXTW_REAL, GLD1H_D_UXTW_REAL, GLD1SB_D_UXTW_R...
11749 36 : printRegWithShiftExtend<false, 8, 'w', 'd'>(MI, 3, STI, O);
11750 : O << ']';
11751 : return;
11752 : break;
11753 26 : case 54:
11754 : // GLD1B_S_SXTW_REAL, GLD1H_S_SXTW_REAL, GLD1SB_S_SXTW_REAL, GLD1SH_S_SXT...
11755 26 : printRegWithShiftExtend<true, 8, 'w', 's'>(MI, 3, STI, O);
11756 : O << ']';
11757 : return;
11758 : break;
11759 26 : case 55:
11760 : // GLD1B_S_UXTW_REAL, GLD1H_S_UXTW_REAL, GLD1SB_S_UXTW_REAL, GLD1SH_S_UXT...
11761 26 : printRegWithShiftExtend<false, 8, 'w', 's'>(MI, 3, STI, O);
11762 : O << ']';
11763 : return;
11764 : break;
11765 6 : case 56:
11766 : // GLD1D_SCALED_REAL, GLDFF1D_SCALED_REAL, SST1D_SCALED
11767 6 : printRegWithShiftExtend<false, 64, 'x', 'd'>(MI, 3, STI, O);
11768 : O << ']';
11769 : return;
11770 : break;
11771 6 : case 57:
11772 : // GLD1D_SXTW_SCALED_REAL, GLDFF1D_SXTW_SCALED_REAL, SST1D_SXTW_SCALED
11773 6 : printRegWithShiftExtend<true, 64, 'w', 'd'>(MI, 3, STI, O);
11774 : O << ']';
11775 : return;
11776 : break;
11777 6 : case 58:
11778 : // GLD1D_UXTW_SCALED_REAL, GLDFF1D_UXTW_SCALED_REAL, SST1D_UXTW_SCALED
11779 6 : printRegWithShiftExtend<false, 64, 'w', 'd'>(MI, 3, STI, O);
11780 : O << ']';
11781 : return;
11782 : break;
11783 10 : case 59:
11784 : // GLD1H_D_SCALED_REAL, GLD1SH_D_SCALED_REAL, GLDFF1H_D_SCALED_REAL, GLDF...
11785 10 : printRegWithShiftExtend<false, 16, 'x', 'd'>(MI, 3, STI, O);
11786 : O << ']';
11787 : return;
11788 : break;
11789 10 : case 60:
11790 : // GLD1H_D_SXTW_SCALED_REAL, GLD1SH_D_SXTW_SCALED_REAL, GLDFF1H_D_SXTW_SC...
11791 10 : printRegWithShiftExtend<true, 16, 'w', 'd'>(MI, 3, STI, O);
11792 : O << ']';
11793 : return;
11794 : break;
11795 10 : case 61:
11796 : // GLD1H_D_UXTW_SCALED_REAL, GLD1SH_D_UXTW_SCALED_REAL, GLDFF1H_D_UXTW_SC...
11797 10 : printRegWithShiftExtend<false, 16, 'w', 'd'>(MI, 3, STI, O);
11798 : O << ']';
11799 : return;
11800 : break;
11801 10 : case 62:
11802 : // GLD1H_S_SXTW_SCALED_REAL, GLD1SH_S_SXTW_SCALED_REAL, GLDFF1H_S_SXTW_SC...
11803 10 : printRegWithShiftExtend<true, 16, 'w', 's'>(MI, 3, STI, O);
11804 : O << ']';
11805 : return;
11806 : break;
11807 10 : case 63:
11808 : // GLD1H_S_UXTW_SCALED_REAL, GLD1SH_S_UXTW_SCALED_REAL, GLDFF1H_S_UXTW_SC...
11809 10 : printRegWithShiftExtend<false, 16, 'w', 's'>(MI, 3, STI, O);
11810 : O << ']';
11811 : return;
11812 : break;
11813 10 : case 64:
11814 : // GLD1SW_D_SCALED_REAL, GLD1W_D_SCALED_REAL, GLDFF1SW_D_SCALED_REAL, GLD...
11815 10 : printRegWithShiftExtend<false, 32, 'x', 'd'>(MI, 3, STI, O);
11816 : O << ']';
11817 : return;
11818 : break;
11819 10 : case 65:
11820 : // GLD1SW_D_SXTW_SCALED_REAL, GLD1W_D_SXTW_SCALED_REAL, GLDFF1SW_D_SXTW_S...
11821 10 : printRegWithShiftExtend<true, 32, 'w', 'd'>(MI, 3, STI, O);
11822 : O << ']';
11823 : return;
11824 : break;
11825 10 : case 66:
11826 : // GLD1SW_D_UXTW_SCALED_REAL, GLD1W_D_UXTW_SCALED_REAL, GLDFF1SW_D_UXTW_S...
11827 10 : printRegWithShiftExtend<false, 32, 'w', 'd'>(MI, 3, STI, O);
11828 : O << ']';
11829 : return;
11830 : break;
11831 6 : case 67:
11832 : // GLD1W_SXTW_SCALED_REAL, GLDFF1W_SXTW_SCALED_REAL, SST1W_SXTW_SCALED
11833 6 : printRegWithShiftExtend<true, 32, 'w', 's'>(MI, 3, STI, O);
11834 : O << ']';
11835 : return;
11836 : break;
11837 6 : case 68:
11838 : // GLD1W_UXTW_SCALED_REAL, GLDFF1W_UXTW_SCALED_REAL, SST1W_UXTW_SCALED
11839 6 : printRegWithShiftExtend<false, 32, 'w', 's'>(MI, 3, STI, O);
11840 : O << ']';
11841 : return;
11842 : break;
11843 : case 69:
11844 : // LD1B, LD1B_D, LD1B_H, LD1B_S, LD1RQ_B, LD1SB_D, LD1SB_H, LD1SB_S, LD2B...
11845 : printRegWithShiftExtend<false, 8, 'x', 0>(MI, 3, STI, O);
11846 : O << ']';
11847 : return;
11848 : break;
11849 38 : case 70:
11850 : // LD1D, LD1RQ_D, LD2D, LD3D, LD4D, LDFF1D_REAL, LDNT1D_ZRR, ST1D, ST2D, ...
11851 38 : printRegWithShiftExtend<false, 64, 'x', 0>(MI, 3, STI, O);
11852 : O << ']';
11853 : return;
11854 : break;
11855 60 : case 71:
11856 : // LD1H, LD1H_D, LD1H_S, LD1RQ_H, LD1SH_D, LD1SH_S, LD2H, LD3H, LD4H, LDF...
11857 60 : printRegWithShiftExtend<false, 16, 'x', 0>(MI, 3, STI, O);
11858 : O << ']';
11859 : return;
11860 : break;
11861 10 : case 72:
11862 : // LD1RD_IMM, LDRAAwriteback, LDRABwriteback
11863 10 : printImmScale<8>(MI, 3, STI, O);
11864 10 : break;
11865 42 : case 73:
11866 : // LD1RH_D_IMM, LD1RH_IMM, LD1RH_S_IMM, LD1RSH_D_IMM, LD1RSH_S_IMM, LD2B_...
11867 42 : printImmScale<2>(MI, 3, STI, O);
11868 42 : break;
11869 24 : case 74:
11870 : // LD1RQ_B_IMM, LD1RQ_D_IMM, LD1RQ_H_IMM, LD1RQ_W_IMM
11871 24 : printImmScale<16>(MI, 3, STI, O);
11872 : O << ']';
11873 : return;
11874 : break;
11875 50 : case 75:
11876 : // LD1RQ_W, LD1SW_D, LD1W, LD1W_D, LD2W, LD3W, LD4W, LDFF1SW_D_REAL, LDFF...
11877 50 : printRegWithShiftExtend<false, 32, 'x', 0>(MI, 3, STI, O);
11878 : O << ']';
11879 : return;
11880 : break;
11881 38 : case 76:
11882 : // LD1RSW_IMM, LD1RW_D_IMM, LD1RW_IMM, LD4B_IMM, LD4D_IMM, LD4H_IMM, LD4W...
11883 38 : printImmScale<4>(MI, 3, STI, O);
11884 38 : break;
11885 32 : case 77:
11886 : // LD3B_IMM, LD3D_IMM, LD3H_IMM, LD3W_IMM, ST3B_IMM, ST3D_IMM, ST3H_IMM, ...
11887 32 : printImmScale<3>(MI, 3, STI, O);
11888 32 : O << ", mul vl]";
11889 32 : return;
11890 : break;
11891 8 : case 78:
11892 : // LDRAAindexed, LDRABindexed
11893 8 : printImmScale<8>(MI, 2, STI, O);
11894 : O << ']';
11895 : return;
11896 : break;
11897 : case 79:
11898 : // LDRBBui, LDRBui, LDRSBWui, LDRSBXui, STRBBui, STRBui
11899 : printUImm12Offset<1>(MI, 2, STI, O);
11900 : O << ']';
11901 : return;
11902 : break;
11903 : case 80:
11904 : // LDRDui, LDRXui, PRFMui, STRDui, STRXui
11905 : printUImm12Offset<8>(MI, 2, STI, O);
11906 : O << ']';
11907 : return;
11908 : break;
11909 : case 81:
11910 : // LDRHHui, LDRHui, LDRSHWui, LDRSHXui, STRHHui, STRHui
11911 : printUImm12Offset<2>(MI, 2, STI, O);
11912 : O << ']';
11913 : return;
11914 : break;
11915 : case 82:
11916 : // LDRQui, STRQui
11917 : printUImm12Offset<16>(MI, 2, STI, O);
11918 : O << ']';
11919 : return;
11920 : break;
11921 : case 83:
11922 : // LDRSWui, LDRSui, LDRWui, STRSui, STRWui
11923 : printUImm12Offset<4>(MI, 2, STI, O);
11924 : O << ']';
11925 : return;
11926 : break;
11927 16 : case 84:
11928 : // PRFB_PRI, PRFD_PRI, PRFH_PRI, PRFW_PRI
11929 16 : O << ", mul vl]";
11930 16 : return;
11931 : break;
11932 16 : case 85:
11933 : // SQDECP_XPWd_B, SQDECP_XPWd_D, SQDECP_XPWd_H, SQDECP_XPWd_S, SQINCP_XPW...
11934 16 : printGPR64as32(MI, 2, STI, O);
11935 16 : return;
11936 : break;
11937 13 : case 86:
11938 : // SYSLxt
11939 13 : printSysCROperand(MI, 2, STI, O);
11940 13 : O << ", ";
11941 13 : printSysCROperand(MI, 3, STI, O);
11942 13 : O << ", ";
11943 13 : printOperand(MI, 4, STI, O);
11944 13 : return;
11945 : break;
11946 139 : case 87:
11947 : // TBNZW, TBNZX, TBZW, TBZX
11948 139 : printAlignedLabel(MI, 2, STI, O);
11949 139 : return;
11950 : break;
11951 36 : case 88:
11952 : // UMAX_ZI_B, UMAX_ZI_D, UMAX_ZI_S, UMIN_ZI_B, UMIN_ZI_D, UMIN_ZI_S
11953 36 : printImm(MI, 2, STI, O);
11954 36 : return;
11955 : break;
11956 : }
11957 :
11958 :
11959 : // Fragment 5 encoded into 6 bits for 37 unique commands.
11960 19009 : switch ((Bits >> 45) & 63) {
11961 0 : default: llvm_unreachable("Invalid command number.");
11962 : case 0:
11963 : // ABS_ZPmZ_B, ABS_ZPmZ_D, ABS_ZPmZ_S, ADCSWr, ADCSXr, ADCWr, ADCXr, ADDP...
11964 : return;
11965 : break;
11966 4943 : case 1:
11967 : // ADDG, ADD_ZPmZ_B, ADD_ZPmZ_D, ADD_ZPmZ_S, ANDS_PPzPP, AND_PPzPP, AND_Z...
11968 4943 : O << ", ";
11969 4943 : break;
11970 521 : case 2:
11971 : // ADDHNv2i64_v2i32, ADDHNv2i64_v4i32, ADDPv2i64, ADDv2i64, CMEQv2i64, CM...
11972 521 : O << ".2d";
11973 521 : return;
11974 : break;
11975 1304 : case 3:
11976 : // ADDHNv4i32_v4i16, ADDHNv4i32_v8i16, ADDPv4i32, ADDv4i32, CMEQv4i32, CM...
11977 1304 : O << ".4s";
11978 1304 : return;
11979 : break;
11980 533 : case 4:
11981 : // ADDHNv8i16_v16i8, ADDHNv8i16_v8i8, ADDPv8i16, ADDv8i16, CMEQv8i16, CMG...
11982 533 : O << ".8h";
11983 533 : return;
11984 : break;
11985 664 : case 5:
11986 : // ADDPv16i8, ADDv16i8, ANDv16i8, BICv16i8, BIFv16i8, BITv16i8, BSLv16i8,...
11987 664 : O << ".16b";
11988 664 : return;
11989 : break;
11990 621 : case 6:
11991 : // ADDPv2i32, ADDv2i32, CMEQv2i32, CMGEv2i32, CMGTv2i32, CMHIv2i32, CMHSv...
11992 621 : O << ".2s";
11993 621 : return;
11994 : break;
11995 496 : case 7:
11996 : // ADDPv4i16, ADDv4i16, CMEQv4i16, CMGEv4i16, CMGTv4i16, CMHIv4i16, CMHSv...
11997 496 : O << ".4h";
11998 496 : return;
11999 : break;
12000 548 : case 8:
12001 : // ADDPv8i8, ADDv8i8, ANDv8i8, BICv8i8, BIFv8i8, BITv8i8, BSLv8i8, CMEQv8...
12002 548 : O << ".8b";
12003 548 : return;
12004 : break;
12005 16 : case 9:
12006 : // ADDSXrx64, ADDXrx64, SUBSXrx64, SUBXrx64
12007 16 : printArithExtend(MI, 3, STI, O);
12008 16 : return;
12009 : break;
12010 136 : case 10:
12011 : // ADD_ZPmZ_H, AND_ZPmZ_H, ASRR_ZPmZ_H, ASR_ZPmZ_H, BIC_ZPmZ_H, CLASTA_ZP...
12012 136 : printSVERegOp<'h'>(MI, 3, STI, O);
12013 136 : break;
12014 42 : case 11:
12015 : // ASRD_ZPmI_H, ASR_ZPmI_H, CMPEQ_PPzZI_H, CMPGE_PPzZI_H, CMPGT_PPzZI_H, ...
12016 42 : printOperand(MI, 3, STI, O);
12017 42 : return;
12018 : break;
12019 26 : case 12:
12020 : // ASR_WIDE_ZPmZ_H, CMPEQ_WIDE_PPzZZ_H, CMPGE_WIDE_PPzZZ_H, CMPGT_WIDE_PP...
12021 26 : printSVERegOp<'d'>(MI, 3, STI, O);
12022 26 : return;
12023 : break;
12024 435 : case 13:
12025 : // BCAX, EOR3, EXTv16i8
12026 435 : O << ".16b, ";
12027 435 : break;
12028 : case 14:
12029 : // CASAB, CASAH, CASALB, CASALH, CASALW, CASALX, CASAW, CASAX, CASB, CASH...
12030 : O << ']';
12031 : return;
12032 : break;
12033 16 : case 15:
12034 : // CMPHI_PPzZI_H, CMPHS_PPzZI_H, CMPLO_PPzZI_H, CMPLS_PPzZI_H
12035 16 : printImm(MI, 3, STI, O);
12036 16 : return;
12037 : break;
12038 41 : case 16:
12039 : // EXTv8i8
12040 41 : O << ".8b, ";
12041 41 : printOperand(MI, 3, STI, O);
12042 41 : return;
12043 : break;
12044 24 : case 17:
12045 : // FADD_ZPmI_H, FSUBR_ZPmI_H, FSUB_ZPmI_H
12046 24 : printExactFPImm<AArch64ExactFPImm::half, AArch64ExactFPImm::one>(MI, 3, STI, O);
12047 24 : return;
12048 : break;
12049 32 : case 18:
12050 : // FCADDv2f32, FCMLAv2f32
12051 32 : O << ".2s, ";
12052 32 : break;
12053 10 : case 19:
12054 : // FCADDv2f64, FCMLAv2f64, XAR
12055 10 : O << ".2d, ";
12056 10 : break;
12057 4 : case 20:
12058 : // FCADDv4f16, FCMLAv4f16
12059 4 : O << ".4h, ";
12060 4 : break;
12061 10 : case 21:
12062 : // FCADDv4f32, FCMLAv4f32, SM3SS1
12063 10 : O << ".4s, ";
12064 10 : break;
12065 4 : case 22:
12066 : // FCADDv8f16, FCMLAv8f16
12067 4 : O << ".8h, ";
12068 4 : break;
12069 24 : case 23:
12070 : // FCMEQ_PPzZ0_D, FCMEQ_PPzZ0_S, FCMGE_PPzZ0_D, FCMGE_PPzZ0_S, FCMGT_PPzZ...
12071 24 : O << ", #0.0";
12072 24 : return;
12073 : break;
12074 32 : case 24:
12075 : // FCMLA_ZPmZZ_H, FMAD_ZPmZZ_H, FMLA_ZPmZZ_H, FMLS_ZPmZZ_H, FMSB_ZPmZZ_H,...
12076 32 : printSVERegOp<'h'>(MI, 4, STI, O);
12077 32 : break;
12078 598 : case 25:
12079 : // FCMLAv4f16_indexed, FCMLAv8f16_indexed, FMLALI2_2s, FMLALI2_4s, FMLALI...
12080 598 : O << ".h";
12081 598 : break;
12082 676 : case 26:
12083 : // FCMLAv4f32_indexed, FMLAv1i32_indexed, FMLAv2i32_indexed, FMLAv4i32_in...
12084 676 : O << ".s";
12085 676 : break;
12086 30 : case 27:
12087 : // FMAXNM_ZPmI_H, FMAX_ZPmI_H, FMINNM_ZPmI_H, FMIN_ZPmI_H
12088 30 : printExactFPImm<AArch64ExactFPImm::zero, AArch64ExactFPImm::one>(MI, 3, STI, O);
12089 30 : return;
12090 : break;
12091 16 : case 28:
12092 : // FMLAL2_2S, FMLAL_2S, FMLSL2_2S, FMLSL_2S
12093 16 : O << ".2h";
12094 16 : return;
12095 : break;
12096 84 : case 29:
12097 : // FMLAv1i64_indexed, FMLAv2i64_indexed, FMLSv1i64_indexed, FMLSv2i64_ind...
12098 84 : O << ".d";
12099 84 : break;
12100 6 : case 30:
12101 : // FMUL_ZPmI_H
12102 6 : printExactFPImm<AArch64ExactFPImm::half, AArch64ExactFPImm::two>(MI, 3, STI, O);
12103 6 : return;
12104 : break;
12105 8 : case 31:
12106 : // FMUL_ZZZI_D, FMUL_ZZZI_S
12107 8 : printVectorIndex(MI, 3, STI, O);
12108 8 : return;
12109 : break;
12110 280 : case 32:
12111 : // LD1B_D_IMM_REAL, LD1B_H_IMM_REAL, LD1B_IMM_REAL, LD1B_S_IMM_REAL, LD1D...
12112 280 : O << ", mul vl]";
12113 280 : return;
12114 : break;
12115 374 : case 33:
12116 : // LDPDpost, LDPQpost, LDPSWpost, LDPSpost, LDPWpost, LDPXpost, STGPpost,...
12117 374 : O << "], ";
12118 374 : break;
12119 867 : case 34:
12120 : // LDRAAwriteback, LDRABwriteback, LDRBBpre, LDRBpre, LDRDpre, LDRHHpre, ...
12121 867 : O << "]!";
12122 867 : return;
12123 : break;
12124 38 : case 35:
12125 : // SDOTlanev16i8, SDOTlanev8i8, UDOTlanev16i8, UDOTlanev8i8
12126 38 : O << ".4b";
12127 38 : printVectorIndex(MI, 4, STI, O);
12128 38 : return;
12129 : break;
12130 47 : case 36:
12131 : // STLXPW, STLXPX, STXPW, STXPX
12132 47 : O << ", [";
12133 47 : printOperand(MI, 3, STI, O);
12134 : O << ']';
12135 : return;
12136 : break;
12137 : }
12138 :
12139 :
12140 : // Fragment 6 encoded into 6 bits for 38 unique commands.
12141 7338 : switch ((Bits >> 51) & 63) {
12142 0 : default: llvm_unreachable("Invalid command number.");
12143 1305 : case 0:
12144 : // ADDG, ASRD_ZPmI_B, ASRD_ZPmI_D, ASRD_ZPmI_S, ASR_ZPmI_B, ASR_ZPmI_D, A...
12145 1305 : printOperand(MI, 3, STI, O);
12146 1305 : return;
12147 : break;
12148 172 : case 1:
12149 : // ADD_ZPmZ_B, ANDS_PPzPP, AND_PPzPP, AND_ZPmZ_B, ASRR_ZPmZ_B, ASR_ZPmZ_B...
12150 172 : printSVERegOp<'b'>(MI, 3, STI, O);
12151 172 : return;
12152 : break;
12153 364 : case 2:
12154 : // ADD_ZPmZ_D, AND_ZPmZ_D, ASRR_ZPmZ_D, ASR_WIDE_ZPmZ_B, ASR_WIDE_ZPmZ_S,...
12155 364 : printSVERegOp<'d'>(MI, 3, STI, O);
12156 364 : break;
12157 : case 3:
12158 : // ADD_ZPmZ_H, AND_ZPmZ_H, ASRR_ZPmZ_H, ASR_ZPmZ_H, BIC_ZPmZ_H, CLASTA_ZP...
12159 : return;
12160 : break;
12161 154 : case 4:
12162 : // ADD_ZPmZ_S, AND_ZPmZ_S, ASRR_ZPmZ_S, ASR_ZPmZ_S, BIC_ZPmZ_S, CLASTA_RP...
12163 154 : printSVERegOp<'s'>(MI, 3, STI, O);
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