Line data Source code
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4617 : case AArch64::ADDSXrr:
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4640 : case AArch64::CFINV:
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4666 : case AArch64::MOVbaseTLS:
4667 : case AArch64::MOVi32imm:
4668 : case AArch64::MOVi64imm:
4669 : case AArch64::ORNWrr:
4670 : case AArch64::ORNXrr:
4671 : case AArch64::ORRWrr:
4672 : case AArch64::ORRXrr:
4673 : case AArch64::PACIA1716:
4674 : case AArch64::PACIASP:
4675 : case AArch64::PACIAZ:
4676 : case AArch64::PACIB1716:
4677 : case AArch64::PACIBSP:
4678 : case AArch64::PACIBZ:
4679 : case AArch64::RETAA:
4680 : case AArch64::RETAB:
4681 : case AArch64::RET_ReallyLR:
4682 : case AArch64::SB:
4683 : case AArch64::SETFFR:
4684 : case AArch64::SUBSWrr:
4685 : case AArch64::SUBSXrr:
4686 : case AArch64::SUBWrr:
4687 : case AArch64::SUBXrr:
4688 : case AArch64::TCRETURNdi:
4689 : case AArch64::TCRETURNri:
4690 : case AArch64::TCRETURNriALL:
4691 : case AArch64::TCRETURNriBTI:
4692 : case AArch64::TLSDESCCALL:
4693 : case AArch64::TLSDESC_CALLSEQ:
4694 : case AArch64::TSB:
4695 : case AArch64::XAFLAG:
4696 : case AArch64::XPACLRI: {
4697 : break;
4698 : }
4699 : case AArch64::CLREX:
4700 : case AArch64::DMB:
4701 : case AArch64::DSB:
4702 : case AArch64::ISB: {
4703 : // op: CRm
4704 0 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
4705 0 : Value |= (op & UINT64_C(15)) << 8;
4706 0 : break;
4707 : }
4708 : case AArch64::PFALSE:
4709 : case AArch64::RDFFR_P: {
4710 : // op: Pd
4711 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
4712 0 : Value |= op & UINT64_C(15);
4713 0 : break;
4714 : }
4715 : case AArch64::ANDS_PPzPP:
4716 : case AArch64::AND_PPzPP:
4717 : case AArch64::BICS_PPzPP:
4718 : case AArch64::BIC_PPzPP:
4719 : case AArch64::BRKPAS_PPzPP:
4720 : case AArch64::BRKPA_PPzPP:
4721 : case AArch64::BRKPBS_PPzPP:
4722 : case AArch64::BRKPB_PPzPP:
4723 : case AArch64::EORS_PPzPP:
4724 : case AArch64::EOR_PPzPP:
4725 : case AArch64::NANDS_PPzPP:
4726 : case AArch64::NAND_PPzPP:
4727 : case AArch64::NORS_PPzPP:
4728 : case AArch64::NOR_PPzPP:
4729 : case AArch64::ORNS_PPzPP:
4730 : case AArch64::ORN_PPzPP:
4731 : case AArch64::ORRS_PPzPP:
4732 : case AArch64::ORR_PPzPP:
4733 : case AArch64::SEL_PPPP: {
4734 : // op: Pd
4735 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
4736 0 : Value |= op & UINT64_C(15);
4737 : // op: Pg
4738 0 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
4739 0 : Value |= (op & UINT64_C(15)) << 10;
4740 : // op: Pm
4741 0 : op = getMachineOpValue(MI, MI.getOperand(3), Fixups, STI);
4742 0 : Value |= (op & UINT64_C(15)) << 16;
4743 : // op: Pn
4744 0 : op = getMachineOpValue(MI, MI.getOperand(2), Fixups, STI);
4745 0 : Value |= (op & UINT64_C(15)) << 5;
4746 0 : break;
4747 : }
4748 : case AArch64::BRKAS_PPzP:
4749 : case AArch64::BRKA_PPzP:
4750 : case AArch64::BRKBS_PPzP:
4751 : case AArch64::BRKB_PPzP: {
4752 : // op: Pd
4753 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
4754 0 : Value |= op & UINT64_C(15);
4755 : // op: Pg
4756 0 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
4757 0 : Value |= (op & UINT64_C(15)) << 10;
4758 : // op: Pn
4759 0 : op = getMachineOpValue(MI, MI.getOperand(2), Fixups, STI);
4760 0 : Value |= (op & UINT64_C(15)) << 5;
4761 0 : break;
4762 : }
4763 : case AArch64::RDFFRS_PPz:
4764 : case AArch64::RDFFR_PPz: {
4765 : // op: Pd
4766 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
4767 0 : Value |= op & UINT64_C(15);
4768 : // op: Pg
4769 0 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
4770 0 : Value |= (op & UINT64_C(15)) << 5;
4771 0 : break;
4772 : }
4773 : case AArch64::CMPEQ_PPzZZ_B:
4774 : case AArch64::CMPEQ_PPzZZ_D:
4775 : case AArch64::CMPEQ_PPzZZ_H:
4776 : case AArch64::CMPEQ_PPzZZ_S:
4777 : case AArch64::CMPEQ_WIDE_PPzZZ_B:
4778 : case AArch64::CMPEQ_WIDE_PPzZZ_H:
4779 : case AArch64::CMPEQ_WIDE_PPzZZ_S:
4780 : case AArch64::CMPGE_PPzZZ_B:
4781 : case AArch64::CMPGE_PPzZZ_D:
4782 : case AArch64::CMPGE_PPzZZ_H:
4783 : case AArch64::CMPGE_PPzZZ_S:
4784 : case AArch64::CMPGE_WIDE_PPzZZ_B:
4785 : case AArch64::CMPGE_WIDE_PPzZZ_H:
4786 : case AArch64::CMPGE_WIDE_PPzZZ_S:
4787 : case AArch64::CMPGT_PPzZZ_B:
4788 : case AArch64::CMPGT_PPzZZ_D:
4789 : case AArch64::CMPGT_PPzZZ_H:
4790 : case AArch64::CMPGT_PPzZZ_S:
4791 : case AArch64::CMPGT_WIDE_PPzZZ_B:
4792 : case AArch64::CMPGT_WIDE_PPzZZ_H:
4793 : case AArch64::CMPGT_WIDE_PPzZZ_S:
4794 : case AArch64::CMPHI_PPzZZ_B:
4795 : case AArch64::CMPHI_PPzZZ_D:
4796 : case AArch64::CMPHI_PPzZZ_H:
4797 : case AArch64::CMPHI_PPzZZ_S:
4798 : case AArch64::CMPHI_WIDE_PPzZZ_B:
4799 : case AArch64::CMPHI_WIDE_PPzZZ_H:
4800 : case AArch64::CMPHI_WIDE_PPzZZ_S:
4801 : case AArch64::CMPHS_PPzZZ_B:
4802 : case AArch64::CMPHS_PPzZZ_D:
4803 : case AArch64::CMPHS_PPzZZ_H:
4804 : case AArch64::CMPHS_PPzZZ_S:
4805 : case AArch64::CMPHS_WIDE_PPzZZ_B:
4806 : case AArch64::CMPHS_WIDE_PPzZZ_H:
4807 : case AArch64::CMPHS_WIDE_PPzZZ_S:
4808 : case AArch64::CMPLE_WIDE_PPzZZ_B:
4809 : case AArch64::CMPLE_WIDE_PPzZZ_H:
4810 : case AArch64::CMPLE_WIDE_PPzZZ_S:
4811 : case AArch64::CMPLO_WIDE_PPzZZ_B:
4812 : case AArch64::CMPLO_WIDE_PPzZZ_H:
4813 : case AArch64::CMPLO_WIDE_PPzZZ_S:
4814 : case AArch64::CMPLS_WIDE_PPzZZ_B:
4815 : case AArch64::CMPLS_WIDE_PPzZZ_H:
4816 : case AArch64::CMPLS_WIDE_PPzZZ_S:
4817 : case AArch64::CMPLT_WIDE_PPzZZ_B:
4818 : case AArch64::CMPLT_WIDE_PPzZZ_H:
4819 : case AArch64::CMPLT_WIDE_PPzZZ_S:
4820 : case AArch64::CMPNE_PPzZZ_B:
4821 : case AArch64::CMPNE_PPzZZ_D:
4822 : case AArch64::CMPNE_PPzZZ_H:
4823 : case AArch64::CMPNE_PPzZZ_S:
4824 : case AArch64::CMPNE_WIDE_PPzZZ_B:
4825 : case AArch64::CMPNE_WIDE_PPzZZ_H:
4826 : case AArch64::CMPNE_WIDE_PPzZZ_S:
4827 : case AArch64::FACGE_PPzZZ_D:
4828 : case AArch64::FACGE_PPzZZ_H:
4829 : case AArch64::FACGE_PPzZZ_S:
4830 : case AArch64::FACGT_PPzZZ_D:
4831 : case AArch64::FACGT_PPzZZ_H:
4832 : case AArch64::FACGT_PPzZZ_S:
4833 : case AArch64::FCMEQ_PPzZZ_D:
4834 : case AArch64::FCMEQ_PPzZZ_H:
4835 : case AArch64::FCMEQ_PPzZZ_S:
4836 : case AArch64::FCMGE_PPzZZ_D:
4837 : case AArch64::FCMGE_PPzZZ_H:
4838 : case AArch64::FCMGE_PPzZZ_S:
4839 : case AArch64::FCMGT_PPzZZ_D:
4840 : case AArch64::FCMGT_PPzZZ_H:
4841 : case AArch64::FCMGT_PPzZZ_S:
4842 : case AArch64::FCMNE_PPzZZ_D:
4843 : case AArch64::FCMNE_PPzZZ_H:
4844 : case AArch64::FCMNE_PPzZZ_S:
4845 : case AArch64::FCMUO_PPzZZ_D:
4846 : case AArch64::FCMUO_PPzZZ_H:
4847 : case AArch64::FCMUO_PPzZZ_S: {
4848 : // op: Pd
4849 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
4850 0 : Value |= op & UINT64_C(15);
4851 : // op: Pg
4852 0 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
4853 0 : Value |= (op & UINT64_C(7)) << 10;
4854 : // op: Zm
4855 0 : op = getMachineOpValue(MI, MI.getOperand(3), Fixups, STI);
4856 0 : Value |= (op & UINT64_C(31)) << 16;
4857 : // op: Zn
4858 0 : op = getMachineOpValue(MI, MI.getOperand(2), Fixups, STI);
4859 0 : Value |= (op & UINT64_C(31)) << 5;
4860 0 : break;
4861 : }
4862 : case AArch64::FCMEQ_PPzZ0_D:
4863 : case AArch64::FCMEQ_PPzZ0_H:
4864 : case AArch64::FCMEQ_PPzZ0_S:
4865 : case AArch64::FCMGE_PPzZ0_D:
4866 : case AArch64::FCMGE_PPzZ0_H:
4867 : case AArch64::FCMGE_PPzZ0_S:
4868 : case AArch64::FCMGT_PPzZ0_D:
4869 : case AArch64::FCMGT_PPzZ0_H:
4870 : case AArch64::FCMGT_PPzZ0_S:
4871 : case AArch64::FCMLE_PPzZ0_D:
4872 : case AArch64::FCMLE_PPzZ0_H:
4873 : case AArch64::FCMLE_PPzZ0_S:
4874 : case AArch64::FCMLT_PPzZ0_D:
4875 : case AArch64::FCMLT_PPzZ0_H:
4876 : case AArch64::FCMLT_PPzZ0_S:
4877 : case AArch64::FCMNE_PPzZ0_D:
4878 : case AArch64::FCMNE_PPzZ0_H:
4879 : case AArch64::FCMNE_PPzZ0_S: {
4880 : // op: Pd
4881 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
4882 0 : Value |= op & UINT64_C(15);
4883 : // op: Pg
4884 0 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
4885 0 : Value |= (op & UINT64_C(7)) << 10;
4886 : // op: Zn
4887 0 : op = getMachineOpValue(MI, MI.getOperand(2), Fixups, STI);
4888 0 : Value |= (op & UINT64_C(31)) << 5;
4889 0 : break;
4890 : }
4891 : case AArch64::CMPEQ_PPzZI_B:
4892 : case AArch64::CMPEQ_PPzZI_D:
4893 : case AArch64::CMPEQ_PPzZI_H:
4894 : case AArch64::CMPEQ_PPzZI_S:
4895 : case AArch64::CMPGE_PPzZI_B:
4896 : case AArch64::CMPGE_PPzZI_D:
4897 : case AArch64::CMPGE_PPzZI_H:
4898 : case AArch64::CMPGE_PPzZI_S:
4899 : case AArch64::CMPGT_PPzZI_B:
4900 : case AArch64::CMPGT_PPzZI_D:
4901 : case AArch64::CMPGT_PPzZI_H:
4902 : case AArch64::CMPGT_PPzZI_S:
4903 : case AArch64::CMPLE_PPzZI_B:
4904 : case AArch64::CMPLE_PPzZI_D:
4905 : case AArch64::CMPLE_PPzZI_H:
4906 : case AArch64::CMPLE_PPzZI_S:
4907 : case AArch64::CMPLT_PPzZI_B:
4908 : case AArch64::CMPLT_PPzZI_D:
4909 : case AArch64::CMPLT_PPzZI_H:
4910 : case AArch64::CMPLT_PPzZI_S:
4911 : case AArch64::CMPNE_PPzZI_B:
4912 : case AArch64::CMPNE_PPzZI_D:
4913 : case AArch64::CMPNE_PPzZI_H:
4914 : case AArch64::CMPNE_PPzZI_S: {
4915 : // op: Pd
4916 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
4917 0 : Value |= op & UINT64_C(15);
4918 : // op: Pg
4919 0 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
4920 0 : Value |= (op & UINT64_C(7)) << 10;
4921 : // op: Zn
4922 0 : op = getMachineOpValue(MI, MI.getOperand(2), Fixups, STI);
4923 0 : Value |= (op & UINT64_C(31)) << 5;
4924 : // op: imm5
4925 0 : op = getMachineOpValue(MI, MI.getOperand(3), Fixups, STI);
4926 0 : Value |= (op & UINT64_C(31)) << 16;
4927 0 : break;
4928 : }
4929 : case AArch64::CMPHI_PPzZI_B:
4930 : case AArch64::CMPHI_PPzZI_D:
4931 : case AArch64::CMPHI_PPzZI_H:
4932 : case AArch64::CMPHI_PPzZI_S:
4933 : case AArch64::CMPHS_PPzZI_B:
4934 : case AArch64::CMPHS_PPzZI_D:
4935 : case AArch64::CMPHS_PPzZI_H:
4936 : case AArch64::CMPHS_PPzZI_S:
4937 : case AArch64::CMPLO_PPzZI_B:
4938 : case AArch64::CMPLO_PPzZI_D:
4939 : case AArch64::CMPLO_PPzZI_H:
4940 : case AArch64::CMPLO_PPzZI_S:
4941 : case AArch64::CMPLS_PPzZI_B:
4942 : case AArch64::CMPLS_PPzZI_D:
4943 : case AArch64::CMPLS_PPzZI_H:
4944 : case AArch64::CMPLS_PPzZI_S: {
4945 : // op: Pd
4946 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
4947 0 : Value |= op & UINT64_C(15);
4948 : // op: Pg
4949 0 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
4950 0 : Value |= (op & UINT64_C(7)) << 10;
4951 : // op: Zn
4952 0 : op = getMachineOpValue(MI, MI.getOperand(2), Fixups, STI);
4953 0 : Value |= (op & UINT64_C(31)) << 5;
4954 : // op: imm7
4955 0 : op = getMachineOpValue(MI, MI.getOperand(3), Fixups, STI);
4956 0 : Value |= (op & UINT64_C(127)) << 14;
4957 0 : break;
4958 : }
4959 : case AArch64::BRKA_PPmP:
4960 : case AArch64::BRKB_PPmP: {
4961 : // op: Pd
4962 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
4963 0 : Value |= op & UINT64_C(15);
4964 : // op: Pg
4965 0 : op = getMachineOpValue(MI, MI.getOperand(2), Fixups, STI);
4966 0 : Value |= (op & UINT64_C(15)) << 10;
4967 : // op: Pn
4968 0 : op = getMachineOpValue(MI, MI.getOperand(3), Fixups, STI);
4969 0 : Value |= (op & UINT64_C(15)) << 5;
4970 0 : break;
4971 : }
4972 : case AArch64::TRN1_PPP_B:
4973 : case AArch64::TRN1_PPP_D:
4974 : case AArch64::TRN1_PPP_H:
4975 : case AArch64::TRN1_PPP_S:
4976 : case AArch64::TRN2_PPP_B:
4977 : case AArch64::TRN2_PPP_D:
4978 : case AArch64::TRN2_PPP_H:
4979 : case AArch64::TRN2_PPP_S:
4980 : case AArch64::UZP1_PPP_B:
4981 : case AArch64::UZP1_PPP_D:
4982 : case AArch64::UZP1_PPP_H:
4983 : case AArch64::UZP1_PPP_S:
4984 : case AArch64::UZP2_PPP_B:
4985 : case AArch64::UZP2_PPP_D:
4986 : case AArch64::UZP2_PPP_H:
4987 : case AArch64::UZP2_PPP_S:
4988 : case AArch64::ZIP1_PPP_B:
4989 : case AArch64::ZIP1_PPP_D:
4990 : case AArch64::ZIP1_PPP_H:
4991 : case AArch64::ZIP1_PPP_S:
4992 : case AArch64::ZIP2_PPP_B:
4993 : case AArch64::ZIP2_PPP_D:
4994 : case AArch64::ZIP2_PPP_H:
4995 : case AArch64::ZIP2_PPP_S: {
4996 : // op: Pd
4997 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
4998 0 : Value |= op & UINT64_C(15);
4999 : // op: Pm
5000 0 : op = getMachineOpValue(MI, MI.getOperand(2), Fixups, STI);
5001 0 : Value |= (op & UINT64_C(15)) << 16;
5002 : // op: Pn
5003 0 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
5004 0 : Value |= (op & UINT64_C(15)) << 5;
5005 0 : break;
5006 : }
5007 : case AArch64::PUNPKHI_PP:
5008 : case AArch64::PUNPKLO_PP:
5009 : case AArch64::REV_PP_B:
5010 : case AArch64::REV_PP_D:
5011 : case AArch64::REV_PP_H:
5012 : case AArch64::REV_PP_S: {
5013 : // op: Pd
5014 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
5015 0 : Value |= op & UINT64_C(15);
5016 : // op: Pn
5017 0 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
5018 0 : Value |= (op & UINT64_C(15)) << 5;
5019 0 : break;
5020 : }
5021 : case AArch64::WHILELE_PWW_B:
5022 : case AArch64::WHILELE_PWW_D:
5023 : case AArch64::WHILELE_PWW_H:
5024 : case AArch64::WHILELE_PWW_S:
5025 : case AArch64::WHILELE_PXX_B:
5026 : case AArch64::WHILELE_PXX_D:
5027 : case AArch64::WHILELE_PXX_H:
5028 : case AArch64::WHILELE_PXX_S:
5029 : case AArch64::WHILELO_PWW_B:
5030 : case AArch64::WHILELO_PWW_D:
5031 : case AArch64::WHILELO_PWW_H:
5032 : case AArch64::WHILELO_PWW_S:
5033 : case AArch64::WHILELO_PXX_B:
5034 : case AArch64::WHILELO_PXX_D:
5035 : case AArch64::WHILELO_PXX_H:
5036 : case AArch64::WHILELO_PXX_S:
5037 : case AArch64::WHILELS_PWW_B:
5038 : case AArch64::WHILELS_PWW_D:
5039 : case AArch64::WHILELS_PWW_H:
5040 : case AArch64::WHILELS_PWW_S:
5041 : case AArch64::WHILELS_PXX_B:
5042 : case AArch64::WHILELS_PXX_D:
5043 : case AArch64::WHILELS_PXX_H:
5044 : case AArch64::WHILELS_PXX_S:
5045 : case AArch64::WHILELT_PWW_B:
5046 : case AArch64::WHILELT_PWW_D:
5047 : case AArch64::WHILELT_PWW_H:
5048 : case AArch64::WHILELT_PWW_S:
5049 : case AArch64::WHILELT_PXX_B:
5050 : case AArch64::WHILELT_PXX_D:
5051 : case AArch64::WHILELT_PXX_H:
5052 : case AArch64::WHILELT_PXX_S: {
5053 : // op: Pd
5054 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
5055 0 : Value |= op & UINT64_C(15);
5056 : // op: Rm
5057 0 : op = getMachineOpValue(MI, MI.getOperand(2), Fixups, STI);
5058 0 : Value |= (op & UINT64_C(31)) << 16;
5059 : // op: Rn
5060 0 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
5061 0 : Value |= (op & UINT64_C(31)) << 5;
5062 0 : break;
5063 : }
5064 : case AArch64::PTRUES_B:
5065 : case AArch64::PTRUES_D:
5066 : case AArch64::PTRUES_H:
5067 : case AArch64::PTRUES_S:
5068 : case AArch64::PTRUE_B:
5069 : case AArch64::PTRUE_D:
5070 : case AArch64::PTRUE_H:
5071 : case AArch64::PTRUE_S: {
5072 : // op: Pd
5073 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
5074 0 : Value |= op & UINT64_C(15);
5075 : // op: pattern
5076 0 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
5077 0 : Value |= (op & UINT64_C(31)) << 5;
5078 0 : break;
5079 : }
5080 : case AArch64::BRKNS_PPzP:
5081 : case AArch64::BRKN_PPzP: {
5082 : // op: Pdm
5083 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
5084 0 : Value |= op & UINT64_C(15);
5085 : // op: Pg
5086 0 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
5087 0 : Value |= (op & UINT64_C(15)) << 10;
5088 : // op: Pn
5089 0 : op = getMachineOpValue(MI, MI.getOperand(2), Fixups, STI);
5090 0 : Value |= (op & UINT64_C(15)) << 5;
5091 0 : break;
5092 : }
5093 : case AArch64::PNEXT_B:
5094 : case AArch64::PNEXT_D:
5095 : case AArch64::PNEXT_H:
5096 : case AArch64::PNEXT_S:
5097 : case AArch64::anonymous_1355: {
5098 : // op: Pdn
5099 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
5100 0 : Value |= op & UINT64_C(15);
5101 : // op: Pg
5102 0 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
5103 0 : Value |= (op & UINT64_C(15)) << 5;
5104 0 : break;
5105 : }
5106 : case AArch64::PTEST_PP: {
5107 : // op: Pg
5108 0 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
5109 0 : Value |= (op & UINT64_C(15)) << 10;
5110 : // op: Pn
5111 0 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
5112 0 : Value |= (op & UINT64_C(15)) << 5;
5113 0 : break;
5114 : }
5115 : case AArch64::CNTP_XPP_B:
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5117 : case AArch64::CNTP_XPP_H:
5118 : case AArch64::CNTP_XPP_S: {
5119 : // op: Pg
5120 0 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
5121 0 : Value |= (op & UINT64_C(15)) << 10;
5122 : // op: Pn
5123 0 : op = getMachineOpValue(MI, MI.getOperand(2), Fixups, STI);
5124 0 : Value |= (op & UINT64_C(15)) << 5;
5125 : // op: Rd
5126 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
5127 0 : Value |= op & UINT64_C(31);
5128 0 : break;
5129 : }
5130 : case AArch64::SEL_ZPZZ_B:
5131 : case AArch64::SEL_ZPZZ_D:
5132 : case AArch64::SEL_ZPZZ_H:
5133 : case AArch64::SEL_ZPZZ_S: {
5134 : // op: Pg
5135 0 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
5136 0 : Value |= (op & UINT64_C(15)) << 10;
5137 : // op: Zd
5138 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
5139 0 : Value |= op & UINT64_C(31);
5140 : // op: Zm
5141 0 : op = getMachineOpValue(MI, MI.getOperand(3), Fixups, STI);
5142 0 : Value |= (op & UINT64_C(31)) << 16;
5143 : // op: Zn
5144 0 : op = getMachineOpValue(MI, MI.getOperand(2), Fixups, STI);
5145 0 : Value |= (op & UINT64_C(31)) << 5;
5146 0 : break;
5147 : }
5148 : case AArch64::LASTA_RPZ_B:
5149 : case AArch64::LASTA_RPZ_D:
5150 : case AArch64::LASTA_RPZ_H:
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5152 : case AArch64::LASTB_RPZ_B:
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5154 : case AArch64::LASTB_RPZ_H:
5155 : case AArch64::LASTB_RPZ_S: {
5156 : // op: Pg
5157 0 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
5158 0 : Value |= (op & UINT64_C(7)) << 10;
5159 : // op: Rd
5160 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
5161 0 : Value |= op & UINT64_C(31);
5162 : // op: Zn
5163 0 : op = getMachineOpValue(MI, MI.getOperand(2), Fixups, STI);
5164 0 : Value |= (op & UINT64_C(31)) << 5;
5165 0 : break;
5166 : }
5167 : case AArch64::CLASTA_RPZ_B:
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5171 : case AArch64::CLASTB_RPZ_B:
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5175 : // op: Pg
5176 0 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
5177 0 : Value |= (op & UINT64_C(7)) << 10;
5178 : // op: Rdn
5179 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
5180 0 : Value |= op & UINT64_C(31);
5181 : // op: Zm
5182 0 : op = getMachineOpValue(MI, MI.getOperand(3), Fixups, STI);
5183 0 : Value |= (op & UINT64_C(31)) << 5;
5184 0 : break;
5185 : }
5186 : case AArch64::LD2B:
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5211 : case AArch64::ST1W_D:
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5226 : case AArch64::STNT1H_ZRR:
5227 : case AArch64::STNT1W_ZRR: {
5228 : // op: Pg
5229 0 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
5230 0 : Value |= (op & UINT64_C(7)) << 10;
5231 : // op: Rm
5232 0 : op = getMachineOpValue(MI, MI.getOperand(3), Fixups, STI);
5233 0 : Value |= (op & UINT64_C(31)) << 16;
5234 : // op: Rn
5235 0 : op = getMachineOpValue(MI, MI.getOperand(2), Fixups, STI);
5236 0 : Value |= (op & UINT64_C(31)) << 5;
5237 : // op: Zt
5238 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
5239 0 : Value |= op & UINT64_C(31);
5240 0 : break;
5241 : }
5242 : case AArch64::GLD1B_D_REAL:
5243 : case AArch64::GLD1B_D_SXTW_REAL:
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5350 : case AArch64::SST1B_S_UXTW:
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5353 : case AArch64::SST1D_SXTW:
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5355 : case AArch64::SST1D_UXTW:
5356 : case AArch64::SST1D_UXTW_SCALED:
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5375 : case AArch64::SST1W_UXTW:
5376 : case AArch64::SST1W_UXTW_SCALED: {
5377 : // op: Pg
5378 0 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
5379 0 : Value |= (op & UINT64_C(7)) << 10;
5380 : // op: Rn
5381 0 : op = getMachineOpValue(MI, MI.getOperand(2), Fixups, STI);
5382 0 : Value |= (op & UINT64_C(31)) << 5;
5383 : // op: Zm
5384 0 : op = getMachineOpValue(MI, MI.getOperand(3), Fixups, STI);
5385 0 : Value |= (op & UINT64_C(31)) << 16;
5386 : // op: Zt
5387 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
5388 0 : Value |= op & UINT64_C(31);
5389 0 : break;
5390 : }
5391 : case AArch64::PRFB_D_SCALED:
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5400 : case AArch64::PRFD_S_UXTW_SCALED:
5401 : case AArch64::PRFH_D_SCALED:
5402 : case AArch64::PRFH_D_SXTW_SCALED:
5403 : case AArch64::PRFH_D_UXTW_SCALED:
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5409 : case AArch64::PRFW_S_SXTW_SCALED:
5410 : case AArch64::PRFW_S_UXTW_SCALED: {
5411 : // op: Pg
5412 0 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
5413 0 : Value |= (op & UINT64_C(7)) << 10;
5414 : // op: Rn
5415 0 : op = getMachineOpValue(MI, MI.getOperand(2), Fixups, STI);
5416 0 : Value |= (op & UINT64_C(31)) << 5;
5417 : // op: Zm
5418 0 : op = getMachineOpValue(MI, MI.getOperand(3), Fixups, STI);
5419 0 : Value |= (op & UINT64_C(31)) << 16;
5420 : // op: prfop
5421 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
5422 0 : Value |= op & UINT64_C(15);
5423 0 : break;
5424 : }
5425 : case AArch64::LD1B_D_IMM_REAL:
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5483 : // op: Pg
5484 0 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
5485 0 : Value |= (op & UINT64_C(7)) << 10;
5486 : // op: Rn
5487 0 : op = getMachineOpValue(MI, MI.getOperand(2), Fixups, STI);
5488 0 : Value |= (op & UINT64_C(31)) << 5;
5489 : // op: Zt
5490 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
5491 0 : Value |= op & UINT64_C(31);
5492 : // op: imm4
5493 0 : op = getMachineOpValue(MI, MI.getOperand(3), Fixups, STI);
5494 0 : Value |= (op & UINT64_C(15)) << 16;
5495 0 : break;
5496 : }
5497 : case AArch64::LD1RB_D_IMM:
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5507 : case AArch64::LD1RSB_S_IMM:
5508 : case AArch64::LD1RSH_D_IMM:
5509 : case AArch64::LD1RSH_S_IMM:
5510 : case AArch64::LD1RSW_IMM:
5511 : case AArch64::LD1RW_D_IMM:
5512 : case AArch64::LD1RW_IMM: {
5513 : // op: Pg
5514 0 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
5515 0 : Value |= (op & UINT64_C(7)) << 10;
5516 : // op: Rn
5517 0 : op = getMachineOpValue(MI, MI.getOperand(2), Fixups, STI);
5518 0 : Value |= (op & UINT64_C(31)) << 5;
5519 : // op: Zt
5520 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
5521 0 : Value |= op & UINT64_C(31);
5522 : // op: imm6
5523 0 : op = getMachineOpValue(MI, MI.getOperand(3), Fixups, STI);
5524 0 : Value |= (op & UINT64_C(63)) << 16;
5525 0 : break;
5526 : }
5527 : case AArch64::ANDV_VPZ_B:
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5543 : case AArch64::ORV_VPZ_B:
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5545 : case AArch64::ORV_VPZ_H:
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5550 : case AArch64::SMAXV_VPZ_B:
5551 : case AArch64::SMAXV_VPZ_D:
5552 : case AArch64::SMAXV_VPZ_H:
5553 : case AArch64::SMAXV_VPZ_S:
5554 : case AArch64::SMINV_VPZ_B:
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5556 : case AArch64::SMINV_VPZ_H:
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5561 : case AArch64::UADDV_VPZ_S:
5562 : case AArch64::UMAXV_VPZ_B:
5563 : case AArch64::UMAXV_VPZ_D:
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5565 : case AArch64::UMAXV_VPZ_S:
5566 : case AArch64::UMINV_VPZ_B:
5567 : case AArch64::UMINV_VPZ_D:
5568 : case AArch64::UMINV_VPZ_H:
5569 : case AArch64::UMINV_VPZ_S: {
5570 : // op: Pg
5571 0 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
5572 0 : Value |= (op & UINT64_C(7)) << 10;
5573 : // op: Vd
5574 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
5575 0 : Value |= op & UINT64_C(31);
5576 : // op: Zn
5577 0 : op = getMachineOpValue(MI, MI.getOperand(2), Fixups, STI);
5578 0 : Value |= (op & UINT64_C(31)) << 5;
5579 0 : break;
5580 : }
5581 : case AArch64::CLASTA_VPZ_B:
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5583 : case AArch64::CLASTA_VPZ_H:
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5585 : case AArch64::CLASTB_VPZ_B:
5586 : case AArch64::CLASTB_VPZ_D:
5587 : case AArch64::CLASTB_VPZ_H:
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5591 : case AArch64::FADDA_VPZ_S: {
5592 : // op: Pg
5593 0 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
5594 0 : Value |= (op & UINT64_C(7)) << 10;
5595 : // op: Vdn
5596 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
5597 0 : Value |= op & UINT64_C(31);
5598 : // op: Zm
5599 0 : op = getMachineOpValue(MI, MI.getOperand(3), Fixups, STI);
5600 0 : Value |= (op & UINT64_C(31)) << 5;
5601 0 : break;
5602 : }
5603 : case AArch64::FMAD_ZPmZZ_D:
5604 : case AArch64::FMAD_ZPmZZ_H:
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5606 : case AArch64::FMSB_ZPmZZ_D:
5607 : case AArch64::FMSB_ZPmZZ_H:
5608 : case AArch64::FMSB_ZPmZZ_S:
5609 : case AArch64::FNMAD_ZPmZZ_D:
5610 : case AArch64::FNMAD_ZPmZZ_H:
5611 : case AArch64::FNMAD_ZPmZZ_S:
5612 : case AArch64::FNMSB_ZPmZZ_D:
5613 : case AArch64::FNMSB_ZPmZZ_H:
5614 : case AArch64::FNMSB_ZPmZZ_S: {
5615 : // op: Pg
5616 0 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
5617 0 : Value |= (op & UINT64_C(7)) << 10;
5618 : // op: Za
5619 0 : op = getMachineOpValue(MI, MI.getOperand(4), Fixups, STI);
5620 0 : Value |= (op & UINT64_C(31)) << 16;
5621 : // op: Zdn
5622 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
5623 0 : Value |= op & UINT64_C(31);
5624 : // op: Zm
5625 0 : op = getMachineOpValue(MI, MI.getOperand(3), Fixups, STI);
5626 0 : Value |= (op & UINT64_C(31)) << 5;
5627 0 : break;
5628 : }
5629 : case AArch64::COMPACT_ZPZ_D:
5630 : case AArch64::COMPACT_ZPZ_S:
5631 : case AArch64::MOVPRFX_ZPzZ_B:
5632 : case AArch64::MOVPRFX_ZPzZ_D:
5633 : case AArch64::MOVPRFX_ZPzZ_H:
5634 : case AArch64::MOVPRFX_ZPzZ_S: {
5635 : // op: Pg
5636 0 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
5637 0 : Value |= (op & UINT64_C(7)) << 10;
5638 : // op: Zd
5639 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
5640 0 : Value |= op & UINT64_C(31);
5641 : // op: Zn
5642 0 : op = getMachineOpValue(MI, MI.getOperand(2), Fixups, STI);
5643 0 : Value |= (op & UINT64_C(31)) << 5;
5644 0 : break;
5645 : }
5646 : case AArch64::FMLA_ZPmZZ_D:
5647 : case AArch64::FMLA_ZPmZZ_H:
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5649 : case AArch64::FMLS_ZPmZZ_D:
5650 : case AArch64::FMLS_ZPmZZ_H:
5651 : case AArch64::FMLS_ZPmZZ_S:
5652 : case AArch64::FNMLA_ZPmZZ_D:
5653 : case AArch64::FNMLA_ZPmZZ_H:
5654 : case AArch64::FNMLA_ZPmZZ_S:
5655 : case AArch64::FNMLS_ZPmZZ_D:
5656 : case AArch64::FNMLS_ZPmZZ_H:
5657 : case AArch64::FNMLS_ZPmZZ_S:
5658 : case AArch64::MLA_ZPmZZ_B:
5659 : case AArch64::MLA_ZPmZZ_D:
5660 : case AArch64::MLA_ZPmZZ_H:
5661 : case AArch64::MLA_ZPmZZ_S:
5662 : case AArch64::MLS_ZPmZZ_B:
5663 : case AArch64::MLS_ZPmZZ_D:
5664 : case AArch64::MLS_ZPmZZ_H:
5665 : case AArch64::MLS_ZPmZZ_S: {
5666 : // op: Pg
5667 0 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
5668 0 : Value |= (op & UINT64_C(7)) << 10;
5669 : // op: Zda
5670 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
5671 0 : Value |= op & UINT64_C(31);
5672 : // op: Zm
5673 0 : op = getMachineOpValue(MI, MI.getOperand(4), Fixups, STI);
5674 0 : Value |= (op & UINT64_C(31)) << 16;
5675 : // op: Zn
5676 0 : op = getMachineOpValue(MI, MI.getOperand(3), Fixups, STI);
5677 0 : Value |= (op & UINT64_C(31)) << 5;
5678 0 : break;
5679 : }
5680 : case AArch64::MAD_ZPmZZ_B:
5681 : case AArch64::MAD_ZPmZZ_D:
5682 : case AArch64::MAD_ZPmZZ_H:
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5684 : case AArch64::MSB_ZPmZZ_B:
5685 : case AArch64::MSB_ZPmZZ_D:
5686 : case AArch64::MSB_ZPmZZ_H:
5687 : case AArch64::MSB_ZPmZZ_S: {
5688 : // op: Pg
5689 0 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
5690 0 : Value |= (op & UINT64_C(7)) << 10;
5691 : // op: Zdn
5692 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
5693 0 : Value |= op & UINT64_C(31);
5694 : // op: Za
5695 0 : op = getMachineOpValue(MI, MI.getOperand(4), Fixups, STI);
5696 0 : Value |= (op & UINT64_C(31)) << 5;
5697 : // op: Zm
5698 0 : op = getMachineOpValue(MI, MI.getOperand(3), Fixups, STI);
5699 0 : Value |= (op & UINT64_C(31)) << 16;
5700 0 : break;
5701 : }
5702 : case AArch64::ADD_ZPmZ_B:
5703 : case AArch64::ADD_ZPmZ_D:
5704 : case AArch64::ADD_ZPmZ_H:
5705 : case AArch64::ADD_ZPmZ_S:
5706 : case AArch64::AND_ZPmZ_B:
5707 : case AArch64::AND_ZPmZ_D:
5708 : case AArch64::AND_ZPmZ_H:
5709 : case AArch64::AND_ZPmZ_S:
5710 : case AArch64::ASRR_ZPmZ_B:
5711 : case AArch64::ASRR_ZPmZ_D:
5712 : case AArch64::ASRR_ZPmZ_H:
5713 : case AArch64::ASRR_ZPmZ_S:
5714 : case AArch64::ASR_WIDE_ZPmZ_B:
5715 : case AArch64::ASR_WIDE_ZPmZ_H:
5716 : case AArch64::ASR_WIDE_ZPmZ_S:
5717 : case AArch64::ASR_ZPmZ_B:
5718 : case AArch64::ASR_ZPmZ_D:
5719 : case AArch64::ASR_ZPmZ_H:
5720 : case AArch64::ASR_ZPmZ_S:
5721 : case AArch64::BIC_ZPmZ_B:
5722 : case AArch64::BIC_ZPmZ_D:
5723 : case AArch64::BIC_ZPmZ_H:
5724 : case AArch64::BIC_ZPmZ_S:
5725 : case AArch64::CLASTA_ZPZ_B:
5726 : case AArch64::CLASTA_ZPZ_D:
5727 : case AArch64::CLASTA_ZPZ_H:
5728 : case AArch64::CLASTA_ZPZ_S:
5729 : case AArch64::CLASTB_ZPZ_B:
5730 : case AArch64::CLASTB_ZPZ_D:
5731 : case AArch64::CLASTB_ZPZ_H:
5732 : case AArch64::CLASTB_ZPZ_S:
5733 : case AArch64::EOR_ZPmZ_B:
5734 : case AArch64::EOR_ZPmZ_D:
5735 : case AArch64::EOR_ZPmZ_H:
5736 : case AArch64::EOR_ZPmZ_S:
5737 : case AArch64::FABD_ZPmZ_D:
5738 : case AArch64::FABD_ZPmZ_H:
5739 : case AArch64::FABD_ZPmZ_S:
5740 : case AArch64::FADD_ZPmZ_D:
5741 : case AArch64::FADD_ZPmZ_H:
5742 : case AArch64::FADD_ZPmZ_S:
5743 : case AArch64::FDIVR_ZPmZ_D:
5744 : case AArch64::FDIVR_ZPmZ_H:
5745 : case AArch64::FDIVR_ZPmZ_S:
5746 : case AArch64::FDIV_ZPmZ_D:
5747 : case AArch64::FDIV_ZPmZ_H:
5748 : case AArch64::FDIV_ZPmZ_S:
5749 : case AArch64::FMAXNM_ZPmZ_D:
5750 : case AArch64::FMAXNM_ZPmZ_H:
5751 : case AArch64::FMAXNM_ZPmZ_S:
5752 : case AArch64::FMAX_ZPmZ_D:
5753 : case AArch64::FMAX_ZPmZ_H:
5754 : case AArch64::FMAX_ZPmZ_S:
5755 : case AArch64::FMINNM_ZPmZ_D:
5756 : case AArch64::FMINNM_ZPmZ_H:
5757 : case AArch64::FMINNM_ZPmZ_S:
5758 : case AArch64::FMIN_ZPmZ_D:
5759 : case AArch64::FMIN_ZPmZ_H:
5760 : case AArch64::FMIN_ZPmZ_S:
5761 : case AArch64::FMULX_ZPmZ_D:
5762 : case AArch64::FMULX_ZPmZ_H:
5763 : case AArch64::FMULX_ZPmZ_S:
5764 : case AArch64::FMUL_ZPmZ_D:
5765 : case AArch64::FMUL_ZPmZ_H:
5766 : case AArch64::FMUL_ZPmZ_S:
5767 : case AArch64::FSCALE_ZPmZ_D:
5768 : case AArch64::FSCALE_ZPmZ_H:
5769 : case AArch64::FSCALE_ZPmZ_S:
5770 : case AArch64::FSUBR_ZPmZ_D:
5771 : case AArch64::FSUBR_ZPmZ_H:
5772 : case AArch64::FSUBR_ZPmZ_S:
5773 : case AArch64::FSUB_ZPmZ_D:
5774 : case AArch64::FSUB_ZPmZ_H:
5775 : case AArch64::FSUB_ZPmZ_S:
5776 : case AArch64::LSLR_ZPmZ_B:
5777 : case AArch64::LSLR_ZPmZ_D:
5778 : case AArch64::LSLR_ZPmZ_H:
5779 : case AArch64::LSLR_ZPmZ_S:
5780 : case AArch64::LSL_WIDE_ZPmZ_B:
5781 : case AArch64::LSL_WIDE_ZPmZ_H:
5782 : case AArch64::LSL_WIDE_ZPmZ_S:
5783 : case AArch64::LSL_ZPmZ_B:
5784 : case AArch64::LSL_ZPmZ_D:
5785 : case AArch64::LSL_ZPmZ_H:
5786 : case AArch64::LSL_ZPmZ_S:
5787 : case AArch64::LSRR_ZPmZ_B:
5788 : case AArch64::LSRR_ZPmZ_D:
5789 : case AArch64::LSRR_ZPmZ_H:
5790 : case AArch64::LSRR_ZPmZ_S:
5791 : case AArch64::LSR_WIDE_ZPmZ_B:
5792 : case AArch64::LSR_WIDE_ZPmZ_H:
5793 : case AArch64::LSR_WIDE_ZPmZ_S:
5794 : case AArch64::LSR_ZPmZ_B:
5795 : case AArch64::LSR_ZPmZ_D:
5796 : case AArch64::LSR_ZPmZ_H:
5797 : case AArch64::LSR_ZPmZ_S:
5798 : case AArch64::MUL_ZPmZ_B:
5799 : case AArch64::MUL_ZPmZ_D:
5800 : case AArch64::MUL_ZPmZ_H:
5801 : case AArch64::MUL_ZPmZ_S:
5802 : case AArch64::ORR_ZPmZ_B:
5803 : case AArch64::ORR_ZPmZ_D:
5804 : case AArch64::ORR_ZPmZ_H:
5805 : case AArch64::ORR_ZPmZ_S:
5806 : case AArch64::SABD_ZPmZ_B:
5807 : case AArch64::SABD_ZPmZ_D:
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5809 : case AArch64::SABD_ZPmZ_S:
5810 : case AArch64::SDIVR_ZPmZ_D:
5811 : case AArch64::SDIVR_ZPmZ_S:
5812 : case AArch64::SDIV_ZPmZ_D:
5813 : case AArch64::SDIV_ZPmZ_S:
5814 : case AArch64::SMAX_ZPmZ_B:
5815 : case AArch64::SMAX_ZPmZ_D:
5816 : case AArch64::SMAX_ZPmZ_H:
5817 : case AArch64::SMAX_ZPmZ_S:
5818 : case AArch64::SMIN_ZPmZ_B:
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5820 : case AArch64::SMIN_ZPmZ_H:
5821 : case AArch64::SMIN_ZPmZ_S:
5822 : case AArch64::SMULH_ZPmZ_B:
5823 : case AArch64::SMULH_ZPmZ_D:
5824 : case AArch64::SMULH_ZPmZ_H:
5825 : case AArch64::SMULH_ZPmZ_S:
5826 : case AArch64::SPLICE_ZPZ_B:
5827 : case AArch64::SPLICE_ZPZ_D:
5828 : case AArch64::SPLICE_ZPZ_H:
5829 : case AArch64::SPLICE_ZPZ_S:
5830 : case AArch64::SUBR_ZPmZ_B:
5831 : case AArch64::SUBR_ZPmZ_D:
5832 : case AArch64::SUBR_ZPmZ_H:
5833 : case AArch64::SUBR_ZPmZ_S:
5834 : case AArch64::SUB_ZPmZ_B:
5835 : case AArch64::SUB_ZPmZ_D:
5836 : case AArch64::SUB_ZPmZ_H:
5837 : case AArch64::SUB_ZPmZ_S:
5838 : case AArch64::UABD_ZPmZ_B:
5839 : case AArch64::UABD_ZPmZ_D:
5840 : case AArch64::UABD_ZPmZ_H:
5841 : case AArch64::UABD_ZPmZ_S:
5842 : case AArch64::UDIVR_ZPmZ_D:
5843 : case AArch64::UDIVR_ZPmZ_S:
5844 : case AArch64::UDIV_ZPmZ_D:
5845 : case AArch64::UDIV_ZPmZ_S:
5846 : case AArch64::UMAX_ZPmZ_B:
5847 : case AArch64::UMAX_ZPmZ_D:
5848 : case AArch64::UMAX_ZPmZ_H:
5849 : case AArch64::UMAX_ZPmZ_S:
5850 : case AArch64::UMIN_ZPmZ_B:
5851 : case AArch64::UMIN_ZPmZ_D:
5852 : case AArch64::UMIN_ZPmZ_H:
5853 : case AArch64::UMIN_ZPmZ_S:
5854 : case AArch64::UMULH_ZPmZ_B:
5855 : case AArch64::UMULH_ZPmZ_D:
5856 : case AArch64::UMULH_ZPmZ_H:
5857 : case AArch64::UMULH_ZPmZ_S: {
5858 : // op: Pg
5859 0 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
5860 0 : Value |= (op & UINT64_C(7)) << 10;
5861 : // op: Zdn
5862 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
5863 0 : Value |= op & UINT64_C(31);
5864 : // op: Zm
5865 0 : op = getMachineOpValue(MI, MI.getOperand(3), Fixups, STI);
5866 0 : Value |= (op & UINT64_C(31)) << 5;
5867 0 : break;
5868 : }
5869 : case AArch64::FADD_ZPmI_D:
5870 : case AArch64::FADD_ZPmI_H:
5871 : case AArch64::FADD_ZPmI_S:
5872 : case AArch64::FMAXNM_ZPmI_D:
5873 : case AArch64::FMAXNM_ZPmI_H:
5874 : case AArch64::FMAXNM_ZPmI_S:
5875 : case AArch64::FMAX_ZPmI_D:
5876 : case AArch64::FMAX_ZPmI_H:
5877 : case AArch64::FMAX_ZPmI_S:
5878 : case AArch64::FMINNM_ZPmI_D:
5879 : case AArch64::FMINNM_ZPmI_H:
5880 : case AArch64::FMINNM_ZPmI_S:
5881 : case AArch64::FMIN_ZPmI_D:
5882 : case AArch64::FMIN_ZPmI_H:
5883 : case AArch64::FMIN_ZPmI_S:
5884 : case AArch64::FMUL_ZPmI_D:
5885 : case AArch64::FMUL_ZPmI_H:
5886 : case AArch64::FMUL_ZPmI_S:
5887 : case AArch64::FSUBR_ZPmI_D:
5888 : case AArch64::FSUBR_ZPmI_H:
5889 : case AArch64::FSUBR_ZPmI_S:
5890 : case AArch64::FSUB_ZPmI_D:
5891 : case AArch64::FSUB_ZPmI_H:
5892 : case AArch64::FSUB_ZPmI_S: {
5893 : // op: Pg
5894 0 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
5895 0 : Value |= (op & UINT64_C(7)) << 10;
5896 : // op: Zdn
5897 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
5898 0 : Value |= op & UINT64_C(31);
5899 : // op: i1
5900 0 : op = getMachineOpValue(MI, MI.getOperand(3), Fixups, STI);
5901 0 : Value |= (op & UINT64_C(1)) << 5;
5902 0 : break;
5903 : }
5904 : case AArch64::LSL_ZPmI_H: {
5905 : // op: Pg
5906 0 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
5907 0 : Value |= (op & UINT64_C(7)) << 10;
5908 : // op: Zdn
5909 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
5910 0 : Value |= op & UINT64_C(31);
5911 : // op: imm
5912 0 : op = getVecShiftL16OpValue(MI, 3, Fixups, STI);
5913 0 : Value |= (op & UINT64_C(15)) << 5;
5914 0 : break;
5915 : }
5916 : case AArch64::LSL_ZPmI_S: {
5917 : // op: Pg
5918 0 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
5919 0 : Value |= (op & UINT64_C(7)) << 10;
5920 : // op: Zdn
5921 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
5922 0 : Value |= op & UINT64_C(31);
5923 : // op: imm
5924 0 : op = getVecShiftL32OpValue(MI, 3, Fixups, STI);
5925 0 : Value |= (op & UINT64_C(31)) << 5;
5926 0 : break;
5927 : }
5928 : case AArch64::LSL_ZPmI_D: {
5929 : // op: Pg
5930 0 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
5931 0 : Value |= (op & UINT64_C(7)) << 10;
5932 : // op: Zdn
5933 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
5934 0 : Value |= op & UINT64_C(31);
5935 : // op: imm
5936 0 : op = getVecShiftL64OpValue(MI, 3, Fixups, STI);
5937 0 : Value |= (op & UINT64_C(32)) << 17;
5938 0 : Value |= (op & UINT64_C(31)) << 5;
5939 0 : break;
5940 : }
5941 : case AArch64::LSL_ZPmI_B: {
5942 : // op: Pg
5943 0 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
5944 0 : Value |= (op & UINT64_C(7)) << 10;
5945 : // op: Zdn
5946 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
5947 0 : Value |= op & UINT64_C(31);
5948 : // op: imm
5949 0 : op = getVecShiftL8OpValue(MI, 3, Fixups, STI);
5950 0 : Value |= (op & UINT64_C(7)) << 5;
5951 0 : break;
5952 : }
5953 : case AArch64::ASRD_ZPmI_H:
5954 : case AArch64::ASR_ZPmI_H:
5955 : case AArch64::LSR_ZPmI_H: {
5956 : // op: Pg
5957 0 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
5958 0 : Value |= (op & UINT64_C(7)) << 10;
5959 : // op: Zdn
5960 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
5961 0 : Value |= op & UINT64_C(31);
5962 : // op: imm
5963 0 : op = getVecShiftR16OpValue(MI, 3, Fixups, STI);
5964 0 : Value |= (op & UINT64_C(15)) << 5;
5965 0 : break;
5966 : }
5967 : case AArch64::ASRD_ZPmI_S:
5968 : case AArch64::ASR_ZPmI_S:
5969 : case AArch64::LSR_ZPmI_S: {
5970 : // op: Pg
5971 0 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
5972 0 : Value |= (op & UINT64_C(7)) << 10;
5973 : // op: Zdn
5974 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
5975 0 : Value |= op & UINT64_C(31);
5976 : // op: imm
5977 0 : op = getVecShiftR32OpValue(MI, 3, Fixups, STI);
5978 0 : Value |= (op & UINT64_C(31)) << 5;
5979 0 : break;
5980 : }
5981 : case AArch64::ASRD_ZPmI_D:
5982 : case AArch64::ASR_ZPmI_D:
5983 : case AArch64::LSR_ZPmI_D: {
5984 : // op: Pg
5985 0 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
5986 0 : Value |= (op & UINT64_C(7)) << 10;
5987 : // op: Zdn
5988 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
5989 0 : Value |= op & UINT64_C(31);
5990 : // op: imm
5991 0 : op = getVecShiftR64OpValue(MI, 3, Fixups, STI);
5992 0 : Value |= (op & UINT64_C(32)) << 17;
5993 0 : Value |= (op & UINT64_C(31)) << 5;
5994 0 : break;
5995 : }
5996 : case AArch64::ASRD_ZPmI_B:
5997 : case AArch64::ASR_ZPmI_B:
5998 : case AArch64::LSR_ZPmI_B: {
5999 : // op: Pg
6000 0 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
6001 0 : Value |= (op & UINT64_C(7)) << 10;
6002 : // op: Zdn
6003 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
6004 0 : Value |= op & UINT64_C(31);
6005 : // op: imm
6006 0 : op = getVecShiftR8OpValue(MI, 3, Fixups, STI);
6007 0 : Value |= (op & UINT64_C(7)) << 5;
6008 0 : break;
6009 : }
6010 : case AArch64::GLD1B_D_IMM_REAL:
6011 : case AArch64::GLD1B_S_IMM_REAL:
6012 : case AArch64::GLD1D_IMM_REAL:
6013 : case AArch64::GLD1H_D_IMM_REAL:
6014 : case AArch64::GLD1H_S_IMM_REAL:
6015 : case AArch64::GLD1SB_D_IMM_REAL:
6016 : case AArch64::GLD1SB_S_IMM_REAL:
6017 : case AArch64::GLD1SH_D_IMM_REAL:
6018 : case AArch64::GLD1SH_S_IMM_REAL:
6019 : case AArch64::GLD1SW_D_IMM_REAL:
6020 : case AArch64::GLD1W_D_IMM_REAL:
6021 : case AArch64::GLD1W_IMM_REAL:
6022 : case AArch64::GLDFF1B_D_IMM_REAL:
6023 : case AArch64::GLDFF1B_S_IMM_REAL:
6024 : case AArch64::GLDFF1D_IMM_REAL:
6025 : case AArch64::GLDFF1H_D_IMM_REAL:
6026 : case AArch64::GLDFF1H_S_IMM_REAL:
6027 : case AArch64::GLDFF1SB_D_IMM_REAL:
6028 : case AArch64::GLDFF1SB_S_IMM_REAL:
6029 : case AArch64::GLDFF1SH_D_IMM_REAL:
6030 : case AArch64::GLDFF1SH_S_IMM_REAL:
6031 : case AArch64::GLDFF1SW_D_IMM_REAL:
6032 : case AArch64::GLDFF1W_D_IMM_REAL:
6033 : case AArch64::GLDFF1W_IMM_REAL: {
6034 : // op: Pg
6035 0 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
6036 0 : Value |= (op & UINT64_C(7)) << 10;
6037 : // op: Zn
6038 0 : op = getMachineOpValue(MI, MI.getOperand(2), Fixups, STI);
6039 0 : Value |= (op & UINT64_C(31)) << 5;
6040 : // op: Zt
6041 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
6042 0 : Value |= op & UINT64_C(31);
6043 : // op: imm5
6044 0 : op = getMachineOpValue(MI, MI.getOperand(3), Fixups, STI);
6045 0 : Value |= (op & UINT64_C(31)) << 16;
6046 0 : break;
6047 : }
6048 : case AArch64::PRFB_D_PZI:
6049 : case AArch64::PRFB_S_PZI:
6050 : case AArch64::PRFD_D_PZI:
6051 : case AArch64::PRFD_S_PZI:
6052 : case AArch64::PRFH_D_PZI:
6053 : case AArch64::PRFH_S_PZI:
6054 : case AArch64::PRFW_D_PZI:
6055 : case AArch64::PRFW_S_PZI: {
6056 : // op: Pg
6057 0 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
6058 0 : Value |= (op & UINT64_C(7)) << 10;
6059 : // op: Zn
6060 0 : op = getMachineOpValue(MI, MI.getOperand(2), Fixups, STI);
6061 0 : Value |= (op & UINT64_C(31)) << 5;
6062 : // op: imm5
6063 0 : op = getMachineOpValue(MI, MI.getOperand(3), Fixups, STI);
6064 0 : Value |= (op & UINT64_C(31)) << 16;
6065 : // op: prfop
6066 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
6067 0 : Value |= op & UINT64_C(15);
6068 0 : break;
6069 : }
6070 : case AArch64::SST1B_D_IMM:
6071 : case AArch64::SST1B_S_IMM:
6072 : case AArch64::SST1D_IMM:
6073 : case AArch64::SST1H_D_IMM:
6074 : case AArch64::SST1H_S_IMM:
6075 : case AArch64::SST1W_D_IMM:
6076 : case AArch64::SST1W_IMM: {
6077 : // op: Pg
6078 0 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
6079 0 : Value |= (op & UINT64_C(7)) << 10;
6080 : // op: imm5
6081 0 : op = getMachineOpValue(MI, MI.getOperand(3), Fixups, STI);
6082 0 : Value |= (op & UINT64_C(31)) << 16;
6083 : // op: Zn
6084 0 : op = getMachineOpValue(MI, MI.getOperand(2), Fixups, STI);
6085 0 : Value |= (op & UINT64_C(31)) << 5;
6086 : // op: Zt
6087 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
6088 0 : Value |= op & UINT64_C(31);
6089 0 : break;
6090 : }
6091 : case AArch64::FCPY_ZPmI_D:
6092 : case AArch64::FCPY_ZPmI_H:
6093 : case AArch64::FCPY_ZPmI_S: {
6094 : // op: Pg
6095 0 : op = getMachineOpValue(MI, MI.getOperand(2), Fixups, STI);
6096 0 : Value |= (op & UINT64_C(15)) << 16;
6097 : // op: Zd
6098 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
6099 0 : Value |= op & UINT64_C(31);
6100 : // op: imm8
6101 0 : op = getMachineOpValue(MI, MI.getOperand(3), Fixups, STI);
6102 0 : Value |= (op & UINT64_C(255)) << 5;
6103 0 : break;
6104 : }
6105 : case AArch64::DECP_ZP_D:
6106 : case AArch64::DECP_ZP_H:
6107 : case AArch64::DECP_ZP_S:
6108 : case AArch64::INCP_ZP_D:
6109 : case AArch64::INCP_ZP_H:
6110 : case AArch64::INCP_ZP_S:
6111 : case AArch64::SQDECP_ZP_D:
6112 : case AArch64::SQDECP_ZP_H:
6113 : case AArch64::SQDECP_ZP_S:
6114 : case AArch64::SQINCP_ZP_D:
6115 : case AArch64::SQINCP_ZP_H:
6116 : case AArch64::SQINCP_ZP_S:
6117 : case AArch64::UQDECP_ZP_D:
6118 : case AArch64::UQDECP_ZP_H:
6119 : case AArch64::UQDECP_ZP_S:
6120 : case AArch64::UQINCP_ZP_D:
6121 : case AArch64::UQINCP_ZP_H:
6122 : case AArch64::UQINCP_ZP_S: {
6123 : // op: Pg
6124 0 : op = getMachineOpValue(MI, MI.getOperand(2), Fixups, STI);
6125 0 : Value |= (op & UINT64_C(15)) << 5;
6126 : // op: Zdn
6127 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
6128 0 : Value |= op & UINT64_C(31);
6129 0 : break;
6130 : }
6131 : case AArch64::CPY_ZPmR_B:
6132 : case AArch64::CPY_ZPmR_D:
6133 : case AArch64::CPY_ZPmR_H:
6134 : case AArch64::CPY_ZPmR_S: {
6135 : // op: Pg
6136 0 : op = getMachineOpValue(MI, MI.getOperand(2), Fixups, STI);
6137 0 : Value |= (op & UINT64_C(7)) << 10;
6138 : // op: Rn
6139 0 : op = getMachineOpValue(MI, MI.getOperand(3), Fixups, STI);
6140 0 : Value |= (op & UINT64_C(31)) << 5;
6141 : // op: Zd
6142 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
6143 0 : Value |= op & UINT64_C(31);
6144 0 : break;
6145 : }
6146 : case AArch64::CPY_ZPmV_B:
6147 : case AArch64::CPY_ZPmV_D:
6148 : case AArch64::CPY_ZPmV_H:
6149 : case AArch64::CPY_ZPmV_S: {
6150 : // op: Pg
6151 0 : op = getMachineOpValue(MI, MI.getOperand(2), Fixups, STI);
6152 0 : Value |= (op & UINT64_C(7)) << 10;
6153 : // op: Vn
6154 0 : op = getMachineOpValue(MI, MI.getOperand(3), Fixups, STI);
6155 0 : Value |= (op & UINT64_C(31)) << 5;
6156 : // op: Zd
6157 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
6158 0 : Value |= op & UINT64_C(31);
6159 0 : break;
6160 : }
6161 : case AArch64::ABS_ZPmZ_B:
6162 : case AArch64::ABS_ZPmZ_D:
6163 : case AArch64::ABS_ZPmZ_H:
6164 : case AArch64::ABS_ZPmZ_S:
6165 : case AArch64::CLS_ZPmZ_B:
6166 : case AArch64::CLS_ZPmZ_D:
6167 : case AArch64::CLS_ZPmZ_H:
6168 : case AArch64::CLS_ZPmZ_S:
6169 : case AArch64::CLZ_ZPmZ_B:
6170 : case AArch64::CLZ_ZPmZ_D:
6171 : case AArch64::CLZ_ZPmZ_H:
6172 : case AArch64::CLZ_ZPmZ_S:
6173 : case AArch64::CNOT_ZPmZ_B:
6174 : case AArch64::CNOT_ZPmZ_D:
6175 : case AArch64::CNOT_ZPmZ_H:
6176 : case AArch64::CNOT_ZPmZ_S:
6177 : case AArch64::CNT_ZPmZ_B:
6178 : case AArch64::CNT_ZPmZ_D:
6179 : case AArch64::CNT_ZPmZ_H:
6180 : case AArch64::CNT_ZPmZ_S:
6181 : case AArch64::FABS_ZPmZ_D:
6182 : case AArch64::FABS_ZPmZ_H:
6183 : case AArch64::FABS_ZPmZ_S:
6184 : case AArch64::FCVTZS_ZPmZ_DtoD:
6185 : case AArch64::FCVTZS_ZPmZ_DtoS:
6186 : case AArch64::FCVTZS_ZPmZ_HtoD:
6187 : case AArch64::FCVTZS_ZPmZ_HtoH:
6188 : case AArch64::FCVTZS_ZPmZ_HtoS:
6189 : case AArch64::FCVTZS_ZPmZ_StoD:
6190 : case AArch64::FCVTZS_ZPmZ_StoS:
6191 : case AArch64::FCVTZU_ZPmZ_DtoD:
6192 : case AArch64::FCVTZU_ZPmZ_DtoS:
6193 : case AArch64::FCVTZU_ZPmZ_HtoD:
6194 : case AArch64::FCVTZU_ZPmZ_HtoH:
6195 : case AArch64::FCVTZU_ZPmZ_HtoS:
6196 : case AArch64::FCVTZU_ZPmZ_StoD:
6197 : case AArch64::FCVTZU_ZPmZ_StoS:
6198 : case AArch64::FCVT_ZPmZ_DtoH:
6199 : case AArch64::FCVT_ZPmZ_DtoS:
6200 : case AArch64::FCVT_ZPmZ_HtoD:
6201 : case AArch64::FCVT_ZPmZ_HtoS:
6202 : case AArch64::FCVT_ZPmZ_StoD:
6203 : case AArch64::FCVT_ZPmZ_StoH:
6204 : case AArch64::FNEG_ZPmZ_D:
6205 : case AArch64::FNEG_ZPmZ_H:
6206 : case AArch64::FNEG_ZPmZ_S:
6207 : case AArch64::FRECPX_ZPmZ_D:
6208 : case AArch64::FRECPX_ZPmZ_H:
6209 : case AArch64::FRECPX_ZPmZ_S:
6210 : case AArch64::FRINTA_ZPmZ_D:
6211 : case AArch64::FRINTA_ZPmZ_H:
6212 : case AArch64::FRINTA_ZPmZ_S:
6213 : case AArch64::FRINTI_ZPmZ_D:
6214 : case AArch64::FRINTI_ZPmZ_H:
6215 : case AArch64::FRINTI_ZPmZ_S:
6216 : case AArch64::FRINTM_ZPmZ_D:
6217 : case AArch64::FRINTM_ZPmZ_H:
6218 : case AArch64::FRINTM_ZPmZ_S:
6219 : case AArch64::FRINTN_ZPmZ_D:
6220 : case AArch64::FRINTN_ZPmZ_H:
6221 : case AArch64::FRINTN_ZPmZ_S:
6222 : case AArch64::FRINTP_ZPmZ_D:
6223 : case AArch64::FRINTP_ZPmZ_H:
6224 : case AArch64::FRINTP_ZPmZ_S:
6225 : case AArch64::FRINTX_ZPmZ_D:
6226 : case AArch64::FRINTX_ZPmZ_H:
6227 : case AArch64::FRINTX_ZPmZ_S:
6228 : case AArch64::FRINTZ_ZPmZ_D:
6229 : case AArch64::FRINTZ_ZPmZ_H:
6230 : case AArch64::FRINTZ_ZPmZ_S:
6231 : case AArch64::FSQRT_ZPmZ_D:
6232 : case AArch64::FSQRT_ZPmZ_H:
6233 : case AArch64::FSQRT_ZPmZ_S:
6234 : case AArch64::MOVPRFX_ZPmZ_B:
6235 : case AArch64::MOVPRFX_ZPmZ_D:
6236 : case AArch64::MOVPRFX_ZPmZ_H:
6237 : case AArch64::MOVPRFX_ZPmZ_S:
6238 : case AArch64::NEG_ZPmZ_B:
6239 : case AArch64::NEG_ZPmZ_D:
6240 : case AArch64::NEG_ZPmZ_H:
6241 : case AArch64::NEG_ZPmZ_S:
6242 : case AArch64::NOT_ZPmZ_B:
6243 : case AArch64::NOT_ZPmZ_D:
6244 : case AArch64::NOT_ZPmZ_H:
6245 : case AArch64::NOT_ZPmZ_S:
6246 : case AArch64::SCVTF_ZPmZ_DtoD:
6247 : case AArch64::SCVTF_ZPmZ_DtoH:
6248 : case AArch64::SCVTF_ZPmZ_DtoS:
6249 : case AArch64::SCVTF_ZPmZ_HtoH:
6250 : case AArch64::SCVTF_ZPmZ_StoD:
6251 : case AArch64::SCVTF_ZPmZ_StoH:
6252 : case AArch64::SCVTF_ZPmZ_StoS:
6253 : case AArch64::SXTB_ZPmZ_D:
6254 : case AArch64::SXTB_ZPmZ_H:
6255 : case AArch64::SXTB_ZPmZ_S:
6256 : case AArch64::SXTH_ZPmZ_D:
6257 : case AArch64::SXTH_ZPmZ_S:
6258 : case AArch64::SXTW_ZPmZ_D:
6259 : case AArch64::UCVTF_ZPmZ_DtoD:
6260 : case AArch64::UCVTF_ZPmZ_DtoH:
6261 : case AArch64::UCVTF_ZPmZ_DtoS:
6262 : case AArch64::UCVTF_ZPmZ_HtoH:
6263 : case AArch64::UCVTF_ZPmZ_StoD:
6264 : case AArch64::UCVTF_ZPmZ_StoH:
6265 : case AArch64::UCVTF_ZPmZ_StoS:
6266 : case AArch64::UXTB_ZPmZ_D:
6267 : case AArch64::UXTB_ZPmZ_H:
6268 : case AArch64::UXTB_ZPmZ_S:
6269 : case AArch64::UXTH_ZPmZ_D:
6270 : case AArch64::UXTH_ZPmZ_S:
6271 : case AArch64::UXTW_ZPmZ_D: {
6272 : // op: Pg
6273 0 : op = getMachineOpValue(MI, MI.getOperand(2), Fixups, STI);
6274 0 : Value |= (op & UINT64_C(7)) << 10;
6275 : // op: Zd
6276 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
6277 0 : Value |= op & UINT64_C(31);
6278 : // op: Zn
6279 0 : op = getMachineOpValue(MI, MI.getOperand(3), Fixups, STI);
6280 0 : Value |= (op & UINT64_C(31)) << 5;
6281 0 : break;
6282 : }
6283 : case AArch64::WRFFR: {
6284 : // op: Pn
6285 0 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
6286 0 : Value |= (op & UINT64_C(15)) << 5;
6287 0 : break;
6288 : }
6289 : case AArch64::LDR_PXI:
6290 : case AArch64::STR_PXI: {
6291 : // op: Pt
6292 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
6293 0 : Value |= op & UINT64_C(15);
6294 : // op: Rn
6295 0 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
6296 0 : Value |= (op & UINT64_C(31)) << 5;
6297 : // op: imm9
6298 0 : op = getMachineOpValue(MI, MI.getOperand(2), Fixups, STI);
6299 0 : Value |= (op & UINT64_C(504)) << 13;
6300 0 : Value |= (op & UINT64_C(7)) << 10;
6301 0 : break;
6302 : }
6303 : case AArch64::AUTDZA:
6304 : case AArch64::AUTDZB:
6305 : case AArch64::AUTIZA:
6306 : case AArch64::AUTIZB:
6307 : case AArch64::PACDZA:
6308 : case AArch64::PACDZB:
6309 : case AArch64::PACIZA:
6310 : case AArch64::PACIZB:
6311 : case AArch64::XPACD:
6312 : case AArch64::XPACI: {
6313 : // op: Rd
6314 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
6315 0 : Value |= op & UINT64_C(31);
6316 0 : break;
6317 : }
6318 : case AArch64::ADDPL_XXI:
6319 : case AArch64::ADDVL_XXI: {
6320 : // op: Rd
6321 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
6322 0 : Value |= op & UINT64_C(31);
6323 : // op: Rn
6324 0 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
6325 0 : Value |= (op & UINT64_C(31)) << 16;
6326 : // op: imm6
6327 0 : op = getMachineOpValue(MI, MI.getOperand(2), Fixups, STI);
6328 0 : Value |= (op & UINT64_C(63)) << 5;
6329 0 : break;
6330 : }
6331 : case AArch64::ABSv16i8:
6332 : case AArch64::ABSv1i64:
6333 : case AArch64::ABSv2i32:
6334 : case AArch64::ABSv2i64:
6335 : case AArch64::ABSv4i16:
6336 : case AArch64::ABSv4i32:
6337 : case AArch64::ABSv8i16:
6338 : case AArch64::ABSv8i8:
6339 : case AArch64::ADDPv2i64p:
6340 : case AArch64::ADDVv16i8v:
6341 : case AArch64::ADDVv4i16v:
6342 : case AArch64::ADDVv4i32v:
6343 : case AArch64::ADDVv8i16v:
6344 : case AArch64::ADDVv8i8v:
6345 : case AArch64::AESIMCrr:
6346 : case AArch64::AESMCrr:
6347 : case AArch64::AUTDA:
6348 : case AArch64::AUTDB:
6349 : case AArch64::AUTIA:
6350 : case AArch64::AUTIB:
6351 : case AArch64::CLSWr:
6352 : case AArch64::CLSXr:
6353 : case AArch64::CLSv16i8:
6354 : case AArch64::CLSv2i32:
6355 : case AArch64::CLSv4i16:
6356 : case AArch64::CLSv4i32:
6357 : case AArch64::CLSv8i16:
6358 : case AArch64::CLSv8i8:
6359 : case AArch64::CLZWr:
6360 : case AArch64::CLZXr:
6361 : case AArch64::CLZv16i8:
6362 : case AArch64::CLZv2i32:
6363 : case AArch64::CLZv4i16:
6364 : case AArch64::CLZv4i32:
6365 : case AArch64::CLZv8i16:
6366 : case AArch64::CLZv8i8:
6367 : case AArch64::CMEQv16i8rz:
6368 : case AArch64::CMEQv1i64rz:
6369 : case AArch64::CMEQv2i32rz:
6370 : case AArch64::CMEQv2i64rz:
6371 : case AArch64::CMEQv4i16rz:
6372 : case AArch64::CMEQv4i32rz:
6373 : case AArch64::CMEQv8i16rz:
6374 : case AArch64::CMEQv8i8rz:
6375 : case AArch64::CMGEv16i8rz:
6376 : case AArch64::CMGEv1i64rz:
6377 : case AArch64::CMGEv2i32rz:
6378 : case AArch64::CMGEv2i64rz:
6379 : case AArch64::CMGEv4i16rz:
6380 : case AArch64::CMGEv4i32rz:
6381 : case AArch64::CMGEv8i16rz:
6382 : case AArch64::CMGEv8i8rz:
6383 : case AArch64::CMGTv16i8rz:
6384 : case AArch64::CMGTv1i64rz:
6385 : case AArch64::CMGTv2i32rz:
6386 : case AArch64::CMGTv2i64rz:
6387 : case AArch64::CMGTv4i16rz:
6388 : case AArch64::CMGTv4i32rz:
6389 : case AArch64::CMGTv8i16rz:
6390 : case AArch64::CMGTv8i8rz:
6391 : case AArch64::CMLEv16i8rz:
6392 : case AArch64::CMLEv1i64rz:
6393 : case AArch64::CMLEv2i32rz:
6394 : case AArch64::CMLEv2i64rz:
6395 : case AArch64::CMLEv4i16rz:
6396 : case AArch64::CMLEv4i32rz:
6397 : case AArch64::CMLEv8i16rz:
6398 : case AArch64::CMLEv8i8rz:
6399 : case AArch64::CMLTv16i8rz:
6400 : case AArch64::CMLTv1i64rz:
6401 : case AArch64::CMLTv2i32rz:
6402 : case AArch64::CMLTv2i64rz:
6403 : case AArch64::CMLTv4i16rz:
6404 : case AArch64::CMLTv4i32rz:
6405 : case AArch64::CMLTv8i16rz:
6406 : case AArch64::CMLTv8i8rz:
6407 : case AArch64::CNTv16i8:
6408 : case AArch64::CNTv8i8:
6409 : case AArch64::DUPv16i8gpr:
6410 : case AArch64::DUPv2i32gpr:
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6416 : case AArch64::FABSDr:
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6418 : case AArch64::FABSSr:
6419 : case AArch64::FABSv2f32:
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6421 : case AArch64::FABSv4f16:
6422 : case AArch64::FABSv4f32:
6423 : case AArch64::FABSv8f16:
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6425 : case AArch64::FADDPv2i32p:
6426 : case AArch64::FADDPv2i64p:
6427 : case AArch64::FCMEQv1i16rz:
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6431 : case AArch64::FCMEQv2i64rz:
6432 : case AArch64::FCMEQv4i16rz:
6433 : case AArch64::FCMEQv4i32rz:
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6439 : case AArch64::FCMGEv2i64rz:
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6442 : case AArch64::FCMGEv8i16rz:
6443 : case AArch64::FCMGTv1i16rz:
6444 : case AArch64::FCMGTv1i32rz:
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6455 : case AArch64::FCMLEv2i64rz:
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6457 : case AArch64::FCMLEv4i32rz:
6458 : case AArch64::FCMLEv8i16rz:
6459 : case AArch64::FCMLTv1i16rz:
6460 : case AArch64::FCMLTv1i32rz:
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6463 : case AArch64::FCMLTv2i64rz:
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6465 : case AArch64::FCMLTv4i32rz:
6466 : case AArch64::FCMLTv8i16rz:
6467 : case AArch64::FCVTASUWDr:
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6469 : case AArch64::FCVTASUWSr:
6470 : case AArch64::FCVTASUXDr:
6471 : case AArch64::FCVTASUXHr:
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6484 : case AArch64::FCVTAUUXDr:
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6495 : case AArch64::FCVTDHr:
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6502 : case AArch64::FCVTLv8i16:
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6957 : case AArch64::UMULLv8i16_indexed: {
6958 : // op: Rd
6959 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
6960 0 : Value |= op & UINT64_C(31);
6961 : // op: Rn
6962 0 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
6963 0 : Value |= (op & UINT64_C(31)) << 5;
6964 : // op: Rm
6965 0 : op = getMachineOpValue(MI, MI.getOperand(2), Fixups, STI);
6966 0 : Value |= (op & UINT64_C(15)) << 16;
6967 : // op: idx
6968 0 : op = getMachineOpValue(MI, MI.getOperand(3), Fixups, STI);
6969 0 : Value |= (op & UINT64_C(3)) << 20;
6970 0 : Value |= (op & UINT64_C(4)) << 9;
6971 0 : break;
6972 : }
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7601 : case AArch64::USUBWv4i16_v4i32:
7602 : case AArch64::USUBWv4i32_v2i64:
7603 : case AArch64::USUBWv8i16_v4i32:
7604 : case AArch64::USUBWv8i8_v8i16:
7605 : case AArch64::UZP1v16i8:
7606 : case AArch64::UZP1v2i32:
7607 : case AArch64::UZP1v2i64:
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7609 : case AArch64::UZP1v4i32:
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7611 : case AArch64::UZP1v8i8:
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7623 : case AArch64::ZIP1v4i32:
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7625 : case AArch64::ZIP1v8i8:
7626 : case AArch64::ZIP2v16i8:
7627 : case AArch64::ZIP2v2i32:
7628 : case AArch64::ZIP2v2i64:
7629 : case AArch64::ZIP2v4i16:
7630 : case AArch64::ZIP2v4i32:
7631 : case AArch64::ZIP2v8i16:
7632 : case AArch64::ZIP2v8i8: {
7633 : // op: Rd
7634 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
7635 0 : Value |= op & UINT64_C(31);
7636 : // op: Rn
7637 0 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
7638 0 : Value |= (op & UINT64_C(31)) << 5;
7639 : // op: Rm
7640 0 : op = getMachineOpValue(MI, MI.getOperand(2), Fixups, STI);
7641 0 : Value |= (op & UINT64_C(31)) << 16;
7642 0 : break;
7643 : }
7644 : case AArch64::FMADDDrrr:
7645 : case AArch64::FMADDHrrr:
7646 : case AArch64::FMADDSrrr:
7647 : case AArch64::FMSUBDrrr:
7648 : case AArch64::FMSUBHrrr:
7649 : case AArch64::FMSUBSrrr:
7650 : case AArch64::FNMADDDrrr:
7651 : case AArch64::FNMADDHrrr:
7652 : case AArch64::FNMADDSrrr:
7653 : case AArch64::FNMSUBDrrr:
7654 : case AArch64::FNMSUBHrrr:
7655 : case AArch64::FNMSUBSrrr:
7656 : case AArch64::MADDWrrr:
7657 : case AArch64::MADDXrrr:
7658 : case AArch64::MSUBWrrr:
7659 : case AArch64::MSUBXrrr:
7660 : case AArch64::SMADDLrrr:
7661 : case AArch64::SMSUBLrrr:
7662 : case AArch64::UMADDLrrr:
7663 : case AArch64::UMSUBLrrr: {
7664 : // op: Rd
7665 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
7666 0 : Value |= op & UINT64_C(31);
7667 : // op: Rn
7668 0 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
7669 0 : Value |= (op & UINT64_C(31)) << 5;
7670 : // op: Rm
7671 0 : op = getMachineOpValue(MI, MI.getOperand(2), Fixups, STI);
7672 0 : Value |= (op & UINT64_C(31)) << 16;
7673 : // op: Ra
7674 0 : op = getMachineOpValue(MI, MI.getOperand(3), Fixups, STI);
7675 0 : Value |= (op & UINT64_C(31)) << 10;
7676 0 : break;
7677 : }
7678 : case AArch64::CSELWr:
7679 : case AArch64::CSELXr:
7680 : case AArch64::CSINCWr:
7681 : case AArch64::CSINCXr:
7682 : case AArch64::CSINVWr:
7683 : case AArch64::CSINVXr:
7684 : case AArch64::CSNEGWr:
7685 : case AArch64::CSNEGXr:
7686 : case AArch64::FCSELDrrr:
7687 : case AArch64::FCSELHrrr:
7688 : case AArch64::FCSELSrrr: {
7689 : // op: Rd
7690 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
7691 0 : Value |= op & UINT64_C(31);
7692 : // op: Rn
7693 0 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
7694 0 : Value |= (op & UINT64_C(31)) << 5;
7695 : // op: Rm
7696 0 : op = getMachineOpValue(MI, MI.getOperand(2), Fixups, STI);
7697 0 : Value |= (op & UINT64_C(31)) << 16;
7698 : // op: cond
7699 0 : op = getMachineOpValue(MI, MI.getOperand(3), Fixups, STI);
7700 0 : Value |= (op & UINT64_C(15)) << 12;
7701 0 : break;
7702 : }
7703 : case AArch64::ADDSXrx64:
7704 : case AArch64::ADDXrx64:
7705 : case AArch64::SUBSXrx64:
7706 : case AArch64::SUBXrx64: {
7707 : // op: Rd
7708 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
7709 0 : Value |= op & UINT64_C(31);
7710 : // op: Rn
7711 0 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
7712 0 : Value |= (op & UINT64_C(31)) << 5;
7713 : // op: Rm
7714 0 : op = getMachineOpValue(MI, MI.getOperand(2), Fixups, STI);
7715 0 : Value |= (op & UINT64_C(31)) << 16;
7716 : // op: ext
7717 0 : op = getMachineOpValue(MI, MI.getOperand(3), Fixups, STI);
7718 0 : Value |= (op & UINT64_C(32)) << 10;
7719 0 : Value |= (op & UINT64_C(7)) << 10;
7720 0 : break;
7721 : }
7722 : case AArch64::ADDSWrx:
7723 : case AArch64::ADDSXrx:
7724 : case AArch64::ADDWrx:
7725 : case AArch64::ADDXrx:
7726 : case AArch64::SUBSWrx:
7727 : case AArch64::SUBSXrx:
7728 : case AArch64::SUBWrx:
7729 : case AArch64::SUBXrx: {
7730 : // op: Rd
7731 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
7732 0 : Value |= op & UINT64_C(31);
7733 : // op: Rn
7734 0 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
7735 0 : Value |= (op & UINT64_C(31)) << 5;
7736 : // op: Rm
7737 0 : op = getMachineOpValue(MI, MI.getOperand(2), Fixups, STI);
7738 0 : Value |= (op & UINT64_C(31)) << 16;
7739 : // op: ext
7740 0 : op = getMachineOpValue(MI, MI.getOperand(3), Fixups, STI);
7741 0 : Value |= (op & UINT64_C(63)) << 10;
7742 0 : break;
7743 : }
7744 : case AArch64::FMULXv1i64_indexed:
7745 : case AArch64::FMULXv2i64_indexed:
7746 : case AArch64::FMULv1i64_indexed:
7747 : case AArch64::FMULv2i64_indexed: {
7748 : // op: Rd
7749 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
7750 0 : Value |= op & UINT64_C(31);
7751 : // op: Rn
7752 0 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
7753 0 : Value |= (op & UINT64_C(31)) << 5;
7754 : // op: Rm
7755 0 : op = getMachineOpValue(MI, MI.getOperand(2), Fixups, STI);
7756 0 : Value |= (op & UINT64_C(31)) << 16;
7757 : // op: idx
7758 0 : op = getMachineOpValue(MI, MI.getOperand(3), Fixups, STI);
7759 0 : Value |= (op & UINT64_C(1)) << 11;
7760 0 : break;
7761 : }
7762 : case AArch64::FMULXv1i32_indexed:
7763 : case AArch64::FMULXv2i32_indexed:
7764 : case AArch64::FMULXv4i32_indexed:
7765 : case AArch64::FMULv1i32_indexed:
7766 : case AArch64::FMULv2i32_indexed:
7767 : case AArch64::FMULv4i32_indexed:
7768 : case AArch64::MULv2i32_indexed:
7769 : case AArch64::MULv4i32_indexed:
7770 : case AArch64::SMULLv2i32_indexed:
7771 : case AArch64::SMULLv4i32_indexed:
7772 : case AArch64::SQDMULHv1i32_indexed:
7773 : case AArch64::SQDMULHv2i32_indexed:
7774 : case AArch64::SQDMULHv4i32_indexed:
7775 : case AArch64::SQDMULLv1i64_indexed:
7776 : case AArch64::SQDMULLv2i32_indexed:
7777 : case AArch64::SQDMULLv4i32_indexed:
7778 : case AArch64::SQRDMULHv1i32_indexed:
7779 : case AArch64::SQRDMULHv2i32_indexed:
7780 : case AArch64::SQRDMULHv4i32_indexed:
7781 : case AArch64::UMULLv2i32_indexed:
7782 : case AArch64::UMULLv4i32_indexed: {
7783 : // op: Rd
7784 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
7785 0 : Value |= op & UINT64_C(31);
7786 : // op: Rn
7787 0 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
7788 0 : Value |= (op & UINT64_C(31)) << 5;
7789 : // op: Rm
7790 0 : op = getMachineOpValue(MI, MI.getOperand(2), Fixups, STI);
7791 0 : Value |= (op & UINT64_C(31)) << 16;
7792 : // op: idx
7793 0 : op = getMachineOpValue(MI, MI.getOperand(3), Fixups, STI);
7794 0 : Value |= (op & UINT64_C(1)) << 21;
7795 0 : Value |= (op & UINT64_C(2)) << 10;
7796 0 : break;
7797 : }
7798 : case AArch64::EXTv16i8: {
7799 : // op: Rd
7800 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
7801 0 : Value |= op & UINT64_C(31);
7802 : // op: Rn
7803 0 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
7804 0 : Value |= (op & UINT64_C(31)) << 5;
7805 : // op: Rm
7806 0 : op = getMachineOpValue(MI, MI.getOperand(2), Fixups, STI);
7807 0 : Value |= (op & UINT64_C(31)) << 16;
7808 : // op: imm
7809 0 : op = getMachineOpValue(MI, MI.getOperand(3), Fixups, STI);
7810 0 : Value |= (op & UINT64_C(15)) << 11;
7811 0 : break;
7812 : }
7813 : case AArch64::EXTRWrri: {
7814 : // op: Rd
7815 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
7816 0 : Value |= op & UINT64_C(31);
7817 : // op: Rn
7818 0 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
7819 0 : Value |= (op & UINT64_C(31)) << 5;
7820 : // op: Rm
7821 0 : op = getMachineOpValue(MI, MI.getOperand(2), Fixups, STI);
7822 0 : Value |= (op & UINT64_C(31)) << 16;
7823 : // op: imm
7824 0 : op = getMachineOpValue(MI, MI.getOperand(3), Fixups, STI);
7825 0 : Value |= (op & UINT64_C(31)) << 10;
7826 0 : break;
7827 : }
7828 : case AArch64::EXTRXrri: {
7829 : // op: Rd
7830 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
7831 0 : Value |= op & UINT64_C(31);
7832 : // op: Rn
7833 0 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
7834 0 : Value |= (op & UINT64_C(31)) << 5;
7835 : // op: Rm
7836 0 : op = getMachineOpValue(MI, MI.getOperand(2), Fixups, STI);
7837 0 : Value |= (op & UINT64_C(31)) << 16;
7838 : // op: imm
7839 0 : op = getMachineOpValue(MI, MI.getOperand(3), Fixups, STI);
7840 0 : Value |= (op & UINT64_C(63)) << 10;
7841 0 : break;
7842 : }
7843 : case AArch64::EXTv8i8: {
7844 : // op: Rd
7845 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
7846 0 : Value |= op & UINT64_C(31);
7847 : // op: Rn
7848 0 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
7849 0 : Value |= (op & UINT64_C(31)) << 5;
7850 : // op: Rm
7851 0 : op = getMachineOpValue(MI, MI.getOperand(2), Fixups, STI);
7852 0 : Value |= (op & UINT64_C(31)) << 16;
7853 : // op: imm
7854 0 : op = getMachineOpValue(MI, MI.getOperand(3), Fixups, STI);
7855 0 : Value |= (op & UINT64_C(7)) << 11;
7856 0 : break;
7857 : }
7858 : case AArch64::FCADDv2f32:
7859 : case AArch64::FCADDv2f64:
7860 : case AArch64::FCADDv4f16:
7861 : case AArch64::FCADDv4f32:
7862 : case AArch64::FCADDv8f16: {
7863 : // op: Rd
7864 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
7865 0 : Value |= op & UINT64_C(31);
7866 : // op: Rn
7867 0 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
7868 0 : Value |= (op & UINT64_C(31)) << 5;
7869 : // op: Rm
7870 0 : op = getMachineOpValue(MI, MI.getOperand(2), Fixups, STI);
7871 0 : Value |= (op & UINT64_C(31)) << 16;
7872 : // op: rot
7873 0 : op = getMachineOpValue(MI, MI.getOperand(3), Fixups, STI);
7874 0 : Value |= (op & UINT64_C(1)) << 12;
7875 0 : break;
7876 : }
7877 : case AArch64::SMULHrr:
7878 : case AArch64::UMULHrr: {
7879 : // op: Rd
7880 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
7881 0 : Value |= op & UINT64_C(31);
7882 : // op: Rn
7883 0 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
7884 0 : Value |= (op & UINT64_C(31)) << 5;
7885 : // op: Rm
7886 0 : op = getMachineOpValue(MI, MI.getOperand(2), Fixups, STI);
7887 0 : Value |= (op & UINT64_C(31)) << 16;
7888 0 : Value = fixMulHigh(MI, Value, STI);
7889 0 : break;
7890 : }
7891 : case AArch64::DUPv2i64lane:
7892 : case AArch64::UMOVvi64: {
7893 : // op: Rd
7894 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
7895 0 : Value |= op & UINT64_C(31);
7896 : // op: Rn
7897 0 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
7898 0 : Value |= (op & UINT64_C(31)) << 5;
7899 : // op: idx
7900 0 : op = getMachineOpValue(MI, MI.getOperand(2), Fixups, STI);
7901 0 : Value |= (op & UINT64_C(1)) << 20;
7902 0 : break;
7903 : }
7904 : case AArch64::DUPv16i8lane:
7905 : case AArch64::DUPv8i8lane:
7906 : case AArch64::SMOVvi8to32:
7907 : case AArch64::SMOVvi8to64:
7908 : case AArch64::UMOVvi8: {
7909 : // op: Rd
7910 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
7911 0 : Value |= op & UINT64_C(31);
7912 : // op: Rn
7913 0 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
7914 0 : Value |= (op & UINT64_C(31)) << 5;
7915 : // op: idx
7916 0 : op = getMachineOpValue(MI, MI.getOperand(2), Fixups, STI);
7917 0 : Value |= (op & UINT64_C(15)) << 17;
7918 0 : break;
7919 : }
7920 : case AArch64::DUPv2i32lane:
7921 : case AArch64::DUPv4i32lane:
7922 : case AArch64::SMOVvi32to64:
7923 : case AArch64::UMOVvi32: {
7924 : // op: Rd
7925 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
7926 0 : Value |= op & UINT64_C(31);
7927 : // op: Rn
7928 0 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
7929 0 : Value |= (op & UINT64_C(31)) << 5;
7930 : // op: idx
7931 0 : op = getMachineOpValue(MI, MI.getOperand(2), Fixups, STI);
7932 0 : Value |= (op & UINT64_C(3)) << 19;
7933 0 : break;
7934 : }
7935 : case AArch64::DUPv4i16lane:
7936 : case AArch64::DUPv8i16lane:
7937 : case AArch64::SMOVvi16to32:
7938 : case AArch64::SMOVvi16to64:
7939 : case AArch64::UMOVvi16: {
7940 : // op: Rd
7941 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
7942 0 : Value |= op & UINT64_C(31);
7943 : // op: Rn
7944 0 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
7945 0 : Value |= (op & UINT64_C(31)) << 5;
7946 : // op: idx
7947 0 : op = getMachineOpValue(MI, MI.getOperand(2), Fixups, STI);
7948 0 : Value |= (op & UINT64_C(7)) << 18;
7949 0 : break;
7950 : }
7951 : case AArch64::ADDSWri:
7952 : case AArch64::ADDSXri:
7953 : case AArch64::ADDWri:
7954 : case AArch64::ADDXri:
7955 : case AArch64::SUBSWri:
7956 : case AArch64::SUBSXri:
7957 : case AArch64::SUBWri:
7958 : case AArch64::SUBXri: {
7959 : // op: Rd
7960 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
7961 0 : Value |= op & UINT64_C(31);
7962 : // op: Rn
7963 0 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
7964 0 : Value |= (op & UINT64_C(31)) << 5;
7965 : // op: imm
7966 0 : op = getAddSubImmOpValue(MI, 2, Fixups, STI);
7967 0 : Value |= (op & UINT64_C(16383)) << 10;
7968 0 : break;
7969 : }
7970 : case AArch64::ANDSWri:
7971 : case AArch64::ANDWri:
7972 : case AArch64::EORWri:
7973 : case AArch64::ORRWri: {
7974 : // op: Rd
7975 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
7976 0 : Value |= op & UINT64_C(31);
7977 : // op: Rn
7978 0 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
7979 0 : Value |= (op & UINT64_C(31)) << 5;
7980 : // op: imm
7981 0 : op = getMachineOpValue(MI, MI.getOperand(2), Fixups, STI);
7982 0 : Value |= (op & UINT64_C(4095)) << 10;
7983 0 : break;
7984 : }
7985 : case AArch64::ANDSXri:
7986 : case AArch64::ANDXri:
7987 : case AArch64::EORXri:
7988 : case AArch64::ORRXri: {
7989 : // op: Rd
7990 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
7991 0 : Value |= op & UINT64_C(31);
7992 : // op: Rn
7993 0 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
7994 0 : Value |= (op & UINT64_C(31)) << 5;
7995 : // op: imm
7996 0 : op = getMachineOpValue(MI, MI.getOperand(2), Fixups, STI);
7997 0 : Value |= (op & UINT64_C(8191)) << 10;
7998 0 : break;
7999 : }
8000 : case AArch64::SHLv4i16_shift:
8001 : case AArch64::SHLv8i16_shift:
8002 : case AArch64::SQSHLUh:
8003 : case AArch64::SQSHLUv4i16_shift:
8004 : case AArch64::SQSHLUv8i16_shift:
8005 : case AArch64::SQSHLh:
8006 : case AArch64::SQSHLv4i16_shift:
8007 : case AArch64::SQSHLv8i16_shift:
8008 : case AArch64::SSHLLv4i16_shift:
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8011 : case AArch64::UQSHLv4i16_shift:
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8013 : case AArch64::USHLLv4i16_shift:
8014 : case AArch64::USHLLv8i16_shift: {
8015 : // op: Rd
8016 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
8017 0 : Value |= op & UINT64_C(31);
8018 : // op: Rn
8019 0 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
8020 0 : Value |= (op & UINT64_C(31)) << 5;
8021 : // op: imm
8022 0 : op = getVecShiftL16OpValue(MI, 2, Fixups, STI);
8023 0 : Value |= (op & UINT64_C(15)) << 16;
8024 0 : break;
8025 : }
8026 : case AArch64::SHLv2i32_shift:
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8032 : case AArch64::SQSHLv2i32_shift:
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8034 : case AArch64::SSHLLv2i32_shift:
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8037 : case AArch64::UQSHLv2i32_shift:
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8039 : case AArch64::USHLLv2i32_shift:
8040 : case AArch64::USHLLv4i32_shift: {
8041 : // op: Rd
8042 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
8043 0 : Value |= op & UINT64_C(31);
8044 : // op: Rn
8045 0 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
8046 0 : Value |= (op & UINT64_C(31)) << 5;
8047 : // op: imm
8048 0 : op = getVecShiftL32OpValue(MI, 2, Fixups, STI);
8049 0 : Value |= (op & UINT64_C(31)) << 16;
8050 0 : break;
8051 : }
8052 : case AArch64::SHLd:
8053 : case AArch64::SHLv2i64_shift:
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8055 : case AArch64::SQSHLUv2i64_shift:
8056 : case AArch64::SQSHLd:
8057 : case AArch64::SQSHLv2i64_shift:
8058 : case AArch64::UQSHLd:
8059 : case AArch64::UQSHLv2i64_shift: {
8060 : // op: Rd
8061 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
8062 0 : Value |= op & UINT64_C(31);
8063 : // op: Rn
8064 0 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
8065 0 : Value |= (op & UINT64_C(31)) << 5;
8066 : // op: imm
8067 0 : op = getVecShiftL64OpValue(MI, 2, Fixups, STI);
8068 0 : Value |= (op & UINT64_C(63)) << 16;
8069 0 : break;
8070 : }
8071 : case AArch64::SHLv16i8_shift:
8072 : case AArch64::SHLv8i8_shift:
8073 : case AArch64::SQSHLUb:
8074 : case AArch64::SQSHLUv16i8_shift:
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8077 : case AArch64::SQSHLv16i8_shift:
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8080 : case AArch64::SSHLLv8i8_shift:
8081 : case AArch64::UQSHLb:
8082 : case AArch64::UQSHLv16i8_shift:
8083 : case AArch64::UQSHLv8i8_shift:
8084 : case AArch64::USHLLv16i8_shift:
8085 : case AArch64::USHLLv8i8_shift: {
8086 : // op: Rd
8087 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
8088 0 : Value |= op & UINT64_C(31);
8089 : // op: Rn
8090 0 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
8091 0 : Value |= (op & UINT64_C(31)) << 5;
8092 : // op: imm
8093 0 : op = getVecShiftL8OpValue(MI, 2, Fixups, STI);
8094 0 : Value |= (op & UINT64_C(7)) << 16;
8095 0 : break;
8096 : }
8097 : case AArch64::FCVTZSh:
8098 : case AArch64::FCVTZSv4i16_shift:
8099 : case AArch64::FCVTZSv8i16_shift:
8100 : case AArch64::FCVTZUh:
8101 : case AArch64::FCVTZUv4i16_shift:
8102 : case AArch64::FCVTZUv8i16_shift:
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8107 : case AArch64::SQRSHRUNh:
8108 : case AArch64::SQSHRNh:
8109 : case AArch64::SQSHRUNh:
8110 : case AArch64::SRSHRv4i16_shift:
8111 : case AArch64::SRSHRv8i16_shift:
8112 : case AArch64::SSHRv4i16_shift:
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8115 : case AArch64::UCVTFv4i16_shift:
8116 : case AArch64::UCVTFv8i16_shift:
8117 : case AArch64::UQRSHRNh:
8118 : case AArch64::UQSHRNh:
8119 : case AArch64::URSHRv4i16_shift:
8120 : case AArch64::URSHRv8i16_shift:
8121 : case AArch64::USHRv4i16_shift:
8122 : case AArch64::USHRv8i16_shift: {
8123 : // op: Rd
8124 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
8125 0 : Value |= op & UINT64_C(31);
8126 : // op: Rn
8127 0 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
8128 0 : Value |= (op & UINT64_C(31)) << 5;
8129 : // op: imm
8130 0 : op = getVecShiftR16OpValue(MI, 2, Fixups, STI);
8131 0 : Value |= (op & UINT64_C(15)) << 16;
8132 0 : break;
8133 : }
8134 : case AArch64::RSHRNv8i8_shift:
8135 : case AArch64::SHRNv8i8_shift:
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8139 : case AArch64::SQSHRUNv8i8_shift:
8140 : case AArch64::UQRSHRNv8i8_shift:
8141 : case AArch64::UQSHRNv8i8_shift: {
8142 : // op: Rd
8143 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
8144 0 : Value |= op & UINT64_C(31);
8145 : // op: Rn
8146 0 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
8147 0 : Value |= (op & UINT64_C(31)) << 5;
8148 : // op: imm
8149 0 : op = getVecShiftR16OpValue(MI, 2, Fixups, STI);
8150 0 : Value |= (op & UINT64_C(7)) << 16;
8151 0 : break;
8152 : }
8153 : case AArch64::RSHRNv4i16_shift:
8154 : case AArch64::SHRNv4i16_shift:
8155 : case AArch64::SQRSHRNv4i16_shift:
8156 : case AArch64::SQRSHRUNv4i16_shift:
8157 : case AArch64::SQSHRNv4i16_shift:
8158 : case AArch64::SQSHRUNv4i16_shift:
8159 : case AArch64::UQRSHRNv4i16_shift:
8160 : case AArch64::UQSHRNv4i16_shift: {
8161 : // op: Rd
8162 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
8163 0 : Value |= op & UINT64_C(31);
8164 : // op: Rn
8165 0 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
8166 0 : Value |= (op & UINT64_C(31)) << 5;
8167 : // op: imm
8168 0 : op = getVecShiftR32OpValue(MI, 2, Fixups, STI);
8169 0 : Value |= (op & UINT64_C(15)) << 16;
8170 0 : break;
8171 : }
8172 : case AArch64::FCVTZSs:
8173 : case AArch64::FCVTZSv2i32_shift:
8174 : case AArch64::FCVTZSv4i32_shift:
8175 : case AArch64::FCVTZUs:
8176 : case AArch64::FCVTZUv2i32_shift:
8177 : case AArch64::FCVTZUv4i32_shift:
8178 : case AArch64::SCVTFs:
8179 : case AArch64::SCVTFv2i32_shift:
8180 : case AArch64::SCVTFv4i32_shift:
8181 : case AArch64::SQRSHRNs:
8182 : case AArch64::SQRSHRUNs:
8183 : case AArch64::SQSHRNs:
8184 : case AArch64::SQSHRUNs:
8185 : case AArch64::SRSHRv2i32_shift:
8186 : case AArch64::SRSHRv4i32_shift:
8187 : case AArch64::SSHRv2i32_shift:
8188 : case AArch64::SSHRv4i32_shift:
8189 : case AArch64::UCVTFs:
8190 : case AArch64::UCVTFv2i32_shift:
8191 : case AArch64::UCVTFv4i32_shift:
8192 : case AArch64::UQRSHRNs:
8193 : case AArch64::UQSHRNs:
8194 : case AArch64::URSHRv2i32_shift:
8195 : case AArch64::URSHRv4i32_shift:
8196 : case AArch64::USHRv2i32_shift:
8197 : case AArch64::USHRv4i32_shift: {
8198 : // op: Rd
8199 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
8200 0 : Value |= op & UINT64_C(31);
8201 : // op: Rn
8202 0 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
8203 0 : Value |= (op & UINT64_C(31)) << 5;
8204 : // op: imm
8205 0 : op = getVecShiftR32OpValue(MI, 2, Fixups, STI);
8206 0 : Value |= (op & UINT64_C(31)) << 16;
8207 0 : break;
8208 : }
8209 : case AArch64::RSHRNv2i32_shift:
8210 : case AArch64::SHRNv2i32_shift:
8211 : case AArch64::SQRSHRNv2i32_shift:
8212 : case AArch64::SQRSHRUNv2i32_shift:
8213 : case AArch64::SQSHRNv2i32_shift:
8214 : case AArch64::SQSHRUNv2i32_shift:
8215 : case AArch64::UQRSHRNv2i32_shift:
8216 : case AArch64::UQSHRNv2i32_shift: {
8217 : // op: Rd
8218 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
8219 0 : Value |= op & UINT64_C(31);
8220 : // op: Rn
8221 0 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
8222 0 : Value |= (op & UINT64_C(31)) << 5;
8223 : // op: imm
8224 0 : op = getVecShiftR64OpValue(MI, 2, Fixups, STI);
8225 0 : Value |= (op & UINT64_C(31)) << 16;
8226 0 : break;
8227 : }
8228 : case AArch64::FCVTZSd:
8229 : case AArch64::FCVTZSv2i64_shift:
8230 : case AArch64::FCVTZUd:
8231 : case AArch64::FCVTZUv2i64_shift:
8232 : case AArch64::SCVTFd:
8233 : case AArch64::SCVTFv2i64_shift:
8234 : case AArch64::SRSHRd:
8235 : case AArch64::SRSHRv2i64_shift:
8236 : case AArch64::SSHRd:
8237 : case AArch64::SSHRv2i64_shift:
8238 : case AArch64::UCVTFd:
8239 : case AArch64::UCVTFv2i64_shift:
8240 : case AArch64::URSHRd:
8241 : case AArch64::URSHRv2i64_shift:
8242 : case AArch64::USHRd:
8243 : case AArch64::USHRv2i64_shift: {
8244 : // op: Rd
8245 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
8246 0 : Value |= op & UINT64_C(31);
8247 : // op: Rn
8248 0 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
8249 0 : Value |= (op & UINT64_C(31)) << 5;
8250 : // op: imm
8251 0 : op = getVecShiftR64OpValue(MI, 2, Fixups, STI);
8252 0 : Value |= (op & UINT64_C(63)) << 16;
8253 0 : break;
8254 : }
8255 : case AArch64::SQRSHRNb:
8256 : case AArch64::SQRSHRUNb:
8257 : case AArch64::SQSHRNb:
8258 : case AArch64::SQSHRUNb:
8259 : case AArch64::SRSHRv16i8_shift:
8260 : case AArch64::SRSHRv8i8_shift:
8261 : case AArch64::SSHRv16i8_shift:
8262 : case AArch64::SSHRv8i8_shift:
8263 : case AArch64::UQRSHRNb:
8264 : case AArch64::UQSHRNb:
8265 : case AArch64::URSHRv16i8_shift:
8266 : case AArch64::URSHRv8i8_shift:
8267 : case AArch64::USHRv16i8_shift:
8268 : case AArch64::USHRv8i8_shift: {
8269 : // op: Rd
8270 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
8271 0 : Value |= op & UINT64_C(31);
8272 : // op: Rn
8273 0 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
8274 0 : Value |= (op & UINT64_C(31)) << 5;
8275 : // op: imm
8276 0 : op = getVecShiftR8OpValue(MI, 2, Fixups, STI);
8277 0 : Value |= (op & UINT64_C(7)) << 16;
8278 0 : break;
8279 : }
8280 : case AArch64::ADDG:
8281 : case AArch64::SUBG: {
8282 : // op: Rd
8283 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
8284 0 : Value |= op & UINT64_C(31);
8285 : // op: Rn
8286 0 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
8287 0 : Value |= (op & UINT64_C(31)) << 5;
8288 : // op: imm6
8289 0 : op = getMachineOpValue(MI, MI.getOperand(2), Fixups, STI);
8290 0 : Value |= (op & UINT64_C(63)) << 16;
8291 : // op: imm4
8292 0 : op = getMachineOpValue(MI, MI.getOperand(3), Fixups, STI);
8293 0 : Value |= (op & UINT64_C(15)) << 10;
8294 0 : break;
8295 : }
8296 : case AArch64::SBFMWri:
8297 : case AArch64::UBFMWri: {
8298 : // op: Rd
8299 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
8300 0 : Value |= op & UINT64_C(31);
8301 : // op: Rn
8302 0 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
8303 0 : Value |= (op & UINT64_C(31)) << 5;
8304 : // op: immr
8305 0 : op = getMachineOpValue(MI, MI.getOperand(2), Fixups, STI);
8306 0 : Value |= (op & UINT64_C(31)) << 16;
8307 : // op: imms
8308 0 : op = getMachineOpValue(MI, MI.getOperand(3), Fixups, STI);
8309 0 : Value |= (op & UINT64_C(31)) << 10;
8310 0 : break;
8311 : }
8312 : case AArch64::SBFMXri:
8313 : case AArch64::UBFMXri: {
8314 : // op: Rd
8315 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
8316 0 : Value |= op & UINT64_C(31);
8317 : // op: Rn
8318 0 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
8319 0 : Value |= (op & UINT64_C(31)) << 5;
8320 : // op: immr
8321 0 : op = getMachineOpValue(MI, MI.getOperand(2), Fixups, STI);
8322 0 : Value |= (op & UINT64_C(63)) << 16;
8323 : // op: imms
8324 0 : op = getMachineOpValue(MI, MI.getOperand(3), Fixups, STI);
8325 0 : Value |= (op & UINT64_C(63)) << 10;
8326 0 : break;
8327 : }
8328 : case AArch64::FCVTZSSWDri:
8329 : case AArch64::FCVTZSSWHri:
8330 : case AArch64::FCVTZSSWSri:
8331 : case AArch64::FCVTZUSWDri:
8332 : case AArch64::FCVTZUSWHri:
8333 : case AArch64::FCVTZUSWSri:
8334 : case AArch64::SCVTFSWDri:
8335 : case AArch64::SCVTFSWHri:
8336 : case AArch64::SCVTFSWSri:
8337 : case AArch64::UCVTFSWDri:
8338 : case AArch64::UCVTFSWHri:
8339 : case AArch64::UCVTFSWSri: {
8340 : // op: Rd
8341 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
8342 0 : Value |= op & UINT64_C(31);
8343 : // op: Rn
8344 0 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
8345 0 : Value |= (op & UINT64_C(31)) << 5;
8346 : // op: scale
8347 0 : op = getFixedPointScaleOpValue(MI, 2, Fixups, STI);
8348 0 : Value |= (op & UINT64_C(31)) << 10;
8349 0 : break;
8350 : }
8351 : case AArch64::FCVTZSSXDri:
8352 : case AArch64::FCVTZSSXHri:
8353 : case AArch64::FCVTZSSXSri:
8354 : case AArch64::FCVTZUSXDri:
8355 : case AArch64::FCVTZUSXHri:
8356 : case AArch64::FCVTZUSXSri:
8357 : case AArch64::SCVTFSXDri:
8358 : case AArch64::SCVTFSXHri:
8359 : case AArch64::SCVTFSXSri:
8360 : case AArch64::UCVTFSXDri:
8361 : case AArch64::UCVTFSXHri:
8362 : case AArch64::UCVTFSXSri: {
8363 : // op: Rd
8364 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
8365 0 : Value |= op & UINT64_C(31);
8366 : // op: Rn
8367 0 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
8368 0 : Value |= (op & UINT64_C(31)) << 5;
8369 : // op: scale
8370 0 : op = getFixedPointScaleOpValue(MI, 2, Fixups, STI);
8371 0 : Value |= (op & UINT64_C(63)) << 10;
8372 0 : break;
8373 : }
8374 : case AArch64::BFMWri: {
8375 : // op: Rd
8376 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
8377 0 : Value |= op & UINT64_C(31);
8378 : // op: Rn
8379 0 : op = getMachineOpValue(MI, MI.getOperand(2), Fixups, STI);
8380 0 : Value |= (op & UINT64_C(31)) << 5;
8381 : // op: immr
8382 0 : op = getMachineOpValue(MI, MI.getOperand(3), Fixups, STI);
8383 0 : Value |= (op & UINT64_C(31)) << 16;
8384 : // op: imms
8385 0 : op = getMachineOpValue(MI, MI.getOperand(4), Fixups, STI);
8386 0 : Value |= (op & UINT64_C(31)) << 10;
8387 0 : break;
8388 : }
8389 : case AArch64::BFMXri: {
8390 : // op: Rd
8391 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
8392 0 : Value |= op & UINT64_C(31);
8393 : // op: Rn
8394 0 : op = getMachineOpValue(MI, MI.getOperand(2), Fixups, STI);
8395 0 : Value |= (op & UINT64_C(31)) << 5;
8396 : // op: immr
8397 0 : op = getMachineOpValue(MI, MI.getOperand(3), Fixups, STI);
8398 0 : Value |= (op & UINT64_C(63)) << 16;
8399 : // op: imms
8400 0 : op = getMachineOpValue(MI, MI.getOperand(4), Fixups, STI);
8401 0 : Value |= (op & UINT64_C(63)) << 10;
8402 0 : break;
8403 : }
8404 : case AArch64::FMOVDi:
8405 : case AArch64::FMOVHi:
8406 : case AArch64::FMOVSi: {
8407 : // op: Rd
8408 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
8409 0 : Value |= op & UINT64_C(31);
8410 : // op: imm
8411 0 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
8412 0 : Value |= (op & UINT64_C(255)) << 13;
8413 0 : break;
8414 : }
8415 : case AArch64::MOVNWi:
8416 : case AArch64::MOVNXi: {
8417 : // op: Rd
8418 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
8419 0 : Value |= op & UINT64_C(31);
8420 : // op: imm
8421 0 : op = getMoveWideImmOpValue(MI, 1, Fixups, STI);
8422 0 : Value |= (op & UINT64_C(65535)) << 5;
8423 : // op: shift
8424 0 : op = getMachineOpValue(MI, MI.getOperand(2), Fixups, STI);
8425 0 : Value |= (op & UINT64_C(48)) << 17;
8426 0 : break;
8427 : }
8428 : case AArch64::MOVZWi:
8429 : case AArch64::MOVZXi: {
8430 : // op: Rd
8431 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
8432 0 : Value |= op & UINT64_C(31);
8433 : // op: imm
8434 0 : op = getMoveWideImmOpValue(MI, 1, Fixups, STI);
8435 0 : Value |= (op & UINT64_C(65535)) << 5;
8436 : // op: shift
8437 0 : op = getMachineOpValue(MI, MI.getOperand(2), Fixups, STI);
8438 0 : Value |= (op & UINT64_C(48)) << 17;
8439 0 : Value = fixMOVZ(MI, Value, STI);
8440 0 : break;
8441 : }
8442 : case AArch64::MOVKWi:
8443 : case AArch64::MOVKXi: {
8444 : // op: Rd
8445 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
8446 0 : Value |= op & UINT64_C(31);
8447 : // op: imm
8448 0 : op = getMoveWideImmOpValue(MI, 2, Fixups, STI);
8449 0 : Value |= (op & UINT64_C(65535)) << 5;
8450 : // op: shift
8451 0 : op = getMachineOpValue(MI, MI.getOperand(3), Fixups, STI);
8452 0 : Value |= (op & UINT64_C(48)) << 17;
8453 0 : break;
8454 : }
8455 : case AArch64::CNTB_XPiI:
8456 : case AArch64::CNTD_XPiI:
8457 : case AArch64::CNTH_XPiI:
8458 : case AArch64::CNTW_XPiI: {
8459 : // op: Rd
8460 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
8461 0 : Value |= op & UINT64_C(31);
8462 : // op: imm4
8463 0 : op = getSVEIncDecImm(MI, 2, Fixups, STI);
8464 0 : Value |= (op & UINT64_C(15)) << 16;
8465 : // op: pattern
8466 0 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
8467 0 : Value |= (op & UINT64_C(31)) << 5;
8468 0 : break;
8469 : }
8470 : case AArch64::RDVLI_XI: {
8471 : // op: Rd
8472 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
8473 0 : Value |= op & UINT64_C(31);
8474 : // op: imm6
8475 0 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
8476 0 : Value |= (op & UINT64_C(63)) << 5;
8477 0 : break;
8478 : }
8479 : case AArch64::FMOVv2f32_ns:
8480 : case AArch64::FMOVv2f64_ns:
8481 : case AArch64::FMOVv4f16_ns:
8482 : case AArch64::FMOVv4f32_ns:
8483 : case AArch64::FMOVv8f16_ns:
8484 : case AArch64::MOVID:
8485 : case AArch64::MOVIv16b_ns:
8486 : case AArch64::MOVIv2d_ns:
8487 : case AArch64::MOVIv8b_ns: {
8488 : // op: Rd
8489 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
8490 0 : Value |= op & UINT64_C(31);
8491 : // op: imm8
8492 0 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
8493 0 : Value |= (op & UINT64_C(224)) << 11;
8494 0 : Value |= (op & UINT64_C(31)) << 5;
8495 0 : break;
8496 : }
8497 : case AArch64::MOVIv2s_msl:
8498 : case AArch64::MOVIv4s_msl:
8499 : case AArch64::MVNIv2s_msl:
8500 : case AArch64::MVNIv4s_msl: {
8501 : // op: Rd
8502 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
8503 0 : Value |= op & UINT64_C(31);
8504 : // op: imm8
8505 0 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
8506 0 : Value |= (op & UINT64_C(224)) << 11;
8507 0 : Value |= (op & UINT64_C(31)) << 5;
8508 : // op: shift
8509 0 : op = getMoveVecShifterOpValue(MI, 2, Fixups, STI);
8510 0 : Value |= (op & UINT64_C(1)) << 12;
8511 0 : break;
8512 : }
8513 : case AArch64::MOVIv4i16:
8514 : case AArch64::MOVIv8i16:
8515 : case AArch64::MVNIv4i16:
8516 : case AArch64::MVNIv8i16: {
8517 : // op: Rd
8518 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
8519 0 : Value |= op & UINT64_C(31);
8520 : // op: imm8
8521 0 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
8522 0 : Value |= (op & UINT64_C(224)) << 11;
8523 0 : Value |= (op & UINT64_C(31)) << 5;
8524 : // op: shift
8525 0 : op = getVecShifterOpValue(MI, 2, Fixups, STI);
8526 0 : Value |= (op & UINT64_C(1)) << 13;
8527 0 : break;
8528 : }
8529 : case AArch64::MOVIv2i32:
8530 : case AArch64::MOVIv4i32:
8531 : case AArch64::MVNIv2i32:
8532 : case AArch64::MVNIv4i32: {
8533 : // op: Rd
8534 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
8535 0 : Value |= op & UINT64_C(31);
8536 : // op: imm8
8537 0 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
8538 0 : Value |= (op & UINT64_C(224)) << 11;
8539 0 : Value |= (op & UINT64_C(31)) << 5;
8540 : // op: shift
8541 0 : op = getVecShifterOpValue(MI, 2, Fixups, STI);
8542 0 : Value |= (op & UINT64_C(3)) << 13;
8543 0 : break;
8544 : }
8545 : case AArch64::AESDrr:
8546 : case AArch64::AESErr:
8547 : case AArch64::FCVTNv4i32:
8548 : case AArch64::FCVTNv8i16:
8549 : case AArch64::FCVTXNv4f32:
8550 : case AArch64::SADALPv16i8_v8i16:
8551 : case AArch64::SADALPv2i32_v1i64:
8552 : case AArch64::SADALPv4i16_v2i32:
8553 : case AArch64::SADALPv4i32_v2i64:
8554 : case AArch64::SADALPv8i16_v4i32:
8555 : case AArch64::SADALPv8i8_v4i16:
8556 : case AArch64::SHA1SU1rr:
8557 : case AArch64::SHA256SU0rr:
8558 : case AArch64::SQXTNv16i8:
8559 : case AArch64::SQXTNv4i32:
8560 : case AArch64::SQXTNv8i16:
8561 : case AArch64::SQXTUNv16i8:
8562 : case AArch64::SQXTUNv4i32:
8563 : case AArch64::SQXTUNv8i16:
8564 : case AArch64::SUQADDv16i8:
8565 : case AArch64::SUQADDv1i16:
8566 : case AArch64::SUQADDv1i32:
8567 : case AArch64::SUQADDv1i64:
8568 : case AArch64::SUQADDv1i8:
8569 : case AArch64::SUQADDv2i32:
8570 : case AArch64::SUQADDv2i64:
8571 : case AArch64::SUQADDv4i16:
8572 : case AArch64::SUQADDv4i32:
8573 : case AArch64::SUQADDv8i16:
8574 : case AArch64::SUQADDv8i8:
8575 : case AArch64::UADALPv16i8_v8i16:
8576 : case AArch64::UADALPv2i32_v1i64:
8577 : case AArch64::UADALPv4i16_v2i32:
8578 : case AArch64::UADALPv4i32_v2i64:
8579 : case AArch64::UADALPv8i16_v4i32:
8580 : case AArch64::UADALPv8i8_v4i16:
8581 : case AArch64::UQXTNv16i8:
8582 : case AArch64::UQXTNv4i32:
8583 : case AArch64::UQXTNv8i16:
8584 : case AArch64::USQADDv16i8:
8585 : case AArch64::USQADDv1i16:
8586 : case AArch64::USQADDv1i32:
8587 : case AArch64::USQADDv1i64:
8588 : case AArch64::USQADDv1i8:
8589 : case AArch64::USQADDv2i32:
8590 : case AArch64::USQADDv2i64:
8591 : case AArch64::USQADDv4i16:
8592 : case AArch64::USQADDv4i32:
8593 : case AArch64::USQADDv8i16:
8594 : case AArch64::USQADDv8i8:
8595 : case AArch64::XTNv16i8:
8596 : case AArch64::XTNv4i32:
8597 : case AArch64::XTNv8i16: {
8598 : // op: Rd
8599 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
8600 0 : Value |= op & UINT64_C(31);
8601 : // op: Rn
8602 0 : op = getMachineOpValue(MI, MI.getOperand(2), Fixups, STI);
8603 0 : Value |= (op & UINT64_C(31)) << 5;
8604 0 : break;
8605 : }
8606 : case AArch64::FMLALI2_2s:
8607 : case AArch64::FMLALI2_4s:
8608 : case AArch64::FMLALI_2s:
8609 : case AArch64::FMLALI_4s:
8610 : case AArch64::FMLAv1i16_indexed:
8611 : case AArch64::FMLAv4i16_indexed:
8612 : case AArch64::FMLAv8i16_indexed:
8613 : case AArch64::FMLSLI2_2s:
8614 : case AArch64::FMLSLI2_4s:
8615 : case AArch64::FMLSLI_2s:
8616 : case AArch64::FMLSLI_4s:
8617 : case AArch64::FMLSv1i16_indexed:
8618 : case AArch64::FMLSv4i16_indexed:
8619 : case AArch64::FMLSv8i16_indexed:
8620 : case AArch64::MLAv4i16_indexed:
8621 : case AArch64::MLAv8i16_indexed:
8622 : case AArch64::MLSv4i16_indexed:
8623 : case AArch64::MLSv8i16_indexed:
8624 : case AArch64::SMLALv4i16_indexed:
8625 : case AArch64::SMLALv8i16_indexed:
8626 : case AArch64::SMLSLv4i16_indexed:
8627 : case AArch64::SMLSLv8i16_indexed:
8628 : case AArch64::SQDMLALv1i32_indexed:
8629 : case AArch64::SQDMLALv4i16_indexed:
8630 : case AArch64::SQDMLALv8i16_indexed:
8631 : case AArch64::SQDMLSLv1i32_indexed:
8632 : case AArch64::SQDMLSLv4i16_indexed:
8633 : case AArch64::SQDMLSLv8i16_indexed:
8634 : case AArch64::SQRDMLAHi16_indexed:
8635 : case AArch64::SQRDMLAHv4i16_indexed:
8636 : case AArch64::SQRDMLAHv8i16_indexed:
8637 : case AArch64::SQRDMLSHi16_indexed:
8638 : case AArch64::SQRDMLSHv4i16_indexed:
8639 : case AArch64::SQRDMLSHv8i16_indexed:
8640 : case AArch64::UMLALv4i16_indexed:
8641 : case AArch64::UMLALv8i16_indexed:
8642 : case AArch64::UMLSLv4i16_indexed:
8643 : case AArch64::UMLSLv8i16_indexed: {
8644 : // op: Rd
8645 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
8646 0 : Value |= op & UINT64_C(31);
8647 : // op: Rn
8648 0 : op = getMachineOpValue(MI, MI.getOperand(2), Fixups, STI);
8649 0 : Value |= (op & UINT64_C(31)) << 5;
8650 : // op: Rm
8651 0 : op = getMachineOpValue(MI, MI.getOperand(3), Fixups, STI);
8652 0 : Value |= (op & UINT64_C(15)) << 16;
8653 : // op: idx
8654 0 : op = getMachineOpValue(MI, MI.getOperand(4), Fixups, STI);
8655 0 : Value |= (op & UINT64_C(3)) << 20;
8656 0 : Value |= (op & UINT64_C(4)) << 9;
8657 0 : break;
8658 : }
8659 : case AArch64::ADDHNv2i64_v4i32:
8660 : case AArch64::ADDHNv4i32_v8i16:
8661 : case AArch64::ADDHNv8i16_v16i8:
8662 : case AArch64::BITv16i8:
8663 : case AArch64::BITv8i8:
8664 : case AArch64::BSLv16i8:
8665 : case AArch64::BSLv8i8:
8666 : case AArch64::FMLAv2f32:
8667 : case AArch64::FMLAv2f64:
8668 : case AArch64::FMLAv4f16:
8669 : case AArch64::FMLAv4f32:
8670 : case AArch64::FMLAv8f16:
8671 : case AArch64::FMLSv2f32:
8672 : case AArch64::FMLSv2f64:
8673 : case AArch64::FMLSv4f16:
8674 : case AArch64::FMLSv4f32:
8675 : case AArch64::FMLSv8f16:
8676 : case AArch64::MLAv16i8:
8677 : case AArch64::MLAv2i32:
8678 : case AArch64::MLAv4i16:
8679 : case AArch64::MLAv4i32:
8680 : case AArch64::MLAv8i16:
8681 : case AArch64::MLAv8i8:
8682 : case AArch64::MLSv16i8:
8683 : case AArch64::MLSv2i32:
8684 : case AArch64::MLSv4i16:
8685 : case AArch64::MLSv4i32:
8686 : case AArch64::MLSv8i16:
8687 : case AArch64::MLSv8i8:
8688 : case AArch64::RADDHNv2i64_v4i32:
8689 : case AArch64::RADDHNv4i32_v8i16:
8690 : case AArch64::RADDHNv8i16_v16i8:
8691 : case AArch64::RSUBHNv2i64_v4i32:
8692 : case AArch64::RSUBHNv4i32_v8i16:
8693 : case AArch64::RSUBHNv8i16_v16i8:
8694 : case AArch64::SABALv16i8_v8i16:
8695 : case AArch64::SABALv2i32_v2i64:
8696 : case AArch64::SABALv4i16_v4i32:
8697 : case AArch64::SABALv4i32_v2i64:
8698 : case AArch64::SABALv8i16_v4i32:
8699 : case AArch64::SABALv8i8_v8i16:
8700 : case AArch64::SABAv16i8:
8701 : case AArch64::SABAv2i32:
8702 : case AArch64::SABAv4i16:
8703 : case AArch64::SABAv4i32:
8704 : case AArch64::SABAv8i16:
8705 : case AArch64::SABAv8i8:
8706 : case AArch64::SDOTv16i8:
8707 : case AArch64::SDOTv8i8:
8708 : case AArch64::SHA1Crrr:
8709 : case AArch64::SHA1Mrrr:
8710 : case AArch64::SHA1Prrr:
8711 : case AArch64::SHA1SU0rrr:
8712 : case AArch64::SHA256H2rrr:
8713 : case AArch64::SHA256Hrrr:
8714 : case AArch64::SHA256SU1rrr:
8715 : case AArch64::SMLALv16i8_v8i16:
8716 : case AArch64::SMLALv2i32_v2i64:
8717 : case AArch64::SMLALv4i16_v4i32:
8718 : case AArch64::SMLALv4i32_v2i64:
8719 : case AArch64::SMLALv8i16_v4i32:
8720 : case AArch64::SMLALv8i8_v8i16:
8721 : case AArch64::SMLSLv16i8_v8i16:
8722 : case AArch64::SMLSLv2i32_v2i64:
8723 : case AArch64::SMLSLv4i16_v4i32:
8724 : case AArch64::SMLSLv4i32_v2i64:
8725 : case AArch64::SMLSLv8i16_v4i32:
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8780 : // op: Rd
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8783 : // op: Rn
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8786 : // op: Rm
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8790 : }
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8804 : // op: idx
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8807 0 : break;
8808 : }
8809 : case AArch64::FMLAv1i32_indexed:
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8842 : case AArch64::UMLSLv4i32_indexed: {
8843 : // op: Rd
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8845 0 : Value |= op & UINT64_C(31);
8846 : // op: Rn
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8848 0 : Value |= (op & UINT64_C(31)) << 5;
8849 : // op: Rm
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8851 0 : Value |= (op & UINT64_C(31)) << 16;
8852 : // op: idx
8853 0 : op = getMachineOpValue(MI, MI.getOperand(4), Fixups, STI);
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8857 : }
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8863 : // op: Rd
8864 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
8865 0 : Value |= op & UINT64_C(31);
8866 : // op: Rn
8867 0 : op = getMachineOpValue(MI, MI.getOperand(2), Fixups, STI);
8868 0 : Value |= (op & UINT64_C(31)) << 5;
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8871 0 : Value |= (op & UINT64_C(31)) << 16;
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8873 0 : op = getMachineOpValue(MI, MI.getOperand(4), Fixups, STI);
8874 0 : Value |= (op & UINT64_C(3)) << 11;
8875 0 : break;
8876 : }
8877 : case AArch64::FCMLAv4f32_indexed: {
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8887 : // op: rot
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8891 0 : op = getMachineOpValue(MI, MI.getOperand(4), Fixups, STI);
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8895 : case AArch64::FCMLAv4f16_indexed: {
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8903 0 : op = getMachineOpValue(MI, MI.getOperand(3), Fixups, STI);
8904 0 : Value |= (op & UINT64_C(31)) << 16;
8905 : // op: rot
8906 0 : op = getMachineOpValue(MI, MI.getOperand(5), Fixups, STI);
8907 0 : Value |= (op & UINT64_C(3)) << 13;
8908 : // op: idx
8909 0 : op = getMachineOpValue(MI, MI.getOperand(4), Fixups, STI);
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8913 : case AArch64::FCMLAv8f16_indexed: {
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8932 : case AArch64::SLIv4i16_shift:
8933 : case AArch64::SLIv8i16_shift: {
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8965 0 : Value |= (op & UINT64_C(31)) << 5;
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8977 0 : op = getMachineOpValue(MI, MI.getOperand(2), Fixups, STI);
8978 0 : Value |= (op & UINT64_C(31)) << 5;
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8995 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
8996 0 : Value |= op & UINT64_C(31);
8997 : // op: Rn
8998 0 : op = getMachineOpValue(MI, MI.getOperand(2), Fixups, STI);
8999 0 : Value |= (op & UINT64_C(31)) << 5;
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9001 0 : op = getVecShiftR16OpValue(MI, 3, Fixups, STI);
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9003 0 : break;
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9018 0 : Value |= (op & UINT64_C(31)) << 5;
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9023 : }
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9041 0 : break;
9042 : }
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9060 0 : op = getVecShiftR32OpValue(MI, 3, Fixups, STI);
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9062 0 : break;
9063 : }
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9082 : }
9083 : case AArch64::SRId:
9084 : case AArch64::SRIv2i64_shift:
9085 : case AArch64::SRSRAd:
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9092 : case AArch64::USRAv2i64_shift: {
9093 : // op: Rd
9094 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
9095 0 : Value |= op & UINT64_C(31);
9096 : // op: Rn
9097 0 : op = getMachineOpValue(MI, MI.getOperand(2), Fixups, STI);
9098 0 : Value |= (op & UINT64_C(31)) << 5;
9099 : // op: imm
9100 0 : op = getVecShiftR64OpValue(MI, 3, Fixups, STI);
9101 0 : Value |= (op & UINT64_C(63)) << 16;
9102 0 : break;
9103 : }
9104 : case AArch64::SRIv16i8_shift:
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9113 : case AArch64::USRAv8i8_shift: {
9114 : // op: Rd
9115 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
9116 0 : Value |= op & UINT64_C(31);
9117 : // op: Rn
9118 0 : op = getMachineOpValue(MI, MI.getOperand(2), Fixups, STI);
9119 0 : Value |= (op & UINT64_C(31)) << 5;
9120 : // op: imm
9121 0 : op = getVecShiftR8OpValue(MI, 3, Fixups, STI);
9122 0 : Value |= (op & UINT64_C(7)) << 16;
9123 0 : break;
9124 : }
9125 : case AArch64::INSvi64gpr: {
9126 : // op: Rd
9127 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
9128 0 : Value |= op & UINT64_C(31);
9129 : // op: Rn
9130 0 : op = getMachineOpValue(MI, MI.getOperand(3), Fixups, STI);
9131 0 : Value |= (op & UINT64_C(31)) << 5;
9132 : // op: idx
9133 0 : op = getMachineOpValue(MI, MI.getOperand(2), Fixups, STI);
9134 0 : Value |= (op & UINT64_C(1)) << 20;
9135 0 : break;
9136 : }
9137 : case AArch64::INSvi64lane: {
9138 : // op: Rd
9139 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
9140 0 : Value |= op & UINT64_C(31);
9141 : // op: Rn
9142 0 : op = getMachineOpValue(MI, MI.getOperand(3), Fixups, STI);
9143 0 : Value |= (op & UINT64_C(31)) << 5;
9144 : // op: idx
9145 0 : op = getMachineOpValue(MI, MI.getOperand(2), Fixups, STI);
9146 0 : Value |= (op & UINT64_C(1)) << 20;
9147 : // op: idx2
9148 0 : op = getMachineOpValue(MI, MI.getOperand(4), Fixups, STI);
9149 0 : Value |= (op & UINT64_C(1)) << 14;
9150 0 : break;
9151 : }
9152 : case AArch64::INSvi8gpr: {
9153 : // op: Rd
9154 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
9155 0 : Value |= op & UINT64_C(31);
9156 : // op: Rn
9157 0 : op = getMachineOpValue(MI, MI.getOperand(3), Fixups, STI);
9158 0 : Value |= (op & UINT64_C(31)) << 5;
9159 : // op: idx
9160 0 : op = getMachineOpValue(MI, MI.getOperand(2), Fixups, STI);
9161 0 : Value |= (op & UINT64_C(15)) << 17;
9162 0 : break;
9163 : }
9164 : case AArch64::INSvi8lane: {
9165 : // op: Rd
9166 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
9167 0 : Value |= op & UINT64_C(31);
9168 : // op: Rn
9169 0 : op = getMachineOpValue(MI, MI.getOperand(3), Fixups, STI);
9170 0 : Value |= (op & UINT64_C(31)) << 5;
9171 : // op: idx
9172 0 : op = getMachineOpValue(MI, MI.getOperand(2), Fixups, STI);
9173 0 : Value |= (op & UINT64_C(15)) << 17;
9174 : // op: idx2
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9177 0 : break;
9178 : }
9179 : case AArch64::INSvi32gpr: {
9180 : // op: Rd
9181 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
9182 0 : Value |= op & UINT64_C(31);
9183 : // op: Rn
9184 0 : op = getMachineOpValue(MI, MI.getOperand(3), Fixups, STI);
9185 0 : Value |= (op & UINT64_C(31)) << 5;
9186 : // op: idx
9187 0 : op = getMachineOpValue(MI, MI.getOperand(2), Fixups, STI);
9188 0 : Value |= (op & UINT64_C(3)) << 19;
9189 0 : break;
9190 : }
9191 : case AArch64::INSvi32lane: {
9192 : // op: Rd
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9194 0 : Value |= op & UINT64_C(31);
9195 : // op: Rn
9196 0 : op = getMachineOpValue(MI, MI.getOperand(3), Fixups, STI);
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9198 : // op: idx
9199 0 : op = getMachineOpValue(MI, MI.getOperand(2), Fixups, STI);
9200 0 : Value |= (op & UINT64_C(3)) << 19;
9201 : // op: idx2
9202 0 : op = getMachineOpValue(MI, MI.getOperand(4), Fixups, STI);
9203 0 : Value |= (op & UINT64_C(3)) << 13;
9204 0 : break;
9205 : }
9206 : case AArch64::INSvi16gpr: {
9207 : // op: Rd
9208 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
9209 0 : Value |= op & UINT64_C(31);
9210 : // op: Rn
9211 0 : op = getMachineOpValue(MI, MI.getOperand(3), Fixups, STI);
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9213 : // op: idx
9214 0 : op = getMachineOpValue(MI, MI.getOperand(2), Fixups, STI);
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9216 0 : break;
9217 : }
9218 : case AArch64::INSvi16lane: {
9219 : // op: Rd
9220 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
9221 0 : Value |= op & UINT64_C(31);
9222 : // op: Rn
9223 0 : op = getMachineOpValue(MI, MI.getOperand(3), Fixups, STI);
9224 0 : Value |= (op & UINT64_C(31)) << 5;
9225 : // op: idx
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9228 : // op: idx2
9229 0 : op = getMachineOpValue(MI, MI.getOperand(4), Fixups, STI);
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9231 0 : break;
9232 : }
9233 : case AArch64::BICv4i16:
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9236 : case AArch64::ORRv8i16: {
9237 : // op: Rd
9238 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
9239 0 : Value |= op & UINT64_C(31);
9240 : // op: imm8
9241 0 : op = getMachineOpValue(MI, MI.getOperand(2), Fixups, STI);
9242 0 : Value |= (op & UINT64_C(224)) << 11;
9243 0 : Value |= (op & UINT64_C(31)) << 5;
9244 : // op: shift
9245 0 : op = getVecShifterOpValue(MI, 3, Fixups, STI);
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9248 : }
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9251 : case AArch64::ORRv2i32:
9252 : case AArch64::ORRv4i32: {
9253 : // op: Rd
9254 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
9255 0 : Value |= op & UINT64_C(31);
9256 : // op: imm8
9257 0 : op = getMachineOpValue(MI, MI.getOperand(2), Fixups, STI);
9258 0 : Value |= (op & UINT64_C(224)) << 11;
9259 0 : Value |= (op & UINT64_C(31)) << 5;
9260 : // op: shift
9261 0 : op = getVecShifterOpValue(MI, 3, Fixups, STI);
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9263 0 : break;
9264 : }
9265 : case AArch64::DECP_XP_B:
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9277 : case AArch64::SQDECP_XP_B:
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9279 : case AArch64::SQDECP_XP_H:
9280 : case AArch64::SQDECP_XP_S:
9281 : case AArch64::SQINCP_XPWd_B:
9282 : case AArch64::SQINCP_XPWd_D:
9283 : case AArch64::SQINCP_XPWd_H:
9284 : case AArch64::SQINCP_XPWd_S:
9285 : case AArch64::SQINCP_XP_B:
9286 : case AArch64::SQINCP_XP_D:
9287 : case AArch64::SQINCP_XP_H:
9288 : case AArch64::SQINCP_XP_S:
9289 : case AArch64::UQDECP_WP_B:
9290 : case AArch64::UQDECP_WP_D:
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9296 : case AArch64::UQDECP_XP_S:
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9300 : case AArch64::UQINCP_WP_S:
9301 : case AArch64::UQINCP_XP_B:
9302 : case AArch64::UQINCP_XP_D:
9303 : case AArch64::UQINCP_XP_H:
9304 : case AArch64::UQINCP_XP_S: {
9305 : // op: Rdn
9306 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
9307 0 : Value |= op & UINT64_C(31);
9308 : // op: Pg
9309 0 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
9310 0 : Value |= (op & UINT64_C(15)) << 5;
9311 0 : break;
9312 : }
9313 : case AArch64::DECB_XPiI:
9314 : case AArch64::DECD_XPiI:
9315 : case AArch64::DECH_XPiI:
9316 : case AArch64::DECW_XPiI:
9317 : case AArch64::INCB_XPiI:
9318 : case AArch64::INCD_XPiI:
9319 : case AArch64::INCH_XPiI:
9320 : case AArch64::INCW_XPiI:
9321 : case AArch64::SQDECB_XPiI:
9322 : case AArch64::SQDECB_XPiWdI:
9323 : case AArch64::SQDECD_XPiI:
9324 : case AArch64::SQDECD_XPiWdI:
9325 : case AArch64::SQDECH_XPiI:
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9327 : case AArch64::SQDECW_XPiI:
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9331 : case AArch64::SQINCD_XPiI:
9332 : case AArch64::SQINCD_XPiWdI:
9333 : case AArch64::SQINCH_XPiI:
9334 : case AArch64::SQINCH_XPiWdI:
9335 : case AArch64::SQINCW_XPiI:
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9337 : case AArch64::UQDECB_WPiI:
9338 : case AArch64::UQDECB_XPiI:
9339 : case AArch64::UQDECD_WPiI:
9340 : case AArch64::UQDECD_XPiI:
9341 : case AArch64::UQDECH_WPiI:
9342 : case AArch64::UQDECH_XPiI:
9343 : case AArch64::UQDECW_WPiI:
9344 : case AArch64::UQDECW_XPiI:
9345 : case AArch64::UQINCB_WPiI:
9346 : case AArch64::UQINCB_XPiI:
9347 : case AArch64::UQINCD_WPiI:
9348 : case AArch64::UQINCD_XPiI:
9349 : case AArch64::UQINCH_WPiI:
9350 : case AArch64::UQINCH_XPiI:
9351 : case AArch64::UQINCW_WPiI:
9352 : case AArch64::UQINCW_XPiI: {
9353 : // op: Rdn
9354 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
9355 0 : Value |= op & UINT64_C(31);
9356 : // op: pattern
9357 0 : op = getMachineOpValue(MI, MI.getOperand(2), Fixups, STI);
9358 0 : Value |= (op & UINT64_C(31)) << 5;
9359 : // op: imm4
9360 0 : op = getSVEIncDecImm(MI, 3, Fixups, STI);
9361 0 : Value |= (op & UINT64_C(15)) << 16;
9362 0 : break;
9363 : }
9364 : case AArch64::CTERMEQ_WW:
9365 : case AArch64::CTERMEQ_XX:
9366 : case AArch64::CTERMNE_WW:
9367 : case AArch64::CTERMNE_XX:
9368 : case AArch64::FCMPDrr:
9369 : case AArch64::FCMPEDrr:
9370 : case AArch64::FCMPEHrr:
9371 : case AArch64::FCMPESrr:
9372 : case AArch64::FCMPHrr:
9373 : case AArch64::FCMPSrr: {
9374 : // op: Rm
9375 0 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
9376 0 : Value |= (op & UINT64_C(31)) << 16;
9377 : // op: Rn
9378 0 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
9379 0 : Value |= (op & UINT64_C(31)) << 5;
9380 0 : break;
9381 : }
9382 : case AArch64::INDEX_IR_B:
9383 : case AArch64::INDEX_IR_D:
9384 : case AArch64::INDEX_IR_H:
9385 : case AArch64::INDEX_IR_S: {
9386 : // op: Rm
9387 0 : op = getMachineOpValue(MI, MI.getOperand(2), Fixups, STI);
9388 0 : Value |= (op & UINT64_C(31)) << 16;
9389 : // op: Zd
9390 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
9391 0 : Value |= op & UINT64_C(31);
9392 : // op: imm5
9393 0 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
9394 0 : Value |= (op & UINT64_C(31)) << 5;
9395 0 : break;
9396 : }
9397 : case AArch64::INSR_ZR_B:
9398 : case AArch64::INSR_ZR_D:
9399 : case AArch64::INSR_ZR_H:
9400 : case AArch64::INSR_ZR_S: {
9401 : // op: Rm
9402 0 : op = getMachineOpValue(MI, MI.getOperand(2), Fixups, STI);
9403 0 : Value |= (op & UINT64_C(31)) << 5;
9404 : // op: Zdn
9405 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
9406 0 : Value |= op & UINT64_C(31);
9407 0 : break;
9408 : }
9409 : case AArch64::PRFB_PRR:
9410 : case AArch64::PRFD_PRR:
9411 : case AArch64::PRFH_PRR:
9412 : case AArch64::PRFS_PRR: {
9413 : // op: Rm
9414 0 : op = getMachineOpValue(MI, MI.getOperand(3), Fixups, STI);
9415 0 : Value |= (op & UINT64_C(31)) << 16;
9416 : // op: Rn
9417 0 : op = getMachineOpValue(MI, MI.getOperand(2), Fixups, STI);
9418 0 : Value |= (op & UINT64_C(31)) << 5;
9419 : // op: Pg
9420 0 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
9421 0 : Value |= (op & UINT64_C(7)) << 10;
9422 : // op: prfop
9423 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
9424 0 : Value |= op & UINT64_C(15);
9425 0 : break;
9426 : }
9427 : case AArch64::BLR:
9428 : case AArch64::BLRAAZ:
9429 : case AArch64::BLRABZ:
9430 : case AArch64::BR:
9431 : case AArch64::BRAAZ:
9432 : case AArch64::BRABZ:
9433 : case AArch64::RET:
9434 : case AArch64::SETF16:
9435 : case AArch64::SETF8: {
9436 : // op: Rn
9437 0 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
9438 0 : Value |= (op & UINT64_C(31)) << 5;
9439 0 : break;
9440 : }
9441 : case AArch64::CCMNWr:
9442 : case AArch64::CCMNXr:
9443 : case AArch64::CCMPWr:
9444 : case AArch64::CCMPXr:
9445 : case AArch64::FCCMPDrr:
9446 : case AArch64::FCCMPEDrr:
9447 : case AArch64::FCCMPEHrr:
9448 : case AArch64::FCCMPESrr:
9449 : case AArch64::FCCMPHrr:
9450 : case AArch64::FCCMPSrr: {
9451 : // op: Rn
9452 0 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
9453 0 : Value |= (op & UINT64_C(31)) << 5;
9454 : // op: Rm
9455 0 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
9456 0 : Value |= (op & UINT64_C(31)) << 16;
9457 : // op: nzcv
9458 : op = getMachineOpValue(MI, MI.getOperand(2), Fixups, STI);
9459 0 : Value |= op & UINT64_C(15);
9460 : // op: cond
9461 0 : op = getMachineOpValue(MI, MI.getOperand(3), Fixups, STI);
9462 0 : Value |= (op & UINT64_C(15)) << 12;
9463 0 : break;
9464 : }
9465 : case AArch64::BLRAA:
9466 : case AArch64::BLRAB:
9467 : case AArch64::BRAA:
9468 : case AArch64::BRAB: {
9469 : // op: Rn
9470 0 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
9471 0 : Value |= (op & UINT64_C(31)) << 5;
9472 : // op: Rm
9473 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
9474 0 : Value |= op & UINT64_C(31);
9475 0 : break;
9476 : }
9477 : case AArch64::CCMNWi:
9478 : case AArch64::CCMNXi:
9479 : case AArch64::CCMPWi:
9480 : case AArch64::CCMPXi: {
9481 : // op: Rn
9482 0 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
9483 0 : Value |= (op & UINT64_C(31)) << 5;
9484 : // op: imm
9485 0 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
9486 0 : Value |= (op & UINT64_C(31)) << 16;
9487 : // op: nzcv
9488 : op = getMachineOpValue(MI, MI.getOperand(2), Fixups, STI);
9489 0 : Value |= op & UINT64_C(15);
9490 : // op: cond
9491 0 : op = getMachineOpValue(MI, MI.getOperand(3), Fixups, STI);
9492 0 : Value |= (op & UINT64_C(15)) << 12;
9493 0 : break;
9494 : }
9495 : case AArch64::RMIF: {
9496 : // op: Rn
9497 0 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
9498 0 : Value |= (op & UINT64_C(31)) << 5;
9499 : // op: imm
9500 0 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
9501 0 : Value |= (op & UINT64_C(63)) << 15;
9502 : // op: mask
9503 : op = getMachineOpValue(MI, MI.getOperand(2), Fixups, STI);
9504 0 : Value |= op & UINT64_C(15);
9505 0 : break;
9506 : }
9507 : case AArch64::ST2GOffset:
9508 : case AArch64::STGOffset:
9509 : case AArch64::STZ2GOffset:
9510 : case AArch64::STZGOffset: {
9511 : // op: Rn
9512 0 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
9513 0 : Value |= (op & UINT64_C(31)) << 5;
9514 : // op: offset
9515 0 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
9516 0 : Value |= (op & UINT64_C(511)) << 12;
9517 0 : break;
9518 : }
9519 : case AArch64::FCMPDri:
9520 : case AArch64::FCMPEDri:
9521 : case AArch64::FCMPEHri:
9522 : case AArch64::FCMPESri:
9523 : case AArch64::FCMPHri:
9524 : case AArch64::FCMPSri: {
9525 : // op: Rn
9526 0 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
9527 0 : Value |= (op & UINT64_C(31)) << 5;
9528 0 : Value = fixOneOperandFPComparison(MI, Value, STI);
9529 0 : break;
9530 : }
9531 : case AArch64::LDAPRB:
9532 : case AArch64::LDAPRH:
9533 : case AArch64::LDAPRW:
9534 : case AArch64::LDAPRX: {
9535 : // op: Rn
9536 0 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
9537 0 : Value |= (op & UINT64_C(31)) << 5;
9538 : // op: Rt
9539 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
9540 0 : Value |= op & UINT64_C(31);
9541 0 : break;
9542 : }
9543 : case AArch64::LDG: {
9544 : // op: Rn
9545 0 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
9546 0 : Value |= (op & UINT64_C(31)) << 5;
9547 : // op: Rt
9548 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
9549 0 : Value |= op & UINT64_C(31);
9550 : // op: offset
9551 0 : op = getMachineOpValue(MI, MI.getOperand(2), Fixups, STI);
9552 0 : Value |= (op & UINT64_C(511)) << 12;
9553 0 : break;
9554 : }
9555 : case AArch64::DUP_ZR_B:
9556 : case AArch64::DUP_ZR_D:
9557 : case AArch64::DUP_ZR_H:
9558 : case AArch64::DUP_ZR_S: {
9559 : // op: Rn
9560 0 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
9561 0 : Value |= (op & UINT64_C(31)) << 5;
9562 : // op: Zd
9563 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
9564 0 : Value |= op & UINT64_C(31);
9565 0 : break;
9566 : }
9567 : case AArch64::INDEX_RI_B:
9568 : case AArch64::INDEX_RI_D:
9569 : case AArch64::INDEX_RI_H:
9570 : case AArch64::INDEX_RI_S: {
9571 : // op: Rn
9572 0 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
9573 0 : Value |= (op & UINT64_C(31)) << 5;
9574 : // op: Zd
9575 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
9576 0 : Value |= op & UINT64_C(31);
9577 : // op: imm5
9578 0 : op = getMachineOpValue(MI, MI.getOperand(2), Fixups, STI);
9579 0 : Value |= (op & UINT64_C(31)) << 16;
9580 0 : break;
9581 : }
9582 : case AArch64::LDR_ZXI:
9583 : case AArch64::STR_ZXI: {
9584 : // op: Rn
9585 0 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
9586 0 : Value |= (op & UINT64_C(31)) << 5;
9587 : // op: Zt
9588 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
9589 0 : Value |= op & UINT64_C(31);
9590 : // op: imm9
9591 0 : op = getMachineOpValue(MI, MI.getOperand(2), Fixups, STI);
9592 0 : Value |= (op & UINT64_C(504)) << 13;
9593 0 : Value |= (op & UINT64_C(7)) << 10;
9594 0 : break;
9595 : }
9596 : case AArch64::ST2GPostIndex:
9597 : case AArch64::ST2GPreIndex:
9598 : case AArch64::STGPostIndex:
9599 : case AArch64::STGPreIndex:
9600 : case AArch64::STZ2GPostIndex:
9601 : case AArch64::STZ2GPreIndex:
9602 : case AArch64::STZGPostIndex:
9603 : case AArch64::STZGPreIndex: {
9604 : // op: Rn
9605 0 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
9606 0 : Value |= (op & UINT64_C(31)) << 5;
9607 : // op: offset
9608 0 : op = getMachineOpValue(MI, MI.getOperand(2), Fixups, STI);
9609 0 : Value |= (op & UINT64_C(511)) << 12;
9610 0 : break;
9611 : }
9612 : case AArch64::PRFB_PRI:
9613 : case AArch64::PRFD_PRI:
9614 : case AArch64::PRFH_PRI:
9615 : case AArch64::PRFW_PRI: {
9616 : // op: Rn
9617 0 : op = getMachineOpValue(MI, MI.getOperand(2), Fixups, STI);
9618 0 : Value |= (op & UINT64_C(31)) << 5;
9619 : // op: Pg
9620 0 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
9621 0 : Value |= (op & UINT64_C(7)) << 10;
9622 : // op: imm6
9623 0 : op = getMachineOpValue(MI, MI.getOperand(3), Fixups, STI);
9624 0 : Value |= (op & UINT64_C(63)) << 16;
9625 : // op: prfop
9626 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
9627 0 : Value |= op & UINT64_C(15);
9628 0 : break;
9629 : }
9630 : case AArch64::LDGV:
9631 : case AArch64::STGV: {
9632 : // op: Rn
9633 0 : op = getMachineOpValue(MI, MI.getOperand(2), Fixups, STI);
9634 0 : Value |= (op & UINT64_C(31)) << 5;
9635 : // op: Rt
9636 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
9637 0 : Value |= op & UINT64_C(31);
9638 0 : break;
9639 : }
9640 : case AArch64::LDADDAB:
9641 : case AArch64::LDADDAH:
9642 : case AArch64::LDADDALB:
9643 : case AArch64::LDADDALH:
9644 : case AArch64::LDADDALW:
9645 : case AArch64::LDADDALX:
9646 : case AArch64::LDADDAW:
9647 : case AArch64::LDADDAX:
9648 : case AArch64::LDADDB:
9649 : case AArch64::LDADDH:
9650 : case AArch64::LDADDLB:
9651 : case AArch64::LDADDLH:
9652 : case AArch64::LDADDLW:
9653 : case AArch64::LDADDLX:
9654 : case AArch64::LDADDW:
9655 : case AArch64::LDADDX:
9656 : case AArch64::LDCLRAB:
9657 : case AArch64::LDCLRAH:
9658 : case AArch64::LDCLRALB:
9659 : case AArch64::LDCLRALH:
9660 : case AArch64::LDCLRALW:
9661 : case AArch64::LDCLRALX:
9662 : case AArch64::LDCLRAW:
9663 : case AArch64::LDCLRAX:
9664 : case AArch64::LDCLRB:
9665 : case AArch64::LDCLRH:
9666 : case AArch64::LDCLRLB:
9667 : case AArch64::LDCLRLH:
9668 : case AArch64::LDCLRLW:
9669 : case AArch64::LDCLRLX:
9670 : case AArch64::LDCLRW:
9671 : case AArch64::LDCLRX:
9672 : case AArch64::LDEORAB:
9673 : case AArch64::LDEORAH:
9674 : case AArch64::LDEORALB:
9675 : case AArch64::LDEORALH:
9676 : case AArch64::LDEORALW:
9677 : case AArch64::LDEORALX:
9678 : case AArch64::LDEORAW:
9679 : case AArch64::LDEORAX:
9680 : case AArch64::LDEORB:
9681 : case AArch64::LDEORH:
9682 : case AArch64::LDEORLB:
9683 : case AArch64::LDEORLH:
9684 : case AArch64::LDEORLW:
9685 : case AArch64::LDEORLX:
9686 : case AArch64::LDEORW:
9687 : case AArch64::LDEORX:
9688 : case AArch64::LDSETAB:
9689 : case AArch64::LDSETAH:
9690 : case AArch64::LDSETALB:
9691 : case AArch64::LDSETALH:
9692 : case AArch64::LDSETALW:
9693 : case AArch64::LDSETALX:
9694 : case AArch64::LDSETAW:
9695 : case AArch64::LDSETAX:
9696 : case AArch64::LDSETB:
9697 : case AArch64::LDSETH:
9698 : case AArch64::LDSETLB:
9699 : case AArch64::LDSETLH:
9700 : case AArch64::LDSETLW:
9701 : case AArch64::LDSETLX:
9702 : case AArch64::LDSETW:
9703 : case AArch64::LDSETX:
9704 : case AArch64::LDSMAXAB:
9705 : case AArch64::LDSMAXAH:
9706 : case AArch64::LDSMAXALB:
9707 : case AArch64::LDSMAXALH:
9708 : case AArch64::LDSMAXALW:
9709 : case AArch64::LDSMAXALX:
9710 : case AArch64::LDSMAXAW:
9711 : case AArch64::LDSMAXAX:
9712 : case AArch64::LDSMAXB:
9713 : case AArch64::LDSMAXH:
9714 : case AArch64::LDSMAXLB:
9715 : case AArch64::LDSMAXLH:
9716 : case AArch64::LDSMAXLW:
9717 : case AArch64::LDSMAXLX:
9718 : case AArch64::LDSMAXW:
9719 : case AArch64::LDSMAXX:
9720 : case AArch64::LDSMINAB:
9721 : case AArch64::LDSMINAH:
9722 : case AArch64::LDSMINALB:
9723 : case AArch64::LDSMINALH:
9724 : case AArch64::LDSMINALW:
9725 : case AArch64::LDSMINALX:
9726 : case AArch64::LDSMINAW:
9727 : case AArch64::LDSMINAX:
9728 : case AArch64::LDSMINB:
9729 : case AArch64::LDSMINH:
9730 : case AArch64::LDSMINLB:
9731 : case AArch64::LDSMINLH:
9732 : case AArch64::LDSMINLW:
9733 : case AArch64::LDSMINLX:
9734 : case AArch64::LDSMINW:
9735 : case AArch64::LDSMINX:
9736 : case AArch64::LDUMAXAB:
9737 : case AArch64::LDUMAXAH:
9738 : case AArch64::LDUMAXALB:
9739 : case AArch64::LDUMAXALH:
9740 : case AArch64::LDUMAXALW:
9741 : case AArch64::LDUMAXALX:
9742 : case AArch64::LDUMAXAW:
9743 : case AArch64::LDUMAXAX:
9744 : case AArch64::LDUMAXB:
9745 : case AArch64::LDUMAXH:
9746 : case AArch64::LDUMAXLB:
9747 : case AArch64::LDUMAXLH:
9748 : case AArch64::LDUMAXLW:
9749 : case AArch64::LDUMAXLX:
9750 : case AArch64::LDUMAXW:
9751 : case AArch64::LDUMAXX:
9752 : case AArch64::LDUMINAB:
9753 : case AArch64::LDUMINAH:
9754 : case AArch64::LDUMINALB:
9755 : case AArch64::LDUMINALH:
9756 : case AArch64::LDUMINALW:
9757 : case AArch64::LDUMINALX:
9758 : case AArch64::LDUMINAW:
9759 : case AArch64::LDUMINAX:
9760 : case AArch64::LDUMINB:
9761 : case AArch64::LDUMINH:
9762 : case AArch64::LDUMINLB:
9763 : case AArch64::LDUMINLH:
9764 : case AArch64::LDUMINLW:
9765 : case AArch64::LDUMINLX:
9766 : case AArch64::LDUMINW:
9767 : case AArch64::LDUMINX:
9768 : case AArch64::SWPAB:
9769 : case AArch64::SWPAH:
9770 : case AArch64::SWPALB:
9771 : case AArch64::SWPALH:
9772 : case AArch64::SWPALW:
9773 : case AArch64::SWPALX:
9774 : case AArch64::SWPAW:
9775 : case AArch64::SWPAX:
9776 : case AArch64::SWPB:
9777 : case AArch64::SWPH:
9778 : case AArch64::SWPLB:
9779 : case AArch64::SWPLH:
9780 : case AArch64::SWPLW:
9781 : case AArch64::SWPLX:
9782 : case AArch64::SWPW:
9783 : case AArch64::SWPX: {
9784 : // op: Rs
9785 0 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
9786 0 : Value |= (op & UINT64_C(31)) << 16;
9787 : // op: Rn
9788 0 : op = getMachineOpValue(MI, MI.getOperand(2), Fixups, STI);
9789 0 : Value |= (op & UINT64_C(31)) << 5;
9790 : // op: Rt
9791 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
9792 0 : Value |= op & UINT64_C(31);
9793 0 : break;
9794 : }
9795 : case AArch64::CASAB:
9796 : case AArch64::CASAH:
9797 : case AArch64::CASALB:
9798 : case AArch64::CASALH:
9799 : case AArch64::CASALW:
9800 : case AArch64::CASALX:
9801 : case AArch64::CASAW:
9802 : case AArch64::CASAX:
9803 : case AArch64::CASB:
9804 : case AArch64::CASH:
9805 : case AArch64::CASLB:
9806 : case AArch64::CASLH:
9807 : case AArch64::CASLW:
9808 : case AArch64::CASLX:
9809 : case AArch64::CASPALW:
9810 : case AArch64::CASPALX:
9811 : case AArch64::CASPAW:
9812 : case AArch64::CASPAX:
9813 : case AArch64::CASPLW:
9814 : case AArch64::CASPLX:
9815 : case AArch64::CASPW:
9816 : case AArch64::CASPX:
9817 : case AArch64::CASW:
9818 : case AArch64::CASX: {
9819 : // op: Rs
9820 0 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
9821 0 : Value |= (op & UINT64_C(31)) << 16;
9822 : // op: Rn
9823 0 : op = getMachineOpValue(MI, MI.getOperand(3), Fixups, STI);
9824 0 : Value |= (op & UINT64_C(31)) << 5;
9825 : // op: Rt
9826 : op = getMachineOpValue(MI, MI.getOperand(2), Fixups, STI);
9827 0 : Value |= op & UINT64_C(31);
9828 0 : break;
9829 : }
9830 : case AArch64::LDRBBroW:
9831 : case AArch64::LDRBBroX:
9832 : case AArch64::LDRBroW:
9833 : case AArch64::LDRBroX:
9834 : case AArch64::LDRDroW:
9835 : case AArch64::LDRDroX:
9836 : case AArch64::LDRHHroW:
9837 : case AArch64::LDRHHroX:
9838 : case AArch64::LDRHroW:
9839 : case AArch64::LDRHroX:
9840 : case AArch64::LDRQroW:
9841 : case AArch64::LDRQroX:
9842 : case AArch64::LDRSBWroW:
9843 : case AArch64::LDRSBWroX:
9844 : case AArch64::LDRSBXroW:
9845 : case AArch64::LDRSBXroX:
9846 : case AArch64::LDRSHWroW:
9847 : case AArch64::LDRSHWroX:
9848 : case AArch64::LDRSHXroW:
9849 : case AArch64::LDRSHXroX:
9850 : case AArch64::LDRSWroW:
9851 : case AArch64::LDRSWroX:
9852 : case AArch64::LDRSroW:
9853 : case AArch64::LDRSroX:
9854 : case AArch64::LDRWroW:
9855 : case AArch64::LDRWroX:
9856 : case AArch64::LDRXroW:
9857 : case AArch64::LDRXroX:
9858 : case AArch64::PRFMroW:
9859 : case AArch64::PRFMroX:
9860 : case AArch64::STRBBroW:
9861 : case AArch64::STRBBroX:
9862 : case AArch64::STRBroW:
9863 : case AArch64::STRBroX:
9864 : case AArch64::STRDroW:
9865 : case AArch64::STRDroX:
9866 : case AArch64::STRHHroW:
9867 : case AArch64::STRHHroX:
9868 : case AArch64::STRHroW:
9869 : case AArch64::STRHroX:
9870 : case AArch64::STRQroW:
9871 : case AArch64::STRQroX:
9872 : case AArch64::STRSroW:
9873 : case AArch64::STRSroX:
9874 : case AArch64::STRWroW:
9875 : case AArch64::STRWroX:
9876 : case AArch64::STRXroW:
9877 : case AArch64::STRXroX: {
9878 : // op: Rt
9879 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
9880 0 : Value |= op & UINT64_C(31);
9881 : // op: Rn
9882 0 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
9883 0 : Value |= (op & UINT64_C(31)) << 5;
9884 : // op: Rm
9885 0 : op = getMachineOpValue(MI, MI.getOperand(2), Fixups, STI);
9886 0 : Value |= (op & UINT64_C(31)) << 16;
9887 : // op: extend
9888 0 : op = getMemExtendOpValue(MI, 3, Fixups, STI);
9889 0 : Value |= (op & UINT64_C(2)) << 14;
9890 0 : Value |= (op & UINT64_C(1)) << 12;
9891 0 : break;
9892 : }
9893 : case AArch64::LDRQui:
9894 : case AArch64::STRQui: {
9895 : // op: Rt
9896 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
9897 0 : Value |= op & UINT64_C(31);
9898 : // op: Rn
9899 0 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
9900 0 : Value |= (op & UINT64_C(31)) << 5;
9901 : // op: offset
9902 0 : op = getLdStUImm12OpValue<AArch64::fixup_aarch64_ldst_imm12_scale16>(MI, 2, Fixups, STI);
9903 0 : Value |= (op & UINT64_C(4095)) << 10;
9904 0 : break;
9905 : }
9906 : case AArch64::LDRBBui:
9907 : case AArch64::LDRBui:
9908 : case AArch64::LDRSBWui:
9909 : case AArch64::LDRSBXui:
9910 : case AArch64::STRBBui:
9911 : case AArch64::STRBui: {
9912 : // op: Rt
9913 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
9914 0 : Value |= op & UINT64_C(31);
9915 : // op: Rn
9916 0 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
9917 0 : Value |= (op & UINT64_C(31)) << 5;
9918 : // op: offset
9919 0 : op = getLdStUImm12OpValue<AArch64::fixup_aarch64_ldst_imm12_scale1>(MI, 2, Fixups, STI);
9920 0 : Value |= (op & UINT64_C(4095)) << 10;
9921 0 : break;
9922 : }
9923 : case AArch64::LDRHHui:
9924 : case AArch64::LDRHui:
9925 : case AArch64::LDRSHWui:
9926 : case AArch64::LDRSHXui:
9927 : case AArch64::STRHHui:
9928 : case AArch64::STRHui: {
9929 : // op: Rt
9930 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
9931 0 : Value |= op & UINT64_C(31);
9932 : // op: Rn
9933 0 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
9934 0 : Value |= (op & UINT64_C(31)) << 5;
9935 : // op: offset
9936 0 : op = getLdStUImm12OpValue<AArch64::fixup_aarch64_ldst_imm12_scale2>(MI, 2, Fixups, STI);
9937 0 : Value |= (op & UINT64_C(4095)) << 10;
9938 0 : break;
9939 : }
9940 : case AArch64::LDRSWui:
9941 : case AArch64::LDRSui:
9942 : case AArch64::LDRWui:
9943 : case AArch64::STRSui:
9944 : case AArch64::STRWui: {
9945 : // op: Rt
9946 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
9947 0 : Value |= op & UINT64_C(31);
9948 : // op: Rn
9949 0 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
9950 0 : Value |= (op & UINT64_C(31)) << 5;
9951 : // op: offset
9952 0 : op = getLdStUImm12OpValue<AArch64::fixup_aarch64_ldst_imm12_scale4>(MI, 2, Fixups, STI);
9953 0 : Value |= (op & UINT64_C(4095)) << 10;
9954 0 : break;
9955 : }
9956 : case AArch64::LDRDui:
9957 : case AArch64::LDRXui:
9958 : case AArch64::PRFMui:
9959 : case AArch64::STRDui:
9960 : case AArch64::STRXui: {
9961 : // op: Rt
9962 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
9963 0 : Value |= op & UINT64_C(31);
9964 : // op: Rn
9965 0 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
9966 0 : Value |= (op & UINT64_C(31)) << 5;
9967 : // op: offset
9968 0 : op = getLdStUImm12OpValue<AArch64::fixup_aarch64_ldst_imm12_scale8>(MI, 2, Fixups, STI);
9969 0 : Value |= (op & UINT64_C(4095)) << 10;
9970 0 : break;
9971 : }
9972 : case AArch64::LDAPURBi:
9973 : case AArch64::LDAPURHi:
9974 : case AArch64::LDAPURSBWi:
9975 : case AArch64::LDAPURSBXi:
9976 : case AArch64::LDAPURSHWi:
9977 : case AArch64::LDAPURSHXi:
9978 : case AArch64::LDAPURSWi:
9979 : case AArch64::LDAPURXi:
9980 : case AArch64::LDAPURi:
9981 : case AArch64::LDTRBi:
9982 : case AArch64::LDTRHi:
9983 : case AArch64::LDTRSBWi:
9984 : case AArch64::LDTRSBXi:
9985 : case AArch64::LDTRSHWi:
9986 : case AArch64::LDTRSHXi:
9987 : case AArch64::LDTRSWi:
9988 : case AArch64::LDTRWi:
9989 : case AArch64::LDTRXi:
9990 : case AArch64::LDURBBi:
9991 : case AArch64::LDURBi:
9992 : case AArch64::LDURDi:
9993 : case AArch64::LDURHHi:
9994 : case AArch64::LDURHi:
9995 : case AArch64::LDURQi:
9996 : case AArch64::LDURSBWi:
9997 : case AArch64::LDURSBXi:
9998 : case AArch64::LDURSHWi:
9999 : case AArch64::LDURSHXi:
10000 : case AArch64::LDURSWi:
10001 : case AArch64::LDURSi:
10002 : case AArch64::LDURWi:
10003 : case AArch64::LDURXi:
10004 : case AArch64::PRFUMi:
10005 : case AArch64::STLURBi:
10006 : case AArch64::STLURHi:
10007 : case AArch64::STLURWi:
10008 : case AArch64::STLURXi:
10009 : case AArch64::STTRBi:
10010 : case AArch64::STTRHi:
10011 : case AArch64::STTRWi:
10012 : case AArch64::STTRXi:
10013 : case AArch64::STURBBi:
10014 : case AArch64::STURBi:
10015 : case AArch64::STURDi:
10016 : case AArch64::STURHHi:
10017 : case AArch64::STURHi:
10018 : case AArch64::STURQi:
10019 : case AArch64::STURSi:
10020 : case AArch64::STURWi:
10021 : case AArch64::STURXi: {
10022 : // op: Rt
10023 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
10024 0 : Value |= op & UINT64_C(31);
10025 : // op: Rn
10026 0 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
10027 0 : Value |= (op & UINT64_C(31)) << 5;
10028 : // op: offset
10029 0 : op = getMachineOpValue(MI, MI.getOperand(2), Fixups, STI);
10030 0 : Value |= (op & UINT64_C(511)) << 12;
10031 0 : break;
10032 : }
10033 : case AArch64::LDARB:
10034 : case AArch64::LDARH:
10035 : case AArch64::LDARW:
10036 : case AArch64::LDARX:
10037 : case AArch64::LDAXRB:
10038 : case AArch64::LDAXRH:
10039 : case AArch64::LDAXRW:
10040 : case AArch64::LDAXRX:
10041 : case AArch64::LDLARB:
10042 : case AArch64::LDLARH:
10043 : case AArch64::LDLARW:
10044 : case AArch64::LDLARX:
10045 : case AArch64::LDXRB:
10046 : case AArch64::LDXRH:
10047 : case AArch64::LDXRW:
10048 : case AArch64::LDXRX:
10049 : case AArch64::STLLRB:
10050 : case AArch64::STLLRH:
10051 : case AArch64::STLLRW:
10052 : case AArch64::STLLRX:
10053 : case AArch64::STLRB:
10054 : case AArch64::STLRH:
10055 : case AArch64::STLRW:
10056 : case AArch64::STLRX: {
10057 : // op: Rt
10058 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
10059 0 : Value |= op & UINT64_C(31);
10060 : // op: Rn
10061 0 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
10062 0 : Value |= (op & UINT64_C(31)) << 5;
10063 0 : Value = fixLoadStoreExclusive<0,0>(MI, Value, STI);
10064 0 : break;
10065 : }
10066 : case AArch64::LDNPDi:
10067 : case AArch64::LDNPQi:
10068 : case AArch64::LDNPSi:
10069 : case AArch64::LDNPWi:
10070 : case AArch64::LDNPXi:
10071 : case AArch64::LDPDi:
10072 : case AArch64::LDPQi:
10073 : case AArch64::LDPSWi:
10074 : case AArch64::LDPSi:
10075 : case AArch64::LDPWi:
10076 : case AArch64::LDPXi:
10077 : case AArch64::STGPi:
10078 : case AArch64::STNPDi:
10079 : case AArch64::STNPQi:
10080 : case AArch64::STNPSi:
10081 : case AArch64::STNPWi:
10082 : case AArch64::STNPXi:
10083 : case AArch64::STPDi:
10084 : case AArch64::STPQi:
10085 : case AArch64::STPSi:
10086 : case AArch64::STPWi:
10087 : case AArch64::STPXi: {
10088 : // op: Rt
10089 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
10090 0 : Value |= op & UINT64_C(31);
10091 : // op: Rt2
10092 0 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
10093 0 : Value |= (op & UINT64_C(31)) << 10;
10094 : // op: Rn
10095 0 : op = getMachineOpValue(MI, MI.getOperand(2), Fixups, STI);
10096 0 : Value |= (op & UINT64_C(31)) << 5;
10097 : // op: offset
10098 0 : op = getMachineOpValue(MI, MI.getOperand(3), Fixups, STI);
10099 0 : Value |= (op & UINT64_C(127)) << 15;
10100 0 : break;
10101 : }
10102 : case AArch64::LDAXPW:
10103 : case AArch64::LDAXPX:
10104 : case AArch64::LDXPW:
10105 : case AArch64::LDXPX: {
10106 : // op: Rt
10107 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
10108 0 : Value |= op & UINT64_C(31);
10109 : // op: Rt2
10110 0 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
10111 0 : Value |= (op & UINT64_C(31)) << 10;
10112 : // op: Rn
10113 0 : op = getMachineOpValue(MI, MI.getOperand(2), Fixups, STI);
10114 0 : Value |= (op & UINT64_C(31)) << 5;
10115 0 : Value = fixLoadStoreExclusive<0,1>(MI, Value, STI);
10116 0 : break;
10117 : }
10118 : case AArch64::TBNZW:
10119 : case AArch64::TBNZX:
10120 : case AArch64::TBZW:
10121 : case AArch64::TBZX: {
10122 : // op: Rt
10123 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
10124 0 : Value |= op & UINT64_C(31);
10125 : // op: bit_off
10126 0 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
10127 0 : Value |= (op & UINT64_C(31)) << 19;
10128 : // op: target
10129 0 : op = getTestBranchTargetOpValue(MI, 2, Fixups, STI);
10130 0 : Value |= (op & UINT64_C(16383)) << 5;
10131 0 : break;
10132 : }
10133 : case AArch64::LDRDl:
10134 : case AArch64::LDRQl:
10135 : case AArch64::LDRSWl:
10136 : case AArch64::LDRSl:
10137 : case AArch64::LDRWl:
10138 : case AArch64::LDRXl:
10139 : case AArch64::PRFMl: {
10140 : // op: Rt
10141 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
10142 0 : Value |= op & UINT64_C(31);
10143 : // op: label
10144 0 : op = getLoadLiteralOpValue(MI, 1, Fixups, STI);
10145 0 : Value |= (op & UINT64_C(524287)) << 5;
10146 0 : break;
10147 : }
10148 : case AArch64::SYSLxt: {
10149 : // op: Rt
10150 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
10151 0 : Value |= op & UINT64_C(31);
10152 : // op: op1
10153 0 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
10154 0 : Value |= (op & UINT64_C(7)) << 16;
10155 : // op: Cn
10156 0 : op = getMachineOpValue(MI, MI.getOperand(2), Fixups, STI);
10157 0 : Value |= (op & UINT64_C(15)) << 12;
10158 : // op: Cm
10159 0 : op = getMachineOpValue(MI, MI.getOperand(3), Fixups, STI);
10160 0 : Value |= (op & UINT64_C(15)) << 8;
10161 : // op: op2
10162 0 : op = getMachineOpValue(MI, MI.getOperand(4), Fixups, STI);
10163 0 : Value |= (op & UINT64_C(7)) << 5;
10164 0 : break;
10165 : }
10166 : case AArch64::MRS: {
10167 : // op: Rt
10168 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
10169 0 : Value |= op & UINT64_C(31);
10170 : // op: systemreg
10171 0 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
10172 0 : Value |= (op & UINT64_C(65535)) << 5;
10173 0 : break;
10174 : }
10175 : case AArch64::CBNZW:
10176 : case AArch64::CBNZX:
10177 : case AArch64::CBZW:
10178 : case AArch64::CBZX: {
10179 : // op: Rt
10180 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
10181 0 : Value |= op & UINT64_C(31);
10182 : // op: target
10183 0 : op = getCondBranchTargetOpValue(MI, 1, Fixups, STI);
10184 0 : Value |= (op & UINT64_C(524287)) << 5;
10185 0 : break;
10186 : }
10187 : case AArch64::LDRBBpost:
10188 : case AArch64::LDRBBpre:
10189 : case AArch64::LDRBpost:
10190 : case AArch64::LDRBpre:
10191 : case AArch64::LDRDpost:
10192 : case AArch64::LDRDpre:
10193 : case AArch64::LDRHHpost:
10194 : case AArch64::LDRHHpre:
10195 : case AArch64::LDRHpost:
10196 : case AArch64::LDRHpre:
10197 : case AArch64::LDRQpost:
10198 : case AArch64::LDRQpre:
10199 : case AArch64::LDRSBWpost:
10200 : case AArch64::LDRSBWpre:
10201 : case AArch64::LDRSBXpost:
10202 : case AArch64::LDRSBXpre:
10203 : case AArch64::LDRSHWpost:
10204 : case AArch64::LDRSHWpre:
10205 : case AArch64::LDRSHXpost:
10206 : case AArch64::LDRSHXpre:
10207 : case AArch64::LDRSWpost:
10208 : case AArch64::LDRSWpre:
10209 : case AArch64::LDRSpost:
10210 : case AArch64::LDRSpre:
10211 : case AArch64::LDRWpost:
10212 : case AArch64::LDRWpre:
10213 : case AArch64::LDRXpost:
10214 : case AArch64::LDRXpre:
10215 : case AArch64::STRBBpost:
10216 : case AArch64::STRBBpre:
10217 : case AArch64::STRBpost:
10218 : case AArch64::STRBpre:
10219 : case AArch64::STRDpost:
10220 : case AArch64::STRDpre:
10221 : case AArch64::STRHHpost:
10222 : case AArch64::STRHHpre:
10223 : case AArch64::STRHpost:
10224 : case AArch64::STRHpre:
10225 : case AArch64::STRQpost:
10226 : case AArch64::STRQpre:
10227 : case AArch64::STRSpost:
10228 : case AArch64::STRSpre:
10229 : case AArch64::STRWpost:
10230 : case AArch64::STRWpre:
10231 : case AArch64::STRXpost:
10232 : case AArch64::STRXpre: {
10233 : // op: Rt
10234 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
10235 0 : Value |= op & UINT64_C(31);
10236 : // op: Rn
10237 0 : op = getMachineOpValue(MI, MI.getOperand(2), Fixups, STI);
10238 0 : Value |= (op & UINT64_C(31)) << 5;
10239 : // op: offset
10240 0 : op = getMachineOpValue(MI, MI.getOperand(3), Fixups, STI);
10241 0 : Value |= (op & UINT64_C(511)) << 12;
10242 0 : break;
10243 : }
10244 : case AArch64::LDPDpost:
10245 : case AArch64::LDPDpre:
10246 : case AArch64::LDPQpost:
10247 : case AArch64::LDPQpre:
10248 : case AArch64::LDPSWpost:
10249 : case AArch64::LDPSWpre:
10250 : case AArch64::LDPSpost:
10251 : case AArch64::LDPSpre:
10252 : case AArch64::LDPWpost:
10253 : case AArch64::LDPWpre:
10254 : case AArch64::LDPXpost:
10255 : case AArch64::LDPXpre:
10256 : case AArch64::STGPpost:
10257 : case AArch64::STGPpre:
10258 : case AArch64::STPDpost:
10259 : case AArch64::STPDpre:
10260 : case AArch64::STPQpost:
10261 : case AArch64::STPQpre:
10262 : case AArch64::STPSpost:
10263 : case AArch64::STPSpre:
10264 : case AArch64::STPWpost:
10265 : case AArch64::STPWpre:
10266 : case AArch64::STPXpost:
10267 : case AArch64::STPXpre: {
10268 : // op: Rt
10269 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
10270 0 : Value |= op & UINT64_C(31);
10271 : // op: Rt2
10272 0 : op = getMachineOpValue(MI, MI.getOperand(2), Fixups, STI);
10273 0 : Value |= (op & UINT64_C(31)) << 10;
10274 : // op: Rn
10275 0 : op = getMachineOpValue(MI, MI.getOperand(3), Fixups, STI);
10276 0 : Value |= (op & UINT64_C(31)) << 5;
10277 : // op: offset
10278 0 : op = getMachineOpValue(MI, MI.getOperand(4), Fixups, STI);
10279 0 : Value |= (op & UINT64_C(127)) << 15;
10280 0 : break;
10281 : }
10282 : case AArch64::MSR: {
10283 : // op: Rt
10284 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
10285 0 : Value |= op & UINT64_C(31);
10286 : // op: systemreg
10287 0 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
10288 0 : Value |= (op & UINT64_C(65535)) << 5;
10289 0 : break;
10290 : }
10291 : case AArch64::SYSxt: {
10292 : // op: Rt
10293 : op = getMachineOpValue(MI, MI.getOperand(4), Fixups, STI);
10294 0 : Value |= op & UINT64_C(31);
10295 : // op: op1
10296 0 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
10297 0 : Value |= (op & UINT64_C(7)) << 16;
10298 : // op: Cn
10299 0 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
10300 0 : Value |= (op & UINT64_C(15)) << 12;
10301 : // op: Cm
10302 0 : op = getMachineOpValue(MI, MI.getOperand(2), Fixups, STI);
10303 0 : Value |= (op & UINT64_C(15)) << 8;
10304 : // op: op2
10305 0 : op = getMachineOpValue(MI, MI.getOperand(3), Fixups, STI);
10306 0 : Value |= (op & UINT64_C(7)) << 5;
10307 0 : break;
10308 : }
10309 : case AArch64::SHA512SU0:
10310 : case AArch64::SM4E: {
10311 : // op: Vd
10312 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
10313 0 : Value |= op & UINT64_C(31);
10314 : // op: Vn
10315 0 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
10316 0 : Value |= (op & UINT64_C(31)) << 5;
10317 0 : break;
10318 : }
10319 : case AArch64::RAX1:
10320 : case AArch64::SM4ENCKEY:
10321 : case AArch64::TBLv16i8Four:
10322 : case AArch64::TBLv16i8One:
10323 : case AArch64::TBLv16i8Three:
10324 : case AArch64::TBLv16i8Two:
10325 : case AArch64::TBLv8i8Four:
10326 : case AArch64::TBLv8i8One:
10327 : case AArch64::TBLv8i8Three:
10328 : case AArch64::TBLv8i8Two: {
10329 : // op: Vd
10330 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
10331 0 : Value |= op & UINT64_C(31);
10332 : // op: Vn
10333 0 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
10334 0 : Value |= (op & UINT64_C(31)) << 5;
10335 : // op: Vm
10336 0 : op = getMachineOpValue(MI, MI.getOperand(2), Fixups, STI);
10337 0 : Value |= (op & UINT64_C(31)) << 16;
10338 0 : break;
10339 : }
10340 : case AArch64::BCAX:
10341 : case AArch64::EOR3:
10342 : case AArch64::SM3SS1: {
10343 : // op: Vd
10344 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
10345 0 : Value |= op & UINT64_C(31);
10346 : // op: Vn
10347 0 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
10348 0 : Value |= (op & UINT64_C(31)) << 5;
10349 : // op: Vm
10350 0 : op = getMachineOpValue(MI, MI.getOperand(2), Fixups, STI);
10351 0 : Value |= (op & UINT64_C(31)) << 16;
10352 : // op: Va
10353 0 : op = getMachineOpValue(MI, MI.getOperand(3), Fixups, STI);
10354 0 : Value |= (op & UINT64_C(31)) << 10;
10355 0 : break;
10356 : }
10357 : case AArch64::XAR: {
10358 : // op: Vd
10359 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
10360 0 : Value |= op & UINT64_C(31);
10361 : // op: Vn
10362 0 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
10363 0 : Value |= (op & UINT64_C(31)) << 5;
10364 : // op: imm
10365 0 : op = getMachineOpValue(MI, MI.getOperand(3), Fixups, STI);
10366 0 : Value |= (op & UINT64_C(63)) << 10;
10367 : // op: Vm
10368 0 : op = getMachineOpValue(MI, MI.getOperand(2), Fixups, STI);
10369 0 : Value |= (op & UINT64_C(31)) << 16;
10370 0 : break;
10371 : }
10372 : case AArch64::SHA512H:
10373 : case AArch64::SHA512H2:
10374 : case AArch64::SHA512SU1:
10375 : case AArch64::SM3PARTW1:
10376 : case AArch64::SM3PARTW2:
10377 : case AArch64::TBXv16i8Four:
10378 : case AArch64::TBXv16i8One:
10379 : case AArch64::TBXv16i8Three:
10380 : case AArch64::TBXv16i8Two:
10381 : case AArch64::TBXv8i8Four:
10382 : case AArch64::TBXv8i8One:
10383 : case AArch64::TBXv8i8Three:
10384 : case AArch64::TBXv8i8Two: {
10385 : // op: Vd
10386 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
10387 0 : Value |= op & UINT64_C(31);
10388 : // op: Vn
10389 0 : op = getMachineOpValue(MI, MI.getOperand(2), Fixups, STI);
10390 0 : Value |= (op & UINT64_C(31)) << 5;
10391 : // op: Vm
10392 0 : op = getMachineOpValue(MI, MI.getOperand(3), Fixups, STI);
10393 0 : Value |= (op & UINT64_C(31)) << 16;
10394 0 : break;
10395 : }
10396 : case AArch64::SM3TT1A:
10397 : case AArch64::SM3TT1B:
10398 : case AArch64::SM3TT2A:
10399 : case AArch64::SM3TT2B: {
10400 : // op: Vd
10401 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
10402 0 : Value |= op & UINT64_C(31);
10403 : // op: Vn
10404 0 : op = getMachineOpValue(MI, MI.getOperand(2), Fixups, STI);
10405 0 : Value |= (op & UINT64_C(31)) << 5;
10406 : // op: imm
10407 0 : op = getMachineOpValue(MI, MI.getOperand(4), Fixups, STI);
10408 0 : Value |= (op & UINT64_C(3)) << 12;
10409 : // op: Vm
10410 0 : op = getMachineOpValue(MI, MI.getOperand(3), Fixups, STI);
10411 0 : Value |= (op & UINT64_C(31)) << 16;
10412 0 : break;
10413 : }
10414 : case AArch64::INSR_ZV_B:
10415 : case AArch64::INSR_ZV_D:
10416 : case AArch64::INSR_ZV_H:
10417 : case AArch64::INSR_ZV_S: {
10418 : // op: Vm
10419 0 : op = getMachineOpValue(MI, MI.getOperand(2), Fixups, STI);
10420 0 : Value |= (op & UINT64_C(31)) << 5;
10421 : // op: Zdn
10422 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
10423 0 : Value |= op & UINT64_C(31);
10424 0 : break;
10425 : }
10426 : case AArch64::LD1Fourv16b:
10427 : case AArch64::LD1Fourv1d:
10428 : case AArch64::LD1Fourv2d:
10429 : case AArch64::LD1Fourv2s:
10430 : case AArch64::LD1Fourv4h:
10431 : case AArch64::LD1Fourv4s:
10432 : case AArch64::LD1Fourv8b:
10433 : case AArch64::LD1Fourv8h:
10434 : case AArch64::LD1Onev16b:
10435 : case AArch64::LD1Onev1d:
10436 : case AArch64::LD1Onev2d:
10437 : case AArch64::LD1Onev2s:
10438 : case AArch64::LD1Onev4h:
10439 : case AArch64::LD1Onev4s:
10440 : case AArch64::LD1Onev8b:
10441 : case AArch64::LD1Onev8h:
10442 : case AArch64::LD1Rv16b:
10443 : case AArch64::LD1Rv1d:
10444 : case AArch64::LD1Rv2d:
10445 : case AArch64::LD1Rv2s:
10446 : case AArch64::LD1Rv4h:
10447 : case AArch64::LD1Rv4s:
10448 : case AArch64::LD1Rv8b:
10449 : case AArch64::LD1Rv8h:
10450 : case AArch64::LD1Threev16b:
10451 : case AArch64::LD1Threev1d:
10452 : case AArch64::LD1Threev2d:
10453 : case AArch64::LD1Threev2s:
10454 : case AArch64::LD1Threev4h:
10455 : case AArch64::LD1Threev4s:
10456 : case AArch64::LD1Threev8b:
10457 : case AArch64::LD1Threev8h:
10458 : case AArch64::LD1Twov16b:
10459 : case AArch64::LD1Twov1d:
10460 : case AArch64::LD1Twov2d:
10461 : case AArch64::LD1Twov2s:
10462 : case AArch64::LD1Twov4h:
10463 : case AArch64::LD1Twov4s:
10464 : case AArch64::LD1Twov8b:
10465 : case AArch64::LD1Twov8h:
10466 : case AArch64::LD2Rv16b:
10467 : case AArch64::LD2Rv1d:
10468 : case AArch64::LD2Rv2d:
10469 : case AArch64::LD2Rv2s:
10470 : case AArch64::LD2Rv4h:
10471 : case AArch64::LD2Rv4s:
10472 : case AArch64::LD2Rv8b:
10473 : case AArch64::LD2Rv8h:
10474 : case AArch64::LD2Twov16b:
10475 : case AArch64::LD2Twov2d:
10476 : case AArch64::LD2Twov2s:
10477 : case AArch64::LD2Twov4h:
10478 : case AArch64::LD2Twov4s:
10479 : case AArch64::LD2Twov8b:
10480 : case AArch64::LD2Twov8h:
10481 : case AArch64::LD3Rv16b:
10482 : case AArch64::LD3Rv1d:
10483 : case AArch64::LD3Rv2d:
10484 : case AArch64::LD3Rv2s:
10485 : case AArch64::LD3Rv4h:
10486 : case AArch64::LD3Rv4s:
10487 : case AArch64::LD3Rv8b:
10488 : case AArch64::LD3Rv8h:
10489 : case AArch64::LD3Threev16b:
10490 : case AArch64::LD3Threev2d:
10491 : case AArch64::LD3Threev2s:
10492 : case AArch64::LD3Threev4h:
10493 : case AArch64::LD3Threev4s:
10494 : case AArch64::LD3Threev8b:
10495 : case AArch64::LD3Threev8h:
10496 : case AArch64::LD4Fourv16b:
10497 : case AArch64::LD4Fourv2d:
10498 : case AArch64::LD4Fourv2s:
10499 : case AArch64::LD4Fourv4h:
10500 : case AArch64::LD4Fourv4s:
10501 : case AArch64::LD4Fourv8b:
10502 : case AArch64::LD4Fourv8h:
10503 : case AArch64::LD4Rv16b:
10504 : case AArch64::LD4Rv1d:
10505 : case AArch64::LD4Rv2d:
10506 : case AArch64::LD4Rv2s:
10507 : case AArch64::LD4Rv4h:
10508 : case AArch64::LD4Rv4s:
10509 : case AArch64::LD4Rv8b:
10510 : case AArch64::LD4Rv8h:
10511 : case AArch64::ST1Fourv16b:
10512 : case AArch64::ST1Fourv1d:
10513 : case AArch64::ST1Fourv2d:
10514 : case AArch64::ST1Fourv2s:
10515 : case AArch64::ST1Fourv4h:
10516 : case AArch64::ST1Fourv4s:
10517 : case AArch64::ST1Fourv8b:
10518 : case AArch64::ST1Fourv8h:
10519 : case AArch64::ST1Onev16b:
10520 : case AArch64::ST1Onev1d:
10521 : case AArch64::ST1Onev2d:
10522 : case AArch64::ST1Onev2s:
10523 : case AArch64::ST1Onev4h:
10524 : case AArch64::ST1Onev4s:
10525 : case AArch64::ST1Onev8b:
10526 : case AArch64::ST1Onev8h:
10527 : case AArch64::ST1Threev16b:
10528 : case AArch64::ST1Threev1d:
10529 : case AArch64::ST1Threev2d:
10530 : case AArch64::ST1Threev2s:
10531 : case AArch64::ST1Threev4h:
10532 : case AArch64::ST1Threev4s:
10533 : case AArch64::ST1Threev8b:
10534 : case AArch64::ST1Threev8h:
10535 : case AArch64::ST1Twov16b:
10536 : case AArch64::ST1Twov1d:
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10545 : case AArch64::ST2Twov2s:
10546 : case AArch64::ST2Twov4h:
10547 : case AArch64::ST2Twov4s:
10548 : case AArch64::ST2Twov8b:
10549 : case AArch64::ST2Twov8h:
10550 : case AArch64::ST3Threev16b:
10551 : case AArch64::ST3Threev2d:
10552 : case AArch64::ST3Threev2s:
10553 : case AArch64::ST3Threev4h:
10554 : case AArch64::ST3Threev4s:
10555 : case AArch64::ST3Threev8b:
10556 : case AArch64::ST3Threev8h:
10557 : case AArch64::ST4Fourv16b:
10558 : case AArch64::ST4Fourv2d:
10559 : case AArch64::ST4Fourv2s:
10560 : case AArch64::ST4Fourv4h:
10561 : case AArch64::ST4Fourv4s:
10562 : case AArch64::ST4Fourv8b:
10563 : case AArch64::ST4Fourv8h: {
10564 : // op: Vt
10565 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
10566 0 : Value |= op & UINT64_C(31);
10567 : // op: Rn
10568 0 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
10569 0 : Value |= (op & UINT64_C(31)) << 5;
10570 0 : break;
10571 : }
10572 : case AArch64::ST1i64:
10573 : case AArch64::ST2i64:
10574 : case AArch64::ST3i64:
10575 : case AArch64::ST4i64: {
10576 : // op: Vt
10577 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
10578 0 : Value |= op & UINT64_C(31);
10579 : // op: Rn
10580 0 : op = getMachineOpValue(MI, MI.getOperand(2), Fixups, STI);
10581 0 : Value |= (op & UINT64_C(31)) << 5;
10582 : // op: idx
10583 0 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
10584 0 : Value |= (op & UINT64_C(1)) << 30;
10585 0 : break;
10586 : }
10587 : case AArch64::ST1i32:
10588 : case AArch64::ST2i32:
10589 : case AArch64::ST3i32:
10590 : case AArch64::ST4i32: {
10591 : // op: Vt
10592 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
10593 0 : Value |= op & UINT64_C(31);
10594 : // op: Rn
10595 0 : op = getMachineOpValue(MI, MI.getOperand(2), Fixups, STI);
10596 0 : Value |= (op & UINT64_C(31)) << 5;
10597 : // op: idx
10598 0 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
10599 0 : Value |= (op & UINT64_C(2)) << 29;
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10601 0 : break;
10602 : }
10603 : case AArch64::ST1i16:
10604 : case AArch64::ST2i16:
10605 : case AArch64::ST3i16:
10606 : case AArch64::ST4i16: {
10607 : // op: Vt
10608 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
10609 0 : Value |= op & UINT64_C(31);
10610 : // op: Rn
10611 0 : op = getMachineOpValue(MI, MI.getOperand(2), Fixups, STI);
10612 0 : Value |= (op & UINT64_C(31)) << 5;
10613 : // op: idx
10614 0 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
10615 0 : Value |= (op & UINT64_C(4)) << 28;
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10617 0 : break;
10618 : }
10619 : case AArch64::ST1i8:
10620 : case AArch64::ST2i8:
10621 : case AArch64::ST3i8:
10622 : case AArch64::ST4i8: {
10623 : // op: Vt
10624 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
10625 0 : Value |= op & UINT64_C(31);
10626 : // op: Rn
10627 0 : op = getMachineOpValue(MI, MI.getOperand(2), Fixups, STI);
10628 0 : Value |= (op & UINT64_C(31)) << 5;
10629 : // op: idx
10630 0 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
10631 0 : Value |= (op & UINT64_C(8)) << 27;
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10633 0 : break;
10634 : }
10635 : case AArch64::LD1Fourv16b_POST:
10636 : case AArch64::LD1Fourv1d_POST:
10637 : case AArch64::LD1Fourv2d_POST:
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10772 : case AArch64::ST4Fourv8h_POST: {
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10778 0 : Value |= (op & UINT64_C(31)) << 5;
10779 : // op: Xm
10780 0 : op = getMachineOpValue(MI, MI.getOperand(3), Fixups, STI);
10781 0 : Value |= (op & UINT64_C(31)) << 16;
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10783 : }
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10790 0 : Value |= op & UINT64_C(31);
10791 : // op: Rn
10792 0 : op = getMachineOpValue(MI, MI.getOperand(3), Fixups, STI);
10793 0 : Value |= (op & UINT64_C(31)) << 5;
10794 : // op: idx
10795 0 : op = getMachineOpValue(MI, MI.getOperand(2), Fixups, STI);
10796 0 : Value |= (op & UINT64_C(1)) << 30;
10797 0 : break;
10798 : }
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10809 : // op: idx
10810 0 : op = getMachineOpValue(MI, MI.getOperand(2), Fixups, STI);
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10812 : // op: Xm
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10826 0 : Value |= (op & UINT64_C(31)) << 5;
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10841 0 : op = getMachineOpValue(MI, MI.getOperand(3), Fixups, STI);
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10844 0 : op = getMachineOpValue(MI, MI.getOperand(2), Fixups, STI);
10845 0 : Value |= (op & UINT64_C(2)) << 29;
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10863 0 : op = getMachineOpValue(MI, MI.getOperand(2), Fixups, STI);
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10876 0 : op = getMachineOpValue(MI, MI.getOperand(3), Fixups, STI);
10877 0 : Value |= (op & UINT64_C(31)) << 5;
10878 : // op: idx
10879 0 : op = getMachineOpValue(MI, MI.getOperand(2), Fixups, STI);
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10882 : // op: Xm
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10884 0 : Value |= (op & UINT64_C(31)) << 16;
10885 0 : break;
10886 : }
10887 : case AArch64::LD1i8:
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10891 : // op: Vt
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10897 : // op: idx
10898 0 : op = getMachineOpValue(MI, MI.getOperand(2), Fixups, STI);
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10902 : }
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10907 : // op: Vt
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10910 : // op: Rn
10911 0 : op = getMachineOpValue(MI, MI.getOperand(3), Fixups, STI);
10912 0 : Value |= (op & UINT64_C(31)) << 5;
10913 : // op: idx
10914 0 : op = getMachineOpValue(MI, MI.getOperand(2), Fixups, STI);
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10920 0 : break;
10921 : }
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10930 0 : op = getMachineOpValue(MI, MI.getOperand(4), Fixups, STI);
10931 0 : Value |= (op & UINT64_C(31)) << 5;
10932 : // op: idx
10933 0 : op = getMachineOpValue(MI, MI.getOperand(3), Fixups, STI);
10934 0 : Value |= (op & UINT64_C(1)) << 30;
10935 : // op: Xm
10936 0 : op = getMachineOpValue(MI, MI.getOperand(5), Fixups, STI);
10937 0 : Value |= (op & UINT64_C(31)) << 16;
10938 0 : break;
10939 : }
10940 : case AArch64::LD1i32_POST:
10941 : case AArch64::LD2i32_POST:
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10943 : case AArch64::LD4i32_POST: {
10944 : // op: Vt
10945 : op = getMachineOpValue(MI, MI.getOperand(2), Fixups, STI);
10946 0 : Value |= op & UINT64_C(31);
10947 : // op: Rn
10948 0 : op = getMachineOpValue(MI, MI.getOperand(4), Fixups, STI);
10949 0 : Value |= (op & UINT64_C(31)) << 5;
10950 : // op: idx
10951 0 : op = getMachineOpValue(MI, MI.getOperand(3), Fixups, STI);
10952 0 : Value |= (op & UINT64_C(2)) << 29;
10953 0 : Value |= (op & UINT64_C(1)) << 12;
10954 : // op: Xm
10955 0 : op = getMachineOpValue(MI, MI.getOperand(5), Fixups, STI);
10956 0 : Value |= (op & UINT64_C(31)) << 16;
10957 0 : break;
10958 : }
10959 : case AArch64::LD1i16_POST:
10960 : case AArch64::LD2i16_POST:
10961 : case AArch64::LD3i16_POST:
10962 : case AArch64::LD4i16_POST: {
10963 : // op: Vt
10964 : op = getMachineOpValue(MI, MI.getOperand(2), Fixups, STI);
10965 0 : Value |= op & UINT64_C(31);
10966 : // op: Rn
10967 0 : op = getMachineOpValue(MI, MI.getOperand(4), Fixups, STI);
10968 0 : Value |= (op & UINT64_C(31)) << 5;
10969 : // op: idx
10970 0 : op = getMachineOpValue(MI, MI.getOperand(3), Fixups, STI);
10971 0 : Value |= (op & UINT64_C(4)) << 28;
10972 0 : Value |= (op & UINT64_C(3)) << 11;
10973 : // op: Xm
10974 0 : op = getMachineOpValue(MI, MI.getOperand(5), Fixups, STI);
10975 0 : Value |= (op & UINT64_C(31)) << 16;
10976 0 : break;
10977 : }
10978 : case AArch64::LD1i8_POST:
10979 : case AArch64::LD2i8_POST:
10980 : case AArch64::LD3i8_POST:
10981 : case AArch64::LD4i8_POST: {
10982 : // op: Vt
10983 : op = getMachineOpValue(MI, MI.getOperand(2), Fixups, STI);
10984 0 : Value |= op & UINT64_C(31);
10985 : // op: Rn
10986 0 : op = getMachineOpValue(MI, MI.getOperand(4), Fixups, STI);
10987 0 : Value |= (op & UINT64_C(31)) << 5;
10988 : // op: idx
10989 0 : op = getMachineOpValue(MI, MI.getOperand(3), Fixups, STI);
10990 0 : Value |= (op & UINT64_C(8)) << 27;
10991 0 : Value |= (op & UINT64_C(7)) << 10;
10992 : // op: Xm
10993 0 : op = getMachineOpValue(MI, MI.getOperand(5), Fixups, STI);
10994 0 : Value |= (op & UINT64_C(31)) << 16;
10995 0 : break;
10996 : }
10997 : case AArch64::STLXRB:
10998 : case AArch64::STLXRH:
10999 : case AArch64::STLXRW:
11000 : case AArch64::STLXRX:
11001 : case AArch64::STXRB:
11002 : case AArch64::STXRH:
11003 : case AArch64::STXRW:
11004 : case AArch64::STXRX: {
11005 : // op: Ws
11006 0 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
11007 0 : Value |= (op & UINT64_C(31)) << 16;
11008 : // op: Rt
11009 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
11010 0 : Value |= op & UINT64_C(31);
11011 : // op: Rn
11012 0 : op = getMachineOpValue(MI, MI.getOperand(2), Fixups, STI);
11013 0 : Value |= (op & UINT64_C(31)) << 5;
11014 0 : Value = fixLoadStoreExclusive<1,0>(MI, Value, STI);
11015 0 : break;
11016 : }
11017 : case AArch64::STLXPW:
11018 : case AArch64::STLXPX:
11019 : case AArch64::STXPW:
11020 : case AArch64::STXPX: {
11021 : // op: Ws
11022 0 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
11023 0 : Value |= (op & UINT64_C(31)) << 16;
11024 : // op: Rt
11025 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
11026 0 : Value |= op & UINT64_C(31);
11027 : // op: Rt2
11028 0 : op = getMachineOpValue(MI, MI.getOperand(2), Fixups, STI);
11029 0 : Value |= (op & UINT64_C(31)) << 10;
11030 : // op: Rn
11031 0 : op = getMachineOpValue(MI, MI.getOperand(3), Fixups, STI);
11032 0 : Value |= (op & UINT64_C(31)) << 5;
11033 0 : break;
11034 : }
11035 : case AArch64::ADR:
11036 : case AArch64::ADRP: {
11037 : // op: Xd
11038 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
11039 0 : Value |= op & UINT64_C(31);
11040 : // op: label
11041 0 : op = getAdrLabelOpValue(MI, 1, Fixups, STI);
11042 0 : Value |= (op & UINT64_C(3)) << 29;
11043 0 : Value |= (op & UINT64_C(2097148)) << 3;
11044 0 : break;
11045 : }
11046 : case AArch64::CPY_ZPzI_B:
11047 : case AArch64::CPY_ZPzI_D:
11048 : case AArch64::CPY_ZPzI_H:
11049 : case AArch64::CPY_ZPzI_S: {
11050 : // op: Zd
11051 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
11052 0 : Value |= op & UINT64_C(31);
11053 : // op: Pg
11054 0 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
11055 0 : Value |= (op & UINT64_C(15)) << 16;
11056 : // op: imm
11057 0 : op = getImm8OptLsl(MI, 2, Fixups, STI);
11058 0 : Value |= (op & UINT64_C(511)) << 5;
11059 0 : break;
11060 : }
11061 : case AArch64::CPY_ZPmI_B:
11062 : case AArch64::CPY_ZPmI_D:
11063 : case AArch64::CPY_ZPmI_H:
11064 : case AArch64::CPY_ZPmI_S: {
11065 : // op: Zd
11066 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
11067 0 : Value |= op & UINT64_C(31);
11068 : // op: Pg
11069 0 : op = getMachineOpValue(MI, MI.getOperand(2), Fixups, STI);
11070 0 : Value |= (op & UINT64_C(15)) << 16;
11071 : // op: imm
11072 0 : op = getImm8OptLsl(MI, 3, Fixups, STI);
11073 0 : Value |= (op & UINT64_C(511)) << 5;
11074 0 : break;
11075 : }
11076 : case AArch64::RBIT_ZPmZ_B:
11077 : case AArch64::RBIT_ZPmZ_D:
11078 : case AArch64::RBIT_ZPmZ_H:
11079 : case AArch64::RBIT_ZPmZ_S:
11080 : case AArch64::REVB_ZPmZ_D:
11081 : case AArch64::REVB_ZPmZ_H:
11082 : case AArch64::REVB_ZPmZ_S:
11083 : case AArch64::REVH_ZPmZ_D:
11084 : case AArch64::REVH_ZPmZ_S:
11085 : case AArch64::REVW_ZPmZ_D: {
11086 : // op: Zd
11087 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
11088 0 : Value |= op & UINT64_C(31);
11089 : // op: Pg
11090 0 : op = getMachineOpValue(MI, MI.getOperand(2), Fixups, STI);
11091 0 : Value |= (op & UINT64_C(7)) << 10;
11092 : // op: Zn
11093 0 : op = getMachineOpValue(MI, MI.getOperand(3), Fixups, STI);
11094 0 : Value |= (op & UINT64_C(31)) << 5;
11095 0 : break;
11096 : }
11097 : case AArch64::INDEX_RR_B:
11098 : case AArch64::INDEX_RR_D:
11099 : case AArch64::INDEX_RR_H:
11100 : case AArch64::INDEX_RR_S: {
11101 : // op: Zd
11102 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
11103 0 : Value |= op & UINT64_C(31);
11104 : // op: Rm
11105 0 : op = getMachineOpValue(MI, MI.getOperand(2), Fixups, STI);
11106 0 : Value |= (op & UINT64_C(31)) << 16;
11107 : // op: Rn
11108 0 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
11109 0 : Value |= (op & UINT64_C(31)) << 5;
11110 0 : break;
11111 : }
11112 : case AArch64::ADD_ZZZ_B:
11113 : case AArch64::ADD_ZZZ_D:
11114 : case AArch64::ADD_ZZZ_H:
11115 : case AArch64::ADD_ZZZ_S:
11116 : case AArch64::AND_ZZZ:
11117 : case AArch64::ASR_WIDE_ZZZ_B:
11118 : case AArch64::ASR_WIDE_ZZZ_H:
11119 : case AArch64::ASR_WIDE_ZZZ_S:
11120 : case AArch64::BIC_ZZZ:
11121 : case AArch64::EOR_ZZZ:
11122 : case AArch64::FADD_ZZZ_D:
11123 : case AArch64::FADD_ZZZ_H:
11124 : case AArch64::FADD_ZZZ_S:
11125 : case AArch64::FMUL_ZZZ_D:
11126 : case AArch64::FMUL_ZZZ_H:
11127 : case AArch64::FMUL_ZZZ_S:
11128 : case AArch64::FRECPS_ZZZ_D:
11129 : case AArch64::FRECPS_ZZZ_H:
11130 : case AArch64::FRECPS_ZZZ_S:
11131 : case AArch64::FRSQRTS_ZZZ_D:
11132 : case AArch64::FRSQRTS_ZZZ_H:
11133 : case AArch64::FRSQRTS_ZZZ_S:
11134 : case AArch64::FSUB_ZZZ_D:
11135 : case AArch64::FSUB_ZZZ_H:
11136 : case AArch64::FSUB_ZZZ_S:
11137 : case AArch64::FTSMUL_ZZZ_D:
11138 : case AArch64::FTSMUL_ZZZ_H:
11139 : case AArch64::FTSMUL_ZZZ_S:
11140 : case AArch64::FTSSEL_ZZZ_D:
11141 : case AArch64::FTSSEL_ZZZ_H:
11142 : case AArch64::FTSSEL_ZZZ_S:
11143 : case AArch64::LSL_WIDE_ZZZ_B:
11144 : case AArch64::LSL_WIDE_ZZZ_H:
11145 : case AArch64::LSL_WIDE_ZZZ_S:
11146 : case AArch64::LSR_WIDE_ZZZ_B:
11147 : case AArch64::LSR_WIDE_ZZZ_H:
11148 : case AArch64::LSR_WIDE_ZZZ_S:
11149 : case AArch64::ORR_ZZZ:
11150 : |
