Line data Source code
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2 : |* *|
3 : |* Machine Code Emitter *|
4 : |* *|
5 : |* Automatically generated file, do not edit! *|
6 : |* *|
7 : \*===----------------------------------------------------------------------===*/
8 :
9 : // Undef for HURD
10 : #ifdef EIEIO
11 : #undef EIEIO
12 : #endif
13 245427 : uint64_t AMDGPUMCCodeEmitter::getBinaryCodeForInstr(const MCInst &MI,
14 : SmallVectorImpl<MCFixup> &Fixups,
15 : const MCSubtargetInfo &STI) const {
16 : static const uint64_t InstBits[] = {
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4013 : UINT64_C(3777495040), // BUFFER_ATOMIC_XOR_OFFSET_vi
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5073 : UINT64_C(4033609728), // IMAGE_ATOMIC_INC_V1_V4_si
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6295 : UINT64_C(3256614912), // S_ATOMIC_UMAX_SGPR_vi
6296 : UINT64_C(3265200128), // S_ATOMIC_UMAX_X2_IMM_RTN_vi
6297 : UINT64_C(3265134592), // S_ATOMIC_UMAX_X2_IMM_vi
6298 : UINT64_C(3265069056), // S_ATOMIC_UMAX_X2_SGPR_RTN_vi
6299 : UINT64_C(3265003520), // S_ATOMIC_UMAX_X2_SGPR_vi
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9105 : UINT64_C(905969664), // V_SUBREV_CO_U32_e32_gfx9
9106 : UINT64_C(3508207616), // V_SUBREV_CO_U32_e64_gfx9
9107 : UINT64_C(905969913), // V_SUBREV_CO_U32_sdwa_gfx9
9108 : UINT64_C(1107296506), // V_SUBREV_F16_dpp
9109 : UINT64_C(1107296256), // V_SUBREV_F16_e32_vi
9110 : UINT64_C(3508600832), // V_SUBREV_F16_e64_vi
9111 : UINT64_C(1107296505), // V_SUBREV_F16_sdwa_gfx9
9112 : UINT64_C(1107296505), // V_SUBREV_F16_sdwa_vi
9113 : UINT64_C(100663546), // V_SUBREV_F32_dpp
9114 : UINT64_C(167772160), // V_SUBREV_F32_e32_si
9115 : UINT64_C(100663296), // V_SUBREV_F32_e32_vi
9116 : UINT64_C(3523870720), // V_SUBREV_F32_e64_si
9117 : UINT64_C(3506634752), // V_SUBREV_F32_e64_vi
9118 : UINT64_C(100663545), // V_SUBREV_F32_sdwa_gfx9
9119 : UINT64_C(100663545), // V_SUBREV_F32_sdwa_vi
9120 : UINT64_C(1308622848), // V_SUBREV_I32_e32_si
9121 : UINT64_C(3528327168), // V_SUBREV_I32_e64_si
9122 : UINT64_C(1342177530), // V_SUBREV_U16_dpp
9123 : UINT64_C(1342177280), // V_SUBREV_U16_e32_vi
9124 : UINT64_C(3509059584), // V_SUBREV_U16_e64_vi
9125 : UINT64_C(1342177529), // V_SUBREV_U16_sdwa_gfx9
9126 : UINT64_C(1342177529), // V_SUBREV_U16_sdwa_vi
9127 : UINT64_C(905969914), // V_SUBREV_U32_dpp
9128 : UINT64_C(1811939578), // V_SUBREV_U32_dpp_gfx9
9129 : UINT64_C(1811939328), // V_SUBREV_U32_e32_gfx9
9130 : UINT64_C(905969664), // V_SUBREV_U32_e32_vi
9131 : UINT64_C(3509977088), // V_SUBREV_U32_e64_gfx9
9132 : UINT64_C(3508207616), // V_SUBREV_U32_e64_vi
9133 : UINT64_C(1811939577), // V_SUBREV_U32_sdwa_gfx9
9134 : UINT64_C(905969913), // V_SUBREV_U32_sdwa_vi
9135 : UINT64_C(872415482), // V_SUB_CO_U32_dpp_gfx9
9136 : UINT64_C(872415232), // V_SUB_CO_U32_e32_gfx9
9137 : UINT64_C(3508142080), // V_SUB_CO_U32_e64_gfx9
9138 : UINT64_C(872415481), // V_SUB_CO_U32_sdwa_gfx9
9139 : UINT64_C(1073742074), // V_SUB_F16_dpp
9140 : UINT64_C(1073741824), // V_SUB_F16_e32_vi
9141 : UINT64_C(3508535296), // V_SUB_F16_e64_vi
9142 : UINT64_C(1073742073), // V_SUB_F16_sdwa_gfx9
9143 : UINT64_C(1073742073), // V_SUB_F16_sdwa_vi
9144 : UINT64_C(67109114), // V_SUB_F32_dpp
9145 : UINT64_C(134217728), // V_SUB_F32_e32_si
9146 : UINT64_C(67108864), // V_SUB_F32_e32_vi
9147 : UINT64_C(3523739648), // V_SUB_F32_e64_si
9148 : UINT64_C(3506569216), // V_SUB_F32_e64_vi
9149 : UINT64_C(67109113), // V_SUB_F32_sdwa_gfx9
9150 : UINT64_C(67109113), // V_SUB_F32_sdwa_vi
9151 : UINT64_C(3533635584), // V_SUB_I16_vi
9152 : UINT64_C(1275068416), // V_SUB_I32_e32_si
9153 : UINT64_C(3528196096), // V_SUB_I32_e64_si
9154 : UINT64_C(3533504512), // V_SUB_I32_gfx9_gfx9
9155 : UINT64_C(1308623098), // V_SUB_U16_dpp
9156 : UINT64_C(1308622848), // V_SUB_U16_e32_vi
9157 : UINT64_C(3508994048), // V_SUB_U16_e64_vi
9158 : UINT64_C(1308623097), // V_SUB_U16_sdwa_gfx9
9159 : UINT64_C(1308623097), // V_SUB_U16_sdwa_vi
9160 : UINT64_C(872415482), // V_SUB_U32_dpp
9161 : UINT64_C(1778385146), // V_SUB_U32_dpp_gfx9
9162 : UINT64_C(1778384896), // V_SUB_U32_e32_gfx9
9163 : UINT64_C(872415232), // V_SUB_U32_e32_vi
9164 : UINT64_C(3509911552), // V_SUB_U32_e64_gfx9
9165 : UINT64_C(3508142080), // V_SUB_U32_e64_vi
9166 : UINT64_C(1778385145), // V_SUB_U32_sdwa_gfx9
9167 : UINT64_C(872415481), // V_SUB_U32_sdwa_vi
9168 : UINT64_C(2113970688), // V_SWAP_B32_vi
9169 : UINT64_C(3538419712), // V_TRIG_PREOP_F64_si
9170 : UINT64_C(3532783616), // V_TRIG_PREOP_F64_vi
9171 : UINT64_C(2113965306), // V_TRUNC_F16_dpp
9172 : UINT64_C(2113965056), // V_TRUNC_F16_e32_vi
9173 : UINT64_C(3515219968), // V_TRUNC_F16_e64_vi
9174 : UINT64_C(2113965305), // V_TRUNC_F16_sdwa_gfx9
9175 : UINT64_C(2113965305), // V_TRUNC_F16_sdwa_vi
9176 : UINT64_C(2113943802), // V_TRUNC_F32_dpp
9177 : UINT64_C(2113946112), // V_TRUNC_F32_e32_si
9178 : UINT64_C(2113943552), // V_TRUNC_F32_e32_vi
9179 : UINT64_C(3544317952), // V_TRUNC_F32_e64_si
9180 : UINT64_C(3512467456), // V_TRUNC_F32_e64_vi
9181 : UINT64_C(2113943801), // V_TRUNC_F32_sdwa_gfx9
9182 : UINT64_C(2113943801), // V_TRUNC_F32_sdwa_vi
9183 : UINT64_C(2113941242), // V_TRUNC_F64_dpp
9184 : UINT64_C(2113940992), // V_TRUNC_F64_e32_ci
9185 : UINT64_C(2113940992), // V_TRUNC_F64_e32_vi
9186 : UINT64_C(3543007232), // V_TRUNC_F64_e64_ci
9187 : UINT64_C(3512139776), // V_TRUNC_F64_e64_vi
9188 : UINT64_C(2113941241), // V_TRUNC_F64_sdwa_gfx9
9189 : UINT64_C(2113941241), // V_TRUNC_F64_sdwa_vi
9190 : UINT64_C(67108864), // V_WRITELANE_B32_si
9191 : UINT64_C(3532259328), // V_WRITELANE_B32_vi
9192 : UINT64_C(3522363392), // V_XAD_U32_vi
9193 : UINT64_C(2046820602), // V_XNOR_B32_dpp
9194 : UINT64_C(2046820352), // V_XNOR_B32_e32_vi
9195 : UINT64_C(3510435840), // V_XNOR_B32_e64_vi
9196 : UINT64_C(2046820601), // V_XNOR_B32_sdwa_gfx9
9197 : UINT64_C(2046820601), // V_XNOR_B32_sdwa_vi
9198 : UINT64_C(704643322), // V_XOR_B32_dpp
9199 : UINT64_C(973078528), // V_XOR_B32_e32_si
9200 : UINT64_C(704643072), // V_XOR_B32_e32_vi
9201 : UINT64_C(3527016448), // V_XOR_B32_e64_si
9202 : UINT64_C(3507814400), // V_XOR_B32_e64_vi
9203 : UINT64_C(704643321), // V_XOR_B32_sdwa_gfx9
9204 : UINT64_C(704643321), // V_XOR_B32_sdwa_vi
9205 : UINT64_C(0)
9206 : };
9207 245427 : const unsigned opcode = MI.getOpcode();
9208 245427 : uint64_t Value = InstBits[opcode];
9209 : uint64_t op = 0;
9210 : (void)op; // suppress warning
9211 245427 : switch (opcode) {
9212 : case AMDGPU::BUFFER_WBINVL1_SC_si:
9213 : case AMDGPU::BUFFER_WBINVL1_VOL_ci:
9214 : case AMDGPU::BUFFER_WBINVL1_VOL_vi:
9215 : case AMDGPU::BUFFER_WBINVL1_si:
9216 : case AMDGPU::BUFFER_WBINVL1_vi:
9217 : case AMDGPU::DS_NOP_si:
9218 : case AMDGPU::DS_NOP_vi:
9219 : case AMDGPU::S_BARRIER:
9220 : case AMDGPU::S_DCACHE_INV_VOL_ci:
9221 : case AMDGPU::S_DCACHE_INV_VOL_vi:
9222 : case AMDGPU::S_DCACHE_INV_si:
9223 : case AMDGPU::S_DCACHE_INV_vi:
9224 : case AMDGPU::S_DCACHE_WB_VOL_vi:
9225 : case AMDGPU::S_DCACHE_WB_vi:
9226 : case AMDGPU::S_ENDPGM:
9227 : case AMDGPU::S_ENDPGM_ORDERED_PS_DONE:
9228 : case AMDGPU::S_ENDPGM_SAVED:
9229 : case AMDGPU::S_ICACHE_INV:
9230 : case AMDGPU::S_SET_GPR_IDX_OFF:
9231 : case AMDGPU::S_TTRACEDATA:
9232 : case AMDGPU::S_WAKEUP:
9233 : case AMDGPU::V_CLREXCP_e32_si:
9234 : case AMDGPU::V_CLREXCP_e32_vi:
9235 : case AMDGPU::V_CLREXCP_e64_si:
9236 : case AMDGPU::V_CLREXCP_e64_vi:
9237 : case AMDGPU::V_CLREXCP_sdwa_gfx9:
9238 : case AMDGPU::V_CLREXCP_sdwa_vi:
9239 : case AMDGPU::V_NOP_e32_si:
9240 : case AMDGPU::V_NOP_e32_vi:
9241 : case AMDGPU::V_NOP_e64_si:
9242 : case AMDGPU::V_NOP_e64_vi:
9243 : case AMDGPU::V_NOP_sdwa_gfx9:
9244 : case AMDGPU::V_NOP_sdwa_vi: {
9245 : break;
9246 : }
9247 117 : case AMDGPU::DS_GWS_BARRIER_si:
9248 : case AMDGPU::DS_GWS_BARRIER_vi:
9249 : case AMDGPU::DS_GWS_INIT_si:
9250 : case AMDGPU::DS_GWS_INIT_vi:
9251 : case AMDGPU::DS_GWS_SEMA_BR_si:
9252 : case AMDGPU::DS_GWS_SEMA_BR_vi: {
9253 : // op: data0
9254 234 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
9255 117 : Value |= (op & UINT64_C(255)) << 40;
9256 : // op: offset
9257 234 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
9258 117 : Value |= op & UINT64_C(65535);
9259 117 : break;
9260 : }
9261 4 : case AMDGPU::V_CLREXCP_dpp:
9262 : case AMDGPU::V_NOP_dpp: {
9263 : // op: dpp_ctrl
9264 8 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
9265 4 : Value |= (op & UINT64_C(511)) << 40;
9266 : // op: bound_ctrl
9267 8 : op = getMachineOpValue(MI, MI.getOperand(3), Fixups, STI);
9268 4 : Value |= (op & UINT64_C(1)) << 51;
9269 : // op: bank_mask
9270 8 : op = getMachineOpValue(MI, MI.getOperand(2), Fixups, STI);
9271 4 : Value |= (op & UINT64_C(15)) << 56;
9272 : // op: row_mask
9273 8 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
9274 4 : Value |= (op & UINT64_C(15)) << 60;
9275 4 : break;
9276 : }
9277 313 : case AMDGPU::EXP_DONE_si:
9278 : case AMDGPU::EXP_DONE_vi:
9279 : case AMDGPU::EXP_si:
9280 : case AMDGPU::EXP_vi: {
9281 : // op: en
9282 626 : op = getMachineOpValue(MI, MI.getOperand(7), Fixups, STI);
9283 313 : Value |= op & UINT64_C(15);
9284 : // op: tgt
9285 626 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
9286 313 : Value |= (op & UINT64_C(63)) << 4;
9287 : // op: compr
9288 626 : op = getMachineOpValue(MI, MI.getOperand(6), Fixups, STI);
9289 313 : Value |= (op & UINT64_C(1)) << 10;
9290 : // op: vm
9291 626 : op = getMachineOpValue(MI, MI.getOperand(5), Fixups, STI);
9292 313 : Value |= (op & UINT64_C(1)) << 12;
9293 : // op: src0
9294 626 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
9295 313 : Value |= (op & UINT64_C(255)) << 32;
9296 : // op: src1
9297 626 : op = getMachineOpValue(MI, MI.getOperand(2), Fixups, STI);
9298 313 : Value |= (op & UINT64_C(255)) << 40;
9299 : // op: src2
9300 626 : op = getMachineOpValue(MI, MI.getOperand(3), Fixups, STI);
9301 313 : Value |= (op & UINT64_C(255)) << 48;
9302 : // op: src3
9303 626 : op = getMachineOpValue(MI, MI.getOperand(4), Fixups, STI);
9304 313 : Value |= (op & UINT64_C(255)) << 56;
9305 313 : break;
9306 : }
9307 845 : case AMDGPU::DS_ADD_SRC2_F32_vi:
9308 : case AMDGPU::DS_ADD_SRC2_U32_vi:
9309 : case AMDGPU::DS_ADD_SRC2_U64_vi:
9310 : case AMDGPU::DS_AND_SRC2_B32_vi:
9311 : case AMDGPU::DS_AND_SRC2_B64_vi:
9312 : case AMDGPU::DS_DEC_SRC2_U32_vi:
9313 : case AMDGPU::DS_DEC_SRC2_U64_vi:
9314 : case AMDGPU::DS_INC_SRC2_U32_vi:
9315 : case AMDGPU::DS_INC_SRC2_U64_vi:
9316 : case AMDGPU::DS_MAX_SRC2_F32_vi:
9317 : case AMDGPU::DS_MAX_SRC2_F64_vi:
9318 : case AMDGPU::DS_MAX_SRC2_I32_vi:
9319 : case AMDGPU::DS_MAX_SRC2_I64_vi:
9320 : case AMDGPU::DS_MAX_SRC2_U32_vi:
9321 : case AMDGPU::DS_MAX_SRC2_U64_vi:
9322 : case AMDGPU::DS_MIN_SRC2_F32_vi:
9323 : case AMDGPU::DS_MIN_SRC2_F64_vi:
9324 : case AMDGPU::DS_MIN_SRC2_I32_vi:
9325 : case AMDGPU::DS_MIN_SRC2_I64_vi:
9326 : case AMDGPU::DS_MIN_SRC2_U32_vi:
9327 : case AMDGPU::DS_MIN_SRC2_U64_vi:
9328 : case AMDGPU::DS_OR_SRC2_B32_vi:
9329 : case AMDGPU::DS_OR_SRC2_B64_vi:
9330 : case AMDGPU::DS_RSUB_SRC2_U32_vi:
9331 : case AMDGPU::DS_RSUB_SRC2_U64_vi:
9332 : case AMDGPU::DS_SUB_SRC2_U32_vi:
9333 : case AMDGPU::DS_SUB_SRC2_U64_vi:
9334 : case AMDGPU::DS_WRITE_SRC2_B32_vi:
9335 : case AMDGPU::DS_WRITE_SRC2_B64_vi:
9336 : case AMDGPU::DS_XOR_SRC2_B32_vi:
9337 : case AMDGPU::DS_XOR_SRC2_B64_vi: {
9338 : // op: gds
9339 1690 : op = getMachineOpValue(MI, MI.getOperand(2), Fixups, STI);
9340 845 : Value |= (op & UINT64_C(1)) << 16;
9341 : // op: addr
9342 1690 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
9343 845 : Value |= (op & UINT64_C(255)) << 32;
9344 : // op: offset
9345 1690 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
9346 845 : Value |= op & UINT64_C(65535);
9347 845 : break;
9348 : }
9349 192 : case AMDGPU::DS_ADD_SRC2_U32_si:
9350 : case AMDGPU::DS_ADD_SRC2_U64_si:
9351 : case AMDGPU::DS_AND_SRC2_B32_si:
9352 : case AMDGPU::DS_AND_SRC2_B64_si:
9353 : case AMDGPU::DS_DEC_SRC2_U32_si:
9354 : case AMDGPU::DS_DEC_SRC2_U64_si:
9355 : case AMDGPU::DS_INC_SRC2_U32_si:
9356 : case AMDGPU::DS_INC_SRC2_U64_si:
9357 : case AMDGPU::DS_MAX_SRC2_F32_si:
9358 : case AMDGPU::DS_MAX_SRC2_F64_si:
9359 : case AMDGPU::DS_MAX_SRC2_I32_si:
9360 : case AMDGPU::DS_MAX_SRC2_I64_si:
9361 : case AMDGPU::DS_MAX_SRC2_U32_si:
9362 : case AMDGPU::DS_MAX_SRC2_U64_si:
9363 : case AMDGPU::DS_MIN_SRC2_F32_si:
9364 : case AMDGPU::DS_MIN_SRC2_F64_si:
9365 : case AMDGPU::DS_MIN_SRC2_I32_si:
9366 : case AMDGPU::DS_MIN_SRC2_I64_si:
9367 : case AMDGPU::DS_MIN_SRC2_U32_si:
9368 : case AMDGPU::DS_MIN_SRC2_U64_si:
9369 : case AMDGPU::DS_OR_SRC2_B32_si:
9370 : case AMDGPU::DS_OR_SRC2_B64_si:
9371 : case AMDGPU::DS_RSUB_SRC2_U32_si:
9372 : case AMDGPU::DS_RSUB_SRC2_U64_si:
9373 : case AMDGPU::DS_SUB_SRC2_U32_si:
9374 : case AMDGPU::DS_SUB_SRC2_U64_si:
9375 : case AMDGPU::DS_WRITE_SRC2_B32_si:
9376 : case AMDGPU::DS_WRITE_SRC2_B64_si:
9377 : case AMDGPU::DS_XOR_SRC2_B32_si:
9378 : case AMDGPU::DS_XOR_SRC2_B64_si: {
9379 : // op: gds
9380 384 : op = getMachineOpValue(MI, MI.getOperand(2), Fixups, STI);
9381 192 : Value |= (op & UINT64_C(1)) << 17;
9382 : // op: addr
9383 384 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
9384 192 : Value |= (op & UINT64_C(255)) << 32;
9385 : // op: offset
9386 384 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
9387 192 : Value |= op & UINT64_C(65535);
9388 192 : break;
9389 : }
9390 1279 : case AMDGPU::DS_ADD_F32_vi:
9391 : case AMDGPU::DS_ADD_U32_vi:
9392 : case AMDGPU::DS_ADD_U64_vi:
9393 : case AMDGPU::DS_AND_B32_vi:
9394 : case AMDGPU::DS_AND_B64_vi:
9395 : case AMDGPU::DS_DEC_U32_vi:
9396 : case AMDGPU::DS_DEC_U64_vi:
9397 : case AMDGPU::DS_INC_U32_vi:
9398 : case AMDGPU::DS_INC_U64_vi:
9399 : case AMDGPU::DS_MAX_F32_vi:
9400 : case AMDGPU::DS_MAX_F64_vi:
9401 : case AMDGPU::DS_MAX_I32_vi:
9402 : case AMDGPU::DS_MAX_I64_vi:
9403 : case AMDGPU::DS_MAX_U32_vi:
9404 : case AMDGPU::DS_MAX_U64_vi:
9405 : case AMDGPU::DS_MIN_F32_vi:
9406 : case AMDGPU::DS_MIN_F64_vi:
9407 : case AMDGPU::DS_MIN_I32_vi:
9408 : case AMDGPU::DS_MIN_I64_vi:
9409 : case AMDGPU::DS_MIN_U32_vi:
9410 : case AMDGPU::DS_MIN_U64_vi:
9411 : case AMDGPU::DS_OR_B32_vi:
9412 : case AMDGPU::DS_OR_B64_vi:
9413 : case AMDGPU::DS_RSUB_U32_vi:
9414 : case AMDGPU::DS_RSUB_U64_vi:
9415 : case AMDGPU::DS_SUB_U32_vi:
9416 : case AMDGPU::DS_SUB_U64_vi:
9417 : case AMDGPU::DS_WRITE_ADDTID_B32_vi:
9418 : case AMDGPU::DS_WRITE_B128_vi:
9419 : case AMDGPU::DS_WRITE_B16_D16_HI_vi:
9420 : case AMDGPU::DS_WRITE_B16_vi:
9421 : case AMDGPU::DS_WRITE_B32_vi:
9422 : case AMDGPU::DS_WRITE_B64_vi:
9423 : case AMDGPU::DS_WRITE_B8_D16_HI_vi:
9424 : case AMDGPU::DS_WRITE_B8_vi:
9425 : case AMDGPU::DS_WRITE_B96_vi:
9426 : case AMDGPU::DS_XOR_B32_vi:
9427 : case AMDGPU::DS_XOR_B64_vi: {
9428 : // op: gds
9429 2558 : op = getMachineOpValue(MI, MI.getOperand(3), Fixups, STI);
9430 1279 : Value |= (op & UINT64_C(1)) << 16;
9431 : // op: addr
9432 2558 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
9433 1279 : Value |= (op & UINT64_C(255)) << 32;
9434 : // op: data0
9435 2558 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
9436 1279 : Value |= (op & UINT64_C(255)) << 40;
9437 : // op: offset
9438 2558 : op = getMachineOpValue(MI, MI.getOperand(2), Fixups, STI);
9439 1279 : Value |= op & UINT64_C(65535);
9440 1279 : break;
9441 : }
9442 462 : case AMDGPU::DS_ADD_U32_si:
9443 : case AMDGPU::DS_ADD_U64_si:
9444 : case AMDGPU::DS_AND_B32_si:
9445 : case AMDGPU::DS_AND_B64_si:
9446 : case AMDGPU::DS_DEC_U32_si:
9447 : case AMDGPU::DS_DEC_U64_si:
9448 : case AMDGPU::DS_INC_U32_si:
9449 : case AMDGPU::DS_INC_U64_si:
9450 : case AMDGPU::DS_MAX_F32_si:
9451 : case AMDGPU::DS_MAX_F64_si:
9452 : case AMDGPU::DS_MAX_I32_si:
9453 : case AMDGPU::DS_MAX_I64_si:
9454 : case AMDGPU::DS_MAX_U32_si:
9455 : case AMDGPU::DS_MAX_U64_si:
9456 : case AMDGPU::DS_MIN_F32_si:
9457 : case AMDGPU::DS_MIN_F64_si:
9458 : case AMDGPU::DS_MIN_I32_si:
9459 : case AMDGPU::DS_MIN_I64_si:
9460 : case AMDGPU::DS_MIN_U32_si:
9461 : case AMDGPU::DS_MIN_U64_si:
9462 : case AMDGPU::DS_OR_B32_si:
9463 : case AMDGPU::DS_OR_B64_si:
9464 : case AMDGPU::DS_RSUB_U32_si:
9465 : case AMDGPU::DS_RSUB_U64_si:
9466 : case AMDGPU::DS_SUB_U32_si:
9467 : case AMDGPU::DS_SUB_U64_si:
9468 : case AMDGPU::DS_WRITE_B128_si:
9469 : case AMDGPU::DS_WRITE_B16_si:
9470 : case AMDGPU::DS_WRITE_B32_si:
9471 : case AMDGPU::DS_WRITE_B64_si:
9472 : case AMDGPU::DS_WRITE_B8_si:
9473 : case AMDGPU::DS_WRITE_B96_si:
9474 : case AMDGPU::DS_XOR_B32_si:
9475 : case AMDGPU::DS_XOR_B64_si: {
9476 : // op: gds
9477 924 : op = getMachineOpValue(MI, MI.getOperand(3), Fixups, STI);
9478 462 : Value |= (op & UINT64_C(1)) << 17;
9479 : // op: addr
9480 924 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
9481 462 : Value |= (op & UINT64_C(255)) << 32;
9482 : // op: data0
9483 924 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
9484 462 : Value |= (op & UINT64_C(255)) << 40;
9485 : // op: offset
9486 924 : op = getMachineOpValue(MI, MI.getOperand(2), Fixups, STI);
9487 462 : Value |= op & UINT64_C(65535);
9488 462 : break;
9489 : }
9490 240 : case AMDGPU::DS_CMPST_B32_vi:
9491 : case AMDGPU::DS_CMPST_B64_vi:
9492 : case AMDGPU::DS_CMPST_F32_vi:
9493 : case AMDGPU::DS_CMPST_F64_vi:
9494 : case AMDGPU::DS_MSKOR_B32_vi:
9495 : case AMDGPU::DS_MSKOR_B64_vi: {
9496 : // op: gds
9497 480 : op = getMachineOpValue(MI, MI.getOperand(4), Fixups, STI);
9498 240 : Value |= (op & UINT64_C(1)) << 16;
9499 : // op: addr
9500 480 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
9501 240 : Value |= (op & UINT64_C(255)) << 32;
9502 : // op: data0
9503 480 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
9504 240 : Value |= (op & UINT64_C(255)) << 40;
9505 : // op: data1
9506 480 : op = getMachineOpValue(MI, MI.getOperand(2), Fixups, STI);
9507 240 : Value |= (op & UINT64_C(255)) << 48;
9508 : // op: offset
9509 480 : op = getMachineOpValue(MI, MI.getOperand(3), Fixups, STI);
9510 240 : Value |= op & UINT64_C(65535);
9511 240 : break;
9512 : }
9513 84 : case AMDGPU::DS_CMPST_B32_si:
9514 : case AMDGPU::DS_CMPST_B64_si:
9515 : case AMDGPU::DS_CMPST_F32_si:
9516 : case AMDGPU::DS_CMPST_F64_si:
9517 : case AMDGPU::DS_MSKOR_B32_si:
9518 : case AMDGPU::DS_MSKOR_B64_si: {
9519 : // op: gds
9520 168 : op = getMachineOpValue(MI, MI.getOperand(4), Fixups, STI);
9521 84 : Value |= (op & UINT64_C(1)) << 17;
9522 : // op: addr
9523 168 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
9524 84 : Value |= (op & UINT64_C(255)) << 32;
9525 : // op: data0
9526 168 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
9527 84 : Value |= (op & UINT64_C(255)) << 40;
9528 : // op: data1
9529 168 : op = getMachineOpValue(MI, MI.getOperand(2), Fixups, STI);
9530 84 : Value |= (op & UINT64_C(255)) << 48;
9531 : // op: offset
9532 168 : op = getMachineOpValue(MI, MI.getOperand(3), Fixups, STI);
9533 84 : Value |= op & UINT64_C(65535);
9534 84 : break;
9535 : }
9536 222 : case AMDGPU::DS_WRITE2ST64_B32_vi:
9537 : case AMDGPU::DS_WRITE2ST64_B64_vi:
9538 : case AMDGPU::DS_WRITE2_B32_vi:
9539 : case AMDGPU::DS_WRITE2_B64_vi: {
9540 : // op: gds
9541 444 : op = getMachineOpValue(MI, MI.getOperand(5), Fixups, STI);
9542 222 : Value |= (op & UINT64_C(1)) << 16;
9543 : // op: addr
9544 444 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
9545 222 : Value |= (op & UINT64_C(255)) << 32;
9546 : // op: data0
9547 444 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
9548 222 : Value |= (op & UINT64_C(255)) << 40;
9549 : // op: data1
9550 444 : op = getMachineOpValue(MI, MI.getOperand(2), Fixups, STI);
9551 222 : Value |= (op & UINT64_C(255)) << 48;
9552 : // op: offset0
9553 444 : op = getMachineOpValue(MI, MI.getOperand(3), Fixups, STI);
9554 222 : Value |= op & UINT64_C(255);
9555 : // op: offset1
9556 444 : op = getMachineOpValue(MI, MI.getOperand(4), Fixups, STI);
9557 222 : Value |= (op & UINT64_C(255)) << 8;
9558 222 : break;
9559 : }
9560 89 : case AMDGPU::DS_WRITE2ST64_B32_si:
9561 : case AMDGPU::DS_WRITE2ST64_B64_si:
9562 : case AMDGPU::DS_WRITE2_B32_si:
9563 : case AMDGPU::DS_WRITE2_B64_si: {
9564 : // op: gds
9565 178 : op = getMachineOpValue(MI, MI.getOperand(5), Fixups, STI);
9566 89 : Value |= (op & UINT64_C(1)) << 17;
9567 : // op: addr
9568 178 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
9569 89 : Value |= (op & UINT64_C(255)) << 32;
9570 : // op: data0
9571 178 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
9572 89 : Value |= (op & UINT64_C(255)) << 40;
9573 : // op: data1
9574 178 : op = getMachineOpValue(MI, MI.getOperand(2), Fixups, STI);
9575 89 : Value |= (op & UINT64_C(255)) << 48;
9576 : // op: offset0
9577 178 : op = getMachineOpValue(MI, MI.getOperand(3), Fixups, STI);
9578 89 : Value |= op & UINT64_C(255);
9579 : // op: offset1
9580 178 : op = getMachineOpValue(MI, MI.getOperand(4), Fixups, STI);
9581 89 : Value |= (op & UINT64_C(255)) << 8;
9582 89 : break;
9583 : }
9584 90 : case AMDGPU::DS_GWS_SEMA_P_si:
9585 : case AMDGPU::DS_GWS_SEMA_P_vi:
9586 : case AMDGPU::DS_GWS_SEMA_RELEASE_ALL_si:
9587 : case AMDGPU::DS_GWS_SEMA_RELEASE_ALL_vi:
9588 : case AMDGPU::DS_GWS_SEMA_V_si:
9589 : case AMDGPU::DS_GWS_SEMA_V_vi: {
9590 : // op: offset
9591 180 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
9592 90 : Value |= op & UINT64_C(65535);
9593 90 : break;
9594 : }
9595 6 : case AMDGPU::BUFFER_STORE_LDS_DWORD_vi: {
9596 : // op: offset
9597 12 : op = getMachineOpValue(MI, MI.getOperand(2), Fixups, STI);
9598 6 : Value |= op & UINT64_C(4095);
9599 : // op: glc
9600 12 : op = getMachineOpValue(MI, MI.getOperand(3), Fixups, STI);
9601 6 : Value |= (op & UINT64_C(1)) << 14;
9602 : // op: srsrc
9603 12 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
9604 6 : Value |= (op & UINT64_C(124)) << 46;
9605 : // op: slc
9606 12 : op = getMachineOpValue(MI, MI.getOperand(4), Fixups, STI);
9607 6 : Value |= (op & UINT64_C(1)) << 17;
9608 : // op: soffset
9609 12 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
9610 6 : Value |= (op & UINT64_C(255)) << 56;
9611 6 : break;
9612 : }
9613 41 : case AMDGPU::BUFFER_LOAD_DWORDX2_LDS_OFFSET_vi:
9614 : case AMDGPU::BUFFER_LOAD_DWORDX3_LDS_OFFSET_vi:
9615 : case AMDGPU::BUFFER_LOAD_DWORDX4_LDS_OFFSET_vi:
9616 : case AMDGPU::BUFFER_LOAD_DWORD_LDS_OFFSET_vi:
9617 : case AMDGPU::BUFFER_LOAD_FORMAT_X_LDS_OFFSET_vi:
9618 : case AMDGPU::BUFFER_LOAD_SBYTE_LDS_OFFSET_vi:
9619 : case AMDGPU::BUFFER_LOAD_SSHORT_LDS_OFFSET_vi:
9620 : case AMDGPU::BUFFER_LOAD_UBYTE_LDS_OFFSET_vi:
9621 : case AMDGPU::BUFFER_LOAD_USHORT_LDS_OFFSET_vi: {
9622 : // op: offset
9623 82 : op = getMachineOpValue(MI, MI.getOperand(3), Fixups, STI);
9624 41 : Value |= op & UINT64_C(4095);
9625 : // op: glc
9626 82 : op = getMachineOpValue(MI, MI.getOperand(4), Fixups, STI);
9627 41 : Value |= (op & UINT64_C(1)) << 14;
9628 : // op: vdata
9629 82 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
9630 41 : Value |= (op & UINT64_C(255)) << 40;
9631 : // op: srsrc
9632 82 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
9633 41 : Value |= (op & UINT64_C(124)) << 46;
9634 : // op: slc
9635 82 : op = getMachineOpValue(MI, MI.getOperand(5), Fixups, STI);
9636 41 : Value |= (op & UINT64_C(1)) << 17;
9637 : // op: soffset
9638 82 : op = getMachineOpValue(MI, MI.getOperand(2), Fixups, STI);
9639 41 : Value |= (op & UINT64_C(255)) << 56;
9640 41 : break;
9641 : }
9642 2985 : case AMDGPU::BUFFER_LOAD_DWORDX2_OFFSET_vi:
9643 : case AMDGPU::BUFFER_LOAD_DWORDX3_OFFSET_vi:
9644 : case AMDGPU::BUFFER_LOAD_DWORDX4_OFFSET_vi:
9645 : case AMDGPU::BUFFER_LOAD_DWORD_OFFSET_vi:
9646 : case AMDGPU::BUFFER_LOAD_FORMAT_D16_HI_X_OFFSET_vi:
9647 : case AMDGPU::BUFFER_LOAD_FORMAT_D16_XYZW_OFFSET_vi:
9648 : case AMDGPU::BUFFER_LOAD_FORMAT_D16_XYZW_gfx80_OFFSET_gfx80:
9649 : case AMDGPU::BUFFER_LOAD_FORMAT_D16_XYZ_OFFSET_vi:
9650 : case AMDGPU::BUFFER_LOAD_FORMAT_D16_XYZ_gfx80_OFFSET_gfx80:
9651 : case AMDGPU::BUFFER_LOAD_FORMAT_D16_XY_OFFSET_vi:
9652 : case AMDGPU::BUFFER_LOAD_FORMAT_D16_XY_gfx80_OFFSET_gfx80:
9653 : case AMDGPU::BUFFER_LOAD_FORMAT_D16_X_OFFSET_vi:
9654 : case AMDGPU::BUFFER_LOAD_FORMAT_D16_X_gfx80_OFFSET_gfx80:
9655 : case AMDGPU::BUFFER_LOAD_FORMAT_XYZW_OFFSET_vi:
9656 : case AMDGPU::BUFFER_LOAD_FORMAT_XYZ_OFFSET_vi:
9657 : case AMDGPU::BUFFER_LOAD_FORMAT_XY_OFFSET_vi:
9658 : case AMDGPU::BUFFER_LOAD_FORMAT_X_OFFSET_vi:
9659 : case AMDGPU::BUFFER_LOAD_SBYTE_D16_HI_OFFSET_vi:
9660 : case AMDGPU::BUFFER_LOAD_SBYTE_D16_OFFSET_vi:
9661 : case AMDGPU::BUFFER_LOAD_SBYTE_OFFSET_vi:
9662 : case AMDGPU::BUFFER_LOAD_SHORT_D16_HI_OFFSET_vi:
9663 : case AMDGPU::BUFFER_LOAD_SHORT_D16_OFFSET_vi:
9664 : case AMDGPU::BUFFER_LOAD_SSHORT_OFFSET_vi:
9665 : case AMDGPU::BUFFER_LOAD_UBYTE_D16_HI_OFFSET_vi:
9666 : case AMDGPU::BUFFER_LOAD_UBYTE_D16_OFFSET_vi:
9667 : case AMDGPU::BUFFER_LOAD_UBYTE_OFFSET_vi:
9668 : case AMDGPU::BUFFER_LOAD_USHORT_OFFSET_vi:
9669 : case AMDGPU::BUFFER_STORE_BYTE_D16_HI_OFFSET_vi:
9670 : case AMDGPU::BUFFER_STORE_BYTE_OFFSET_vi:
9671 : case AMDGPU::BUFFER_STORE_DWORDX2_OFFSET_vi:
9672 : case AMDGPU::BUFFER_STORE_DWORDX3_OFFSET_vi:
9673 : case AMDGPU::BUFFER_STORE_DWORDX4_OFFSET_vi:
9674 : case AMDGPU::BUFFER_STORE_DWORD_OFFSET_vi:
9675 : case AMDGPU::BUFFER_STORE_FORMAT_D16_HI_X_OFFSET_vi:
9676 : case AMDGPU::BUFFER_STORE_FORMAT_D16_XYZW_OFFSET_vi:
9677 : case AMDGPU::BUFFER_STORE_FORMAT_D16_XYZW_gfx80_OFFSET_gfx80:
9678 : case AMDGPU::BUFFER_STORE_FORMAT_D16_XYZ_OFFSET_vi:
9679 : case AMDGPU::BUFFER_STORE_FORMAT_D16_XYZ_gfx80_OFFSET_gfx80:
9680 : case AMDGPU::BUFFER_STORE_FORMAT_D16_XY_OFFSET_vi:
9681 : case AMDGPU::BUFFER_STORE_FORMAT_D16_XY_gfx80_OFFSET_gfx80:
9682 : case AMDGPU::BUFFER_STORE_FORMAT_D16_X_OFFSET_vi:
9683 : case AMDGPU::BUFFER_STORE_FORMAT_D16_X_gfx80_OFFSET_gfx80:
9684 : case AMDGPU::BUFFER_STORE_FORMAT_XYZW_OFFSET_vi:
9685 : case AMDGPU::BUFFER_STORE_FORMAT_XYZ_OFFSET_vi:
9686 : case AMDGPU::BUFFER_STORE_FORMAT_XY_OFFSET_vi:
9687 : case AMDGPU::BUFFER_STORE_FORMAT_X_OFFSET_vi:
9688 : case AMDGPU::BUFFER_STORE_SHORT_D16_HI_OFFSET_vi:
9689 : case AMDGPU::BUFFER_STORE_SHORT_OFFSET_vi: {
9690 : // op: offset
9691 5970 : op = getMachineOpValue(MI, MI.getOperand(3), Fixups, STI);
9692 2985 : Value |= op & UINT64_C(4095);
9693 : // op: glc
9694 5970 : op = getMachineOpValue(MI, MI.getOperand(4), Fixups, STI);
9695 2985 : Value |= (op & UINT64_C(1)) << 14;
9696 : // op: vdata
9697 5970 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
9698 2985 : Value |= (op & UINT64_C(255)) << 40;
9699 : // op: srsrc
9700 5970 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
9701 2985 : Value |= (op & UINT64_C(124)) << 46;
9702 : // op: slc
9703 5970 : op = getMachineOpValue(MI, MI.getOperand(5), Fixups, STI);
9704 2985 : Value |= (op & UINT64_C(1)) << 17;
9705 : // op: tfe
9706 5970 : op = getMachineOpValue(MI, MI.getOperand(6), Fixups, STI);
9707 2985 : Value |= (op & UINT64_C(1)) << 55;
9708 : // op: soffset
9709 5970 : op = getMachineOpValue(MI, MI.getOperand(2), Fixups, STI);
9710 2985 : Value |= (op & UINT64_C(255)) << 56;
9711 2985 : break;
9712 : }
9713 14 : case AMDGPU::BUFFER_LOAD_DWORD_LDS_OFFSET_si:
9714 : case AMDGPU::BUFFER_LOAD_FORMAT_X_LDS_OFFSET_si:
9715 : case AMDGPU::BUFFER_LOAD_SBYTE_LDS_OFFSET_si:
9716 : case AMDGPU::BUFFER_LOAD_SSHORT_LDS_OFFSET_si:
9717 : case AMDGPU::BUFFER_LOAD_UBYTE_LDS_OFFSET_si:
9718 : case AMDGPU::BUFFER_LOAD_USHORT_LDS_OFFSET_si: {
9719 : // op: offset
9720 28 : op = getMachineOpValue(MI, MI.getOperand(3), Fixups, STI);
9721 14 : Value |= op & UINT64_C(4095);
9722 : // op: glc
9723 28 : op = getMachineOpValue(MI, MI.getOperand(4), Fixups, STI);
9724 14 : Value |= (op & UINT64_C(1)) << 14;
9725 : // op: vdata
9726 28 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
9727 14 : Value |= (op & UINT64_C(255)) << 40;
9728 : // op: srsrc
9729 28 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
9730 14 : Value |= (op & UINT64_C(124)) << 46;
9731 : // op: slc
9732 28 : op = getMachineOpValue(MI, MI.getOperand(5), Fixups, STI);
9733 14 : Value |= (op & UINT64_C(1)) << 54;
9734 : // op: soffset
9735 28 : op = getMachineOpValue(MI, MI.getOperand(2), Fixups, STI);
9736 14 : Value |= (op & UINT64_C(255)) << 56;
9737 14 : break;
9738 : }
9739 681 : case AMDGPU::BUFFER_LOAD_DWORDX2_OFFSET_si:
9740 : case AMDGPU::BUFFER_LOAD_DWORDX3_OFFSET_si:
9741 : case AMDGPU::BUFFER_LOAD_DWORDX4_OFFSET_si:
9742 : case AMDGPU::BUFFER_LOAD_DWORD_OFFSET_si:
9743 : case AMDGPU::BUFFER_LOAD_FORMAT_XYZW_OFFSET_si:
9744 : case AMDGPU::BUFFER_LOAD_FORMAT_XYZ_OFFSET_si:
9745 : case AMDGPU::BUFFER_LOAD_FORMAT_XY_OFFSET_si:
9746 : case AMDGPU::BUFFER_LOAD_FORMAT_X_OFFSET_si:
9747 : case AMDGPU::BUFFER_LOAD_SBYTE_OFFSET_si:
9748 : case AMDGPU::BUFFER_LOAD_SSHORT_OFFSET_si:
9749 : case AMDGPU::BUFFER_LOAD_UBYTE_OFFSET_si:
9750 : case AMDGPU::BUFFER_LOAD_USHORT_OFFSET_si:
9751 : case AMDGPU::BUFFER_STORE_BYTE_OFFSET_si:
9752 : case AMDGPU::BUFFER_STORE_DWORDX2_OFFSET_si:
9753 : case AMDGPU::BUFFER_STORE_DWORDX3_OFFSET_si:
9754 : case AMDGPU::BUFFER_STORE_DWORDX4_OFFSET_si:
9755 : case AMDGPU::BUFFER_STORE_DWORD_OFFSET_si:
9756 : case AMDGPU::BUFFER_STORE_FORMAT_XYZW_OFFSET_si:
9757 : case AMDGPU::BUFFER_STORE_FORMAT_XYZ_OFFSET_si:
9758 : case AMDGPU::BUFFER_STORE_FORMAT_XY_OFFSET_si:
9759 : case AMDGPU::BUFFER_STORE_FORMAT_X_OFFSET_si:
9760 : case AMDGPU::BUFFER_STORE_SHORT_OFFSET_si: {
9761 : // op: offset
9762 1362 : op = getMachineOpValue(MI, MI.getOperand(3), Fixups, STI);
9763 681 : Value |= op & UINT64_C(4095);
9764 : // op: glc
9765 1362 : op = getMachineOpValue(MI, MI.getOperand(4), Fixups, STI);
9766 681 : Value |= (op & UINT64_C(1)) << 14;
9767 : // op: vdata
9768 1362 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
9769 681 : Value |= (op & UINT64_C(255)) << 40;
9770 : // op: srsrc
9771 1362 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
9772 681 : Value |= (op & UINT64_C(124)) << 46;
9773 : // op: slc
9774 1362 : op = getMachineOpValue(MI, MI.getOperand(5), Fixups, STI);
9775 681 : Value |= (op & UINT64_C(1)) << 54;
9776 : // op: tfe
9777 1362 : op = getMachineOpValue(MI, MI.getOperand(6), Fixups, STI);
9778 681 : Value |= (op & UINT64_C(1)) << 55;
9779 : // op: soffset
9780 1362 : op = getMachineOpValue(MI, MI.getOperand(2), Fixups, STI);
9781 681 : Value |= (op & UINT64_C(255)) << 56;
9782 681 : break;
9783 : }
9784 100 : case AMDGPU::TBUFFER_LOAD_FORMAT_D16_XYZW_OFFSET_vi:
9785 : case AMDGPU::TBUFFER_LOAD_FORMAT_D16_XYZW_gfx80_OFFSET_gfx80:
9786 : case AMDGPU::TBUFFER_LOAD_FORMAT_D16_XYZ_OFFSET_vi:
9787 : case AMDGPU::TBUFFER_LOAD_FORMAT_D16_XYZ_gfx80_OFFSET_gfx80:
9788 : case AMDGPU::TBUFFER_LOAD_FORMAT_D16_XY_OFFSET_vi:
9789 : case AMDGPU::TBUFFER_LOAD_FORMAT_D16_XY_gfx80_OFFSET_gfx80:
9790 : case AMDGPU::TBUFFER_LOAD_FORMAT_D16_X_OFFSET_vi:
9791 : case AMDGPU::TBUFFER_LOAD_FORMAT_D16_X_gfx80_OFFSET_gfx80:
9792 : case AMDGPU::TBUFFER_LOAD_FORMAT_XYZW_OFFSET_si:
9793 : case AMDGPU::TBUFFER_LOAD_FORMAT_XYZW_OFFSET_vi:
9794 : case AMDGPU::TBUFFER_LOAD_FORMAT_XYZ_OFFSET_si:
9795 : case AMDGPU::TBUFFER_LOAD_FORMAT_XYZ_OFFSET_vi:
9796 : case AMDGPU::TBUFFER_LOAD_FORMAT_XY_OFFSET_si:
9797 : case AMDGPU::TBUFFER_LOAD_FORMAT_XY_OFFSET_vi:
9798 : case AMDGPU::TBUFFER_LOAD_FORMAT_X_OFFSET_si:
9799 : case AMDGPU::TBUFFER_LOAD_FORMAT_X_OFFSET_vi:
9800 : case AMDGPU::TBUFFER_STORE_FORMAT_D16_XYZW_OFFSET_vi:
9801 : case AMDGPU::TBUFFER_STORE_FORMAT_D16_XYZW_gfx80_OFFSET_gfx80:
9802 : case AMDGPU::TBUFFER_STORE_FORMAT_D16_XYZ_OFFSET_vi:
9803 : case AMDGPU::TBUFFER_STORE_FORMAT_D16_XYZ_gfx80_OFFSET_gfx80:
9804 : case AMDGPU::TBUFFER_STORE_FORMAT_D16_XY_OFFSET_vi:
9805 : case AMDGPU::TBUFFER_STORE_FORMAT_D16_XY_gfx80_OFFSET_gfx80:
9806 : case AMDGPU::TBUFFER_STORE_FORMAT_D16_X_OFFSET_vi:
9807 : case AMDGPU::TBUFFER_STORE_FORMAT_D16_X_gfx80_OFFSET_gfx80:
9808 : case AMDGPU::TBUFFER_STORE_FORMAT_XYZW_OFFSET_si:
9809 : case AMDGPU::TBUFFER_STORE_FORMAT_XYZW_OFFSET_vi:
9810 : case AMDGPU::TBUFFER_STORE_FORMAT_XYZ_OFFSET_si:
9811 : case AMDGPU::TBUFFER_STORE_FORMAT_XYZ_OFFSET_vi:
9812 : case AMDGPU::TBUFFER_STORE_FORMAT_XY_OFFSET_si:
9813 : case AMDGPU::TBUFFER_STORE_FORMAT_XY_OFFSET_vi:
9814 : case AMDGPU::TBUFFER_STORE_FORMAT_X_OFFSET_si:
9815 : case AMDGPU::TBUFFER_STORE_FORMAT_X_OFFSET_vi: {
9816 : // op: offset
9817 200 : op = getMachineOpValue(MI, MI.getOperand(3), Fixups, STI);
9818 100 : Value |= op & UINT64_C(4095);
9819 : // op: glc
9820 200 : op = getMachineOpValue(MI, MI.getOperand(5), Fixups, STI);
9821 100 : Value |= (op & UINT64_C(1)) << 14;
9822 : // op: format
9823 200 : op = getMachineOpValue(MI, MI.getOperand(4), Fixups, STI);
9824 100 : Value |= (op & UINT64_C(127)) << 19;
9825 : // op: vdata
9826 200 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
9827 100 : Value |= (op & UINT64_C(255)) << 40;
9828 : // op: srsrc
9829 200 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
9830 100 : Value |= (op & UINT64_C(124)) << 46;
9831 : // op: slc
9832 200 : op = getMachineOpValue(MI, MI.getOperand(6), Fixups, STI);
9833 100 : Value |= (op & UINT64_C(1)) << 54;
9834 : // op: tfe
9835 200 : op = getMachineOpValue(MI, MI.getOperand(7), Fixups, STI);
9836 100 : Value |= (op & UINT64_C(1)) << 55;
9837 : // op: soffset
9838 200 : op = getMachineOpValue(MI, MI.getOperand(2), Fixups, STI);
9839 100 : Value |= (op & UINT64_C(255)) << 56;
9840 100 : break;
9841 : }
9842 1674 : case AMDGPU::BUFFER_ATOMIC_ADD_OFFSET_vi:
9843 : case AMDGPU::BUFFER_ATOMIC_ADD_X2_OFFSET_vi:
9844 : case AMDGPU::BUFFER_ATOMIC_AND_OFFSET_vi:
9845 : case AMDGPU::BUFFER_ATOMIC_AND_X2_OFFSET_vi:
9846 : case AMDGPU::BUFFER_ATOMIC_CMPSWAP_OFFSET_vi:
9847 : case AMDGPU::BUFFER_ATOMIC_CMPSWAP_X2_OFFSET_vi:
9848 : case AMDGPU::BUFFER_ATOMIC_DEC_OFFSET_vi:
9849 : case AMDGPU::BUFFER_ATOMIC_DEC_X2_OFFSET_vi:
9850 : case AMDGPU::BUFFER_ATOMIC_INC_OFFSET_vi:
9851 : case AMDGPU::BUFFER_ATOMIC_INC_X2_OFFSET_vi:
9852 : case AMDGPU::BUFFER_ATOMIC_OR_OFFSET_vi:
9853 : case AMDGPU::BUFFER_ATOMIC_OR_X2_OFFSET_vi:
9854 : case AMDGPU::BUFFER_ATOMIC_SMAX_OFFSET_vi:
9855 : case AMDGPU::BUFFER_ATOMIC_SMAX_X2_OFFSET_vi:
9856 : case AMDGPU::BUFFER_ATOMIC_SMIN_OFFSET_vi:
9857 : case AMDGPU::BUFFER_ATOMIC_SMIN_X2_OFFSET_vi:
9858 : case AMDGPU::BUFFER_ATOMIC_SUB_OFFSET_vi:
9859 : case AMDGPU::BUFFER_ATOMIC_SUB_X2_OFFSET_vi:
9860 : case AMDGPU::BUFFER_ATOMIC_SWAP_OFFSET_vi:
9861 : case AMDGPU::BUFFER_ATOMIC_SWAP_X2_OFFSET_vi:
9862 : case AMDGPU::BUFFER_ATOMIC_UMAX_OFFSET_vi:
9863 : case AMDGPU::BUFFER_ATOMIC_UMAX_X2_OFFSET_vi:
9864 : case AMDGPU::BUFFER_ATOMIC_UMIN_OFFSET_vi:
9865 : case AMDGPU::BUFFER_ATOMIC_UMIN_X2_OFFSET_vi:
9866 : case AMDGPU::BUFFER_ATOMIC_XOR_OFFSET_vi:
9867 : case AMDGPU::BUFFER_ATOMIC_XOR_X2_OFFSET_vi: {
9868 : // op: offset
9869 3348 : op = getMachineOpValue(MI, MI.getOperand(3), Fixups, STI);
9870 1674 : Value |= op & UINT64_C(4095);
9871 : // op: vdata
9872 3348 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
9873 1674 : Value |= (op & UINT64_C(255)) << 40;
9874 : // op: srsrc
9875 3348 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
9876 1674 : Value |= (op & UINT64_C(124)) << 46;
9877 : // op: slc
9878 3348 : op = getMachineOpValue(MI, MI.getOperand(4), Fixups, STI);
9879 1674 : Value |= (op & UINT64_C(1)) << 17;
9880 : // op: soffset
9881 3348 : op = getMachineOpValue(MI, MI.getOperand(2), Fixups, STI);
9882 1674 : Value |= (op & UINT64_C(255)) << 56;
9883 1674 : break;
9884 : }
9885 349 : case AMDGPU::BUFFER_ATOMIC_ADD_OFFSET_si:
9886 : case AMDGPU::BUFFER_ATOMIC_ADD_X2_OFFSET_si:
9887 : case AMDGPU::BUFFER_ATOMIC_AND_OFFSET_si:
9888 : case AMDGPU::BUFFER_ATOMIC_AND_X2_OFFSET_si:
9889 : case AMDGPU::BUFFER_ATOMIC_CMPSWAP_OFFSET_si:
9890 : case AMDGPU::BUFFER_ATOMIC_CMPSWAP_X2_OFFSET_si:
9891 : case AMDGPU::BUFFER_ATOMIC_DEC_OFFSET_si:
9892 : case AMDGPU::BUFFER_ATOMIC_DEC_X2_OFFSET_si:
9893 : case AMDGPU::BUFFER_ATOMIC_INC_OFFSET_si:
9894 : case AMDGPU::BUFFER_ATOMIC_INC_X2_OFFSET_si:
9895 : case AMDGPU::BUFFER_ATOMIC_OR_OFFSET_si:
9896 : case AMDGPU::BUFFER_ATOMIC_OR_X2_OFFSET_si:
9897 : case AMDGPU::BUFFER_ATOMIC_SMAX_OFFSET_si:
9898 : case AMDGPU::BUFFER_ATOMIC_SMAX_X2_OFFSET_si:
9899 : case AMDGPU::BUFFER_ATOMIC_SMIN_OFFSET_si:
9900 : case AMDGPU::BUFFER_ATOMIC_SMIN_X2_OFFSET_si:
9901 : case AMDGPU::BUFFER_ATOMIC_SUB_OFFSET_si:
9902 : case AMDGPU::BUFFER_ATOMIC_SUB_X2_OFFSET_si:
9903 : case AMDGPU::BUFFER_ATOMIC_SWAP_OFFSET_si:
9904 : case AMDGPU::BUFFER_ATOMIC_SWAP_X2_OFFSET_si:
9905 : case AMDGPU::BUFFER_ATOMIC_UMAX_OFFSET_si:
9906 : case AMDGPU::BUFFER_ATOMIC_UMAX_X2_OFFSET_si:
9907 : case AMDGPU::BUFFER_ATOMIC_UMIN_OFFSET_si:
9908 : case AMDGPU::BUFFER_ATOMIC_UMIN_X2_OFFSET_si:
9909 : case AMDGPU::BUFFER_ATOMIC_XOR_OFFSET_si:
9910 : case AMDGPU::BUFFER_ATOMIC_XOR_X2_OFFSET_si: {
9911 : // op: offset
9912 698 : op = getMachineOpValue(MI, MI.getOperand(3), Fixups, STI);
9913 349 : Value |= op & UINT64_C(4095);
9914 : // op: vdata
9915 698 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
9916 349 : Value |= (op & UINT64_C(255)) << 40;
9917 : // op: srsrc
9918 698 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
9919 349 : Value |= (op & UINT64_C(124)) << 46;
9920 : // op: slc
9921 698 : op = getMachineOpValue(MI, MI.getOperand(4), Fixups, STI);
9922 349 : Value |= (op & UINT64_C(1)) << 54;
9923 : // op: soffset
9924 698 : op = getMachineOpValue(MI, MI.getOperand(2), Fixups, STI);
9925 349 : Value |= (op & UINT64_C(255)) << 56;
9926 349 : break;
9927 : }
9928 18 : case AMDGPU::BUFFER_LOAD_DWORDX2_LDS_BOTHEN_vi:
9929 : case AMDGPU::BUFFER_LOAD_DWORDX2_LDS_IDXEN_vi:
9930 : case AMDGPU::BUFFER_LOAD_DWORDX2_LDS_OFFEN_vi:
9931 : case AMDGPU::BUFFER_LOAD_DWORDX3_LDS_BOTHEN_vi:
9932 : case AMDGPU::BUFFER_LOAD_DWORDX3_LDS_IDXEN_vi:
9933 : case AMDGPU::BUFFER_LOAD_DWORDX3_LDS_OFFEN_vi:
9934 : case AMDGPU::BUFFER_LOAD_DWORDX4_LDS_BOTHEN_vi:
9935 : case AMDGPU::BUFFER_LOAD_DWORDX4_LDS_IDXEN_vi:
9936 : case AMDGPU::BUFFER_LOAD_DWORDX4_LDS_OFFEN_vi:
9937 : case AMDGPU::BUFFER_LOAD_DWORD_LDS_BOTHEN_vi:
9938 : case AMDGPU::BUFFER_LOAD_DWORD_LDS_IDXEN_vi:
9939 : case AMDGPU::BUFFER_LOAD_DWORD_LDS_OFFEN_vi:
9940 : case AMDGPU::BUFFER_LOAD_FORMAT_X_LDS_BOTHEN_vi:
9941 : case AMDGPU::BUFFER_LOAD_FORMAT_X_LDS_IDXEN_vi:
9942 : case AMDGPU::BUFFER_LOAD_FORMAT_X_LDS_OFFEN_vi:
9943 : case AMDGPU::BUFFER_LOAD_SBYTE_LDS_BOTHEN_vi:
9944 : case AMDGPU::BUFFER_LOAD_SBYTE_LDS_IDXEN_vi:
9945 : case AMDGPU::BUFFER_LOAD_SBYTE_LDS_OFFEN_vi:
9946 : case AMDGPU::BUFFER_LOAD_SSHORT_LDS_BOTHEN_vi:
9947 : case AMDGPU::BUFFER_LOAD_SSHORT_LDS_IDXEN_vi:
9948 : case AMDGPU::BUFFER_LOAD_SSHORT_LDS_OFFEN_vi:
9949 : case AMDGPU::BUFFER_LOAD_UBYTE_LDS_BOTHEN_vi:
9950 : case AMDGPU::BUFFER_LOAD_UBYTE_LDS_IDXEN_vi:
9951 : case AMDGPU::BUFFER_LOAD_UBYTE_LDS_OFFEN_vi:
9952 : case AMDGPU::BUFFER_LOAD_USHORT_LDS_BOTHEN_vi:
9953 : case AMDGPU::BUFFER_LOAD_USHORT_LDS_IDXEN_vi:
9954 : case AMDGPU::BUFFER_LOAD_USHORT_LDS_OFFEN_vi: {
9955 : // op: offset
9956 36 : op = getMachineOpValue(MI, MI.getOperand(4), Fixups, STI);
9957 18 : Value |= op & UINT64_C(4095);
9958 : // op: glc
9959 36 : op = getMachineOpValue(MI, MI.getOperand(5), Fixups, STI);
9960 18 : Value |= (op & UINT64_C(1)) << 14;
9961 : // op: vaddr
9962 36 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
9963 18 : Value |= (op & UINT64_C(255)) << 32;
9964 : // op: vdata
9965 36 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
9966 18 : Value |= (op & UINT64_C(255)) << 40;
9967 : // op: srsrc
9968 36 : op = getMachineOpValue(MI, MI.getOperand(2), Fixups, STI);
9969 18 : Value |= (op & UINT64_C(124)) << 46;
9970 : // op: slc
9971 36 : op = getMachineOpValue(MI, MI.getOperand(6), Fixups, STI);
9972 18 : Value |= (op & UINT64_C(1)) << 17;
9973 : // op: soffset
9974 36 : op = getMachineOpValue(MI, MI.getOperand(3), Fixups, STI);
9975 18 : Value |= (op & UINT64_C(255)) << 56;
9976 18 : break;
9977 : }
9978 640 : case AMDGPU::BUFFER_LOAD_DWORDX2_BOTHEN_vi:
9979 : case AMDGPU::BUFFER_LOAD_DWORDX2_IDXEN_vi:
9980 : case AMDGPU::BUFFER_LOAD_DWORDX2_OFFEN_vi:
9981 : case AMDGPU::BUFFER_LOAD_DWORDX3_BOTHEN_vi:
9982 : case AMDGPU::BUFFER_LOAD_DWORDX3_IDXEN_vi:
9983 : case AMDGPU::BUFFER_LOAD_DWORDX3_OFFEN_vi:
9984 : case AMDGPU::BUFFER_LOAD_DWORDX4_BOTHEN_vi:
9985 : case AMDGPU::BUFFER_LOAD_DWORDX4_IDXEN_vi:
9986 : case AMDGPU::BUFFER_LOAD_DWORDX4_OFFEN_vi:
9987 : case AMDGPU::BUFFER_LOAD_DWORD_BOTHEN_vi:
9988 : case AMDGPU::BUFFER_LOAD_DWORD_IDXEN_vi:
9989 : case AMDGPU::BUFFER_LOAD_DWORD_OFFEN_vi:
9990 : case AMDGPU::BUFFER_LOAD_FORMAT_D16_HI_X_BOTHEN_vi:
9991 : case AMDGPU::BUFFER_LOAD_FORMAT_D16_HI_X_IDXEN_vi:
9992 : case AMDGPU::BUFFER_LOAD_FORMAT_D16_HI_X_OFFEN_vi:
9993 : case AMDGPU::BUFFER_LOAD_FORMAT_D16_XYZW_BOTHEN_vi:
9994 : case AMDGPU::BUFFER_LOAD_FORMAT_D16_XYZW_IDXEN_vi:
9995 : case AMDGPU::BUFFER_LOAD_FORMAT_D16_XYZW_OFFEN_vi:
9996 : case AMDGPU::BUFFER_LOAD_FORMAT_D16_XYZW_gfx80_BOTHEN_gfx80:
9997 : case AMDGPU::BUFFER_LOAD_FORMAT_D16_XYZW_gfx80_IDXEN_gfx80:
9998 : case AMDGPU::BUFFER_LOAD_FORMAT_D16_XYZW_gfx80_OFFEN_gfx80:
9999 : case AMDGPU::BUFFER_LOAD_FORMAT_D16_XYZ_BOTHEN_vi:
10000 : case AMDGPU::BUFFER_LOAD_FORMAT_D16_XYZ_IDXEN_vi:
10001 : case AMDGPU::BUFFER_LOAD_FORMAT_D16_XYZ_OFFEN_vi:
10002 : case AMDGPU::BUFFER_LOAD_FORMAT_D16_XYZ_gfx80_BOTHEN_gfx80:
10003 : case AMDGPU::BUFFER_LOAD_FORMAT_D16_XYZ_gfx80_IDXEN_gfx80:
10004 : case AMDGPU::BUFFER_LOAD_FORMAT_D16_XYZ_gfx80_OFFEN_gfx80:
10005 : case AMDGPU::BUFFER_LOAD_FORMAT_D16_XY_BOTHEN_vi:
10006 : case AMDGPU::BUFFER_LOAD_FORMAT_D16_XY_IDXEN_vi:
10007 : case AMDGPU::BUFFER_LOAD_FORMAT_D16_XY_OFFEN_vi:
10008 : case AMDGPU::BUFFER_LOAD_FORMAT_D16_XY_gfx80_BOTHEN_gfx80:
10009 : case AMDGPU::BUFFER_LOAD_FORMAT_D16_XY_gfx80_IDXEN_gfx80:
10010 : case AMDGPU::BUFFER_LOAD_FORMAT_D16_XY_gfx80_OFFEN_gfx80:
10011 : case AMDGPU::BUFFER_LOAD_FORMAT_D16_X_BOTHEN_vi:
10012 : case AMDGPU::BUFFER_LOAD_FORMAT_D16_X_IDXEN_vi:
10013 : case AMDGPU::BUFFER_LOAD_FORMAT_D16_X_OFFEN_vi:
10014 : case AMDGPU::BUFFER_LOAD_FORMAT_D16_X_gfx80_BOTHEN_gfx80:
10015 : case AMDGPU::BUFFER_LOAD_FORMAT_D16_X_gfx80_IDXEN_gfx80:
10016 : case AMDGPU::BUFFER_LOAD_FORMAT_D16_X_gfx80_OFFEN_gfx80:
10017 : case AMDGPU::BUFFER_LOAD_FORMAT_XYZW_BOTHEN_vi:
10018 : case AMDGPU::BUFFER_LOAD_FORMAT_XYZW_IDXEN_vi:
10019 : case AMDGPU::BUFFER_LOAD_FORMAT_XYZW_OFFEN_vi:
10020 : case AMDGPU::BUFFER_LOAD_FORMAT_XYZ_BOTHEN_vi:
10021 : case AMDGPU::BUFFER_LOAD_FORMAT_XYZ_IDXEN_vi:
10022 : case AMDGPU::BUFFER_LOAD_FORMAT_XYZ_OFFEN_vi:
10023 : case AMDGPU::BUFFER_LOAD_FORMAT_XY_BOTHEN_vi:
10024 : case AMDGPU::BUFFER_LOAD_FORMAT_XY_IDXEN_vi:
10025 : case AMDGPU::BUFFER_LOAD_FORMAT_XY_OFFEN_vi:
10026 : case AMDGPU::BUFFER_LOAD_FORMAT_X_BOTHEN_vi:
10027 : case AMDGPU::BUFFER_LOAD_FORMAT_X_IDXEN_vi:
10028 : case AMDGPU::BUFFER_LOAD_FORMAT_X_OFFEN_vi:
10029 : case AMDGPU::BUFFER_LOAD_SBYTE_BOTHEN_vi:
10030 : case AMDGPU::BUFFER_LOAD_SBYTE_D16_BOTHEN_vi:
10031 : case AMDGPU::BUFFER_LOAD_SBYTE_D16_HI_BOTHEN_vi:
10032 : case AMDGPU::BUFFER_LOAD_SBYTE_D16_HI_IDXEN_vi:
10033 : case AMDGPU::BUFFER_LOAD_SBYTE_D16_HI_OFFEN_vi:
10034 : case AMDGPU::BUFFER_LOAD_SBYTE_D16_IDXEN_vi:
10035 : case AMDGPU::BUFFER_LOAD_SBYTE_D16_OFFEN_vi:
10036 : case AMDGPU::BUFFER_LOAD_SBYTE_IDXEN_vi:
10037 : case AMDGPU::BUFFER_LOAD_SBYTE_OFFEN_vi:
10038 : case AMDGPU::BUFFER_LOAD_SHORT_D16_BOTHEN_vi:
10039 : case AMDGPU::BUFFER_LOAD_SHORT_D16_HI_BOTHEN_vi:
10040 : case AMDGPU::BUFFER_LOAD_SHORT_D16_HI_IDXEN_vi:
10041 : case AMDGPU::BUFFER_LOAD_SHORT_D16_HI_OFFEN_vi:
10042 : case AMDGPU::BUFFER_LOAD_SHORT_D16_IDXEN_vi:
10043 : case AMDGPU::BUFFER_LOAD_SHORT_D16_OFFEN_vi:
10044 : case AMDGPU::BUFFER_LOAD_SSHORT_BOTHEN_vi:
10045 : case AMDGPU::BUFFER_LOAD_SSHORT_IDXEN_vi:
10046 : case AMDGPU::BUFFER_LOAD_SSHORT_OFFEN_vi:
10047 : case AMDGPU::BUFFER_LOAD_UBYTE_BOTHEN_vi:
10048 : case AMDGPU::BUFFER_LOAD_UBYTE_D16_BOTHEN_vi:
10049 : case AMDGPU::BUFFER_LOAD_UBYTE_D16_HI_BOTHEN_vi:
10050 : case AMDGPU::BUFFER_LOAD_UBYTE_D16_HI_IDXEN_vi:
10051 : case AMDGPU::BUFFER_LOAD_UBYTE_D16_HI_OFFEN_vi:
10052 : case AMDGPU::BUFFER_LOAD_UBYTE_D16_IDXEN_vi:
10053 : case AMDGPU::BUFFER_LOAD_UBYTE_D16_OFFEN_vi:
10054 : case AMDGPU::BUFFER_LOAD_UBYTE_IDXEN_vi:
10055 : case AMDGPU::BUFFER_LOAD_UBYTE_OFFEN_vi:
10056 : case AMDGPU::BUFFER_LOAD_USHORT_BOTHEN_vi:
10057 : case AMDGPU::BUFFER_LOAD_USHORT_IDXEN_vi:
10058 : case AMDGPU::BUFFER_LOAD_USHORT_OFFEN_vi:
10059 : case AMDGPU::BUFFER_STORE_BYTE_BOTHEN_vi:
10060 : case AMDGPU::BUFFER_STORE_BYTE_D16_HI_BOTHEN_vi:
10061 : case AMDGPU::BUFFER_STORE_BYTE_D16_HI_IDXEN_vi:
10062 : case AMDGPU::BUFFER_STORE_BYTE_D16_HI_OFFEN_vi:
10063 : case AMDGPU::BUFFER_STORE_BYTE_IDXEN_vi:
10064 : case AMDGPU::BUFFER_STORE_BYTE_OFFEN_vi:
10065 : case AMDGPU::BUFFER_STORE_DWORDX2_BOTHEN_vi:
10066 : case AMDGPU::BUFFER_STORE_DWORDX2_IDXEN_vi:
10067 : case AMDGPU::BUFFER_STORE_DWORDX2_OFFEN_vi:
10068 : case AMDGPU::BUFFER_STORE_DWORDX3_BOTHEN_vi:
10069 : case AMDGPU::BUFFER_STORE_DWORDX3_IDXEN_vi:
10070 : case AMDGPU::BUFFER_STORE_DWORDX3_OFFEN_vi:
10071 : case AMDGPU::BUFFER_STORE_DWORDX4_BOTHEN_vi:
10072 : case AMDGPU::BUFFER_STORE_DWORDX4_IDXEN_vi:
10073 : case AMDGPU::BUFFER_STORE_DWORDX4_OFFEN_vi:
10074 : case AMDGPU::BUFFER_STORE_DWORD_BOTHEN_vi:
10075 : case AMDGPU::BUFFER_STORE_DWORD_IDXEN_vi:
10076 : case AMDGPU::BUFFER_STORE_DWORD_OFFEN_vi:
10077 : case AMDGPU::BUFFER_STORE_FORMAT_D16_HI_X_BOTHEN_vi:
10078 : case AMDGPU::BUFFER_STORE_FORMAT_D16_HI_X_IDXEN_vi:
10079 : case AMDGPU::BUFFER_STORE_FORMAT_D16_HI_X_OFFEN_vi:
10080 : case AMDGPU::BUFFER_STORE_FORMAT_D16_XYZW_BOTHEN_vi:
10081 : case AMDGPU::BUFFER_STORE_FORMAT_D16_XYZW_IDXEN_vi:
10082 : case AMDGPU::BUFFER_STORE_FORMAT_D16_XYZW_OFFEN_vi:
10083 : case AMDGPU::BUFFER_STORE_FORMAT_D16_XYZW_gfx80_BOTHEN_gfx80:
10084 : case AMDGPU::BUFFER_STORE_FORMAT_D16_XYZW_gfx80_IDXEN_gfx80:
10085 : case AMDGPU::BUFFER_STORE_FORMAT_D16_XYZW_gfx80_OFFEN_gfx80:
10086 : case AMDGPU::BUFFER_STORE_FORMAT_D16_XYZ_BOTHEN_vi:
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10088 : case AMDGPU::BUFFER_STORE_FORMAT_D16_XYZ_OFFEN_vi:
10089 : case AMDGPU::BUFFER_STORE_FORMAT_D16_XYZ_gfx80_BOTHEN_gfx80:
10090 : case AMDGPU::BUFFER_STORE_FORMAT_D16_XYZ_gfx80_IDXEN_gfx80:
10091 : case AMDGPU::BUFFER_STORE_FORMAT_D16_XYZ_gfx80_OFFEN_gfx80:
10092 : case AMDGPU::BUFFER_STORE_FORMAT_D16_XY_BOTHEN_vi:
10093 : case AMDGPU::BUFFER_STORE_FORMAT_D16_XY_IDXEN_vi:
10094 : case AMDGPU::BUFFER_STORE_FORMAT_D16_XY_OFFEN_vi:
10095 : case AMDGPU::BUFFER_STORE_FORMAT_D16_XY_gfx80_BOTHEN_gfx80:
10096 : case AMDGPU::BUFFER_STORE_FORMAT_D16_XY_gfx80_IDXEN_gfx80:
10097 : case AMDGPU::BUFFER_STORE_FORMAT_D16_XY_gfx80_OFFEN_gfx80:
10098 : case AMDGPU::BUFFER_STORE_FORMAT_D16_X_BOTHEN_vi:
10099 : case AMDGPU::BUFFER_STORE_FORMAT_D16_X_IDXEN_vi:
10100 : case AMDGPU::BUFFER_STORE_FORMAT_D16_X_OFFEN_vi:
10101 : case AMDGPU::BUFFER_STORE_FORMAT_D16_X_gfx80_BOTHEN_gfx80:
10102 : case AMDGPU::BUFFER_STORE_FORMAT_D16_X_gfx80_IDXEN_gfx80:
10103 : case AMDGPU::BUFFER_STORE_FORMAT_D16_X_gfx80_OFFEN_gfx80:
10104 : case AMDGPU::BUFFER_STORE_FORMAT_XYZW_BOTHEN_vi:
10105 : case AMDGPU::BUFFER_STORE_FORMAT_XYZW_IDXEN_vi:
10106 : case AMDGPU::BUFFER_STORE_FORMAT_XYZW_OFFEN_vi:
10107 : case AMDGPU::BUFFER_STORE_FORMAT_XYZ_BOTHEN_vi:
10108 : case AMDGPU::BUFFER_STORE_FORMAT_XYZ_IDXEN_vi:
10109 : case AMDGPU::BUFFER_STORE_FORMAT_XYZ_OFFEN_vi:
10110 : case AMDGPU::BUFFER_STORE_FORMAT_XY_BOTHEN_vi:
10111 : case AMDGPU::BUFFER_STORE_FORMAT_XY_IDXEN_vi:
10112 : case AMDGPU::BUFFER_STORE_FORMAT_XY_OFFEN_vi:
10113 : case AMDGPU::BUFFER_STORE_FORMAT_X_BOTHEN_vi:
10114 : case AMDGPU::BUFFER_STORE_FORMAT_X_IDXEN_vi:
10115 : case AMDGPU::BUFFER_STORE_FORMAT_X_OFFEN_vi:
10116 : case AMDGPU::BUFFER_STORE_SHORT_BOTHEN_vi:
10117 : case AMDGPU::BUFFER_STORE_SHORT_D16_HI_BOTHEN_vi:
10118 : case AMDGPU::BUFFER_STORE_SHORT_D16_HI_IDXEN_vi:
10119 : case AMDGPU::BUFFER_STORE_SHORT_D16_HI_OFFEN_vi:
10120 : case AMDGPU::BUFFER_STORE_SHORT_IDXEN_vi:
10121 : case AMDGPU::BUFFER_STORE_SHORT_OFFEN_vi: {
10122 : // op: offset
10123 1280 : op = getMachineOpValue(MI, MI.getOperand(4), Fixups, STI);
10124 640 : Value |= op & UINT64_C(4095);
10125 : // op: glc
10126 1280 : op = getMachineOpValue(MI, MI.getOperand(5), Fixups, STI);
10127 640 : Value |= (op & UINT64_C(1)) << 14;
10128 : // op: vaddr
10129 1280 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
10130 640 : Value |= (op & UINT64_C(255)) << 32;
10131 : // op: vdata
10132 1280 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
10133 640 : Value |= (op & UINT64_C(255)) << 40;
10134 : // op: srsrc
10135 1280 : op = getMachineOpValue(MI, MI.getOperand(2), Fixups, STI);
10136 640 : Value |= (op & UINT64_C(124)) << 46;
10137 : // op: slc
10138 1280 : op = getMachineOpValue(MI, MI.getOperand(6), Fixups, STI);
10139 640 : Value |= (op & UINT64_C(1)) << 17;
10140 : // op: tfe
10141 1280 : op = getMachineOpValue(MI, MI.getOperand(7), Fixups, STI);
10142 640 : Value |= (op & UINT64_C(1)) << 55;
10143 : // op: soffset
10144 1280 : op = getMachineOpValue(MI, MI.getOperand(3), Fixups, STI);
10145 640 : Value |= (op & UINT64_C(255)) << 56;
10146 640 : break;
10147 : }
10148 18 : case AMDGPU::BUFFER_LOAD_DWORD_LDS_ADDR64_si:
10149 : case AMDGPU::BUFFER_LOAD_DWORD_LDS_BOTHEN_si:
10150 : case AMDGPU::BUFFER_LOAD_DWORD_LDS_IDXEN_si:
10151 : case AMDGPU::BUFFER_LOAD_DWORD_LDS_OFFEN_si:
10152 : case AMDGPU::BUFFER_LOAD_FORMAT_X_LDS_ADDR64_si:
10153 : case AMDGPU::BUFFER_LOAD_FORMAT_X_LDS_BOTHEN_si:
10154 : case AMDGPU::BUFFER_LOAD_FORMAT_X_LDS_IDXEN_si:
10155 : case AMDGPU::BUFFER_LOAD_FORMAT_X_LDS_OFFEN_si:
10156 : case AMDGPU::BUFFER_LOAD_SBYTE_LDS_ADDR64_si:
10157 : case AMDGPU::BUFFER_LOAD_SBYTE_LDS_BOTHEN_si:
10158 : case AMDGPU::BUFFER_LOAD_SBYTE_LDS_IDXEN_si:
10159 : case AMDGPU::BUFFER_LOAD_SBYTE_LDS_OFFEN_si:
10160 : case AMDGPU::BUFFER_LOAD_SSHORT_LDS_ADDR64_si:
10161 : case AMDGPU::BUFFER_LOAD_SSHORT_LDS_BOTHEN_si:
10162 : case AMDGPU::BUFFER_LOAD_SSHORT_LDS_IDXEN_si:
10163 : case AMDGPU::BUFFER_LOAD_SSHORT_LDS_OFFEN_si:
10164 : case AMDGPU::BUFFER_LOAD_UBYTE_LDS_ADDR64_si:
10165 : case AMDGPU::BUFFER_LOAD_UBYTE_LDS_BOTHEN_si:
10166 : case AMDGPU::BUFFER_LOAD_UBYTE_LDS_IDXEN_si:
10167 : case AMDGPU::BUFFER_LOAD_UBYTE_LDS_OFFEN_si:
10168 : case AMDGPU::BUFFER_LOAD_USHORT_LDS_ADDR64_si:
10169 : case AMDGPU::BUFFER_LOAD_USHORT_LDS_BOTHEN_si:
10170 : case AMDGPU::BUFFER_LOAD_USHORT_LDS_IDXEN_si:
10171 : case AMDGPU::BUFFER_LOAD_USHORT_LDS_OFFEN_si: {
10172 : // op: offset
10173 36 : op = getMachineOpValue(MI, MI.getOperand(4), Fixups, STI);
10174 18 : Value |= op & UINT64_C(4095);
10175 : // op: glc
10176 36 : op = getMachineOpValue(MI, MI.getOperand(5), Fixups, STI);
10177 18 : Value |= (op & UINT64_C(1)) << 14;
10178 : // op: vaddr
10179 36 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
10180 18 : Value |= (op & UINT64_C(255)) << 32;
10181 : // op: vdata
10182 36 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
10183 18 : Value |= (op & UINT64_C(255)) << 40;
10184 : // op: srsrc
10185 36 : op = getMachineOpValue(MI, MI.getOperand(2), Fixups, STI);
10186 18 : Value |= (op & UINT64_C(124)) << 46;
10187 : // op: slc
10188 36 : op = getMachineOpValue(MI, MI.getOperand(6), Fixups, STI);
10189 18 : Value |= (op & UINT64_C(1)) << 54;
10190 : // op: soffset
10191 36 : op = getMachineOpValue(MI, MI.getOperand(3), Fixups, STI);
10192 18 : Value |= (op & UINT64_C(255)) << 56;
10193 18 : break;
10194 : }
10195 449 : case AMDGPU::BUFFER_LOAD_DWORDX2_ADDR64_si:
10196 : case AMDGPU::BUFFER_LOAD_DWORDX2_BOTHEN_si:
10197 : case AMDGPU::BUFFER_LOAD_DWORDX2_IDXEN_si:
10198 : case AMDGPU::BUFFER_LOAD_DWORDX2_OFFEN_si:
10199 : case AMDGPU::BUFFER_LOAD_DWORDX3_ADDR64_si:
10200 : case AMDGPU::BUFFER_LOAD_DWORDX3_BOTHEN_si:
10201 : case AMDGPU::BUFFER_LOAD_DWORDX3_IDXEN_si:
10202 : case AMDGPU::BUFFER_LOAD_DWORDX3_OFFEN_si:
10203 : case AMDGPU::BUFFER_LOAD_DWORDX4_ADDR64_si:
10204 : case AMDGPU::BUFFER_LOAD_DWORDX4_BOTHEN_si:
10205 : case AMDGPU::BUFFER_LOAD_DWORDX4_IDXEN_si:
10206 : case AMDGPU::BUFFER_LOAD_DWORDX4_OFFEN_si:
10207 : case AMDGPU::BUFFER_LOAD_DWORD_ADDR64_si:
10208 : case AMDGPU::BUFFER_LOAD_DWORD_BOTHEN_si:
10209 : case AMDGPU::BUFFER_LOAD_DWORD_IDXEN_si:
10210 : case AMDGPU::BUFFER_LOAD_DWORD_OFFEN_si:
10211 : case AMDGPU::BUFFER_LOAD_FORMAT_XYZW_ADDR64_si:
10212 : case AMDGPU::BUFFER_LOAD_FORMAT_XYZW_BOTHEN_si:
10213 : case AMDGPU::BUFFER_LOAD_FORMAT_XYZW_IDXEN_si:
10214 : case AMDGPU::BUFFER_LOAD_FORMAT_XYZW_OFFEN_si:
10215 : case AMDGPU::BUFFER_LOAD_FORMAT_XYZ_ADDR64_si:
10216 : case AMDGPU::BUFFER_LOAD_FORMAT_XYZ_BOTHEN_si:
10217 : case AMDGPU::BUFFER_LOAD_FORMAT_XYZ_IDXEN_si:
10218 : case AMDGPU::BUFFER_LOAD_FORMAT_XYZ_OFFEN_si:
10219 : case AMDGPU::BUFFER_LOAD_FORMAT_XY_ADDR64_si:
10220 : case AMDGPU::BUFFER_LOAD_FORMAT_XY_BOTHEN_si:
10221 : case AMDGPU::BUFFER_LOAD_FORMAT_XY_IDXEN_si:
10222 : case AMDGPU::BUFFER_LOAD_FORMAT_XY_OFFEN_si:
10223 : case AMDGPU::BUFFER_LOAD_FORMAT_X_ADDR64_si:
10224 : case AMDGPU::BUFFER_LOAD_FORMAT_X_BOTHEN_si:
10225 : case AMDGPU::BUFFER_LOAD_FORMAT_X_IDXEN_si:
10226 : case AMDGPU::BUFFER_LOAD_FORMAT_X_OFFEN_si:
10227 : case AMDGPU::BUFFER_LOAD_SBYTE_ADDR64_si:
10228 : case AMDGPU::BUFFER_LOAD_SBYTE_BOTHEN_si:
10229 : case AMDGPU::BUFFER_LOAD_SBYTE_IDXEN_si:
10230 : case AMDGPU::BUFFER_LOAD_SBYTE_OFFEN_si:
10231 : case AMDGPU::BUFFER_LOAD_SSHORT_ADDR64_si:
10232 : case AMDGPU::BUFFER_LOAD_SSHORT_BOTHEN_si:
10233 : case AMDGPU::BUFFER_LOAD_SSHORT_IDXEN_si:
10234 : case AMDGPU::BUFFER_LOAD_SSHORT_OFFEN_si:
10235 : case AMDGPU::BUFFER_LOAD_UBYTE_ADDR64_si:
10236 : case AMDGPU::BUFFER_LOAD_UBYTE_BOTHEN_si:
10237 : case AMDGPU::BUFFER_LOAD_UBYTE_IDXEN_si:
10238 : case AMDGPU::BUFFER_LOAD_UBYTE_OFFEN_si:
10239 : case AMDGPU::BUFFER_LOAD_USHORT_ADDR64_si:
10240 : case AMDGPU::BUFFER_LOAD_USHORT_BOTHEN_si:
10241 : case AMDGPU::BUFFER_LOAD_USHORT_IDXEN_si:
10242 : case AMDGPU::BUFFER_LOAD_USHORT_OFFEN_si:
10243 : case AMDGPU::BUFFER_STORE_BYTE_ADDR64_si:
10244 : case AMDGPU::BUFFER_STORE_BYTE_BOTHEN_si:
10245 : case AMDGPU::BUFFER_STORE_BYTE_IDXEN_si:
10246 : case AMDGPU::BUFFER_STORE_BYTE_OFFEN_si:
10247 : case AMDGPU::BUFFER_STORE_DWORDX2_ADDR64_si:
10248 : case AMDGPU::BUFFER_STORE_DWORDX2_BOTHEN_si:
10249 : case AMDGPU::BUFFER_STORE_DWORDX2_IDXEN_si:
10250 : case AMDGPU::BUFFER_STORE_DWORDX2_OFFEN_si:
10251 : case AMDGPU::BUFFER_STORE_DWORDX3_ADDR64_si:
10252 : case AMDGPU::BUFFER_STORE_DWORDX3_BOTHEN_si:
10253 : case AMDGPU::BUFFER_STORE_DWORDX3_IDXEN_si:
10254 : case AMDGPU::BUFFER_STORE_DWORDX3_OFFEN_si:
10255 : case AMDGPU::BUFFER_STORE_DWORDX4_ADDR64_si:
10256 : case AMDGPU::BUFFER_STORE_DWORDX4_BOTHEN_si:
10257 : case AMDGPU::BUFFER_STORE_DWORDX4_IDXEN_si:
10258 : case AMDGPU::BUFFER_STORE_DWORDX4_OFFEN_si:
10259 : case AMDGPU::BUFFER_STORE_DWORD_ADDR64_si:
10260 : case AMDGPU::BUFFER_STORE_DWORD_BOTHEN_si:
10261 : case AMDGPU::BUFFER_STORE_DWORD_IDXEN_si:
10262 : case AMDGPU::BUFFER_STORE_DWORD_OFFEN_si:
10263 : case AMDGPU::BUFFER_STORE_FORMAT_XYZW_ADDR64_si:
10264 : case AMDGPU::BUFFER_STORE_FORMAT_XYZW_BOTHEN_si:
10265 : case AMDGPU::BUFFER_STORE_FORMAT_XYZW_IDXEN_si:
10266 : case AMDGPU::BUFFER_STORE_FORMAT_XYZW_OFFEN_si:
10267 : case AMDGPU::BUFFER_STORE_FORMAT_XYZ_ADDR64_si:
10268 : case AMDGPU::BUFFER_STORE_FORMAT_XYZ_BOTHEN_si:
10269 : case AMDGPU::BUFFER_STORE_FORMAT_XYZ_IDXEN_si:
10270 : case AMDGPU::BUFFER_STORE_FORMAT_XYZ_OFFEN_si:
10271 : case AMDGPU::BUFFER_STORE_FORMAT_XY_ADDR64_si:
10272 : case AMDGPU::BUFFER_STORE_FORMAT_XY_BOTHEN_si:
10273 : case AMDGPU::BUFFER_STORE_FORMAT_XY_IDXEN_si:
10274 : case AMDGPU::BUFFER_STORE_FORMAT_XY_OFFEN_si:
10275 : case AMDGPU::BUFFER_STORE_FORMAT_X_ADDR64_si:
10276 : case AMDGPU::BUFFER_STORE_FORMAT_X_BOTHEN_si:
10277 : case AMDGPU::BUFFER_STORE_FORMAT_X_IDXEN_si:
10278 : case AMDGPU::BUFFER_STORE_FORMAT_X_OFFEN_si:
10279 : case AMDGPU::BUFFER_STORE_SHORT_ADDR64_si:
10280 : case AMDGPU::BUFFER_STORE_SHORT_BOTHEN_si:
10281 : case AMDGPU::BUFFER_STORE_SHORT_IDXEN_si:
10282 : case AMDGPU::BUFFER_STORE_SHORT_OFFEN_si: {
10283 : // op: offset
10284 898 : op = getMachineOpValue(MI, MI.getOperand(4), Fixups, STI);
10285 449 : Value |= op & UINT64_C(4095);
10286 : // op: glc
10287 898 : op = getMachineOpValue(MI, MI.getOperand(5), Fixups, STI);
10288 449 : Value |= (op & UINT64_C(1)) << 14;
10289 : // op: vaddr
10290 898 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
10291 449 : Value |= (op & UINT64_C(255)) << 32;
10292 : // op: vdata
10293 898 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
10294 449 : Value |= (op & UINT64_C(255)) << 40;
10295 : // op: srsrc
10296 898 : op = getMachineOpValue(MI, MI.getOperand(2), Fixups, STI);
10297 449 : Value |= (op & UINT64_C(124)) << 46;
10298 : // op: slc
10299 898 : op = getMachineOpValue(MI, MI.getOperand(6), Fixups, STI);
10300 449 : Value |= (op & UINT64_C(1)) << 54;
10301 : // op: tfe
10302 898 : op = getMachineOpValue(MI, MI.getOperand(7), Fixups, STI);
10303 449 : Value |= (op & UINT64_C(1)) << 55;
10304 : // op: soffset
10305 898 : op = getMachineOpValue(MI, MI.getOperand(3), Fixups, STI);
10306 449 : Value |= (op & UINT64_C(255)) << 56;
10307 449 : break;
10308 : }
10309 5 : case AMDGPU::TBUFFER_LOAD_FORMAT_D16_XYZW_BOTHEN_vi:
10310 : case AMDGPU::TBUFFER_LOAD_FORMAT_D16_XYZW_IDXEN_vi:
10311 : case AMDGPU::TBUFFER_LOAD_FORMAT_D16_XYZW_OFFEN_vi:
10312 : case AMDGPU::TBUFFER_LOAD_FORMAT_D16_XYZW_gfx80_BOTHEN_gfx80:
10313 : case AMDGPU::TBUFFER_LOAD_FORMAT_D16_XYZW_gfx80_IDXEN_gfx80:
10314 : case AMDGPU::TBUFFER_LOAD_FORMAT_D16_XYZW_gfx80_OFFEN_gfx80:
10315 : case AMDGPU::TBUFFER_LOAD_FORMAT_D16_XYZ_BOTHEN_vi:
10316 : case AMDGPU::TBUFFER_LOAD_FORMAT_D16_XYZ_IDXEN_vi:
10317 : case AMDGPU::TBUFFER_LOAD_FORMAT_D16_XYZ_OFFEN_vi:
10318 : case AMDGPU::TBUFFER_LOAD_FORMAT_D16_XYZ_gfx80_BOTHEN_gfx80:
10319 : case AMDGPU::TBUFFER_LOAD_FORMAT_D16_XYZ_gfx80_IDXEN_gfx80:
10320 : case AMDGPU::TBUFFER_LOAD_FORMAT_D16_XYZ_gfx80_OFFEN_gfx80:
10321 : case AMDGPU::TBUFFER_LOAD_FORMAT_D16_XY_BOTHEN_vi:
10322 : case AMDGPU::TBUFFER_LOAD_FORMAT_D16_XY_IDXEN_vi:
10323 : case AMDGPU::TBUFFER_LOAD_FORMAT_D16_XY_OFFEN_vi:
10324 : case AMDGPU::TBUFFER_LOAD_FORMAT_D16_XY_gfx80_BOTHEN_gfx80:
10325 : case AMDGPU::TBUFFER_LOAD_FORMAT_D16_XY_gfx80_IDXEN_gfx80:
10326 : case AMDGPU::TBUFFER_LOAD_FORMAT_D16_XY_gfx80_OFFEN_gfx80:
10327 : case AMDGPU::TBUFFER_LOAD_FORMAT_D16_X_BOTHEN_vi:
10328 : case AMDGPU::TBUFFER_LOAD_FORMAT_D16_X_IDXEN_vi:
10329 : case AMDGPU::TBUFFER_LOAD_FORMAT_D16_X_OFFEN_vi:
10330 : case AMDGPU::TBUFFER_LOAD_FORMAT_D16_X_gfx80_BOTHEN_gfx80:
10331 : case AMDGPU::TBUFFER_LOAD_FORMAT_D16_X_gfx80_IDXEN_gfx80:
10332 : case AMDGPU::TBUFFER_LOAD_FORMAT_D16_X_gfx80_OFFEN_gfx80:
10333 : case AMDGPU::TBUFFER_LOAD_FORMAT_XYZW_ADDR64_si:
10334 : case AMDGPU::TBUFFER_LOAD_FORMAT_XYZW_BOTHEN_si:
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10345 : case AMDGPU::TBUFFER_LOAD_FORMAT_XYZ_OFFEN_si:
10346 : case AMDGPU::TBUFFER_LOAD_FORMAT_XYZ_OFFEN_vi:
10347 : case AMDGPU::TBUFFER_LOAD_FORMAT_XY_ADDR64_si:
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10350 : case AMDGPU::TBUFFER_LOAD_FORMAT_XY_IDXEN_si:
10351 : case AMDGPU::TBUFFER_LOAD_FORMAT_XY_IDXEN_vi:
10352 : case AMDGPU::TBUFFER_LOAD_FORMAT_XY_OFFEN_si:
10353 : case AMDGPU::TBUFFER_LOAD_FORMAT_XY_OFFEN_vi:
10354 : case AMDGPU::TBUFFER_LOAD_FORMAT_X_ADDR64_si:
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10357 : case AMDGPU::TBUFFER_LOAD_FORMAT_X_IDXEN_si:
10358 : case AMDGPU::TBUFFER_LOAD_FORMAT_X_IDXEN_vi:
10359 : case AMDGPU::TBUFFER_LOAD_FORMAT_X_OFFEN_si:
10360 : case AMDGPU::TBUFFER_LOAD_FORMAT_X_OFFEN_vi:
10361 : case AMDGPU::TBUFFER_STORE_FORMAT_D16_XYZW_BOTHEN_vi:
10362 : case AMDGPU::TBUFFER_STORE_FORMAT_D16_XYZW_IDXEN_vi:
10363 : case AMDGPU::TBUFFER_STORE_FORMAT_D16_XYZW_OFFEN_vi:
10364 : case AMDGPU::TBUFFER_STORE_FORMAT_D16_XYZW_gfx80_BOTHEN_gfx80:
10365 : case AMDGPU::TBUFFER_STORE_FORMAT_D16_XYZW_gfx80_IDXEN_gfx80:
10366 : case AMDGPU::TBUFFER_STORE_FORMAT_D16_XYZW_gfx80_OFFEN_gfx80:
10367 : case AMDGPU::TBUFFER_STORE_FORMAT_D16_XYZ_BOTHEN_vi:
10368 : case AMDGPU::TBUFFER_STORE_FORMAT_D16_XYZ_IDXEN_vi:
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10370 : case AMDGPU::TBUFFER_STORE_FORMAT_D16_XYZ_gfx80_BOTHEN_gfx80:
10371 : case AMDGPU::TBUFFER_STORE_FORMAT_D16_XYZ_gfx80_IDXEN_gfx80:
10372 : case AMDGPU::TBUFFER_STORE_FORMAT_D16_XYZ_gfx80_OFFEN_gfx80:
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10387 : case AMDGPU::TBUFFER_STORE_FORMAT_XYZW_BOTHEN_vi:
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10390 : case AMDGPU::TBUFFER_STORE_FORMAT_XYZW_OFFEN_si:
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10396 : case AMDGPU::TBUFFER_STORE_FORMAT_XYZ_IDXEN_vi:
10397 : case AMDGPU::TBUFFER_STORE_FORMAT_XYZ_OFFEN_si:
10398 : case AMDGPU::TBUFFER_STORE_FORMAT_XYZ_OFFEN_vi:
10399 : case AMDGPU::TBUFFER_STORE_FORMAT_XY_ADDR64_si:
10400 : case AMDGPU::TBUFFER_STORE_FORMAT_XY_BOTHEN_si:
10401 : case AMDGPU::TBUFFER_STORE_FORMAT_XY_BOTHEN_vi:
10402 : case AMDGPU::TBUFFER_STORE_FORMAT_XY_IDXEN_si:
10403 : case AMDGPU::TBUFFER_STORE_FORMAT_XY_IDXEN_vi:
10404 : case AMDGPU::TBUFFER_STORE_FORMAT_XY_OFFEN_si:
10405 : case AMDGPU::TBUFFER_STORE_FORMAT_XY_OFFEN_vi:
10406 : case AMDGPU::TBUFFER_STORE_FORMAT_X_ADDR64_si:
10407 : case AMDGPU::TBUFFER_STORE_FORMAT_X_BOTHEN_si:
10408 : case AMDGPU::TBUFFER_STORE_FORMAT_X_BOTHEN_vi:
10409 : case AMDGPU::TBUFFER_STORE_FORMAT_X_IDXEN_si:
10410 : case AMDGPU::TBUFFER_STORE_FORMAT_X_IDXEN_vi:
10411 : case AMDGPU::TBUFFER_STORE_FORMAT_X_OFFEN_si:
10412 : case AMDGPU::TBUFFER_STORE_FORMAT_X_OFFEN_vi: {
10413 : // op: offset
10414 10 : op = getMachineOpValue(MI, MI.getOperand(4), Fixups, STI);
10415 5 : Value |= op & UINT64_C(4095);
10416 : // op: glc
10417 10 : op = getMachineOpValue(MI, MI.getOperand(6), Fixups, STI);
10418 5 : Value |= (op & UINT64_C(1)) << 14;
10419 : // op: format
10420 10 : op = getMachineOpValue(MI, MI.getOperand(5), Fixups, STI);
10421 5 : Value |= (op & UINT64_C(127)) << 19;
10422 : // op: vaddr
10423 10 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
10424 5 : Value |= (op & UINT64_C(255)) << 32;
10425 : // op: vdata
10426 10 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
10427 5 : Value |= (op & UINT64_C(255)) << 40;
10428 : // op: srsrc
10429 10 : op = getMachineOpValue(MI, MI.getOperand(2), Fixups, STI);
10430 5 : Value |= (op & UINT64_C(124)) << 46;
10431 : // op: slc
10432 10 : op = getMachineOpValue(MI, MI.getOperand(7), Fixups, STI);
10433 5 : Value |= (op & UINT64_C(1)) << 54;
10434 : // op: tfe
10435 10 : op = getMachineOpValue(MI, MI.getOperand(8), Fixups, STI);
10436 5 : Value |= (op & UINT64_C(1)) << 55;
10437 : // op: soffset
10438 10 : op = getMachineOpValue(MI, MI.getOperand(3), Fixups, STI);
10439 5 : Value |= (op & UINT64_C(255)) << 56;
10440 5 : break;
10441 : }
10442 290 : case AMDGPU::BUFFER_ATOMIC_ADD_BOTHEN_vi:
10443 : case AMDGPU::BUFFER_ATOMIC_ADD_IDXEN_vi:
10444 : case AMDGPU::BUFFER_ATOMIC_ADD_OFFEN_vi:
10445 : case AMDGPU::BUFFER_ATOMIC_ADD_X2_BOTHEN_vi:
10446 : case AMDGPU::BUFFER_ATOMIC_ADD_X2_IDXEN_vi:
10447 : case AMDGPU::BUFFER_ATOMIC_ADD_X2_OFFEN_vi:
10448 : case AMDGPU::BUFFER_ATOMIC_AND_BOTHEN_vi:
10449 : case AMDGPU::BUFFER_ATOMIC_AND_IDXEN_vi:
10450 : case AMDGPU::BUFFER_ATOMIC_AND_OFFEN_vi:
10451 : case AMDGPU::BUFFER_ATOMIC_AND_X2_BOTHEN_vi:
10452 : case AMDGPU::BUFFER_ATOMIC_AND_X2_IDXEN_vi:
10453 : case AMDGPU::BUFFER_ATOMIC_AND_X2_OFFEN_vi:
10454 : case AMDGPU::BUFFER_ATOMIC_CMPSWAP_BOTHEN_vi:
10455 : case AMDGPU::BUFFER_ATOMIC_CMPSWAP_IDXEN_vi:
10456 : case AMDGPU::BUFFER_ATOMIC_CMPSWAP_OFFEN_vi:
10457 : case AMDGPU::BUFFER_ATOMIC_CMPSWAP_X2_BOTHEN_vi:
10458 : case AMDGPU::BUFFER_ATOMIC_CMPSWAP_X2_IDXEN_vi:
10459 : case AMDGPU::BUFFER_ATOMIC_CMPSWAP_X2_OFFEN_vi:
10460 : case AMDGPU::BUFFER_ATOMIC_DEC_BOTHEN_vi:
10461 : case AMDGPU::BUFFER_ATOMIC_DEC_IDXEN_vi:
10462 : case AMDGPU::BUFFER_ATOMIC_DEC_OFFEN_vi:
10463 : case AMDGPU::BUFFER_ATOMIC_DEC_X2_BOTHEN_vi:
10464 : case AMDGPU::BUFFER_ATOMIC_DEC_X2_IDXEN_vi:
10465 : case AMDGPU::BUFFER_ATOMIC_DEC_X2_OFFEN_vi:
10466 : case AMDGPU::BUFFER_ATOMIC_INC_BOTHEN_vi:
10467 : case AMDGPU::BUFFER_ATOMIC_INC_IDXEN_vi:
10468 : case AMDGPU::BUFFER_ATOMIC_INC_OFFEN_vi:
10469 : case AMDGPU::BUFFER_ATOMIC_INC_X2_BOTHEN_vi:
10470 : case AMDGPU::BUFFER_ATOMIC_INC_X2_IDXEN_vi:
10471 : case AMDGPU::BUFFER_ATOMIC_INC_X2_OFFEN_vi:
10472 : case AMDGPU::BUFFER_ATOMIC_OR_BOTHEN_vi:
10473 : case AMDGPU::BUFFER_ATOMIC_OR_IDXEN_vi:
10474 : case AMDGPU::BUFFER_ATOMIC_OR_OFFEN_vi:
10475 : case AMDGPU::BUFFER_ATOMIC_OR_X2_BOTHEN_vi:
10476 : case AMDGPU::BUFFER_ATOMIC_OR_X2_IDXEN_vi:
10477 : case AMDGPU::BUFFER_ATOMIC_OR_X2_OFFEN_vi:
10478 : case AMDGPU::BUFFER_ATOMIC_SMAX_BOTHEN_vi:
10479 : case AMDGPU::BUFFER_ATOMIC_SMAX_IDXEN_vi:
10480 : case AMDGPU::BUFFER_ATOMIC_SMAX_OFFEN_vi:
10481 : case AMDGPU::BUFFER_ATOMIC_SMAX_X2_BOTHEN_vi:
10482 : case AMDGPU::BUFFER_ATOMIC_SMAX_X2_IDXEN_vi:
10483 : case AMDGPU::BUFFER_ATOMIC_SMAX_X2_OFFEN_vi:
10484 : case AMDGPU::BUFFER_ATOMIC_SMIN_BOTHEN_vi:
10485 : case AMDGPU::BUFFER_ATOMIC_SMIN_IDXEN_vi:
10486 : case AMDGPU::BUFFER_ATOMIC_SMIN_OFFEN_vi:
10487 : case AMDGPU::BUFFER_ATOMIC_SMIN_X2_BOTHEN_vi:
10488 : case AMDGPU::BUFFER_ATOMIC_SMIN_X2_IDXEN_vi:
10489 : case AMDGPU::BUFFER_ATOMIC_SMIN_X2_OFFEN_vi:
10490 : case AMDGPU::BUFFER_ATOMIC_SUB_BOTHEN_vi:
10491 : case AMDGPU::BUFFER_ATOMIC_SUB_IDXEN_vi:
10492 : case AMDGPU::BUFFER_ATOMIC_SUB_OFFEN_vi:
10493 : case AMDGPU::BUFFER_ATOMIC_SUB_X2_BOTHEN_vi:
10494 : case AMDGPU::BUFFER_ATOMIC_SUB_X2_IDXEN_vi:
10495 : case AMDGPU::BUFFER_ATOMIC_SUB_X2_OFFEN_vi:
10496 : case AMDGPU::BUFFER_ATOMIC_SWAP_BOTHEN_vi:
10497 : case AMDGPU::BUFFER_ATOMIC_SWAP_IDXEN_vi:
10498 : case AMDGPU::BUFFER_ATOMIC_SWAP_OFFEN_vi:
10499 : case AMDGPU::BUFFER_ATOMIC_SWAP_X2_BOTHEN_vi:
10500 : case AMDGPU::BUFFER_ATOMIC_SWAP_X2_IDXEN_vi:
10501 : case AMDGPU::BUFFER_ATOMIC_SWAP_X2_OFFEN_vi:
10502 : case AMDGPU::BUFFER_ATOMIC_UMAX_BOTHEN_vi:
10503 : case AMDGPU::BUFFER_ATOMIC_UMAX_IDXEN_vi:
10504 : case AMDGPU::BUFFER_ATOMIC_UMAX_OFFEN_vi:
10505 : case AMDGPU::BUFFER_ATOMIC_UMAX_X2_BOTHEN_vi:
10506 : case AMDGPU::BUFFER_ATOMIC_UMAX_X2_IDXEN_vi:
10507 : case AMDGPU::BUFFER_ATOMIC_UMAX_X2_OFFEN_vi:
10508 : case AMDGPU::BUFFER_ATOMIC_UMIN_BOTHEN_vi:
10509 : case AMDGPU::BUFFER_ATOMIC_UMIN_IDXEN_vi:
10510 : case AMDGPU::BUFFER_ATOMIC_UMIN_OFFEN_vi:
10511 : case AMDGPU::BUFFER_ATOMIC_UMIN_X2_BOTHEN_vi:
10512 : case AMDGPU::BUFFER_ATOMIC_UMIN_X2_IDXEN_vi:
10513 : case AMDGPU::BUFFER_ATOMIC_UMIN_X2_OFFEN_vi:
10514 : case AMDGPU::BUFFER_ATOMIC_XOR_BOTHEN_vi:
10515 : case AMDGPU::BUFFER_ATOMIC_XOR_IDXEN_vi:
10516 : case AMDGPU::BUFFER_ATOMIC_XOR_OFFEN_vi:
10517 : case AMDGPU::BUFFER_ATOMIC_XOR_X2_BOTHEN_vi:
10518 : case AMDGPU::BUFFER_ATOMIC_XOR_X2_IDXEN_vi:
10519 : case AMDGPU::BUFFER_ATOMIC_XOR_X2_OFFEN_vi: {
10520 : // op: offset
10521 580 : op = getMachineOpValue(MI, MI.getOperand(4), Fixups, STI);
10522 290 : Value |= op & UINT64_C(4095);
10523 : // op: vaddr
10524 580 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
10525 290 : Value |= (op & UINT64_C(255)) << 32;
10526 : // op: vdata
10527 580 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
10528 290 : Value |= (op & UINT64_C(255)) << 40;
10529 : // op: srsrc
10530 580 : op = getMachineOpValue(MI, MI.getOperand(2), Fixups, STI);
10531 290 : Value |= (op & UINT64_C(124)) << 46;
10532 : // op: slc
10533 580 : op = getMachineOpValue(MI, MI.getOperand(5), Fixups, STI);
10534 290 : Value |= (op & UINT64_C(1)) << 17;
10535 : // op: soffset
10536 580 : op = getMachineOpValue(MI, MI.getOperand(3), Fixups, STI);
10537 290 : Value |= (op & UINT64_C(255)) << 56;
10538 290 : break;
10539 : }
10540 118 : case AMDGPU::BUFFER_ATOMIC_ADD_ADDR64_si:
10541 : case AMDGPU::BUFFER_ATOMIC_ADD_BOTHEN_si:
10542 : case AMDGPU::BUFFER_ATOMIC_ADD_IDXEN_si:
10543 : case AMDGPU::BUFFER_ATOMIC_ADD_OFFEN_si:
10544 : case AMDGPU::BUFFER_ATOMIC_ADD_X2_ADDR64_si:
10545 : case AMDGPU::BUFFER_ATOMIC_ADD_X2_BOTHEN_si:
10546 : case AMDGPU::BUFFER_ATOMIC_ADD_X2_IDXEN_si:
10547 : case AMDGPU::BUFFER_ATOMIC_ADD_X2_OFFEN_si:
10548 : case AMDGPU::BUFFER_ATOMIC_AND_ADDR64_si:
10549 : case AMDGPU::BUFFER_ATOMIC_AND_BOTHEN_si:
10550 : case AMDGPU::BUFFER_ATOMIC_AND_IDXEN_si:
10551 : case AMDGPU::BUFFER_ATOMIC_AND_OFFEN_si:
10552 : case AMDGPU::BUFFER_ATOMIC_AND_X2_ADDR64_si:
10553 : case AMDGPU::BUFFER_ATOMIC_AND_X2_BOTHEN_si:
10554 : case AMDGPU::BUFFER_ATOMIC_AND_X2_IDXEN_si:
10555 : case AMDGPU::BUFFER_ATOMIC_AND_X2_OFFEN_si:
10556 : case AMDGPU::BUFFER_ATOMIC_CMPSWAP_ADDR64_si:
10557 : case AMDGPU::BUFFER_ATOMIC_CMPSWAP_BOTHEN_si:
10558 : case AMDGPU::BUFFER_ATOMIC_CMPSWAP_IDXEN_si:
10559 : case AMDGPU::BUFFER_ATOMIC_CMPSWAP_OFFEN_si:
10560 : case AMDGPU::BUFFER_ATOMIC_CMPSWAP_X2_ADDR64_si:
10561 : case AMDGPU::BUFFER_ATOMIC_CMPSWAP_X2_BOTHEN_si:
10562 : case AMDGPU::BUFFER_ATOMIC_CMPSWAP_X2_IDXEN_si:
10563 : case AMDGPU::BUFFER_ATOMIC_CMPSWAP_X2_OFFEN_si:
10564 : case AMDGPU::BUFFER_ATOMIC_DEC_ADDR64_si:
10565 : case AMDGPU::BUFFER_ATOMIC_DEC_BOTHEN_si:
10566 : case AMDGPU::BUFFER_ATOMIC_DEC_IDXEN_si:
10567 : case AMDGPU::BUFFER_ATOMIC_DEC_OFFEN_si:
10568 : case AMDGPU::BUFFER_ATOMIC_DEC_X2_ADDR64_si:
10569 : case AMDGPU::BUFFER_ATOMIC_DEC_X2_BOTHEN_si:
10570 : case AMDGPU::BUFFER_ATOMIC_DEC_X2_IDXEN_si:
10571 : case AMDGPU::BUFFER_ATOMIC_DEC_X2_OFFEN_si:
10572 : case AMDGPU::BUFFER_ATOMIC_INC_ADDR64_si:
10573 : case AMDGPU::BUFFER_ATOMIC_INC_BOTHEN_si:
10574 : case AMDGPU::BUFFER_ATOMIC_INC_IDXEN_si:
10575 : case AMDGPU::BUFFER_ATOMIC_INC_OFFEN_si:
10576 : case AMDGPU::BUFFER_ATOMIC_INC_X2_ADDR64_si:
10577 : case AMDGPU::BUFFER_ATOMIC_INC_X2_BOTHEN_si:
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10580 : case AMDGPU::BUFFER_ATOMIC_OR_ADDR64_si:
10581 : case AMDGPU::BUFFER_ATOMIC_OR_BOTHEN_si:
10582 : case AMDGPU::BUFFER_ATOMIC_OR_IDXEN_si:
10583 : case AMDGPU::BUFFER_ATOMIC_OR_OFFEN_si:
10584 : case AMDGPU::BUFFER_ATOMIC_OR_X2_ADDR64_si:
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10586 : case AMDGPU::BUFFER_ATOMIC_OR_X2_IDXEN_si:
10587 : case AMDGPU::BUFFER_ATOMIC_OR_X2_OFFEN_si:
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10590 : case AMDGPU::BUFFER_ATOMIC_SMAX_IDXEN_si:
10591 : case AMDGPU::BUFFER_ATOMIC_SMAX_OFFEN_si:
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10595 : case AMDGPU::BUFFER_ATOMIC_SMAX_X2_OFFEN_si:
10596 : case AMDGPU::BUFFER_ATOMIC_SMIN_ADDR64_si:
10597 : case AMDGPU::BUFFER_ATOMIC_SMIN_BOTHEN_si:
10598 : case AMDGPU::BUFFER_ATOMIC_SMIN_IDXEN_si:
10599 : case AMDGPU::BUFFER_ATOMIC_SMIN_OFFEN_si:
10600 : case AMDGPU::BUFFER_ATOMIC_SMIN_X2_ADDR64_si:
10601 : case AMDGPU::BUFFER_ATOMIC_SMIN_X2_BOTHEN_si:
10602 : case AMDGPU::BUFFER_ATOMIC_SMIN_X2_IDXEN_si:
10603 : case AMDGPU::BUFFER_ATOMIC_SMIN_X2_OFFEN_si:
10604 : case AMDGPU::BUFFER_ATOMIC_SUB_ADDR64_si:
10605 : case AMDGPU::BUFFER_ATOMIC_SUB_BOTHEN_si:
10606 : case AMDGPU::BUFFER_ATOMIC_SUB_IDXEN_si:
10607 : case AMDGPU::BUFFER_ATOMIC_SUB_OFFEN_si:
10608 : case AMDGPU::BUFFER_ATOMIC_SUB_X2_ADDR64_si:
10609 : case AMDGPU::BUFFER_ATOMIC_SUB_X2_BOTHEN_si:
10610 : case AMDGPU::BUFFER_ATOMIC_SUB_X2_IDXEN_si:
10611 : case AMDGPU::BUFFER_ATOMIC_SUB_X2_OFFEN_si:
10612 : case AMDGPU::BUFFER_ATOMIC_SWAP_ADDR64_si:
10613 : case AMDGPU::BUFFER_ATOMIC_SWAP_BOTHEN_si:
10614 : case AMDGPU::BUFFER_ATOMIC_SWAP_IDXEN_si:
10615 : case AMDGPU::BUFFER_ATOMIC_SWAP_OFFEN_si:
10616 : case AMDGPU::BUFFER_ATOMIC_SWAP_X2_ADDR64_si:
10617 : case AMDGPU::BUFFER_ATOMIC_SWAP_X2_BOTHEN_si:
10618 : case AMDGPU::BUFFER_ATOMIC_SWAP_X2_IDXEN_si:
10619 : case AMDGPU::BUFFER_ATOMIC_SWAP_X2_OFFEN_si:
10620 : case AMDGPU::BUFFER_ATOMIC_UMAX_ADDR64_si:
10621 : case AMDGPU::BUFFER_ATOMIC_UMAX_BOTHEN_si:
10622 : case AMDGPU::BUFFER_ATOMIC_UMAX_IDXEN_si:
10623 : case AMDGPU::BUFFER_ATOMIC_UMAX_OFFEN_si:
10624 : case AMDGPU::BUFFER_ATOMIC_UMAX_X2_ADDR64_si:
10625 : case AMDGPU::BUFFER_ATOMIC_UMAX_X2_BOTHEN_si:
10626 : case AMDGPU::BUFFER_ATOMIC_UMAX_X2_IDXEN_si:
10627 : case AMDGPU::BUFFER_ATOMIC_UMAX_X2_OFFEN_si:
10628 : case AMDGPU::BUFFER_ATOMIC_UMIN_ADDR64_si:
10629 : case AMDGPU::BUFFER_ATOMIC_UMIN_BOTHEN_si:
10630 : case AMDGPU::BUFFER_ATOMIC_UMIN_IDXEN_si:
10631 : case AMDGPU::BUFFER_ATOMIC_UMIN_OFFEN_si:
10632 : case AMDGPU::BUFFER_ATOMIC_UMIN_X2_ADDR64_si:
10633 : case AMDGPU::BUFFER_ATOMIC_UMIN_X2_BOTHEN_si:
10634 : case AMDGPU::BUFFER_ATOMIC_UMIN_X2_IDXEN_si:
10635 : case AMDGPU::BUFFER_ATOMIC_UMIN_X2_OFFEN_si:
10636 : case AMDGPU::BUFFER_ATOMIC_XOR_ADDR64_si:
10637 : case AMDGPU::BUFFER_ATOMIC_XOR_BOTHEN_si:
10638 : case AMDGPU::BUFFER_ATOMIC_XOR_IDXEN_si:
10639 : case AMDGPU::BUFFER_ATOMIC_XOR_OFFEN_si:
10640 : case AMDGPU::BUFFER_ATOMIC_XOR_X2_ADDR64_si:
10641 : case AMDGPU::BUFFER_ATOMIC_XOR_X2_BOTHEN_si:
10642 : case AMDGPU::BUFFER_ATOMIC_XOR_X2_IDXEN_si:
10643 : case AMDGPU::BUFFER_ATOMIC_XOR_X2_OFFEN_si: {
10644 : // op: offset
10645 236 : op = getMachineOpValue(MI, MI.getOperand(4), Fixups, STI);
10646 118 : Value |= op & UINT64_C(4095);
10647 : // op: vaddr
10648 236 : op = getMachineOpValue(MI, MI.getOperand(1), Fixups, STI);
10649 118 : Value |= (op & UINT64_C(255)) << 32;
10650 : // op: vdata
10651 236 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
10652 118 : Value |= (op & UINT64_C(255)) << 40;
10653 : // op: srsrc
10654 236 : op = getMachineOpValue(MI, MI.getOperand(2), Fixups, STI);
10655 118 : Value |= (op & UINT64_C(124)) << 46;
10656 : // op: slc
10657 236 : op = getMachineOpValue(MI, MI.getOperand(5), Fixups, STI);
10658 118 : Value |= (op & UINT64_C(1)) << 54;
10659 : // op: soffset
10660 236 : op = getMachineOpValue(MI, MI.getOperand(3), Fixups, STI);
10661 118 : Value |= (op & UINT64_C(255)) << 56;
10662 118 : break;
10663 : }
10664 149 : case AMDGPU::BUFFER_ATOMIC_ADD_OFFSET_RTN_vi:
10665 : case AMDGPU::BUFFER_ATOMIC_ADD_X2_OFFSET_RTN_vi:
10666 : case AMDGPU::BUFFER_ATOMIC_AND_OFFSET_RTN_vi:
10667 : case AMDGPU::BUFFER_ATOMIC_AND_X2_OFFSET_RTN_vi:
10668 : case AMDGPU::BUFFER_ATOMIC_CMPSWAP_OFFSET_RTN_vi:
10669 : case AMDGPU::BUFFER_ATOMIC_CMPSWAP_X2_OFFSET_RTN_vi:
10670 : case AMDGPU::BUFFER_ATOMIC_DEC_OFFSET_RTN_vi:
10671 : case AMDGPU::BUFFER_ATOMIC_DEC_X2_OFFSET_RTN_vi:
10672 : case AMDGPU::BUFFER_ATOMIC_INC_OFFSET_RTN_vi:
10673 : case AMDGPU::BUFFER_ATOMIC_INC_X2_OFFSET_RTN_vi:
10674 : case AMDGPU::BUFFER_ATOMIC_OR_OFFSET_RTN_vi:
10675 : case AMDGPU::BUFFER_ATOMIC_OR_X2_OFFSET_RTN_vi:
10676 : case AMDGPU::BUFFER_ATOMIC_SMAX_OFFSET_RTN_vi:
10677 : case AMDGPU::BUFFER_ATOMIC_SMAX_X2_OFFSET_RTN_vi:
10678 : case AMDGPU::BUFFER_ATOMIC_SMIN_OFFSET_RTN_vi:
10679 : case AMDGPU::BUFFER_ATOMIC_SMIN_X2_OFFSET_RTN_vi:
10680 : case AMDGPU::BUFFER_ATOMIC_SUB_OFFSET_RTN_vi:
10681 : case AMDGPU::BUFFER_ATOMIC_SUB_X2_OFFSET_RTN_vi:
10682 : case AMDGPU::BUFFER_ATOMIC_SWAP_OFFSET_RTN_vi:
10683 : case AMDGPU::BUFFER_ATOMIC_SWAP_X2_OFFSET_RTN_vi:
10684 : case AMDGPU::BUFFER_ATOMIC_UMAX_OFFSET_RTN_vi:
10685 : case AMDGPU::BUFFER_ATOMIC_UMAX_X2_OFFSET_RTN_vi:
10686 : case AMDGPU::BUFFER_ATOMIC_UMIN_OFFSET_RTN_vi:
10687 : case AMDGPU::BUFFER_ATOMIC_UMIN_X2_OFFSET_RTN_vi:
10688 : case AMDGPU::BUFFER_ATOMIC_XOR_OFFSET_RTN_vi:
10689 : case AMDGPU::BUFFER_ATOMIC_XOR_X2_OFFSET_RTN_vi: {
10690 : // op: offset
10691 298 : op = getMachineOpValue(MI, MI.getOperand(4), Fixups, STI);
10692 149 : Value |= op & UINT64_C(4095);
10693 : // op: vdata
10694 298 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
10695 149 : Value |= (op & UINT64_C(255)) << 40;
10696 : // op: srsrc
10697 298 : op = getMachineOpValue(MI, MI.getOperand(2), Fixups, STI);
10698 149 : Value |= (op & UINT64_C(124)) << 46;
10699 : // op: slc
10700 298 : op = getMachineOpValue(MI, MI.getOperand(5), Fixups, STI);
10701 149 : Value |= (op & UINT64_C(1)) << 17;
10702 : // op: soffset
10703 298 : op = getMachineOpValue(MI, MI.getOperand(3), Fixups, STI);
10704 149 : Value |= (op & UINT64_C(255)) << 56;
10705 149 : break;
10706 : }
10707 40 : case AMDGPU::BUFFER_ATOMIC_ADD_OFFSET_RTN_si:
10708 : case AMDGPU::BUFFER_ATOMIC_ADD_X2_OFFSET_RTN_si:
10709 : case AMDGPU::BUFFER_ATOMIC_AND_OFFSET_RTN_si:
10710 : case AMDGPU::BUFFER_ATOMIC_AND_X2_OFFSET_RTN_si:
10711 : case AMDGPU::BUFFER_ATOMIC_CMPSWAP_OFFSET_RTN_si:
10712 : case AMDGPU::BUFFER_ATOMIC_CMPSWAP_X2_OFFSET_RTN_si:
10713 : case AMDGPU::BUFFER_ATOMIC_DEC_OFFSET_RTN_si:
10714 : case AMDGPU::BUFFER_ATOMIC_DEC_X2_OFFSET_RTN_si:
10715 : case AMDGPU::BUFFER_ATOMIC_INC_OFFSET_RTN_si:
10716 : case AMDGPU::BUFFER_ATOMIC_INC_X2_OFFSET_RTN_si:
10717 : case AMDGPU::BUFFER_ATOMIC_OR_OFFSET_RTN_si:
10718 : case AMDGPU::BUFFER_ATOMIC_OR_X2_OFFSET_RTN_si:
10719 : case AMDGPU::BUFFER_ATOMIC_SMAX_OFFSET_RTN_si:
10720 : case AMDGPU::BUFFER_ATOMIC_SMAX_X2_OFFSET_RTN_si:
10721 : case AMDGPU::BUFFER_ATOMIC_SMIN_OFFSET_RTN_si:
10722 : case AMDGPU::BUFFER_ATOMIC_SMIN_X2_OFFSET_RTN_si:
10723 : case AMDGPU::BUFFER_ATOMIC_SUB_OFFSET_RTN_si:
10724 : case AMDGPU::BUFFER_ATOMIC_SUB_X2_OFFSET_RTN_si:
10725 : case AMDGPU::BUFFER_ATOMIC_SWAP_OFFSET_RTN_si:
10726 : case AMDGPU::BUFFER_ATOMIC_SWAP_X2_OFFSET_RTN_si:
10727 : case AMDGPU::BUFFER_ATOMIC_UMAX_OFFSET_RTN_si:
10728 : case AMDGPU::BUFFER_ATOMIC_UMAX_X2_OFFSET_RTN_si:
10729 : case AMDGPU::BUFFER_ATOMIC_UMIN_OFFSET_RTN_si:
10730 : case AMDGPU::BUFFER_ATOMIC_UMIN_X2_OFFSET_RTN_si:
10731 : case AMDGPU::BUFFER_ATOMIC_XOR_OFFSET_RTN_si:
10732 : case AMDGPU::BUFFER_ATOMIC_XOR_X2_OFFSET_RTN_si: {
10733 : // op: offset
10734 80 : op = getMachineOpValue(MI, MI.getOperand(4), Fixups, STI);
10735 40 : Value |= op & UINT64_C(4095);
10736 : // op: vdata
10737 80 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
10738 40 : Value |= (op & UINT64_C(255)) << 40;
10739 : // op: srsrc
10740 80 : op = getMachineOpValue(MI, MI.getOperand(2), Fixups, STI);
10741 40 : Value |= (op & UINT64_C(124)) << 46;
10742 : // op: slc
10743 80 : op = getMachineOpValue(MI, MI.getOperand(5), Fixups, STI);
10744 40 : Value |= (op & UINT64_C(1)) << 54;
10745 : // op: soffset
10746 80 : op = getMachineOpValue(MI, MI.getOperand(3), Fixups, STI);
10747 40 : Value |= (op & UINT64_C(255)) << 56;
10748 40 : break;
10749 : }
10750 30 : case AMDGPU::BUFFER_ATOMIC_ADD_BOTHEN_RTN_vi:
10751 : case AMDGPU::BUFFER_ATOMIC_ADD_IDXEN_RTN_vi:
10752 : case AMDGPU::BUFFER_ATOMIC_ADD_OFFEN_RTN_vi:
10753 : case AMDGPU::BUFFER_ATOMIC_ADD_X2_BOTHEN_RTN_vi:
10754 : case AMDGPU::BUFFER_ATOMIC_ADD_X2_IDXEN_RTN_vi:
10755 : case AMDGPU::BUFFER_ATOMIC_ADD_X2_OFFEN_RTN_vi:
10756 : case AMDGPU::BUFFER_ATOMIC_AND_BOTHEN_RTN_vi:
10757 : case AMDGPU::BUFFER_ATOMIC_AND_IDXEN_RTN_vi:
10758 : case AMDGPU::BUFFER_ATOMIC_AND_OFFEN_RTN_vi:
10759 : case AMDGPU::BUFFER_ATOMIC_AND_X2_BOTHEN_RTN_vi:
10760 : case AMDGPU::BUFFER_ATOMIC_AND_X2_IDXEN_RTN_vi:
10761 : case AMDGPU::BUFFER_ATOMIC_AND_X2_OFFEN_RTN_vi:
10762 : case AMDGPU::BUFFER_ATOMIC_CMPSWAP_BOTHEN_RTN_vi:
10763 : case AMDGPU::BUFFER_ATOMIC_CMPSWAP_IDXEN_RTN_vi:
10764 : case AMDGPU::BUFFER_ATOMIC_CMPSWAP_OFFEN_RTN_vi:
10765 : case AMDGPU::BUFFER_ATOMIC_CMPSWAP_X2_BOTHEN_RTN_vi:
10766 : case AMDGPU::BUFFER_ATOMIC_CMPSWAP_X2_IDXEN_RTN_vi:
10767 : case AMDGPU::BUFFER_ATOMIC_CMPSWAP_X2_OFFEN_RTN_vi:
10768 : case AMDGPU::BUFFER_ATOMIC_DEC_BOTHEN_RTN_vi:
10769 : case AMDGPU::BUFFER_ATOMIC_DEC_IDXEN_RTN_vi:
10770 : case AMDGPU::BUFFER_ATOMIC_DEC_OFFEN_RTN_vi:
10771 : case AMDGPU::BUFFER_ATOMIC_DEC_X2_BOTHEN_RTN_vi:
10772 : case AMDGPU::BUFFER_ATOMIC_DEC_X2_IDXEN_RTN_vi:
10773 : case AMDGPU::BUFFER_ATOMIC_DEC_X2_OFFEN_RTN_vi:
10774 : case AMDGPU::BUFFER_ATOMIC_INC_BOTHEN_RTN_vi:
10775 : case AMDGPU::BUFFER_ATOMIC_INC_IDXEN_RTN_vi:
10776 : case AMDGPU::BUFFER_ATOMIC_INC_OFFEN_RTN_vi:
10777 : case AMDGPU::BUFFER_ATOMIC_INC_X2_BOTHEN_RTN_vi:
10778 : case AMDGPU::BUFFER_ATOMIC_INC_X2_IDXEN_RTN_vi:
10779 : case AMDGPU::BUFFER_ATOMIC_INC_X2_OFFEN_RTN_vi:
10780 : case AMDGPU::BUFFER_ATOMIC_OR_BOTHEN_RTN_vi:
10781 : case AMDGPU::BUFFER_ATOMIC_OR_IDXEN_RTN_vi:
10782 : case AMDGPU::BUFFER_ATOMIC_OR_OFFEN_RTN_vi:
10783 : case AMDGPU::BUFFER_ATOMIC_OR_X2_BOTHEN_RTN_vi:
10784 : case AMDGPU::BUFFER_ATOMIC_OR_X2_IDXEN_RTN_vi:
10785 : case AMDGPU::BUFFER_ATOMIC_OR_X2_OFFEN_RTN_vi:
10786 : case AMDGPU::BUFFER_ATOMIC_SMAX_BOTHEN_RTN_vi:
10787 : case AMDGPU::BUFFER_ATOMIC_SMAX_IDXEN_RTN_vi:
10788 : case AMDGPU::BUFFER_ATOMIC_SMAX_OFFEN_RTN_vi:
10789 : case AMDGPU::BUFFER_ATOMIC_SMAX_X2_BOTHEN_RTN_vi:
10790 : case AMDGPU::BUFFER_ATOMIC_SMAX_X2_IDXEN_RTN_vi:
10791 : case AMDGPU::BUFFER_ATOMIC_SMAX_X2_OFFEN_RTN_vi:
10792 : case AMDGPU::BUFFER_ATOMIC_SMIN_BOTHEN_RTN_vi:
10793 : case AMDGPU::BUFFER_ATOMIC_SMIN_IDXEN_RTN_vi:
10794 : case AMDGPU::BUFFER_ATOMIC_SMIN_OFFEN_RTN_vi:
10795 : case AMDGPU::BUFFER_ATOMIC_SMIN_X2_BOTHEN_RTN_vi:
10796 : case AMDGPU::BUFFER_ATOMIC_SMIN_X2_IDXEN_RTN_vi:
10797 : case AMDGPU::BUFFER_ATOMIC_SMIN_X2_OFFEN_RTN_vi:
10798 : case AMDGPU::BUFFER_ATOMIC_SUB_BOTHEN_RTN_vi:
10799 : case AMDGPU::BUFFER_ATOMIC_SUB_IDXEN_RTN_vi:
10800 : case AMDGPU::BUFFER_ATOMIC_SUB_OFFEN_RTN_vi:
10801 : case AMDGPU::BUFFER_ATOMIC_SUB_X2_BOTHEN_RTN_vi:
10802 : case AMDGPU::BUFFER_ATOMIC_SUB_X2_IDXEN_RTN_vi:
10803 : case AMDGPU::BUFFER_ATOMIC_SUB_X2_OFFEN_RTN_vi:
10804 : case AMDGPU::BUFFER_ATOMIC_SWAP_BOTHEN_RTN_vi:
10805 : case AMDGPU::BUFFER_ATOMIC_SWAP_IDXEN_RTN_vi:
10806 : case AMDGPU::BUFFER_ATOMIC_SWAP_OFFEN_RTN_vi:
10807 : case AMDGPU::BUFFER_ATOMIC_SWAP_X2_BOTHEN_RTN_vi:
10808 : case AMDGPU::BUFFER_ATOMIC_SWAP_X2_IDXEN_RTN_vi:
10809 : case AMDGPU::BUFFER_ATOMIC_SWAP_X2_OFFEN_RTN_vi:
10810 : case AMDGPU::BUFFER_ATOMIC_UMAX_BOTHEN_RTN_vi:
10811 : case AMDGPU::BUFFER_ATOMIC_UMAX_IDXEN_RTN_vi:
10812 : case AMDGPU::BUFFER_ATOMIC_UMAX_OFFEN_RTN_vi:
10813 : case AMDGPU::BUFFER_ATOMIC_UMAX_X2_BOTHEN_RTN_vi:
10814 : case AMDGPU::BUFFER_ATOMIC_UMAX_X2_IDXEN_RTN_vi:
10815 : case AMDGPU::BUFFER_ATOMIC_UMAX_X2_OFFEN_RTN_vi:
10816 : case AMDGPU::BUFFER_ATOMIC_UMIN_BOTHEN_RTN_vi:
10817 : case AMDGPU::BUFFER_ATOMIC_UMIN_IDXEN_RTN_vi:
10818 : case AMDGPU::BUFFER_ATOMIC_UMIN_OFFEN_RTN_vi:
10819 : case AMDGPU::BUFFER_ATOMIC_UMIN_X2_BOTHEN_RTN_vi:
10820 : case AMDGPU::BUFFER_ATOMIC_UMIN_X2_IDXEN_RTN_vi:
10821 : case AMDGPU::BUFFER_ATOMIC_UMIN_X2_OFFEN_RTN_vi:
10822 : case AMDGPU::BUFFER_ATOMIC_XOR_BOTHEN_RTN_vi:
10823 : case AMDGPU::BUFFER_ATOMIC_XOR_IDXEN_RTN_vi:
10824 : case AMDGPU::BUFFER_ATOMIC_XOR_OFFEN_RTN_vi:
10825 : case AMDGPU::BUFFER_ATOMIC_XOR_X2_BOTHEN_RTN_vi:
10826 : case AMDGPU::BUFFER_ATOMIC_XOR_X2_IDXEN_RTN_vi:
10827 : case AMDGPU::BUFFER_ATOMIC_XOR_X2_OFFEN_RTN_vi: {
10828 : // op: offset
10829 60 : op = getMachineOpValue(MI, MI.getOperand(5), Fixups, STI);
10830 30 : Value |= op & UINT64_C(4095);
10831 : // op: vaddr
10832 60 : op = getMachineOpValue(MI, MI.getOperand(2), Fixups, STI);
10833 30 : Value |= (op & UINT64_C(255)) << 32;
10834 : // op: vdata
10835 60 : op = getMachineOpValue(MI, MI.getOperand(0), Fixups, STI);
10836 30 : Value |= (op & UINT64_C(255)) << 40;
10837 : // op: srsrc
10838 60 : op = getMachineOpValue(MI, MI.getOperand(3), Fixups, STI);
10839 30 : Value |= (op & UINT64_C(124)) << 46;
10840 : // op: slc
10841 60 : op = getMachineOpValue(MI, MI.getOperand(6), Fixups, STI);
10842 30 : Value |= (op & UINT64_C(1)) << 17;
10843 : // op: soffset
10844 60 : op = getMachineOpValue(MI, MI.getOperand(4), Fixups, STI);
10845 30 : Value |= (op & UINT64_C(255)) << 56;
10846 30 : break;
10847 : }
10848 40 : case AMDGPU::BUFFER_ATOMIC_ADD_ADDR64_RTN_si:
10849 : case AMDGPU::BUFFER_ATOMIC_ADD_BOTHEN_RTN_si:
10850 : case AMDGPU::BUFFER_ATOMIC_ADD_IDXEN_RTN_si:
10851 : case AMDGPU::BUFFER_ATOMIC_ADD_OFFEN_RTN_si:
10852 : case AMDGPU::BUFFER_ATOMIC_ADD_X2_ADDR64_RTN_si:
10853 : case AMDGPU::BUFFER_ATOMIC_ADD_X2_BOTHEN_RTN_si:
10854 : case AMDGPU::BUFFER_ATOMIC_ADD_X2_IDXEN_RTN_si:
10855 : case AMDGPU::BUFFER_ATOMIC_ADD_X2_OFFEN_RTN_si:
10856 : case AMDGPU::BUFFER_ATOMIC_AND_ADDR64_RTN_si:
10857 : case AMDGPU::BUFFER_ATOMIC_AND_BOTHEN_RTN_si:
10858 : case AMDGPU::BUFFER_ATOMIC_AND_IDXEN_RTN_si:
10859 : case AMDGPU::BUFFER_ATOMIC_AND_OFFEN_RTN_si:
10860 : case AMDGPU::BUFFER_ATOMIC_AND_X2_ADDR64_RTN_si:
10861 : case AMDGPU::BUFFER_ATOMIC_AND_X2_BOTHEN_RTN_si:
10862 : case AMDGPU::BUFFER_ATOMIC_AND_X2_IDXEN_RTN_si:
10863 : case AMDGPU::BUFFER_ATOMIC_AND_X2_OFFEN_RTN_si:
10864 : case AMDGPU::BUFFER_ATOMIC_CMPSWAP_ADDR64_RTN_si:
10865 : case AMDGPU::BUFFER_ATOMIC_CMPSWAP_BOTHEN_RTN_si:
10866 : case AMDGPU::BUFFER_ATOMIC_CMPSWAP_IDXEN_RTN_si:
10867 : case AMDGPU::BUFFER_ATOMIC_CMPSWAP_OFFEN_RTN_si:
10868 : case AMDGPU::BUFFER_ATOMIC_CMPSWAP_X2_ADDR64_RTN_si:
10869 : case AMDGPU::BUFFER_ATOMIC_CMPSWAP_X2_BOTHEN_RTN_si:
10870 : case AMDGPU::BUFFER_ATOMIC_CMPSWAP_X2_IDXEN_RTN_si:
10871 : case AMDGPU::BUFFER_ATOMIC_CMPSWAP_X2_OFFEN_RTN_si:
10872 : case AMDGPU::BUFFER_ATOMIC_DEC_ADDR64_RTN_si:
10873 : case AMDGPU::BUFFER_ATOMIC_DEC_BOTHEN_RTN_si:
10874 : case AMDGPU::BUFFER_ATOMIC_DEC_IDXEN_RTN_si:
10875 : case AMDGPU::BUFFER_ATOMIC_DEC_OFFEN_RTN_s |
