LLVM 20.0.0git
Macros | Functions | Variables
AArch64AdvSIMDScalarPass.cpp File Reference
#include "AArch64.h"
#include "AArch64InstrInfo.h"
#include "AArch64RegisterInfo.h"
#include "llvm/ADT/Statistic.h"
#include "llvm/CodeGen/MachineFunction.h"
#include "llvm/CodeGen/MachineFunctionPass.h"
#include "llvm/CodeGen/MachineInstr.h"
#include "llvm/CodeGen/MachineInstrBuilder.h"
#include "llvm/CodeGen/MachineRegisterInfo.h"
#include "llvm/Support/CommandLine.h"
#include "llvm/Support/Debug.h"
#include "llvm/Support/raw_ostream.h"

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Macros

#define DEBUG_TYPE   "aarch64-simd-scalar"
 
#define AARCH64_ADVSIMD_NAME   "AdvSIMD Scalar Operation Optimization"
 

Functions

 STATISTIC (NumScalarInsnsUsed, "Number of scalar instructions used")
 
 STATISTIC (NumCopiesDeleted, "Number of cross-class copies deleted")
 
 STATISTIC (NumCopiesInserted, "Number of cross-class copies inserted")
 
 INITIALIZE_PASS (AArch64AdvSIMDScalar, "aarch64-simd-scalar", AARCH64_ADVSIMD_NAME, false, false) static bool isGPR64(unsigned Reg
 
 if (Register::isVirtualRegister(Reg)) return MRI -> getRegClass(Reg) ->hasSuperClassEq(&AArch64::GPR64RegClass)
 
return AArch64::GPR64RegClass contains (Reg)
 
static bool isFPR64 (unsigned Reg, unsigned SubReg, const MachineRegisterInfo *MRI)
 
static MachineOperandgetSrcFromCopy (MachineInstr *MI, const MachineRegisterInfo *MRI, unsigned &SubReg)
 
static unsigned getTransformOpcode (unsigned Opc)
 
static bool isTransformable (const MachineInstr &MI)
 
static MachineInstrinsertCopy (const TargetInstrInfo *TII, MachineInstr &MI, unsigned Dst, unsigned Src, bool IsKill)
 

Variables

static cl::opt< boolTransformAll ("aarch64-simd-scalar-force-all", cl::desc("Force use of AdvSIMD scalar instructions everywhere"), cl::init(false), cl::Hidden)
 
unsigned SubReg
 
unsigned const MachineRegisterInfoMRI
 

Macro Definition Documentation

◆ AARCH64_ADVSIMD_NAME

#define AARCH64_ADVSIMD_NAME   "AdvSIMD Scalar Operation Optimization"

Definition at line 62 of file AArch64AdvSIMDScalarPass.cpp.

◆ DEBUG_TYPE

#define DEBUG_TYPE   "aarch64-simd-scalar"

Definition at line 49 of file AArch64AdvSIMDScalarPass.cpp.

Function Documentation

◆ contains()

return AArch64::GPR64RegClass contains ( Reg  )

Referenced by isFPR64().

◆ getSrcFromCopy()

static MachineOperand * getSrcFromCopy ( MachineInstr MI,
const MachineRegisterInfo MRI,
unsigned SubReg 
)
static

Definition at line 127 of file AArch64AdvSIMDScalarPass.cpp.

References isFPR64(), MI, MRI, and SubReg.

◆ getTransformOpcode()

static unsigned getTransformOpcode ( unsigned  Opc)
static

Definition at line 164 of file AArch64AdvSIMDScalarPass.cpp.

Referenced by isTransformable().

◆ if()

if ( Register::isVirtualRegister(Reg ) -> getRegClass(Reg) ->hasSuperClassEq(&AArch64::GPR64RegClass)

◆ INITIALIZE_PASS()

INITIALIZE_PASS ( AArch64AdvSIMDScalar  ,
"aarch64-simd-scalar"  ,
AARCH64_ADVSIMD_NAME  ,
false  ,
false   
)

◆ insertCopy()

static MachineInstr * insertCopy ( const TargetInstrInfo TII,
MachineInstr MI,
unsigned  Dst,
unsigned  Src,
bool  IsKill 
)
static

◆ isFPR64()

static bool isFPR64 ( unsigned  Reg,
unsigned  SubReg,
const MachineRegisterInfo MRI 
)
static

Definition at line 113 of file AArch64AdvSIMDScalarPass.cpp.

References contains(), llvm::Register::isVirtualRegister(), MRI, and SubReg.

Referenced by getSrcFromCopy().

◆ isTransformable()

static bool isTransformable ( const MachineInstr MI)
static

Definition at line 184 of file AArch64AdvSIMDScalarPass.cpp.

References getTransformOpcode(), and MI.

◆ STATISTIC() [1/3]

STATISTIC ( NumCopiesDeleted  ,
"Number of cross-class copies deleted"   
)

◆ STATISTIC() [2/3]

STATISTIC ( NumCopiesInserted  ,
"Number of cross-class copies inserted"   
)

◆ STATISTIC() [3/3]

STATISTIC ( NumScalarInsnsUsed  ,
"Number of scalar instructions used"   
)

Variable Documentation

◆ MRI

Initial value:
{
if (SubReg)
return false
unsigned SubReg

Definition at line 105 of file AArch64AdvSIMDScalarPass.cpp.

Referenced by llvm::AliasSetTracker::add(), addCalleeSavedRegs(), addConstantsToTrack(), llvm::DstOp::addDefToMIB(), addHints(), addImplicitDefs(), llvm::RegsForValue::AddInlineAsmOperands(), addInstrRequirements(), llvm::PressureDiffs::addInstruction(), llvm::MachineBasicBlock::addLiveIn(), llvm::MachineFunction::addLiveIn(), llvm::addLiveIns(), llvm::AMDGPURegisterBankInfo::addMappingFromTable(), llvm::SITargetLowering::AddMemOpInit(), llvm::MachineInstr::addOperand(), llvm::PressureDiff::addPressureChange(), adjustAllocatableRegClass(), AdjustBaseAndOffset(), llvm::ARMFrameLowering::adjustForSegmentedStacks(), llvm::SITargetLowering::AdjustInstrPostInstrSelection(), llvm::RegisterOperands::adjustLaneLiveness(), llvm::RISCVRegisterInfo::adjustReg(), llvm::RegPressureTracker::advance(), llvm::GISelAddressing::aliasIsKnownForLoadStore(), llvm::SITargetLowering::allocateHSAUserSGPRs(), allocateHSAUserSGPRs(), llvm::SITargetLowering::allocateSpecialEntryInputVGPRs(), llvm::SIMachineFunctionInfo::allocateVGPRSpillToAGPR(), allPhiOperandsUndefined(), allUsesHaveSourceMods(), llvm::ARMBaseInstrInfo::analyzeLoopForPipelining(), llvm::PPCInstrInfo::analyzeLoopForPipelining(), llvm::AnalyzeVirtRegLanesInBundle(), llvm::RegisterBankInfo::applyDefaultMapping(), llvm::AMDGPURegisterBankInfo::applyMappingBFE(), llvm::AMDGPURegisterBankInfo::applyMappingDynStackAlloc(), llvm::AMDGPURegisterBankInfo::applyMappingImpl(), llvm::MipsRegisterBankInfo::applyMappingImpl(), llvm::AMDGPURegisterBankInfo::applyMappingLoad(), llvm::AMDGPURegisterBankInfo::applyMappingMAD_64_32(), llvm::AMDGPURegisterBankInfo::applyMappingSBufferLoad(), llvm::AMDGPURegisterBankInfo::applyMappingSMULU64(), llvm::AMDGPUCallLowering::areCalleeOutgoingArgsTailCallable(), llvm::ARMAsmBackendDarwin::ARMAsmBackendDarwin(), llvm::PPCFrameLowering::assignCalleeSavedSpillSlots(), llvm::CallLowering::IncomingValueHandler::assignValueToReg(), attachMEMCPYScratchRegs(), attemptDebugCopyProp(), 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llvm::AMDGPURegisterBankInfo::getSGPROpMapping(), getShape(), llvm::RegisterBankInfo::getSizeInBits(), getSrcFromCopy(), llvm::getSrcRegIgnoringCopies(), getTestBitReg(), getTileShape(), getTruncStoreByteOffset(), getTypeFromTypeIdx(), getTypeReg(), llvm::MachineInstr::getTypeToPrint(), llvm::AMDGPURegisterBankInfo::getValueMappingForPtr(), llvm::SIInstrInfo::getVALUOp(), getVectorShiftImm(), getVectorSHLImm(), llvm::getVectorSplat(), llvm::AMDGPURegisterBankInfo::getVGPROpMapping(), getVRegDef(), llvm::PerFunctionMIParsingState::getVRegInfo(), llvm::getVRegSubRegDef(), llvm::GISelInstProfileBuilder::GISelInstProfileBuilder(), llvm::CallLowering::handleAssignments(), llvm::AMDGPURegisterBankInfo::handleD16VData(), llvm::AMDGPULegalizerInfo::handleD16VData(), llvm::LiveIntervals::handleMove(), llvm::LiveIntervals::handleMoveIntoNewBundle(), hasAllNBitUsers(), hasAllWUsers(), hasAnyNonFlatUseOfReg(), hasArgumentDef(), llvm::X86InstrInfo::hasCommutePreference(), llvm::MCInstrDesc::hasImplicitDefOfPhysReg(), hasMoreUses(), hasOneNonDBGUse(), llvm::TargetInstrInfo::hasReassociableOperands(), llvm::RISCVInstrInfo::hasReassociableOperands(), llvm::TargetInstrInfo::hasReassociableSibling(), llvm::RISCVInstrInfo::hasReassociableSibling(), hasSameNumEltsOnAllVectorOperands(), hasSameValue(), hasUseAfterLoop(), llvm::SIInstrInfo::hasVGPRUses(), llvm::LiveIntervals::HMEditor::HMEditor(), hoistAndMergeSGPRInits(), llvm::GCNRegPressure::inc(), increaseSetPressure(), llvm::LiveRegSet::init(), INITIALIZE_PASS(), llvm::MIRParserImpl::initializeMachineFunction(), initializeRecordStreamer(), llvm::AArch64_MC::initLLVMToCVRegMapping(), llvm::ARM_MC::initLLVMToCVRegMapping(), llvm::X86_MC::initLLVMToSEHAndCVRegMapping(), llvm::WebAssemblyFunctionInfo::initWARegs(), llvm::PPCFrameLowering::inlineStackProbe(), llvm::insertAssignInstr(), llvm::VEInstrInfo::insertBranch(), llvm::AArch64TargetLowering::insertCopiesSplitCSR(), llvm::SITargetLowering::insertCopiesSplitCSR(), insertCSRSaves(), llvm::SIInstrInfo::insertEQ(), llvm::SIInstrInfo::insertIndirectBranch(), llvm::LoongArchInstrInfo::insertIndirectBranch(), llvm::RISCVInstrInfo::insertIndirectBranch(), insertInlineAsmProcess(), llvm::insertMultibyteShift(), llvm::SIInstrInfo::insertNE(), InsertNewDef(), insertPHI(), llvm::SIInstrInfo::insertSelect(), llvm::AArch64InstrInfo::insertSelect(), llvm::PPCInstrInfo::insertSelect(), llvm::SystemZInstrInfo::insertSelect(), llvm::X86InstrInfo::insertSelect(), llvm::SIInstrInfo::insertSimulatedTrap(), llvm::CallLowering::insertSRetIncomingArgument(), llvm::CallLowering::insertSRetLoads(), llvm::CallLowering::insertSRetStores(), insertUndefLaneMask(), llvm::SIInstrInfo::insertVectorSelect(), llvm::GISelAddressing::instMayAlias(), InstReorderLimit(), is64bitDefwithZeroHigh64bit(), llvm::SIRegisterInfo::isAGPR(), isAGPRCopy(), IsAGPROperand(), llvm::isAllOnesOrAllOnesSplat(), isBackwardPropagatableCopy(), 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◆ SubReg

unsigned SubReg

Definition at line 104 of file AArch64AdvSIMDScalarPass.cpp.

Referenced by llvm::MachineInstrBuilder::addDef(), llvm::LiveIntervals::addKillFlags(), llvm::SITargetLowering::AddMemOpInit(), llvm::LivePhysRegs::addReg(), llvm::MachineInstrBuilder::addReg(), llvm::MachineInstrBuilder::addUse(), llvm::LiveRangeEdit::allUsesAvailableAt(), llvm::AnalyzeVirtRegLanesInBundle(), llvm::SIInstrInfo::buildExtractSubReg(), llvm::SIInstrInfo::buildExtractSubRegOrImm(), llvm::SIRegisterInfo::buildSpillLoadStore(), llvm::LiveIntervalCalc::calculate(), llvm::LiveInterval::computeSubRangeUndefs(), llvm::AArch64InstrInfo::copyGPRRegTuple(), llvm::SIInstrInfo::copyPhysReg(), llvm::AArch64InstrInfo::copyPhysRegTuple(), copySubReg(), llvm::MachineOperand::CreateReg(), emitIndirectDst(), emitIndirectSrc(), llvm::GIMatchTableExecutor::executeMatchTable(), llvm::SIInstrInfo::expandPostRAPseudo(), llvm::finalizeBundle(), findHoistingInsertPosAndDeps(), llvm::SIRegisterInfo::findReachingDef(), llvm::TargetInstrInfo::foldMemoryOperand(), llvm::X86InstrInfo::foldMemoryOperandImpl(), foldVGPRCopyIntoRegSequence(), llvm::SIRegisterInfo::getChannelFromSubReg(), getInstReadLaneMask(), llvm::ScheduleDAGInstrs::getLaneMaskForMO(), getMax32BitSubRegister(), llvm::SIRegisterInfo::getNumChannelsFromSubReg(), llvm::SIInstrInfo::getOpSize(), llvm::getRegSequenceSubReg(), llvm::X86RegisterInfo::getReservedRegs(), getSrcFromCopy(), llvm::AArch64RegisterInfo::getStrictlyReservedRegs(), llvm::SuperRegClassIterator::getSubReg(), llvm::SIRegisterInfo::getSubRegAlignmentNumBits(), getSubRegForClass(), llvm::MCRegisterInfo::getSubRegIndex(), insertPHI(), isCrossCopy(), isFPR64(), isSubRegOf(), llvm::SuperRegClassIterator::operator++(), llvm::MachineOperand::print(), llvm::ARMAsmPrinter::PrintAsmOperand(), llvm::LiveIntervals::repairIntervalsInRange(), llvm::SIRegisterInfo::restoreSGPR(), llvm::MachineFunction::salvageCopySSAImpl(), selectCopy(), llvm::HexagonDAGToDAGISel::SelectExtractSubvector(), llvm::HvxSelector::selectExtractSubvector(), llvm::MipsRegInfoRecord::SetPhysRegUsed(), llvm::AArch64RegisterInfo::shouldCoalesce(), llvm::AVRRegisterInfo::shouldCoalesce(), llvm::LiveIntervals::shrinkToUses(), llvm::SIRegisterInfo::spillEmergencySGPR(), llvm::SIRegisterInfo::spillSGPR(), swapRegAndNonRegOperand(), llvm::LiveIntervals::HMEditor::updateAllRanges(), and llvm::AArch64RegisterInfo::UpdateCustomCallPreservedMask().

◆ TransformAll

cl::opt< bool > TransformAll("aarch64-simd-scalar-force-all", cl::desc("Force use of AdvSIMD scalar instructions everywhere"), cl::init(false), cl::Hidden) ( "aarch64-simd-scalar-force-all"  ,
cl::desc("Force use of AdvSIMD scalar instructions everywhere")  ,
cl::init(false)  ,
cl::Hidden   
)
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