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llvm::MCInst Class Reference

Instances of this class represent a single low-level machine instruction. More...

#include "llvm/MC/MCInst.h"

Public Types

using iterator = SmallVectorImpl< MCOperand >::iterator
 
using const_iterator = SmallVectorImpl< MCOperand >::const_iterator
 

Public Member Functions

 MCInst ()=default
 
void setOpcode (unsigned Op)
 
unsigned getOpcode () const
 
void setLoc (SMLoc loc)
 
SMLoc getLoc () const
 
const MCOperandgetOperand (unsigned i) const
 
MCOperandgetOperand (unsigned i)
 
unsigned getNumOperands () const
 
void addOperand (const MCOperand &Op)
 
void clear ()
 
void erase (iterator I)
 
size_t size () const
 
iterator begin ()
 
const_iterator begin () const
 
iterator end ()
 
const_iterator end () const
 
iterator insert (iterator I, const MCOperand &Op)
 
void print (raw_ostream &OS) const
 
void dump () const
 
void dump_pretty (raw_ostream &OS, const MCInstPrinter *Printer=nullptr, StringRef Separator=" ") const
 Dump the MCInst as prettily as possible using the additional MC structures, if given. More...
 

Detailed Description

Instances of this class represent a single low-level machine instruction.

Definition at line 159 of file MCInst.h.

Member Typedef Documentation

◆ const_iterator

Definition at line 180 of file MCInst.h.

◆ iterator

Definition at line 179 of file MCInst.h.

Constructor & Destructor Documentation

◆ MCInst()

llvm::MCInst::MCInst ( )
default

Member Function Documentation

◆ addOperand()

void llvm::MCInst::addOperand ( const MCOperand Op)
inline

Definition at line 177 of file MCInst.h.

References llvm::SmallVectorTemplateBase< T, isPodLike< T >::value >::push_back().

Referenced by llvm::X86Operand::addAbsMemOperands(), llvm::HexagonMCInstrInfo::addConstant(), llvm::HexagonMCInstrInfo::addConstExtender(), llvm::X86Operand::addDstIdxOperands(), llvm::MCInstBuilder::addExpr(), llvm::AVROperand::addExpr(), llvm::X86Operand::addExpr(), llvm::MCInstBuilder::addFPImm(), llvm::X86Operand::addGR32orGR64Operands(), llvm::MCInstBuilder::addImm(), llvm::MCInstBuilder::addInst(), llvm::X86Operand::addMemOffsOperands(), llvm::X86Operand::addMemOperands(), llvm::AVROperand::addMemriOperands(), addNegOperand(), addOperand(), llvm::MCInstBuilder::addOperand(), addOps(), addOptionalImmOperand(), llvm::MCInstBuilder::addReg(), llvm::AVROperand::addRegOperands(), llvm::X86Operand::addRegOperands(), llvm::X86Operand::addSrcIdxOperands(), llvm::HexagonMCShuffler::copyTo(), countMCSymbolRefExpr(), llvm::HexagonMCInstrInfo::createBundle(), Decode2RImmInstruction(), Decode2RUSInstruction(), Decode3RImmInstruction(), DecodeACC64DSPRegisterClass(), DecodeAddiGroupBranch(), DecodeAddiur2Simm7(), DecodeAddrMode2IdxInstruction(), DecodeAddrMode3Instruction(), DecodeAddrMode5FP16Operand(), DecodeAddrMode5Operand(), DecodeAddrMode6Operand(), DecodeAddrModeImm12Operand(), DecodeAddSubERegInstruction(), DecodeAdrInstruction(), DecodeAFGR64RegisterClass(), DecodeANDI16Imm(), DecodeArmMOVTWInstruction(), DecodeASRRegsRegisterClass(), DecodeBankedReg(), DecodeBaseAddSubImm(), decodeBDAddr12Operand(), decodeBDAddr20Operand(), decodeBDLAddr12Len4Operand(), decodeBDLAddr12Len8Operand(), decodeBDRAddr12Operand(), decodeBDVAddr12Operand(), decodeBDXAddr12Operand(), decodeBDXAddr20Operand(), DecodeBgtzGroupBranch(), DecodeBgtzGroupBranchMMR6(), DecodeBgtzlGroupBranch(), DecodeBitfieldMaskOperand(), DecodeBitpOperand(), DecodeBlezGroupBranch(), DecodeBlezGroupBranchMMR6(), DecodeBlezlGroupBranch(), decodeBranch(), DecodeBranchImmInstruction(), DecodeBranchTarget(), DecodeBranchTarget10MM(), DecodeBranchTarget1SImm16(), DecodeBranchTarget21(), DecodeBranchTarget21MM(), DecodeBranchTarget26(), DecodeBranchTarget26MM(), DecodeBranchTarget7MM(), DecodeBranchTargetMM(), DecodeCacheeOp_CacheOpR6(), DecodeCacheOp(), DecodeCacheOpMM(), DecodeCall(), DecodeCCOutOperand(), DecodeCCRRegisterClass(), DecodeCOP0RegisterClass(), DecodeCOP2RegisterClass(), DecodeCopMemInstruction(), DecodeCoprocessor(), DecodeCPPairRegisterClass(), DecodeCPRegsRegisterClass(), DecodeCPSInstruction(), decodeCRBitMOperand(), DecodeCtrRegs64RegisterClass(), DecodeCtrRegsRegisterClass(), DecodeDaddiGroupBranch(), DecodeDAHIDATI(), DecodeDAHIDATIMMR6(), DecodeDDDDRegisterClass(), DecodeDDDRegisterClass(), DecodeDDRegisterClass(), DecodeDFPRegsRegisterClass(), DecodeDPairRegisterClass(), DecodeDPairSpacedRegisterClass(), DecodeDPRRegisterClass(), DecodeFCCRegisterClass(), DecodeFCCRegsRegisterClass(), DecodeFGR32RegisterClass(), DecodeFGR64RegisterClass(), DecodeFGRCCRegisterClass(), DecodeFixedPointScaleImm32(), DecodeFixedPointScaleImm64(), DecodeFMem(), DecodeFMem2(), DecodeFMem3(), DecodeFMemCop2MMR6(), DecodeFMemCop2R6(), DecodeFMemMMR2(), DecodeFMOVLaneInstruction(), DecodeFPR128RegisterClass(), DecodeFPR16RegisterClass(), DecodeFPR32RegisterClass(), DecodeFPR64RegisterClass(), DecodeFPR8RegisterClass(), DecodeFPRegsRegisterClass(), DecodeGPR32RegisterClass(), DecodeGPR32spRegisterClass(), DecodeGPR64RegisterClass(), DecodeGPR64spRegisterClass(), DecodeGPRMM16MovePRegisterClass(), DecodeGPRMM16RegisterClass(), DecodeGPRMM16ZeroRegisterClass(), DecodeGPRPairRegisterClass(), DecodeGPRRegisterClass(), DecodeGPRSeqPairsClassRegisterClass(), DecodeGPRwithAPSRRegisterClass(), DecodeGRRegsRegisterClass(), DecodeHI32DSPRegisterClass(), DecodeHINTInstruction(), DecodeHWRegsRegisterClass(), DecodeI64RegsRegisterClass(), DecodeInsSize(), DecodeInstSyncBarrierOption(), DecodeINSVE_DF(), DecodeIntPairRegisterClass(), DecodeIntRegsRegisterClass(), DecodeIT(), DecodeJMPL(), DecodeJumpTarget(), DecodeJumpTargetMM(), DecodeL2RUSInstruction(), DecodeLi16Imm(), DecodeLO32DSPRegisterClass(), DecodeLoadByte15(), DecodeLoadByte9(), DecodeLogicalImmInstruction(), DecodeMem(), DecodeMemBarrierOption(), DecodeMemEVA(), DecodeMemExtend(), DecodeMemMMGPImm7Lsl2(), DecodeMemMMImm12(), DecodeMemMMImm16(), DecodeMemMMImm4(), DecodeMemMMImm9(), DecodeMemMMReglistImm4Lsl2(), DecodeMemMMSPImm5Lsl2(), DecodeMemMultipleWritebackInstruction(), decodeMemoryOpValue(), decodeMemRIOperands(), decodeMemRIX16Operands(), decodeMemRIXOperands(), DecodeModImmInstruction(), DecodeModImmTiedInstruction(), DecodeModRegsRegisterClass(), DecodeMoveImmInstruction(), DecodeMovePRegPair(), DecodeMRSSystemRegister(), DecodeMSA128BRegisterClass(), DecodeMSA128DRegisterClass(), DecodeMSA128HRegisterClass(), DecodeMSA128Mem(), DecodeMSA128WRegisterClass(), DecodeMSACtrlRegisterClass(), DecodeMSRMask(), DecodeMSRSystemRegister(), DecodeNegImmOperand(), DecodeNEONModImmInstruction(), DecodePairLdStInstruction(), decodePCDBLOperand(), DecodePCRelLabel19(), DecodePOOL16BEncodedField(), DecodePOP35GroupBranchMMR6(), DecodePOP37GroupBranchMMR6(), DecodePOP65GroupBranchMMR6(), DecodePOP75GroupBranchMMR6(), DecodePostIdxReg(), decodePredicateOperand(), DecodePredicateOperand(), DecodePrefeOpMM(), DecodePRRegsRegisterClass(), DecodeQFPRegsRegisterClass(), DecodeQPRRegisterClass(), DecodeQQQQRegisterClass(), DecodeQQQRegisterClass(), DecodeQQRegisterClass(), decodeRegisterClass(), DecodeRegisterClass(), DecodeRegListOperand(), DecodeRegListOperand16(), DecodeReturn(), DecodeRFEInstruction(), DecoderForMRRC2AndMCRR2(), decodeRiMemoryValue(), DecodeRRegsRegisterClass(), decodeRrMemoryValue(), DecodeRUSInstruction(), DecodeSETPANInstruction(), decodeShiftImm(), DecodeShiftRight16Imm(), DecodeShiftRight32Imm(), DecodeShiftRight64Imm(), DecodeShiftRight8Imm(), DecodeSignedLdStInstruction(), DecodeSIMM13(), DecodeSimm18Lsl3(), DecodeSimm19Lsl2(), DecodeSimm23Lsl2(), DecodeSimm9SP(), decodeSImmOperand(), DecodeSImmWithOffsetAndScale(), DecodeSORegImmOperand(), DecodeSORegMemOperand(), DecodeSORegRegOperand(), DecodeSpecial3LlSc(), decodeSplsValue(), DecodeSPRRegisterClass(), DecodeStoreEvaOpMM(), DecodeSWAP(), DecodeSyncI(), DecodeSynciR6(), DecodeSystemPStateInstruction(), DecodeT2AddrModeImm0_1020s4(), DecodeT2AddrModeImm12(), DecodeT2AddrModeSOReg(), DecodeT2Adr(), DecodeT2BInstruction(), DecodeT2BROperand(), DecodeT2CPSInstruction(), DecodeT2Imm8(), DecodeT2Imm8S4(), DecodeT2LoadLabel(), DecodeT2MOVTWInstruction(), DecodeT2ShifterImmOperand(), DecodeT2SOImm(), DecodetcGPRRegisterClass(), DecodeTestAndBranch(), DecodeThreeAddrSRegInstruction(), DecodeThumbAddrModeIS(), DecodeThumbAddrModePC(), DecodeThumbAddrModeSP(), DecodeThumbAddSpecialReg(), DecodeThumbAddSPImm(), DecodeThumbAddSPReg(), DecodeThumbBCCTargetOperand(), DecodeThumbBLTargetOperand(), DecodeThumbBROperand(), DecodeThumbCmpBROperand(), DecodeThumbCPS(), DecodeTRAP(), decodeUImmOperand(), DecodeUImmWithOffsetAndScale(), DecodeUnconditionalBranch(), DecodeUnsignedLdStInstruction(), DecodeVCVTD(), DecodeVCVTQ(), DecodeVecShiftLImm(), DecodeVecShiftRImm(), DecodeVectorRegisterClass(), DecodeVLD1DupInstruction(), DecodeVLD1LN(), DecodeVLD2DupInstruction(), DecodeVLD2LN(), DecodeVLD3DupInstruction(), DecodeVLD3LN(), DecodeVLD4DupInstruction(), DecodeVLD4LN(), DecodeVLDInstruction(), DecodeVSHLMaxInstruction(), DecodeVST1LN(), DecodeVST2LN(), DecodeVST3LN(), DecodeVST4LN(), DecodeVSTInstruction(), llvm::HexagonMCInstrInfo::deriveDuplex(), llvm::HexagonMCInstrInfo::deriveExtender(), EmitBinary(), EmitCall(), llvm::MipsTargetELFStreamer::emitDirectiveCpLoad(), llvm::MipsTargetELFStreamer::emitDirectiveCpreturn(), llvm::MipsTargetStreamer::emitII(), llvm::ARMAsmPrinter::EmitInstruction(), llvm::NVPTXAsmPrinter::emitLineNumberAsDotLoc(), EmitNops(), llvm::MipsTargetStreamer::emitR(), llvm::MipsTargetStreamer::emitRRX(), llvm::MipsTargetStreamer::emitRX(), EmitSETHI(), llvm::MipsAsmPrinter::EmitStartOfAsmFile(), getCompoundInsn(), getDRegFromQReg(), llvm::ARMInstrInfo::getNoop(), llvm::Thumb1InstrInfo::getNoop(), llvm::Thumb2InstrInfo::getNoop(), llvm::AArch64InstrInfo::getNoop(), getRealVLDOpcode(), getRetOpcode(), llvm::HexagonLowerToMC(), llvm::HexagonAsmPrinter::HexagonProcessInstruction(), incrementLoc(), IsSmallMemAccess(), LLVMInitializeHexagonDisassembler(), llvm::XCoreMCInstLower::Lower(), llvm::SystemZMCInstLower::lower(), llvm::MipsMCInstLower::Lower(), llvm::MSP430MCInstLower::Lower(), llvm::BPFMCInstLower::Lower(), llvm::LanaiMCInstLower::Lower(), llvm::AArch64MCInstLower::Lower(), llvm::AMDGPUMCInstLower::lower(), llvm::WebAssemblyMCInstLower::Lower(), llvm::LowerARMMachineInstrToMCInst(), llvm::AVRMCInstLower::lowerInstruction(), llvm::MipsMCInstLower::LowerOperand(), llvm::LowerPPCMachineInstrToMCInst(), llvm::LowerSparcMachineInstrToMCInst(), makeCombineInst(), nextReg(), llvm::HexagonMCInstrInfo::padEndloop(), PostOperandDecodeAdjust(), llvm::ARMInstPrinter::printInst(), readInstruction64(), llvm::ARMAsmBackend::relaxInstruction(), llvm::MipsAsmPrinter::runOnMachineFunction(), ScaleVectorOffset(), SimplifyShortImmForm(), SimplifyShortMoveForm(), translateDstIndex(), translateFPRegister(), translateImmediate(), translateMaskRegister(), translateRegister(), translateRMMemory(), translateSrcIndex(), llvm::AArch64ExternalSymbolizer::tryAddingSymbolicOperand(), llvm::MCExternalSymbolizer::tryAddingSymbolicOperand(), and llvm::AMDGPUSymbolizer::tryAddingSymbolicOperand().

◆ begin() [1/2]

iterator llvm::MCInst::begin ( )
inline

◆ begin() [2/2]

const_iterator llvm::MCInst::begin ( ) const
inline

Definition at line 186 of file MCInst.h.

References llvm::SmallVectorTemplateCommon< T >::begin().

◆ clear()

void llvm::MCInst::clear ( )
inline

◆ dump()

LLVM_DUMP_METHOD void MCInst::dump ( ) const

Definition at line 70 of file MCInst.cpp.

References llvm::dbgs(), and llvm::MCOperand::print().

Referenced by HasSecRelSymbolRef(), and llvm::HexagonMCShuffler::reshuffleTo().

◆ dump_pretty()

void MCInst::dump_pretty ( raw_ostream OS,
const MCInstPrinter Printer = nullptr,
StringRef  Separator = " " 
) const

Dump the MCInst as prettily as possible using the additional MC structures, if given.

Operators are separated by the Separator string.

Definition at line 54 of file MCInst.cpp.

References llvm::MCInstPrinter::getOpcodeName(), and Separator.

Referenced by llvm::MCFragment::dump(), llvm::RuntimeDyldCheckerExprEval::evaluate(), getRelaxedOpcode(), PrintCFIEscape(), and llvm::ARMAsmBackend::relaxInstruction().

◆ end() [1/2]

iterator llvm::MCInst::end ( )
inline

◆ end() [2/2]

const_iterator llvm::MCInst::end ( ) const
inline

Definition at line 188 of file MCInst.h.

References llvm::SmallVectorTemplateCommon< T >::end().

◆ erase()

void llvm::MCInst::erase ( iterator  I)
inline

◆ getLoc()

SMLoc llvm::MCInst::getLoc ( ) const
inline

◆ getNumOperands()

unsigned llvm::MCInst::getNumOperands ( ) const
inline

Definition at line 175 of file MCInst.h.

References llvm::SmallVectorTemplateCommon< T >::size().

Referenced by addNegOperand(), checkLowRegisterList(), countMCSymbolRefExpr(), createLanaiElfRelocation(), createMipsObjectTargetStreamer(), llvm::createWebAssemblyMCCodeEmitter(), llvm::EmitAnyX86InstComments(), llvm::MipsELFStreamer::EmitInstruction(), llvm::MCStreamer::EmitInstruction(), llvm::HexagonMCELFStreamer::EmitSymbol(), llvm::RuntimeDyldCheckerExprEval::evaluate(), llvm::MCInstrAnalysis::evaluateBranch(), getARMLoadDeprecationInfo(), getARMStoreDeprecationInfo(), llvm::HexagonMCInstrInfo::getDuplexPossibilties(), getItineraryLatency(), getLit64Encoding(), llvm::HexagonMCCodeEmitter::getMachineOpValue(), llvm::MipsMCCodeEmitter::getMemEncodingMMImm12(), llvm::MipsMCCodeEmitter::getMemEncodingMMImm4sp(), getRealVLDOpcode(), llvm::MipsMCCodeEmitter::getRegisterListOpValue(), llvm::MipsMCCodeEmitter::getRegisterListOpValue16(), getRelaxedOpcode(), getRetOpcode(), HasConditionalBranch(), HasSecRelSymbolRef(), llvm::HexagonMCInstrInfo::isOrderedDuplexPair(), isRegOrImmWithInputMods(), listContainsReg(), LowerDins(), LowerLargeShift(), llvm::MCInstrDesc::mayAffectControlFlow(), needsPCRel(), nextReg(), llvm::ARMInstPrinter::printInst(), llvm::WebAssemblyInstPrinter::printInst(), llvm::MipsInstPrinter::printInst(), llvm::ARMInstPrinter::printRegisterList(), llvm::AMDGPUInstPrinter::printRegOperand(), printSImmOperand(), llvm::SparcInstPrinter::printSparcAliasInstr(), ScaleVectorOffset(), SimplifyShortImmForm(), SimplifyShortMoveForm(), and llvm::AMDGPUDisassembler::tryDecodeInst().

◆ getOpcode()

unsigned llvm::MCInst::getOpcode ( ) const
inline

Definition at line 168 of file MCInst.h.

Referenced by addNegOperand(), addOptionalImmOperand(), AddThumb1SBit(), llvm::HexagonMCChecker::check(), checkDecodedInstruction(), llvm::AMDGPUDisassembler::convertSDWAInst(), countMCSymbolRefExpr(), createARMMCRelocationInfo(), llvm::createBPFbeMCCodeEmitter(), createLanaiElfRelocation(), createMipsObjectTargetStreamer(), llvm::createPPCMCCodeEmitter(), llvm::createR600MCCodeEmitter(), llvm::createWebAssemblyMCCodeEmitter(), decIncOperator(), DecodeAddrMode2IdxInstruction(), DecodeAddrMode3Instruction(), DecodeAddSubERegInstruction(), DecodeArmMOVTWInstruction(), DecodeCopMemInstruction(), DecodeExclusiveLdStInstruction(), DecodeInsSize(), DecodeLogicalImmInstruction(), DecodeMem(), DecodeMemEVA(), DecodeMemMMImm12(), DecodeMemMMImm4(), DecodeMemMMImm9(), DecodeMemMMReglistImm4Lsl2(), DecodeMemMultipleWritebackInstruction(), decodeMemRIOperands(), decodeMemRIXOperands(), DecodeModImmInstruction(), DecodeMoveImmInstruction(), DecodeMSA128Mem(), DecodeMSRMask(), DecodeNEONModImmInstruction(), DecodePairLdStInstruction(), DecodePCRelLabel19(), DecodePredicateOperand(), DecodeRegListOperand(), DecodeRegListOperand16(), DecoderForMRRC2AndMCRR2(), DecodeSignedLdStInstruction(), DecodeSpecial3LlSc(), DecodeT2AddrModeImm12(), DecodeT2AddrModeImm8(), DecodeT2AddrModeSOReg(), DecodeT2LdStPre(), DecodeT2LoadImm12(), DecodeT2LoadImm8(), DecodeT2LoadLabel(), DecodeT2LoadShift(), DecodeT2LoadT(), DecodeT2MOVTWInstruction(), DecodeTBLInstruction(), DecodeThreeAddrSRegInstruction(), DecodeThumbAddSpecialReg(), DecodeThumbAddSPReg(), DecodeUnsignedLdStInstruction(), DecodeVLD1DupInstruction(), DecodeVLD2DupInstruction(), DecodeVLDInstruction(), DecodeVSTInstruction(), llvm::HexagonMCInstrInfo::deriveSubInst(), llvm::EmitAnyX86InstComments(), llvm::AsmPrinter::EmitFunctionBody(), llvm::HexagonMCELFStreamer::EmitInstruction(), encodeBitmaskPerm(), llvm::MipsMCCodeEmitter::encodeInstruction(), llvm::HexagonMCCodeEmitter::EncodeSingleInstruction(), llvm::MCInstrAnalysis::evaluateBranch(), getCompoundCandidateGroup(), getCompoundInsn(), getCompoundOp(), llvm::HexagonMCInstrInfo::getDesc(), getDRegFromQReg(), llvm::HexagonMCInstrInfo::getDuplexCandidateGroup(), llvm::HexagonMCInstrInfo::getDuplexPossibilties(), llvm::AMDGPUDisassembler::getInstruction(), getItineraryLatency(), getLatency(), getLit64Encoding(), getMaskName(), llvm::MipsMCCodeEmitter::getMemEncodingMMImm12(), llvm::MipsMCCodeEmitter::getMemEncodingMMImm4sp(), llvm::HexagonMCInstrInfo::getName(), llvm::AVRInstPrinter::getPrettyRegisterName(), getRealVLDOpcode(), getRelaxedOpcode(), getRelaxedOpcodeArith(), getRelaxedOpcodeBranch(), getRetOpcode(), llvm::TargetSubtargetInfo::getSchedInfoStr(), getSpecialRegForName(), llvm::HexagonMCInstrInfo::getType(), getZeroExtensionResultType(), HasConditionalBranch(), HasSecRelSymbolRef(), llvm::HexagonLowerToMC(), llvm::HexagonAsmPrinter::HexagonProcessInstruction(), insertNamedMCOperand(), instIsBreakpoint(), llvm::MCInstrAnalysis::isBranch(), llvm::HexagonMCInstrInfo::isBundle(), llvm::MCInstrAnalysis::isCall(), llvm::MCInstrAnalysis::isConditionalBranch(), llvm::HexagonMCInstrInfo::isConstExtended(), llvm::IsCPSRDead< MCInst >(), llvm::HexagonMCInstrInfo::isImmext(), llvm::MCInstrAnalysis::isIndirectBranch(), isOrderedCompoundPair(), llvm::HexagonMCInstrInfo::isOrderedDuplexPair(), isRegOrImmWithInputMods(), llvm::MCInstrAnalysis::isReturn(), IsSmallMemAccess(), llvm::HexagonMCInstrInfo::isSolo(), llvm::HexagonMCInstrInfo::isSubInstruction(), llvm::MCInstrAnalysis::isTerminator(), llvm::MCInstrAnalysis::isUnconditionalBranch(), LLVMInitializeHexagonDisassembler(), lookForCompound(), LowerDins(), LowerLargeShift(), makeCombineInst(), llvm::ARMAsmBackend::mayNeedRelaxation(), needsPCRel(), nextReg(), PostOperandDecodeAdjust(), llvm::AArch64InstPrinter::printBarrierOption(), llvm::SparcInstPrinter::printCCOperand(), llvm::ARMInstPrinter::printInst(), llvm::X86ATTInstPrinter::printInst(), llvm::AArch64InstPrinter::printInst(), llvm::X86IntelInstPrinter::printInst(), llvm::AVRInstPrinter::printInst(), llvm::PPCInstPrinter::printInst(), llvm::WebAssemblyInstPrinter::printInst(), llvm::MipsInstPrinter::printInst(), llvm::AArch64AppleInstPrinter::printInst(), llvm::ARMInstPrinter::printModImmOperand(), llvm::ARMInstPrinter::printMSRMaskOperand(), llvm::WebAssemblyInstPrinter::printOperand(), llvm::SparcInstPrinter::printOperand(), llvm::PPCInstPrinter::printOperand(), printPackedModifier(), llvm::AMDGPUInstPrinter::printRegOperand(), llvm::SparcInstPrinter::printSparcAliasInstr(), llvm::AArch64InstPrinter::printSysAlias(), llvm::WebAssemblyInstPrinter::printWebAssemblyP2AlignOperand(), readInstruction64(), llvm::ARMAsmBackend::relaxInstruction(), RewriteIntelBracExpression(), ScaleVectorOffset(), setRequiredFeatureString(), SimplifyMOVSX(), llvm::HexagonMCInstrInfo::subInstWouldBeExtended(), SwapBits(), translateImmediate(), translateInstruction(), translateRMMemory(), llvm::AArch64ExternalSymbolizer::tryAddingSymbolicOperand(), and llvm::AMDGPUDisassembler::tryDecodeInst().

◆ getOperand() [1/2]

const MCOperand& llvm::MCInst::getOperand ( unsigned  i) const
inline

Definition at line 173 of file MCInst.h.

Referenced by llvm::HexagonMCInstrInfo::addConstExtender(), addNegOperand(), addOps(), addOptionalImmOperand(), AddThumb1SBit(), llvm::adjustPqBits(), llvm::HexagonMCChecker::check(), llvm::HexagonShuffler::check(), checkLowRegisterList(), llvm::HexagonMCInstrInfo::clampExtended(), countMCSymbolRefExpr(), createARMMCRelocationInfo(), createLanaiElfRelocation(), createMipsObjectTargetStreamer(), llvm::createPPCMCCodeEmitter(), llvm::createR600MCCodeEmitter(), llvm::createWebAssemblyMCCodeEmitter(), decIncOperator(), DecodeInsSize(), DecodeMoveImmInstruction(), DecodeRegListOperand(), llvm::HexagonMCInstrInfo::deriveSubInst(), llvm::EmitAnyX86InstComments(), llvm::HexagonMCELFStreamer::EmitInstruction(), llvm::MipsELFStreamer::EmitInstruction(), llvm::MCStreamer::EmitInstruction(), llvm::HexagonMCELFStreamer::EmitSymbol(), llvm::HexagonMCCodeEmitter::EncodeSingleInstruction(), encodeThumbBLOffset(), llvm::RuntimeDyldCheckerExprEval::evaluate(), llvm::MCInstrAnalysis::evaluateBranch(), llvm::HexagonMCInstrInfo::extenderForIndex(), getARMLoadDeprecationInfo(), getARMStoreDeprecationInfo(), llvm::MipsMCCodeEmitter::getBranchTarget21OpValue(), llvm::MipsMCCodeEmitter::getBranchTarget21OpValueMM(), llvm::MipsMCCodeEmitter::getBranchTarget26OpValue(), llvm::MipsMCCodeEmitter::getBranchTarget26OpValueMM(), llvm::MipsMCCodeEmitter::getBranchTarget7OpValueMM(), llvm::MipsMCCodeEmitter::getBranchTargetOpValue(), getBranchTargetOpValue(), llvm::MipsMCCodeEmitter::getBranchTargetOpValue1SImm16(), llvm::MipsMCCodeEmitter::getBranchTargetOpValueLsl2MMR6(), llvm::MipsMCCodeEmitter::getBranchTargetOpValueMM(), llvm::MipsMCCodeEmitter::getBranchTargetOpValueMMPC10(), llvm::MipsMCCodeEmitter::getBranchTargetOpValueMMR6(), getCompoundCandidateGroup(), getCompoundInsn(), getCompoundOp(), getDRegFromQReg(), llvm::HexagonMCInstrInfo::getDuplexCandidateGroup(), llvm::HexagonMCInstrInfo::getDuplexPossibilties(), llvm::HexagonMCInstrInfo::getExtendableOperand(), getITDeprecationInfo(), llvm::MipsMCCodeEmitter::getJumpOffset16OpValue(), llvm::MipsMCCodeEmitter::getJumpTargetOpValue(), llvm::MipsMCCodeEmitter::getJumpTargetOpValueMM(), getLit64Encoding(), llvm::HexagonMCCodeEmitter::getMachineOpValue(), getMaskName(), getMCRDeprecationInfo(), llvm::MipsMCCodeEmitter::getMemEncoding(), llvm::MipsMCCodeEmitter::getMemEncodingMMGPImm7Lsl2(), llvm::MipsMCCodeEmitter::getMemEncodingMMImm11(), llvm::MipsMCCodeEmitter::getMemEncodingMMImm12(), llvm::MipsMCCodeEmitter::getMemEncodingMMImm16(), llvm::MipsMCCodeEmitter::getMemEncodingMMImm4(), llvm::MipsMCCodeEmitter::getMemEncodingMMImm4Lsl1(), llvm::MipsMCCodeEmitter::getMemEncodingMMImm4Lsl2(), llvm::MipsMCCodeEmitter::getMemEncodingMMImm4sp(), llvm::MipsMCCodeEmitter::getMemEncodingMMImm9(), llvm::MipsMCCodeEmitter::getMemEncodingMMSPImm5Lsl2(), llvm::MipsMCCodeEmitter::getMovePRegPairOpValue(), llvm::HexagonMCInstrInfo::getNewValueOperand(), llvm::HexagonMCInstrInfo::getNewValueOperand2(), llvm::AVRInstPrinter::getPrettyRegisterName(), getRealVLDOpcode(), llvm::MipsMCCodeEmitter::getRegisterListOpValue(), llvm::MipsMCCodeEmitter::getRegisterPairOpValue(), getRegOperandVectorVT(), getRelaxedOpcode(), getRetOpcode(), llvm::MipsMCCodeEmitter::getSimm18Lsl3Encoding(), llvm::MipsMCCodeEmitter::getSimm19Lsl2Encoding(), llvm::MipsMCCodeEmitter::getSimm23Lsl2Encoding(), llvm::MipsMCCodeEmitter::getSImm3Lsa2Value(), llvm::MipsMCCodeEmitter::getSImm9AddiuspValue(), llvm::MipsMCCodeEmitter::getSizeInsEncoding(), getSpecialRegForName(), llvm::MipsMCCodeEmitter::getUImm3Mod8Encoding(), llvm::MipsMCCodeEmitter::getUImm4AndValue(), llvm::MipsMCCodeEmitter::getUImm5Lsl2Encoding(), llvm::MipsMCCodeEmitter::getUImm6Lsl2Encoding(), llvm::MipsMCCodeEmitter::getUImmWithOffsetEncoding(), HasConditionalBranch(), llvm::MCInstrDesc::hasImplicitDefOfPhysReg(), HasSecRelSymbolRef(), llvm::HexagonAsmPrinter::HexagonProcessInstruction(), instIsBreakpoint(), llvm::HexagonMCInstrInfo::instruction(), Is32BitMemOperand(), Is64BitMemOperand(), llvm::HexagonMCInstrInfo::isBundle(), llvm::IsCPSRDead< MCInst >(), llvm::HexagonMCInstrInfo::isInnerLoop(), llvm::HexagonMCInstrInfo::isMemReorderDisabled(), llvm::HexagonMCInstrInfo::isMemStoreReorderEnabled(), isOrderedCompoundPair(), llvm::HexagonMCInstrInfo::isOrderedDuplexPair(), llvm::HexagonMCInstrInfo::isOuterLoop(), isPostIncrementForm(), isPreIncrementForm(), isReg(), isRegOrImmWithInputMods(), isShiftedUIntAtAnyPosition(), listContainsReg(), LLVMInitializeHexagonDisassembler(), LowerDins(), LowerLargeShift(), makeCombineInst(), llvm::MCInstrDesc::mayAffectControlFlow(), llvm::HexagonMCInstrInfo::minConstant(), needsPCRel(), nextReg(), PostOperandDecodeAdjust(), llvm::PPCInstPrinter::printAbsBranchOperand(), llvm::ARMInstPrinter::printAddrMode2OffsetOperand(), llvm::ARMInstPrinter::printAddrMode2Operand(), llvm::ARMInstPrinter::printAddrMode3OffsetOperand(), llvm::ARMInstPrinter::printAddrMode3Operand(), llvm::ARMInstPrinter::printAddrMode5FP16Operand(), llvm::ARMInstPrinter::printAddrMode5Operand(), llvm::ARMInstPrinter::printAddrMode6OffsetOperand(), llvm::ARMInstPrinter::printAddrMode6Operand(), llvm::ARMInstPrinter::printAddrMode7Operand(), llvm::ARMInstPrinter::printAddrModeImm12Operand(), llvm::ARMInstPrinter::printAddrModeTBB(), llvm::ARMInstPrinter::printAddrModeTBH(), llvm::AArch64InstPrinter::printAddSubImm(), llvm::ARMInstPrinter::printAdrLabelOperand(), llvm::AArch64InstPrinter::printAdrpLabel(), llvm::AArch64InstPrinter::printAlignedLabel(), llvm::ARMInstPrinter::printAM2PreOrOffsetIndexOp(), llvm::ARMInstPrinter::printAM3PreOrOffsetIndexOp(), llvm::AArch64InstPrinter::printAMIndexedWB(), llvm::AArch64InstPrinter::printAMNoIndex(), llvm::AArch64InstPrinter::printArithExtend(), llvm::PPCInstPrinter::printATBitsAsHint(), llvm::ARMInstPrinter::printBankedRegOperand(), llvm::AArch64InstPrinter::printBarrierOption(), llvm::ARMInstPrinter::printBitfieldInvMaskImmOperand(), llvm::PPCInstPrinter::printBranchOperand(), llvm::HexagonInstPrinter::printBrtarget(), llvm::MSP430InstPrinter::printCCOperand(), llvm::LanaiInstPrinter::printCCOperand(), llvm::SparcInstPrinter::printCCOperand(), llvm::ARMInstPrinter::printCImmediate(), llvm::NVPTXInstPrinter::printCmpMode(), llvm::AArch64InstPrinter::printCondCode(), llvm::HexagonInstPrinter::printConstantPool(), llvm::ARMInstPrinter::printCoprocOptionImm(), llvm::ARMInstPrinter::printCPSIFlag(), llvm::ARMInstPrinter::printCPSIMod(), llvm::PPCInstPrinter::printcrbitm(), llvm::NVPTXInstPrinter::printCvtMode(), printExpr(), llvm::AArch64InstPrinter::printExtendedRegister(), llvm::ARMInstPrinter::printFBits16(), llvm::ARMInstPrinter::printFBits32(), llvm::AArch64InstPrinter::printFPImmOperand(), llvm::ARMInstPrinter::printFPImmOperand(), llvm::ARMInstPrinter::printGPRPairOperand(), llvm::AArch64InstPrinter::printGPRSeqPairsClassOperand(), llvm::LanaiInstPrinter::printHi16AndImmOperand(), llvm::LanaiInstPrinter::printHi16ImmOperand(), llvm::AArch64InstPrinter::printImm(), llvm::BPFInstPrinter::printImm64Operand(), llvm::AArch64InstPrinter::printImmHex(), llvm::ARMInstPrinter::printImmPlusOneOperand(), llvm::AArch64InstPrinter::printImmScale(), llvm::ARMInstPrinter::printInst(), llvm::AArch64InstPrinter::printInst(), llvm::HexagonInstPrinter::printInst(), llvm::AMDGPUInstPrinter::printInst(), llvm::PPCInstPrinter::printInst(), llvm::WebAssemblyInstPrinter::printInst(), llvm::MipsInstPrinter::printInst(), llvm::AArch64AppleInstPrinter::printInst(), llvm::ARMInstPrinter::printInstSyncBOption(), llvm::AArch64InstPrinter::printInverseCondCode(), llvm::HexagonInstPrinter::printJumpTable(), llvm::NVPTXInstPrinter::printLdStCode(), llvm::ARMInstPrinter::printLdStmModeOperand(), llvm::LanaiInstPrinter::printLo16AndImmOperand(), llvm::AArch64InstPrinter::printLogicalImm32(), llvm::AArch64InstPrinter::printLogicalImm64(), llvm::ARMInstPrinter::printMandatoryPredicateOperand(), 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◆ getOperand() [2/2]

MCOperand& llvm::MCInst::getOperand ( unsigned  i)
inline

Definition at line 174 of file MCInst.h.

◆ insert()

iterator llvm::MCInst::insert ( iterator  I,
const MCOperand Op 
)
inline

◆ print()

void MCInst::print ( raw_ostream OS) const

Definition at line 45 of file MCInst.cpp.

Referenced by llvm::operator<<().

◆ setLoc()

void llvm::MCInst::setLoc ( SMLoc  loc)
inline

◆ setOpcode()

void llvm::MCInst::setOpcode ( unsigned  Op)
inline

Definition at line 167 of file MCInst.h.

Referenced by addNegOperand(), countMCSymbolRefExpr(), llvm::HexagonMCInstrInfo::createBundle(), Decode2OpInstructionFail(), DecodeAddiGroupBranch(), DecodeBgtzGroupBranch(), DecodeBgtzGroupBranchMMR6(), DecodeBgtzlGroupBranch(), DecodeBlezGroupBranch(), DecodeBlezGroupBranchMMR6(), DecodeBlezlGroupBranch(), DecodeBranchImmInstruction(), DecodeCPSInstruction(), DecodeDaddiGroupBranch(), DecodeL2OpInstructionFail(), DecodeL5RInstructionFail(), DecodeMemMultipleWritebackInstruction(), DecodePOP35GroupBranchMMR6(), DecodePOP37GroupBranchMMR6(), DecodePOP65GroupBranchMMR6(), DecodePOP75GroupBranchMMR6(), DecodeSETPANInstruction(), DecodeT2CPSInstruction(), DecodeT2LdStPre(), DecodeT2LoadImm12(), DecodeT2LoadImm8(), DecodeT2LoadLabel(), DecodeT2LoadShift(), DecodeT2LoadT(), DecodeThumb2BCCInstruction(), DecodeVCVTD(), DecodeVCVTQ(), llvm::HexagonMCInstrInfo::deriveDuplex(), llvm::HexagonMCInstrInfo::deriveExtender(), llvm::HexagonMCInstrInfo::deriveSubInst(), EmitBinary(), EmitCall(), llvm::MipsTargetELFStreamer::emitDirectiveCpLoad(), llvm::MipsTargetELFStreamer::emitDirectiveCpreturn(), llvm::MipsTargetStreamer::emitII(), llvm::ARMAsmPrinter::EmitInstruction(), llvm::NVPTXAsmPrinter::emitLineNumberAsDotLoc(), EmitNops(), llvm::MipsTargetStreamer::emitR(), llvm::MipsTargetStreamer::emitRRX(), llvm::MipsTargetStreamer::emitRX(), EmitSETHI(), llvm::MipsAsmPrinter::EmitStartOfAsmFile(), llvm::MipsMCCodeEmitter::encodeInstruction(), getCompoundInsn(), getDRegFromQReg(), llvm::ARMInstrInfo::getNoop(), llvm::Thumb1InstrInfo::getNoop(), llvm::Thumb2InstrInfo::getNoop(), llvm::AArch64InstrInfo::getNoop(), llvm::PPCInstrInfo::getNoop(), llvm::X86InstrInfo::getNoop(), getRealVLDOpcode(), getRelaxedOpcode(), getRetOpcode(), llvm::HexagonLowerToMC(), llvm::HexagonAsmPrinter::HexagonProcessInstruction(), incrementLoc(), IsSmallMemAccess(), LLVMInitializeHexagonDisassembler(), llvm::XCoreMCInstLower::Lower(), llvm::MipsMCInstLower::Lower(), llvm::SystemZMCInstLower::lower(), llvm::MSP430MCInstLower::Lower(), llvm::LanaiMCInstLower::Lower(), llvm::BPFMCInstLower::Lower(), llvm::AArch64MCInstLower::Lower(), llvm::AMDGPUMCInstLower::lower(), llvm::WebAssemblyMCInstLower::Lower(), llvm::LowerARMMachineInstrToMCInst(), LowerDins(), llvm::AVRMCInstLower::lowerInstruction(), LowerLargeShift(), llvm::MipsMCInstLower::LowerOperand(), llvm::LowerPPCMachineInstrToMCInst(), llvm::LowerSparcMachineInstrToMCInst(), makeCombineInst(), llvm::MCInstBuilder::MCInstBuilder(), nextReg(), llvm::HexagonMCInstrInfo::padEndloop(), llvm::ARMInstPrinter::printInst(), llvm::X86ATTInstPrinter::printInst(), llvm::HexagonInstPrinter::printInst(), llvm::ARMAsmBackend::relaxInstruction(), RewriteIntelBracExpression(), llvm::MipsAsmPrinter::runOnMachineFunction(), ScaleVectorOffset(), SimplifyMOVSX(), SimplifyShortImmForm(), SimplifyShortMoveForm(), stripRegisterPrefix(), translateImmediate(), and translateInstruction().

◆ size()

size_t llvm::MCInst::size ( ) const
inline

The documentation for this class was generated from the following files: