LLVM 19.0.0git
Namespaces | Macros | Functions | Variables
HexagonCopyToCombine.cpp File Reference
#include "HexagonInstrInfo.h"
#include "HexagonSubtarget.h"
#include "llvm/ADT/DenseMap.h"
#include "llvm/ADT/DenseSet.h"
#include "llvm/CodeGen/MachineBasicBlock.h"
#include "llvm/CodeGen/MachineFunction.h"
#include "llvm/CodeGen/MachineFunctionPass.h"
#include "llvm/CodeGen/MachineInstr.h"
#include "llvm/CodeGen/MachineInstrBuilder.h"
#include "llvm/CodeGen/Passes.h"
#include "llvm/CodeGen/TargetRegisterInfo.h"
#include "llvm/Pass.h"
#include "llvm/Support/CodeGen.h"
#include "llvm/Support/CommandLine.h"
#include "llvm/Support/Debug.h"
#include "llvm/Support/raw_ostream.h"
#include "llvm/Target/TargetMachine.h"

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Namespaces

namespace  llvm
 This is an optimization pass for GlobalISel generic memory operations.
 

Macros

#define DEBUG_TYPE   "hexagon-copy-combine"
 

Functions

FunctionPassllvm::createHexagonCopyToCombine ()
 
void llvm::initializeHexagonCopyToCombinePass (PassRegistry &)
 
 INITIALIZE_PASS (HexagonCopyToCombine, "hexagon-copy-combine", "Hexagon Copy-To-Combine Pass", false, false) static bool isCombinableInstType(MachineInstr &MI
 
template<unsigned N>
static bool isGreaterThanNBitTFRI (const MachineInstr &I)
 
static bool areCombinableOperations (const TargetRegisterInfo *TRI, MachineInstr &HighRegInst, MachineInstr &LowRegInst, bool AllowC64)
 areCombinableOperations - Returns true if the two instruction can be merge into a combine (ignoring register constraints).
 
static bool isEvenReg (unsigned Reg)
 
static void removeKillInfo (MachineInstr &MI, unsigned RegNotKilled)
 
static bool isUnsafeToMoveAcross (MachineInstr &MI, unsigned UseReg, unsigned DestReg, const TargetRegisterInfo *TRI)
 Returns true if it is unsafe to move a copy instruction from UseReg to DestReg over the instruction MI.
 
static Register UseReg (const MachineOperand &MO)
 

Variables

static cl::opt< boolIsCombinesDisabled ("disable-merge-into-combines", cl::Hidden, cl::desc("Disable merging into combines"))
 
static cl::opt< boolIsConst64Disabled ("disable-const64", cl::Hidden, cl::desc("Disable generation of const64"))
 
static cl::opt< unsignedMaxNumOfInstsBetweenNewValueStoreAndTFR ("max-num-inst-between-tfr-and-nv-store", cl::Hidden, cl::init(4), cl::desc("Maximum distance between a tfr feeding a store we " "consider the store still to be newifiable"))
 
const HexagonInstrInfoTII
 
const HexagonInstrInfo bool ShouldCombineAggressively
 

Macro Definition Documentation

◆ DEBUG_TYPE

#define DEBUG_TYPE   "hexagon-copy-combine"

Definition at line 34 of file HexagonCopyToCombine.cpp.

Function Documentation

◆ areCombinableOperations()

static bool areCombinableOperations ( const TargetRegisterInfo TRI,
MachineInstr HighRegInst,
MachineInstr LowRegInst,
bool  AllowC64 
)
static

areCombinableOperations - Returns true if the two instruction can be merge into a combine (ignoring register constraints).

Definition at line 181 of file HexagonCopyToCombine.cpp.

References llvm::MachineInstr::getOpcode(), llvm::MachineInstr::getOperand(), IsConst64Disabled, llvm::MachineOperand::isImm(), and llvm_unreachable.

◆ INITIALIZE_PASS()

INITIALIZE_PASS ( HexagonCopyToCombine  ,
"hexagon-copy-combine"  ,
"Hexagon Copy-To-Combine Pass"  ,
false  ,
false   
) &

◆ isEvenReg()

static bool isEvenReg ( unsigned  Reg)
static

◆ isGreaterThanNBitTFRI()

template<unsigned N>
static bool isGreaterThanNBitTFRI ( const MachineInstr I)
static

Definition at line 170 of file HexagonCopyToCombine.cpp.

References I.

◆ isUnsafeToMoveAcross()

static bool isUnsafeToMoveAcross ( MachineInstr MI,
unsigned  UseReg,
unsigned  DestReg,
const TargetRegisterInfo TRI 
)
static

Returns true if it is unsafe to move a copy instruction from UseReg to DestReg over the instruction MI.

Definition at line 243 of file HexagonCopyToCombine.cpp.

References MI, TRI, and UseReg().

◆ removeKillInfo()

static void removeKillInfo ( MachineInstr MI,
unsigned  RegNotKilled 
)
static

Definition at line 235 of file HexagonCopyToCombine.cpp.

References MI.

◆ UseReg()

static Register UseReg ( const MachineOperand MO)
static

Variable Documentation

◆ IsCombinesDisabled

cl::opt< bool > IsCombinesDisabled("disable-merge-into-combines", cl::Hidden, cl::desc("Disable merging into combines")) ( "disable-merge-into-combines"  ,
cl::Hidden  ,
cl::desc("Disable merging into combines")   
)
static

◆ IsConst64Disabled

cl::opt< bool > IsConst64Disabled("disable-const64", cl::Hidden, cl::desc("Disable generation of const64")) ( "disable-const64"  ,
cl::Hidden  ,
cl::desc("Disable generation of const64")   
)
static

Referenced by areCombinableOperations().

◆ MaxNumOfInstsBetweenNewValueStoreAndTFR

cl::opt< unsigned > MaxNumOfInstsBetweenNewValueStoreAndTFR("max-num-inst-between-tfr-and-nv-store", cl::Hidden, cl::init(4), cl::desc("Maximum distance between a tfr feeding a store we " "consider the store still to be newifiable")) ( "max-num-inst-between-tfr-and-nv-store"  ,
cl::Hidden  ,
cl::init(4)  ,
cl::desc("Maximum distance between a tfr feeding a store we " "consider the store still to be newifiable")   
)
static

◆ ShouldCombineAggressively

const HexagonInstrInfo bool ShouldCombineAggressively

Definition at line 126 of file HexagonCopyToCombine.cpp.

◆ TII

Definition at line 125 of file HexagonCopyToCombine.cpp.

Referenced by addDecorations(), llvm::SITargetLowering::AddIMGInit(), addImplicitDefs(), llvm::MachineBasicBlock::addLiveIn(), AdjustBaseAndOffset(), llvm::ARMFrameLowering::adjustForSegmentedStacks(), llvm::SITargetLowering::AdjustInstrPostInstrSelection(), llvm::ARMTargetLowering::AdjustInstrPostInstrSelection(), llvm::RISCVRegisterInfo::adjustReg(), llvm::SIFrameLowering::allocateScavengingFrameIndexesNearIncomingSP(), appendEndToFunction(), areCandidatesToMergeOrPair(), llvm::ARMBasicBlockUtils::ARMBasicBlockUtils(), llvm::SPIRVGlobalRegistry::assignIntTypeToVReg(), assignSections(), llvm::SPIRVGlobalRegistry::assignVectTypeToVReg(), attemptDebugCopyProp(), llvm::DwarfDebug::beginInstruction(), blockPrologueInterferes(), buildAddr64RSrc(), buildGitPtr(), buildMUBUFOffsetLoadStore(), buildOffsetSrc(), llvm::buildOpDecorate(), BuildPACM(), buildScratchExecCopy(), llvm::SIRegisterInfo::buildSpillLoadStore(), llvm::SITargetLowering::bundleInstWithWaitcnt(), canClobberPhysRegDefs(), canClobberReachingPhysRegUse(), canFoldCopy(), llvm::MachineBasicBlock::canSplitCriticalEdge(), llvm::AArch64PAuth::checkAuthenticatedRegister(), CheckForPhysRegDependency(), llvm::SITargetLowering::checkForPhysRegDependency(), llvm::checkVOPDRegConstraints(), CMSEPopCalleeSaves(), CMSEPushCalleeSaves(), CombineCVTAToLocal(), combineFPFusedMultiply(), combineRestoreADD(), combineRestoreOR(), combineRestoreSETHIi(), llvm::MachineFrameInfo::computeMaxCallFrameSize(), llvm::MachineInstrBuilder::constrainAllUses(), llvm::constrainOperandRegClass(), llvm::constrainSelectedInstRegOperands(), convertCalleeSaveRestoreToSPPrePostIncDec(), convertImplicitDefToConstZero(), copyDebugInfoToPredecessor(), copyDebugInfoToSuccessor(), createBBSelectReg(), llvm::createBURRListDAGScheduler(), createCall(), llvm::createCopyConstrainDAGMutation(), llvm::createHybridListDAGScheduler(), llvm::createILPListDAGScheduler(), llvm::createLoadClusterDAGMutation(), createPHIsForCMOVsInSinkBB(), createPHIsForSelects(), createPostIncLoadStore(), createScratchRegisterForInstruction(), llvm::createSourceListDAGScheduler(), llvm::createStoreClusterDAGMutation(), definedBySignExtendingOp(), definedByZeroExtendingOp(), llvm::TargetInstrInfo::describeLoadedValue(), describeORRLoadedValue(), llvm::ARMFrameLowering::determineCalleeSaves(), llvm::CSKYFrameLowering::determineCalleeSaves(), llvm::Mips16FrameLowering::determineCalleeSaves(), llvm::SIFrameLowering::determineCalleeSaves(), llvm::AArch64FrameLowering::eliminateCallFramePseudoInstr(), llvm::ARCFrameLowering::eliminateCallFramePseudoInstr(), llvm::PPCFrameLowering::eliminateCallFramePseudoInstr(), llvm::WebAssemblyFrameLowering::eliminateCallFramePseudoInstr(), llvm::XCoreFrameLowering::eliminateCallFramePseudoInstr(), llvm::SIFrameLowering::eliminateCallFramePseudoInstr(), llvm::Thumb1FrameLowering::eliminateCallFramePseudoInstr(), llvm::AVRFrameLowering::eliminateCallFramePseudoInstr(), llvm::AArch64RegisterInfo::eliminateFrameIndex(), llvm::ARCRegisterInfo::eliminateFrameIndex(), llvm::ARMBaseRegisterInfo::eliminateFrameIndex(), llvm::ThumbRegisterInfo::eliminateFrameIndex(), llvm::LanaiRegisterInfo::eliminateFrameIndex(), llvm::MSP430RegisterInfo::eliminateFrameIndex(), llvm::PPCRegisterInfo::eliminateFrameIndex(), llvm::SparcRegisterInfo::eliminateFrameIndex(), llvm::VERegisterInfo::eliminateFrameIndex(), llvm::XCoreRegisterInfo::eliminateFrameIndex(), llvm::SIRegisterInfo::eliminateFrameIndex(), llvm::CSKYRegisterInfo::eliminateFrameIndex(), llvm::SystemZRegisterInfo::eliminateFrameIndex(), llvm::AVRRegisterInfo::eliminateFrameIndex(), llvm::BPFRegisterInfo::eliminateFrameIndex(), llvm::LoongArchRegisterInfo::eliminateFrameIndex(), llvm::WebAssemblyRegisterInfo::eliminateFrameIndex(), emitAlignedDPRCS2Restores(), emitAlignedDPRCS2Spills(), emitAligningInstructions(), llvm::emitARMRegPlusImmediate(), llvm::PPCTargetLowering::EmitAtomicBinary(), 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forceReg(), FuseInst(), FuseTwoAddrInst(), llvm::AArch64InstrInfo::genAlternativeCodeSequence(), genAlternativeDpCodeSequence(), generateEndPgm(), generateStackAdjustment(), genFNegatedMAD(), genFusedMultiply(), genFusedMultiplyAcc(), genFusedMultiplyAccNeg(), genFusedMultiplyIdx(), genFusedMultiplyIdxNeg(), genIndexedMultiply(), genMaddR(), genNeg(), genSubAdd2SubSub(), genTPEntry(), genTPLoopBody(), getBBAddrMapMetadata(), getBBFallenThrough(), getCopyRewriter(), GetCostForDef(), llvm::getEHScopeMembership(), llvm::MachineBasicBlock::getFallThrough(), getFirstNonPrologue(), getFlatScratchSpillOpcode(), llvm::MachineInstr::getFoldedRestoreSize(), llvm::MachineInstr::getFoldedSpillSize(), llvm::getFunctionLiveInPhysReg(), llvm::ARMHazardRecognizerFPMLx::getHazardType(), getHWReg(), getIndirectSGPRIdx(), llvm::TargetSchedModel::getInstrInfo(), llvm::RegisterBankInfo::getInstrMappingImpl(), llvm::AVRInstrInfo::getInstSizeInBytes(), llvm::MSP430InstrInfo::getInstSizeInBytes(), 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llvm::R600RegisterInfo::getReservedRegs(), llvm::MachineInstr::getRestoreSize(), getSchedRegions(), llvm::ARMTargetLowering::getSchedulingPreference(), llvm::MachineInstr::getSpillSize(), getTargetFlagName(), getTargetIndexName(), getTargetMMOFlagName(), handleMIFlagDecoration(), hasAnyNonFlatUseOfReg(), hasSameValue(), llvm::HexagonHazardRecognizer::HexagonHazardRecognizer(), hoistAndMergeSGPRInits(), IfNeededExtSP(), IfNeededLDAWSP(), indirectCopyToAGPR(), llvm::PreRARematStage::initGCNSchedStage(), llvm::MipsFunctionInfo::initGlobalBaseReg(), llvm::ConvergingVLIWScheduler::initialize(), llvm::R600SchedStrategy::initialize(), INITIALIZE_PASS(), llvm::PPCFrameLowering::inlineStackProbe(), llvm::AArch64TargetLowering::insertCopiesSplitCSR(), llvm::SITargetLowering::insertCopiesSplitCSR(), insertCopy(), insertCSRRestores(), insertCSRSaves(), insertDeleteInstructions(), insertDivByZeroTrap(), InsertFPConstInst(), InsertFPImmInst(), InsertLDR_STR(), llvm::insertMultibyteShift(), InsertNewDef(), insertNoopsInBundle(), insertNopBeforeInstruction(), insertPHI(), llvm::SIInstrInfo::insertScratchExecCopy(), InsertSEH(), insertSEH(), insertSEHRange(), InsertSPConstInst(), InsertSPImmInst(), InsertUncondBranch(), insertUndefLaneMask(), InstReorderLimit(), interpretValues(), isAnalyzableBB(), isCallerPreservedOrConstPhysReg(), IsChainDependent(), isCopyOf(), isCopyOfBundle(), llvm::isCycleInvariant(), llvm::SIRegisterInfo::isFrameOffsetLegal(), isFuncOrHeaderInstr(), isLdOffsetInRangeOfSt(), llvm::isLegalAddressImm(), IsLegalOffset(), isLegalOrConvertableAddressImm(), isLibCallInTailPosition(), isLoadStoreThatCanHandleDisplacement(), llvm::MachineLoop::isLoopInvariant(), isNopCopy(), llvm::VirtRegAuxInfo::isRematerializable(), isSafeToFoldImmIntoCopy(), isSchedBoundary(), isSendMsgTraceDataOrGDS(), isSignExtended(), llvm::SystemZVectorConstantInfo::isVectorConstantLegal(), jumpTableHasOtherUses(), llvm::MipsLegalizerInfo::legalizeIntrinsic(), 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llvm::PPCRegisterInfo::lowerWACCSpilling(), lowerWaveReduce(), MakeM0Inst(), MatchingStackOffset(), llvm::AArch64RegisterInfo::materializeFrameBaseRegister(), llvm::SIRegisterInfo::materializeFrameBaseRegister(), llvm::ARMBaseRegisterInfo::materializeFrameBaseRegister(), llvm::PPCRegisterInfo::materializeFrameBaseRegister(), llvm::RISCVRegisterInfo::materializeFrameBaseRegister(), llvm::MachineInstr::mayAlias(), maybeRewriteToFallthrough(), llvm::ModuloScheduleExpander::ModuloScheduleExpander(), moveAndTeeForMultiUse(), llvm::SIRegisterInfo::needsFrameBaseReg(), llvm::SystemZELFFrameLowering::orderFrameObjects(), llvm::PeelSingleBlockLoop(), performCopyPropagation(), llvm::SITargetLowering::PerformDAGCombine(), popRegsFromStack(), llvm::SITargetLowering::PostISelFolding(), llvm::PPCRegisterInfo::prepareDynamicAlloca(), llvm::VETargetLowering::prepareMBB(), llvm::VETargetLowering::prepareSymbol(), llvm::MIPrinter::print(), llvm::MachineInstr::print(), llvm::MachineBasicBlock::print(), llvm::MachineOperand::print(), llvm::MachineMemOperand::print(), printMemOperand(), llvm::MachineOperand::printTargetFlags(), llvm::AArch64InstrInfo::probedStackAlloc(), llvm::AArch64FrameLowering::processFunctionBeforeFrameFinalized(), llvm::LoongArchFrameLowering::processFunctionBeforeFrameFinalized(), llvm::RISCVFrameLowering::processFunctionBeforeFrameFinalized(), llvm::SIFrameLowering::processFunctionBeforeFrameFinalized(), llvm::PrologEpilogSGPRSpillBuilder::PrologEpilogSGPRSpillBuilder(), pushRegsToStack(), readsLaneSubset(), llvm::TargetInstrInfo::reassociateOps(), llvm::MachineRegisterInfo::recomputeRegClass(), replaceFI(), replaceFrameIndex(), reportIllegalCopy(), llvm::AArch64FrameLowering::resetCFIToInitialState(), llvm::AArch64RegisterInfo::resolveFrameIndex(), llvm::SIRegisterInfo::resolveFrameIndex(), llvm::ARMBaseRegisterInfo::resolveFrameIndex(), llvm::ThumbRegisterInfo::resolveFrameIndex(), llvm::PPCRegisterInfo::resolveFrameIndex(), llvm::ResourceManager::ResourceManager(), llvm::SystemZELFFrameLowering::restoreCalleeSavedRegisters(), llvm::SystemZXPLINKFrameLowering::restoreCalleeSavedRegisters(), llvm::AArch64FrameLowering::restoreCalleeSavedRegisters(), llvm::Thumb1FrameLowering::restoreCalleeSavedRegisters(), llvm::AVRFrameLowering::restoreCalleeSavedRegisters(), llvm::CSKYFrameLowering::restoreCalleeSavedRegisters(), llvm::PPCFrameLowering::restoreCalleeSavedRegisters(), llvm::RISCVFrameLowering::restoreCalleeSavedRegisters(), llvm::XCoreFrameLowering::restoreCalleeSavedRegisters(), restoreCRs(), RestoreSpillList(), llvm::restoreStatusRegister(), llvm::RevertDoLoopStart(), llvm::RevertLoopDec(), llvm::RevertLoopEnd(), RevertWhileLoopSetup(), llvm::RevertWhileLoopStartLR(), llvm::rewriteAArch64FrameIndex(), llvm::rewriteARMFrameIndex(), llvm::ThumbRegisterInfo::rewriteFrameIndex(), llvm::rewriteT2FrameIndex(), rollbackRestoreSplit(), llvm::CFIFixup::runOnMachineFunction(), llvm::MachinePipeliner::runOnMachineFunction(), llvm::VirtRegMap::runOnMachineFunction(), llvm::InsertNOPLoad::runOnMachineFunction(), llvm::FixAllFDIVSQRT::runOnMachineFunction(), llvm::SPIRVModuleAnalysis::runOnModule(), llvm::MachineFunction::salvageCopySSA(), llvm::MachineFunction::salvageCopySSAImpl(), salvageDebugInfoFromEmptyBlock(), llvm::Mips16RegisterInfo::saveScavengerRegister(), selectCopy(), selectMergeValues(), selectUnmergeValues(), llvm::FunctionLoweringInfo::set(), setCallTargetReg(), setM0ToIndexFromSGPR(), llvm::VETargetLowering::setupEntryBlockForSjLj(), llvm::TargetRegisterInfo::shouldRegionSplitForVirtReg(), shouldRematerialize(), shouldScheduleVOPDAdjacent(), signOutlinedFunction(), SinkingPreventsImplicitNullCheck(), llvm::MachineBasicBlock::SkipPHIsAndLabels(), llvm::MachineBasicBlock::SkipPHIsLabelsAndDebug(), llvm::SystemZELFFrameLowering::spillCalleeSavedRegisters(), llvm::SystemZXPLINKFrameLowering::spillCalleeSavedRegisters(), llvm::AArch64FrameLowering::spillCalleeSavedRegisters(), llvm::Thumb1FrameLowering::spillCalleeSavedRegisters(), llvm::AVRFrameLowering::spillCalleeSavedRegisters(), llvm::CSKYFrameLowering::spillCalleeSavedRegisters(), llvm::LoongArchFrameLowering::spillCalleeSavedRegisters(), llvm::MipsSEFrameLowering::spillCalleeSavedRegisters(), llvm::PPCFrameLowering::spillCalleeSavedRegisters(), llvm::RISCVFrameLowering::spillCalleeSavedRegisters(), llvm::XCoreFrameLowering::spillCalleeSavedRegisters(), spillRegPairs(), spillVGPRtoAGPR(), llvm::MachineBasicBlock::SplitCriticalEdge(), splitEdge(), llvm::SITargetLowering::splitKillBlock(), splitMBB(), STATISTIC(), llvm::SystemZHazardRecognizer::SystemZHazardRecognizer(), tryChangeVGPRtoSGPRinCopy(), tryOptimizeLEAtoMOV(), tryToGetTargetInfo(), tryToSplitRestore(), unstackifyVRegsUsedInSplitBB(), updateBranches(), UpdateOperandRegClass(), updateOperandRegConstraints(), updateTerminator(), llvm::MachineBasicBlock::updateTerminator(), usedAsAddr(), vectorPseudoHasAllNBitUsers(), llvm::VirtRegAuxInfo::weightCalcHelper(), llvm::SITargetLowering::wrapAddr64Rsrc(), and llvm::WebAssemblyFrameLowering::writeSPToGlobal().