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Macros | Functions | Variables
SILowerControlFlow.cpp File Reference

This pass lowers the pseudo control flow instructions to real machine instructions. More...

#include "AMDGPU.h"
#include "AMDGPUSubtarget.h"
#include "SIInstrInfo.h"
#include "llvm/ADT/SmallVector.h"
#include "llvm/ADT/StringRef.h"
#include "llvm/CodeGen/LiveIntervalAnalysis.h"
#include "llvm/CodeGen/MachineBasicBlock.h"
#include "llvm/CodeGen/MachineFunction.h"
#include "llvm/CodeGen/MachineFunctionPass.h"
#include "llvm/CodeGen/MachineInstr.h"
#include "llvm/CodeGen/MachineInstrBuilder.h"
#include "llvm/CodeGen/MachineOperand.h"
#include "llvm/CodeGen/MachineRegisterInfo.h"
#include "llvm/CodeGen/Passes.h"
#include "llvm/CodeGen/SlotIndexes.h"
#include "llvm/CodeGen/TargetRegisterInfo.h"
#include "llvm/MC/MCRegisterInfo.h"
#include "llvm/Pass.h"
#include <cassert>
#include <iterator>
Include dependency graph for SILowerControlFlow.cpp:

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Macros

#define DEBUG_TYPE   "si-lower-control-flow"
 

Functions

 INITIALIZE_PASS (SILowerControlFlow, DEBUG_TYPE, "SI lower control flow", false, false) static void setImpSCCDefDead(MachineInstr &MI
 
 assert (ImpDefSCC.getReg()==AMDGPU::SCC &&ImpDefSCC.isDef())
 
ImpDefSCC setIsDead (IsDead)
 
static bool isSimpleIf (const MachineInstr &MI, const MachineRegisterInfo *MRI, const SIInstrInfo *TII)
 

Variables

bool IsDead
 

Detailed Description

This pass lowers the pseudo control flow instructions to real machine instructions.

All control flow is handled using predicated instructions and a predicate stack. Each Scalar ALU controls the operations of 64 Vector ALUs. The Scalar ALU can update the predicate for any of the Vector ALUs by writting to the 64-bit EXEC register (each bit corresponds to a single vector ALU). Typically, for predicates, a vector ALU will write to its bit of the VCC register (like EXEC VCC is 64-bits, one for each Vector ALU) and then the ScalarALU will AND the VCC register with the EXEC to update the predicates.

For example: VCC = V_CMP_GT_F32 VGPR1, VGPR2 SGPR0 = SI_IF VCC VGPR0 = V_ADD_F32 VGPR0, VGPR0 SGPR0 = SI_ELSE SGPR0 VGPR0 = V_SUB_F32 VGPR0, VGPR0 SI_END_CF SGPR0

becomes:

SGPR0 = S_AND_SAVEEXEC_B64 VCC // Save and update the exec mask SGPR0 = S_XOR_B64 SGPR0, EXEC // Clear live bits from saved exec mask S_CBRANCH_EXECZ label0 // This instruction is an optional // optimization which allows us to // branch if all the bits of // EXEC are zero. VGPR0 = V_ADD_F32 VGPR0, VGPR0 // Do the IF block of the branch

label0: SGPR0 = S_OR_SAVEEXEC_B64 EXEC // Restore the exec mask for the Then block EXEC = S_XOR_B64 SGPR0, EXEC // Clear live bits from saved exec mask S_BRANCH_EXECZ label1 // Use our branch optimization // instruction again. VGPR0 = V_SUB_F32 VGPR0, VGPR // Do the THEN block label1: EXEC = S_OR_B64 EXEC, SGPR0 // Re-enable saved exec mask bits

Definition in file SILowerControlFlow.cpp.

Macro Definition Documentation

◆ DEBUG_TYPE

#define DEBUG_TYPE   "si-lower-control-flow"

Definition at line 74 of file SILowerControlFlow.cpp.

Function Documentation

◆ assert()

assert ( ImpDefSCC.  getReg() = =AMDGPU::SCC &&ImpDefSCC.isDef())

Referenced by __jit_debug_register_code(), llvm::AArch64RegisterBankInfo::AArch64RegisterBankInfo(), llvm::GEPOperator::accumulateConstantOffset(), llvm::GetElementPtrInst::accumulateConstantOffset(), llvm::sys::MutexImpl::acquire(), llvm::StringTableBuilder::add(), false::Chain::add(), llvm::lto::LTO::add(), llvm::PMDataManager::add(), llvm::AliasSetTracker::add(), llvm::SCEVUnionPredicate::add(), llvm::LiveRangeUpdater::add(), llvm::APFloat::add(), llvm::ImutAVLFactory< ImutInfo >::add_internal(), llvm::cflaa::StratifiedSetsBuilder< T >::addAbove(), llvm::X86Operand::addAbsMemOperands(), llvm::AttrBuilder::addAlignmentAttr(), llvm::AttrBuilder::addAllocSizeAttrFromRawRepr(), llvm::cflaa::CFLGraph::addAttr(), llvm::AttrBuilder::addAttribute(), llvm::AttributeList::addAttributes(), llvm::SSAUpdater::AddAvailableValue(), llvm::X86Operand::addAVX512RCOperands(), llvm::ScheduleDAGInstrs::addBarrierChain(), llvm::DominanceFrontierBase< BasicBlock, false >::addBasicBlock(), llvm::LoopBase< BasicBlock, Loop >::addBasicBlockToLoop(), llvm::cflaa::StratifiedSetsBuilder< T >::addBelow(), llvm::LoopBase< BasicBlock, Loop >::addBlockEntry(), llvm::DwarfExpression::addBReg(), llvm::CallGraphNode::addCalledFunction(), llvm::SwitchInst::addCase(), llvm::codeview::DebugChecksumsSubsection::addChecksum(), llvm::DIE::addChild(), llvm::LoopBase< BasicBlock, Loop >::addChildLoop(), llvm::LPMUpdater::addChildLoops(), llvm::RecordKeeper::addClass(), llvm::LandingPadInst::addClause(), llvm::addClonedBlockToLoopInfo(), AddCombineTo64bitMLAL(), llvm::DwarfUnit::addConstantFPValue(), llvm::DwarfUnit::addConstantValue(), llvm::HexagonMCInstrInfo::addConstExtender(), llvm::GCOVBlock::addCount(), addData(), llvm::SelectionDAG::AddDbgValue(), llvm::RecordKeeper::addDef(), llvm::IndirectBrInst::addDestination(), llvm::GCOVBlock::addDstEdge(), llvm::X86Operand::addDstIdxOperands(), addEdge(), llvm::cflaa::CFLGraph::addEdge(), llvm::PBQP::Graph< RegAllocSolverImpl >::addEdge(), llvm::PBQP::Graph< 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llvm::LazyValueInfoWrapperPass::~LazyValueInfoWrapperPass(), llvm::LiveDebugVariables::~LiveDebugVariables(), llvm::MMIAddrLabelMap::~MMIAddrLabelMap(), llvm::sys::MutexImpl::~MutexImpl(), llvm::PrettyStackTraceEntry::~PrettyStackTraceEntry(), llvm::raw_fd_ostream::~raw_fd_ostream(), llvm::raw_ostream::~raw_ostream(), llvm::Recycler< llvm::MachineInstr >::~Recycler(), llvm::ReplaceableMetadataImpl::~ReplaceableMetadataImpl(), llvm::sys::RWMutexImpl::~RWMutexImpl(), llvm::ScalarEvolution::~ScalarEvolution(), llvm::SCEVExpander::~SCEVExpander(), llvm::ScopedHashTable< K, V, KInfo, AllocatorTy >::~ScopedHashTable(), llvm::ScopedHashTableScope< K, V, KInfo, AllocatorTy >::~ScopedHashTableScope(), llvm::SelectionDAG::~SelectionDAG(), llvm::SoftInstrProfErrors::~SoftInstrProfErrors(), llvm::StringPool::~StringPool(), llvm::sys::fs::TempFile::~TempFile(), llvm::lto::ThinBackendProc::~ThinBackendProc(), llvm::Value::~Value(), and llvm::ValueSymbolTable::~ValueSymbolTable().

◆ INITIALIZE_PASS()

INITIALIZE_PASS ( SILowerControlFlow  ,
DEBUG_TYPE  ,
"SI lower control flow"  ,
false  ,
false   
) &

◆ isSimpleIf()

static bool isSimpleIf ( const MachineInstr MI,
const MachineRegisterInfo MRI,
const SIInstrInfo TII 
)
static

Definition at line 137 of file SILowerControlFlow.cpp.

References llvm::ARM_AM::add, llvm::MachineInstrBuilder::add(), llvm::MachineInstr::addOperand(), llvm::MachineInstrBuilder::addReg(), assert(), llvm::MachineBasicBlock::begin(), llvm::MachineFunction::begin(), llvm::MCID::Branch, llvm::BuildMI(), llvm::tgtok::Def, llvm::MachineBasicBlock::end(), llvm::MachineFunction::end(), llvm::MachineInstr::eraseFromParent(), llvm::MachineInstr::explicit_operands(), llvm::MachineInstr::getDebugLoc(), llvm::MachineOperand::getImm(), llvm::SISubtarget::getInstrInfo(), llvm::ilist_node_impl< OptionsT >::getIterator(), llvm::MachineOperand::getMBB(), llvm::MachineInstr::getNumExplicitOperands(), llvm::MachineInstr::getOpcode(), llvm::MachineInstr::getOperand(), llvm::MachineInstr::getParent(), llvm::MachineBasicBlock::getParent(), llvm::MachineOperand::getReg(), llvm::MachineFunction::getRegInfo(), llvm::SISubtarget::getRegisterInfo(), llvm::MachineOperand::getSubReg(), llvm::MachineFunction::getSubtarget(), I, llvm::RegState::ImplicitDefine, llvm::detail::DenseSetImpl< ValueT, DenseMap< ValueT, detail::DenseSetEmpty, ValueInfoT, detail::DenseSetPair< ValueT > >, ValueInfoT >::insert(), llvm::MachineOperand::isDead(), llvm::MachineOperand::isDef(), llvm::MachineInstr::isFullCopy(), llvm::SIInstrInfo::isKillTerminator(), llvm::MachineOperand::isReg(), llvm::TargetRegisterInfo::isVirtualRegister(), llvm::RegState::Kill, MI, MRI, llvm::SmallVectorTemplateBase< T, isPodLike< T >::value >::push_back(), llvm::MachineInstr::RemoveOperand(), llvm::MachineInstr::setDesc(), llvm::ARM_MB::ST, llvm::MachineBasicBlock::succ_begin(), llvm::MachineBasicBlock::succ_end(), llvm::MachineBasicBlock::terminators(), TII, llvm::MachineRegisterInfo::use_instr_nodbg_begin(), and llvm::MachineRegisterInfo::use_instr_nodbg_end().

◆ setIsDead()

ImpDefSCC setIsDead ( IsDead  )

Variable Documentation

◆ IsDead

bool IsDead
Initial value:
{
MachineOperand &ImpDefSCC = MI.getOperand(3)
MachineOperand class - Representation of each machine instruction operand.
IRTranslator LLVM IR MI

Definition at line 128 of file SILowerControlFlow.cpp.

Referenced by llvm::rdf::DeadCodeElimination::collect(), llvm::rdf::Liveness::computePhiInfo(), llvm::rdf::Liveness::getAllReachedUses(), isPHIRegionIndex(), RematerializeCheapDef(), and swapRegAndNonRegOperand().